/src/capstonev5/arch/ARM/ARMGenAsmWriter.inc
| Line | Count | Source (jump to first uncovered line) | 
| 1 |  | /* Capstone Disassembly Engine, http://www.capstone-engine.org */ | 
| 2 |  | /* By Nguyen Anh Quynh <aquynh@gmail.com>, 2013-2019 */ | 
| 3 |  |  | 
| 4 |  | /*===- TableGen'erated file -------------------------------------*- C++ -*-===*\ | 
| 5 |  | |*                                                                            *| | 
| 6 |  | |* Assembly Writer Source Fragment                                            *| | 
| 7 |  | |*                                                                            *| | 
| 8 |  | |* Automatically generated file, do not edit!                                 *| | 
| 9 |  | |*                                                                            *| | 
| 10 |  | \*===----------------------------------------------------------------------===*/ | 
| 11 |  |  | 
| 12 |  | /// printInstruction - This method is automatically generated by tablegen | 
| 13 |  | /// from the instruction set description. | 
| 14 |  | static void printInstruction(MCInst *MI, SStream *O) | 
| 15 | 301k | { | 
| 16 | 301k | #ifndef CAPSTONE_DIET | 
| 17 | 301k |   static const char AsmStrs[] = { | 
| 18 | 301k |   /* 0 */ 's', 'h', 'a', '1', 's', 'u', '0', '.', '3', '2', 9, 0, | 
| 19 | 301k |   /* 12 */ 's', 'h', 'a', '2', '5', '6', 's', 'u', '0', '.', '3', '2', 9, 0, | 
| 20 | 301k |   /* 26 */ 's', 'h', 'a', '1', 's', 'u', '1', '.', '3', '2', 9, 0, | 
| 21 | 301k |   /* 38 */ 's', 'h', 'a', '2', '5', '6', 's', 'u', '1', '.', '3', '2', 9, 0, | 
| 22 | 301k |   /* 52 */ 's', 'h', 'a', '2', '5', '6', 'h', '2', '.', '3', '2', 9, 0, | 
| 23 | 301k |   /* 65 */ 's', 'h', 'a', '1', 'c', '.', '3', '2', 9, 0, | 
| 24 | 301k |   /* 75 */ 's', 'h', 'a', '1', 'h', '.', '3', '2', 9, 0, | 
| 25 | 301k |   /* 85 */ 's', 'h', 'a', '2', '5', '6', 'h', '.', '3', '2', 9, 0, | 
| 26 | 301k |   /* 97 */ 's', 'h', 'a', '1', 'm', '.', '3', '2', 9, 0, | 
| 27 | 301k |   /* 107 */ 's', 'h', 'a', '1', 'p', '.', '3', '2', 9, 0, | 
| 28 | 301k |   /* 117 */ 'v', 'c', 'v', 't', 'a', '.', 's', '3', '2', '.', 'f', '3', '2', 9, 0, | 
| 29 | 301k |   /* 132 */ 'v', 'c', 'v', 't', 'm', '.', 's', '3', '2', '.', 'f', '3', '2', 9, 0, | 
| 30 | 301k |   /* 147 */ 'v', 'c', 'v', 't', 'n', '.', 's', '3', '2', '.', 'f', '3', '2', 9, 0, | 
| 31 | 301k |   /* 162 */ 'v', 'c', 'v', 't', 'p', '.', 's', '3', '2', '.', 'f', '3', '2', 9, 0, | 
| 32 | 301k |   /* 177 */ 'v', 'c', 'v', 't', 'a', '.', 'u', '3', '2', '.', 'f', '3', '2', 9, 0, | 
| 33 | 301k |   /* 192 */ 'v', 'c', 'v', 't', 'm', '.', 'u', '3', '2', '.', 'f', '3', '2', 9, 0, | 
| 34 | 301k |   /* 207 */ 'v', 'c', 'v', 't', 'n', '.', 'u', '3', '2', '.', 'f', '3', '2', 9, 0, | 
| 35 | 301k |   /* 222 */ 'v', 'c', 'v', 't', 'p', '.', 'u', '3', '2', '.', 'f', '3', '2', 9, 0, | 
| 36 | 301k |   /* 237 */ 'v', 'c', 'm', 'l', 'a', '.', 'f', '3', '2', 9, 0, | 
| 37 | 301k |   /* 248 */ 'v', 'r', 'i', 'n', 't', 'a', '.', 'f', '3', '2', 9, 0, | 
| 38 | 301k |   /* 260 */ 'v', 'c', 'a', 'd', 'd', '.', 'f', '3', '2', 9, 0, | 
| 39 | 301k |   /* 271 */ 'v', 's', 'e', 'l', 'g', 'e', '.', 'f', '3', '2', 9, 0, | 
| 40 | 301k |   /* 283 */ 'v', 'm', 'i', 'n', 'n', 'm', '.', 'f', '3', '2', 9, 0, | 
| 41 | 301k |   /* 295 */ 'v', 'm', 'a', 'x', 'n', 'm', '.', 'f', '3', '2', 9, 0, | 
| 42 | 301k |   /* 307 */ 'v', 'r', 'i', 'n', 't', 'm', '.', 'f', '3', '2', 9, 0, | 
| 43 | 301k |   /* 319 */ 'v', 'r', 'i', 'n', 't', 'n', '.', 'f', '3', '2', 9, 0, | 
| 44 | 301k |   /* 331 */ 'v', 'r', 'i', 'n', 't', 'p', '.', 'f', '3', '2', 9, 0, | 
| 45 | 301k |   /* 343 */ 'v', 's', 'e', 'l', 'e', 'q', '.', 'f', '3', '2', 9, 0, | 
| 46 | 301k |   /* 355 */ 'v', 's', 'e', 'l', 'v', 's', '.', 'f', '3', '2', 9, 0, | 
| 47 | 301k |   /* 367 */ 'v', 's', 'e', 'l', 'g', 't', '.', 'f', '3', '2', 9, 0, | 
| 48 | 301k |   /* 379 */ 'v', 'r', 'i', 'n', 't', 'x', '.', 'f', '3', '2', 9, 0, | 
| 49 | 301k |   /* 391 */ 'v', 'r', 'i', 'n', 't', 'z', '.', 'f', '3', '2', 9, 0, | 
| 50 | 301k |   /* 403 */ 'l', 'd', 'c', '2', 9, 0, | 
| 51 | 301k |   /* 409 */ 'm', 'r', 'c', '2', 9, 0, | 
| 52 | 301k |   /* 415 */ 'm', 'r', 'r', 'c', '2', 9, 0, | 
| 53 | 301k |   /* 422 */ 's', 't', 'c', '2', 9, 0, | 
| 54 | 301k |   /* 428 */ 'c', 'd', 'p', '2', 9, 0, | 
| 55 | 301k |   /* 434 */ 'm', 'c', 'r', '2', 9, 0, | 
| 56 | 301k |   /* 440 */ 'm', 'c', 'r', 'r', '2', 9, 0, | 
| 57 | 301k |   /* 447 */ 'v', 'c', 'v', 't', 'a', '.', 's', '3', '2', '.', 'f', '6', '4', 9, 0, | 
| 58 | 301k |   /* 462 */ 'v', 'c', 'v', 't', 'm', '.', 's', '3', '2', '.', 'f', '6', '4', 9, 0, | 
| 59 | 301k |   /* 477 */ 'v', 'c', 'v', 't', 'n', '.', 's', '3', '2', '.', 'f', '6', '4', 9, 0, | 
| 60 | 301k |   /* 492 */ 'v', 'c', 'v', 't', 'p', '.', 's', '3', '2', '.', 'f', '6', '4', 9, 0, | 
| 61 | 301k |   /* 507 */ 'v', 'c', 'v', 't', 'a', '.', 'u', '3', '2', '.', 'f', '6', '4', 9, 0, | 
| 62 | 301k |   /* 522 */ 'v', 'c', 'v', 't', 'm', '.', 'u', '3', '2', '.', 'f', '6', '4', 9, 0, | 
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| 64 | 301k |   /* 552 */ 'v', 'c', 'v', 't', 'p', '.', 'u', '3', '2', '.', 'f', '6', '4', 9, 0, | 
| 65 | 301k |   /* 567 */ 'v', 'r', 'i', 'n', 't', 'a', '.', 'f', '6', '4', 9, 0, | 
| 66 | 301k |   /* 579 */ 'v', 's', 'e', 'l', 'g', 'e', '.', 'f', '6', '4', 9, 0, | 
| 67 | 301k |   /* 591 */ 'v', 'm', 'i', 'n', 'n', 'm', '.', 'f', '6', '4', 9, 0, | 
| 68 | 301k |   /* 603 */ 'v', 'm', 'a', 'x', 'n', 'm', '.', 'f', '6', '4', 9, 0, | 
| 69 | 301k |   /* 615 */ 'v', 'r', 'i', 'n', 't', 'm', '.', 'f', '6', '4', 9, 0, | 
| 70 | 301k |   /* 627 */ 'v', 'r', 'i', 'n', 't', 'n', '.', 'f', '6', '4', 9, 0, | 
| 71 | 301k |   /* 639 */ 'v', 'r', 'i', 'n', 't', 'p', '.', 'f', '6', '4', 9, 0, | 
| 72 | 301k |   /* 651 */ 'v', 's', 'e', 'l', 'e', 'q', '.', 'f', '6', '4', 9, 0, | 
| 73 | 301k |   /* 663 */ 'v', 's', 'e', 'l', 'v', 's', '.', 'f', '6', '4', 9, 0, | 
| 74 | 301k |   /* 675 */ 'v', 's', 'e', 'l', 'g', 't', '.', 'f', '6', '4', 9, 0, | 
| 75 | 301k |   /* 687 */ 'v', 'm', 'u', 'l', 'l', '.', 'p', '6', '4', 9, 0, | 
| 76 | 301k |   /* 698 */ 'v', 'c', 'v', 't', 'a', '.', 's', '3', '2', '.', 'f', '1', '6', 9, 0, | 
| 77 | 301k |   /* 713 */ 'v', 'c', 'v', 't', 'm', '.', 's', '3', '2', '.', 'f', '1', '6', 9, 0, | 
| 78 | 301k |   /* 728 */ 'v', 'c', 'v', 't', 'n', '.', 's', '3', '2', '.', 'f', '1', '6', 9, 0, | 
| 79 | 301k |   /* 743 */ 'v', 'c', 'v', 't', 'p', '.', 's', '3', '2', '.', 'f', '1', '6', 9, 0, | 
| 80 | 301k |   /* 758 */ 'v', 'c', 'v', 't', 'a', '.', 'u', '3', '2', '.', 'f', '1', '6', 9, 0, | 
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| 82 | 301k |   /* 788 */ 'v', 'c', 'v', 't', 'n', '.', 'u', '3', '2', '.', 'f', '1', '6', 9, 0, | 
| 83 | 301k |   /* 803 */ 'v', 'c', 'v', 't', 'p', '.', 'u', '3', '2', '.', 'f', '1', '6', 9, 0, | 
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| 90 | 301k |   /* 908 */ 'v', 'c', 'v', 't', 'n', '.', 'u', '1', '6', '.', 'f', '1', '6', 9, 0, | 
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| 100 | 301k |   /* 1032 */ 'v', 'r', 'i', 'n', 't', 'p', '.', 'f', '1', '6', 9, 0, | 
| 101 | 301k |   /* 1044 */ 'v', 's', 'e', 'l', 'e', 'q', '.', 'f', '1', '6', 9, 0, | 
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| 107 | 301k |   /* 1113 */ 'v', 'r', 'i', 'n', 't', 'z', '.', 'f', '1', '6', 9, 0, | 
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| 109 | 301k |   /* 1135 */ 'a', 'e', 's', 'm', 'c', '.', '8', 9, 0, | 
| 110 | 301k |   /* 1144 */ 'a', 'e', 's', 'd', '.', '8', 9, 0, | 
| 111 | 301k |   /* 1152 */ 'a', 'e', 's', 'e', '.', '8', 9, 0, | 
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| 114 | 301k |   /* 1180 */ 'r', 'f', 'e', 'd', 'a', 9, 0, | 
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| 117 | 301k |   /* 1202 */ 'c', 'r', 'c', '3', '2', 'c', 'b', 9, 0, | 
| 118 | 301k |   /* 1211 */ 'r', 'f', 'e', 'd', 'b', 9, 0, | 
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| 121 | 301k |   /* 1230 */ 'd', 's', 'b', 9, 0, | 
| 122 | 301k |   /* 1235 */ 'i', 's', 'b', 9, 0, | 
| 123 | 301k |   /* 1240 */ 't', 's', 'b', 9, 0, | 
| 124 | 301k |   /* 1245 */ 'h', 'v', 'c', 9, 0, | 
| 125 | 301k |   /* 1250 */ 'p', 'l', 'd', 9, 0, | 
| 126 | 301k |   /* 1255 */ 's', 'e', 't', 'e', 'n', 'd', 9, 0, | 
| 127 | 301k |   /* 1263 */ 'u', 'd', 'f', 9, 0, | 
| 128 | 301k |   /* 1268 */ 'c', 'r', 'c', '3', '2', 'h', 9, 0, | 
| 129 | 301k |   /* 1276 */ 'c', 'r', 'c', '3', '2', 'c', 'h', 9, 0, | 
| 130 | 301k |   /* 1285 */ 'p', 'l', 'i', 9, 0, | 
| 131 | 301k |   /* 1290 */ 'l', 'd', 'c', '2', 'l', 9, 0, | 
| 132 | 301k |   /* 1297 */ 's', 't', 'c', '2', 'l', 9, 0, | 
| 133 | 301k |   /* 1304 */ 'b', 'l', 9, 0, | 
| 134 | 301k |   /* 1308 */ 's', 'e', 't', 'p', 'a', 'n', 9, 0, | 
| 135 | 301k |   /* 1316 */ 'c', 'p', 's', 9, 0, | 
| 136 | 301k |   /* 1321 */ 'm', 'o', 'v', 's', 9, 0, | 
| 137 | 301k |   /* 1327 */ 'h', 'l', 't', 9, 0, | 
| 138 | 301k |   /* 1332 */ 'b', 'k', 'p', 't', 9, 0, | 
| 139 | 301k |   /* 1338 */ 'h', 'v', 'c', '.', 'w', 9, 0, | 
| 140 | 301k |   /* 1345 */ 'u', 'd', 'f', '.', 'w', 9, 0, | 
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| 142 | 301k |   /* 1360 */ 'c', 'r', 'c', '3', '2', 'c', 'w', 9, 0, | 
| 143 | 301k |   /* 1369 */ 'p', 'l', 'd', 'w', 9, 0, | 
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| 145 | 301k |   /* 1379 */ 'b', 'l', 'x', 9, 0, | 
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| 147 | 301k |   /* 1389 */ 'c', 'b', 'n', 'z', 9, 0, | 
| 148 | 301k |   /* 1395 */ 's', 'r', 's', 'd', 'a', 9, 's', 'p', '!', ',', 32, 0, | 
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| 150 | 301k |   /* 1419 */ 's', 'r', 's', 'd', 'b', 9, 's', 'p', '!', ',', 32, 0, | 
| 151 | 301k |   /* 1431 */ 's', 'r', 's', 'i', 'b', 9, 's', 'p', '!', ',', 32, 0, | 
| 152 | 301k |   /* 1443 */ 's', 'r', 's', 'd', 'a', 9, 's', 'p', ',', 32, 0, | 
| 153 | 301k |   /* 1454 */ 's', 'r', 's', 'i', 'a', 9, 's', 'p', ',', 32, 0, | 
| 154 | 301k |   /* 1465 */ 's', 'r', 's', 'd', 'b', 9, 's', 'p', ',', 32, 0, | 
| 155 | 301k |   /* 1476 */ 's', 'r', 's', 'i', 'b', 9, 's', 'p', ',', 32, 0, | 
| 156 | 301k |   /* 1487 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'F', 'u', 'n', 'c', 't', 'i', 'o', 'n', 32, 'P', 'a', 't', 'c', 'h', 'a', 'b', 'l', 'e', 32, 'R', 'E', 'T', '.', 0, | 
| 157 | 301k |   /* 1518 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'T', 'y', 'p', 'e', 'd', 32, 'E', 'v', 'e', 'n', 't', 32, 'L', 'o', 'g', '.', 0, | 
| 158 | 301k |   /* 1542 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'C', 'u', 's', 't', 'o', 'm', 32, 'E', 'v', 'e', 'n', 't', 32, 'L', 'o', 'g', '.', 0, | 
| 159 | 301k |   /* 1567 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'F', 'u', 'n', 'c', 't', 'i', 'o', 'n', 32, 'E', 'n', 't', 'e', 'r', '.', 0, | 
| 160 | 301k |   /* 1590 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'T', 'a', 'i', 'l', 32, 'C', 'a', 'l', 'l', 32, 'E', 'x', 'i', 't', '.', 0, | 
| 161 | 301k |   /* 1613 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'F', 'u', 'n', 'c', 't', 'i', 'o', 'n', 32, 'E', 'x', 'i', 't', '.', 0, | 
| 162 | 301k |   /* 1635 */ '_', '_', 'b', 'r', 'k', 'd', 'i', 'v', '0', 0, | 
| 163 | 301k |   /* 1645 */ 'v', 'l', 'd', '1', 0, | 
| 164 | 301k |   /* 1650 */ 'd', 'c', 'p', 's', '1', 0, | 
| 165 | 301k |   /* 1656 */ 'v', 's', 't', '1', 0, | 
| 166 | 301k |   /* 1661 */ 'v', 'r', 'e', 'v', '3', '2', 0, | 
| 167 | 301k |   /* 1668 */ 'l', 'd', 'c', '2', 0, | 
| 168 | 301k |   /* 1673 */ 'm', 'r', 'c', '2', 0, | 
| 169 | 301k |   /* 1678 */ 'm', 'r', 'r', 'c', '2', 0, | 
| 170 | 301k |   /* 1684 */ 's', 't', 'c', '2', 0, | 
| 171 | 301k |   /* 1689 */ 'v', 'l', 'd', '2', 0, | 
| 172 | 301k |   /* 1694 */ 'c', 'd', 'p', '2', 0, | 
| 173 | 301k |   /* 1699 */ 'm', 'c', 'r', '2', 0, | 
| 174 | 301k |   /* 1704 */ 'm', 'c', 'r', 'r', '2', 0, | 
| 175 | 301k |   /* 1710 */ 'd', 'c', 'p', 's', '2', 0, | 
| 176 | 301k |   /* 1716 */ 'v', 's', 't', '2', 0, | 
| 177 | 301k |   /* 1721 */ 'v', 'l', 'd', '3', 0, | 
| 178 | 301k |   /* 1726 */ 'd', 'c', 'p', 's', '3', 0, | 
| 179 | 301k |   /* 1732 */ 'v', 's', 't', '3', 0, | 
| 180 | 301k |   /* 1737 */ 'v', 'r', 'e', 'v', '6', '4', 0, | 
| 181 | 301k |   /* 1744 */ 'v', 'l', 'd', '4', 0, | 
| 182 | 301k |   /* 1749 */ 'v', 's', 't', '4', 0, | 
| 183 | 301k |   /* 1754 */ 's', 'x', 't', 'a', 'b', '1', '6', 0, | 
| 184 | 301k |   /* 1762 */ 'u', 'x', 't', 'a', 'b', '1', '6', 0, | 
| 185 | 301k |   /* 1770 */ 's', 'x', 't', 'b', '1', '6', 0, | 
| 186 | 301k |   /* 1777 */ 'u', 'x', 't', 'b', '1', '6', 0, | 
| 187 | 301k |   /* 1784 */ 's', 'h', 's', 'u', 'b', '1', '6', 0, | 
| 188 | 301k |   /* 1792 */ 'u', 'h', 's', 'u', 'b', '1', '6', 0, | 
| 189 | 301k |   /* 1800 */ 'u', 'q', 's', 'u', 'b', '1', '6', 0, | 
| 190 | 301k |   /* 1808 */ 's', 's', 'u', 'b', '1', '6', 0, | 
| 191 | 301k |   /* 1815 */ 'u', 's', 'u', 'b', '1', '6', 0, | 
| 192 | 301k |   /* 1822 */ 's', 'h', 'a', 'd', 'd', '1', '6', 0, | 
| 193 | 301k |   /* 1830 */ 'u', 'h', 'a', 'd', 'd', '1', '6', 0, | 
| 194 | 301k |   /* 1838 */ 'u', 'q', 'a', 'd', 'd', '1', '6', 0, | 
| 195 | 301k |   /* 1846 */ 's', 'a', 'd', 'd', '1', '6', 0, | 
| 196 | 301k |   /* 1853 */ 'u', 'a', 'd', 'd', '1', '6', 0, | 
| 197 | 301k |   /* 1860 */ 's', 's', 'a', 't', '1', '6', 0, | 
| 198 | 301k |   /* 1867 */ 'u', 's', 'a', 't', '1', '6', 0, | 
| 199 | 301k |   /* 1874 */ 'v', 'r', 'e', 'v', '1', '6', 0, | 
| 200 | 301k |   /* 1881 */ 'u', 's', 'a', 'd', 'a', '8', 0, | 
| 201 | 301k |   /* 1888 */ 's', 'h', 's', 'u', 'b', '8', 0, | 
| 202 | 301k |   /* 1895 */ 'u', 'h', 's', 'u', 'b', '8', 0, | 
| 203 | 301k |   /* 1902 */ 'u', 'q', 's', 'u', 'b', '8', 0, | 
| 204 | 301k |   /* 1909 */ 's', 's', 'u', 'b', '8', 0, | 
| 205 | 301k |   /* 1915 */ 'u', 's', 'u', 'b', '8', 0, | 
| 206 | 301k |   /* 1921 */ 'u', 's', 'a', 'd', '8', 0, | 
| 207 | 301k |   /* 1927 */ 's', 'h', 'a', 'd', 'd', '8', 0, | 
| 208 | 301k |   /* 1934 */ 'u', 'h', 'a', 'd', 'd', '8', 0, | 
| 209 | 301k |   /* 1941 */ 'u', 'q', 'a', 'd', 'd', '8', 0, | 
| 210 | 301k |   /* 1948 */ 's', 'a', 'd', 'd', '8', 0, | 
| 211 | 301k |   /* 1954 */ 'u', 'a', 'd', 'd', '8', 0, | 
| 212 | 301k |   /* 1960 */ 'L', 'I', 'F', 'E', 'T', 'I', 'M', 'E', '_', 'E', 'N', 'D', 0, | 
| 213 | 301k |   /* 1973 */ 'B', 'U', 'N', 'D', 'L', 'E', 0, | 
| 214 | 301k |   /* 1980 */ 'D', 'B', 'G', '_', 'V', 'A', 'L', 'U', 'E', 0, | 
| 215 | 301k |   /* 1990 */ 'D', 'B', 'G', '_', 'L', 'A', 'B', 'E', 'L', 0, | 
| 216 | 301k |   /* 2000 */ '@', 32, 'C', 'O', 'M', 'P', 'I', 'L', 'E', 'R', 32, 'B', 'A', 'R', 'R', 'I', 'E', 'R', 0, | 
| 217 | 301k |   /* 2019 */ 'L', 'I', 'F', 'E', 'T', 'I', 'M', 'E', '_', 'S', 'T', 'A', 'R', 'T', 0, | 
| 218 | 301k |   /* 2034 */ 'v', 'a', 'b', 'a', 0, | 
| 219 | 301k |   /* 2039 */ 'l', 'd', 'a', 0, | 
| 220 | 301k |   /* 2043 */ 'l', 'd', 'm', 'd', 'a', 0, | 
| 221 | 301k |   /* 2049 */ 's', 't', 'm', 'd', 'a', 0, | 
| 222 | 301k |   /* 2055 */ 'r', 'f', 'e', 'i', 'a', 0, | 
| 223 | 301k |   /* 2061 */ 'v', 'l', 'd', 'm', 'i', 'a', 0, | 
| 224 | 301k |   /* 2068 */ 'v', 's', 't', 'm', 'i', 'a', 0, | 
| 225 | 301k |   /* 2075 */ 's', 'r', 's', 'i', 'a', 0, | 
| 226 | 301k |   /* 2081 */ 's', 'm', 'm', 'l', 'a', 0, | 
| 227 | 301k |   /* 2087 */ 'v', 'n', 'm', 'l', 'a', 0, | 
| 228 | 301k |   /* 2093 */ 'v', 'm', 'l', 'a', 0, | 
| 229 | 301k |   /* 2098 */ 'v', 'f', 'm', 'a', 0, | 
| 230 | 301k |   /* 2103 */ 'v', 'f', 'n', 'm', 'a', 0, | 
| 231 | 301k |   /* 2109 */ 'v', 'r', 's', 'r', 'a', 0, | 
| 232 | 301k |   /* 2115 */ 'v', 's', 'r', 'a', 0, | 
| 233 | 301k |   /* 2120 */ 't', 't', 'a', 0, | 
| 234 | 301k |   /* 2124 */ 'l', 'd', 'a', 'b', 0, | 
| 235 | 301k |   /* 2129 */ 's', 'x', 't', 'a', 'b', 0, | 
| 236 | 301k |   /* 2135 */ 'u', 'x', 't', 'a', 'b', 0, | 
| 237 | 301k |   /* 2141 */ 's', 'm', 'l', 'a', 'b', 'b', 0, | 
| 238 | 301k |   /* 2148 */ 's', 'm', 'l', 'a', 'l', 'b', 'b', 0, | 
| 239 | 301k |   /* 2156 */ 's', 'm', 'u', 'l', 'b', 'b', 0, | 
| 240 | 301k |   /* 2163 */ 't', 'b', 'b', 0, | 
| 241 | 301k |   /* 2167 */ 'r', 'f', 'e', 'd', 'b', 0, | 
| 242 | 301k |   /* 2173 */ 'v', 'l', 'd', 'm', 'd', 'b', 0, | 
| 243 | 301k |   /* 2180 */ 'v', 's', 't', 'm', 'd', 'b', 0, | 
| 244 | 301k |   /* 2187 */ 's', 'r', 's', 'd', 'b', 0, | 
| 245 | 301k |   /* 2193 */ 'l', 'd', 'm', 'i', 'b', 0, | 
| 246 | 301k |   /* 2199 */ 's', 't', 'm', 'i', 'b', 0, | 
| 247 | 301k |   /* 2205 */ 's', 't', 'l', 'b', 0, | 
| 248 | 301k |   /* 2210 */ 'd', 'm', 'b', 0, | 
| 249 | 301k |   /* 2214 */ 's', 'w', 'p', 'b', 0, | 
| 250 | 301k |   /* 2219 */ 'l', 'd', 'r', 'b', 0, | 
| 251 | 301k |   /* 2224 */ 's', 't', 'r', 'b', 0, | 
| 252 | 301k |   /* 2229 */ 'd', 's', 'b', 0, | 
| 253 | 301k |   /* 2233 */ 'i', 's', 'b', 0, | 
| 254 | 301k |   /* 2237 */ 'l', 'd', 'r', 's', 'b', 0, | 
| 255 | 301k |   /* 2243 */ 't', 's', 'b', 0, | 
| 256 | 301k |   /* 2247 */ 's', 'm', 'l', 'a', 't', 'b', 0, | 
| 257 | 301k |   /* 2254 */ 'p', 'k', 'h', 't', 'b', 0, | 
| 258 | 301k |   /* 2260 */ 's', 'm', 'l', 'a', 'l', 't', 'b', 0, | 
| 259 | 301k |   /* 2268 */ 's', 'm', 'u', 'l', 't', 'b', 0, | 
| 260 | 301k |   /* 2275 */ 'v', 'c', 'v', 't', 'b', 0, | 
| 261 | 301k |   /* 2281 */ 's', 'x', 't', 'b', 0, | 
| 262 | 301k |   /* 2286 */ 'u', 'x', 't', 'b', 0, | 
| 263 | 301k |   /* 2291 */ 'q', 'd', 's', 'u', 'b', 0, | 
| 264 | 301k |   /* 2297 */ 'v', 'h', 's', 'u', 'b', 0, | 
| 265 | 301k |   /* 2303 */ 'v', 'q', 's', 'u', 'b', 0, | 
| 266 | 301k |   /* 2309 */ 'v', 's', 'u', 'b', 0, | 
| 267 | 301k |   /* 2314 */ 's', 'm', 'l', 'a', 'w', 'b', 0, | 
| 268 | 301k |   /* 2321 */ 's', 'm', 'u', 'l', 'w', 'b', 0, | 
| 269 | 301k |   /* 2328 */ 'l', 'd', 'a', 'e', 'x', 'b', 0, | 
| 270 | 301k |   /* 2335 */ 's', 't', 'l', 'e', 'x', 'b', 0, | 
| 271 | 301k |   /* 2342 */ 'l', 'd', 'r', 'e', 'x', 'b', 0, | 
| 272 | 301k |   /* 2349 */ 's', 't', 'r', 'e', 'x', 'b', 0, | 
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| 274 | 301k |   /* 2360 */ 'a', 'd', 'c', 0, | 
| 275 | 301k |   /* 2364 */ 'l', 'd', 'c', 0, | 
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| 280 | 301k |   /* 2385 */ 'm', 'r', 'r', 'c', 0, | 
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| 324 | 301k |   /* 2640 */ 'l', 'd', 'r', 'h', 0, | 
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| 525 | 301k |   static const uint32_t OpInfo0[] = { | 
| 526 | 301k |     0U, // PHI | 
| 527 | 301k |     0U, // INLINEASM | 
| 528 | 301k |     0U, // CFI_INSTRUCTION | 
| 529 | 301k |     0U, // EH_LABEL | 
| 530 | 301k |     0U, // GC_LABEL | 
| 531 | 301k |     0U, // ANNOTATION_LABEL | 
| 532 | 301k |     0U, // KILL | 
| 533 | 301k |     0U, // EXTRACT_SUBREG | 
| 534 | 301k |     0U, // INSERT_SUBREG | 
| 535 | 301k |     0U, // IMPLICIT_DEF | 
| 536 | 301k |     0U, // SUBREG_TO_REG | 
| 537 | 301k |     0U, // COPY_TO_REGCLASS | 
| 538 | 301k |     1981U,  // DBG_VALUE | 
| 539 | 301k |     1991U,  // DBG_LABEL | 
| 540 | 301k |     0U, // REG_SEQUENCE | 
| 541 | 301k |     0U, // COPY | 
| 542 | 301k |     1974U,  // BUNDLE | 
| 543 | 301k |     2020U,  // LIFETIME_START | 
| 544 | 301k |     1961U,  // LIFETIME_END | 
| 545 | 301k |     0U, // STACKMAP | 
| 546 | 301k |     2862U,  // FENTRY_CALL | 
| 547 | 301k |     0U, // PATCHPOINT | 
| 548 | 301k |     0U, // LOAD_STACK_GUARD | 
| 549 | 301k |     0U, // STATEPOINT | 
| 550 | 301k |     0U, // LOCAL_ESCAPE | 
| 551 | 301k |     0U, // FAULTING_OP | 
| 552 | 301k |     0U, // PATCHABLE_OP | 
| 553 | 301k |     1568U,  // PATCHABLE_FUNCTION_ENTER | 
| 554 | 301k |     1488U,  // PATCHABLE_RET | 
| 555 | 301k |     1614U,  // PATCHABLE_FUNCTION_EXIT | 
| 556 | 301k |     1591U,  // PATCHABLE_TAIL_CALL | 
| 557 | 301k |     1543U,  // PATCHABLE_EVENT_CALL | 
| 558 | 301k |     1519U,  // PATCHABLE_TYPED_EVENT_CALL | 
| 559 | 301k |     0U, // ICALL_BRANCH_FUNNEL | 
| 560 | 301k |     0U, // G_ADD | 
| 561 | 301k |     0U, // G_SUB | 
| 562 | 301k |     0U, // G_MUL | 
| 563 | 301k |     0U, // G_SDIV | 
| 564 | 301k |     0U, // G_UDIV | 
| 565 | 301k |     0U, // G_SREM | 
| 566 | 301k |     0U, // G_UREM | 
| 567 | 301k |     0U, // G_AND | 
| 568 | 301k |     0U, // G_OR | 
| 569 | 301k |     0U, // G_XOR | 
| 570 | 301k |     0U, // G_IMPLICIT_DEF | 
| 571 | 301k |     0U, // G_PHI | 
| 572 | 301k |     0U, // G_FRAME_INDEX | 
| 573 | 301k |     0U, // G_GLOBAL_VALUE | 
| 574 | 301k |     0U, // G_EXTRACT | 
| 575 | 301k |     0U, // G_UNMERGE_VALUES | 
| 576 | 301k |     0U, // G_INSERT | 
| 577 | 301k |     0U, // G_MERGE_VALUES | 
| 578 | 301k |     0U, // G_PTRTOINT | 
| 579 | 301k |     0U, // G_INTTOPTR | 
| 580 | 301k |     0U, // G_BITCAST | 
| 581 | 301k |     0U, // G_LOAD | 
| 582 | 301k |     0U, // G_SEXTLOAD | 
| 583 | 301k |     0U, // G_ZEXTLOAD | 
| 584 | 301k |     0U, // G_STORE | 
| 585 | 301k |     0U, // G_ATOMIC_CMPXCHG_WITH_SUCCESS | 
| 586 | 301k |     0U, // G_ATOMIC_CMPXCHG | 
| 587 | 301k |     0U, // G_ATOMICRMW_XCHG | 
| 588 | 301k |     0U, // G_ATOMICRMW_ADD | 
| 589 | 301k |     0U, // G_ATOMICRMW_SUB | 
| 590 | 301k |     0U, // G_ATOMICRMW_AND | 
| 591 | 301k |     0U, // G_ATOMICRMW_NAND | 
| 592 | 301k |     0U, // G_ATOMICRMW_OR | 
| 593 | 301k |     0U, // G_ATOMICRMW_XOR | 
| 594 | 301k |     0U, // G_ATOMICRMW_MAX | 
| 595 | 301k |     0U, // G_ATOMICRMW_MIN | 
| 596 | 301k |     0U, // G_ATOMICRMW_UMAX | 
| 597 | 301k |     0U, // G_ATOMICRMW_UMIN | 
| 598 | 301k |     0U, // G_BRCOND | 
| 599 | 301k |     0U, // G_BRINDIRECT | 
| 600 | 301k |     0U, // G_INTRINSIC | 
| 601 | 301k |     0U, // G_INTRINSIC_W_SIDE_EFFECTS | 
| 602 | 301k |     0U, // G_ANYEXT | 
| 603 | 301k |     0U, // G_TRUNC | 
| 604 | 301k |     0U, // G_CONSTANT | 
| 605 | 301k |     0U, // G_FCONSTANT | 
| 606 | 301k |     0U, // G_VASTART | 
| 607 | 301k |     0U, // G_VAARG | 
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| 609 | 301k |     0U, // G_ZEXT | 
| 610 | 301k |     0U, // G_SHL | 
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| 612 | 301k |     0U, // G_ASHR | 
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| 615 | 301k |     0U, // G_SELECT | 
| 616 | 301k |     0U, // G_UADDE | 
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| 623 | 301k |     0U, // G_SMULH | 
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| 629 | 301k |     0U, // G_FREM | 
| 630 | 301k |     0U, // G_FPOW | 
| 631 | 301k |     0U, // G_FEXP | 
| 632 | 301k |     0U, // G_FEXP2 | 
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| 634 | 301k |     0U, // G_FLOG2 | 
| 635 | 301k |     0U, // G_FNEG | 
| 636 | 301k |     0U, // G_FPEXT | 
| 637 | 301k |     0U, // G_FPTRUNC | 
| 638 | 301k |     0U, // G_FPTOSI | 
| 639 | 301k |     0U, // G_FPTOUI | 
| 640 | 301k |     0U, // G_SITOFP | 
| 641 | 301k |     0U, // G_UITOFP | 
| 642 | 301k |     0U, // G_FABS | 
| 643 | 301k |     0U, // G_GEP | 
| 644 | 301k |     0U, // G_PTR_MASK | 
| 645 | 301k |     0U, // G_BR | 
| 646 | 301k |     0U, // G_INSERT_VECTOR_ELT | 
| 647 | 301k |     0U, // G_EXTRACT_VECTOR_ELT | 
| 648 | 301k |     0U, // G_SHUFFLE_VECTOR | 
| 649 | 301k |     0U, // G_BSWAP | 
| 650 | 301k |     0U, // G_ADDRSPACE_CAST | 
| 651 | 301k |     0U, // G_BLOCK_ADDR | 
| 652 | 301k |     0U, // ABS | 
| 653 | 301k |     0U, // ADDSri | 
| 654 | 301k |     0U, // ADDSrr | 
| 655 | 301k |     0U, // ADDSrsi | 
| 656 | 301k |     0U, // ADDSrsr | 
| 657 | 301k |     0U, // ADJCALLSTACKDOWN | 
| 658 | 301k |     0U, // ADJCALLSTACKUP | 
| 659 | 301k |     7292U,  // ASRi | 
| 660 | 301k |     7292U,  // ASRr | 
| 661 | 301k |     0U, // B | 
| 662 | 301k |     0U, // BCCZi64 | 
| 663 | 301k |     0U, // BCCi64 | 
| 664 | 301k |     0U, // BMOVPCB_CALL | 
| 665 | 301k |     0U, // BMOVPCRX_CALL | 
| 666 | 301k |     0U, // BR_JTadd | 
| 667 | 301k |     0U, // BR_JTm_i12 | 
| 668 | 301k |     0U, // BR_JTm_rs | 
| 669 | 301k |     0U, // BR_JTr | 
| 670 | 301k |     0U, // BX_CALL | 
| 671 | 301k |     0U, // CMP_SWAP_16 | 
| 672 | 301k |     0U, // CMP_SWAP_32 | 
| 673 | 301k |     0U, // CMP_SWAP_64 | 
| 674 | 301k |     0U, // CMP_SWAP_8 | 
| 675 | 301k |     0U, // CONSTPOOL_ENTRY | 
| 676 | 301k |     0U, // COPY_STRUCT_BYVAL_I32 | 
| 677 | 301k |     2001U,  // CompilerBarrier | 
| 678 | 301k |     16788832U,  // ITasm | 
| 679 | 301k |     0U, // Int_eh_sjlj_dispatchsetup | 
| 680 | 301k |     0U, // Int_eh_sjlj_longjmp | 
| 681 | 301k |     0U, // Int_eh_sjlj_setjmp | 
| 682 | 301k |     0U, // Int_eh_sjlj_setjmp_nofp | 
| 683 | 301k |     0U, // Int_eh_sjlj_setup_dispatch | 
| 684 | 301k |     0U, // JUMPTABLE_ADDRS | 
| 685 | 301k |     0U, // JUMPTABLE_INSTS | 
| 686 | 301k |     0U, // JUMPTABLE_TBB | 
| 687 | 301k |     0U, // JUMPTABLE_TBH | 
| 688 | 301k |     0U, // LDMIA_RET | 
| 689 | 301k |     15656U, // LDRBT_POST | 
| 690 | 301k |     15443U, // LDRConstPool | 
| 691 | 301k |     0U, // LDRLIT_ga_abs | 
| 692 | 301k |     0U, // LDRLIT_ga_pcrel | 
| 693 | 301k |     0U, // LDRLIT_ga_pcrel_ldr | 
| 694 | 301k |     15735U, // LDRT_POST | 
| 695 | 301k |     0U, // LEApcrel | 
| 696 | 301k |     0U, // LEApcrelJT | 
| 697 | 301k |     7013U,  // LSLi | 
| 698 | 301k |     7013U,  // LSLr | 
| 699 | 301k |     7299U,  // LSRi | 
| 700 | 301k |     7299U,  // LSRr | 
| 701 | 301k |     0U, // MEMCPY | 
| 702 | 301k |     0U, // MLAv5 | 
| 703 | 301k |     0U, // MOVCCi | 
| 704 | 301k |     0U, // MOVCCi16 | 
| 705 | 301k |     0U, // MOVCCi32imm | 
| 706 | 301k |     0U, // MOVCCr | 
| 707 | 301k |     0U, // MOVCCsi | 
| 708 | 301k |     0U, // MOVCCsr | 
| 709 | 301k |     0U, // MOVPCRX | 
| 710 | 301k |     0U, // MOVTi16_ga_pcrel | 
| 711 | 301k |     0U, // MOV_ga_pcrel | 
| 712 | 301k |     0U, // MOV_ga_pcrel_ldr | 
| 713 | 301k |     0U, // MOVi16_ga_pcrel | 
| 714 | 301k |     0U, // MOVi32imm | 
| 715 | 301k |     0U, // MOVsra_flag | 
| 716 | 301k |     0U, // MOVsrl_flag | 
| 717 | 301k |     0U, // MULv5 | 
| 718 | 301k |     0U, // MVNCCi | 
| 719 | 301k |     0U, // PICADD | 
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| 723 | 301k |     0U, // PICLDRSB | 
| 724 | 301k |     0U, // PICLDRSH | 
| 725 | 301k |     0U, // PICSTR | 
| 726 | 301k |     0U, // PICSTRB | 
| 727 | 301k |     0U, // PICSTRH | 
| 728 | 301k |     7278U,  // RORi | 
| 729 | 301k |     7278U,  // RORr | 
| 730 | 301k |     0U, // RRX | 
| 731 | 301k |     20136U, // RRXi | 
| 732 | 301k |     0U, // RSBSri | 
| 733 | 301k |     0U, // RSBSrsi | 
| 734 | 301k |     0U, // RSBSrsr | 
| 735 | 301k |     0U, // SMLALv5 | 
| 736 | 301k |     0U, // SMULLv5 | 
| 737 | 301k |     0U, // SPACE | 
| 738 | 301k |     15662U, // STRBT_POST | 
| 739 | 301k |     0U, // STRBi_preidx | 
| 740 | 301k |     0U, // STRBr_preidx | 
| 741 | 301k |     0U, // STRH_preidx | 
| 742 | 301k |     15746U, // STRT_POST | 
| 743 | 301k |     0U, // STRi_preidx | 
| 744 | 301k |     0U, // STRr_preidx | 
| 745 | 301k |     0U, // SUBS_PC_LR | 
| 746 | 301k |     0U, // SUBSri | 
| 747 | 301k |     0U, // SUBSrr | 
| 748 | 301k |     0U, // SUBSrsi | 
| 749 | 301k |     0U, // SUBSrsr | 
| 750 | 301k |     0U, // TAILJMPd | 
| 751 | 301k |     0U, // TAILJMPr | 
| 752 | 301k |     0U, // TAILJMPr4 | 
| 753 | 301k |     0U, // TCRETURNdi | 
| 754 | 301k |     0U, // TCRETURNri | 
| 755 | 301k |     0U, // TPsoft | 
| 756 | 301k |     0U, // UMLALv5 | 
| 757 | 301k |     0U, // UMULLv5 | 
| 758 | 301k |     153198U,  // VLD1LNdAsm_16 | 
| 759 | 301k |     284270U,  // VLD1LNdAsm_32 | 
| 760 | 301k |     415342U,  // VLD1LNdAsm_8 | 
| 761 | 301k |     153198U,  // VLD1LNdWB_fixed_Asm_16 | 
| 762 | 301k |     284270U,  // VLD1LNdWB_fixed_Asm_32 | 
| 763 | 301k |     415342U,  // VLD1LNdWB_fixed_Asm_8 | 
| 764 | 301k |     157294U,  // VLD1LNdWB_register_Asm_16 | 
| 765 | 301k |     288366U,  // VLD1LNdWB_register_Asm_32 | 
| 766 | 301k |     419438U,  // VLD1LNdWB_register_Asm_8 | 
| 767 | 301k |     153242U,  // VLD2LNdAsm_16 | 
| 768 | 301k |     284314U,  // VLD2LNdAsm_32 | 
| 769 | 301k |     415386U,  // VLD2LNdAsm_8 | 
| 770 | 301k |     153242U,  // VLD2LNdWB_fixed_Asm_16 | 
| 771 | 301k |     284314U,  // VLD2LNdWB_fixed_Asm_32 | 
| 772 | 301k |     415386U,  // VLD2LNdWB_fixed_Asm_8 | 
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| 780 | 301k |     157338U,  // VLD2LNqWB_register_Asm_16 | 
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| 782 | 301k |     1107457722U,  // VLD3DUPdAsm_16 | 
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| 1063 | 301k |     539726U,  // ADR | 
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| 1069 | 301k |     530859U,  // ANDrr | 
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| 1075 | 301k |     530758U,  // BICrr | 
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| 1078 | 301k |     828725U,  // BKPT | 
| 1079 | 301k |     828697U,  // BL | 
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| 1082 | 301k |     828772U,  // BLXi | 
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| 1089 | 301k |     201907225U, // CDP | 
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| 1096 | 301k |     547775U,  // CMNzrsr | 
| 1097 | 301k |     539683U,  // CMPri | 
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| 1099 | 301k |     556067U,  // CMPrsi | 
| 1100 | 301k |     547875U,  // CMPrsr | 
| 1101 | 301k |     828709U,  // CPS1p | 
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| 1104 | 301k |     185246891U, // CRC32B | 
| 1105 | 301k |     185246899U, // CRC32CB | 
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| 1107 | 301k |     185247057U, // CRC32CW | 
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| 1110 | 301k |     1074313739U,  // DBG | 
| 1111 | 301k |     66762U, // DMB | 
| 1112 | 301k |     66767U, // DSB | 
| 1113 | 301k |     531562U,  // EORri | 
| 1114 | 301k |     531562U,  // EORrr | 
| 1115 | 301k |     560234U,  // EORrsi | 
| 1116 | 301k |     40042U, // EORrsr | 
| 1117 | 301k |     838971U,  // ERET | 
| 1118 | 301k |     1326595561U,  // FCONSTD | 
| 1119 | 301k |     1326726633U,  // FCONSTH | 
| 1120 | 301k |     1326857705U,  // FCONSTS | 
| 1121 | 301k |     2332573243U,  // FLDMXDB_UPD | 
| 1122 | 301k |     572932U,  // FLDMXIA | 
| 1123 | 301k |     2332573188U,  // FLDMXIA_UPD | 
| 1124 | 301k |     1625313U, // FMSTAT | 
| 1125 | 301k |     2332573251U,  // FSTMXDB_UPD | 
| 1126 | 301k |     572940U,  // FSTMXIA | 
| 1127 | 301k |     2332573196U,  // FSTMXIA_UPD | 
| 1128 | 301k |     1074314610U,  // HINT | 
| 1129 | 301k |     828720U,  // HLT | 
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| 1137 | 301k |     539263U,  // LDAEXH | 
| 1138 | 301k |     539165U,  // LDAH | 
| 1139 | 301k |     286975243U, // LDC2L_OFFSET | 
| 1140 | 301k |     3524977931U,  // LDC2L_OPTION | 
| 1141 | 301k |     303752459U, // LDC2L_POST | 
| 1142 | 301k |     320529675U, // LDC2L_PRE | 
| 1143 | 301k |     286974356U, // LDC2_OFFSET | 
| 1144 | 301k |     3524977044U,  // LDC2_OPTION | 
| 1145 | 301k |     303751572U, // LDC2_POST | 
| 1146 | 301k |     320528788U, // LDC2_PRE | 
| 1147 | 301k |     1275615989U,  // LDCL_OFFSET | 
| 1148 | 301k |     1275615989U,  // LDCL_OPTION | 
| 1149 | 301k |     1275615989U,  // LDCL_POST | 
| 1150 | 301k |     1275615989U,  // LDCL_PRE | 
| 1151 | 301k |     1275615549U,  // LDC_OFFSET | 
| 1152 | 301k |     1275615549U,  // LDC_OPTION | 
| 1153 | 301k |     1275615549U,  // LDC_POST | 
| 1154 | 301k |     1275615549U,  // LDC_PRE | 
| 1155 | 301k |     571388U,  // LDMDA | 
| 1156 | 301k |     2332571644U,  // LDMDA_UPD | 
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| 1158 | 301k |     2332571775U,  // LDMDB_UPD | 
| 1159 | 301k |     572300U,  // LDMIA | 
| 1160 | 301k |     2332572556U,  // LDMIA_UPD | 
| 1161 | 301k |     571538U,  // LDMIB | 
| 1162 | 301k |     2332571794U,  // LDMIB_UPD | 
| 1163 | 301k |     552232U,  // LDRBT_POST_IMM | 
| 1164 | 301k |     552232U,  // LDRBT_POST_REG | 
| 1165 | 301k |     551084U,  // LDRB_POST_IMM | 
| 1166 | 301k |     551084U,  // LDRB_POST_REG | 
| 1167 | 301k |     546988U,  // LDRB_PRE_IMM | 
| 1168 | 301k |     551084U,  // LDRB_PRE_REG | 
| 1169 | 301k |     555180U,  // LDRBi12 | 
| 1170 | 301k |     546988U,  // LDRBrs | 
| 1171 | 301k |     551343U,  // LDRD | 
| 1172 | 301k |     580015U,  // LDRD_POST | 
| 1173 | 301k |     580015U,  // LDRD_PRE | 
| 1174 | 301k |     540296U,  // LDREX | 
| 1175 | 301k |     538919U,  // LDREXB | 
| 1176 | 301k |     268974547U, // LDREXD | 
| 1177 | 301k |     539277U,  // LDREXH | 
| 1178 | 301k |     547409U,  // LDRH | 
| 1179 | 301k |     548171U,  // LDRHTi | 
| 1180 | 301k |     552267U,  // LDRHTr | 
| 1181 | 301k |     551505U,  // LDRH_POST | 
| 1182 | 301k |     551505U,  // LDRH_PRE | 
| 1183 | 301k |     547006U,  // LDRSB | 
| 1184 | 301k |     548148U,  // LDRSBTi | 
| 1185 | 301k |     552244U,  // LDRSBTr | 
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| 1187 | 301k |     551102U,  // LDRSB_PRE | 
| 1188 | 301k |     547428U,  // LDRSH | 
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| 1190 | 301k |     552279U,  // LDRSHTr | 
| 1191 | 301k |     551524U,  // LDRSH_POST | 
| 1192 | 301k |     551524U,  // LDRSH_PRE | 
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| 1194 | 301k |     552311U,  // LDRT_POST_REG | 
| 1195 | 301k |     552019U,  // LDR_POST_IMM | 
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| 1198 | 301k |     552019U,  // LDR_PRE_REG | 
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| 1200 | 301k |     556115U,  // LDRi12 | 
| 1201 | 301k |     547923U,  // LDRrs | 
| 1202 | 301k |     201907274U, // MCR | 
| 1203 | 301k |     168878515U, // MCR2 | 
| 1204 | 301k |     201878642U, // MCRR | 
| 1205 | 301k |     168878521U, // MCRR2 | 
| 1206 | 301k |     559140U,  // MLA | 
| 1207 | 301k |     548021U,  // MLS | 
| 1208 | 301k |     1887722U, // MOVPCLR | 
| 1209 | 301k |     556471U,  // MOVTi16 | 
| 1210 | 301k |     544234U,  // MOVi | 
| 1211 | 301k |     540159U,  // MOVi16 | 
| 1212 | 301k |     544234U,  // MOVr | 
| 1213 | 301k |     544234U,  // MOVr_TC | 
| 1214 | 301k |     531946U,  // MOVsi | 
| 1215 | 301k |     560618U,  // MOVsr | 
| 1216 | 301k |     336124238U, // MRC | 
| 1217 | 301k |     74138U, // MRC2 | 
| 1218 | 301k |     352872786U, // MRRC | 
| 1219 | 301k |     78240U, // MRRC2 | 
| 1220 | 301k |     2148056290U,  // MRS | 
| 1221 | 301k |     539874U,  // MRSbanked | 
| 1222 | 301k |     3221798114U,  // MRSsys | 
| 1223 | 301k |     369638536U, // MSR | 
| 1224 | 301k |     386415752U, // MSRbanked | 
| 1225 | 301k |     369638536U, // MSRi | 
| 1226 | 301k |     531317U,  // MUL | 
| 1227 | 301k |     543747U,  // MVNi | 
| 1228 | 301k |     543747U,  // MVNr | 
| 1229 | 301k |     531459U,  // MVNsi | 
| 1230 | 301k |     560131U,  // MVNsr | 
| 1231 | 301k |     531576U,  // ORRri | 
| 1232 | 301k |     531576U,  // ORRrr | 
| 1233 | 301k |     560248U,  // ORRrsi | 
| 1234 | 301k |     40056U, // ORRrsr | 
| 1235 | 301k |     548115U,  // PKHBT | 
| 1236 | 301k |     547023U,  // PKHTB | 
| 1237 | 301k |     83290U, // PLDWi12 | 
| 1238 | 301k |     87386U, // PLDWrs | 
| 1239 | 301k |     83171U, // PLDi12 | 
| 1240 | 301k |     87267U, // PLDrs | 
| 1241 | 301k |     83206U, // PLIi12 | 
| 1242 | 301k |     87302U, // PLIrs | 
| 1243 | 301k |     555406U,  // QADD | 
| 1244 | 301k |     554800U,  // QADD16 | 
| 1245 | 301k |     554903U,  // QADD8 | 
| 1246 | 301k |     556729U,  // QASX | 
| 1247 | 301k |     555380U,  // QDADD | 
| 1248 | 301k |     555252U,  // QDSUB | 
| 1249 | 301k |     556588U,  // QSAX | 
| 1250 | 301k |     555265U,  // QSUB | 
| 1251 | 301k |     554762U,  // QSUB16 | 
| 1252 | 301k |     554864U,  // QSUB8 | 
| 1253 | 301k |     539998U,  // RBIT | 
| 1254 | 301k |     540118U,  // REV | 
| 1255 | 301k |     538452U,  // REV16 | 
| 1256 | 301k |     539247U,  // REVSH | 
| 1257 | 301k |     828573U,  // RFEDA | 
| 1258 | 301k |     2008221U, // RFEDA_UPD | 
| 1259 | 301k |     828604U,  // RFEDB | 
| 1260 | 301k |     2008252U, // RFEDB_UPD | 
| 1261 | 301k |     828580U,  // RFEIA | 
| 1262 | 301k |     2008228U, // RFEIA_UPD | 
| 1263 | 301k |     828611U,  // RFEIB | 
| 1264 | 301k |     2008259U, // RFEIB_UPD | 
| 1265 | 301k |     530624U,  // RSBri | 
| 1266 | 301k |     530624U,  // RSBrr | 
| 1267 | 301k |     559296U,  // RSBrsi | 
| 1268 | 301k |     39104U, // RSBrsr | 
| 1269 | 301k |     530775U,  // RSCri | 
| 1270 | 301k |     530775U,  // RSCrr | 
| 1271 | 301k |     559447U,  // RSCrsi | 
| 1272 | 301k |     39255U, // RSCrsr | 
| 1273 | 301k |     554807U,  // SADD16 | 
| 1274 | 301k |     554909U,  // SADD8 | 
| 1275 | 301k |     556734U,  // SASX | 
| 1276 | 301k |     530741U,  // SBCri | 
| 1277 | 301k |     530741U,  // SBCrr | 
| 1278 | 301k |     559413U,  // SBCrsi | 
| 1279 | 301k |     39221U, // SBCrsr | 
| 1280 | 301k |     548506U,  // SBFX | 
| 1281 | 301k |     556506U,  // SDIV | 
| 1282 | 301k |     555794U,  // SEL | 
| 1283 | 301k |     91368U, // SETEND | 
| 1284 | 301k |     828701U,  // SETPAN | 
| 1285 | 301k |     168468546U, // SHA1C | 
| 1286 | 301k |     1258987596U,  // SHA1H | 
| 1287 | 301k |     168468578U, // SHA1M | 
| 1288 | 301k |     168468588U, // SHA1P | 
| 1289 | 301k |     168468481U, // SHA1SU0 | 
| 1290 | 301k |     1242210331U,  // SHA1SU1 | 
| 1291 | 301k |     168468566U, // SHA256H | 
| 1292 | 301k |     168468533U, // SHA256H2 | 
| 1293 | 301k |     1242210317U,  // SHA256SU0 | 
| 1294 | 301k |     168468519U, // SHA256SU1 | 
| 1295 | 301k |     554783U,  // SHADD16 | 
| 1296 | 301k |     554888U,  // SHADD8 | 
| 1297 | 301k |     556716U,  // SHASX | 
| 1298 | 301k |     556575U,  // SHSAX | 
| 1299 | 301k |     554745U,  // SHSUB16 | 
| 1300 | 301k |     554849U,  // SHSUB8 | 
| 1301 | 301k |     1074313546U,  // SMC | 
| 1302 | 301k |     546910U,  // SMLABB | 
| 1303 | 301k |     548108U,  // SMLABT | 
| 1304 | 301k |     547171U,  // SMLAD | 
| 1305 | 301k |     548432U,  // SMLADX | 
| 1306 | 301k |     96984U, // SMLAL | 
| 1307 | 301k |     579685U,  // SMLALBB | 
| 1308 | 301k |     580889U,  // SMLALBT | 
| 1309 | 301k |     579992U,  // SMLALD | 
| 1310 | 301k |     581214U,  // SMLALDX | 
| 1311 | 301k |     579797U,  // SMLALTB | 
| 1312 | 301k |     581011U,  // SMLALTT | 
| 1313 | 301k |     547016U,  // SMLATB | 
| 1314 | 301k |     548236U,  // SMLATT | 
| 1315 | 301k |     547083U,  // SMLAWB | 
| 1316 | 301k |     548284U,  // SMLAWT | 
| 1317 | 301k |     547257U,  // SMLSD | 
| 1318 | 301k |     548462U,  // SMLSDX | 
| 1319 | 301k |     580003U,  // SMLSLD | 
| 1320 | 301k |     581222U,  // SMLSLDX | 
| 1321 | 301k |     546850U,  // SMMLA | 
| 1322 | 301k |     547907U,  // SMMLAR | 
| 1323 | 301k |     548019U,  // SMMLS | 
| 1324 | 301k |     547968U,  // SMMLSR | 
| 1325 | 301k |     555891U,  // SMMUL | 
| 1326 | 301k |     556130U,  // SMMULR | 
| 1327 | 301k |     555369U,  // SMUAD | 
| 1328 | 301k |     556631U,  // SMUADX | 
| 1329 | 301k |     555117U,  // SMULBB | 
| 1330 | 301k |     556321U,  // SMULBT | 
| 1331 | 301k |     559946U,  // SMULL | 
| 1332 | 301k |     555229U,  // SMULTB | 
| 1333 | 301k |     556443U,  // SMULTT | 
| 1334 | 301k |     555282U,  // SMULWB | 
| 1335 | 301k |     556483U,  // SMULWT | 
| 1336 | 301k |     555455U,  // SMUSD | 
| 1337 | 301k |     556661U,  // SMUSDX | 
| 1338 | 301k |     828836U,  // SRSDA | 
| 1339 | 301k |     828788U,  // SRSDA_UPD | 
| 1340 | 301k |     828858U,  // SRSDB | 
| 1341 | 301k |     828812U,  // SRSDB_UPD | 
| 1342 | 301k |     828847U,  // SRSIA | 
| 1343 | 301k |     828800U,  // SRSIA_UPD | 
| 1344 | 301k |     828869U,  // SRSIB | 
| 1345 | 301k |     828824U,  // SRSIB_UPD | 
| 1346 | 301k |     548093U,  // SSAT | 
| 1347 | 301k |     554821U,  // SSAT16 | 
| 1348 | 301k |     556593U,  // SSAX | 
| 1349 | 301k |     554769U,  // SSUB16 | 
| 1350 | 301k |     554870U,  // SSUB8 | 
| 1351 | 301k |     286975250U, // STC2L_OFFSET | 
| 1352 | 301k |     3524977938U,  // STC2L_OPTION | 
| 1353 | 301k |     303752466U, // STC2L_POST | 
| 1354 | 301k |     320529682U, // STC2L_PRE | 
| 1355 | 301k |     286974375U, // STC2_OFFSET | 
| 1356 | 301k |     3524977063U,  // STC2_OPTION | 
| 1357 | 301k |     303751591U, // STC2_POST | 
| 1358 | 301k |     320528807U, // STC2_PRE | 
| 1359 | 301k |     1275615994U,  // STCL_OFFSET | 
| 1360 | 301k |     1275615994U,  // STCL_OPTION | 
| 1361 | 301k |     1275615994U,  // STCL_POST | 
| 1362 | 301k |     1275615994U,  // STCL_PRE | 
| 1363 | 301k |     1275615579U,  // STC_OFFSET | 
| 1364 | 301k |     1275615579U,  // STC_OPTION | 
| 1365 | 301k |     1275615579U,  // STC_POST | 
| 1366 | 301k |     1275615579U,  // STC_PRE | 
| 1367 | 301k |     539503U,  // STL | 
| 1368 | 301k |     538782U,  // STLB | 
| 1369 | 301k |     556674U,  // STLEX | 
| 1370 | 301k |     555296U,  // STLEXB | 
| 1371 | 301k |     555468U,  // STLEXD | 
| 1372 | 301k |     555654U,  // STLEXH | 
| 1373 | 301k |     539195U,  // STLH | 
| 1374 | 301k |     571394U,  // STMDA | 
| 1375 | 301k |     2332571650U,  // STMDA_UPD | 
| 1376 | 301k |     571526U,  // STMDB | 
| 1377 | 301k |     2332571782U,  // STMDB_UPD | 
| 1378 | 301k |     572306U,  // STMIA | 
| 1379 | 301k |     2332572562U,  // STMIA_UPD | 
| 1380 | 301k |     571544U,  // STMIB | 
| 1381 | 301k |     2332571800U,  // STMIB_UPD | 
| 1382 | 301k |     185101614U, // STRBT_POST_IMM | 
| 1383 | 301k |     185101614U, // STRBT_POST_REG | 
| 1384 | 301k |     185100465U, // STRB_POST_IMM | 
| 1385 | 301k |     185100465U, // STRB_POST_REG | 
| 1386 | 301k |     185096369U, // STRB_PRE_IMM | 
| 1387 | 301k |     185100465U, // STRB_PRE_REG | 
| 1388 | 301k |     555185U,  // STRBi12 | 
| 1389 | 301k |     546993U,  // STRBrs | 
| 1390 | 301k |     551348U,  // STRD | 
| 1391 | 301k |     185129396U, // STRD_POST | 
| 1392 | 301k |     185129396U, // STRD_PRE | 
| 1393 | 301k |     556692U,  // STREX | 
| 1394 | 301k |     555310U,  // STREXB | 
| 1395 | 301k |     555482U,  // STREXD | 
| 1396 | 301k |     555668U,  // STREXH | 
| 1397 | 301k |     547414U,  // STRH | 
| 1398 | 301k |     185097553U, // STRHTi | 
| 1399 | 301k |     185101649U, // STRHTr | 
| 1400 | 301k |     185100886U, // STRH_POST | 
| 1401 | 301k |     185100886U, // STRH_PRE | 
| 1402 | 301k |     185101698U, // STRT_POST_IMM | 
| 1403 | 301k |     185101698U, // STRT_POST_REG | 
| 1404 | 301k |     185101460U, // STR_POST_IMM | 
| 1405 | 301k |     185101460U, // STR_POST_REG | 
| 1406 | 301k |     185097364U, // STR_PRE_IMM | 
| 1407 | 301k |     185101460U, // STR_PRE_REG | 
| 1408 | 301k |     556180U,  // STRi12 | 
| 1409 | 301k |     547988U,  // STRrs | 
| 1410 | 301k |     530678U,  // SUBri | 
| 1411 | 301k |     530678U,  // SUBrr | 
| 1412 | 301k |     559350U,  // SUBrsi | 
| 1413 | 301k |     39158U, // SUBrsr | 
| 1414 | 301k |     1074313567U,  // SVC | 
| 1415 | 301k |     556081U,  // SWP | 
| 1416 | 301k |     555175U,  // SWPB | 
| 1417 | 301k |     546898U,  // SXTAB | 
| 1418 | 301k |     546523U,  // SXTAB16 | 
| 1419 | 301k |     547371U,  // SXTAH | 
| 1420 | 301k |     555242U,  // SXTB | 
| 1421 | 301k |     554731U,  // SXTB16 | 
| 1422 | 301k |     555637U,  // SXTH | 
| 1423 | 301k |     539711U,  // TEQri | 
| 1424 | 301k |     539711U,  // TEQrr | 
| 1425 | 301k |     556095U,  // TEQrsi | 
| 1426 | 301k |     547903U,  // TEQrsr | 
| 1427 | 301k |     3092U,  // TRAP | 
| 1428 | 301k |     3092U,  // TRAPNaCl | 
| 1429 | 301k |     99545U, // TSB | 
| 1430 | 301k |     540040U,  // TSTri | 
| 1431 | 301k |     540040U,  // TSTrr | 
| 1432 | 301k |     556424U,  // TSTrsi | 
| 1433 | 301k |     548232U,  // TSTrsr | 
| 1434 | 301k |     554814U,  // UADD16 | 
| 1435 | 301k |     554915U,  // UADD8 | 
| 1436 | 301k |     556739U,  // UASX | 
| 1437 | 301k |     548511U,  // UBFX | 
| 1438 | 301k |     828656U,  // UDF | 
| 1439 | 301k |     556511U,  // UDIV | 
| 1440 | 301k |     554791U,  // UHADD16 | 
| 1441 | 301k |     554895U,  // UHADD8 | 
| 1442 | 301k |     556722U,  // UHASX | 
| 1443 | 301k |     556581U,  // UHSAX | 
| 1444 | 301k |     554753U,  // UHSUB16 | 
| 1445 | 301k |     554856U,  // UHSUB8 | 
| 1446 | 301k |     580285U,  // UMAAL | 
| 1447 | 301k |     96990U, // UMLAL | 
| 1448 | 301k |     559952U,  // UMULL | 
| 1449 | 301k |     554799U,  // UQADD16 | 
| 1450 | 301k |     554902U,  // UQADD8 | 
| 1451 | 301k |     556728U,  // UQASX | 
| 1452 | 301k |     556587U,  // UQSAX | 
| 1453 | 301k |     554761U,  // UQSUB16 | 
| 1454 | 301k |     554863U,  // UQSUB8 | 
| 1455 | 301k |     554882U,  // USAD8 | 
| 1456 | 301k |     546650U,  // USADA8 | 
| 1457 | 301k |     548098U,  // USAT | 
| 1458 | 301k |     554828U,  // USAT16 | 
| 1459 | 301k |     556598U,  // USAX | 
| 1460 | 301k |     554776U,  // USUB16 | 
| 1461 | 301k |     554876U,  // USUB8 | 
| 1462 | 301k |     546904U,  // UXTAB | 
| 1463 | 301k |     546531U,  // UXTAB16 | 
| 1464 | 301k |     547377U,  // UXTAH | 
| 1465 | 301k |     555247U,  // UXTB | 
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| 1468 | 301k |     169892547U, // VABALsv2i64 | 
| 1469 | 301k |     170023619U, // VABALsv4i32 | 
| 1470 | 301k |     170154691U, // VABALsv8i16 | 
| 1471 | 301k |     170285763U, // VABALuv2i64 | 
| 1472 | 301k |     170416835U, // VABALuv4i32 | 
| 1473 | 301k |     170547907U, // VABALuv8i16 | 
| 1474 | 301k |     170153971U, // VABAsv16i8 | 
| 1475 | 301k |     169891827U, // VABAsv2i32 | 
| 1476 | 301k |     170022899U, // VABAsv4i16 | 
| 1477 | 301k |     169891827U, // VABAsv4i32 | 
| 1478 | 301k |     170022899U, // VABAsv8i16 | 
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| 1480 | 301k |     170547187U, // VABAuv16i8 | 
| 1481 | 301k |     170285043U, // VABAuv2i32 | 
| 1482 | 301k |     170416115U, // VABAuv4i16 | 
| 1483 | 301k |     170285043U, // VABAuv4i32 | 
| 1484 | 301k |     170416115U, // VABAuv8i16 | 
| 1485 | 301k |     170547187U, // VABAuv8i8 | 
| 1486 | 301k |     186678015U, // VABDLsv2i64 | 
| 1487 | 301k |     186809087U, // VABDLsv4i32 | 
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| 1489 | 301k |     187071231U, // VABDLuv2i64 | 
| 1490 | 301k |     187202303U, // VABDLuv4i32 | 
| 1491 | 301k |     187333375U, // VABDLuv8i16 | 
| 1492 | 301k |     253131119U, // VABDfd | 
| 1493 | 301k |     253131119U, // VABDfq | 
| 1494 | 301k |     253000047U, // VABDhd | 
| 1495 | 301k |     253000047U, // VABDhq | 
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| 1500 | 301k |     186808687U, // VABDsv8i16 | 
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| 1502 | 301k |     187332975U, // VABDuv16i8 | 
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| 1508 | 301k |     252853412U, // VABSD | 
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| 1514 | 301k |     252984484U, // VABShq | 
| 1515 | 301k |     1260666020U,  // VABSv16i8 | 
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| 1518 | 301k |     1260403876U,  // VABSv4i32 | 
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| 1520 | 301k |     1260666020U,  // VABSv8i8 | 
| 1521 | 301k |     253131233U, // VACGEfd | 
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| 1527 | 301k |     253001024U, // VACGThd | 
| 1528 | 301k |     253001024U, // VACGThq | 
| 1529 | 301k |     252869011U, // VADDD | 
| 1530 | 301k |     253000083U, // VADDH | 
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| 1540 | 301k |     253131155U, // VADDS | 
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| 1570 | 301k |     548195U,  // VBITq | 
| 1571 | 301k |     547676U,  // VBSLd | 
| 1572 | 301k |     547676U,  // VBSLq | 
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| 1574 | 301k |     185246658U, // VCADDv4f16 | 
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| 1577 | 301k |     253131834U, // VCEQfd | 
| 1578 | 301k |     253131834U, // VCEQfq | 
| 1579 | 301k |     253000762U, // VCEQhd | 
| 1580 | 301k |     253000762U, // VCEQhq | 
| 1581 | 301k |     187857978U, // VCEQv16i8 | 
| 1582 | 301k |     187595834U, // VCEQv2i32 | 
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| 1587 | 301k |     1261583418U,  // VCEQzv16i8 | 
| 1588 | 301k |     253115450U, // VCEQzv2f32 | 
| 1589 | 301k |     1261321274U,  // VCEQzv2i32 | 
| 1590 | 301k |     252984378U, // VCEQzv4f16 | 
| 1591 | 301k |     253115450U, // VCEQzv4f32 | 
| 1592 | 301k |     1261452346U,  // VCEQzv4i16 | 
| 1593 | 301k |     1261321274U,  // VCEQzv4i32 | 
| 1594 | 301k |     252984378U, // VCEQzv8f16 | 
| 1595 | 301k |     1261452346U,  // VCEQzv8i16 | 
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| 1597 | 301k |     253131239U, // VCGEfd | 
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| 1599 | 301k |     253000167U, // VCGEhd | 
| 1600 | 301k |     253000167U, // VCGEhq | 
| 1601 | 301k |     186939879U, // VCGEsv16i8 | 
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| 1613 | 301k |     1260665319U,  // VCGEzv16i8 | 
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| 1619 | 301k |     1260403175U,  // VCGEzv4i32 | 
| 1620 | 301k |     252983783U, // VCGEzv8f16 | 
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| 1623 | 301k |     253132102U, // VCGTfd | 
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| 3689 | 301k |     0U, // tInt_eh_sjlj_longjmp | 
| 3690 | 301k |     0U, // tInt_eh_sjlj_setjmp | 
| 3691 | 301k |     572300U,  // tLDMIA | 
| 3692 | 301k |     555180U,  // tLDRBi | 
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| 3700 | 301k |     556115U,  // tLDRr | 
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| 3722 | 301k |     2332572562U,  // tSTMIA_UPD | 
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| 3742 | 301k |     1636U,  // t__brkdiv0 | 
| 3743 | 301k |   }; | 
| 3744 |  |  | 
| 3745 | 301k |   static const uint32_t OpInfo1[] = { | 
| 3746 | 301k |     0U, // PHI | 
| 3747 | 301k |     0U, // INLINEASM | 
| 3748 | 301k |     0U, // CFI_INSTRUCTION | 
| 3749 | 301k |     0U, // EH_LABEL | 
| 3750 | 301k |     0U, // GC_LABEL | 
| 3751 | 301k |     0U, // ANNOTATION_LABEL | 
| 3752 | 301k |     0U, // KILL | 
| 3753 | 301k |     0U, // EXTRACT_SUBREG | 
| 3754 | 301k |     0U, // INSERT_SUBREG | 
| 3755 | 301k |     0U, // IMPLICIT_DEF | 
| 3756 | 301k |     0U, // SUBREG_TO_REG | 
| 3757 | 301k |     0U, // COPY_TO_REGCLASS | 
| 3758 | 301k |     0U, // DBG_VALUE | 
| 3759 | 301k |     0U, // DBG_LABEL | 
| 3760 | 301k |     0U, // REG_SEQUENCE | 
| 3761 | 301k |     0U, // COPY | 
| 3762 | 301k |     0U, // BUNDLE | 
| 3763 | 301k |     0U, // LIFETIME_START | 
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| 3765 | 301k |     0U, // STACKMAP | 
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| 3771 | 301k |     0U, // FAULTING_OP | 
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| 3779 | 301k |     0U, // ICALL_BRANCH_FUNNEL | 
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| 3789 | 301k |     0U, // G_XOR | 
| 3790 | 301k |     0U, // G_IMPLICIT_DEF | 
| 3791 | 301k |     0U, // G_PHI | 
| 3792 | 301k |     0U, // G_FRAME_INDEX | 
| 3793 | 301k |     0U, // G_GLOBAL_VALUE | 
| 3794 | 301k |     0U, // G_EXTRACT | 
| 3795 | 301k |     0U, // G_UNMERGE_VALUES | 
| 3796 | 301k |     0U, // G_INSERT | 
| 3797 | 301k |     0U, // G_MERGE_VALUES | 
| 3798 | 301k |     0U, // G_PTRTOINT | 
| 3799 | 301k |     0U, // G_INTTOPTR | 
| 3800 | 301k |     0U, // G_BITCAST | 
| 3801 | 301k |     0U, // G_LOAD | 
| 3802 | 301k |     0U, // G_SEXTLOAD | 
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| 3804 | 301k |     0U, // G_STORE | 
| 3805 | 301k |     0U, // G_ATOMIC_CMPXCHG_WITH_SUCCESS | 
| 3806 | 301k |     0U, // G_ATOMIC_CMPXCHG | 
| 3807 | 301k |     0U, // G_ATOMICRMW_XCHG | 
| 3808 | 301k |     0U, // G_ATOMICRMW_ADD | 
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| 3811 | 301k |     0U, // G_ATOMICRMW_NAND | 
| 3812 | 301k |     0U, // G_ATOMICRMW_OR | 
| 3813 | 301k |     0U, // G_ATOMICRMW_XOR | 
| 3814 | 301k |     0U, // G_ATOMICRMW_MAX | 
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| 3818 | 301k |     0U, // G_BRCOND | 
| 3819 | 301k |     0U, // G_BRINDIRECT | 
| 3820 | 301k |     0U, // G_INTRINSIC | 
| 3821 | 301k |     0U, // G_INTRINSIC_W_SIDE_EFFECTS | 
| 3822 | 301k |     0U, // G_ANYEXT | 
| 3823 | 301k |     0U, // G_TRUNC | 
| 3824 | 301k |     0U, // G_CONSTANT | 
| 3825 | 301k |     0U, // G_FCONSTANT | 
| 3826 | 301k |     0U, // G_VASTART | 
| 3827 | 301k |     0U, // G_VAARG | 
| 3828 | 301k |     0U, // G_SEXT | 
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| 3832 | 301k |     0U, // G_ASHR | 
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| 3835 | 301k |     0U, // G_SELECT | 
| 3836 | 301k |     0U, // G_UADDE | 
| 3837 | 301k |     0U, // G_USUBE | 
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| 3839 | 301k |     0U, // G_SSUBO | 
| 3840 | 301k |     0U, // G_UMULO | 
| 3841 | 301k |     0U, // G_SMULO | 
| 3842 | 301k |     0U, // G_UMULH | 
| 3843 | 301k |     0U, // G_SMULH | 
| 3844 | 301k |     0U, // G_FADD | 
| 3845 | 301k |     0U, // G_FSUB | 
| 3846 | 301k |     0U, // G_FMUL | 
| 3847 | 301k |     0U, // G_FMA | 
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| 3851 | 301k |     0U, // G_FEXP | 
| 3852 | 301k |     0U, // G_FEXP2 | 
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| 3868 | 301k |     0U, // G_SHUFFLE_VECTOR | 
| 3869 | 301k |     0U, // G_BSWAP | 
| 3870 | 301k |     0U, // G_ADDRSPACE_CAST | 
| 3871 | 301k |     0U, // G_BLOCK_ADDR | 
| 3872 | 301k |     0U, // ABS | 
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| 3876 | 301k |     0U, // ADDSrsr | 
| 3877 | 301k |     0U, // ADJCALLSTACKDOWN | 
| 3878 | 301k |     0U, // ADJCALLSTACKUP | 
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| 3881 | 301k |     0U, // B | 
| 3882 | 301k |     0U, // BCCZi64 | 
| 3883 | 301k |     0U, // BCCi64 | 
| 3884 | 301k |     0U, // BMOVPCB_CALL | 
| 3885 | 301k |     0U, // BMOVPCRX_CALL | 
| 3886 | 301k |     0U, // BR_JTadd | 
| 3887 | 301k |     0U, // BR_JTm_i12 | 
| 3888 | 301k |     0U, // BR_JTm_rs | 
| 3889 | 301k |     0U, // BR_JTr | 
| 3890 | 301k |     0U, // BX_CALL | 
| 3891 | 301k |     0U, // CMP_SWAP_16 | 
| 3892 | 301k |     0U, // CMP_SWAP_32 | 
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| 3894 | 301k |     0U, // CMP_SWAP_8 | 
| 3895 | 301k |     0U, // CONSTPOOL_ENTRY | 
| 3896 | 301k |     0U, // COPY_STRUCT_BYVAL_I32 | 
| 3897 | 301k |     0U, // CompilerBarrier | 
| 3898 | 301k |     0U, // ITasm | 
| 3899 | 301k |     0U, // Int_eh_sjlj_dispatchsetup | 
| 3900 | 301k |     0U, // Int_eh_sjlj_longjmp | 
| 3901 | 301k |     0U, // Int_eh_sjlj_setjmp | 
| 3902 | 301k |     0U, // Int_eh_sjlj_setjmp_nofp | 
| 3903 | 301k |     0U, // Int_eh_sjlj_setup_dispatch | 
| 3904 | 301k |     0U, // JUMPTABLE_ADDRS | 
| 3905 | 301k |     0U, // JUMPTABLE_INSTS | 
| 3906 | 301k |     0U, // JUMPTABLE_TBB | 
| 3907 | 301k |     0U, // JUMPTABLE_TBH | 
| 3908 | 301k |     0U, // LDMIA_RET | 
| 3909 | 301k |     8U, // LDRBT_POST | 
| 3910 | 301k |     1024U,  // LDRConstPool | 
| 3911 | 301k |     0U, // LDRLIT_ga_abs | 
| 3912 | 301k |     0U, // LDRLIT_ga_pcrel | 
| 3913 | 301k |     0U, // LDRLIT_ga_pcrel_ldr | 
| 3914 | 301k |     8U, // LDRT_POST | 
| 3915 | 301k |     0U, // LEApcrel | 
| 3916 | 301k |     0U, // LEApcrelJT | 
| 3917 | 301k |     0U, // LSLi | 
| 3918 | 301k |     0U, // LSLr | 
| 3919 | 301k |     0U, // LSRi | 
| 3920 | 301k |     0U, // LSRr | 
| 3921 | 301k |     0U, // MEMCPY | 
| 3922 | 301k |     0U, // MLAv5 | 
| 3923 | 301k |     0U, // MOVCCi | 
| 3924 | 301k |     0U, // MOVCCi16 | 
| 3925 | 301k |     0U, // MOVCCi32imm | 
| 3926 | 301k |     0U, // MOVCCr | 
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| 3929 | 301k |     0U, // MOVPCRX | 
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| 3932 | 301k |     0U, // MOV_ga_pcrel_ldr | 
| 3933 | 301k |     0U, // MOVi16_ga_pcrel | 
| 3934 | 301k |     0U, // MOVi32imm | 
| 3935 | 301k |     0U, // MOVsra_flag | 
| 3936 | 301k |     0U, // MOVsrl_flag | 
| 3937 | 301k |     0U, // MULv5 | 
| 3938 | 301k |     0U, // MVNCCi | 
| 3939 | 301k |     0U, // PICADD | 
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| 4156 | 301k |     0U, // VST3qAsm_16 | 
| 4157 | 301k |     0U, // VST3qAsm_32 | 
| 4158 | 301k |     0U, // VST3qAsm_8 | 
| 4159 | 301k |     0U, // VST3qWB_fixed_Asm_16 | 
| 4160 | 301k |     0U, // VST3qWB_fixed_Asm_32 | 
| 4161 | 301k |     0U, // VST3qWB_fixed_Asm_8 | 
| 4162 | 301k |     1048U,  // VST3qWB_register_Asm_16 | 
| 4163 | 301k |     1048U,  // VST3qWB_register_Asm_32 | 
| 4164 | 301k |     1048U,  // VST3qWB_register_Asm_8 | 
| 4165 | 301k |     1040U,  // VST4LNdAsm_16 | 
| 4166 | 301k |     1040U,  // VST4LNdAsm_32 | 
| 4167 | 301k |     1040U,  // VST4LNdAsm_8 | 
| 4168 | 301k |     2064U,  // VST4LNdWB_fixed_Asm_16 | 
| 4169 | 301k |     2064U,  // VST4LNdWB_fixed_Asm_32 | 
| 4170 | 301k |     2064U,  // VST4LNdWB_fixed_Asm_8 | 
| 4171 | 301k |     32784U, // VST4LNdWB_register_Asm_16 | 
| 4172 | 301k |     32784U, // VST4LNdWB_register_Asm_32 | 
| 4173 | 301k |     32784U, // VST4LNdWB_register_Asm_8 | 
| 4174 | 301k |     1040U,  // VST4LNqAsm_16 | 
| 4175 | 301k |     1040U,  // VST4LNqAsm_32 | 
| 4176 | 301k |     2064U,  // VST4LNqWB_fixed_Asm_16 | 
| 4177 | 301k |     2064U,  // VST4LNqWB_fixed_Asm_32 | 
| 4178 | 301k |     32784U, // VST4LNqWB_register_Asm_16 | 
| 4179 | 301k |     32784U, // VST4LNqWB_register_Asm_32 | 
| 4180 | 301k |     32U,  // VST4dAsm_16 | 
| 4181 | 301k |     32U,  // VST4dAsm_32 | 
| 4182 | 301k |     32U,  // VST4dAsm_8 | 
| 4183 | 301k |     40U,  // VST4dWB_fixed_Asm_16 | 
| 4184 | 301k |     40U,  // VST4dWB_fixed_Asm_32 | 
| 4185 | 301k |     40U,  // VST4dWB_fixed_Asm_8 | 
| 4186 | 301k |     68656U, // VST4dWB_register_Asm_16 | 
| 4187 | 301k |     68656U, // VST4dWB_register_Asm_32 | 
| 4188 | 301k |     68656U, // VST4dWB_register_Asm_8 | 
| 4189 | 301k |     0U, // VST4qAsm_16 | 
| 4190 | 301k |     0U, // VST4qAsm_32 | 
| 4191 | 301k |     0U, // VST4qAsm_8 | 
| 4192 | 301k |     0U, // VST4qWB_fixed_Asm_16 | 
| 4193 | 301k |     0U, // VST4qWB_fixed_Asm_32 | 
| 4194 | 301k |     0U, // VST4qWB_fixed_Asm_8 | 
| 4195 | 301k |     1048U,  // VST4qWB_register_Asm_16 | 
| 4196 | 301k |     1048U,  // VST4qWB_register_Asm_32 | 
| 4197 | 301k |     1048U,  // VST4qWB_register_Asm_8 | 
| 4198 | 301k |     0U, // WIN__CHKSTK | 
| 4199 | 301k |     0U, // WIN__DBZCHK | 
| 4200 | 301k |     0U, // t2ABS | 
| 4201 | 301k |     0U, // t2ADDSri | 
| 4202 | 301k |     0U, // t2ADDSrr | 
| 4203 | 301k |     0U, // t2ADDSrs | 
| 4204 | 301k |     0U, // t2BR_JT | 
| 4205 | 301k |     0U, // t2LDMIA_RET | 
| 4206 | 301k |     1024U,  // t2LDRBpcrel | 
| 4207 | 301k |     1024U,  // t2LDRConstPool | 
| 4208 | 301k |     1024U,  // t2LDRHpcrel | 
| 4209 | 301k |     1024U,  // t2LDRSBpcrel | 
| 4210 | 301k |     1024U,  // t2LDRSHpcrel | 
| 4211 | 301k |     0U, // t2LDRpci_pic | 
| 4212 | 301k |     1024U,  // t2LDRpcrel | 
| 4213 | 301k |     0U, // t2LEApcrel | 
| 4214 | 301k |     0U, // t2LEApcrelJT | 
| 4215 | 301k |     0U, // t2MOVCCasr | 
| 4216 | 301k |     0U, // t2MOVCCi | 
| 4217 | 301k |     0U, // t2MOVCCi16 | 
| 4218 | 301k |     0U, // t2MOVCCi32imm | 
| 4219 | 301k |     0U, // t2MOVCClsl | 
| 4220 | 301k |     0U, // t2MOVCClsr | 
| 4221 | 301k |     0U, // t2MOVCCr | 
| 4222 | 301k |     0U, // t2MOVCCror | 
| 4223 | 301k |     56U,  // t2MOVSsi | 
| 4224 | 301k |     64U,  // t2MOVSsr | 
| 4225 | 301k |     0U, // t2MOVTi16_ga_pcrel | 
| 4226 | 301k |     0U, // t2MOV_ga_pcrel | 
| 4227 | 301k |     0U, // t2MOVi16_ga_pcrel | 
| 4228 | 301k |     0U, // t2MOVi32imm | 
| 4229 | 301k |     56U,  // t2MOVsi | 
| 4230 | 301k |     64U,  // t2MOVsr | 
| 4231 | 301k |     0U, // t2MVNCCi | 
| 4232 | 301k |     0U, // t2RSBSri | 
| 4233 | 301k |     0U, // t2RSBSrs | 
| 4234 | 301k |     0U, // t2STRB_preidx | 
| 4235 | 301k |     0U, // t2STRH_preidx | 
| 4236 | 301k |     0U, // t2STR_preidx | 
| 4237 | 301k |     0U, // t2SUBSri | 
| 4238 | 301k |     0U, // t2SUBSrr | 
| 4239 | 301k |     0U, // t2SUBSrs | 
| 4240 | 301k |     0U, // t2TBB_JT | 
| 4241 | 301k |     0U, // t2TBH_JT | 
| 4242 | 301k |     0U, // tADCS | 
| 4243 | 301k |     0U, // tADDSi3 | 
| 4244 | 301k |     0U, // tADDSi8 | 
| 4245 | 301k |     0U, // tADDSrr | 
| 4246 | 301k |     0U, // tADDframe | 
| 4247 | 301k |     0U, // tADJCALLSTACKDOWN | 
| 4248 | 301k |     0U, // tADJCALLSTACKUP | 
| 4249 | 301k |     0U, // tBRIND | 
| 4250 | 301k |     0U, // tBR_JTr | 
| 4251 | 301k |     0U, // tBX_CALL | 
| 4252 | 301k |     0U, // tBX_RET | 
| 4253 | 301k |     0U, // tBX_RET_vararg | 
| 4254 | 301k |     0U, // tBfar | 
| 4255 | 301k |     0U, // tLDMIA_UPD | 
| 4256 | 301k |     1024U,  // tLDRConstPool | 
| 4257 | 301k |     0U, // tLDRLIT_ga_abs | 
| 4258 | 301k |     0U, // tLDRLIT_ga_pcrel | 
| 4259 | 301k |     0U, // tLDR_postidx | 
| 4260 | 301k |     0U, // tLDRpci_pic | 
| 4261 | 301k |     0U, // tLEApcrel | 
| 4262 | 301k |     0U, // tLEApcrelJT | 
| 4263 | 301k |     0U, // tMOVCCr_pseudo | 
| 4264 | 301k |     0U, // tPOP_RET | 
| 4265 | 301k |     0U, // tSBCS | 
| 4266 | 301k |     0U, // tSUBSi3 | 
| 4267 | 301k |     0U, // tSUBSi8 | 
| 4268 | 301k |     0U, // tSUBSrr | 
| 4269 | 301k |     0U, // tTAILJMPd | 
| 4270 | 301k |     0U, // tTAILJMPdND | 
| 4271 | 301k |     0U, // tTAILJMPr | 
| 4272 | 301k |     0U, // tTBB_JT | 
| 4273 | 301k |     0U, // tTBH_JT | 
| 4274 | 301k |     0U, // tTPsoft | 
| 4275 | 301k |     98304U, // ADCri | 
| 4276 | 301k |     0U, // ADCrr | 
| 4277 | 301k |     131072U,  // ADCrsi | 
| 4278 | 301k |     0U, // ADCrsr | 
| 4279 | 301k |     98304U, // ADDri | 
| 4280 | 301k |     0U, // ADDrr | 
| 4281 | 301k |     131072U,  // ADDrsi | 
| 4282 | 301k |     0U, // ADDrsr | 
| 4283 | 301k |     72U,  // ADR | 
| 4284 | 301k |     0U, // AESD | 
| 4285 | 301k |     0U, // AESE | 
| 4286 | 301k |     0U, // AESIMC | 
| 4287 | 301k |     0U, // AESMC | 
| 4288 | 301k |     98304U, // ANDri | 
| 4289 | 301k |     0U, // ANDrr | 
| 4290 | 301k |     131072U,  // ANDrsi | 
| 4291 | 301k |     0U, // ANDrsr | 
| 4292 | 301k |     80U,  // BFC | 
| 4293 | 301k |     163928U,  // BFI | 
| 4294 | 301k |     98304U, // BICri | 
| 4295 | 301k |     0U, // BICrr | 
| 4296 | 301k |     131072U,  // BICrsi | 
| 4297 | 301k |     0U, // BICrsr | 
| 4298 | 301k |     0U, // BKPT | 
| 4299 | 301k |     0U, // BL | 
| 4300 | 301k |     0U, // BLX | 
| 4301 | 301k |     0U, // BLX_pred | 
| 4302 | 301k |     0U, // BLXi | 
| 4303 | 301k |     0U, // BL_pred | 
| 4304 | 301k |     0U, // BX | 
| 4305 | 301k |     0U, // BXJ | 
| 4306 | 301k |     0U, // BX_RET | 
| 4307 | 301k |     0U, // BX_pred | 
| 4308 | 301k |     0U, // Bcc | 
| 4309 | 301k |     4145U,  // CDP | 
| 4310 | 301k |     0U, // CDP2 | 
| 4311 | 301k |     0U, // CLREX | 
| 4312 | 301k |     1024U,  // CLZ | 
| 4313 | 301k |     96U,  // CMNri | 
| 4314 | 301k |     1024U,  // CMNzrr | 
| 4315 | 301k |     104U, // CMNzrsi | 
| 4316 | 301k |     64U,  // CMNzrsr | 
| 4317 | 301k |     96U,  // CMPri | 
| 4318 | 301k |     1024U,  // CMPrr | 
| 4319 | 301k |     104U, // CMPrsi | 
| 4320 | 301k |     64U,  // CMPrsr | 
| 4321 | 301k |     0U, // CPS1p | 
| 4322 | 301k |     0U, // CPS2p | 
| 4323 | 301k |     1112U,  // CPS3p | 
| 4324 | 301k |     1112U,  // CRC32B | 
| 4325 | 301k |     1112U,  // CRC32CB | 
| 4326 | 301k |     1112U,  // CRC32CH | 
| 4327 | 301k |     1112U,  // CRC32CW | 
| 4328 | 301k |     1112U,  // CRC32H | 
| 4329 | 301k |     1112U,  // CRC32W | 
| 4330 | 301k |     0U, // DBG | 
| 4331 | 301k |     0U, // DMB | 
| 4332 | 301k |     0U, // DSB | 
| 4333 | 301k |     98304U, // EORri | 
| 4334 | 301k |     0U, // EORrr | 
| 4335 | 301k |     131072U,  // EORrsi | 
| 4336 | 301k |     0U, // EORrsr | 
| 4337 | 301k |     0U, // ERET | 
| 4338 | 301k |     1U, // FCONSTD | 
| 4339 | 301k |     1U, // FCONSTH | 
| 4340 | 301k |     1U, // FCONSTS | 
| 4341 | 301k |     33U,  // FLDMXDB_UPD | 
| 4342 | 301k |     1136U,  // FLDMXIA | 
| 4343 | 301k |     33U,  // FLDMXIA_UPD | 
| 4344 | 301k |     0U, // FMSTAT | 
| 4345 | 301k |     33U,  // FSTMXDB_UPD | 
| 4346 | 301k |     1136U,  // FSTMXIA | 
| 4347 | 301k |     33U,  // FSTMXIA_UPD | 
| 4348 | 301k |     0U, // HINT | 
| 4349 | 301k |     0U, // HLT | 
| 4350 | 301k |     0U, // HVC | 
| 4351 | 301k |     0U, // ISB | 
| 4352 | 301k |     8U, // LDA | 
| 4353 | 301k |     8U, // LDAB | 
| 4354 | 301k |     8U, // LDAEX | 
| 4355 | 301k |     8U, // LDAEXB | 
| 4356 | 301k |     0U, // LDAEXD | 
| 4357 | 301k |     8U, // LDAEXH | 
| 4358 | 301k |     8U, // LDAH | 
| 4359 | 301k |     0U, // LDC2L_OFFSET | 
| 4360 | 301k |     1U, // LDC2L_OPTION | 
| 4361 | 301k |     2U, // LDC2L_POST | 
| 4362 | 301k |     0U, // LDC2L_PRE | 
| 4363 | 301k |     0U, // LDC2_OFFSET | 
| 4364 | 301k |     1U, // LDC2_OPTION | 
| 4365 | 301k |     2U, // LDC2_POST | 
| 4366 | 301k |     0U, // LDC2_PRE | 
| 4367 | 301k |     122U, // LDCL_OFFSET | 
| 4368 | 301k |     196738U,  // LDCL_OPTION | 
| 4369 | 301k |     229506U,  // LDCL_POST | 
| 4370 | 301k |     138U, // LDCL_PRE | 
| 4371 | 301k |     122U, // LDC_OFFSET | 
| 4372 | 301k |     196738U,  // LDC_OPTION | 
| 4373 | 301k |     229506U,  // LDC_POST | 
| 4374 | 301k |     138U, // LDC_PRE | 
| 4375 | 301k |     1136U,  // LDMDA | 
| 4376 | 301k |     33U,  // LDMDA_UPD | 
| 4377 | 301k |     1136U,  // LDMDB | 
| 4378 | 301k |     33U,  // LDMDB_UPD | 
| 4379 | 301k |     1136U,  // LDMIA | 
| 4380 | 301k |     33U,  // LDMIA_UPD | 
| 4381 | 301k |     1136U,  // LDMIB | 
| 4382 | 301k |     33U,  // LDMIB_UPD | 
| 4383 | 301k |     262272U,  // LDRBT_POST_IMM | 
| 4384 | 301k |     262272U,  // LDRBT_POST_REG | 
| 4385 | 301k |     262272U,  // LDRB_POST_IMM | 
| 4386 | 301k |     262272U,  // LDRB_POST_REG | 
| 4387 | 301k |     144U, // LDRB_PRE_IMM | 
| 4388 | 301k |     152U, // LDRB_PRE_REG | 
| 4389 | 301k |     160U, // LDRBi12 | 
| 4390 | 301k |     168U, // LDRBrs | 
| 4391 | 301k |     294912U,  // LDRD | 
| 4392 | 301k |     2424832U, // LDRD_POST | 
| 4393 | 301k |     360448U,  // LDRD_PRE | 
| 4394 | 301k |     8U, // LDREX | 
| 4395 | 301k |     8U, // LDREXB | 
| 4396 | 301k |     0U, // LDREXD | 
| 4397 | 301k |     8U, // LDREXH | 
| 4398 | 301k |     176U, // LDRH | 
| 4399 | 301k |     393344U,  // LDRHTi | 
| 4400 | 301k |     426112U,  // LDRHTr | 
| 4401 | 301k |     458880U,  // LDRH_POST | 
| 4402 | 301k |     184U, // LDRH_PRE | 
| 4403 | 301k |     176U, // LDRSB | 
| 4404 | 301k |     393344U,  // LDRSBTi | 
| 4405 | 301k |     426112U,  // LDRSBTr | 
| 4406 | 301k |     458880U,  // LDRSB_POST | 
| 4407 | 301k |     184U, // LDRSB_PRE | 
| 4408 | 301k |     176U, // LDRSH | 
| 4409 | 301k |     393344U,  // LDRSHTi | 
| 4410 | 301k |     426112U,  // LDRSHTr | 
| 4411 | 301k |     458880U,  // LDRSH_POST | 
| 4412 | 301k |     184U, // LDRSH_PRE | 
| 4413 | 301k |     262272U,  // LDRT_POST_IMM | 
| 4414 | 301k |     262272U,  // LDRT_POST_REG | 
| 4415 | 301k |     262272U,  // LDR_POST_IMM | 
| 4416 | 301k |     262272U,  // LDR_POST_REG | 
| 4417 | 301k |     144U, // LDR_PRE_IMM | 
| 4418 | 301k |     152U, // LDR_PRE_REG | 
| 4419 | 301k |     160U, // LDRcp | 
| 4420 | 301k |     160U, // LDRi12 | 
| 4421 | 301k |     168U, // LDRrs | 
| 4422 | 301k |     4690993U, // MCR | 
| 4423 | 301k |     192U, // MCR2 | 
| 4424 | 301k |     6788145U, // MCRR | 
| 4425 | 301k |     524312U,  // MCRR2 | 
| 4426 | 301k |     35651584U,  // MLA | 
| 4427 | 301k |     35651584U,  // MLS | 
| 4428 | 301k |     0U, // MOVPCLR | 
| 4429 | 301k |     1112U,  // MOVTi16 | 
| 4430 | 301k |     96U,  // MOVi | 
| 4431 | 301k |     1024U,  // MOVi16 | 
| 4432 | 301k |     1024U,  // MOVr | 
| 4433 | 301k |     1024U,  // MOVr_TC | 
| 4434 | 301k |     104U, // MOVsi | 
| 4435 | 301k |     64U,  // MOVsr | 
| 4436 | 301k |     0U, // MRC | 
| 4437 | 301k |     0U, // MRC2 | 
| 4438 | 301k |     0U, // MRRC | 
| 4439 | 301k |     0U, // MRRC2 | 
| 4440 | 301k |     2U, // MRS | 
| 4441 | 301k |     200U, // MRSbanked | 
| 4442 | 301k |     2U, // MRSsys | 
| 4443 | 301k |     33U,  // MSR | 
| 4444 | 301k |     0U, // MSRbanked | 
| 4445 | 301k |     3U, // MSRi | 
| 4446 | 301k |     0U, // MUL | 
| 4447 | 301k |     96U,  // MVNi | 
| 4448 | 301k |     1024U,  // MVNr | 
| 4449 | 301k |     104U, // MVNsi | 
| 4450 | 301k |     64U,  // MVNsr | 
| 4451 | 301k |     98304U, // ORRri | 
| 4452 | 301k |     0U, // ORRrr | 
| 4453 | 301k |     131072U,  // ORRrsi | 
| 4454 | 301k |     0U, // ORRrsr | 
| 4455 | 301k |     8388608U, // PKHBT | 
| 4456 | 301k |     10485760U,  // PKHTB | 
| 4457 | 301k |     0U, // PLDWi12 | 
| 4458 | 301k |     0U, // PLDWrs | 
| 4459 | 301k |     0U, // PLDi12 | 
| 4460 | 301k |     0U, // PLDrs | 
| 4461 | 301k |     0U, // PLIi12 | 
| 4462 | 301k |     0U, // PLIrs | 
| 4463 | 301k |     0U, // QADD | 
| 4464 | 301k |     0U, // QADD16 | 
| 4465 | 301k |     0U, // QADD8 | 
| 4466 | 301k |     0U, // QASX | 
| 4467 | 301k |     0U, // QDADD | 
| 4468 | 301k |     0U, // QDSUB | 
| 4469 | 301k |     0U, // QSAX | 
| 4470 | 301k |     0U, // QSUB | 
| 4471 | 301k |     0U, // QSUB16 | 
| 4472 | 301k |     0U, // QSUB8 | 
| 4473 | 301k |     1024U,  // RBIT | 
| 4474 | 301k |     1024U,  // REV | 
| 4475 | 301k |     1024U,  // REV16 | 
| 4476 | 301k |     1024U,  // REVSH | 
| 4477 | 301k |     0U, // RFEDA | 
| 4478 | 301k |     0U, // RFEDA_UPD | 
| 4479 | 301k |     0U, // RFEDB | 
| 4480 | 301k |     0U, // RFEDB_UPD | 
| 4481 | 301k |     0U, // RFEIA | 
| 4482 | 301k |     0U, // RFEIA_UPD | 
| 4483 | 301k |     0U, // RFEIB | 
| 4484 | 301k |     0U, // RFEIB_UPD | 
| 4485 | 301k |     98304U, // RSBri | 
| 4486 | 301k |     0U, // RSBrr | 
| 4487 | 301k |     131072U,  // RSBrsi | 
| 4488 | 301k |     0U, // RSBrsr | 
| 4489 | 301k |     98304U, // RSCri | 
| 4490 | 301k |     0U, // RSCrr | 
| 4491 | 301k |     131072U,  // RSCrsi | 
| 4492 | 301k |     0U, // RSCrsr | 
| 4493 | 301k |     0U, // SADD16 | 
| 4494 | 301k |     0U, // SADD8 | 
| 4495 | 301k |     0U, // SASX | 
| 4496 | 301k |     98304U, // SBCri | 
| 4497 | 301k |     0U, // SBCrr | 
| 4498 | 301k |     131072U,  // SBCrsi | 
| 4499 | 301k |     0U, // SBCrsr | 
| 4500 | 301k |     69206016U,  // SBFX | 
| 4501 | 301k |     0U, // SDIV | 
| 4502 | 301k |     0U, // SEL | 
| 4503 | 301k |     0U, // SETEND | 
| 4504 | 301k |     0U, // SETPAN | 
| 4505 | 301k |     1048U,  // SHA1C | 
| 4506 | 301k |     0U, // SHA1H | 
| 4507 | 301k |     1048U,  // SHA1M | 
| 4508 | 301k |     1048U,  // SHA1P | 
| 4509 | 301k |     1048U,  // SHA1SU0 | 
| 4510 | 301k |     0U, // SHA1SU1 | 
| 4511 | 301k |     1048U,  // SHA256H | 
| 4512 | 301k |     1048U,  // SHA256H2 | 
| 4513 | 301k |     0U, // SHA256SU0 | 
| 4514 | 301k |     1048U,  // SHA256SU1 | 
| 4515 | 301k |     0U, // SHADD16 | 
| 4516 | 301k |     0U, // SHADD8 | 
| 4517 | 301k |     0U, // SHASX | 
| 4518 | 301k |     0U, // SHSAX | 
| 4519 | 301k |     0U, // SHSUB16 | 
| 4520 | 301k |     0U, // SHSUB8 | 
| 4521 | 301k |     0U, // SMC | 
| 4522 | 301k |     35651584U,  // SMLABB | 
| 4523 | 301k |     35651584U,  // SMLABT | 
| 4524 | 301k |     35651584U,  // SMLAD | 
| 4525 | 301k |     35651584U,  // SMLADX | 
| 4526 | 301k |     0U, // SMLAL | 
| 4527 | 301k |     35651584U,  // SMLALBB | 
| 4528 | 301k |     35651584U,  // SMLALBT | 
| 4529 | 301k |     35651584U,  // SMLALD | 
| 4530 | 301k |     35651584U,  // SMLALDX | 
| 4531 | 301k |     35651584U,  // SMLALTB | 
| 4532 | 301k |     35651584U,  // SMLALTT | 
| 4533 | 301k |     35651584U,  // SMLATB | 
| 4534 | 301k |     35651584U,  // SMLATT | 
| 4535 | 301k |     35651584U,  // SMLAWB | 
| 4536 | 301k |     35651584U,  // SMLAWT | 
| 4537 | 301k |     35651584U,  // SMLSD | 
| 4538 | 301k |     35651584U,  // SMLSDX | 
| 4539 | 301k |     35651584U,  // SMLSLD | 
| 4540 | 301k |     35651584U,  // SMLSLDX | 
| 4541 | 301k |     35651584U,  // SMMLA | 
| 4542 | 301k |     35651584U,  // SMMLAR | 
| 4543 | 301k |     35651584U,  // SMMLS | 
| 4544 | 301k |     35651584U,  // SMMLSR | 
| 4545 | 301k |     0U, // SMMUL | 
| 4546 | 301k |     0U, // SMMULR | 
| 4547 | 301k |     0U, // SMUAD | 
| 4548 | 301k |     0U, // SMUADX | 
| 4549 | 301k |     0U, // SMULBB | 
| 4550 | 301k |     0U, // SMULBT | 
| 4551 | 301k |     35651584U,  // SMULL | 
| 4552 | 301k |     0U, // SMULTB | 
| 4553 | 301k |     0U, // SMULTT | 
| 4554 | 301k |     0U, // SMULWB | 
| 4555 | 301k |     0U, // SMULWT | 
| 4556 | 301k |     0U, // SMUSD | 
| 4557 | 301k |     0U, // SMUSDX | 
| 4558 | 301k |     0U, // SRSDA | 
| 4559 | 301k |     0U, // SRSDA_UPD | 
| 4560 | 301k |     0U, // SRSDB | 
| 4561 | 301k |     0U, // SRSDB_UPD | 
| 4562 | 301k |     0U, // SRSIA | 
| 4563 | 301k |     0U, // SRSIA_UPD | 
| 4564 | 301k |     0U, // SRSIB | 
| 4565 | 301k |     0U, // SRSIB_UPD | 
| 4566 | 301k |     6352U,  // SSAT | 
| 4567 | 301k |     1232U,  // SSAT16 | 
| 4568 | 301k |     0U, // SSAX | 
| 4569 | 301k |     0U, // SSUB16 | 
| 4570 | 301k |     0U, // SSUB8 | 
| 4571 | 301k |     0U, // STC2L_OFFSET | 
| 4572 | 301k |     1U, // STC2L_OPTION | 
| 4573 | 301k |     2U, // STC2L_POST | 
| 4574 | 301k |     0U, // STC2L_PRE | 
| 4575 | 301k |     0U, // STC2_OFFSET | 
| 4576 | 301k |     1U, // STC2_OPTION | 
| 4577 | 301k |     2U, // STC2_POST | 
| 4578 | 301k |     0U, // STC2_PRE | 
| 4579 | 301k |     122U, // STCL_OFFSET | 
| 4580 | 301k |     196738U,  // STCL_OPTION | 
| 4581 | 301k |     229506U,  // STCL_POST | 
| 4582 | 301k |     138U, // STCL_PRE | 
| 4583 | 301k |     122U, // STC_OFFSET | 
| 4584 | 301k |     196738U,  // STC_OPTION | 
| 4585 | 301k |     229506U,  // STC_POST | 
| 4586 | 301k |     138U, // STC_PRE | 
| 4587 | 301k |     8U, // STL | 
| 4588 | 301k |     8U, // STLB | 
| 4589 | 301k |     557056U,  // STLEX | 
| 4590 | 301k |     557056U,  // STLEXB | 
| 4591 | 301k |     216U, // STLEXD | 
| 4592 | 301k |     557056U,  // STLEXH | 
| 4593 | 301k |     8U, // STLH | 
| 4594 | 301k |     1136U,  // STMDA | 
| 4595 | 301k |     33U,  // STMDA_UPD | 
| 4596 | 301k |     1136U,  // STMDB | 
| 4597 | 301k |     33U,  // STMDB_UPD | 
| 4598 | 301k |     1136U,  // STMIA | 
| 4599 | 301k |     33U,  // STMIA_UPD | 
| 4600 | 301k |     1136U,  // STMIB | 
| 4601 | 301k |     33U,  // STMIB_UPD | 
| 4602 | 301k |     262272U,  // STRBT_POST_IMM | 
| 4603 | 301k |     262272U,  // STRBT_POST_REG | 
| 4604 | 301k |     262272U,  // STRB_POST_IMM | 
| 4605 | 301k |     262272U,  // STRB_POST_REG | 
| 4606 | 301k |     144U, // STRB_PRE_IMM | 
| 4607 | 301k |     152U, // STRB_PRE_REG | 
| 4608 | 301k |     160U, // STRBi12 | 
| 4609 | 301k |     168U, // STRBrs | 
| 4610 | 301k |     294912U,  // STRD | 
| 4611 | 301k |     2424920U, // STRD_POST | 
| 4612 | 301k |     360536U,  // STRD_PRE | 
| 4613 | 301k |     557056U,  // STREX | 
| 4614 | 301k |     557056U,  // STREXB | 
| 4615 | 301k |     216U, // STREXD | 
| 4616 | 301k |     557056U,  // STREXH | 
| 4617 | 301k |     176U, // STRH | 
| 4618 | 301k |     393344U,  // STRHTi | 
| 4619 | 301k |     426112U,  // STRHTr | 
| 4620 | 301k |     458880U,  // STRH_POST | 
| 4621 | 301k |     184U, // STRH_PRE | 
| 4622 | 301k |     262272U,  // STRT_POST_IMM | 
| 4623 | 301k |     262272U,  // STRT_POST_REG | 
| 4624 | 301k |     262272U,  // STR_POST_IMM | 
| 4625 | 301k |     262272U,  // STR_POST_REG | 
| 4626 | 301k |     144U, // STR_PRE_IMM | 
| 4627 | 301k |     152U, // STR_PRE_REG | 
| 4628 | 301k |     160U, // STRi12 | 
| 4629 | 301k |     168U, // STRrs | 
| 4630 | 301k |     98304U, // SUBri | 
| 4631 | 301k |     0U, // SUBrr | 
| 4632 | 301k |     131072U,  // SUBrsi | 
| 4633 | 301k |     0U, // SUBrsr | 
| 4634 | 301k |     0U, // SVC | 
| 4635 | 301k |     557056U,  // SWP | 
| 4636 | 301k |     557056U,  // SWPB | 
| 4637 | 301k |     12582912U,  // SXTAB | 
| 4638 | 301k |     12582912U,  // SXTAB16 | 
| 4639 | 301k |     12582912U,  // SXTAH | 
| 4640 | 301k |     7168U,  // SXTB | 
| 4641 | 301k |     7168U,  // SXTB16 | 
| 4642 | 301k |     7168U,  // SXTH | 
| 4643 | 301k |     96U,  // TEQri | 
| 4644 | 301k |     1024U,  // TEQrr | 
| 4645 | 301k |     104U, // TEQrsi | 
| 4646 | 301k |     64U,  // TEQrsr | 
| 4647 | 301k |     0U, // TRAP | 
| 4648 | 301k |     0U, // TRAPNaCl | 
| 4649 | 301k |     0U, // TSB | 
| 4650 | 301k |     96U,  // TSTri | 
| 4651 | 301k |     1024U,  // TSTrr | 
| 4652 | 301k |     104U, // TSTrsi | 
| 4653 | 301k |     64U,  // TSTrsr | 
| 4654 | 301k |     0U, // UADD16 | 
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| 6742 | 301k |     35651584U,  // t2SMMLSR | 
| 6743 | 301k |     0U, // t2SMMUL | 
| 6744 | 301k |     0U, // t2SMMULR | 
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| 6757 | 301k |     0U, // t2SRSDB_UPD | 
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| 6759 | 301k |     0U, // t2SRSIA_UPD | 
| 6760 | 301k |     6352U,  // t2SSAT | 
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| 6765 | 301k |     122U, // t2STC2L_OFFSET | 
| 6766 | 301k |     196738U,  // t2STC2L_OPTION | 
| 6767 | 301k |     229506U,  // t2STC2L_POST | 
| 6768 | 301k |     138U, // t2STC2L_PRE | 
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| 6770 | 301k |     196738U,  // t2STC2_OPTION | 
| 6771 | 301k |     229506U,  // t2STC2_POST | 
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| 6779 | 301k |     229506U,  // t2STC_POST | 
| 6780 | 301k |     138U, // t2STC_PRE | 
| 6781 | 301k |     8U, // t2STL | 
| 6782 | 301k |     8U, // t2STLB | 
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| 6807 | 301k |     416U, // t2STRH_PRE | 
| 6808 | 301k |     160U, // t2STRHi12 | 
| 6809 | 301k |     408U, // t2STRHi8 | 
| 6810 | 301k |     432U, // t2STRHs | 
| 6811 | 301k |     408U, // t2STRT | 
| 6812 | 301k |     21632U, // t2STR_POST | 
| 6813 | 301k |     416U, // t2STR_PRE | 
| 6814 | 301k |     160U, // t2STRi12 | 
| 6815 | 301k |     408U, // t2STRi8 | 
| 6816 | 301k |     432U, // t2STRs | 
| 6817 | 301k |     0U, // t2SUBS_PC_LR | 
| 6818 | 301k |     0U, // t2SUBri | 
| 6819 | 301k |     0U, // t2SUBri12 | 
| 6820 | 301k |     0U, // t2SUBrr | 
| 6821 | 301k |     1048576U, // t2SUBrs | 
| 6822 | 301k |     12582912U,  // t2SXTAB | 
| 6823 | 301k |     12582912U,  // t2SXTAB16 | 
| 6824 | 301k |     12582912U,  // t2SXTAH | 
| 6825 | 301k |     7168U,  // t2SXTB | 
| 6826 | 301k |     7168U,  // t2SXTB16 | 
| 6827 | 301k |     7168U,  // t2SXTH | 
| 6828 | 301k |     0U, // t2TBB | 
| 6829 | 301k |     0U, // t2TBH | 
| 6830 | 301k |     1024U,  // t2TEQri | 
| 6831 | 301k |     1024U,  // t2TEQrr | 
| 6832 | 301k |     56U,  // t2TEQrs | 
| 6833 | 301k |     0U, // t2TSB | 
| 6834 | 301k |     1024U,  // t2TSTri | 
| 6835 | 301k |     1024U,  // t2TSTrr | 
| 6836 | 301k |     56U,  // t2TSTrs | 
| 6837 | 301k |     1024U,  // t2TT | 
| 6838 | 301k |     1024U,  // t2TTA | 
| 6839 | 301k |     1024U,  // t2TTAT | 
| 6840 | 301k |     1024U,  // t2TTT | 
| 6841 | 301k |     0U, // t2UADD16 | 
| 6842 | 301k |     0U, // t2UADD8 | 
| 6843 | 301k |     0U, // t2UASX | 
| 6844 | 301k |     69206016U,  // t2UBFX | 
| 6845 | 301k |     0U, // t2UDF | 
| 6846 | 301k |     0U, // t2UDIV | 
| 6847 | 301k |     0U, // t2UHADD16 | 
| 6848 | 301k |     0U, // t2UHADD8 | 
| 6849 | 301k |     0U, // t2UHASX | 
| 6850 | 301k |     0U, // t2UHSAX | 
| 6851 | 301k |     0U, // t2UHSUB16 | 
| 6852 | 301k |     0U, // t2UHSUB8 | 
| 6853 | 301k |     35651584U,  // t2UMAAL | 
| 6854 | 301k |     35651584U,  // t2UMLAL | 
| 6855 | 301k |     35651584U,  // t2UMULL | 
| 6856 | 301k |     0U, // t2UQADD16 | 
| 6857 | 301k |     0U, // t2UQADD8 | 
| 6858 | 301k |     0U, // t2UQASX | 
| 6859 | 301k |     0U, // t2UQSAX | 
| 6860 | 301k |     0U, // t2UQSUB16 | 
| 6861 | 301k |     0U, // t2UQSUB8 | 
| 6862 | 301k |     0U, // t2USAD8 | 
| 6863 | 301k |     35651584U,  // t2USADA8 | 
| 6864 | 301k |     14680064U,  // t2USAT | 
| 6865 | 301k |     0U, // t2USAT16 | 
| 6866 | 301k |     0U, // t2USAX | 
| 6867 | 301k |     0U, // t2USUB16 | 
| 6868 | 301k |     0U, // t2USUB8 | 
| 6869 | 301k |     12582912U,  // t2UXTAB | 
| 6870 | 301k |     12582912U,  // t2UXTAB16 | 
| 6871 | 301k |     12582912U,  // t2UXTAH | 
| 6872 | 301k |     7168U,  // t2UXTB | 
| 6873 | 301k |     7168U,  // t2UXTB16 | 
| 6874 | 301k |     7168U,  // t2UXTH | 
| 6875 | 301k |     0U, // tADC | 
| 6876 | 301k |     1112U,  // tADDhirr | 
| 6877 | 301k |     1048U,  // tADDi3 | 
| 6878 | 301k |     0U, // tADDi8 | 
| 6879 | 301k |     0U, // tADDrSP | 
| 6880 | 301k |     1212416U, // tADDrSPi | 
| 6881 | 301k |     1048U,  // tADDrr | 
| 6882 | 301k |     456U, // tADDspi | 
| 6883 | 301k |     1112U,  // tADDspr | 
| 6884 | 301k |     464U, // tADR | 
| 6885 | 301k |     0U, // tAND | 
| 6886 | 301k |     472U, // tASRri | 
| 6887 | 301k |     0U, // tASRrr | 
| 6888 | 301k |     0U, // tB | 
| 6889 | 301k |     0U, // tBIC | 
| 6890 | 301k |     0U, // tBKPT | 
| 6891 | 301k |     0U, // tBL | 
| 6892 | 301k |     0U, // tBLXNSr | 
| 6893 | 301k |     0U, // tBLXi | 
| 6894 | 301k |     0U, // tBLXr | 
| 6895 | 301k |     0U, // tBX | 
| 6896 | 301k |     0U, // tBXNS | 
| 6897 | 301k |     0U, // tBcc | 
| 6898 | 301k |     0U, // tCBNZ | 
| 6899 | 301k |     0U, // tCBZ | 
| 6900 | 301k |     1024U,  // tCMNz | 
| 6901 | 301k |     1024U,  // tCMPhir | 
| 6902 | 301k |     1024U,  // tCMPi8 | 
| 6903 | 301k |     1024U,  // tCMPr | 
| 6904 | 301k |     0U, // tCPS | 
| 6905 | 301k |     0U, // tEOR | 
| 6906 | 301k |     0U, // tHINT | 
| 6907 | 301k |     0U, // tHLT | 
| 6908 | 301k |     0U, // tInt_WIN_eh_sjlj_longjmp | 
| 6909 | 301k |     0U, // tInt_eh_sjlj_longjmp | 
| 6910 | 301k |     0U, // tInt_eh_sjlj_setjmp | 
| 6911 | 301k |     1136U,  // tLDMIA | 
| 6912 | 301k |     480U, // tLDRBi | 
| 6913 | 301k |     488U, // tLDRBr | 
| 6914 | 301k |     496U, // tLDRHi | 
| 6915 | 301k |     488U, // tLDRHr | 
| 6916 | 301k |     488U, // tLDRSB | 
| 6917 | 301k |     488U, // tLDRSH | 
| 6918 | 301k |     504U, // tLDRi | 
| 6919 | 301k |     424U, // tLDRpci | 
| 6920 | 301k |     488U, // tLDRr | 
| 6921 | 301k |     512U, // tLDRspi | 
| 6922 | 301k |     1048U,  // tLSLri | 
| 6923 | 301k |     0U, // tLSLrr | 
| 6924 | 301k |     472U, // tLSRri | 
| 6925 | 301k |     0U, // tLSRrr | 
| 6926 | 301k |     0U, // tMOVSr | 
| 6927 | 301k |     0U, // tMOVi8 | 
| 6928 | 301k |     1024U,  // tMOVr | 
| 6929 | 301k |     1048U,  // tMUL | 
| 6930 | 301k |     0U, // tMVN | 
| 6931 | 301k |     0U, // tORR | 
| 6932 | 301k |     0U, // tPICADD | 
| 6933 | 301k |     0U, // tPOP | 
| 6934 | 301k |     0U, // tPUSH | 
| 6935 | 301k |     1024U,  // tREV | 
| 6936 | 301k |     1024U,  // tREV16 | 
| 6937 | 301k |     1024U,  // tREVSH | 
| 6938 | 301k |     0U, // tROR | 
| 6939 | 301k |     0U, // tRSB | 
| 6940 | 301k |     0U, // tSBC | 
| 6941 | 301k |     0U, // tSETEND | 
| 6942 | 301k |     33U,  // tSTMIA_UPD | 
| 6943 | 301k |     480U, // tSTRBi | 
| 6944 | 301k |     488U, // tSTRBr | 
| 6945 | 301k |     496U, // tSTRHi | 
| 6946 | 301k |     488U, // tSTRHr | 
| 6947 | 301k |     504U, // tSTRi | 
| 6948 | 301k |     488U, // tSTRr | 
| 6949 | 301k |     512U, // tSTRspi | 
| 6950 | 301k |     1048U,  // tSUBi3 | 
| 6951 | 301k |     0U, // tSUBi8 | 
| 6952 | 301k |     1048U,  // tSUBrr | 
| 6953 | 301k |     456U, // tSUBspi | 
| 6954 | 301k |     0U, // tSVC | 
| 6955 | 301k |     1024U,  // tSXTB | 
| 6956 | 301k |     1024U,  // tSXTH | 
| 6957 | 301k |     0U, // tTRAP | 
| 6958 | 301k |     1024U,  // tTST | 
| 6959 | 301k |     0U, // tUDF | 
| 6960 | 301k |     1024U,  // tUXTB | 
| 6961 | 301k |     1024U,  // tUXTH | 
| 6962 | 301k |     0U, // t__brkdiv0 | 
| 6963 | 301k |   }; | 
| 6964 |  |  | 
| 6965 | 301k |   unsigned int opcode = MCInst_getOpcode(MI); | 
| 6966 |  |   // printf("opcode = %u\n", opcode); | 
| 6967 |  |  | 
| 6968 |  |   // Emit the opcode for the instruction. | 
| 6969 | 301k |   uint64_t Bits = 0; | 
| 6970 | 301k |   Bits |= (uint64_t)OpInfo0[opcode] << 0; | 
| 6971 | 301k |   Bits |= (uint64_t)OpInfo1[opcode] << 32; | 
| 6972 | 301k | #ifndef CAPSTONE_DIET | 
| 6973 | 301k |   SStream_concat0(O, AsmStrs+(Bits & 4095)-1); | 
| 6974 | 301k | #endif | 
| 6975 |  |  | 
| 6976 |  |  | 
| 6977 |  |   // Fragment 0 encoded into 5 bits for 32 unique commands. | 
| 6978 |  |   // printf("Fragment 0: %"PRIu64"\n", ((Bits >> 12) & 31)); | 
| 6979 | 301k |   switch ((Bits >> 12) & 31) { | 
| 6980 | 0 |   default: // unreachable | 
| 6981 | 18 |   case 0: | 
| 6982 |  |     // DBG_VALUE, DBG_LABEL, BUNDLE, LIFETIME_START, LIFETIME_END, FENTRY_CAL... | 
| 6983 | 18 |     return; | 
| 6984 | 0 |     break; | 
| 6985 | 10.6k |   case 1: | 
| 6986 |  |     // ASRi, ASRr, LSLi, LSLr, LSRi, LSRr, RORi, RORr, ADCri, ADCrr, ADDri, A... | 
| 6987 | 10.6k |     printSBitModifierOperand(MI, 5, O); | 
| 6988 | 10.6k |     printPredicateOperand(MI, 3, O); | 
| 6989 | 10.6k |     break; | 
| 6990 | 4.03k |   case 2: | 
| 6991 |  |     // ITasm, t2IT | 
| 6992 | 4.03k |     printThumbITMask(MI, 1, O); | 
| 6993 | 4.03k |     break; | 
| 6994 | 34.6k |   case 3: | 
| 6995 |  |     // LDRBT_POST, LDRConstPool, LDRT_POST, STRBT_POST, STRT_POST, t2LDRBpcre... | 
| 6996 | 34.6k |     printPredicateOperand(MI, 2, O); | 
| 6997 | 34.6k |     break; | 
| 6998 | 818 |   case 4: | 
| 6999 |  |     // RRXi, MOVi, MOVr, MOVr_TC, MVNi, MVNr, t2MOVi, t2MOVr, t2MVNi, t2MVNr,... | 
| 7000 | 818 |     printSBitModifierOperand(MI, 4, O); | 
| 7001 | 818 |     printPredicateOperand(MI, 2, O); | 
| 7002 | 818 |     break; | 
| 7003 | 24.9k |   case 5: | 
| 7004 |  |     // VLD1LNdAsm_16, VLD1LNdAsm_32, VLD1LNdAsm_8, VLD1LNdWB_fixed_Asm_16, VL... | 
| 7005 | 24.9k |     printPredicateOperand(MI, 4, O); | 
| 7006 | 24.9k |     break; | 
| 7007 | 18.3k |   case 6: | 
| 7008 |  |     // VLD1LNdWB_register_Asm_16, VLD1LNdWB_register_Asm_32, VLD1LNdWB_regist... | 
| 7009 | 18.3k |     printPredicateOperand(MI, 5, O); | 
| 7010 | 18.3k |     break; | 
| 7011 | 69.7k |   case 7: | 
| 7012 |  |     // VLD3DUPdAsm_16, VLD3DUPdAsm_32, VLD3DUPdAsm_8, VLD3DUPdWB_fixed_Asm_16... | 
| 7013 | 69.7k |     printPredicateOperand(MI, 3, O); | 
| 7014 | 69.7k |     break; | 
| 7015 | 6.85k |   case 8: | 
| 7016 |  |     // ADCrsi, ADDrsi, ANDrsi, BICrsi, EORrsi, MLA, MOVsr, MVNsr, ORRrsi, RSB... | 
| 7017 | 6.85k |     printSBitModifierOperand(MI, 6, O); | 
| 7018 | 6.85k |     printPredicateOperand(MI, 4, O); | 
| 7019 | 6.85k |     break; | 
| 7020 | 1.87k |   case 9: | 
| 7021 |  |     // ADCrsr, ADDrsr, ANDrsr, BICrsr, EORrsr, ORRrsr, RSBrsr, RSCrsr, SBCrsr... | 
| 7022 | 1.87k |     printSBitModifierOperand(MI, 7, O); | 
| 7023 | 1.87k |     printPredicateOperand(MI, 5, O); | 
| 7024 | 1.87k |     SStream_concat0(O, "\t"); | 
| 7025 | 1.87k |     printOperand(MI, 0, O); | 
| 7026 | 1.87k |     SStream_concat0(O, ", "); | 
| 7027 | 1.87k |     printOperand(MI, 1, O); | 
| 7028 | 1.87k |     SStream_concat0(O, ", "); | 
| 7029 | 1.87k |     printSORegRegOperand(MI, 2, O); | 
| 7030 | 1.87k |     return; | 
| 7031 | 0 |     break; | 
| 7032 | 31.6k |   case 10: | 
| 7033 |  |     // AESD, AESE, AESIMC, AESMC, BKPT, BL, BLX, BLXi, BX, CPS1p, CRC32B, CRC... | 
| 7034 | 31.6k |     printOperand(MI, 0, O); | 
| 7035 | 31.6k |     break; | 
| 7036 | 23.9k |   case 11: | 
| 7037 |  |     // BLX_pred, BL_pred, BXJ, BX_pred, Bcc, DBG, FLDMXIA, FSTMXIA, HINT, LDM... | 
| 7038 | 23.9k |     printPredicateOperand(MI, 1, O); | 
| 7039 | 23.9k |     break; | 
| 7040 | 2.61k |   case 12: | 
| 7041 |  |     // BX_RET, ERET, FMSTAT, MOVPCLR, t2CLREX, t2DCPS1, t2DCPS2, t2DCPS3, t2S... | 
| 7042 | 2.61k |     printPredicateOperand(MI, 0, O); | 
| 7043 | 2.61k |     break; | 
| 7044 | 6.26k |   case 13: | 
| 7045 |  |     // CDP, LDRD_POST, LDRD_PRE, MCR, MRC, SMLALBB, SMLALBT, SMLALD, SMLALDX,... | 
| 7046 | 6.26k |     printPredicateOperand(MI, 6, O); | 
| 7047 | 6.26k |     break; | 
| 7048 | 2.10k |   case 14: | 
| 7049 |  |     // CDP2, LDC2L_OFFSET, LDC2L_OPTION, LDC2L_POST, LDC2L_PRE, LDC2_OFFSET, ... | 
| 7050 | 2.10k |     printPImmediate(MI, 0, O); | 
| 7051 | 2.10k |     SStream_concat0(O, ", "); | 
| 7052 | 2.10k |     break; | 
| 7053 | 309 |   case 15: | 
| 7054 |  |     // CPS2p, CPS3p, t2CPS2p, t2CPS3p, tCPS | 
| 7055 | 309 |     printCPSIMod(MI, 0, O); | 
| 7056 | 309 |     break; | 
| 7057 | 194 |   case 16: | 
| 7058 |  |     // DMB, DSB | 
| 7059 | 194 |     printMemBOption(MI, 0, O); | 
| 7060 | 194 |     return; | 
| 7061 | 0 |     break; | 
| 7062 | 23 |   case 17: | 
| 7063 |  |     // ISB | 
| 7064 | 23 |     printInstSyncBOption(MI, 0, O); | 
| 7065 | 23 |     return; | 
| 7066 | 0 |     break; | 
| 7067 | 117 |   case 18: | 
| 7068 |  |     // MRC2 | 
| 7069 | 117 |     printPImmediate(MI, 1, O); | 
| 7070 | 117 |     SStream_concat0(O, ", "); | 
| 7071 | 117 |     printOperand(MI, 2, O); | 
| 7072 | 117 |     SStream_concat0(O, ", "); | 
| 7073 | 117 |     printOperand(MI, 0, O); | 
| 7074 | 117 |     SStream_concat0(O, ", "); | 
| 7075 | 117 |     printCImmediate(MI, 3, O); | 
| 7076 | 117 |     SStream_concat0(O, ", "); | 
| 7077 | 117 |     printCImmediate(MI, 4, O); | 
| 7078 | 117 |     SStream_concat0(O, ", "); | 
| 7079 | 117 |     printOperand(MI, 5, O); | 
| 7080 | 117 |     return; | 
| 7081 | 0 |     break; | 
| 7082 | 38 |   case 19: | 
| 7083 |  |     // MRRC2 | 
| 7084 | 38 |     printPImmediate(MI, 2, O); | 
| 7085 | 38 |     SStream_concat0(O, ", "); | 
| 7086 | 38 |     printOperand(MI, 3, O); | 
| 7087 | 38 |     SStream_concat0(O, ", "); | 
| 7088 | 38 |     printOperand(MI, 0, O); | 
| 7089 | 38 |     SStream_concat0(O, ", "); | 
| 7090 | 38 |     printOperand(MI, 1, O); | 
| 7091 | 38 |     SStream_concat0(O, ", "); | 
| 7092 | 38 |     printCImmediate(MI, 4, O); | 
| 7093 | 38 |     return; | 
| 7094 | 0 |     break; | 
| 7095 | 45 |   case 20: | 
| 7096 |  |     // PLDWi12, PLDi12, PLIi12 | 
| 7097 | 45 |     printAddrModeImm12Operand(MI, 0, O, false); | 
| 7098 | 45 |     return; | 
| 7099 | 0 |     break; | 
| 7100 | 20 |   case 21: | 
| 7101 |  |     // PLDWrs, PLDrs, PLIrs | 
| 7102 | 20 |     printAddrMode2Operand(MI, 0, O); | 
| 7103 | 20 |     return; | 
| 7104 | 0 |     break; | 
| 7105 | 966 |   case 22: | 
| 7106 |  |     // SETEND, tSETEND | 
| 7107 | 966 |     printSetendOperand(MI, 0, O); | 
| 7108 | 966 |     return; | 
| 7109 | 0 |     break; | 
| 7110 | 139 |   case 23: | 
| 7111 |  |     // SMLAL, UMLAL | 
| 7112 | 139 |     printSBitModifierOperand(MI, 8, O); | 
| 7113 | 139 |     printPredicateOperand(MI, 6, O); | 
| 7114 | 139 |     SStream_concat0(O, "\t"); | 
| 7115 | 139 |     printOperand(MI, 0, O); | 
| 7116 | 139 |     SStream_concat0(O, ", "); | 
| 7117 | 139 |     printOperand(MI, 1, O); | 
| 7118 | 139 |     SStream_concat0(O, ", "); | 
| 7119 | 139 |     printOperand(MI, 2, O); | 
| 7120 | 139 |     SStream_concat0(O, ", "); | 
| 7121 | 139 |     printOperand(MI, 3, O); | 
| 7122 | 139 |     return; | 
| 7123 | 0 |     break; | 
| 7124 | 0 |   case 24: | 
| 7125 |  |     // TSB | 
| 7126 | 0 |     printTraceSyncBOption(MI, 0, O); | 
| 7127 | 0 |     return; | 
| 7128 | 0 |     break; | 
| 7129 | 1.90k |   case 25: | 
| 7130 |  |     // VLD1LNd16_UPD, VLD1LNd32_UPD, VLD1LNd8_UPD, VLD2LNd16, VLD2LNd32, VLD2... | 
| 7131 | 1.90k |     printPredicateOperand(MI, 7, O); | 
| 7132 | 1.90k |     break; | 
| 7133 | 758 |   case 26: | 
| 7134 |  |     // VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_UPD, VLD2LNq32_U... | 
| 7135 | 758 |     printPredicateOperand(MI, 9, O); | 
| 7136 | 758 |     break; | 
| 7137 | 279 |   case 27: | 
| 7138 |  |     // VLD3LNd16_UPD, VLD3LNd32_UPD, VLD3LNd8_UPD, VLD3LNq16_UPD, VLD3LNq32_U... | 
| 7139 | 279 |     printPredicateOperand(MI, 11, O); | 
| 7140 | 279 |     break; | 
| 7141 | 1.66k |   case 28: | 
| 7142 |  |     // VLD4DUPd16_UPD, VLD4DUPd32_UPD, VLD4DUPd8_UPD, VLD4DUPq16_UPD, VLD4DUP... | 
| 7143 | 1.66k |     printPredicateOperand(MI, 8, O); | 
| 7144 | 1.66k |     break; | 
| 7145 | 474 |   case 29: | 
| 7146 |  |     // VLD4LNd16_UPD, VLD4LNd32_UPD, VLD4LNd8_UPD, VLD4LNq16_UPD, VLD4LNq32_U... | 
| 7147 | 474 |     printPredicateOperand(MI, 13, O); | 
| 7148 | 474 |     break; | 
| 7149 | 16 |   case 30: | 
| 7150 |  |     // VSDOTD, VSDOTDI, VSDOTQ, VSDOTQI, VUDOTD, VUDOTDI, VUDOTQ, VUDOTQI | 
| 7151 | 16 |     printOperand(MI, 1, O); | 
| 7152 | 16 |     SStream_concat0(O, ", "); | 
| 7153 | 16 |     printOperand(MI, 2, O); | 
| 7154 | 16 |     SStream_concat0(O, ", "); | 
| 7155 | 16 |     printOperand(MI, 3, O); | 
| 7156 | 16 |     break; | 
| 7157 | 55.6k |   case 31: | 
| 7158 |  |     // tADC, tADDi3, tADDi8, tADDrr, tAND, tASRri, tASRrr, tBIC, tEOR, tLSLri... | 
| 7159 | 55.6k |     printSBitModifierOperand(MI, 1, O); | 
| 7160 | 55.6k |     break; | 
| 7161 | 301k |   } | 
| 7162 |  |  | 
| 7163 |  |  | 
| 7164 |  |   // Fragment 1 encoded into 7 bits for 75 unique commands. | 
| 7165 |  |   // printf("Fragment 1: %"PRIu64"\n", ((Bits >> 17) & 127)); | 
| 7166 | 297k |   switch ((Bits >> 17) & 127) { | 
| 7167 | 0 |   default: // unreachable | 
| 7168 | 83 |   case 0: | 
| 7169 |  |     // ASRi, ASRr, ITasm, LDRBT_POST, LDRConstPool, LDRT_POST, LSLi, LSLr, LS... | 
| 7170 | 83 |     SStream_concat0(O, " "); | 
| 7171 | 83 |     break; | 
| 7172 | 4.38k |   case 1: | 
| 7173 |  |     // VLD1LNdAsm_16, VLD1LNdWB_fixed_Asm_16, VLD1LNdWB_register_Asm_16, VLD2... | 
| 7174 | 4.38k |     SStream_concat0(O, ".16\t"); | 
| 7175 | 4.38k |     ARM_addVectorDataSize(MI, 16); | 
| 7176 | 4.38k |     break; | 
| 7177 | 2.21k |   case 2: | 
| 7178 |  |     // VLD1LNdAsm_32, VLD1LNdWB_fixed_Asm_32, VLD1LNdWB_register_Asm_32, VLD2... | 
| 7179 | 2.21k |     SStream_concat0(O, ".32\t"); | 
| 7180 | 2.21k |     ARM_addVectorDataSize(MI, 32); | 
| 7181 | 2.21k |     break; | 
| 7182 | 3.29k |   case 3: | 
| 7183 |  |     // VLD1LNdAsm_8, VLD1LNdWB_fixed_Asm_8, VLD1LNdWB_register_Asm_8, VLD2LNd... | 
| 7184 | 3.29k |     SStream_concat0(O, ".8\t"); | 
| 7185 | 3.29k |     ARM_addVectorDataSize(MI, 8); | 
| 7186 | 3.29k |     break; | 
| 7187 | 172k |   case 4: | 
| 7188 |  |     // ADCri, ADCrr, ADCrsi, ADDri, ADDrr, ADDrsi, ADR, ANDri, ANDrr, ANDrsi,... | 
| 7189 | 172k |     SStream_concat0(O, "\t"); | 
| 7190 | 172k |     break; | 
| 7191 | 28.6k |   case 5: | 
| 7192 |  |     // AESD, AESE, AESIMC, AESMC, CRC32B, CRC32CB, CRC32CH, CRC32CW, CRC32H, ... | 
| 7193 | 28.6k |     SStream_concat0(O, ", "); | 
| 7194 | 28.6k |     break; | 
| 7195 | 2.88k |   case 6: | 
| 7196 |  |     // BKPT, BL, BLX, BLXi, BX, CPS1p, ERET, HLT, HVC, RFEDA, RFEDB, RFEIA, R... | 
| 7197 | 2.88k |     return; | 
| 7198 | 0 |     break; | 
| 7199 | 5 |   case 7: | 
| 7200 |  |     // BX_RET | 
| 7201 | 5 |     SStream_concat0(O, "\tlr"); | 
| 7202 | 5 |     ARM_addReg(MI, ARM_REG_LR); | 
| 7203 | 5 |     return; | 
| 7204 | 0 |     break; | 
| 7205 | 450 |   case 8: | 
| 7206 |  |     // CDP2, MCR2, MCRR2 | 
| 7207 | 450 |     printOperand(MI, 1, O); | 
| 7208 | 450 |     SStream_concat0(O, ", "); | 
| 7209 | 450 |     break; | 
| 7210 | 379 |   case 9: | 
| 7211 |  |     // FCONSTD, VABSD, VADDD, VCMPD, VCMPED, VCMPEZD, VCMPZD, VDIVD, VFMAD, V... | 
| 7212 | 379 |     SStream_concat0(O, ".f64\t"); | 
| 7213 | 379 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_F64); | 
| 7214 | 379 |     printOperand(MI, 0, O); | 
| 7215 | 379 |     break; | 
| 7216 | 578 |   case 10: | 
| 7217 |  |     // FCONSTH, VABDhd, VABDhq, VABSH, VABShd, VABShq, VACGEhd, VACGEhq, VACG... | 
| 7218 | 578 |     SStream_concat0(O, ".f16\t"); | 
| 7219 | 578 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_F16); | 
| 7220 | 578 |     printOperand(MI, 0, O); | 
| 7221 | 578 |     break; | 
| 7222 | 734 |   case 11: | 
| 7223 |  |     // FCONSTS, VABDfd, VABDfq, VABSS, VABSfd, VABSfq, VACGEfd, VACGEfq, VACG... | 
| 7224 | 734 |     SStream_concat0(O, ".f32\t"); | 
| 7225 | 734 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_F32); | 
| 7226 | 734 |     printOperand(MI, 0, O); | 
| 7227 | 734 |     break; | 
| 7228 | 24 |   case 12: | 
| 7229 |  |     // FMSTAT | 
| 7230 | 24 |     SStream_concat0(O, "\tapsr_nzcv, fpscr"); | 
| 7231 | 24 |     ARM_addReg(MI, ARM_REG_APSR_NZCV); | 
| 7232 | 24 |     ARM_addReg(MI, ARM_REG_FPSCR); | 
| 7233 | 24 |     return; | 
| 7234 | 0 |     break; | 
| 7235 | 1.65k |   case 13: | 
| 7236 |  |     // LDC2L_OFFSET, LDC2L_OPTION, LDC2L_POST, LDC2L_PRE, LDC2_OFFSET, LDC2_O... | 
| 7237 | 1.65k |     printCImmediate(MI, 1, O); | 
| 7238 | 1.65k |     SStream_concat0(O, ", "); | 
| 7239 | 1.65k |     break; | 
| 7240 | 23 |   case 14: | 
| 7241 |  |     // MOVPCLR | 
| 7242 | 23 |     SStream_concat0(O, "\tpc, lr"); | 
| 7243 | 23 |     ARM_addReg(MI, ARM_REG_PC); | 
| 7244 | 23 |     ARM_addReg(MI, ARM_REG_LR); | 
| 7245 | 23 |     return; | 
| 7246 | 0 |     break; | 
| 7247 | 157 |   case 15: | 
| 7248 |  |     // RFEDA_UPD, RFEDB_UPD, RFEIA_UPD, RFEIB_UPD | 
| 7249 | 157 |     SStream_concat0(O, "!"); | 
| 7250 | 157 |     return; | 
| 7251 | 0 |     break; | 
| 7252 | 382 |   case 16: | 
| 7253 |  |     // VABALsv2i64, VABAsv2i32, VABAsv4i32, VABDLsv2i64, VABDsv2i32, VABDsv4i... | 
| 7254 | 382 |     SStream_concat0(O, ".s32\t"); | 
| 7255 | 382 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_S32); | 
| 7256 | 382 |     printOperand(MI, 0, O); | 
| 7257 | 382 |     SStream_concat0(O, ", "); | 
| 7258 | 382 |     break; | 
| 7259 | 323 |   case 17: | 
| 7260 |  |     // VABALsv4i32, VABAsv4i16, VABAsv8i16, VABDLsv4i32, VABDsv4i16, VABDsv8i... | 
| 7261 | 323 |     SStream_concat0(O, ".s16\t"); | 
| 7262 | 323 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_S16); | 
| 7263 | 323 |     printOperand(MI, 0, O); | 
| 7264 | 323 |     SStream_concat0(O, ", "); | 
| 7265 | 323 |     break; | 
| 7266 | 178 |   case 18: | 
| 7267 |  |     // VABALsv8i16, VABAsv16i8, VABAsv8i8, VABDLsv8i16, VABDsv16i8, VABDsv8i8... | 
| 7268 | 178 |     SStream_concat0(O, ".s8\t"); | 
| 7269 | 178 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_S8); | 
| 7270 | 178 |     printOperand(MI, 0, O); | 
| 7271 | 178 |     SStream_concat0(O, ", "); | 
| 7272 | 178 |     break; | 
| 7273 | 550 |   case 19: | 
| 7274 |  |     // VABALuv2i64, VABAuv2i32, VABAuv4i32, VABDLuv2i64, VABDuv2i32, VABDuv4i... | 
| 7275 | 550 |     SStream_concat0(O, ".u32\t"); | 
| 7276 | 550 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_U32); | 
| 7277 | 550 |     printOperand(MI, 0, O); | 
| 7278 | 550 |     SStream_concat0(O, ", "); | 
| 7279 | 550 |     break; | 
| 7280 | 209 |   case 20: | 
| 7281 |  |     // VABALuv4i32, VABAuv4i16, VABAuv8i16, VABDLuv4i32, VABDuv4i16, VABDuv8i... | 
| 7282 | 209 |     SStream_concat0(O, ".u16\t"); | 
| 7283 | 209 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_U16); | 
| 7284 | 209 |     printOperand(MI, 0, O); | 
| 7285 | 209 |     SStream_concat0(O, ", "); | 
| 7286 | 209 |     break; | 
| 7287 | 917 |   case 21: | 
| 7288 |  |     // VABALuv8i16, VABAuv16i8, VABAuv8i8, VABDLuv8i16, VABDuv16i8, VABDuv8i8... | 
| 7289 | 917 |     SStream_concat0(O, ".u8\t"); | 
| 7290 | 917 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_U8); | 
| 7291 | 917 |     printOperand(MI, 0, O); | 
| 7292 | 917 |     SStream_concat0(O, ", "); | 
| 7293 | 917 |     break; | 
| 7294 | 366 |   case 22: | 
| 7295 |  |     // VADDHNv2i32, VADDv1i64, VADDv2i64, VMOVNv2i32, VMOVv1i64, VMOVv2i64, V... | 
| 7296 | 366 |     SStream_concat0(O, ".i64\t"); | 
| 7297 | 366 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_I64); | 
| 7298 | 366 |     printOperand(MI, 0, O); | 
| 7299 | 366 |     SStream_concat0(O, ", "); | 
| 7300 | 366 |     break; | 
| 7301 | 1.23k |   case 23: | 
| 7302 |  |     // VADDHNv4i16, VADDv2i32, VADDv4i32, VBICiv2i32, VBICiv4i32, VCEQv2i32, ... | 
| 7303 | 1.23k |     SStream_concat0(O, ".i32\t"); | 
| 7304 | 1.23k |     ARM_addVectorDataType(MI, ARM_VECTORDATA_I32); | 
| 7305 | 1.23k |     printOperand(MI, 0, O); | 
| 7306 | 1.23k |     SStream_concat0(O, ", "); | 
| 7307 | 1.23k |     break; | 
| 7308 | 323 |   case 24: | 
| 7309 |  |     // VADDHNv8i8, VADDv4i16, VADDv8i16, VBICiv4i16, VBICiv8i16, VCEQv4i16, V... | 
| 7310 | 323 |     SStream_concat0(O, ".i16\t"); | 
| 7311 | 323 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_I16); | 
| 7312 | 323 |     printOperand(MI, 0, O); | 
| 7313 | 323 |     SStream_concat0(O, ", "); | 
| 7314 | 323 |     break; | 
| 7315 | 115 |   case 25: | 
| 7316 |  |     // VADDv16i8, VADDv8i8, VCEQv16i8, VCEQv8i8, VCEQzv16i8, VCEQzv8i8, VCLZv... | 
| 7317 | 115 |     SStream_concat0(O, ".i8\t"); | 
| 7318 | 115 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_I8); | 
| 7319 | 115 |     printOperand(MI, 0, O); | 
| 7320 | 115 |     SStream_concat0(O, ", "); | 
| 7321 | 115 |     break; | 
| 7322 | 17 |   case 26: | 
| 7323 |  |     // VCVTBDH, VCVTTDH | 
| 7324 | 17 |     SStream_concat0(O, ".f16.f64\t"); | 
| 7325 | 17 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_F16F64); | 
| 7326 | 17 |     printOperand(MI, 0, O); | 
| 7327 | 17 |     SStream_concat0(O, ", "); | 
| 7328 | 17 |     printOperand(MI, 1, O); | 
| 7329 | 17 |     return; | 
| 7330 | 0 |     break; | 
| 7331 | 36 |   case 27: | 
| 7332 |  |     // VCVTBHD, VCVTTHD | 
| 7333 | 36 |     SStream_concat0(O, ".f64.f16\t"); | 
| 7334 | 36 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_F64F16); | 
| 7335 | 36 |     printOperand(MI, 0, O); | 
| 7336 | 36 |     SStream_concat0(O, ", "); | 
| 7337 | 36 |     printOperand(MI, 1, O); | 
| 7338 | 36 |     return; | 
| 7339 | 0 |     break; | 
| 7340 | 17 |   case 28: | 
| 7341 |  |     // VCVTBHS, VCVTTHS, VCVTh2f | 
| 7342 | 17 |     SStream_concat0(O, ".f32.f16\t"); | 
| 7343 | 17 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_F32F16); | 
| 7344 | 17 |     printOperand(MI, 0, O); | 
| 7345 | 17 |     SStream_concat0(O, ", "); | 
| 7346 | 17 |     printOperand(MI, 1, O); | 
| 7347 | 17 |     return; | 
| 7348 | 0 |     break; | 
| 7349 | 42 |   case 29: | 
| 7350 |  |     // VCVTBSH, VCVTTSH, VCVTf2h | 
| 7351 | 42 |     SStream_concat0(O, ".f16.f32\t"); | 
| 7352 | 42 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_F16F32); | 
| 7353 | 42 |     printOperand(MI, 0, O); | 
| 7354 | 42 |     SStream_concat0(O, ", "); | 
| 7355 | 42 |     printOperand(MI, 1, O); | 
| 7356 | 42 |     return; | 
| 7357 | 0 |     break; | 
| 7358 | 138 |   case 30: | 
| 7359 |  |     // VCVTDS | 
| 7360 | 138 |     SStream_concat0(O, ".f64.f32\t"); | 
| 7361 | 138 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_F64F32); | 
| 7362 | 138 |     printOperand(MI, 0, O); | 
| 7363 | 138 |     SStream_concat0(O, ", "); | 
| 7364 | 138 |     printOperand(MI, 1, O); | 
| 7365 | 138 |     return; | 
| 7366 | 0 |     break; | 
| 7367 | 13 |   case 31: | 
| 7368 |  |     // VCVTSD | 
| 7369 | 13 |     SStream_concat0(O, ".f32.f64\t"); | 
| 7370 | 13 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_F32F64); | 
| 7371 | 13 |     printOperand(MI, 0, O); | 
| 7372 | 13 |     SStream_concat0(O, ", "); | 
| 7373 | 13 |     printOperand(MI, 1, O); | 
| 7374 | 13 |     return; | 
| 7375 | 0 |     break; | 
| 7376 | 53 |   case 32: | 
| 7377 |  |     // VCVTf2sd, VCVTf2sq, VCVTf2xsd, VCVTf2xsq, VTOSIRS, VTOSIZS, VTOSLS | 
| 7378 | 53 |     SStream_concat0(O, ".s32.f32\t"); | 
| 7379 | 53 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_S32F32); | 
| 7380 | 53 |     printOperand(MI, 0, O); | 
| 7381 | 53 |     SStream_concat0(O, ", "); | 
| 7382 | 53 |     printOperand(MI, 1, O); | 
| 7383 | 53 |     break; | 
| 7384 | 45 |   case 33: | 
| 7385 |  |     // VCVTf2ud, VCVTf2uq, VCVTf2xud, VCVTf2xuq, VTOUIRS, VTOUIZS, VTOULS | 
| 7386 | 45 |     SStream_concat0(O, ".u32.f32\t"); | 
| 7387 | 45 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_U32F32); | 
| 7388 | 45 |     printOperand(MI, 0, O); | 
| 7389 | 45 |     SStream_concat0(O, ", "); | 
| 7390 | 45 |     printOperand(MI, 1, O); | 
| 7391 | 45 |     break; | 
| 7392 | 128 |   case 34: | 
| 7393 |  |     // VCVTh2sd, VCVTh2sq, VCVTh2xsd, VCVTh2xsq, VTOSHH | 
| 7394 | 128 |     SStream_concat0(O, ".s16.f16\t"); | 
| 7395 | 128 |     printOperand(MI, 0, O); | 
| 7396 | 128 |     SStream_concat0(O, ", "); | 
| 7397 | 128 |     printOperand(MI, 1, O); | 
| 7398 | 128 |     break; | 
| 7399 | 38 |   case 35: | 
| 7400 |  |     // VCVTh2ud, VCVTh2uq, VCVTh2xud, VCVTh2xuq, VTOUHH | 
| 7401 | 38 |     SStream_concat0(O, ".u16.f16\t"); | 
| 7402 | 38 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_U16F16); | 
| 7403 | 38 |     printOperand(MI, 0, O); | 
| 7404 | 38 |     SStream_concat0(O, ", "); | 
| 7405 | 38 |     printOperand(MI, 1, O); | 
| 7406 | 38 |     break; | 
| 7407 | 220 |   case 36: | 
| 7408 |  |     // VCVTs2fd, VCVTs2fq, VCVTxs2fd, VCVTxs2fq, VSITOS, VSLTOS | 
| 7409 | 220 |     SStream_concat0(O, ".f32.s32\t"); | 
| 7410 | 220 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_F32S32); | 
| 7411 | 220 |     printOperand(MI, 0, O); | 
| 7412 | 220 |     SStream_concat0(O, ", "); | 
| 7413 | 220 |     printOperand(MI, 1, O); | 
| 7414 | 220 |     break; | 
| 7415 | 20 |   case 37: | 
| 7416 |  |     // VCVTs2hd, VCVTs2hq, VCVTxs2hd, VCVTxs2hq, VSHTOH | 
| 7417 | 20 |     SStream_concat0(O, ".f16.s16\t"); | 
| 7418 | 20 |     printOperand(MI, 0, O); | 
| 7419 | 20 |     SStream_concat0(O, ", "); | 
| 7420 | 20 |     printOperand(MI, 1, O); | 
| 7421 | 20 |     break; | 
| 7422 | 12 |   case 38: | 
| 7423 |  |     // VCVTu2fd, VCVTu2fq, VCVTxu2fd, VCVTxu2fq, VUITOS, VULTOS | 
| 7424 | 12 |     SStream_concat0(O, ".f32.u32\t"); | 
| 7425 | 12 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_F32U32); | 
| 7426 | 12 |     printOperand(MI, 0, O); | 
| 7427 | 12 |     SStream_concat0(O, ", "); | 
| 7428 | 12 |     printOperand(MI, 1, O); | 
| 7429 | 12 |     break; | 
| 7430 | 14 |   case 39: | 
| 7431 |  |     // VCVTu2hd, VCVTu2hq, VCVTxu2hd, VCVTxu2hq, VUHTOH | 
| 7432 | 14 |     SStream_concat0(O, ".f16.u16\t"); | 
| 7433 | 14 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_F16U16); | 
| 7434 | 14 |     printOperand(MI, 0, O); | 
| 7435 | 14 |     SStream_concat0(O, ", "); | 
| 7436 | 14 |     printOperand(MI, 1, O); | 
| 7437 | 14 |     break; | 
| 7438 | 574 |   case 40: | 
| 7439 |  |     // VEXTq64, VLD1d64, VLD1d64Q, VLD1d64Qwb_fixed, VLD1d64Qwb_register, VLD... | 
| 7440 | 574 |     SStream_concat0(O, ".64\t"); | 
| 7441 | 574 |     ARM_addVectorDataSize(MI, 64); | 
| 7442 | 574 |     break; | 
| 7443 | 44 |   case 41: | 
| 7444 |  |     // VJCVT, VTOSIRD, VTOSIZD, VTOSLD | 
| 7445 | 44 |     SStream_concat0(O, ".s32.f64\t"); | 
| 7446 | 44 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_S32F64); | 
| 7447 | 44 |     printOperand(MI, 0, O); | 
| 7448 | 44 |     SStream_concat0(O, ", "); | 
| 7449 | 44 |     printOperand(MI, 1, O); | 
| 7450 | 44 |     break; | 
| 7451 | 2.94k |   case 42: | 
| 7452 |  |     // VLD1LNd16, VLD1LNd16_UPD, VLD2LNd16, VLD2LNd16_UPD, VLD2LNq16, VLD2LNq... | 
| 7453 | 2.94k |     SStream_concat0(O, ".16\t{"); | 
| 7454 | 2.94k |     ARM_addVectorDataSize(MI, 16); | 
| 7455 | 2.94k |     break; | 
| 7456 | 2.38k |   case 43: | 
| 7457 |  |     // VLD1LNd32, VLD1LNd32_UPD, VLD2LNd32, VLD2LNd32_UPD, VLD2LNq32, VLD2LNq... | 
| 7458 | 2.38k |     SStream_concat0(O, ".32\t{"); | 
| 7459 | 2.38k |     ARM_addVectorDataSize(MI, 32); | 
| 7460 | 2.38k |     break; | 
| 7461 | 1.98k |   case 44: | 
| 7462 |  |     // VLD1LNd8, VLD1LNd8_UPD, VLD2LNd8, VLD2LNd8_UPD, VLD3DUPd8, VLD3DUPd8_U... | 
| 7463 | 1.98k |     SStream_concat0(O, ".8\t{"); | 
| 7464 | 1.98k |     ARM_addVectorDataSize(MI, 8); | 
| 7465 | 1.98k |     break; | 
| 7466 | 66 |   case 45: | 
| 7467 |  |     // VMSR | 
| 7468 | 66 |     SStream_concat0(O, "\tfpscr, "); | 
| 7469 | 66 |     ARM_addReg(MI, ARM_REG_FPSCR); | 
| 7470 | 66 |     printOperand(MI, 0, O); | 
| 7471 | 66 |     return; | 
| 7472 | 0 |     break; | 
| 7473 | 136 |   case 46: | 
| 7474 |  |     // VMSR_FPEXC | 
| 7475 | 136 |     SStream_concat0(O, "\tfpexc, "); | 
| 7476 | 136 |     ARM_addReg(MI, ARM_REG_FPEXC); | 
| 7477 | 136 |     printOperand(MI, 0, O); | 
| 7478 | 136 |     return; | 
| 7479 | 0 |     break; | 
| 7480 | 24 |   case 47: | 
| 7481 |  |     // VMSR_FPINST | 
| 7482 | 24 |     SStream_concat0(O, "\tfpinst, "); | 
| 7483 | 24 |     ARM_addReg(MI, ARM_REG_FPINST); | 
| 7484 | 24 |     printOperand(MI, 0, O); | 
| 7485 | 24 |     return; | 
| 7486 | 0 |     break; | 
| 7487 | 197 |   case 48: | 
| 7488 |  |     // VMSR_FPINST2 | 
| 7489 | 197 |     SStream_concat0(O, "\tfpinst2, "); | 
| 7490 | 197 |     ARM_addReg(MI, ARM_REG_FPINST2); | 
| 7491 | 197 |     printOperand(MI, 0, O); | 
| 7492 | 197 |     return; | 
| 7493 | 0 |     break; | 
| 7494 | 15 |   case 49: | 
| 7495 |  |     // VMSR_FPSID | 
| 7496 | 15 |     SStream_concat0(O, "\tfpsid, "); | 
| 7497 | 15 |     ARM_addReg(MI, ARM_REG_FPSID); | 
| 7498 | 15 |     printOperand(MI, 0, O); | 
| 7499 | 15 |     return; | 
| 7500 | 0 |     break; | 
| 7501 | 207 |   case 50: | 
| 7502 |  |     // VMULLp8, VMULpd, VMULpq | 
| 7503 | 207 |     SStream_concat0(O, ".p8\t"); | 
| 7504 | 207 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_P8); | 
| 7505 | 207 |     printOperand(MI, 0, O); | 
| 7506 | 207 |     SStream_concat0(O, ", "); | 
| 7507 | 207 |     printOperand(MI, 1, O); | 
| 7508 | 207 |     SStream_concat0(O, ", "); | 
| 7509 | 207 |     printOperand(MI, 2, O); | 
| 7510 | 207 |     return; | 
| 7511 | 0 |     break; | 
| 7512 | 119 |   case 51: | 
| 7513 |  |     // VQADDsv1i64, VQADDsv2i64, VQMOVNsuv2i32, VQMOVNsv2i32, VQRSHLsv1i64, V... | 
| 7514 | 119 |     SStream_concat0(O, ".s64\t"); | 
| 7515 | 119 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_S64); | 
| 7516 | 119 |     printOperand(MI, 0, O); | 
| 7517 | 119 |     SStream_concat0(O, ", "); | 
| 7518 | 119 |     break; | 
| 7519 | 266 |   case 52: | 
| 7520 |  |     // VQADDuv1i64, VQADDuv2i64, VQMOVNuv2i32, VQRSHLuv1i64, VQRSHLuv2i64, VQ... | 
| 7521 | 266 |     SStream_concat0(O, ".u64\t"); | 
| 7522 | 266 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_U64); | 
| 7523 | 266 |     printOperand(MI, 0, O); | 
| 7524 | 266 |     SStream_concat0(O, ", "); | 
| 7525 | 266 |     break; | 
| 7526 | 16 |   case 53: | 
| 7527 |  |     // VSDOTDI, VSDOTQI, VUDOTDI, VUDOTQI | 
| 7528 | 16 |     printVectorIndex(MI, 4, O); | 
| 7529 | 16 |     return; | 
| 7530 | 0 |     break; | 
| 7531 | 5 |   case 54: | 
| 7532 |  |     // VSHTOD | 
| 7533 | 5 |     SStream_concat0(O, ".f64.s16\t"); | 
| 7534 | 5 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_F64S16); | 
| 7535 | 5 |     printOperand(MI, 0, O); | 
| 7536 | 5 |     SStream_concat0(O, ", "); | 
| 7537 | 5 |     printOperand(MI, 1, O); | 
| 7538 | 5 |     SStream_concat0(O, ", "); | 
| 7539 | 5 |     printFBits16(MI, 2, O); | 
| 7540 | 5 |     return; | 
| 7541 | 0 |     break; | 
| 7542 | 19 |   case 55: | 
| 7543 |  |     // VSHTOS | 
| 7544 | 19 |     SStream_concat0(O, ".f32.s16\t"); | 
| 7545 | 19 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_F32S16); | 
| 7546 | 19 |     printOperand(MI, 0, O); | 
| 7547 | 19 |     SStream_concat0(O, ", "); | 
| 7548 | 19 |     printOperand(MI, 1, O); | 
| 7549 | 19 |     SStream_concat0(O, ", "); | 
| 7550 | 19 |     printFBits16(MI, 2, O); | 
| 7551 | 19 |     return; | 
| 7552 | 0 |     break; | 
| 7553 | 9 |   case 56: | 
| 7554 |  |     // VSITOD, VSLTOD | 
| 7555 | 9 |     SStream_concat0(O, ".f64.s32\t"); | 
| 7556 | 9 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_F64S32); | 
| 7557 | 9 |     printOperand(MI, 0, O); | 
| 7558 | 9 |     SStream_concat0(O, ", "); | 
| 7559 | 9 |     printOperand(MI, 1, O); | 
| 7560 | 9 |     break; | 
| 7561 | 155 |   case 57: | 
| 7562 |  |     // VSITOH, VSLTOH | 
| 7563 | 155 |     SStream_concat0(O, ".f16.s32\t"); | 
| 7564 | 155 |     printOperand(MI, 0, O); | 
| 7565 | 155 |     SStream_concat0(O, ", "); | 
| 7566 | 155 |     printOperand(MI, 1, O); | 
| 7567 | 155 |     break; | 
| 7568 | 98 |   case 58: | 
| 7569 |  |     // VTOSHD | 
| 7570 | 98 |     SStream_concat0(O, ".s16.f64\t"); | 
| 7571 | 98 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_S16F64); | 
| 7572 | 98 |     printOperand(MI, 0, O); | 
| 7573 | 98 |     SStream_concat0(O, ", "); | 
| 7574 | 98 |     printOperand(MI, 1, O); | 
| 7575 | 98 |     SStream_concat0(O, ", "); | 
| 7576 | 98 |     printFBits16(MI, 2, O); | 
| 7577 | 98 |     return; | 
| 7578 | 0 |     break; | 
| 7579 | 7 |   case 59: | 
| 7580 |  |     // VTOSHS | 
| 7581 | 7 |     SStream_concat0(O, ".s16.f32\t"); | 
| 7582 | 7 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_S16F32); | 
| 7583 | 7 |     printOperand(MI, 0, O); | 
| 7584 | 7 |     SStream_concat0(O, ", "); | 
| 7585 | 7 |     printOperand(MI, 1, O); | 
| 7586 | 7 |     SStream_concat0(O, ", "); | 
| 7587 | 7 |     printFBits16(MI, 2, O); | 
| 7588 | 7 |     return; | 
| 7589 | 0 |     break; | 
| 7590 | 125 |   case 60: | 
| 7591 |  |     // VTOSIRH, VTOSIZH, VTOSLH | 
| 7592 | 125 |     SStream_concat0(O, ".s32.f16\t"); | 
| 7593 | 125 |     printOperand(MI, 0, O); | 
| 7594 | 125 |     SStream_concat0(O, ", "); | 
| 7595 | 125 |     printOperand(MI, 1, O); | 
| 7596 | 125 |     break; | 
| 7597 | 46 |   case 61: | 
| 7598 |  |     // VTOUHD | 
| 7599 | 46 |     SStream_concat0(O, ".u16.f64\t"); | 
| 7600 | 46 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_U16F64); | 
| 7601 | 46 |     printOperand(MI, 0, O); | 
| 7602 | 46 |     SStream_concat0(O, ", "); | 
| 7603 | 46 |     printOperand(MI, 1, O); | 
| 7604 | 46 |     SStream_concat0(O, ", "); | 
| 7605 | 46 |     printFBits16(MI, 2, O); | 
| 7606 | 46 |     return; | 
| 7607 | 0 |     break; | 
| 7608 | 27 |   case 62: | 
| 7609 |  |     // VTOUHS | 
| 7610 | 27 |     SStream_concat0(O, ".u16.f32\t"); | 
| 7611 | 27 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_U16F32); | 
| 7612 | 27 |     printOperand(MI, 0, O); | 
| 7613 | 27 |     SStream_concat0(O, ", "); | 
| 7614 | 27 |     printOperand(MI, 1, O); | 
| 7615 | 27 |     SStream_concat0(O, ", "); | 
| 7616 | 27 |     printFBits16(MI, 2, O); | 
| 7617 | 27 |     return; | 
| 7618 | 0 |     break; | 
| 7619 | 40 |   case 63: | 
| 7620 |  |     // VTOUIRD, VTOUIZD, VTOULD | 
| 7621 | 40 |     SStream_concat0(O, ".u32.f64\t"); | 
| 7622 | 40 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_U32F64); | 
| 7623 | 40 |     printOperand(MI, 0, O); | 
| 7624 | 40 |     SStream_concat0(O, ", "); | 
| 7625 | 40 |     printOperand(MI, 1, O); | 
| 7626 | 40 |     break; | 
| 7627 | 73 |   case 64: | 
| 7628 |  |     // VTOUIRH, VTOUIZH, VTOULH | 
| 7629 | 73 |     SStream_concat0(O, ".u32.f16\t"); | 
| 7630 | 73 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_U32F16); | 
| 7631 | 73 |     printOperand(MI, 0, O); | 
| 7632 | 73 |     SStream_concat0(O, ", "); | 
| 7633 | 73 |     printOperand(MI, 1, O); | 
| 7634 | 73 |     break; | 
| 7635 | 293 |   case 65: | 
| 7636 |  |     // VUHTOD | 
| 7637 | 293 |     SStream_concat0(O, ".f64.u16\t"); | 
| 7638 | 293 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_F64U16); | 
| 7639 | 293 |     printOperand(MI, 0, O); | 
| 7640 | 293 |     SStream_concat0(O, ", "); | 
| 7641 | 293 |     printOperand(MI, 1, O); | 
| 7642 | 293 |     SStream_concat0(O, ", "); | 
| 7643 | 293 |     printFBits16(MI, 2, O); | 
| 7644 | 293 |     return; | 
| 7645 | 0 |     break; | 
| 7646 | 2 |   case 66: | 
| 7647 |  |     // VUHTOS | 
| 7648 | 2 |     SStream_concat0(O, ".f32.u16\t"); | 
| 7649 | 2 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_F32U16); | 
| 7650 | 2 |     printOperand(MI, 0, O); | 
| 7651 | 2 |     SStream_concat0(O, ", "); | 
| 7652 | 2 |     printOperand(MI, 1, O); | 
| 7653 | 2 |     SStream_concat0(O, ", "); | 
| 7654 | 2 |     printFBits16(MI, 2, O); | 
| 7655 | 2 |     return; | 
| 7656 | 0 |     break; | 
| 7657 | 72 |   case 67: | 
| 7658 |  |     // VUITOD, VULTOD | 
| 7659 | 72 |     SStream_concat0(O, ".f64.u32\t"); | 
| 7660 | 72 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_F64U32); | 
| 7661 | 72 |     printOperand(MI, 0, O); | 
| 7662 | 72 |     SStream_concat0(O, ", "); | 
| 7663 | 72 |     printOperand(MI, 1, O); | 
| 7664 | 72 |     break; | 
| 7665 | 6 |   case 68: | 
| 7666 |  |     // VUITOH, VULTOH | 
| 7667 | 6 |     SStream_concat0(O, ".f16.u32\t"); | 
| 7668 | 6 |     ARM_addVectorDataType(MI, ARM_VECTORDATA_F16U32); | 
| 7669 | 6 |     printOperand(MI, 0, O); | 
| 7670 | 6 |     SStream_concat0(O, ", "); | 
| 7671 | 6 |     printOperand(MI, 1, O); | 
| 7672 | 6 |     break; | 
| 7673 | 8.49k |   case 69: | 
| 7674 |  |     // t2ADCrr, t2ADCrs, t2ADDri, t2ADDrr, t2ADDrs, t2ADR, t2ANDrr, t2ANDrs, ... | 
| 7675 | 8.49k |     SStream_concat0(O, ".w\t"); | 
| 7676 | 8.49k |     break; | 
| 7677 | 26 |   case 70: | 
| 7678 |  |     // t2SRSDB, t2SRSIA | 
| 7679 | 26 |     SStream_concat0(O, "\tsp, "); | 
| 7680 | 26 |     ARM_addReg(MI, ARM_REG_SP); | 
| 7681 | 26 |     printOperand(MI, 0, O); | 
| 7682 | 26 |     return; | 
| 7683 | 0 |     break; | 
| 7684 | 31 |   case 71: | 
| 7685 |  |     // t2SRSDB_UPD, t2SRSIA_UPD | 
| 7686 | 31 |     SStream_concat0(O, "\tsp!, "); | 
| 7687 | 31 |     ARM_addReg(MI, ARM_REG_SP); | 
| 7688 | 31 |     printOperand(MI, 0, O); | 
| 7689 | 31 |     return; | 
| 7690 | 0 |     break; | 
| 7691 | 1 |   case 72: | 
| 7692 |  |     // t2SUBS_PC_LR | 
| 7693 | 1 |     SStream_concat0(O, "\tpc, lr, "); | 
| 7694 | 1 |     printOperand(MI, 0, O); | 
| 7695 | 1 |     return; | 
| 7696 | 0 |     break; | 
| 7697 | 50.5k |   case 73: | 
| 7698 |  |     // tADC, tADDi3, tADDi8, tADDrr, tAND, tASRri, tASRrr, tBIC, tEOR, tLSLri... | 
| 7699 | 50.5k |     printPredicateOperand(MI, 4, O); | 
| 7700 | 50.5k |     SStream_concat0(O, "\t"); | 
| 7701 | 50.5k |     printOperand(MI, 0, O); | 
| 7702 | 50.5k |     SStream_concat0(O, ", "); | 
| 7703 | 50.5k |     break; | 
| 7704 | 5.11k |   case 74: | 
| 7705 |  |     // tMOVi8, tMVN, tRSB | 
| 7706 | 5.11k |     printPredicateOperand(MI, 3, O); | 
| 7707 | 5.11k |     SStream_concat0(O, "\t"); | 
| 7708 | 5.11k |     printOperand(MI, 0, O); | 
| 7709 | 5.11k |     SStream_concat0(O, ", "); | 
| 7710 | 5.11k |     printOperand(MI, 2, O); | 
| 7711 | 5.11k |     break; | 
| 7712 | 297k |   } | 
| 7713 |  |  | 
| 7714 |  |  | 
| 7715 |  |   // Fragment 2 encoded into 6 bits for 60 unique commands. | 
| 7716 |  |   // printf("Fragment 2: %"PRIu64"\n", ((Bits >> 24) & 63)); | 
| 7717 | 293k |   switch ((Bits >> 24) & 63) { | 
| 7718 | 0 |   default: // unreachable | 
| 7719 | 148k |   case 0: | 
| 7720 |  |     // ASRi, ASRr, LDRBT_POST, LDRConstPool, LDRT_POST, LSLi, LSLr, LSRi, LSR... | 
| 7721 | 148k |     printOperand(MI, 0, O); | 
| 7722 | 148k |     break; | 
| 7723 | 4.03k |   case 1: | 
| 7724 |  |     // ITasm, t2IT | 
| 7725 | 4.03k |     printMandatoryPredicateOperand(MI, 0, O); | 
| 7726 | 4.03k |     return; | 
| 7727 | 0 |     break; | 
| 7728 | 0 |   case 2: | 
| 7729 |  |     // VLD3DUPdAsm_16, VLD3DUPdAsm_32, VLD3DUPdAsm_8, VLD3DUPdWB_fixed_Asm_16... | 
| 7730 | 0 |     printVectorListThreeAllLanes(MI, 0, O); | 
| 7731 | 0 |     SStream_concat0(O, ", "); | 
| 7732 | 0 |     printAddrMode6Operand(MI, 1, O); | 
| 7733 | 0 |     break; | 
| 7734 | 0 |   case 3: | 
| 7735 |  |     // VLD3DUPqAsm_16, VLD3DUPqAsm_32, VLD3DUPqAsm_8, VLD3DUPqWB_fixed_Asm_16... | 
| 7736 | 0 |     printVectorListThreeSpacedAllLanes(MI, 0, O); | 
| 7737 | 0 |     SStream_concat0(O, ", "); | 
| 7738 | 0 |     printAddrMode6Operand(MI, 1, O); | 
| 7739 | 0 |     break; | 
| 7740 | 331 |   case 4: | 
| 7741 |  |     // VLD3dAsm_16, VLD3dAsm_32, VLD3dAsm_8, VLD3dWB_fixed_Asm_16, VLD3dWB_fi... | 
| 7742 | 331 |     printVectorListThree(MI, 0, O); | 
| 7743 | 331 |     SStream_concat0(O, ", "); | 
| 7744 | 331 |     break; | 
| 7745 | 0 |   case 5: | 
| 7746 |  |     // VLD3qAsm_16, VLD3qAsm_32, VLD3qAsm_8, VLD3qWB_fixed_Asm_16, VLD3qWB_fi... | 
| 7747 | 0 |     printVectorListThreeSpaced(MI, 0, O); | 
| 7748 | 0 |     SStream_concat0(O, ", "); | 
| 7749 | 0 |     printAddrMode6Operand(MI, 1, O); | 
| 7750 | 0 |     break; | 
| 7751 | 0 |   case 6: | 
| 7752 |  |     // VLD4DUPdAsm_16, VLD4DUPdAsm_32, VLD4DUPdAsm_8, VLD4DUPdWB_fixed_Asm_16... | 
| 7753 | 0 |     printVectorListFourAllLanes(MI, 0, O); | 
| 7754 | 0 |     SStream_concat0(O, ", "); | 
| 7755 | 0 |     printAddrMode6Operand(MI, 1, O); | 
| 7756 | 0 |     break; | 
| 7757 | 0 |   case 7: | 
| 7758 |  |     // VLD4DUPqAsm_16, VLD4DUPqAsm_32, VLD4DUPqAsm_8, VLD4DUPqWB_fixed_Asm_16... | 
| 7759 | 0 |     printVectorListFourSpacedAllLanes(MI, 0, O); | 
| 7760 | 0 |     SStream_concat0(O, ", "); | 
| 7761 | 0 |     printAddrMode6Operand(MI, 1, O); | 
| 7762 | 0 |     break; | 
| 7763 | 708 |   case 8: | 
| 7764 |  |     // VLD4dAsm_16, VLD4dAsm_32, VLD4dAsm_8, VLD4dWB_fixed_Asm_16, VLD4dWB_fi... | 
| 7765 | 708 |     printVectorListFour(MI, 0, O); | 
| 7766 | 708 |     SStream_concat0(O, ", "); | 
| 7767 | 708 |     break; | 
| 7768 | 0 |   case 9: | 
| 7769 |  |     // VLD4qAsm_16, VLD4qAsm_32, VLD4qAsm_8, VLD4qWB_fixed_Asm_16, VLD4qWB_fi... | 
| 7770 | 0 |     printVectorListFourSpaced(MI, 0, O); | 
| 7771 | 0 |     SStream_concat0(O, ", "); | 
| 7772 | 0 |     printAddrMode6Operand(MI, 1, O); | 
| 7773 | 0 |     break; | 
| 7774 | 41.5k |   case 10: | 
| 7775 |  |     // AESD, AESE, MCR2, MCRR2, SHA1C, SHA1M, SHA1P, SHA1SU0, SHA1SU1, SHA256... | 
| 7776 | 41.5k |     printOperand(MI, 2, O); | 
| 7777 | 41.5k |     break; | 
| 7778 | 45.9k |   case 11: | 
| 7779 |  |     // AESIMC, AESMC, CRC32B, CRC32CB, CRC32CH, CRC32CW, CRC32H, CRC32W, FLDM... | 
| 7780 | 45.9k |     printOperand(MI, 1, O); | 
| 7781 | 45.9k |     break; | 
| 7782 | 11.8k |   case 12: | 
| 7783 |  |     // CDP, LDCL_OFFSET, LDCL_OPTION, LDCL_POST, LDCL_PRE, LDC_OFFSET, LDC_OP... | 
| 7784 | 11.8k |     printPImmediate(MI, 0, O); | 
| 7785 | 11.8k |     SStream_concat0(O, ", "); | 
| 7786 | 11.8k |     break; | 
| 7787 | 218 |   case 13: | 
| 7788 |  |     // CDP2 | 
| 7789 | 218 |     printCImmediate(MI, 2, O); | 
| 7790 | 218 |     SStream_concat0(O, ", "); | 
| 7791 | 218 |     printCImmediate(MI, 3, O); | 
| 7792 | 218 |     SStream_concat0(O, ", "); | 
| 7793 | 218 |     printCImmediate(MI, 4, O); | 
| 7794 | 218 |     SStream_concat0(O, ", "); | 
| 7795 | 218 |     printOperand(MI, 5, O); | 
| 7796 | 218 |     return; | 
| 7797 | 0 |     break; | 
| 7798 | 309 |   case 14: | 
| 7799 |  |     // CPS2p, CPS3p, t2CPS2p, t2CPS3p, tCPS | 
| 7800 | 309 |     printCPSIFlag(MI, 1, O); | 
| 7801 | 309 |     break; | 
| 7802 | 2.14k |   case 15: | 
| 7803 |  |     // FCONSTD, FCONSTH, FCONSTS, VABDfd, VABDfq, VABDhd, VABDhq, VABSD, VABS... | 
| 7804 | 2.14k |     SStream_concat0(O, ", "); | 
| 7805 | 2.14k |     break; | 
| 7806 | 348 |   case 16: | 
| 7807 |  |     // LDAEXD, LDREXD | 
| 7808 | 348 |     printGPRPairOperand(MI, 0, O); | 
| 7809 | 348 |     SStream_concat0(O, ", "); | 
| 7810 | 348 |     printAddrMode7Operand(MI, 1, O); | 
| 7811 | 348 |     return; | 
| 7812 | 0 |     break; | 
| 7813 | 443 |   case 17: | 
| 7814 |  |     // LDC2L_OFFSET, LDC2_OFFSET, STC2L_OFFSET, STC2_OFFSET | 
| 7815 | 443 |     printAddrMode5Operand(MI, 2, O, false); | 
| 7816 | 443 |     return; | 
| 7817 | 0 |     break; | 
| 7818 | 727 |   case 18: | 
| 7819 |  |     // LDC2L_OPTION, LDC2L_POST, LDC2_OPTION, LDC2_POST, STC2L_OPTION, STC2L_... | 
| 7820 | 727 |     printAddrMode7Operand(MI, 2, O); | 
| 7821 | 727 |     SStream_concat0(O, ", "); | 
| 7822 | 727 |     break; | 
| 7823 | 489 |   case 19: | 
| 7824 |  |     // LDC2L_PRE, LDC2_PRE, STC2L_PRE, STC2_PRE | 
| 7825 | 489 |     printAddrMode5Operand(MI, 2, O, true); | 
| 7826 | 489 |     SStream_concat0(O, "!"); | 
| 7827 | 489 |     return; | 
| 7828 | 0 |     break; | 
| 7829 | 867 |   case 20: | 
| 7830 |  |     // MRC, t2MRC, t2MRC2 | 
| 7831 | 867 |     printPImmediate(MI, 1, O); | 
| 7832 | 867 |     SStream_concat0(O, ", "); | 
| 7833 | 867 |     printOperand(MI, 2, O); | 
| 7834 | 867 |     SStream_concat0(O, ", "); | 
| 7835 | 867 |     printOperand(MI, 0, O); | 
| 7836 | 867 |     SStream_concat0(O, ", "); | 
| 7837 | 867 |     printCImmediate(MI, 3, O); | 
| 7838 | 867 |     SStream_concat0(O, ", "); | 
| 7839 | 867 |     printCImmediate(MI, 4, O); | 
| 7840 | 867 |     SStream_concat0(O, ", "); | 
| 7841 | 867 |     printOperand(MI, 5, O); | 
| 7842 | 867 |     return; | 
| 7843 | 0 |     break; | 
| 7844 | 329 |   case 21: | 
| 7845 |  |     // MRRC, t2MRRC, t2MRRC2 | 
| 7846 | 329 |     printPImmediate(MI, 2, O); | 
| 7847 | 329 |     SStream_concat0(O, ", "); | 
| 7848 | 329 |     printOperand(MI, 3, O); | 
| 7849 | 329 |     SStream_concat0(O, ", "); | 
| 7850 | 329 |     printOperand(MI, 0, O); | 
| 7851 | 329 |     SStream_concat0(O, ", "); | 
| 7852 | 329 |     printOperand(MI, 1, O); | 
| 7853 | 329 |     SStream_concat0(O, ", "); | 
| 7854 | 329 |     printCImmediate(MI, 4, O); | 
| 7855 | 329 |     return; | 
| 7856 | 0 |     break; | 
| 7857 | 2.02k |   case 22: | 
| 7858 |  |     // MSR, MSRi, t2MSR_AR, t2MSR_M | 
| 7859 | 2.02k |     printMSRMaskOperand(MI, 0, O); | 
| 7860 | 2.02k |     SStream_concat0(O, ", "); | 
| 7861 | 2.02k |     break; | 
| 7862 | 203 |   case 23: | 
| 7863 |  |     // MSRbanked, t2MSRbanked | 
| 7864 | 203 |     printBankedRegOperand(MI, 0, O); | 
| 7865 | 203 |     SStream_concat0(O, ", "); | 
| 7866 | 203 |     printOperand(MI, 1, O); | 
| 7867 | 203 |     return; | 
| 7868 | 0 |     break; | 
| 7869 | 1.37k |   case 24: | 
| 7870 |  |     // VBICiv2i32, VBICiv4i16, VBICiv4i32, VBICiv8i16, VMOVv16i8, VMOVv1i64, ... | 
| 7871 | 1.37k |     printNEONModImmOperand(MI, 1, O); | 
| 7872 | 1.37k |     return; | 
| 7873 | 0 |     break; | 
| 7874 | 427 |   case 25: | 
| 7875 |  |     // VCMPEZD, VCMPEZH, VCMPEZS, VCMPZD, VCMPZH, VCMPZS, tRSB | 
| 7876 | 427 |     SStream_concat0(O, ", #0"); | 
| 7877 | 427 |     op_addImm(MI, 0); | 
| 7878 | 427 |     return; | 
| 7879 | 0 |     break; | 
| 7880 | 5.28k |   case 26: | 
| 7881 |  |     // VCVTf2sd, VCVTf2sq, VCVTf2ud, VCVTf2uq, VCVTh2sd, VCVTh2sq, VCVTh2ud, ... | 
| 7882 | 5.28k |     return; | 
| 7883 | 0 |     break; | 
| 7884 | 128 |   case 27: | 
| 7885 |  |     // VLD1DUPd16, VLD1DUPd16wb_fixed, VLD1DUPd16wb_register, VLD1DUPd32, VLD... | 
| 7886 | 128 |     printVectorListOneAllLanes(MI, 0, O); | 
| 7887 | 128 |     SStream_concat0(O, ", "); | 
| 7888 | 128 |     break; | 
| 7889 | 1.22k |   case 28: | 
| 7890 |  |     // VLD1DUPq16, VLD1DUPq16wb_fixed, VLD1DUPq16wb_register, VLD1DUPq32, VLD... | 
| 7891 | 1.22k |     printVectorListTwoAllLanes(MI, 0, O); | 
| 7892 | 1.22k |     SStream_concat0(O, ", "); | 
| 7893 | 1.22k |     break; | 
| 7894 | 479 |   case 29: | 
| 7895 |  |     // VLD1d16, VLD1d16wb_fixed, VLD1d16wb_register, VLD1d32, VLD1d32wb_fixed... | 
| 7896 | 479 |     printVectorListOne(MI, 0, O); | 
| 7897 | 479 |     SStream_concat0(O, ", "); | 
| 7898 | 479 |     break; | 
| 7899 | 858 |   case 30: | 
| 7900 |  |     // VLD1q16, VLD1q16wb_fixed, VLD1q16wb_register, VLD1q32, VLD1q32wb_fixed... | 
| 7901 | 858 |     printVectorListTwo(MI, 0, O); | 
| 7902 | 858 |     SStream_concat0(O, ", "); | 
| 7903 | 858 |     break; | 
| 7904 | 386 |   case 31: | 
| 7905 |  |     // VLD2DUPd16x2, VLD2DUPd16x2wb_fixed, VLD2DUPd16x2wb_register, VLD2DUPd3... | 
| 7906 | 386 |     printVectorListTwoSpacedAllLanes(MI, 0, O); | 
| 7907 | 386 |     SStream_concat0(O, ", "); | 
| 7908 | 386 |     break; | 
| 7909 | 672 |   case 32: | 
| 7910 |  |     // VLD2b16, VLD2b16wb_fixed, VLD2b16wb_register, VLD2b32, VLD2b32wb_fixed... | 
| 7911 | 672 |     printVectorListTwoSpaced(MI, 0, O); | 
| 7912 | 672 |     SStream_concat0(O, ", "); | 
| 7913 | 672 |     break; | 
| 7914 | 2.45k |   case 33: | 
| 7915 |  |     // VST1LNd16_UPD, VST1LNd32_UPD, VST1LNd8_UPD, VST2LNd16_UPD, VST2LNd32_U... | 
| 7916 | 2.45k |     printOperand(MI, 4, O); | 
| 7917 | 2.45k |     break; | 
| 7918 | 35 |   case 34: | 
| 7919 |  |     // VST1d16, VST1d32, VST1d64, VST1d8 | 
| 7920 | 35 |     printVectorListOne(MI, 2, O); | 
| 7921 | 35 |     SStream_concat0(O, ", "); | 
| 7922 | 35 |     printAddrMode6Operand(MI, 0, O); | 
| 7923 | 35 |     return; | 
| 7924 | 0 |     break; | 
| 7925 | 44 |   case 35: | 
| 7926 |  |     // VST1d16Q, VST1d32Q, VST1d64Q, VST1d8Q, VST2q16, VST2q32, VST2q8 | 
| 7927 | 44 |     printVectorListFour(MI, 2, O); | 
| 7928 | 44 |     SStream_concat0(O, ", "); | 
| 7929 | 44 |     printAddrMode6Operand(MI, 0, O); | 
| 7930 | 44 |     return; | 
| 7931 | 0 |     break; | 
| 7932 | 496 |   case 36: | 
| 7933 |  |     // VST1d16Qwb_fixed, VST1d32Qwb_fixed, VST1d64Qwb_fixed, VST1d8Qwb_fixed,... | 
| 7934 | 496 |     printVectorListFour(MI, 3, O); | 
| 7935 | 496 |     SStream_concat0(O, ", "); | 
| 7936 | 496 |     printAddrMode6Operand(MI, 1, O); | 
| 7937 | 496 |     SStream_concat0(O, "!"); | 
| 7938 | 496 |     return; | 
| 7939 | 0 |     break; | 
| 7940 | 179 |   case 37: | 
| 7941 |  |     // VST1d16Qwb_register, VST1d32Qwb_register, VST1d64Qwb_register, VST1d8Q... | 
| 7942 | 179 |     printVectorListFour(MI, 4, O); | 
| 7943 | 179 |     SStream_concat0(O, ", "); | 
| 7944 | 179 |     printAddrMode6Operand(MI, 1, O); | 
| 7945 | 179 |     SStream_concat0(O, ", "); | 
| 7946 | 179 |     printOperand(MI, 3, O); | 
| 7947 | 179 |     return; | 
| 7948 | 0 |     break; | 
| 7949 | 6 |   case 38: | 
| 7950 |  |     // VST1d16T, VST1d32T, VST1d64T, VST1d8T | 
| 7951 | 6 |     printVectorListThree(MI, 2, O); | 
| 7952 | 6 |     SStream_concat0(O, ", "); | 
| 7953 | 6 |     printAddrMode6Operand(MI, 0, O); | 
| 7954 | 6 |     return; | 
| 7955 | 0 |     break; | 
| 7956 | 105 |   case 39: | 
| 7957 |  |     // VST1d16Twb_fixed, VST1d32Twb_fixed, VST1d64Twb_fixed, VST1d8Twb_fixed | 
| 7958 | 105 |     printVectorListThree(MI, 3, O); | 
| 7959 | 105 |     SStream_concat0(O, ", "); | 
| 7960 | 105 |     printAddrMode6Operand(MI, 1, O); | 
| 7961 | 105 |     SStream_concat0(O, "!"); | 
| 7962 | 105 |     return; | 
| 7963 | 0 |     break; | 
| 7964 | 276 |   case 40: | 
| 7965 |  |     // VST1d16Twb_register, VST1d32Twb_register, VST1d64Twb_register, VST1d8T... | 
| 7966 | 276 |     printVectorListThree(MI, 4, O); | 
| 7967 | 276 |     SStream_concat0(O, ", "); | 
| 7968 | 276 |     printAddrMode6Operand(MI, 1, O); | 
| 7969 | 276 |     SStream_concat0(O, ", "); | 
| 7970 | 276 |     printOperand(MI, 3, O); | 
| 7971 | 276 |     return; | 
| 7972 | 0 |     break; | 
| 7973 | 32 |   case 41: | 
| 7974 |  |     // VST1d16wb_fixed, VST1d32wb_fixed, VST1d64wb_fixed, VST1d8wb_fixed | 
| 7975 | 32 |     printVectorListOne(MI, 3, O); | 
| 7976 | 32 |     SStream_concat0(O, ", "); | 
| 7977 | 32 |     printAddrMode6Operand(MI, 1, O); | 
| 7978 | 32 |     SStream_concat0(O, "!"); | 
| 7979 | 32 |     return; | 
| 7980 | 0 |     break; | 
| 7981 | 309 |   case 42: | 
| 7982 |  |     // VST1d16wb_register, VST1d32wb_register, VST1d64wb_register, VST1d8wb_r... | 
| 7983 | 309 |     printVectorListOne(MI, 4, O); | 
| 7984 | 309 |     SStream_concat0(O, ", "); | 
| 7985 | 309 |     printAddrMode6Operand(MI, 1, O); | 
| 7986 | 309 |     SStream_concat0(O, ", "); | 
| 7987 | 309 |     printOperand(MI, 3, O); | 
| 7988 | 309 |     return; | 
| 7989 | 0 |     break; | 
| 7990 | 554 |   case 43: | 
| 7991 |  |     // VST1q16, VST1q32, VST1q64, VST1q8, VST2d16, VST2d32, VST2d8 | 
| 7992 | 554 |     printVectorListTwo(MI, 2, O); | 
| 7993 | 554 |     SStream_concat0(O, ", "); | 
| 7994 | 554 |     printAddrMode6Operand(MI, 0, O); | 
| 7995 | 554 |     return; | 
| 7996 | 0 |     break; | 
| 7997 | 316 |   case 44: | 
| 7998 |  |     // VST1q16wb_fixed, VST1q32wb_fixed, VST1q64wb_fixed, VST1q8wb_fixed, VST... | 
| 7999 | 316 |     printVectorListTwo(MI, 3, O); | 
| 8000 | 316 |     SStream_concat0(O, ", "); | 
| 8001 | 316 |     printAddrMode6Operand(MI, 1, O); | 
| 8002 | 316 |     SStream_concat0(O, "!"); | 
| 8003 | 316 |     return; | 
| 8004 | 0 |     break; | 
| 8005 | 156 |   case 45: | 
| 8006 |  |     // VST1q16wb_register, VST1q32wb_register, VST1q64wb_register, VST1q8wb_r... | 
| 8007 | 156 |     printVectorListTwo(MI, 4, O); | 
| 8008 | 156 |     SStream_concat0(O, ", "); | 
| 8009 | 156 |     printAddrMode6Operand(MI, 1, O); | 
| 8010 | 156 |     SStream_concat0(O, ", "); | 
| 8011 | 156 |     printOperand(MI, 3, O); | 
| 8012 | 156 |     return; | 
| 8013 | 0 |     break; | 
| 8014 | 66 |   case 46: | 
| 8015 |  |     // VST2b16, VST2b32, VST2b8 | 
| 8016 | 66 |     printVectorListTwoSpaced(MI, 2, O); | 
| 8017 | 66 |     SStream_concat0(O, ", "); | 
| 8018 | 66 |     printAddrMode6Operand(MI, 0, O); | 
| 8019 | 66 |     return; | 
| 8020 | 0 |     break; | 
| 8021 | 372 |   case 47: | 
| 8022 |  |     // VST2b16wb_fixed, VST2b32wb_fixed, VST2b8wb_fixed | 
| 8023 | 372 |     printVectorListTwoSpaced(MI, 3, O); | 
| 8024 | 372 |     SStream_concat0(O, ", "); | 
| 8025 | 372 |     printAddrMode6Operand(MI, 1, O); | 
| 8026 | 372 |     SStream_concat0(O, "!"); | 
| 8027 | 372 |     return; | 
| 8028 | 0 |     break; | 
| 8029 | 352 |   case 48: | 
| 8030 |  |     // VST2b16wb_register, VST2b32wb_register, VST2b8wb_register | 
| 8031 | 352 |     printVectorListTwoSpaced(MI, 4, O); | 
| 8032 | 352 |     SStream_concat0(O, ", "); | 
| 8033 | 352 |     printAddrMode6Operand(MI, 1, O); | 
| 8034 | 352 |     SStream_concat0(O, ", "); | 
| 8035 | 352 |     printOperand(MI, 3, O); | 
| 8036 | 352 |     return; | 
| 8037 | 0 |     break; | 
| 8038 | 319 |   case 49: | 
| 8039 |  |     // t2DMB, t2DSB | 
| 8040 | 319 |     printMemBOption(MI, 0, O); | 
| 8041 | 319 |     return; | 
| 8042 | 0 |     break; | 
| 8043 | 103 |   case 50: | 
| 8044 |  |     // t2ISB | 
| 8045 | 103 |     printInstSyncBOption(MI, 0, O); | 
| 8046 | 103 |     return; | 
| 8047 | 0 |     break; | 
| 8048 | 91 |   case 51: | 
| 8049 |  |     // t2PLDWi12, t2PLDi12, t2PLIi12 | 
| 8050 | 91 |     printAddrModeImm12Operand(MI, 0, O, false); | 
| 8051 | 91 |     return; | 
| 8052 | 0 |     break; | 
| 8053 | 24 |   case 52: | 
| 8054 |  |     // t2PLDWi8, t2PLDi8, t2PLIi8 | 
| 8055 | 24 |     printT2AddrModeImm8Operand(MI, 0, O, false); | 
| 8056 | 24 |     return; | 
| 8057 | 0 |     break; | 
| 8058 | 151 |   case 53: | 
| 8059 |  |     // t2PLDWs, t2PLDs, t2PLIs | 
| 8060 | 151 |     printT2AddrModeSoRegOperand(MI, 0, O); | 
| 8061 | 151 |     return; | 
| 8062 | 0 |     break; | 
| 8063 | 748 |   case 54: | 
| 8064 |  |     // t2PLDpci, t2PLIpci | 
| 8065 | 748 |     printThumbLdrLabelOperand(MI, 0, O); | 
| 8066 | 748 |     return; | 
| 8067 | 0 |     break; | 
| 8068 | 135 |   case 55: | 
| 8069 |  |     // t2TBB | 
| 8070 | 135 |     printAddrModeTBB(MI, 0, O); | 
| 8071 | 135 |     return; | 
| 8072 | 0 |     break; | 
| 8073 | 32 |   case 56: | 
| 8074 |  |     // t2TBH | 
| 8075 | 32 |     printAddrModeTBH(MI, 0, O); | 
| 8076 | 32 |     return; | 
| 8077 | 0 |     break; | 
| 8078 | 0 |   case 57: | 
| 8079 |  |     // t2TSB | 
| 8080 | 0 |     printTraceSyncBOption(MI, 0, O); | 
| 8081 | 0 |     return; | 
| 8082 | 0 |     break; | 
| 8083 | 12.7k |   case 58: | 
| 8084 |  |     // tADC, tADDi8, tAND, tASRrr, tBIC, tEOR, tLSLrr, tLSRrr, tORR, tROR, tS... | 
| 8085 | 12.7k |     printOperand(MI, 3, O); | 
| 8086 | 12.7k |     return; | 
| 8087 | 0 |     break; | 
| 8088 | 1.40k |   case 59: | 
| 8089 |  |     // tPOP, tPUSH | 
| 8090 | 1.40k |     printRegisterList(MI, 2, O); | 
| 8091 | 1.40k |     return; | 
| 8092 | 0 |     break; | 
| 8093 | 293k |   } | 
| 8094 |  |  | 
| 8095 |  |  | 
| 8096 |  |   // Fragment 3 encoded into 5 bits for 30 unique commands. | 
| 8097 |  |   // printf("Fragment 3: %"PRIu64"\n", ((Bits >> 30) & 31)); | 
| 8098 | 260k |   switch ((Bits >> 30) & 31) { | 
| 8099 | 0 |   default: // unreachable | 
| 8100 | 179k |   case 0: | 
| 8101 |  |     // ASRi, ASRr, LDRBT_POST, LDRConstPool, LDRT_POST, LSLi, LSLr, LSRi, LSR... | 
| 8102 | 179k |     SStream_concat0(O, ", "); | 
| 8103 | 179k |     break; | 
| 8104 | 48.2k |   case 1: | 
| 8105 |  |     // VLD3DUPdAsm_16, VLD3DUPdAsm_32, VLD3DUPdAsm_8, VLD3DUPqAsm_16, VLD3DUP... | 
| 8106 | 48.2k |     return; | 
| 8107 | 0 |     break; | 
| 8108 | 12 |   case 2: | 
| 8109 |  |     // VLD3DUPdWB_fixed_Asm_16, VLD3DUPdWB_fixed_Asm_32, VLD3DUPdWB_fixed_Asm... | 
| 8110 | 12 |     SStream_concat0(O, "!"); | 
| 8111 | 12 |     return; | 
| 8112 | 0 |     break; | 
| 8113 | 976 |   case 3: | 
| 8114 |  |     // VLD3dAsm_16, VLD3dAsm_32, VLD3dAsm_8, VLD3dWB_fixed_Asm_16, VLD3dWB_fi... | 
| 8115 | 976 |     printAddrMode6Operand(MI, 1, O); | 
| 8116 | 976 |     break; | 
| 8117 | 5.83k |   case 4: | 
| 8118 |  |     // CDP, MCR, MCRR, MSR, VABDfd, VABDfq, VABDhd, VABDhq, VABSD, VABSH, VAB... | 
| 8119 | 5.83k |     printOperand(MI, 1, O); | 
| 8120 | 5.83k |     break; | 
| 8121 | 120 |   case 5: | 
| 8122 |  |     // FCONSTD, FCONSTH, FCONSTS, VMOVv2f32, VMOVv4f32 | 
| 8123 | 120 |     printFPImmOperand(MI, 1, O); | 
| 8124 | 120 |     return; | 
| 8125 | 0 |     break; | 
| 8126 | 6.16k |   case 6: | 
| 8127 |  |     // FLDMXDB_UPD, FLDMXIA_UPD, FSTMXDB_UPD, FSTMXIA_UPD, LDMDA_UPD, LDMDB_U... | 
| 8128 | 6.16k |     SStream_concat0(O, "!, "); | 
| 8129 | 6.16k |     printRegisterList(MI, 4, O); | 
| 8130 | 6.16k |     break; | 
| 8131 | 180 |   case 7: | 
| 8132 |  |     // LDC2L_OPTION, LDC2_OPTION, STC2L_OPTION, STC2_OPTION | 
| 8133 | 180 |     printCoprocOptionImm(MI, 3, O); | 
| 8134 | 180 |     return; | 
| 8135 | 0 |     break; | 
| 8136 | 547 |   case 8: | 
| 8137 |  |     // LDC2L_POST, LDC2_POST, STC2L_POST, STC2_POST | 
| 8138 | 547 |     printPostIdxImm8s4Operand(MI, 3, O); | 
| 8139 | 547 |     return; | 
| 8140 | 0 |     break; | 
| 8141 | 8.43k |   case 9: | 
| 8142 |  |     // LDCL_OFFSET, LDCL_OPTION, LDCL_POST, LDCL_PRE, LDC_OFFSET, LDC_OPTION,... | 
| 8143 | 8.43k |     printCImmediate(MI, 1, O); | 
| 8144 | 8.43k |     SStream_concat0(O, ", "); | 
| 8145 | 8.43k |     break; | 
| 8146 | 424 |   case 10: | 
| 8147 |  |     // MRS, t2MRS_AR | 
| 8148 | 424 |     SStream_concat0(O, ", apsr"); | 
| 8149 | 424 |     ARM_addReg(MI, ARM_REG_APSR); | 
| 8150 | 424 |     return; | 
| 8151 | 0 |     break; | 
| 8152 | 33 |   case 11: | 
| 8153 |  |     // MRSsys, t2MRSsys_AR | 
| 8154 | 33 |     SStream_concat0(O, ", spsr"); | 
| 8155 | 33 |     ARM_addReg(MI, ARM_REG_SPSR); | 
| 8156 | 33 |     return; | 
| 8157 | 0 |     break; | 
| 8158 | 369 |   case 12: | 
| 8159 |  |     // MSRi | 
| 8160 | 369 |     printModImmOperand(MI, 1, O); | 
| 8161 | 369 |     return; | 
| 8162 | 0 |     break; | 
| 8163 | 249 |   case 13: | 
| 8164 |  |     // VCEQzv16i8, VCEQzv2i32, VCEQzv4i16, VCEQzv4i32, VCEQzv8i16, VCEQzv8i8,... | 
| 8165 | 249 |     SStream_concat0(O, ", #0"); | 
| 8166 | 249 |     op_addImm(MI, 0); | 
| 8167 | 249 |     return; | 
| 8168 | 0 |     break; | 
| 8169 | 907 |   case 14: | 
| 8170 |  |     // VCVTf2xsd, VCVTf2xsq, VCVTf2xud, VCVTf2xuq, VCVTh2xsd, VCVTh2xsq, VCVT... | 
| 8171 | 907 |     printOperand(MI, 2, O); | 
| 8172 | 907 |     break; | 
| 8173 | 54 |   case 15: | 
| 8174 |  |     // VGETLNs16, VGETLNs8, VGETLNu16, VGETLNu8 | 
| 8175 | 54 |     printVectorIndex(MI, 2, O); | 
| 8176 | 54 |     return; | 
| 8177 | 0 |     break; | 
| 8178 | 3.80k |   case 16: | 
| 8179 |  |     // VLD1DUPd16wb_fixed, VLD1DUPd16wb_register, VLD1DUPd32wb_fixed, VLD1DUP... | 
| 8180 | 3.80k |     printAddrMode6Operand(MI, 2, O); | 
| 8181 | 3.80k |     break; | 
| 8182 | 3.26k |   case 17: | 
| 8183 |  |     // VLD1LNd16, VLD1LNd16_UPD, VLD1LNd32, VLD1LNd32_UPD, VLD1LNd8, VLD1LNd8... | 
| 8184 | 3.26k |     SStream_concat0(O, "["); | 
| 8185 | 3.26k |     set_mem_access(MI, true); | 
| 8186 | 3.26k |     break; | 
| 8187 | 658 |   case 18: | 
| 8188 |  |     // VLD3DUPd16, VLD3DUPd16_UPD, VLD3DUPd32, VLD3DUPd32_UPD, VLD3DUPd8, VLD... | 
| 8189 | 658 |     SStream_concat0(O, "[], "); | 
| 8190 | 658 |     printOperand(MI, 1, O); | 
| 8191 | 658 |     SStream_concat0(O, "[], "); | 
| 8192 | 658 |     printOperand(MI, 2, O); | 
| 8193 | 658 |     break; | 
| 8194 | 22 |   case 19: | 
| 8195 |  |     // VMRS | 
| 8196 | 22 |     SStream_concat0(O, ", fpscr"); | 
| 8197 | 22 |     ARM_addReg(MI, ARM_REG_FPSCR); | 
| 8198 | 22 |     return; | 
| 8199 | 0 |     break; | 
| 8200 | 47 |   case 20: | 
| 8201 |  |     // VMRS_FPEXC | 
| 8202 | 47 |     SStream_concat0(O, ", fpexc"); | 
| 8203 | 47 |     ARM_addReg(MI, ARM_REG_FPEXC); | 
| 8204 | 47 |     return; | 
| 8205 | 0 |     break; | 
| 8206 | 13 |   case 21: | 
| 8207 |  |     // VMRS_FPINST | 
| 8208 | 13 |     SStream_concat0(O, ", fpinst"); | 
| 8209 | 13 |     ARM_addReg(MI, ARM_REG_FPINST); | 
| 8210 | 13 |     return; | 
| 8211 | 0 |     break; | 
| 8212 | 59 |   case 22: | 
| 8213 |  |     // VMRS_FPINST2 | 
| 8214 | 59 |     SStream_concat0(O, ", fpinst2"); | 
| 8215 | 59 |     ARM_addReg(MI, ARM_REG_FPINST2); | 
| 8216 | 59 |     return; | 
| 8217 | 0 |     break; | 
| 8218 | 153 |   case 23: | 
| 8219 |  |     // VMRS_FPSID | 
| 8220 | 153 |     SStream_concat0(O, ", fpsid"); | 
| 8221 | 153 |     ARM_addReg(MI, ARM_REG_FPSID); | 
| 8222 | 153 |     return; | 
| 8223 | 0 |     break; | 
| 8224 | 21 |   case 24: | 
| 8225 |  |     // VMRS_MVFR0 | 
| 8226 | 21 |     SStream_concat0(O, ", mvfr0"); | 
| 8227 | 21 |     ARM_addReg(MI, ARM_REG_MVFR0); | 
| 8228 | 21 |     return; | 
| 8229 | 0 |     break; | 
| 8230 | 54 |   case 25: | 
| 8231 |  |     // VMRS_MVFR1 | 
| 8232 | 54 |     SStream_concat0(O, ", mvfr1"); | 
| 8233 | 54 |     ARM_addReg(MI, ARM_REG_MVFR1); | 
| 8234 | 54 |     return; | 
| 8235 | 0 |     break; | 
| 8236 | 11 |   case 26: | 
| 8237 |  |     // VMRS_MVFR2 | 
| 8238 | 11 |     SStream_concat0(O, ", mvfr2"); | 
| 8239 | 11 |     ARM_addReg(MI, ARM_REG_MVFR2); | 
| 8240 | 11 |     return; | 
| 8241 | 0 |     break; | 
| 8242 | 39 |   case 27: | 
| 8243 |  |     // VSETLNi16, VSETLNi32, VSETLNi8 | 
| 8244 | 39 |     printVectorIndex(MI, 3, O); | 
| 8245 | 39 |     SStream_concat0(O, ", "); | 
| 8246 | 39 |     printOperand(MI, 2, O); | 
| 8247 | 39 |     return; | 
| 8248 | 0 |     break; | 
| 8249 | 123 |   case 28: | 
| 8250 |  |     // VSHTOH, VTOSHH, VTOUHH, VUHTOH | 
| 8251 | 123 |     printFBits16(MI, 2, O); | 
| 8252 | 123 |     return; | 
| 8253 | 0 |     break; | 
| 8254 | 207 |   case 29: | 
| 8255 |  |     // VSLTOD, VSLTOH, VSLTOS, VTOSLD, VTOSLH, VTOSLS, VTOULD, VTOULH, VTOULS... | 
| 8256 | 207 |     printFBits32(MI, 2, O); | 
| 8257 | 207 |     return; | 
| 8258 | 0 |     break; | 
| 8259 | 260k |   } | 
| 8260 |  |  | 
| 8261 |  |  | 
| 8262 |  |   // Fragment 4 encoded into 7 bits for 65 unique commands. | 
| 8263 |  |   // printf("Fragment 4: %"PRIu64"\n", ((Bits >> 35) & 127)); | 
| 8264 | 209k |   switch ((Bits >> 35) & 127) { | 
| 8265 | 0 |   default: // unreachable | 
| 8266 | 39.2k |   case 0: | 
| 8267 |  |     // ASRi, ASRr, LDRConstPool, LSLi, LSLr, LSRi, LSRr, RORi, RORr, RRXi, t2... | 
| 8268 | 39.2k |     printOperand(MI, 1, O); | 
| 8269 | 39.2k |     break; | 
| 8270 | 455 |   case 1: | 
| 8271 |  |     // LDRBT_POST, LDRT_POST, STRBT_POST, STRT_POST, LDA, LDAB, LDAEX, LDAEXB... | 
| 8272 | 455 |     printAddrMode7Operand(MI, 1, O); | 
| 8273 | 455 |     return; | 
| 8274 | 0 |     break; | 
| 8275 | 0 |   case 2: | 
| 8276 |  |     // VLD1LNdAsm_16, VLD1LNdAsm_32, VLD1LNdAsm_8, VLD1LNdWB_fixed_Asm_16, VL... | 
| 8277 | 0 |     printAddrMode6Operand(MI, 2, O); | 
| 8278 | 0 |     break; | 
| 8279 | 27.5k |   case 3: | 
| 8280 |  |     // VLD3DUPdWB_register_Asm_16, VLD3DUPdWB_register_Asm_32, VLD3DUPdWB_reg... | 
| 8281 | 27.5k |     printOperand(MI, 3, O); | 
| 8282 | 27.5k |     break; | 
| 8283 | 8.63k |   case 4: | 
| 8284 |  |     // VLD3dAsm_16, VLD3dAsm_32, VLD3dAsm_8, VLD4dAsm_16, VLD4dAsm_32, VLD4dA... | 
| 8285 | 8.63k |     return; | 
| 8286 | 0 |     break; | 
| 8287 | 1.19k |   case 5: | 
| 8288 |  |     // VLD3dWB_fixed_Asm_16, VLD3dWB_fixed_Asm_32, VLD3dWB_fixed_Asm_8, VLD4d... | 
| 8289 | 1.19k |     SStream_concat0(O, "!"); | 
| 8290 | 1.19k |     return; | 
| 8291 | 0 |     break; | 
| 8292 | 7.20k |   case 6: | 
| 8293 |  |     // VLD3dWB_register_Asm_16, VLD3dWB_register_Asm_32, VLD3dWB_register_Asm... | 
| 8294 | 7.20k |     SStream_concat0(O, ", "); | 
| 8295 | 7.20k |     break; | 
| 8296 | 654 |   case 7: | 
| 8297 |  |     // t2MOVSsi, t2MOVsi, t2CMNzrs, t2CMPrs, t2MVNs, t2TEQrs, t2TSTrs | 
| 8298 | 654 |     printT2SOOperand(MI, 1, O); | 
| 8299 | 654 |     return; | 
| 8300 | 0 |     break; | 
| 8301 | 502 |   case 8: | 
| 8302 |  |     // t2MOVSsr, t2MOVsr, CMNzrsr, CMPrsr, MOVsr, MVNsr, TEQrsr, TSTrsr | 
| 8303 | 502 |     printSORegRegOperand(MI, 1, O); | 
| 8304 | 502 |     return; | 
| 8305 | 0 |     break; | 
| 8306 | 0 |   case 9: | 
| 8307 |  |     // ADR, t2ADR | 
| 8308 | 0 |     printAdrLabelOperand(MI, 1, O, 0); | 
| 8309 | 0 |     return; | 
| 8310 | 0 |     break; | 
| 8311 | 163 |   case 10: | 
| 8312 |  |     // BFC, t2BFC | 
| 8313 | 163 |     printBitfieldInvMaskImmOperand(MI, 2, O); | 
| 8314 | 163 |     return; | 
| 8315 | 0 |     break; | 
| 8316 | 7.44k |   case 11: | 
| 8317 |  |     // BFI, CPS3p, CRC32B, CRC32CB, CRC32CH, CRC32CW, CRC32H, CRC32W, MOVTi16... | 
| 8318 | 7.44k |     printOperand(MI, 2, O); | 
| 8319 | 7.44k |     break; | 
| 8320 | 1.16k |   case 12: | 
| 8321 |  |     // CMNri, CMPri, MOVi, MVNi, TEQri, TSTri | 
| 8322 | 1.16k |     printModImmOperand(MI, 1, O); | 
| 8323 | 1.16k |     return; | 
| 8324 | 0 |     break; | 
| 8325 | 733 |   case 13: | 
| 8326 |  |     // CMNzrsi, CMPrsi, MOVsi, MVNsi, TEQrsi, TSTrsi | 
| 8327 | 733 |     printSORegImmOperand(MI, 1, O); | 
| 8328 | 733 |     return; | 
| 8329 | 0 |     break; | 
| 8330 | 2.06k |   case 14: | 
| 8331 |  |     // FLDMXIA, FSTMXIA, LDMDA, LDMDB, LDMIA, LDMIB, STMDA, STMDB, STMIA, STM... | 
| 8332 | 2.06k |     printRegisterList(MI, 3, O); | 
| 8333 | 2.06k |     break; | 
| 8334 | 1.88k |   case 15: | 
| 8335 |  |     // LDCL_OFFSET, LDC_OFFSET, STCL_OFFSET, STC_OFFSET, t2LDC2L_OFFSET, t2LD... | 
| 8336 | 1.88k |     printAddrMode5Operand(MI, 2, O, false); | 
| 8337 | 1.88k |     return; | 
| 8338 | 0 |     break; | 
| 8339 | 11.5k |   case 16: | 
| 8340 |  |     // LDCL_OPTION, LDCL_POST, LDC_OPTION, LDC_POST, LDRBT_POST_IMM, LDRBT_PO... | 
| 8341 | 11.5k |     printAddrMode7Operand(MI, 2, O); | 
| 8342 | 11.5k |     break; | 
| 8343 | 2.93k |   case 17: | 
| 8344 |  |     // LDCL_PRE, LDC_PRE, STCL_PRE, STC_PRE, t2LDC2L_PRE, t2LDC2_PRE, t2LDCL_... | 
| 8345 | 2.93k |     printAddrMode5Operand(MI, 2, O, true); | 
| 8346 | 2.93k |     SStream_concat0(O, "!"); | 
| 8347 | 2.93k |     return; | 
| 8348 | 0 |     break; | 
| 8349 | 1.88k |   case 18: | 
| 8350 |  |     // LDRB_PRE_IMM, LDR_PRE_IMM, STRB_PRE_IMM, STR_PRE_IMM | 
| 8351 | 1.88k |     printAddrModeImm12Operand(MI, 2, O, true); | 
| 8352 | 1.88k |     SStream_concat0(O, "!"); | 
| 8353 | 1.88k |     return; | 
| 8354 | 0 |     break; | 
| 8355 | 1.34k |   case 19: | 
| 8356 |  |     // LDRB_PRE_REG, LDR_PRE_REG, STRB_PRE_REG, STR_PRE_REG | 
| 8357 | 1.34k |     printAddrMode2Operand(MI, 2, O); | 
| 8358 | 1.34k |     SStream_concat0(O, "!"); | 
| 8359 | 1.34k |     return; | 
| 8360 | 0 |     break; | 
| 8361 | 2.25k |   case 20: | 
| 8362 |  |     // LDRBi12, LDRcp, LDRi12, STRBi12, STRi12, t2LDRBi12, t2LDRHi12, t2LDRSB... | 
| 8363 | 2.25k |     printAddrModeImm12Operand(MI, 1, O, false); | 
| 8364 | 2.25k |     return; | 
| 8365 | 0 |     break; | 
| 8366 | 1.16k |   case 21: | 
| 8367 |  |     // LDRBrs, LDRrs, STRBrs, STRrs | 
| 8368 | 1.16k |     printAddrMode2Operand(MI, 1, O); | 
| 8369 | 1.16k |     return; | 
| 8370 | 0 |     break; | 
| 8371 | 1.13k |   case 22: | 
| 8372 |  |     // LDRH, LDRSB, LDRSH, STRH | 
| 8373 | 1.13k |     printAddrMode3Operand(MI, 1, O, false); | 
| 8374 | 1.13k |     return; | 
| 8375 | 0 |     break; | 
| 8376 | 1.02k |   case 23: | 
| 8377 |  |     // LDRH_PRE, LDRSB_PRE, LDRSH_PRE, STRH_PRE | 
| 8378 | 1.02k |     printAddrMode3Operand(MI, 2, O, true); | 
| 8379 | 1.02k |     SStream_concat0(O, "!"); | 
| 8380 | 1.02k |     return; | 
| 8381 | 0 |     break; | 
| 8382 | 145 |   case 24: | 
| 8383 |  |     // MCR2 | 
| 8384 | 145 |     printCImmediate(MI, 3, O); | 
| 8385 | 145 |     SStream_concat0(O, ", "); | 
| 8386 | 145 |     printCImmediate(MI, 4, O); | 
| 8387 | 145 |     SStream_concat0(O, ", "); | 
| 8388 | 145 |     printOperand(MI, 5, O); | 
| 8389 | 145 |     return; | 
| 8390 | 0 |     break; | 
| 8391 | 548 |   case 25: | 
| 8392 |  |     // MRSbanked, t2MRSbanked | 
| 8393 | 548 |     printBankedRegOperand(MI, 1, O); | 
| 8394 | 548 |     return; | 
| 8395 | 0 |     break; | 
| 8396 | 549 |   case 26: | 
| 8397 |  |     // SSAT, SSAT16, t2SSAT, t2SSAT16 | 
| 8398 | 549 |     printImmPlusOneOperand(MI, 1, O); | 
| 8399 | 549 |     SStream_concat0(O, ", "); | 
| 8400 | 549 |     printOperand(MI, 2, O); | 
| 8401 | 549 |     break; | 
| 8402 | 79 |   case 27: | 
| 8403 |  |     // STLEXD, STREXD | 
| 8404 | 79 |     printGPRPairOperand(MI, 1, O); | 
| 8405 | 79 |     SStream_concat0(O, ", "); | 
| 8406 | 79 |     printAddrMode7Operand(MI, 2, O); | 
| 8407 | 79 |     return; | 
| 8408 | 0 |     break; | 
| 8409 | 14 |   case 28: | 
| 8410 |  |     // VCEQzv2f32, VCEQzv4f16, VCEQzv4f32, VCEQzv8f16, VCGEzv2f32, VCGEzv4f16... | 
| 8411 | 14 |     SStream_concat0(O, ", #0"); | 
| 8412 | 14 |     op_addImm(MI, 0); | 
| 8413 | 14 |     return; | 
| 8414 | 0 |     break; | 
| 8415 | 203 |   case 29: | 
| 8416 |  |     // VLD1LNd16, VLD1LNd32, VLD1LNd8, VST2LNd16, VST2LNd32, VST2LNd8, VST2LN... | 
| 8417 | 203 |     printNoHashImmediate(MI, 4, O); | 
| 8418 | 203 |     break; | 
| 8419 | 1.00k |   case 30: | 
| 8420 |  |     // VLD1LNd16_UPD, VLD1LNd32_UPD, VLD1LNd8_UPD, VLD2LNd16, VLD2LNd32, VLD2... | 
| 8421 | 1.00k |     printNoHashImmediate(MI, 6, O); | 
| 8422 | 1.00k |     break; | 
| 8423 | 758 |   case 31: | 
| 8424 |  |     // VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_UPD, VLD2LNq32_U... | 
| 8425 | 758 |     printNoHashImmediate(MI, 8, O); | 
| 8426 | 758 |     SStream_concat0(O, "], "); | 
| 8427 | 758 |     set_mem_access(MI, false); | 
| 8428 | 758 |     break; | 
| 8429 | 155 |   case 32: | 
| 8430 |  |     // VLD3DUPd16, VLD3DUPd16_UPD, VLD3DUPd32, VLD3DUPd32_UPD, VLD3DUPd8, VLD... | 
| 8431 | 155 |     SStream_concat0(O, "[]}, "); | 
| 8432 | 155 |     break; | 
| 8433 | 279 |   case 33: | 
| 8434 |  |     // VLD3LNd16_UPD, VLD3LNd32_UPD, VLD3LNd8_UPD, VLD3LNq16_UPD, VLD3LNq32_U... | 
| 8435 | 279 |     printNoHashImmediate(MI, 10, O); | 
| 8436 | 279 |     SStream_concat0(O, "], "); | 
| 8437 | 279 |     set_mem_access(MI, false); | 
| 8438 | 279 |     printOperand(MI, 1, O); | 
| 8439 | 279 |     SStream_concat0(O, "["); | 
| 8440 | 279 |     set_mem_access(MI, true); | 
| 8441 | 279 |     printNoHashImmediate(MI, 10, O); | 
| 8442 | 279 |     SStream_concat0(O, "], "); | 
| 8443 | 279 |     set_mem_access(MI, false); | 
| 8444 | 279 |     printOperand(MI, 2, O); | 
| 8445 | 279 |     SStream_concat0(O, "["); | 
| 8446 | 279 |     set_mem_access(MI, true); | 
| 8447 | 279 |     printNoHashImmediate(MI, 10, O); | 
| 8448 | 279 |     break; | 
| 8449 | 503 |   case 34: | 
| 8450 |  |     // VLD4DUPd16, VLD4DUPd16_UPD, VLD4DUPd32, VLD4DUPd32_UPD, VLD4DUPd8, VLD... | 
| 8451 | 503 |     SStream_concat0(O, "[], "); | 
| 8452 | 503 |     printOperand(MI, 3, O); | 
| 8453 | 503 |     SStream_concat0(O, "[]}, "); | 
| 8454 | 503 |     break; | 
| 8455 | 474 |   case 35: | 
| 8456 |  |     // VLD4LNd16_UPD, VLD4LNd32_UPD, VLD4LNd8_UPD, VLD4LNq16_UPD, VLD4LNq32_U... | 
| 8457 | 474 |     printNoHashImmediate(MI, 12, O); | 
| 8458 | 474 |     SStream_concat0(O, "], "); | 
| 8459 | 474 |     set_mem_access(MI, false); | 
| 8460 | 474 |     printOperand(MI, 1, O); | 
| 8461 | 474 |     SStream_concat0(O, "["); | 
| 8462 | 474 |     set_mem_access(MI, true); | 
| 8463 | 474 |     printNoHashImmediate(MI, 12, O); | 
| 8464 | 474 |     SStream_concat0(O, "], "); | 
| 8465 | 474 |     set_mem_access(MI, false); | 
| 8466 | 474 |     printOperand(MI, 2, O); | 
| 8467 | 474 |     SStream_concat0(O, "["); | 
| 8468 | 474 |     set_mem_access(MI, true); | 
| 8469 | 474 |     printNoHashImmediate(MI, 12, O); | 
| 8470 | 474 |     SStream_concat0(O, "], "); | 
| 8471 | 474 |     set_mem_access(MI, false); | 
| 8472 | 474 |     printOperand(MI, 3, O); | 
| 8473 | 474 |     SStream_concat0(O, "["); | 
| 8474 | 474 |     set_mem_access(MI, true); | 
| 8475 | 474 |     printNoHashImmediate(MI, 12, O); | 
| 8476 | 474 |     SStream_concat0(O, "]}, "); | 
| 8477 | 474 |     set_mem_access(MI, false); | 
| 8478 | 474 |     printAddrMode6Operand(MI, 5, O); | 
| 8479 | 474 |     printAddrMode6OffsetOperand(MI, 7, O); | 
| 8480 | 474 |     return; | 
| 8481 | 0 |     break; | 
| 8482 | 493 |   case 36: | 
| 8483 |  |     // VLDRD, VLDRS, VSTRD, VSTRS | 
| 8484 | 493 |     printAddrMode5Operand(MI, 1, O, false); | 
| 8485 | 493 |     return; | 
| 8486 | 0 |     break; | 
| 8487 | 165 |   case 37: | 
| 8488 |  |     // VLDRH, VSTRH | 
| 8489 | 165 |     printAddrMode5FP16Operand(MI, 1, O, false); | 
| 8490 | 165 |     return; | 
| 8491 | 0 |     break; | 
| 8492 | 41 |   case 38: | 
| 8493 |  |     // VST1LNd16, VST1LNd32, VST1LNd8 | 
| 8494 | 41 |     printNoHashImmediate(MI, 3, O); | 
| 8495 | 41 |     SStream_concat0(O, "]}, "); | 
| 8496 | 41 |     set_mem_access(MI, false); | 
| 8497 | 41 |     printAddrMode6Operand(MI, 0, O); | 
| 8498 | 41 |     return; | 
| 8499 | 0 |     break; | 
| 8500 | 275 |   case 39: | 
| 8501 |  |     // VST1LNd16_UPD, VST1LNd32_UPD, VST1LNd8_UPD, VST3LNd16, VST3LNd32, VST3... | 
| 8502 | 275 |     printNoHashImmediate(MI, 5, O); | 
| 8503 | 275 |     break; | 
| 8504 | 224 |   case 40: | 
| 8505 |  |     // VST3LNd16_UPD, VST3LNd32_UPD, VST3LNd8_UPD, VST3LNq16_UPD, VST3LNq32_U... | 
| 8506 | 224 |     printNoHashImmediate(MI, 7, O); | 
| 8507 | 224 |     SStream_concat0(O, "], "); | 
| 8508 | 224 |     set_mem_access(MI, false); | 
| 8509 | 224 |     printOperand(MI, 5, O); | 
| 8510 | 224 |     SStream_concat0(O, "["); | 
| 8511 | 224 |     set_mem_access(MI, true); | 
| 8512 | 224 |     printNoHashImmediate(MI, 7, O); | 
| 8513 | 224 |     SStream_concat0(O, "], "); | 
| 8514 | 224 |     set_mem_access(MI, false); | 
| 8515 | 224 |     printOperand(MI, 6, O); | 
| 8516 | 224 |     SStream_concat0(O, "["); | 
| 8517 | 224 |     set_mem_access(MI, true); | 
| 8518 | 224 |     printNoHashImmediate(MI, 7, O); | 
| 8519 | 224 |     SStream_concat0(O, "]}, "); | 
| 8520 | 224 |     set_mem_access(MI, false); | 
| 8521 | 224 |     printAddrMode6Operand(MI, 1, O); | 
| 8522 | 224 |     printAddrMode6OffsetOperand(MI, 3, O); | 
| 8523 | 224 |     return; | 
| 8524 | 0 |     break; | 
| 8525 | 1.28k |   case 41: | 
| 8526 |  |     // VST3d16_UPD, VST3d32_UPD, VST3d8_UPD, VST3q16_UPD, VST3q32_UPD, VST3q8... | 
| 8527 | 1.28k |     printOperand(MI, 5, O); | 
| 8528 | 1.28k |     SStream_concat0(O, ", "); | 
| 8529 | 1.28k |     printOperand(MI, 6, O); | 
| 8530 | 1.28k |     break; | 
| 8531 | 43 |   case 42: | 
| 8532 |  |     // VTBL1 | 
| 8533 | 43 |     printVectorListOne(MI, 1, O); | 
| 8534 | 43 |     SStream_concat0(O, ", "); | 
| 8535 | 43 |     printOperand(MI, 2, O); | 
| 8536 | 43 |     return; | 
| 8537 | 0 |     break; | 
| 8538 | 180 |   case 43: | 
| 8539 |  |     // VTBL2 | 
| 8540 | 180 |     printVectorListTwo(MI, 1, O); | 
| 8541 | 180 |     SStream_concat0(O, ", "); | 
| 8542 | 180 |     printOperand(MI, 2, O); | 
| 8543 | 180 |     return; | 
| 8544 | 0 |     break; | 
| 8545 | 181 |   case 44: | 
| 8546 |  |     // VTBL3 | 
| 8547 | 181 |     printVectorListThree(MI, 1, O); | 
| 8548 | 181 |     SStream_concat0(O, ", "); | 
| 8549 | 181 |     printOperand(MI, 2, O); | 
| 8550 | 181 |     return; | 
| 8551 | 0 |     break; | 
| 8552 | 51 |   case 45: | 
| 8553 |  |     // VTBL4 | 
| 8554 | 51 |     printVectorListFour(MI, 1, O); | 
| 8555 | 51 |     SStream_concat0(O, ", "); | 
| 8556 | 51 |     printOperand(MI, 2, O); | 
| 8557 | 51 |     return; | 
| 8558 | 0 |     break; | 
| 8559 | 21 |   case 46: | 
| 8560 |  |     // VTBX1 | 
| 8561 | 21 |     printVectorListOne(MI, 2, O); | 
| 8562 | 21 |     SStream_concat0(O, ", "); | 
| 8563 | 21 |     printOperand(MI, 3, O); | 
| 8564 | 21 |     return; | 
| 8565 | 0 |     break; | 
| 8566 | 136 |   case 47: | 
| 8567 |  |     // VTBX2 | 
| 8568 | 136 |     printVectorListTwo(MI, 2, O); | 
| 8569 | 136 |     SStream_concat0(O, ", "); | 
| 8570 | 136 |     printOperand(MI, 3, O); | 
| 8571 | 136 |     return; | 
| 8572 | 0 |     break; | 
| 8573 | 207 |   case 48: | 
| 8574 |  |     // VTBX3 | 
| 8575 | 207 |     printVectorListThree(MI, 2, O); | 
| 8576 | 207 |     SStream_concat0(O, ", "); | 
| 8577 | 207 |     printOperand(MI, 3, O); | 
| 8578 | 207 |     return; | 
| 8579 | 0 |     break; | 
| 8580 | 9 |   case 49: | 
| 8581 |  |     // VTBX4 | 
| 8582 | 9 |     printVectorListFour(MI, 2, O); | 
| 8583 | 9 |     SStream_concat0(O, ", "); | 
| 8584 | 9 |     printOperand(MI, 3, O); | 
| 8585 | 9 |     return; | 
| 8586 | 0 |     break; | 
| 8587 | 646 |   case 50: | 
| 8588 |  |     // sysLDMDA_UPD, sysLDMDB_UPD, sysLDMIA_UPD, sysLDMIB_UPD, sysSTMDA_UPD, ... | 
| 8589 | 646 |     SStream_concat0(O, " ^"); | 
| 8590 | 646 |     ARM_addUserMode(MI); | 
| 8591 | 646 |     return; | 
| 8592 | 0 |     break; | 
| 8593 | 961 |   case 51: | 
| 8594 |  |     // t2LDRBT, t2LDRBi8, t2LDRHT, t2LDRHi8, t2LDRSBT, t2LDRSBi8, t2LDRSHT, t... | 
| 8595 | 961 |     printT2AddrModeImm8Operand(MI, 1, O, false); | 
| 8596 | 961 |     return; | 
| 8597 | 0 |     break; | 
| 8598 | 499 |   case 52: | 
| 8599 |  |     // t2LDRB_PRE, t2LDRH_PRE, t2LDRSB_PRE, t2LDRSH_PRE, t2LDR_PRE, t2STRB_PR... | 
| 8600 | 499 |     printT2AddrModeImm8Operand(MI, 2, O, true); | 
| 8601 | 499 |     SStream_concat0(O, "!"); | 
| 8602 | 499 |     return; | 
| 8603 | 0 |     break; | 
| 8604 | 6.59k |   case 53: | 
| 8605 |  |     // t2LDRBpci, t2LDRHpci, t2LDRSBpci, t2LDRSHpci, t2LDRpci, tLDRpci | 
| 8606 | 6.59k |     printThumbLdrLabelOperand(MI, 1, O); | 
| 8607 | 6.59k |     return; | 
| 8608 | 0 |     break; | 
| 8609 | 731 |   case 54: | 
| 8610 |  |     // t2LDRBs, t2LDRHs, t2LDRSBs, t2LDRSHs, t2LDRs, t2STRBs, t2STRHs, t2STRs | 
| 8611 | 731 |     printT2AddrModeSoRegOperand(MI, 1, O); | 
| 8612 | 731 |     return; | 
| 8613 | 0 |     break; | 
| 8614 | 62 |   case 55: | 
| 8615 |  |     // t2LDREX | 
| 8616 | 62 |     printT2AddrModeImm0_1020s4Operand(MI, 1, O); | 
| 8617 | 62 |     return; | 
| 8618 | 0 |     break; | 
| 8619 | 227 |   case 56: | 
| 8620 |  |     // t2MRS_M | 
| 8621 | 227 |     printMSRMaskOperand(MI, 1, O); | 
| 8622 | 227 |     return; | 
| 8623 | 0 |     break; | 
| 8624 | 750 |   case 57: | 
| 8625 |  |     // tADDspi, tSUBspi | 
| 8626 | 750 |     printThumbS4ImmOperand(MI, 2, O); | 
| 8627 | 750 |     return; | 
| 8628 | 0 |     break; | 
| 8629 | 6.21k |   case 58: | 
| 8630 |  |     // tADR | 
| 8631 | 6.21k |     printAdrLabelOperand(MI, 1, O, 2); | 
| 8632 | 6.21k |     return; | 
| 8633 | 0 |     break; | 
| 8634 | 12.0k |   case 59: | 
| 8635 |  |     // tASRri, tLSRri | 
| 8636 | 12.0k |     printThumbSRImm(MI, 3, O); | 
| 8637 | 12.0k |     return; | 
| 8638 | 0 |     break; | 
| 8639 | 8.51k |   case 60: | 
| 8640 |  |     // tLDRBi, tSTRBi | 
| 8641 | 8.51k |     printThumbAddrModeImm5S1Operand(MI, 1, O); | 
| 8642 | 8.51k |     return; | 
| 8643 | 0 |     break; | 
| 8644 | 7.86k |   case 61: | 
| 8645 |  |     // tLDRBr, tLDRHr, tLDRSB, tLDRSH, tLDRr, tSTRBr, tSTRHr, tSTRr | 
| 8646 | 7.86k |     printThumbAddrModeRROperand(MI, 1, O); | 
| 8647 | 7.86k |     return; | 
| 8648 | 0 |     break; | 
| 8649 | 12.1k |   case 62: | 
| 8650 |  |     // tLDRHi, tSTRHi | 
| 8651 | 12.1k |     printThumbAddrModeImm5S2Operand(MI, 1, O); | 
| 8652 | 12.1k |     return; | 
| 8653 | 0 |     break; | 
| 8654 | 14.9k |   case 63: | 
| 8655 |  |     // tLDRi, tSTRi | 
| 8656 | 14.9k |     printThumbAddrModeImm5S4Operand(MI, 1, O); | 
| 8657 | 14.9k |     return; | 
| 8658 | 0 |     break; | 
| 8659 | 6.45k |   case 64: | 
| 8660 |  |     // tLDRspi, tSTRspi | 
| 8661 | 6.45k |     printThumbAddrModeSPOperand(MI, 1, O); | 
| 8662 | 6.45k |     return; | 
| 8663 | 0 |     break; | 
| 8664 | 209k |   } | 
| 8665 |  |  | 
| 8666 |  |  | 
| 8667 |  |   // Fragment 5 encoded into 5 bits for 23 unique commands. | 
| 8668 |  |   // printf("Fragment 5: %"PRIu64"\n", ((Bits >> 42) & 31)); | 
| 8669 | 100k |   switch ((Bits >> 42) & 31) { | 
| 8670 | 0 |   default: // unreachable | 
| 8671 | 44.9k |   case 0: | 
| 8672 |  |     // ASRi, ASRr, LSLi, LSLr, LSRi, LSRr, RORi, RORr, VLD1LNdWB_register_Asm... | 
| 8673 | 44.9k |     SStream_concat0(O, ", "); | 
| 8674 | 44.9k |     break; | 
| 8675 | 40.9k |   case 1: | 
| 8676 |  |     // LDRConstPool, RRXi, VLD1LNdAsm_16, VLD1LNdAsm_32, VLD1LNdAsm_8, VLD2LN... | 
| 8677 | 40.9k |     return; | 
| 8678 | 0 |     break; | 
| 8679 | 0 |   case 2: | 
| 8680 |  |     // VLD1LNdWB_fixed_Asm_16, VLD1LNdWB_fixed_Asm_32, VLD1LNdWB_fixed_Asm_8,... | 
| 8681 | 0 |     SStream_concat0(O, "!"); | 
| 8682 | 0 |     return; | 
| 8683 | 0 |     break; | 
| 8684 | 555 |   case 3: | 
| 8685 |  |     // VLD3dWB_register_Asm_16, VLD3dWB_register_Asm_32, VLD3dWB_register_Asm... | 
| 8686 | 555 |     printOperand(MI, 3, O); | 
| 8687 | 555 |     break; | 
| 8688 | 2.06k |   case 4: | 
| 8689 |  |     // CDP, t2CDP, t2CDP2 | 
| 8690 | 2.06k |     printCImmediate(MI, 2, O); | 
| 8691 | 2.06k |     SStream_concat0(O, ", "); | 
| 8692 | 2.06k |     printCImmediate(MI, 3, O); | 
| 8693 | 2.06k |     SStream_concat0(O, ", "); | 
| 8694 | 2.06k |     printCImmediate(MI, 4, O); | 
| 8695 | 2.06k |     SStream_concat0(O, ", "); | 
| 8696 | 2.06k |     printOperand(MI, 5, O); | 
| 8697 | 2.06k |     return; | 
| 8698 | 0 |     break; | 
| 8699 | 1.96k |   case 5: | 
| 8700 |  |     // MCR, MCRR, VABDfd, VABDfq, VABDhd, VABDhq, VACGEfd, VACGEfq, VACGEhd, ... | 
| 8701 | 1.96k |     printOperand(MI, 2, O); | 
| 8702 | 1.96k |     break; | 
| 8703 | 466 |   case 6: | 
| 8704 |  |     // SSAT, t2SSAT | 
| 8705 | 466 |     printShiftImmOperand(MI, 3, O); | 
| 8706 | 466 |     return; | 
| 8707 | 0 |     break; | 
| 8708 | 125 |   case 7: | 
| 8709 |  |     // SXTB, SXTB16, SXTH, UXTB, UXTB16, UXTH, t2SXTB, t2SXTB16, t2SXTH, t2UX... | 
| 8710 | 125 |     printRotImmOperand(MI, 2, O); | 
| 8711 | 125 |     return; | 
| 8712 | 0 |     break; | 
| 8713 | 693 |   case 8: | 
| 8714 |  |     // VCMLAv2f32_indexed, VCMLAv4f16_indexed, VCMLAv4f32_indexed, VCMLAv8f16... | 
| 8715 | 693 |     printVectorIndex(MI, 4, O); | 
| 8716 | 693 |     break; | 
| 8717 | 341 |   case 9: | 
| 8718 |  |     // VDUPLN16d, VDUPLN16q, VDUPLN32d, VDUPLN32q, VDUPLN8d, VDUPLN8q, VGETLN... | 
| 8719 | 341 |     printVectorIndex(MI, 2, O); | 
| 8720 | 341 |     return; | 
| 8721 | 0 |     break; | 
| 8722 | 2.61k |   case 10: | 
| 8723 |  |     // VLD1DUPd16wb_register, VLD1DUPd32wb_register, VLD1DUPd8wb_register, VL... | 
| 8724 | 2.61k |     printOperand(MI, 4, O); | 
| 8725 | 2.61k |     return; | 
| 8726 | 0 |     break; | 
| 8727 | 733 |   case 11: | 
| 8728 |  |     // VLD1LNd16, VLD1LNd16_UPD, VLD1LNd32, VLD1LNd32_UPD, VLD1LNd8, VLD1LNd8... | 
| 8729 | 733 |     SStream_concat0(O, "]}, "); | 
| 8730 | 733 |     set_mem_access(MI, false); | 
| 8731 | 733 |     break; | 
| 8732 | 1.03k |   case 12: | 
| 8733 |  |     // VLD2LNd16, VLD2LNd32, VLD2LNd8, VLD2LNq16, VLD2LNq32, VLD4LNd16, VLD4L... | 
| 8734 | 1.03k |     SStream_concat0(O, "], "); | 
| 8735 | 1.03k |     set_mem_access(MI, false); | 
| 8736 | 1.03k |     break; | 
| 8737 | 258 |   case 13: | 
| 8738 |  |     // VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_UPD, VLD2LNq32_U... | 
| 8739 | 258 |     printOperand(MI, 1, O); | 
| 8740 | 258 |     SStream_concat0(O, "["); | 
| 8741 | 258 |     set_mem_access(MI, true); | 
| 8742 | 258 |     printNoHashImmediate(MI, 8, O); | 
| 8743 | 258 |     break; | 
| 8744 | 42 |   case 14: | 
| 8745 |  |     // VLD3DUPd16, VLD3DUPd32, VLD3DUPd8, VLD3DUPq16, VLD3DUPq32, VLD3DUPq8 | 
| 8746 | 42 |     printAddrMode6Operand(MI, 3, O); | 
| 8747 | 42 |     return; | 
| 8748 | 0 |     break; | 
| 8749 | 321 |   case 15: | 
| 8750 |  |     // VLD3DUPd16_UPD, VLD3DUPd32_UPD, VLD3DUPd8_UPD, VLD3DUPq16_UPD, VLD3DUP... | 
| 8751 | 321 |     printAddrMode6Operand(MI, 4, O); | 
| 8752 | 321 |     break; | 
| 8753 | 295 |   case 16: | 
| 8754 |  |     // VLD4DUPd16_UPD, VLD4DUPd32_UPD, VLD4DUPd8_UPD, VLD4DUPq16_UPD, VLD4DUP... | 
| 8755 | 295 |     printAddrMode6Operand(MI, 5, O); | 
| 8756 | 295 |     printAddrMode6OffsetOperand(MI, 7, O); | 
| 8757 | 295 |     return; | 
| 8758 | 0 |     break; | 
| 8759 | 469 |   case 17: | 
| 8760 |  |     // VMULLslsv2i32, VMULLslsv4i16, VMULLsluv2i32, VMULLsluv4i16, VMULslv2i3... | 
| 8761 | 469 |     printVectorIndex(MI, 3, O); | 
| 8762 | 469 |     return; | 
| 8763 | 0 |     break; | 
| 8764 | 549 |   case 18: | 
| 8765 |  |     // VST3d16_UPD, VST3d32_UPD, VST3d8_UPD, VST3q16_UPD, VST3q32_UPD, VST3q8... | 
| 8766 | 549 |     SStream_concat0(O, "}, "); | 
| 8767 | 549 |     printAddrMode6Operand(MI, 1, O); | 
| 8768 | 549 |     printAddrMode6OffsetOperand(MI, 3, O); | 
| 8769 | 549 |     return; | 
| 8770 | 0 |     break; | 
| 8771 | 500 |   case 19: | 
| 8772 |  |     // VST4LNd16_UPD, VST4LNd32_UPD, VST4LNd8_UPD, VST4LNq16_UPD, VST4LNq32_U... | 
| 8773 | 500 |     printOperand(MI, 5, O); | 
| 8774 | 500 |     SStream_concat0(O, "["); | 
| 8775 | 500 |     set_mem_access(MI, true); | 
| 8776 | 500 |     printNoHashImmediate(MI, 8, O); | 
| 8777 | 500 |     SStream_concat0(O, "], "); | 
| 8778 | 500 |     set_mem_access(MI, false); | 
| 8779 | 500 |     printOperand(MI, 6, O); | 
| 8780 | 500 |     SStream_concat0(O, "["); | 
| 8781 | 500 |     set_mem_access(MI, true); | 
| 8782 | 500 |     printNoHashImmediate(MI, 8, O); | 
| 8783 | 500 |     SStream_concat0(O, "], "); | 
| 8784 | 500 |     set_mem_access(MI, false); | 
| 8785 | 500 |     printOperand(MI, 7, O); | 
| 8786 | 500 |     SStream_concat0(O, "["); | 
| 8787 | 500 |     set_mem_access(MI, true); | 
| 8788 | 500 |     printNoHashImmediate(MI, 8, O); | 
| 8789 | 500 |     SStream_concat0(O, "]}, "); | 
| 8790 | 500 |     set_mem_access(MI, false); | 
| 8791 | 500 |     printAddrMode6Operand(MI, 1, O); | 
| 8792 | 500 |     printAddrMode6OffsetOperand(MI, 3, O); | 
| 8793 | 500 |     return; | 
| 8794 | 0 |     break; | 
| 8795 | 692 |   case 20: | 
| 8796 |  |     // sysLDMDA, sysLDMDB, sysLDMIA, sysLDMIB, sysSTMDA, sysSTMDB, sysSTMIA, ... | 
| 8797 | 692 |     SStream_concat0(O, " ^"); | 
| 8798 | 692 |     ARM_addUserMode(MI); | 
| 8799 | 692 |     return; | 
| 8800 | 0 |     break; | 
| 8801 | 617 |   case 21: | 
| 8802 |  |     // t2LDRB_POST, t2LDRH_POST, t2LDRSB_POST, t2LDRSH_POST, t2LDR_POST, t2ST... | 
| 8803 | 617 |     printT2AddrModeImm8OffsetOperand(MI, 3, O); | 
| 8804 | 617 |     return; | 
| 8805 | 0 |     break; | 
| 8806 | 0 |   case 22: | 
| 8807 |  |     // t2MOVsra_flag, t2MOVsrl_flag | 
| 8808 | 0 |     SStream_concat0(O, ", #1"); | 
| 8809 | 0 |     op_addImm(MI, 1); | 
| 8810 | 0 |     return; | 
| 8811 | 0 |     break; | 
| 8812 | 100k |   } | 
| 8813 |  |  | 
| 8814 |  |  | 
| 8815 |  |   // Fragment 6 encoded into 6 bits for 38 unique commands. | 
| 8816 |  |   // printf("Fragment 6: %"PRIu64"\n", ((Bits >> 47) & 63)); | 
| 8817 | 50.5k |   switch ((Bits >> 47) & 63) { | 
| 8818 | 0 |   default: // unreachable | 
| 8819 | 14.2k |   case 0: | 
| 8820 |  |     // ASRi, ASRr, LSLi, LSLr, LSRi, LSRr, RORi, RORr, ADCrr, ADDrr, ANDrr, B... | 
| 8821 | 14.2k |     printOperand(MI, 2, O); | 
| 8822 | 14.2k |     break; | 
| 8823 | 453 |   case 1: | 
| 8824 |  |     // VLD1LNdWB_register_Asm_16, VLD1LNdWB_register_Asm_32, VLD1LNdWB_regist... | 
| 8825 | 453 |     printOperand(MI, 4, O); | 
| 8826 | 453 |     break; | 
| 8827 | 1.69k |   case 2: | 
| 8828 |  |     // VLD3dWB_register_Asm_16, VLD3dWB_register_Asm_32, VLD3dWB_register_Asm... | 
| 8829 | 1.69k |     return; | 
| 8830 | 0 |     break; | 
| 8831 | 3.44k |   case 3: | 
| 8832 |  |     // ADCri, ADDri, ANDri, BICri, EORri, ORRri, RSBri, RSCri, SBCri, SUBri | 
| 8833 | 3.44k |     printModImmOperand(MI, 2, O); | 
| 8834 | 3.44k |     return; | 
| 8835 | 0 |     break; | 
| 8836 | 5.16k |   case 4: | 
| 8837 |  |     // ADCrsi, ADDrsi, ANDrsi, BICrsi, EORrsi, ORRrsi, RSBrsi, RSCrsi, SBCrsi... | 
| 8838 | 5.16k |     printSORegImmOperand(MI, 2, O); | 
| 8839 | 5.16k |     return; | 
| 8840 | 0 |     break; | 
| 8841 | 360 |   case 5: | 
| 8842 |  |     // BFI, t2BFI | 
| 8843 | 360 |     printBitfieldInvMaskImmOperand(MI, 3, O); | 
| 8844 | 360 |     return; | 
| 8845 | 0 |     break; | 
| 8846 | 1.06k |   case 6: | 
| 8847 |  |     // LDCL_OPTION, LDC_OPTION, STCL_OPTION, STC_OPTION, t2LDC2L_OPTION, t2LD... | 
| 8848 | 1.06k |     printCoprocOptionImm(MI, 3, O); | 
| 8849 | 1.06k |     return; | 
| 8850 | 0 |     break; | 
| 8851 | 2.54k |   case 7: | 
| 8852 |  |     // LDCL_POST, LDC_POST, STCL_POST, STC_POST, t2LDC2L_POST, t2LDC2_POST, t... | 
| 8853 | 2.54k |     printPostIdxImm8s4Operand(MI, 3, O); | 
| 8854 | 2.54k |     return; | 
| 8855 | 0 |     break; | 
| 8856 | 5.12k |   case 8: | 
| 8857 |  |     // LDRBT_POST_IMM, LDRBT_POST_REG, LDRB_POST_IMM, LDRB_POST_REG, LDRT_POS... | 
| 8858 | 5.12k |     printAddrMode2OffsetOperand(MI, 3, O); | 
| 8859 | 5.12k |     return; | 
| 8860 | 0 |     break; | 
| 8861 | 99 |   case 9: | 
| 8862 |  |     // LDRD, STRD | 
| 8863 | 99 |     printAddrMode3Operand(MI, 2, O, false); | 
| 8864 | 99 |     return; | 
| 8865 | 0 |     break; | 
| 8866 | 1.29k |   case 10: | 
| 8867 |  |     // LDRD_POST, STRD_POST, t2LDRD_POST, t2STRD_POST | 
| 8868 | 1.29k |     printAddrMode7Operand(MI, 3, O); | 
| 8869 | 1.29k |     break; | 
| 8870 | 146 |   case 11: | 
| 8871 |  |     // LDRD_PRE, STRD_PRE | 
| 8872 | 146 |     printAddrMode3Operand(MI, 3, O, true); | 
| 8873 | 146 |     SStream_concat0(O, "!"); | 
| 8874 | 146 |     return; | 
| 8875 | 0 |     break; | 
| 8876 | 403 |   case 12: | 
| 8877 |  |     // LDRHTi, LDRSBTi, LDRSHTi, STRHTi | 
| 8878 | 403 |     printPostIdxImm8Operand(MI, 3, O); | 
| 8879 | 403 |     return; | 
| 8880 | 0 |     break; | 
| 8881 | 830 |   case 13: | 
| 8882 |  |     // LDRHTr, LDRSBTr, LDRSHTr, STRHTr | 
| 8883 | 830 |     printPostIdxRegOperand(MI, 3, O); | 
| 8884 | 830 |     return; | 
| 8885 | 0 |     break; | 
| 8886 | 1.01k |   case 14: | 
| 8887 |  |     // LDRH_POST, LDRSB_POST, LDRSH_POST, STRH_POST | 
| 8888 | 1.01k |     printAddrMode3OffsetOperand(MI, 3, O); | 
| 8889 | 1.01k |     return; | 
| 8890 | 0 |     break; | 
| 8891 | 1.61k |   case 15: | 
| 8892 |  |     // MCR, MCRR, VCMLAv2f32_indexed, VCMLAv4f16_indexed, VCMLAv4f32_indexed,... | 
| 8893 | 1.61k |     SStream_concat0(O, ", "); | 
| 8894 | 1.61k |     break; | 
| 8895 | 87 |   case 16: | 
| 8896 |  |     // MCRR2 | 
| 8897 | 87 |     printCImmediate(MI, 4, O); | 
| 8898 | 87 |     return; | 
| 8899 | 0 |     break; | 
| 8900 | 680 |   case 17: | 
| 8901 |  |     // STLEX, STLEXB, STLEXH, STREX, STREXB, STREXH, SWP, SWPB, t2LDAEXD, t2L... | 
| 8902 | 680 |     printAddrMode7Operand(MI, 2, O); | 
| 8903 | 680 |     return; | 
| 8904 | 0 |     break; | 
| 8905 | 911 |   case 18: | 
| 8906 |  |     // VBIFd, VBIFq, VBITd, VBITq, VBSLd, VBSLq, VLD4LNd16, VLD4LNd32, VLD4LN... | 
| 8907 | 911 |     printOperand(MI, 3, O); | 
| 8908 | 911 |     break; | 
| 8909 | 29 |   case 19: | 
| 8910 |  |     // VCADDv2f32, VCADDv4f16, VCADDv4f32, VCADDv8f16 | 
| 8911 | 29 |     printComplexRotationOp(MI, 3, O, 180, 90); | 
| 8912 | 29 |     return; | 
| 8913 | 0 |     break; | 
| 8914 | 34 |   case 20: | 
| 8915 |  |     // VCMLAv2f32, VCMLAv4f16, VCMLAv4f32, VCMLAv8f16 | 
| 8916 | 34 |     printComplexRotationOp(MI, 4, O, 90, 0); | 
| 8917 | 34 |     return; | 
| 8918 | 0 |     break; | 
| 8919 | 352 |   case 21: | 
| 8920 |  |     // VLD1LNd16, VLD1LNd32, VLD1LNd8, VST1LNd16_UPD, VST1LNd32_UPD, VST1LNd8... | 
| 8921 | 352 |     printAddrMode6Operand(MI, 1, O); | 
| 8922 | 352 |     break; | 
| 8923 | 177 |   case 22: | 
| 8924 |  |     // VLD1LNd16_UPD, VLD1LNd32_UPD, VLD1LNd8_UPD | 
| 8925 | 177 |     printAddrMode6Operand(MI, 2, O); | 
| 8926 | 177 |     printAddrMode6OffsetOperand(MI, 4, O); | 
| 8927 | 177 |     return; | 
| 8928 | 0 |     break; | 
| 8929 | 187 |   case 23: | 
| 8930 |  |     // VLD2LNd16, VLD2LNd32, VLD2LNd8, VLD2LNq16, VLD2LNq32 | 
| 8931 | 187 |     printOperand(MI, 1, O); | 
| 8932 | 187 |     SStream_concat0(O, "["); | 
| 8933 | 187 |     set_mem_access(MI, true); | 
| 8934 | 187 |     printNoHashImmediate(MI, 6, O); | 
| 8935 | 187 |     SStream_concat0(O, "]}, "); | 
| 8936 | 187 |     set_mem_access(MI, false); | 
| 8937 | 187 |     printAddrMode6Operand(MI, 2, O); | 
| 8938 | 187 |     return; | 
| 8939 | 0 |     break; | 
| 8940 | 238 |   case 24: | 
| 8941 |  |     // VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_UPD, VLD2LNq32_U... | 
| 8942 | 238 |     SStream_concat0(O, "]}, "); | 
| 8943 | 238 |     set_mem_access(MI, false); | 
| 8944 | 238 |     printAddrMode6Operand(MI, 3, O); | 
| 8945 | 238 |     printAddrMode6OffsetOperand(MI, 5, O); | 
| 8946 | 238 |     return; | 
| 8947 | 0 |     break; | 
| 8948 | 113 |   case 25: | 
| 8949 |  |     // VLD3DUPd16_UPD, VLD3DUPd32_UPD, VLD3DUPd8_UPD, VLD3DUPq16_UPD, VLD3DUP... | 
| 8950 | 113 |     printAddrMode6OffsetOperand(MI, 6, O); | 
| 8951 | 113 |     return; | 
| 8952 | 0 |     break; | 
| 8953 | 20 |   case 26: | 
| 8954 |  |     // VLD3LNd16, VLD3LNd32, VLD3LNd8, VLD3LNq16, VLD3LNq32 | 
| 8955 | 20 |     SStream_concat0(O, "], "); | 
| 8956 | 20 |     set_mem_access(MI, false); | 
| 8957 | 20 |     printOperand(MI, 2, O); | 
| 8958 | 20 |     SStream_concat0(O, "["); | 
| 8959 | 20 |     set_mem_access(MI, true); | 
| 8960 | 20 |     printNoHashImmediate(MI, 8, O); | 
| 8961 | 20 |     SStream_concat0(O, "]}, "); | 
| 8962 | 20 |     set_mem_access(MI, false); | 
| 8963 | 20 |     printAddrMode6Operand(MI, 3, O); | 
| 8964 | 20 |     return; | 
| 8965 | 0 |     break; | 
| 8966 | 204 |   case 27: | 
| 8967 |  |     // VLD3LNd16_UPD, VLD3LNd32_UPD, VLD3LNd8_UPD, VLD3LNq16_UPD, VLD3LNq32_U... | 
| 8968 | 204 |     printAddrMode6Operand(MI, 4, O); | 
| 8969 | 204 |     printAddrMode6OffsetOperand(MI, 6, O); | 
| 8970 | 204 |     return; | 
| 8971 | 0 |     break; | 
| 8972 | 90 |   case 28: | 
| 8973 |  |     // VMLAslfd, VMLAslfq, VMLAslhd, VMLAslhq, VMLSslfd, VMLSslfq, VMLSslhd, ... | 
| 8974 | 90 |     printVectorIndex(MI, 4, O); | 
| 8975 | 90 |     return; | 
| 8976 | 0 |     break; | 
| 8977 | 23 |   case 29: | 
| 8978 |  |     // VMULslfd, VMULslfq, VMULslhd, VMULslhq | 
| 8979 | 23 |     printVectorIndex(MI, 3, O); | 
| 8980 | 23 |     return; | 
| 8981 | 0 |     break; | 
| 8982 | 256 |   case 30: | 
| 8983 |  |     // VST2LNd16_UPD, VST2LNd32_UPD, VST2LNd8_UPD, VST2LNq16_UPD, VST2LNq32_U... | 
| 8984 | 256 |     printOperand(MI, 5, O); | 
| 8985 | 256 |     SStream_concat0(O, "["); | 
| 8986 | 256 |     set_mem_access(MI, true); | 
| 8987 | 256 |     printNoHashImmediate(MI, 6, O); | 
| 8988 | 256 |     SStream_concat0(O, "]}, "); | 
| 8989 | 256 |     set_mem_access(MI, false); | 
| 8990 | 256 |     printAddrMode6Operand(MI, 1, O); | 
| 8991 | 256 |     printAddrMode6OffsetOperand(MI, 3, O); | 
| 8992 | 256 |     return; | 
| 8993 | 0 |     break; | 
| 8994 | 739 |   case 31: | 
| 8995 |  |     // VST4d16_UPD, VST4d32_UPD, VST4d8_UPD, VST4q16_UPD, VST4q32_UPD, VST4q8... | 
| 8996 | 739 |     printOperand(MI, 7, O); | 
| 8997 | 739 |     SStream_concat0(O, "}, "); | 
| 8998 | 739 |     printAddrMode6Operand(MI, 1, O); | 
| 8999 | 739 |     printAddrMode6OffsetOperand(MI, 3, O); | 
| 9000 | 739 |     return; | 
| 9001 | 0 |     break; | 
| 9002 | 1.13k |   case 32: | 
| 9003 |  |     // t2ADCrs, t2ADDrs, t2ANDrs, t2BICrs, t2EORrs, t2ORNrs, t2ORRrs, t2RSBrs... | 
| 9004 | 1.13k |     printT2SOOperand(MI, 2, O); | 
| 9005 | 1.13k |     return; | 
| 9006 | 0 |     break; | 
| 9007 | 54 |   case 33: | 
| 9008 |  |     // t2ASRri, t2LSRri | 
| 9009 | 54 |     printThumbSRImm(MI, 2, O); | 
| 9010 | 54 |     return; | 
| 9011 | 0 |     break; | 
| 9012 | 2.06k |   case 34: | 
| 9013 |  |     // t2LDRD_PRE, t2STRD_PRE | 
| 9014 | 2.06k |     printT2AddrModeImm8s4Operand(MI, 3, O, true); | 
| 9015 | 2.06k |     SStream_concat0(O, "!"); | 
| 9016 | 2.06k |     return; | 
| 9017 | 0 |     break; | 
| 9018 | 275 |   case 35: | 
| 9019 |  |     // t2LDRDi8, t2STRDi8 | 
| 9020 | 275 |     printT2AddrModeImm8s4Operand(MI, 2, O, false); | 
| 9021 | 275 |     return; | 
| 9022 | 0 |     break; | 
| 9023 | 129 |   case 36: | 
| 9024 |  |     // t2STREX | 
| 9025 | 129 |     printT2AddrModeImm0_1020s4Operand(MI, 2, O); | 
| 9026 | 129 |     return; | 
| 9027 | 0 |     break; | 
| 9028 | 3.18k |   case 37: | 
| 9029 |  |     // tADDrSPi | 
| 9030 | 3.18k |     printThumbS4ImmOperand(MI, 2, O); | 
| 9031 | 3.18k |     return; | 
| 9032 | 0 |     break; | 
| 9033 | 50.5k |   } | 
| 9034 |  |  | 
| 9035 |  |  | 
| 9036 |  |   // Fragment 7 encoded into 4 bits for 13 unique commands. | 
| 9037 |  |   // printf("Fragment 7: %"PRIu64"\n", ((Bits >> 53) & 15)); | 
| 9038 | 18.9k |   switch ((Bits >> 53) & 15) { | 
| 9039 | 0 |   default: // unreachable | 
| 9040 | 8.71k |   case 0: | 
| 9041 |  |     // ASRi, ASRr, LSLi, LSLr, LSRi, LSRr, RORi, RORr, VLD1LNdWB_register_Asm... | 
| 9042 | 8.71k |     return; | 
| 9043 | 0 |     break; | 
| 9044 | 4.67k |   case 1: | 
| 9045 |  |     // LDRD_POST, MLA, MLS, SBFX, SMLABB, SMLABT, SMLAD, SMLADX, SMLALBB, SML... | 
| 9046 | 4.67k |     SStream_concat0(O, ", "); | 
| 9047 | 4.67k |     break; | 
| 9048 | 751 |   case 2: | 
| 9049 |  |     // MCR, t2MCR, t2MCR2 | 
| 9050 | 751 |     printCImmediate(MI, 3, O); | 
| 9051 | 751 |     SStream_concat0(O, ", "); | 
| 9052 | 751 |     printCImmediate(MI, 4, O); | 
| 9053 | 751 |     SStream_concat0(O, ", "); | 
| 9054 | 751 |     printOperand(MI, 5, O); | 
| 9055 | 751 |     return; | 
| 9056 | 0 |     break; | 
| 9057 | 577 |   case 3: | 
| 9058 |  |     // MCRR, t2MCRR, t2MCRR2 | 
| 9059 | 577 |     printOperand(MI, 3, O); | 
| 9060 | 577 |     SStream_concat0(O, ", "); | 
| 9061 | 577 |     printCImmediate(MI, 4, O); | 
| 9062 | 577 |     return; | 
| 9063 | 0 |     break; | 
| 9064 | 128 |   case 4: | 
| 9065 |  |     // PKHBT, t2PKHBT | 
| 9066 | 128 |     printPKHLSLShiftImm(MI, 3, O); | 
| 9067 | 128 |     return; | 
| 9068 | 0 |     break; | 
| 9069 | 326 |   case 5: | 
| 9070 |  |     // PKHTB, t2PKHTB | 
| 9071 | 326 |     printPKHASRShiftImm(MI, 3, O); | 
| 9072 | 326 |     return; | 
| 9073 | 0 |     break; | 
| 9074 | 848 |   case 6: | 
| 9075 |  |     // SXTAB, SXTAB16, SXTAH, UXTAB, UXTAB16, UXTAH, t2SXTAB, t2SXTAB16, t2SX... | 
| 9076 | 848 |     printRotImmOperand(MI, 3, O); | 
| 9077 | 848 |     return; | 
| 9078 | 0 |     break; | 
| 9079 | 218 |   case 7: | 
| 9080 |  |     // USAT, t2USAT | 
| 9081 | 218 |     printShiftImmOperand(MI, 3, O); | 
| 9082 | 218 |     return; | 
| 9083 | 0 |     break; | 
| 9084 | 289 |   case 8: | 
| 9085 |  |     // VCMLAv2f32_indexed, VCMLAv4f16_indexed, VCMLAv4f32_indexed, VCMLAv8f16... | 
| 9086 | 289 |     printComplexRotationOp(MI, 5, O, 90, 0); | 
| 9087 | 289 |     return; | 
| 9088 | 0 |     break; | 
| 9089 | 829 |   case 9: | 
| 9090 |  |     // VLD3d16, VLD3d16_UPD, VLD3d32, VLD3d32_UPD, VLD3d8, VLD3d8_UPD, VLD3q1... | 
| 9091 | 829 |     SStream_concat0(O, "}, "); | 
| 9092 | 829 |     break; | 
| 9093 | 590 |   case 10: | 
| 9094 |  |     // VLD4LNd16, VLD4LNd32, VLD4LNd8, VLD4LNq16, VLD4LNq32, VST2LNd16, VST2L... | 
| 9095 | 590 |     SStream_concat0(O, "["); | 
| 9096 | 590 |     set_mem_access(MI, true); | 
| 9097 | 590 |     break; | 
| 9098 | 190 |   case 11: | 
| 9099 |  |     // VST1LNd16_UPD, VST1LNd32_UPD, VST1LNd8_UPD | 
| 9100 | 190 |     printAddrMode6OffsetOperand(MI, 3, O); | 
| 9101 | 190 |     return; | 
| 9102 | 0 |     break; | 
| 9103 | 762 |   case 12: | 
| 9104 |  |     // t2LDRD_POST, t2STRD_POST | 
| 9105 | 762 |     printT2AddrModeImm8s4OffsetOperand(MI, 4, O); | 
| 9106 | 762 |     return; | 
| 9107 | 0 |     break; | 
| 9108 | 18.9k |   } | 
| 9109 |  |  | 
| 9110 |  |  | 
| 9111 |  |   // Fragment 8 encoded into 4 bits for 12 unique commands. | 
| 9112 |  |   // printf("Fragment 8: %"PRIu64"\n", ((Bits >> 57) & 15)); | 
| 9113 | 6.09k |   switch ((Bits >> 57) & 15) { | 
| 9114 | 0 |   default: // unreachable | 
| 9115 | 530 |   case 0: | 
| 9116 |  |     // LDRD_POST, STRD_POST | 
| 9117 | 530 |     printAddrMode3OffsetOperand(MI, 4, O); | 
| 9118 | 530 |     return; | 
| 9119 | 0 |     break; | 
| 9120 | 3.40k |   case 1: | 
| 9121 |  |     // MLA, MLS, SMLABB, SMLABT, SMLAD, SMLADX, SMLALBB, SMLALBT, SMLALD, SML... | 
| 9122 | 3.40k |     printOperand(MI, 3, O); | 
| 9123 | 3.40k |     break; | 
| 9124 | 279 |   case 2: | 
| 9125 |  |     // SBFX, UBFX, t2SBFX, t2UBFX | 
| 9126 | 279 |     printImmPlusOneOperand(MI, 3, O); | 
| 9127 | 279 |     return; | 
| 9128 | 0 |     break; | 
| 9129 | 447 |   case 3: | 
| 9130 |  |     // VLD3d16, VLD3d32, VLD3d8, VLD3q16, VLD3q32, VLD3q8 | 
| 9131 | 447 |     printAddrMode6Operand(MI, 3, O); | 
| 9132 | 447 |     return; | 
| 9133 | 0 |     break; | 
| 9134 | 230 |   case 4: | 
| 9135 |  |     // VLD3d16_UPD, VLD3d32_UPD, VLD3d8_UPD, VLD3q16_UPD, VLD3q32_UPD, VLD3q8... | 
| 9136 | 230 |     printAddrMode6Operand(MI, 4, O); | 
| 9137 | 230 |     printAddrMode6OffsetOperand(MI, 6, O); | 
| 9138 | 230 |     return; | 
| 9139 | 0 |     break; | 
| 9140 | 75 |   case 5: | 
| 9141 |  |     // VLD4LNd16, VLD4LNd32, VLD4LNd8, VLD4LNq16, VLD4LNq32 | 
| 9142 | 75 |     printNoHashImmediate(MI, 10, O); | 
| 9143 | 75 |     SStream_concat0(O, "]}, "); | 
| 9144 | 75 |     set_mem_access(MI, false); | 
| 9145 | 75 |     printAddrMode6Operand(MI, 4, O); | 
| 9146 | 75 |     return; | 
| 9147 | 0 |     break; | 
| 9148 | 41 |   case 6: | 
| 9149 |  |     // VST2LNd16, VST2LNd32, VST2LNd8, VST2LNq16, VST2LNq32 | 
| 9150 | 41 |     printNoHashImmediate(MI, 4, O); | 
| 9151 | 41 |     SStream_concat0(O, "]}, "); | 
| 9152 | 41 |     set_mem_access(MI, false); | 
| 9153 | 41 |     printAddrMode6Operand(MI, 0, O); | 
| 9154 | 41 |     return; | 
| 9155 | 0 |     break; | 
| 9156 | 85 |   case 7: | 
| 9157 |  |     // VST3LNd16, VST3LNd32, VST3LNd8, VST3LNq16, VST3LNq32 | 
| 9158 | 85 |     printNoHashImmediate(MI, 5, O); | 
| 9159 | 85 |     SStream_concat0(O, "], "); | 
| 9160 | 85 |     set_mem_access(MI, false); | 
| 9161 | 85 |     printOperand(MI, 4, O); | 
| 9162 | 85 |     SStream_concat0(O, "["); | 
| 9163 | 85 |     set_mem_access(MI, true); | 
| 9164 | 85 |     printNoHashImmediate(MI, 5, O); | 
| 9165 | 85 |     SStream_concat0(O, "]}, "); | 
| 9166 | 85 |     set_mem_access(MI, false); | 
| 9167 | 85 |     printAddrMode6Operand(MI, 0, O); | 
| 9168 | 85 |     return; | 
| 9169 | 0 |     break; | 
| 9170 | 152 |   case 8: | 
| 9171 |  |     // VST3d16, VST3d32, VST3d8, VST3q16, VST3q32, VST3q8 | 
| 9172 | 152 |     printAddrMode6Operand(MI, 0, O); | 
| 9173 | 152 |     return; | 
| 9174 | 0 |     break; | 
| 9175 | 389 |   case 9: | 
| 9176 |  |     // VST4LNd16, VST4LNd32, VST4LNd8, VST4LNq16, VST4LNq32 | 
| 9177 | 389 |     printNoHashImmediate(MI, 6, O); | 
| 9178 | 389 |     SStream_concat0(O, "], "); | 
| 9179 | 389 |     set_mem_access(MI, false); | 
| 9180 | 389 |     printOperand(MI, 4, O); | 
| 9181 | 389 |     SStream_concat0(O, "["); | 
| 9182 | 389 |     set_mem_access(MI, true); | 
| 9183 | 389 |     printNoHashImmediate(MI, 6, O); | 
| 9184 | 389 |     SStream_concat0(O, "], "); | 
| 9185 | 389 |     set_mem_access(MI, false); | 
| 9186 | 389 |     printOperand(MI, 5, O); | 
| 9187 | 389 |     SStream_concat0(O, "["); | 
| 9188 | 389 |     set_mem_access(MI, true); | 
| 9189 | 389 |     printNoHashImmediate(MI, 6, O); | 
| 9190 | 389 |     SStream_concat0(O, "]}, "); | 
| 9191 | 389 |     set_mem_access(MI, false); | 
| 9192 | 389 |     printAddrMode6Operand(MI, 0, O); | 
| 9193 | 389 |     return; | 
| 9194 | 0 |     break; | 
| 9195 | 301 |   case 10: | 
| 9196 |  |     // VST4d16, VST4d32, VST4d8, VST4q16, VST4q32, VST4q8 | 
| 9197 | 301 |     printOperand(MI, 5, O); | 
| 9198 | 301 |     SStream_concat0(O, "}, "); | 
| 9199 | 301 |     printAddrMode6Operand(MI, 0, O); | 
| 9200 | 301 |     return; | 
| 9201 | 0 |     break; | 
| 9202 | 167 |   case 11: | 
| 9203 |  |     // t2STLEXD, t2STREXD | 
| 9204 | 167 |     printAddrMode7Operand(MI, 3, O); | 
| 9205 | 167 |     return; | 
| 9206 | 0 |     break; | 
| 9207 | 6.09k |   } | 
| 9208 |  |  | 
| 9209 |  |  | 
| 9210 |  |   // Fragment 9 encoded into 1 bits for 2 unique commands. | 
| 9211 |  |   // printf("Fragment 9: %"PRIu64"\n", ((Bits >> 61) & 1)); | 
| 9212 | 3.40k |   if ((Bits >> 61) & 1) { | 
| 9213 |  |     // VLD4d16, VLD4d16_UPD, VLD4d32, VLD4d32_UPD, VLD4d8, VLD4d8_UPD, VLD4q1... | 
| 9214 | 974 |     SStream_concat0(O, "}, "); | 
| 9215 | 2.42k |   } else { | 
| 9216 |  |     // MLA, MLS, SMLABB, SMLABT, SMLAD, SMLADX, SMLALBB, SMLALBT, SMLALD, SML... | 
| 9217 | 2.42k |     return; | 
| 9218 | 2.42k |   } | 
| 9219 |  |  | 
| 9220 |  |  | 
| 9221 |  |   // Fragment 10 encoded into 1 bits for 2 unique commands. | 
| 9222 |  |   // printf("Fragment 10: %"PRIu64"\n", ((Bits >> 62) & 1)); | 
| 9223 | 974 |   if ((Bits >> 62) & 1) { | 
| 9224 |  |     // VLD4d16_UPD, VLD4d32_UPD, VLD4d8_UPD, VLD4q16_UPD, VLD4q32_UPD, VLD4q8... | 
| 9225 | 403 |     printAddrMode6Operand(MI, 5, O); | 
| 9226 | 403 |     printAddrMode6OffsetOperand(MI, 7, O); | 
| 9227 | 403 |     return; | 
| 9228 | 571 |   } else { | 
| 9229 |  |     // VLD4d16, VLD4d32, VLD4d8, VLD4q16, VLD4q32, VLD4q8 | 
| 9230 | 571 |     printAddrMode6Operand(MI, 4, O); | 
| 9231 | 571 |     return; | 
| 9232 | 571 |   } | 
| 9233 |  |  | 
| 9234 | 974 | } | 
| 9235 |  |  | 
| 9236 |  |  | 
| 9237 |  |  | 
| 9238 |  | #ifdef PRINT_ALIAS_INSTR | 
| 9239 |  | #undef PRINT_ALIAS_INSTR | 
| 9240 |  |  | 
| 9241 |  | static bool printAliasInstr(MCInst *MI, SStream *OS) | 
| 9242 | 302k | { | 
| 9243 | 302k |   unsigned int I = 0, OpIdx, PrintMethodIdx; | 
| 9244 | 302k |   char *tmpString; | 
| 9245 | 302k |   const char *AsmString; | 
| 9246 | 302k |   switch (MCInst_getOpcode(MI)) { | 
| 9247 | 300k |   default: return false; | 
| 9248 | 112 |   case ARM_DSB: | 
| 9249 | 112 |     if (MCInst_getNumOperands(MI) == 1 && | 
| 9250 | 112 |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9251 | 112 |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && | 
| 9252 | 112 |         !ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && | 
| 9253 | 112 |         ARM_getFeatureBits(MI->csh->mode, ARM_FeatureDFB)) { | 
| 9254 |  |       // (DSB 12) | 
| 9255 | 8 |       AsmString = "dfb"; | 
| 9256 | 8 |       break; | 
| 9257 | 8 |     } | 
| 9258 | 104 |     return false; | 
| 9259 | 430 |   case ARM_HINT: | 
| 9260 | 430 |     if (MCInst_getNumOperands(MI) == 3 && | 
| 9261 | 430 |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9262 | 430 |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0 && | 
| 9263 | 430 |         !ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && | 
| 9264 | 430 |         ARM_getFeatureBits(MI->csh->mode, ARM_HasV6KOps)) { | 
| 9265 |  |       // (HINT 0, pred:$p) | 
| 9266 | 116 |       AsmString = "nop$\xFF\x02\x01"; | 
| 9267 | 116 |       break; | 
| 9268 | 116 |     } | 
| 9269 | 314 |     if (MCInst_getNumOperands(MI) == 3 && | 
| 9270 | 314 |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9271 | 314 |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 1 && | 
| 9272 | 314 |         !ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && | 
| 9273 | 314 |         ARM_getFeatureBits(MI->csh->mode, ARM_HasV6KOps)) { | 
| 9274 |  |       // (HINT 1, pred:$p) | 
| 9275 | 55 |       AsmString = "yield$\xFF\x02\x01"; | 
| 9276 | 55 |       break; | 
| 9277 | 55 |     } | 
| 9278 | 259 |     if (MCInst_getNumOperands(MI) == 3 && | 
| 9279 | 259 |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9280 | 259 |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 2 && | 
| 9281 | 259 |         !ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && | 
| 9282 | 259 |         ARM_getFeatureBits(MI->csh->mode, ARM_HasV6KOps)) { | 
| 9283 |  |       // (HINT 2, pred:$p) | 
| 9284 | 10 |       AsmString = "wfe$\xFF\x02\x01"; | 
| 9285 | 10 |       break; | 
| 9286 | 10 |     } | 
| 9287 | 249 |     if (MCInst_getNumOperands(MI) == 3 && | 
| 9288 | 249 |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9289 | 249 |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 3 && | 
| 9290 | 249 |         !ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && | 
| 9291 | 249 |         ARM_getFeatureBits(MI->csh->mode, ARM_HasV6KOps)) { | 
| 9292 |  |       // (HINT 3, pred:$p) | 
| 9293 | 28 |       AsmString = "wfi$\xFF\x02\x01"; | 
| 9294 | 28 |       break; | 
| 9295 | 28 |     } | 
| 9296 | 221 |     if (MCInst_getNumOperands(MI) == 3 && | 
| 9297 | 221 |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9298 | 221 |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 4 && | 
| 9299 | 221 |         !ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && | 
| 9300 | 221 |         ARM_getFeatureBits(MI->csh->mode, ARM_HasV6KOps)) { | 
| 9301 |  |       // (HINT 4, pred:$p) | 
| 9302 | 16 |       AsmString = "sev$\xFF\x02\x01"; | 
| 9303 | 16 |       break; | 
| 9304 | 16 |     } | 
| 9305 | 205 |     if (MCInst_getNumOperands(MI) == 3 && | 
| 9306 | 205 |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9307 | 205 |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 5 && | 
| 9308 | 205 |         !ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && | 
| 9309 | 205 |         ARM_getFeatureBits(MI->csh->mode, ARM_HasV8Ops)) { | 
| 9310 |  |       // (HINT 5, pred:$p) | 
| 9311 | 31 |       AsmString = "sevl$\xFF\x02\x01"; | 
| 9312 | 31 |       break; | 
| 9313 | 31 |     } | 
| 9314 | 174 |     if (MCInst_getNumOperands(MI) == 3 && | 
| 9315 | 174 |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9316 | 174 |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 16 && | 
| 9317 | 174 |         !ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && | 
| 9318 | 174 |         ARM_getFeatureBits(MI->csh->mode, ARM_FeatureRAS)) { | 
| 9319 |  |       // (HINT 16, pred:$p) | 
| 9320 | 38 |       AsmString = "esb$\xFF\x02\x01"; | 
| 9321 | 38 |       break; | 
| 9322 | 38 |     } | 
| 9323 | 136 |     if (MCInst_getNumOperands(MI) == 3 && | 
| 9324 | 136 |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9325 | 136 |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 20 && | 
| 9326 | 136 |         !ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && | 
| 9327 | 136 |         ARM_getFeatureBits(MI->csh->mode, ARM_HasV6KOps)) { | 
| 9328 |  |       // (HINT 20, pred:$p) | 
| 9329 | 3 |       AsmString = "csdb$\xFF\x02\x01"; | 
| 9330 | 3 |       break; | 
| 9331 | 3 |     } | 
| 9332 | 133 |     return false; | 
| 9333 | 193 |   case ARM_t2DSB: | 
| 9334 | 193 |     if (MCInst_getNumOperands(MI) == 3 && | 
| 9335 | 193 |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9336 | 193 |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && | 
| 9337 | 193 |         ARM_getFeatureBits(MI->csh->mode, ARM_FeatureDFB)) { | 
| 9338 |  |       // (t2DSB 12, pred:$p) | 
| 9339 | 39 |       AsmString = "dfb$\xFF\x02\x01"; | 
| 9340 | 39 |       break; | 
| 9341 | 39 |     } | 
| 9342 | 154 |     return false; | 
| 9343 | 297 |   case ARM_t2HINT: | 
| 9344 | 297 |     if (MCInst_getNumOperands(MI) == 3 && | 
| 9345 | 297 |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9346 | 297 |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0 && | 
| 9347 | 297 |         ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && | 
| 9348 | 297 |         ARM_getFeatureBits(MI->csh->mode, ARM_FeatureThumb2)) { | 
| 9349 |  |       // (t2HINT 0, pred:$p) | 
| 9350 | 27 |       AsmString = "nop$\xFF\x02\x01.w"; | 
| 9351 | 27 |       break; | 
| 9352 | 27 |     } | 
| 9353 | 270 |     if (MCInst_getNumOperands(MI) == 3 && | 
| 9354 | 270 |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9355 | 270 |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 1 && | 
| 9356 | 270 |         ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && | 
| 9357 | 270 |         ARM_getFeatureBits(MI->csh->mode, ARM_FeatureThumb2)) { | 
| 9358 |  |       // (t2HINT 1, pred:$p) | 
| 9359 | 5 |       AsmString = "yield$\xFF\x02\x01.w"; | 
| 9360 | 5 |       break; | 
| 9361 | 5 |     } | 
| 9362 | 265 |     if (MCInst_getNumOperands(MI) == 3 && | 
| 9363 | 265 |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9364 | 265 |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 2 && | 
| 9365 | 265 |         ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && | 
| 9366 | 265 |         ARM_getFeatureBits(MI->csh->mode, ARM_FeatureThumb2)) { | 
| 9367 |  |       // (t2HINT 2, pred:$p) | 
| 9368 | 10 |       AsmString = "wfe$\xFF\x02\x01.w"; | 
| 9369 | 10 |       break; | 
| 9370 | 10 |     } | 
| 9371 | 255 |     if (MCInst_getNumOperands(MI) == 3 && | 
| 9372 | 255 |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9373 | 255 |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 3 && | 
| 9374 | 255 |         ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && | 
| 9375 | 255 |         ARM_getFeatureBits(MI->csh->mode, ARM_FeatureThumb2)) { | 
| 9376 |  |       // (t2HINT 3, pred:$p) | 
| 9377 | 22 |       AsmString = "wfi$\xFF\x02\x01.w"; | 
| 9378 | 22 |       break; | 
| 9379 | 22 |     } | 
| 9380 | 233 |     if (MCInst_getNumOperands(MI) == 3 && | 
| 9381 | 233 |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9382 | 233 |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 4 && | 
| 9383 | 233 |         ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && | 
| 9384 | 233 |         ARM_getFeatureBits(MI->csh->mode, ARM_FeatureThumb2)) { | 
| 9385 |  |       // (t2HINT 4, pred:$p) | 
| 9386 | 9 |       AsmString = "sev$\xFF\x02\x01.w"; | 
| 9387 | 9 |       break; | 
| 9388 | 9 |     } | 
| 9389 | 224 |     if (MCInst_getNumOperands(MI) == 3 && | 
| 9390 | 224 |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9391 | 224 |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 5 && | 
| 9392 | 224 |         ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && | 
| 9393 | 224 |         ARM_getFeatureBits(MI->csh->mode, ARM_FeatureThumb2) && | 
| 9394 | 224 |         ARM_getFeatureBits(MI->csh->mode, ARM_HasV8Ops)) { | 
| 9395 |  |       // (t2HINT 5, pred:$p) | 
| 9396 | 21 |       AsmString = "sevl$\xFF\x02\x01.w"; | 
| 9397 | 21 |       break; | 
| 9398 | 21 |     } | 
| 9399 | 203 |     if (MCInst_getNumOperands(MI) == 3 && | 
| 9400 | 203 |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9401 | 203 |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 16 && | 
| 9402 | 203 |         ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && | 
| 9403 | 203 |         ARM_getFeatureBits(MI->csh->mode, ARM_FeatureThumb2) && | 
| 9404 | 203 |         ARM_getFeatureBits(MI->csh->mode, ARM_FeatureRAS)) { | 
| 9405 |  |       // (t2HINT 16, pred:$p) | 
| 9406 | 8 |       AsmString = "esb$\xFF\x02\x01.w"; | 
| 9407 | 8 |       break; | 
| 9408 | 8 |     } | 
| 9409 | 195 |     if (MCInst_getNumOperands(MI) == 3 && | 
| 9410 | 195 |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9411 | 195 |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 20 && | 
| 9412 | 195 |         ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && | 
| 9413 | 195 |         ARM_getFeatureBits(MI->csh->mode, ARM_FeatureThumb2)) { | 
| 9414 |  |       // (t2HINT 20, pred:$p) | 
| 9415 | 4 |       AsmString = "csdb$\xFF\x02\x01"; | 
| 9416 | 4 |       break; | 
| 9417 | 4 |     } | 
| 9418 | 191 |     return false; | 
| 9419 | 12 |   case ARM_t2SUBS_PC_LR: | 
| 9420 | 12 |     if (MCInst_getNumOperands(MI) == 3 && | 
| 9421 | 12 |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9422 | 12 |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0 && | 
| 9423 | 12 |         ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && | 
| 9424 | 12 |         ARM_getFeatureBits(MI->csh->mode, ARM_FeatureThumb2) && | 
| 9425 | 12 |         ARM_getFeatureBits(MI->csh->mode, ARM_FeatureVirtualization)) { | 
| 9426 |  |       // (t2SUBS_PC_LR 0, pred:$p) | 
| 9427 | 11 |       AsmString = "eret$\xFF\x02\x01"; | 
| 9428 | 11 |       break; | 
| 9429 | 11 |     } | 
| 9430 | 1 |     return false; | 
| 9431 | 1.40k |   case ARM_tHINT: | 
| 9432 | 1.40k |     if (MCInst_getNumOperands(MI) == 3 && | 
| 9433 | 1.40k |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9434 | 1.40k |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0 && | 
| 9435 | 1.40k |         ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && | 
| 9436 | 1.40k |         ARM_getFeatureBits(MI->csh->mode, ARM_HasV6MOps)) { | 
| 9437 |  |       // (tHINT 0, pred:$p) | 
| 9438 | 169 |       AsmString = "nop$\xFF\x02\x01"; | 
| 9439 | 169 |       break; | 
| 9440 | 169 |     } | 
| 9441 | 1.24k |     if (MCInst_getNumOperands(MI) == 3 && | 
| 9442 | 1.24k |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9443 | 1.24k |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 1 && | 
| 9444 | 1.24k |         ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && | 
| 9445 | 1.24k |         ARM_getFeatureBits(MI->csh->mode, ARM_HasV6MOps)) { | 
| 9446 |  |       // (tHINT 1, pred:$p) | 
| 9447 | 30 |       AsmString = "yield$\xFF\x02\x01"; | 
| 9448 | 30 |       break; | 
| 9449 | 30 |     } | 
| 9450 | 1.21k |     if (MCInst_getNumOperands(MI) == 3 && | 
| 9451 | 1.21k |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9452 | 1.21k |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 2 && | 
| 9453 | 1.21k |         ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && | 
| 9454 | 1.21k |         ARM_getFeatureBits(MI->csh->mode, ARM_HasV6MOps)) { | 
| 9455 |  |       // (tHINT 2, pred:$p) | 
| 9456 | 141 |       AsmString = "wfe$\xFF\x02\x01"; | 
| 9457 | 141 |       break; | 
| 9458 | 141 |     } | 
| 9459 | 1.06k |     if (MCInst_getNumOperands(MI) == 3 && | 
| 9460 | 1.06k |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9461 | 1.06k |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 3 && | 
| 9462 | 1.06k |         ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && | 
| 9463 | 1.06k |         ARM_getFeatureBits(MI->csh->mode, ARM_HasV6MOps)) { | 
| 9464 |  |       // (tHINT 3, pred:$p) | 
| 9465 | 215 |       AsmString = "wfi$\xFF\x02\x01"; | 
| 9466 | 215 |       break; | 
| 9467 | 215 |     } | 
| 9468 | 854 |     if (MCInst_getNumOperands(MI) == 3 && | 
| 9469 | 854 |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9470 | 854 |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 4 && | 
| 9471 | 854 |         ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && | 
| 9472 | 854 |         ARM_getFeatureBits(MI->csh->mode, ARM_HasV6MOps)) { | 
| 9473 |  |       // (tHINT 4, pred:$p) | 
| 9474 | 71 |       AsmString = "sev$\xFF\x02\x01"; | 
| 9475 | 71 |       break; | 
| 9476 | 71 |     } | 
| 9477 | 783 |     if (MCInst_getNumOperands(MI) == 3 && | 
| 9478 | 783 |         MCOperand_isImm(MCInst_getOperand(MI, 0)) && | 
| 9479 | 783 |         MCOperand_getImm(MCInst_getOperand(MI, 0)) == 5 && | 
| 9480 | 783 |         ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && | 
| 9481 | 783 |         ARM_getFeatureBits(MI->csh->mode, ARM_FeatureThumb2) && | 
| 9482 | 783 |         ARM_getFeatureBits(MI->csh->mode, ARM_HasV8Ops)) { | 
| 9483 |  |       // (tHINT 5, pred:$p) | 
| 9484 | 316 |       AsmString = "sevl$\xFF\x02\x01"; | 
| 9485 | 316 |       break; | 
| 9486 | 316 |     } | 
| 9487 | 467 |     return false; | 
| 9488 | 302k |   } | 
| 9489 |  |  | 
| 9490 |  |  | 
| 9491 | 1.40k |   tmpString = cs_strdup(AsmString); | 
| 9492 |  |  | 
| 9493 | 6.17k |   while (AsmString[I] != ' ' && AsmString[I] != '\t' && | 
| 9494 | 6.17k |          AsmString[I] != '$' && AsmString[I] != '\0') | 
| 9495 | 4.77k |     ++I; | 
| 9496 |  |  | 
| 9497 | 1.40k |   tmpString[I] = 0; | 
| 9498 | 1.40k |   SStream_concat0(OS, tmpString); | 
| 9499 | 1.40k |   cs_mem_free(tmpString); | 
| 9500 |  |  | 
| 9501 | 1.40k |   if (AsmString[I] != '\0') { | 
| 9502 | 1.39k |     if (AsmString[I] == ' ' || AsmString[I] == '\t') { | 
| 9503 | 0 |       SStream_concat0(OS, " "); | 
| 9504 | 0 |       ++I; | 
| 9505 | 0 |     } | 
| 9506 |  |  | 
| 9507 | 1.59k |     do { | 
| 9508 | 1.59k |       if (AsmString[I] == '$') { | 
| 9509 | 1.39k |         ++I; | 
| 9510 | 1.39k |         if (AsmString[I] == (char)0xff) { | 
| 9511 | 1.39k |           ++I; | 
| 9512 | 1.39k |           OpIdx = AsmString[I++] - 1; | 
| 9513 | 1.39k |           PrintMethodIdx = AsmString[I++] - 1; | 
| 9514 | 1.39k |           printCustomAliasOperand(MI, OpIdx, PrintMethodIdx, OS); | 
| 9515 | 1.39k |         } else | 
| 9516 | 0 |             printOperand(MI, (unsigned)(AsmString[I++]) - 1, OS); | 
| 9517 | 1.39k |       } else { | 
| 9518 | 204 |         if (AsmString[I] == '[') { | 
| 9519 | 0 |           set_mem_access(MI, true); | 
| 9520 | 204 |         } else if (AsmString[I] == ']') { | 
| 9521 | 0 |           set_mem_access(MI, false); | 
| 9522 | 0 |         } | 
| 9523 | 204 |         SStream_concat1(OS, AsmString[I++]); | 
| 9524 | 204 |       } | 
| 9525 | 1.59k |     } while (AsmString[I] != '\0'); | 
| 9526 | 1.39k |   } | 
| 9527 |  |  | 
| 9528 | 1.40k |   return true; | 
| 9529 | 302k | } | 
| 9530 |  |          | 
| 9531 |  | static void printCustomAliasOperand( | 
| 9532 |  |          MCInst *MI, unsigned OpIdx, | 
| 9533 |  |          unsigned PrintMethodIdx, | 
| 9534 |  |          SStream *OS) | 
| 9535 | 1.39k | { | 
| 9536 | 1.39k |   switch (PrintMethodIdx) { | 
| 9537 | 0 |   default: | 
| 9538 | 0 |     break; | 
| 9539 | 1.39k |   case 0: | 
| 9540 | 1.39k |     printPredicateOperand(MI, OpIdx, OS); | 
| 9541 | 1.39k |     break; | 
| 9542 | 1.39k |   } | 
| 9543 | 1.39k | } | 
| 9544 |  |  | 
| 9545 |  | #endif // PRINT_ALIAS_INSTR |