/src/capstonev5/arch/ARM/ARMGenAsmWriter.inc
Line | Count | Source (jump to first uncovered line) |
1 | | /* Capstone Disassembly Engine, http://www.capstone-engine.org */ |
2 | | /* By Nguyen Anh Quynh <aquynh@gmail.com>, 2013-2019 */ |
3 | | |
4 | | /*===- TableGen'erated file -------------------------------------*- C++ -*-===*\ |
5 | | |* *| |
6 | | |* Assembly Writer Source Fragment *| |
7 | | |* *| |
8 | | |* Automatically generated file, do not edit! *| |
9 | | |* *| |
10 | | \*===----------------------------------------------------------------------===*/ |
11 | | |
12 | | /// printInstruction - This method is automatically generated by tablegen |
13 | | /// from the instruction set description. |
14 | | static void printInstruction(MCInst *MI, SStream *O) |
15 | 608k | { |
16 | 608k | #ifndef CAPSTONE_DIET |
17 | 608k | static const char AsmStrs[] = { |
18 | 608k | /* 0 */ 's', 'h', 'a', '1', 's', 'u', '0', '.', '3', '2', 9, 0, |
19 | 608k | /* 12 */ 's', 'h', 'a', '2', '5', '6', 's', 'u', '0', '.', '3', '2', 9, 0, |
20 | 608k | /* 26 */ 's', 'h', 'a', '1', 's', 'u', '1', '.', '3', '2', 9, 0, |
21 | 608k | /* 38 */ 's', 'h', 'a', '2', '5', '6', 's', 'u', '1', '.', '3', '2', 9, 0, |
22 | 608k | /* 52 */ 's', 'h', 'a', '2', '5', '6', 'h', '2', '.', '3', '2', 9, 0, |
23 | 608k | /* 65 */ 's', 'h', 'a', '1', 'c', '.', '3', '2', 9, 0, |
24 | 608k | /* 75 */ 's', 'h', 'a', '1', 'h', '.', '3', '2', 9, 0, |
25 | 608k | /* 85 */ 's', 'h', 'a', '2', '5', '6', 'h', '.', '3', '2', 9, 0, |
26 | 608k | /* 97 */ 's', 'h', 'a', '1', 'm', '.', '3', '2', 9, 0, |
27 | 608k | /* 107 */ 's', 'h', 'a', '1', 'p', '.', '3', '2', 9, 0, |
28 | 608k | /* 117 */ 'v', 'c', 'v', 't', 'a', '.', 's', '3', '2', '.', 'f', '3', '2', 9, 0, |
29 | 608k | /* 132 */ 'v', 'c', 'v', 't', 'm', '.', 's', '3', '2', '.', 'f', '3', '2', 9, 0, |
30 | 608k | /* 147 */ 'v', 'c', 'v', 't', 'n', '.', 's', '3', '2', '.', 'f', '3', '2', 9, 0, |
31 | 608k | /* 162 */ 'v', 'c', 'v', 't', 'p', '.', 's', '3', '2', '.', 'f', '3', '2', 9, 0, |
32 | 608k | /* 177 */ 'v', 'c', 'v', 't', 'a', '.', 'u', '3', '2', '.', 'f', '3', '2', 9, 0, |
33 | 608k | /* 192 */ 'v', 'c', 'v', 't', 'm', '.', 'u', '3', '2', '.', 'f', '3', '2', 9, 0, |
34 | 608k | /* 207 */ 'v', 'c', 'v', 't', 'n', '.', 'u', '3', '2', '.', 'f', '3', '2', 9, 0, |
35 | 608k | /* 222 */ 'v', 'c', 'v', 't', 'p', '.', 'u', '3', '2', '.', 'f', '3', '2', 9, 0, |
36 | 608k | /* 237 */ 'v', 'c', 'm', 'l', 'a', '.', 'f', '3', '2', 9, 0, |
37 | 608k | /* 248 */ 'v', 'r', 'i', 'n', 't', 'a', '.', 'f', '3', '2', 9, 0, |
38 | 608k | /* 260 */ 'v', 'c', 'a', 'd', 'd', '.', 'f', '3', '2', 9, 0, |
39 | 608k | /* 271 */ 'v', 's', 'e', 'l', 'g', 'e', '.', 'f', '3', '2', 9, 0, |
40 | 608k | /* 283 */ 'v', 'm', 'i', 'n', 'n', 'm', '.', 'f', '3', '2', 9, 0, |
41 | 608k | /* 295 */ 'v', 'm', 'a', 'x', 'n', 'm', '.', 'f', '3', '2', 9, 0, |
42 | 608k | /* 307 */ 'v', 'r', 'i', 'n', 't', 'm', '.', 'f', '3', '2', 9, 0, |
43 | 608k | /* 319 */ 'v', 'r', 'i', 'n', 't', 'n', '.', 'f', '3', '2', 9, 0, |
44 | 608k | /* 331 */ 'v', 'r', 'i', 'n', 't', 'p', '.', 'f', '3', '2', 9, 0, |
45 | 608k | /* 343 */ 'v', 's', 'e', 'l', 'e', 'q', '.', 'f', '3', '2', 9, 0, |
46 | 608k | /* 355 */ 'v', 's', 'e', 'l', 'v', 's', '.', 'f', '3', '2', 9, 0, |
47 | 608k | /* 367 */ 'v', 's', 'e', 'l', 'g', 't', '.', 'f', '3', '2', 9, 0, |
48 | 608k | /* 379 */ 'v', 'r', 'i', 'n', 't', 'x', '.', 'f', '3', '2', 9, 0, |
49 | 608k | /* 391 */ 'v', 'r', 'i', 'n', 't', 'z', '.', 'f', '3', '2', 9, 0, |
50 | 608k | /* 403 */ 'l', 'd', 'c', '2', 9, 0, |
51 | 608k | /* 409 */ 'm', 'r', 'c', '2', 9, 0, |
52 | 608k | /* 415 */ 'm', 'r', 'r', 'c', '2', 9, 0, |
53 | 608k | /* 422 */ 's', 't', 'c', '2', 9, 0, |
54 | 608k | /* 428 */ 'c', 'd', 'p', '2', 9, 0, |
55 | 608k | /* 434 */ 'm', 'c', 'r', '2', 9, 0, |
56 | 608k | /* 440 */ 'm', 'c', 'r', 'r', '2', 9, 0, |
57 | 608k | /* 447 */ 'v', 'c', 'v', 't', 'a', '.', 's', '3', '2', '.', 'f', '6', '4', 9, 0, |
58 | 608k | /* 462 */ 'v', 'c', 'v', 't', 'm', '.', 's', '3', '2', '.', 'f', '6', '4', 9, 0, |
59 | 608k | /* 477 */ 'v', 'c', 'v', 't', 'n', '.', 's', '3', '2', '.', 'f', '6', '4', 9, 0, |
60 | 608k | /* 492 */ 'v', 'c', 'v', 't', 'p', '.', 's', '3', '2', '.', 'f', '6', '4', 9, 0, |
61 | 608k | /* 507 */ 'v', 'c', 'v', 't', 'a', '.', 'u', '3', '2', '.', 'f', '6', '4', 9, 0, |
62 | 608k | /* 522 */ 'v', 'c', 'v', 't', 'm', '.', 'u', '3', '2', '.', 'f', '6', '4', 9, 0, |
63 | 608k | /* 537 */ 'v', 'c', 'v', 't', 'n', '.', 'u', '3', '2', '.', 'f', '6', '4', 9, 0, |
64 | 608k | /* 552 */ 'v', 'c', 'v', 't', 'p', '.', 'u', '3', '2', '.', 'f', '6', '4', 9, 0, |
65 | 608k | /* 567 */ 'v', 'r', 'i', 'n', 't', 'a', '.', 'f', '6', '4', 9, 0, |
66 | 608k | /* 579 */ 'v', 's', 'e', 'l', 'g', 'e', '.', 'f', '6', '4', 9, 0, |
67 | 608k | /* 591 */ 'v', 'm', 'i', 'n', 'n', 'm', '.', 'f', '6', '4', 9, 0, |
68 | 608k | /* 603 */ 'v', 'm', 'a', 'x', 'n', 'm', '.', 'f', '6', '4', 9, 0, |
69 | 608k | /* 615 */ 'v', 'r', 'i', 'n', 't', 'm', '.', 'f', '6', '4', 9, 0, |
70 | 608k | /* 627 */ 'v', 'r', 'i', 'n', 't', 'n', '.', 'f', '6', '4', 9, 0, |
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75 | 608k | /* 687 */ 'v', 'm', 'u', 'l', 'l', '.', 'p', '6', '4', 9, 0, |
76 | 608k | /* 698 */ 'v', 'c', 'v', 't', 'a', '.', 's', '3', '2', '.', 'f', '1', '6', 9, 0, |
77 | 608k | /* 713 */ 'v', 'c', 'v', 't', 'm', '.', 's', '3', '2', '.', 'f', '1', '6', 9, 0, |
78 | 608k | /* 728 */ 'v', 'c', 'v', 't', 'n', '.', 's', '3', '2', '.', 'f', '1', '6', 9, 0, |
79 | 608k | /* 743 */ 'v', 'c', 'v', 't', 'p', '.', 's', '3', '2', '.', 'f', '1', '6', 9, 0, |
80 | 608k | /* 758 */ 'v', 'c', 'v', 't', 'a', '.', 'u', '3', '2', '.', 'f', '1', '6', 9, 0, |
81 | 608k | /* 773 */ 'v', 'c', 'v', 't', 'm', '.', 'u', '3', '2', '.', 'f', '1', '6', 9, 0, |
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83 | 608k | /* 803 */ 'v', 'c', 'v', 't', 'p', '.', 'u', '3', '2', '.', 'f', '1', '6', 9, 0, |
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100 | 608k | /* 1032 */ 'v', 'r', 'i', 'n', 't', 'p', '.', 'f', '1', '6', 9, 0, |
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103 | 608k | /* 1066 */ 'v', 's', 'e', 'l', 'v', 's', '.', 'f', '1', '6', 9, 0, |
104 | 608k | /* 1078 */ 'v', 's', 'e', 'l', 'g', 't', '.', 'f', '1', '6', 9, 0, |
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110 | 608k | /* 1144 */ 'a', 'e', 's', 'd', '.', '8', 9, 0, |
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129 | 608k | /* 1276 */ 'c', 'r', 'c', '3', '2', 'c', 'h', 9, 0, |
130 | 608k | /* 1285 */ 'p', 'l', 'i', 9, 0, |
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134 | 608k | /* 1308 */ 's', 'e', 't', 'p', 'a', 'n', 9, 0, |
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136 | 608k | /* 1321 */ 'm', 'o', 'v', 's', 9, 0, |
137 | 608k | /* 1327 */ 'h', 'l', 't', 9, 0, |
138 | 608k | /* 1332 */ 'b', 'k', 'p', 't', 9, 0, |
139 | 608k | /* 1338 */ 'h', 'v', 'c', '.', 'w', 9, 0, |
140 | 608k | /* 1345 */ 'u', 'd', 'f', '.', 'w', 9, 0, |
141 | 608k | /* 1352 */ 'c', 'r', 'c', '3', '2', 'w', 9, 0, |
142 | 608k | /* 1360 */ 'c', 'r', 'c', '3', '2', 'c', 'w', 9, 0, |
143 | 608k | /* 1369 */ 'p', 'l', 'd', 'w', 9, 0, |
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145 | 608k | /* 1379 */ 'b', 'l', 'x', 9, 0, |
146 | 608k | /* 1384 */ 'c', 'b', 'z', 9, 0, |
147 | 608k | /* 1389 */ 'c', 'b', 'n', 'z', 9, 0, |
148 | 608k | /* 1395 */ 's', 'r', 's', 'd', 'a', 9, 's', 'p', '!', ',', 32, 0, |
149 | 608k | /* 1407 */ 's', 'r', 's', 'i', 'a', 9, 's', 'p', '!', ',', 32, 0, |
150 | 608k | /* 1419 */ 's', 'r', 's', 'd', 'b', 9, 's', 'p', '!', ',', 32, 0, |
151 | 608k | /* 1431 */ 's', 'r', 's', 'i', 'b', 9, 's', 'p', '!', ',', 32, 0, |
152 | 608k | /* 1443 */ 's', 'r', 's', 'd', 'a', 9, 's', 'p', ',', 32, 0, |
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155 | 608k | /* 1476 */ 's', 'r', 's', 'i', 'b', 9, 's', 'p', ',', 32, 0, |
156 | 608k | /* 1487 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'F', 'u', 'n', 'c', 't', 'i', 'o', 'n', 32, 'P', 'a', 't', 'c', 'h', 'a', 'b', 'l', 'e', 32, 'R', 'E', 'T', '.', 0, |
157 | 608k | /* 1518 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'T', 'y', 'p', 'e', 'd', 32, 'E', 'v', 'e', 'n', 't', 32, 'L', 'o', 'g', '.', 0, |
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159 | 608k | /* 1567 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'F', 'u', 'n', 'c', 't', 'i', 'o', 'n', 32, 'E', 'n', 't', 'e', 'r', '.', 0, |
160 | 608k | /* 1590 */ '#', 32, 'X', 'R', 'a', 'y', 32, 'T', 'a', 'i', 'l', 32, 'C', 'a', 'l', 'l', 32, 'E', 'x', 'i', 't', '.', 0, |
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162 | 608k | /* 1635 */ '_', '_', 'b', 'r', 'k', 'd', 'i', 'v', '0', 0, |
163 | 608k | /* 1645 */ 'v', 'l', 'd', '1', 0, |
164 | 608k | /* 1650 */ 'd', 'c', 'p', 's', '1', 0, |
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376 | 608k | /* 2953 */ 'v', 'l', 'l', 'd', 'm', 0, |
377 | 608k | /* 2959 */ 'v', 'l', 's', 't', 'm', 0, |
378 | 608k | /* 2965 */ 'v', 'r', 's', 'u', 'b', 'h', 'n', 0, |
379 | 608k | /* 2973 */ 'v', 's', 'u', 'b', 'h', 'n', 0, |
380 | 608k | /* 2980 */ 'v', 'r', 'a', 'd', 'd', 'h', 'n', 0, |
381 | 608k | /* 2988 */ 'v', 'a', 'd', 'd', 'h', 'n', 0, |
382 | 608k | /* 2995 */ 'v', 'p', 'm', 'i', 'n', 0, |
383 | 608k | /* 3001 */ 'v', 'm', 'i', 'n', 0, |
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386 | 608k | /* 3017 */ 'v', 'q', 'r', 's', 'h', 'r', 'n', 0, |
387 | 608k | /* 3025 */ 'v', 'r', 's', 'h', 'r', 'n', 0, |
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390 | 608k | /* 3043 */ 'v', 't', 'r', 'n', 0, |
391 | 608k | /* 3048 */ 'v', 'q', 's', 'h', 'r', 'u', 'n', 0, |
392 | 608k | /* 3056 */ 'v', 'q', 'r', 's', 'h', 'r', 'u', 'n', 0, |
393 | 608k | /* 3065 */ 'v', 'q', 'm', 'o', 'v', 'u', 'n', 0, |
394 | 608k | /* 3073 */ 'v', 'm', 'v', 'n', 0, |
395 | 608k | /* 3078 */ 'v', 'q', 'm', 'o', 'v', 'n', 0, |
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453 | 608k | /* 3397 */ 'v', 'c', 'g', 't', 0, |
454 | 608k | /* 3402 */ 'l', 'd', 'r', 'h', 't', 0, |
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488 | 608k | /* 3595 */ 'f', 's', 't', 'm', 'i', 'a', 'x', 0, |
489 | 608k | /* 3603 */ 'v', 'p', 'm', 'a', 'x', 0, |
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500 | 608k | /* 3670 */ 's', 'm', 'u', 'a', 'd', 'x', 0, |
501 | 608k | /* 3677 */ 's', 'm', 'l', 'a', 'l', 'd', 'x', 0, |
502 | 608k | /* 3685 */ 's', 'm', 'l', 's', 'l', 'd', 'x', 0, |
503 | 608k | /* 3693 */ 's', 'm', 'l', 's', 'd', 'x', 0, |
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518 | 608k | /* 3778 */ 'u', 'a', 's', 'x', 0, |
519 | 608k | /* 3783 */ 'v', 'r', 'i', 'n', 't', 'x', 0, |
520 | 608k | /* 3790 */ 'v', 'c', 'l', 'z', 0, |
521 | 608k | /* 3795 */ 'v', 'r', 'i', 'n', 't', 'z', 0, |
522 | 608k | }; |
523 | 608k | #endif |
524 | | |
525 | 608k | static const uint32_t OpInfo0[] = { |
526 | 608k | 0U, // PHI |
527 | 608k | 0U, // INLINEASM |
528 | 608k | 0U, // CFI_INSTRUCTION |
529 | 608k | 0U, // EH_LABEL |
530 | 608k | 0U, // GC_LABEL |
531 | 608k | 0U, // ANNOTATION_LABEL |
532 | 608k | 0U, // KILL |
533 | 608k | 0U, // EXTRACT_SUBREG |
534 | 608k | 0U, // INSERT_SUBREG |
535 | 608k | 0U, // IMPLICIT_DEF |
536 | 608k | 0U, // SUBREG_TO_REG |
537 | 608k | 0U, // COPY_TO_REGCLASS |
538 | 608k | 1981U, // DBG_VALUE |
539 | 608k | 1991U, // DBG_LABEL |
540 | 608k | 0U, // REG_SEQUENCE |
541 | 608k | 0U, // COPY |
542 | 608k | 1974U, // BUNDLE |
543 | 608k | 2020U, // LIFETIME_START |
544 | 608k | 1961U, // LIFETIME_END |
545 | 608k | 0U, // STACKMAP |
546 | 608k | 2862U, // FENTRY_CALL |
547 | 608k | 0U, // PATCHPOINT |
548 | 608k | 0U, // LOAD_STACK_GUARD |
549 | 608k | 0U, // STATEPOINT |
550 | 608k | 0U, // LOCAL_ESCAPE |
551 | 608k | 0U, // FAULTING_OP |
552 | 608k | 0U, // PATCHABLE_OP |
553 | 608k | 1568U, // PATCHABLE_FUNCTION_ENTER |
554 | 608k | 1488U, // PATCHABLE_RET |
555 | 608k | 1614U, // PATCHABLE_FUNCTION_EXIT |
556 | 608k | 1591U, // PATCHABLE_TAIL_CALL |
557 | 608k | 1543U, // PATCHABLE_EVENT_CALL |
558 | 608k | 1519U, // PATCHABLE_TYPED_EVENT_CALL |
559 | 608k | 0U, // ICALL_BRANCH_FUNNEL |
560 | 608k | 0U, // G_ADD |
561 | 608k | 0U, // G_SUB |
562 | 608k | 0U, // G_MUL |
563 | 608k | 0U, // G_SDIV |
564 | 608k | 0U, // G_UDIV |
565 | 608k | 0U, // G_SREM |
566 | 608k | 0U, // G_UREM |
567 | 608k | 0U, // G_AND |
568 | 608k | 0U, // G_OR |
569 | 608k | 0U, // G_XOR |
570 | 608k | 0U, // G_IMPLICIT_DEF |
571 | 608k | 0U, // G_PHI |
572 | 608k | 0U, // G_FRAME_INDEX |
573 | 608k | 0U, // G_GLOBAL_VALUE |
574 | 608k | 0U, // G_EXTRACT |
575 | 608k | 0U, // G_UNMERGE_VALUES |
576 | 608k | 0U, // G_INSERT |
577 | 608k | 0U, // G_MERGE_VALUES |
578 | 608k | 0U, // G_PTRTOINT |
579 | 608k | 0U, // G_INTTOPTR |
580 | 608k | 0U, // G_BITCAST |
581 | 608k | 0U, // G_LOAD |
582 | 608k | 0U, // G_SEXTLOAD |
583 | 608k | 0U, // G_ZEXTLOAD |
584 | 608k | 0U, // G_STORE |
585 | 608k | 0U, // G_ATOMIC_CMPXCHG_WITH_SUCCESS |
586 | 608k | 0U, // G_ATOMIC_CMPXCHG |
587 | 608k | 0U, // G_ATOMICRMW_XCHG |
588 | 608k | 0U, // G_ATOMICRMW_ADD |
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590 | 608k | 0U, // G_ATOMICRMW_AND |
591 | 608k | 0U, // G_ATOMICRMW_NAND |
592 | 608k | 0U, // G_ATOMICRMW_OR |
593 | 608k | 0U, // G_ATOMICRMW_XOR |
594 | 608k | 0U, // G_ATOMICRMW_MAX |
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597 | 608k | 0U, // G_ATOMICRMW_UMIN |
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599 | 608k | 0U, // G_BRINDIRECT |
600 | 608k | 0U, // G_INTRINSIC |
601 | 608k | 0U, // G_INTRINSIC_W_SIDE_EFFECTS |
602 | 608k | 0U, // G_ANYEXT |
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604 | 608k | 0U, // G_CONSTANT |
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607 | 608k | 0U, // G_VAARG |
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626 | 608k | 0U, // G_FMUL |
627 | 608k | 0U, // G_FMA |
628 | 608k | 0U, // G_FDIV |
629 | 608k | 0U, // G_FREM |
630 | 608k | 0U, // G_FPOW |
631 | 608k | 0U, // G_FEXP |
632 | 608k | 0U, // G_FEXP2 |
633 | 608k | 0U, // G_FLOG |
634 | 608k | 0U, // G_FLOG2 |
635 | 608k | 0U, // G_FNEG |
636 | 608k | 0U, // G_FPEXT |
637 | 608k | 0U, // G_FPTRUNC |
638 | 608k | 0U, // G_FPTOSI |
639 | 608k | 0U, // G_FPTOUI |
640 | 608k | 0U, // G_SITOFP |
641 | 608k | 0U, // G_UITOFP |
642 | 608k | 0U, // G_FABS |
643 | 608k | 0U, // G_GEP |
644 | 608k | 0U, // G_PTR_MASK |
645 | 608k | 0U, // G_BR |
646 | 608k | 0U, // G_INSERT_VECTOR_ELT |
647 | 608k | 0U, // G_EXTRACT_VECTOR_ELT |
648 | 608k | 0U, // G_SHUFFLE_VECTOR |
649 | 608k | 0U, // G_BSWAP |
650 | 608k | 0U, // G_ADDRSPACE_CAST |
651 | 608k | 0U, // G_BLOCK_ADDR |
652 | 608k | 0U, // ABS |
653 | 608k | 0U, // ADDSri |
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657 | 608k | 0U, // ADJCALLSTACKDOWN |
658 | 608k | 0U, // ADJCALLSTACKUP |
659 | 608k | 7292U, // ASRi |
660 | 608k | 7292U, // ASRr |
661 | 608k | 0U, // B |
662 | 608k | 0U, // BCCZi64 |
663 | 608k | 0U, // BCCi64 |
664 | 608k | 0U, // BMOVPCB_CALL |
665 | 608k | 0U, // BMOVPCRX_CALL |
666 | 608k | 0U, // BR_JTadd |
667 | 608k | 0U, // BR_JTm_i12 |
668 | 608k | 0U, // BR_JTm_rs |
669 | 608k | 0U, // BR_JTr |
670 | 608k | 0U, // BX_CALL |
671 | 608k | 0U, // CMP_SWAP_16 |
672 | 608k | 0U, // CMP_SWAP_32 |
673 | 608k | 0U, // CMP_SWAP_64 |
674 | 608k | 0U, // CMP_SWAP_8 |
675 | 608k | 0U, // CONSTPOOL_ENTRY |
676 | 608k | 0U, // COPY_STRUCT_BYVAL_I32 |
677 | 608k | 2001U, // CompilerBarrier |
678 | 608k | 16788832U, // ITasm |
679 | 608k | 0U, // Int_eh_sjlj_dispatchsetup |
680 | 608k | 0U, // Int_eh_sjlj_longjmp |
681 | 608k | 0U, // Int_eh_sjlj_setjmp |
682 | 608k | 0U, // Int_eh_sjlj_setjmp_nofp |
683 | 608k | 0U, // Int_eh_sjlj_setup_dispatch |
684 | 608k | 0U, // JUMPTABLE_ADDRS |
685 | 608k | 0U, // JUMPTABLE_INSTS |
686 | 608k | 0U, // JUMPTABLE_TBB |
687 | 608k | 0U, // JUMPTABLE_TBH |
688 | 608k | 0U, // LDMIA_RET |
689 | 608k | 15656U, // LDRBT_POST |
690 | 608k | 15443U, // LDRConstPool |
691 | 608k | 0U, // LDRLIT_ga_abs |
692 | 608k | 0U, // LDRLIT_ga_pcrel |
693 | 608k | 0U, // LDRLIT_ga_pcrel_ldr |
694 | 608k | 15735U, // LDRT_POST |
695 | 608k | 0U, // LEApcrel |
696 | 608k | 0U, // LEApcrelJT |
697 | 608k | 7013U, // LSLi |
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699 | 608k | 7299U, // LSRi |
700 | 608k | 7299U, // LSRr |
701 | 608k | 0U, // MEMCPY |
702 | 608k | 0U, // MLAv5 |
703 | 608k | 0U, // MOVCCi |
704 | 608k | 0U, // MOVCCi16 |
705 | 608k | 0U, // MOVCCi32imm |
706 | 608k | 0U, // MOVCCr |
707 | 608k | 0U, // MOVCCsi |
708 | 608k | 0U, // MOVCCsr |
709 | 608k | 0U, // MOVPCRX |
710 | 608k | 0U, // MOVTi16_ga_pcrel |
711 | 608k | 0U, // MOV_ga_pcrel |
712 | 608k | 0U, // MOV_ga_pcrel_ldr |
713 | 608k | 0U, // MOVi16_ga_pcrel |
714 | 608k | 0U, // MOVi32imm |
715 | 608k | 0U, // MOVsra_flag |
716 | 608k | 0U, // MOVsrl_flag |
717 | 608k | 0U, // MULv5 |
718 | 608k | 0U, // MVNCCi |
719 | 608k | 0U, // PICADD |
720 | 608k | 0U, // PICLDR |
721 | 608k | 0U, // PICLDRB |
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723 | 608k | 0U, // PICLDRSB |
724 | 608k | 0U, // PICLDRSH |
725 | 608k | 0U, // PICSTR |
726 | 608k | 0U, // PICSTRB |
727 | 608k | 0U, // PICSTRH |
728 | 608k | 7278U, // RORi |
729 | 608k | 7278U, // RORr |
730 | 608k | 0U, // RRX |
731 | 608k | 20136U, // RRXi |
732 | 608k | 0U, // RSBSri |
733 | 608k | 0U, // RSBSrsi |
734 | 608k | 0U, // RSBSrsr |
735 | 608k | 0U, // SMLALv5 |
736 | 608k | 0U, // SMULLv5 |
737 | 608k | 0U, // SPACE |
738 | 608k | 15662U, // STRBT_POST |
739 | 608k | 0U, // STRBi_preidx |
740 | 608k | 0U, // STRBr_preidx |
741 | 608k | 0U, // STRH_preidx |
742 | 608k | 15746U, // STRT_POST |
743 | 608k | 0U, // STRi_preidx |
744 | 608k | 0U, // STRr_preidx |
745 | 608k | 0U, // SUBS_PC_LR |
746 | 608k | 0U, // SUBSri |
747 | 608k | 0U, // SUBSrr |
748 | 608k | 0U, // SUBSrsi |
749 | 608k | 0U, // SUBSrsr |
750 | 608k | 0U, // TAILJMPd |
751 | 608k | 0U, // TAILJMPr |
752 | 608k | 0U, // TAILJMPr4 |
753 | 608k | 0U, // TCRETURNdi |
754 | 608k | 0U, // TCRETURNri |
755 | 608k | 0U, // TPsoft |
756 | 608k | 0U, // UMLALv5 |
757 | 608k | 0U, // UMULLv5 |
758 | 608k | 153198U, // VLD1LNdAsm_16 |
759 | 608k | 284270U, // VLD1LNdAsm_32 |
760 | 608k | 415342U, // VLD1LNdAsm_8 |
761 | 608k | 153198U, // VLD1LNdWB_fixed_Asm_16 |
762 | 608k | 284270U, // VLD1LNdWB_fixed_Asm_32 |
763 | 608k | 415342U, // VLD1LNdWB_fixed_Asm_8 |
764 | 608k | 157294U, // VLD1LNdWB_register_Asm_16 |
765 | 608k | 288366U, // VLD1LNdWB_register_Asm_32 |
766 | 608k | 419438U, // VLD1LNdWB_register_Asm_8 |
767 | 608k | 153242U, // VLD2LNdAsm_16 |
768 | 608k | 284314U, // VLD2LNdAsm_32 |
769 | 608k | 415386U, // VLD2LNdAsm_8 |
770 | 608k | 153242U, // VLD2LNdWB_fixed_Asm_16 |
771 | 608k | 284314U, // VLD2LNdWB_fixed_Asm_32 |
772 | 608k | 415386U, // VLD2LNdWB_fixed_Asm_8 |
773 | 608k | 157338U, // VLD2LNdWB_register_Asm_16 |
774 | 608k | 288410U, // VLD2LNdWB_register_Asm_32 |
775 | 608k | 419482U, // VLD2LNdWB_register_Asm_8 |
776 | 608k | 153242U, // VLD2LNqAsm_16 |
777 | 608k | 284314U, // VLD2LNqAsm_32 |
778 | 608k | 153242U, // VLD2LNqWB_fixed_Asm_16 |
779 | 608k | 284314U, // VLD2LNqWB_fixed_Asm_32 |
780 | 608k | 157338U, // VLD2LNqWB_register_Asm_16 |
781 | 608k | 288410U, // VLD2LNqWB_register_Asm_32 |
782 | 608k | 1107457722U, // VLD3DUPdAsm_16 |
783 | 608k | 1107588794U, // VLD3DUPdAsm_32 |
784 | 608k | 1107719866U, // VLD3DUPdAsm_8 |
785 | 608k | 2181199546U, // VLD3DUPdWB_fixed_Asm_16 |
786 | 608k | 2181330618U, // VLD3DUPdWB_fixed_Asm_32 |
787 | 608k | 2181461690U, // VLD3DUPdWB_fixed_Asm_8 |
788 | 608k | 33707706U, // VLD3DUPdWB_register_Asm_16 |
789 | 608k | 33838778U, // VLD3DUPdWB_register_Asm_32 |
790 | 608k | 33969850U, // VLD3DUPdWB_register_Asm_8 |
791 | 608k | 1124234938U, // VLD3DUPqAsm_16 |
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793 | 608k | 1124497082U, // VLD3DUPqAsm_8 |
794 | 608k | 2197976762U, // VLD3DUPqWB_fixed_Asm_16 |
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796 | 608k | 2198238906U, // VLD3DUPqWB_fixed_Asm_8 |
797 | 608k | 50484922U, // VLD3DUPqWB_register_Asm_16 |
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799 | 608k | 50747066U, // VLD3DUPqWB_register_Asm_8 |
800 | 608k | 153274U, // VLD3LNdAsm_16 |
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809 | 608k | 153274U, // VLD3LNqAsm_16 |
810 | 608k | 284346U, // VLD3LNqAsm_32 |
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820 | 608k | 3288757946U, // VLD3dWB_fixed_Asm_8 |
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1016 | 608k | 0U, // t2STR_preidx |
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1039 | 608k | 0U, // tLDR_postidx |
1040 | 608k | 0U, // tLDRpci_pic |
1041 | 608k | 0U, // tLEApcrel |
1042 | 608k | 0U, // tLEApcrelJT |
1043 | 608k | 0U, // tMOVCCr_pseudo |
1044 | 608k | 0U, // tPOP_RET |
1045 | 608k | 0U, // tSBCS |
1046 | 608k | 0U, // tSUBSi3 |
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1048 | 608k | 0U, // tSUBSrr |
1049 | 608k | 0U, // tTAILJMPd |
1050 | 608k | 0U, // tTAILJMPdND |
1051 | 608k | 0U, // tTAILJMPr |
1052 | 608k | 0U, // tTBB_JT |
1053 | 608k | 0U, // tTBH_JT |
1054 | 608k | 0U, // tTPsoft |
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1056 | 608k | 530745U, // ADCrr |
1057 | 608k | 559417U, // ADCrsi |
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1059 | 608k | 530806U, // ADDri |
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1062 | 608k | 39286U, // ADDrsr |
1063 | 608k | 539726U, // ADR |
1064 | 608k | 1242211449U, // AESD |
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1066 | 608k | 1258988646U, // AESIMC |
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1068 | 608k | 530859U, // ANDri |
1069 | 608k | 530859U, // ANDrr |
1070 | 608k | 559531U, // ANDrsi |
1071 | 608k | 39339U, // ANDrsr |
1072 | 608k | 555329U, // BFC |
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1074 | 608k | 530758U, // BICri |
1075 | 608k | 530758U, // BICrr |
1076 | 608k | 559430U, // BICrsi |
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1078 | 608k | 828725U, // BKPT |
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1084 | 608k | 828768U, // BX |
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1088 | 608k | 1074313296U, // Bcc |
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1100 | 608k | 547875U, // CMPrsr |
1101 | 608k | 828709U, // CPS1p |
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1110 | 608k | 1074313739U, // DBG |
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1161 | 608k | 571538U, // LDMIB |
1162 | 608k | 2332571794U, // LDMIB_UPD |
1163 | 608k | 552232U, // LDRBT_POST_IMM |
1164 | 608k | 552232U, // LDRBT_POST_REG |
1165 | 608k | 551084U, // LDRB_POST_IMM |
1166 | 608k | 551084U, // LDRB_POST_REG |
1167 | 608k | 546988U, // LDRB_PRE_IMM |
1168 | 608k | 551084U, // LDRB_PRE_REG |
1169 | 608k | 555180U, // LDRBi12 |
1170 | 608k | 546988U, // LDRBrs |
1171 | 608k | 551343U, // LDRD |
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1173 | 608k | 580015U, // LDRD_PRE |
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1187 | 608k | 551102U, // LDRSB_PRE |
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1189 | 608k | 548183U, // LDRSHTi |
1190 | 608k | 552279U, // LDRSHTr |
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1192 | 608k | 551524U, // LDRSH_PRE |
1193 | 608k | 552311U, // LDRT_POST_IMM |
1194 | 608k | 552311U, // LDRT_POST_REG |
1195 | 608k | 552019U, // LDR_POST_IMM |
1196 | 608k | 552019U, // LDR_POST_REG |
1197 | 608k | 547923U, // LDR_PRE_IMM |
1198 | 608k | 552019U, // LDR_PRE_REG |
1199 | 608k | 556115U, // LDRcp |
1200 | 608k | 556115U, // LDRi12 |
1201 | 608k | 547923U, // LDRrs |
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1203 | 608k | 168878515U, // MCR2 |
1204 | 608k | 201878642U, // MCRR |
1205 | 608k | 168878521U, // MCRR2 |
1206 | 608k | 559140U, // MLA |
1207 | 608k | 548021U, // MLS |
1208 | 608k | 1887722U, // MOVPCLR |
1209 | 608k | 556471U, // MOVTi16 |
1210 | 608k | 544234U, // MOVi |
1211 | 608k | 540159U, // MOVi16 |
1212 | 608k | 544234U, // MOVr |
1213 | 608k | 544234U, // MOVr_TC |
1214 | 608k | 531946U, // MOVsi |
1215 | 608k | 560618U, // MOVsr |
1216 | 608k | 336124238U, // MRC |
1217 | 608k | 74138U, // MRC2 |
1218 | 608k | 352872786U, // MRRC |
1219 | 608k | 78240U, // MRRC2 |
1220 | 608k | 2148056290U, // MRS |
1221 | 608k | 539874U, // MRSbanked |
1222 | 608k | 3221798114U, // MRSsys |
1223 | 608k | 369638536U, // MSR |
1224 | 608k | 386415752U, // MSRbanked |
1225 | 608k | 369638536U, // MSRi |
1226 | 608k | 531317U, // MUL |
1227 | 608k | 543747U, // MVNi |
1228 | 608k | 543747U, // MVNr |
1229 | 608k | 531459U, // MVNsi |
1230 | 608k | 560131U, // MVNsr |
1231 | 608k | 531576U, // ORRri |
1232 | 608k | 531576U, // ORRrr |
1233 | 608k | 560248U, // ORRrsi |
1234 | 608k | 40056U, // ORRrsr |
1235 | 608k | 548115U, // PKHBT |
1236 | 608k | 547023U, // PKHTB |
1237 | 608k | 83290U, // PLDWi12 |
1238 | 608k | 87386U, // PLDWrs |
1239 | 608k | 83171U, // PLDi12 |
1240 | 608k | 87267U, // PLDrs |
1241 | 608k | 83206U, // PLIi12 |
1242 | 608k | 87302U, // PLIrs |
1243 | 608k | 555406U, // QADD |
1244 | 608k | 554800U, // QADD16 |
1245 | 608k | 554903U, // QADD8 |
1246 | 608k | 556729U, // QASX |
1247 | 608k | 555380U, // QDADD |
1248 | 608k | 555252U, // QDSUB |
1249 | 608k | 556588U, // QSAX |
1250 | 608k | 555265U, // QSUB |
1251 | 608k | 554762U, // QSUB16 |
1252 | 608k | 554864U, // QSUB8 |
1253 | 608k | 539998U, // RBIT |
1254 | 608k | 540118U, // REV |
1255 | 608k | 538452U, // REV16 |
1256 | 608k | 539247U, // REVSH |
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1258 | 608k | 2008221U, // RFEDA_UPD |
1259 | 608k | 828604U, // RFEDB |
1260 | 608k | 2008252U, // RFEDB_UPD |
1261 | 608k | 828580U, // RFEIA |
1262 | 608k | 2008228U, // RFEIA_UPD |
1263 | 608k | 828611U, // RFEIB |
1264 | 608k | 2008259U, // RFEIB_UPD |
1265 | 608k | 530624U, // RSBri |
1266 | 608k | 530624U, // RSBrr |
1267 | 608k | 559296U, // RSBrsi |
1268 | 608k | 39104U, // RSBrsr |
1269 | 608k | 530775U, // RSCri |
1270 | 608k | 530775U, // RSCrr |
1271 | 608k | 559447U, // RSCrsi |
1272 | 608k | 39255U, // RSCrsr |
1273 | 608k | 554807U, // SADD16 |
1274 | 608k | 554909U, // SADD8 |
1275 | 608k | 556734U, // SASX |
1276 | 608k | 530741U, // SBCri |
1277 | 608k | 530741U, // SBCrr |
1278 | 608k | 559413U, // SBCrsi |
1279 | 608k | 39221U, // SBCrsr |
1280 | 608k | 548506U, // SBFX |
1281 | 608k | 556506U, // SDIV |
1282 | 608k | 555794U, // SEL |
1283 | 608k | 91368U, // SETEND |
1284 | 608k | 828701U, // SETPAN |
1285 | 608k | 168468546U, // SHA1C |
1286 | 608k | 1258987596U, // SHA1H |
1287 | 608k | 168468578U, // SHA1M |
1288 | 608k | 168468588U, // SHA1P |
1289 | 608k | 168468481U, // SHA1SU0 |
1290 | 608k | 1242210331U, // SHA1SU1 |
1291 | 608k | 168468566U, // SHA256H |
1292 | 608k | 168468533U, // SHA256H2 |
1293 | 608k | 1242210317U, // SHA256SU0 |
1294 | 608k | 168468519U, // SHA256SU1 |
1295 | 608k | 554783U, // SHADD16 |
1296 | 608k | 554888U, // SHADD8 |
1297 | 608k | 556716U, // SHASX |
1298 | 608k | 556575U, // SHSAX |
1299 | 608k | 554745U, // SHSUB16 |
1300 | 608k | 554849U, // SHSUB8 |
1301 | 608k | 1074313546U, // SMC |
1302 | 608k | 546910U, // SMLABB |
1303 | 608k | 548108U, // SMLABT |
1304 | 608k | 547171U, // SMLAD |
1305 | 608k | 548432U, // SMLADX |
1306 | 608k | 96984U, // SMLAL |
1307 | 608k | 579685U, // SMLALBB |
1308 | 608k | 580889U, // SMLALBT |
1309 | 608k | 579992U, // SMLALD |
1310 | 608k | 581214U, // SMLALDX |
1311 | 608k | 579797U, // SMLALTB |
1312 | 608k | 581011U, // SMLALTT |
1313 | 608k | 547016U, // SMLATB |
1314 | 608k | 548236U, // SMLATT |
1315 | 608k | 547083U, // SMLAWB |
1316 | 608k | 548284U, // SMLAWT |
1317 | 608k | 547257U, // SMLSD |
1318 | 608k | 548462U, // SMLSDX |
1319 | 608k | 580003U, // SMLSLD |
1320 | 608k | 581222U, // SMLSLDX |
1321 | 608k | 546850U, // SMMLA |
1322 | 608k | 547907U, // SMMLAR |
1323 | 608k | 548019U, // SMMLS |
1324 | 608k | 547968U, // SMMLSR |
1325 | 608k | 555891U, // SMMUL |
1326 | 608k | 556130U, // SMMULR |
1327 | 608k | 555369U, // SMUAD |
1328 | 608k | 556631U, // SMUADX |
1329 | 608k | 555117U, // SMULBB |
1330 | 608k | 556321U, // SMULBT |
1331 | 608k | 559946U, // SMULL |
1332 | 608k | 555229U, // SMULTB |
1333 | 608k | 556443U, // SMULTT |
1334 | 608k | 555282U, // SMULWB |
1335 | 608k | 556483U, // SMULWT |
1336 | 608k | 555455U, // SMUSD |
1337 | 608k | 556661U, // SMUSDX |
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1339 | 608k | 828788U, // SRSDA_UPD |
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1341 | 608k | 828812U, // SRSDB_UPD |
1342 | 608k | 828847U, // SRSIA |
1343 | 608k | 828800U, // SRSIA_UPD |
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1345 | 608k | 828824U, // SRSIB_UPD |
1346 | 608k | 548093U, // SSAT |
1347 | 608k | 554821U, // SSAT16 |
1348 | 608k | 556593U, // SSAX |
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1350 | 608k | 554870U, // SSUB8 |
1351 | 608k | 286975250U, // STC2L_OFFSET |
1352 | 608k | 3524977938U, // STC2L_OPTION |
1353 | 608k | 303752466U, // STC2L_POST |
1354 | 608k | 320529682U, // STC2L_PRE |
1355 | 608k | 286974375U, // STC2_OFFSET |
1356 | 608k | 3524977063U, // STC2_OPTION |
1357 | 608k | 303751591U, // STC2_POST |
1358 | 608k | 320528807U, // STC2_PRE |
1359 | 608k | 1275615994U, // STCL_OFFSET |
1360 | 608k | 1275615994U, // STCL_OPTION |
1361 | 608k | 1275615994U, // STCL_POST |
1362 | 608k | 1275615994U, // STCL_PRE |
1363 | 608k | 1275615579U, // STC_OFFSET |
1364 | 608k | 1275615579U, // STC_OPTION |
1365 | 608k | 1275615579U, // STC_POST |
1366 | 608k | 1275615579U, // STC_PRE |
1367 | 608k | 539503U, // STL |
1368 | 608k | 538782U, // STLB |
1369 | 608k | 556674U, // STLEX |
1370 | 608k | 555296U, // STLEXB |
1371 | 608k | 555468U, // STLEXD |
1372 | 608k | 555654U, // STLEXH |
1373 | 608k | 539195U, // STLH |
1374 | 608k | 571394U, // STMDA |
1375 | 608k | 2332571650U, // STMDA_UPD |
1376 | 608k | 571526U, // STMDB |
1377 | 608k | 2332571782U, // STMDB_UPD |
1378 | 608k | 572306U, // STMIA |
1379 | 608k | 2332572562U, // STMIA_UPD |
1380 | 608k | 571544U, // STMIB |
1381 | 608k | 2332571800U, // STMIB_UPD |
1382 | 608k | 185101614U, // STRBT_POST_IMM |
1383 | 608k | 185101614U, // STRBT_POST_REG |
1384 | 608k | 185100465U, // STRB_POST_IMM |
1385 | 608k | 185100465U, // STRB_POST_REG |
1386 | 608k | 185096369U, // STRB_PRE_IMM |
1387 | 608k | 185100465U, // STRB_PRE_REG |
1388 | 608k | 555185U, // STRBi12 |
1389 | 608k | 546993U, // STRBrs |
1390 | 608k | 551348U, // STRD |
1391 | 608k | 185129396U, // STRD_POST |
1392 | 608k | 185129396U, // STRD_PRE |
1393 | 608k | 556692U, // STREX |
1394 | 608k | 555310U, // STREXB |
1395 | 608k | 555482U, // STREXD |
1396 | 608k | 555668U, // STREXH |
1397 | 608k | 547414U, // STRH |
1398 | 608k | 185097553U, // STRHTi |
1399 | 608k | 185101649U, // STRHTr |
1400 | 608k | 185100886U, // STRH_POST |
1401 | 608k | 185100886U, // STRH_PRE |
1402 | 608k | 185101698U, // STRT_POST_IMM |
1403 | 608k | 185101698U, // STRT_POST_REG |
1404 | 608k | 185101460U, // STR_POST_IMM |
1405 | 608k | 185101460U, // STR_POST_REG |
1406 | 608k | 185097364U, // STR_PRE_IMM |
1407 | 608k | 185101460U, // STR_PRE_REG |
1408 | 608k | 556180U, // STRi12 |
1409 | 608k | 547988U, // STRrs |
1410 | 608k | 530678U, // SUBri |
1411 | 608k | 530678U, // SUBrr |
1412 | 608k | 559350U, // SUBrsi |
1413 | 608k | 39158U, // SUBrsr |
1414 | 608k | 1074313567U, // SVC |
1415 | 608k | 556081U, // SWP |
1416 | 608k | 555175U, // SWPB |
1417 | 608k | 546898U, // SXTAB |
1418 | 608k | 546523U, // SXTAB16 |
1419 | 608k | 547371U, // SXTAH |
1420 | 608k | 555242U, // SXTB |
1421 | 608k | 554731U, // SXTB16 |
1422 | 608k | 555637U, // SXTH |
1423 | 608k | 539711U, // TEQri |
1424 | 608k | 539711U, // TEQrr |
1425 | 608k | 556095U, // TEQrsi |
1426 | 608k | 547903U, // TEQrsr |
1427 | 608k | 3092U, // TRAP |
1428 | 608k | 3092U, // TRAPNaCl |
1429 | 608k | 99545U, // TSB |
1430 | 608k | 540040U, // TSTri |
1431 | 608k | 540040U, // TSTrr |
1432 | 608k | 556424U, // TSTrsi |
1433 | 608k | 548232U, // TSTrsr |
1434 | 608k | 554814U, // UADD16 |
1435 | 608k | 554915U, // UADD8 |
1436 | 608k | 556739U, // UASX |
1437 | 608k | 548511U, // UBFX |
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3645 | 608k | 554828U, // t2USAT16 |
3646 | 608k | 556598U, // t2USAX |
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3650 | 608k | 546531U, // t2UXTAB16 |
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3675 | 608k | 1074314816U, // tBX |
3676 | 608k | 1074314447U, // tBXNS |
3677 | 608k | 1074313296U, // tBcc |
3678 | 608k | 1258988910U, // tCBNZ |
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3680 | 608k | 539583U, // tCMNz |
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3684 | 608k | 1308687581U, // tCPS |
3685 | 608k | 982776938U, // tEOR |
3686 | 608k | 1074314610U, // tHINT |
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3688 | 608k | 0U, // tInt_WIN_eh_sjlj_longjmp |
3689 | 608k | 0U, // tInt_eh_sjlj_longjmp |
3690 | 608k | 0U, // tInt_eh_sjlj_setjmp |
3691 | 608k | 572300U, // tLDMIA |
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3718 | 608k | 982776942U, // tROR |
3719 | 608k | 429258944U, // tRSB |
3720 | 608k | 982776117U, // tSBC |
3721 | 608k | 91368U, // tSETEND |
3722 | 608k | 2332572562U, // tSTMIA_UPD |
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3726 | 608k | 555606U, // tSTRHr |
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3729 | 608k | 556180U, // tSTRspi |
3730 | 608k | 177469686U, // tSUBi3 |
3731 | 608k | 982776054U, // tSUBi8 |
3732 | 608k | 177469686U, // tSUBrr |
3733 | 608k | 555254U, // tSUBspi |
3734 | 608k | 1074313567U, // tSVC |
3735 | 608k | 538858U, // tSXTB |
3736 | 608k | 539253U, // tSXTH |
3737 | 608k | 3092U, // tTRAP |
3738 | 608k | 540040U, // tTST |
3739 | 608k | 828656U, // tUDF |
3740 | 608k | 538863U, // tUXTB |
3741 | 608k | 539258U, // tUXTH |
3742 | 608k | 1636U, // t__brkdiv0 |
3743 | 608k | }; |
3744 | | |
3745 | 608k | static const uint32_t OpInfo1[] = { |
3746 | 608k | 0U, // PHI |
3747 | 608k | 0U, // INLINEASM |
3748 | 608k | 0U, // CFI_INSTRUCTION |
3749 | 608k | 0U, // EH_LABEL |
3750 | 608k | 0U, // GC_LABEL |
3751 | 608k | 0U, // ANNOTATION_LABEL |
3752 | 608k | 0U, // KILL |
3753 | 608k | 0U, // EXTRACT_SUBREG |
3754 | 608k | 0U, // INSERT_SUBREG |
3755 | 608k | 0U, // IMPLICIT_DEF |
3756 | 608k | 0U, // SUBREG_TO_REG |
3757 | 608k | 0U, // COPY_TO_REGCLASS |
3758 | 608k | 0U, // DBG_VALUE |
3759 | 608k | 0U, // DBG_LABEL |
3760 | 608k | 0U, // REG_SEQUENCE |
3761 | 608k | 0U, // COPY |
3762 | 608k | 0U, // BUNDLE |
3763 | 608k | 0U, // LIFETIME_START |
3764 | 608k | 0U, // LIFETIME_END |
3765 | 608k | 0U, // STACKMAP |
3766 | 608k | 0U, // FENTRY_CALL |
3767 | 608k | 0U, // PATCHPOINT |
3768 | 608k | 0U, // LOAD_STACK_GUARD |
3769 | 608k | 0U, // STATEPOINT |
3770 | 608k | 0U, // LOCAL_ESCAPE |
3771 | 608k | 0U, // FAULTING_OP |
3772 | 608k | 0U, // PATCHABLE_OP |
3773 | 608k | 0U, // PATCHABLE_FUNCTION_ENTER |
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3776 | 608k | 0U, // PATCHABLE_TAIL_CALL |
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3779 | 608k | 0U, // ICALL_BRANCH_FUNNEL |
3780 | 608k | 0U, // G_ADD |
3781 | 608k | 0U, // G_SUB |
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3790 | 608k | 0U, // G_IMPLICIT_DEF |
3791 | 608k | 0U, // G_PHI |
3792 | 608k | 0U, // G_FRAME_INDEX |
3793 | 608k | 0U, // G_GLOBAL_VALUE |
3794 | 608k | 0U, // G_EXTRACT |
3795 | 608k | 0U, // G_UNMERGE_VALUES |
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3797 | 608k | 0U, // G_MERGE_VALUES |
3798 | 608k | 0U, // G_PTRTOINT |
3799 | 608k | 0U, // G_INTTOPTR |
3800 | 608k | 0U, // G_BITCAST |
3801 | 608k | 0U, // G_LOAD |
3802 | 608k | 0U, // G_SEXTLOAD |
3803 | 608k | 0U, // G_ZEXTLOAD |
3804 | 608k | 0U, // G_STORE |
3805 | 608k | 0U, // G_ATOMIC_CMPXCHG_WITH_SUCCESS |
3806 | 608k | 0U, // G_ATOMIC_CMPXCHG |
3807 | 608k | 0U, // G_ATOMICRMW_XCHG |
3808 | 608k | 0U, // G_ATOMICRMW_ADD |
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3811 | 608k | 0U, // G_ATOMICRMW_NAND |
3812 | 608k | 0U, // G_ATOMICRMW_OR |
3813 | 608k | 0U, // G_ATOMICRMW_XOR |
3814 | 608k | 0U, // G_ATOMICRMW_MAX |
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3818 | 608k | 0U, // G_BRCOND |
3819 | 608k | 0U, // G_BRINDIRECT |
3820 | 608k | 0U, // G_INTRINSIC |
3821 | 608k | 0U, // G_INTRINSIC_W_SIDE_EFFECTS |
3822 | 608k | 0U, // G_ANYEXT |
3823 | 608k | 0U, // G_TRUNC |
3824 | 608k | 0U, // G_CONSTANT |
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3826 | 608k | 0U, // G_VASTART |
3827 | 608k | 0U, // G_VAARG |
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3830 | 608k | 0U, // G_SHL |
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3838 | 608k | 0U, // G_SADDO |
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3840 | 608k | 0U, // G_UMULO |
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3850 | 608k | 0U, // G_FPOW |
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3856 | 608k | 0U, // G_FPEXT |
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3860 | 608k | 0U, // G_SITOFP |
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3862 | 608k | 0U, // G_FABS |
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3864 | 608k | 0U, // G_PTR_MASK |
3865 | 608k | 0U, // G_BR |
3866 | 608k | 0U, // G_INSERT_VECTOR_ELT |
3867 | 608k | 0U, // G_EXTRACT_VECTOR_ELT |
3868 | 608k | 0U, // G_SHUFFLE_VECTOR |
3869 | 608k | 0U, // G_BSWAP |
3870 | 608k | 0U, // G_ADDRSPACE_CAST |
3871 | 608k | 0U, // G_BLOCK_ADDR |
3872 | 608k | 0U, // ABS |
3873 | 608k | 0U, // ADDSri |
3874 | 608k | 0U, // ADDSrr |
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3876 | 608k | 0U, // ADDSrsr |
3877 | 608k | 0U, // ADJCALLSTACKDOWN |
3878 | 608k | 0U, // ADJCALLSTACKUP |
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3880 | 608k | 0U, // ASRr |
3881 | 608k | 0U, // B |
3882 | 608k | 0U, // BCCZi64 |
3883 | 608k | 0U, // BCCi64 |
3884 | 608k | 0U, // BMOVPCB_CALL |
3885 | 608k | 0U, // BMOVPCRX_CALL |
3886 | 608k | 0U, // BR_JTadd |
3887 | 608k | 0U, // BR_JTm_i12 |
3888 | 608k | 0U, // BR_JTm_rs |
3889 | 608k | 0U, // BR_JTr |
3890 | 608k | 0U, // BX_CALL |
3891 | 608k | 0U, // CMP_SWAP_16 |
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3894 | 608k | 0U, // CMP_SWAP_8 |
3895 | 608k | 0U, // CONSTPOOL_ENTRY |
3896 | 608k | 0U, // COPY_STRUCT_BYVAL_I32 |
3897 | 608k | 0U, // CompilerBarrier |
3898 | 608k | 0U, // ITasm |
3899 | 608k | 0U, // Int_eh_sjlj_dispatchsetup |
3900 | 608k | 0U, // Int_eh_sjlj_longjmp |
3901 | 608k | 0U, // Int_eh_sjlj_setjmp |
3902 | 608k | 0U, // Int_eh_sjlj_setjmp_nofp |
3903 | 608k | 0U, // Int_eh_sjlj_setup_dispatch |
3904 | 608k | 0U, // JUMPTABLE_ADDRS |
3905 | 608k | 0U, // JUMPTABLE_INSTS |
3906 | 608k | 0U, // JUMPTABLE_TBB |
3907 | 608k | 0U, // JUMPTABLE_TBH |
3908 | 608k | 0U, // LDMIA_RET |
3909 | 608k | 8U, // LDRBT_POST |
3910 | 608k | 1024U, // LDRConstPool |
3911 | 608k | 0U, // LDRLIT_ga_abs |
3912 | 608k | 0U, // LDRLIT_ga_pcrel |
3913 | 608k | 0U, // LDRLIT_ga_pcrel_ldr |
3914 | 608k | 8U, // LDRT_POST |
3915 | 608k | 0U, // LEApcrel |
3916 | 608k | 0U, // LEApcrelJT |
3917 | 608k | 0U, // LSLi |
3918 | 608k | 0U, // LSLr |
3919 | 608k | 0U, // LSRi |
3920 | 608k | 0U, // LSRr |
3921 | 608k | 0U, // MEMCPY |
3922 | 608k | 0U, // MLAv5 |
3923 | 608k | 0U, // MOVCCi |
3924 | 608k | 0U, // MOVCCi16 |
3925 | 608k | 0U, // MOVCCi32imm |
3926 | 608k | 0U, // MOVCCr |
3927 | 608k | 0U, // MOVCCsi |
3928 | 608k | 0U, // MOVCCsr |
3929 | 608k | 0U, // MOVPCRX |
3930 | 608k | 0U, // MOVTi16_ga_pcrel |
3931 | 608k | 0U, // MOV_ga_pcrel |
3932 | 608k | 0U, // MOV_ga_pcrel_ldr |
3933 | 608k | 0U, // MOVi16_ga_pcrel |
3934 | 608k | 0U, // MOVi32imm |
3935 | 608k | 0U, // MOVsra_flag |
3936 | 608k | 0U, // MOVsrl_flag |
3937 | 608k | 0U, // MULv5 |
3938 | 608k | 0U, // MVNCCi |
3939 | 608k | 0U, // PICADD |
3940 | 608k | 0U, // PICLDR |
3941 | 608k | 0U, // PICLDRB |
3942 | 608k | 0U, // PICLDRH |
3943 | 608k | 0U, // PICLDRSB |
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3945 | 608k | 0U, // PICSTR |
3946 | 608k | 0U, // PICSTRB |
3947 | 608k | 0U, // PICSTRH |
3948 | 608k | 0U, // RORi |
3949 | 608k | 0U, // RORr |
3950 | 608k | 0U, // RRX |
3951 | 608k | 1024U, // RRXi |
3952 | 608k | 0U, // RSBSri |
3953 | 608k | 0U, // RSBSrsi |
3954 | 608k | 0U, // RSBSrsr |
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4212 | 608k | 1024U, // t2LDRpcrel |
4213 | 608k | 0U, // t2LEApcrel |
4214 | 608k | 0U, // t2LEApcrelJT |
4215 | 608k | 0U, // t2MOVCCasr |
4216 | 608k | 0U, // t2MOVCCi |
4217 | 608k | 0U, // t2MOVCCi16 |
4218 | 608k | 0U, // t2MOVCCi32imm |
4219 | 608k | 0U, // t2MOVCClsl |
4220 | 608k | 0U, // t2MOVCClsr |
4221 | 608k | 0U, // t2MOVCCr |
4222 | 608k | 0U, // t2MOVCCror |
4223 | 608k | 56U, // t2MOVSsi |
4224 | 608k | 64U, // t2MOVSsr |
4225 | 608k | 0U, // t2MOVTi16_ga_pcrel |
4226 | 608k | 0U, // t2MOV_ga_pcrel |
4227 | 608k | 0U, // t2MOVi16_ga_pcrel |
4228 | 608k | 0U, // t2MOVi32imm |
4229 | 608k | 56U, // t2MOVsi |
4230 | 608k | 64U, // t2MOVsr |
4231 | 608k | 0U, // t2MVNCCi |
4232 | 608k | 0U, // t2RSBSri |
4233 | 608k | 0U, // t2RSBSrs |
4234 | 608k | 0U, // t2STRB_preidx |
4235 | 608k | 0U, // t2STRH_preidx |
4236 | 608k | 0U, // t2STR_preidx |
4237 | 608k | 0U, // t2SUBSri |
4238 | 608k | 0U, // t2SUBSrr |
4239 | 608k | 0U, // t2SUBSrs |
4240 | 608k | 0U, // t2TBB_JT |
4241 | 608k | 0U, // t2TBH_JT |
4242 | 608k | 0U, // tADCS |
4243 | 608k | 0U, // tADDSi3 |
4244 | 608k | 0U, // tADDSi8 |
4245 | 608k | 0U, // tADDSrr |
4246 | 608k | 0U, // tADDframe |
4247 | 608k | 0U, // tADJCALLSTACKDOWN |
4248 | 608k | 0U, // tADJCALLSTACKUP |
4249 | 608k | 0U, // tBRIND |
4250 | 608k | 0U, // tBR_JTr |
4251 | 608k | 0U, // tBX_CALL |
4252 | 608k | 0U, // tBX_RET |
4253 | 608k | 0U, // tBX_RET_vararg |
4254 | 608k | 0U, // tBfar |
4255 | 608k | 0U, // tLDMIA_UPD |
4256 | 608k | 1024U, // tLDRConstPool |
4257 | 608k | 0U, // tLDRLIT_ga_abs |
4258 | 608k | 0U, // tLDRLIT_ga_pcrel |
4259 | 608k | 0U, // tLDR_postidx |
4260 | 608k | 0U, // tLDRpci_pic |
4261 | 608k | 0U, // tLEApcrel |
4262 | 608k | 0U, // tLEApcrelJT |
4263 | 608k | 0U, // tMOVCCr_pseudo |
4264 | 608k | 0U, // tPOP_RET |
4265 | 608k | 0U, // tSBCS |
4266 | 608k | 0U, // tSUBSi3 |
4267 | 608k | 0U, // tSUBSi8 |
4268 | 608k | 0U, // tSUBSrr |
4269 | 608k | 0U, // tTAILJMPd |
4270 | 608k | 0U, // tTAILJMPdND |
4271 | 608k | 0U, // tTAILJMPr |
4272 | 608k | 0U, // tTBB_JT |
4273 | 608k | 0U, // tTBH_JT |
4274 | 608k | 0U, // tTPsoft |
4275 | 608k | 98304U, // ADCri |
4276 | 608k | 0U, // ADCrr |
4277 | 608k | 131072U, // ADCrsi |
4278 | 608k | 0U, // ADCrsr |
4279 | 608k | 98304U, // ADDri |
4280 | 608k | 0U, // ADDrr |
4281 | 608k | 131072U, // ADDrsi |
4282 | 608k | 0U, // ADDrsr |
4283 | 608k | 72U, // ADR |
4284 | 608k | 0U, // AESD |
4285 | 608k | 0U, // AESE |
4286 | 608k | 0U, // AESIMC |
4287 | 608k | 0U, // AESMC |
4288 | 608k | 98304U, // ANDri |
4289 | 608k | 0U, // ANDrr |
4290 | 608k | 131072U, // ANDrsi |
4291 | 608k | 0U, // ANDrsr |
4292 | 608k | 80U, // BFC |
4293 | 608k | 163928U, // BFI |
4294 | 608k | 98304U, // BICri |
4295 | 608k | 0U, // BICrr |
4296 | 608k | 131072U, // BICrsi |
4297 | 608k | 0U, // BICrsr |
4298 | 608k | 0U, // BKPT |
4299 | 608k | 0U, // BL |
4300 | 608k | 0U, // BLX |
4301 | 608k | 0U, // BLX_pred |
4302 | 608k | 0U, // BLXi |
4303 | 608k | 0U, // BL_pred |
4304 | 608k | 0U, // BX |
4305 | 608k | 0U, // BXJ |
4306 | 608k | 0U, // BX_RET |
4307 | 608k | 0U, // BX_pred |
4308 | 608k | 0U, // Bcc |
4309 | 608k | 4145U, // CDP |
4310 | 608k | 0U, // CDP2 |
4311 | 608k | 0U, // CLREX |
4312 | 608k | 1024U, // CLZ |
4313 | 608k | 96U, // CMNri |
4314 | 608k | 1024U, // CMNzrr |
4315 | 608k | 104U, // CMNzrsi |
4316 | 608k | 64U, // CMNzrsr |
4317 | 608k | 96U, // CMPri |
4318 | 608k | 1024U, // CMPrr |
4319 | 608k | 104U, // CMPrsi |
4320 | 608k | 64U, // CMPrsr |
4321 | 608k | 0U, // CPS1p |
4322 | 608k | 0U, // CPS2p |
4323 | 608k | 1112U, // CPS3p |
4324 | 608k | 1112U, // CRC32B |
4325 | 608k | 1112U, // CRC32CB |
4326 | 608k | 1112U, // CRC32CH |
4327 | 608k | 1112U, // CRC32CW |
4328 | 608k | 1112U, // CRC32H |
4329 | 608k | 1112U, // CRC32W |
4330 | 608k | 0U, // DBG |
4331 | 608k | 0U, // DMB |
4332 | 608k | 0U, // DSB |
4333 | 608k | 98304U, // EORri |
4334 | 608k | 0U, // EORrr |
4335 | 608k | 131072U, // EORrsi |
4336 | 608k | 0U, // EORrsr |
4337 | 608k | 0U, // ERET |
4338 | 608k | 1U, // FCONSTD |
4339 | 608k | 1U, // FCONSTH |
4340 | 608k | 1U, // FCONSTS |
4341 | 608k | 33U, // FLDMXDB_UPD |
4342 | 608k | 1136U, // FLDMXIA |
4343 | 608k | 33U, // FLDMXIA_UPD |
4344 | 608k | 0U, // FMSTAT |
4345 | 608k | 33U, // FSTMXDB_UPD |
4346 | 608k | 1136U, // FSTMXIA |
4347 | 608k | 33U, // FSTMXIA_UPD |
4348 | 608k | 0U, // HINT |
4349 | 608k | 0U, // HLT |
4350 | 608k | 0U, // HVC |
4351 | 608k | 0U, // ISB |
4352 | 608k | 8U, // LDA |
4353 | 608k | 8U, // LDAB |
4354 | 608k | 8U, // LDAEX |
4355 | 608k | 8U, // LDAEXB |
4356 | 608k | 0U, // LDAEXD |
4357 | 608k | 8U, // LDAEXH |
4358 | 608k | 8U, // LDAH |
4359 | 608k | 0U, // LDC2L_OFFSET |
4360 | 608k | 1U, // LDC2L_OPTION |
4361 | 608k | 2U, // LDC2L_POST |
4362 | 608k | 0U, // LDC2L_PRE |
4363 | 608k | 0U, // LDC2_OFFSET |
4364 | 608k | 1U, // LDC2_OPTION |
4365 | 608k | 2U, // LDC2_POST |
4366 | 608k | 0U, // LDC2_PRE |
4367 | 608k | 122U, // LDCL_OFFSET |
4368 | 608k | 196738U, // LDCL_OPTION |
4369 | 608k | 229506U, // LDCL_POST |
4370 | 608k | 138U, // LDCL_PRE |
4371 | 608k | 122U, // LDC_OFFSET |
4372 | 608k | 196738U, // LDC_OPTION |
4373 | 608k | 229506U, // LDC_POST |
4374 | 608k | 138U, // LDC_PRE |
4375 | 608k | 1136U, // LDMDA |
4376 | 608k | 33U, // LDMDA_UPD |
4377 | 608k | 1136U, // LDMDB |
4378 | 608k | 33U, // LDMDB_UPD |
4379 | 608k | 1136U, // LDMIA |
4380 | 608k | 33U, // LDMIA_UPD |
4381 | 608k | 1136U, // LDMIB |
4382 | 608k | 33U, // LDMIB_UPD |
4383 | 608k | 262272U, // LDRBT_POST_IMM |
4384 | 608k | 262272U, // LDRBT_POST_REG |
4385 | 608k | 262272U, // LDRB_POST_IMM |
4386 | 608k | 262272U, // LDRB_POST_REG |
4387 | 608k | 144U, // LDRB_PRE_IMM |
4388 | 608k | 152U, // LDRB_PRE_REG |
4389 | 608k | 160U, // LDRBi12 |
4390 | 608k | 168U, // LDRBrs |
4391 | 608k | 294912U, // LDRD |
4392 | 608k | 2424832U, // LDRD_POST |
4393 | 608k | 360448U, // LDRD_PRE |
4394 | 608k | 8U, // LDREX |
4395 | 608k | 8U, // LDREXB |
4396 | 608k | 0U, // LDREXD |
4397 | 608k | 8U, // LDREXH |
4398 | 608k | 176U, // LDRH |
4399 | 608k | 393344U, // LDRHTi |
4400 | 608k | 426112U, // LDRHTr |
4401 | 608k | 458880U, // LDRH_POST |
4402 | 608k | 184U, // LDRH_PRE |
4403 | 608k | 176U, // LDRSB |
4404 | 608k | 393344U, // LDRSBTi |
4405 | 608k | 426112U, // LDRSBTr |
4406 | 608k | 458880U, // LDRSB_POST |
4407 | 608k | 184U, // LDRSB_PRE |
4408 | 608k | 176U, // LDRSH |
4409 | 608k | 393344U, // LDRSHTi |
4410 | 608k | 426112U, // LDRSHTr |
4411 | 608k | 458880U, // LDRSH_POST |
4412 | 608k | 184U, // LDRSH_PRE |
4413 | 608k | 262272U, // LDRT_POST_IMM |
4414 | 608k | 262272U, // LDRT_POST_REG |
4415 | 608k | 262272U, // LDR_POST_IMM |
4416 | 608k | 262272U, // LDR_POST_REG |
4417 | 608k | 144U, // LDR_PRE_IMM |
4418 | 608k | 152U, // LDR_PRE_REG |
4419 | 608k | 160U, // LDRcp |
4420 | 608k | 160U, // LDRi12 |
4421 | 608k | 168U, // LDRrs |
4422 | 608k | 4690993U, // MCR |
4423 | 608k | 192U, // MCR2 |
4424 | 608k | 6788145U, // MCRR |
4425 | 608k | 524312U, // MCRR2 |
4426 | 608k | 35651584U, // MLA |
4427 | 608k | 35651584U, // MLS |
4428 | 608k | 0U, // MOVPCLR |
4429 | 608k | 1112U, // MOVTi16 |
4430 | 608k | 96U, // MOVi |
4431 | 608k | 1024U, // MOVi16 |
4432 | 608k | 1024U, // MOVr |
4433 | 608k | 1024U, // MOVr_TC |
4434 | 608k | 104U, // MOVsi |
4435 | 608k | 64U, // MOVsr |
4436 | 608k | 0U, // MRC |
4437 | 608k | 0U, // MRC2 |
4438 | 608k | 0U, // MRRC |
4439 | 608k | 0U, // MRRC2 |
4440 | 608k | 2U, // MRS |
4441 | 608k | 200U, // MRSbanked |
4442 | 608k | 2U, // MRSsys |
4443 | 608k | 33U, // MSR |
4444 | 608k | 0U, // MSRbanked |
4445 | 608k | 3U, // MSRi |
4446 | 608k | 0U, // MUL |
4447 | 608k | 96U, // MVNi |
4448 | 608k | 1024U, // MVNr |
4449 | 608k | 104U, // MVNsi |
4450 | 608k | 64U, // MVNsr |
4451 | 608k | 98304U, // ORRri |
4452 | 608k | 0U, // ORRrr |
4453 | 608k | 131072U, // ORRrsi |
4454 | 608k | 0U, // ORRrsr |
4455 | 608k | 8388608U, // PKHBT |
4456 | 608k | 10485760U, // PKHTB |
4457 | 608k | 0U, // PLDWi12 |
4458 | 608k | 0U, // PLDWrs |
4459 | 608k | 0U, // PLDi12 |
4460 | 608k | 0U, // PLDrs |
4461 | 608k | 0U, // PLIi12 |
4462 | 608k | 0U, // PLIrs |
4463 | 608k | 0U, // QADD |
4464 | 608k | 0U, // QADD16 |
4465 | 608k | 0U, // QADD8 |
4466 | 608k | 0U, // QASX |
4467 | 608k | 0U, // QDADD |
4468 | 608k | 0U, // QDSUB |
4469 | 608k | 0U, // QSAX |
4470 | 608k | 0U, // QSUB |
4471 | 608k | 0U, // QSUB16 |
4472 | 608k | 0U, // QSUB8 |
4473 | 608k | 1024U, // RBIT |
4474 | 608k | 1024U, // REV |
4475 | 608k | 1024U, // REV16 |
4476 | 608k | 1024U, // REVSH |
4477 | 608k | 0U, // RFEDA |
4478 | 608k | 0U, // RFEDA_UPD |
4479 | 608k | 0U, // RFEDB |
4480 | 608k | 0U, // RFEDB_UPD |
4481 | 608k | 0U, // RFEIA |
4482 | 608k | 0U, // RFEIA_UPD |
4483 | 608k | 0U, // RFEIB |
4484 | 608k | 0U, // RFEIB_UPD |
4485 | 608k | 98304U, // RSBri |
4486 | 608k | 0U, // RSBrr |
4487 | 608k | 131072U, // RSBrsi |
4488 | 608k | 0U, // RSBrsr |
4489 | 608k | 98304U, // RSCri |
4490 | 608k | 0U, // RSCrr |
4491 | 608k | 131072U, // RSCrsi |
4492 | 608k | 0U, // RSCrsr |
4493 | 608k | 0U, // SADD16 |
4494 | 608k | 0U, // SADD8 |
4495 | 608k | 0U, // SASX |
4496 | 608k | 98304U, // SBCri |
4497 | 608k | 0U, // SBCrr |
4498 | 608k | 131072U, // SBCrsi |
4499 | 608k | 0U, // SBCrsr |
4500 | 608k | 69206016U, // SBFX |
4501 | 608k | 0U, // SDIV |
4502 | 608k | 0U, // SEL |
4503 | 608k | 0U, // SETEND |
4504 | 608k | 0U, // SETPAN |
4505 | 608k | 1048U, // SHA1C |
4506 | 608k | 0U, // SHA1H |
4507 | 608k | 1048U, // SHA1M |
4508 | 608k | 1048U, // SHA1P |
4509 | 608k | 1048U, // SHA1SU0 |
4510 | 608k | 0U, // SHA1SU1 |
4511 | 608k | 1048U, // SHA256H |
4512 | 608k | 1048U, // SHA256H2 |
4513 | 608k | 0U, // SHA256SU0 |
4514 | 608k | 1048U, // SHA256SU1 |
4515 | 608k | 0U, // SHADD16 |
4516 | 608k | 0U, // SHADD8 |
4517 | 608k | 0U, // SHASX |
4518 | 608k | 0U, // SHSAX |
4519 | 608k | 0U, // SHSUB16 |
4520 | 608k | 0U, // SHSUB8 |
4521 | 608k | 0U, // SMC |
4522 | 608k | 35651584U, // SMLABB |
4523 | 608k | 35651584U, // SMLABT |
4524 | 608k | 35651584U, // SMLAD |
4525 | 608k | 35651584U, // SMLADX |
4526 | 608k | 0U, // SMLAL |
4527 | 608k | 35651584U, // SMLALBB |
4528 | 608k | 35651584U, // SMLALBT |
4529 | 608k | 35651584U, // SMLALD |
4530 | 608k | 35651584U, // SMLALDX |
4531 | 608k | 35651584U, // SMLALTB |
4532 | 608k | 35651584U, // SMLALTT |
4533 | 608k | 35651584U, // SMLATB |
4534 | 608k | 35651584U, // SMLATT |
4535 | 608k | 35651584U, // SMLAWB |
4536 | 608k | 35651584U, // SMLAWT |
4537 | 608k | 35651584U, // SMLSD |
4538 | 608k | 35651584U, // SMLSDX |
4539 | 608k | 35651584U, // SMLSLD |
4540 | 608k | 35651584U, // SMLSLDX |
4541 | 608k | 35651584U, // SMMLA |
4542 | 608k | 35651584U, // SMMLAR |
4543 | 608k | 35651584U, // SMMLS |
4544 | 608k | 35651584U, // SMMLSR |
4545 | 608k | 0U, // SMMUL |
4546 | 608k | 0U, // SMMULR |
4547 | 608k | 0U, // SMUAD |
4548 | 608k | 0U, // SMUADX |
4549 | 608k | 0U, // SMULBB |
4550 | 608k | 0U, // SMULBT |
4551 | 608k | 35651584U, // SMULL |
4552 | 608k | 0U, // SMULTB |
4553 | 608k | 0U, // SMULTT |
4554 | 608k | 0U, // SMULWB |
4555 | 608k | 0U, // SMULWT |
4556 | 608k | 0U, // SMUSD |
4557 | 608k | 0U, // SMUSDX |
4558 | 608k | 0U, // SRSDA |
4559 | 608k | 0U, // SRSDA_UPD |
4560 | 608k | 0U, // SRSDB |
4561 | 608k | 0U, // SRSDB_UPD |
4562 | 608k | 0U, // SRSIA |
4563 | 608k | 0U, // SRSIA_UPD |
4564 | 608k | 0U, // SRSIB |
4565 | 608k | 0U, // SRSIB_UPD |
4566 | 608k | 6352U, // SSAT |
4567 | 608k | 1232U, // SSAT16 |
4568 | 608k | 0U, // SSAX |
4569 | 608k | 0U, // SSUB16 |
4570 | 608k | 0U, // SSUB8 |
4571 | 608k | 0U, // STC2L_OFFSET |
4572 | 608k | 1U, // STC2L_OPTION |
4573 | 608k | 2U, // STC2L_POST |
4574 | 608k | 0U, // STC2L_PRE |
4575 | 608k | 0U, // STC2_OFFSET |
4576 | 608k | 1U, // STC2_OPTION |
4577 | 608k | 2U, // STC2_POST |
4578 | 608k | 0U, // STC2_PRE |
4579 | 608k | 122U, // STCL_OFFSET |
4580 | 608k | 196738U, // STCL_OPTION |
4581 | 608k | 229506U, // STCL_POST |
4582 | 608k | 138U, // STCL_PRE |
4583 | 608k | 122U, // STC_OFFSET |
4584 | 608k | 196738U, // STC_OPTION |
4585 | 608k | 229506U, // STC_POST |
4586 | 608k | 138U, // STC_PRE |
4587 | 608k | 8U, // STL |
4588 | 608k | 8U, // STLB |
4589 | 608k | 557056U, // STLEX |
4590 | 608k | 557056U, // STLEXB |
4591 | 608k | 216U, // STLEXD |
4592 | 608k | 557056U, // STLEXH |
4593 | 608k | 8U, // STLH |
4594 | 608k | 1136U, // STMDA |
4595 | 608k | 33U, // STMDA_UPD |
4596 | 608k | 1136U, // STMDB |
4597 | 608k | 33U, // STMDB_UPD |
4598 | 608k | 1136U, // STMIA |
4599 | 608k | 33U, // STMIA_UPD |
4600 | 608k | 1136U, // STMIB |
4601 | 608k | 33U, // STMIB_UPD |
4602 | 608k | 262272U, // STRBT_POST_IMM |
4603 | 608k | 262272U, // STRBT_POST_REG |
4604 | 608k | 262272U, // STRB_POST_IMM |
4605 | 608k | 262272U, // STRB_POST_REG |
4606 | 608k | 144U, // STRB_PRE_IMM |
4607 | 608k | 152U, // STRB_PRE_REG |
4608 | 608k | 160U, // STRBi12 |
4609 | 608k | 168U, // STRBrs |
4610 | 608k | 294912U, // STRD |
4611 | 608k | 2424920U, // STRD_POST |
4612 | 608k | 360536U, // STRD_PRE |
4613 | 608k | 557056U, // STREX |
4614 | 608k | 557056U, // STREXB |
4615 | 608k | 216U, // STREXD |
4616 | 608k | 557056U, // STREXH |
4617 | 608k | 176U, // STRH |
4618 | 608k | 393344U, // STRHTi |
4619 | 608k | 426112U, // STRHTr |
4620 | 608k | 458880U, // STRH_POST |
4621 | 608k | 184U, // STRH_PRE |
4622 | 608k | 262272U, // STRT_POST_IMM |
4623 | 608k | 262272U, // STRT_POST_REG |
4624 | 608k | 262272U, // STR_POST_IMM |
4625 | 608k | 262272U, // STR_POST_REG |
4626 | 608k | 144U, // STR_PRE_IMM |
4627 | 608k | 152U, // STR_PRE_REG |
4628 | 608k | 160U, // STRi12 |
4629 | 608k | 168U, // STRrs |
4630 | 608k | 98304U, // SUBri |
4631 | 608k | 0U, // SUBrr |
4632 | 608k | 131072U, // SUBrsi |
4633 | 608k | 0U, // SUBrsr |
4634 | 608k | 0U, // SVC |
4635 | 608k | 557056U, // SWP |
4636 | 608k | 557056U, // SWPB |
4637 | 608k | 12582912U, // SXTAB |
4638 | 608k | 12582912U, // SXTAB16 |
4639 | 608k | 12582912U, // SXTAH |
4640 | 608k | 7168U, // SXTB |
4641 | 608k | 7168U, // SXTB16 |
4642 | 608k | 7168U, // SXTH |
4643 | 608k | 96U, // TEQri |
4644 | 608k | 1024U, // TEQrr |
4645 | 608k | 104U, // TEQrsi |
4646 | 608k | 64U, // TEQrsr |
4647 | 608k | 0U, // TRAP |
4648 | 608k | 0U, // TRAPNaCl |
4649 | 608k | 0U, // TSB |
4650 | 608k | 96U, // TSTri |
4651 | 608k | 1024U, // TSTrr |
4652 | 608k | 104U, // TSTrsi |
4653 | 608k | 64U, // TSTrsr |
4654 | 608k | 0U, // UADD16 |
4655 | 608k | 0U, // UADD8 |
4656 | 608k | 0U, // UASX |
4657 | 608k | 69206016U, // UBFX |
4658 | 608k | 0U, // UDF |
4659 | 608k | 0U, // UDIV |
4660 | 608k | 0U, // UHADD16 |
4661 | 608k | 0U, // UHADD8 |
4662 | 608k | 0U, // UHASX |
4663 | 608k | 0U, // UHSAX |
4664 | 608k | 0U, // UHSUB16 |
4665 | 608k | 0U, // UHSUB8 |
4666 | 608k | 35651584U, // UMAAL |
4667 | 608k | 0U, // UMLAL |
4668 | 608k | 35651584U, // UMULL |
4669 | 608k | 0U, // UQADD16 |
4670 | 608k | 0U, // UQADD8 |
4671 | 608k | 0U, // UQASX |
4672 | 608k | 0U, // UQSAX |
4673 | 608k | 0U, // UQSUB16 |
4674 | 608k | 0U, // UQSUB8 |
4675 | 608k | 0U, // USAD8 |
4676 | 608k | 35651584U, // USADA8 |
4677 | 608k | 14680064U, // USAT |
4678 | 608k | 0U, // USAT16 |
4679 | 608k | 0U, // USAX |
4680 | 608k | 0U, // USUB16 |
4681 | 608k | 0U, // USUB8 |
4682 | 608k | 12582912U, // UXTAB |
4683 | 608k | 12582912U, // UXTAB16 |
4684 | 608k | 12582912U, // UXTAH |
4685 | 608k | 7168U, // UXTB |
4686 | 608k | 7168U, // UXTB16 |
4687 | 608k | 7168U, // UXTH |
4688 | 608k | 1048U, // VABALsv2i64 |
4689 | 608k | 1048U, // VABALsv4i32 |
4690 | 608k | 1048U, // VABALsv8i16 |
4691 | 608k | 1048U, // VABALuv2i64 |
4692 | 608k | 1048U, // VABALuv4i32 |
4693 | 608k | 1048U, // VABALuv8i16 |
4694 | 608k | 1048U, // VABAsv16i8 |
4695 | 608k | 1048U, // VABAsv2i32 |
4696 | 608k | 1048U, // VABAsv4i16 |
4697 | 608k | 1048U, // VABAsv4i32 |
4698 | 608k | 1048U, // VABAsv8i16 |
4699 | 608k | 1048U, // VABAsv8i8 |
4700 | 608k | 1048U, // VABAuv16i8 |
4701 | 608k | 1048U, // VABAuv2i32 |
4702 | 608k | 1048U, // VABAuv4i16 |
4703 | 608k | 1048U, // VABAuv4i32 |
4704 | 608k | 1048U, // VABAuv8i16 |
4705 | 608k | 1048U, // VABAuv8i8 |
4706 | 608k | 1112U, // VABDLsv2i64 |
4707 | 608k | 1112U, // VABDLsv4i32 |
4708 | 608k | 1112U, // VABDLsv8i16 |
4709 | 608k | 1112U, // VABDLuv2i64 |
4710 | 608k | 1112U, // VABDLuv4i32 |
4711 | 608k | 1112U, // VABDLuv8i16 |
4712 | 608k | 70705U, // VABDfd |
4713 | 608k | 70705U, // VABDfq |
4714 | 608k | 70705U, // VABDhd |
4715 | 608k | 70705U, // VABDhq |
4716 | 608k | 1112U, // VABDsv16i8 |
4717 | 608k | 1112U, // VABDsv2i32 |
4718 | 608k | 1112U, // VABDsv4i16 |
4719 | 608k | 1112U, // VABDsv4i32 |
4720 | 608k | 1112U, // VABDsv8i16 |
4721 | 608k | 1112U, // VABDsv8i8 |
4722 | 608k | 1112U, // VABDuv16i8 |
4723 | 608k | 1112U, // VABDuv2i32 |
4724 | 608k | 1112U, // VABDuv4i16 |
4725 | 608k | 1112U, // VABDuv4i32 |
4726 | 608k | 1112U, // VABDuv8i16 |
4727 | 608k | 1112U, // VABDuv8i8 |
4728 | 608k | 33U, // VABSD |
4729 | 608k | 33U, // VABSH |
4730 | 608k | 33U, // VABSS |
4731 | 608k | 33U, // VABSfd |
4732 | 608k | 33U, // VABSfq |
4733 | 608k | 33U, // VABShd |
4734 | 608k | 33U, // VABShq |
4735 | 608k | 0U, // VABSv16i8 |
4736 | 608k | 0U, // VABSv2i32 |
4737 | 608k | 0U, // VABSv4i16 |
4738 | 608k | 0U, // VABSv4i32 |
4739 | 608k | 0U, // VABSv8i16 |
4740 | 608k | 0U, // VABSv8i8 |
4741 | 608k | 70705U, // VACGEfd |
4742 | 608k | 70705U, // VACGEfq |
4743 | 608k | 70705U, // VACGEhd |
4744 | 608k | 70705U, // VACGEhq |
4745 | 608k | 70705U, // VACGTfd |
4746 | 608k | 70705U, // VACGTfq |
4747 | 608k | 70705U, // VACGThd |
4748 | 608k | 70705U, // VACGThq |
4749 | 608k | 70705U, // VADDD |
4750 | 608k | 70705U, // VADDH |
4751 | 608k | 1112U, // VADDHNv2i32 |
4752 | 608k | 1112U, // VADDHNv4i16 |
4753 | 608k | 1112U, // VADDHNv8i8 |
4754 | 608k | 1112U, // VADDLsv2i64 |
4755 | 608k | 1112U, // VADDLsv4i32 |
4756 | 608k | 1112U, // VADDLsv8i16 |
4757 | 608k | 1112U, // VADDLuv2i64 |
4758 | 608k | 1112U, // VADDLuv4i32 |
4759 | 608k | 1112U, // VADDLuv8i16 |
4760 | 608k | 70705U, // VADDS |
4761 | 608k | 1112U, // VADDWsv2i64 |
4762 | 608k | 1112U, // VADDWsv4i32 |
4763 | 608k | 1112U, // VADDWsv8i16 |
4764 | 608k | 1112U, // VADDWuv2i64 |
4765 | 608k | 1112U, // VADDWuv4i32 |
4766 | 608k | 1112U, // VADDWuv8i16 |
4767 | 608k | 70705U, // VADDfd |
4768 | 608k | 70705U, // VADDfq |
4769 | 608k | 70705U, // VADDhd |
4770 | 608k | 70705U, // VADDhq |
4771 | 608k | 1112U, // VADDv16i8 |
4772 | 608k | 1112U, // VADDv1i64 |
4773 | 608k | 1112U, // VADDv2i32 |
4774 | 608k | 1112U, // VADDv2i64 |
4775 | 608k | 1112U, // VADDv4i16 |
4776 | 608k | 1112U, // VADDv4i32 |
4777 | 608k | 1112U, // VADDv8i16 |
4778 | 608k | 1112U, // VADDv8i8 |
4779 | 608k | 0U, // VANDd |
4780 | 608k | 0U, // VANDq |
4781 | 608k | 0U, // VBICd |
4782 | 608k | 0U, // VBICiv2i32 |
4783 | 608k | 0U, // VBICiv4i16 |
4784 | 608k | 0U, // VBICiv4i32 |
4785 | 608k | 0U, // VBICiv8i16 |
4786 | 608k | 0U, // VBICq |
4787 | 608k | 589912U, // VBIFd |
4788 | 608k | 589912U, // VBIFq |
4789 | 608k | 589912U, // VBITd |
4790 | 608k | 589912U, // VBITq |
4791 | 608k | 589912U, // VBSLd |
4792 | 608k | 589912U, // VBSLq |
4793 | 608k | 622680U, // VCADDv2f32 |
4794 | 608k | 622680U, // VCADDv4f16 |
4795 | 608k | 622680U, // VCADDv4f32 |
4796 | 608k | 622680U, // VCADDv8f16 |
4797 | 608k | 70705U, // VCEQfd |
4798 | 608k | 70705U, // VCEQfq |
4799 | 608k | 70705U, // VCEQhd |
4800 | 608k | 70705U, // VCEQhq |
4801 | 608k | 1112U, // VCEQv16i8 |
4802 | 608k | 1112U, // VCEQv2i32 |
4803 | 608k | 1112U, // VCEQv4i16 |
4804 | 608k | 1112U, // VCEQv4i32 |
4805 | 608k | 1112U, // VCEQv8i16 |
4806 | 608k | 1112U, // VCEQv8i8 |
4807 | 608k | 3U, // VCEQzv16i8 |
4808 | 608k | 225U, // VCEQzv2f32 |
4809 | 608k | 3U, // VCEQzv2i32 |
4810 | 608k | 225U, // VCEQzv4f16 |
4811 | 608k | 225U, // VCEQzv4f32 |
4812 | 608k | 3U, // VCEQzv4i16 |
4813 | 608k | 3U, // VCEQzv4i32 |
4814 | 608k | 225U, // VCEQzv8f16 |
4815 | 608k | 3U, // VCEQzv8i16 |
4816 | 608k | 3U, // VCEQzv8i8 |
4817 | 608k | 70705U, // VCGEfd |
4818 | 608k | 70705U, // VCGEfq |
4819 | 608k | 70705U, // VCGEhd |
4820 | 608k | 70705U, // VCGEhq |
4821 | 608k | 1112U, // VCGEsv16i8 |
4822 | 608k | 1112U, // VCGEsv2i32 |
4823 | 608k | 1112U, // VCGEsv4i16 |
4824 | 608k | 1112U, // VCGEsv4i32 |
4825 | 608k | 1112U, // VCGEsv8i16 |
4826 | 608k | 1112U, // VCGEsv8i8 |
4827 | 608k | 1112U, // VCGEuv16i8 |
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5295 | 608k | 834820U, // VLD3DUPd8_UPD |
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5307 | 608k | 834820U, // VLD3DUPq8_UPD |
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5312 | 608k | 865532U, // VLD3LNd32 |
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5315 | 608k | 896268U, // VLD3LNd32_UPD |
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5318 | 608k | 0U, // VLD3LNd8Pseudo_UPD |
5319 | 608k | 896268U, // VLD3LNd8_UPD |
5320 | 608k | 865532U, // VLD3LNq16 |
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5322 | 608k | 0U, // VLD3LNq16Pseudo_UPD |
5323 | 608k | 896268U, // VLD3LNq16_UPD |
5324 | 608k | 865532U, // VLD3LNq32 |
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5326 | 608k | 0U, // VLD3LNq32Pseudo_UPD |
5327 | 608k | 896268U, // VLD3LNq32_UPD |
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5330 | 608k | 0U, // VLD3d16Pseudo_UPD |
5331 | 608k | 153092096U, // VLD3d16_UPD |
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5334 | 608k | 0U, // VLD3d32Pseudo_UPD |
5335 | 608k | 153092096U, // VLD3d32_UPD |
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5337 | 608k | 0U, // VLD3d8Pseudo |
5338 | 608k | 0U, // VLD3d8Pseudo_UPD |
5339 | 608k | 153092096U, // VLD3d8_UPD |
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5347 | 608k | 153092096U, // VLD3q32_UPD |
5348 | 608k | 0U, // VLD3q32oddPseudo |
5349 | 608k | 0U, // VLD3q32oddPseudo_UPD |
5350 | 608k | 119537664U, // VLD3q8 |
5351 | 608k | 0U, // VLD3q8Pseudo_UPD |
5352 | 608k | 153092096U, // VLD3q8_UPD |
5353 | 608k | 0U, // VLD3q8oddPseudo |
5354 | 608k | 0U, // VLD3q8oddPseudo_UPD |
5355 | 608k | 81172U, // VLD4DUPd16 |
5356 | 608k | 0U, // VLD4DUPd16Pseudo |
5357 | 608k | 0U, // VLD4DUPd16Pseudo_UPD |
5358 | 608k | 16660U, // VLD4DUPd16_UPD |
5359 | 608k | 81172U, // VLD4DUPd32 |
5360 | 608k | 0U, // VLD4DUPd32Pseudo |
5361 | 608k | 0U, // VLD4DUPd32Pseudo_UPD |
5362 | 608k | 16660U, // VLD4DUPd32_UPD |
5363 | 608k | 81172U, // VLD4DUPd8 |
5364 | 608k | 0U, // VLD4DUPd8Pseudo |
5365 | 608k | 0U, // VLD4DUPd8Pseudo_UPD |
5366 | 608k | 16660U, // VLD4DUPd8_UPD |
5367 | 608k | 81172U, // VLD4DUPq16 |
5368 | 608k | 0U, // VLD4DUPq16EvenPseudo |
5369 | 608k | 0U, // VLD4DUPq16OddPseudo |
5370 | 608k | 16660U, // VLD4DUPq16_UPD |
5371 | 608k | 81172U, // VLD4DUPq32 |
5372 | 608k | 0U, // VLD4DUPq32EvenPseudo |
5373 | 608k | 0U, // VLD4DUPq32OddPseudo |
5374 | 608k | 16660U, // VLD4DUPq32_UPD |
5375 | 608k | 81172U, // VLD4DUPq8 |
5376 | 608k | 0U, // VLD4DUPq8EvenPseudo |
5377 | 608k | 0U, // VLD4DUPq8OddPseudo |
5378 | 608k | 16660U, // VLD4DUPq8_UPD |
5379 | 608k | 189346060U, // VLD4LNd16 |
5380 | 608k | 0U, // VLD4LNd16Pseudo |
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5382 | 608k | 284U, // VLD4LNd16_UPD |
5383 | 608k | 189346060U, // VLD4LNd32 |
5384 | 608k | 0U, // VLD4LNd32Pseudo |
5385 | 608k | 0U, // VLD4LNd32Pseudo_UPD |
5386 | 608k | 284U, // VLD4LNd32_UPD |
5387 | 608k | 189346060U, // VLD4LNd8 |
5388 | 608k | 0U, // VLD4LNd8Pseudo |
5389 | 608k | 0U, // VLD4LNd8Pseudo_UPD |
5390 | 608k | 284U, // VLD4LNd8_UPD |
5391 | 608k | 189346060U, // VLD4LNq16 |
5392 | 608k | 0U, // VLD4LNq16Pseudo |
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5394 | 608k | 284U, // VLD4LNq16_UPD |
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6496 | 608k | 20592U, // sysSTMDA |
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6503 | 608k | 401U, // sysSTMIB_UPD |
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6510 | 608k | 1048576U, // t2ADDrs |
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6654 | 608k | 0U, // t2MSRbanked |
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6749 | 608k | 35651584U, // t2SMULL |
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6752 | 608k | 0U, // t2SMULWB |
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6759 | 608k | 0U, // t2SRSIA_UPD |
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6769 | 608k | 122U, // t2STC2_OFFSET |
6770 | 608k | 196738U, // t2STC2_OPTION |
6771 | 608k | 229506U, // t2STC2_POST |
6772 | 608k | 138U, // t2STC2_PRE |
6773 | 608k | 122U, // t2STCL_OFFSET |
6774 | 608k | 196738U, // t2STCL_OPTION |
6775 | 608k | 229506U, // t2STCL_POST |
6776 | 608k | 138U, // t2STCL_PRE |
6777 | 608k | 122U, // t2STC_OFFSET |
6778 | 608k | 196738U, // t2STC_OPTION |
6779 | 608k | 229506U, // t2STC_POST |
6780 | 608k | 138U, // t2STC_PRE |
6781 | 608k | 8U, // t2STL |
6782 | 608k | 8U, // t2STLB |
6783 | 608k | 557056U, // t2STLEX |
6784 | 608k | 557056U, // t2STLEXB |
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6786 | 608k | 557056U, // t2STLEXH |
6787 | 608k | 8U, // t2STLH |
6788 | 608k | 1136U, // t2STMDB |
6789 | 608k | 33U, // t2STMDB_UPD |
6790 | 608k | 1136U, // t2STMIA |
6791 | 608k | 33U, // t2STMIA_UPD |
6792 | 608k | 408U, // t2STRBT |
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6794 | 608k | 416U, // t2STRB_PRE |
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6796 | 608k | 408U, // t2STRBi8 |
6797 | 608k | 432U, // t2STRBs |
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6799 | 608k | 1114200U, // t2STRD_PRE |
6800 | 608k | 1146880U, // t2STRDi8 |
6801 | 608k | 1179648U, // t2STREX |
6802 | 608k | 557056U, // t2STREXB |
6803 | 608k | 371195904U, // t2STREXD |
6804 | 608k | 557056U, // t2STREXH |
6805 | 608k | 408U, // t2STRHT |
6806 | 608k | 21632U, // t2STRH_POST |
6807 | 608k | 416U, // t2STRH_PRE |
6808 | 608k | 160U, // t2STRHi12 |
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6810 | 608k | 432U, // t2STRHs |
6811 | 608k | 408U, // t2STRT |
6812 | 608k | 21632U, // t2STR_POST |
6813 | 608k | 416U, // t2STR_PRE |
6814 | 608k | 160U, // t2STRi12 |
6815 | 608k | 408U, // t2STRi8 |
6816 | 608k | 432U, // t2STRs |
6817 | 608k | 0U, // t2SUBS_PC_LR |
6818 | 608k | 0U, // t2SUBri |
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6820 | 608k | 0U, // t2SUBrr |
6821 | 608k | 1048576U, // t2SUBrs |
6822 | 608k | 12582912U, // t2SXTAB |
6823 | 608k | 12582912U, // t2SXTAB16 |
6824 | 608k | 12582912U, // t2SXTAH |
6825 | 608k | 7168U, // t2SXTB |
6826 | 608k | 7168U, // t2SXTB16 |
6827 | 608k | 7168U, // t2SXTH |
6828 | 608k | 0U, // t2TBB |
6829 | 608k | 0U, // t2TBH |
6830 | 608k | 1024U, // t2TEQri |
6831 | 608k | 1024U, // t2TEQrr |
6832 | 608k | 56U, // t2TEQrs |
6833 | 608k | 0U, // t2TSB |
6834 | 608k | 1024U, // t2TSTri |
6835 | 608k | 1024U, // t2TSTrr |
6836 | 608k | 56U, // t2TSTrs |
6837 | 608k | 1024U, // t2TT |
6838 | 608k | 1024U, // t2TTA |
6839 | 608k | 1024U, // t2TTAT |
6840 | 608k | 1024U, // t2TTT |
6841 | 608k | 0U, // t2UADD16 |
6842 | 608k | 0U, // t2UADD8 |
6843 | 608k | 0U, // t2UASX |
6844 | 608k | 69206016U, // t2UBFX |
6845 | 608k | 0U, // t2UDF |
6846 | 608k | 0U, // t2UDIV |
6847 | 608k | 0U, // t2UHADD16 |
6848 | 608k | 0U, // t2UHADD8 |
6849 | 608k | 0U, // t2UHASX |
6850 | 608k | 0U, // t2UHSAX |
6851 | 608k | 0U, // t2UHSUB16 |
6852 | 608k | 0U, // t2UHSUB8 |
6853 | 608k | 35651584U, // t2UMAAL |
6854 | 608k | 35651584U, // t2UMLAL |
6855 | 608k | 35651584U, // t2UMULL |
6856 | 608k | 0U, // t2UQADD16 |
6857 | 608k | 0U, // t2UQADD8 |
6858 | 608k | 0U, // t2UQASX |
6859 | 608k | 0U, // t2UQSAX |
6860 | 608k | 0U, // t2UQSUB16 |
6861 | 608k | 0U, // t2UQSUB8 |
6862 | 608k | 0U, // t2USAD8 |
6863 | 608k | 35651584U, // t2USADA8 |
6864 | 608k | 14680064U, // t2USAT |
6865 | 608k | 0U, // t2USAT16 |
6866 | 608k | 0U, // t2USAX |
6867 | 608k | 0U, // t2USUB16 |
6868 | 608k | 0U, // t2USUB8 |
6869 | 608k | 12582912U, // t2UXTAB |
6870 | 608k | 12582912U, // t2UXTAB16 |
6871 | 608k | 12582912U, // t2UXTAH |
6872 | 608k | 7168U, // t2UXTB |
6873 | 608k | 7168U, // t2UXTB16 |
6874 | 608k | 7168U, // t2UXTH |
6875 | 608k | 0U, // tADC |
6876 | 608k | 1112U, // tADDhirr |
6877 | 608k | 1048U, // tADDi3 |
6878 | 608k | 0U, // tADDi8 |
6879 | 608k | 0U, // tADDrSP |
6880 | 608k | 1212416U, // tADDrSPi |
6881 | 608k | 1048U, // tADDrr |
6882 | 608k | 456U, // tADDspi |
6883 | 608k | 1112U, // tADDspr |
6884 | 608k | 464U, // tADR |
6885 | 608k | 0U, // tAND |
6886 | 608k | 472U, // tASRri |
6887 | 608k | 0U, // tASRrr |
6888 | 608k | 0U, // tB |
6889 | 608k | 0U, // tBIC |
6890 | 608k | 0U, // tBKPT |
6891 | 608k | 0U, // tBL |
6892 | 608k | 0U, // tBLXNSr |
6893 | 608k | 0U, // tBLXi |
6894 | 608k | 0U, // tBLXr |
6895 | 608k | 0U, // tBX |
6896 | 608k | 0U, // tBXNS |
6897 | 608k | 0U, // tBcc |
6898 | 608k | 0U, // tCBNZ |
6899 | 608k | 0U, // tCBZ |
6900 | 608k | 1024U, // tCMNz |
6901 | 608k | 1024U, // tCMPhir |
6902 | 608k | 1024U, // tCMPi8 |
6903 | 608k | 1024U, // tCMPr |
6904 | 608k | 0U, // tCPS |
6905 | 608k | 0U, // tEOR |
6906 | 608k | 0U, // tHINT |
6907 | 608k | 0U, // tHLT |
6908 | 608k | 0U, // tInt_WIN_eh_sjlj_longjmp |
6909 | 608k | 0U, // tInt_eh_sjlj_longjmp |
6910 | 608k | 0U, // tInt_eh_sjlj_setjmp |
6911 | 608k | 1136U, // tLDMIA |
6912 | 608k | 480U, // tLDRBi |
6913 | 608k | 488U, // tLDRBr |
6914 | 608k | 496U, // tLDRHi |
6915 | 608k | 488U, // tLDRHr |
6916 | 608k | 488U, // tLDRSB |
6917 | 608k | 488U, // tLDRSH |
6918 | 608k | 504U, // tLDRi |
6919 | 608k | 424U, // tLDRpci |
6920 | 608k | 488U, // tLDRr |
6921 | 608k | 512U, // tLDRspi |
6922 | 608k | 1048U, // tLSLri |
6923 | 608k | 0U, // tLSLrr |
6924 | 608k | 472U, // tLSRri |
6925 | 608k | 0U, // tLSRrr |
6926 | 608k | 0U, // tMOVSr |
6927 | 608k | 0U, // tMOVi8 |
6928 | 608k | 1024U, // tMOVr |
6929 | 608k | 1048U, // tMUL |
6930 | 608k | 0U, // tMVN |
6931 | 608k | 0U, // tORR |
6932 | 608k | 0U, // tPICADD |
6933 | 608k | 0U, // tPOP |
6934 | 608k | 0U, // tPUSH |
6935 | 608k | 1024U, // tREV |
6936 | 608k | 1024U, // tREV16 |
6937 | 608k | 1024U, // tREVSH |
6938 | 608k | 0U, // tROR |
6939 | 608k | 0U, // tRSB |
6940 | 608k | 0U, // tSBC |
6941 | 608k | 0U, // tSETEND |
6942 | 608k | 33U, // tSTMIA_UPD |
6943 | 608k | 480U, // tSTRBi |
6944 | 608k | 488U, // tSTRBr |
6945 | 608k | 496U, // tSTRHi |
6946 | 608k | 488U, // tSTRHr |
6947 | 608k | 504U, // tSTRi |
6948 | 608k | 488U, // tSTRr |
6949 | 608k | 512U, // tSTRspi |
6950 | 608k | 1048U, // tSUBi3 |
6951 | 608k | 0U, // tSUBi8 |
6952 | 608k | 1048U, // tSUBrr |
6953 | 608k | 456U, // tSUBspi |
6954 | 608k | 0U, // tSVC |
6955 | 608k | 1024U, // tSXTB |
6956 | 608k | 1024U, // tSXTH |
6957 | 608k | 0U, // tTRAP |
6958 | 608k | 1024U, // tTST |
6959 | 608k | 0U, // tUDF |
6960 | 608k | 1024U, // tUXTB |
6961 | 608k | 1024U, // tUXTH |
6962 | 608k | 0U, // t__brkdiv0 |
6963 | 608k | }; |
6964 | | |
6965 | 608k | unsigned int opcode = MCInst_getOpcode(MI); |
6966 | | // printf("opcode = %u\n", opcode); |
6967 | | |
6968 | | // Emit the opcode for the instruction. |
6969 | 608k | uint64_t Bits = 0; |
6970 | 608k | Bits |= (uint64_t)OpInfo0[opcode] << 0; |
6971 | 608k | Bits |= (uint64_t)OpInfo1[opcode] << 32; |
6972 | 608k | #ifndef CAPSTONE_DIET |
6973 | 608k | SStream_concat0(O, AsmStrs+(Bits & 4095)-1); |
6974 | 608k | #endif |
6975 | | |
6976 | | |
6977 | | // Fragment 0 encoded into 5 bits for 32 unique commands. |
6978 | | // printf("Fragment 0: %"PRIu64"\n", ((Bits >> 12) & 31)); |
6979 | 608k | switch ((Bits >> 12) & 31) { |
6980 | 0 | default: // unreachable |
6981 | 13 | case 0: |
6982 | | // DBG_VALUE, DBG_LABEL, BUNDLE, LIFETIME_START, LIFETIME_END, FENTRY_CAL... |
6983 | 13 | return; |
6984 | 0 | break; |
6985 | 18.7k | case 1: |
6986 | | // ASRi, ASRr, LSLi, LSLr, LSRi, LSRr, RORi, RORr, ADCri, ADCrr, ADDri, A... |
6987 | 18.7k | printSBitModifierOperand(MI, 5, O); |
6988 | 18.7k | printPredicateOperand(MI, 3, O); |
6989 | 18.7k | break; |
6990 | 6.68k | case 2: |
6991 | | // ITasm, t2IT |
6992 | 6.68k | printThumbITMask(MI, 1, O); |
6993 | 6.68k | break; |
6994 | 66.0k | case 3: |
6995 | | // LDRBT_POST, LDRConstPool, LDRT_POST, STRBT_POST, STRT_POST, t2LDRBpcre... |
6996 | 66.0k | printPredicateOperand(MI, 2, O); |
6997 | 66.0k | break; |
6998 | 1.98k | case 4: |
6999 | | // RRXi, MOVi, MOVr, MOVr_TC, MVNi, MVNr, t2MOVi, t2MOVr, t2MVNi, t2MVNr,... |
7000 | 1.98k | printSBitModifierOperand(MI, 4, O); |
7001 | 1.98k | printPredicateOperand(MI, 2, O); |
7002 | 1.98k | break; |
7003 | 49.7k | case 5: |
7004 | | // VLD1LNdAsm_16, VLD1LNdAsm_32, VLD1LNdAsm_8, VLD1LNdWB_fixed_Asm_16, VL... |
7005 | 49.7k | printPredicateOperand(MI, 4, O); |
7006 | 49.7k | break; |
7007 | 36.7k | case 6: |
7008 | | // VLD1LNdWB_register_Asm_16, VLD1LNdWB_register_Asm_32, VLD1LNdWB_regist... |
7009 | 36.7k | printPredicateOperand(MI, 5, O); |
7010 | 36.7k | break; |
7011 | 145k | case 7: |
7012 | | // VLD3DUPdAsm_16, VLD3DUPdAsm_32, VLD3DUPdAsm_8, VLD3DUPdWB_fixed_Asm_16... |
7013 | 145k | printPredicateOperand(MI, 3, O); |
7014 | 145k | break; |
7015 | 11.8k | case 8: |
7016 | | // ADCrsi, ADDrsi, ANDrsi, BICrsi, EORrsi, MLA, MOVsr, MVNsr, ORRrsi, RSB... |
7017 | 11.8k | printSBitModifierOperand(MI, 6, O); |
7018 | 11.8k | printPredicateOperand(MI, 4, O); |
7019 | 11.8k | break; |
7020 | 4.71k | case 9: |
7021 | | // ADCrsr, ADDrsr, ANDrsr, BICrsr, EORrsr, ORRrsr, RSBrsr, RSCrsr, SBCrsr... |
7022 | 4.71k | printSBitModifierOperand(MI, 7, O); |
7023 | 4.71k | printPredicateOperand(MI, 5, O); |
7024 | 4.71k | SStream_concat0(O, "\t"); |
7025 | 4.71k | printOperand(MI, 0, O); |
7026 | 4.71k | SStream_concat0(O, ", "); |
7027 | 4.71k | printOperand(MI, 1, O); |
7028 | 4.71k | SStream_concat0(O, ", "); |
7029 | 4.71k | printSORegRegOperand(MI, 2, O); |
7030 | 4.71k | return; |
7031 | 0 | break; |
7032 | 61.0k | case 10: |
7033 | | // AESD, AESE, AESIMC, AESMC, BKPT, BL, BLX, BLXi, BX, CPS1p, CRC32B, CRC... |
7034 | 61.0k | printOperand(MI, 0, O); |
7035 | 61.0k | break; |
7036 | 49.1k | case 11: |
7037 | | // BLX_pred, BL_pred, BXJ, BX_pred, Bcc, DBG, FLDMXIA, FSTMXIA, HINT, LDM... |
7038 | 49.1k | printPredicateOperand(MI, 1, O); |
7039 | 49.1k | break; |
7040 | 6.06k | case 12: |
7041 | | // BX_RET, ERET, FMSTAT, MOVPCLR, t2CLREX, t2DCPS1, t2DCPS2, t2DCPS3, t2S... |
7042 | 6.06k | printPredicateOperand(MI, 0, O); |
7043 | 6.06k | break; |
7044 | 12.1k | case 13: |
7045 | | // CDP, LDRD_POST, LDRD_PRE, MCR, MRC, SMLALBB, SMLALBT, SMLALD, SMLALDX,... |
7046 | 12.1k | printPredicateOperand(MI, 6, O); |
7047 | 12.1k | break; |
7048 | 4.67k | case 14: |
7049 | | // CDP2, LDC2L_OFFSET, LDC2L_OPTION, LDC2L_POST, LDC2L_PRE, LDC2_OFFSET, ... |
7050 | 4.67k | printPImmediate(MI, 0, O); |
7051 | 4.67k | SStream_concat0(O, ", "); |
7052 | 4.67k | break; |
7053 | 1.60k | case 15: |
7054 | | // CPS2p, CPS3p, t2CPS2p, t2CPS3p, tCPS |
7055 | 1.60k | printCPSIMod(MI, 0, O); |
7056 | 1.60k | break; |
7057 | 252 | case 16: |
7058 | | // DMB, DSB |
7059 | 252 | printMemBOption(MI, 0, O); |
7060 | 252 | return; |
7061 | 0 | break; |
7062 | 282 | case 17: |
7063 | | // ISB |
7064 | 282 | printInstSyncBOption(MI, 0, O); |
7065 | 282 | return; |
7066 | 0 | break; |
7067 | 1.11k | case 18: |
7068 | | // MRC2 |
7069 | 1.11k | printPImmediate(MI, 1, O); |
7070 | 1.11k | SStream_concat0(O, ", "); |
7071 | 1.11k | printOperand(MI, 2, O); |
7072 | 1.11k | SStream_concat0(O, ", "); |
7073 | 1.11k | printOperand(MI, 0, O); |
7074 | 1.11k | SStream_concat0(O, ", "); |
7075 | 1.11k | printCImmediate(MI, 3, O); |
7076 | 1.11k | SStream_concat0(O, ", "); |
7077 | 1.11k | printCImmediate(MI, 4, O); |
7078 | 1.11k | SStream_concat0(O, ", "); |
7079 | 1.11k | printOperand(MI, 5, O); |
7080 | 1.11k | return; |
7081 | 0 | break; |
7082 | 341 | case 19: |
7083 | | // MRRC2 |
7084 | 341 | printPImmediate(MI, 2, O); |
7085 | 341 | SStream_concat0(O, ", "); |
7086 | 341 | printOperand(MI, 3, O); |
7087 | 341 | SStream_concat0(O, ", "); |
7088 | 341 | printOperand(MI, 0, O); |
7089 | 341 | SStream_concat0(O, ", "); |
7090 | 341 | printOperand(MI, 1, O); |
7091 | 341 | SStream_concat0(O, ", "); |
7092 | 341 | printCImmediate(MI, 4, O); |
7093 | 341 | return; |
7094 | 0 | break; |
7095 | 42 | case 20: |
7096 | | // PLDWi12, PLDi12, PLIi12 |
7097 | 42 | printAddrModeImm12Operand(MI, 0, O, false); |
7098 | 42 | return; |
7099 | 0 | break; |
7100 | 24 | case 21: |
7101 | | // PLDWrs, PLDrs, PLIrs |
7102 | 24 | printAddrMode2Operand(MI, 0, O); |
7103 | 24 | return; |
7104 | 0 | break; |
7105 | 111 | case 22: |
7106 | | // SETEND, tSETEND |
7107 | 111 | printSetendOperand(MI, 0, O); |
7108 | 111 | return; |
7109 | 0 | break; |
7110 | 357 | case 23: |
7111 | | // SMLAL, UMLAL |
7112 | 357 | printSBitModifierOperand(MI, 8, O); |
7113 | 357 | printPredicateOperand(MI, 6, O); |
7114 | 357 | SStream_concat0(O, "\t"); |
7115 | 357 | printOperand(MI, 0, O); |
7116 | 357 | SStream_concat0(O, ", "); |
7117 | 357 | printOperand(MI, 1, O); |
7118 | 357 | SStream_concat0(O, ", "); |
7119 | 357 | printOperand(MI, 2, O); |
7120 | 357 | SStream_concat0(O, ", "); |
7121 | 357 | printOperand(MI, 3, O); |
7122 | 357 | return; |
7123 | 0 | break; |
7124 | 0 | case 24: |
7125 | | // TSB |
7126 | 0 | printTraceSyncBOption(MI, 0, O); |
7127 | 0 | return; |
7128 | 0 | break; |
7129 | 4.72k | case 25: |
7130 | | // VLD1LNd16_UPD, VLD1LNd32_UPD, VLD1LNd8_UPD, VLD2LNd16, VLD2LNd32, VLD2... |
7131 | 4.72k | printPredicateOperand(MI, 7, O); |
7132 | 4.72k | break; |
7133 | 1.73k | case 26: |
7134 | | // VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_UPD, VLD2LNq32_U... |
7135 | 1.73k | printPredicateOperand(MI, 9, O); |
7136 | 1.73k | break; |
7137 | 651 | case 27: |
7138 | | // VLD3LNd16_UPD, VLD3LNd32_UPD, VLD3LNd8_UPD, VLD3LNq16_UPD, VLD3LNq32_U... |
7139 | 651 | printPredicateOperand(MI, 11, O); |
7140 | 651 | break; |
7141 | 3.48k | case 28: |
7142 | | // VLD4DUPd16_UPD, VLD4DUPd32_UPD, VLD4DUPd8_UPD, VLD4DUPq16_UPD, VLD4DUP... |
7143 | 3.48k | printPredicateOperand(MI, 8, O); |
7144 | 3.48k | break; |
7145 | 1.06k | case 29: |
7146 | | // VLD4LNd16_UPD, VLD4LNd32_UPD, VLD4LNd8_UPD, VLD4LNq16_UPD, VLD4LNq32_U... |
7147 | 1.06k | printPredicateOperand(MI, 13, O); |
7148 | 1.06k | break; |
7149 | 266 | case 30: |
7150 | | // VSDOTD, VSDOTDI, VSDOTQ, VSDOTQI, VUDOTD, VUDOTDI, VUDOTQ, VUDOTQI |
7151 | 266 | printOperand(MI, 1, O); |
7152 | 266 | SStream_concat0(O, ", "); |
7153 | 266 | printOperand(MI, 2, O); |
7154 | 266 | SStream_concat0(O, ", "); |
7155 | 266 | printOperand(MI, 3, O); |
7156 | 266 | break; |
7157 | 117k | case 31: |
7158 | | // tADC, tADDi3, tADDi8, tADDrr, tAND, tASRri, tASRrr, tBIC, tEOR, tLSLri... |
7159 | 117k | printSBitModifierOperand(MI, 1, O); |
7160 | 117k | break; |
7161 | 608k | } |
7162 | | |
7163 | | |
7164 | | // Fragment 1 encoded into 7 bits for 75 unique commands. |
7165 | | // printf("Fragment 1: %"PRIu64"\n", ((Bits >> 17) & 127)); |
7166 | 601k | switch ((Bits >> 17) & 127) { |
7167 | 0 | default: // unreachable |
7168 | 109 | case 0: |
7169 | | // ASRi, ASRr, ITasm, LDRBT_POST, LDRConstPool, LDRT_POST, LSLi, LSLr, LS... |
7170 | 109 | SStream_concat0(O, " "); |
7171 | 109 | break; |
7172 | 6.10k | case 1: |
7173 | | // VLD1LNdAsm_16, VLD1LNdWB_fixed_Asm_16, VLD1LNdWB_register_Asm_16, VLD2... |
7174 | 6.10k | SStream_concat0(O, ".16\t"); |
7175 | 6.10k | ARM_addVectorDataSize(MI, 16); |
7176 | 6.10k | break; |
7177 | 5.60k | case 2: |
7178 | | // VLD1LNdAsm_32, VLD1LNdWB_fixed_Asm_32, VLD1LNdWB_register_Asm_32, VLD2... |
7179 | 5.60k | SStream_concat0(O, ".32\t"); |
7180 | 5.60k | ARM_addVectorDataSize(MI, 32); |
7181 | 5.60k | break; |
7182 | 7.82k | case 3: |
7183 | | // VLD1LNdAsm_8, VLD1LNdWB_fixed_Asm_8, VLD1LNdWB_register_Asm_8, VLD2LNd... |
7184 | 7.82k | SStream_concat0(O, ".8\t"); |
7185 | 7.82k | ARM_addVectorDataSize(MI, 8); |
7186 | 7.82k | break; |
7187 | 346k | case 4: |
7188 | | // ADCri, ADCrr, ADCrsi, ADDri, ADDrr, ADDrsi, ADR, ANDri, ANDrr, ANDrsi,... |
7189 | 346k | SStream_concat0(O, "\t"); |
7190 | 346k | break; |
7191 | 56.2k | case 5: |
7192 | | // AESD, AESE, AESIMC, AESMC, CRC32B, CRC32CB, CRC32CH, CRC32CW, CRC32H, ... |
7193 | 56.2k | SStream_concat0(O, ", "); |
7194 | 56.2k | break; |
7195 | 4.55k | case 6: |
7196 | | // BKPT, BL, BLX, BLXi, BX, CPS1p, ERET, HLT, HVC, RFEDA, RFEDB, RFEIA, R... |
7197 | 4.55k | return; |
7198 | 0 | break; |
7199 | 6 | case 7: |
7200 | | // BX_RET |
7201 | 6 | SStream_concat0(O, "\tlr"); |
7202 | 6 | ARM_addReg(MI, ARM_REG_LR); |
7203 | 6 | return; |
7204 | 0 | break; |
7205 | 1.59k | case 8: |
7206 | | // CDP2, MCR2, MCRR2 |
7207 | 1.59k | printOperand(MI, 1, O); |
7208 | 1.59k | SStream_concat0(O, ", "); |
7209 | 1.59k | break; |
7210 | 719 | case 9: |
7211 | | // FCONSTD, VABSD, VADDD, VCMPD, VCMPED, VCMPEZD, VCMPZD, VDIVD, VFMAD, V... |
7212 | 719 | SStream_concat0(O, ".f64\t"); |
7213 | 719 | ARM_addVectorDataType(MI, ARM_VECTORDATA_F64); |
7214 | 719 | printOperand(MI, 0, O); |
7215 | 719 | break; |
7216 | 704 | case 10: |
7217 | | // FCONSTH, VABDhd, VABDhq, VABSH, VABShd, VABShq, VACGEhd, VACGEhq, VACG... |
7218 | 704 | SStream_concat0(O, ".f16\t"); |
7219 | 704 | ARM_addVectorDataType(MI, ARM_VECTORDATA_F16); |
7220 | 704 | printOperand(MI, 0, O); |
7221 | 704 | break; |
7222 | 1.56k | case 11: |
7223 | | // FCONSTS, VABDfd, VABDfq, VABSS, VABSfd, VABSfq, VACGEfd, VACGEfq, VACG... |
7224 | 1.56k | SStream_concat0(O, ".f32\t"); |
7225 | 1.56k | ARM_addVectorDataType(MI, ARM_VECTORDATA_F32); |
7226 | 1.56k | printOperand(MI, 0, O); |
7227 | 1.56k | break; |
7228 | 10 | case 12: |
7229 | | // FMSTAT |
7230 | 10 | SStream_concat0(O, "\tapsr_nzcv, fpscr"); |
7231 | 10 | ARM_addReg(MI, ARM_REG_APSR_NZCV); |
7232 | 10 | ARM_addReg(MI, ARM_REG_FPSCR); |
7233 | 10 | return; |
7234 | 0 | break; |
7235 | 3.07k | case 13: |
7236 | | // LDC2L_OFFSET, LDC2L_OPTION, LDC2L_POST, LDC2L_PRE, LDC2_OFFSET, LDC2_O... |
7237 | 3.07k | printCImmediate(MI, 1, O); |
7238 | 3.07k | SStream_concat0(O, ", "); |
7239 | 3.07k | break; |
7240 | 12 | case 14: |
7241 | | // MOVPCLR |
7242 | 12 | SStream_concat0(O, "\tpc, lr"); |
7243 | 12 | ARM_addReg(MI, ARM_REG_PC); |
7244 | 12 | ARM_addReg(MI, ARM_REG_LR); |
7245 | 12 | return; |
7246 | 0 | break; |
7247 | 359 | case 15: |
7248 | | // RFEDA_UPD, RFEDB_UPD, RFEIA_UPD, RFEIB_UPD |
7249 | 359 | SStream_concat0(O, "!"); |
7250 | 359 | return; |
7251 | 0 | break; |
7252 | 1.49k | case 16: |
7253 | | // VABALsv2i64, VABAsv2i32, VABAsv4i32, VABDLsv2i64, VABDsv2i32, VABDsv4i... |
7254 | 1.49k | SStream_concat0(O, ".s32\t"); |
7255 | 1.49k | ARM_addVectorDataType(MI, ARM_VECTORDATA_S32); |
7256 | 1.49k | printOperand(MI, 0, O); |
7257 | 1.49k | SStream_concat0(O, ", "); |
7258 | 1.49k | break; |
7259 | 1.08k | case 17: |
7260 | | // VABALsv4i32, VABAsv4i16, VABAsv8i16, VABDLsv4i32, VABDsv4i16, VABDsv8i... |
7261 | 1.08k | SStream_concat0(O, ".s16\t"); |
7262 | 1.08k | ARM_addVectorDataType(MI, ARM_VECTORDATA_S16); |
7263 | 1.08k | printOperand(MI, 0, O); |
7264 | 1.08k | SStream_concat0(O, ", "); |
7265 | 1.08k | break; |
7266 | 498 | case 18: |
7267 | | // VABALsv8i16, VABAsv16i8, VABAsv8i8, VABDLsv8i16, VABDsv16i8, VABDsv8i8... |
7268 | 498 | SStream_concat0(O, ".s8\t"); |
7269 | 498 | ARM_addVectorDataType(MI, ARM_VECTORDATA_S8); |
7270 | 498 | printOperand(MI, 0, O); |
7271 | 498 | SStream_concat0(O, ", "); |
7272 | 498 | break; |
7273 | 971 | case 19: |
7274 | | // VABALuv2i64, VABAuv2i32, VABAuv4i32, VABDLuv2i64, VABDuv2i32, VABDuv4i... |
7275 | 971 | SStream_concat0(O, ".u32\t"); |
7276 | 971 | ARM_addVectorDataType(MI, ARM_VECTORDATA_U32); |
7277 | 971 | printOperand(MI, 0, O); |
7278 | 971 | SStream_concat0(O, ", "); |
7279 | 971 | break; |
7280 | 781 | case 20: |
7281 | | // VABALuv4i32, VABAuv4i16, VABAuv8i16, VABDLuv4i32, VABDuv4i16, VABDuv8i... |
7282 | 781 | SStream_concat0(O, ".u16\t"); |
7283 | 781 | ARM_addVectorDataType(MI, ARM_VECTORDATA_U16); |
7284 | 781 | printOperand(MI, 0, O); |
7285 | 781 | SStream_concat0(O, ", "); |
7286 | 781 | break; |
7287 | 1.01k | case 21: |
7288 | | // VABALuv8i16, VABAuv16i8, VABAuv8i8, VABDLuv8i16, VABDuv16i8, VABDuv8i8... |
7289 | 1.01k | SStream_concat0(O, ".u8\t"); |
7290 | 1.01k | ARM_addVectorDataType(MI, ARM_VECTORDATA_U8); |
7291 | 1.01k | printOperand(MI, 0, O); |
7292 | 1.01k | SStream_concat0(O, ", "); |
7293 | 1.01k | break; |
7294 | 725 | case 22: |
7295 | | // VADDHNv2i32, VADDv1i64, VADDv2i64, VMOVNv2i32, VMOVv1i64, VMOVv2i64, V... |
7296 | 725 | SStream_concat0(O, ".i64\t"); |
7297 | 725 | ARM_addVectorDataType(MI, ARM_VECTORDATA_I64); |
7298 | 725 | printOperand(MI, 0, O); |
7299 | 725 | SStream_concat0(O, ", "); |
7300 | 725 | break; |
7301 | 2.21k | case 23: |
7302 | | // VADDHNv4i16, VADDv2i32, VADDv4i32, VBICiv2i32, VBICiv4i32, VCEQv2i32, ... |
7303 | 2.21k | SStream_concat0(O, ".i32\t"); |
7304 | 2.21k | ARM_addVectorDataType(MI, ARM_VECTORDATA_I32); |
7305 | 2.21k | printOperand(MI, 0, O); |
7306 | 2.21k | SStream_concat0(O, ", "); |
7307 | 2.21k | break; |
7308 | 489 | case 24: |
7309 | | // VADDHNv8i8, VADDv4i16, VADDv8i16, VBICiv4i16, VBICiv8i16, VCEQv4i16, V... |
7310 | 489 | SStream_concat0(O, ".i16\t"); |
7311 | 489 | ARM_addVectorDataType(MI, ARM_VECTORDATA_I16); |
7312 | 489 | printOperand(MI, 0, O); |
7313 | 489 | SStream_concat0(O, ", "); |
7314 | 489 | break; |
7315 | 276 | case 25: |
7316 | | // VADDv16i8, VADDv8i8, VCEQv16i8, VCEQv8i8, VCEQzv16i8, VCEQzv8i8, VCLZv... |
7317 | 276 | SStream_concat0(O, ".i8\t"); |
7318 | 276 | ARM_addVectorDataType(MI, ARM_VECTORDATA_I8); |
7319 | 276 | printOperand(MI, 0, O); |
7320 | 276 | SStream_concat0(O, ", "); |
7321 | 276 | break; |
7322 | 141 | case 26: |
7323 | | // VCVTBDH, VCVTTDH |
7324 | 141 | SStream_concat0(O, ".f16.f64\t"); |
7325 | 141 | ARM_addVectorDataType(MI, ARM_VECTORDATA_F16F64); |
7326 | 141 | printOperand(MI, 0, O); |
7327 | 141 | SStream_concat0(O, ", "); |
7328 | 141 | printOperand(MI, 1, O); |
7329 | 141 | return; |
7330 | 0 | break; |
7331 | 192 | case 27: |
7332 | | // VCVTBHD, VCVTTHD |
7333 | 192 | SStream_concat0(O, ".f64.f16\t"); |
7334 | 192 | ARM_addVectorDataType(MI, ARM_VECTORDATA_F64F16); |
7335 | 192 | printOperand(MI, 0, O); |
7336 | 192 | SStream_concat0(O, ", "); |
7337 | 192 | printOperand(MI, 1, O); |
7338 | 192 | return; |
7339 | 0 | break; |
7340 | 115 | case 28: |
7341 | | // VCVTBHS, VCVTTHS, VCVTh2f |
7342 | 115 | SStream_concat0(O, ".f32.f16\t"); |
7343 | 115 | ARM_addVectorDataType(MI, ARM_VECTORDATA_F32F16); |
7344 | 115 | printOperand(MI, 0, O); |
7345 | 115 | SStream_concat0(O, ", "); |
7346 | 115 | printOperand(MI, 1, O); |
7347 | 115 | return; |
7348 | 0 | break; |
7349 | 21 | case 29: |
7350 | | // VCVTBSH, VCVTTSH, VCVTf2h |
7351 | 21 | SStream_concat0(O, ".f16.f32\t"); |
7352 | 21 | ARM_addVectorDataType(MI, ARM_VECTORDATA_F16F32); |
7353 | 21 | printOperand(MI, 0, O); |
7354 | 21 | SStream_concat0(O, ", "); |
7355 | 21 | printOperand(MI, 1, O); |
7356 | 21 | return; |
7357 | 0 | break; |
7358 | 27 | case 30: |
7359 | | // VCVTDS |
7360 | 27 | SStream_concat0(O, ".f64.f32\t"); |
7361 | 27 | ARM_addVectorDataType(MI, ARM_VECTORDATA_F64F32); |
7362 | 27 | printOperand(MI, 0, O); |
7363 | 27 | SStream_concat0(O, ", "); |
7364 | 27 | printOperand(MI, 1, O); |
7365 | 27 | return; |
7366 | 0 | break; |
7367 | 210 | case 31: |
7368 | | // VCVTSD |
7369 | 210 | SStream_concat0(O, ".f32.f64\t"); |
7370 | 210 | ARM_addVectorDataType(MI, ARM_VECTORDATA_F32F64); |
7371 | 210 | printOperand(MI, 0, O); |
7372 | 210 | SStream_concat0(O, ", "); |
7373 | 210 | printOperand(MI, 1, O); |
7374 | 210 | return; |
7375 | 0 | break; |
7376 | 47 | case 32: |
7377 | | // VCVTf2sd, VCVTf2sq, VCVTf2xsd, VCVTf2xsq, VTOSIRS, VTOSIZS, VTOSLS |
7378 | 47 | SStream_concat0(O, ".s32.f32\t"); |
7379 | 47 | ARM_addVectorDataType(MI, ARM_VECTORDATA_S32F32); |
7380 | 47 | printOperand(MI, 0, O); |
7381 | 47 | SStream_concat0(O, ", "); |
7382 | 47 | printOperand(MI, 1, O); |
7383 | 47 | break; |
7384 | 181 | case 33: |
7385 | | // VCVTf2ud, VCVTf2uq, VCVTf2xud, VCVTf2xuq, VTOUIRS, VTOUIZS, VTOULS |
7386 | 181 | SStream_concat0(O, ".u32.f32\t"); |
7387 | 181 | ARM_addVectorDataType(MI, ARM_VECTORDATA_U32F32); |
7388 | 181 | printOperand(MI, 0, O); |
7389 | 181 | SStream_concat0(O, ", "); |
7390 | 181 | printOperand(MI, 1, O); |
7391 | 181 | break; |
7392 | 71 | case 34: |
7393 | | // VCVTh2sd, VCVTh2sq, VCVTh2xsd, VCVTh2xsq, VTOSHH |
7394 | 71 | SStream_concat0(O, ".s16.f16\t"); |
7395 | 71 | printOperand(MI, 0, O); |
7396 | 71 | SStream_concat0(O, ", "); |
7397 | 71 | printOperand(MI, 1, O); |
7398 | 71 | break; |
7399 | 43 | case 35: |
7400 | | // VCVTh2ud, VCVTh2uq, VCVTh2xud, VCVTh2xuq, VTOUHH |
7401 | 43 | SStream_concat0(O, ".u16.f16\t"); |
7402 | 43 | ARM_addVectorDataType(MI, ARM_VECTORDATA_U16F16); |
7403 | 43 | printOperand(MI, 0, O); |
7404 | 43 | SStream_concat0(O, ", "); |
7405 | 43 | printOperand(MI, 1, O); |
7406 | 43 | break; |
7407 | 59 | case 36: |
7408 | | // VCVTs2fd, VCVTs2fq, VCVTxs2fd, VCVTxs2fq, VSITOS, VSLTOS |
7409 | 59 | SStream_concat0(O, ".f32.s32\t"); |
7410 | 59 | ARM_addVectorDataType(MI, ARM_VECTORDATA_F32S32); |
7411 | 59 | printOperand(MI, 0, O); |
7412 | 59 | SStream_concat0(O, ", "); |
7413 | 59 | printOperand(MI, 1, O); |
7414 | 59 | break; |
7415 | 24 | case 37: |
7416 | | // VCVTs2hd, VCVTs2hq, VCVTxs2hd, VCVTxs2hq, VSHTOH |
7417 | 24 | SStream_concat0(O, ".f16.s16\t"); |
7418 | 24 | printOperand(MI, 0, O); |
7419 | 24 | SStream_concat0(O, ", "); |
7420 | 24 | printOperand(MI, 1, O); |
7421 | 24 | break; |
7422 | 76 | case 38: |
7423 | | // VCVTu2fd, VCVTu2fq, VCVTxu2fd, VCVTxu2fq, VUITOS, VULTOS |
7424 | 76 | SStream_concat0(O, ".f32.u32\t"); |
7425 | 76 | ARM_addVectorDataType(MI, ARM_VECTORDATA_F32U32); |
7426 | 76 | printOperand(MI, 0, O); |
7427 | 76 | SStream_concat0(O, ", "); |
7428 | 76 | printOperand(MI, 1, O); |
7429 | 76 | break; |
7430 | 145 | case 39: |
7431 | | // VCVTu2hd, VCVTu2hq, VCVTxu2hd, VCVTxu2hq, VUHTOH |
7432 | 145 | SStream_concat0(O, ".f16.u16\t"); |
7433 | 145 | ARM_addVectorDataType(MI, ARM_VECTORDATA_F16U16); |
7434 | 145 | printOperand(MI, 0, O); |
7435 | 145 | SStream_concat0(O, ", "); |
7436 | 145 | printOperand(MI, 1, O); |
7437 | 145 | break; |
7438 | 1.82k | case 40: |
7439 | | // VEXTq64, VLD1d64, VLD1d64Q, VLD1d64Qwb_fixed, VLD1d64Qwb_register, VLD... |
7440 | 1.82k | SStream_concat0(O, ".64\t"); |
7441 | 1.82k | ARM_addVectorDataSize(MI, 64); |
7442 | 1.82k | break; |
7443 | 152 | case 41: |
7444 | | // VJCVT, VTOSIRD, VTOSIZD, VTOSLD |
7445 | 152 | SStream_concat0(O, ".s32.f64\t"); |
7446 | 152 | ARM_addVectorDataType(MI, ARM_VECTORDATA_S32F64); |
7447 | 152 | printOperand(MI, 0, O); |
7448 | 152 | SStream_concat0(O, ", "); |
7449 | 152 | printOperand(MI, 1, O); |
7450 | 152 | break; |
7451 | 5.27k | case 42: |
7452 | | // VLD1LNd16, VLD1LNd16_UPD, VLD2LNd16, VLD2LNd16_UPD, VLD2LNq16, VLD2LNq... |
7453 | 5.27k | SStream_concat0(O, ".16\t{"); |
7454 | 5.27k | ARM_addVectorDataSize(MI, 16); |
7455 | 5.27k | break; |
7456 | 5.03k | case 43: |
7457 | | // VLD1LNd32, VLD1LNd32_UPD, VLD2LNd32, VLD2LNd32_UPD, VLD2LNq32, VLD2LNq... |
7458 | 5.03k | SStream_concat0(O, ".32\t{"); |
7459 | 5.03k | ARM_addVectorDataSize(MI, 32); |
7460 | 5.03k | break; |
7461 | 5.94k | case 44: |
7462 | | // VLD1LNd8, VLD1LNd8_UPD, VLD2LNd8, VLD2LNd8_UPD, VLD3DUPd8, VLD3DUPd8_U... |
7463 | 5.94k | SStream_concat0(O, ".8\t{"); |
7464 | 5.94k | ARM_addVectorDataSize(MI, 8); |
7465 | 5.94k | break; |
7466 | 32 | case 45: |
7467 | | // VMSR |
7468 | 32 | SStream_concat0(O, "\tfpscr, "); |
7469 | 32 | ARM_addReg(MI, ARM_REG_FPSCR); |
7470 | 32 | printOperand(MI, 0, O); |
7471 | 32 | return; |
7472 | 0 | break; |
7473 | 145 | case 46: |
7474 | | // VMSR_FPEXC |
7475 | 145 | SStream_concat0(O, "\tfpexc, "); |
7476 | 145 | ARM_addReg(MI, ARM_REG_FPEXC); |
7477 | 145 | printOperand(MI, 0, O); |
7478 | 145 | return; |
7479 | 0 | break; |
7480 | 202 | case 47: |
7481 | | // VMSR_FPINST |
7482 | 202 | SStream_concat0(O, "\tfpinst, "); |
7483 | 202 | ARM_addReg(MI, ARM_REG_FPINST); |
7484 | 202 | printOperand(MI, 0, O); |
7485 | 202 | return; |
7486 | 0 | break; |
7487 | 258 | case 48: |
7488 | | // VMSR_FPINST2 |
7489 | 258 | SStream_concat0(O, "\tfpinst2, "); |
7490 | 258 | ARM_addReg(MI, ARM_REG_FPINST2); |
7491 | 258 | printOperand(MI, 0, O); |
7492 | 258 | return; |
7493 | 0 | break; |
7494 | 17 | case 49: |
7495 | | // VMSR_FPSID |
7496 | 17 | SStream_concat0(O, "\tfpsid, "); |
7497 | 17 | ARM_addReg(MI, ARM_REG_FPSID); |
7498 | 17 | printOperand(MI, 0, O); |
7499 | 17 | return; |
7500 | 0 | break; |
7501 | 76 | case 50: |
7502 | | // VMULLp8, VMULpd, VMULpq |
7503 | 76 | SStream_concat0(O, ".p8\t"); |
7504 | 76 | ARM_addVectorDataType(MI, ARM_VECTORDATA_P8); |
7505 | 76 | printOperand(MI, 0, O); |
7506 | 76 | SStream_concat0(O, ", "); |
7507 | 76 | printOperand(MI, 1, O); |
7508 | 76 | SStream_concat0(O, ", "); |
7509 | 76 | printOperand(MI, 2, O); |
7510 | 76 | return; |
7511 | 0 | break; |
7512 | 182 | case 51: |
7513 | | // VQADDsv1i64, VQADDsv2i64, VQMOVNsuv2i32, VQMOVNsv2i32, VQRSHLsv1i64, V... |
7514 | 182 | SStream_concat0(O, ".s64\t"); |
7515 | 182 | ARM_addVectorDataType(MI, ARM_VECTORDATA_S64); |
7516 | 182 | printOperand(MI, 0, O); |
7517 | 182 | SStream_concat0(O, ", "); |
7518 | 182 | break; |
7519 | 753 | case 52: |
7520 | | // VQADDuv1i64, VQADDuv2i64, VQMOVNuv2i32, VQRSHLuv1i64, VQRSHLuv2i64, VQ... |
7521 | 753 | SStream_concat0(O, ".u64\t"); |
7522 | 753 | ARM_addVectorDataType(MI, ARM_VECTORDATA_U64); |
7523 | 753 | printOperand(MI, 0, O); |
7524 | 753 | SStream_concat0(O, ", "); |
7525 | 753 | break; |
7526 | 235 | case 53: |
7527 | | // VSDOTDI, VSDOTQI, VUDOTDI, VUDOTQI |
7528 | 235 | printVectorIndex(MI, 4, O); |
7529 | 235 | return; |
7530 | 0 | break; |
7531 | 35 | case 54: |
7532 | | // VSHTOD |
7533 | 35 | SStream_concat0(O, ".f64.s16\t"); |
7534 | 35 | ARM_addVectorDataType(MI, ARM_VECTORDATA_F64S16); |
7535 | 35 | printOperand(MI, 0, O); |
7536 | 35 | SStream_concat0(O, ", "); |
7537 | 35 | printOperand(MI, 1, O); |
7538 | 35 | SStream_concat0(O, ", "); |
7539 | 35 | printFBits16(MI, 2, O); |
7540 | 35 | return; |
7541 | 0 | break; |
7542 | 22 | case 55: |
7543 | | // VSHTOS |
7544 | 22 | SStream_concat0(O, ".f32.s16\t"); |
7545 | 22 | ARM_addVectorDataType(MI, ARM_VECTORDATA_F32S16); |
7546 | 22 | printOperand(MI, 0, O); |
7547 | 22 | SStream_concat0(O, ", "); |
7548 | 22 | printOperand(MI, 1, O); |
7549 | 22 | SStream_concat0(O, ", "); |
7550 | 22 | printFBits16(MI, 2, O); |
7551 | 22 | return; |
7552 | 0 | break; |
7553 | 135 | case 56: |
7554 | | // VSITOD, VSLTOD |
7555 | 135 | SStream_concat0(O, ".f64.s32\t"); |
7556 | 135 | ARM_addVectorDataType(MI, ARM_VECTORDATA_F64S32); |
7557 | 135 | printOperand(MI, 0, O); |
7558 | 135 | SStream_concat0(O, ", "); |
7559 | 135 | printOperand(MI, 1, O); |
7560 | 135 | break; |
7561 | 23 | case 57: |
7562 | | // VSITOH, VSLTOH |
7563 | 23 | SStream_concat0(O, ".f16.s32\t"); |
7564 | 23 | printOperand(MI, 0, O); |
7565 | 23 | SStream_concat0(O, ", "); |
7566 | 23 | printOperand(MI, 1, O); |
7567 | 23 | break; |
7568 | 267 | case 58: |
7569 | | // VTOSHD |
7570 | 267 | SStream_concat0(O, ".s16.f64\t"); |
7571 | 267 | ARM_addVectorDataType(MI, ARM_VECTORDATA_S16F64); |
7572 | 267 | printOperand(MI, 0, O); |
7573 | 267 | SStream_concat0(O, ", "); |
7574 | 267 | printOperand(MI, 1, O); |
7575 | 267 | SStream_concat0(O, ", "); |
7576 | 267 | printFBits16(MI, 2, O); |
7577 | 267 | return; |
7578 | 0 | break; |
7579 | 26 | case 59: |
7580 | | // VTOSHS |
7581 | 26 | SStream_concat0(O, ".s16.f32\t"); |
7582 | 26 | ARM_addVectorDataType(MI, ARM_VECTORDATA_S16F32); |
7583 | 26 | printOperand(MI, 0, O); |
7584 | 26 | SStream_concat0(O, ", "); |
7585 | 26 | printOperand(MI, 1, O); |
7586 | 26 | SStream_concat0(O, ", "); |
7587 | 26 | printFBits16(MI, 2, O); |
7588 | 26 | return; |
7589 | 0 | break; |
7590 | 196 | case 60: |
7591 | | // VTOSIRH, VTOSIZH, VTOSLH |
7592 | 196 | SStream_concat0(O, ".s32.f16\t"); |
7593 | 196 | printOperand(MI, 0, O); |
7594 | 196 | SStream_concat0(O, ", "); |
7595 | 196 | printOperand(MI, 1, O); |
7596 | 196 | break; |
7597 | 94 | case 61: |
7598 | | // VTOUHD |
7599 | 94 | SStream_concat0(O, ".u16.f64\t"); |
7600 | 94 | ARM_addVectorDataType(MI, ARM_VECTORDATA_U16F64); |
7601 | 94 | printOperand(MI, 0, O); |
7602 | 94 | SStream_concat0(O, ", "); |
7603 | 94 | printOperand(MI, 1, O); |
7604 | 94 | SStream_concat0(O, ", "); |
7605 | 94 | printFBits16(MI, 2, O); |
7606 | 94 | return; |
7607 | 0 | break; |
7608 | 55 | case 62: |
7609 | | // VTOUHS |
7610 | 55 | SStream_concat0(O, ".u16.f32\t"); |
7611 | 55 | ARM_addVectorDataType(MI, ARM_VECTORDATA_U16F32); |
7612 | 55 | printOperand(MI, 0, O); |
7613 | 55 | SStream_concat0(O, ", "); |
7614 | 55 | printOperand(MI, 1, O); |
7615 | 55 | SStream_concat0(O, ", "); |
7616 | 55 | printFBits16(MI, 2, O); |
7617 | 55 | return; |
7618 | 0 | break; |
7619 | 45 | case 63: |
7620 | | // VTOUIRD, VTOUIZD, VTOULD |
7621 | 45 | SStream_concat0(O, ".u32.f64\t"); |
7622 | 45 | ARM_addVectorDataType(MI, ARM_VECTORDATA_U32F64); |
7623 | 45 | printOperand(MI, 0, O); |
7624 | 45 | SStream_concat0(O, ", "); |
7625 | 45 | printOperand(MI, 1, O); |
7626 | 45 | break; |
7627 | 48 | case 64: |
7628 | | // VTOUIRH, VTOUIZH, VTOULH |
7629 | 48 | SStream_concat0(O, ".u32.f16\t"); |
7630 | 48 | ARM_addVectorDataType(MI, ARM_VECTORDATA_U32F16); |
7631 | 48 | printOperand(MI, 0, O); |
7632 | 48 | SStream_concat0(O, ", "); |
7633 | 48 | printOperand(MI, 1, O); |
7634 | 48 | break; |
7635 | 178 | case 65: |
7636 | | // VUHTOD |
7637 | 178 | SStream_concat0(O, ".f64.u16\t"); |
7638 | 178 | ARM_addVectorDataType(MI, ARM_VECTORDATA_F64U16); |
7639 | 178 | printOperand(MI, 0, O); |
7640 | 178 | SStream_concat0(O, ", "); |
7641 | 178 | printOperand(MI, 1, O); |
7642 | 178 | SStream_concat0(O, ", "); |
7643 | 178 | printFBits16(MI, 2, O); |
7644 | 178 | return; |
7645 | 0 | break; |
7646 | 30 | case 66: |
7647 | | // VUHTOS |
7648 | 30 | SStream_concat0(O, ".f32.u16\t"); |
7649 | 30 | ARM_addVectorDataType(MI, ARM_VECTORDATA_F32U16); |
7650 | 30 | printOperand(MI, 0, O); |
7651 | 30 | SStream_concat0(O, ", "); |
7652 | 30 | printOperand(MI, 1, O); |
7653 | 30 | SStream_concat0(O, ", "); |
7654 | 30 | printFBits16(MI, 2, O); |
7655 | 30 | return; |
7656 | 0 | break; |
7657 | 67 | case 67: |
7658 | | // VUITOD, VULTOD |
7659 | 67 | SStream_concat0(O, ".f64.u32\t"); |
7660 | 67 | ARM_addVectorDataType(MI, ARM_VECTORDATA_F64U32); |
7661 | 67 | printOperand(MI, 0, O); |
7662 | 67 | SStream_concat0(O, ", "); |
7663 | 67 | printOperand(MI, 1, O); |
7664 | 67 | break; |
7665 | 8 | case 68: |
7666 | | // VUITOH, VULTOH |
7667 | 8 | SStream_concat0(O, ".f16.u32\t"); |
7668 | 8 | ARM_addVectorDataType(MI, ARM_VECTORDATA_F16U32); |
7669 | 8 | printOperand(MI, 0, O); |
7670 | 8 | SStream_concat0(O, ", "); |
7671 | 8 | printOperand(MI, 1, O); |
7672 | 8 | break; |
7673 | 16.8k | case 69: |
7674 | | // t2ADCrr, t2ADCrs, t2ADDri, t2ADDrr, t2ADDrs, t2ADR, t2ANDrr, t2ANDrs, ... |
7675 | 16.8k | SStream_concat0(O, ".w\t"); |
7676 | 16.8k | break; |
7677 | 170 | case 70: |
7678 | | // t2SRSDB, t2SRSIA |
7679 | 170 | SStream_concat0(O, "\tsp, "); |
7680 | 170 | ARM_addReg(MI, ARM_REG_SP); |
7681 | 170 | printOperand(MI, 0, O); |
7682 | 170 | return; |
7683 | 0 | break; |
7684 | 203 | case 71: |
7685 | | // t2SRSDB_UPD, t2SRSIA_UPD |
7686 | 203 | SStream_concat0(O, "\tsp!, "); |
7687 | 203 | ARM_addReg(MI, ARM_REG_SP); |
7688 | 203 | printOperand(MI, 0, O); |
7689 | 203 | return; |
7690 | 0 | break; |
7691 | 7 | case 72: |
7692 | | // t2SUBS_PC_LR |
7693 | 7 | SStream_concat0(O, "\tpc, lr, "); |
7694 | 7 | printOperand(MI, 0, O); |
7695 | 7 | return; |
7696 | 0 | break; |
7697 | 105k | case 73: |
7698 | | // tADC, tADDi3, tADDi8, tADDrr, tAND, tASRri, tASRrr, tBIC, tEOR, tLSLri... |
7699 | 105k | printPredicateOperand(MI, 4, O); |
7700 | 105k | SStream_concat0(O, "\t"); |
7701 | 105k | printOperand(MI, 0, O); |
7702 | 105k | SStream_concat0(O, ", "); |
7703 | 105k | break; |
7704 | 11.8k | case 74: |
7705 | | // tMOVi8, tMVN, tRSB |
7706 | 11.8k | printPredicateOperand(MI, 3, O); |
7707 | 11.8k | SStream_concat0(O, "\t"); |
7708 | 11.8k | printOperand(MI, 0, O); |
7709 | 11.8k | SStream_concat0(O, ", "); |
7710 | 11.8k | printOperand(MI, 2, O); |
7711 | 11.8k | break; |
7712 | 601k | } |
7713 | | |
7714 | | |
7715 | | // Fragment 2 encoded into 6 bits for 60 unique commands. |
7716 | | // printf("Fragment 2: %"PRIu64"\n", ((Bits >> 24) & 63)); |
7717 | 593k | switch ((Bits >> 24) & 63) { |
7718 | 0 | default: // unreachable |
7719 | 301k | case 0: |
7720 | | // ASRi, ASRr, LDRBT_POST, LDRConstPool, LDRT_POST, LSLi, LSLr, LSRi, LSR... |
7721 | 301k | printOperand(MI, 0, O); |
7722 | 301k | break; |
7723 | 6.68k | case 1: |
7724 | | // ITasm, t2IT |
7725 | 6.68k | printMandatoryPredicateOperand(MI, 0, O); |
7726 | 6.68k | return; |
7727 | 0 | break; |
7728 | 0 | case 2: |
7729 | | // VLD3DUPdAsm_16, VLD3DUPdAsm_32, VLD3DUPdAsm_8, VLD3DUPdWB_fixed_Asm_16... |
7730 | 0 | printVectorListThreeAllLanes(MI, 0, O); |
7731 | 0 | SStream_concat0(O, ", "); |
7732 | 0 | printAddrMode6Operand(MI, 1, O); |
7733 | 0 | break; |
7734 | 0 | case 3: |
7735 | | // VLD3DUPqAsm_16, VLD3DUPqAsm_32, VLD3DUPqAsm_8, VLD3DUPqWB_fixed_Asm_16... |
7736 | 0 | printVectorListThreeSpacedAllLanes(MI, 0, O); |
7737 | 0 | SStream_concat0(O, ", "); |
7738 | 0 | printAddrMode6Operand(MI, 1, O); |
7739 | 0 | break; |
7740 | 929 | case 4: |
7741 | | // VLD3dAsm_16, VLD3dAsm_32, VLD3dAsm_8, VLD3dWB_fixed_Asm_16, VLD3dWB_fi... |
7742 | 929 | printVectorListThree(MI, 0, O); |
7743 | 929 | SStream_concat0(O, ", "); |
7744 | 929 | break; |
7745 | 0 | case 5: |
7746 | | // VLD3qAsm_16, VLD3qAsm_32, VLD3qAsm_8, VLD3qWB_fixed_Asm_16, VLD3qWB_fi... |
7747 | 0 | printVectorListThreeSpaced(MI, 0, O); |
7748 | 0 | SStream_concat0(O, ", "); |
7749 | 0 | printAddrMode6Operand(MI, 1, O); |
7750 | 0 | break; |
7751 | 0 | case 6: |
7752 | | // VLD4DUPdAsm_16, VLD4DUPdAsm_32, VLD4DUPdAsm_8, VLD4DUPdWB_fixed_Asm_16... |
7753 | 0 | printVectorListFourAllLanes(MI, 0, O); |
7754 | 0 | SStream_concat0(O, ", "); |
7755 | 0 | printAddrMode6Operand(MI, 1, O); |
7756 | 0 | break; |
7757 | 0 | case 7: |
7758 | | // VLD4DUPqAsm_16, VLD4DUPqAsm_32, VLD4DUPqAsm_8, VLD4DUPqWB_fixed_Asm_16... |
7759 | 0 | printVectorListFourSpacedAllLanes(MI, 0, O); |
7760 | 0 | SStream_concat0(O, ", "); |
7761 | 0 | printAddrMode6Operand(MI, 1, O); |
7762 | 0 | break; |
7763 | 2.54k | case 8: |
7764 | | // VLD4dAsm_16, VLD4dAsm_32, VLD4dAsm_8, VLD4dWB_fixed_Asm_16, VLD4dWB_fi... |
7765 | 2.54k | printVectorListFour(MI, 0, O); |
7766 | 2.54k | SStream_concat0(O, ", "); |
7767 | 2.54k | break; |
7768 | 0 | case 9: |
7769 | | // VLD4qAsm_16, VLD4qAsm_32, VLD4qAsm_8, VLD4qWB_fixed_Asm_16, VLD4qWB_fi... |
7770 | 0 | printVectorListFourSpaced(MI, 0, O); |
7771 | 0 | SStream_concat0(O, ", "); |
7772 | 0 | printAddrMode6Operand(MI, 1, O); |
7773 | 0 | break; |
7774 | 86.6k | case 10: |
7775 | | // AESD, AESE, MCR2, MCRR2, SHA1C, SHA1M, SHA1P, SHA1SU0, SHA1SU1, SHA256... |
7776 | 86.6k | printOperand(MI, 2, O); |
7777 | 86.6k | break; |
7778 | 88.5k | case 11: |
7779 | | // AESIMC, AESMC, CRC32B, CRC32CB, CRC32CH, CRC32CW, CRC32H, CRC32W, FLDM... |
7780 | 88.5k | printOperand(MI, 1, O); |
7781 | 88.5k | break; |
7782 | 20.8k | case 12: |
7783 | | // CDP, LDCL_OFFSET, LDCL_OPTION, LDCL_POST, LDCL_PRE, LDC_OFFSET, LDC_OP... |
7784 | 20.8k | printPImmediate(MI, 0, O); |
7785 | 20.8k | SStream_concat0(O, ", "); |
7786 | 20.8k | break; |
7787 | 999 | case 13: |
7788 | | // CDP2 |
7789 | 999 | printCImmediate(MI, 2, O); |
7790 | 999 | SStream_concat0(O, ", "); |
7791 | 999 | printCImmediate(MI, 3, O); |
7792 | 999 | SStream_concat0(O, ", "); |
7793 | 999 | printCImmediate(MI, 4, O); |
7794 | 999 | SStream_concat0(O, ", "); |
7795 | 999 | printOperand(MI, 5, O); |
7796 | 999 | return; |
7797 | 0 | break; |
7798 | 1.60k | case 14: |
7799 | | // CPS2p, CPS3p, t2CPS2p, t2CPS3p, tCPS |
7800 | 1.60k | printCPSIFlag(MI, 1, O); |
7801 | 1.60k | break; |
7802 | 3.73k | case 15: |
7803 | | // FCONSTD, FCONSTH, FCONSTS, VABDfd, VABDfq, VABDhd, VABDhq, VABSD, VABS... |
7804 | 3.73k | SStream_concat0(O, ", "); |
7805 | 3.73k | break; |
7806 | 104 | case 16: |
7807 | | // LDAEXD, LDREXD |
7808 | 104 | printGPRPairOperand(MI, 0, O); |
7809 | 104 | SStream_concat0(O, ", "); |
7810 | 104 | printAddrMode7Operand(MI, 1, O); |
7811 | 104 | return; |
7812 | 0 | break; |
7813 | 729 | case 17: |
7814 | | // LDC2L_OFFSET, LDC2_OFFSET, STC2L_OFFSET, STC2_OFFSET |
7815 | 729 | printAddrMode5Operand(MI, 2, O, false); |
7816 | 729 | return; |
7817 | 0 | break; |
7818 | 1.05k | case 18: |
7819 | | // LDC2L_OPTION, LDC2L_POST, LDC2_OPTION, LDC2_POST, STC2L_OPTION, STC2L_... |
7820 | 1.05k | printAddrMode7Operand(MI, 2, O); |
7821 | 1.05k | SStream_concat0(O, ", "); |
7822 | 1.05k | break; |
7823 | 1.28k | case 19: |
7824 | | // LDC2L_PRE, LDC2_PRE, STC2L_PRE, STC2_PRE |
7825 | 1.28k | printAddrMode5Operand(MI, 2, O, true); |
7826 | 1.28k | SStream_concat0(O, "!"); |
7827 | 1.28k | return; |
7828 | 0 | break; |
7829 | 1.83k | case 20: |
7830 | | // MRC, t2MRC, t2MRC2 |
7831 | 1.83k | printPImmediate(MI, 1, O); |
7832 | 1.83k | SStream_concat0(O, ", "); |
7833 | 1.83k | printOperand(MI, 2, O); |
7834 | 1.83k | SStream_concat0(O, ", "); |
7835 | 1.83k | printOperand(MI, 0, O); |
7836 | 1.83k | SStream_concat0(O, ", "); |
7837 | 1.83k | printCImmediate(MI, 3, O); |
7838 | 1.83k | SStream_concat0(O, ", "); |
7839 | 1.83k | printCImmediate(MI, 4, O); |
7840 | 1.83k | SStream_concat0(O, ", "); |
7841 | 1.83k | printOperand(MI, 5, O); |
7842 | 1.83k | return; |
7843 | 0 | break; |
7844 | 657 | case 21: |
7845 | | // MRRC, t2MRRC, t2MRRC2 |
7846 | 657 | printPImmediate(MI, 2, O); |
7847 | 657 | SStream_concat0(O, ", "); |
7848 | 657 | printOperand(MI, 3, O); |
7849 | 657 | SStream_concat0(O, ", "); |
7850 | 657 | printOperand(MI, 0, O); |
7851 | 657 | SStream_concat0(O, ", "); |
7852 | 657 | printOperand(MI, 1, O); |
7853 | 657 | SStream_concat0(O, ", "); |
7854 | 657 | printCImmediate(MI, 4, O); |
7855 | 657 | return; |
7856 | 0 | break; |
7857 | 2.82k | case 22: |
7858 | | // MSR, MSRi, t2MSR_AR, t2MSR_M |
7859 | 2.82k | printMSRMaskOperand(MI, 0, O); |
7860 | 2.82k | SStream_concat0(O, ", "); |
7861 | 2.82k | break; |
7862 | 251 | case 23: |
7863 | | // MSRbanked, t2MSRbanked |
7864 | 251 | printBankedRegOperand(MI, 0, O); |
7865 | 251 | SStream_concat0(O, ", "); |
7866 | 251 | printOperand(MI, 1, O); |
7867 | 251 | return; |
7868 | 0 | break; |
7869 | 2.82k | case 24: |
7870 | | // VBICiv2i32, VBICiv4i16, VBICiv4i32, VBICiv8i16, VMOVv16i8, VMOVv1i64, ... |
7871 | 2.82k | printNEONModImmOperand(MI, 1, O); |
7872 | 2.82k | return; |
7873 | 0 | break; |
7874 | 1.63k | case 25: |
7875 | | // VCMPEZD, VCMPEZH, VCMPEZS, VCMPZD, VCMPZH, VCMPZS, tRSB |
7876 | 1.63k | SStream_concat0(O, ", #0"); |
7877 | 1.63k | op_addImm(MI, 0); |
7878 | 1.63k | return; |
7879 | 0 | break; |
7880 | 10.7k | case 26: |
7881 | | // VCVTf2sd, VCVTf2sq, VCVTf2ud, VCVTf2uq, VCVTh2sd, VCVTh2sq, VCVTh2ud, ... |
7882 | 10.7k | return; |
7883 | 0 | break; |
7884 | 139 | case 27: |
7885 | | // VLD1DUPd16, VLD1DUPd16wb_fixed, VLD1DUPd16wb_register, VLD1DUPd32, VLD... |
7886 | 139 | printVectorListOneAllLanes(MI, 0, O); |
7887 | 139 | SStream_concat0(O, ", "); |
7888 | 139 | break; |
7889 | 1.24k | case 28: |
7890 | | // VLD1DUPq16, VLD1DUPq16wb_fixed, VLD1DUPq16wb_register, VLD1DUPq32, VLD... |
7891 | 1.24k | printVectorListTwoAllLanes(MI, 0, O); |
7892 | 1.24k | SStream_concat0(O, ", "); |
7893 | 1.24k | break; |
7894 | 765 | case 29: |
7895 | | // VLD1d16, VLD1d16wb_fixed, VLD1d16wb_register, VLD1d32, VLD1d32wb_fixed... |
7896 | 765 | printVectorListOne(MI, 0, O); |
7897 | 765 | SStream_concat0(O, ", "); |
7898 | 765 | break; |
7899 | 2.74k | case 30: |
7900 | | // VLD1q16, VLD1q16wb_fixed, VLD1q16wb_register, VLD1q32, VLD1q32wb_fixed... |
7901 | 2.74k | printVectorListTwo(MI, 0, O); |
7902 | 2.74k | SStream_concat0(O, ", "); |
7903 | 2.74k | break; |
7904 | 701 | case 31: |
7905 | | // VLD2DUPd16x2, VLD2DUPd16x2wb_fixed, VLD2DUPd16x2wb_register, VLD2DUPd3... |
7906 | 701 | printVectorListTwoSpacedAllLanes(MI, 0, O); |
7907 | 701 | SStream_concat0(O, ", "); |
7908 | 701 | break; |
7909 | 1.34k | case 32: |
7910 | | // VLD2b16, VLD2b16wb_fixed, VLD2b16wb_register, VLD2b32, VLD2b32wb_fixed... |
7911 | 1.34k | printVectorListTwoSpaced(MI, 0, O); |
7912 | 1.34k | SStream_concat0(O, ", "); |
7913 | 1.34k | break; |
7914 | 5.24k | case 33: |
7915 | | // VST1LNd16_UPD, VST1LNd32_UPD, VST1LNd8_UPD, VST2LNd16_UPD, VST2LNd32_U... |
7916 | 5.24k | printOperand(MI, 4, O); |
7917 | 5.24k | break; |
7918 | 115 | case 34: |
7919 | | // VST1d16, VST1d32, VST1d64, VST1d8 |
7920 | 115 | printVectorListOne(MI, 2, O); |
7921 | 115 | SStream_concat0(O, ", "); |
7922 | 115 | printAddrMode6Operand(MI, 0, O); |
7923 | 115 | return; |
7924 | 0 | break; |
7925 | 347 | case 35: |
7926 | | // VST1d16Q, VST1d32Q, VST1d64Q, VST1d8Q, VST2q16, VST2q32, VST2q8 |
7927 | 347 | printVectorListFour(MI, 2, O); |
7928 | 347 | SStream_concat0(O, ", "); |
7929 | 347 | printAddrMode6Operand(MI, 0, O); |
7930 | 347 | return; |
7931 | 0 | break; |
7932 | 647 | case 36: |
7933 | | // VST1d16Qwb_fixed, VST1d32Qwb_fixed, VST1d64Qwb_fixed, VST1d8Qwb_fixed,... |
7934 | 647 | printVectorListFour(MI, 3, O); |
7935 | 647 | SStream_concat0(O, ", "); |
7936 | 647 | printAddrMode6Operand(MI, 1, O); |
7937 | 647 | SStream_concat0(O, "!"); |
7938 | 647 | return; |
7939 | 0 | break; |
7940 | 1.32k | case 37: |
7941 | | // VST1d16Qwb_register, VST1d32Qwb_register, VST1d64Qwb_register, VST1d8Q... |
7942 | 1.32k | printVectorListFour(MI, 4, O); |
7943 | 1.32k | SStream_concat0(O, ", "); |
7944 | 1.32k | printAddrMode6Operand(MI, 1, O); |
7945 | 1.32k | SStream_concat0(O, ", "); |
7946 | 1.32k | printOperand(MI, 3, O); |
7947 | 1.32k | return; |
7948 | 0 | break; |
7949 | 81 | case 38: |
7950 | | // VST1d16T, VST1d32T, VST1d64T, VST1d8T |
7951 | 81 | printVectorListThree(MI, 2, O); |
7952 | 81 | SStream_concat0(O, ", "); |
7953 | 81 | printAddrMode6Operand(MI, 0, O); |
7954 | 81 | return; |
7955 | 0 | break; |
7956 | 200 | case 39: |
7957 | | // VST1d16Twb_fixed, VST1d32Twb_fixed, VST1d64Twb_fixed, VST1d8Twb_fixed |
7958 | 200 | printVectorListThree(MI, 3, O); |
7959 | 200 | SStream_concat0(O, ", "); |
7960 | 200 | printAddrMode6Operand(MI, 1, O); |
7961 | 200 | SStream_concat0(O, "!"); |
7962 | 200 | return; |
7963 | 0 | break; |
7964 | 575 | case 40: |
7965 | | // VST1d16Twb_register, VST1d32Twb_register, VST1d64Twb_register, VST1d8T... |
7966 | 575 | printVectorListThree(MI, 4, O); |
7967 | 575 | SStream_concat0(O, ", "); |
7968 | 575 | printAddrMode6Operand(MI, 1, O); |
7969 | 575 | SStream_concat0(O, ", "); |
7970 | 575 | printOperand(MI, 3, O); |
7971 | 575 | return; |
7972 | 0 | break; |
7973 | 265 | case 41: |
7974 | | // VST1d16wb_fixed, VST1d32wb_fixed, VST1d64wb_fixed, VST1d8wb_fixed |
7975 | 265 | printVectorListOne(MI, 3, O); |
7976 | 265 | SStream_concat0(O, ", "); |
7977 | 265 | printAddrMode6Operand(MI, 1, O); |
7978 | 265 | SStream_concat0(O, "!"); |
7979 | 265 | return; |
7980 | 0 | break; |
7981 | 515 | case 42: |
7982 | | // VST1d16wb_register, VST1d32wb_register, VST1d64wb_register, VST1d8wb_r... |
7983 | 515 | printVectorListOne(MI, 4, O); |
7984 | 515 | SStream_concat0(O, ", "); |
7985 | 515 | printAddrMode6Operand(MI, 1, O); |
7986 | 515 | SStream_concat0(O, ", "); |
7987 | 515 | printOperand(MI, 3, O); |
7988 | 515 | return; |
7989 | 0 | break; |
7990 | 585 | case 43: |
7991 | | // VST1q16, VST1q32, VST1q64, VST1q8, VST2d16, VST2d32, VST2d8 |
7992 | 585 | printVectorListTwo(MI, 2, O); |
7993 | 585 | SStream_concat0(O, ", "); |
7994 | 585 | printAddrMode6Operand(MI, 0, O); |
7995 | 585 | return; |
7996 | 0 | break; |
7997 | 723 | case 44: |
7998 | | // VST1q16wb_fixed, VST1q32wb_fixed, VST1q64wb_fixed, VST1q8wb_fixed, VST... |
7999 | 723 | printVectorListTwo(MI, 3, O); |
8000 | 723 | SStream_concat0(O, ", "); |
8001 | 723 | printAddrMode6Operand(MI, 1, O); |
8002 | 723 | SStream_concat0(O, "!"); |
8003 | 723 | return; |
8004 | 0 | break; |
8005 | 941 | case 45: |
8006 | | // VST1q16wb_register, VST1q32wb_register, VST1q64wb_register, VST1q8wb_r... |
8007 | 941 | printVectorListTwo(MI, 4, O); |
8008 | 941 | SStream_concat0(O, ", "); |
8009 | 941 | printAddrMode6Operand(MI, 1, O); |
8010 | 941 | SStream_concat0(O, ", "); |
8011 | 941 | printOperand(MI, 3, O); |
8012 | 941 | return; |
8013 | 0 | break; |
8014 | 323 | case 46: |
8015 | | // VST2b16, VST2b32, VST2b8 |
8016 | 323 | printVectorListTwoSpaced(MI, 2, O); |
8017 | 323 | SStream_concat0(O, ", "); |
8018 | 323 | printAddrMode6Operand(MI, 0, O); |
8019 | 323 | return; |
8020 | 0 | break; |
8021 | 266 | case 47: |
8022 | | // VST2b16wb_fixed, VST2b32wb_fixed, VST2b8wb_fixed |
8023 | 266 | printVectorListTwoSpaced(MI, 3, O); |
8024 | 266 | SStream_concat0(O, ", "); |
8025 | 266 | printAddrMode6Operand(MI, 1, O); |
8026 | 266 | SStream_concat0(O, "!"); |
8027 | 266 | return; |
8028 | 0 | break; |
8029 | 636 | case 48: |
8030 | | // VST2b16wb_register, VST2b32wb_register, VST2b8wb_register |
8031 | 636 | printVectorListTwoSpaced(MI, 4, O); |
8032 | 636 | SStream_concat0(O, ", "); |
8033 | 636 | printAddrMode6Operand(MI, 1, O); |
8034 | 636 | SStream_concat0(O, ", "); |
8035 | 636 | printOperand(MI, 3, O); |
8036 | 636 | return; |
8037 | 0 | break; |
8038 | 1.99k | case 49: |
8039 | | // t2DMB, t2DSB |
8040 | 1.99k | printMemBOption(MI, 0, O); |
8041 | 1.99k | return; |
8042 | 0 | break; |
8043 | 569 | case 50: |
8044 | | // t2ISB |
8045 | 569 | printInstSyncBOption(MI, 0, O); |
8046 | 569 | return; |
8047 | 0 | break; |
8048 | 84 | case 51: |
8049 | | // t2PLDWi12, t2PLDi12, t2PLIi12 |
8050 | 84 | printAddrModeImm12Operand(MI, 0, O, false); |
8051 | 84 | return; |
8052 | 0 | break; |
8053 | 524 | case 52: |
8054 | | // t2PLDWi8, t2PLDi8, t2PLIi8 |
8055 | 524 | printT2AddrModeImm8Operand(MI, 0, O, false); |
8056 | 524 | return; |
8057 | 0 | break; |
8058 | 138 | case 53: |
8059 | | // t2PLDWs, t2PLDs, t2PLIs |
8060 | 138 | printT2AddrModeSoRegOperand(MI, 0, O); |
8061 | 138 | return; |
8062 | 0 | break; |
8063 | 1.26k | case 54: |
8064 | | // t2PLDpci, t2PLIpci |
8065 | 1.26k | printThumbLdrLabelOperand(MI, 0, O); |
8066 | 1.26k | return; |
8067 | 0 | break; |
8068 | 83 | case 55: |
8069 | | // t2TBB |
8070 | 83 | printAddrModeTBB(MI, 0, O); |
8071 | 83 | return; |
8072 | 0 | break; |
8073 | 167 | case 56: |
8074 | | // t2TBH |
8075 | 167 | printAddrModeTBH(MI, 0, O); |
8076 | 167 | return; |
8077 | 0 | break; |
8078 | 0 | case 57: |
8079 | | // t2TSB |
8080 | 0 | printTraceSyncBOption(MI, 0, O); |
8081 | 0 | return; |
8082 | 0 | break; |
8083 | 27.3k | case 58: |
8084 | | // tADC, tADDi8, tAND, tASRrr, tBIC, tEOR, tLSLrr, tLSRrr, tORR, tROR, tS... |
8085 | 27.3k | printOperand(MI, 3, O); |
8086 | 27.3k | return; |
8087 | 0 | break; |
8088 | 3.15k | case 59: |
8089 | | // tPOP, tPUSH |
8090 | 3.15k | printRegisterList(MI, 2, O); |
8091 | 3.15k | return; |
8092 | 0 | break; |
8093 | 593k | } |
8094 | | |
8095 | | |
8096 | | // Fragment 3 encoded into 5 bits for 30 unique commands. |
8097 | | // printf("Fragment 3: %"PRIu64"\n", ((Bits >> 30) & 31)); |
8098 | 522k | switch ((Bits >> 30) & 31) { |
8099 | 0 | default: // unreachable |
8100 | 364k | case 0: |
8101 | | // ASRi, ASRr, LDRBT_POST, LDRConstPool, LDRT_POST, LSLi, LSLr, LSRi, LSR... |
8102 | 364k | SStream_concat0(O, ", "); |
8103 | 364k | break; |
8104 | 96.5k | case 1: |
8105 | | // VLD3DUPdAsm_16, VLD3DUPdAsm_32, VLD3DUPdAsm_8, VLD3DUPqAsm_16, VLD3DUP... |
8106 | 96.5k | return; |
8107 | 0 | break; |
8108 | 19 | case 2: |
8109 | | // VLD3DUPdWB_fixed_Asm_16, VLD3DUPdWB_fixed_Asm_32, VLD3DUPdWB_fixed_Asm... |
8110 | 19 | SStream_concat0(O, "!"); |
8111 | 19 | return; |
8112 | 0 | break; |
8113 | 1.34k | case 3: |
8114 | | // VLD3dAsm_16, VLD3dAsm_32, VLD3dAsm_8, VLD3dWB_fixed_Asm_16, VLD3dWB_fi... |
8115 | 1.34k | printAddrMode6Operand(MI, 1, O); |
8116 | 1.34k | break; |
8117 | 8.87k | case 4: |
8118 | | // CDP, MCR, MCRR, MSR, VABDfd, VABDfq, VABDhd, VABDhq, VABSD, VABSH, VAB... |
8119 | 8.87k | printOperand(MI, 1, O); |
8120 | 8.87k | break; |
8121 | 683 | case 5: |
8122 | | // FCONSTD, FCONSTH, FCONSTS, VMOVv2f32, VMOVv4f32 |
8123 | 683 | printFPImmOperand(MI, 1, O); |
8124 | 683 | return; |
8125 | 0 | break; |
8126 | 11.6k | case 6: |
8127 | | // FLDMXDB_UPD, FLDMXIA_UPD, FSTMXDB_UPD, FSTMXIA_UPD, LDMDA_UPD, LDMDB_U... |
8128 | 11.6k | SStream_concat0(O, "!, "); |
8129 | 11.6k | printRegisterList(MI, 4, O); |
8130 | 11.6k | break; |
8131 | 413 | case 7: |
8132 | | // LDC2L_OPTION, LDC2_OPTION, STC2L_OPTION, STC2_OPTION |
8133 | 413 | printCoprocOptionImm(MI, 3, O); |
8134 | 413 | return; |
8135 | 0 | break; |
8136 | 644 | case 8: |
8137 | | // LDC2L_POST, LDC2_POST, STC2L_POST, STC2_POST |
8138 | 644 | printPostIdxImm8s4Operand(MI, 3, O); |
8139 | 644 | return; |
8140 | 0 | break; |
8141 | 15.8k | case 9: |
8142 | | // LDCL_OFFSET, LDCL_OPTION, LDCL_POST, LDCL_PRE, LDC_OFFSET, LDC_OPTION,... |
8143 | 15.8k | printCImmediate(MI, 1, O); |
8144 | 15.8k | SStream_concat0(O, ", "); |
8145 | 15.8k | break; |
8146 | 352 | case 10: |
8147 | | // MRS, t2MRS_AR |
8148 | 352 | SStream_concat0(O, ", apsr"); |
8149 | 352 | ARM_addReg(MI, ARM_REG_APSR); |
8150 | 352 | return; |
8151 | 0 | break; |
8152 | 33 | case 11: |
8153 | | // MRSsys, t2MRSsys_AR |
8154 | 33 | SStream_concat0(O, ", spsr"); |
8155 | 33 | ARM_addReg(MI, ARM_REG_SPSR); |
8156 | 33 | return; |
8157 | 0 | break; |
8158 | 404 | case 12: |
8159 | | // MSRi |
8160 | 404 | printModImmOperand(MI, 1, O); |
8161 | 404 | return; |
8162 | 0 | break; |
8163 | 168 | case 13: |
8164 | | // VCEQzv16i8, VCEQzv2i32, VCEQzv4i16, VCEQzv4i32, VCEQzv8i16, VCEQzv8i8,... |
8165 | 168 | SStream_concat0(O, ", #0"); |
8166 | 168 | op_addImm(MI, 0); |
8167 | 168 | return; |
8168 | 0 | break; |
8169 | 1.25k | case 14: |
8170 | | // VCVTf2xsd, VCVTf2xsq, VCVTf2xud, VCVTf2xuq, VCVTh2xsd, VCVTh2xsq, VCVT... |
8171 | 1.25k | printOperand(MI, 2, O); |
8172 | 1.25k | break; |
8173 | 127 | case 15: |
8174 | | // VGETLNs16, VGETLNs8, VGETLNu16, VGETLNu8 |
8175 | 127 | printVectorIndex(MI, 2, O); |
8176 | 127 | return; |
8177 | 0 | break; |
8178 | 9.07k | case 16: |
8179 | | // VLD1DUPd16wb_fixed, VLD1DUPd16wb_register, VLD1DUPd32wb_fixed, VLD1DUP... |
8180 | 9.07k | printAddrMode6Operand(MI, 2, O); |
8181 | 9.07k | break; |
8182 | 7.67k | case 17: |
8183 | | // VLD1LNd16, VLD1LNd16_UPD, VLD1LNd32, VLD1LNd32_UPD, VLD1LNd8, VLD1LNd8... |
8184 | 7.67k | SStream_concat0(O, "["); |
8185 | 7.67k | set_mem_access(MI, true); |
8186 | 7.67k | break; |
8187 | 915 | case 18: |
8188 | | // VLD3DUPd16, VLD3DUPd16_UPD, VLD3DUPd32, VLD3DUPd32_UPD, VLD3DUPd8, VLD... |
8189 | 915 | SStream_concat0(O, "[], "); |
8190 | 915 | printOperand(MI, 1, O); |
8191 | 915 | SStream_concat0(O, "[], "); |
8192 | 915 | printOperand(MI, 2, O); |
8193 | 915 | break; |
8194 | 325 | case 19: |
8195 | | // VMRS |
8196 | 325 | SStream_concat0(O, ", fpscr"); |
8197 | 325 | ARM_addReg(MI, ARM_REG_FPSCR); |
8198 | 325 | return; |
8199 | 0 | break; |
8200 | 276 | case 20: |
8201 | | // VMRS_FPEXC |
8202 | 276 | SStream_concat0(O, ", fpexc"); |
8203 | 276 | ARM_addReg(MI, ARM_REG_FPEXC); |
8204 | 276 | return; |
8205 | 0 | break; |
8206 | 309 | case 21: |
8207 | | // VMRS_FPINST |
8208 | 309 | SStream_concat0(O, ", fpinst"); |
8209 | 309 | ARM_addReg(MI, ARM_REG_FPINST); |
8210 | 309 | return; |
8211 | 0 | break; |
8212 | 20 | case 22: |
8213 | | // VMRS_FPINST2 |
8214 | 20 | SStream_concat0(O, ", fpinst2"); |
8215 | 20 | ARM_addReg(MI, ARM_REG_FPINST2); |
8216 | 20 | return; |
8217 | 0 | break; |
8218 | 227 | case 23: |
8219 | | // VMRS_FPSID |
8220 | 227 | SStream_concat0(O, ", fpsid"); |
8221 | 227 | ARM_addReg(MI, ARM_REG_FPSID); |
8222 | 227 | return; |
8223 | 0 | break; |
8224 | 54 | case 24: |
8225 | | // VMRS_MVFR0 |
8226 | 54 | SStream_concat0(O, ", mvfr0"); |
8227 | 54 | ARM_addReg(MI, ARM_REG_MVFR0); |
8228 | 54 | return; |
8229 | 0 | break; |
8230 | 42 | case 25: |
8231 | | // VMRS_MVFR1 |
8232 | 42 | SStream_concat0(O, ", mvfr1"); |
8233 | 42 | ARM_addReg(MI, ARM_REG_MVFR1); |
8234 | 42 | return; |
8235 | 0 | break; |
8236 | 56 | case 26: |
8237 | | // VMRS_MVFR2 |
8238 | 56 | SStream_concat0(O, ", mvfr2"); |
8239 | 56 | ARM_addReg(MI, ARM_REG_MVFR2); |
8240 | 56 | return; |
8241 | 0 | break; |
8242 | 281 | case 27: |
8243 | | // VSETLNi16, VSETLNi32, VSETLNi8 |
8244 | 281 | printVectorIndex(MI, 3, O); |
8245 | 281 | SStream_concat0(O, ", "); |
8246 | 281 | printOperand(MI, 2, O); |
8247 | 281 | return; |
8248 | 0 | break; |
8249 | 74 | case 28: |
8250 | | // VSHTOH, VTOSHH, VTOUHH, VUHTOH |
8251 | 74 | printFBits16(MI, 2, O); |
8252 | 74 | return; |
8253 | 0 | break; |
8254 | 241 | case 29: |
8255 | | // VSLTOD, VSLTOH, VSLTOS, VTOSLD, VTOSLH, VTOSLS, VTOULD, VTOULH, VTOULS... |
8256 | 241 | printFBits32(MI, 2, O); |
8257 | 241 | return; |
8258 | 0 | break; |
8259 | 522k | } |
8260 | | |
8261 | | |
8262 | | // Fragment 4 encoded into 7 bits for 65 unique commands. |
8263 | | // printf("Fragment 4: %"PRIu64"\n", ((Bits >> 35) & 127)); |
8264 | 421k | switch ((Bits >> 35) & 127) { |
8265 | 0 | default: // unreachable |
8266 | 83.6k | case 0: |
8267 | | // ASRi, ASRr, LDRConstPool, LSLi, LSLr, LSRi, LSRr, RORi, RORr, RRXi, t2... |
8268 | 83.6k | printOperand(MI, 1, O); |
8269 | 83.6k | break; |
8270 | 309 | case 1: |
8271 | | // LDRBT_POST, LDRT_POST, STRBT_POST, STRT_POST, LDA, LDAB, LDAEX, LDAEXB... |
8272 | 309 | printAddrMode7Operand(MI, 1, O); |
8273 | 309 | return; |
8274 | 0 | break; |
8275 | 0 | case 2: |
8276 | | // VLD1LNdAsm_16, VLD1LNdAsm_32, VLD1LNdAsm_8, VLD1LNdWB_fixed_Asm_16, VL... |
8277 | 0 | printAddrMode6Operand(MI, 2, O); |
8278 | 0 | break; |
8279 | 58.2k | case 3: |
8280 | | // VLD3DUPdWB_register_Asm_16, VLD3DUPdWB_register_Asm_32, VLD3DUPdWB_reg... |
8281 | 58.2k | printOperand(MI, 3, O); |
8282 | 58.2k | break; |
8283 | 14.7k | case 4: |
8284 | | // VLD3dAsm_16, VLD3dAsm_32, VLD3dAsm_8, VLD4dAsm_16, VLD4dAsm_32, VLD4dA... |
8285 | 14.7k | return; |
8286 | 0 | break; |
8287 | 4.33k | case 5: |
8288 | | // VLD3dWB_fixed_Asm_16, VLD3dWB_fixed_Asm_32, VLD3dWB_fixed_Asm_8, VLD4d... |
8289 | 4.33k | SStream_concat0(O, "!"); |
8290 | 4.33k | return; |
8291 | 0 | break; |
8292 | 11.4k | case 6: |
8293 | | // VLD3dWB_register_Asm_16, VLD3dWB_register_Asm_32, VLD3dWB_register_Asm... |
8294 | 11.4k | SStream_concat0(O, ", "); |
8295 | 11.4k | break; |
8296 | 1.09k | case 7: |
8297 | | // t2MOVSsi, t2MOVsi, t2CMNzrs, t2CMPrs, t2MVNs, t2TEQrs, t2TSTrs |
8298 | 1.09k | printT2SOOperand(MI, 1, O); |
8299 | 1.09k | return; |
8300 | 0 | break; |
8301 | 1.44k | case 8: |
8302 | | // t2MOVSsr, t2MOVsr, CMNzrsr, CMPrsr, MOVsr, MVNsr, TEQrsr, TSTrsr |
8303 | 1.44k | printSORegRegOperand(MI, 1, O); |
8304 | 1.44k | return; |
8305 | 0 | break; |
8306 | 0 | case 9: |
8307 | | // ADR, t2ADR |
8308 | 0 | printAdrLabelOperand(MI, 1, O, 0); |
8309 | 0 | return; |
8310 | 0 | break; |
8311 | 758 | case 10: |
8312 | | // BFC, t2BFC |
8313 | 758 | printBitfieldInvMaskImmOperand(MI, 2, O); |
8314 | 758 | return; |
8315 | 0 | break; |
8316 | 16.1k | case 11: |
8317 | | // BFI, CPS3p, CRC32B, CRC32CB, CRC32CH, CRC32CW, CRC32H, CRC32W, MOVTi16... |
8318 | 16.1k | printOperand(MI, 2, O); |
8319 | 16.1k | break; |
8320 | 1.05k | case 12: |
8321 | | // CMNri, CMPri, MOVi, MVNi, TEQri, TSTri |
8322 | 1.05k | printModImmOperand(MI, 1, O); |
8323 | 1.05k | return; |
8324 | 0 | break; |
8325 | 1.38k | case 13: |
8326 | | // CMNzrsi, CMPrsi, MOVsi, MVNsi, TEQrsi, TSTrsi |
8327 | 1.38k | printSORegImmOperand(MI, 1, O); |
8328 | 1.38k | return; |
8329 | 0 | break; |
8330 | 4.44k | case 14: |
8331 | | // FLDMXIA, FSTMXIA, LDMDA, LDMDB, LDMIA, LDMIB, STMDA, STMDB, STMIA, STM... |
8332 | 4.44k | printRegisterList(MI, 3, O); |
8333 | 4.44k | break; |
8334 | 4.27k | case 15: |
8335 | | // LDCL_OFFSET, LDC_OFFSET, STCL_OFFSET, STC_OFFSET, t2LDC2L_OFFSET, t2LD... |
8336 | 4.27k | printAddrMode5Operand(MI, 2, O, false); |
8337 | 4.27k | return; |
8338 | 0 | break; |
8339 | 20.9k | case 16: |
8340 | | // LDCL_OPTION, LDCL_POST, LDC_OPTION, LDC_POST, LDRBT_POST_IMM, LDRBT_PO... |
8341 | 20.9k | printAddrMode7Operand(MI, 2, O); |
8342 | 20.9k | break; |
8343 | 5.15k | case 17: |
8344 | | // LDCL_PRE, LDC_PRE, STCL_PRE, STC_PRE, t2LDC2L_PRE, t2LDC2_PRE, t2LDCL_... |
8345 | 5.15k | printAddrMode5Operand(MI, 2, O, true); |
8346 | 5.15k | SStream_concat0(O, "!"); |
8347 | 5.15k | return; |
8348 | 0 | break; |
8349 | 3.30k | case 18: |
8350 | | // LDRB_PRE_IMM, LDR_PRE_IMM, STRB_PRE_IMM, STR_PRE_IMM |
8351 | 3.30k | printAddrModeImm12Operand(MI, 2, O, true); |
8352 | 3.30k | SStream_concat0(O, "!"); |
8353 | 3.30k | return; |
8354 | 0 | break; |
8355 | 2.55k | case 19: |
8356 | | // LDRB_PRE_REG, LDR_PRE_REG, STRB_PRE_REG, STR_PRE_REG |
8357 | 2.55k | printAddrMode2Operand(MI, 2, O); |
8358 | 2.55k | SStream_concat0(O, "!"); |
8359 | 2.55k | return; |
8360 | 0 | break; |
8361 | 3.58k | case 20: |
8362 | | // LDRBi12, LDRcp, LDRi12, STRBi12, STRi12, t2LDRBi12, t2LDRHi12, t2LDRSB... |
8363 | 3.58k | printAddrModeImm12Operand(MI, 1, O, false); |
8364 | 3.58k | return; |
8365 | 0 | break; |
8366 | 2.45k | case 21: |
8367 | | // LDRBrs, LDRrs, STRBrs, STRrs |
8368 | 2.45k | printAddrMode2Operand(MI, 1, O); |
8369 | 2.45k | return; |
8370 | 0 | break; |
8371 | 1.50k | case 22: |
8372 | | // LDRH, LDRSB, LDRSH, STRH |
8373 | 1.50k | printAddrMode3Operand(MI, 1, O, false); |
8374 | 1.50k | return; |
8375 | 0 | break; |
8376 | 1.05k | case 23: |
8377 | | // LDRH_PRE, LDRSB_PRE, LDRSH_PRE, STRH_PRE |
8378 | 1.05k | printAddrMode3Operand(MI, 2, O, true); |
8379 | 1.05k | SStream_concat0(O, "!"); |
8380 | 1.05k | return; |
8381 | 0 | break; |
8382 | 325 | case 24: |
8383 | | // MCR2 |
8384 | 325 | printCImmediate(MI, 3, O); |
8385 | 325 | SStream_concat0(O, ", "); |
8386 | 325 | printCImmediate(MI, 4, O); |
8387 | 325 | SStream_concat0(O, ", "); |
8388 | 325 | printOperand(MI, 5, O); |
8389 | 325 | return; |
8390 | 0 | break; |
8391 | 271 | case 25: |
8392 | | // MRSbanked, t2MRSbanked |
8393 | 271 | printBankedRegOperand(MI, 1, O); |
8394 | 271 | return; |
8395 | 0 | break; |
8396 | 1.30k | case 26: |
8397 | | // SSAT, SSAT16, t2SSAT, t2SSAT16 |
8398 | 1.30k | printImmPlusOneOperand(MI, 1, O); |
8399 | 1.30k | SStream_concat0(O, ", "); |
8400 | 1.30k | printOperand(MI, 2, O); |
8401 | 1.30k | break; |
8402 | 386 | case 27: |
8403 | | // STLEXD, STREXD |
8404 | 386 | printGPRPairOperand(MI, 1, O); |
8405 | 386 | SStream_concat0(O, ", "); |
8406 | 386 | printAddrMode7Operand(MI, 2, O); |
8407 | 386 | return; |
8408 | 0 | break; |
8409 | 198 | case 28: |
8410 | | // VCEQzv2f32, VCEQzv4f16, VCEQzv4f32, VCEQzv8f16, VCGEzv2f32, VCGEzv4f16... |
8411 | 198 | SStream_concat0(O, ", #0"); |
8412 | 198 | op_addImm(MI, 0); |
8413 | 198 | return; |
8414 | 0 | break; |
8415 | 533 | case 29: |
8416 | | // VLD1LNd16, VLD1LNd32, VLD1LNd8, VST2LNd16, VST2LNd32, VST2LNd8, VST2LN... |
8417 | 533 | printNoHashImmediate(MI, 4, O); |
8418 | 533 | break; |
8419 | 2.39k | case 30: |
8420 | | // VLD1LNd16_UPD, VLD1LNd32_UPD, VLD1LNd8_UPD, VLD2LNd16, VLD2LNd32, VLD2... |
8421 | 2.39k | printNoHashImmediate(MI, 6, O); |
8422 | 2.39k | break; |
8423 | 1.73k | case 31: |
8424 | | // VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_UPD, VLD2LNq32_U... |
8425 | 1.73k | printNoHashImmediate(MI, 8, O); |
8426 | 1.73k | SStream_concat0(O, "], "); |
8427 | 1.73k | set_mem_access(MI, false); |
8428 | 1.73k | break; |
8429 | 508 | case 32: |
8430 | | // VLD3DUPd16, VLD3DUPd16_UPD, VLD3DUPd32, VLD3DUPd32_UPD, VLD3DUPd8, VLD... |
8431 | 508 | SStream_concat0(O, "[]}, "); |
8432 | 508 | break; |
8433 | 651 | case 33: |
8434 | | // VLD3LNd16_UPD, VLD3LNd32_UPD, VLD3LNd8_UPD, VLD3LNq16_UPD, VLD3LNq32_U... |
8435 | 651 | printNoHashImmediate(MI, 10, O); |
8436 | 651 | SStream_concat0(O, "], "); |
8437 | 651 | set_mem_access(MI, false); |
8438 | 651 | printOperand(MI, 1, O); |
8439 | 651 | SStream_concat0(O, "["); |
8440 | 651 | set_mem_access(MI, true); |
8441 | 651 | printNoHashImmediate(MI, 10, O); |
8442 | 651 | SStream_concat0(O, "], "); |
8443 | 651 | set_mem_access(MI, false); |
8444 | 651 | printOperand(MI, 2, O); |
8445 | 651 | SStream_concat0(O, "["); |
8446 | 651 | set_mem_access(MI, true); |
8447 | 651 | printNoHashImmediate(MI, 10, O); |
8448 | 651 | break; |
8449 | 407 | case 34: |
8450 | | // VLD4DUPd16, VLD4DUPd16_UPD, VLD4DUPd32, VLD4DUPd32_UPD, VLD4DUPd8, VLD... |
8451 | 407 | SStream_concat0(O, "[], "); |
8452 | 407 | printOperand(MI, 3, O); |
8453 | 407 | SStream_concat0(O, "[]}, "); |
8454 | 407 | break; |
8455 | 1.06k | case 35: |
8456 | | // VLD4LNd16_UPD, VLD4LNd32_UPD, VLD4LNd8_UPD, VLD4LNq16_UPD, VLD4LNq32_U... |
8457 | 1.06k | printNoHashImmediate(MI, 12, O); |
8458 | 1.06k | SStream_concat0(O, "], "); |
8459 | 1.06k | set_mem_access(MI, false); |
8460 | 1.06k | printOperand(MI, 1, O); |
8461 | 1.06k | SStream_concat0(O, "["); |
8462 | 1.06k | set_mem_access(MI, true); |
8463 | 1.06k | printNoHashImmediate(MI, 12, O); |
8464 | 1.06k | SStream_concat0(O, "], "); |
8465 | 1.06k | set_mem_access(MI, false); |
8466 | 1.06k | printOperand(MI, 2, O); |
8467 | 1.06k | SStream_concat0(O, "["); |
8468 | 1.06k | set_mem_access(MI, true); |
8469 | 1.06k | printNoHashImmediate(MI, 12, O); |
8470 | 1.06k | SStream_concat0(O, "], "); |
8471 | 1.06k | set_mem_access(MI, false); |
8472 | 1.06k | printOperand(MI, 3, O); |
8473 | 1.06k | SStream_concat0(O, "["); |
8474 | 1.06k | set_mem_access(MI, true); |
8475 | 1.06k | printNoHashImmediate(MI, 12, O); |
8476 | 1.06k | SStream_concat0(O, "]}, "); |
8477 | 1.06k | set_mem_access(MI, false); |
8478 | 1.06k | printAddrMode6Operand(MI, 5, O); |
8479 | 1.06k | printAddrMode6OffsetOperand(MI, 7, O); |
8480 | 1.06k | return; |
8481 | 0 | break; |
8482 | 471 | case 36: |
8483 | | // VLDRD, VLDRS, VSTRD, VSTRS |
8484 | 471 | printAddrMode5Operand(MI, 1, O, false); |
8485 | 471 | return; |
8486 | 0 | break; |
8487 | 223 | case 37: |
8488 | | // VLDRH, VSTRH |
8489 | 223 | printAddrMode5FP16Operand(MI, 1, O, false); |
8490 | 223 | return; |
8491 | 0 | break; |
8492 | 31 | case 38: |
8493 | | // VST1LNd16, VST1LNd32, VST1LNd8 |
8494 | 31 | printNoHashImmediate(MI, 3, O); |
8495 | 31 | SStream_concat0(O, "]}, "); |
8496 | 31 | set_mem_access(MI, false); |
8497 | 31 | printAddrMode6Operand(MI, 0, O); |
8498 | 31 | return; |
8499 | 0 | break; |
8500 | 647 | case 39: |
8501 | | // VST1LNd16_UPD, VST1LNd32_UPD, VST1LNd8_UPD, VST3LNd16, VST3LNd32, VST3... |
8502 | 647 | printNoHashImmediate(MI, 5, O); |
8503 | 647 | break; |
8504 | 630 | case 40: |
8505 | | // VST3LNd16_UPD, VST3LNd32_UPD, VST3LNd8_UPD, VST3LNq16_UPD, VST3LNq32_U... |
8506 | 630 | printNoHashImmediate(MI, 7, O); |
8507 | 630 | SStream_concat0(O, "], "); |
8508 | 630 | set_mem_access(MI, false); |
8509 | 630 | printOperand(MI, 5, O); |
8510 | 630 | SStream_concat0(O, "["); |
8511 | 630 | set_mem_access(MI, true); |
8512 | 630 | printNoHashImmediate(MI, 7, O); |
8513 | 630 | SStream_concat0(O, "], "); |
8514 | 630 | set_mem_access(MI, false); |
8515 | 630 | printOperand(MI, 6, O); |
8516 | 630 | SStream_concat0(O, "["); |
8517 | 630 | set_mem_access(MI, true); |
8518 | 630 | printNoHashImmediate(MI, 7, O); |
8519 | 630 | SStream_concat0(O, "]}, "); |
8520 | 630 | set_mem_access(MI, false); |
8521 | 630 | printAddrMode6Operand(MI, 1, O); |
8522 | 630 | printAddrMode6OffsetOperand(MI, 3, O); |
8523 | 630 | return; |
8524 | 0 | break; |
8525 | 2.08k | case 41: |
8526 | | // VST3d16_UPD, VST3d32_UPD, VST3d8_UPD, VST3q16_UPD, VST3q32_UPD, VST3q8... |
8527 | 2.08k | printOperand(MI, 5, O); |
8528 | 2.08k | SStream_concat0(O, ", "); |
8529 | 2.08k | printOperand(MI, 6, O); |
8530 | 2.08k | break; |
8531 | 270 | case 42: |
8532 | | // VTBL1 |
8533 | 270 | printVectorListOne(MI, 1, O); |
8534 | 270 | SStream_concat0(O, ", "); |
8535 | 270 | printOperand(MI, 2, O); |
8536 | 270 | return; |
8537 | 0 | break; |
8538 | 251 | case 43: |
8539 | | // VTBL2 |
8540 | 251 | printVectorListTwo(MI, 1, O); |
8541 | 251 | SStream_concat0(O, ", "); |
8542 | 251 | printOperand(MI, 2, O); |
8543 | 251 | return; |
8544 | 0 | break; |
8545 | 122 | case 44: |
8546 | | // VTBL3 |
8547 | 122 | printVectorListThree(MI, 1, O); |
8548 | 122 | SStream_concat0(O, ", "); |
8549 | 122 | printOperand(MI, 2, O); |
8550 | 122 | return; |
8551 | 0 | break; |
8552 | 162 | case 45: |
8553 | | // VTBL4 |
8554 | 162 | printVectorListFour(MI, 1, O); |
8555 | 162 | SStream_concat0(O, ", "); |
8556 | 162 | printOperand(MI, 2, O); |
8557 | 162 | return; |
8558 | 0 | break; |
8559 | 24 | case 46: |
8560 | | // VTBX1 |
8561 | 24 | printVectorListOne(MI, 2, O); |
8562 | 24 | SStream_concat0(O, ", "); |
8563 | 24 | printOperand(MI, 3, O); |
8564 | 24 | return; |
8565 | 0 | break; |
8566 | 39 | case 47: |
8567 | | // VTBX2 |
8568 | 39 | printVectorListTwo(MI, 2, O); |
8569 | 39 | SStream_concat0(O, ", "); |
8570 | 39 | printOperand(MI, 3, O); |
8571 | 39 | return; |
8572 | 0 | break; |
8573 | 158 | case 48: |
8574 | | // VTBX3 |
8575 | 158 | printVectorListThree(MI, 2, O); |
8576 | 158 | SStream_concat0(O, ", "); |
8577 | 158 | printOperand(MI, 3, O); |
8578 | 158 | return; |
8579 | 0 | break; |
8580 | 73 | case 49: |
8581 | | // VTBX4 |
8582 | 73 | printVectorListFour(MI, 2, O); |
8583 | 73 | SStream_concat0(O, ", "); |
8584 | 73 | printOperand(MI, 3, O); |
8585 | 73 | return; |
8586 | 0 | break; |
8587 | 1.39k | case 50: |
8588 | | // sysLDMDA_UPD, sysLDMDB_UPD, sysLDMIA_UPD, sysLDMIB_UPD, sysSTMDA_UPD, ... |
8589 | 1.39k | SStream_concat0(O, " ^"); |
8590 | 1.39k | ARM_addUserMode(MI); |
8591 | 1.39k | return; |
8592 | 0 | break; |
8593 | 2.06k | case 51: |
8594 | | // t2LDRBT, t2LDRBi8, t2LDRHT, t2LDRHi8, t2LDRSBT, t2LDRSBi8, t2LDRSHT, t... |
8595 | 2.06k | printT2AddrModeImm8Operand(MI, 1, O, false); |
8596 | 2.06k | return; |
8597 | 0 | break; |
8598 | 723 | case 52: |
8599 | | // t2LDRB_PRE, t2LDRH_PRE, t2LDRSB_PRE, t2LDRSH_PRE, t2LDR_PRE, t2STRB_PR... |
8600 | 723 | printT2AddrModeImm8Operand(MI, 2, O, true); |
8601 | 723 | SStream_concat0(O, "!"); |
8602 | 723 | return; |
8603 | 0 | break; |
8604 | 12.7k | case 53: |
8605 | | // t2LDRBpci, t2LDRHpci, t2LDRSBpci, t2LDRSHpci, t2LDRpci, tLDRpci |
8606 | 12.7k | printThumbLdrLabelOperand(MI, 1, O); |
8607 | 12.7k | return; |
8608 | 0 | break; |
8609 | 1.62k | case 54: |
8610 | | // t2LDRBs, t2LDRHs, t2LDRSBs, t2LDRSHs, t2LDRs, t2STRBs, t2STRHs, t2STRs |
8611 | 1.62k | printT2AddrModeSoRegOperand(MI, 1, O); |
8612 | 1.62k | return; |
8613 | 0 | break; |
8614 | 84 | case 55: |
8615 | | // t2LDREX |
8616 | 84 | printT2AddrModeImm0_1020s4Operand(MI, 1, O); |
8617 | 84 | return; |
8618 | 0 | break; |
8619 | 647 | case 56: |
8620 | | // t2MRS_M |
8621 | 647 | printMSRMaskOperand(MI, 1, O); |
8622 | 647 | return; |
8623 | 0 | break; |
8624 | 1.51k | case 57: |
8625 | | // tADDspi, tSUBspi |
8626 | 1.51k | printThumbS4ImmOperand(MI, 2, O); |
8627 | 1.51k | return; |
8628 | 0 | break; |
8629 | 8.99k | case 58: |
8630 | | // tADR |
8631 | 8.99k | printAdrLabelOperand(MI, 1, O, 2); |
8632 | 8.99k | return; |
8633 | 0 | break; |
8634 | 24.6k | case 59: |
8635 | | // tASRri, tLSRri |
8636 | 24.6k | printThumbSRImm(MI, 3, O); |
8637 | 24.6k | return; |
8638 | 0 | break; |
8639 | 26.7k | case 60: |
8640 | | // tLDRBi, tSTRBi |
8641 | 26.7k | printThumbAddrModeImm5S1Operand(MI, 1, O); |
8642 | 26.7k | return; |
8643 | 0 | break; |
8644 | 12.6k | case 61: |
8645 | | // tLDRBr, tLDRHr, tLDRSB, tLDRSH, tLDRr, tSTRBr, tSTRHr, tSTRr |
8646 | 12.6k | printThumbAddrModeRROperand(MI, 1, O); |
8647 | 12.6k | return; |
8648 | 0 | break; |
8649 | 23.0k | case 62: |
8650 | | // tLDRHi, tSTRHi |
8651 | 23.0k | printThumbAddrModeImm5S2Operand(MI, 1, O); |
8652 | 23.0k | return; |
8653 | 0 | break; |
8654 | 34.6k | case 63: |
8655 | | // tLDRi, tSTRi |
8656 | 34.6k | printThumbAddrModeImm5S4Operand(MI, 1, O); |
8657 | 34.6k | return; |
8658 | 0 | break; |
8659 | 11.0k | case 64: |
8660 | | // tLDRspi, tSTRspi |
8661 | 11.0k | printThumbAddrModeSPOperand(MI, 1, O); |
8662 | 11.0k | return; |
8663 | 0 | break; |
8664 | 421k | } |
8665 | | |
8666 | | |
8667 | | // Fragment 5 encoded into 5 bits for 23 unique commands. |
8668 | | // printf("Fragment 5: %"PRIu64"\n", ((Bits >> 42) & 31)); |
8669 | 205k | switch ((Bits >> 42) & 31) { |
8670 | 0 | default: // unreachable |
8671 | 87.5k | case 0: |
8672 | | // ASRi, ASRr, LSLi, LSLr, LSRi, LSRr, RORi, RORr, VLD1LNdWB_register_Asm... |
8673 | 87.5k | SStream_concat0(O, ", "); |
8674 | 87.5k | break; |
8675 | 90.3k | case 1: |
8676 | | // LDRConstPool, RRXi, VLD1LNdAsm_16, VLD1LNdAsm_32, VLD1LNdAsm_8, VLD2LN... |
8677 | 90.3k | return; |
8678 | 0 | break; |
8679 | 0 | case 2: |
8680 | | // VLD1LNdWB_fixed_Asm_16, VLD1LNdWB_fixed_Asm_32, VLD1LNdWB_fixed_Asm_8,... |
8681 | 0 | SStream_concat0(O, "!"); |
8682 | 0 | return; |
8683 | 0 | break; |
8684 | 788 | case 3: |
8685 | | // VLD3dWB_register_Asm_16, VLD3dWB_register_Asm_32, VLD3dWB_register_Asm... |
8686 | 788 | printOperand(MI, 3, O); |
8687 | 788 | break; |
8688 | 3.21k | case 4: |
8689 | | // CDP, t2CDP, t2CDP2 |
8690 | 3.21k | printCImmediate(MI, 2, O); |
8691 | 3.21k | SStream_concat0(O, ", "); |
8692 | 3.21k | printCImmediate(MI, 3, O); |
8693 | 3.21k | SStream_concat0(O, ", "); |
8694 | 3.21k | printCImmediate(MI, 4, O); |
8695 | 3.21k | SStream_concat0(O, ", "); |
8696 | 3.21k | printOperand(MI, 5, O); |
8697 | 3.21k | return; |
8698 | 0 | break; |
8699 | 2.70k | case 5: |
8700 | | // MCR, MCRR, VABDfd, VABDfq, VABDhd, VABDhq, VACGEfd, VACGEfq, VACGEhd, ... |
8701 | 2.70k | printOperand(MI, 2, O); |
8702 | 2.70k | break; |
8703 | 1.10k | case 6: |
8704 | | // SSAT, t2SSAT |
8705 | 1.10k | printShiftImmOperand(MI, 3, O); |
8706 | 1.10k | return; |
8707 | 0 | break; |
8708 | 1.47k | case 7: |
8709 | | // SXTB, SXTB16, SXTH, UXTB, UXTB16, UXTH, t2SXTB, t2SXTB16, t2SXTH, t2UX... |
8710 | 1.47k | printRotImmOperand(MI, 2, O); |
8711 | 1.47k | return; |
8712 | 0 | break; |
8713 | 1.30k | case 8: |
8714 | | // VCMLAv2f32_indexed, VCMLAv4f16_indexed, VCMLAv4f32_indexed, VCMLAv8f16... |
8715 | 1.30k | printVectorIndex(MI, 4, O); |
8716 | 1.30k | break; |
8717 | 375 | case 9: |
8718 | | // VDUPLN16d, VDUPLN16q, VDUPLN32d, VDUPLN32q, VDUPLN8d, VDUPLN8q, VGETLN... |
8719 | 375 | printVectorIndex(MI, 2, O); |
8720 | 375 | return; |
8721 | 0 | break; |
8722 | 4.74k | case 10: |
8723 | | // VLD1DUPd16wb_register, VLD1DUPd32wb_register, VLD1DUPd8wb_register, VL... |
8724 | 4.74k | printOperand(MI, 4, O); |
8725 | 4.74k | return; |
8726 | 0 | break; |
8727 | 2.04k | case 11: |
8728 | | // VLD1LNd16, VLD1LNd16_UPD, VLD1LNd32, VLD1LNd32_UPD, VLD1LNd8, VLD1LNd8... |
8729 | 2.04k | SStream_concat0(O, "]}, "); |
8730 | 2.04k | set_mem_access(MI, false); |
8731 | 2.04k | break; |
8732 | 2.18k | case 12: |
8733 | | // VLD2LNd16, VLD2LNd32, VLD2LNd8, VLD2LNq16, VLD2LNq32, VLD4LNd16, VLD4L... |
8734 | 2.18k | SStream_concat0(O, "], "); |
8735 | 2.18k | set_mem_access(MI, false); |
8736 | 2.18k | break; |
8737 | 1.06k | case 13: |
8738 | | // VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_UPD, VLD2LNq32_U... |
8739 | 1.06k | printOperand(MI, 1, O); |
8740 | 1.06k | SStream_concat0(O, "["); |
8741 | 1.06k | set_mem_access(MI, true); |
8742 | 1.06k | printNoHashImmediate(MI, 8, O); |
8743 | 1.06k | break; |
8744 | 127 | case 14: |
8745 | | // VLD3DUPd16, VLD3DUPd32, VLD3DUPd8, VLD3DUPq16, VLD3DUPq32, VLD3DUPq8 |
8746 | 127 | printAddrMode6Operand(MI, 3, O); |
8747 | 127 | return; |
8748 | 0 | break; |
8749 | 493 | case 15: |
8750 | | // VLD3DUPd16_UPD, VLD3DUPd32_UPD, VLD3DUPd8_UPD, VLD3DUPq16_UPD, VLD3DUP... |
8751 | 493 | printAddrMode6Operand(MI, 4, O); |
8752 | 493 | break; |
8753 | 295 | case 16: |
8754 | | // VLD4DUPd16_UPD, VLD4DUPd32_UPD, VLD4DUPd8_UPD, VLD4DUPq16_UPD, VLD4DUP... |
8755 | 295 | printAddrMode6Operand(MI, 5, O); |
8756 | 295 | printAddrMode6OffsetOperand(MI, 7, O); |
8757 | 295 | return; |
8758 | 0 | break; |
8759 | 755 | case 17: |
8760 | | // VMULLslsv2i32, VMULLslsv4i16, VMULLsluv2i32, VMULLsluv4i16, VMULslv2i3... |
8761 | 755 | printVectorIndex(MI, 3, O); |
8762 | 755 | return; |
8763 | 0 | break; |
8764 | 635 | case 18: |
8765 | | // VST3d16_UPD, VST3d32_UPD, VST3d8_UPD, VST3q16_UPD, VST3q32_UPD, VST3q8... |
8766 | 635 | SStream_concat0(O, "}, "); |
8767 | 635 | printAddrMode6Operand(MI, 1, O); |
8768 | 635 | printAddrMode6OffsetOperand(MI, 3, O); |
8769 | 635 | return; |
8770 | 0 | break; |
8771 | 665 | case 19: |
8772 | | // VST4LNd16_UPD, VST4LNd32_UPD, VST4LNd8_UPD, VST4LNq16_UPD, VST4LNq32_U... |
8773 | 665 | printOperand(MI, 5, O); |
8774 | 665 | SStream_concat0(O, "["); |
8775 | 665 | set_mem_access(MI, true); |
8776 | 665 | printNoHashImmediate(MI, 8, O); |
8777 | 665 | SStream_concat0(O, "], "); |
8778 | 665 | set_mem_access(MI, false); |
8779 | 665 | printOperand(MI, 6, O); |
8780 | 665 | SStream_concat0(O, "["); |
8781 | 665 | set_mem_access(MI, true); |
8782 | 665 | printNoHashImmediate(MI, 8, O); |
8783 | 665 | SStream_concat0(O, "], "); |
8784 | 665 | set_mem_access(MI, false); |
8785 | 665 | printOperand(MI, 7, O); |
8786 | 665 | SStream_concat0(O, "["); |
8787 | 665 | set_mem_access(MI, true); |
8788 | 665 | printNoHashImmediate(MI, 8, O); |
8789 | 665 | SStream_concat0(O, "]}, "); |
8790 | 665 | set_mem_access(MI, false); |
8791 | 665 | printAddrMode6Operand(MI, 1, O); |
8792 | 665 | printAddrMode6OffsetOperand(MI, 3, O); |
8793 | 665 | return; |
8794 | 0 | break; |
8795 | 1.75k | case 20: |
8796 | | // sysLDMDA, sysLDMDB, sysLDMIA, sysLDMIB, sysSTMDA, sysSTMDB, sysSTMIA, ... |
8797 | 1.75k | SStream_concat0(O, " ^"); |
8798 | 1.75k | ARM_addUserMode(MI); |
8799 | 1.75k | return; |
8800 | 0 | break; |
8801 | 1.56k | case 21: |
8802 | | // t2LDRB_POST, t2LDRH_POST, t2LDRSB_POST, t2LDRSH_POST, t2LDR_POST, t2ST... |
8803 | 1.56k | printT2AddrModeImm8OffsetOperand(MI, 3, O); |
8804 | 1.56k | return; |
8805 | 0 | break; |
8806 | 0 | case 22: |
8807 | | // t2MOVsra_flag, t2MOVsrl_flag |
8808 | 0 | SStream_concat0(O, ", #1"); |
8809 | 0 | op_addImm(MI, 1); |
8810 | 0 | return; |
8811 | 0 | break; |
8812 | 205k | } |
8813 | | |
8814 | | |
8815 | | // Fragment 6 encoded into 6 bits for 38 unique commands. |
8816 | | // printf("Fragment 6: %"PRIu64"\n", ((Bits >> 47) & 63)); |
8817 | 98.1k | switch ((Bits >> 47) & 63) { |
8818 | 0 | default: // unreachable |
8819 | 29.1k | case 0: |
8820 | | // ASRi, ASRr, LSLi, LSLr, LSRi, LSRr, RORi, RORr, ADCrr, ADDrr, ANDrr, B... |
8821 | 29.1k | printOperand(MI, 2, O); |
8822 | 29.1k | break; |
8823 | 1.77k | case 1: |
8824 | | // VLD1LNdWB_register_Asm_16, VLD1LNdWB_register_Asm_32, VLD1LNdWB_regist... |
8825 | 1.77k | printOperand(MI, 4, O); |
8826 | 1.77k | break; |
8827 | 2.58k | case 2: |
8828 | | // VLD3dWB_register_Asm_16, VLD3dWB_register_Asm_32, VLD3dWB_register_Asm... |
8829 | 2.58k | return; |
8830 | 0 | break; |
8831 | 4.88k | case 3: |
8832 | | // ADCri, ADDri, ANDri, BICri, EORri, ORRri, RSBri, RSCri, SBCri, SUBri |
8833 | 4.88k | printModImmOperand(MI, 2, O); |
8834 | 4.88k | return; |
8835 | 0 | break; |
8836 | 7.72k | case 4: |
8837 | | // ADCrsi, ADDrsi, ANDrsi, BICrsi, EORrsi, ORRrsi, RSBrsi, RSCrsi, SBCrsi... |
8838 | 7.72k | printSORegImmOperand(MI, 2, O); |
8839 | 7.72k | return; |
8840 | 0 | break; |
8841 | 839 | case 5: |
8842 | | // BFI, t2BFI |
8843 | 839 | printBitfieldInvMaskImmOperand(MI, 3, O); |
8844 | 839 | return; |
8845 | 0 | break; |
8846 | 1.89k | case 6: |
8847 | | // LDCL_OPTION, LDC_OPTION, STCL_OPTION, STC_OPTION, t2LDC2L_OPTION, t2LD... |
8848 | 1.89k | printCoprocOptionImm(MI, 3, O); |
8849 | 1.89k | return; |
8850 | 0 | break; |
8851 | 4.49k | case 7: |
8852 | | // LDCL_POST, LDC_POST, STCL_POST, STC_POST, t2LDC2L_POST, t2LDC2_POST, t... |
8853 | 4.49k | printPostIdxImm8s4Operand(MI, 3, O); |
8854 | 4.49k | return; |
8855 | 0 | break; |
8856 | 8.73k | case 8: |
8857 | | // LDRBT_POST_IMM, LDRBT_POST_REG, LDRB_POST_IMM, LDRB_POST_REG, LDRT_POS... |
8858 | 8.73k | printAddrMode2OffsetOperand(MI, 3, O); |
8859 | 8.73k | return; |
8860 | 0 | break; |
8861 | 706 | case 9: |
8862 | | // LDRD, STRD |
8863 | 706 | printAddrMode3Operand(MI, 2, O, false); |
8864 | 706 | return; |
8865 | 0 | break; |
8866 | 3.41k | case 10: |
8867 | | // LDRD_POST, STRD_POST, t2LDRD_POST, t2STRD_POST |
8868 | 3.41k | printAddrMode7Operand(MI, 3, O); |
8869 | 3.41k | break; |
8870 | 358 | case 11: |
8871 | | // LDRD_PRE, STRD_PRE |
8872 | 358 | printAddrMode3Operand(MI, 3, O, true); |
8873 | 358 | SStream_concat0(O, "!"); |
8874 | 358 | return; |
8875 | 0 | break; |
8876 | 525 | case 12: |
8877 | | // LDRHTi, LDRSBTi, LDRSHTi, STRHTi |
8878 | 525 | printPostIdxImm8Operand(MI, 3, O); |
8879 | 525 | return; |
8880 | 0 | break; |
8881 | 1.86k | case 13: |
8882 | | // LDRHTr, LDRSBTr, LDRSHTr, STRHTr |
8883 | 1.86k | printPostIdxRegOperand(MI, 3, O); |
8884 | 1.86k | return; |
8885 | 0 | break; |
8886 | 1.85k | case 14: |
8887 | | // LDRH_POST, LDRSB_POST, LDRSH_POST, STRH_POST |
8888 | 1.85k | printAddrMode3OffsetOperand(MI, 3, O); |
8889 | 1.85k | return; |
8890 | 0 | break; |
8891 | 2.04k | case 15: |
8892 | | // MCR, MCRR, VCMLAv2f32_indexed, VCMLAv4f16_indexed, VCMLAv4f32_indexed,... |
8893 | 2.04k | SStream_concat0(O, ", "); |
8894 | 2.04k | break; |
8895 | 274 | case 16: |
8896 | | // MCRR2 |
8897 | 274 | printCImmediate(MI, 4, O); |
8898 | 274 | return; |
8899 | 0 | break; |
8900 | 1.19k | case 17: |
8901 | | // STLEX, STLEXB, STLEXH, STREX, STREXB, STREXH, SWP, SWPB, t2LDAEXD, t2L... |
8902 | 1.19k | printAddrMode7Operand(MI, 2, O); |
8903 | 1.19k | return; |
8904 | 0 | break; |
8905 | 1.36k | case 18: |
8906 | | // VBIFd, VBIFq, VBITd, VBITq, VBSLd, VBSLq, VLD4LNd16, VLD4LNd32, VLD4LN... |
8907 | 1.36k | printOperand(MI, 3, O); |
8908 | 1.36k | break; |
8909 | 72 | case 19: |
8910 | | // VCADDv2f32, VCADDv4f16, VCADDv4f32, VCADDv8f16 |
8911 | 72 | printComplexRotationOp(MI, 3, O, 180, 90); |
8912 | 72 | return; |
8913 | 0 | break; |
8914 | 540 | case 20: |
8915 | | // VCMLAv2f32, VCMLAv4f16, VCMLAv4f32, VCMLAv8f16 |
8916 | 540 | printComplexRotationOp(MI, 4, O, 90, 0); |
8917 | 540 | return; |
8918 | 0 | break; |
8919 | 841 | case 21: |
8920 | | // VLD1LNd16, VLD1LNd32, VLD1LNd8, VST1LNd16_UPD, VST1LNd32_UPD, VST1LNd8... |
8921 | 841 | printAddrMode6Operand(MI, 1, O); |
8922 | 841 | break; |
8923 | 786 | case 22: |
8924 | | // VLD1LNd16_UPD, VLD1LNd32_UPD, VLD1LNd8_UPD |
8925 | 786 | printAddrMode6Operand(MI, 2, O); |
8926 | 786 | printAddrMode6OffsetOperand(MI, 4, O); |
8927 | 786 | return; |
8928 | 0 | break; |
8929 | 95 | case 23: |
8930 | | // VLD2LNd16, VLD2LNd32, VLD2LNd8, VLD2LNq16, VLD2LNq32 |
8931 | 95 | printOperand(MI, 1, O); |
8932 | 95 | SStream_concat0(O, "["); |
8933 | 95 | set_mem_access(MI, true); |
8934 | 95 | printNoHashImmediate(MI, 6, O); |
8935 | 95 | SStream_concat0(O, "]}, "); |
8936 | 95 | set_mem_access(MI, false); |
8937 | 95 | printAddrMode6Operand(MI, 2, O); |
8938 | 95 | return; |
8939 | 0 | break; |
8940 | 802 | case 24: |
8941 | | // VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_UPD, VLD2LNq32_U... |
8942 | 802 | SStream_concat0(O, "]}, "); |
8943 | 802 | set_mem_access(MI, false); |
8944 | 802 | printAddrMode6Operand(MI, 3, O); |
8945 | 802 | printAddrMode6OffsetOperand(MI, 5, O); |
8946 | 802 | return; |
8947 | 0 | break; |
8948 | 381 | case 25: |
8949 | | // VLD3DUPd16_UPD, VLD3DUPd32_UPD, VLD3DUPd8_UPD, VLD3DUPq16_UPD, VLD3DUP... |
8950 | 381 | printAddrMode6OffsetOperand(MI, 6, O); |
8951 | 381 | return; |
8952 | 0 | break; |
8953 | 265 | case 26: |
8954 | | // VLD3LNd16, VLD3LNd32, VLD3LNd8, VLD3LNq16, VLD3LNq32 |
8955 | 265 | SStream_concat0(O, "], "); |
8956 | 265 | set_mem_access(MI, false); |
8957 | 265 | printOperand(MI, 2, O); |
8958 | 265 | SStream_concat0(O, "["); |
8959 | 265 | set_mem_access(MI, true); |
8960 | 265 | printNoHashImmediate(MI, 8, O); |
8961 | 265 | SStream_concat0(O, "]}, "); |
8962 | 265 | set_mem_access(MI, false); |
8963 | 265 | printAddrMode6Operand(MI, 3, O); |
8964 | 265 | return; |
8965 | 0 | break; |
8966 | 416 | case 27: |
8967 | | // VLD3LNd16_UPD, VLD3LNd32_UPD, VLD3LNd8_UPD, VLD3LNq16_UPD, VLD3LNq32_U... |
8968 | 416 | printAddrMode6Operand(MI, 4, O); |
8969 | 416 | printAddrMode6OffsetOperand(MI, 6, O); |
8970 | 416 | return; |
8971 | 0 | break; |
8972 | 67 | case 28: |
8973 | | // VMLAslfd, VMLAslfq, VMLAslhd, VMLAslhq, VMLSslfd, VMLSslfq, VMLSslhd, ... |
8974 | 67 | printVectorIndex(MI, 4, O); |
8975 | 67 | return; |
8976 | 0 | break; |
8977 | 213 | case 29: |
8978 | | // VMULslfd, VMULslfq, VMULslhd, VMULslhq |
8979 | 213 | printVectorIndex(MI, 3, O); |
8980 | 213 | return; |
8981 | 0 | break; |
8982 | 1.25k | case 30: |
8983 | | // VST2LNd16_UPD, VST2LNd32_UPD, VST2LNd8_UPD, VST2LNq16_UPD, VST2LNq32_U... |
8984 | 1.25k | printOperand(MI, 5, O); |
8985 | 1.25k | SStream_concat0(O, "["); |
8986 | 1.25k | set_mem_access(MI, true); |
8987 | 1.25k | printNoHashImmediate(MI, 6, O); |
8988 | 1.25k | SStream_concat0(O, "]}, "); |
8989 | 1.25k | set_mem_access(MI, false); |
8990 | 1.25k | printAddrMode6Operand(MI, 1, O); |
8991 | 1.25k | printAddrMode6OffsetOperand(MI, 3, O); |
8992 | 1.25k | return; |
8993 | 0 | break; |
8994 | 1.45k | case 31: |
8995 | | // VST4d16_UPD, VST4d32_UPD, VST4d8_UPD, VST4q16_UPD, VST4q32_UPD, VST4q8... |
8996 | 1.45k | printOperand(MI, 7, O); |
8997 | 1.45k | SStream_concat0(O, "}, "); |
8998 | 1.45k | printAddrMode6Operand(MI, 1, O); |
8999 | 1.45k | printAddrMode6OffsetOperand(MI, 3, O); |
9000 | 1.45k | return; |
9001 | 0 | break; |
9002 | 2.70k | case 32: |
9003 | | // t2ADCrs, t2ADDrs, t2ANDrs, t2BICrs, t2EORrs, t2ORNrs, t2ORRrs, t2RSBrs... |
9004 | 2.70k | printT2SOOperand(MI, 2, O); |
9005 | 2.70k | return; |
9006 | 0 | break; |
9007 | 265 | case 33: |
9008 | | // t2ASRri, t2LSRri |
9009 | 265 | printThumbSRImm(MI, 2, O); |
9010 | 265 | return; |
9011 | 0 | break; |
9012 | 5.05k | case 34: |
9013 | | // t2LDRD_PRE, t2STRD_PRE |
9014 | 5.05k | printT2AddrModeImm8s4Operand(MI, 3, O, true); |
9015 | 5.05k | SStream_concat0(O, "!"); |
9016 | 5.05k | return; |
9017 | 0 | break; |
9018 | 1.05k | case 35: |
9019 | | // t2LDRDi8, t2STRDi8 |
9020 | 1.05k | printT2AddrModeImm8s4Operand(MI, 2, O, false); |
9021 | 1.05k | return; |
9022 | 0 | break; |
9023 | 846 | case 36: |
9024 | | // t2STREX |
9025 | 846 | printT2AddrModeImm0_1020s4Operand(MI, 2, O); |
9026 | 846 | return; |
9027 | 0 | break; |
9028 | 5.37k | case 37: |
9029 | | // tADDrSPi |
9030 | 5.37k | printThumbS4ImmOperand(MI, 2, O); |
9031 | 5.37k | return; |
9032 | 0 | break; |
9033 | 98.1k | } |
9034 | | |
9035 | | |
9036 | | // Fragment 7 encoded into 4 bits for 13 unique commands. |
9037 | | // printf("Fragment 7: %"PRIu64"\n", ((Bits >> 53) & 15)); |
9038 | 38.5k | switch ((Bits >> 53) & 15) { |
9039 | 0 | default: // unreachable |
9040 | 16.9k | case 0: |
9041 | | // ASRi, ASRr, LSLi, LSLr, LSRi, LSRr, RORi, RORr, VLD1LNdWB_register_Asm... |
9042 | 16.9k | return; |
9043 | 0 | break; |
9044 | 11.0k | case 1: |
9045 | | // LDRD_POST, MLA, MLS, SBFX, SMLABB, SMLABT, SMLAD, SMLADX, SMLALBB, SML... |
9046 | 11.0k | SStream_concat0(O, ", "); |
9047 | 11.0k | break; |
9048 | 1.10k | case 2: |
9049 | | // MCR, t2MCR, t2MCR2 |
9050 | 1.10k | printCImmediate(MI, 3, O); |
9051 | 1.10k | SStream_concat0(O, ", "); |
9052 | 1.10k | printCImmediate(MI, 4, O); |
9053 | 1.10k | SStream_concat0(O, ", "); |
9054 | 1.10k | printOperand(MI, 5, O); |
9055 | 1.10k | return; |
9056 | 0 | break; |
9057 | 659 | case 3: |
9058 | | // MCRR, t2MCRR, t2MCRR2 |
9059 | 659 | printOperand(MI, 3, O); |
9060 | 659 | SStream_concat0(O, ", "); |
9061 | 659 | printCImmediate(MI, 4, O); |
9062 | 659 | return; |
9063 | 0 | break; |
9064 | 519 | case 4: |
9065 | | // PKHBT, t2PKHBT |
9066 | 519 | printPKHLSLShiftImm(MI, 3, O); |
9067 | 519 | return; |
9068 | 0 | break; |
9069 | 647 | case 5: |
9070 | | // PKHTB, t2PKHTB |
9071 | 647 | printPKHASRShiftImm(MI, 3, O); |
9072 | 647 | return; |
9073 | 0 | break; |
9074 | 577 | case 6: |
9075 | | // SXTAB, SXTAB16, SXTAH, UXTAB, UXTAB16, UXTAH, t2SXTAB, t2SXTAB16, t2SX... |
9076 | 577 | printRotImmOperand(MI, 3, O); |
9077 | 577 | return; |
9078 | 0 | break; |
9079 | 906 | case 7: |
9080 | | // USAT, t2USAT |
9081 | 906 | printShiftImmOperand(MI, 3, O); |
9082 | 906 | return; |
9083 | 0 | break; |
9084 | 284 | case 8: |
9085 | | // VCMLAv2f32_indexed, VCMLAv4f16_indexed, VCMLAv4f32_indexed, VCMLAv8f16... |
9086 | 284 | printComplexRotationOp(MI, 5, O, 90, 0); |
9087 | 284 | return; |
9088 | 0 | break; |
9089 | 2.75k | case 9: |
9090 | | // VLD3d16, VLD3d16_UPD, VLD3d32, VLD3d32_UPD, VLD3d8, VLD3d8_UPD, VLD3q1... |
9091 | 2.75k | SStream_concat0(O, "}, "); |
9092 | 2.75k | break; |
9093 | 830 | case 10: |
9094 | | // VLD4LNd16, VLD4LNd32, VLD4LNd8, VLD4LNq16, VLD4LNq32, VST2LNd16, VST2L... |
9095 | 830 | SStream_concat0(O, "["); |
9096 | 830 | set_mem_access(MI, true); |
9097 | 830 | break; |
9098 | 604 | case 11: |
9099 | | // VST1LNd16_UPD, VST1LNd32_UPD, VST1LNd8_UPD |
9100 | 604 | printAddrMode6OffsetOperand(MI, 3, O); |
9101 | 604 | return; |
9102 | 0 | break; |
9103 | 1.70k | case 12: |
9104 | | // t2LDRD_POST, t2STRD_POST |
9105 | 1.70k | printT2AddrModeImm8s4OffsetOperand(MI, 4, O); |
9106 | 1.70k | return; |
9107 | 0 | break; |
9108 | 38.5k | } |
9109 | | |
9110 | | |
9111 | | // Fragment 8 encoded into 4 bits for 12 unique commands. |
9112 | | // printf("Fragment 8: %"PRIu64"\n", ((Bits >> 57) & 15)); |
9113 | 14.6k | switch ((Bits >> 57) & 15) { |
9114 | 0 | default: // unreachable |
9115 | 1.71k | case 0: |
9116 | | // LDRD_POST, STRD_POST |
9117 | 1.71k | printAddrMode3OffsetOperand(MI, 4, O); |
9118 | 1.71k | return; |
9119 | 0 | break; |
9120 | 7.53k | case 1: |
9121 | | // MLA, MLS, SMLABB, SMLABT, SMLAD, SMLADX, SMLALBB, SMLALBT, SMLALD, SML... |
9122 | 7.53k | printOperand(MI, 3, O); |
9123 | 7.53k | break; |
9124 | 618 | case 2: |
9125 | | // SBFX, UBFX, t2SBFX, t2UBFX |
9126 | 618 | printImmPlusOneOperand(MI, 3, O); |
9127 | 618 | return; |
9128 | 0 | break; |
9129 | 614 | case 3: |
9130 | | // VLD3d16, VLD3d32, VLD3d8, VLD3q16, VLD3q32, VLD3q8 |
9131 | 614 | printAddrMode6Operand(MI, 3, O); |
9132 | 614 | return; |
9133 | 0 | break; |
9134 | 1.31k | case 4: |
9135 | | // VLD3d16_UPD, VLD3d32_UPD, VLD3d8_UPD, VLD3q16_UPD, VLD3q32_UPD, VLD3q8... |
9136 | 1.31k | printAddrMode6Operand(MI, 4, O); |
9137 | 1.31k | printAddrMode6OffsetOperand(MI, 6, O); |
9138 | 1.31k | return; |
9139 | 0 | break; |
9140 | 235 | case 5: |
9141 | | // VLD4LNd16, VLD4LNd32, VLD4LNd8, VLD4LNq16, VLD4LNq32 |
9142 | 235 | printNoHashImmediate(MI, 10, O); |
9143 | 235 | SStream_concat0(O, "]}, "); |
9144 | 235 | set_mem_access(MI, false); |
9145 | 235 | printAddrMode6Operand(MI, 4, O); |
9146 | 235 | return; |
9147 | 0 | break; |
9148 | 296 | case 6: |
9149 | | // VST2LNd16, VST2LNd32, VST2LNd8, VST2LNq16, VST2LNq32 |
9150 | 296 | printNoHashImmediate(MI, 4, O); |
9151 | 296 | SStream_concat0(O, "]}, "); |
9152 | 296 | set_mem_access(MI, false); |
9153 | 296 | printAddrMode6Operand(MI, 0, O); |
9154 | 296 | return; |
9155 | 0 | break; |
9156 | 43 | case 7: |
9157 | | // VST3LNd16, VST3LNd32, VST3LNd8, VST3LNq16, VST3LNq32 |
9158 | 43 | printNoHashImmediate(MI, 5, O); |
9159 | 43 | SStream_concat0(O, "], "); |
9160 | 43 | set_mem_access(MI, false); |
9161 | 43 | printOperand(MI, 4, O); |
9162 | 43 | SStream_concat0(O, "["); |
9163 | 43 | set_mem_access(MI, true); |
9164 | 43 | printNoHashImmediate(MI, 5, O); |
9165 | 43 | SStream_concat0(O, "]}, "); |
9166 | 43 | set_mem_access(MI, false); |
9167 | 43 | printAddrMode6Operand(MI, 0, O); |
9168 | 43 | return; |
9169 | 0 | break; |
9170 | 829 | case 8: |
9171 | | // VST3d16, VST3d32, VST3d8, VST3q16, VST3q32, VST3q8 |
9172 | 829 | printAddrMode6Operand(MI, 0, O); |
9173 | 829 | return; |
9174 | 0 | break; |
9175 | 256 | case 9: |
9176 | | // VST4LNd16, VST4LNd32, VST4LNd8, VST4LNq16, VST4LNq32 |
9177 | 256 | printNoHashImmediate(MI, 6, O); |
9178 | 256 | SStream_concat0(O, "], "); |
9179 | 256 | set_mem_access(MI, false); |
9180 | 256 | printOperand(MI, 4, O); |
9181 | 256 | SStream_concat0(O, "["); |
9182 | 256 | set_mem_access(MI, true); |
9183 | 256 | printNoHashImmediate(MI, 6, O); |
9184 | 256 | SStream_concat0(O, "], "); |
9185 | 256 | set_mem_access(MI, false); |
9186 | 256 | printOperand(MI, 5, O); |
9187 | 256 | SStream_concat0(O, "["); |
9188 | 256 | set_mem_access(MI, true); |
9189 | 256 | printNoHashImmediate(MI, 6, O); |
9190 | 256 | SStream_concat0(O, "]}, "); |
9191 | 256 | set_mem_access(MI, false); |
9192 | 256 | printAddrMode6Operand(MI, 0, O); |
9193 | 256 | return; |
9194 | 0 | break; |
9195 | 945 | case 10: |
9196 | | // VST4d16, VST4d32, VST4d8, VST4q16, VST4q32, VST4q8 |
9197 | 945 | printOperand(MI, 5, O); |
9198 | 945 | SStream_concat0(O, "}, "); |
9199 | 945 | printAddrMode6Operand(MI, 0, O); |
9200 | 945 | return; |
9201 | 0 | break; |
9202 | 283 | case 11: |
9203 | | // t2STLEXD, t2STREXD |
9204 | 283 | printAddrMode7Operand(MI, 3, O); |
9205 | 283 | return; |
9206 | 0 | break; |
9207 | 14.6k | } |
9208 | | |
9209 | | |
9210 | | // Fragment 9 encoded into 1 bits for 2 unique commands. |
9211 | | // printf("Fragment 9: %"PRIu64"\n", ((Bits >> 61) & 1)); |
9212 | 7.53k | if ((Bits >> 61) & 1) { |
9213 | | // VLD4d16, VLD4d16_UPD, VLD4d32, VLD4d32_UPD, VLD4d8, VLD4d8_UPD, VLD4q1... |
9214 | 1.87k | SStream_concat0(O, "}, "); |
9215 | 5.65k | } else { |
9216 | | // MLA, MLS, SMLABB, SMLABT, SMLAD, SMLADX, SMLALBB, SMLALBT, SMLALD, SML... |
9217 | 5.65k | return; |
9218 | 5.65k | } |
9219 | | |
9220 | | |
9221 | | // Fragment 10 encoded into 1 bits for 2 unique commands. |
9222 | | // printf("Fragment 10: %"PRIu64"\n", ((Bits >> 62) & 1)); |
9223 | 1.87k | if ((Bits >> 62) & 1) { |
9224 | | // VLD4d16_UPD, VLD4d32_UPD, VLD4d8_UPD, VLD4q16_UPD, VLD4q32_UPD, VLD4q8... |
9225 | 1.11k | printAddrMode6Operand(MI, 5, O); |
9226 | 1.11k | printAddrMode6OffsetOperand(MI, 7, O); |
9227 | 1.11k | return; |
9228 | 1.11k | } else { |
9229 | | // VLD4d16, VLD4d32, VLD4d8, VLD4q16, VLD4q32, VLD4q8 |
9230 | 762 | printAddrMode6Operand(MI, 4, O); |
9231 | 762 | return; |
9232 | 762 | } |
9233 | | |
9234 | 1.87k | } |
9235 | | |
9236 | | |
9237 | | |
9238 | | #ifdef PRINT_ALIAS_INSTR |
9239 | | #undef PRINT_ALIAS_INSTR |
9240 | | |
9241 | | static bool printAliasInstr(MCInst *MI, SStream *OS) |
9242 | 610k | { |
9243 | 610k | unsigned int I = 0, OpIdx, PrintMethodIdx; |
9244 | 610k | char *tmpString; |
9245 | 610k | const char *AsmString; |
9246 | 610k | switch (MCInst_getOpcode(MI)) { |
9247 | 605k | default: return false; |
9248 | 247 | case ARM_DSB: |
9249 | 247 | if (MCInst_getNumOperands(MI) == 1 && |
9250 | 247 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9251 | 247 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
9252 | 247 | !ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && |
9253 | 247 | ARM_getFeatureBits(MI->csh->mode, ARM_FeatureDFB)) { |
9254 | | // (DSB 12) |
9255 | 30 | AsmString = "dfb"; |
9256 | 30 | break; |
9257 | 30 | } |
9258 | 217 | return false; |
9259 | 816 | case ARM_HINT: |
9260 | 816 | if (MCInst_getNumOperands(MI) == 3 && |
9261 | 816 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9262 | 816 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0 && |
9263 | 816 | !ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && |
9264 | 816 | ARM_getFeatureBits(MI->csh->mode, ARM_HasV6KOps)) { |
9265 | | // (HINT 0, pred:$p) |
9266 | 400 | AsmString = "nop$\xFF\x02\x01"; |
9267 | 400 | break; |
9268 | 400 | } |
9269 | 416 | if (MCInst_getNumOperands(MI) == 3 && |
9270 | 416 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9271 | 416 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 1 && |
9272 | 416 | !ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && |
9273 | 416 | ARM_getFeatureBits(MI->csh->mode, ARM_HasV6KOps)) { |
9274 | | // (HINT 1, pred:$p) |
9275 | 39 | AsmString = "yield$\xFF\x02\x01"; |
9276 | 39 | break; |
9277 | 39 | } |
9278 | 377 | if (MCInst_getNumOperands(MI) == 3 && |
9279 | 377 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9280 | 377 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 2 && |
9281 | 377 | !ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && |
9282 | 377 | ARM_getFeatureBits(MI->csh->mode, ARM_HasV6KOps)) { |
9283 | | // (HINT 2, pred:$p) |
9284 | 16 | AsmString = "wfe$\xFF\x02\x01"; |
9285 | 16 | break; |
9286 | 16 | } |
9287 | 361 | if (MCInst_getNumOperands(MI) == 3 && |
9288 | 361 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9289 | 361 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 3 && |
9290 | 361 | !ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && |
9291 | 361 | ARM_getFeatureBits(MI->csh->mode, ARM_HasV6KOps)) { |
9292 | | // (HINT 3, pred:$p) |
9293 | 147 | AsmString = "wfi$\xFF\x02\x01"; |
9294 | 147 | break; |
9295 | 147 | } |
9296 | 214 | if (MCInst_getNumOperands(MI) == 3 && |
9297 | 214 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9298 | 214 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 4 && |
9299 | 214 | !ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && |
9300 | 214 | ARM_getFeatureBits(MI->csh->mode, ARM_HasV6KOps)) { |
9301 | | // (HINT 4, pred:$p) |
9302 | 16 | AsmString = "sev$\xFF\x02\x01"; |
9303 | 16 | break; |
9304 | 16 | } |
9305 | 198 | if (MCInst_getNumOperands(MI) == 3 && |
9306 | 198 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9307 | 198 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 5 && |
9308 | 198 | !ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && |
9309 | 198 | ARM_getFeatureBits(MI->csh->mode, ARM_HasV8Ops)) { |
9310 | | // (HINT 5, pred:$p) |
9311 | 57 | AsmString = "sevl$\xFF\x02\x01"; |
9312 | 57 | break; |
9313 | 57 | } |
9314 | 141 | if (MCInst_getNumOperands(MI) == 3 && |
9315 | 141 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9316 | 141 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 16 && |
9317 | 141 | !ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && |
9318 | 141 | ARM_getFeatureBits(MI->csh->mode, ARM_FeatureRAS)) { |
9319 | | // (HINT 16, pred:$p) |
9320 | 53 | AsmString = "esb$\xFF\x02\x01"; |
9321 | 53 | break; |
9322 | 53 | } |
9323 | 88 | if (MCInst_getNumOperands(MI) == 3 && |
9324 | 88 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9325 | 88 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 20 && |
9326 | 88 | !ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && |
9327 | 88 | ARM_getFeatureBits(MI->csh->mode, ARM_HasV6KOps)) { |
9328 | | // (HINT 20, pred:$p) |
9329 | 1 | AsmString = "csdb$\xFF\x02\x01"; |
9330 | 1 | break; |
9331 | 1 | } |
9332 | 87 | return false; |
9333 | 977 | case ARM_t2DSB: |
9334 | 977 | if (MCInst_getNumOperands(MI) == 3 && |
9335 | 977 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9336 | 977 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
9337 | 977 | ARM_getFeatureBits(MI->csh->mode, ARM_FeatureDFB)) { |
9338 | | // (t2DSB 12, pred:$p) |
9339 | 63 | AsmString = "dfb$\xFF\x02\x01"; |
9340 | 63 | break; |
9341 | 63 | } |
9342 | 914 | return false; |
9343 | 1.30k | case ARM_t2HINT: |
9344 | 1.30k | if (MCInst_getNumOperands(MI) == 3 && |
9345 | 1.30k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9346 | 1.30k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0 && |
9347 | 1.30k | ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && |
9348 | 1.30k | ARM_getFeatureBits(MI->csh->mode, ARM_FeatureThumb2)) { |
9349 | | // (t2HINT 0, pred:$p) |
9350 | 172 | AsmString = "nop$\xFF\x02\x01.w"; |
9351 | 172 | break; |
9352 | 172 | } |
9353 | 1.13k | if (MCInst_getNumOperands(MI) == 3 && |
9354 | 1.13k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9355 | 1.13k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 1 && |
9356 | 1.13k | ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && |
9357 | 1.13k | ARM_getFeatureBits(MI->csh->mode, ARM_FeatureThumb2)) { |
9358 | | // (t2HINT 1, pred:$p) |
9359 | 87 | AsmString = "yield$\xFF\x02\x01.w"; |
9360 | 87 | break; |
9361 | 87 | } |
9362 | 1.04k | if (MCInst_getNumOperands(MI) == 3 && |
9363 | 1.04k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9364 | 1.04k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 2 && |
9365 | 1.04k | ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && |
9366 | 1.04k | ARM_getFeatureBits(MI->csh->mode, ARM_FeatureThumb2)) { |
9367 | | // (t2HINT 2, pred:$p) |
9368 | 40 | AsmString = "wfe$\xFF\x02\x01.w"; |
9369 | 40 | break; |
9370 | 40 | } |
9371 | 1.00k | if (MCInst_getNumOperands(MI) == 3 && |
9372 | 1.00k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9373 | 1.00k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 3 && |
9374 | 1.00k | ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && |
9375 | 1.00k | ARM_getFeatureBits(MI->csh->mode, ARM_FeatureThumb2)) { |
9376 | | // (t2HINT 3, pred:$p) |
9377 | 53 | AsmString = "wfi$\xFF\x02\x01.w"; |
9378 | 53 | break; |
9379 | 53 | } |
9380 | 951 | if (MCInst_getNumOperands(MI) == 3 && |
9381 | 951 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9382 | 951 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 4 && |
9383 | 951 | ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && |
9384 | 951 | ARM_getFeatureBits(MI->csh->mode, ARM_FeatureThumb2)) { |
9385 | | // (t2HINT 4, pred:$p) |
9386 | 18 | AsmString = "sev$\xFF\x02\x01.w"; |
9387 | 18 | break; |
9388 | 18 | } |
9389 | 933 | if (MCInst_getNumOperands(MI) == 3 && |
9390 | 933 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9391 | 933 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 5 && |
9392 | 933 | ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && |
9393 | 933 | ARM_getFeatureBits(MI->csh->mode, ARM_FeatureThumb2) && |
9394 | 933 | ARM_getFeatureBits(MI->csh->mode, ARM_HasV8Ops)) { |
9395 | | // (t2HINT 5, pred:$p) |
9396 | 21 | AsmString = "sevl$\xFF\x02\x01.w"; |
9397 | 21 | break; |
9398 | 21 | } |
9399 | 912 | if (MCInst_getNumOperands(MI) == 3 && |
9400 | 912 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9401 | 912 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 16 && |
9402 | 912 | ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && |
9403 | 912 | ARM_getFeatureBits(MI->csh->mode, ARM_FeatureThumb2) && |
9404 | 912 | ARM_getFeatureBits(MI->csh->mode, ARM_FeatureRAS)) { |
9405 | | // (t2HINT 16, pred:$p) |
9406 | 169 | AsmString = "esb$\xFF\x02\x01.w"; |
9407 | 169 | break; |
9408 | 169 | } |
9409 | 743 | if (MCInst_getNumOperands(MI) == 3 && |
9410 | 743 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9411 | 743 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 20 && |
9412 | 743 | ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && |
9413 | 743 | ARM_getFeatureBits(MI->csh->mode, ARM_FeatureThumb2)) { |
9414 | | // (t2HINT 20, pred:$p) |
9415 | 130 | AsmString = "csdb$\xFF\x02\x01"; |
9416 | 130 | break; |
9417 | 130 | } |
9418 | 613 | return false; |
9419 | 51 | case ARM_t2SUBS_PC_LR: |
9420 | 51 | if (MCInst_getNumOperands(MI) == 3 && |
9421 | 51 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9422 | 51 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0 && |
9423 | 51 | ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && |
9424 | 51 | ARM_getFeatureBits(MI->csh->mode, ARM_FeatureThumb2) && |
9425 | 51 | ARM_getFeatureBits(MI->csh->mode, ARM_FeatureVirtualization)) { |
9426 | | // (t2SUBS_PC_LR 0, pred:$p) |
9427 | 44 | AsmString = "eret$\xFF\x02\x01"; |
9428 | 44 | break; |
9429 | 44 | } |
9430 | 7 | return false; |
9431 | 1.66k | case ARM_tHINT: |
9432 | 1.66k | if (MCInst_getNumOperands(MI) == 3 && |
9433 | 1.66k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9434 | 1.66k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0 && |
9435 | 1.66k | ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && |
9436 | 1.66k | ARM_getFeatureBits(MI->csh->mode, ARM_HasV6MOps)) { |
9437 | | // (tHINT 0, pred:$p) |
9438 | 426 | AsmString = "nop$\xFF\x02\x01"; |
9439 | 426 | break; |
9440 | 426 | } |
9441 | 1.24k | if (MCInst_getNumOperands(MI) == 3 && |
9442 | 1.24k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9443 | 1.24k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 1 && |
9444 | 1.24k | ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && |
9445 | 1.24k | ARM_getFeatureBits(MI->csh->mode, ARM_HasV6MOps)) { |
9446 | | // (tHINT 1, pred:$p) |
9447 | 39 | AsmString = "yield$\xFF\x02\x01"; |
9448 | 39 | break; |
9449 | 39 | } |
9450 | 1.20k | if (MCInst_getNumOperands(MI) == 3 && |
9451 | 1.20k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9452 | 1.20k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 2 && |
9453 | 1.20k | ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && |
9454 | 1.20k | ARM_getFeatureBits(MI->csh->mode, ARM_HasV6MOps)) { |
9455 | | // (tHINT 2, pred:$p) |
9456 | 218 | AsmString = "wfe$\xFF\x02\x01"; |
9457 | 218 | break; |
9458 | 218 | } |
9459 | 986 | if (MCInst_getNumOperands(MI) == 3 && |
9460 | 986 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9461 | 986 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 3 && |
9462 | 986 | ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && |
9463 | 986 | ARM_getFeatureBits(MI->csh->mode, ARM_HasV6MOps)) { |
9464 | | // (tHINT 3, pred:$p) |
9465 | 132 | AsmString = "wfi$\xFF\x02\x01"; |
9466 | 132 | break; |
9467 | 132 | } |
9468 | 854 | if (MCInst_getNumOperands(MI) == 3 && |
9469 | 854 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9470 | 854 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 4 && |
9471 | 854 | ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && |
9472 | 854 | ARM_getFeatureBits(MI->csh->mode, ARM_HasV6MOps)) { |
9473 | | // (tHINT 4, pred:$p) |
9474 | 128 | AsmString = "sev$\xFF\x02\x01"; |
9475 | 128 | break; |
9476 | 128 | } |
9477 | 726 | if (MCInst_getNumOperands(MI) == 3 && |
9478 | 726 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9479 | 726 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 5 && |
9480 | 726 | ARM_getFeatureBits(MI->csh->mode, ARM_ModeThumb) && |
9481 | 726 | ARM_getFeatureBits(MI->csh->mode, ARM_FeatureThumb2) && |
9482 | 726 | ARM_getFeatureBits(MI->csh->mode, ARM_HasV8Ops)) { |
9483 | | // (tHINT 5, pred:$p) |
9484 | 28 | AsmString = "sevl$\xFF\x02\x01"; |
9485 | 28 | break; |
9486 | 28 | } |
9487 | 698 | return false; |
9488 | 610k | } |
9489 | | |
9490 | | |
9491 | 2.52k | tmpString = cs_strdup(AsmString); |
9492 | | |
9493 | 10.7k | while (AsmString[I] != ' ' && AsmString[I] != '\t' && |
9494 | 10.7k | AsmString[I] != '$' && AsmString[I] != '\0') |
9495 | 8.19k | ++I; |
9496 | | |
9497 | 2.52k | tmpString[I] = 0; |
9498 | 2.52k | SStream_concat0(OS, tmpString); |
9499 | 2.52k | cs_mem_free(tmpString); |
9500 | | |
9501 | 2.52k | if (AsmString[I] != '\0') { |
9502 | 2.49k | if (AsmString[I] == ' ' || AsmString[I] == '\t') { |
9503 | 0 | SStream_concat0(OS, " "); |
9504 | 0 | ++I; |
9505 | 0 | } |
9506 | | |
9507 | 3.61k | do { |
9508 | 3.61k | if (AsmString[I] == '$') { |
9509 | 2.49k | ++I; |
9510 | 2.49k | if (AsmString[I] == (char)0xff) { |
9511 | 2.49k | ++I; |
9512 | 2.49k | OpIdx = AsmString[I++] - 1; |
9513 | 2.49k | PrintMethodIdx = AsmString[I++] - 1; |
9514 | 2.49k | printCustomAliasOperand(MI, OpIdx, PrintMethodIdx, OS); |
9515 | 2.49k | } else |
9516 | 0 | printOperand(MI, (unsigned)(AsmString[I++]) - 1, OS); |
9517 | 2.49k | } else { |
9518 | 1.12k | if (AsmString[I] == '[') { |
9519 | 0 | set_mem_access(MI, true); |
9520 | 1.12k | } else if (AsmString[I] == ']') { |
9521 | 0 | set_mem_access(MI, false); |
9522 | 0 | } |
9523 | 1.12k | SStream_concat1(OS, AsmString[I++]); |
9524 | 1.12k | } |
9525 | 3.61k | } while (AsmString[I] != '\0'); |
9526 | 2.49k | } |
9527 | | |
9528 | 2.52k | return true; |
9529 | 610k | } |
9530 | | |
9531 | | static void printCustomAliasOperand( |
9532 | | MCInst *MI, unsigned OpIdx, |
9533 | | unsigned PrintMethodIdx, |
9534 | | SStream *OS) |
9535 | 2.49k | { |
9536 | 2.49k | switch (PrintMethodIdx) { |
9537 | 0 | default: |
9538 | 0 | break; |
9539 | 2.49k | case 0: |
9540 | 2.49k | printPredicateOperand(MI, OpIdx, OS); |
9541 | 2.49k | break; |
9542 | 2.49k | } |
9543 | 2.49k | } |
9544 | | |
9545 | | #endif // PRINT_ALIAS_INSTR |