/src/capstonev5/arch/Mips/MipsGenAsmWriter.inc
Line | Count | Source (jump to first uncovered line) |
1 | | /*===- TableGen'erated file -------------------------------------*- C++ -*-===*\ |
2 | | |* *| |
3 | | |*Assembly Writer Source Fragment *| |
4 | | |* *| |
5 | | |* Automatically generated file, do not edit! *| |
6 | | |* *| |
7 | | \*===----------------------------------------------------------------------===*/ |
8 | | |
9 | | /* Capstone Disassembly Engine, http://www.capstone-engine.org */ |
10 | | /* By Nguyen Anh Quynh <aquynh@gmail.com>, 2013-2015 */ |
11 | | |
12 | | /// printInstruction - This method is automatically generated by tablegen |
13 | | /// from the instruction set description. |
14 | | static void printInstruction(MCInst *MI, SStream *O, const MCRegisterInfo *MRI) |
15 | 79.9k | { |
16 | 79.9k | static const uint32_t OpInfo[] = { |
17 | 79.9k | 0U, // PHI |
18 | 79.9k | 0U, // INLINEASM |
19 | 79.9k | 0U, // CFI_INSTRUCTION |
20 | 79.9k | 0U, // EH_LABEL |
21 | 79.9k | 0U, // GC_LABEL |
22 | 79.9k | 0U, // KILL |
23 | 79.9k | 0U, // EXTRACT_SUBREG |
24 | 79.9k | 0U, // INSERT_SUBREG |
25 | 79.9k | 0U, // IMPLICIT_DEF |
26 | 79.9k | 0U, // SUBREG_TO_REG |
27 | 79.9k | 0U, // COPY_TO_REGCLASS |
28 | 79.9k | 9396U, // DBG_VALUE |
29 | 79.9k | 0U, // REG_SEQUENCE |
30 | 79.9k | 0U, // COPY |
31 | 79.9k | 9389U, // BUNDLE |
32 | 79.9k | 9406U, // LIFETIME_START |
33 | 79.9k | 9376U, // LIFETIME_END |
34 | 79.9k | 0U, // STACKMAP |
35 | 79.9k | 0U, // PATCHPOINT |
36 | 79.9k | 0U, // LOAD_STACK_GUARD |
37 | 79.9k | 0U, // STATEPOINT |
38 | 79.9k | 0U, // FRAME_ALLOC |
39 | 79.9k | 21660U, // ABSQ_S_PH |
40 | 79.9k | 18025U, // ABSQ_S_QB |
41 | 79.9k | 24850U, // ABSQ_S_W |
42 | 79.9k | 134237992U, // ADD |
43 | 79.9k | 18294U, // ADDIUPC |
44 | 79.9k | 18294U, // ADDIUPC_MM |
45 | 79.9k | 22527U, // ADDIUR1SP_MM |
46 | 79.9k | 134234410U, // ADDIUR2_MM |
47 | 79.9k | 8683851U, // ADDIUS5_MM |
48 | 79.9k | 546875U, // ADDIUSP_MM |
49 | 79.9k | 134239193U, // ADDQH_PH |
50 | 79.9k | 134239310U, // ADDQH_R_PH |
51 | 79.9k | 134242253U, // ADDQH_R_W |
52 | 79.9k | 134241856U, // ADDQH_W |
53 | 79.9k | 134239267U, // ADDQ_PH |
54 | 79.9k | 134239366U, // ADDQ_S_PH |
55 | 79.9k | 134242558U, // ADDQ_S_W |
56 | 79.9k | 134236055U, // ADDSC |
57 | 79.9k | 134234730U, // ADDS_A_B |
58 | 79.9k | 134236180U, // ADDS_A_D |
59 | 79.9k | 134238138U, // ADDS_A_H |
60 | 79.9k | 134241564U, // ADDS_A_W |
61 | 79.9k | 134235198U, // ADDS_S_B |
62 | 79.9k | 134237269U, // ADDS_S_D |
63 | 79.9k | 134238695U, // ADDS_S_H |
64 | 79.9k | 134242608U, // ADDS_S_W |
65 | 79.9k | 134235413U, // ADDS_U_B |
66 | 79.9k | 134237736U, // ADDS_U_D |
67 | 79.9k | 134238973U, // ADDS_U_H |
68 | 79.9k | 134243026U, // ADDS_U_W |
69 | 79.9k | 134234575U, // ADDU16_MM |
70 | 79.9k | 134235621U, // ADDUH_QB |
71 | 79.9k | 134235729U, // ADDUH_R_QB |
72 | 79.9k | 134239465U, // ADDU_PH |
73 | 79.9k | 134235834U, // ADDU_QB |
74 | 79.9k | 134239410U, // ADDU_S_PH |
75 | 79.9k | 134235775U, // ADDU_S_QB |
76 | 79.9k | 2281718627U, // ADDVI_B |
77 | 79.9k | 2281720348U, // ADDVI_D |
78 | 79.9k | 2281722002U, // ADDVI_H |
79 | 79.9k | 2281725637U, // ADDVI_W |
80 | 79.9k | 134235491U, // ADDV_B |
81 | 79.9k | 134237836U, // ADDV_D |
82 | 79.9k | 134239051U, // ADDV_H |
83 | 79.9k | 134243126U, // ADDV_W |
84 | 79.9k | 134236094U, // ADDWC |
85 | 79.9k | 134234712U, // ADD_A_B |
86 | 79.9k | 134236161U, // ADD_A_D |
87 | 79.9k | 134238120U, // ADD_A_H |
88 | 79.9k | 134241545U, // ADD_A_W |
89 | 79.9k | 134237992U, // ADD_MM |
90 | 79.9k | 134239685U, // ADDi |
91 | 79.9k | 134239685U, // ADDi_MM |
92 | 79.9k | 134241307U, // ADDiu |
93 | 79.9k | 134241307U, // ADDiu_MM |
94 | 79.9k | 134241261U, // ADDu |
95 | 79.9k | 134241261U, // ADDu_MM |
96 | 79.9k | 0U, // ADJCALLSTACKDOWN |
97 | 79.9k | 0U, // ADJCALLSTACKUP |
98 | 79.9k | 134240158U, // ALIGN |
99 | 79.9k | 18286U, // ALUIPC |
100 | 79.9k | 134238014U, // AND |
101 | 79.9k | 835930U, // AND16_MM |
102 | 79.9k | 134238014U, // AND64 |
103 | 79.9k | 134234471U, // ANDI16_MM |
104 | 79.9k | 2281718486U, // ANDI_B |
105 | 79.9k | 134238014U, // AND_MM |
106 | 79.9k | 134241389U, // AND_V |
107 | 79.9k | 0U, // AND_V_D_PSEUDO |
108 | 79.9k | 0U, // AND_V_H_PSEUDO |
109 | 79.9k | 0U, // AND_V_W_PSEUDO |
110 | 79.9k | 134239691U, // ANDi |
111 | 79.9k | 134239691U, // ANDi64 |
112 | 79.9k | 134239691U, // ANDi_MM |
113 | 79.9k | 134238028U, // APPEND |
114 | 79.9k | 134235092U, // ASUB_S_B |
115 | 79.9k | 134237099U, // ASUB_S_D |
116 | 79.9k | 134238527U, // ASUB_S_H |
117 | 79.9k | 134242388U, // ASUB_S_W |
118 | 79.9k | 134235307U, // ASUB_U_B |
119 | 79.9k | 134237566U, // ASUB_U_D |
120 | 79.9k | 134238815U, // ASUB_U_H |
121 | 79.9k | 134242856U, // ASUB_U_W |
122 | 79.9k | 0U, // ATOMIC_CMP_SWAP_I16 |
123 | 79.9k | 0U, // ATOMIC_CMP_SWAP_I32 |
124 | 79.9k | 0U, // ATOMIC_CMP_SWAP_I64 |
125 | 79.9k | 0U, // ATOMIC_CMP_SWAP_I8 |
126 | 79.9k | 0U, // ATOMIC_LOAD_ADD_I16 |
127 | 79.9k | 0U, // ATOMIC_LOAD_ADD_I32 |
128 | 79.9k | 0U, // ATOMIC_LOAD_ADD_I64 |
129 | 79.9k | 0U, // ATOMIC_LOAD_ADD_I8 |
130 | 79.9k | 0U, // ATOMIC_LOAD_AND_I16 |
131 | 79.9k | 0U, // ATOMIC_LOAD_AND_I32 |
132 | 79.9k | 0U, // ATOMIC_LOAD_AND_I64 |
133 | 79.9k | 0U, // ATOMIC_LOAD_AND_I8 |
134 | 79.9k | 0U, // ATOMIC_LOAD_NAND_I16 |
135 | 79.9k | 0U, // ATOMIC_LOAD_NAND_I32 |
136 | 79.9k | 0U, // ATOMIC_LOAD_NAND_I64 |
137 | 79.9k | 0U, // ATOMIC_LOAD_NAND_I8 |
138 | 79.9k | 0U, // ATOMIC_LOAD_OR_I16 |
139 | 79.9k | 0U, // ATOMIC_LOAD_OR_I32 |
140 | 79.9k | 0U, // ATOMIC_LOAD_OR_I64 |
141 | 79.9k | 0U, // ATOMIC_LOAD_OR_I8 |
142 | 79.9k | 0U, // ATOMIC_LOAD_SUB_I16 |
143 | 79.9k | 0U, // ATOMIC_LOAD_SUB_I32 |
144 | 79.9k | 0U, // ATOMIC_LOAD_SUB_I64 |
145 | 79.9k | 0U, // ATOMIC_LOAD_SUB_I8 |
146 | 79.9k | 0U, // ATOMIC_LOAD_XOR_I16 |
147 | 79.9k | 0U, // ATOMIC_LOAD_XOR_I32 |
148 | 79.9k | 0U, // ATOMIC_LOAD_XOR_I64 |
149 | 79.9k | 0U, // ATOMIC_LOAD_XOR_I8 |
150 | 79.9k | 0U, // ATOMIC_SWAP_I16 |
151 | 79.9k | 0U, // ATOMIC_SWAP_I32 |
152 | 79.9k | 0U, // ATOMIC_SWAP_I64 |
153 | 79.9k | 0U, // ATOMIC_SWAP_I8 |
154 | 79.9k | 134239795U, // AUI |
155 | 79.9k | 18279U, // AUIPC |
156 | 79.9k | 134235178U, // AVER_S_B |
157 | 79.9k | 134237249U, // AVER_S_D |
158 | 79.9k | 134238665U, // AVER_S_H |
159 | 79.9k | 134242588U, // AVER_S_W |
160 | 79.9k | 134235393U, // AVER_U_B |
161 | 79.9k | 134237716U, // AVER_U_D |
162 | 79.9k | 134238953U, // AVER_U_H |
163 | 79.9k | 134243006U, // AVER_U_W |
164 | 79.9k | 134235120U, // AVE_S_B |
165 | 79.9k | 134237181U, // AVE_S_D |
166 | 79.9k | 134238597U, // AVE_S_H |
167 | 79.9k | 134242470U, // AVE_S_W |
168 | 79.9k | 134235335U, // AVE_U_B |
169 | 79.9k | 134237648U, // AVE_U_D |
170 | 79.9k | 134238885U, // AVE_U_H |
171 | 79.9k | 134242938U, // AVE_U_W |
172 | 79.9k | 23579U, // AddiuRxImmX16 |
173 | 79.9k | 1072155U, // AddiuRxPcImmX16 |
174 | 79.9k | 285236251U, // AddiuRxRxImm16 |
175 | 79.9k | 16800795U, // AddiuRxRxImmX16 |
176 | 79.9k | 25189403U, // AddiuRxRyOffMemX16 |
177 | 79.9k | 1336343U, // AddiuSpImm16 |
178 | 79.9k | 549911U, // AddiuSpImmX16 |
179 | 79.9k | 134241261U, // AdduRxRyRz16 |
180 | 79.9k | 16797502U, // AndRxRxRy16 |
181 | 79.9k | 0U, // B |
182 | 79.9k | 541013U, // B16_MM |
183 | 79.9k | 134241260U, // BADDu |
184 | 79.9k | 546393U, // BAL |
185 | 79.9k | 542494U, // BALC |
186 | 79.9k | 134240157U, // BALIGN |
187 | 79.9k | 0U, // BAL_BR |
188 | 79.9k | 167788585U, // BBIT0 |
189 | 79.9k | 167788717U, // BBIT032 |
190 | 79.9k | 167788710U, // BBIT1 |
191 | 79.9k | 167788726U, // BBIT132 |
192 | 79.9k | 542473U, // BC |
193 | 79.9k | 20351U, // BC0F |
194 | 79.9k | 22218U, // BC0FL |
195 | 79.9k | 23455U, // BC0T |
196 | 79.9k | 22347U, // BC0TL |
197 | 79.9k | 25733U, // BC1EQZ |
198 | 79.9k | 20357U, // BC1F |
199 | 79.9k | 22225U, // BC1FL |
200 | 79.9k | 20357U, // BC1F_MM |
201 | 79.9k | 25717U, // BC1NEZ |
202 | 79.9k | 23461U, // BC1T |
203 | 79.9k | 22354U, // BC1TL |
204 | 79.9k | 23461U, // BC1T_MM |
205 | 79.9k | 25741U, // BC2EQZ |
206 | 79.9k | 20363U, // BC2F |
207 | 79.9k | 22232U, // BC2FL |
208 | 79.9k | 25725U, // BC2NEZ |
209 | 79.9k | 23467U, // BC2T |
210 | 79.9k | 22361U, // BC2TL |
211 | 79.9k | 20369U, // BC3F |
212 | 79.9k | 22239U, // BC3FL |
213 | 79.9k | 23473U, // BC3T |
214 | 79.9k | 22368U, // BC3TL |
215 | 79.9k | 2281718555U, // BCLRI_B |
216 | 79.9k | 2281720292U, // BCLRI_D |
217 | 79.9k | 2281721946U, // BCLRI_H |
218 | 79.9k | 2281725581U, // BCLRI_W |
219 | 79.9k | 134235059U, // BCLR_B |
220 | 79.9k | 134237023U, // BCLR_D |
221 | 79.9k | 134238494U, // BCLR_H |
222 | 79.9k | 134242304U, // BCLR_W |
223 | 79.9k | 134240340U, // BEQ |
224 | 79.9k | 134240340U, // BEQ64 |
225 | 79.9k | 134236044U, // BEQC |
226 | 79.9k | 134240063U, // BEQL |
227 | 79.9k | 16882U, // BEQZ16_MM |
228 | 79.9k | 18246U, // BEQZALC |
229 | 79.9k | 18394U, // BEQZC |
230 | 79.9k | 18394U, // BEQZC_MM |
231 | 79.9k | 134240340U, // BEQ_MM |
232 | 79.9k | 134235917U, // BGEC |
233 | 79.9k | 134236068U, // BGEUC |
234 | 79.9k | 25500U, // BGEZ |
235 | 79.9k | 25500U, // BGEZ64 |
236 | 79.9k | 22115U, // BGEZAL |
237 | 79.9k | 18219U, // BGEZALC |
238 | 79.9k | 22311U, // BGEZALL |
239 | 79.9k | 23424U, // BGEZALS_MM |
240 | 79.9k | 22115U, // BGEZAL_MM |
241 | 79.9k | 18373U, // BGEZC |
242 | 79.9k | 22391U, // BGEZL |
243 | 79.9k | 25500U, // BGEZ_MM |
244 | 79.9k | 25560U, // BGTZ |
245 | 79.9k | 25560U, // BGTZ64 |
246 | 79.9k | 18255U, // BGTZALC |
247 | 79.9k | 18401U, // BGTZC |
248 | 79.9k | 22405U, // BGTZL |
249 | 79.9k | 25560U, // BGTZ_MM |
250 | 79.9k | 2298495744U, // BINSLI_B |
251 | 79.9k | 2298497481U, // BINSLI_D |
252 | 79.9k | 2298499135U, // BINSLI_H |
253 | 79.9k | 2298502770U, // BINSLI_W |
254 | 79.9k | 151012243U, // BINSL_B |
255 | 79.9k | 151014033U, // BINSL_D |
256 | 79.9k | 151015601U, // BINSL_H |
257 | 79.9k | 151019280U, // BINSL_W |
258 | 79.9k | 2298495805U, // BINSRI_B |
259 | 79.9k | 2298497526U, // BINSRI_D |
260 | 79.9k | 2298499180U, // BINSRI_H |
261 | 79.9k | 2298502815U, // BINSRI_W |
262 | 79.9k | 151012291U, // BINSR_B |
263 | 79.9k | 151014289U, // BINSR_D |
264 | 79.9k | 151015726U, // BINSR_H |
265 | 79.9k | 151019570U, // BINSR_W |
266 | 79.9k | 23733U, // BITREV |
267 | 79.9k | 22477U, // BITSWAP |
268 | 79.9k | 25506U, // BLEZ |
269 | 79.9k | 25506U, // BLEZ64 |
270 | 79.9k | 18228U, // BLEZALC |
271 | 79.9k | 18380U, // BLEZC |
272 | 79.9k | 22398U, // BLEZL |
273 | 79.9k | 25506U, // BLEZ_MM |
274 | 79.9k | 134236062U, // BLTC |
275 | 79.9k | 134236075U, // BLTUC |
276 | 79.9k | 25566U, // BLTZ |
277 | 79.9k | 25566U, // BLTZ64 |
278 | 79.9k | 22123U, // BLTZAL |
279 | 79.9k | 18264U, // BLTZALC |
280 | 79.9k | 22320U, // BLTZALL |
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1061 | 79.9k | 151019356U, // MADD_Q_W |
1062 | 79.9k | 134240571U, // MADD_S |
1063 | 79.9k | 134240571U, // MADD_S_MM |
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1188 | 79.9k | 134241138U, // MOVZ_I_S_MM |
1189 | 79.9k | 18179U, // MSUB |
1190 | 79.9k | 151013742U, // MSUBF_D |
1191 | 79.9k | 151017912U, // MSUBF_S |
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1194 | 79.9k | 23525U, // MSUBU |
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1205 | 79.9k | 18179U, // MSUB_MM |
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1216 | 79.9k | 1884240U, // MTHC1_MM |
1217 | 79.9k | 546287U, // MTHI |
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1219 | 79.9k | 1873391U, // MTHI_DSP |
1220 | 79.9k | 546287U, // MTHI_MM |
1221 | 79.9k | 1873900U, // MTHLIP |
1222 | 79.9k | 546758U, // MTLO |
1223 | 79.9k | 546758U, // MTLO64 |
1224 | 79.9k | 1873862U, // MTLO_DSP |
1225 | 79.9k | 546758U, // MTLO_MM |
1226 | 79.9k | 540701U, // MTM0 |
1227 | 79.9k | 540826U, // MTM1 |
1228 | 79.9k | 540958U, // MTM2 |
1229 | 79.9k | 540707U, // MTP0 |
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1231 | 79.9k | 540964U, // MTP2 |
1232 | 79.9k | 134239672U, // MUH |
1233 | 79.9k | 134241300U, // MUHU |
1234 | 79.9k | 134240104U, // MUL |
1235 | 79.9k | 134240015U, // MULEQ_S_W_PHL |
1236 | 79.9k | 134240477U, // MULEQ_S_W_PHR |
1237 | 79.9k | 134239883U, // MULEU_S_PH_QBL |
1238 | 79.9k | 134240379U, // MULEU_S_PH_QBR |
1239 | 79.9k | 134239433U, // MULQ_RS_PH |
1240 | 79.9k | 134242709U, // MULQ_RS_W |
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1243 | 79.9k | 134238462U, // MULR_Q_H |
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1245 | 79.9k | 134239579U, // MULSAQ_S_W_PH |
1246 | 79.9k | 134239554U, // MULSA_W_PH |
1247 | 79.9k | 23496U, // MULT |
1248 | 79.9k | 134241370U, // MULTU_DSP |
1249 | 79.9k | 134241224U, // MULT_DSP |
1250 | 79.9k | 23496U, // MULT_MM |
1251 | 79.9k | 23642U, // MULTu |
1252 | 79.9k | 23642U, // MULTu_MM |
1253 | 79.9k | 134241337U, // MULU |
1254 | 79.9k | 134235517U, // MULV_B |
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1257 | 79.9k | 134243160U, // MULV_W |
1258 | 79.9k | 134240104U, // MUL_MM |
1259 | 79.9k | 134239250U, // MUL_PH |
1260 | 79.9k | 134238431U, // MUL_Q_H |
1261 | 79.9k | 134242150U, // MUL_Q_W |
1262 | 79.9k | 134240104U, // MUL_R6 |
1263 | 79.9k | 134239345U, // MUL_S_PH |
1264 | 79.9k | 546281U, // Mfhi16 |
1265 | 79.9k | 546745U, // Mflo16 |
1266 | 79.9k | 20345U, // Move32R16 |
1267 | 79.9k | 20345U, // MoveR3216 |
1268 | 79.9k | 23496U, // MultRxRy16 |
1269 | 79.9k | 75799496U, // MultRxRyRz16 |
1270 | 79.9k | 23642U, // MultuRxRy16 |
1271 | 79.9k | 75799642U, // MultuRxRyRz16 |
1272 | 79.9k | 17028U, // NLOC_B |
1273 | 79.9k | 18521U, // NLOC_D |
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1276 | 79.9k | 17036U, // NLZC_B |
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1280 | 79.9k | 134236282U, // NMADD_D32 |
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1286 | 79.9k | 134236240U, // NMSUB_D32_MM |
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1290 | 79.9k | 0U, // NOP |
1291 | 79.9k | 134240502U, // NOR |
1292 | 79.9k | 134240502U, // NOR64 |
1293 | 79.9k | 2281718573U, // NORI_B |
1294 | 79.9k | 134240502U, // NOR_MM |
1295 | 79.9k | 134241412U, // NOR_V |
1296 | 79.9k | 0U, // NOR_V_D_PSEUDO |
1297 | 79.9k | 0U, // NOR_V_H_PSEUDO |
1298 | 79.9k | 0U, // NOR_V_W_PSEUDO |
1299 | 79.9k | 16825U, // NOT16_MM |
1300 | 79.9k | 20387U, // NegRxRy16 |
1301 | 79.9k | 23502U, // NotRxRy16 |
1302 | 79.9k | 134240503U, // OR |
1303 | 79.9k | 836010U, // OR16_MM |
1304 | 79.9k | 134240503U, // OR64 |
1305 | 79.9k | 2281718574U, // ORI_B |
1306 | 79.9k | 134240503U, // OR_MM |
1307 | 79.9k | 134241413U, // OR_V |
1308 | 79.9k | 0U, // OR_V_D_PSEUDO |
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1311 | 79.9k | 134239771U, // ORi |
1312 | 79.9k | 134239771U, // ORi64 |
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1314 | 79.9k | 16799991U, // OrRxRxRy16 |
1315 | 79.9k | 134239239U, // PACKRL_PH |
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1330 | 79.9k | 134239203U, // PICK_PH |
1331 | 79.9k | 134235631U, // PICK_QB |
1332 | 79.9k | 22522U, // POP |
1333 | 79.9k | 22186U, // PRECEQU_PH_QBL |
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1340 | 79.9k | 16890U, // PRECEU_PH_QBLA |
1341 | 79.9k | 22667U, // PRECEU_PH_QBR |
1342 | 79.9k | 16923U, // PRECEU_PH_QBRA |
1343 | 79.9k | 134239155U, // PRECRQU_S_QB_PH |
1344 | 79.9k | 134241800U, // PRECRQ_PH_W |
1345 | 79.9k | 134239128U, // PRECRQ_QB_PH |
1346 | 79.9k | 134241831U, // PRECRQ_RS_PH_W |
1347 | 79.9k | 134239142U, // PRECR_QB_PH |
1348 | 79.9k | 134241784U, // PRECR_SRA_PH_W |
1349 | 79.9k | 134241813U, // PRECR_SRA_R_PH_W |
1350 | 79.9k | 85911U, // PREF |
1351 | 79.9k | 85911U, // PREF_MM |
1352 | 79.9k | 85911U, // PREF_R6 |
1353 | 79.9k | 134238019U, // PREPEND |
1354 | 79.9k | 0U, // PseudoCMPU_EQ_QB |
1355 | 79.9k | 0U, // PseudoCMPU_LE_QB |
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1357 | 79.9k | 0U, // PseudoCMP_EQ_PH |
1358 | 79.9k | 0U, // PseudoCMP_LE_PH |
1359 | 79.9k | 0U, // PseudoCMP_LT_PH |
1360 | 79.9k | 16391U, // PseudoCVT_D32_W |
1361 | 79.9k | 16391U, // PseudoCVT_D64_L |
1362 | 79.9k | 16391U, // PseudoCVT_D64_W |
1363 | 79.9k | 16391U, // PseudoCVT_S_L |
1364 | 79.9k | 16391U, // PseudoCVT_S_W |
1365 | 79.9k | 0U, // PseudoDMULT |
1366 | 79.9k | 0U, // PseudoDMULTu |
1367 | 79.9k | 0U, // PseudoDSDIV |
1368 | 79.9k | 0U, // PseudoDUDIV |
1369 | 79.9k | 0U, // PseudoIndirectBranch |
1370 | 79.9k | 0U, // PseudoIndirectBranch64 |
1371 | 79.9k | 0U, // PseudoMADD |
1372 | 79.9k | 0U, // PseudoMADDU |
1373 | 79.9k | 0U, // PseudoMFHI |
1374 | 79.9k | 0U, // PseudoMFHI64 |
1375 | 79.9k | 0U, // PseudoMFLO |
1376 | 79.9k | 0U, // PseudoMFLO64 |
1377 | 79.9k | 0U, // PseudoMSUB |
1378 | 79.9k | 0U, // PseudoMSUBU |
1379 | 79.9k | 0U, // PseudoMTLOHI |
1380 | 79.9k | 0U, // PseudoMTLOHI64 |
1381 | 79.9k | 0U, // PseudoMTLOHI_DSP |
1382 | 79.9k | 0U, // PseudoMULT |
1383 | 79.9k | 0U, // PseudoMULTu |
1384 | 79.9k | 0U, // PseudoPICK_PH |
1385 | 79.9k | 0U, // PseudoPICK_QB |
1386 | 79.9k | 0U, // PseudoReturn |
1387 | 79.9k | 0U, // PseudoReturn64 |
1388 | 79.9k | 0U, // PseudoSDIV |
1389 | 79.9k | 0U, // PseudoSELECTFP_F_D32 |
1390 | 79.9k | 0U, // PseudoSELECTFP_F_D64 |
1391 | 79.9k | 0U, // PseudoSELECTFP_F_I |
1392 | 79.9k | 0U, // PseudoSELECTFP_F_I64 |
1393 | 79.9k | 0U, // PseudoSELECTFP_F_S |
1394 | 79.9k | 0U, // PseudoSELECTFP_T_D32 |
1395 | 79.9k | 0U, // PseudoSELECTFP_T_D64 |
1396 | 79.9k | 0U, // PseudoSELECTFP_T_I |
1397 | 79.9k | 0U, // PseudoSELECTFP_T_I64 |
1398 | 79.9k | 0U, // PseudoSELECTFP_T_S |
1399 | 79.9k | 0U, // PseudoSELECT_D32 |
1400 | 79.9k | 0U, // PseudoSELECT_D64 |
1401 | 79.9k | 0U, // PseudoSELECT_I |
1402 | 79.9k | 0U, // PseudoSELECT_I64 |
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1404 | 79.9k | 0U, // PseudoUDIV |
1405 | 79.9k | 18155U, // RADDU_W_QB |
1406 | 79.9k | 33577003U, // RDDSP |
1407 | 79.9k | 22791U, // RDHWR |
1408 | 79.9k | 22791U, // RDHWR64 |
1409 | 79.9k | 22791U, // RDHWR_MM |
1410 | 79.9k | 21766U, // REPLV_PH |
1411 | 79.9k | 18135U, // REPLV_QB |
1412 | 79.9k | 33575925U, // REPL_PH |
1413 | 79.9k | 33572353U, // REPL_QB |
1414 | 79.9k | 19787U, // RINT_D |
1415 | 79.9k | 23293U, // RINT_S |
1416 | 79.9k | 134240513U, // ROTR |
1417 | 79.9k | 134241514U, // ROTRV |
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1419 | 79.9k | 134240513U, // ROTR_MM |
1420 | 79.9k | 18992U, // ROUND_L_D64 |
1421 | 79.9k | 23020U, // ROUND_L_S |
1422 | 79.9k | 20168U, // ROUND_W_D32 |
1423 | 79.9k | 20168U, // ROUND_W_D64 |
1424 | 79.9k | 20168U, // ROUND_W_MM |
1425 | 79.9k | 23342U, // ROUND_W_S |
1426 | 79.9k | 23342U, // ROUND_W_S_MM |
1427 | 79.9k | 0U, // Restore16 |
1428 | 79.9k | 0U, // RestoreX16 |
1429 | 79.9k | 0U, // RetRA |
1430 | 79.9k | 0U, // RetRA16 |
1431 | 79.9k | 134235208U, // SAT_S_B |
1432 | 79.9k | 134237279U, // SAT_S_D |
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1438 | 79.9k | 134243048U, // SAT_U_W |
1439 | 79.9k | 58738423U, // SB |
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1441 | 79.9k | 58738423U, // SB64 |
1442 | 79.9k | 58738423U, // SB_MM |
1443 | 79.9k | 3966874U, // SC |
1444 | 79.9k | 3968802U, // SCD |
1445 | 79.9k | 3968802U, // SCD_R6 |
1446 | 79.9k | 3966874U, // SC_MM |
1447 | 79.9k | 3966874U, // SC_R6 |
1448 | 79.9k | 58740570U, // SD |
1449 | 79.9k | 546774U, // SDBBP |
1450 | 79.9k | 65946U, // SDBBP16_MM |
1451 | 79.9k | 546774U, // SDBBP_MM |
1452 | 79.9k | 546774U, // SDBBP_R6 |
1453 | 79.9k | 58736694U, // SDC1 |
1454 | 79.9k | 58736694U, // SDC164 |
1455 | 79.9k | 58736694U, // SDC1_MM |
1456 | 79.9k | 58736894U, // SDC2 |
1457 | 79.9k | 58736894U, // SDC2_R6 |
1458 | 79.9k | 58736953U, // SDC3 |
1459 | 79.9k | 25611U, // SDIV |
1460 | 79.9k | 25611U, // SDIV_MM |
1461 | 79.9k | 58742463U, // SDL |
1462 | 79.9k | 58742959U, // SDR |
1463 | 79.9k | 1358970999U, // SDXC1 |
1464 | 79.9k | 1358970999U, // SDXC164 |
1465 | 79.9k | 17810U, // SEB |
1466 | 79.9k | 17810U, // SEB64 |
1467 | 79.9k | 17810U, // SEB_MM |
1468 | 79.9k | 21382U, // SEH |
1469 | 79.9k | 21382U, // SEH64 |
1470 | 79.9k | 21382U, // SEH_MM |
1471 | 79.9k | 134243273U, // SELEQZ |
1472 | 79.9k | 134243273U, // SELEQZ64 |
1473 | 79.9k | 134237968U, // SELEQZ_D |
1474 | 79.9k | 134241128U, // SELEQZ_S |
1475 | 79.9k | 134243246U, // SELNEZ |
1476 | 79.9k | 134243246U, // SELNEZ64 |
1477 | 79.9k | 134237951U, // SELNEZ_D |
1478 | 79.9k | 134241118U, // SELNEZ_S |
1479 | 79.9k | 151013977U, // SEL_D |
1480 | 79.9k | 151018005U, // SEL_S |
1481 | 79.9k | 134240345U, // SEQ |
1482 | 79.9k | 134239758U, // SEQi |
1483 | 79.9k | 58742195U, // SH |
1484 | 79.9k | 58736993U, // SH16_MM |
1485 | 79.9k | 58742195U, // SH64 |
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1489 | 79.9k | 22463U, // SHILO |
1490 | 79.9k | 23761U, // SHILOV |
1491 | 79.9k | 134239484U, // SHLLV_PH |
1492 | 79.9k | 134235853U, // SHLLV_QB |
1493 | 79.9k | 134239421U, // SHLLV_S_PH |
1494 | 79.9k | 134242679U, // SHLLV_S_W |
1495 | 79.9k | 134239212U, // SHLL_PH |
1496 | 79.9k | 134235640U, // SHLL_QB |
1497 | 79.9k | 134239334U, // SHLL_S_PH |
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1499 | 79.9k | 134239474U, // SHRAV_PH |
1500 | 79.9k | 134235843U, // SHRAV_QB |
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1502 | 79.9k | 134235741U, // SHRAV_R_QB |
1503 | 79.9k | 134242274U, // SHRAV_R_W |
1504 | 79.9k | 134239119U, // SHRA_PH |
1505 | 79.9k | 134235563U, // SHRA_QB |
1506 | 79.9k | 134239287U, // SHRA_R_PH |
1507 | 79.9k | 134235706U, // SHRA_R_QB |
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1509 | 79.9k | 134239504U, // SHRLV_PH |
1510 | 79.9k | 134235873U, // SHRLV_QB |
1511 | 79.9k | 134239230U, // SHRL_PH |
1512 | 79.9k | 134235658U, // SHRL_QB |
1513 | 79.9k | 58742195U, // SH_MM |
1514 | 79.9k | 2969584334U, // SLDI_B |
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1516 | 79.9k | 2969587742U, // SLDI_H |
1517 | 79.9k | 2969591377U, // SLDI_W |
1518 | 79.9k | 822100628U, // SLD_B |
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1520 | 79.9k | 822104036U, // SLD_H |
1521 | 79.9k | 822107506U, // SLD_W |
1522 | 79.9k | 134240058U, // SLL |
1523 | 79.9k | 134234494U, // SLL16_MM |
1524 | 79.9k | 1610635066U, // SLL64_32 |
1525 | 79.9k | 1610635066U, // SLL64_64 |
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1527 | 79.9k | 2281720249U, // SLLI_D |
1528 | 79.9k | 2281721903U, // SLLI_H |
1529 | 79.9k | 2281725538U, // SLLI_W |
1530 | 79.9k | 134241476U, // SLLV |
1531 | 79.9k | 134241476U, // SLLV_MM |
1532 | 79.9k | 134235013U, // SLL_B |
1533 | 79.9k | 134236785U, // SLL_D |
1534 | 79.9k | 134238371U, // SLL_H |
1535 | 79.9k | 134240058U, // SLL_MM |
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1537 | 79.9k | 134241213U, // SLT |
1538 | 79.9k | 134241213U, // SLT64 |
1539 | 79.9k | 134241213U, // SLT_MM |
1540 | 79.9k | 134239782U, // SLTi |
1541 | 79.9k | 134239782U, // SLTi64 |
1542 | 79.9k | 134239782U, // SLTi_MM |
1543 | 79.9k | 134241321U, // SLTiu |
1544 | 79.9k | 134241321U, // SLTiu64 |
1545 | 79.9k | 134241321U, // SLTiu_MM |
1546 | 79.9k | 134241357U, // SLTu |
1547 | 79.9k | 134241357U, // SLTu64 |
1548 | 79.9k | 134241357U, // SLTu_MM |
1549 | 79.9k | 134238063U, // SNE |
1550 | 79.9k | 134239703U, // SNEi |
1551 | 79.9k | 0U, // SNZ_B_PSEUDO |
1552 | 79.9k | 0U, // SNZ_D_PSEUDO |
1553 | 79.9k | 0U, // SNZ_H_PSEUDO |
1554 | 79.9k | 0U, // SNZ_V_PSEUDO |
1555 | 79.9k | 0U, // SNZ_W_PSEUDO |
1556 | 79.9k | 2952807239U, // SPLATI_B |
1557 | 79.9k | 2952808960U, // SPLATI_D |
1558 | 79.9k | 2952810614U, // SPLATI_H |
1559 | 79.9k | 2952814249U, // SPLATI_W |
1560 | 79.9k | 805323906U, // SPLAT_B |
1561 | 79.9k | 805326016U, // SPLAT_D |
1562 | 79.9k | 805327414U, // SPLAT_H |
1563 | 79.9k | 805331393U, // SPLAT_W |
1564 | 79.9k | 134234685U, // SRA |
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1566 | 79.9k | 2281720224U, // SRAI_D |
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1804 | | |
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1823 | 79.9k | 0U, // STACKMAP |
1824 | 79.9k | 0U, // PATCHPOINT |
1825 | 79.9k | 0U, // LOAD_STACK_GUARD |
1826 | 79.9k | 0U, // STATEPOINT |
1827 | 79.9k | 0U, // FRAME_ALLOC |
1828 | 79.9k | 0U, // ABSQ_S_PH |
1829 | 79.9k | 0U, // ABSQ_S_QB |
1830 | 79.9k | 0U, // ABSQ_S_W |
1831 | 79.9k | 0U, // ADD |
1832 | 79.9k | 0U, // ADDIUPC |
1833 | 79.9k | 0U, // ADDIUPC_MM |
1834 | 79.9k | 0U, // ADDIUR1SP_MM |
1835 | 79.9k | 0U, // ADDIUR2_MM |
1836 | 79.9k | 0U, // ADDIUS5_MM |
1837 | 79.9k | 0U, // ADDIUSP_MM |
1838 | 79.9k | 0U, // ADDQH_PH |
1839 | 79.9k | 0U, // ADDQH_R_PH |
1840 | 79.9k | 0U, // ADDQH_R_W |
1841 | 79.9k | 0U, // ADDQH_W |
1842 | 79.9k | 0U, // ADDQ_PH |
1843 | 79.9k | 0U, // ADDQ_S_PH |
1844 | 79.9k | 0U, // ADDQ_S_W |
1845 | 79.9k | 0U, // ADDSC |
1846 | 79.9k | 0U, // ADDS_A_B |
1847 | 79.9k | 0U, // ADDS_A_D |
1848 | 79.9k | 0U, // ADDS_A_H |
1849 | 79.9k | 0U, // ADDS_A_W |
1850 | 79.9k | 0U, // ADDS_S_B |
1851 | 79.9k | 0U, // ADDS_S_D |
1852 | 79.9k | 0U, // ADDS_S_H |
1853 | 79.9k | 0U, // ADDS_S_W |
1854 | 79.9k | 0U, // ADDS_U_B |
1855 | 79.9k | 0U, // ADDS_U_D |
1856 | 79.9k | 0U, // ADDS_U_H |
1857 | 79.9k | 0U, // ADDS_U_W |
1858 | 79.9k | 0U, // ADDU16_MM |
1859 | 79.9k | 0U, // ADDUH_QB |
1860 | 79.9k | 0U, // ADDUH_R_QB |
1861 | 79.9k | 0U, // ADDU_PH |
1862 | 79.9k | 0U, // ADDU_QB |
1863 | 79.9k | 0U, // ADDU_S_PH |
1864 | 79.9k | 0U, // ADDU_S_QB |
1865 | 79.9k | 0U, // ADDVI_B |
1866 | 79.9k | 0U, // ADDVI_D |
1867 | 79.9k | 0U, // ADDVI_H |
1868 | 79.9k | 0U, // ADDVI_W |
1869 | 79.9k | 0U, // ADDV_B |
1870 | 79.9k | 0U, // ADDV_D |
1871 | 79.9k | 0U, // ADDV_H |
1872 | 79.9k | 0U, // ADDV_W |
1873 | 79.9k | 0U, // ADDWC |
1874 | 79.9k | 0U, // ADD_A_B |
1875 | 79.9k | 0U, // ADD_A_D |
1876 | 79.9k | 0U, // ADD_A_H |
1877 | 79.9k | 0U, // ADD_A_W |
1878 | 79.9k | 0U, // ADD_MM |
1879 | 79.9k | 0U, // ADDi |
1880 | 79.9k | 0U, // ADDi_MM |
1881 | 79.9k | 0U, // ADDiu |
1882 | 79.9k | 0U, // ADDiu_MM |
1883 | 79.9k | 0U, // ADDu |
1884 | 79.9k | 0U, // ADDu_MM |
1885 | 79.9k | 0U, // ADJCALLSTACKDOWN |
1886 | 79.9k | 0U, // ADJCALLSTACKUP |
1887 | 79.9k | 4U, // ALIGN |
1888 | 79.9k | 0U, // ALUIPC |
1889 | 79.9k | 0U, // AND |
1890 | 79.9k | 0U, // AND16_MM |
1891 | 79.9k | 0U, // AND64 |
1892 | 79.9k | 0U, // ANDI16_MM |
1893 | 79.9k | 0U, // ANDI_B |
1894 | 79.9k | 0U, // AND_MM |
1895 | 79.9k | 0U, // AND_V |
1896 | 79.9k | 0U, // AND_V_D_PSEUDO |
1897 | 79.9k | 0U, // AND_V_H_PSEUDO |
1898 | 79.9k | 0U, // AND_V_W_PSEUDO |
1899 | 79.9k | 1U, // ANDi |
1900 | 79.9k | 1U, // ANDi64 |
1901 | 79.9k | 1U, // ANDi_MM |
1902 | 79.9k | 1U, // APPEND |
1903 | 79.9k | 0U, // ASUB_S_B |
1904 | 79.9k | 0U, // ASUB_S_D |
1905 | 79.9k | 0U, // ASUB_S_H |
1906 | 79.9k | 0U, // ASUB_S_W |
1907 | 79.9k | 0U, // ASUB_U_B |
1908 | 79.9k | 0U, // ASUB_U_D |
1909 | 79.9k | 0U, // ASUB_U_H |
1910 | 79.9k | 0U, // ASUB_U_W |
1911 | 79.9k | 0U, // ATOMIC_CMP_SWAP_I16 |
1912 | 79.9k | 0U, // ATOMIC_CMP_SWAP_I32 |
1913 | 79.9k | 0U, // ATOMIC_CMP_SWAP_I64 |
1914 | 79.9k | 0U, // ATOMIC_CMP_SWAP_I8 |
1915 | 79.9k | 0U, // ATOMIC_LOAD_ADD_I16 |
1916 | 79.9k | 0U, // ATOMIC_LOAD_ADD_I32 |
1917 | 79.9k | 0U, // ATOMIC_LOAD_ADD_I64 |
1918 | 79.9k | 0U, // ATOMIC_LOAD_ADD_I8 |
1919 | 79.9k | 0U, // ATOMIC_LOAD_AND_I16 |
1920 | 79.9k | 0U, // ATOMIC_LOAD_AND_I32 |
1921 | 79.9k | 0U, // ATOMIC_LOAD_AND_I64 |
1922 | 79.9k | 0U, // ATOMIC_LOAD_AND_I8 |
1923 | 79.9k | 0U, // ATOMIC_LOAD_NAND_I16 |
1924 | 79.9k | 0U, // ATOMIC_LOAD_NAND_I32 |
1925 | 79.9k | 0U, // ATOMIC_LOAD_NAND_I64 |
1926 | 79.9k | 0U, // ATOMIC_LOAD_NAND_I8 |
1927 | 79.9k | 0U, // ATOMIC_LOAD_OR_I16 |
1928 | 79.9k | 0U, // ATOMIC_LOAD_OR_I32 |
1929 | 79.9k | 0U, // ATOMIC_LOAD_OR_I64 |
1930 | 79.9k | 0U, // ATOMIC_LOAD_OR_I8 |
1931 | 79.9k | 0U, // ATOMIC_LOAD_SUB_I16 |
1932 | 79.9k | 0U, // ATOMIC_LOAD_SUB_I32 |
1933 | 79.9k | 0U, // ATOMIC_LOAD_SUB_I64 |
1934 | 79.9k | 0U, // ATOMIC_LOAD_SUB_I8 |
1935 | 79.9k | 0U, // ATOMIC_LOAD_XOR_I16 |
1936 | 79.9k | 0U, // ATOMIC_LOAD_XOR_I32 |
1937 | 79.9k | 0U, // ATOMIC_LOAD_XOR_I64 |
1938 | 79.9k | 0U, // ATOMIC_LOAD_XOR_I8 |
1939 | 79.9k | 0U, // ATOMIC_SWAP_I16 |
1940 | 79.9k | 0U, // ATOMIC_SWAP_I32 |
1941 | 79.9k | 0U, // ATOMIC_SWAP_I64 |
1942 | 79.9k | 0U, // ATOMIC_SWAP_I8 |
1943 | 79.9k | 0U, // AUI |
1944 | 79.9k | 0U, // AUIPC |
1945 | 79.9k | 0U, // AVER_S_B |
1946 | 79.9k | 0U, // AVER_S_D |
1947 | 79.9k | 0U, // AVER_S_H |
1948 | 79.9k | 0U, // AVER_S_W |
1949 | 79.9k | 0U, // AVER_U_B |
1950 | 79.9k | 0U, // AVER_U_D |
1951 | 79.9k | 0U, // AVER_U_H |
1952 | 79.9k | 0U, // AVER_U_W |
1953 | 79.9k | 0U, // AVE_S_B |
1954 | 79.9k | 0U, // AVE_S_D |
1955 | 79.9k | 0U, // AVE_S_H |
1956 | 79.9k | 0U, // AVE_S_W |
1957 | 79.9k | 0U, // AVE_U_B |
1958 | 79.9k | 0U, // AVE_U_D |
1959 | 79.9k | 0U, // AVE_U_H |
1960 | 79.9k | 0U, // AVE_U_W |
1961 | 79.9k | 0U, // AddiuRxImmX16 |
1962 | 79.9k | 0U, // AddiuRxPcImmX16 |
1963 | 79.9k | 0U, // AddiuRxRxImm16 |
1964 | 79.9k | 0U, // AddiuRxRxImmX16 |
1965 | 79.9k | 0U, // AddiuRxRyOffMemX16 |
1966 | 79.9k | 0U, // AddiuSpImm16 |
1967 | 79.9k | 0U, // AddiuSpImmX16 |
1968 | 79.9k | 0U, // AdduRxRyRz16 |
1969 | 79.9k | 0U, // AndRxRxRy16 |
1970 | 79.9k | 0U, // B |
1971 | 79.9k | 0U, // B16_MM |
1972 | 79.9k | 0U, // BADDu |
1973 | 79.9k | 0U, // BAL |
1974 | 79.9k | 0U, // BALC |
1975 | 79.9k | 1U, // BALIGN |
1976 | 79.9k | 0U, // BAL_BR |
1977 | 79.9k | 0U, // BBIT0 |
1978 | 79.9k | 0U, // BBIT032 |
1979 | 79.9k | 0U, // BBIT1 |
1980 | 79.9k | 0U, // BBIT132 |
1981 | 79.9k | 0U, // BC |
1982 | 79.9k | 0U, // BC0F |
1983 | 79.9k | 0U, // BC0FL |
1984 | 79.9k | 0U, // BC0T |
1985 | 79.9k | 0U, // BC0TL |
1986 | 79.9k | 0U, // BC1EQZ |
1987 | 79.9k | 0U, // BC1F |
1988 | 79.9k | 0U, // BC1FL |
1989 | 79.9k | 0U, // BC1F_MM |
1990 | 79.9k | 0U, // BC1NEZ |
1991 | 79.9k | 0U, // BC1T |
1992 | 79.9k | 0U, // BC1TL |
1993 | 79.9k | 0U, // BC1T_MM |
1994 | 79.9k | 0U, // BC2EQZ |
1995 | 79.9k | 0U, // BC2F |
1996 | 79.9k | 0U, // BC2FL |
1997 | 79.9k | 0U, // BC2NEZ |
1998 | 79.9k | 0U, // BC2T |
1999 | 79.9k | 0U, // BC2TL |
2000 | 79.9k | 0U, // BC3F |
2001 | 79.9k | 0U, // BC3FL |
2002 | 79.9k | 0U, // BC3T |
2003 | 79.9k | 0U, // BC3TL |
2004 | 79.9k | 0U, // BCLRI_B |
2005 | 79.9k | 0U, // BCLRI_D |
2006 | 79.9k | 0U, // BCLRI_H |
2007 | 79.9k | 0U, // BCLRI_W |
2008 | 79.9k | 0U, // BCLR_B |
2009 | 79.9k | 0U, // BCLR_D |
2010 | 79.9k | 0U, // BCLR_H |
2011 | 79.9k | 0U, // BCLR_W |
2012 | 79.9k | 0U, // BEQ |
2013 | 79.9k | 0U, // BEQ64 |
2014 | 79.9k | 0U, // BEQC |
2015 | 79.9k | 0U, // BEQL |
2016 | 79.9k | 0U, // BEQZ16_MM |
2017 | 79.9k | 0U, // BEQZALC |
2018 | 79.9k | 0U, // BEQZC |
2019 | 79.9k | 0U, // BEQZC_MM |
2020 | 79.9k | 0U, // BEQ_MM |
2021 | 79.9k | 0U, // BGEC |
2022 | 79.9k | 0U, // BGEUC |
2023 | 79.9k | 0U, // BGEZ |
2024 | 79.9k | 0U, // BGEZ64 |
2025 | 79.9k | 0U, // BGEZAL |
2026 | 79.9k | 0U, // BGEZALC |
2027 | 79.9k | 0U, // BGEZALL |
2028 | 79.9k | 0U, // BGEZALS_MM |
2029 | 79.9k | 0U, // BGEZAL_MM |
2030 | 79.9k | 0U, // BGEZC |
2031 | 79.9k | 0U, // BGEZL |
2032 | 79.9k | 0U, // BGEZ_MM |
2033 | 79.9k | 0U, // BGTZ |
2034 | 79.9k | 0U, // BGTZ64 |
2035 | 79.9k | 0U, // BGTZALC |
2036 | 79.9k | 0U, // BGTZC |
2037 | 79.9k | 0U, // BGTZL |
2038 | 79.9k | 0U, // BGTZ_MM |
2039 | 79.9k | 1U, // BINSLI_B |
2040 | 79.9k | 1U, // BINSLI_D |
2041 | 79.9k | 1U, // BINSLI_H |
2042 | 79.9k | 1U, // BINSLI_W |
2043 | 79.9k | 2U, // BINSL_B |
2044 | 79.9k | 2U, // BINSL_D |
2045 | 79.9k | 2U, // BINSL_H |
2046 | 79.9k | 2U, // BINSL_W |
2047 | 79.9k | 1U, // BINSRI_B |
2048 | 79.9k | 1U, // BINSRI_D |
2049 | 79.9k | 1U, // BINSRI_H |
2050 | 79.9k | 1U, // BINSRI_W |
2051 | 79.9k | 2U, // BINSR_B |
2052 | 79.9k | 2U, // BINSR_D |
2053 | 79.9k | 2U, // BINSR_H |
2054 | 79.9k | 2U, // BINSR_W |
2055 | 79.9k | 0U, // BITREV |
2056 | 79.9k | 0U, // BITSWAP |
2057 | 79.9k | 0U, // BLEZ |
2058 | 79.9k | 0U, // BLEZ64 |
2059 | 79.9k | 0U, // BLEZALC |
2060 | 79.9k | 0U, // BLEZC |
2061 | 79.9k | 0U, // BLEZL |
2062 | 79.9k | 0U, // BLEZ_MM |
2063 | 79.9k | 0U, // BLTC |
2064 | 79.9k | 0U, // BLTUC |
2065 | 79.9k | 0U, // BLTZ |
2066 | 79.9k | 0U, // BLTZ64 |
2067 | 79.9k | 0U, // BLTZAL |
2068 | 79.9k | 0U, // BLTZALC |
2069 | 79.9k | 0U, // BLTZALL |
2070 | 79.9k | 0U, // BLTZALS_MM |
2071 | 79.9k | 0U, // BLTZAL_MM |
2072 | 79.9k | 0U, // BLTZC |
2073 | 79.9k | 0U, // BLTZL |
2074 | 79.9k | 0U, // BLTZ_MM |
2075 | 79.9k | 1U, // BMNZI_B |
2076 | 79.9k | 2U, // BMNZ_V |
2077 | 79.9k | 1U, // BMZI_B |
2078 | 79.9k | 2U, // BMZ_V |
2079 | 79.9k | 0U, // BNE |
2080 | 79.9k | 0U, // BNE64 |
2081 | 79.9k | 0U, // BNEC |
2082 | 79.9k | 0U, // BNEGI_B |
2083 | 79.9k | 0U, // BNEGI_D |
2084 | 79.9k | 0U, // BNEGI_H |
2085 | 79.9k | 0U, // BNEGI_W |
2086 | 79.9k | 0U, // BNEG_B |
2087 | 79.9k | 0U, // BNEG_D |
2088 | 79.9k | 0U, // BNEG_H |
2089 | 79.9k | 0U, // BNEG_W |
2090 | 79.9k | 0U, // BNEL |
2091 | 79.9k | 0U, // BNEZ16_MM |
2092 | 79.9k | 0U, // BNEZALC |
2093 | 79.9k | 0U, // BNEZC |
2094 | 79.9k | 0U, // BNEZC_MM |
2095 | 79.9k | 0U, // BNE_MM |
2096 | 79.9k | 0U, // BNVC |
2097 | 79.9k | 0U, // BNZ_B |
2098 | 79.9k | 0U, // BNZ_D |
2099 | 79.9k | 0U, // BNZ_H |
2100 | 79.9k | 0U, // BNZ_V |
2101 | 79.9k | 0U, // BNZ_W |
2102 | 79.9k | 0U, // BOVC |
2103 | 79.9k | 0U, // BPOSGE32 |
2104 | 79.9k | 0U, // BPOSGE32_PSEUDO |
2105 | 79.9k | 0U, // BREAK |
2106 | 79.9k | 0U, // BREAK16_MM |
2107 | 79.9k | 0U, // BREAK_MM |
2108 | 79.9k | 1U, // BSELI_B |
2109 | 79.9k | 0U, // BSEL_D_PSEUDO |
2110 | 79.9k | 0U, // BSEL_FD_PSEUDO |
2111 | 79.9k | 0U, // BSEL_FW_PSEUDO |
2112 | 79.9k | 0U, // BSEL_H_PSEUDO |
2113 | 79.9k | 2U, // BSEL_V |
2114 | 79.9k | 0U, // BSEL_W_PSEUDO |
2115 | 79.9k | 0U, // BSETI_B |
2116 | 79.9k | 0U, // BSETI_D |
2117 | 79.9k | 0U, // BSETI_H |
2118 | 79.9k | 0U, // BSETI_W |
2119 | 79.9k | 0U, // BSET_B |
2120 | 79.9k | 0U, // BSET_D |
2121 | 79.9k | 0U, // BSET_H |
2122 | 79.9k | 0U, // BSET_W |
2123 | 79.9k | 0U, // BZ_B |
2124 | 79.9k | 0U, // BZ_D |
2125 | 79.9k | 0U, // BZ_H |
2126 | 79.9k | 0U, // BZ_V |
2127 | 79.9k | 0U, // BZ_W |
2128 | 79.9k | 0U, // B_MM_Pseudo |
2129 | 79.9k | 0U, // BeqzRxImm16 |
2130 | 79.9k | 0U, // BeqzRxImmX16 |
2131 | 79.9k | 0U, // Bimm16 |
2132 | 79.9k | 0U, // BimmX16 |
2133 | 79.9k | 0U, // BnezRxImm16 |
2134 | 79.9k | 0U, // BnezRxImmX16 |
2135 | 79.9k | 0U, // Break16 |
2136 | 79.9k | 0U, // Bteqz16 |
2137 | 79.9k | 0U, // BteqzT8CmpX16 |
2138 | 79.9k | 0U, // BteqzT8CmpiX16 |
2139 | 79.9k | 0U, // BteqzT8SltX16 |
2140 | 79.9k | 0U, // BteqzT8SltiX16 |
2141 | 79.9k | 0U, // BteqzT8SltiuX16 |
2142 | 79.9k | 0U, // BteqzT8SltuX16 |
2143 | 79.9k | 0U, // BteqzX16 |
2144 | 79.9k | 0U, // Btnez16 |
2145 | 79.9k | 0U, // BtnezT8CmpX16 |
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2147 | 79.9k | 0U, // BtnezT8SltX16 |
2148 | 79.9k | 0U, // BtnezT8SltiX16 |
2149 | 79.9k | 0U, // BtnezT8SltiuX16 |
2150 | 79.9k | 0U, // BtnezT8SltuX16 |
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2152 | 79.9k | 0U, // BuildPairF64 |
2153 | 79.9k | 0U, // BuildPairF64_64 |
2154 | 79.9k | 0U, // CACHE |
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2156 | 79.9k | 0U, // CACHE_R6 |
2157 | 79.9k | 0U, // CEIL_L_D64 |
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2172 | 79.9k | 0U, // CFC1 |
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2177 | 79.9k | 0U, // CLASS_D |
2178 | 79.9k | 0U, // CLASS_S |
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2195 | 79.9k | 0U, // CLO |
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2200 | 79.9k | 0U, // CLTI_S_H |
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2209 | 79.9k | 0U, // CLT_S_W |
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2211 | 79.9k | 0U, // CLT_U_D |
2212 | 79.9k | 0U, // CLT_U_H |
2213 | 79.9k | 0U, // CLT_U_W |
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2215 | 79.9k | 0U, // CLZ_MM |
2216 | 79.9k | 0U, // CLZ_R6 |
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2228 | 79.9k | 0U, // CMP_EQ_S |
2229 | 79.9k | 0U, // CMP_F_D |
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2231 | 79.9k | 0U, // CMP_LE_D |
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2233 | 79.9k | 0U, // CMP_LE_S |
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2238 | 79.9k | 0U, // CMP_SAF_S |
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2240 | 79.9k | 0U, // CMP_SEQ_S |
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2242 | 79.9k | 0U, // CMP_SLE_S |
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2245 | 79.9k | 0U, // CMP_SUEQ_D |
2246 | 79.9k | 0U, // CMP_SUEQ_S |
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2248 | 79.9k | 0U, // CMP_SULE_S |
2249 | 79.9k | 0U, // CMP_SULT_D |
2250 | 79.9k | 0U, // CMP_SULT_S |
2251 | 79.9k | 0U, // CMP_SUN_D |
2252 | 79.9k | 0U, // CMP_SUN_S |
2253 | 79.9k | 0U, // CMP_UEQ_D |
2254 | 79.9k | 0U, // CMP_UEQ_S |
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2256 | 79.9k | 0U, // CMP_ULE_S |
2257 | 79.9k | 0U, // CMP_ULT_D |
2258 | 79.9k | 0U, // CMP_ULT_S |
2259 | 79.9k | 0U, // CMP_UN_D |
2260 | 79.9k | 0U, // CMP_UN_S |
2261 | 79.9k | 0U, // CONSTPOOL_ENTRY |
2262 | 79.9k | 0U, // COPY_FD_PSEUDO |
2263 | 79.9k | 0U, // COPY_FW_PSEUDO |
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2265 | 79.9k | 8U, // COPY_S_D |
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2267 | 79.9k | 8U, // COPY_S_W |
2268 | 79.9k | 8U, // COPY_U_B |
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2271 | 79.9k | 8U, // COPY_U_W |
2272 | 79.9k | 0U, // CTC1 |
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2274 | 79.9k | 0U, // CTCMSA |
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2279 | 79.9k | 0U, // CVT_D64_S |
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2281 | 79.9k | 0U, // CVT_D_S_MM |
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2297 | 79.9k | 0U, // C_EQ_D32 |
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2300 | 79.9k | 0U, // C_F_D32 |
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2309 | 79.9k | 0U, // C_NGE_D32 |
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2312 | 79.9k | 0U, // C_NGLE_D32 |
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2315 | 79.9k | 0U, // C_NGL_D32 |
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2318 | 79.9k | 0U, // C_NGT_D32 |
2319 | 79.9k | 0U, // C_NGT_D64 |
2320 | 79.9k | 0U, // C_NGT_S |
2321 | 79.9k | 0U, // C_OLE_D32 |
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2324 | 79.9k | 0U, // C_OLT_D32 |
2325 | 79.9k | 0U, // C_OLT_D64 |
2326 | 79.9k | 0U, // C_OLT_S |
2327 | 79.9k | 0U, // C_SEQ_D32 |
2328 | 79.9k | 0U, // C_SEQ_D64 |
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2330 | 79.9k | 0U, // C_SF_D32 |
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2332 | 79.9k | 0U, // C_SF_S |
2333 | 79.9k | 0U, // C_UEQ_D32 |
2334 | 79.9k | 0U, // C_UEQ_D64 |
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2336 | 79.9k | 0U, // C_ULE_D32 |
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2338 | 79.9k | 0U, // C_ULE_S |
2339 | 79.9k | 0U, // C_ULT_D32 |
2340 | 79.9k | 0U, // C_ULT_D64 |
2341 | 79.9k | 0U, // C_ULT_S |
2342 | 79.9k | 0U, // C_UN_D32 |
2343 | 79.9k | 0U, // C_UN_D64 |
2344 | 79.9k | 0U, // C_UN_S |
2345 | 79.9k | 0U, // CmpRxRy16 |
2346 | 79.9k | 0U, // CmpiRxImm16 |
2347 | 79.9k | 0U, // CmpiRxImmX16 |
2348 | 79.9k | 0U, // Constant32 |
2349 | 79.9k | 0U, // DADD |
2350 | 79.9k | 0U, // DADDi |
2351 | 79.9k | 0U, // DADDiu |
2352 | 79.9k | 0U, // DADDu |
2353 | 79.9k | 0U, // DAHI |
2354 | 79.9k | 4U, // DALIGN |
2355 | 79.9k | 0U, // DATI |
2356 | 79.9k | 0U, // DAUI |
2357 | 79.9k | 0U, // DBITSWAP |
2358 | 79.9k | 0U, // DCLO |
2359 | 79.9k | 0U, // DCLO_R6 |
2360 | 79.9k | 0U, // DCLZ |
2361 | 79.9k | 0U, // DCLZ_R6 |
2362 | 79.9k | 0U, // DDIV |
2363 | 79.9k | 0U, // DDIVU |
2364 | 79.9k | 0U, // DERET |
2365 | 79.9k | 0U, // DERET_MM |
2366 | 79.9k | 21U, // DEXT |
2367 | 79.9k | 21U, // DEXTM |
2368 | 79.9k | 21U, // DEXTU |
2369 | 79.9k | 0U, // DI |
2370 | 79.9k | 21U, // DINS |
2371 | 79.9k | 21U, // DINSM |
2372 | 79.9k | 21U, // DINSU |
2373 | 79.9k | 0U, // DIV |
2374 | 79.9k | 0U, // DIVU |
2375 | 79.9k | 0U, // DIV_S_B |
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2377 | 79.9k | 0U, // DIV_S_H |
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2379 | 79.9k | 0U, // DIV_U_B |
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2381 | 79.9k | 0U, // DIV_U_H |
2382 | 79.9k | 0U, // DIV_U_W |
2383 | 79.9k | 0U, // DI_MM |
2384 | 79.9k | 4U, // DLSA |
2385 | 79.9k | 4U, // DLSA_R6 |
2386 | 79.9k | 1U, // DMFC0 |
2387 | 79.9k | 0U, // DMFC1 |
2388 | 79.9k | 1U, // DMFC2 |
2389 | 79.9k | 0U, // DMOD |
2390 | 79.9k | 0U, // DMODU |
2391 | 79.9k | 1U, // DMTC0 |
2392 | 79.9k | 0U, // DMTC1 |
2393 | 79.9k | 1U, // DMTC2 |
2394 | 79.9k | 0U, // DMUH |
2395 | 79.9k | 0U, // DMUHU |
2396 | 79.9k | 0U, // DMUL |
2397 | 79.9k | 0U, // DMULT |
2398 | 79.9k | 0U, // DMULTu |
2399 | 79.9k | 0U, // DMULU |
2400 | 79.9k | 0U, // DMUL_R6 |
2401 | 79.9k | 0U, // DOTP_S_D |
2402 | 79.9k | 0U, // DOTP_S_H |
2403 | 79.9k | 0U, // DOTP_S_W |
2404 | 79.9k | 0U, // DOTP_U_D |
2405 | 79.9k | 0U, // DOTP_U_H |
2406 | 79.9k | 0U, // DOTP_U_W |
2407 | 79.9k | 2U, // DPADD_S_D |
2408 | 79.9k | 2U, // DPADD_S_H |
2409 | 79.9k | 2U, // DPADD_S_W |
2410 | 79.9k | 2U, // DPADD_U_D |
2411 | 79.9k | 2U, // DPADD_U_H |
2412 | 79.9k | 2U, // DPADD_U_W |
2413 | 79.9k | 0U, // DPAQX_SA_W_PH |
2414 | 79.9k | 0U, // DPAQX_S_W_PH |
2415 | 79.9k | 0U, // DPAQ_SA_L_W |
2416 | 79.9k | 0U, // DPAQ_S_W_PH |
2417 | 79.9k | 0U, // DPAU_H_QBL |
2418 | 79.9k | 0U, // DPAU_H_QBR |
2419 | 79.9k | 0U, // DPAX_W_PH |
2420 | 79.9k | 0U, // DPA_W_PH |
2421 | 79.9k | 0U, // DPOP |
2422 | 79.9k | 0U, // DPSQX_SA_W_PH |
2423 | 79.9k | 0U, // DPSQX_S_W_PH |
2424 | 79.9k | 0U, // DPSQ_SA_L_W |
2425 | 79.9k | 0U, // DPSQ_S_W_PH |
2426 | 79.9k | 2U, // DPSUB_S_D |
2427 | 79.9k | 2U, // DPSUB_S_H |
2428 | 79.9k | 2U, // DPSUB_S_W |
2429 | 79.9k | 2U, // DPSUB_U_D |
2430 | 79.9k | 2U, // DPSUB_U_H |
2431 | 79.9k | 2U, // DPSUB_U_W |
2432 | 79.9k | 0U, // DPSU_H_QBL |
2433 | 79.9k | 0U, // DPSU_H_QBR |
2434 | 79.9k | 0U, // DPSX_W_PH |
2435 | 79.9k | 0U, // DPS_W_PH |
2436 | 79.9k | 1U, // DROTR |
2437 | 79.9k | 1U, // DROTR32 |
2438 | 79.9k | 0U, // DROTRV |
2439 | 79.9k | 0U, // DSBH |
2440 | 79.9k | 0U, // DSDIV |
2441 | 79.9k | 0U, // DSHD |
2442 | 79.9k | 1U, // DSLL |
2443 | 79.9k | 1U, // DSLL32 |
2444 | 79.9k | 0U, // DSLL64_32 |
2445 | 79.9k | 0U, // DSLLV |
2446 | 79.9k | 1U, // DSRA |
2447 | 79.9k | 1U, // DSRA32 |
2448 | 79.9k | 0U, // DSRAV |
2449 | 79.9k | 1U, // DSRL |
2450 | 79.9k | 1U, // DSRL32 |
2451 | 79.9k | 0U, // DSRLV |
2452 | 79.9k | 0U, // DSUB |
2453 | 79.9k | 0U, // DSUBu |
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2540 | 79.9k | 0U, // FEXUPR_W |
2541 | 79.9k | 0U, // FFINT_S_D |
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2545 | 79.9k | 0U, // FFQL_D |
2546 | 79.9k | 0U, // FFQL_W |
2547 | 79.9k | 0U, // FFQR_D |
2548 | 79.9k | 0U, // FFQR_W |
2549 | 79.9k | 0U, // FILL_B |
2550 | 79.9k | 0U, // FILL_D |
2551 | 79.9k | 0U, // FILL_FD_PSEUDO |
2552 | 79.9k | 0U, // FILL_FW_PSEUDO |
2553 | 79.9k | 0U, // FILL_H |
2554 | 79.9k | 0U, // FILL_W |
2555 | 79.9k | 0U, // FLOG2_D |
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2557 | 79.9k | 0U, // FLOOR_L_D64 |
2558 | 79.9k | 0U, // FLOOR_L_S |
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2560 | 79.9k | 0U, // FLOOR_W_D64 |
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2564 | 79.9k | 2U, // FMADD_D |
2565 | 79.9k | 2U, // FMADD_W |
2566 | 79.9k | 0U, // FMAX_A_D |
2567 | 79.9k | 0U, // FMAX_A_W |
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2570 | 79.9k | 0U, // FMIN_A_D |
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2574 | 79.9k | 0U, // FMOV_D32 |
2575 | 79.9k | 0U, // FMOV_D32_MM |
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2579 | 79.9k | 2U, // FMSUB_D |
2580 | 79.9k | 2U, // FMSUB_W |
2581 | 79.9k | 0U, // FMUL_D |
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2592 | 79.9k | 0U, // FNEG_S_MM |
2593 | 79.9k | 0U, // FRCP_D |
2594 | 79.9k | 0U, // FRCP_W |
2595 | 79.9k | 0U, // FRINT_D |
2596 | 79.9k | 0U, // FRINT_W |
2597 | 79.9k | 0U, // FRSQRT_D |
2598 | 79.9k | 0U, // FRSQRT_W |
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2600 | 79.9k | 0U, // FSAF_W |
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2634 | 79.9k | 0U, // FSUN_W |
2635 | 79.9k | 0U, // FTINT_S_D |
2636 | 79.9k | 0U, // FTINT_S_W |
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2638 | 79.9k | 0U, // FTINT_U_W |
2639 | 79.9k | 0U, // FTQ_H |
2640 | 79.9k | 0U, // FTQ_W |
2641 | 79.9k | 0U, // FTRUNC_S_D |
2642 | 79.9k | 0U, // FTRUNC_S_W |
2643 | 79.9k | 0U, // FTRUNC_U_D |
2644 | 79.9k | 0U, // FTRUNC_U_W |
2645 | 79.9k | 0U, // GotPrologue16 |
2646 | 79.9k | 0U, // HADD_S_D |
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2652 | 79.9k | 0U, // HSUB_S_D |
2653 | 79.9k | 0U, // HSUB_S_H |
2654 | 79.9k | 0U, // HSUB_S_W |
2655 | 79.9k | 0U, // HSUB_U_D |
2656 | 79.9k | 0U, // HSUB_U_H |
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2658 | 79.9k | 0U, // ILVEV_B |
2659 | 79.9k | 0U, // ILVEV_D |
2660 | 79.9k | 0U, // ILVEV_H |
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2662 | 79.9k | 0U, // ILVL_B |
2663 | 79.9k | 0U, // ILVL_D |
2664 | 79.9k | 0U, // ILVL_H |
2665 | 79.9k | 0U, // ILVL_W |
2666 | 79.9k | 0U, // ILVOD_B |
2667 | 79.9k | 0U, // ILVOD_D |
2668 | 79.9k | 0U, // ILVOD_H |
2669 | 79.9k | 0U, // ILVOD_W |
2670 | 79.9k | 0U, // ILVR_B |
2671 | 79.9k | 0U, // ILVR_D |
2672 | 79.9k | 0U, // ILVR_H |
2673 | 79.9k | 0U, // ILVR_W |
2674 | 79.9k | 21U, // INS |
2675 | 79.9k | 0U, // INSERT_B |
2676 | 79.9k | 0U, // INSERT_B_VIDX_PSEUDO |
2677 | 79.9k | 0U, // INSERT_D |
2678 | 79.9k | 0U, // INSERT_D_VIDX_PSEUDO |
2679 | 79.9k | 0U, // INSERT_FD_PSEUDO |
2680 | 79.9k | 0U, // INSERT_FD_VIDX_PSEUDO |
2681 | 79.9k | 0U, // INSERT_FW_PSEUDO |
2682 | 79.9k | 0U, // INSERT_FW_VIDX_PSEUDO |
2683 | 79.9k | 0U, // INSERT_H |
2684 | 79.9k | 0U, // INSERT_H_VIDX_PSEUDO |
2685 | 79.9k | 0U, // INSERT_W |
2686 | 79.9k | 0U, // INSERT_W_VIDX_PSEUDO |
2687 | 79.9k | 0U, // INSV |
2688 | 79.9k | 0U, // INSVE_B |
2689 | 79.9k | 0U, // INSVE_D |
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2691 | 79.9k | 0U, // INSVE_W |
2692 | 79.9k | 21U, // INS_MM |
2693 | 79.9k | 0U, // J |
2694 | 79.9k | 0U, // JAL |
2695 | 79.9k | 0U, // JALR |
2696 | 79.9k | 0U, // JALR16_MM |
2697 | 79.9k | 0U, // JALR64 |
2698 | 79.9k | 0U, // JALR64Pseudo |
2699 | 79.9k | 0U, // JALRPseudo |
2700 | 79.9k | 0U, // JALRS16_MM |
2701 | 79.9k | 0U, // JALRS_MM |
2702 | 79.9k | 0U, // JALR_HB |
2703 | 79.9k | 0U, // JALR_MM |
2704 | 79.9k | 0U, // JALS_MM |
2705 | 79.9k | 0U, // JALX |
2706 | 79.9k | 0U, // JALX_MM |
2707 | 79.9k | 0U, // JAL_MM |
2708 | 79.9k | 0U, // JIALC |
2709 | 79.9k | 0U, // JIC |
2710 | 79.9k | 0U, // JR |
2711 | 79.9k | 0U, // JR16_MM |
2712 | 79.9k | 0U, // JR64 |
2713 | 79.9k | 0U, // JRADDIUSP |
2714 | 79.9k | 0U, // JRC16_MM |
2715 | 79.9k | 0U, // JR_HB |
2716 | 79.9k | 0U, // JR_HB_R6 |
2717 | 79.9k | 0U, // JR_MM |
2718 | 79.9k | 0U, // J_MM |
2719 | 79.9k | 0U, // Jal16 |
2720 | 79.9k | 0U, // JalB16 |
2721 | 79.9k | 0U, // JalOneReg |
2722 | 79.9k | 0U, // JalTwoReg |
2723 | 79.9k | 0U, // JrRa16 |
2724 | 79.9k | 0U, // JrcRa16 |
2725 | 79.9k | 0U, // JrcRx16 |
2726 | 79.9k | 0U, // JumpLinkReg16 |
2727 | 79.9k | 0U, // LB |
2728 | 79.9k | 0U, // LB64 |
2729 | 79.9k | 0U, // LBU16_MM |
2730 | 79.9k | 0U, // LBUX |
2731 | 79.9k | 0U, // LB_MM |
2732 | 79.9k | 0U, // LBu |
2733 | 79.9k | 0U, // LBu64 |
2734 | 79.9k | 0U, // LBu_MM |
2735 | 79.9k | 0U, // LD |
2736 | 79.9k | 0U, // LDC1 |
2737 | 79.9k | 0U, // LDC164 |
2738 | 79.9k | 0U, // LDC1_MM |
2739 | 79.9k | 0U, // LDC2 |
2740 | 79.9k | 0U, // LDC2_R6 |
2741 | 79.9k | 0U, // LDC3 |
2742 | 79.9k | 0U, // LDI_B |
2743 | 79.9k | 0U, // LDI_D |
2744 | 79.9k | 0U, // LDI_H |
2745 | 79.9k | 0U, // LDI_W |
2746 | 79.9k | 0U, // LDL |
2747 | 79.9k | 0U, // LDPC |
2748 | 79.9k | 0U, // LDR |
2749 | 79.9k | 0U, // LDXC1 |
2750 | 79.9k | 0U, // LDXC164 |
2751 | 79.9k | 0U, // LD_B |
2752 | 79.9k | 0U, // LD_D |
2753 | 79.9k | 0U, // LD_H |
2754 | 79.9k | 0U, // LD_W |
2755 | 79.9k | 0U, // LEA_ADDiu |
2756 | 79.9k | 0U, // LEA_ADDiu64 |
2757 | 79.9k | 0U, // LEA_ADDiu_MM |
2758 | 79.9k | 0U, // LH |
2759 | 79.9k | 0U, // LH64 |
2760 | 79.9k | 0U, // LHU16_MM |
2761 | 79.9k | 0U, // LHX |
2762 | 79.9k | 0U, // LH_MM |
2763 | 79.9k | 0U, // LHu |
2764 | 79.9k | 0U, // LHu64 |
2765 | 79.9k | 0U, // LHu_MM |
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2800 | 79.9k | 0U, // LWM32_MM |
2801 | 79.9k | 0U, // LWM_MM |
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2805 | 79.9k | 0U, // LWR64 |
2806 | 79.9k | 0U, // LWR_MM |
2807 | 79.9k | 0U, // LWSP_MM |
2808 | 79.9k | 0U, // LWUPC |
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2810 | 79.9k | 0U, // LWX |
2811 | 79.9k | 0U, // LWXC1 |
2812 | 79.9k | 0U, // LWXC1_MM |
2813 | 79.9k | 0U, // LWXS_MM |
2814 | 79.9k | 0U, // LW_MM |
2815 | 79.9k | 0U, // LWu |
2816 | 79.9k | 0U, // LbRxRyOffMemX16 |
2817 | 79.9k | 0U, // LbuRxRyOffMemX16 |
2818 | 79.9k | 0U, // LhRxRyOffMemX16 |
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2820 | 79.9k | 0U, // LiRxImm16 |
2821 | 79.9k | 0U, // LiRxImmAlignX16 |
2822 | 79.9k | 0U, // LiRxImmX16 |
2823 | 79.9k | 0U, // LoadAddr32Imm |
2824 | 79.9k | 0U, // LoadAddr32Reg |
2825 | 79.9k | 0U, // LoadImm32Reg |
2826 | 79.9k | 0U, // LoadImm64Reg |
2827 | 79.9k | 0U, // LwConstant32 |
2828 | 79.9k | 0U, // LwRxPcTcp16 |
2829 | 79.9k | 0U, // LwRxPcTcpX16 |
2830 | 79.9k | 0U, // LwRxRyOffMemX16 |
2831 | 79.9k | 0U, // LwRxSpImmX16 |
2832 | 79.9k | 0U, // MADD |
2833 | 79.9k | 2U, // MADDF_D |
2834 | 79.9k | 2U, // MADDF_S |
2835 | 79.9k | 2U, // MADDR_Q_H |
2836 | 79.9k | 2U, // MADDR_Q_W |
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2838 | 79.9k | 0U, // MADDU_DSP |
2839 | 79.9k | 0U, // MADDU_MM |
2840 | 79.9k | 2U, // MADDV_B |
2841 | 79.9k | 2U, // MADDV_D |
2842 | 79.9k | 2U, // MADDV_H |
2843 | 79.9k | 2U, // MADDV_W |
2844 | 79.9k | 20U, // MADD_D32 |
2845 | 79.9k | 20U, // MADD_D32_MM |
2846 | 79.9k | 20U, // MADD_D64 |
2847 | 79.9k | 0U, // MADD_DSP |
2848 | 79.9k | 0U, // MADD_MM |
2849 | 79.9k | 2U, // MADD_Q_H |
2850 | 79.9k | 2U, // MADD_Q_W |
2851 | 79.9k | 20U, // MADD_S |
2852 | 79.9k | 20U, // MADD_S_MM |
2853 | 79.9k | 0U, // MAQ_SA_W_PHL |
2854 | 79.9k | 0U, // MAQ_SA_W_PHR |
2855 | 79.9k | 0U, // MAQ_S_W_PHL |
2856 | 79.9k | 0U, // MAQ_S_W_PHR |
2857 | 79.9k | 0U, // MAXA_D |
2858 | 79.9k | 0U, // MAXA_S |
2859 | 79.9k | 0U, // MAXI_S_B |
2860 | 79.9k | 0U, // MAXI_S_D |
2861 | 79.9k | 0U, // MAXI_S_H |
2862 | 79.9k | 0U, // MAXI_S_W |
2863 | 79.9k | 0U, // MAXI_U_B |
2864 | 79.9k | 0U, // MAXI_U_D |
2865 | 79.9k | 0U, // MAXI_U_H |
2866 | 79.9k | 0U, // MAXI_U_W |
2867 | 79.9k | 0U, // MAX_A_B |
2868 | 79.9k | 0U, // MAX_A_D |
2869 | 79.9k | 0U, // MAX_A_H |
2870 | 79.9k | 0U, // MAX_A_W |
2871 | 79.9k | 0U, // MAX_D |
2872 | 79.9k | 0U, // MAX_S |
2873 | 79.9k | 0U, // MAX_S_B |
2874 | 79.9k | 0U, // MAX_S_D |
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2876 | 79.9k | 0U, // MAX_S_W |
2877 | 79.9k | 0U, // MAX_U_B |
2878 | 79.9k | 0U, // MAX_U_D |
2879 | 79.9k | 0U, // MAX_U_H |
2880 | 79.9k | 0U, // MAX_U_W |
2881 | 79.9k | 1U, // MFC0 |
2882 | 79.9k | 0U, // MFC1 |
2883 | 79.9k | 0U, // MFC1_MM |
2884 | 79.9k | 1U, // MFC2 |
2885 | 79.9k | 0U, // MFHC1_D32 |
2886 | 79.9k | 0U, // MFHC1_D64 |
2887 | 79.9k | 0U, // MFHC1_MM |
2888 | 79.9k | 0U, // MFHI |
2889 | 79.9k | 0U, // MFHI16_MM |
2890 | 79.9k | 0U, // MFHI64 |
2891 | 79.9k | 0U, // MFHI_DSP |
2892 | 79.9k | 0U, // MFHI_MM |
2893 | 79.9k | 0U, // MFLO |
2894 | 79.9k | 0U, // MFLO16_MM |
2895 | 79.9k | 0U, // MFLO64 |
2896 | 79.9k | 0U, // MFLO_DSP |
2897 | 79.9k | 0U, // MFLO_MM |
2898 | 79.9k | 0U, // MINA_D |
2899 | 79.9k | 0U, // MINA_S |
2900 | 79.9k | 0U, // MINI_S_B |
2901 | 79.9k | 0U, // MINI_S_D |
2902 | 79.9k | 0U, // MINI_S_H |
2903 | 79.9k | 0U, // MINI_S_W |
2904 | 79.9k | 0U, // MINI_U_B |
2905 | 79.9k | 0U, // MINI_U_D |
2906 | 79.9k | 0U, // MINI_U_H |
2907 | 79.9k | 0U, // MINI_U_W |
2908 | 79.9k | 0U, // MIN_A_B |
2909 | 79.9k | 0U, // MIN_A_D |
2910 | 79.9k | 0U, // MIN_A_H |
2911 | 79.9k | 0U, // MIN_A_W |
2912 | 79.9k | 0U, // MIN_D |
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2914 | 79.9k | 0U, // MIN_S_B |
2915 | 79.9k | 0U, // MIN_S_D |
2916 | 79.9k | 0U, // MIN_S_H |
2917 | 79.9k | 0U, // MIN_S_W |
2918 | 79.9k | 0U, // MIN_U_B |
2919 | 79.9k | 0U, // MIN_U_D |
2920 | 79.9k | 0U, // MIN_U_H |
2921 | 79.9k | 0U, // MIN_U_W |
2922 | 79.9k | 0U, // MIPSeh_return32 |
2923 | 79.9k | 0U, // MIPSeh_return64 |
2924 | 79.9k | 0U, // MOD |
2925 | 79.9k | 0U, // MODSUB |
2926 | 79.9k | 0U, // MODU |
2927 | 79.9k | 0U, // MOD_S_B |
2928 | 79.9k | 0U, // MOD_S_D |
2929 | 79.9k | 0U, // MOD_S_H |
2930 | 79.9k | 0U, // MOD_S_W |
2931 | 79.9k | 0U, // MOD_U_B |
2932 | 79.9k | 0U, // MOD_U_D |
2933 | 79.9k | 0U, // MOD_U_H |
2934 | 79.9k | 0U, // MOD_U_W |
2935 | 79.9k | 0U, // MOVE16_MM |
2936 | 79.9k | 0U, // MOVEP_MM |
2937 | 79.9k | 0U, // MOVE_V |
2938 | 79.9k | 0U, // MOVF_D32 |
2939 | 79.9k | 0U, // MOVF_D32_MM |
2940 | 79.9k | 0U, // MOVF_D64 |
2941 | 79.9k | 0U, // MOVF_I |
2942 | 79.9k | 0U, // MOVF_I64 |
2943 | 79.9k | 0U, // MOVF_I_MM |
2944 | 79.9k | 0U, // MOVF_S |
2945 | 79.9k | 0U, // MOVF_S_MM |
2946 | 79.9k | 0U, // MOVN_I64_D64 |
2947 | 79.9k | 0U, // MOVN_I64_I |
2948 | 79.9k | 0U, // MOVN_I64_I64 |
2949 | 79.9k | 0U, // MOVN_I64_S |
2950 | 79.9k | 0U, // MOVN_I_D32 |
2951 | 79.9k | 0U, // MOVN_I_D32_MM |
2952 | 79.9k | 0U, // MOVN_I_D64 |
2953 | 79.9k | 0U, // MOVN_I_I |
2954 | 79.9k | 0U, // MOVN_I_I64 |
2955 | 79.9k | 0U, // MOVN_I_MM |
2956 | 79.9k | 0U, // MOVN_I_S |
2957 | 79.9k | 0U, // MOVN_I_S_MM |
2958 | 79.9k | 0U, // MOVT_D32 |
2959 | 79.9k | 0U, // MOVT_D32_MM |
2960 | 79.9k | 0U, // MOVT_D64 |
2961 | 79.9k | 0U, // MOVT_I |
2962 | 79.9k | 0U, // MOVT_I64 |
2963 | 79.9k | 0U, // MOVT_I_MM |
2964 | 79.9k | 0U, // MOVT_S |
2965 | 79.9k | 0U, // MOVT_S_MM |
2966 | 79.9k | 0U, // MOVZ_I64_D64 |
2967 | 79.9k | 0U, // MOVZ_I64_I |
2968 | 79.9k | 0U, // MOVZ_I64_I64 |
2969 | 79.9k | 0U, // MOVZ_I64_S |
2970 | 79.9k | 0U, // MOVZ_I_D32 |
2971 | 79.9k | 0U, // MOVZ_I_D32_MM |
2972 | 79.9k | 0U, // MOVZ_I_D64 |
2973 | 79.9k | 0U, // MOVZ_I_I |
2974 | 79.9k | 0U, // MOVZ_I_I64 |
2975 | 79.9k | 0U, // MOVZ_I_MM |
2976 | 79.9k | 0U, // MOVZ_I_S |
2977 | 79.9k | 0U, // MOVZ_I_S_MM |
2978 | 79.9k | 0U, // MSUB |
2979 | 79.9k | 2U, // MSUBF_D |
2980 | 79.9k | 2U, // MSUBF_S |
2981 | 79.9k | 2U, // MSUBR_Q_H |
2982 | 79.9k | 2U, // MSUBR_Q_W |
2983 | 79.9k | 0U, // MSUBU |
2984 | 79.9k | 0U, // MSUBU_DSP |
2985 | 79.9k | 0U, // MSUBU_MM |
2986 | 79.9k | 2U, // MSUBV_B |
2987 | 79.9k | 2U, // MSUBV_D |
2988 | 79.9k | 2U, // MSUBV_H |
2989 | 79.9k | 2U, // MSUBV_W |
2990 | 79.9k | 20U, // MSUB_D32 |
2991 | 79.9k | 20U, // MSUB_D32_MM |
2992 | 79.9k | 20U, // MSUB_D64 |
2993 | 79.9k | 0U, // MSUB_DSP |
2994 | 79.9k | 0U, // MSUB_MM |
2995 | 79.9k | 2U, // MSUB_Q_H |
2996 | 79.9k | 2U, // MSUB_Q_W |
2997 | 79.9k | 20U, // MSUB_S |
2998 | 79.9k | 20U, // MSUB_S_MM |
2999 | 79.9k | 1U, // MTC0 |
3000 | 79.9k | 0U, // MTC1 |
3001 | 79.9k | 0U, // MTC1_MM |
3002 | 79.9k | 1U, // MTC2 |
3003 | 79.9k | 0U, // MTHC1_D32 |
3004 | 79.9k | 0U, // MTHC1_D64 |
3005 | 79.9k | 0U, // MTHC1_MM |
3006 | 79.9k | 0U, // MTHI |
3007 | 79.9k | 0U, // MTHI64 |
3008 | 79.9k | 0U, // MTHI_DSP |
3009 | 79.9k | 0U, // MTHI_MM |
3010 | 79.9k | 0U, // MTHLIP |
3011 | 79.9k | 0U, // MTLO |
3012 | 79.9k | 0U, // MTLO64 |
3013 | 79.9k | 0U, // MTLO_DSP |
3014 | 79.9k | 0U, // MTLO_MM |
3015 | 79.9k | 0U, // MTM0 |
3016 | 79.9k | 0U, // MTM1 |
3017 | 79.9k | 0U, // MTM2 |
3018 | 79.9k | 0U, // MTP0 |
3019 | 79.9k | 0U, // MTP1 |
3020 | 79.9k | 0U, // MTP2 |
3021 | 79.9k | 0U, // MUH |
3022 | 79.9k | 0U, // MUHU |
3023 | 79.9k | 0U, // MUL |
3024 | 79.9k | 0U, // MULEQ_S_W_PHL |
3025 | 79.9k | 0U, // MULEQ_S_W_PHR |
3026 | 79.9k | 0U, // MULEU_S_PH_QBL |
3027 | 79.9k | 0U, // MULEU_S_PH_QBR |
3028 | 79.9k | 0U, // MULQ_RS_PH |
3029 | 79.9k | 0U, // MULQ_RS_W |
3030 | 79.9k | 0U, // MULQ_S_PH |
3031 | 79.9k | 0U, // MULQ_S_W |
3032 | 79.9k | 0U, // MULR_Q_H |
3033 | 79.9k | 0U, // MULR_Q_W |
3034 | 79.9k | 0U, // MULSAQ_S_W_PH |
3035 | 79.9k | 0U, // MULSA_W_PH |
3036 | 79.9k | 0U, // MULT |
3037 | 79.9k | 0U, // MULTU_DSP |
3038 | 79.9k | 0U, // MULT_DSP |
3039 | 79.9k | 0U, // MULT_MM |
3040 | 79.9k | 0U, // MULTu |
3041 | 79.9k | 0U, // MULTu_MM |
3042 | 79.9k | 0U, // MULU |
3043 | 79.9k | 0U, // MULV_B |
3044 | 79.9k | 0U, // MULV_D |
3045 | 79.9k | 0U, // MULV_H |
3046 | 79.9k | 0U, // MULV_W |
3047 | 79.9k | 0U, // MUL_MM |
3048 | 79.9k | 0U, // MUL_PH |
3049 | 79.9k | 0U, // MUL_Q_H |
3050 | 79.9k | 0U, // MUL_Q_W |
3051 | 79.9k | 0U, // MUL_R6 |
3052 | 79.9k | 0U, // MUL_S_PH |
3053 | 79.9k | 0U, // Mfhi16 |
3054 | 79.9k | 0U, // Mflo16 |
3055 | 79.9k | 0U, // Move32R16 |
3056 | 79.9k | 0U, // MoveR3216 |
3057 | 79.9k | 0U, // MultRxRy16 |
3058 | 79.9k | 0U, // MultRxRyRz16 |
3059 | 79.9k | 0U, // MultuRxRy16 |
3060 | 79.9k | 0U, // MultuRxRyRz16 |
3061 | 79.9k | 0U, // NLOC_B |
3062 | 79.9k | 0U, // NLOC_D |
3063 | 79.9k | 0U, // NLOC_H |
3064 | 79.9k | 0U, // NLOC_W |
3065 | 79.9k | 0U, // NLZC_B |
3066 | 79.9k | 0U, // NLZC_D |
3067 | 79.9k | 0U, // NLZC_H |
3068 | 79.9k | 0U, // NLZC_W |
3069 | 79.9k | 20U, // NMADD_D32 |
3070 | 79.9k | 20U, // NMADD_D32_MM |
3071 | 79.9k | 20U, // NMADD_D64 |
3072 | 79.9k | 20U, // NMADD_S |
3073 | 79.9k | 20U, // NMADD_S_MM |
3074 | 79.9k | 20U, // NMSUB_D32 |
3075 | 79.9k | 20U, // NMSUB_D32_MM |
3076 | 79.9k | 20U, // NMSUB_D64 |
3077 | 79.9k | 20U, // NMSUB_S |
3078 | 79.9k | 20U, // NMSUB_S_MM |
3079 | 79.9k | 0U, // NOP |
3080 | 79.9k | 0U, // NOR |
3081 | 79.9k | 0U, // NOR64 |
3082 | 79.9k | 0U, // NORI_B |
3083 | 79.9k | 0U, // NOR_MM |
3084 | 79.9k | 0U, // NOR_V |
3085 | 79.9k | 0U, // NOR_V_D_PSEUDO |
3086 | 79.9k | 0U, // NOR_V_H_PSEUDO |
3087 | 79.9k | 0U, // NOR_V_W_PSEUDO |
3088 | 79.9k | 0U, // NOT16_MM |
3089 | 79.9k | 0U, // NegRxRy16 |
3090 | 79.9k | 0U, // NotRxRy16 |
3091 | 79.9k | 0U, // OR |
3092 | 79.9k | 0U, // OR16_MM |
3093 | 79.9k | 0U, // OR64 |
3094 | 79.9k | 0U, // ORI_B |
3095 | 79.9k | 0U, // OR_MM |
3096 | 79.9k | 0U, // OR_V |
3097 | 79.9k | 0U, // OR_V_D_PSEUDO |
3098 | 79.9k | 0U, // OR_V_H_PSEUDO |
3099 | 79.9k | 0U, // OR_V_W_PSEUDO |
3100 | 79.9k | 1U, // ORi |
3101 | 79.9k | 1U, // ORi64 |
3102 | 79.9k | 1U, // ORi_MM |
3103 | 79.9k | 0U, // OrRxRxRy16 |
3104 | 79.9k | 0U, // PACKRL_PH |
3105 | 79.9k | 0U, // PAUSE |
3106 | 79.9k | 0U, // PAUSE_MM |
3107 | 79.9k | 0U, // PCKEV_B |
3108 | 79.9k | 0U, // PCKEV_D |
3109 | 79.9k | 0U, // PCKEV_H |
3110 | 79.9k | 0U, // PCKEV_W |
3111 | 79.9k | 0U, // PCKOD_B |
3112 | 79.9k | 0U, // PCKOD_D |
3113 | 79.9k | 0U, // PCKOD_H |
3114 | 79.9k | 0U, // PCKOD_W |
3115 | 79.9k | 0U, // PCNT_B |
3116 | 79.9k | 0U, // PCNT_D |
3117 | 79.9k | 0U, // PCNT_H |
3118 | 79.9k | 0U, // PCNT_W |
3119 | 79.9k | 0U, // PICK_PH |
3120 | 79.9k | 0U, // PICK_QB |
3121 | 79.9k | 0U, // POP |
3122 | 79.9k | 0U, // PRECEQU_PH_QBL |
3123 | 79.9k | 0U, // PRECEQU_PH_QBLA |
3124 | 79.9k | 0U, // PRECEQU_PH_QBR |
3125 | 79.9k | 0U, // PRECEQU_PH_QBRA |
3126 | 79.9k | 0U, // PRECEQ_W_PHL |
3127 | 79.9k | 0U, // PRECEQ_W_PHR |
3128 | 79.9k | 0U, // PRECEU_PH_QBL |
3129 | 79.9k | 0U, // PRECEU_PH_QBLA |
3130 | 79.9k | 0U, // PRECEU_PH_QBR |
3131 | 79.9k | 0U, // PRECEU_PH_QBRA |
3132 | 79.9k | 0U, // PRECRQU_S_QB_PH |
3133 | 79.9k | 0U, // PRECRQ_PH_W |
3134 | 79.9k | 0U, // PRECRQ_QB_PH |
3135 | 79.9k | 0U, // PRECRQ_RS_PH_W |
3136 | 79.9k | 0U, // PRECR_QB_PH |
3137 | 79.9k | 1U, // PRECR_SRA_PH_W |
3138 | 79.9k | 1U, // PRECR_SRA_R_PH_W |
3139 | 79.9k | 0U, // PREF |
3140 | 79.9k | 0U, // PREF_MM |
3141 | 79.9k | 0U, // PREF_R6 |
3142 | 79.9k | 1U, // PREPEND |
3143 | 79.9k | 0U, // PseudoCMPU_EQ_QB |
3144 | 79.9k | 0U, // PseudoCMPU_LE_QB |
3145 | 79.9k | 0U, // PseudoCMPU_LT_QB |
3146 | 79.9k | 0U, // PseudoCMP_EQ_PH |
3147 | 79.9k | 0U, // PseudoCMP_LE_PH |
3148 | 79.9k | 0U, // PseudoCMP_LT_PH |
3149 | 79.9k | 0U, // PseudoCVT_D32_W |
3150 | 79.9k | 0U, // PseudoCVT_D64_L |
3151 | 79.9k | 0U, // PseudoCVT_D64_W |
3152 | 79.9k | 0U, // PseudoCVT_S_L |
3153 | 79.9k | 0U, // PseudoCVT_S_W |
3154 | 79.9k | 0U, // PseudoDMULT |
3155 | 79.9k | 0U, // PseudoDMULTu |
3156 | 79.9k | 0U, // PseudoDSDIV |
3157 | 79.9k | 0U, // PseudoDUDIV |
3158 | 79.9k | 0U, // PseudoIndirectBranch |
3159 | 79.9k | 0U, // PseudoIndirectBranch64 |
3160 | 79.9k | 0U, // PseudoMADD |
3161 | 79.9k | 0U, // PseudoMADDU |
3162 | 79.9k | 0U, // PseudoMFHI |
3163 | 79.9k | 0U, // PseudoMFHI64 |
3164 | 79.9k | 0U, // PseudoMFLO |
3165 | 79.9k | 0U, // PseudoMFLO64 |
3166 | 79.9k | 0U, // PseudoMSUB |
3167 | 79.9k | 0U, // PseudoMSUBU |
3168 | 79.9k | 0U, // PseudoMTLOHI |
3169 | 79.9k | 0U, // PseudoMTLOHI64 |
3170 | 79.9k | 0U, // PseudoMTLOHI_DSP |
3171 | 79.9k | 0U, // PseudoMULT |
3172 | 79.9k | 0U, // PseudoMULTu |
3173 | 79.9k | 0U, // PseudoPICK_PH |
3174 | 79.9k | 0U, // PseudoPICK_QB |
3175 | 79.9k | 0U, // PseudoReturn |
3176 | 79.9k | 0U, // PseudoReturn64 |
3177 | 79.9k | 0U, // PseudoSDIV |
3178 | 79.9k | 0U, // PseudoSELECTFP_F_D32 |
3179 | 79.9k | 0U, // PseudoSELECTFP_F_D64 |
3180 | 79.9k | 0U, // PseudoSELECTFP_F_I |
3181 | 79.9k | 0U, // PseudoSELECTFP_F_I64 |
3182 | 79.9k | 0U, // PseudoSELECTFP_F_S |
3183 | 79.9k | 0U, // PseudoSELECTFP_T_D32 |
3184 | 79.9k | 0U, // PseudoSELECTFP_T_D64 |
3185 | 79.9k | 0U, // PseudoSELECTFP_T_I |
3186 | 79.9k | 0U, // PseudoSELECTFP_T_I64 |
3187 | 79.9k | 0U, // PseudoSELECTFP_T_S |
3188 | 79.9k | 0U, // PseudoSELECT_D32 |
3189 | 79.9k | 0U, // PseudoSELECT_D64 |
3190 | 79.9k | 0U, // PseudoSELECT_I |
3191 | 79.9k | 0U, // PseudoSELECT_I64 |
3192 | 79.9k | 0U, // PseudoSELECT_S |
3193 | 79.9k | 0U, // PseudoUDIV |
3194 | 79.9k | 0U, // RADDU_W_QB |
3195 | 79.9k | 0U, // RDDSP |
3196 | 79.9k | 0U, // RDHWR |
3197 | 79.9k | 0U, // RDHWR64 |
3198 | 79.9k | 0U, // RDHWR_MM |
3199 | 79.9k | 0U, // REPLV_PH |
3200 | 79.9k | 0U, // REPLV_QB |
3201 | 79.9k | 0U, // REPL_PH |
3202 | 79.9k | 0U, // REPL_QB |
3203 | 79.9k | 0U, // RINT_D |
3204 | 79.9k | 0U, // RINT_S |
3205 | 79.9k | 1U, // ROTR |
3206 | 79.9k | 0U, // ROTRV |
3207 | 79.9k | 0U, // ROTRV_MM |
3208 | 79.9k | 1U, // ROTR_MM |
3209 | 79.9k | 0U, // ROUND_L_D64 |
3210 | 79.9k | 0U, // ROUND_L_S |
3211 | 79.9k | 0U, // ROUND_W_D32 |
3212 | 79.9k | 0U, // ROUND_W_D64 |
3213 | 79.9k | 0U, // ROUND_W_MM |
3214 | 79.9k | 0U, // ROUND_W_S |
3215 | 79.9k | 0U, // ROUND_W_S_MM |
3216 | 79.9k | 0U, // Restore16 |
3217 | 79.9k | 0U, // RestoreX16 |
3218 | 79.9k | 0U, // RetRA |
3219 | 79.9k | 0U, // RetRA16 |
3220 | 79.9k | 1U, // SAT_S_B |
3221 | 79.9k | 1U, // SAT_S_D |
3222 | 79.9k | 0U, // SAT_S_H |
3223 | 79.9k | 1U, // SAT_S_W |
3224 | 79.9k | 1U, // SAT_U_B |
3225 | 79.9k | 1U, // SAT_U_D |
3226 | 79.9k | 0U, // SAT_U_H |
3227 | 79.9k | 1U, // SAT_U_W |
3228 | 79.9k | 0U, // SB |
3229 | 79.9k | 0U, // SB16_MM |
3230 | 79.9k | 0U, // SB64 |
3231 | 79.9k | 0U, // SB_MM |
3232 | 79.9k | 0U, // SC |
3233 | 79.9k | 0U, // SCD |
3234 | 79.9k | 0U, // SCD_R6 |
3235 | 79.9k | 0U, // SC_MM |
3236 | 79.9k | 0U, // SC_R6 |
3237 | 79.9k | 0U, // SD |
3238 | 79.9k | 0U, // SDBBP |
3239 | 79.9k | 0U, // SDBBP16_MM |
3240 | 79.9k | 0U, // SDBBP_MM |
3241 | 79.9k | 0U, // SDBBP_R6 |
3242 | 79.9k | 0U, // SDC1 |
3243 | 79.9k | 0U, // SDC164 |
3244 | 79.9k | 0U, // SDC1_MM |
3245 | 79.9k | 0U, // SDC2 |
3246 | 79.9k | 0U, // SDC2_R6 |
3247 | 79.9k | 0U, // SDC3 |
3248 | 79.9k | 0U, // SDIV |
3249 | 79.9k | 0U, // SDIV_MM |
3250 | 79.9k | 0U, // SDL |
3251 | 79.9k | 0U, // SDR |
3252 | 79.9k | 0U, // SDXC1 |
3253 | 79.9k | 0U, // SDXC164 |
3254 | 79.9k | 0U, // SEB |
3255 | 79.9k | 0U, // SEB64 |
3256 | 79.9k | 0U, // SEB_MM |
3257 | 79.9k | 0U, // SEH |
3258 | 79.9k | 0U, // SEH64 |
3259 | 79.9k | 0U, // SEH_MM |
3260 | 79.9k | 0U, // SELEQZ |
3261 | 79.9k | 0U, // SELEQZ64 |
3262 | 79.9k | 0U, // SELEQZ_D |
3263 | 79.9k | 0U, // SELEQZ_S |
3264 | 79.9k | 0U, // SELNEZ |
3265 | 79.9k | 0U, // SELNEZ64 |
3266 | 79.9k | 0U, // SELNEZ_D |
3267 | 79.9k | 0U, // SELNEZ_S |
3268 | 79.9k | 2U, // SEL_D |
3269 | 79.9k | 2U, // SEL_S |
3270 | 79.9k | 0U, // SEQ |
3271 | 79.9k | 0U, // SEQi |
3272 | 79.9k | 0U, // SH |
3273 | 79.9k | 0U, // SH16_MM |
3274 | 79.9k | 0U, // SH64 |
3275 | 79.9k | 0U, // SHF_B |
3276 | 79.9k | 0U, // SHF_H |
3277 | 79.9k | 0U, // SHF_W |
3278 | 79.9k | 0U, // SHILO |
3279 | 79.9k | 0U, // SHILOV |
3280 | 79.9k | 0U, // SHLLV_PH |
3281 | 79.9k | 0U, // SHLLV_QB |
3282 | 79.9k | 0U, // SHLLV_S_PH |
3283 | 79.9k | 0U, // SHLLV_S_W |
3284 | 79.9k | 1U, // SHLL_PH |
3285 | 79.9k | 1U, // SHLL_QB |
3286 | 79.9k | 1U, // SHLL_S_PH |
3287 | 79.9k | 1U, // SHLL_S_W |
3288 | 79.9k | 0U, // SHRAV_PH |
3289 | 79.9k | 0U, // SHRAV_QB |
3290 | 79.9k | 0U, // SHRAV_R_PH |
3291 | 79.9k | 0U, // SHRAV_R_QB |
3292 | 79.9k | 0U, // SHRAV_R_W |
3293 | 79.9k | 1U, // SHRA_PH |
3294 | 79.9k | 1U, // SHRA_QB |
3295 | 79.9k | 1U, // SHRA_R_PH |
3296 | 79.9k | 1U, // SHRA_R_QB |
3297 | 79.9k | 1U, // SHRA_R_W |
3298 | 79.9k | 0U, // SHRLV_PH |
3299 | 79.9k | 0U, // SHRLV_QB |
3300 | 79.9k | 1U, // SHRL_PH |
3301 | 79.9k | 1U, // SHRL_QB |
3302 | 79.9k | 0U, // SH_MM |
3303 | 79.9k | 9U, // SLDI_B |
3304 | 79.9k | 9U, // SLDI_D |
3305 | 79.9k | 9U, // SLDI_H |
3306 | 79.9k | 9U, // SLDI_W |
3307 | 79.9k | 10U, // SLD_B |
3308 | 79.9k | 10U, // SLD_D |
3309 | 79.9k | 10U, // SLD_H |
3310 | 79.9k | 10U, // SLD_W |
3311 | 79.9k | 1U, // SLL |
3312 | 79.9k | 0U, // SLL16_MM |
3313 | 79.9k | 0U, // SLL64_32 |
3314 | 79.9k | 0U, // SLL64_64 |
3315 | 79.9k | 0U, // SLLI_B |
3316 | 79.9k | 0U, // SLLI_D |
3317 | 79.9k | 0U, // SLLI_H |
3318 | 79.9k | 0U, // SLLI_W |
3319 | 79.9k | 0U, // SLLV |
3320 | 79.9k | 0U, // SLLV_MM |
3321 | 79.9k | 0U, // SLL_B |
3322 | 79.9k | 0U, // SLL_D |
3323 | 79.9k | 0U, // SLL_H |
3324 | 79.9k | 1U, // SLL_MM |
3325 | 79.9k | 0U, // SLL_W |
3326 | 79.9k | 0U, // SLT |
3327 | 79.9k | 0U, // SLT64 |
3328 | 79.9k | 0U, // SLT_MM |
3329 | 79.9k | 0U, // SLTi |
3330 | 79.9k | 0U, // SLTi64 |
3331 | 79.9k | 0U, // SLTi_MM |
3332 | 79.9k | 0U, // SLTiu |
3333 | 79.9k | 0U, // SLTiu64 |
3334 | 79.9k | 0U, // SLTiu_MM |
3335 | 79.9k | 0U, // SLTu |
3336 | 79.9k | 0U, // SLTu64 |
3337 | 79.9k | 0U, // SLTu_MM |
3338 | 79.9k | 0U, // SNE |
3339 | 79.9k | 0U, // SNEi |
3340 | 79.9k | 0U, // SNZ_B_PSEUDO |
3341 | 79.9k | 0U, // SNZ_D_PSEUDO |
3342 | 79.9k | 0U, // SNZ_H_PSEUDO |
3343 | 79.9k | 0U, // SNZ_V_PSEUDO |
3344 | 79.9k | 0U, // SNZ_W_PSEUDO |
3345 | 79.9k | 8U, // SPLATI_B |
3346 | 79.9k | 8U, // SPLATI_D |
3347 | 79.9k | 8U, // SPLATI_H |
3348 | 79.9k | 8U, // SPLATI_W |
3349 | 79.9k | 8U, // SPLAT_B |
3350 | 79.9k | 8U, // SPLAT_D |
3351 | 79.9k | 8U, // SPLAT_H |
3352 | 79.9k | 8U, // SPLAT_W |
3353 | 79.9k | 1U, // SRA |
3354 | 79.9k | 0U, // SRAI_B |
3355 | 79.9k | 0U, // SRAI_D |
3356 | 79.9k | 0U, // SRAI_H |
3357 | 79.9k | 0U, // SRAI_W |
3358 | 79.9k | 1U, // SRARI_B |
3359 | 79.9k | 1U, // SRARI_D |
3360 | 79.9k | 0U, // SRARI_H |
3361 | 79.9k | 1U, // SRARI_W |
3362 | 79.9k | 0U, // SRAR_B |
3363 | 79.9k | 0U, // SRAR_D |
3364 | 79.9k | 0U, // SRAR_H |
3365 | 79.9k | 0U, // SRAR_W |
3366 | 79.9k | 0U, // SRAV |
3367 | 79.9k | 0U, // SRAV_MM |
3368 | 79.9k | 0U, // SRA_B |
3369 | 79.9k | 0U, // SRA_D |
3370 | 79.9k | 0U, // SRA_H |
3371 | 79.9k | 1U, // SRA_MM |
3372 | 79.9k | 0U, // SRA_W |
3373 | 79.9k | 1U, // SRL |
3374 | 79.9k | 0U, // SRL16_MM |
3375 | 79.9k | 0U, // SRLI_B |
3376 | 79.9k | 0U, // SRLI_D |
3377 | 79.9k | 0U, // SRLI_H |
3378 | 79.9k | 0U, // SRLI_W |
3379 | 79.9k | 1U, // SRLRI_B |
3380 | 79.9k | 1U, // SRLRI_D |
3381 | 79.9k | 0U, // SRLRI_H |
3382 | 79.9k | 1U, // SRLRI_W |
3383 | 79.9k | 0U, // SRLR_B |
3384 | 79.9k | 0U, // SRLR_D |
3385 | 79.9k | 0U, // SRLR_H |
3386 | 79.9k | 0U, // SRLR_W |
3387 | 79.9k | 0U, // SRLV |
3388 | 79.9k | 0U, // SRLV_MM |
3389 | 79.9k | 0U, // SRL_B |
3390 | 79.9k | 0U, // SRL_D |
3391 | 79.9k | 0U, // SRL_H |
3392 | 79.9k | 1U, // SRL_MM |
3393 | 79.9k | 0U, // SRL_W |
3394 | 79.9k | 0U, // SSNOP |
3395 | 79.9k | 0U, // SSNOP_MM |
3396 | 79.9k | 0U, // STORE_ACC128 |
3397 | 79.9k | 0U, // STORE_ACC64 |
3398 | 79.9k | 0U, // STORE_ACC64DSP |
3399 | 79.9k | 0U, // STORE_CCOND_DSP |
3400 | 79.9k | 0U, // ST_B |
3401 | 79.9k | 0U, // ST_D |
3402 | 79.9k | 0U, // ST_H |
3403 | 79.9k | 0U, // ST_W |
3404 | 79.9k | 0U, // SUB |
3405 | 79.9k | 0U, // SUBQH_PH |
3406 | 79.9k | 0U, // SUBQH_R_PH |
3407 | 79.9k | 0U, // SUBQH_R_W |
3408 | 79.9k | 0U, // SUBQH_W |
3409 | 79.9k | 0U, // SUBQ_PH |
3410 | 79.9k | 0U, // SUBQ_S_PH |
3411 | 79.9k | 0U, // SUBQ_S_W |
3412 | 79.9k | 0U, // SUBSUS_U_B |
3413 | 79.9k | 0U, // SUBSUS_U_D |
3414 | 79.9k | 0U, // SUBSUS_U_H |
3415 | 79.9k | 0U, // SUBSUS_U_W |
3416 | 79.9k | 0U, // SUBSUU_S_B |
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3419 | 79.9k | 0U, // SUBSUU_S_W |
3420 | 79.9k | 0U, // SUBS_S_B |
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3422 | 79.9k | 0U, // SUBS_S_H |
3423 | 79.9k | 0U, // SUBS_S_W |
3424 | 79.9k | 0U, // SUBS_U_B |
3425 | 79.9k | 0U, // SUBS_U_D |
3426 | 79.9k | 0U, // SUBS_U_H |
3427 | 79.9k | 0U, // SUBS_U_W |
3428 | 79.9k | 0U, // SUBU16_MM |
3429 | 79.9k | 0U, // SUBUH_QB |
3430 | 79.9k | 0U, // SUBUH_R_QB |
3431 | 79.9k | 0U, // SUBU_PH |
3432 | 79.9k | 0U, // SUBU_QB |
3433 | 79.9k | 0U, // SUBU_S_PH |
3434 | 79.9k | 0U, // SUBU_S_QB |
3435 | 79.9k | 0U, // SUBVI_B |
3436 | 79.9k | 0U, // SUBVI_D |
3437 | 79.9k | 0U, // SUBVI_H |
3438 | 79.9k | 0U, // SUBVI_W |
3439 | 79.9k | 0U, // SUBV_B |
3440 | 79.9k | 0U, // SUBV_D |
3441 | 79.9k | 0U, // SUBV_H |
3442 | 79.9k | 0U, // SUBV_W |
3443 | 79.9k | 0U, // SUB_MM |
3444 | 79.9k | 0U, // SUBu |
3445 | 79.9k | 0U, // SUBu_MM |
3446 | 79.9k | 0U, // SUXC1 |
3447 | 79.9k | 0U, // SUXC164 |
3448 | 79.9k | 0U, // SUXC1_MM |
3449 | 79.9k | 0U, // SW |
3450 | 79.9k | 0U, // SW16_MM |
3451 | 79.9k | 0U, // SW64 |
3452 | 79.9k | 0U, // SWC1 |
3453 | 79.9k | 0U, // SWC1_MM |
3454 | 79.9k | 0U, // SWC2 |
3455 | 79.9k | 0U, // SWC2_R6 |
3456 | 79.9k | 0U, // SWC3 |
3457 | 79.9k | 0U, // SWL |
3458 | 79.9k | 0U, // SWL64 |
3459 | 79.9k | 0U, // SWL_MM |
3460 | 79.9k | 0U, // SWM16_MM |
3461 | 79.9k | 0U, // SWM32_MM |
3462 | 79.9k | 0U, // SWM_MM |
3463 | 79.9k | 0U, // SWP_MM |
3464 | 79.9k | 0U, // SWR |
3465 | 79.9k | 0U, // SWR64 |
3466 | 79.9k | 0U, // SWR_MM |
3467 | 79.9k | 0U, // SWSP_MM |
3468 | 79.9k | 0U, // SWXC1 |
3469 | 79.9k | 0U, // SWXC1_MM |
3470 | 79.9k | 0U, // SW_MM |
3471 | 79.9k | 0U, // SYNC |
3472 | 79.9k | 0U, // SYNCI |
3473 | 79.9k | 0U, // SYNC_MM |
3474 | 79.9k | 0U, // SYSCALL |
3475 | 79.9k | 0U, // SYSCALL_MM |
3476 | 79.9k | 0U, // SZ_B_PSEUDO |
3477 | 79.9k | 0U, // SZ_D_PSEUDO |
3478 | 79.9k | 0U, // SZ_H_PSEUDO |
3479 | 79.9k | 0U, // SZ_V_PSEUDO |
3480 | 79.9k | 0U, // SZ_W_PSEUDO |
3481 | 79.9k | 0U, // Save16 |
3482 | 79.9k | 0U, // SaveX16 |
3483 | 79.9k | 0U, // SbRxRyOffMemX16 |
3484 | 79.9k | 0U, // SebRx16 |
3485 | 79.9k | 0U, // SehRx16 |
3486 | 79.9k | 0U, // SelBeqZ |
3487 | 79.9k | 0U, // SelBneZ |
3488 | 79.9k | 0U, // SelTBteqZCmp |
3489 | 79.9k | 0U, // SelTBteqZCmpi |
3490 | 79.9k | 0U, // SelTBteqZSlt |
3491 | 79.9k | 0U, // SelTBteqZSlti |
3492 | 79.9k | 0U, // SelTBteqZSltiu |
3493 | 79.9k | 0U, // SelTBteqZSltu |
3494 | 79.9k | 0U, // SelTBtneZCmp |
3495 | 79.9k | 0U, // SelTBtneZCmpi |
3496 | 79.9k | 0U, // SelTBtneZSlt |
3497 | 79.9k | 0U, // SelTBtneZSlti |
3498 | 79.9k | 0U, // SelTBtneZSltiu |
3499 | 79.9k | 0U, // SelTBtneZSltu |
3500 | 79.9k | 0U, // ShRxRyOffMemX16 |
3501 | 79.9k | 1U, // SllX16 |
3502 | 79.9k | 0U, // SllvRxRy16 |
3503 | 79.9k | 0U, // SltCCRxRy16 |
3504 | 79.9k | 0U, // SltRxRy16 |
3505 | 79.9k | 0U, // SltiCCRxImmX16 |
3506 | 79.9k | 0U, // SltiRxImm16 |
3507 | 79.9k | 0U, // SltiRxImmX16 |
3508 | 79.9k | 0U, // SltiuCCRxImmX16 |
3509 | 79.9k | 0U, // SltiuRxImm16 |
3510 | 79.9k | 0U, // SltiuRxImmX16 |
3511 | 79.9k | 0U, // SltuCCRxRy16 |
3512 | 79.9k | 0U, // SltuRxRy16 |
3513 | 79.9k | 0U, // SltuRxRyRz16 |
3514 | 79.9k | 1U, // SraX16 |
3515 | 79.9k | 0U, // SravRxRy16 |
3516 | 79.9k | 1U, // SrlX16 |
3517 | 79.9k | 0U, // SrlvRxRy16 |
3518 | 79.9k | 0U, // SubuRxRyRz16 |
3519 | 79.9k | 0U, // SwRxRyOffMemX16 |
3520 | 79.9k | 0U, // SwRxSpImmX16 |
3521 | 79.9k | 0U, // TAILCALL |
3522 | 79.9k | 0U, // TAILCALL64_R |
3523 | 79.9k | 0U, // TAILCALL_R |
3524 | 79.9k | 1U, // TEQ |
3525 | 79.9k | 0U, // TEQI |
3526 | 79.9k | 0U, // TEQI_MM |
3527 | 79.9k | 1U, // TEQ_MM |
3528 | 79.9k | 1U, // TGE |
3529 | 79.9k | 0U, // TGEI |
3530 | 79.9k | 0U, // TGEIU |
3531 | 79.9k | 0U, // TGEIU_MM |
3532 | 79.9k | 0U, // TGEI_MM |
3533 | 79.9k | 1U, // TGEU |
3534 | 79.9k | 1U, // TGEU_MM |
3535 | 79.9k | 1U, // TGE_MM |
3536 | 79.9k | 0U, // TLBP |
3537 | 79.9k | 0U, // TLBP_MM |
3538 | 79.9k | 0U, // TLBR |
3539 | 79.9k | 0U, // TLBR_MM |
3540 | 79.9k | 0U, // TLBWI |
3541 | 79.9k | 0U, // TLBWI_MM |
3542 | 79.9k | 0U, // TLBWR |
3543 | 79.9k | 0U, // TLBWR_MM |
3544 | 79.9k | 1U, // TLT |
3545 | 79.9k | 0U, // TLTI |
3546 | 79.9k | 0U, // TLTIU_MM |
3547 | 79.9k | 0U, // TLTI_MM |
3548 | 79.9k | 1U, // TLTU |
3549 | 79.9k | 1U, // TLTU_MM |
3550 | 79.9k | 1U, // TLT_MM |
3551 | 79.9k | 1U, // TNE |
3552 | 79.9k | 0U, // TNEI |
3553 | 79.9k | 0U, // TNEI_MM |
3554 | 79.9k | 1U, // TNE_MM |
3555 | 79.9k | 0U, // TRAP |
3556 | 79.9k | 0U, // TRUNC_L_D64 |
3557 | 79.9k | 0U, // TRUNC_L_S |
3558 | 79.9k | 0U, // TRUNC_W_D32 |
3559 | 79.9k | 0U, // TRUNC_W_D64 |
3560 | 79.9k | 0U, // TRUNC_W_MM |
3561 | 79.9k | 0U, // TRUNC_W_S |
3562 | 79.9k | 0U, // TRUNC_W_S_MM |
3563 | 79.9k | 0U, // TTLTIU |
3564 | 79.9k | 0U, // UDIV |
3565 | 79.9k | 0U, // UDIV_MM |
3566 | 79.9k | 0U, // V3MULU |
3567 | 79.9k | 0U, // VMM0 |
3568 | 79.9k | 0U, // VMULU |
3569 | 79.9k | 2U, // VSHF_B |
3570 | 79.9k | 2U, // VSHF_D |
3571 | 79.9k | 2U, // VSHF_H |
3572 | 79.9k | 2U, // VSHF_W |
3573 | 79.9k | 0U, // WAIT |
3574 | 79.9k | 0U, // WAIT_MM |
3575 | 79.9k | 0U, // WRDSP |
3576 | 79.9k | 0U, // WSBH |
3577 | 79.9k | 0U, // WSBH_MM |
3578 | 79.9k | 0U, // XOR |
3579 | 79.9k | 0U, // XOR16_MM |
3580 | 79.9k | 0U, // XOR64 |
3581 | 79.9k | 0U, // XORI_B |
3582 | 79.9k | 0U, // XOR_MM |
3583 | 79.9k | 0U, // XOR_V |
3584 | 79.9k | 0U, // XOR_V_D_PSEUDO |
3585 | 79.9k | 0U, // XOR_V_H_PSEUDO |
3586 | 79.9k | 0U, // XOR_V_W_PSEUDO |
3587 | 79.9k | 1U, // XORi |
3588 | 79.9k | 1U, // XORi64 |
3589 | 79.9k | 1U, // XORi_MM |
3590 | 79.9k | 0U, // XorRxRxRy16 |
3591 | 79.9k | 0U |
3592 | 79.9k | }; |
3593 | | |
3594 | 79.9k | #ifndef CAPSTONE_DIET |
3595 | 79.9k | static const char AsmStrs[] = { |
3596 | 79.9k | /* 0 */ 'j', 'a', 'l', 'r', 'c', 32, 9, 0, |
3597 | 79.9k | /* 8 */ 'd', 'm', 'f', 'c', '0', 9, 0, |
3598 | 79.9k | /* 15 */ 'd', 'm', 't', 'c', '0', 9, 0, |
3599 | 79.9k | /* 22 */ 'v', 'm', 'm', '0', 9, 0, |
3600 | 79.9k | /* 28 */ 'm', 't', 'm', '0', 9, 0, |
3601 | 79.9k | /* 34 */ 'm', 't', 'p', '0', 9, 0, |
3602 | 79.9k | /* 40 */ 'b', 'b', 'i', 't', '0', 9, 0, |
3603 | 79.9k | /* 47 */ 'l', 'd', 'c', '1', 9, 0, |
3604 | 79.9k | /* 53 */ 's', 'd', 'c', '1', 9, 0, |
3605 | 79.9k | /* 59 */ 'c', 'f', 'c', '1', 9, 0, |
3606 | 79.9k | /* 65 */ 'd', 'm', 'f', 'c', '1', 9, 0, |
3607 | 79.9k | /* 72 */ 'm', 'f', 'h', 'c', '1', 9, 0, |
3608 | 79.9k | /* 79 */ 'm', 't', 'h', 'c', '1', 9, 0, |
3609 | 79.9k | /* 86 */ 'c', 't', 'c', '1', 9, 0, |
3610 | 79.9k | /* 92 */ 'd', 'm', 't', 'c', '1', 9, 0, |
3611 | 79.9k | /* 99 */ 'l', 'w', 'c', '1', 9, 0, |
3612 | 79.9k | /* 105 */ 's', 'w', 'c', '1', 9, 0, |
3613 | 79.9k | /* 111 */ 'l', 'd', 'x', 'c', '1', 9, 0, |
3614 | 79.9k | /* 118 */ 's', 'd', 'x', 'c', '1', 9, 0, |
3615 | 79.9k | /* 125 */ 'l', 'u', 'x', 'c', '1', 9, 0, |
3616 | 79.9k | /* 132 */ 's', 'u', 'x', 'c', '1', 9, 0, |
3617 | 79.9k | /* 139 */ 'l', 'w', 'x', 'c', '1', 9, 0, |
3618 | 79.9k | /* 146 */ 's', 'w', 'x', 'c', '1', 9, 0, |
3619 | 79.9k | /* 153 */ 'm', 't', 'm', '1', 9, 0, |
3620 | 79.9k | /* 159 */ 'm', 't', 'p', '1', 9, 0, |
3621 | 79.9k | /* 165 */ 'b', 'b', 'i', 't', '1', 9, 0, |
3622 | 79.9k | /* 172 */ 'b', 'b', 'i', 't', '0', '3', '2', 9, 0, |
3623 | 79.9k | /* 181 */ 'b', 'b', 'i', 't', '1', '3', '2', 9, 0, |
3624 | 79.9k | /* 190 */ 'd', 's', 'r', 'a', '3', '2', 9, 0, |
3625 | 79.9k | /* 198 */ 'b', 'p', 'o', 's', 'g', 'e', '3', '2', 9, 0, |
3626 | 79.9k | /* 208 */ 'd', 's', 'l', 'l', '3', '2', 9, 0, |
3627 | 79.9k | /* 216 */ 'd', 's', 'r', 'l', '3', '2', 9, 0, |
3628 | 79.9k | /* 224 */ 'l', 'w', 'm', '3', '2', 9, 0, |
3629 | 79.9k | /* 231 */ 's', 'w', 'm', '3', '2', 9, 0, |
3630 | 79.9k | /* 238 */ 'd', 'r', 'o', 't', 'r', '3', '2', 9, 0, |
3631 | 79.9k | /* 247 */ 'l', 'd', 'c', '2', 9, 0, |
3632 | 79.9k | /* 253 */ 's', 'd', 'c', '2', 9, 0, |
3633 | 79.9k | /* 259 */ 'd', 'm', 'f', 'c', '2', 9, 0, |
3634 | 79.9k | /* 266 */ 'd', 'm', 't', 'c', '2', 9, 0, |
3635 | 79.9k | /* 273 */ 'l', 'w', 'c', '2', 9, 0, |
3636 | 79.9k | /* 279 */ 's', 'w', 'c', '2', 9, 0, |
3637 | 79.9k | /* 285 */ 'm', 't', 'm', '2', 9, 0, |
3638 | 79.9k | /* 291 */ 'm', 't', 'p', '2', 9, 0, |
3639 | 79.9k | /* 297 */ 'a', 'd', 'd', 'i', 'u', 'r', '2', 9, 0, |
3640 | 79.9k | /* 306 */ 'l', 'd', 'c', '3', 9, 0, |
3641 | 79.9k | /* 312 */ 's', 'd', 'c', '3', 9, 0, |
3642 | 79.9k | /* 318 */ 'l', 'w', 'c', '3', 9, 0, |
3643 | 79.9k | /* 324 */ 's', 'w', 'c', '3', 9, 0, |
3644 | 79.9k | /* 330 */ 'a', 'd', 'd', 'i', 'u', 's', '5', 9, 0, |
3645 | 79.9k | /* 339 */ 's', 'b', '1', '6', 9, 0, |
3646 | 79.9k | /* 345 */ 'a', 'n', 'd', '1', '6', 9, 0, |
3647 | 79.9k | /* 352 */ 's', 'h', '1', '6', 9, 0, |
3648 | 79.9k | /* 358 */ 'a', 'n', 'd', 'i', '1', '6', 9, 0, |
3649 | 79.9k | /* 366 */ 'l', 'i', '1', '6', 9, 0, |
3650 | 79.9k | /* 372 */ 'b', 'r', 'e', 'a', 'k', '1', '6', 9, 0, |
3651 | 79.9k | /* 381 */ 's', 'l', 'l', '1', '6', 9, 0, |
3652 | 79.9k | /* 388 */ 's', 'r', 'l', '1', '6', 9, 0, |
3653 | 79.9k | /* 395 */ 'l', 'w', 'm', '1', '6', 9, 0, |
3654 | 79.9k | /* 402 */ 's', 'w', 'm', '1', '6', 9, 0, |
3655 | 79.9k | /* 409 */ 's', 'd', 'b', 'b', 'p', '1', '6', 9, 0, |
3656 | 79.9k | /* 418 */ 'j', 'r', '1', '6', 9, 0, |
3657 | 79.9k | /* 424 */ 'x', 'o', 'r', '1', '6', 9, 0, |
3658 | 79.9k | /* 431 */ 'j', 'a', 'l', 'r', 's', '1', '6', 9, 0, |
3659 | 79.9k | /* 440 */ 'n', 'o', 't', '1', '6', 9, 0, |
3660 | 79.9k | /* 447 */ 'l', 'b', 'u', '1', '6', 9, 0, |
3661 | 79.9k | /* 454 */ 's', 'u', 'b', 'u', '1', '6', 9, 0, |
3662 | 79.9k | /* 462 */ 'a', 'd', 'd', 'u', '1', '6', 9, 0, |
3663 | 79.9k | /* 470 */ 'l', 'h', 'u', '1', '6', 9, 0, |
3664 | 79.9k | /* 477 */ 'l', 'w', '1', '6', 9, 0, |
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3811 | 79.9k | /* 1827 */ 'j', 'i', 'a', 'l', 'c', 9, 0, |
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3827 | 79.9k | /* 1949 */ 'b', 'l', 't', 'c', 9, 0, |
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4688 | 79.9k | /* 9473 */ 't', 'l', 'b', 'w', 'r', 0, |
4689 | 79.9k | /* 9479 */ 'd', 'e', 'r', 'e', 't', 0, |
4690 | 79.9k | /* 9485 */ 'w', 'a', 'i', 't', 0, |
4691 | 79.9k | }; |
4692 | 79.9k | #endif |
4693 | | |
4694 | | // Emit the opcode for the instruction. |
4695 | 79.9k | uint64_t Bits1 = OpInfo[MCInst_getOpcode(MI)]; |
4696 | 79.9k | uint64_t Bits2 = OpInfo2[MCInst_getOpcode(MI)]; |
4697 | 79.9k | uint64_t Bits = (Bits2 << 32) | Bits1; |
4698 | | // assert(Bits != 0 && "Cannot print this instruction."); |
4699 | 79.9k | #ifndef CAPSTONE_DIET |
4700 | 79.9k | SStream_concat0(O, AsmStrs+(Bits & 16383)-1); |
4701 | 79.9k | #endif |
4702 | | |
4703 | | |
4704 | | // Fragment 0 encoded into 4 bits for 11 unique commands. |
4705 | | //printf("Frag-0: %"PRIu64"\n", (Bits >> 14) & 15); |
4706 | 79.9k | switch ((Bits >> 14) & 15) { |
4707 | 0 | default: // llvm_unreachable("Invalid command number."); |
4708 | 331 | case 0: |
4709 | | // DBG_VALUE, BUNDLE, LIFETIME_START, LIFETIME_END, Break16, CONSTPOOL_EN... |
4710 | 331 | return; |
4711 | 0 | break; |
4712 | 74.0k | case 1: |
4713 | | // ABSQ_S_PH, ABSQ_S_QB, ABSQ_S_W, ADD, ADDIUPC, ADDIUPC_MM, ADDIUR1SP_MM... |
4714 | 74.0k | printOperand(MI, 0, O); |
4715 | 74.0k | break; |
4716 | 2.28k | case 2: |
4717 | | // ADDIUS5_MM, CTC1, CTC1_MM, DAHI, DATI, DMTC1, MTC1, MTC1_MM, MTHI_DSP,... |
4718 | 2.28k | printOperand(MI, 1, O); |
4719 | 2.28k | SStream_concat0(O, ", "); |
4720 | 2.28k | break; |
4721 | 560 | case 3: |
4722 | | // AND16_MM, MTHC1_D32, MTHC1_D64, MTHC1_MM, OR16_MM, XOR16_MM |
4723 | 560 | printOperand(MI, 2, O); |
4724 | 560 | SStream_concat0(O, ", "); |
4725 | 560 | break; |
4726 | 74 | case 4: |
4727 | | // BREAK16_MM, SDBBP16_MM |
4728 | 74 | printUnsignedImm8(MI, 0, O); |
4729 | 74 | return; |
4730 | 0 | break; |
4731 | 593 | case 5: |
4732 | | // CACHE, CACHE_MM, CACHE_R6, PREF, PREF_MM, PREF_R6 |
4733 | 593 | printUnsignedImm(MI, 2, O); |
4734 | 593 | SStream_concat0(O, ", "); |
4735 | 593 | printMemOperand(MI, 0, O); |
4736 | 593 | return; |
4737 | 0 | break; |
4738 | 0 | case 6: |
4739 | | // FCMP_D32, FCMP_D32_MM, FCMP_D64, FCMP_S32, FCMP_S32_MM |
4740 | 0 | printFCCOperand(MI, 2, O); |
4741 | 0 | break; |
4742 | 1.44k | case 7: |
4743 | | // LWM16_MM, LWM32_MM, LWM_MM, MOVEP_MM, SWM16_MM, SWM32_MM, SWM_MM |
4744 | 1.44k | printRegisterList(MI, 0, O); |
4745 | 1.44k | SStream_concat0(O, ", "); |
4746 | 1.44k | break; |
4747 | 266 | case 8: |
4748 | | // LWP_MM, SWP_MM |
4749 | 266 | printRegisterPair(MI, 0, O); |
4750 | 266 | SStream_concat0(O, ", "); |
4751 | 266 | printMemOperand(MI, 2, O); |
4752 | 266 | return; |
4753 | 0 | break; |
4754 | 300 | case 9: |
4755 | | // SYNCI |
4756 | 300 | printMemOperand(MI, 0, O); |
4757 | 300 | return; |
4758 | 0 | break; |
4759 | 0 | case 10: |
4760 | | // SelBeqZ, SelBneZ, SelTBteqZCmp, SelTBteqZCmpi, SelTBteqZSlt, SelTBteqZ... |
4761 | 0 | printOperand(MI, 3, O); |
4762 | 0 | break; |
4763 | 79.9k | } |
4764 | | |
4765 | | |
4766 | | // Fragment 1 encoded into 5 bits for 17 unique commands. |
4767 | | //printf("Frag-1: %"PRIu64"\n", (Bits >> 18) & 31); |
4768 | 78.3k | switch ((Bits >> 18) & 31) { |
4769 | 0 | default: // llvm_unreachable("Invalid command number."); |
4770 | 66.9k | case 0: |
4771 | | // ABSQ_S_PH, ABSQ_S_QB, ABSQ_S_W, ADD, ADDIUPC, ADDIUPC_MM, ADDIUR1SP_MM... |
4772 | 66.9k | SStream_concat0(O, ", "); |
4773 | 66.9k | break; |
4774 | 567 | case 1: |
4775 | | // ADDIUS5_MM, DAHI, DATI, MOVEP_MM, MultRxRyRz16, MultuRxRyRz16, SltCCRx... |
4776 | 567 | printOperand(MI, 2, O); |
4777 | 567 | break; |
4778 | 6.23k | case 2: |
4779 | | // ADDIUSP_MM, AddiuSpImmX16, B16_MM, BAL, BALC, BC, BPOSGE32, B_MM_Pseud... |
4780 | 6.23k | return; |
4781 | 0 | break; |
4782 | 239 | case 3: |
4783 | | // AND16_MM, OR16_MM, XOR16_MM |
4784 | 239 | printOperand(MI, 1, O); |
4785 | 239 | return; |
4786 | 0 | break; |
4787 | 0 | case 4: |
4788 | | // AddiuRxPcImmX16 |
4789 | 0 | SStream_concat0(O, ", $pc, "); |
4790 | 0 | printOperand(MI, 1, O); |
4791 | 0 | return; |
4792 | 0 | break; |
4793 | 0 | case 5: |
4794 | | // AddiuSpImm16, Bimm16 |
4795 | 0 | SStream_concat0(O, " # 16 bit inst"); |
4796 | 0 | return; |
4797 | 0 | break; |
4798 | 0 | case 6: |
4799 | | // Bteqz16, Btnez16 |
4800 | 0 | SStream_concat0(O, " # 16 bit inst"); |
4801 | 0 | return; |
4802 | 0 | break; |
4803 | 760 | case 7: |
4804 | | // CTC1, CTC1_MM, DMTC1, MTC1, MTC1_MM, MTHC1_D32, MTHC1_D64, MTHC1_MM, M... |
4805 | 760 | printOperand(MI, 0, O); |
4806 | 760 | return; |
4807 | 0 | break; |
4808 | 0 | case 8: |
4809 | | // FCMP_D32, FCMP_D32_MM, FCMP_D64 |
4810 | 0 | SStream_concat0(O, ".d\t"); |
4811 | 0 | printOperand(MI, 0, O); |
4812 | 0 | SStream_concat0(O, ", "); |
4813 | 0 | printOperand(MI, 1, O); |
4814 | 0 | return; |
4815 | 0 | break; |
4816 | 0 | case 9: |
4817 | | // FCMP_S32, FCMP_S32_MM |
4818 | 0 | SStream_concat0(O, ".s\t"); |
4819 | 0 | printOperand(MI, 0, O); |
4820 | 0 | SStream_concat0(O, ", "); |
4821 | 0 | printOperand(MI, 1, O); |
4822 | 0 | return; |
4823 | 0 | break; |
4824 | 880 | case 10: |
4825 | | // INSERT_B, INSERT_D, INSERT_H, INSERT_W, INSVE_B, INSVE_D, INSVE_H, INS... |
4826 | 880 | SStream_concat0(O, "["); |
4827 | 880 | break; |
4828 | 0 | case 11: |
4829 | | // Jal16 |
4830 | 0 | SStream_concat0(O, "\n\tnop"); |
4831 | 0 | return; |
4832 | 0 | break; |
4833 | 0 | case 12: |
4834 | | // JalB16 |
4835 | 0 | SStream_concat0(O, "\t# branch\n\tnop"); |
4836 | 0 | return; |
4837 | 0 | break; |
4838 | 1.17k | case 13: |
4839 | | // LWM16_MM, LWM32_MM, LWM_MM, SWM16_MM, SWM32_MM, SWM_MM |
4840 | 1.17k | printMemOperand(MI, 1, O); |
4841 | 1.17k | return; |
4842 | 0 | break; |
4843 | 0 | case 14: |
4844 | | // LwConstant32 |
4845 | 0 | SStream_concat0(O, ", 1f\n\tb\t2f\n\t.align\t2\n1: \t.word\t"); |
4846 | 0 | printOperand(MI, 1, O); |
4847 | 0 | SStream_concat0(O, "\n2:"); |
4848 | 0 | return; |
4849 | 0 | break; |
4850 | 1.54k | case 15: |
4851 | | // SC, SCD, SCD_R6, SC_MM, SC_R6 |
4852 | 1.54k | printMemOperand(MI, 2, O); |
4853 | 1.54k | return; |
4854 | 0 | break; |
4855 | 0 | case 16: |
4856 | | // SelBeqZ, SelBneZ |
4857 | 0 | SStream_concat0(O, ", .+4\n\t\n\tmove "); |
4858 | 0 | printOperand(MI, 1, O); |
4859 | 0 | SStream_concat0(O, ", "); |
4860 | 0 | printOperand(MI, 2, O); |
4861 | 0 | return; |
4862 | 0 | break; |
4863 | 78.3k | } |
4864 | | |
4865 | | |
4866 | | // Fragment 2 encoded into 4 bits for 12 unique commands. |
4867 | | //printf("Frag-2: %"PRIu64"\n", (Bits >> 23) & 15); |
4868 | 68.3k | switch ((Bits >> 23) & 15) { |
4869 | 0 | default: // llvm_unreachable("Invalid command number."); |
4870 | 46.9k | case 0: |
4871 | | // ABSQ_S_PH, ABSQ_S_QB, ABSQ_S_W, ADD, ADDIUPC, ADDIUPC_MM, ADDIUR1SP_MM... |
4872 | 46.9k | printOperand(MI, 1, O); |
4873 | 46.9k | break; |
4874 | 300 | case 1: |
4875 | | // ADDIUS5_MM, DAHI, DATI |
4876 | 300 | return; |
4877 | 0 | break; |
4878 | 3.35k | case 2: |
4879 | | // AddiuRxRxImm16, AddiuRxRxImmX16, AndRxRxRy16, BINSLI_B, BINSLI_D, BINS... |
4880 | 3.35k | printOperand(MI, 2, O); |
4881 | 3.35k | break; |
4882 | 0 | case 3: |
4883 | | // AddiuRxRyOffMemX16, LEA_ADDiu, LEA_ADDiu64, LEA_ADDiu_MM |
4884 | 0 | printMemOperandEA(MI, 1, O); |
4885 | 0 | return; |
4886 | 0 | break; |
4887 | 1.27k | case 4: |
4888 | | // BBIT0, BBIT032, BBIT1, BBIT132, LUi, LUi64, LUi_MM, LoadAddr32Imm, Loa... |
4889 | 1.27k | printUnsignedImm(MI, 1, O); |
4890 | 1.27k | break; |
4891 | 475 | case 5: |
4892 | | // INSERT_B, INSERT_D, INSERT_H, INSERT_W |
4893 | 475 | printUnsignedImm(MI, 3, O); |
4894 | 475 | SStream_concat0(O, "], "); |
4895 | 475 | printOperand(MI, 2, O); |
4896 | 475 | return; |
4897 | 0 | break; |
4898 | 405 | case 6: |
4899 | | // INSVE_B, INSVE_D, INSVE_H, INSVE_W |
4900 | 405 | printUnsignedImm(MI, 2, O); |
4901 | 405 | SStream_concat0(O, "], "); |
4902 | 405 | printOperand(MI, 3, O); |
4903 | 405 | SStream_concat0(O, "["); |
4904 | 405 | printUnsignedImm(MI, 4, O); |
4905 | 405 | SStream_concat0(O, "]"); |
4906 | 405 | return; |
4907 | 0 | break; |
4908 | 15.3k | case 7: |
4909 | | // LB, LB64, LBU16_MM, LB_MM, LBu, LBu64, LBu_MM, LD, LDC1, LDC164, LDC1_... |
4910 | 15.3k | printMemOperand(MI, 1, O); |
4911 | 15.3k | return; |
4912 | 0 | break; |
4913 | 267 | case 8: |
4914 | | // MOVEP_MM |
4915 | 267 | SStream_concat0(O, ", "); |
4916 | 267 | printOperand(MI, 3, O); |
4917 | 267 | return; |
4918 | 0 | break; |
4919 | 0 | case 9: |
4920 | | // MultRxRyRz16, MultuRxRyRz16 |
4921 | 0 | SStream_concat0(O, "\n\tmflo\t"); |
4922 | 0 | printOperand(MI, 0, O); |
4923 | 0 | return; |
4924 | 0 | break; |
4925 | 0 | case 10: |
4926 | | // SelTBteqZCmp, SelTBteqZCmpi, SelTBteqZSlt, SelTBteqZSlti, SelTBteqZSlt... |
4927 | 0 | printOperand(MI, 4, O); |
4928 | 0 | break; |
4929 | 0 | case 11: |
4930 | | // SltCCRxRy16, SltiCCRxImmX16, SltiuCCRxImmX16, SltuCCRxRy16, SltuRxRyRz... |
4931 | 0 | SStream_concat0(O, "\n\tmove\t"); |
4932 | 0 | printOperand(MI, 0, O); |
4933 | 0 | SStream_concat0(O, ", $t8"); |
4934 | 0 | return; |
4935 | 0 | break; |
4936 | 68.3k | } |
4937 | | |
4938 | | |
4939 | | // Fragment 3 encoded into 4 bits for 15 unique commands. |
4940 | | //printf("Frag-3: %"PRIu64"\n", (Bits >> 27) & 15); |
4941 | 51.6k | switch ((Bits >> 27) & 15) { |
4942 | 0 | default: // llvm_unreachable("Invalid command number."); |
4943 | 18.8k | case 0: |
4944 | | // ABSQ_S_PH, ABSQ_S_QB, ABSQ_S_W, ADDIUPC, ADDIUPC_MM, ADDIUR1SP_MM, ALU... |
4945 | 18.8k | return; |
4946 | 0 | break; |
4947 | 29.3k | case 1: |
4948 | | // ADD, ADDIUR2_MM, ADDQH_PH, ADDQH_R_PH, ADDQH_R_W, ADDQH_W, ADDQ_PH, AD... |
4949 | 29.3k | SStream_concat0(O, ", "); |
4950 | 29.3k | break; |
4951 | 0 | case 2: |
4952 | | // AddiuRxRxImm16, LwRxPcTcp16 |
4953 | 0 | SStream_concat0(O, "\t# 16 bit inst"); |
4954 | 0 | return; |
4955 | 0 | break; |
4956 | 0 | case 3: |
4957 | | // BeqzRxImm16, BnezRxImm16 |
4958 | 0 | SStream_concat0(O, " # 16 bit inst"); |
4959 | 0 | return; |
4960 | 0 | break; |
4961 | 0 | case 4: |
4962 | | // BteqzT8CmpX16, BteqzT8CmpiX16, BteqzT8SltX16, BteqzT8SltiX16, BteqzT8S... |
4963 | 0 | SStream_concat0(O, "\n\tbteqz\t"); |
4964 | 0 | printOperand(MI, 2, O); |
4965 | 0 | return; |
4966 | 0 | break; |
4967 | 0 | case 5: |
4968 | | // BtnezT8CmpX16, BtnezT8CmpiX16, BtnezT8SltX16, BtnezT8SltiX16, BtnezT8S... |
4969 | 0 | SStream_concat0(O, "\n\tbtnez\t"); |
4970 | 0 | printOperand(MI, 2, O); |
4971 | 0 | return; |
4972 | 0 | break; |
4973 | 2.31k | case 6: |
4974 | | // COPY_S_B, COPY_S_D, COPY_S_H, COPY_S_W, COPY_U_B, COPY_U_D, COPY_U_H, ... |
4975 | 2.31k | SStream_concat0(O, "["); |
4976 | 2.31k | break; |
4977 | 0 | case 7: |
4978 | | // CmpiRxImm16, LiRxImm16, SltiRxImm16, SltiuRxImm16 |
4979 | 0 | SStream_concat0(O, " \t# 16 bit inst"); |
4980 | 0 | return; |
4981 | 0 | break; |
4982 | 0 | case 8: |
4983 | | // DSLL64_32 |
4984 | 0 | SStream_concat0(O, ", 32"); |
4985 | 0 | return; |
4986 | 0 | break; |
4987 | 0 | case 9: |
4988 | | // GotPrologue16 |
4989 | 0 | SStream_concat0(O, "\n\taddiu\t"); |
4990 | 0 | printOperand(MI, 1, O); |
4991 | 0 | SStream_concat0(O, ", $pc, "); |
4992 | 0 | printOperand(MI, 3, O); |
4993 | 0 | SStream_concat0(O, "\n "); |
4994 | 0 | return; |
4995 | 0 | break; |
4996 | 1.14k | case 10: |
4997 | | // LBUX, LDXC1, LDXC164, LHX, LUXC1, LUXC164, LUXC1_MM, LWX, LWXC1, LWXC1... |
4998 | 1.14k | SStream_concat0(O, "("); |
4999 | 1.14k | printOperand(MI, 1, O); |
5000 | 1.14k | SStream_concat0(O, ")"); |
5001 | 1.14k | return; |
5002 | 0 | break; |
5003 | 0 | case 11: |
5004 | | // LwRxSpImmX16, SwRxSpImmX16 |
5005 | 0 | SStream_concat0(O, " ( "); |
5006 | 0 | printOperand(MI, 1, O); |
5007 | 0 | SStream_concat0(O, " ); "); |
5008 | 0 | return; |
5009 | 0 | break; |
5010 | 0 | case 12: |
5011 | | // SLL64_32, SLL64_64 |
5012 | 0 | SStream_concat0(O, ", 0"); |
5013 | 0 | return; |
5014 | 0 | break; |
5015 | 0 | case 13: |
5016 | | // SelTBteqZCmp, SelTBteqZCmpi, SelTBteqZSlt, SelTBteqZSlti, SelTBteqZSlt... |
5017 | 0 | SStream_concat0(O, "\n\tbteqz\t.+4\n\tmove "); |
5018 | 0 | printOperand(MI, 1, O); |
5019 | 0 | SStream_concat0(O, ", "); |
5020 | 0 | printOperand(MI, 2, O); |
5021 | 0 | return; |
5022 | 0 | break; |
5023 | 0 | case 14: |
5024 | | // SelTBtneZCmp, SelTBtneZCmpi, SelTBtneZSlt, SelTBtneZSlti, SelTBtneZSlt... |
5025 | 0 | SStream_concat0(O, "\n\tbtnez\t.+4\n\tmove "); |
5026 | 0 | printOperand(MI, 1, O); |
5027 | 0 | SStream_concat0(O, ", "); |
5028 | 0 | printOperand(MI, 2, O); |
5029 | 0 | return; |
5030 | 0 | break; |
5031 | 51.6k | } |
5032 | | |
5033 | | |
5034 | | // Fragment 4 encoded into 3 bits for 5 unique commands. |
5035 | | //printf("Frag-4: %"PRIu64"\n", (Bits >> 31) & 7); |
5036 | 31.6k | switch ((Bits >> 31) & 7) { |
5037 | 0 | default: // llvm_unreachable("Invalid command number."); |
5038 | 18.6k | case 0: |
5039 | | // ADD, ADDIUR2_MM, ADDQH_PH, ADDQH_R_PH, ADDQH_R_W, ADDQH_W, ADDQ_PH, AD... |
5040 | 18.6k | printOperand(MI, 2, O); |
5041 | 18.6k | break; |
5042 | 1.85k | case 1: |
5043 | | // ADDVI_B, ADDVI_D, ADDVI_H, ADDVI_W, ANDI_B, BCLRI_B, BCLRI_D, BCLRI_H,... |
5044 | 1.85k | printUnsignedImm8(MI, 2, O); |
5045 | 1.85k | break; |
5046 | 8.98k | case 2: |
5047 | | // ANDi, ANDi64, ANDi_MM, APPEND, BALIGN, CINS, CINS32, DEXT, DEXTM, DEXT... |
5048 | 8.98k | printUnsignedImm(MI, 2, O); |
5049 | 8.98k | break; |
5050 | 709 | case 3: |
5051 | | // BINSLI_B, BINSLI_D, BINSLI_H, BINSLI_W, BINSRI_B, BINSRI_D, BINSRI_H, ... |
5052 | 709 | printUnsignedImm8(MI, 3, O); |
5053 | 709 | break; |
5054 | 1.43k | case 4: |
5055 | | // BINSL_B, BINSL_D, BINSL_H, BINSL_W, BINSR_B, BINSR_D, BINSR_H, BINSR_W... |
5056 | 1.43k | printOperand(MI, 3, O); |
5057 | 1.43k | break; |
5058 | 31.6k | } |
5059 | | |
5060 | | |
5061 | | // Fragment 5 encoded into 2 bits for 3 unique commands. |
5062 | | //printf("Frag-5: %"PRIu64"\n", (Bits >> 34) & 3); |
5063 | 31.6k | switch ((Bits >> 34) & 3) { |
5064 | 0 | default: // llvm_unreachable("Invalid command number."); |
5065 | 26.9k | case 0: |
5066 | | // ADD, ADDIUR2_MM, ADDQH_PH, ADDQH_R_PH, ADDQH_R_W, ADDQH_W, ADDQ_PH, AD... |
5067 | 26.9k | return; |
5068 | 0 | break; |
5069 | 2.34k | case 1: |
5070 | | // ALIGN, CINS, CINS32, DALIGN, DEXT, DEXTM, DEXTU, DINS, DINSM, DINSU, D... |
5071 | 2.34k | SStream_concat0(O, ", "); |
5072 | 2.34k | break; |
5073 | 2.31k | case 2: |
5074 | | // COPY_S_B, COPY_S_D, COPY_S_H, COPY_S_W, COPY_U_B, COPY_U_D, COPY_U_H, ... |
5075 | 2.31k | SStream_concat0(O, "]"); |
5076 | 2.31k | return; |
5077 | 0 | break; |
5078 | 31.6k | } |
5079 | | |
5080 | | |
5081 | | // Fragment 6 encoded into 1 bits for 2 unique commands. |
5082 | | //printf("Frag-6: %"PRIu64"\n", (Bits >> 36) & 1); |
5083 | 2.34k | if ((Bits >> 36) & 1) { |
5084 | | // DEXT, DEXTM, DEXTU, DINS, DINSM, DINSU, EXT, EXT_MM, INS, INS_MM, MADD... |
5085 | 1.48k | printOperand(MI, 3, O); |
5086 | 1.48k | return; |
5087 | 1.48k | } else { |
5088 | | // ALIGN, CINS, CINS32, DALIGN, DLSA, DLSA_R6, EXTS, EXTS32, LSA, LSA_R6 |
5089 | 859 | printUnsignedImm(MI, 3, O); |
5090 | 859 | return; |
5091 | 859 | } |
5092 | 2.34k | } |
5093 | | |
5094 | | |
5095 | | /// getRegisterName - This method is automatically generated by tblgen |
5096 | | /// from the register set description. This returns the assembler name |
5097 | | /// for the specified register. |
5098 | | static const char *getRegisterName(unsigned RegNo) |
5099 | 152k | { |
5100 | | // assert(RegNo && RegNo < 394 && "Invalid register number!"); |
5101 | | |
5102 | 152k | #ifndef CAPSTONE_DIET |
5103 | 152k | static const char AsmStrs[] = { |
5104 | 152k | /* 0 */ 'f', '1', '0', 0, |
5105 | 152k | /* 4 */ 'w', '1', '0', 0, |
5106 | 152k | /* 8 */ 'f', '2', '0', 0, |
5107 | 152k | /* 12 */ 'D', 'S', 'P', 'O', 'u', 't', 'F', 'l', 'a', 'g', '2', '0', 0, |
5108 | 152k | /* 25 */ 'w', '2', '0', 0, |
5109 | 152k | /* 29 */ 'f', '3', '0', 0, |
5110 | 152k | /* 33 */ 'w', '3', '0', 0, |
5111 | 152k | /* 37 */ 'a', '0', 0, |
5112 | 152k | /* 40 */ 'a', 'c', '0', 0, |
5113 | 152k | /* 44 */ 'f', 'c', 'c', '0', 0, |
5114 | 152k | /* 49 */ 'f', '0', 0, |
5115 | 152k | /* 52 */ 'k', '0', 0, |
5116 | 152k | /* 55 */ 'm', 'p', 'l', '0', 0, |
5117 | 152k | /* 60 */ 'p', '0', 0, |
5118 | 152k | /* 63 */ 's', '0', 0, |
5119 | 152k | /* 66 */ 't', '0', 0, |
5120 | 152k | /* 69 */ 'v', '0', 0, |
5121 | 152k | /* 72 */ 'w', '0', 0, |
5122 | 152k | /* 75 */ 'f', '1', '1', 0, |
5123 | 152k | /* 79 */ 'w', '1', '1', 0, |
5124 | 152k | /* 83 */ 'f', '2', '1', 0, |
5125 | 152k | /* 87 */ 'D', 'S', 'P', 'O', 'u', 't', 'F', 'l', 'a', 'g', '2', '1', 0, |
5126 | 152k | /* 100 */ 'w', '2', '1', 0, |
5127 | 152k | /* 104 */ 'f', '3', '1', 0, |
5128 | 152k | /* 108 */ 'w', '3', '1', 0, |
5129 | 152k | /* 112 */ 'a', '1', 0, |
5130 | 152k | /* 115 */ 'a', 'c', '1', 0, |
5131 | 152k | /* 119 */ 'f', 'c', 'c', '1', 0, |
5132 | 152k | /* 124 */ 'f', '1', 0, |
5133 | 152k | /* 127 */ 'k', '1', 0, |
5134 | 152k | /* 130 */ 'm', 'p', 'l', '1', 0, |
5135 | 152k | /* 135 */ 'p', '1', 0, |
5136 | 152k | /* 138 */ 's', '1', 0, |
5137 | 152k | /* 141 */ 't', '1', 0, |
5138 | 152k | /* 144 */ 'v', '1', 0, |
5139 | 152k | /* 147 */ 'w', '1', 0, |
5140 | 152k | /* 150 */ 'f', '1', '2', 0, |
5141 | 152k | /* 154 */ 'w', '1', '2', 0, |
5142 | 152k | /* 158 */ 'f', '2', '2', 0, |
5143 | 152k | /* 162 */ 'D', 'S', 'P', 'O', 'u', 't', 'F', 'l', 'a', 'g', '2', '2', 0, |
5144 | 152k | /* 175 */ 'w', '2', '2', 0, |
5145 | 152k | /* 179 */ 'a', '2', 0, |
5146 | 152k | /* 182 */ 'a', 'c', '2', 0, |
5147 | 152k | /* 186 */ 'f', 'c', 'c', '2', 0, |
5148 | 152k | /* 191 */ 'f', '2', 0, |
5149 | 152k | /* 194 */ 'm', 'p', 'l', '2', 0, |
5150 | 152k | /* 199 */ 'p', '2', 0, |
5151 | 152k | /* 202 */ 's', '2', 0, |
5152 | 152k | /* 205 */ 't', '2', 0, |
5153 | 152k | /* 208 */ 'w', '2', 0, |
5154 | 152k | /* 211 */ 'f', '1', '3', 0, |
5155 | 152k | /* 215 */ 'w', '1', '3', 0, |
5156 | 152k | /* 219 */ 'f', '2', '3', 0, |
5157 | 152k | /* 223 */ 'D', 'S', 'P', 'O', 'u', 't', 'F', 'l', 'a', 'g', '2', '3', 0, |
5158 | 152k | /* 236 */ 'w', '2', '3', 0, |
5159 | 152k | /* 240 */ 'a', '3', 0, |
5160 | 152k | /* 243 */ 'a', 'c', '3', 0, |
5161 | 152k | /* 247 */ 'f', 'c', 'c', '3', 0, |
5162 | 152k | /* 252 */ 'f', '3', 0, |
5163 | 152k | /* 255 */ 's', '3', 0, |
5164 | 152k | /* 258 */ 't', '3', 0, |
5165 | 152k | /* 261 */ 'w', '3', 0, |
5166 | 152k | /* 264 */ 'f', '1', '4', 0, |
5167 | 152k | /* 268 */ 'w', '1', '4', 0, |
5168 | 152k | /* 272 */ 'f', '2', '4', 0, |
5169 | 152k | /* 276 */ 'w', '2', '4', 0, |
5170 | 152k | /* 280 */ 'f', 'c', 'c', '4', 0, |
5171 | 152k | /* 285 */ 'f', '4', 0, |
5172 | 152k | /* 288 */ 's', '4', 0, |
5173 | 152k | /* 291 */ 't', '4', 0, |
5174 | 152k | /* 294 */ 'w', '4', 0, |
5175 | 152k | /* 297 */ 'f', '1', '5', 0, |
5176 | 152k | /* 301 */ 'w', '1', '5', 0, |
5177 | 152k | /* 305 */ 'f', '2', '5', 0, |
5178 | 152k | /* 309 */ 'w', '2', '5', 0, |
5179 | 152k | /* 313 */ 'f', 'c', 'c', '5', 0, |
5180 | 152k | /* 318 */ 'f', '5', 0, |
5181 | 152k | /* 321 */ 's', '5', 0, |
5182 | 152k | /* 324 */ 't', '5', 0, |
5183 | 152k | /* 327 */ 'w', '5', 0, |
5184 | 152k | /* 330 */ 'f', '1', '6', 0, |
5185 | 152k | /* 334 */ 'w', '1', '6', 0, |
5186 | 152k | /* 338 */ 'f', '2', '6', 0, |
5187 | 152k | /* 342 */ 'w', '2', '6', 0, |
5188 | 152k | /* 346 */ 'f', 'c', 'c', '6', 0, |
5189 | 152k | /* 351 */ 'f', '6', 0, |
5190 | 152k | /* 354 */ 's', '6', 0, |
5191 | 152k | /* 357 */ 't', '6', 0, |
5192 | 152k | /* 360 */ 'w', '6', 0, |
5193 | 152k | /* 363 */ 'f', '1', '7', 0, |
5194 | 152k | /* 367 */ 'w', '1', '7', 0, |
5195 | 152k | /* 371 */ 'f', '2', '7', 0, |
5196 | 152k | /* 375 */ 'w', '2', '7', 0, |
5197 | 152k | /* 379 */ 'f', 'c', 'c', '7', 0, |
5198 | 152k | /* 384 */ 'f', '7', 0, |
5199 | 152k | /* 387 */ 's', '7', 0, |
5200 | 152k | /* 390 */ 't', '7', 0, |
5201 | 152k | /* 393 */ 'w', '7', 0, |
5202 | 152k | /* 396 */ 'f', '1', '8', 0, |
5203 | 152k | /* 400 */ 'w', '1', '8', 0, |
5204 | 152k | /* 404 */ 'f', '2', '8', 0, |
5205 | 152k | /* 408 */ 'w', '2', '8', 0, |
5206 | 152k | /* 412 */ 'f', '8', 0, |
5207 | 152k | /* 415 */ 't', '8', 0, |
5208 | 152k | /* 418 */ 'w', '8', 0, |
5209 | 152k | /* 421 */ 'D', 'S', 'P', 'O', 'u', 't', 'F', 'l', 'a', 'g', '1', '6', '_', '1', '9', 0, |
5210 | 152k | /* 437 */ 'f', '1', '9', 0, |
5211 | 152k | /* 441 */ 'w', '1', '9', 0, |
5212 | 152k | /* 445 */ 'f', '2', '9', 0, |
5213 | 152k | /* 449 */ 'w', '2', '9', 0, |
5214 | 152k | /* 453 */ 'f', '9', 0, |
5215 | 152k | /* 456 */ 't', '9', 0, |
5216 | 152k | /* 459 */ 'w', '9', 0, |
5217 | 152k | /* 462 */ 'D', 'S', 'P', 'E', 'F', 'I', 0, |
5218 | 152k | /* 469 */ 'r', 'a', 0, |
5219 | 152k | /* 472 */ 'h', 'w', 'r', '_', 'c', 'c', 0, |
5220 | 152k | /* 479 */ 'p', 'c', 0, |
5221 | 152k | /* 482 */ 'D', 'S', 'P', 'C', 'C', 'o', 'n', 'd', 0, |
5222 | 152k | /* 491 */ 'D', 'S', 'P', 'O', 'u', 't', 'F', 'l', 'a', 'g', 0, |
5223 | 152k | /* 502 */ 'h', 'i', 0, |
5224 | 152k | /* 505 */ 'h', 'w', 'r', '_', 'c', 'p', 'u', 'n', 'u', 'm', 0, |
5225 | 152k | /* 516 */ 'l', 'o', 0, |
5226 | 152k | /* 519 */ 'z', 'e', 'r', 'o', 0, |
5227 | 152k | /* 524 */ 'h', 'w', 'r', '_', 's', 'y', 'n', 'c', 'i', '_', 's', 't', 'e', 'p', 0, |
5228 | 152k | /* 539 */ 'f', 'p', 0, |
5229 | 152k | /* 542 */ 'g', 'p', 0, |
5230 | 152k | /* 545 */ 's', 'p', 0, |
5231 | 152k | /* 548 */ 'h', 'w', 'r', '_', 'c', 'c', 'r', 'e', 's', 0, |
5232 | 152k | /* 558 */ 'D', 'S', 'P', 'P', 'o', 's', 0, |
5233 | 152k | /* 565 */ 'a', 't', 0, |
5234 | 152k | /* 568 */ 'D', 'S', 'P', 'S', 'C', 'o', 'u', 'n', 't', 0, |
5235 | 152k | /* 578 */ 'D', 'S', 'P', 'C', 'a', 'r', 'r', 'y', 0, |
5236 | 152k | }; |
5237 | | |
5238 | 152k | static const uint16_t RegAsmOffset[] = { |
5239 | 152k | 565, 482, 578, 462, 491, 558, 568, 539, 542, 152, 77, 2, 332, 266, |
5240 | 152k | 299, 213, 365, 479, 469, 545, 519, 37, 112, 179, 240, 40, 115, 182, |
5241 | 152k | 243, 565, 45, 120, 187, 248, 281, 314, 347, 380, 2, 77, 152, 213, |
5242 | 152k | 266, 299, 332, 365, 398, 435, 2, 77, 152, 213, 266, 299, 332, 365, |
5243 | 152k | 398, 435, 1, 76, 151, 212, 265, 298, 331, 364, 397, 434, 9, 84, |
5244 | 152k | 159, 220, 273, 306, 339, 372, 405, 446, 30, 105, 1, 76, 151, 212, |
5245 | 152k | 265, 298, 331, 364, 397, 434, 9, 84, 159, 220, 273, 306, 339, 372, |
5246 | 152k | 405, 446, 30, 105, 49, 191, 285, 351, 412, 0, 150, 264, 330, 396, |
5247 | 152k | 8, 158, 272, 338, 404, 29, 12, 87, 162, 223, 49, 124, 191, 252, |
5248 | 152k | 285, 318, 351, 384, 412, 453, 0, 75, 150, 211, 264, 297, 330, 363, |
5249 | 152k | 396, 437, 8, 83, 158, 219, 272, 305, 338, 371, 404, 445, 29, 104, |
5250 | 152k | 44, 119, 186, 247, 280, 313, 346, 379, 2, 77, 152, 213, 266, 299, |
5251 | 152k | 332, 365, 398, 435, 1, 76, 151, 212, 265, 298, 331, 364, 397, 434, |
5252 | 152k | 9, 84, 159, 220, 273, 306, 339, 372, 405, 446, 30, 105, 539, 49, |
5253 | 152k | 124, 191, 252, 285, 318, 351, 384, 412, 453, 0, 75, 150, 211, 264, |
5254 | 152k | 297, 330, 363, 396, 437, 8, 83, 158, 219, 272, 305, 338, 371, 404, |
5255 | 152k | 445, 29, 104, 542, 40, 115, 182, 243, 505, 524, 472, 548, 266, 299, |
5256 | 152k | 332, 365, 398, 435, 1, 76, 151, 212, 265, 298, 331, 364, 397, 434, |
5257 | 152k | 9, 84, 159, 220, 273, 306, 339, 372, 405, 446, 30, 105, 52, 127, |
5258 | 152k | 40, 115, 182, 243, 55, 130, 194, 60, 135, 199, 469, 63, 138, 202, |
5259 | 152k | 255, 288, 321, 354, 387, 545, 66, 141, 205, 258, 291, 324, 357, 390, |
5260 | 152k | 415, 456, 69, 144, 72, 147, 208, 261, 294, 327, 360, 393, 418, 459, |
5261 | 152k | 4, 79, 154, 215, 268, 301, 334, 367, 400, 441, 25, 100, 175, 236, |
5262 | 152k | 276, 309, 342, 375, 408, 449, 33, 108, 519, 37, 112, 179, 240, 40, |
5263 | 152k | 49, 124, 191, 252, 285, 318, 351, 384, 412, 453, 0, 75, 150, 211, |
5264 | 152k | 264, 297, 330, 363, 396, 437, 8, 83, 158, 219, 272, 305, 338, 371, |
5265 | 152k | 404, 445, 29, 104, 421, 502, 52, 127, 516, 63, 138, 202, 255, 288, |
5266 | 152k | 321, 354, 387, 66, 141, 205, 258, 291, 324, 357, 390, 415, 456, 69, |
5267 | 152k | 144, |
5268 | 152k | }; |
5269 | | |
5270 | | //printf("==== RegNo = %u, id = %s\n", RegNo, AsmStrs+RegAsmOffset[RegNo-1]); |
5271 | | //int i; |
5272 | | //for (i = 0; i < sizeof(RegAsmOffset)/2; i++) |
5273 | | // printf("%s = %u\n", AsmStrs+RegAsmOffset[i], i + 1); |
5274 | | //printf("-------------------------\n"); |
5275 | 152k | return AsmStrs+RegAsmOffset[RegNo-1]; |
5276 | | #else |
5277 | | return NULL; |
5278 | | #endif |
5279 | 152k | } |
5280 | | |
5281 | | #ifdef PRINT_ALIAS_INSTR |
5282 | | #undef PRINT_ALIAS_INSTR |
5283 | | |
5284 | | static void printCustomAliasOperand(MCInst *MI, unsigned OpIdx, |
5285 | | unsigned PrintMethodIdx, SStream *OS) |
5286 | 0 | { |
5287 | 0 | } |
5288 | | |
5289 | | static char *printAliasInstr(MCInst *MI, SStream *OS, void *info) |
5290 | 89.4k | { |
5291 | 89.4k | #define GETREGCLASS_CONTAIN(_class, _reg) MCRegisterClass_contains(MCRegisterInfo_getRegClass(MRI, _class), MCOperand_getReg(MCInst_getOperand(MI, _reg))) |
5292 | 89.4k | const char *AsmString; |
5293 | 89.4k | char *tmp, *AsmMnem, *AsmOps, *c; |
5294 | 89.4k | int OpIdx, PrintMethodIdx; |
5295 | 89.4k | MCRegisterInfo *MRI = (MCRegisterInfo *)info; |
5296 | 89.4k | switch (MCInst_getOpcode(MI)) { |
5297 | 73.1k | default: return NULL; |
5298 | 273 | case Mips_ADDu: |
5299 | 273 | if (MCInst_getNumOperands(MI) == 3 && |
5300 | 273 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
5301 | 273 | GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 0) && |
5302 | 273 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
5303 | 273 | GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 1) && |
5304 | 273 | MCOperand_getReg(MCInst_getOperand(MI, 2)) == Mips_ZERO) { |
5305 | | // (ADDu GPR32Opnd:$dst, GPR32Opnd:$src, ZERO) |
5306 | 204 | AsmString = "move $\x01, $\x02"; |
5307 | 204 | break; |
5308 | 204 | } |
5309 | 69 | return NULL; |
5310 | 1.24k | case Mips_BC0F: |
5311 | 1.24k | if (MCInst_getNumOperands(MI) == 2 && |
5312 | 1.24k | MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_CC0) { |
5313 | | // (BC0F CC0, brtarget:$offset) |
5314 | 1.05k | AsmString = "bc0f $\x02"; |
5315 | 1.05k | break; |
5316 | 1.05k | } |
5317 | 199 | return NULL; |
5318 | 263 | case Mips_BC0FL: |
5319 | 263 | if (MCInst_getNumOperands(MI) == 2 && |
5320 | 263 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_CC0) { |
5321 | | // (BC0FL CC0, brtarget:$offset) |
5322 | 195 | AsmString = "bc0fl $\x02"; |
5323 | 195 | break; |
5324 | 195 | } |
5325 | 68 | return NULL; |
5326 | 434 | case Mips_BC0T: |
5327 | 434 | if (MCInst_getNumOperands(MI) == 2 && |
5328 | 434 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_CC0) { |
5329 | | // (BC0T CC0, brtarget:$offset) |
5330 | 195 | AsmString = "bc0t $\x02"; |
5331 | 195 | break; |
5332 | 195 | } |
5333 | 239 | return NULL; |
5334 | 472 | case Mips_BC0TL: |
5335 | 472 | if (MCInst_getNumOperands(MI) == 2 && |
5336 | 472 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_CC0) { |
5337 | | // (BC0TL CC0, brtarget:$offset) |
5338 | 252 | AsmString = "bc0tl $\x02"; |
5339 | 252 | break; |
5340 | 252 | } |
5341 | 220 | return NULL; |
5342 | 218 | case Mips_BC1F: |
5343 | 218 | if (MCInst_getNumOperands(MI) == 2 && |
5344 | 218 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_FCC0) { |
5345 | | // (BC1F FCC0, brtarget:$offset) |
5346 | 68 | AsmString = "bc1f $\x02"; |
5347 | 68 | break; |
5348 | 68 | } |
5349 | 150 | return NULL; |
5350 | 277 | case Mips_BC1FL: |
5351 | 277 | if (MCInst_getNumOperands(MI) == 2 && |
5352 | 277 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_FCC0) { |
5353 | | // (BC1FL FCC0, brtarget:$offset) |
5354 | 68 | AsmString = "bc1fl $\x02"; |
5355 | 68 | break; |
5356 | 68 | } |
5357 | 209 | return NULL; |
5358 | 152 | case Mips_BC1T: |
5359 | 152 | if (MCInst_getNumOperands(MI) == 2 && |
5360 | 152 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_FCC0) { |
5361 | | // (BC1T FCC0, brtarget:$offset) |
5362 | 78 | AsmString = "bc1t $\x02"; |
5363 | 78 | break; |
5364 | 78 | } |
5365 | 74 | return NULL; |
5366 | 304 | case Mips_BC1TL: |
5367 | 304 | if (MCInst_getNumOperands(MI) == 2 && |
5368 | 304 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_FCC0) { |
5369 | | // (BC1TL FCC0, brtarget:$offset) |
5370 | 70 | AsmString = "bc1tl $\x02"; |
5371 | 70 | break; |
5372 | 70 | } |
5373 | 234 | return NULL; |
5374 | 412 | case Mips_BC2F: |
5375 | 412 | if (MCInst_getNumOperands(MI) == 2 && |
5376 | 412 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_CC0) { |
5377 | | // (BC2F CC0, brtarget:$offset) |
5378 | 69 | AsmString = "bc2f $\x02"; |
5379 | 69 | break; |
5380 | 69 | } |
5381 | 343 | return NULL; |
5382 | 61 | case Mips_BC2FL: |
5383 | 61 | if (MCInst_getNumOperands(MI) == 2 && |
5384 | 61 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_CC0) { |
5385 | | // (BC2FL CC0, brtarget:$offset) |
5386 | 35 | AsmString = "bc2fl $\x02"; |
5387 | 35 | break; |
5388 | 35 | } |
5389 | 26 | return NULL; |
5390 | 138 | case Mips_BC2T: |
5391 | 138 | if (MCInst_getNumOperands(MI) == 2 && |
5392 | 138 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_CC0) { |
5393 | | // (BC2T CC0, brtarget:$offset) |
5394 | 71 | AsmString = "bc2t $\x02"; |
5395 | 71 | break; |
5396 | 71 | } |
5397 | 67 | return NULL; |
5398 | 149 | case Mips_BC2TL: |
5399 | 149 | if (MCInst_getNumOperands(MI) == 2 && |
5400 | 149 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_CC0) { |
5401 | | // (BC2TL CC0, brtarget:$offset) |
5402 | 82 | AsmString = "bc2tl $\x02"; |
5403 | 82 | break; |
5404 | 82 | } |
5405 | 67 | return NULL; |
5406 | 342 | case Mips_BC3F: |
5407 | 342 | if (MCInst_getNumOperands(MI) == 2 && |
5408 | 342 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_CC0) { |
5409 | | // (BC3F CC0, brtarget:$offset) |
5410 | 121 | AsmString = "bc3f $\x02"; |
5411 | 121 | break; |
5412 | 121 | } |
5413 | 221 | return NULL; |
5414 | 143 | case Mips_BC3FL: |
5415 | 143 | if (MCInst_getNumOperands(MI) == 2 && |
5416 | 143 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_CC0) { |
5417 | | // (BC3FL CC0, brtarget:$offset) |
5418 | 70 | AsmString = "bc3fl $\x02"; |
5419 | 70 | break; |
5420 | 70 | } |
5421 | 73 | return NULL; |
5422 | 205 | case Mips_BC3T: |
5423 | 205 | if (MCInst_getNumOperands(MI) == 2 && |
5424 | 205 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_CC0) { |
5425 | | // (BC3T CC0, brtarget:$offset) |
5426 | 76 | AsmString = "bc3t $\x02"; |
5427 | 76 | break; |
5428 | 76 | } |
5429 | 129 | return NULL; |
5430 | 285 | case Mips_BC3TL: |
5431 | 285 | if (MCInst_getNumOperands(MI) == 2 && |
5432 | 285 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_CC0) { |
5433 | | // (BC3TL CC0, brtarget:$offset) |
5434 | 79 | AsmString = "bc3tl $\x02"; |
5435 | 79 | break; |
5436 | 79 | } |
5437 | 206 | return NULL; |
5438 | 904 | case Mips_BREAK: |
5439 | 904 | if (MCInst_getNumOperands(MI) == 2 && |
5440 | 904 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
5441 | 904 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0 && |
5442 | 904 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
5443 | 904 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 0) { |
5444 | | // (BREAK 0, 0) |
5445 | 74 | AsmString = "break"; |
5446 | 74 | break; |
5447 | 74 | } |
5448 | 830 | if (MCInst_getNumOperands(MI) == 2 && |
5449 | 830 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
5450 | 830 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 0) { |
5451 | | // (BREAK uimm10:$imm, 0) |
5452 | 275 | AsmString = "break $\x01"; |
5453 | 275 | break; |
5454 | 275 | } |
5455 | 555 | return NULL; |
5456 | 159 | case Mips_DADDu: |
5457 | 159 | if (MCInst_getNumOperands(MI) == 3 && |
5458 | 159 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
5459 | 159 | GETREGCLASS_CONTAIN(Mips_GPR64RegClassID, 0) && |
5460 | 159 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
5461 | 159 | GETREGCLASS_CONTAIN(Mips_GPR64RegClassID, 1) && |
5462 | 159 | MCOperand_getReg(MCInst_getOperand(MI, 2)) == Mips_ZERO_64) { |
5463 | | // (DADDu GPR64Opnd:$dst, GPR64Opnd:$src, ZERO_64) |
5464 | 82 | AsmString = "move $\x01, $\x02"; |
5465 | 82 | break; |
5466 | 82 | } |
5467 | 77 | return NULL; |
5468 | 118 | case Mips_DI: |
5469 | 118 | if (MCInst_getNumOperands(MI) == 1 && |
5470 | 118 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_ZERO) { |
5471 | | // (DI ZERO) |
5472 | 77 | AsmString = "di"; |
5473 | 77 | break; |
5474 | 77 | } |
5475 | 41 | return NULL; |
5476 | 68 | case Mips_EI: |
5477 | 68 | if (MCInst_getNumOperands(MI) == 1 && |
5478 | 68 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_ZERO) { |
5479 | | // (EI ZERO) |
5480 | 34 | AsmString = "ei"; |
5481 | 34 | break; |
5482 | 34 | } |
5483 | 34 | return NULL; |
5484 | 302 | case Mips_JALR: |
5485 | 302 | if (MCInst_getNumOperands(MI) == 2 && |
5486 | 302 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_ZERO && |
5487 | 302 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
5488 | 302 | GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 1)) { |
5489 | | // (JALR ZERO, GPR32Opnd:$rs) |
5490 | 75 | AsmString = "jr $\x02"; |
5491 | 75 | break; |
5492 | 75 | } |
5493 | 227 | return NULL; |
5494 | 0 | case Mips_JALR64: |
5495 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
5496 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_ZERO_64 && |
5497 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
5498 | 0 | GETREGCLASS_CONTAIN(Mips_GPR64RegClassID, 1)) { |
5499 | | // (JALR64 ZERO_64, GPR64Opnd:$rs) |
5500 | 0 | AsmString = "jr $\x02"; |
5501 | 0 | break; |
5502 | 0 | } |
5503 | 0 | return NULL; |
5504 | 102 | case Mips_JALR_HB: |
5505 | 102 | if (MCInst_getNumOperands(MI) == 2 && |
5506 | 102 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_RA && |
5507 | 102 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
5508 | 102 | GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 1)) { |
5509 | | // (JALR_HB RA, GPR32Opnd:$rs) |
5510 | 35 | AsmString = "jalr.hb $\x02"; |
5511 | 35 | break; |
5512 | 35 | } |
5513 | 67 | return NULL; |
5514 | 979 | case Mips_MOVE16_MM: |
5515 | 979 | if (MCInst_getNumOperands(MI) == 2 && |
5516 | 979 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_ZERO && |
5517 | 979 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == Mips_ZERO) { |
5518 | | // (MOVE16_MM ZERO, ZERO) |
5519 | 205 | AsmString = "nop"; |
5520 | 205 | break; |
5521 | 205 | } |
5522 | 774 | return NULL; |
5523 | 118 | case Mips_SDBBP: |
5524 | 118 | if (MCInst_getNumOperands(MI) == 1 && |
5525 | 118 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
5526 | 118 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0) { |
5527 | | // (SDBBP 0) |
5528 | 34 | AsmString = "sdbbp"; |
5529 | 34 | break; |
5530 | 34 | } |
5531 | 84 | return NULL; |
5532 | 330 | case Mips_SDBBP_R6: |
5533 | 330 | if (MCInst_getNumOperands(MI) == 1 && |
5534 | 330 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
5535 | 330 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0) { |
5536 | | // (SDBBP_R6 0) |
5537 | 256 | AsmString = "sdbbp"; |
5538 | 256 | break; |
5539 | 256 | } |
5540 | 74 | return NULL; |
5541 | 2.54k | case Mips_SLL: |
5542 | 2.54k | if (MCInst_getNumOperands(MI) == 3 && |
5543 | 2.54k | MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_ZERO && |
5544 | 2.54k | MCOperand_getReg(MCInst_getOperand(MI, 1)) == Mips_ZERO && |
5545 | 2.54k | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
5546 | 2.54k | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
5547 | | // (SLL ZERO, ZERO, 0) |
5548 | 1.56k | AsmString = "nop"; |
5549 | 1.56k | break; |
5550 | 1.56k | } |
5551 | 981 | return NULL; |
5552 | 1.06k | case Mips_SLL_MM: |
5553 | 1.06k | if (MCInst_getNumOperands(MI) == 3 && |
5554 | 1.06k | MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_ZERO && |
5555 | 1.06k | MCOperand_getReg(MCInst_getOperand(MI, 1)) == Mips_ZERO && |
5556 | 1.06k | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
5557 | 1.06k | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
5558 | | // (SLL_MM ZERO, ZERO, 0) |
5559 | 303 | AsmString = "nop"; |
5560 | 303 | break; |
5561 | 303 | } |
5562 | 765 | return NULL; |
5563 | 243 | case Mips_SUB: |
5564 | 243 | if (MCInst_getNumOperands(MI) == 3 && |
5565 | 243 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
5566 | 243 | GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 0) && |
5567 | 243 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == Mips_ZERO && |
5568 | 243 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
5569 | 243 | GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 2)) { |
5570 | | // (SUB GPR32Opnd:$rt, ZERO, GPR32Opnd:$rs) |
5571 | 39 | AsmString = "neg $\x01, $\x03"; |
5572 | 39 | break; |
5573 | 39 | } |
5574 | 204 | return NULL; |
5575 | 138 | case Mips_SUBu: |
5576 | 138 | if (MCInst_getNumOperands(MI) == 3 && |
5577 | 138 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
5578 | 138 | GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 0) && |
5579 | 138 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == Mips_ZERO && |
5580 | 138 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
5581 | 138 | GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 2)) { |
5582 | | // (SUBu GPR32Opnd:$rt, ZERO, GPR32Opnd:$rs) |
5583 | 68 | AsmString = "negu $\x01, $\x03"; |
5584 | 68 | break; |
5585 | 68 | } |
5586 | 70 | return NULL; |
5587 | 293 | case Mips_SYNC: |
5588 | 293 | if (MCInst_getNumOperands(MI) == 1 && |
5589 | 293 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
5590 | 293 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0) { |
5591 | | // (SYNC 0) |
5592 | 84 | AsmString = "sync"; |
5593 | 84 | break; |
5594 | 84 | } |
5595 | 209 | return NULL; |
5596 | 209 | case Mips_SYSCALL: |
5597 | 209 | if (MCInst_getNumOperands(MI) == 1 && |
5598 | 209 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
5599 | 209 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0) { |
5600 | | // (SYSCALL 0) |
5601 | 90 | AsmString = "syscall"; |
5602 | 90 | break; |
5603 | 90 | } |
5604 | 119 | return NULL; |
5605 | 439 | case Mips_TEQ: |
5606 | 439 | if (MCInst_getNumOperands(MI) == 3 && |
5607 | 439 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
5608 | 439 | GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 0) && |
5609 | 439 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
5610 | 439 | GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 1) && |
5611 | 439 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
5612 | 439 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
5613 | | // (TEQ GPR32Opnd:$rs, GPR32Opnd:$rt, 0) |
5614 | 143 | AsmString = "teq $\x01, $\x02"; |
5615 | 143 | break; |
5616 | 143 | } |
5617 | 296 | return NULL; |
5618 | 426 | case Mips_TGE: |
5619 | 426 | if (MCInst_getNumOperands(MI) == 3 && |
5620 | 426 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
5621 | 426 | GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 0) && |
5622 | 426 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
5623 | 426 | GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 1) && |
5624 | 426 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
5625 | 426 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
5626 | | // (TGE GPR32Opnd:$rs, GPR32Opnd:$rt, 0) |
5627 | 314 | AsmString = "tge $\x01, $\x02"; |
5628 | 314 | break; |
5629 | 314 | } |
5630 | 112 | return NULL; |
5631 | 718 | case Mips_TGEU: |
5632 | 718 | if (MCInst_getNumOperands(MI) == 3 && |
5633 | 718 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
5634 | 718 | GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 0) && |
5635 | 718 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
5636 | 718 | GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 1) && |
5637 | 718 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
5638 | 718 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
5639 | | // (TGEU GPR32Opnd:$rs, GPR32Opnd:$rt, 0) |
5640 | 472 | AsmString = "tgeu $\x01, $\x02"; |
5641 | 472 | break; |
5642 | 472 | } |
5643 | 246 | return NULL; |
5644 | 688 | case Mips_TLT: |
5645 | 688 | if (MCInst_getNumOperands(MI) == 3 && |
5646 | 688 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
5647 | 688 | GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 0) && |
5648 | 688 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
5649 | 688 | GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 1) && |
5650 | 688 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
5651 | 688 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
5652 | | // (TLT GPR32Opnd:$rs, GPR32Opnd:$rt, 0) |
5653 | 443 | AsmString = "tlt $\x01, $\x02"; |
5654 | 443 | break; |
5655 | 443 | } |
5656 | 245 | return NULL; |
5657 | 365 | case Mips_TLTU: |
5658 | 365 | if (MCInst_getNumOperands(MI) == 3 && |
5659 | 365 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
5660 | 365 | GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 0) && |
5661 | 365 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
5662 | 365 | GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 1) && |
5663 | 365 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
5664 | 365 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
5665 | | // (TLTU GPR32Opnd:$rs, GPR32Opnd:$rt, 0) |
5666 | 112 | AsmString = "tltu $\x01, $\x02"; |
5667 | 112 | break; |
5668 | 112 | } |
5669 | 253 | return NULL; |
5670 | 107 | case Mips_TNE: |
5671 | 107 | if (MCInst_getNumOperands(MI) == 3 && |
5672 | 107 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
5673 | 107 | GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 0) && |
5674 | 107 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
5675 | 107 | GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 1) && |
5676 | 107 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
5677 | 107 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
5678 | | // (TNE GPR32Opnd:$rs, GPR32Opnd:$rt, 0) |
5679 | 34 | AsmString = "tne $\x01, $\x02"; |
5680 | 34 | break; |
5681 | 34 | } |
5682 | 73 | return NULL; |
5683 | 638 | case Mips_WAIT_MM: |
5684 | 638 | if (MCInst_getNumOperands(MI) == 1 && |
5685 | 638 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
5686 | 638 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0) { |
5687 | | // (WAIT_MM 0) |
5688 | 421 | AsmString = "wait"; |
5689 | 421 | break; |
5690 | 421 | } |
5691 | 217 | return NULL; |
5692 | 89.4k | } |
5693 | | |
5694 | 8.02k | tmp = cs_strdup(AsmString); |
5695 | 8.02k | AsmMnem = tmp; |
5696 | 38.5k | for(AsmOps = tmp; *AsmOps; AsmOps++) { |
5697 | 35.4k | if (*AsmOps == ' ' || *AsmOps == '\t') { |
5698 | 4.87k | *AsmOps = '\0'; |
5699 | 4.87k | AsmOps++; |
5700 | 4.87k | break; |
5701 | 4.87k | } |
5702 | 35.4k | } |
5703 | 8.02k | SStream_concat0(OS, AsmMnem); |
5704 | 8.02k | if (*AsmOps) { |
5705 | 4.87k | SStream_concat0(OS, "\t"); |
5706 | 15.4k | for (c = AsmOps; *c; c++) { |
5707 | 10.6k | if (*c == '$') { |
5708 | 6.78k | c += 1; |
5709 | 6.78k | if (*c == (char)0xff) { |
5710 | 0 | c += 1; |
5711 | 0 | OpIdx = *c - 1; |
5712 | 0 | c += 1; |
5713 | 0 | PrintMethodIdx = *c - 1; |
5714 | 0 | printCustomAliasOperand(MI, OpIdx, PrintMethodIdx, OS); |
5715 | 0 | } else |
5716 | 6.78k | printOperand(MI, *c - 1, OS); |
5717 | 6.78k | } else { |
5718 | 3.82k | SStream_concat(OS, "%c", *c); |
5719 | 3.82k | } |
5720 | 10.6k | } |
5721 | 4.87k | } |
5722 | 8.02k | return tmp; |
5723 | 89.4k | } |
5724 | | |
5725 | | #endif // PRINT_ALIAS_INSTR |