/src/capstonev5/arch/PowerPC/PPCGenAsmWriter.inc
Line | Count | Source (jump to first uncovered line) |
1 | | /* Capstone Disassembly Engine, http://www.capstone-engine.org */ |
2 | | /* By Nguyen Anh Quynh <aquynh@gmail.com>, 2013-2019 */ |
3 | | |
4 | | /*===- TableGen'erated file -------------------------------------*- C++ -*-===*\ |
5 | | |* *| |
6 | | |* Assembly Writer Source Fragment *| |
7 | | |* *| |
8 | | |* Automatically generated file, do not edit! *| |
9 | | |* *| |
10 | | \*===----------------------------------------------------------------------===*/ |
11 | | |
12 | | /// printInstruction - This method is automatically generated by tablegen |
13 | | /// from the instruction set description. |
14 | | static void printInstruction(MCInst *MI, SStream *O) |
15 | 71.4k | { |
16 | 71.4k | #ifndef CAPSTONE_DIET |
17 | 71.4k | static const char AsmStrs[] = { |
18 | 71.4k | /* 0 */ '#', 'E', 'H', '_', 'S', 'j', 'L', 'j', '_', 'S', 'e', 't', 'u', 'p', 9, 0, |
19 | 71.4k | /* 16 */ 'b', 'd', 'z', 'l', 'a', '+', 32, 0, |
20 | 71.4k | /* 24 */ 'b', 'd', 'n', 'z', 'l', 'a', '+', 32, 0, |
21 | 71.4k | /* 33 */ 'b', 'd', 'z', 'a', '+', 32, 0, |
22 | 71.4k | /* 40 */ 'b', 'd', 'n', 'z', 'a', '+', 32, 0, |
23 | 71.4k | /* 48 */ 'b', 'd', 'z', 'l', '+', 32, 0, |
24 | 71.4k | /* 55 */ 'b', 'd', 'n', 'z', 'l', '+', 32, 0, |
25 | 71.4k | /* 63 */ 'b', 'd', 'z', '+', 32, 0, |
26 | 71.4k | /* 69 */ 'b', 'd', 'n', 'z', '+', 32, 0, |
27 | 71.4k | /* 76 */ 'b', 'c', 'l', 32, '2', '0', ',', 32, '3', '1', ',', 32, 0, |
28 | 71.4k | /* 89 */ 'b', 'c', 't', 'r', 'l', 10, 9, 'l', 'd', 32, '2', ',', 32, 0, |
29 | 71.4k | /* 103 */ 'b', 'c', 32, '1', '2', ',', 32, 0, |
30 | 71.4k | /* 111 */ 'b', 'c', 'l', 32, '1', '2', ',', 32, 0, |
31 | 71.4k | /* 120 */ 'b', 'c', 'l', 'r', 'l', 32, '1', '2', ',', 32, 0, |
32 | 71.4k | /* 131 */ 'b', 'c', 'c', 't', 'r', 'l', 32, '1', '2', ',', 32, 0, |
33 | 71.4k | /* 143 */ 'b', 'c', 'l', 'r', 32, '1', '2', ',', 32, 0, |
34 | 71.4k | /* 153 */ 'b', 'c', 'c', 't', 'r', 32, '1', '2', ',', 32, 0, |
35 | 71.4k | /* 164 */ 'b', 'c', 32, '4', ',', 32, 0, |
36 | 71.4k | /* 171 */ 'b', 'c', 'l', 32, '4', ',', 32, 0, |
37 | 71.4k | /* 179 */ 'b', 'c', 'l', 'r', 'l', 32, '4', ',', 32, 0, |
38 | 71.4k | /* 189 */ 'b', 'c', 'c', 't', 'r', 'l', 32, '4', ',', 32, 0, |
39 | 71.4k | /* 200 */ 'b', 'c', 'l', 'r', 32, '4', ',', 32, 0, |
40 | 71.4k | /* 209 */ 'b', 'c', 'c', 't', 'r', 32, '4', ',', 32, 0, |
41 | 71.4k | /* 219 */ 'm', 't', 's', 'p', 'r', 32, '2', '5', '6', ',', 32, 0, |
42 | 71.4k | /* 231 */ 'b', 'd', 'z', 'l', 'a', '-', 32, 0, |
43 | 71.4k | /* 239 */ 'b', 'd', 'n', 'z', 'l', 'a', '-', 32, 0, |
44 | 71.4k | /* 248 */ 'b', 'd', 'z', 'a', '-', 32, 0, |
45 | 71.4k | /* 255 */ 'b', 'd', 'n', 'z', 'a', '-', 32, 0, |
46 | 71.4k | /* 263 */ 'b', 'd', 'z', 'l', '-', 32, 0, |
47 | 71.4k | /* 270 */ 'b', 'd', 'n', 'z', 'l', '-', 32, 0, |
48 | 71.4k | /* 278 */ 'b', 'd', 'z', '-', 32, 0, |
49 | 71.4k | /* 284 */ 'b', 'd', 'n', 'z', '-', 32, 0, |
50 | 71.4k | /* 291 */ 'p', 's', '_', 'm', 'e', 'r', 'g', 'e', '0', '0', '.', 32, 0, |
51 | 71.4k | /* 304 */ 'p', 's', '_', 'm', 'e', 'r', 'g', 'e', '1', '0', '.', 32, 0, |
52 | 71.4k | /* 317 */ 'p', 's', '_', 's', 'u', 'm', '0', '.', 32, 0, |
53 | 71.4k | /* 327 */ 'p', 's', '_', 'm', 'a', 'd', 'd', 's', '0', '.', 32, 0, |
54 | 71.4k | /* 339 */ 'p', 's', '_', 'm', 'u', 'l', 's', '0', '.', 32, 0, |
55 | 71.4k | /* 350 */ 'p', 's', '_', 'm', 'e', 'r', 'g', 'e', '0', '1', '.', 32, 0, |
56 | 71.4k | /* 363 */ 'p', 's', '_', 'm', 'e', 'r', 'g', 'e', '1', '1', '.', 32, 0, |
57 | 71.4k | /* 376 */ 'p', 's', '_', 's', 'u', 'm', '1', '.', 32, 0, |
58 | 71.4k | /* 386 */ 'p', 's', '_', 'm', 'a', 'd', 'd', 's', '1', '.', 32, 0, |
59 | 71.4k | /* 398 */ 'p', 's', '_', 'm', 'u', 'l', 's', '1', '.', 32, 0, |
60 | 71.4k | /* 409 */ 'v', 'c', 'm', 'p', 'n', 'e', 'b', '.', 32, 0, |
61 | 71.4k | /* 419 */ 'v', 'c', 'm', 'p', 'g', 't', 's', 'b', '.', 32, 0, |
62 | 71.4k | /* 430 */ 'e', 'x', 't', 's', 'b', '.', 32, 0, |
63 | 71.4k | /* 438 */ 'v', 'c', 'm', 'p', 'e', 'q', 'u', 'b', '.', 32, 0, |
64 | 71.4k | /* 449 */ 'p', 's', '_', 's', 'u', 'b', '.', 32, 0, |
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67 | 71.4k | /* 475 */ 'f', 'm', 's', 'u', 'b', '.', 32, 0, |
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69 | 71.4k | /* 494 */ 'f', 'n', 'm', 's', 'u', 'b', '.', 32, 0, |
70 | 71.4k | /* 503 */ 'v', 'c', 'm', 'p', 'g', 't', 'u', 'b', '.', 32, 0, |
71 | 71.4k | /* 514 */ 'v', 'c', 'm', 'p', 'n', 'e', 'z', 'b', '.', 32, 0, |
72 | 71.4k | /* 525 */ 'a', 'd', 'd', 'c', '.', 32, 0, |
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75 | 71.4k | /* 550 */ 's', 'u', 'b', 'f', 'c', '.', 32, 0, |
76 | 71.4k | /* 558 */ 's', 'u', 'b', 'i', 'c', '.', 32, 0, |
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80 | 71.4k | /* 593 */ 'b', 'c', 'd', 'u', 't', 'r', 'u', 'n', 'c', '.', 32, 0, |
81 | 71.4k | /* 605 */ 'o', 'r', 'c', '.', 32, 0, |
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83 | 71.4k | /* 622 */ 's', 'r', 'a', 'd', '.', 32, 0, |
84 | 71.4k | /* 629 */ 'p', 's', '_', 'a', 'd', 'd', '.', 32, 0, |
85 | 71.4k | /* 638 */ 'f', 'a', 'd', 'd', '.', 32, 0, |
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87 | 71.4k | /* 655 */ 'f', 'm', 'a', 'd', 'd', '.', 32, 0, |
88 | 71.4k | /* 663 */ 'p', 's', '_', 'n', 'm', 'a', 'd', 'd', '.', 32, 0, |
89 | 71.4k | /* 674 */ 'f', 'n', 'm', 'a', 'd', 'd', '.', 32, 0, |
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91 | 71.4k | /* 691 */ 'f', 'c', 'f', 'i', 'd', '.', 32, 0, |
92 | 71.4k | /* 699 */ 'f', 'c', 't', 'i', 'd', '.', 32, 0, |
93 | 71.4k | /* 707 */ 'm', 'u', 'l', 'l', 'd', '.', 32, 0, |
94 | 71.4k | /* 715 */ 's', 'l', 'd', '.', 32, 0, |
95 | 71.4k | /* 721 */ 'n', 'a', 'n', 'd', '.', 32, 0, |
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98 | 71.4k | /* 741 */ 'v', 'c', 'm', 'p', 'g', 't', 's', 'd', '.', 32, 0, |
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100 | 71.4k | /* 763 */ 'v', 'c', 'm', 'p', 'g', 't', 'u', 'd', '.', 32, 0, |
101 | 71.4k | /* 774 */ 'd', 'i', 'v', 'd', '.', 32, 0, |
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104 | 71.4k | /* 799 */ 'a', 'd', 'd', 'e', '.', 32, 0, |
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109 | 71.4k | /* 839 */ 'f', 'r', 'e', '.', 32, 0, |
110 | 71.4k | /* 845 */ 'p', 's', '_', 'r', 's', 'q', 'r', 't', 'e', '.', 32, 0, |
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112 | 71.4k | /* 867 */ 'p', 'a', 's', 't', 'e', '.', 32, 0, |
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144 | 71.4k | /* 1163 */ 'c', 'l', 'r', 'r', 'w', 'i', '.', 32, 0, |
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155 | 71.4k | /* 1259 */ 'f', 'r', 'i', 'm', '.', 32, 0, |
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157 | 71.4k | /* 1275 */ 'r', 'l', 'w', 'n', 'm', '.', 32, 0, |
158 | 71.4k | /* 1283 */ 'b', 'c', 'd', 'c', 'f', 'n', '.', 32, 0, |
159 | 71.4k | /* 1292 */ 'b', 'c', 'd', 'c', 'p', 's', 'g', 'n', '.', 32, 0, |
160 | 71.4k | /* 1303 */ 'f', 'c', 'p', 's', 'g', 'n', '.', 32, 0, |
161 | 71.4k | /* 1312 */ 'b', 'c', 'd', 's', 'e', 't', 's', 'g', 'n', '.', 32, 0, |
162 | 71.4k | /* 1324 */ 't', 'b', 'e', 'g', 'i', 'n', '.', 32, 0, |
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169 | 71.4k | /* 1395 */ 'v', 'c', 'm', 'p', 'g', 'e', 'f', 'p', '.', 32, 0, |
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1686 | | |
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1750 | 71.4k | 0U, // G_ATOMICRMW_ADD |
1751 | 71.4k | 0U, // G_ATOMICRMW_SUB |
1752 | 71.4k | 0U, // G_ATOMICRMW_AND |
1753 | 71.4k | 0U, // G_ATOMICRMW_NAND |
1754 | 71.4k | 0U, // G_ATOMICRMW_OR |
1755 | 71.4k | 0U, // G_ATOMICRMW_XOR |
1756 | 71.4k | 0U, // G_ATOMICRMW_MAX |
1757 | 71.4k | 0U, // G_ATOMICRMW_MIN |
1758 | 71.4k | 0U, // G_ATOMICRMW_UMAX |
1759 | 71.4k | 0U, // G_ATOMICRMW_UMIN |
1760 | 71.4k | 0U, // G_BRCOND |
1761 | 71.4k | 0U, // G_BRINDIRECT |
1762 | 71.4k | 0U, // G_INTRINSIC |
1763 | 71.4k | 0U, // G_INTRINSIC_W_SIDE_EFFECTS |
1764 | 71.4k | 0U, // G_ANYEXT |
1765 | 71.4k | 0U, // G_TRUNC |
1766 | 71.4k | 0U, // G_CONSTANT |
1767 | 71.4k | 0U, // G_FCONSTANT |
1768 | 71.4k | 0U, // G_VASTART |
1769 | 71.4k | 0U, // G_VAARG |
1770 | 71.4k | 0U, // G_SEXT |
1771 | 71.4k | 0U, // G_ZEXT |
1772 | 71.4k | 0U, // G_SHL |
1773 | 71.4k | 0U, // G_LSHR |
1774 | 71.4k | 0U, // G_ASHR |
1775 | 71.4k | 0U, // G_ICMP |
1776 | 71.4k | 0U, // G_FCMP |
1777 | 71.4k | 0U, // G_SELECT |
1778 | 71.4k | 0U, // G_UADDE |
1779 | 71.4k | 0U, // G_USUBE |
1780 | 71.4k | 0U, // G_SADDO |
1781 | 71.4k | 0U, // G_SSUBO |
1782 | 71.4k | 0U, // G_UMULO |
1783 | 71.4k | 0U, // G_SMULO |
1784 | 71.4k | 0U, // G_UMULH |
1785 | 71.4k | 0U, // G_SMULH |
1786 | 71.4k | 0U, // G_FADD |
1787 | 71.4k | 0U, // G_FSUB |
1788 | 71.4k | 0U, // G_FMUL |
1789 | 71.4k | 0U, // G_FMA |
1790 | 71.4k | 0U, // G_FDIV |
1791 | 71.4k | 0U, // G_FREM |
1792 | 71.4k | 0U, // G_FPOW |
1793 | 71.4k | 0U, // G_FEXP |
1794 | 71.4k | 0U, // G_FEXP2 |
1795 | 71.4k | 0U, // G_FLOG |
1796 | 71.4k | 0U, // G_FLOG2 |
1797 | 71.4k | 0U, // G_FNEG |
1798 | 71.4k | 0U, // G_FPEXT |
1799 | 71.4k | 0U, // G_FPTRUNC |
1800 | 71.4k | 0U, // G_FPTOSI |
1801 | 71.4k | 0U, // G_FPTOUI |
1802 | 71.4k | 0U, // G_SITOFP |
1803 | 71.4k | 0U, // G_UITOFP |
1804 | 71.4k | 0U, // G_FABS |
1805 | 71.4k | 0U, // G_GEP |
1806 | 71.4k | 0U, // G_PTR_MASK |
1807 | 71.4k | 0U, // G_BR |
1808 | 71.4k | 0U, // G_INSERT_VECTOR_ELT |
1809 | 71.4k | 0U, // G_EXTRACT_VECTOR_ELT |
1810 | 71.4k | 0U, // G_SHUFFLE_VECTOR |
1811 | 71.4k | 0U, // G_BSWAP |
1812 | 71.4k | 0U, // G_ADDRSPACE_CAST |
1813 | 71.4k | 0U, // G_BLOCK_ADDR |
1814 | 71.4k | 14702U, // CFENCE8 |
1815 | 71.4k | 21525U, // CLRLSLDI |
1816 | 71.4k | 17410U, // CLRLSLDIo |
1817 | 71.4k | 22034U, // CLRLSLWI |
1818 | 71.4k | 17519U, // CLRLSLWIo |
1819 | 71.4k | 21560U, // CLRRDI |
1820 | 71.4k | 17437U, // CLRRDIo |
1821 | 71.4k | 22075U, // CLRRWI |
1822 | 71.4k | 17548U, // CLRRWIo |
1823 | 71.4k | 536897663U, // CP_COPY_FIRST |
1824 | 71.4k | 536900326U, // CP_COPYx |
1825 | 71.4k | 536897612U, // CP_PASTE_LAST |
1826 | 71.4k | 536891737U, // CP_PASTEx |
1827 | 71.4k | 562987U, // DCBFL |
1828 | 71.4k | 564850U, // DCBFLP |
1829 | 71.4k | 561542U, // DCBFx |
1830 | 71.4k | 553691021U, // DCBTCT |
1831 | 71.4k | 553690294U, // DCBTDS |
1832 | 71.4k | 553691029U, // DCBTSTCT |
1833 | 71.4k | 553690302U, // DCBTSTDS |
1834 | 71.4k | 567463U, // DCBTSTT |
1835 | 71.4k | 567435U, // DCBTSTx |
1836 | 71.4k | 567450U, // DCBTT |
1837 | 71.4k | 567169U, // DCBTx |
1838 | 71.4k | 13949U, // DFLOADf32 |
1839 | 71.4k | 14261U, // DFLOADf64 |
1840 | 71.4k | 13971U, // DFSTOREf32 |
1841 | 71.4k | 14283U, // DFSTOREf64 |
1842 | 71.4k | 21535U, // EXTLDI |
1843 | 71.4k | 17421U, // EXTLDIo |
1844 | 71.4k | 22060U, // EXTLWI |
1845 | 71.4k | 17539U, // EXTLWIo |
1846 | 71.4k | 21584U, // EXTRDI |
1847 | 71.4k | 17464U, // EXTRDIo |
1848 | 71.4k | 22099U, // EXTRWI |
1849 | 71.4k | 17575U, // EXTRWIo |
1850 | 71.4k | 22044U, // INSLWI |
1851 | 71.4k | 17530U, // INSLWIo |
1852 | 71.4k | 21568U, // INSRDI |
1853 | 71.4k | 17446U, // INSRDIo |
1854 | 71.4k | 22083U, // INSRWI |
1855 | 71.4k | 17557U, // INSRWIo |
1856 | 71.4k | 33573652U, // LAx |
1857 | 71.4k | 15826U, // LIWAX |
1858 | 71.4k | 15872U, // LIWZX |
1859 | 71.4k | 21688U, // RLWIMIbm |
1860 | 71.4k | 17502U, // RLWIMIobm |
1861 | 71.4k | 22616U, // RLWINMbm |
1862 | 71.4k | 17651U, // RLWINMobm |
1863 | 71.4k | 22625U, // RLWNMbm |
1864 | 71.4k | 17660U, // RLWNMobm |
1865 | 71.4k | 21576U, // ROTRDI |
1866 | 71.4k | 17455U, // ROTRDIo |
1867 | 71.4k | 22091U, // ROTRWI |
1868 | 71.4k | 17566U, // ROTRWIo |
1869 | 71.4k | 21529U, // SLDI |
1870 | 71.4k | 17414U, // SLDIo |
1871 | 71.4k | 22038U, // SLWI |
1872 | 71.4k | 17523U, // SLWIo |
1873 | 71.4k | 15358U, // SPILLTOVSR_LD |
1874 | 71.4k | 15833U, // SPILLTOVSR_LDX |
1875 | 71.4k | 15811U, // SPILLTOVSR_ST |
1876 | 71.4k | 15849U, // SPILLTOVSR_STX |
1877 | 71.4k | 21570U, // SRDI |
1878 | 71.4k | 17448U, // SRDIo |
1879 | 71.4k | 22085U, // SRWI |
1880 | 71.4k | 17559U, // SRWIo |
1881 | 71.4k | 15865U, // STIWX |
1882 | 71.4k | 21476U, // SUBI |
1883 | 71.4k | 19959U, // SUBIC |
1884 | 71.4k | 16943U, // SUBICo |
1885 | 71.4k | 26021U, // SUBIS |
1886 | 71.4k | 50357676U, // SUBPCIS |
1887 | 71.4k | 13960U, // XFLOADf32 |
1888 | 71.4k | 14272U, // XFLOADf64 |
1889 | 71.4k | 13983U, // XFSTOREf32 |
1890 | 71.4k | 14295U, // XFSTOREf64 |
1891 | 71.4k | 20142U, // ADD4 |
1892 | 71.4k | 20142U, // ADD4TLS |
1893 | 71.4k | 17017U, // ADD4o |
1894 | 71.4k | 20142U, // ADD8 |
1895 | 71.4k | 20142U, // ADD8TLS |
1896 | 71.4k | 20142U, // ADD8TLS_ |
1897 | 71.4k | 17017U, // ADD8o |
1898 | 71.4k | 19921U, // ADDC |
1899 | 71.4k | 19921U, // ADDC8 |
1900 | 71.4k | 16910U, // ADDC8o |
1901 | 71.4k | 16910U, // ADDCo |
1902 | 71.4k | 20699U, // ADDE |
1903 | 71.4k | 20699U, // ADDE8 |
1904 | 71.4k | 17184U, // ADDE8o |
1905 | 71.4k | 17184U, // ADDEo |
1906 | 71.4k | 21511U, // ADDI |
1907 | 71.4k | 21511U, // ADDI8 |
1908 | 71.4k | 19966U, // ADDIC |
1909 | 71.4k | 19966U, // ADDIC8 |
1910 | 71.4k | 16951U, // ADDICo |
1911 | 71.4k | 26046U, // ADDIS |
1912 | 71.4k | 26046U, // ADDIS8 |
1913 | 71.4k | 15118U, // ADDISdtprelHA |
1914 | 71.4k | 13544U, // ADDISdtprelHA32 |
1915 | 71.4k | 15101U, // ADDISgotTprelHA |
1916 | 71.4k | 15073U, // ADDIStlsgdHA |
1917 | 71.4k | 15087U, // ADDIStlsldHA |
1918 | 71.4k | 15061U, // ADDIStocHA |
1919 | 71.4k | 15535U, // ADDIdtprelL |
1920 | 71.4k | 13833U, // ADDIdtprelL32 |
1921 | 71.4k | 15498U, // ADDItlsgdL |
1922 | 71.4k | 13790U, // ADDItlsgdL32 |
1923 | 71.4k | 15581U, // ADDItlsgdLADDR |
1924 | 71.4k | 13885U, // ADDItlsgdLADDR32 |
1925 | 71.4k | 15510U, // ADDItlsldL |
1926 | 71.4k | 13804U, // ADDItlsldL32 |
1927 | 71.4k | 15597U, // ADDItlsldLADDR |
1928 | 71.4k | 13903U, // ADDItlsldLADDR32 |
1929 | 71.4k | 15488U, // ADDItocL |
1930 | 71.4k | 536891678U, // ADDME |
1931 | 71.4k | 536891678U, // ADDME8 |
1932 | 71.4k | 536888119U, // ADDME8o |
1933 | 71.4k | 536888119U, // ADDMEo |
1934 | 71.4k | 536896949U, // ADDPCIS |
1935 | 71.4k | 536891767U, // ADDZE |
1936 | 71.4k | 536891767U, // ADDZE8 |
1937 | 71.4k | 536888180U, // ADDZE8o |
1938 | 71.4k | 536888180U, // ADDZEo |
1939 | 71.4k | 51521U, // ADJCALLSTACKDOWN |
1940 | 71.4k | 51540U, // ADJCALLSTACKUP |
1941 | 71.4k | 20440U, // AND |
1942 | 71.4k | 20440U, // AND8 |
1943 | 71.4k | 17107U, // AND8o |
1944 | 71.4k | 19930U, // ANDC |
1945 | 71.4k | 19930U, // ANDC8 |
1946 | 71.4k | 16917U, // ANDC8o |
1947 | 71.4k | 16917U, // ANDCo |
1948 | 71.4k | 18086U, // ANDISo |
1949 | 71.4k | 18086U, // ANDISo8 |
1950 | 71.4k | 17430U, // ANDIo |
1951 | 71.4k | 17430U, // ANDIo8 |
1952 | 71.4k | 15731U, // ANDIo_1_EQ_BIT |
1953 | 71.4k | 15011U, // ANDIo_1_EQ_BIT8 |
1954 | 71.4k | 15747U, // ANDIo_1_GT_BIT |
1955 | 71.4k | 15028U, // ANDIo_1_GT_BIT8 |
1956 | 71.4k | 17107U, // ANDo |
1957 | 71.4k | 1141917938U, // ATOMIC_CMP_SWAP_I16 |
1958 | 71.4k | 1141917916U, // ATOMIC_CMP_SWAP_I32 |
1959 | 71.4k | 14119U, // ATOMIC_CMP_SWAP_I64 |
1960 | 71.4k | 14872U, // ATOMIC_CMP_SWAP_I8 |
1961 | 71.4k | 14483U, // ATOMIC_LOAD_ADD_I16 |
1962 | 71.4k | 13582U, // ATOMIC_LOAD_ADD_I32 |
1963 | 71.4k | 14016U, // ATOMIC_LOAD_ADD_I64 |
1964 | 71.4k | 14770U, // ATOMIC_LOAD_ADD_I8 |
1965 | 71.4k | 14526U, // ATOMIC_LOAD_AND_I16 |
1966 | 71.4k | 13625U, // ATOMIC_LOAD_AND_I32 |
1967 | 71.4k | 14307U, // ATOMIC_LOAD_AND_I64 |
1968 | 71.4k | 14811U, // ATOMIC_LOAD_AND_I8 |
1969 | 71.4k | 14670U, // ATOMIC_LOAD_MAX_I16 |
1970 | 71.4k | 13769U, // ATOMIC_LOAD_MAX_I32 |
1971 | 71.4k | 14203U, // ATOMIC_LOAD_MAX_I64 |
1972 | 71.4k | 14962U, // ATOMIC_LOAD_MAX_I8 |
1973 | 71.4k | 14569U, // ATOMIC_LOAD_MIN_I16 |
1974 | 71.4k | 13668U, // ATOMIC_LOAD_MIN_I32 |
1975 | 71.4k | 14081U, // ATOMIC_LOAD_MIN_I64 |
1976 | 71.4k | 14852U, // ATOMIC_LOAD_MIN_I8 |
1977 | 71.4k | 14504U, // ATOMIC_LOAD_NAND_I16 |
1978 | 71.4k | 13603U, // ATOMIC_LOAD_NAND_I32 |
1979 | 71.4k | 14037U, // ATOMIC_LOAD_NAND_I64 |
1980 | 71.4k | 14790U, // ATOMIC_LOAD_NAND_I8 |
1981 | 71.4k | 14628U, // ATOMIC_LOAD_OR_I16 |
1982 | 71.4k | 13727U, // ATOMIC_LOAD_OR_I32 |
1983 | 71.4k | 14161U, // ATOMIC_LOAD_OR_I64 |
1984 | 71.4k | 14911U, // ATOMIC_LOAD_OR_I8 |
1985 | 71.4k | 14462U, // ATOMIC_LOAD_SUB_I16 |
1986 | 71.4k | 13561U, // ATOMIC_LOAD_SUB_I32 |
1987 | 71.4k | 13995U, // ATOMIC_LOAD_SUB_I64 |
1988 | 71.4k | 14736U, // ATOMIC_LOAD_SUB_I8 |
1989 | 71.4k | 14648U, // ATOMIC_LOAD_UMAX_I16 |
1990 | 71.4k | 13747U, // ATOMIC_LOAD_UMAX_I32 |
1991 | 71.4k | 14181U, // ATOMIC_LOAD_UMAX_I64 |
1992 | 71.4k | 14941U, // ATOMIC_LOAD_UMAX_I8 |
1993 | 71.4k | 14547U, // ATOMIC_LOAD_UMIN_I16 |
1994 | 71.4k | 13646U, // ATOMIC_LOAD_UMIN_I32 |
1995 | 71.4k | 14059U, // ATOMIC_LOAD_UMIN_I64 |
1996 | 71.4k | 14831U, // ATOMIC_LOAD_UMIN_I8 |
1997 | 71.4k | 14607U, // ATOMIC_LOAD_XOR_I16 |
1998 | 71.4k | 13706U, // ATOMIC_LOAD_XOR_I32 |
1999 | 71.4k | 14140U, // ATOMIC_LOAD_XOR_I64 |
2000 | 71.4k | 14892U, // ATOMIC_LOAD_XOR_I8 |
2001 | 71.4k | 14590U, // ATOMIC_SWAP_I16 |
2002 | 71.4k | 13689U, // ATOMIC_SWAP_I32 |
2003 | 71.4k | 14102U, // ATOMIC_SWAP_I64 |
2004 | 71.4k | 15045U, // ATOMIC_SWAP_I8 |
2005 | 71.4k | 16051U, // ATTN |
2006 | 71.4k | 592924U, // B |
2007 | 71.4k | 608750U, // BA |
2008 | 71.4k | 83902568U, // BC |
2009 | 71.4k | 1687074U, // BCC |
2010 | 71.4k | 2211362U, // BCCA |
2011 | 71.4k | 2735650U, // BCCCTR |
2012 | 71.4k | 2735650U, // BCCCTR8 |
2013 | 71.4k | 3259938U, // BCCCTRL |
2014 | 71.4k | 3259938U, // BCCCTRL8 |
2015 | 71.4k | 3784226U, // BCCL |
2016 | 71.4k | 4308514U, // BCCLA |
2017 | 71.4k | 4832802U, // BCCLR |
2018 | 71.4k | 5357090U, // BCCLRL |
2019 | 71.4k | 5783706U, // BCCTR |
2020 | 71.4k | 5783706U, // BCCTR8 |
2021 | 71.4k | 5783762U, // BCCTR8n |
2022 | 71.4k | 5783684U, // BCCTRL |
2023 | 71.4k | 5783684U, // BCCTRL8 |
2024 | 71.4k | 5783742U, // BCCTRL8n |
2025 | 71.4k | 5783742U, // BCCTRLn |
2026 | 71.4k | 5783762U, // BCCTRn |
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2298 | 71.4k | 22397U, // EVFSMUL |
2299 | 71.4k | 536896482U, // EVFSNABS |
2300 | 71.4k | 536892050U, // EVFSNEG |
2301 | 71.4k | 19854U, // EVFSSUB |
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2327 | 71.4k | 21624U, // EVMERGEHI |
2328 | 71.4k | 22989U, // EVMERGEHILO |
2329 | 71.4k | 22978U, // EVMERGELO |
2330 | 71.4k | 21635U, // EVMERGELOHI |
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2336 | 71.4k | 22833U, // EVMHEGUMIAN |
2337 | 71.4k | 20882U, // EVMHESMF |
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2341 | 71.4k | 21696U, // EVMHESMI |
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2350 | 71.4k | 27819U, // EVMHESSIANW |
2351 | 71.4k | 21735U, // EVMHEUMI |
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2357 | 71.4k | 18815U, // EVMHOGSMFAA |
2358 | 71.4k | 22761U, // EVMHOGSMFAN |
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2361 | 71.4k | 18900U, // EVMHOGUMIAA |
2362 | 71.4k | 22846U, // EVMHOGUMIAN |
2363 | 71.4k | 20902U, // EVMHOSMF |
2364 | 71.4k | 18957U, // EVMHOSMFA |
2365 | 71.4k | 27177U, // EVMHOSMFAAW |
2366 | 71.4k | 27702U, // EVMHOSMFANW |
2367 | 71.4k | 21716U, // EVMHOSMI |
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2369 | 71.4k | 27269U, // EVMHOSMIAAW |
2370 | 71.4k | 27767U, // EVMHOSMIANW |
2371 | 71.4k | 21005U, // EVMHOSSF |
2372 | 71.4k | 19000U, // EVMHOSSFA |
2373 | 71.4k | 27203U, // EVMHOSSFAAW |
2374 | 71.4k | 27728U, // EVMHOSSFANW |
2375 | 71.4k | 27401U, // EVMHOSSIAAW |
2376 | 71.4k | 27845U, // EVMHOSSIANW |
2377 | 71.4k | 21765U, // EVMHOUMI |
2378 | 71.4k | 19102U, // EVMHOUMIA |
2379 | 71.4k | 27335U, // EVMHOUMIAAW |
2380 | 71.4k | 27806U, // EVMHOUMIANW |
2381 | 71.4k | 27467U, // EVMHOUSIAAW |
2382 | 71.4k | 27884U, // EVMHOUSIANW |
2383 | 71.4k | 536890157U, // EVMRA |
2384 | 71.4k | 20892U, // EVMWHSMF |
2385 | 71.4k | 18946U, // EVMWHSMFA |
2386 | 71.4k | 21706U, // EVMWHSMI |
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2389 | 71.4k | 18989U, // EVMWHSSFA |
2390 | 71.4k | 21745U, // EVMWHUMI |
2391 | 71.4k | 19080U, // EVMWHUMIA |
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2401 | 71.4k | 27871U, // EVMWLUSIANW |
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2403 | 71.4k | 18968U, // EVMWSMFA |
2404 | 71.4k | 18828U, // EVMWSMFAA |
2405 | 71.4k | 22774U, // EVMWSMFAN |
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2407 | 71.4k | 19059U, // EVMWSMIA |
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2410 | 71.4k | 21015U, // EVMWSSF |
2411 | 71.4k | 19011U, // EVMWSSFA |
2412 | 71.4k | 18839U, // EVMWSSFAA |
2413 | 71.4k | 22785U, // EVMWSSFAN |
2414 | 71.4k | 21775U, // EVMWUMI |
2415 | 71.4k | 19113U, // EVMWUMIA |
2416 | 71.4k | 18913U, // EVMWUMIAA |
2417 | 71.4k | 22859U, // EVMWUMIAN |
2418 | 71.4k | 20462U, // EVNAND |
2419 | 71.4k | 536892059U, // EVNEG |
2420 | 71.4k | 25392U, // EVNOR |
2421 | 71.4k | 25405U, // EVOR |
2422 | 71.4k | 20050U, // EVORC |
2423 | 71.4k | 27655U, // EVRLW |
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2426 | 71.4k | 2154329095U, // EVSEL |
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2428 | 71.4k | 22052U, // EVSLWI |
2429 | 71.4k | 151016557U, // EVSPLATFI |
2430 | 71.4k | 151016880U, // EVSPLATI |
2431 | 71.4k | 26065U, // EVSRWIS |
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2434 | 71.4k | 27003U, // EVSRWU |
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2439 | 71.4k | 33581963U, // EVSTDW |
2440 | 71.4k | 604009086U, // EVSTDWX |
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2442 | 71.4k | 604008269U, // EVSTWHEX |
2443 | 71.4k | 33577401U, // EVSTWHO |
2444 | 71.4k | 604008459U, // EVSTWHOX |
2445 | 71.4k | 33575278U, // EVSTWWE |
2446 | 71.4k | 604008279U, // EVSTWWEX |
2447 | 71.4k | 33577554U, // EVSTWWO |
2448 | 71.4k | 604008469U, // EVSTWWOX |
2449 | 71.4k | 536898154U, // EVSUBFSMIAAW |
2450 | 71.4k | 536898286U, // EVSUBFSSIAAW |
2451 | 71.4k | 536898220U, // EVSUBFUMIAAW |
2452 | 71.4k | 536898352U, // EVSUBFUSIAAW |
2453 | 71.4k | 27556U, // EVSUBFW |
2454 | 71.4k | 167799725U, // EVSUBIFW |
2455 | 71.4k | 25436U, // EVXOR |
2456 | 71.4k | 536890583U, // EXTSB |
2457 | 71.4k | 536890583U, // EXTSB8 |
2458 | 71.4k | 536890583U, // EXTSB8_32_64 |
2459 | 71.4k | 536887727U, // EXTSB8o |
2460 | 71.4k | 536887727U, // EXTSBo |
2461 | 71.4k | 536892221U, // EXTSH |
2462 | 71.4k | 536892221U, // EXTSH8 |
2463 | 71.4k | 536892221U, // EXTSH8_32_64 |
2464 | 71.4k | 536888249U, // EXTSH8o |
2465 | 71.4k | 536888249U, // EXTSHo |
2466 | 71.4k | 536898925U, // EXTSW |
2467 | 71.4k | 21662U, // EXTSWSLI |
2468 | 71.4k | 17482U, // EXTSWSLIo |
2469 | 71.4k | 536898925U, // EXTSW_32 |
2470 | 71.4k | 536898925U, // EXTSW_32_64 |
2471 | 71.4k | 536889231U, // EXTSW_32_64o |
2472 | 71.4k | 536889231U, // EXTSWo |
2473 | 71.4k | 16056U, // EnforceIEIO |
2474 | 71.4k | 536896440U, // FABSD |
2475 | 71.4k | 536888869U, // FABSDo |
2476 | 71.4k | 536896440U, // FABSS |
2477 | 71.4k | 536888869U, // FABSSo |
2478 | 71.4k | 20157U, // FADD |
2479 | 71.4k | 25692U, // FADDS |
2480 | 71.4k | 18016U, // FADDSo |
2481 | 71.4k | 17023U, // FADDo |
2482 | 71.4k | 0U, // FADDrtz |
2483 | 71.4k | 536891245U, // FCFID |
2484 | 71.4k | 536896686U, // FCFIDS |
2485 | 71.4k | 536888955U, // FCFIDSo |
2486 | 71.4k | 536897764U, // FCFIDU |
2487 | 71.4k | 536897079U, // FCFIDUS |
2488 | 71.4k | 536889031U, // FCFIDUSo |
2489 | 71.4k | 536889075U, // FCFIDUo |
2490 | 71.4k | 536887988U, // FCFIDo |
2491 | 71.4k | 26936U, // FCMPUD |
2492 | 71.4k | 26936U, // FCMPUS |
2493 | 71.4k | 22883U, // FCPSGND |
2494 | 71.4k | 17688U, // FCPSGNDo |
2495 | 71.4k | 22883U, // FCPSGNS |
2496 | 71.4k | 17688U, // FCPSGNSo |
2497 | 71.4k | 536891264U, // FCTID |
2498 | 71.4k | 536897774U, // FCTIDU |
2499 | 71.4k | 536900508U, // FCTIDUZ |
2500 | 71.4k | 536889371U, // FCTIDUZo |
2501 | 71.4k | 536889084U, // FCTIDUo |
2502 | 71.4k | 536900361U, // FCTIDZ |
2503 | 71.4k | 536889337U, // FCTIDZo |
2504 | 71.4k | 536887996U, // FCTIDo |
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2511 | 71.4k | 536889391U, // FCTIWZo |
2512 | 71.4k | 536889192U, // FCTIWo |
2513 | 71.4k | 27069U, // FDIV |
2514 | 71.4k | 26230U, // FDIVS |
2515 | 71.4k | 18129U, // FDIVSo |
2516 | 71.4k | 18242U, // FDIVo |
2517 | 71.4k | 20174U, // FMADD |
2518 | 71.4k | 25701U, // FMADDS |
2519 | 71.4k | 18024U, // FMADDSo |
2520 | 71.4k | 17040U, // FMADDo |
2521 | 71.4k | 536896246U, // FMR |
2522 | 71.4k | 536888828U, // FMRo |
2523 | 71.4k | 19819U, // FMSUB |
2524 | 71.4k | 25671U, // FMSUBS |
2525 | 71.4k | 17990U, // FMSUBSo |
2526 | 71.4k | 16860U, // FMSUBo |
2527 | 71.4k | 22383U, // FMUL |
2528 | 71.4k | 26084U, // FMULS |
2529 | 71.4k | 18094U, // FMULSo |
2530 | 71.4k | 17626U, // FMULo |
2531 | 71.4k | 536896466U, // FNABSD |
2532 | 71.4k | 536888886U, // FNABSDo |
2533 | 71.4k | 536896466U, // FNABSS |
2534 | 71.4k | 536888886U, // FNABSSo |
2535 | 71.4k | 536892036U, // FNEGD |
2536 | 71.4k | 536888221U, // FNEGDo |
2537 | 71.4k | 536892036U, // FNEGS |
2538 | 71.4k | 536888221U, // FNEGSo |
2539 | 71.4k | 20193U, // FNMADD |
2540 | 71.4k | 25711U, // FNMADDS |
2541 | 71.4k | 18033U, // FNMADDSo |
2542 | 71.4k | 17059U, // FNMADDo |
2543 | 71.4k | 19838U, // FNMSUB |
2544 | 71.4k | 25681U, // FNMSUBS |
2545 | 71.4k | 17999U, // FNMSUBSo |
2546 | 71.4k | 16879U, // FNMSUBo |
2547 | 71.4k | 536891702U, // FRE |
2548 | 71.4k | 536896794U, // FRES |
2549 | 71.4k | 536888973U, // FRESo |
2550 | 71.4k | 536888136U, // FREo |
2551 | 71.4k | 536893514U, // FRIMD |
2552 | 71.4k | 536888556U, // FRIMDo |
2553 | 71.4k | 536893514U, // FRIMS |
2554 | 71.4k | 536888556U, // FRIMSo |
2555 | 71.4k | 536893812U, // FRIND |
2556 | 71.4k | 536888630U, // FRINDo |
2557 | 71.4k | 536893812U, // FRINS |
2558 | 71.4k | 536888630U, // FRINSo |
2559 | 71.4k | 536895084U, // FRIPD |
2560 | 71.4k | 536888725U, // FRIPDo |
2561 | 71.4k | 536895084U, // FRIPS |
2562 | 71.4k | 536888725U, // FRIPSo |
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2796 | 71.4k | 536896362U, // MTSPR8 |
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2801 | 71.4k | 549568U, // MTVSCR |
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2803 | 71.4k | 20273U, // MTVSRDD |
2804 | 71.4k | 536890169U, // MTVSRWA |
2805 | 71.4k | 536897157U, // MTVSRWS |
2806 | 71.4k | 536900552U, // MTVSRWZ |
2807 | 71.4k | 20324U, // MULHD |
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2810 | 71.4k | 17068U, // MULHDo |
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2812 | 71.4k | 26985U, // MULHWU |
2813 | 71.4k | 18207U, // MULHWUo |
2814 | 71.4k | 18272U, // MULHWo |
2815 | 71.4k | 20384U, // MULLD |
2816 | 71.4k | 17092U, // MULLDo |
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2819 | 71.4k | 27641U, // MULLW |
2820 | 71.4k | 18288U, // MULLWo |
2821 | 71.4k | 15651U, // MoveGOTtoLR |
2822 | 71.4k | 15639U, // MovePCtoLR |
2823 | 71.4k | 14982U, // MovePCtoLR8 |
2824 | 71.4k | 20448U, // NAND |
2825 | 71.4k | 20448U, // NAND8 |
2826 | 71.4k | 17106U, // NAND8o |
2827 | 71.4k | 17106U, // NANDo |
2828 | 71.4k | 16062U, // NAP |
2829 | 71.4k | 536892021U, // NEG |
2830 | 71.4k | 536892021U, // NEG8 |
2831 | 71.4k | 536888215U, // NEG8o |
2832 | 71.4k | 536888215U, // NEGo |
2833 | 71.4k | 16071U, // NOP |
2834 | 71.4k | 13520U, // NOP_GT_PWR6 |
2835 | 71.4k | 13532U, // NOP_GT_PWR7 |
2836 | 71.4k | 25380U, // NOR |
2837 | 71.4k | 25380U, // NOR8 |
2838 | 71.4k | 17922U, // NOR8o |
2839 | 71.4k | 17922U, // NORo |
2840 | 71.4k | 25373U, // OR |
2841 | 71.4k | 25373U, // OR8 |
2842 | 71.4k | 17923U, // OR8o |
2843 | 71.4k | 20038U, // ORC |
2844 | 71.4k | 20038U, // ORC8 |
2845 | 71.4k | 16990U, // ORC8o |
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2847 | 71.4k | 21864U, // ORI |
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2850 | 71.4k | 26059U, // ORIS8 |
2851 | 71.4k | 17923U, // ORo |
2852 | 71.4k | 536890619U, // POPCNTB |
2853 | 71.4k | 536891491U, // POPCNTD |
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2855 | 71.4k | 15763U, // PPC32GOT |
2856 | 71.4k | 15773U, // PPC32PICGOT |
2857 | 71.4k | 536893140U, // PSC_DCBZL |
2858 | 71.4k | 318789325U, // PSQ_L |
2859 | 71.4k | 318794023U, // PSQ_LU |
2860 | 71.4k | 29181U, // PSQ_LUX |
2861 | 71.4k | 28632U, // PSQ_LX |
2862 | 71.4k | 318793796U, // PSQ_ST |
2863 | 71.4k | 318794080U, // PSQ_STU |
2864 | 71.4k | 29240U, // PSQ_STUX |
2865 | 71.4k | 29084U, // PSQ_STX |
2866 | 71.4k | 536896422U, // PS_ABS |
2867 | 71.4k | 536888860U, // PS_ABSo |
2868 | 71.4k | 20139U, // PS_ADD |
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2870 | 71.4k | 18529U, // PS_CMPO0 |
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2876 | 71.4k | 20163U, // PS_MADD |
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2880 | 71.4k | 16771U, // PS_MADDS1o |
2881 | 71.4k | 17030U, // PS_MADDo |
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2884 | 71.4k | 18570U, // PS_MERGE01 |
2885 | 71.4k | 16735U, // PS_MERGE01o |
2886 | 71.4k | 18500U, // PS_MERGE10 |
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2890 | 71.4k | 536896237U, // PS_MR |
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2900 | 71.4k | 536896446U, // PS_NABS |
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2909 | 71.4k | 536888964U, // PS_RESo |
2910 | 71.4k | 536891715U, // PS_RSQRTE |
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2913 | 71.4k | 17601U, // PS_SELo |
2914 | 71.4k | 19784U, // PS_SUB |
2915 | 71.4k | 16834U, // PS_SUBo |
2916 | 71.4k | 18520U, // PS_SUM0 |
2917 | 71.4k | 16702U, // PS_SUM0o |
2918 | 71.4k | 18602U, // PS_SUM1 |
2919 | 71.4k | 16761U, // PS_SUM1o |
2920 | 71.4k | 21792U, // QVALIGNI |
2921 | 71.4k | 21792U, // QVALIGNIb |
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2923 | 71.4k | 21925U, // QVESPLATI |
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2925 | 71.4k | 21925U, // QVESPLATIs |
2926 | 71.4k | 536896438U, // QVFABS |
2927 | 71.4k | 536896438U, // QVFABSs |
2928 | 71.4k | 20155U, // QVFADD |
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2930 | 71.4k | 25690U, // QVFADDSs |
2931 | 71.4k | 536891243U, // QVFCFID |
2932 | 71.4k | 536896684U, // QVFCFIDS |
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2936 | 71.4k | 25049U, // QVFCMPEQ |
2937 | 71.4k | 25049U, // QVFCMPEQb |
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2943 | 71.4k | 26615U, // QVFCMPLTb |
2944 | 71.4k | 26615U, // QVFCMPLTbs |
2945 | 71.4k | 22881U, // QVFCPSGN |
2946 | 71.4k | 22881U, // QVFCPSGNs |
2947 | 71.4k | 536891262U, // QVFCTID |
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2960 | 71.4k | 25699U, // QVFMADDS |
2961 | 71.4k | 25699U, // QVFMADDSs |
2962 | 71.4k | 536896244U, // QVFMR |
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2966 | 71.4k | 25669U, // QVFMSUBS |
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2970 | 71.4k | 26082U, // QVFMULSs |
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2972 | 71.4k | 536896464U, // QVFNABSs |
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2974 | 71.4k | 536892034U, // QVFNEGs |
2975 | 71.4k | 20191U, // QVFNMADD |
2976 | 71.4k | 25709U, // QVFNMADDS |
2977 | 71.4k | 25709U, // QVFNMADDSs |
2978 | 71.4k | 19836U, // QVFNMSUB |
2979 | 71.4k | 25679U, // QVFNMSUBS |
2980 | 71.4k | 25679U, // QVFNMSUBSs |
2981 | 71.4k | 22670U, // QVFPERM |
2982 | 71.4k | 22670U, // QVFPERMs |
2983 | 71.4k | 536891700U, // QVFRE |
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2985 | 71.4k | 536896792U, // QVFRESs |
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2987 | 71.4k | 536893512U, // QVFRIMs |
2988 | 71.4k | 536893810U, // QVFRIN |
2989 | 71.4k | 536893810U, // QVFRINs |
2990 | 71.4k | 536895082U, // QVFRIP |
2991 | 71.4k | 536895082U, // QVFRIPs |
2992 | 71.4k | 536900441U, // QVFRIZ |
2993 | 71.4k | 536900441U, // QVFRIZs |
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2995 | 71.4k | 536895783U, // QVFRSPs |
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3000 | 71.4k | 22288U, // QVFSELb |
3001 | 71.4k | 22288U, // QVFSELbb |
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3005 | 71.4k | 25660U, // QVFSUBSs |
3006 | 71.4k | 22870U, // QVFTSTNAN |
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3009 | 71.4k | 20228U, // QVFXMADD |
3010 | 71.4k | 25749U, // QVFXMADDS |
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3012 | 71.4k | 26091U, // QVFXMULS |
3013 | 71.4k | 20201U, // QVFXXCPNMADD |
3014 | 71.4k | 25720U, // QVFXXCPNMADDS |
3015 | 71.4k | 20238U, // QVFXXMADD |
3016 | 71.4k | 25760U, // QVFXXMADDS |
3017 | 71.4k | 20215U, // QVFXXNPMADD |
3018 | 71.4k | 25735U, // QVFXXNPMADDS |
3019 | 71.4k | 335565816U, // QVGPCI |
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3080 | 71.4k | 603998983U, // QVSTFSUXIA |
3081 | 71.4k | 218313262U, // QVSTFSUXs |
3082 | 71.4k | 604008743U, // QVSTFSX |
3083 | 71.4k | 603999123U, // QVSTFSXA |
3084 | 71.4k | 604001933U, // QVSTFSXI |
3085 | 71.4k | 603998934U, // QVSTFSXIA |
3086 | 71.4k | 604008743U, // QVSTFSXs |
3087 | 71.4k | 15559U, // RESTORE_CR |
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3089 | 71.4k | 15430U, // RESTORE_VRSAVE |
3090 | 71.4k | 15980U, // RFCI |
3091 | 71.4k | 15991U, // RFDI |
3092 | 71.4k | 265247U, // RFEBB |
3093 | 71.4k | 15996U, // RFI |
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3096 | 71.4k | 22257U, // RLDCL |
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3204 | 71.4k | 33575030U, // STD |
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3213 | 71.4k | 28478U, // STDXTLS_ |
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3237 | 71.4k | 28554U, // STHXTLS_ |
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3240 | 71.4k | 16075U, // STOP |
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3248 | 71.4k | 33582508U, // STW8 |
3249 | 71.4k | 26490U, // STWAT |
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3251 | 71.4k | 28591U, // STWCIX |
3252 | 71.4k | 603998185U, // STWCX |
3253 | 71.4k | 604008533U, // STWEPX |
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3257 | 71.4k | 218313282U, // STWUX8 |
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3261 | 71.4k | 29353U, // STWXTLS_ |
3262 | 71.4k | 29353U, // STWXTLS_32 |
3263 | 71.4k | 33574992U, // STXSD |
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3290 | 71.4k | 17199U, // SUBFEo |
3291 | 71.4k | 19980U, // SUBFIC |
3292 | 71.4k | 19980U, // SUBFIC8 |
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3298 | 71.4k | 536891774U, // SUBFZE8 |
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3303 | 71.4k | 542425U, // TABORT |
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3341 | 71.4k | 16066U, // TRAP |
3342 | 71.4k | 13510U, // TRECHKPT |
3343 | 71.4k | 541921U, // TRECLAIM |
3344 | 71.4k | 263702U, // TSR |
3345 | 71.4k | 191872U, // TW |
3346 | 71.4k | 185960U, // TWI |
3347 | 71.4k | 536889650U, // UPDATE_VRSAVE |
3348 | 71.4k | 15548U, // UpdateGBR |
3349 | 71.4k | 19731U, // VABSDUB |
3350 | 71.4k | 21357U, // VABSDUH |
3351 | 71.4k | 28106U, // VABSDUW |
3352 | 71.4k | 25166U, // VADDCUQ |
3353 | 71.4k | 28090U, // VADDCUW |
3354 | 71.4k | 25197U, // VADDECUQ |
3355 | 71.4k | 22660U, // VADDEUQM |
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3360 | 71.4k | 22480U, // VADDUBM |
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3524 | 71.4k | 25288U, // VNCIPHER |
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3539 | 71.4k | 26194U, // VPKSHUS |
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3545 | 71.4k | 26203U, // VPKUHUS |
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3547 | 71.4k | 26221U, // VPKUWUS |
3548 | 71.4k | 19561U, // VPMSUMB |
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3550 | 71.4k | 21213U, // VPMSUMH |
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3553 | 71.4k | 536891490U, // VPOPCNTD |
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3571 | 71.4k | 22624U, // VRLWNM |
3572 | 71.4k | 536894981U, // VRSQRTEFP |
3573 | 71.4k | 536899588U, // VSBOX |
3574 | 71.4k | 22302U, // VSEL |
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3576 | 71.4k | 27480U, // VSHASIGMAW |
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3621 | 71.4k | 25604U, // VSUM4SBS |
3622 | 71.4k | 25932U, // VSUM4SHS |
3623 | 71.4k | 25632U, // VSUM4UBS |
3624 | 71.4k | 26282U, // VSUMSWS |
3625 | 71.4k | 536899677U, // VUPKHPX |
3626 | 71.4k | 536890526U, // VUPKHSB |
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3631 | 71.4k | 536892183U, // VUPKLSH |
3632 | 71.4k | 536898879U, // VUPKLSW |
3633 | 71.4k | 25437U, // VXOR |
3634 | 71.4k | 117465949U, // V_SET0 |
3635 | 71.4k | 117465949U, // V_SET0B |
3636 | 71.4k | 117465949U, // V_SET0H |
3637 | 71.4k | 8940853U, // V_SETALLONES |
3638 | 71.4k | 8940853U, // V_SETALLONESB |
3639 | 71.4k | 8940853U, // V_SETALLONESH |
3640 | 71.4k | 550887U, // WAIT |
3641 | 71.4k | 545009U, // WRTEE |
3642 | 71.4k | 545885U, // WRTEEI |
3643 | 71.4k | 25414U, // XOR |
3644 | 71.4k | 25414U, // XOR8 |
3645 | 71.4k | 17928U, // XOR8o |
3646 | 71.4k | 21863U, // XORI |
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3648 | 71.4k | 26058U, // XORIS |
3649 | 71.4k | 26058U, // XORIS8 |
3650 | 71.4k | 17928U, // XORo |
3651 | 71.4k | 536894671U, // XSABSDP |
3652 | 71.4k | 536895290U, // XSABSQP |
3653 | 71.4k | 23283U, // XSADDDP |
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3657 | 71.4k | 23717U, // XSCMPEQDP |
3658 | 71.4k | 23685U, // XSCMPEXPDP |
3659 | 71.4k | 24346U, // XSCMPEXPQP |
3660 | 71.4k | 23345U, // XSCMPGEDP |
3661 | 71.4k | 23777U, // XSCMPGTDP |
3662 | 71.4k | 23615U, // XSCMPODP |
3663 | 71.4k | 24316U, // XSCMPOQP |
3664 | 71.4k | 23841U, // XSCMPUDP |
3665 | 71.4k | 24397U, // XSCMPUQP |
3666 | 71.4k | 23575U, // XSCPSGNDP |
3667 | 71.4k | 24305U, // XSCPSGNQP |
3668 | 71.4k | 536895028U, // XSCVDPHP |
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3670 | 71.4k | 536895722U, // XSCVDPSP |
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3674 | 71.4k | 536897230U, // XSCVDPSXWS |
3675 | 71.4k | 536897230U, // XSCVDPSXWSs |
3676 | 71.4k | 536896748U, // XSCVDPUXDS |
3677 | 71.4k | 536896748U, // XSCVDPUXDSs |
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3679 | 71.4k | 536897266U, // XSCVDPUXWSs |
3680 | 71.4k | 536894537U, // XSCVHPDP |
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3688 | 71.4k | 536894557U, // XSCVSPDP |
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3691 | 71.4k | 536895478U, // XSCVSXDSP |
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3695 | 71.4k | 23851U, // XSDIVDP |
3696 | 71.4k | 24407U, // XSDIVQP |
3697 | 71.4k | 23106U, // XSDIVQPO |
3698 | 71.4k | 24962U, // XSDIVSP |
3699 | 71.4k | 23665U, // XSIEXPDP |
3700 | 71.4k | 24336U, // XSIEXPQP |
3701 | 71.4k | 1744853665U, // XSMADDADP |
3702 | 71.4k | 1744854950U, // XSMADDASP |
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3706 | 71.4k | 1744853528U, // XSMADDQPO |
3707 | 71.4k | 23273U, // XSMAXCDP |
3708 | 71.4k | 23911U, // XSMAXDP |
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3710 | 71.4k | 23263U, // XSMINCDP |
3711 | 71.4k | 23597U, // XSMINDP |
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3719 | 71.4k | 23465U, // XSMULDP |
3720 | 71.4k | 24296U, // XSMULQP |
3721 | 71.4k | 23085U, // XSMULQPO |
3722 | 71.4k | 24680U, // XSMULSP |
3723 | 71.4k | 536894651U, // XSNABSDP |
3724 | 71.4k | 536895280U, // XSNABSQP |
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3727 | 71.4k | 1744853641U, // XSNMADDADP |
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3731 | 71.4k | 1744854691U, // XSNMADDQP |
3732 | 71.4k | 1744853516U, // XSNMADDQPO |
3733 | 71.4k | 1744853595U, // XSNMSUBADP |
3734 | 71.4k | 1744854880U, // XSNMSUBASP |
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3736 | 71.4k | 1744855162U, // XSNMSUBMSP |
3737 | 71.4k | 1744854650U, // XSNMSUBQP |
3738 | 71.4k | 1744853483U, // XSNMSUBQPO |
3739 | 71.4k | 536892743U, // XSRDPI |
3740 | 71.4k | 536890900U, // XSRDPIC |
3741 | 71.4k | 536893485U, // XSRDPIM |
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3743 | 71.4k | 536900414U, // XSRDPIZ |
3744 | 71.4k | 536894279U, // XSREDP |
3745 | 71.4k | 536895533U, // XSRESP |
3746 | 71.4k | 283991U, // XSRQPI |
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3749 | 71.4k | 536895791U, // XSRSP |
3750 | 71.4k | 536894295U, // XSRSQRTEDP |
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3760 | 71.4k | 23860U, // XSTDIVDP |
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3765 | 71.4k | 536894609U, // XSXEXPDP |
3766 | 71.4k | 536895270U, // XSXEXPQP |
3767 | 71.4k | 536894337U, // XSXSIGDP |
3768 | 71.4k | 536895198U, // XSXSIGQP |
3769 | 71.4k | 536894680U, // XVABSDP |
3770 | 71.4k | 536895808U, // XVABSSP |
3771 | 71.4k | 23292U, // XVADDDP |
3772 | 71.4k | 24557U, // XVADDSP |
3773 | 71.4k | 23728U, // XVCMPEQDP |
3774 | 71.4k | 17746U, // XVCMPEQDPo |
3775 | 71.4k | 24860U, // XVCMPEQSP |
3776 | 71.4k | 17832U, // XVCMPEQSPo |
3777 | 71.4k | 23356U, // XVCMPGEDP |
3778 | 71.4k | 17734U, // XVCMPGEDPo |
3779 | 71.4k | 24610U, // XVCMPGESP |
3780 | 71.4k | 17820U, // XVCMPGESPo |
3781 | 71.4k | 23788U, // XVCMPGTDP |
3782 | 71.4k | 17758U, // XVCMPGTDPo |
3783 | 71.4k | 24920U, // XVCMPGTSP |
3784 | 71.4k | 17851U, // XVCMPGTSPo |
3785 | 71.4k | 23586U, // XVCPSGNDP |
3786 | 71.4k | 24790U, // XVCPSGNSP |
3787 | 71.4k | 536895732U, // XVCVDPSP |
3788 | 71.4k | 536896724U, // XVCVDPSXDS |
3789 | 71.4k | 536897242U, // XVCVDPSXWS |
3790 | 71.4k | 536896760U, // XVCVDPUXDS |
3791 | 71.4k | 536897278U, // XVCVDPUXWS |
3792 | 71.4k | 536895742U, // XVCVHPSP |
3793 | 71.4k | 536894567U, // XVCVSPDP |
3794 | 71.4k | 536895038U, // XVCVSPHP |
3795 | 71.4k | 536896736U, // XVCVSPSXDS |
3796 | 71.4k | 536897254U, // XVCVSPSXWS |
3797 | 71.4k | 536896772U, // XVCVSPUXDS |
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3799 | 71.4k | 536894224U, // XVCVSXDDP |
3800 | 71.4k | 536895489U, // XVCVSXDSP |
3801 | 71.4k | 536894801U, // XVCVSXWDP |
3802 | 71.4k | 536895902U, // XVCVSXWSP |
3803 | 71.4k | 536894246U, // XVCVUXDDP |
3804 | 71.4k | 536895511U, // XVCVUXDSP |
3805 | 71.4k | 536894812U, // XVCVUXWDP |
3806 | 71.4k | 536895913U, // XVCVUXWSP |
3807 | 71.4k | 23880U, // XVDIVDP |
3808 | 71.4k | 24981U, // XVDIVSP |
3809 | 71.4k | 23675U, // XVIEXPDP |
3810 | 71.4k | 24840U, // XVIEXPSP |
3811 | 71.4k | 1744853676U, // XVMADDADP |
3812 | 71.4k | 1744854961U, // XVMADDASP |
3813 | 71.4k | 1744854028U, // XVMADDMDP |
3814 | 71.4k | 1744855243U, // XVMADDMSP |
3815 | 71.4k | 23920U, // XVMAXDP |
3816 | 71.4k | 25012U, // XVMAXSP |
3817 | 71.4k | 23606U, // XVMINDP |
3818 | 71.4k | 24801U, // XVMINSP |
3819 | 71.4k | 1744853630U, // XVMSUBADP |
3820 | 71.4k | 1744854915U, // XVMSUBASP |
3821 | 71.4k | 1744853982U, // XVMSUBMDP |
3822 | 71.4k | 1744855197U, // XVMSUBMSP |
3823 | 71.4k | 23474U, // XVMULDP |
3824 | 71.4k | 24689U, // XVMULSP |
3825 | 71.4k | 536894661U, // XVNABSDP |
3826 | 71.4k | 536895798U, // XVNABSSP |
3827 | 71.4k | 536894328U, // XVNEGDP |
3828 | 71.4k | 536895573U, // XVNEGSP |
3829 | 71.4k | 1744853653U, // XVNMADDADP |
3830 | 71.4k | 1744854938U, // XVNMADDASP |
3831 | 71.4k | 1744854005U, // XVNMADDMDP |
3832 | 71.4k | 1744855220U, // XVNMADDMSP |
3833 | 71.4k | 1744853607U, // XVNMSUBADP |
3834 | 71.4k | 1744854892U, // XVNMSUBASP |
3835 | 71.4k | 1744853959U, // XVNMSUBMDP |
3836 | 71.4k | 1744855174U, // XVNMSUBMSP |
3837 | 71.4k | 536892751U, // XVRDPI |
3838 | 71.4k | 536890909U, // XVRDPIC |
3839 | 71.4k | 536893494U, // XVRDPIM |
3840 | 71.4k | 536895064U, // XVRDPIP |
3841 | 71.4k | 536900423U, // XVRDPIZ |
3842 | 71.4k | 536894287U, // XVREDP |
3843 | 71.4k | 536895541U, // XVRESP |
3844 | 71.4k | 536892767U, // XVRSPI |
3845 | 71.4k | 536890918U, // XVRSPIC |
3846 | 71.4k | 536893503U, // XVRSPIM |
3847 | 71.4k | 536895073U, // XVRSPIP |
3848 | 71.4k | 536900432U, // XVRSPIZ |
3849 | 71.4k | 536894307U, // XVRSQRTEDP |
3850 | 71.4k | 536895561U, // XVRSQRTESP |
3851 | 71.4k | 536894743U, // XVSQRTDP |
3852 | 71.4k | 536895864U, // XVSQRTSP |
3853 | 71.4k | 23232U, // XVSUBDP |
3854 | 71.4k | 24517U, // XVSUBSP |
3855 | 71.4k | 23870U, // XVTDIVDP |
3856 | 71.4k | 24971U, // XVTDIVSP |
3857 | 71.4k | 536894732U, // XVTSQRTDP |
3858 | 71.4k | 536895853U, // XVTSQRTSP |
3859 | 71.4k | 2281724628U, // XVTSTDCDP |
3860 | 71.4k | 2281725913U, // XVTSTDCSP |
3861 | 71.4k | 536894619U, // XVXEXPDP |
3862 | 71.4k | 536895762U, // XVXEXPSP |
3863 | 71.4k | 536894347U, // XVXSIGDP |
3864 | 71.4k | 536895582U, // XVXSIGSP |
3865 | 71.4k | 536891402U, // XXBRD |
3866 | 71.4k | 536892134U, // XXBRH |
3867 | 71.4k | 536896041U, // XXBRQ |
3868 | 71.4k | 536898823U, // XXBRW |
3869 | 71.4k | 28171U, // XXEXTRACTUW |
3870 | 71.4k | 2818600353U, // XXINSERTW |
3871 | 71.4k | 20437U, // XXLAND |
3872 | 71.4k | 19927U, // XXLANDC |
3873 | 71.4k | 27105U, // XXLEQV |
3874 | 71.4k | 20445U, // XXLNAND |
3875 | 71.4k | 25377U, // XXLNOR |
3876 | 71.4k | 25370U, // XXLOR |
3877 | 71.4k | 20035U, // XXLORC |
3878 | 71.4k | 25370U, // XXLORf |
3879 | 71.4k | 25411U, // XXLXOR |
3880 | 71.4k | 117465923U, // XXLXORdpz |
3881 | 71.4k | 117465923U, // XXLXORspz |
3882 | 71.4k | 117465923U, // XXLXORz |
3883 | 71.4k | 27590U, // XXMRGHW |
3884 | 71.4k | 27632U, // XXMRGLW |
3885 | 71.4k | 22686U, // XXPERM |
3886 | 71.4k | 21543U, // XXPERMDI |
3887 | 71.4k | 21543U, // XXPERMDIs |
3888 | 71.4k | 25361U, // XXPERMR |
3889 | 71.4k | 22308U, // XXSEL |
3890 | 71.4k | 22009U, // XXSLDWI |
3891 | 71.4k | 22009U, // XXSLDWIs |
3892 | 71.4k | 369118283U, // XXSPLTIB |
3893 | 71.4k | 28036U, // XXSPLTW |
3894 | 71.4k | 28036U, // XXSPLTWs |
3895 | 71.4k | 183757U, // gBC |
3896 | 71.4k | 182770U, // gBCA |
3897 | 71.4k | 9747975U, // gBCAat |
3898 | 71.4k | 189329U, // gBCCTR |
3899 | 71.4k | 186184U, // gBCCTRL |
3900 | 71.4k | 186092U, // gBCL |
3901 | 71.4k | 183064U, // gBCLA |
3902 | 71.4k | 9747991U, // gBCLAat |
3903 | 71.4k | 189147U, // gBCLR |
3904 | 71.4k | 186177U, // gBCLRL |
3905 | 71.4k | 10272384U, // gBCLat |
3906 | 71.4k | 10272292U, // gBCat |
3907 | 71.4k | }; |
3908 | | |
3909 | 71.4k | static const uint16_t OpInfo1[] = { |
3910 | 71.4k | 0U, // PHI |
3911 | 71.4k | 0U, // INLINEASM |
3912 | 71.4k | 0U, // CFI_INSTRUCTION |
3913 | 71.4k | 0U, // EH_LABEL |
3914 | 71.4k | 0U, // GC_LABEL |
3915 | 71.4k | 0U, // ANNOTATION_LABEL |
3916 | 71.4k | 0U, // KILL |
3917 | 71.4k | 0U, // EXTRACT_SUBREG |
3918 | 71.4k | 0U, // INSERT_SUBREG |
3919 | 71.4k | 0U, // IMPLICIT_DEF |
3920 | 71.4k | 0U, // SUBREG_TO_REG |
3921 | 71.4k | 0U, // COPY_TO_REGCLASS |
3922 | 71.4k | 0U, // DBG_VALUE |
3923 | 71.4k | 0U, // DBG_LABEL |
3924 | 71.4k | 0U, // REG_SEQUENCE |
3925 | 71.4k | 0U, // COPY |
3926 | 71.4k | 0U, // BUNDLE |
3927 | 71.4k | 0U, // LIFETIME_START |
3928 | 71.4k | 0U, // LIFETIME_END |
3929 | 71.4k | 0U, // STACKMAP |
3930 | 71.4k | 0U, // FENTRY_CALL |
3931 | 71.4k | 0U, // PATCHPOINT |
3932 | 71.4k | 0U, // LOAD_STACK_GUARD |
3933 | 71.4k | 0U, // STATEPOINT |
3934 | 71.4k | 0U, // LOCAL_ESCAPE |
3935 | 71.4k | 0U, // FAULTING_OP |
3936 | 71.4k | 0U, // PATCHABLE_OP |
3937 | 71.4k | 0U, // PATCHABLE_FUNCTION_ENTER |
3938 | 71.4k | 0U, // PATCHABLE_RET |
3939 | 71.4k | 0U, // PATCHABLE_FUNCTION_EXIT |
3940 | 71.4k | 0U, // PATCHABLE_TAIL_CALL |
3941 | 71.4k | 0U, // PATCHABLE_EVENT_CALL |
3942 | 71.4k | 0U, // PATCHABLE_TYPED_EVENT_CALL |
3943 | 71.4k | 0U, // ICALL_BRANCH_FUNNEL |
3944 | 71.4k | 0U, // G_ADD |
3945 | 71.4k | 0U, // G_SUB |
3946 | 71.4k | 0U, // G_MUL |
3947 | 71.4k | 0U, // G_SDIV |
3948 | 71.4k | 0U, // G_UDIV |
3949 | 71.4k | 0U, // G_SREM |
3950 | 71.4k | 0U, // G_UREM |
3951 | 71.4k | 0U, // G_AND |
3952 | 71.4k | 0U, // G_OR |
3953 | 71.4k | 0U, // G_XOR |
3954 | 71.4k | 0U, // G_IMPLICIT_DEF |
3955 | 71.4k | 0U, // G_PHI |
3956 | 71.4k | 0U, // G_FRAME_INDEX |
3957 | 71.4k | 0U, // G_GLOBAL_VALUE |
3958 | 71.4k | 0U, // G_EXTRACT |
3959 | 71.4k | 0U, // G_UNMERGE_VALUES |
3960 | 71.4k | 0U, // G_INSERT |
3961 | 71.4k | 0U, // G_MERGE_VALUES |
3962 | 71.4k | 0U, // G_PTRTOINT |
3963 | 71.4k | 0U, // G_INTTOPTR |
3964 | 71.4k | 0U, // G_BITCAST |
3965 | 71.4k | 0U, // G_LOAD |
3966 | 71.4k | 0U, // G_SEXTLOAD |
3967 | 71.4k | 0U, // G_ZEXTLOAD |
3968 | 71.4k | 0U, // G_STORE |
3969 | 71.4k | 0U, // G_ATOMIC_CMPXCHG_WITH_SUCCESS |
3970 | 71.4k | 0U, // G_ATOMIC_CMPXCHG |
3971 | 71.4k | 0U, // G_ATOMICRMW_XCHG |
3972 | 71.4k | 0U, // G_ATOMICRMW_ADD |
3973 | 71.4k | 0U, // G_ATOMICRMW_SUB |
3974 | 71.4k | 0U, // G_ATOMICRMW_AND |
3975 | 71.4k | 0U, // G_ATOMICRMW_NAND |
3976 | 71.4k | 0U, // G_ATOMICRMW_OR |
3977 | 71.4k | 0U, // G_ATOMICRMW_XOR |
3978 | 71.4k | 0U, // G_ATOMICRMW_MAX |
3979 | 71.4k | 0U, // G_ATOMICRMW_MIN |
3980 | 71.4k | 0U, // G_ATOMICRMW_UMAX |
3981 | 71.4k | 0U, // G_ATOMICRMW_UMIN |
3982 | 71.4k | 0U, // G_BRCOND |
3983 | 71.4k | 0U, // G_BRINDIRECT |
3984 | 71.4k | 0U, // G_INTRINSIC |
3985 | 71.4k | 0U, // G_INTRINSIC_W_SIDE_EFFECTS |
3986 | 71.4k | 0U, // G_ANYEXT |
3987 | 71.4k | 0U, // G_TRUNC |
3988 | 71.4k | 0U, // G_CONSTANT |
3989 | 71.4k | 0U, // G_FCONSTANT |
3990 | 71.4k | 0U, // G_VASTART |
3991 | 71.4k | 0U, // G_VAARG |
3992 | 71.4k | 0U, // G_SEXT |
3993 | 71.4k | 0U, // G_ZEXT |
3994 | 71.4k | 0U, // G_SHL |
3995 | 71.4k | 0U, // G_LSHR |
3996 | 71.4k | 0U, // G_ASHR |
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3998 | 71.4k | 0U, // G_FCMP |
3999 | 71.4k | 0U, // G_SELECT |
4000 | 71.4k | 0U, // G_UADDE |
4001 | 71.4k | 0U, // G_USUBE |
4002 | 71.4k | 0U, // G_SADDO |
4003 | 71.4k | 0U, // G_SSUBO |
4004 | 71.4k | 0U, // G_UMULO |
4005 | 71.4k | 0U, // G_SMULO |
4006 | 71.4k | 0U, // G_UMULH |
4007 | 71.4k | 0U, // G_SMULH |
4008 | 71.4k | 0U, // G_FADD |
4009 | 71.4k | 0U, // G_FSUB |
4010 | 71.4k | 0U, // G_FMUL |
4011 | 71.4k | 0U, // G_FMA |
4012 | 71.4k | 0U, // G_FDIV |
4013 | 71.4k | 0U, // G_FREM |
4014 | 71.4k | 0U, // G_FPOW |
4015 | 71.4k | 0U, // G_FEXP |
4016 | 71.4k | 0U, // G_FEXP2 |
4017 | 71.4k | 0U, // G_FLOG |
4018 | 71.4k | 0U, // G_FLOG2 |
4019 | 71.4k | 0U, // G_FNEG |
4020 | 71.4k | 0U, // G_FPEXT |
4021 | 71.4k | 0U, // G_FPTRUNC |
4022 | 71.4k | 0U, // G_FPTOSI |
4023 | 71.4k | 0U, // G_FPTOUI |
4024 | 71.4k | 0U, // G_SITOFP |
4025 | 71.4k | 0U, // G_UITOFP |
4026 | 71.4k | 0U, // G_FABS |
4027 | 71.4k | 0U, // G_GEP |
4028 | 71.4k | 0U, // G_PTR_MASK |
4029 | 71.4k | 0U, // G_BR |
4030 | 71.4k | 0U, // G_INSERT_VECTOR_ELT |
4031 | 71.4k | 0U, // G_EXTRACT_VECTOR_ELT |
4032 | 71.4k | 0U, // G_SHUFFLE_VECTOR |
4033 | 71.4k | 0U, // G_BSWAP |
4034 | 71.4k | 0U, // G_ADDRSPACE_CAST |
4035 | 71.4k | 0U, // G_BLOCK_ADDR |
4036 | 71.4k | 0U, // CFENCE8 |
4037 | 71.4k | 0U, // CLRLSLDI |
4038 | 71.4k | 0U, // CLRLSLDIo |
4039 | 71.4k | 66U, // CLRLSLWI |
4040 | 71.4k | 66U, // CLRLSLWIo |
4041 | 71.4k | 32U, // CLRRDI |
4042 | 71.4k | 32U, // CLRRDIo |
4043 | 71.4k | 34U, // CLRRWI |
4044 | 71.4k | 34U, // CLRRWIo |
4045 | 71.4k | 0U, // CP_COPY_FIRST |
4046 | 71.4k | 0U, // CP_COPYx |
4047 | 71.4k | 0U, // CP_PASTE_LAST |
4048 | 71.4k | 0U, // CP_PASTEx |
4049 | 71.4k | 0U, // DCBFL |
4050 | 71.4k | 0U, // DCBFLP |
4051 | 71.4k | 0U, // DCBFx |
4052 | 71.4k | 0U, // DCBTCT |
4053 | 71.4k | 0U, // DCBTDS |
4054 | 71.4k | 0U, // DCBTSTCT |
4055 | 71.4k | 0U, // DCBTSTDS |
4056 | 71.4k | 0U, // DCBTSTT |
4057 | 71.4k | 0U, // DCBTSTx |
4058 | 71.4k | 0U, // DCBTT |
4059 | 71.4k | 0U, // DCBTx |
4060 | 71.4k | 0U, // DFLOADf32 |
4061 | 71.4k | 0U, // DFLOADf64 |
4062 | 71.4k | 0U, // DFSTOREf32 |
4063 | 71.4k | 0U, // DFSTOREf64 |
4064 | 71.4k | 0U, // EXTLDI |
4065 | 71.4k | 0U, // EXTLDIo |
4066 | 71.4k | 66U, // EXTLWI |
4067 | 71.4k | 66U, // EXTLWIo |
4068 | 71.4k | 0U, // EXTRDI |
4069 | 71.4k | 0U, // EXTRDIo |
4070 | 71.4k | 66U, // EXTRWI |
4071 | 71.4k | 66U, // EXTRWIo |
4072 | 71.4k | 66U, // INSLWI |
4073 | 71.4k | 66U, // INSLWIo |
4074 | 71.4k | 0U, // INSRDI |
4075 | 71.4k | 0U, // INSRDIo |
4076 | 71.4k | 66U, // INSRWI |
4077 | 71.4k | 66U, // INSRWIo |
4078 | 71.4k | 0U, // LAx |
4079 | 71.4k | 0U, // LIWAX |
4080 | 71.4k | 0U, // LIWZX |
4081 | 71.4k | 130U, // RLWIMIbm |
4082 | 71.4k | 130U, // RLWIMIobm |
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4084 | 71.4k | 130U, // RLWINMobm |
4085 | 71.4k | 130U, // RLWNMbm |
4086 | 71.4k | 130U, // RLWNMobm |
4087 | 71.4k | 32U, // ROTRDI |
4088 | 71.4k | 32U, // ROTRDIo |
4089 | 71.4k | 34U, // ROTRWI |
4090 | 71.4k | 34U, // ROTRWIo |
4091 | 71.4k | 32U, // SLDI |
4092 | 71.4k | 32U, // SLDIo |
4093 | 71.4k | 34U, // SLWI |
4094 | 71.4k | 34U, // SLWIo |
4095 | 71.4k | 0U, // SPILLTOVSR_LD |
4096 | 71.4k | 0U, // SPILLTOVSR_LDX |
4097 | 71.4k | 0U, // SPILLTOVSR_ST |
4098 | 71.4k | 0U, // SPILLTOVSR_STX |
4099 | 71.4k | 32U, // SRDI |
4100 | 71.4k | 32U, // SRDIo |
4101 | 71.4k | 34U, // SRWI |
4102 | 71.4k | 34U, // SRWIo |
4103 | 71.4k | 0U, // STIWX |
4104 | 71.4k | 4U, // SUBI |
4105 | 71.4k | 4U, // SUBIC |
4106 | 71.4k | 4U, // SUBICo |
4107 | 71.4k | 4U, // SUBIS |
4108 | 71.4k | 0U, // SUBPCIS |
4109 | 71.4k | 0U, // XFLOADf32 |
4110 | 71.4k | 0U, // XFLOADf64 |
4111 | 71.4k | 0U, // XFSTOREf32 |
4112 | 71.4k | 0U, // XFSTOREf64 |
4113 | 71.4k | 38U, // ADD4 |
4114 | 71.4k | 38U, // ADD4TLS |
4115 | 71.4k | 38U, // ADD4o |
4116 | 71.4k | 38U, // ADD8 |
4117 | 71.4k | 38U, // ADD8TLS |
4118 | 71.4k | 38U, // ADD8TLS_ |
4119 | 71.4k | 38U, // ADD8o |
4120 | 71.4k | 38U, // ADDC |
4121 | 71.4k | 38U, // ADDC8 |
4122 | 71.4k | 38U, // ADDC8o |
4123 | 71.4k | 38U, // ADDCo |
4124 | 71.4k | 38U, // ADDE |
4125 | 71.4k | 38U, // ADDE8 |
4126 | 71.4k | 38U, // ADDE8o |
4127 | 71.4k | 38U, // ADDEo |
4128 | 71.4k | 4U, // ADDI |
4129 | 71.4k | 4U, // ADDI8 |
4130 | 71.4k | 4U, // ADDIC |
4131 | 71.4k | 4U, // ADDIC8 |
4132 | 71.4k | 4U, // ADDICo |
4133 | 71.4k | 4U, // ADDIS |
4134 | 71.4k | 4U, // ADDIS8 |
4135 | 71.4k | 0U, // ADDISdtprelHA |
4136 | 71.4k | 0U, // ADDISdtprelHA32 |
4137 | 71.4k | 0U, // ADDISgotTprelHA |
4138 | 71.4k | 0U, // ADDIStlsgdHA |
4139 | 71.4k | 0U, // ADDIStlsldHA |
4140 | 71.4k | 0U, // ADDIStocHA |
4141 | 71.4k | 0U, // ADDIdtprelL |
4142 | 71.4k | 0U, // ADDIdtprelL32 |
4143 | 71.4k | 0U, // ADDItlsgdL |
4144 | 71.4k | 0U, // ADDItlsgdL32 |
4145 | 71.4k | 0U, // ADDItlsgdLADDR |
4146 | 71.4k | 0U, // ADDItlsgdLADDR32 |
4147 | 71.4k | 0U, // ADDItlsldL |
4148 | 71.4k | 0U, // ADDItlsldL32 |
4149 | 71.4k | 0U, // ADDItlsldLADDR |
4150 | 71.4k | 0U, // ADDItlsldLADDR32 |
4151 | 71.4k | 0U, // ADDItocL |
4152 | 71.4k | 0U, // ADDME |
4153 | 71.4k | 0U, // ADDME8 |
4154 | 71.4k | 0U, // ADDME8o |
4155 | 71.4k | 0U, // ADDMEo |
4156 | 71.4k | 0U, // ADDPCIS |
4157 | 71.4k | 0U, // ADDZE |
4158 | 71.4k | 0U, // ADDZE8 |
4159 | 71.4k | 0U, // ADDZE8o |
4160 | 71.4k | 0U, // ADDZEo |
4161 | 71.4k | 0U, // ADJCALLSTACKDOWN |
4162 | 71.4k | 0U, // ADJCALLSTACKUP |
4163 | 71.4k | 38U, // AND |
4164 | 71.4k | 38U, // AND8 |
4165 | 71.4k | 38U, // AND8o |
4166 | 71.4k | 38U, // ANDC |
4167 | 71.4k | 38U, // ANDC8 |
4168 | 71.4k | 38U, // ANDC8o |
4169 | 71.4k | 38U, // ANDCo |
4170 | 71.4k | 8U, // ANDISo |
4171 | 71.4k | 8U, // ANDISo8 |
4172 | 71.4k | 8U, // ANDIo |
4173 | 71.4k | 8U, // ANDIo8 |
4174 | 71.4k | 0U, // ANDIo_1_EQ_BIT |
4175 | 71.4k | 0U, // ANDIo_1_EQ_BIT8 |
4176 | 71.4k | 0U, // ANDIo_1_GT_BIT |
4177 | 71.4k | 0U, // ANDIo_1_GT_BIT8 |
4178 | 71.4k | 38U, // ANDo |
4179 | 71.4k | 0U, // ATOMIC_CMP_SWAP_I16 |
4180 | 71.4k | 0U, // ATOMIC_CMP_SWAP_I32 |
4181 | 71.4k | 0U, // ATOMIC_CMP_SWAP_I64 |
4182 | 71.4k | 0U, // ATOMIC_CMP_SWAP_I8 |
4183 | 71.4k | 0U, // ATOMIC_LOAD_ADD_I16 |
4184 | 71.4k | 0U, // ATOMIC_LOAD_ADD_I32 |
4185 | 71.4k | 0U, // ATOMIC_LOAD_ADD_I64 |
4186 | 71.4k | 0U, // ATOMIC_LOAD_ADD_I8 |
4187 | 71.4k | 0U, // ATOMIC_LOAD_AND_I16 |
4188 | 71.4k | 0U, // ATOMIC_LOAD_AND_I32 |
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4190 | 71.4k | 0U, // ATOMIC_LOAD_AND_I8 |
4191 | 71.4k | 0U, // ATOMIC_LOAD_MAX_I16 |
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4194 | 71.4k | 0U, // ATOMIC_LOAD_MAX_I8 |
4195 | 71.4k | 0U, // ATOMIC_LOAD_MIN_I16 |
4196 | 71.4k | 0U, // ATOMIC_LOAD_MIN_I32 |
4197 | 71.4k | 0U, // ATOMIC_LOAD_MIN_I64 |
4198 | 71.4k | 0U, // ATOMIC_LOAD_MIN_I8 |
4199 | 71.4k | 0U, // ATOMIC_LOAD_NAND_I16 |
4200 | 71.4k | 0U, // ATOMIC_LOAD_NAND_I32 |
4201 | 71.4k | 0U, // ATOMIC_LOAD_NAND_I64 |
4202 | 71.4k | 0U, // ATOMIC_LOAD_NAND_I8 |
4203 | 71.4k | 0U, // ATOMIC_LOAD_OR_I16 |
4204 | 71.4k | 0U, // ATOMIC_LOAD_OR_I32 |
4205 | 71.4k | 0U, // ATOMIC_LOAD_OR_I64 |
4206 | 71.4k | 0U, // ATOMIC_LOAD_OR_I8 |
4207 | 71.4k | 0U, // ATOMIC_LOAD_SUB_I16 |
4208 | 71.4k | 0U, // ATOMIC_LOAD_SUB_I32 |
4209 | 71.4k | 0U, // ATOMIC_LOAD_SUB_I64 |
4210 | 71.4k | 0U, // ATOMIC_LOAD_SUB_I8 |
4211 | 71.4k | 0U, // ATOMIC_LOAD_UMAX_I16 |
4212 | 71.4k | 0U, // ATOMIC_LOAD_UMAX_I32 |
4213 | 71.4k | 0U, // ATOMIC_LOAD_UMAX_I64 |
4214 | 71.4k | 0U, // ATOMIC_LOAD_UMAX_I8 |
4215 | 71.4k | 0U, // ATOMIC_LOAD_UMIN_I16 |
4216 | 71.4k | 0U, // ATOMIC_LOAD_UMIN_I32 |
4217 | 71.4k | 0U, // ATOMIC_LOAD_UMIN_I64 |
4218 | 71.4k | 0U, // ATOMIC_LOAD_UMIN_I8 |
4219 | 71.4k | 0U, // ATOMIC_LOAD_XOR_I16 |
4220 | 71.4k | 0U, // ATOMIC_LOAD_XOR_I32 |
4221 | 71.4k | 0U, // ATOMIC_LOAD_XOR_I64 |
4222 | 71.4k | 0U, // ATOMIC_LOAD_XOR_I8 |
4223 | 71.4k | 0U, // ATOMIC_SWAP_I16 |
4224 | 71.4k | 0U, // ATOMIC_SWAP_I32 |
4225 | 71.4k | 0U, // ATOMIC_SWAP_I64 |
4226 | 71.4k | 0U, // ATOMIC_SWAP_I8 |
4227 | 71.4k | 0U, // ATTN |
4228 | 71.4k | 0U, // B |
4229 | 71.4k | 0U, // BA |
4230 | 71.4k | 0U, // BC |
4231 | 71.4k | 0U, // BCC |
4232 | 71.4k | 0U, // BCCA |
4233 | 71.4k | 0U, // BCCCTR |
4234 | 71.4k | 0U, // BCCCTR8 |
4235 | 71.4k | 0U, // BCCCTRL |
4236 | 71.4k | 0U, // BCCCTRL8 |
4237 | 71.4k | 0U, // BCCL |
4238 | 71.4k | 0U, // BCCLA |
4239 | 71.4k | 0U, // BCCLR |
4240 | 71.4k | 0U, // BCCLRL |
4241 | 71.4k | 0U, // BCCTR |
4242 | 71.4k | 0U, // BCCTR8 |
4243 | 71.4k | 0U, // BCCTR8n |
4244 | 71.4k | 0U, // BCCTRL |
4245 | 71.4k | 0U, // BCCTRL8 |
4246 | 71.4k | 0U, // BCCTRL8n |
4247 | 71.4k | 0U, // BCCTRLn |
4248 | 71.4k | 0U, // BCCTRn |
4249 | 71.4k | 42U, // BCDCFNo |
4250 | 71.4k | 42U, // BCDCFSQo |
4251 | 71.4k | 42U, // BCDCFZo |
4252 | 71.4k | 38U, // BCDCPSGNo |
4253 | 71.4k | 0U, // BCDCTNo |
4254 | 71.4k | 0U, // BCDCTSQo |
4255 | 71.4k | 42U, // BCDCTZo |
4256 | 71.4k | 42U, // BCDSETSGNo |
4257 | 71.4k | 198U, // BCDSRo |
4258 | 71.4k | 198U, // BCDSo |
4259 | 71.4k | 198U, // BCDTRUNCo |
4260 | 71.4k | 38U, // BCDUSo |
4261 | 71.4k | 38U, // BCDUTRUNCo |
4262 | 71.4k | 0U, // BCL |
4263 | 71.4k | 0U, // BCLR |
4264 | 71.4k | 0U, // BCLRL |
4265 | 71.4k | 0U, // BCLRLn |
4266 | 71.4k | 0U, // BCLRn |
4267 | 71.4k | 0U, // BCLalways |
4268 | 71.4k | 0U, // BCLn |
4269 | 71.4k | 0U, // BCTR |
4270 | 71.4k | 0U, // BCTR8 |
4271 | 71.4k | 0U, // BCTRL |
4272 | 71.4k | 0U, // BCTRL8 |
4273 | 71.4k | 0U, // BCTRL8_LDinto_toc |
4274 | 71.4k | 0U, // BCn |
4275 | 71.4k | 0U, // BDNZ |
4276 | 71.4k | 0U, // BDNZ8 |
4277 | 71.4k | 0U, // BDNZA |
4278 | 71.4k | 0U, // BDNZAm |
4279 | 71.4k | 0U, // BDNZAp |
4280 | 71.4k | 0U, // BDNZL |
4281 | 71.4k | 0U, // BDNZLA |
4282 | 71.4k | 0U, // BDNZLAm |
4283 | 71.4k | 0U, // BDNZLAp |
4284 | 71.4k | 0U, // BDNZLR |
4285 | 71.4k | 0U, // BDNZLR8 |
4286 | 71.4k | 0U, // BDNZLRL |
4287 | 71.4k | 0U, // BDNZLRLm |
4288 | 71.4k | 0U, // BDNZLRLp |
4289 | 71.4k | 0U, // BDNZLRm |
4290 | 71.4k | 0U, // BDNZLRp |
4291 | 71.4k | 0U, // BDNZLm |
4292 | 71.4k | 0U, // BDNZLp |
4293 | 71.4k | 0U, // BDNZm |
4294 | 71.4k | 0U, // BDNZp |
4295 | 71.4k | 0U, // BDZ |
4296 | 71.4k | 0U, // BDZ8 |
4297 | 71.4k | 0U, // BDZA |
4298 | 71.4k | 0U, // BDZAm |
4299 | 71.4k | 0U, // BDZAp |
4300 | 71.4k | 0U, // BDZL |
4301 | 71.4k | 0U, // BDZLA |
4302 | 71.4k | 0U, // BDZLAm |
4303 | 71.4k | 0U, // BDZLAp |
4304 | 71.4k | 0U, // BDZLR |
4305 | 71.4k | 0U, // BDZLR8 |
4306 | 71.4k | 0U, // BDZLRL |
4307 | 71.4k | 0U, // BDZLRLm |
4308 | 71.4k | 0U, // BDZLRLp |
4309 | 71.4k | 0U, // BDZLRm |
4310 | 71.4k | 0U, // BDZLRp |
4311 | 71.4k | 0U, // BDZLm |
4312 | 71.4k | 0U, // BDZLp |
4313 | 71.4k | 0U, // BDZm |
4314 | 71.4k | 0U, // BDZp |
4315 | 71.4k | 0U, // BL |
4316 | 71.4k | 0U, // BL8 |
4317 | 71.4k | 0U, // BL8_NOP |
4318 | 71.4k | 0U, // BL8_NOP_TLS |
4319 | 71.4k | 0U, // BL8_TLS |
4320 | 71.4k | 0U, // BL8_TLS_ |
4321 | 71.4k | 0U, // BLA |
4322 | 71.4k | 0U, // BLA8 |
4323 | 71.4k | 0U, // BLA8_NOP |
4324 | 71.4k | 0U, // BLR |
4325 | 71.4k | 0U, // BLR8 |
4326 | 71.4k | 0U, // BLRL |
4327 | 71.4k | 0U, // BL_TLS |
4328 | 71.4k | 38U, // BPERMD |
4329 | 71.4k | 38U, // BRINC |
4330 | 71.4k | 0U, // CLRBHRB |
4331 | 71.4k | 38U, // CMPB |
4332 | 71.4k | 38U, // CMPB8 |
4333 | 71.4k | 38U, // CMPD |
4334 | 71.4k | 4U, // CMPDI |
4335 | 71.4k | 38U, // CMPEQB |
4336 | 71.4k | 38U, // CMPLD |
4337 | 71.4k | 8U, // CMPLDI |
4338 | 71.4k | 38U, // CMPLW |
4339 | 71.4k | 8U, // CMPLWI |
4340 | 71.4k | 0U, // CMPRB |
4341 | 71.4k | 0U, // CMPRB8 |
4342 | 71.4k | 38U, // CMPW |
4343 | 71.4k | 4U, // CMPWI |
4344 | 71.4k | 0U, // CNTLZD |
4345 | 71.4k | 0U, // CNTLZDo |
4346 | 71.4k | 0U, // CNTLZW |
4347 | 71.4k | 0U, // CNTLZW8 |
4348 | 71.4k | 0U, // CNTLZW8o |
4349 | 71.4k | 0U, // CNTLZWo |
4350 | 71.4k | 0U, // CNTTZD |
4351 | 71.4k | 0U, // CNTTZDo |
4352 | 71.4k | 0U, // CNTTZW |
4353 | 71.4k | 0U, // CNTTZW8 |
4354 | 71.4k | 0U, // CNTTZW8o |
4355 | 71.4k | 0U, // CNTTZWo |
4356 | 71.4k | 0U, // CP_ABORT |
4357 | 71.4k | 42U, // CP_COPY |
4358 | 71.4k | 42U, // CP_COPY8 |
4359 | 71.4k | 42U, // CP_PASTE |
4360 | 71.4k | 42U, // CP_PASTE8 |
4361 | 71.4k | 42U, // CP_PASTE8o |
4362 | 71.4k | 42U, // CP_PASTEo |
4363 | 71.4k | 0U, // CR6SET |
4364 | 71.4k | 0U, // CR6UNSET |
4365 | 71.4k | 38U, // CRAND |
4366 | 71.4k | 38U, // CRANDC |
4367 | 71.4k | 38U, // CREQV |
4368 | 71.4k | 38U, // CRNAND |
4369 | 71.4k | 38U, // CRNOR |
4370 | 71.4k | 38U, // CROR |
4371 | 71.4k | 38U, // CRORC |
4372 | 71.4k | 12U, // CRSET |
4373 | 71.4k | 12U, // CRUNSET |
4374 | 71.4k | 38U, // CRXOR |
4375 | 71.4k | 0U, // CTRL_DEP |
4376 | 71.4k | 0U, // DARN |
4377 | 71.4k | 0U, // DCBA |
4378 | 71.4k | 0U, // DCBF |
4379 | 71.4k | 0U, // DCBFEP |
4380 | 71.4k | 0U, // DCBI |
4381 | 71.4k | 0U, // DCBST |
4382 | 71.4k | 0U, // DCBSTEP |
4383 | 71.4k | 0U, // DCBT |
4384 | 71.4k | 0U, // DCBTEP |
4385 | 71.4k | 0U, // DCBTST |
4386 | 71.4k | 0U, // DCBTSTEP |
4387 | 71.4k | 0U, // DCBZ |
4388 | 71.4k | 0U, // DCBZEP |
4389 | 71.4k | 0U, // DCBZL |
4390 | 71.4k | 0U, // DCBZLEP |
4391 | 71.4k | 0U, // DCCCI |
4392 | 71.4k | 38U, // DIVD |
4393 | 71.4k | 38U, // DIVDE |
4394 | 71.4k | 38U, // DIVDEU |
4395 | 71.4k | 38U, // DIVDEUo |
4396 | 71.4k | 38U, // DIVDEo |
4397 | 71.4k | 38U, // DIVDU |
4398 | 71.4k | 38U, // DIVDUo |
4399 | 71.4k | 38U, // DIVDo |
4400 | 71.4k | 38U, // DIVW |
4401 | 71.4k | 38U, // DIVWE |
4402 | 71.4k | 38U, // DIVWEU |
4403 | 71.4k | 38U, // DIVWEUo |
4404 | 71.4k | 38U, // DIVWEo |
4405 | 71.4k | 38U, // DIVWU |
4406 | 71.4k | 38U, // DIVWUo |
4407 | 71.4k | 38U, // DIVWo |
4408 | 71.4k | 0U, // DSS |
4409 | 71.4k | 0U, // DSSALL |
4410 | 71.4k | 0U, // DST |
4411 | 71.4k | 0U, // DST64 |
4412 | 71.4k | 0U, // DSTST |
4413 | 71.4k | 0U, // DSTST64 |
4414 | 71.4k | 0U, // DSTSTT |
4415 | 71.4k | 0U, // DSTSTT64 |
4416 | 71.4k | 0U, // DSTT |
4417 | 71.4k | 0U, // DSTT64 |
4418 | 71.4k | 0U, // DYNALLOC |
4419 | 71.4k | 0U, // DYNALLOC8 |
4420 | 71.4k | 0U, // DYNAREAOFFSET |
4421 | 71.4k | 0U, // DYNAREAOFFSET8 |
4422 | 71.4k | 0U, // EFDABS |
4423 | 71.4k | 38U, // EFDADD |
4424 | 71.4k | 0U, // EFDCFS |
4425 | 71.4k | 0U, // EFDCFSF |
4426 | 71.4k | 0U, // EFDCFSI |
4427 | 71.4k | 0U, // EFDCFSID |
4428 | 71.4k | 0U, // EFDCFUF |
4429 | 71.4k | 0U, // EFDCFUI |
4430 | 71.4k | 0U, // EFDCFUID |
4431 | 71.4k | 38U, // EFDCMPEQ |
4432 | 71.4k | 38U, // EFDCMPGT |
4433 | 71.4k | 38U, // EFDCMPLT |
4434 | 71.4k | 0U, // EFDCTSF |
4435 | 71.4k | 0U, // EFDCTSI |
4436 | 71.4k | 0U, // EFDCTSIDZ |
4437 | 71.4k | 0U, // EFDCTSIZ |
4438 | 71.4k | 0U, // EFDCTUF |
4439 | 71.4k | 0U, // EFDCTUI |
4440 | 71.4k | 0U, // EFDCTUIDZ |
4441 | 71.4k | 0U, // EFDCTUIZ |
4442 | 71.4k | 38U, // EFDDIV |
4443 | 71.4k | 38U, // EFDMUL |
4444 | 71.4k | 0U, // EFDNABS |
4445 | 71.4k | 0U, // EFDNEG |
4446 | 71.4k | 38U, // EFDSUB |
4447 | 71.4k | 38U, // EFDTSTEQ |
4448 | 71.4k | 38U, // EFDTSTGT |
4449 | 71.4k | 38U, // EFDTSTLT |
4450 | 71.4k | 0U, // EFSABS |
4451 | 71.4k | 38U, // EFSADD |
4452 | 71.4k | 0U, // EFSCFD |
4453 | 71.4k | 0U, // EFSCFSF |
4454 | 71.4k | 0U, // EFSCFSI |
4455 | 71.4k | 0U, // EFSCFUF |
4456 | 71.4k | 0U, // EFSCFUI |
4457 | 71.4k | 38U, // EFSCMPEQ |
4458 | 71.4k | 38U, // EFSCMPGT |
4459 | 71.4k | 38U, // EFSCMPLT |
4460 | 71.4k | 0U, // EFSCTSF |
4461 | 71.4k | 0U, // EFSCTSI |
4462 | 71.4k | 0U, // EFSCTSIZ |
4463 | 71.4k | 0U, // EFSCTUF |
4464 | 71.4k | 0U, // EFSCTUI |
4465 | 71.4k | 0U, // EFSCTUIZ |
4466 | 71.4k | 38U, // EFSDIV |
4467 | 71.4k | 38U, // EFSMUL |
4468 | 71.4k | 0U, // EFSNABS |
4469 | 71.4k | 0U, // EFSNEG |
4470 | 71.4k | 38U, // EFSSUB |
4471 | 71.4k | 38U, // EFSTSTEQ |
4472 | 71.4k | 38U, // EFSTSTGT |
4473 | 71.4k | 38U, // EFSTSTLT |
4474 | 71.4k | 0U, // EH_SjLj_LongJmp32 |
4475 | 71.4k | 0U, // EH_SjLj_LongJmp64 |
4476 | 71.4k | 0U, // EH_SjLj_SetJmp32 |
4477 | 71.4k | 0U, // EH_SjLj_SetJmp64 |
4478 | 71.4k | 0U, // EH_SjLj_Setup |
4479 | 71.4k | 38U, // EQV |
4480 | 71.4k | 38U, // EQV8 |
4481 | 71.4k | 38U, // EQV8o |
4482 | 71.4k | 38U, // EQVo |
4483 | 71.4k | 0U, // EVABS |
4484 | 71.4k | 46U, // EVADDIW |
4485 | 71.4k | 0U, // EVADDSMIAAW |
4486 | 71.4k | 0U, // EVADDSSIAAW |
4487 | 71.4k | 0U, // EVADDUMIAAW |
4488 | 71.4k | 0U, // EVADDUSIAAW |
4489 | 71.4k | 38U, // EVADDW |
4490 | 71.4k | 38U, // EVAND |
4491 | 71.4k | 38U, // EVANDC |
4492 | 71.4k | 38U, // EVCMPEQ |
4493 | 71.4k | 38U, // EVCMPGTS |
4494 | 71.4k | 38U, // EVCMPGTU |
4495 | 71.4k | 38U, // EVCMPLTS |
4496 | 71.4k | 38U, // EVCMPLTU |
4497 | 71.4k | 0U, // EVCNTLSW |
4498 | 71.4k | 0U, // EVCNTLZW |
4499 | 71.4k | 38U, // EVDIVWS |
4500 | 71.4k | 38U, // EVDIVWU |
4501 | 71.4k | 38U, // EVEQV |
4502 | 71.4k | 0U, // EVEXTSB |
4503 | 71.4k | 0U, // EVEXTSH |
4504 | 71.4k | 0U, // EVFSABS |
4505 | 71.4k | 38U, // EVFSADD |
4506 | 71.4k | 0U, // EVFSCFSF |
4507 | 71.4k | 0U, // EVFSCFSI |
4508 | 71.4k | 0U, // EVFSCFUF |
4509 | 71.4k | 0U, // EVFSCFUI |
4510 | 71.4k | 38U, // EVFSCMPEQ |
4511 | 71.4k | 38U, // EVFSCMPGT |
4512 | 71.4k | 38U, // EVFSCMPLT |
4513 | 71.4k | 0U, // EVFSCTSF |
4514 | 71.4k | 0U, // EVFSCTSI |
4515 | 71.4k | 0U, // EVFSCTSIZ |
4516 | 71.4k | 0U, // EVFSCTUF |
4517 | 71.4k | 0U, // EVFSCTUI |
4518 | 71.4k | 0U, // EVFSCTUIZ |
4519 | 71.4k | 38U, // EVFSDIV |
4520 | 71.4k | 38U, // EVFSMUL |
4521 | 71.4k | 0U, // EVFSNABS |
4522 | 71.4k | 0U, // EVFSNEG |
4523 | 71.4k | 38U, // EVFSSUB |
4524 | 71.4k | 38U, // EVFSTSTEQ |
4525 | 71.4k | 38U, // EVFSTSTGT |
4526 | 71.4k | 38U, // EVFSTSTLT |
4527 | 71.4k | 0U, // EVLDD |
4528 | 71.4k | 0U, // EVLDDX |
4529 | 71.4k | 0U, // EVLDH |
4530 | 71.4k | 0U, // EVLDHX |
4531 | 71.4k | 0U, // EVLDW |
4532 | 71.4k | 0U, // EVLDWX |
4533 | 71.4k | 0U, // EVLHHESPLAT |
4534 | 71.4k | 0U, // EVLHHESPLATX |
4535 | 71.4k | 0U, // EVLHHOSSPLAT |
4536 | 71.4k | 0U, // EVLHHOSSPLATX |
4537 | 71.4k | 0U, // EVLHHOUSPLAT |
4538 | 71.4k | 0U, // EVLHHOUSPLATX |
4539 | 71.4k | 0U, // EVLWHE |
4540 | 71.4k | 0U, // EVLWHEX |
4541 | 71.4k | 0U, // EVLWHOS |
4542 | 71.4k | 0U, // EVLWHOSX |
4543 | 71.4k | 0U, // EVLWHOU |
4544 | 71.4k | 0U, // EVLWHOUX |
4545 | 71.4k | 0U, // EVLWHSPLAT |
4546 | 71.4k | 0U, // EVLWHSPLATX |
4547 | 71.4k | 0U, // EVLWWSPLAT |
4548 | 71.4k | 0U, // EVLWWSPLATX |
4549 | 71.4k | 38U, // EVMERGEHI |
4550 | 71.4k | 38U, // EVMERGEHILO |
4551 | 71.4k | 38U, // EVMERGELO |
4552 | 71.4k | 38U, // EVMERGELOHI |
4553 | 71.4k | 38U, // EVMHEGSMFAA |
4554 | 71.4k | 38U, // EVMHEGSMFAN |
4555 | 71.4k | 38U, // EVMHEGSMIAA |
4556 | 71.4k | 38U, // EVMHEGSMIAN |
4557 | 71.4k | 38U, // EVMHEGUMIAA |
4558 | 71.4k | 38U, // EVMHEGUMIAN |
4559 | 71.4k | 38U, // EVMHESMF |
4560 | 71.4k | 38U, // EVMHESMFA |
4561 | 71.4k | 38U, // EVMHESMFAAW |
4562 | 71.4k | 38U, // EVMHESMFANW |
4563 | 71.4k | 38U, // EVMHESMI |
4564 | 71.4k | 38U, // EVMHESMIA |
4565 | 71.4k | 38U, // EVMHESMIAAW |
4566 | 71.4k | 38U, // EVMHESMIANW |
4567 | 71.4k | 38U, // EVMHESSF |
4568 | 71.4k | 38U, // EVMHESSFA |
4569 | 71.4k | 38U, // EVMHESSFAAW |
4570 | 71.4k | 38U, // EVMHESSFANW |
4571 | 71.4k | 38U, // EVMHESSIAAW |
4572 | 71.4k | 38U, // EVMHESSIANW |
4573 | 71.4k | 38U, // EVMHEUMI |
4574 | 71.4k | 38U, // EVMHEUMIA |
4575 | 71.4k | 38U, // EVMHEUMIAAW |
4576 | 71.4k | 38U, // EVMHEUMIANW |
4577 | 71.4k | 38U, // EVMHEUSIAAW |
4578 | 71.4k | 38U, // EVMHEUSIANW |
4579 | 71.4k | 38U, // EVMHOGSMFAA |
4580 | 71.4k | 38U, // EVMHOGSMFAN |
4581 | 71.4k | 38U, // EVMHOGSMIAA |
4582 | 71.4k | 38U, // EVMHOGSMIAN |
4583 | 71.4k | 38U, // EVMHOGUMIAA |
4584 | 71.4k | 38U, // EVMHOGUMIAN |
4585 | 71.4k | 38U, // EVMHOSMF |
4586 | 71.4k | 38U, // EVMHOSMFA |
4587 | 71.4k | 38U, // EVMHOSMFAAW |
4588 | 71.4k | 38U, // EVMHOSMFANW |
4589 | 71.4k | 38U, // EVMHOSMI |
4590 | 71.4k | 38U, // EVMHOSMIA |
4591 | 71.4k | 38U, // EVMHOSMIAAW |
4592 | 71.4k | 38U, // EVMHOSMIANW |
4593 | 71.4k | 38U, // EVMHOSSF |
4594 | 71.4k | 38U, // EVMHOSSFA |
4595 | 71.4k | 38U, // EVMHOSSFAAW |
4596 | 71.4k | 38U, // EVMHOSSFANW |
4597 | 71.4k | 38U, // EVMHOSSIAAW |
4598 | 71.4k | 38U, // EVMHOSSIANW |
4599 | 71.4k | 38U, // EVMHOUMI |
4600 | 71.4k | 38U, // EVMHOUMIA |
4601 | 71.4k | 38U, // EVMHOUMIAAW |
4602 | 71.4k | 38U, // EVMHOUMIANW |
4603 | 71.4k | 38U, // EVMHOUSIAAW |
4604 | 71.4k | 38U, // EVMHOUSIANW |
4605 | 71.4k | 0U, // EVMRA |
4606 | 71.4k | 38U, // EVMWHSMF |
4607 | 71.4k | 38U, // EVMWHSMFA |
4608 | 71.4k | 38U, // EVMWHSMI |
4609 | 71.4k | 38U, // EVMWHSMIA |
4610 | 71.4k | 38U, // EVMWHSSF |
4611 | 71.4k | 38U, // EVMWHSSFA |
4612 | 71.4k | 38U, // EVMWHUMI |
4613 | 71.4k | 38U, // EVMWHUMIA |
4614 | 71.4k | 38U, // EVMWLSMIAAW |
4615 | 71.4k | 38U, // EVMWLSMIANW |
4616 | 71.4k | 38U, // EVMWLSSIAAW |
4617 | 71.4k | 38U, // EVMWLSSIANW |
4618 | 71.4k | 38U, // EVMWLUMI |
4619 | 71.4k | 38U, // EVMWLUMIA |
4620 | 71.4k | 38U, // EVMWLUMIAAW |
4621 | 71.4k | 38U, // EVMWLUMIANW |
4622 | 71.4k | 38U, // EVMWLUSIAAW |
4623 | 71.4k | 38U, // EVMWLUSIANW |
4624 | 71.4k | 38U, // EVMWSMF |
4625 | 71.4k | 38U, // EVMWSMFA |
4626 | 71.4k | 38U, // EVMWSMFAA |
4627 | 71.4k | 38U, // EVMWSMFAN |
4628 | 71.4k | 38U, // EVMWSMI |
4629 | 71.4k | 38U, // EVMWSMIA |
4630 | 71.4k | 38U, // EVMWSMIAA |
4631 | 71.4k | 38U, // EVMWSMIAN |
4632 | 71.4k | 38U, // EVMWSSF |
4633 | 71.4k | 38U, // EVMWSSFA |
4634 | 71.4k | 38U, // EVMWSSFAA |
4635 | 71.4k | 38U, // EVMWSSFAN |
4636 | 71.4k | 38U, // EVMWUMI |
4637 | 71.4k | 38U, // EVMWUMIA |
4638 | 71.4k | 38U, // EVMWUMIAA |
4639 | 71.4k | 38U, // EVMWUMIAN |
4640 | 71.4k | 38U, // EVNAND |
4641 | 71.4k | 0U, // EVNEG |
4642 | 71.4k | 38U, // EVNOR |
4643 | 71.4k | 38U, // EVOR |
4644 | 71.4k | 38U, // EVORC |
4645 | 71.4k | 38U, // EVRLW |
4646 | 71.4k | 34U, // EVRLWI |
4647 | 71.4k | 0U, // EVRNDW |
4648 | 71.4k | 0U, // EVSEL |
4649 | 71.4k | 38U, // EVSLW |
4650 | 71.4k | 34U, // EVSLWI |
4651 | 71.4k | 0U, // EVSPLATFI |
4652 | 71.4k | 0U, // EVSPLATI |
4653 | 71.4k | 34U, // EVSRWIS |
4654 | 71.4k | 34U, // EVSRWIU |
4655 | 71.4k | 38U, // EVSRWS |
4656 | 71.4k | 38U, // EVSRWU |
4657 | 71.4k | 0U, // EVSTDD |
4658 | 71.4k | 0U, // EVSTDDX |
4659 | 71.4k | 0U, // EVSTDH |
4660 | 71.4k | 0U, // EVSTDHX |
4661 | 71.4k | 0U, // EVSTDW |
4662 | 71.4k | 0U, // EVSTDWX |
4663 | 71.4k | 0U, // EVSTWHE |
4664 | 71.4k | 0U, // EVSTWHEX |
4665 | 71.4k | 0U, // EVSTWHO |
4666 | 71.4k | 0U, // EVSTWHOX |
4667 | 71.4k | 0U, // EVSTWWE |
4668 | 71.4k | 0U, // EVSTWWEX |
4669 | 71.4k | 0U, // EVSTWWO |
4670 | 71.4k | 0U, // EVSTWWOX |
4671 | 71.4k | 0U, // EVSUBFSMIAAW |
4672 | 71.4k | 0U, // EVSUBFSSIAAW |
4673 | 71.4k | 0U, // EVSUBFUMIAAW |
4674 | 71.4k | 0U, // EVSUBFUSIAAW |
4675 | 71.4k | 38U, // EVSUBFW |
4676 | 71.4k | 0U, // EVSUBIFW |
4677 | 71.4k | 38U, // EVXOR |
4678 | 71.4k | 0U, // EXTSB |
4679 | 71.4k | 0U, // EXTSB8 |
4680 | 71.4k | 0U, // EXTSB8_32_64 |
4681 | 71.4k | 0U, // EXTSB8o |
4682 | 71.4k | 0U, // EXTSBo |
4683 | 71.4k | 0U, // EXTSH |
4684 | 71.4k | 0U, // EXTSH8 |
4685 | 71.4k | 0U, // EXTSH8_32_64 |
4686 | 71.4k | 0U, // EXTSH8o |
4687 | 71.4k | 0U, // EXTSHo |
4688 | 71.4k | 0U, // EXTSW |
4689 | 71.4k | 32U, // EXTSWSLI |
4690 | 71.4k | 32U, // EXTSWSLIo |
4691 | 71.4k | 0U, // EXTSW_32 |
4692 | 71.4k | 0U, // EXTSW_32_64 |
4693 | 71.4k | 0U, // EXTSW_32_64o |
4694 | 71.4k | 0U, // EXTSWo |
4695 | 71.4k | 0U, // EnforceIEIO |
4696 | 71.4k | 0U, // FABSD |
4697 | 71.4k | 0U, // FABSDo |
4698 | 71.4k | 0U, // FABSS |
4699 | 71.4k | 0U, // FABSSo |
4700 | 71.4k | 38U, // FADD |
4701 | 71.4k | 38U, // FADDS |
4702 | 71.4k | 38U, // FADDSo |
4703 | 71.4k | 38U, // FADDo |
4704 | 71.4k | 0U, // FADDrtz |
4705 | 71.4k | 0U, // FCFID |
4706 | 71.4k | 0U, // FCFIDS |
4707 | 71.4k | 0U, // FCFIDSo |
4708 | 71.4k | 0U, // FCFIDU |
4709 | 71.4k | 0U, // FCFIDUS |
4710 | 71.4k | 0U, // FCFIDUSo |
4711 | 71.4k | 0U, // FCFIDUo |
4712 | 71.4k | 0U, // FCFIDo |
4713 | 71.4k | 38U, // FCMPUD |
4714 | 71.4k | 38U, // FCMPUS |
4715 | 71.4k | 38U, // FCPSGND |
4716 | 71.4k | 38U, // FCPSGNDo |
4717 | 71.4k | 38U, // FCPSGNS |
4718 | 71.4k | 38U, // FCPSGNSo |
4719 | 71.4k | 0U, // FCTID |
4720 | 71.4k | 0U, // FCTIDU |
4721 | 71.4k | 0U, // FCTIDUZ |
4722 | 71.4k | 0U, // FCTIDUZo |
4723 | 71.4k | 0U, // FCTIDUo |
4724 | 71.4k | 0U, // FCTIDZ |
4725 | 71.4k | 0U, // FCTIDZo |
4726 | 71.4k | 0U, // FCTIDo |
4727 | 71.4k | 0U, // FCTIW |
4728 | 71.4k | 0U, // FCTIWU |
4729 | 71.4k | 0U, // FCTIWUZ |
4730 | 71.4k | 0U, // FCTIWUZo |
4731 | 71.4k | 0U, // FCTIWUo |
4732 | 71.4k | 0U, // FCTIWZ |
4733 | 71.4k | 0U, // FCTIWZo |
4734 | 71.4k | 0U, // FCTIWo |
4735 | 71.4k | 38U, // FDIV |
4736 | 71.4k | 38U, // FDIVS |
4737 | 71.4k | 38U, // FDIVSo |
4738 | 71.4k | 38U, // FDIVo |
4739 | 71.4k | 134U, // FMADD |
4740 | 71.4k | 134U, // FMADDS |
4741 | 71.4k | 134U, // FMADDSo |
4742 | 71.4k | 134U, // FMADDo |
4743 | 71.4k | 0U, // FMR |
4744 | 71.4k | 0U, // FMRo |
4745 | 71.4k | 134U, // FMSUB |
4746 | 71.4k | 134U, // FMSUBS |
4747 | 71.4k | 134U, // FMSUBSo |
4748 | 71.4k | 134U, // FMSUBo |
4749 | 71.4k | 38U, // FMUL |
4750 | 71.4k | 38U, // FMULS |
4751 | 71.4k | 38U, // FMULSo |
4752 | 71.4k | 38U, // FMULo |
4753 | 71.4k | 0U, // FNABSD |
4754 | 71.4k | 0U, // FNABSDo |
4755 | 71.4k | 0U, // FNABSS |
4756 | 71.4k | 0U, // FNABSSo |
4757 | 71.4k | 0U, // FNEGD |
4758 | 71.4k | 0U, // FNEGDo |
4759 | 71.4k | 0U, // FNEGS |
4760 | 71.4k | 0U, // FNEGSo |
4761 | 71.4k | 134U, // FNMADD |
4762 | 71.4k | 134U, // FNMADDS |
4763 | 71.4k | 134U, // FNMADDSo |
4764 | 71.4k | 134U, // FNMADDo |
4765 | 71.4k | 134U, // FNMSUB |
4766 | 71.4k | 134U, // FNMSUBS |
4767 | 71.4k | 134U, // FNMSUBSo |
4768 | 71.4k | 134U, // FNMSUBo |
4769 | 71.4k | 0U, // FRE |
4770 | 71.4k | 0U, // FRES |
4771 | 71.4k | 0U, // FRESo |
4772 | 71.4k | 0U, // FREo |
4773 | 71.4k | 0U, // FRIMD |
4774 | 71.4k | 0U, // FRIMDo |
4775 | 71.4k | 0U, // FRIMS |
4776 | 71.4k | 0U, // FRIMSo |
4777 | 71.4k | 0U, // FRIND |
4778 | 71.4k | 0U, // FRINDo |
4779 | 71.4k | 0U, // FRINS |
4780 | 71.4k | 0U, // FRINSo |
4781 | 71.4k | 0U, // FRIPD |
4782 | 71.4k | 0U, // FRIPDo |
4783 | 71.4k | 0U, // FRIPS |
4784 | 71.4k | 0U, // FRIPSo |
4785 | 71.4k | 0U, // FRIZD |
4786 | 71.4k | 0U, // FRIZDo |
4787 | 71.4k | 0U, // FRIZS |
4788 | 71.4k | 0U, // FRIZSo |
4789 | 71.4k | 0U, // FRSP |
4790 | 71.4k | 0U, // FRSPo |
4791 | 71.4k | 0U, // FRSQRTE |
4792 | 71.4k | 0U, // FRSQRTES |
4793 | 71.4k | 0U, // FRSQRTESo |
4794 | 71.4k | 0U, // FRSQRTEo |
4795 | 71.4k | 134U, // FSELD |
4796 | 71.4k | 134U, // FSELDo |
4797 | 71.4k | 134U, // FSELS |
4798 | 71.4k | 134U, // FSELSo |
4799 | 71.4k | 0U, // FSQRT |
4800 | 71.4k | 0U, // FSQRTS |
4801 | 71.4k | 0U, // FSQRTSo |
4802 | 71.4k | 0U, // FSQRTo |
4803 | 71.4k | 38U, // FSUB |
4804 | 71.4k | 38U, // FSUBS |
4805 | 71.4k | 38U, // FSUBSo |
4806 | 71.4k | 38U, // FSUBo |
4807 | 71.4k | 38U, // FTDIV |
4808 | 71.4k | 0U, // FTSQRT |
4809 | 71.4k | 0U, // GETtlsADDR |
4810 | 71.4k | 0U, // GETtlsADDR32 |
4811 | 71.4k | 0U, // GETtlsldADDR |
4812 | 71.4k | 0U, // GETtlsldADDR32 |
4813 | 71.4k | 0U, // HRFID |
4814 | 71.4k | 0U, // ICBI |
4815 | 71.4k | 0U, // ICBIEP |
4816 | 71.4k | 0U, // ICBLC |
4817 | 71.4k | 0U, // ICBLQ |
4818 | 71.4k | 0U, // ICBT |
4819 | 71.4k | 0U, // ICBTLS |
4820 | 71.4k | 0U, // ICCCI |
4821 | 71.4k | 134U, // ISEL |
4822 | 71.4k | 134U, // ISEL8 |
4823 | 71.4k | 0U, // ISYNC |
4824 | 71.4k | 0U, // LA |
4825 | 71.4k | 0U, // LBARX |
4826 | 71.4k | 0U, // LBARXL |
4827 | 71.4k | 0U, // LBEPX |
4828 | 71.4k | 0U, // LBZ |
4829 | 71.4k | 0U, // LBZ8 |
4830 | 71.4k | 38U, // LBZCIX |
4831 | 71.4k | 0U, // LBZU |
4832 | 71.4k | 0U, // LBZU8 |
4833 | 71.4k | 0U, // LBZUX |
4834 | 71.4k | 0U, // LBZUX8 |
4835 | 71.4k | 0U, // LBZX |
4836 | 71.4k | 0U, // LBZX8 |
4837 | 71.4k | 38U, // LBZXTLS |
4838 | 71.4k | 38U, // LBZXTLS_ |
4839 | 71.4k | 38U, // LBZXTLS_32 |
4840 | 71.4k | 0U, // LD |
4841 | 71.4k | 0U, // LDARX |
4842 | 71.4k | 0U, // LDARXL |
4843 | 71.4k | 34U, // LDAT |
4844 | 71.4k | 0U, // LDBRX |
4845 | 71.4k | 38U, // LDCIX |
4846 | 71.4k | 0U, // LDMX |
4847 | 71.4k | 0U, // LDU |
4848 | 71.4k | 0U, // LDUX |
4849 | 71.4k | 0U, // LDX |
4850 | 71.4k | 38U, // LDXTLS |
4851 | 71.4k | 38U, // LDXTLS_ |
4852 | 71.4k | 0U, // LDgotTprelL |
4853 | 71.4k | 0U, // LDgotTprelL32 |
4854 | 71.4k | 0U, // LDtoc |
4855 | 71.4k | 0U, // LDtocBA |
4856 | 71.4k | 0U, // LDtocCPT |
4857 | 71.4k | 0U, // LDtocJTI |
4858 | 71.4k | 0U, // LDtocL |
4859 | 71.4k | 0U, // LFD |
4860 | 71.4k | 0U, // LFDEPX |
4861 | 71.4k | 0U, // LFDU |
4862 | 71.4k | 0U, // LFDUX |
4863 | 71.4k | 0U, // LFDX |
4864 | 71.4k | 0U, // LFIWAX |
4865 | 71.4k | 0U, // LFIWZX |
4866 | 71.4k | 0U, // LFS |
4867 | 71.4k | 0U, // LFSU |
4868 | 71.4k | 0U, // LFSUX |
4869 | 71.4k | 0U, // LFSX |
4870 | 71.4k | 0U, // LHA |
4871 | 71.4k | 0U, // LHA8 |
4872 | 71.4k | 0U, // LHARX |
4873 | 71.4k | 0U, // LHARXL |
4874 | 71.4k | 0U, // LHAU |
4875 | 71.4k | 0U, // LHAU8 |
4876 | 71.4k | 0U, // LHAUX |
4877 | 71.4k | 0U, // LHAUX8 |
4878 | 71.4k | 0U, // LHAX |
4879 | 71.4k | 0U, // LHAX8 |
4880 | 71.4k | 0U, // LHBRX |
4881 | 71.4k | 0U, // LHBRX8 |
4882 | 71.4k | 0U, // LHEPX |
4883 | 71.4k | 0U, // LHZ |
4884 | 71.4k | 0U, // LHZ8 |
4885 | 71.4k | 38U, // LHZCIX |
4886 | 71.4k | 0U, // LHZU |
4887 | 71.4k | 0U, // LHZU8 |
4888 | 71.4k | 0U, // LHZUX |
4889 | 71.4k | 0U, // LHZUX8 |
4890 | 71.4k | 0U, // LHZX |
4891 | 71.4k | 0U, // LHZX8 |
4892 | 71.4k | 38U, // LHZXTLS |
4893 | 71.4k | 38U, // LHZXTLS_ |
4894 | 71.4k | 38U, // LHZXTLS_32 |
4895 | 71.4k | 0U, // LI |
4896 | 71.4k | 0U, // LI8 |
4897 | 71.4k | 0U, // LIS |
4898 | 71.4k | 0U, // LIS8 |
4899 | 71.4k | 0U, // LMW |
4900 | 71.4k | 34U, // LSWI |
4901 | 71.4k | 0U, // LVEBX |
4902 | 71.4k | 0U, // LVEHX |
4903 | 71.4k | 0U, // LVEWX |
4904 | 71.4k | 0U, // LVSL |
4905 | 71.4k | 0U, // LVSR |
4906 | 71.4k | 0U, // LVX |
4907 | 71.4k | 0U, // LVXL |
4908 | 71.4k | 0U, // LWA |
4909 | 71.4k | 0U, // LWARX |
4910 | 71.4k | 0U, // LWARXL |
4911 | 71.4k | 34U, // LWAT |
4912 | 71.4k | 0U, // LWAUX |
4913 | 71.4k | 0U, // LWAX |
4914 | 71.4k | 0U, // LWAX_32 |
4915 | 71.4k | 0U, // LWA_32 |
4916 | 71.4k | 0U, // LWBRX |
4917 | 71.4k | 0U, // LWBRX8 |
4918 | 71.4k | 0U, // LWEPX |
4919 | 71.4k | 0U, // LWZ |
4920 | 71.4k | 0U, // LWZ8 |
4921 | 71.4k | 38U, // LWZCIX |
4922 | 71.4k | 0U, // LWZU |
4923 | 71.4k | 0U, // LWZU8 |
4924 | 71.4k | 0U, // LWZUX |
4925 | 71.4k | 0U, // LWZUX8 |
4926 | 71.4k | 0U, // LWZX |
4927 | 71.4k | 0U, // LWZX8 |
4928 | 71.4k | 38U, // LWZXTLS |
4929 | 71.4k | 38U, // LWZXTLS_ |
4930 | 71.4k | 38U, // LWZXTLS_32 |
4931 | 71.4k | 0U, // LWZtoc |
4932 | 71.4k | 0U, // LXSD |
4933 | 71.4k | 0U, // LXSDX |
4934 | 71.4k | 0U, // LXSIBZX |
4935 | 71.4k | 0U, // LXSIHZX |
4936 | 71.4k | 0U, // LXSIWAX |
4937 | 71.4k | 0U, // LXSIWZX |
4938 | 71.4k | 0U, // LXSSP |
4939 | 71.4k | 0U, // LXSSPX |
4940 | 71.4k | 0U, // LXV |
4941 | 71.4k | 0U, // LXVB16X |
4942 | 71.4k | 0U, // LXVD2X |
4943 | 71.4k | 0U, // LXVDSX |
4944 | 71.4k | 0U, // LXVH8X |
4945 | 71.4k | 38U, // LXVL |
4946 | 71.4k | 38U, // LXVLL |
4947 | 71.4k | 0U, // LXVW4X |
4948 | 71.4k | 0U, // LXVWSX |
4949 | 71.4k | 0U, // LXVX |
4950 | 71.4k | 134U, // MADDHD |
4951 | 71.4k | 134U, // MADDHDU |
4952 | 71.4k | 134U, // MADDLD |
4953 | 71.4k | 0U, // MBAR |
4954 | 71.4k | 0U, // MCRF |
4955 | 71.4k | 0U, // MCRFS |
4956 | 71.4k | 0U, // MCRXRX |
4957 | 71.4k | 0U, // MFBHRBE |
4958 | 71.4k | 0U, // MFCR |
4959 | 71.4k | 0U, // MFCR8 |
4960 | 71.4k | 0U, // MFCTR |
4961 | 71.4k | 0U, // MFCTR8 |
4962 | 71.4k | 0U, // MFDCR |
4963 | 71.4k | 0U, // MFFS |
4964 | 71.4k | 0U, // MFFSCDRN |
4965 | 71.4k | 0U, // MFFSCDRNI |
4966 | 71.4k | 0U, // MFFSCE |
4967 | 71.4k | 0U, // MFFSCRN |
4968 | 71.4k | 0U, // MFFSCRNI |
4969 | 71.4k | 0U, // MFFSL |
4970 | 71.4k | 0U, // MFFSo |
4971 | 71.4k | 0U, // MFLR |
4972 | 71.4k | 0U, // MFLR8 |
4973 | 71.4k | 0U, // MFMSR |
4974 | 71.4k | 0U, // MFOCRF |
4975 | 71.4k | 0U, // MFOCRF8 |
4976 | 71.4k | 0U, // MFPMR |
4977 | 71.4k | 0U, // MFSPR |
4978 | 71.4k | 0U, // MFSPR8 |
4979 | 71.4k | 0U, // MFSR |
4980 | 71.4k | 0U, // MFSRIN |
4981 | 71.4k | 0U, // MFTB |
4982 | 71.4k | 0U, // MFTB8 |
4983 | 71.4k | 0U, // MFVRD |
4984 | 71.4k | 0U, // MFVRSAVE |
4985 | 71.4k | 0U, // MFVRSAVEv |
4986 | 71.4k | 0U, // MFVSCR |
4987 | 71.4k | 0U, // MFVSRD |
4988 | 71.4k | 0U, // MFVSRLD |
4989 | 71.4k | 0U, // MFVSRWZ |
4990 | 71.4k | 38U, // MODSD |
4991 | 71.4k | 38U, // MODSW |
4992 | 71.4k | 38U, // MODUD |
4993 | 71.4k | 38U, // MODUW |
4994 | 71.4k | 0U, // MSGSYNC |
4995 | 71.4k | 0U, // MSYNC |
4996 | 71.4k | 0U, // MTCRF |
4997 | 71.4k | 0U, // MTCRF8 |
4998 | 71.4k | 0U, // MTCTR |
4999 | 71.4k | 0U, // MTCTR8 |
5000 | 71.4k | 0U, // MTCTR8loop |
5001 | 71.4k | 0U, // MTCTRloop |
5002 | 71.4k | 0U, // MTDCR |
5003 | 71.4k | 0U, // MTFSB0 |
5004 | 71.4k | 0U, // MTFSB1 |
5005 | 71.4k | 134U, // MTFSF |
5006 | 71.4k | 38U, // MTFSFI |
5007 | 71.4k | 38U, // MTFSFIo |
5008 | 71.4k | 0U, // MTFSFb |
5009 | 71.4k | 134U, // MTFSFo |
5010 | 71.4k | 0U, // MTLR |
5011 | 71.4k | 0U, // MTLR8 |
5012 | 71.4k | 0U, // MTMSR |
5013 | 71.4k | 0U, // MTMSRD |
5014 | 71.4k | 0U, // MTOCRF |
5015 | 71.4k | 0U, // MTOCRF8 |
5016 | 71.4k | 0U, // MTPMR |
5017 | 71.4k | 0U, // MTSPR |
5018 | 71.4k | 0U, // MTSPR8 |
5019 | 71.4k | 0U, // MTSR |
5020 | 71.4k | 0U, // MTSRIN |
5021 | 71.4k | 0U, // MTVRSAVE |
5022 | 71.4k | 0U, // MTVRSAVEv |
5023 | 71.4k | 0U, // MTVSCR |
5024 | 71.4k | 0U, // MTVSRD |
5025 | 71.4k | 38U, // MTVSRDD |
5026 | 71.4k | 0U, // MTVSRWA |
5027 | 71.4k | 0U, // MTVSRWS |
5028 | 71.4k | 0U, // MTVSRWZ |
5029 | 71.4k | 38U, // MULHD |
5030 | 71.4k | 38U, // MULHDU |
5031 | 71.4k | 38U, // MULHDUo |
5032 | 71.4k | 38U, // MULHDo |
5033 | 71.4k | 38U, // MULHW |
5034 | 71.4k | 38U, // MULHWU |
5035 | 71.4k | 38U, // MULHWUo |
5036 | 71.4k | 38U, // MULHWo |
5037 | 71.4k | 38U, // MULLD |
5038 | 71.4k | 38U, // MULLDo |
5039 | 71.4k | 4U, // MULLI |
5040 | 71.4k | 4U, // MULLI8 |
5041 | 71.4k | 38U, // MULLW |
5042 | 71.4k | 38U, // MULLWo |
5043 | 71.4k | 0U, // MoveGOTtoLR |
5044 | 71.4k | 0U, // MovePCtoLR |
5045 | 71.4k | 0U, // MovePCtoLR8 |
5046 | 71.4k | 38U, // NAND |
5047 | 71.4k | 38U, // NAND8 |
5048 | 71.4k | 38U, // NAND8o |
5049 | 71.4k | 38U, // NANDo |
5050 | 71.4k | 0U, // NAP |
5051 | 71.4k | 0U, // NEG |
5052 | 71.4k | 0U, // NEG8 |
5053 | 71.4k | 0U, // NEG8o |
5054 | 71.4k | 0U, // NEGo |
5055 | 71.4k | 0U, // NOP |
5056 | 71.4k | 0U, // NOP_GT_PWR6 |
5057 | 71.4k | 0U, // NOP_GT_PWR7 |
5058 | 71.4k | 38U, // NOR |
5059 | 71.4k | 38U, // NOR8 |
5060 | 71.4k | 38U, // NOR8o |
5061 | 71.4k | 38U, // NORo |
5062 | 71.4k | 38U, // OR |
5063 | 71.4k | 38U, // OR8 |
5064 | 71.4k | 38U, // OR8o |
5065 | 71.4k | 38U, // ORC |
5066 | 71.4k | 38U, // ORC8 |
5067 | 71.4k | 38U, // ORC8o |
5068 | 71.4k | 38U, // ORCo |
5069 | 71.4k | 8U, // ORI |
5070 | 71.4k | 8U, // ORI8 |
5071 | 71.4k | 8U, // ORIS |
5072 | 71.4k | 8U, // ORIS8 |
5073 | 71.4k | 38U, // ORo |
5074 | 71.4k | 0U, // POPCNTB |
5075 | 71.4k | 0U, // POPCNTD |
5076 | 71.4k | 0U, // POPCNTW |
5077 | 71.4k | 0U, // PPC32GOT |
5078 | 71.4k | 0U, // PPC32PICGOT |
5079 | 71.4k | 0U, // PSC_DCBZL |
5080 | 71.4k | 0U, // PSQ_L |
5081 | 71.4k | 0U, // PSQ_LU |
5082 | 71.4k | 710U, // PSQ_LUX |
5083 | 71.4k | 710U, // PSQ_LX |
5084 | 71.4k | 0U, // PSQ_ST |
5085 | 71.4k | 0U, // PSQ_STU |
5086 | 71.4k | 710U, // PSQ_STUX |
5087 | 71.4k | 710U, // PSQ_STX |
5088 | 71.4k | 0U, // PS_ABS |
5089 | 71.4k | 0U, // PS_ABSo |
5090 | 71.4k | 38U, // PS_ADD |
5091 | 71.4k | 38U, // PS_ADDo |
5092 | 71.4k | 38U, // PS_CMPO0 |
5093 | 71.4k | 38U, // PS_CMPO1 |
5094 | 71.4k | 38U, // PS_CMPU0 |
5095 | 71.4k | 38U, // PS_CMPU1 |
5096 | 71.4k | 38U, // PS_DIV |
5097 | 71.4k | 38U, // PS_DIVo |
5098 | 71.4k | 134U, // PS_MADD |
5099 | 71.4k | 134U, // PS_MADDS0 |
5100 | 71.4k | 134U, // PS_MADDS0o |
5101 | 71.4k | 134U, // PS_MADDS1 |
5102 | 71.4k | 134U, // PS_MADDS1o |
5103 | 71.4k | 134U, // PS_MADDo |
5104 | 71.4k | 38U, // PS_MERGE00 |
5105 | 71.4k | 38U, // PS_MERGE00o |
5106 | 71.4k | 38U, // PS_MERGE01 |
5107 | 71.4k | 38U, // PS_MERGE01o |
5108 | 71.4k | 38U, // PS_MERGE10 |
5109 | 71.4k | 38U, // PS_MERGE10o |
5110 | 71.4k | 38U, // PS_MERGE11 |
5111 | 71.4k | 38U, // PS_MERGE11o |
5112 | 71.4k | 0U, // PS_MR |
5113 | 71.4k | 0U, // PS_MRo |
5114 | 71.4k | 134U, // PS_MSUB |
5115 | 71.4k | 134U, // PS_MSUBo |
5116 | 71.4k | 38U, // PS_MUL |
5117 | 71.4k | 38U, // PS_MULS0 |
5118 | 71.4k | 38U, // PS_MULS0o |
5119 | 71.4k | 38U, // PS_MULS1 |
5120 | 71.4k | 38U, // PS_MULS1o |
5121 | 71.4k | 38U, // PS_MULo |
5122 | 71.4k | 0U, // PS_NABS |
5123 | 71.4k | 0U, // PS_NABSo |
5124 | 71.4k | 0U, // PS_NEG |
5125 | 71.4k | 0U, // PS_NEGo |
5126 | 71.4k | 134U, // PS_NMADD |
5127 | 71.4k | 134U, // PS_NMADDo |
5128 | 71.4k | 134U, // PS_NMSUB |
5129 | 71.4k | 134U, // PS_NMSUBo |
5130 | 71.4k | 0U, // PS_RES |
5131 | 71.4k | 0U, // PS_RESo |
5132 | 71.4k | 0U, // PS_RSQRTE |
5133 | 71.4k | 0U, // PS_RSQRTEo |
5134 | 71.4k | 134U, // PS_SEL |
5135 | 71.4k | 134U, // PS_SELo |
5136 | 71.4k | 38U, // PS_SUB |
5137 | 71.4k | 38U, // PS_SUBo |
5138 | 71.4k | 134U, // PS_SUM0 |
5139 | 71.4k | 134U, // PS_SUM0o |
5140 | 71.4k | 134U, // PS_SUM1 |
5141 | 71.4k | 134U, // PS_SUM1o |
5142 | 71.4k | 262U, // QVALIGNI |
5143 | 71.4k | 262U, // QVALIGNIb |
5144 | 71.4k | 262U, // QVALIGNIs |
5145 | 71.4k | 16U, // QVESPLATI |
5146 | 71.4k | 16U, // QVESPLATIb |
5147 | 71.4k | 16U, // QVESPLATIs |
5148 | 71.4k | 0U, // QVFABS |
5149 | 71.4k | 0U, // QVFABSs |
5150 | 71.4k | 38U, // QVFADD |
5151 | 71.4k | 38U, // QVFADDS |
5152 | 71.4k | 38U, // QVFADDSs |
5153 | 71.4k | 0U, // QVFCFID |
5154 | 71.4k | 0U, // QVFCFIDS |
5155 | 71.4k | 0U, // QVFCFIDU |
5156 | 71.4k | 0U, // QVFCFIDUS |
5157 | 71.4k | 0U, // QVFCFIDb |
5158 | 71.4k | 38U, // QVFCMPEQ |
5159 | 71.4k | 38U, // QVFCMPEQb |
5160 | 71.4k | 38U, // QVFCMPEQbs |
5161 | 71.4k | 38U, // QVFCMPGT |
5162 | 71.4k | 38U, // QVFCMPGTb |
5163 | 71.4k | 38U, // QVFCMPGTbs |
5164 | 71.4k | 38U, // QVFCMPLT |
5165 | 71.4k | 38U, // QVFCMPLTb |
5166 | 71.4k | 38U, // QVFCMPLTbs |
5167 | 71.4k | 38U, // QVFCPSGN |
5168 | 71.4k | 38U, // QVFCPSGNs |
5169 | 71.4k | 0U, // QVFCTID |
5170 | 71.4k | 0U, // QVFCTIDU |
5171 | 71.4k | 0U, // QVFCTIDUZ |
5172 | 71.4k | 0U, // QVFCTIDZ |
5173 | 71.4k | 0U, // QVFCTIDb |
5174 | 71.4k | 0U, // QVFCTIW |
5175 | 71.4k | 0U, // QVFCTIWU |
5176 | 71.4k | 0U, // QVFCTIWUZ |
5177 | 71.4k | 0U, // QVFCTIWZ |
5178 | 71.4k | 326U, // QVFLOGICAL |
5179 | 71.4k | 326U, // QVFLOGICALb |
5180 | 71.4k | 326U, // QVFLOGICALs |
5181 | 71.4k | 18U, // QVFMADD |
5182 | 71.4k | 18U, // QVFMADDS |
5183 | 71.4k | 18U, // QVFMADDSs |
5184 | 71.4k | 0U, // QVFMR |
5185 | 71.4k | 0U, // QVFMRb |
5186 | 71.4k | 0U, // QVFMRs |
5187 | 71.4k | 18U, // QVFMSUB |
5188 | 71.4k | 18U, // QVFMSUBS |
5189 | 71.4k | 18U, // QVFMSUBSs |
5190 | 71.4k | 38U, // QVFMUL |
5191 | 71.4k | 38U, // QVFMULS |
5192 | 71.4k | 38U, // QVFMULSs |
5193 | 71.4k | 0U, // QVFNABS |
5194 | 71.4k | 0U, // QVFNABSs |
5195 | 71.4k | 0U, // QVFNEG |
5196 | 71.4k | 0U, // QVFNEGs |
5197 | 71.4k | 18U, // QVFNMADD |
5198 | 71.4k | 18U, // QVFNMADDS |
5199 | 71.4k | 18U, // QVFNMADDSs |
5200 | 71.4k | 18U, // QVFNMSUB |
5201 | 71.4k | 18U, // QVFNMSUBS |
5202 | 71.4k | 18U, // QVFNMSUBSs |
5203 | 71.4k | 134U, // QVFPERM |
5204 | 71.4k | 134U, // QVFPERMs |
5205 | 71.4k | 0U, // QVFRE |
5206 | 71.4k | 0U, // QVFRES |
5207 | 71.4k | 0U, // QVFRESs |
5208 | 71.4k | 0U, // QVFRIM |
5209 | 71.4k | 0U, // QVFRIMs |
5210 | 71.4k | 0U, // QVFRIN |
5211 | 71.4k | 0U, // QVFRINs |
5212 | 71.4k | 0U, // QVFRIP |
5213 | 71.4k | 0U, // QVFRIPs |
5214 | 71.4k | 0U, // QVFRIZ |
5215 | 71.4k | 0U, // QVFRIZs |
5216 | 71.4k | 0U, // QVFRSP |
5217 | 71.4k | 0U, // QVFRSPs |
5218 | 71.4k | 0U, // QVFRSQRTE |
5219 | 71.4k | 0U, // QVFRSQRTES |
5220 | 71.4k | 0U, // QVFRSQRTESs |
5221 | 71.4k | 18U, // QVFSEL |
5222 | 71.4k | 18U, // QVFSELb |
5223 | 71.4k | 18U, // QVFSELbb |
5224 | 71.4k | 18U, // QVFSELbs |
5225 | 71.4k | 38U, // QVFSUB |
5226 | 71.4k | 38U, // QVFSUBS |
5227 | 71.4k | 38U, // QVFSUBSs |
5228 | 71.4k | 38U, // QVFTSTNAN |
5229 | 71.4k | 38U, // QVFTSTNANb |
5230 | 71.4k | 38U, // QVFTSTNANbs |
5231 | 71.4k | 18U, // QVFXMADD |
5232 | 71.4k | 18U, // QVFXMADDS |
5233 | 71.4k | 38U, // QVFXMUL |
5234 | 71.4k | 38U, // QVFXMULS |
5235 | 71.4k | 18U, // QVFXXCPNMADD |
5236 | 71.4k | 18U, // QVFXXCPNMADDS |
5237 | 71.4k | 18U, // QVFXXMADD |
5238 | 71.4k | 18U, // QVFXXMADDS |
5239 | 71.4k | 18U, // QVFXXNPMADD |
5240 | 71.4k | 18U, // QVFXXNPMADDS |
5241 | 71.4k | 0U, // QVGPCI |
5242 | 71.4k | 0U, // QVLFCDUX |
5243 | 71.4k | 0U, // QVLFCDUXA |
5244 | 71.4k | 0U, // QVLFCDX |
5245 | 71.4k | 0U, // QVLFCDXA |
5246 | 71.4k | 0U, // QVLFCSUX |
5247 | 71.4k | 0U, // QVLFCSUXA |
5248 | 71.4k | 0U, // QVLFCSX |
5249 | 71.4k | 0U, // QVLFCSXA |
5250 | 71.4k | 0U, // QVLFCSXs |
5251 | 71.4k | 0U, // QVLFDUX |
5252 | 71.4k | 0U, // QVLFDUXA |
5253 | 71.4k | 0U, // QVLFDX |
5254 | 71.4k | 0U, // QVLFDXA |
5255 | 71.4k | 0U, // QVLFDXb |
5256 | 71.4k | 0U, // QVLFIWAX |
5257 | 71.4k | 0U, // QVLFIWAXA |
5258 | 71.4k | 0U, // QVLFIWZX |
5259 | 71.4k | 0U, // QVLFIWZXA |
5260 | 71.4k | 0U, // QVLFSUX |
5261 | 71.4k | 0U, // QVLFSUXA |
5262 | 71.4k | 0U, // QVLFSX |
5263 | 71.4k | 0U, // QVLFSXA |
5264 | 71.4k | 0U, // QVLFSXb |
5265 | 71.4k | 0U, // QVLFSXs |
5266 | 71.4k | 0U, // QVLPCLDX |
5267 | 71.4k | 0U, // QVLPCLSX |
5268 | 71.4k | 0U, // QVLPCLSXint |
5269 | 71.4k | 0U, // QVLPCRDX |
5270 | 71.4k | 0U, // QVLPCRSX |
5271 | 71.4k | 0U, // QVSTFCDUX |
5272 | 71.4k | 0U, // QVSTFCDUXA |
5273 | 71.4k | 0U, // QVSTFCDUXI |
5274 | 71.4k | 0U, // QVSTFCDUXIA |
5275 | 71.4k | 0U, // QVSTFCDX |
5276 | 71.4k | 0U, // QVSTFCDXA |
5277 | 71.4k | 0U, // QVSTFCDXI |
5278 | 71.4k | 0U, // QVSTFCDXIA |
5279 | 71.4k | 0U, // QVSTFCSUX |
5280 | 71.4k | 0U, // QVSTFCSUXA |
5281 | 71.4k | 0U, // QVSTFCSUXI |
5282 | 71.4k | 0U, // QVSTFCSUXIA |
5283 | 71.4k | 0U, // QVSTFCSX |
5284 | 71.4k | 0U, // QVSTFCSXA |
5285 | 71.4k | 0U, // QVSTFCSXI |
5286 | 71.4k | 0U, // QVSTFCSXIA |
5287 | 71.4k | 0U, // QVSTFCSXs |
5288 | 71.4k | 0U, // QVSTFDUX |
5289 | 71.4k | 0U, // QVSTFDUXA |
5290 | 71.4k | 0U, // QVSTFDUXI |
5291 | 71.4k | 0U, // QVSTFDUXIA |
5292 | 71.4k | 0U, // QVSTFDX |
5293 | 71.4k | 0U, // QVSTFDXA |
5294 | 71.4k | 0U, // QVSTFDXI |
5295 | 71.4k | 0U, // QVSTFDXIA |
5296 | 71.4k | 0U, // QVSTFDXb |
5297 | 71.4k | 0U, // QVSTFIWX |
5298 | 71.4k | 0U, // QVSTFIWXA |
5299 | 71.4k | 0U, // QVSTFSUX |
5300 | 71.4k | 0U, // QVSTFSUXA |
5301 | 71.4k | 0U, // QVSTFSUXI |
5302 | 71.4k | 0U, // QVSTFSUXIA |
5303 | 71.4k | 0U, // QVSTFSUXs |
5304 | 71.4k | 0U, // QVSTFSX |
5305 | 71.4k | 0U, // QVSTFSXA |
5306 | 71.4k | 0U, // QVSTFSXI |
5307 | 71.4k | 0U, // QVSTFSXIA |
5308 | 71.4k | 0U, // QVSTFSXs |
5309 | 71.4k | 0U, // RESTORE_CR |
5310 | 71.4k | 0U, // RESTORE_CRBIT |
5311 | 71.4k | 0U, // RESTORE_VRSAVE |
5312 | 71.4k | 0U, // RFCI |
5313 | 71.4k | 0U, // RFDI |
5314 | 71.4k | 0U, // RFEBB |
5315 | 71.4k | 0U, // RFI |
5316 | 71.4k | 0U, // RFID |
5317 | 71.4k | 0U, // RFMCI |
5318 | 71.4k | 6U, // RLDCL |
5319 | 71.4k | 6U, // RLDCLo |
5320 | 71.4k | 6U, // RLDCR |
5321 | 71.4k | 6U, // RLDCRo |
5322 | 71.4k | 0U, // RLDIC |
5323 | 71.4k | 0U, // RLDICL |
5324 | 71.4k | 0U, // RLDICL_32 |
5325 | 71.4k | 0U, // RLDICL_32_64 |
5326 | 71.4k | 0U, // RLDICL_32o |
5327 | 71.4k | 0U, // RLDICLo |
5328 | 71.4k | 0U, // RLDICR |
5329 | 71.4k | 0U, // RLDICR_32 |
5330 | 71.4k | 0U, // RLDICRo |
5331 | 71.4k | 0U, // RLDICo |
5332 | 71.4k | 0U, // RLDIMI |
5333 | 71.4k | 0U, // RLDIMIo |
5334 | 71.4k | 0U, // RLWIMI |
5335 | 71.4k | 0U, // RLWIMI8 |
5336 | 71.4k | 0U, // RLWIMI8o |
5337 | 71.4k | 0U, // RLWIMIo |
5338 | 71.4k | 1602U, // RLWINM |
5339 | 71.4k | 1602U, // RLWINM8 |
5340 | 71.4k | 1602U, // RLWINM8o |
5341 | 71.4k | 1602U, // RLWINMo |
5342 | 71.4k | 1606U, // RLWNM |
5343 | 71.4k | 1606U, // RLWNM8 |
5344 | 71.4k | 1606U, // RLWNM8o |
5345 | 71.4k | 1606U, // RLWNMo |
5346 | 71.4k | 0U, // ReadTB |
5347 | 71.4k | 0U, // SC |
5348 | 71.4k | 0U, // SELECT_CC_F16 |
5349 | 71.4k | 0U, // SELECT_CC_F4 |
5350 | 71.4k | 0U, // SELECT_CC_F8 |
5351 | 71.4k | 0U, // SELECT_CC_I4 |
5352 | 71.4k | 0U, // SELECT_CC_I8 |
5353 | 71.4k | 0U, // SELECT_CC_QBRC |
5354 | 71.4k | 0U, // SELECT_CC_QFRC |
5355 | 71.4k | 0U, // SELECT_CC_QSRC |
5356 | 71.4k | 0U, // SELECT_CC_SPE |
5357 | 71.4k | 0U, // SELECT_CC_SPE4 |
5358 | 71.4k | 0U, // SELECT_CC_VRRC |
5359 | 71.4k | 0U, // SELECT_CC_VSFRC |
5360 | 71.4k | 0U, // SELECT_CC_VSRC |
5361 | 71.4k | 0U, // SELECT_CC_VSSRC |
5362 | 71.4k | 0U, // SELECT_F16 |
5363 | 71.4k | 0U, // SELECT_F4 |
5364 | 71.4k | 0U, // SELECT_F8 |
5365 | 71.4k | 0U, // SELECT_I4 |
5366 | 71.4k | 0U, // SELECT_I8 |
5367 | 71.4k | 0U, // SELECT_QBRC |
5368 | 71.4k | 0U, // SELECT_QFRC |
5369 | 71.4k | 0U, // SELECT_QSRC |
5370 | 71.4k | 0U, // SELECT_SPE |
5371 | 71.4k | 0U, // SELECT_SPE4 |
5372 | 71.4k | 0U, // SELECT_VRRC |
5373 | 71.4k | 0U, // SELECT_VSFRC |
5374 | 71.4k | 0U, // SELECT_VSRC |
5375 | 71.4k | 0U, // SELECT_VSSRC |
5376 | 71.4k | 0U, // SETB |
5377 | 71.4k | 0U, // SLBIA |
5378 | 71.4k | 0U, // SLBIE |
5379 | 71.4k | 0U, // SLBIEG |
5380 | 71.4k | 0U, // SLBMFEE |
5381 | 71.4k | 0U, // SLBMFEV |
5382 | 71.4k | 0U, // SLBMTE |
5383 | 71.4k | 0U, // SLBSYNC |
5384 | 71.4k | 38U, // SLD |
5385 | 71.4k | 38U, // SLDo |
5386 | 71.4k | 38U, // SLW |
5387 | 71.4k | 38U, // SLW8 |
5388 | 71.4k | 38U, // SLW8o |
5389 | 71.4k | 38U, // SLWo |
5390 | 71.4k | 0U, // SPELWZ |
5391 | 71.4k | 0U, // SPELWZX |
5392 | 71.4k | 0U, // SPESTW |
5393 | 71.4k | 0U, // SPESTWX |
5394 | 71.4k | 0U, // SPILL_CR |
5395 | 71.4k | 0U, // SPILL_CRBIT |
5396 | 71.4k | 0U, // SPILL_VRSAVE |
5397 | 71.4k | 38U, // SRAD |
5398 | 71.4k | 32U, // SRADI |
5399 | 71.4k | 32U, // SRADI_32 |
5400 | 71.4k | 32U, // SRADIo |
5401 | 71.4k | 38U, // SRADo |
5402 | 71.4k | 38U, // SRAW |
5403 | 71.4k | 34U, // SRAWI |
5404 | 71.4k | 34U, // SRAWIo |
5405 | 71.4k | 38U, // SRAWo |
5406 | 71.4k | 38U, // SRD |
5407 | 71.4k | 38U, // SRDo |
5408 | 71.4k | 38U, // SRW |
5409 | 71.4k | 38U, // SRW8 |
5410 | 71.4k | 38U, // SRW8o |
5411 | 71.4k | 38U, // SRWo |
5412 | 71.4k | 0U, // STB |
5413 | 71.4k | 0U, // STB8 |
5414 | 71.4k | 38U, // STBCIX |
5415 | 71.4k | 0U, // STBCX |
5416 | 71.4k | 0U, // STBEPX |
5417 | 71.4k | 0U, // STBU |
5418 | 71.4k | 0U, // STBU8 |
5419 | 71.4k | 0U, // STBUX |
5420 | 71.4k | 0U, // STBUX8 |
5421 | 71.4k | 0U, // STBX |
5422 | 71.4k | 0U, // STBX8 |
5423 | 71.4k | 38U, // STBXTLS |
5424 | 71.4k | 38U, // STBXTLS_ |
5425 | 71.4k | 38U, // STBXTLS_32 |
5426 | 71.4k | 0U, // STD |
5427 | 71.4k | 34U, // STDAT |
5428 | 71.4k | 0U, // STDBRX |
5429 | 71.4k | 38U, // STDCIX |
5430 | 71.4k | 0U, // STDCX |
5431 | 71.4k | 0U, // STDU |
5432 | 71.4k | 0U, // STDUX |
5433 | 71.4k | 0U, // STDX |
5434 | 71.4k | 38U, // STDXTLS |
5435 | 71.4k | 38U, // STDXTLS_ |
5436 | 71.4k | 0U, // STFD |
5437 | 71.4k | 0U, // STFDEPX |
5438 | 71.4k | 0U, // STFDU |
5439 | 71.4k | 0U, // STFDUX |
5440 | 71.4k | 0U, // STFDX |
5441 | 71.4k | 0U, // STFIWX |
5442 | 71.4k | 0U, // STFS |
5443 | 71.4k | 0U, // STFSU |
5444 | 71.4k | 0U, // STFSUX |
5445 | 71.4k | 0U, // STFSX |
5446 | 71.4k | 0U, // STH |
5447 | 71.4k | 0U, // STH8 |
5448 | 71.4k | 0U, // STHBRX |
5449 | 71.4k | 38U, // STHCIX |
5450 | 71.4k | 0U, // STHCX |
5451 | 71.4k | 0U, // STHEPX |
5452 | 71.4k | 0U, // STHU |
5453 | 71.4k | 0U, // STHU8 |
5454 | 71.4k | 0U, // STHUX |
5455 | 71.4k | 0U, // STHUX8 |
5456 | 71.4k | 0U, // STHX |
5457 | 71.4k | 0U, // STHX8 |
5458 | 71.4k | 38U, // STHXTLS |
5459 | 71.4k | 38U, // STHXTLS_ |
5460 | 71.4k | 38U, // STHXTLS_32 |
5461 | 71.4k | 0U, // STMW |
5462 | 71.4k | 0U, // STOP |
5463 | 71.4k | 34U, // STSWI |
5464 | 71.4k | 0U, // STVEBX |
5465 | 71.4k | 0U, // STVEHX |
5466 | 71.4k | 0U, // STVEWX |
5467 | 71.4k | 0U, // STVX |
5468 | 71.4k | 0U, // STVXL |
5469 | 71.4k | 0U, // STW |
5470 | 71.4k | 0U, // STW8 |
5471 | 71.4k | 34U, // STWAT |
5472 | 71.4k | 0U, // STWBRX |
5473 | 71.4k | 38U, // STWCIX |
5474 | 71.4k | 0U, // STWCX |
5475 | 71.4k | 0U, // STWEPX |
5476 | 71.4k | 0U, // STWU |
5477 | 71.4k | 0U, // STWU8 |
5478 | 71.4k | 0U, // STWUX |
5479 | 71.4k | 0U, // STWUX8 |
5480 | 71.4k | 0U, // STWX |
5481 | 71.4k | 0U, // STWX8 |
5482 | 71.4k | 38U, // STWXTLS |
5483 | 71.4k | 38U, // STWXTLS_ |
5484 | 71.4k | 38U, // STWXTLS_32 |
5485 | 71.4k | 0U, // STXSD |
5486 | 71.4k | 0U, // STXSDX |
5487 | 71.4k | 0U, // STXSIBX |
5488 | 71.4k | 0U, // STXSIBXv |
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5490 | 71.4k | 0U, // STXSIHXv |
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5521 | 71.4k | 0U, // SUBFZE8o |
5522 | 71.4k | 0U, // SUBFZEo |
5523 | 71.4k | 38U, // SUBFo |
5524 | 71.4k | 0U, // SYNC |
5525 | 71.4k | 0U, // TABORT |
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5546 | 71.4k | 38U, // TD |
5547 | 71.4k | 4U, // TDI |
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5560 | 71.4k | 0U, // TLBSYNC |
5561 | 71.4k | 0U, // TLBWE |
5562 | 71.4k | 38U, // TLBWE2 |
5563 | 71.4k | 0U, // TRAP |
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5569 | 71.4k | 0U, // UPDATE_VRSAVE |
5570 | 71.4k | 0U, // UpdateGBR |
5571 | 71.4k | 38U, // VABSDUB |
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5575 | 71.4k | 38U, // VADDCUW |
5576 | 71.4k | 134U, // VADDECUQ |
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5582 | 71.4k | 38U, // VADDUBM |
5583 | 71.4k | 38U, // VADDUBS |
5584 | 71.4k | 38U, // VADDUDM |
5585 | 71.4k | 38U, // VADDUHM |
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5589 | 71.4k | 38U, // VADDUWS |
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5604 | 71.4k | 38U, // VCIPHER |
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5664 | 71.4k | 38U, // VEQV |
5665 | 71.4k | 0U, // VEXPTEFP |
5666 | 71.4k | 1U, // VEXTRACTD |
5667 | 71.4k | 1U, // VEXTRACTUB |
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5677 | 71.4k | 0U, // VEXTSH2Ws |
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5679 | 71.4k | 0U, // VEXTSW2Ds |
5680 | 71.4k | 38U, // VEXTUBLX |
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5686 | 71.4k | 0U, // VGBBD |
5687 | 71.4k | 0U, // VINSERTB |
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5691 | 71.4k | 0U, // VLOGEFP |
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5693 | 71.4k | 38U, // VMAXFP |
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5702 | 71.4k | 134U, // VMHADDSHS |
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5704 | 71.4k | 38U, // VMINFP |
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5712 | 71.4k | 38U, // VMINUW |
5713 | 71.4k | 134U, // VMLADDUHM |
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5719 | 71.4k | 38U, // VMRGLH |
5720 | 71.4k | 38U, // VMRGLW |
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5722 | 71.4k | 134U, // VMSUMMBM |
5723 | 71.4k | 134U, // VMSUMSHM |
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5728 | 71.4k | 0U, // VMUL10CUQ |
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5741 | 71.4k | 38U, // VMULOUB |
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5745 | 71.4k | 38U, // VNAND |
5746 | 71.4k | 38U, // VNCIPHER |
5747 | 71.4k | 38U, // VNCIPHERLAST |
5748 | 71.4k | 0U, // VNEGD |
5749 | 71.4k | 0U, // VNEGW |
5750 | 71.4k | 134U, // VNMSUBFP |
5751 | 71.4k | 38U, // VNOR |
5752 | 71.4k | 38U, // VOR |
5753 | 71.4k | 38U, // VORC |
5754 | 71.4k | 134U, // VPERM |
5755 | 71.4k | 134U, // VPERMR |
5756 | 71.4k | 134U, // VPERMXOR |
5757 | 71.4k | 38U, // VPKPX |
5758 | 71.4k | 38U, // VPKSDSS |
5759 | 71.4k | 38U, // VPKSDUS |
5760 | 71.4k | 38U, // VPKSHSS |
5761 | 71.4k | 38U, // VPKSHUS |
5762 | 71.4k | 38U, // VPKSWSS |
5763 | 71.4k | 38U, // VPKSWUS |
5764 | 71.4k | 38U, // VPKUDUM |
5765 | 71.4k | 38U, // VPKUDUS |
5766 | 71.4k | 38U, // VPKUHUM |
5767 | 71.4k | 38U, // VPKUHUS |
5768 | 71.4k | 38U, // VPKUWUM |
5769 | 71.4k | 38U, // VPKUWUS |
5770 | 71.4k | 38U, // VPMSUMB |
5771 | 71.4k | 38U, // VPMSUMD |
5772 | 71.4k | 38U, // VPMSUMH |
5773 | 71.4k | 38U, // VPMSUMW |
5774 | 71.4k | 0U, // VPOPCNTB |
5775 | 71.4k | 0U, // VPOPCNTD |
5776 | 71.4k | 0U, // VPOPCNTH |
5777 | 71.4k | 0U, // VPOPCNTW |
5778 | 71.4k | 0U, // VPRTYBD |
5779 | 71.4k | 0U, // VPRTYBQ |
5780 | 71.4k | 0U, // VPRTYBW |
5781 | 71.4k | 0U, // VREFP |
5782 | 71.4k | 0U, // VRFIM |
5783 | 71.4k | 0U, // VRFIN |
5784 | 71.4k | 0U, // VRFIP |
5785 | 71.4k | 0U, // VRFIZ |
5786 | 71.4k | 38U, // VRLB |
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5790 | 71.4k | 38U, // VRLH |
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5793 | 71.4k | 38U, // VRLWNM |
5794 | 71.4k | 0U, // VRSQRTEFP |
5795 | 71.4k | 0U, // VSBOX |
5796 | 71.4k | 134U, // VSEL |
5797 | 71.4k | 394U, // VSHASIGMAD |
5798 | 71.4k | 394U, // VSHASIGMAW |
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5803 | 71.4k | 38U, // VSLH |
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5805 | 71.4k | 38U, // VSLV |
5806 | 71.4k | 38U, // VSLW |
5807 | 71.4k | 1U, // VSPLTB |
5808 | 71.4k | 1U, // VSPLTBs |
5809 | 71.4k | 1U, // VSPLTH |
5810 | 71.4k | 1U, // VSPLTHs |
5811 | 71.4k | 0U, // VSPLTISB |
5812 | 71.4k | 0U, // VSPLTISH |
5813 | 71.4k | 0U, // VSPLTISW |
5814 | 71.4k | 1U, // VSPLTW |
5815 | 71.4k | 38U, // VSR |
5816 | 71.4k | 38U, // VSRAB |
5817 | 71.4k | 38U, // VSRAD |
5818 | 71.4k | 38U, // VSRAH |
5819 | 71.4k | 38U, // VSRAW |
5820 | 71.4k | 38U, // VSRB |
5821 | 71.4k | 38U, // VSRD |
5822 | 71.4k | 38U, // VSRH |
5823 | 71.4k | 38U, // VSRO |
5824 | 71.4k | 38U, // VSRV |
5825 | 71.4k | 38U, // VSRW |
5826 | 71.4k | 38U, // VSUBCUQ |
5827 | 71.4k | 38U, // VSUBCUW |
5828 | 71.4k | 134U, // VSUBECUQ |
5829 | 71.4k | 134U, // VSUBEUQM |
5830 | 71.4k | 38U, // VSUBFP |
5831 | 71.4k | 38U, // VSUBSBS |
5832 | 71.4k | 38U, // VSUBSHS |
5833 | 71.4k | 38U, // VSUBSWS |
5834 | 71.4k | 38U, // VSUBUBM |
5835 | 71.4k | 38U, // VSUBUBS |
5836 | 71.4k | 38U, // VSUBUDM |
5837 | 71.4k | 38U, // VSUBUHM |
5838 | 71.4k | 38U, // VSUBUHS |
5839 | 71.4k | 38U, // VSUBUQM |
5840 | 71.4k | 38U, // VSUBUWM |
5841 | 71.4k | 38U, // VSUBUWS |
5842 | 71.4k | 38U, // VSUM2SWS |
5843 | 71.4k | 38U, // VSUM4SBS |
5844 | 71.4k | 38U, // VSUM4SHS |
5845 | 71.4k | 38U, // VSUM4UBS |
5846 | 71.4k | 38U, // VSUMSWS |
5847 | 71.4k | 0U, // VUPKHPX |
5848 | 71.4k | 0U, // VUPKHSB |
5849 | 71.4k | 0U, // VUPKHSH |
5850 | 71.4k | 0U, // VUPKHSW |
5851 | 71.4k | 0U, // VUPKLPX |
5852 | 71.4k | 0U, // VUPKLSB |
5853 | 71.4k | 0U, // VUPKLSH |
5854 | 71.4k | 0U, // VUPKLSW |
5855 | 71.4k | 38U, // VXOR |
5856 | 71.4k | 12U, // V_SET0 |
5857 | 71.4k | 12U, // V_SET0B |
5858 | 71.4k | 12U, // V_SET0H |
5859 | 71.4k | 0U, // V_SETALLONES |
5860 | 71.4k | 0U, // V_SETALLONESB |
5861 | 71.4k | 0U, // V_SETALLONESH |
5862 | 71.4k | 0U, // WAIT |
5863 | 71.4k | 0U, // WRTEE |
5864 | 71.4k | 0U, // WRTEEI |
5865 | 71.4k | 38U, // XOR |
5866 | 71.4k | 38U, // XOR8 |
5867 | 71.4k | 38U, // XOR8o |
5868 | 71.4k | 8U, // XORI |
5869 | 71.4k | 8U, // XORI8 |
5870 | 71.4k | 8U, // XORIS |
5871 | 71.4k | 8U, // XORIS8 |
5872 | 71.4k | 38U, // XORo |
5873 | 71.4k | 0U, // XSABSDP |
5874 | 71.4k | 0U, // XSABSQP |
5875 | 71.4k | 38U, // XSADDDP |
5876 | 71.4k | 38U, // XSADDQP |
5877 | 71.4k | 38U, // XSADDQPO |
5878 | 71.4k | 38U, // XSADDSP |
5879 | 71.4k | 38U, // XSCMPEQDP |
5880 | 71.4k | 38U, // XSCMPEXPDP |
5881 | 71.4k | 38U, // XSCMPEXPQP |
5882 | 71.4k | 38U, // XSCMPGEDP |
5883 | 71.4k | 38U, // XSCMPGTDP |
5884 | 71.4k | 38U, // XSCMPODP |
5885 | 71.4k | 38U, // XSCMPOQP |
5886 | 71.4k | 38U, // XSCMPUDP |
5887 | 71.4k | 38U, // XSCMPUQP |
5888 | 71.4k | 38U, // XSCPSGNDP |
5889 | 71.4k | 38U, // XSCPSGNQP |
5890 | 71.4k | 0U, // XSCVDPHP |
5891 | 71.4k | 0U, // XSCVDPQP |
5892 | 71.4k | 0U, // XSCVDPSP |
5893 | 71.4k | 0U, // XSCVDPSPN |
5894 | 71.4k | 0U, // XSCVDPSXDS |
5895 | 71.4k | 0U, // XSCVDPSXDSs |
5896 | 71.4k | 0U, // XSCVDPSXWS |
5897 | 71.4k | 0U, // XSCVDPSXWSs |
5898 | 71.4k | 0U, // XSCVDPUXDS |
5899 | 71.4k | 0U, // XSCVDPUXDSs |
5900 | 71.4k | 0U, // XSCVDPUXWS |
5901 | 71.4k | 0U, // XSCVDPUXWSs |
5902 | 71.4k | 0U, // XSCVHPDP |
5903 | 71.4k | 0U, // XSCVQPDP |
5904 | 71.4k | 0U, // XSCVQPDPO |
5905 | 71.4k | 0U, // XSCVQPSDZ |
5906 | 71.4k | 0U, // XSCVQPSWZ |
5907 | 71.4k | 0U, // XSCVQPUDZ |
5908 | 71.4k | 0U, // XSCVQPUWZ |
5909 | 71.4k | 0U, // XSCVSDQP |
5910 | 71.4k | 0U, // XSCVSPDP |
5911 | 71.4k | 0U, // XSCVSPDPN |
5912 | 71.4k | 0U, // XSCVSXDDP |
5913 | 71.4k | 0U, // XSCVSXDSP |
5914 | 71.4k | 0U, // XSCVUDQP |
5915 | 71.4k | 0U, // XSCVUXDDP |
5916 | 71.4k | 0U, // XSCVUXDSP |
5917 | 71.4k | 38U, // XSDIVDP |
5918 | 71.4k | 38U, // XSDIVQP |
5919 | 71.4k | 38U, // XSDIVQPO |
5920 | 71.4k | 38U, // XSDIVSP |
5921 | 71.4k | 38U, // XSIEXPDP |
5922 | 71.4k | 38U, // XSIEXPQP |
5923 | 71.4k | 1U, // XSMADDADP |
5924 | 71.4k | 1U, // XSMADDASP |
5925 | 71.4k | 1U, // XSMADDMDP |
5926 | 71.4k | 1U, // XSMADDMSP |
5927 | 71.4k | 1U, // XSMADDQP |
5928 | 71.4k | 1U, // XSMADDQPO |
5929 | 71.4k | 38U, // XSMAXCDP |
5930 | 71.4k | 38U, // XSMAXDP |
5931 | 71.4k | 38U, // XSMAXJDP |
5932 | 71.4k | 38U, // XSMINCDP |
5933 | 71.4k | 38U, // XSMINDP |
5934 | 71.4k | 38U, // XSMINJDP |
5935 | 71.4k | 1U, // XSMSUBADP |
5936 | 71.4k | 1U, // XSMSUBASP |
5937 | 71.4k | 1U, // XSMSUBMDP |
5938 | 71.4k | 1U, // XSMSUBMSP |
5939 | 71.4k | 1U, // XSMSUBQP |
5940 | 71.4k | 1U, // XSMSUBQPO |
5941 | 71.4k | 38U, // XSMULDP |
5942 | 71.4k | 38U, // XSMULQP |
5943 | 71.4k | 38U, // XSMULQPO |
5944 | 71.4k | 38U, // XSMULSP |
5945 | 71.4k | 0U, // XSNABSDP |
5946 | 71.4k | 0U, // XSNABSQP |
5947 | 71.4k | 0U, // XSNEGDP |
5948 | 71.4k | 0U, // XSNEGQP |
5949 | 71.4k | 1U, // XSNMADDADP |
5950 | 71.4k | 1U, // XSNMADDASP |
5951 | 71.4k | 1U, // XSNMADDMDP |
5952 | 71.4k | 1U, // XSNMADDMSP |
5953 | 71.4k | 1U, // XSNMADDQP |
5954 | 71.4k | 1U, // XSNMADDQPO |
5955 | 71.4k | 1U, // XSNMSUBADP |
5956 | 71.4k | 1U, // XSNMSUBASP |
5957 | 71.4k | 1U, // XSNMSUBMDP |
5958 | 71.4k | 1U, // XSNMSUBMSP |
5959 | 71.4k | 1U, // XSNMSUBQP |
5960 | 71.4k | 1U, // XSNMSUBQPO |
5961 | 71.4k | 0U, // XSRDPI |
5962 | 71.4k | 0U, // XSRDPIC |
5963 | 71.4k | 0U, // XSRDPIM |
5964 | 71.4k | 0U, // XSRDPIP |
5965 | 71.4k | 0U, // XSRDPIZ |
5966 | 71.4k | 0U, // XSREDP |
5967 | 71.4k | 0U, // XSRESP |
5968 | 71.4k | 0U, // XSRQPI |
5969 | 71.4k | 0U, // XSRQPIX |
5970 | 71.4k | 0U, // XSRQPXP |
5971 | 71.4k | 0U, // XSRSP |
5972 | 71.4k | 0U, // XSRSQRTEDP |
5973 | 71.4k | 0U, // XSRSQRTESP |
5974 | 71.4k | 0U, // XSSQRTDP |
5975 | 71.4k | 0U, // XSSQRTQP |
5976 | 71.4k | 0U, // XSSQRTQPO |
5977 | 71.4k | 0U, // XSSQRTSP |
5978 | 71.4k | 38U, // XSSUBDP |
5979 | 71.4k | 38U, // XSSUBQP |
5980 | 71.4k | 38U, // XSSUBQPO |
5981 | 71.4k | 38U, // XSSUBSP |
5982 | 71.4k | 38U, // XSTDIVDP |
5983 | 71.4k | 0U, // XSTSQRTDP |
5984 | 71.4k | 1U, // XSTSTDCDP |
5985 | 71.4k | 1U, // XSTSTDCQP |
5986 | 71.4k | 1U, // XSTSTDCSP |
5987 | 71.4k | 0U, // XSXEXPDP |
5988 | 71.4k | 0U, // XSXEXPQP |
5989 | 71.4k | 0U, // XSXSIGDP |
5990 | 71.4k | 0U, // XSXSIGQP |
5991 | 71.4k | 0U, // XVABSDP |
5992 | 71.4k | 0U, // XVABSSP |
5993 | 71.4k | 38U, // XVADDDP |
5994 | 71.4k | 38U, // XVADDSP |
5995 | 71.4k | 38U, // XVCMPEQDP |
5996 | 71.4k | 38U, // XVCMPEQDPo |
5997 | 71.4k | 38U, // XVCMPEQSP |
5998 | 71.4k | 38U, // XVCMPEQSPo |
5999 | 71.4k | 38U, // XVCMPGEDP |
6000 | 71.4k | 38U, // XVCMPGEDPo |
6001 | 71.4k | 38U, // XVCMPGESP |
6002 | 71.4k | 38U, // XVCMPGESPo |
6003 | 71.4k | 38U, // XVCMPGTDP |
6004 | 71.4k | 38U, // XVCMPGTDPo |
6005 | 71.4k | 38U, // XVCMPGTSP |
6006 | 71.4k | 38U, // XVCMPGTSPo |
6007 | 71.4k | 38U, // XVCPSGNDP |
6008 | 71.4k | 38U, // XVCPSGNSP |
6009 | 71.4k | 0U, // XVCVDPSP |
6010 | 71.4k | 0U, // XVCVDPSXDS |
6011 | 71.4k | 0U, // XVCVDPSXWS |
6012 | 71.4k | 0U, // XVCVDPUXDS |
6013 | 71.4k | 0U, // XVCVDPUXWS |
6014 | 71.4k | 0U, // XVCVHPSP |
6015 | 71.4k | 0U, // XVCVSPDP |
6016 | 71.4k | 0U, // XVCVSPHP |
6017 | 71.4k | 0U, // XVCVSPSXDS |
6018 | 71.4k | 0U, // XVCVSPSXWS |
6019 | 71.4k | 0U, // XVCVSPUXDS |
6020 | 71.4k | 0U, // XVCVSPUXWS |
6021 | 71.4k | 0U, // XVCVSXDDP |
6022 | 71.4k | 0U, // XVCVSXDSP |
6023 | 71.4k | 0U, // XVCVSXWDP |
6024 | 71.4k | 0U, // XVCVSXWSP |
6025 | 71.4k | 0U, // XVCVUXDDP |
6026 | 71.4k | 0U, // XVCVUXDSP |
6027 | 71.4k | 0U, // XVCVUXWDP |
6028 | 71.4k | 0U, // XVCVUXWSP |
6029 | 71.4k | 38U, // XVDIVDP |
6030 | 71.4k | 38U, // XVDIVSP |
6031 | 71.4k | 38U, // XVIEXPDP |
6032 | 71.4k | 38U, // XVIEXPSP |
6033 | 71.4k | 1U, // XVMADDADP |
6034 | 71.4k | 1U, // XVMADDASP |
6035 | 71.4k | 1U, // XVMADDMDP |
6036 | 71.4k | 1U, // XVMADDMSP |
6037 | 71.4k | 38U, // XVMAXDP |
6038 | 71.4k | 38U, // XVMAXSP |
6039 | 71.4k | 38U, // XVMINDP |
6040 | 71.4k | 38U, // XVMINSP |
6041 | 71.4k | 1U, // XVMSUBADP |
6042 | 71.4k | 1U, // XVMSUBASP |
6043 | 71.4k | 1U, // XVMSUBMDP |
6044 | 71.4k | 1U, // XVMSUBMSP |
6045 | 71.4k | 38U, // XVMULDP |
6046 | 71.4k | 38U, // XVMULSP |
6047 | 71.4k | 0U, // XVNABSDP |
6048 | 71.4k | 0U, // XVNABSSP |
6049 | 71.4k | 0U, // XVNEGDP |
6050 | 71.4k | 0U, // XVNEGSP |
6051 | 71.4k | 1U, // XVNMADDADP |
6052 | 71.4k | 1U, // XVNMADDASP |
6053 | 71.4k | 1U, // XVNMADDMDP |
6054 | 71.4k | 1U, // XVNMADDMSP |
6055 | 71.4k | 1U, // XVNMSUBADP |
6056 | 71.4k | 1U, // XVNMSUBASP |
6057 | 71.4k | 1U, // XVNMSUBMDP |
6058 | 71.4k | 1U, // XVNMSUBMSP |
6059 | 71.4k | 0U, // XVRDPI |
6060 | 71.4k | 0U, // XVRDPIC |
6061 | 71.4k | 0U, // XVRDPIM |
6062 | 71.4k | 0U, // XVRDPIP |
6063 | 71.4k | 0U, // XVRDPIZ |
6064 | 71.4k | 0U, // XVREDP |
6065 | 71.4k | 0U, // XVRESP |
6066 | 71.4k | 0U, // XVRSPI |
6067 | 71.4k | 0U, // XVRSPIC |
6068 | 71.4k | 0U, // XVRSPIM |
6069 | 71.4k | 0U, // XVRSPIP |
6070 | 71.4k | 0U, // XVRSPIZ |
6071 | 71.4k | 0U, // XVRSQRTEDP |
6072 | 71.4k | 0U, // XVRSQRTESP |
6073 | 71.4k | 0U, // XVSQRTDP |
6074 | 71.4k | 0U, // XVSQRTSP |
6075 | 71.4k | 38U, // XVSUBDP |
6076 | 71.4k | 38U, // XVSUBSP |
6077 | 71.4k | 38U, // XVTDIVDP |
6078 | 71.4k | 38U, // XVTDIVSP |
6079 | 71.4k | 0U, // XVTSQRTDP |
6080 | 71.4k | 0U, // XVTSQRTSP |
6081 | 71.4k | 1U, // XVTSTDCDP |
6082 | 71.4k | 1U, // XVTSTDCSP |
6083 | 71.4k | 0U, // XVXEXPDP |
6084 | 71.4k | 0U, // XVXEXPSP |
6085 | 71.4k | 0U, // XVXSIGDP |
6086 | 71.4k | 0U, // XVXSIGSP |
6087 | 71.4k | 0U, // XXBRD |
6088 | 71.4k | 0U, // XXBRH |
6089 | 71.4k | 0U, // XXBRQ |
6090 | 71.4k | 0U, // XXBRW |
6091 | 71.4k | 20U, // XXEXTRACTUW |
6092 | 71.4k | 1U, // XXINSERTW |
6093 | 71.4k | 38U, // XXLAND |
6094 | 71.4k | 38U, // XXLANDC |
6095 | 71.4k | 38U, // XXLEQV |
6096 | 71.4k | 38U, // XXLNAND |
6097 | 71.4k | 38U, // XXLNOR |
6098 | 71.4k | 38U, // XXLOR |
6099 | 71.4k | 38U, // XXLORC |
6100 | 71.4k | 38U, // XXLORf |
6101 | 71.4k | 38U, // XXLXOR |
6102 | 71.4k | 12U, // XXLXORdpz |
6103 | 71.4k | 12U, // XXLXORspz |
6104 | 71.4k | 12U, // XXLXORz |
6105 | 71.4k | 38U, // XXMRGHW |
6106 | 71.4k | 38U, // XXMRGLW |
6107 | 71.4k | 38U, // XXPERM |
6108 | 71.4k | 262U, // XXPERMDI |
6109 | 71.4k | 462U, // XXPERMDIs |
6110 | 71.4k | 38U, // XXPERMR |
6111 | 71.4k | 134U, // XXSEL |
6112 | 71.4k | 262U, // XXSLDWI |
6113 | 71.4k | 462U, // XXSLDWIs |
6114 | 71.4k | 0U, // XXSPLTIB |
6115 | 71.4k | 16U, // XXSPLTW |
6116 | 71.4k | 16U, // XXSPLTWs |
6117 | 71.4k | 22U, // gBC |
6118 | 71.4k | 24U, // gBCA |
6119 | 71.4k | 0U, // gBCAat |
6120 | 71.4k | 38U, // gBCCTR |
6121 | 71.4k | 38U, // gBCCTRL |
6122 | 71.4k | 22U, // gBCL |
6123 | 71.4k | 24U, // gBCLA |
6124 | 71.4k | 0U, // gBCLAat |
6125 | 71.4k | 38U, // gBCLR |
6126 | 71.4k | 38U, // gBCLRL |
6127 | 71.4k | 0U, // gBCLat |
6128 | 71.4k | 0U, // gBCat |
6129 | 71.4k | }; |
6130 | | |
6131 | 71.4k | unsigned int opcode = MCInst_getOpcode(MI); |
6132 | | // printf("opcode = %u\n", opcode); |
6133 | | |
6134 | | // Emit the opcode for the instruction. |
6135 | 71.4k | uint64_t Bits = 0; |
6136 | 71.4k | Bits |= (uint64_t)OpInfo0[opcode] << 0; |
6137 | 71.4k | Bits |= (uint64_t)OpInfo1[opcode] << 32; |
6138 | 71.4k | #ifndef CAPSTONE_DIET |
6139 | 71.4k | SStream_concat0(O, AsmStrs+(Bits & 16383)-1); |
6140 | 71.4k | #endif |
6141 | | |
6142 | | |
6143 | | // Fragment 0 encoded into 5 bits for 19 unique commands. |
6144 | | // printf("Fragment 0: %"PRIu64"\n", ((Bits >> 14) & 31)); |
6145 | 71.4k | switch ((Bits >> 14) & 31) { |
6146 | 0 | default: // unreachable |
6147 | 231 | case 0: |
6148 | | // DBG_VALUE, DBG_LABEL, BUNDLE, LIFETIME_START, LIFETIME_END, FENTRY_CAL... |
6149 | 231 | return; |
6150 | 0 | break; |
6151 | 61.4k | case 1: |
6152 | | // CLRLSLDI, CLRLSLDIo, CLRLSLWI, CLRLSLWIo, CLRRDI, CLRRDIo, CLRRWI, CLR... |
6153 | 61.4k | printOperand(MI, 0, O); |
6154 | 61.4k | break; |
6155 | 31 | case 2: |
6156 | | // DCBFL, DCBFLP, DCBFx, DCBTCT, DCBTDS, DCBTSTCT, DCBTSTDS, DCBTSTT, DCB... |
6157 | 31 | printMemRegReg(MI, 0, O); |
6158 | 31 | break; |
6159 | 0 | case 3: |
6160 | | // ADJCALLSTACKDOWN, ADJCALLSTACKUP |
6161 | 0 | printU16ImmOperand(MI, 0, O); |
6162 | 0 | SStream_concat0(O, " "); |
6163 | 0 | printU16ImmOperand(MI, 1, O); |
6164 | 0 | return; |
6165 | 0 | break; |
6166 | 2.01k | case 4: |
6167 | | // B, BCLalways, BDNZ, BDNZ8, BDNZL, BDNZLm, BDNZLp, BDNZm, BDNZp, BDZ, B... |
6168 | 2.01k | printBranchOperand(MI, 0, O); |
6169 | 2.01k | break; |
6170 | 1.18k | case 5: |
6171 | | // BA, BDNZA, BDNZAm, BDNZAp, BDNZLA, BDNZLAm, BDNZLAp, BDZA, BDZAm, BDZA... |
6172 | 1.18k | printAbsBranchOperand(MI, 0, O); |
6173 | 1.18k | break; |
6174 | 0 | case 6: |
6175 | | // BCC, BCCA, BCCCTR, BCCCTR8, BCCCTRL, BCCCTRL8, BCCL, BCCLA, BCCLR, BCC... |
6176 | 0 | printPredicateOperand(MI, 0, O, "cc"); |
6177 | 0 | break; |
6178 | 0 | case 7: |
6179 | | // BCTRL8_LDinto_toc |
6180 | 0 | printMemRegImm(MI, 0, O); |
6181 | 0 | return; |
6182 | 0 | break; |
6183 | 0 | case 8: |
6184 | | // BL8_NOP_TLS, BL8_TLS, BL8_TLS_, BL_TLS |
6185 | 0 | printTLSCall(MI, 0, O); |
6186 | 0 | break; |
6187 | 47 | case 9: |
6188 | | // DCBF, DCBT, DCBTST |
6189 | 47 | printMemRegReg(MI, 1, O); |
6190 | 47 | SStream_concat0(O, ", "); |
6191 | 47 | printU5ImmOperand(MI, 0, O); |
6192 | 47 | return; |
6193 | 0 | break; |
6194 | 36 | case 10: |
6195 | | // DCBTEP, DCBTSTEP |
6196 | 36 | printU5ImmOperand(MI, 2, O); |
6197 | 36 | SStream_concat0(O, ", "); |
6198 | 36 | printMemRegReg(MI, 0, O); |
6199 | 36 | return; |
6200 | 0 | break; |
6201 | 2.73k | case 11: |
6202 | | // DSS, MBAR, MTFSB0, MTFSB1, TABORTDC, TABORTDCI, TABORTWC, TABORTWCI, T... |
6203 | 2.73k | printU5ImmOperand(MI, 0, O); |
6204 | 2.73k | break; |
6205 | 3.49k | case 12: |
6206 | | // DST, DST64, DSTST, DSTST64, DSTSTT, DSTSTT64, DSTT, DSTT64, MTDCR, MTV... |
6207 | 3.49k | printOperand(MI, 1, O); |
6208 | 3.49k | break; |
6209 | 64 | case 13: |
6210 | | // ICBLC, ICBLQ, ICBT, ICBTLS |
6211 | 64 | printU4ImmOperand(MI, 0, O); |
6212 | 64 | SStream_concat0(O, ", "); |
6213 | 64 | printMemRegReg(MI, 1, O); |
6214 | 64 | return; |
6215 | 0 | break; |
6216 | 49 | case 14: |
6217 | | // MTOCRF, MTOCRF8 |
6218 | 49 | printcrbitm(MI, 0, O); |
6219 | 49 | SStream_concat0(O, ", "); |
6220 | 49 | printOperand(MI, 1, O); |
6221 | 49 | return; |
6222 | 0 | break; |
6223 | 76 | case 15: |
6224 | | // MTSR |
6225 | 76 | printU4ImmOperand(MI, 1, O); |
6226 | 76 | SStream_concat0(O, ", "); |
6227 | 76 | printOperand(MI, 0, O); |
6228 | 76 | return; |
6229 | 0 | break; |
6230 | 16 | case 16: |
6231 | | // RFEBB, TBEGIN, TEND, TSR |
6232 | 16 | printU1ImmOperand(MI, 0, O); |
6233 | 16 | return; |
6234 | 0 | break; |
6235 | 23 | case 17: |
6236 | | // XSRQPI, XSRQPIX, XSRQPXP |
6237 | 23 | printU1ImmOperand(MI, 1, O); |
6238 | 23 | SStream_concat0(O, ", "); |
6239 | 23 | printOperand(MI, 0, O); |
6240 | 23 | SStream_concat0(O, ", "); |
6241 | 23 | printOperand(MI, 2, O); |
6242 | 23 | SStream_concat0(O, ", "); |
6243 | 23 | printU2ImmOperand(MI, 3, O); |
6244 | 23 | return; |
6245 | 0 | break; |
6246 | 0 | case 18: |
6247 | | // gBCAat, gBCLAat, gBCLat, gBCat |
6248 | 0 | printATBitsAsHint(MI, 1, O); |
6249 | 0 | SStream_concat0(O, " "); |
6250 | 0 | printU5ImmOperand(MI, 0, O); |
6251 | 0 | SStream_concat0(O, ", "); |
6252 | 0 | printOperand(MI, 2, O); |
6253 | 0 | SStream_concat0(O, ", "); |
6254 | 0 | break; |
6255 | 71.4k | } |
6256 | | |
6257 | | |
6258 | | // Fragment 1 encoded into 5 bits for 20 unique commands. |
6259 | | // printf("Fragment 1: %"PRIu64"\n", ((Bits >> 19) & 31)); |
6260 | 70.9k | switch ((Bits >> 19) & 31) { |
6261 | 0 | default: // unreachable |
6262 | 66.1k | case 0: |
6263 | | // CLRLSLDI, CLRLSLDIo, CLRLSLWI, CLRLSLWIo, CLRRDI, CLRRDIo, CLRRWI, CLR... |
6264 | 66.1k | SStream_concat0(O, ", "); |
6265 | 66.1k | break; |
6266 | 4.72k | case 1: |
6267 | | // DCBFL, DCBFLP, DCBFx, DCBTSTT, DCBTSTx, DCBTT, DCBTx, B, BA, BCLalways... |
6268 | 4.72k | return; |
6269 | 0 | break; |
6270 | 0 | case 2: |
6271 | | // ATOMIC_CMP_SWAP_I16, ATOMIC_CMP_SWAP_I32, TCRETURNai, TCRETURNai8, TCR... |
6272 | 0 | SStream_concat0(O, " "); |
6273 | 0 | break; |
6274 | 0 | case 3: |
6275 | | // BCC, CTRL_DEP |
6276 | 0 | printPredicateOperand(MI, 0, O, "pm"); |
6277 | 0 | SStream_concat0(O, " "); |
6278 | 0 | printPredicateOperand(MI, 0, O, "reg"); |
6279 | 0 | SStream_concat0(O, ", "); |
6280 | 0 | printBranchOperand(MI, 2, O); |
6281 | 0 | return; |
6282 | 0 | break; |
6283 | 0 | case 4: |
6284 | | // BCCA |
6285 | 0 | SStream_concat0(O, "a"); |
6286 | 0 | printPredicateOperand(MI, 0, O, "pm"); |
6287 | 0 | SStream_concat0(O, " "); |
6288 | 0 | printPredicateOperand(MI, 0, O, "reg"); |
6289 | 0 | SStream_concat0(O, ", "); |
6290 | 0 | printAbsBranchOperand(MI, 2, O); |
6291 | 0 | return; |
6292 | 0 | break; |
6293 | 0 | case 5: |
6294 | | // BCCCTR, BCCCTR8 |
6295 | 0 | SStream_concat0(O, "ctr"); |
6296 | 0 | printPredicateOperand(MI, 0, O, "pm"); |
6297 | 0 | SStream_concat0(O, " "); |
6298 | 0 | printPredicateOperand(MI, 0, O, "reg"); |
6299 | 0 | return; |
6300 | 0 | break; |
6301 | 0 | case 6: |
6302 | | // BCCCTRL, BCCCTRL8 |
6303 | 0 | SStream_concat0(O, "ctrl"); |
6304 | 0 | printPredicateOperand(MI, 0, O, "pm"); |
6305 | 0 | SStream_concat0(O, " "); |
6306 | 0 | printPredicateOperand(MI, 0, O, "reg"); |
6307 | 0 | return; |
6308 | 0 | break; |
6309 | 0 | case 7: |
6310 | | // BCCL |
6311 | 0 | SStream_concat0(O, "l"); |
6312 | 0 | printPredicateOperand(MI, 0, O, "pm"); |
6313 | 0 | SStream_concat0(O, " "); |
6314 | 0 | printPredicateOperand(MI, 0, O, "reg"); |
6315 | 0 | SStream_concat0(O, ", "); |
6316 | 0 | printBranchOperand(MI, 2, O); |
6317 | 0 | return; |
6318 | 0 | break; |
6319 | 0 | case 8: |
6320 | | // BCCLA |
6321 | 0 | SStream_concat0(O, "la"); |
6322 | 0 | printPredicateOperand(MI, 0, O, "pm"); |
6323 | 0 | SStream_concat0(O, " "); |
6324 | 0 | printPredicateOperand(MI, 0, O, "reg"); |
6325 | 0 | SStream_concat0(O, ", "); |
6326 | 0 | printAbsBranchOperand(MI, 2, O); |
6327 | 0 | return; |
6328 | 0 | break; |
6329 | 0 | case 9: |
6330 | | // BCCLR |
6331 | 0 | SStream_concat0(O, "lr"); |
6332 | 0 | printPredicateOperand(MI, 0, O, "pm"); |
6333 | 0 | SStream_concat0(O, " "); |
6334 | 0 | printPredicateOperand(MI, 0, O, "reg"); |
6335 | 0 | return; |
6336 | 0 | break; |
6337 | 0 | case 10: |
6338 | | // BCCLRL |
6339 | 0 | SStream_concat0(O, "lrl"); |
6340 | 0 | printPredicateOperand(MI, 0, O, "pm"); |
6341 | 0 | SStream_concat0(O, " "); |
6342 | 0 | printPredicateOperand(MI, 0, O, "reg"); |
6343 | 0 | return; |
6344 | 0 | break; |
6345 | 0 | case 11: |
6346 | | // BCCTR, BCCTR8, BCCTR8n, BCCTRL, BCCTRL8, BCCTRL8n, BCCTRLn, BCCTRn, BC... |
6347 | 0 | SStream_concat0(O, ", 0"); |
6348 | 0 | op_addImm(MI, 0); |
6349 | 0 | return; |
6350 | 0 | break; |
6351 | 0 | case 12: |
6352 | | // BL8_NOP, BL8_NOP_TLS, BLA8_NOP |
6353 | 0 | SStream_concat0(O, "\n\tnop"); |
6354 | 0 | return; |
6355 | 0 | break; |
6356 | 45 | case 13: |
6357 | | // EVSEL, TLBIE |
6358 | 45 | SStream_concat0(O, ","); |
6359 | 45 | break; |
6360 | 0 | case 14: |
6361 | | // MFTB8 |
6362 | 0 | SStream_concat0(O, ", 268"); |
6363 | 0 | op_addImm(MI, 268); |
6364 | 0 | return; |
6365 | 0 | break; |
6366 | 0 | case 15: |
6367 | | // MFVRSAVE, MFVRSAVEv |
6368 | 0 | SStream_concat0(O, ", 256"); |
6369 | 0 | op_addImm(MI, 256); |
6370 | 0 | return; |
6371 | 0 | break; |
6372 | 0 | case 16: |
6373 | | // QVLPCLSXint |
6374 | 0 | SStream_concat0(O, ", 0, "); |
6375 | 0 | op_addImm(MI, 0); |
6376 | 0 | printOperand(MI, 1, O); |
6377 | 0 | return; |
6378 | 0 | break; |
6379 | 0 | case 17: |
6380 | | // V_SETALLONES, V_SETALLONESB, V_SETALLONESH |
6381 | 0 | SStream_concat0(O, ", -1"); |
6382 | 0 | op_addImm(MI, -1); |
6383 | 0 | return; |
6384 | 0 | break; |
6385 | 0 | case 18: |
6386 | | // gBCAat, gBCLAat |
6387 | 0 | printAbsBranchOperand(MI, 3, O); |
6388 | 0 | return; |
6389 | 0 | break; |
6390 | 0 | case 19: |
6391 | | // gBCLat, gBCat |
6392 | 0 | printBranchOperand(MI, 3, O); |
6393 | 0 | return; |
6394 | 0 | break; |
6395 | 70.9k | } |
6396 | | |
6397 | | |
6398 | | // Fragment 2 encoded into 5 bits for 23 unique commands. |
6399 | | // printf("Fragment 2: %"PRIu64"\n", ((Bits >> 24) & 31)); |
6400 | 66.2k | switch ((Bits >> 24) & 31) { |
6401 | 0 | default: // unreachable |
6402 | 38.5k | case 0: |
6403 | | // CLRLSLDI, CLRLSLDIo, CLRLSLWI, CLRLSLWIo, CLRRDI, CLRRDIo, CLRRWI, CLR... |
6404 | 38.5k | printOperand(MI, 1, O); |
6405 | 38.5k | break; |
6406 | 0 | case 1: |
6407 | | // DCBTCT, DCBTDS, DCBTSTCT, DCBTSTDS, EVADDIW |
6408 | 0 | printU5ImmOperand(MI, 2, O); |
6409 | 0 | break; |
6410 | 12.3k | case 2: |
6411 | | // LAx, EVLDD, EVLDH, EVLDW, EVLHHESPLAT, EVLHHOSSPLAT, EVLHHOUSPLAT, EVL... |
6412 | 12.3k | printMemRegImm(MI, 1, O); |
6413 | 12.3k | return; |
6414 | 0 | break; |
6415 | 486 | case 3: |
6416 | | // SUBPCIS, LI, LI8, LIS, LIS8 |
6417 | 486 | printS16ImmOperand(MI, 1, O); |
6418 | 486 | return; |
6419 | 0 | break; |
6420 | 876 | case 4: |
6421 | | // ATOMIC_CMP_SWAP_I16, ATOMIC_CMP_SWAP_I32, EVLDDX, EVLDHX, EVLDWX, EVLH... |
6422 | 876 | printMemRegReg(MI, 1, O); |
6423 | 876 | break; |
6424 | 0 | case 5: |
6425 | | // BC, BCL, BCLn, BCn |
6426 | 0 | printBranchOperand(MI, 1, O); |
6427 | 0 | return; |
6428 | 0 | break; |
6429 | 88 | case 6: |
6430 | | // CMPRB, CMPRB8 |
6431 | 88 | printU1ImmOperand(MI, 1, O); |
6432 | 88 | SStream_concat0(O, ", "); |
6433 | 88 | printOperand(MI, 2, O); |
6434 | 88 | SStream_concat0(O, ", "); |
6435 | 88 | printOperand(MI, 3, O); |
6436 | 88 | return; |
6437 | 0 | break; |
6438 | 181 | case 7: |
6439 | | // CRSET, CRUNSET, MTDCR, TLBIE, V_SET0, V_SET0B, V_SET0H, XXLXORdpz, XXL... |
6440 | 181 | printOperand(MI, 0, O); |
6441 | 181 | break; |
6442 | 2.15k | case 8: |
6443 | | // DST, DST64, DSTST, DSTST64, DSTSTT, DSTSTT64, DSTT, DSTT64, RLDIMI, RL... |
6444 | 2.15k | printOperand(MI, 2, O); |
6445 | 2.15k | SStream_concat0(O, ", "); |
6446 | 2.15k | break; |
6447 | 30 | case 9: |
6448 | | // EVSPLATFI, EVSPLATI, VSPLTISB, VSPLTISH, VSPLTISW |
6449 | 30 | printS5ImmOperand(MI, 1, O); |
6450 | 30 | return; |
6451 | 0 | break; |
6452 | 0 | case 10: |
6453 | | // EVSUBIFW |
6454 | 0 | printU5ImmOperand(MI, 1, O); |
6455 | 0 | SStream_concat0(O, ", "); |
6456 | 0 | printOperand(MI, 2, O); |
6457 | 0 | return; |
6458 | 0 | break; |
6459 | 0 | case 11: |
6460 | | // LA |
6461 | 0 | printS16ImmOperand(MI, 2, O); |
6462 | 0 | SStream_concat0(O, "("); |
6463 | 0 | printOperand(MI, 1, O); |
6464 | 0 | SStream_concat0(O, ")"); |
6465 | 0 | return; |
6466 | 0 | break; |
6467 | 10.9k | case 12: |
6468 | | // LBZU, LBZU8, LDU, LFDU, LFSU, LHAU, LHAU8, LHZU, LHZU8, LWZU, LWZU8, S... |
6469 | 10.9k | printMemRegImm(MI, 2, O); |
6470 | 10.9k | return; |
6471 | 0 | break; |
6472 | 348 | case 13: |
6473 | | // LBZUX, LBZUX8, LDUX, LFDUX, LFSUX, LHAUX, LHAUX8, LHZUX, LHZUX8, LWAUX... |
6474 | 348 | printMemRegReg(MI, 2, O); |
6475 | 348 | return; |
6476 | 0 | break; |
6477 | 16 | case 14: |
6478 | | // MFBHRBE |
6479 | 16 | printU10ImmOperand(MI, 1, O); |
6480 | 16 | return; |
6481 | 0 | break; |
6482 | 1 | case 15: |
6483 | | // MFFSCDRNI |
6484 | 1 | printU3ImmOperand(MI, 1, O); |
6485 | 1 | return; |
6486 | 0 | break; |
6487 | 7 | case 16: |
6488 | | // MFFSCRNI |
6489 | 7 | printU2ImmOperand(MI, 1, O); |
6490 | 7 | return; |
6491 | 0 | break; |
6492 | 78 | case 17: |
6493 | | // MFOCRF, MFOCRF8 |
6494 | 78 | printcrbitm(MI, 1, O); |
6495 | 78 | return; |
6496 | 0 | break; |
6497 | 65 | case 18: |
6498 | | // MFSR |
6499 | 65 | printU4ImmOperand(MI, 1, O); |
6500 | 65 | return; |
6501 | 0 | break; |
6502 | 0 | case 19: |
6503 | | // PSQ_L, PSQ_LU, PSQ_ST, PSQ_STU |
6504 | 0 | printPSMemRegImm(MI, 1, O); |
6505 | 0 | SStream_concat0(O, ", "); |
6506 | 0 | printU1ImmOperand(MI, 3, O); |
6507 | 0 | SStream_concat0(O, ", "); |
6508 | 0 | printU3ImmOperand(MI, 4, O); |
6509 | 0 | return; |
6510 | 0 | break; |
6511 | 12 | case 20: |
6512 | | // QVGPCI |
6513 | 12 | printU12ImmOperand(MI, 1, O); |
6514 | 12 | return; |
6515 | 0 | break; |
6516 | 12 | case 21: |
6517 | | // VINSERTB, VINSERTH |
6518 | 12 | printOperand(MI, 3, O); |
6519 | 12 | SStream_concat0(O, ", "); |
6520 | 12 | printU4ImmOperand(MI, 2, O); |
6521 | 12 | return; |
6522 | 0 | break; |
6523 | 20 | case 22: |
6524 | | // XXSPLTIB |
6525 | 20 | printU8ImmOperand(MI, 1, O); |
6526 | 20 | return; |
6527 | 0 | break; |
6528 | 66.2k | } |
6529 | | |
6530 | | |
6531 | | // Fragment 3 encoded into 4 bits for 14 unique commands. |
6532 | | // printf("Fragment 3: %"PRIu64"\n", ((Bits >> 29) & 15)); |
6533 | 41.7k | switch ((Bits >> 29) & 15) { |
6534 | 0 | default: // unreachable |
6535 | 35.9k | case 0: |
6536 | | // CLRLSLDI, CLRLSLDIo, CLRLSLWI, CLRLSLWIo, CLRRDI, CLRRDIo, CLRRWI, CLR... |
6537 | 35.9k | SStream_concat0(O, ", "); |
6538 | 35.9k | break; |
6539 | 3.60k | case 1: |
6540 | | // CP_COPY_FIRST, CP_COPYx, CP_PASTE_LAST, CP_PASTEx, DCBTCT, DCBTDS, DCB... |
6541 | 3.60k | return; |
6542 | 0 | break; |
6543 | 0 | case 2: |
6544 | | // ATOMIC_CMP_SWAP_I16, ATOMIC_CMP_SWAP_I32 |
6545 | 0 | SStream_concat0(O, " "); |
6546 | 0 | printOperand(MI, 3, O); |
6547 | 0 | SStream_concat0(O, " "); |
6548 | 0 | printOperand(MI, 4, O); |
6549 | 0 | return; |
6550 | 0 | break; |
6551 | 3 | case 3: |
6552 | | // DST, DST64, DSTST, DSTST64, DSTSTT, DSTSTT64, DSTT, DSTT64 |
6553 | 3 | printU5ImmOperand(MI, 0, O); |
6554 | 3 | return; |
6555 | 0 | break; |
6556 | 0 | case 4: |
6557 | | // EVSEL |
6558 | 0 | SStream_concat0(O, ","); |
6559 | 0 | printOperand(MI, 2, O); |
6560 | 0 | return; |
6561 | 0 | break; |
6562 | 55 | case 5: |
6563 | | // LBARXL, LDARXL, LHARXL, LWARXL |
6564 | 55 | SStream_concat0(O, ", 1"); |
6565 | 55 | op_addImm(MI, 1); |
6566 | 55 | return; |
6567 | 0 | break; |
6568 | 253 | case 6: |
6569 | | // RLDIMI, RLDIMIo |
6570 | 253 | printU6ImmOperand(MI, 3, O); |
6571 | 253 | SStream_concat0(O, ", "); |
6572 | 253 | printU6ImmOperand(MI, 4, O); |
6573 | 253 | return; |
6574 | 0 | break; |
6575 | 980 | case 7: |
6576 | | // RLWIMI, RLWIMI8, RLWIMI8o, RLWIMIo |
6577 | 980 | printU5ImmOperand(MI, 3, O); |
6578 | 980 | SStream_concat0(O, ", "); |
6579 | 980 | printU5ImmOperand(MI, 4, O); |
6580 | 980 | SStream_concat0(O, ", "); |
6581 | 980 | printU5ImmOperand(MI, 5, O); |
6582 | 980 | return; |
6583 | 0 | break; |
6584 | 19 | case 8: |
6585 | | // VCFSX, VCFUX, VCTSXS, VCTUXS, VSPLTB, VSPLTBs, VSPLTH, VSPLTHs, VSPLTW |
6586 | 19 | printU5ImmOperand(MI, 1, O); |
6587 | 19 | return; |
6588 | 0 | break; |
6589 | 0 | case 9: |
6590 | | // VCFSX_0, VCFUX_0, VCTSXS_0, VCTUXS_0 |
6591 | 0 | SStream_concat0(O, ", 0"); |
6592 | 0 | op_addImm(MI, 0); |
6593 | 0 | return; |
6594 | 0 | break; |
6595 | 18 | case 10: |
6596 | | // VEXTRACTD, VEXTRACTUB, VEXTRACTUH, VEXTRACTUW, VINSERTD, VINSERTW |
6597 | 18 | printU4ImmOperand(MI, 1, O); |
6598 | 18 | return; |
6599 | 0 | break; |
6600 | 354 | case 11: |
6601 | | // XSMADDADP, XSMADDASP, XSMADDMDP, XSMADDMSP, XSMADDQP, XSMADDQPO, XSMSU... |
6602 | 354 | printOperand(MI, 3, O); |
6603 | 354 | return; |
6604 | 0 | break; |
6605 | 518 | case 12: |
6606 | | // XSTSTDCDP, XSTSTDCQP, XSTSTDCSP, XVTSTDCDP, XVTSTDCSP |
6607 | 518 | printU7ImmOperand(MI, 1, O); |
6608 | 518 | return; |
6609 | 0 | break; |
6610 | 10 | case 13: |
6611 | | // XXINSERTW |
6612 | 10 | printU4ImmOperand(MI, 3, O); |
6613 | 10 | return; |
6614 | 0 | break; |
6615 | 41.7k | } |
6616 | | |
6617 | | |
6618 | | // Fragment 4 encoded into 4 bits for 13 unique commands. |
6619 | | // printf("Fragment 4: %"PRIu64"\n", ((Bits >> 33) & 15)); |
6620 | 35.9k | switch ((Bits >> 33) & 15) { |
6621 | 0 | default: // unreachable |
6622 | 789 | case 0: |
6623 | | // CLRLSLDI, CLRLSLDIo, CLRRDI, CLRRDIo, EXTLDI, EXTLDIo, EXTRDI, EXTRDIo... |
6624 | 789 | printU6ImmOperand(MI, 2, O); |
6625 | 789 | break; |
6626 | 1.54k | case 1: |
6627 | | // CLRLSLWI, CLRLSLWIo, CLRRWI, CLRRWIo, EXTLWI, EXTLWIo, EXTRWI, EXTRWIo... |
6628 | 1.54k | printU5ImmOperand(MI, 2, O); |
6629 | 1.54k | break; |
6630 | 12.1k | case 2: |
6631 | | // SUBI, SUBIC, SUBICo, SUBIS, ADDI, ADDI8, ADDIC, ADDIC8, ADDICo, ADDIS,... |
6632 | 12.1k | printS16ImmOperand(MI, 2, O); |
6633 | 12.1k | return; |
6634 | 0 | break; |
6635 | 10.5k | case 3: |
6636 | | // ADD4, ADD4TLS, ADD4o, ADD8, ADD8TLS, ADD8TLS_, ADD8o, ADDC, ADDC8, ADD... |
6637 | 10.5k | printOperand(MI, 2, O); |
6638 | 10.5k | break; |
6639 | 9.91k | case 4: |
6640 | | // ANDISo, ANDISo8, ANDIo, ANDIo8, CMPLDI, CMPLWI, ORI, ORI8, ORIS, ORIS8... |
6641 | 9.91k | printU16ImmOperand(MI, 2, O); |
6642 | 9.91k | return; |
6643 | 0 | break; |
6644 | 75 | case 5: |
6645 | | // BCDCFNo, BCDCFSQo, BCDCFZo, BCDCTZo, BCDSETSGNo, CP_COPY, CP_COPY8, CP... |
6646 | 75 | printU1ImmOperand(MI, 2, O); |
6647 | 75 | break; |
6648 | 0 | case 6: |
6649 | | // CRSET, CRUNSET, V_SET0, V_SET0B, V_SET0H, XXLXORdpz, XXLXORspz, XXLXOR... |
6650 | 0 | printOperand(MI, 0, O); |
6651 | 0 | return; |
6652 | 0 | break; |
6653 | 0 | case 7: |
6654 | | // EVADDIW, XXPERMDIs, XXSLDWIs |
6655 | 0 | printOperand(MI, 1, O); |
6656 | 0 | break; |
6657 | 27 | case 8: |
6658 | | // QVESPLATI, QVESPLATIb, QVESPLATIs, XXSPLTW, XXSPLTWs |
6659 | 27 | printU2ImmOperand(MI, 2, O); |
6660 | 27 | return; |
6661 | 0 | break; |
6662 | 931 | case 9: |
6663 | | // QVFMADD, QVFMADDS, QVFMADDSs, QVFMSUB, QVFMSUBS, QVFMSUBSs, QVFNMADD, ... |
6664 | 931 | printOperand(MI, 3, O); |
6665 | 931 | SStream_concat0(O, ", "); |
6666 | 931 | printOperand(MI, 2, O); |
6667 | 931 | return; |
6668 | 0 | break; |
6669 | 23 | case 10: |
6670 | | // XXEXTRACTUW |
6671 | 23 | printU4ImmOperand(MI, 2, O); |
6672 | 23 | return; |
6673 | 0 | break; |
6674 | 0 | case 11: |
6675 | | // gBC, gBCL |
6676 | 0 | printBranchOperand(MI, 2, O); |
6677 | 0 | return; |
6678 | 0 | break; |
6679 | 0 | case 12: |
6680 | | // gBCA, gBCLA |
6681 | 0 | printAbsBranchOperand(MI, 2, O); |
6682 | 0 | return; |
6683 | 0 | break; |
6684 | 35.9k | } |
6685 | | |
6686 | | |
6687 | | // Fragment 5 encoded into 1 bits for 2 unique commands. |
6688 | | // printf("Fragment 5: %"PRIu64"\n", ((Bits >> 37) & 1)); |
6689 | 12.9k | if ((Bits >> 37) & 1) { |
6690 | | // CLRRDI, CLRRDIo, CLRRWI, CLRRWIo, ROTRDI, ROTRDIo, ROTRWI, ROTRWIo, SL... |
6691 | 4.48k | return; |
6692 | 8.44k | } else { |
6693 | | // CLRLSLDI, CLRLSLDIo, CLRLSLWI, CLRLSLWIo, EXTLDI, EXTLDIo, EXTLWI, EXT... |
6694 | 8.44k | SStream_concat0(O, ", "); |
6695 | 8.44k | } |
6696 | | |
6697 | | |
6698 | | // Fragment 6 encoded into 3 bits for 8 unique commands. |
6699 | | // printf("Fragment 6: %"PRIu64"\n", ((Bits >> 38) & 7)); |
6700 | 8.44k | switch ((Bits >> 38) & 7) { |
6701 | 0 | default: // unreachable |
6702 | 1.31k | case 0: |
6703 | | // CLRLSLDI, CLRLSLDIo, EXTLDI, EXTLDIo, EXTRDI, EXTRDIo, INSRDI, INSRDIo... |
6704 | 1.31k | printU6ImmOperand(MI, 3, O); |
6705 | 1.31k | return; |
6706 | 0 | break; |
6707 | 3.22k | case 1: |
6708 | | // CLRLSLWI, CLRLSLWIo, EXTLWI, EXTLWIo, EXTRWI, EXTRWIo, INSLWI, INSLWIo... |
6709 | 3.22k | printU5ImmOperand(MI, 3, O); |
6710 | 3.22k | break; |
6711 | 3.11k | case 2: |
6712 | | // RLWIMIbm, RLWIMIobm, RLWINMbm, RLWINMobm, RLWNMbm, RLWNMobm, FMADD, FM... |
6713 | 3.11k | printOperand(MI, 3, O); |
6714 | 3.11k | return; |
6715 | 0 | break; |
6716 | 22 | case 3: |
6717 | | // BCDSRo, BCDSo, BCDTRUNCo, PSQ_LUX, PSQ_LX, PSQ_STUX, PSQ_STX |
6718 | 22 | printU1ImmOperand(MI, 3, O); |
6719 | 22 | break; |
6720 | 251 | case 4: |
6721 | | // QVALIGNI, QVALIGNIb, QVALIGNIs, XXPERMDI, XXSLDWI |
6722 | 251 | printU2ImmOperand(MI, 3, O); |
6723 | 251 | return; |
6724 | 0 | break; |
6725 | 400 | case 5: |
6726 | | // QVFLOGICAL, QVFLOGICALb, QVFLOGICALs |
6727 | 400 | printU12ImmOperand(MI, 3, O); |
6728 | 400 | return; |
6729 | 0 | break; |
6730 | 121 | case 6: |
6731 | | // VSHASIGMAD, VSHASIGMAW, VSLDOI |
6732 | 121 | printU4ImmOperand(MI, 3, O); |
6733 | 121 | return; |
6734 | 0 | break; |
6735 | 0 | case 7: |
6736 | | // XXPERMDIs, XXSLDWIs |
6737 | 0 | printU2ImmOperand(MI, 2, O); |
6738 | 0 | return; |
6739 | 0 | break; |
6740 | 8.44k | } |
6741 | | |
6742 | | |
6743 | | // Fragment 7 encoded into 1 bits for 2 unique commands. |
6744 | | // printf("Fragment 7: %"PRIu64"\n", ((Bits >> 41) & 1)); |
6745 | 3.24k | if ((Bits >> 41) & 1) { |
6746 | | // PSQ_LUX, PSQ_LX, PSQ_STUX, PSQ_STX, RLWINM, RLWINM8, RLWINM8o, RLWINMo... |
6747 | 3.22k | SStream_concat0(O, ", "); |
6748 | 3.22k | } else { |
6749 | | // CLRLSLWI, CLRLSLWIo, EXTLWI, EXTLWIo, EXTRWI, EXTRWIo, INSLWI, INSLWIo... |
6750 | 22 | return; |
6751 | 22 | } |
6752 | | |
6753 | | |
6754 | | // Fragment 8 encoded into 1 bits for 2 unique commands. |
6755 | | // printf("Fragment 8: %"PRIu64"\n", ((Bits >> 42) & 1)); |
6756 | 3.22k | if ((Bits >> 42) & 1) { |
6757 | | // RLWINM, RLWINM8, RLWINM8o, RLWINMo, RLWNM, RLWNM8, RLWNM8o, RLWNMo |
6758 | 3.22k | printU5ImmOperand(MI, 4, O); |
6759 | 3.22k | return; |
6760 | 3.22k | } else { |
6761 | | // PSQ_LUX, PSQ_LX, PSQ_STUX, PSQ_STX |
6762 | 0 | printU3ImmOperand(MI, 4, O); |
6763 | 0 | return; |
6764 | 0 | } |
6765 | | |
6766 | 3.22k | } |
6767 | | |
6768 | | |
6769 | | |
6770 | | #ifdef PRINT_ALIAS_INSTR |
6771 | | #undef PRINT_ALIAS_INSTR |
6772 | | |
6773 | | static char *printAliasInstr(MCInst *MI, SStream *OS, MCRegisterInfo *MRI) |
6774 | 94.8k | { |
6775 | 415k | #define GETREGCLASS_CONTAIN(_class, _reg) MCRegisterClass_contains(MCRegisterInfo_getRegClass(MRI, _class), MCOperand_getReg(MCInst_getOperand(MI, _reg))) |
6776 | 94.8k | unsigned int I = 0, OpIdx, PrintMethodIdx; |
6777 | 94.8k | char *tmpString; |
6778 | 94.8k | const char *AsmString; |
6779 | 94.8k | switch (MCInst_getOpcode(MI)) { |
6780 | 57.5k | default: return false; |
6781 | 302 | case PPC_ADDPCIS: |
6782 | 302 | if (MCInst_getNumOperands(MI) == 2 && |
6783 | 302 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
6784 | 302 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 0) && |
6785 | 302 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
6786 | 302 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 0) { |
6787 | | // (ADDPCIS g8rc:$RT, 0) |
6788 | 108 | AsmString = "lnia $\x01"; |
6789 | 108 | break; |
6790 | 108 | } |
6791 | 194 | return NULL; |
6792 | 0 | case PPC_BCC: |
6793 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
6794 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
6795 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
6796 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
6797 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
6798 | | // (BCC 12, crrc:$cc, condbrtarget:$dst) |
6799 | 0 | AsmString = "blt $\x02, $\xFF\x03\x01"; |
6800 | 0 | break; |
6801 | 0 | } |
6802 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
6803 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
6804 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
6805 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
6806 | | // (BCC 12, CR0, condbrtarget:$dst) |
6807 | 0 | AsmString = "blt $\xFF\x03\x01"; |
6808 | 0 | break; |
6809 | 0 | } |
6810 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
6811 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
6812 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 14 && |
6813 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
6814 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
6815 | | // (BCC 14, crrc:$cc, condbrtarget:$dst) |
6816 | 0 | AsmString = "blt- $\x02, $\xFF\x03\x01"; |
6817 | 0 | break; |
6818 | 0 | } |
6819 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
6820 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
6821 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 14 && |
6822 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
6823 | | // (BCC 14, CR0, condbrtarget:$dst) |
6824 | 0 | AsmString = "blt- $\xFF\x03\x01"; |
6825 | 0 | break; |
6826 | 0 | } |
6827 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
6828 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
6829 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 15 && |
6830 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
6831 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
6832 | | // (BCC 15, crrc:$cc, condbrtarget:$dst) |
6833 | 0 | AsmString = "blt+ $\x02, $\xFF\x03\x01"; |
6834 | 0 | break; |
6835 | 0 | } |
6836 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
6837 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
6838 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 15 && |
6839 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
6840 | | // (BCC 15, CR0, condbrtarget:$dst) |
6841 | 0 | AsmString = "blt+ $\xFF\x03\x01"; |
6842 | 0 | break; |
6843 | 0 | } |
6844 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
6845 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
6846 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 44 && |
6847 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
6848 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
6849 | | // (BCC 44, crrc:$cc, condbrtarget:$dst) |
6850 | 0 | AsmString = "bgt $\x02, $\xFF\x03\x01"; |
6851 | 0 | break; |
6852 | 0 | } |
6853 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
6854 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
6855 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 44 && |
6856 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
6857 | | // (BCC 44, CR0, condbrtarget:$dst) |
6858 | 0 | AsmString = "bgt $\xFF\x03\x01"; |
6859 | 0 | break; |
6860 | 0 | } |
6861 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
6862 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
6863 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 46 && |
6864 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
6865 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
6866 | | // (BCC 46, crrc:$cc, condbrtarget:$dst) |
6867 | 0 | AsmString = "bgt- $\x02, $\xFF\x03\x01"; |
6868 | 0 | break; |
6869 | 0 | } |
6870 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
6871 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
6872 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 46 && |
6873 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
6874 | | // (BCC 46, CR0, condbrtarget:$dst) |
6875 | 0 | AsmString = "bgt- $\xFF\x03\x01"; |
6876 | 0 | break; |
6877 | 0 | } |
6878 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
6879 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
6880 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 47 && |
6881 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
6882 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
6883 | | // (BCC 47, crrc:$cc, condbrtarget:$dst) |
6884 | 0 | AsmString = "bgt+ $\x02, $\xFF\x03\x01"; |
6885 | 0 | break; |
6886 | 0 | } |
6887 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
6888 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
6889 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 47 && |
6890 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
6891 | | // (BCC 47, CR0, condbrtarget:$dst) |
6892 | 0 | AsmString = "bgt+ $\xFF\x03\x01"; |
6893 | 0 | break; |
6894 | 0 | } |
6895 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
6896 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
6897 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 76 && |
6898 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
6899 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
6900 | | // (BCC 76, crrc:$cc, condbrtarget:$dst) |
6901 | 0 | AsmString = "beq $\x02, $\xFF\x03\x01"; |
6902 | 0 | break; |
6903 | 0 | } |
6904 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
6905 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
6906 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 76 && |
6907 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
6908 | | // (BCC 76, CR0, condbrtarget:$dst) |
6909 | 0 | AsmString = "beq $\xFF\x03\x01"; |
6910 | 0 | break; |
6911 | 0 | } |
6912 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
6913 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
6914 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 78 && |
6915 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
6916 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
6917 | | // (BCC 78, crrc:$cc, condbrtarget:$dst) |
6918 | 0 | AsmString = "beq- $\x02, $\xFF\x03\x01"; |
6919 | 0 | break; |
6920 | 0 | } |
6921 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
6922 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
6923 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 78 && |
6924 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
6925 | | // (BCC 78, CR0, condbrtarget:$dst) |
6926 | 0 | AsmString = "beq- $\xFF\x03\x01"; |
6927 | 0 | break; |
6928 | 0 | } |
6929 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
6930 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
6931 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 79 && |
6932 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
6933 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
6934 | | // (BCC 79, crrc:$cc, condbrtarget:$dst) |
6935 | 0 | AsmString = "beq+ $\x02, $\xFF\x03\x01"; |
6936 | 0 | break; |
6937 | 0 | } |
6938 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
6939 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
6940 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 79 && |
6941 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
6942 | | // (BCC 79, CR0, condbrtarget:$dst) |
6943 | 0 | AsmString = "beq+ $\xFF\x03\x01"; |
6944 | 0 | break; |
6945 | 0 | } |
6946 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
6947 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
6948 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 68 && |
6949 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
6950 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
6951 | | // (BCC 68, crrc:$cc, condbrtarget:$dst) |
6952 | 0 | AsmString = "bne $\x02, $\xFF\x03\x01"; |
6953 | 0 | break; |
6954 | 0 | } |
6955 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
6956 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
6957 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 68 && |
6958 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
6959 | | // (BCC 68, CR0, condbrtarget:$dst) |
6960 | 0 | AsmString = "bne $\xFF\x03\x01"; |
6961 | 0 | break; |
6962 | 0 | } |
6963 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
6964 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
6965 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 70 && |
6966 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
6967 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
6968 | | // (BCC 70, crrc:$cc, condbrtarget:$dst) |
6969 | 0 | AsmString = "bne- $\x02, $\xFF\x03\x01"; |
6970 | 0 | break; |
6971 | 0 | } |
6972 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
6973 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
6974 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 70 && |
6975 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
6976 | | // (BCC 70, CR0, condbrtarget:$dst) |
6977 | 0 | AsmString = "bne- $\xFF\x03\x01"; |
6978 | 0 | break; |
6979 | 0 | } |
6980 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
6981 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
6982 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 71 && |
6983 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
6984 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
6985 | | // (BCC 71, crrc:$cc, condbrtarget:$dst) |
6986 | 0 | AsmString = "bne+ $\x02, $\xFF\x03\x01"; |
6987 | 0 | break; |
6988 | 0 | } |
6989 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
6990 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
6991 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 71 && |
6992 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
6993 | | // (BCC 71, CR0, condbrtarget:$dst) |
6994 | 0 | AsmString = "bne+ $\xFF\x03\x01"; |
6995 | 0 | break; |
6996 | 0 | } |
6997 | 0 | return NULL; |
6998 | 0 | case PPC_BCCA: |
6999 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7000 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7001 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
7002 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7003 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7004 | | // (BCCA 12, crrc:$cc, abscondbrtarget:$dst) |
7005 | 0 | AsmString = "blta $\x02, $\xFF\x03\x02"; |
7006 | 0 | break; |
7007 | 0 | } |
7008 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7009 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7010 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
7011 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7012 | | // (BCCA 12, CR0, abscondbrtarget:$dst) |
7013 | 0 | AsmString = "blta $\xFF\x03\x02"; |
7014 | 0 | break; |
7015 | 0 | } |
7016 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7017 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7018 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 14 && |
7019 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7020 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7021 | | // (BCCA 14, crrc:$cc, abscondbrtarget:$dst) |
7022 | 0 | AsmString = "blta- $\x02, $\xFF\x03\x02"; |
7023 | 0 | break; |
7024 | 0 | } |
7025 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7026 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7027 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 14 && |
7028 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7029 | | // (BCCA 14, CR0, abscondbrtarget:$dst) |
7030 | 0 | AsmString = "blta- $\xFF\x03\x02"; |
7031 | 0 | break; |
7032 | 0 | } |
7033 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7034 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7035 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 15 && |
7036 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7037 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7038 | | // (BCCA 15, crrc:$cc, abscondbrtarget:$dst) |
7039 | 0 | AsmString = "blta+ $\x02, $\xFF\x03\x02"; |
7040 | 0 | break; |
7041 | 0 | } |
7042 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7043 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7044 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 15 && |
7045 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7046 | | // (BCCA 15, CR0, abscondbrtarget:$dst) |
7047 | 0 | AsmString = "blta+ $\xFF\x03\x02"; |
7048 | 0 | break; |
7049 | 0 | } |
7050 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7051 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7052 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 44 && |
7053 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7054 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7055 | | // (BCCA 44, crrc:$cc, abscondbrtarget:$dst) |
7056 | 0 | AsmString = "bgta $\x02, $\xFF\x03\x02"; |
7057 | 0 | break; |
7058 | 0 | } |
7059 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7060 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7061 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 44 && |
7062 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7063 | | // (BCCA 44, CR0, abscondbrtarget:$dst) |
7064 | 0 | AsmString = "bgta $\xFF\x03\x02"; |
7065 | 0 | break; |
7066 | 0 | } |
7067 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7068 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7069 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 46 && |
7070 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7071 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7072 | | // (BCCA 46, crrc:$cc, abscondbrtarget:$dst) |
7073 | 0 | AsmString = "bgta- $\x02, $\xFF\x03\x02"; |
7074 | 0 | break; |
7075 | 0 | } |
7076 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7077 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7078 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 46 && |
7079 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7080 | | // (BCCA 46, CR0, abscondbrtarget:$dst) |
7081 | 0 | AsmString = "bgta- $\xFF\x03\x02"; |
7082 | 0 | break; |
7083 | 0 | } |
7084 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7085 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7086 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 47 && |
7087 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7088 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7089 | | // (BCCA 47, crrc:$cc, abscondbrtarget:$dst) |
7090 | 0 | AsmString = "bgta+ $\x02, $\xFF\x03\x02"; |
7091 | 0 | break; |
7092 | 0 | } |
7093 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7094 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7095 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 47 && |
7096 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7097 | | // (BCCA 47, CR0, abscondbrtarget:$dst) |
7098 | 0 | AsmString = "bgta+ $\xFF\x03\x02"; |
7099 | 0 | break; |
7100 | 0 | } |
7101 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7102 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7103 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 76 && |
7104 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7105 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7106 | | // (BCCA 76, crrc:$cc, abscondbrtarget:$dst) |
7107 | 0 | AsmString = "beqa $\x02, $\xFF\x03\x02"; |
7108 | 0 | break; |
7109 | 0 | } |
7110 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7111 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7112 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 76 && |
7113 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7114 | | // (BCCA 76, CR0, abscondbrtarget:$dst) |
7115 | 0 | AsmString = "beqa $\xFF\x03\x02"; |
7116 | 0 | break; |
7117 | 0 | } |
7118 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7119 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7120 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 78 && |
7121 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7122 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7123 | | // (BCCA 78, crrc:$cc, abscondbrtarget:$dst) |
7124 | 0 | AsmString = "beqa- $\x02, $\xFF\x03\x02"; |
7125 | 0 | break; |
7126 | 0 | } |
7127 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7128 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7129 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 78 && |
7130 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7131 | | // (BCCA 78, CR0, abscondbrtarget:$dst) |
7132 | 0 | AsmString = "beqa- $\xFF\x03\x02"; |
7133 | 0 | break; |
7134 | 0 | } |
7135 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7136 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7137 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 79 && |
7138 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7139 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7140 | | // (BCCA 79, crrc:$cc, abscondbrtarget:$dst) |
7141 | 0 | AsmString = "beqa+ $\x02, $\xFF\x03\x02"; |
7142 | 0 | break; |
7143 | 0 | } |
7144 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7145 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7146 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 79 && |
7147 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7148 | | // (BCCA 79, CR0, abscondbrtarget:$dst) |
7149 | 0 | AsmString = "beqa+ $\xFF\x03\x02"; |
7150 | 0 | break; |
7151 | 0 | } |
7152 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7153 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7154 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 68 && |
7155 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7156 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7157 | | // (BCCA 68, crrc:$cc, abscondbrtarget:$dst) |
7158 | 0 | AsmString = "bnea $\x02, $\xFF\x03\x02"; |
7159 | 0 | break; |
7160 | 0 | } |
7161 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7162 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7163 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 68 && |
7164 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7165 | | // (BCCA 68, CR0, abscondbrtarget:$dst) |
7166 | 0 | AsmString = "bnea $\xFF\x03\x02"; |
7167 | 0 | break; |
7168 | 0 | } |
7169 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7170 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7171 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 70 && |
7172 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7173 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7174 | | // (BCCA 70, crrc:$cc, abscondbrtarget:$dst) |
7175 | 0 | AsmString = "bnea- $\x02, $\xFF\x03\x02"; |
7176 | 0 | break; |
7177 | 0 | } |
7178 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7179 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7180 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 70 && |
7181 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7182 | | // (BCCA 70, CR0, abscondbrtarget:$dst) |
7183 | 0 | AsmString = "bnea- $\xFF\x03\x02"; |
7184 | 0 | break; |
7185 | 0 | } |
7186 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7187 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7188 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 71 && |
7189 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7190 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7191 | | // (BCCA 71, crrc:$cc, abscondbrtarget:$dst) |
7192 | 0 | AsmString = "bnea+ $\x02, $\xFF\x03\x02"; |
7193 | 0 | break; |
7194 | 0 | } |
7195 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7196 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7197 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 71 && |
7198 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7199 | | // (BCCA 71, CR0, abscondbrtarget:$dst) |
7200 | 0 | AsmString = "bnea+ $\xFF\x03\x02"; |
7201 | 0 | break; |
7202 | 0 | } |
7203 | 0 | return NULL; |
7204 | 0 | case PPC_BCCCTR: |
7205 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7206 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7207 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
7208 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7209 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7210 | | // (BCCCTR 12, crrc:$cc) |
7211 | 0 | AsmString = "bltctr $\x02"; |
7212 | 0 | break; |
7213 | 0 | } |
7214 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7215 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7216 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
7217 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7218 | | // (BCCCTR 12, CR0) |
7219 | 0 | AsmString = "bltctr"; |
7220 | 0 | break; |
7221 | 0 | } |
7222 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7223 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7224 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 14 && |
7225 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7226 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7227 | | // (BCCCTR 14, crrc:$cc) |
7228 | 0 | AsmString = "bltctr- $\x02"; |
7229 | 0 | break; |
7230 | 0 | } |
7231 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7232 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7233 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 14 && |
7234 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7235 | | // (BCCCTR 14, CR0) |
7236 | 0 | AsmString = "bltctr-"; |
7237 | 0 | break; |
7238 | 0 | } |
7239 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7240 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7241 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 15 && |
7242 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7243 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7244 | | // (BCCCTR 15, crrc:$cc) |
7245 | 0 | AsmString = "bltctr+ $\x02"; |
7246 | 0 | break; |
7247 | 0 | } |
7248 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7249 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7250 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 15 && |
7251 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7252 | | // (BCCCTR 15, CR0) |
7253 | 0 | AsmString = "bltctr+"; |
7254 | 0 | break; |
7255 | 0 | } |
7256 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7257 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7258 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 44 && |
7259 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7260 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7261 | | // (BCCCTR 44, crrc:$cc) |
7262 | 0 | AsmString = "bgtctr $\x02"; |
7263 | 0 | break; |
7264 | 0 | } |
7265 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7266 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7267 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 44 && |
7268 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7269 | | // (BCCCTR 44, CR0) |
7270 | 0 | AsmString = "bgtctr"; |
7271 | 0 | break; |
7272 | 0 | } |
7273 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7274 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7275 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 46 && |
7276 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7277 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7278 | | // (BCCCTR 46, crrc:$cc) |
7279 | 0 | AsmString = "bgtctr- $\x02"; |
7280 | 0 | break; |
7281 | 0 | } |
7282 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7283 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7284 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 46 && |
7285 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7286 | | // (BCCCTR 46, CR0) |
7287 | 0 | AsmString = "bgtctr-"; |
7288 | 0 | break; |
7289 | 0 | } |
7290 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7291 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7292 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 47 && |
7293 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7294 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7295 | | // (BCCCTR 47, crrc:$cc) |
7296 | 0 | AsmString = "bgtctr+ $\x02"; |
7297 | 0 | break; |
7298 | 0 | } |
7299 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7300 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7301 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 47 && |
7302 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7303 | | // (BCCCTR 47, CR0) |
7304 | 0 | AsmString = "bgtctr+"; |
7305 | 0 | break; |
7306 | 0 | } |
7307 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7308 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7309 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 76 && |
7310 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7311 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7312 | | // (BCCCTR 76, crrc:$cc) |
7313 | 0 | AsmString = "beqctr $\x02"; |
7314 | 0 | break; |
7315 | 0 | } |
7316 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7317 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7318 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 76 && |
7319 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7320 | | // (BCCCTR 76, CR0) |
7321 | 0 | AsmString = "beqctr"; |
7322 | 0 | break; |
7323 | 0 | } |
7324 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7325 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7326 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 78 && |
7327 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7328 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7329 | | // (BCCCTR 78, crrc:$cc) |
7330 | 0 | AsmString = "beqctr- $\x02"; |
7331 | 0 | break; |
7332 | 0 | } |
7333 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7334 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7335 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 78 && |
7336 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7337 | | // (BCCCTR 78, CR0) |
7338 | 0 | AsmString = "beqctr-"; |
7339 | 0 | break; |
7340 | 0 | } |
7341 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7342 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7343 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 79 && |
7344 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7345 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7346 | | // (BCCCTR 79, crrc:$cc) |
7347 | 0 | AsmString = "beqctr+ $\x02"; |
7348 | 0 | break; |
7349 | 0 | } |
7350 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7351 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7352 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 79 && |
7353 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7354 | | // (BCCCTR 79, CR0) |
7355 | 0 | AsmString = "beqctr+"; |
7356 | 0 | break; |
7357 | 0 | } |
7358 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7359 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7360 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 68 && |
7361 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7362 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7363 | | // (BCCCTR 68, crrc:$cc) |
7364 | 0 | AsmString = "bnectr $\x02"; |
7365 | 0 | break; |
7366 | 0 | } |
7367 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7368 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7369 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 68 && |
7370 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7371 | | // (BCCCTR 68, CR0) |
7372 | 0 | AsmString = "bnectr"; |
7373 | 0 | break; |
7374 | 0 | } |
7375 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7376 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7377 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 70 && |
7378 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7379 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7380 | | // (BCCCTR 70, crrc:$cc) |
7381 | 0 | AsmString = "bnectr- $\x02"; |
7382 | 0 | break; |
7383 | 0 | } |
7384 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7385 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7386 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 70 && |
7387 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7388 | | // (BCCCTR 70, CR0) |
7389 | 0 | AsmString = "bnectr-"; |
7390 | 0 | break; |
7391 | 0 | } |
7392 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7393 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7394 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 71 && |
7395 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7396 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7397 | | // (BCCCTR 71, crrc:$cc) |
7398 | 0 | AsmString = "bnectr+ $\x02"; |
7399 | 0 | break; |
7400 | 0 | } |
7401 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7402 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7403 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 71 && |
7404 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7405 | | // (BCCCTR 71, CR0) |
7406 | 0 | AsmString = "bnectr+"; |
7407 | 0 | break; |
7408 | 0 | } |
7409 | 0 | return NULL; |
7410 | 0 | case PPC_BCCCTRL: |
7411 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7412 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7413 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
7414 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7415 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7416 | | // (BCCCTRL 12, crrc:$cc) |
7417 | 0 | AsmString = "bltctrl $\x02"; |
7418 | 0 | break; |
7419 | 0 | } |
7420 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7421 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7422 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
7423 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7424 | | // (BCCCTRL 12, CR0) |
7425 | 0 | AsmString = "bltctrl"; |
7426 | 0 | break; |
7427 | 0 | } |
7428 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7429 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7430 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 14 && |
7431 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7432 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7433 | | // (BCCCTRL 14, crrc:$cc) |
7434 | 0 | AsmString = "bltctrl- $\x02"; |
7435 | 0 | break; |
7436 | 0 | } |
7437 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7438 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7439 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 14 && |
7440 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7441 | | // (BCCCTRL 14, CR0) |
7442 | 0 | AsmString = "bltctrl-"; |
7443 | 0 | break; |
7444 | 0 | } |
7445 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7446 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7447 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 15 && |
7448 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7449 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7450 | | // (BCCCTRL 15, crrc:$cc) |
7451 | 0 | AsmString = "bltctrl+ $\x02"; |
7452 | 0 | break; |
7453 | 0 | } |
7454 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7455 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7456 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 15 && |
7457 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7458 | | // (BCCCTRL 15, CR0) |
7459 | 0 | AsmString = "bltctrl+"; |
7460 | 0 | break; |
7461 | 0 | } |
7462 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7463 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7464 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 44 && |
7465 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7466 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7467 | | // (BCCCTRL 44, crrc:$cc) |
7468 | 0 | AsmString = "bgtctrl $\x02"; |
7469 | 0 | break; |
7470 | 0 | } |
7471 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7472 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7473 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 44 && |
7474 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7475 | | // (BCCCTRL 44, CR0) |
7476 | 0 | AsmString = "bgtctrl"; |
7477 | 0 | break; |
7478 | 0 | } |
7479 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7480 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7481 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 46 && |
7482 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7483 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7484 | | // (BCCCTRL 46, crrc:$cc) |
7485 | 0 | AsmString = "bgtctrl- $\x02"; |
7486 | 0 | break; |
7487 | 0 | } |
7488 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7489 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7490 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 46 && |
7491 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7492 | | // (BCCCTRL 46, CR0) |
7493 | 0 | AsmString = "bgtctrl-"; |
7494 | 0 | break; |
7495 | 0 | } |
7496 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7497 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7498 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 47 && |
7499 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7500 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7501 | | // (BCCCTRL 47, crrc:$cc) |
7502 | 0 | AsmString = "bgtctrl+ $\x02"; |
7503 | 0 | break; |
7504 | 0 | } |
7505 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7506 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7507 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 47 && |
7508 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7509 | | // (BCCCTRL 47, CR0) |
7510 | 0 | AsmString = "bgtctrl+"; |
7511 | 0 | break; |
7512 | 0 | } |
7513 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7514 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7515 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 76 && |
7516 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7517 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7518 | | // (BCCCTRL 76, crrc:$cc) |
7519 | 0 | AsmString = "beqctrl $\x02"; |
7520 | 0 | break; |
7521 | 0 | } |
7522 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7523 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7524 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 76 && |
7525 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7526 | | // (BCCCTRL 76, CR0) |
7527 | 0 | AsmString = "beqctrl"; |
7528 | 0 | break; |
7529 | 0 | } |
7530 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7531 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7532 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 78 && |
7533 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7534 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7535 | | // (BCCCTRL 78, crrc:$cc) |
7536 | 0 | AsmString = "beqctrl- $\x02"; |
7537 | 0 | break; |
7538 | 0 | } |
7539 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7540 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7541 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 78 && |
7542 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7543 | | // (BCCCTRL 78, CR0) |
7544 | 0 | AsmString = "beqctrl-"; |
7545 | 0 | break; |
7546 | 0 | } |
7547 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7548 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7549 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 79 && |
7550 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7551 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7552 | | // (BCCCTRL 79, crrc:$cc) |
7553 | 0 | AsmString = "beqctrl+ $\x02"; |
7554 | 0 | break; |
7555 | 0 | } |
7556 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7557 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7558 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 79 && |
7559 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7560 | | // (BCCCTRL 79, CR0) |
7561 | 0 | AsmString = "beqctrl+"; |
7562 | 0 | break; |
7563 | 0 | } |
7564 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7565 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7566 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 68 && |
7567 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7568 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7569 | | // (BCCCTRL 68, crrc:$cc) |
7570 | 0 | AsmString = "bnectrl $\x02"; |
7571 | 0 | break; |
7572 | 0 | } |
7573 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7574 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7575 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 68 && |
7576 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7577 | | // (BCCCTRL 68, CR0) |
7578 | 0 | AsmString = "bnectrl"; |
7579 | 0 | break; |
7580 | 0 | } |
7581 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7582 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7583 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 70 && |
7584 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7585 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7586 | | // (BCCCTRL 70, crrc:$cc) |
7587 | 0 | AsmString = "bnectrl- $\x02"; |
7588 | 0 | break; |
7589 | 0 | } |
7590 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7591 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7592 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 70 && |
7593 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7594 | | // (BCCCTRL 70, CR0) |
7595 | 0 | AsmString = "bnectrl-"; |
7596 | 0 | break; |
7597 | 0 | } |
7598 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7599 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7600 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 71 && |
7601 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7602 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7603 | | // (BCCCTRL 71, crrc:$cc) |
7604 | 0 | AsmString = "bnectrl+ $\x02"; |
7605 | 0 | break; |
7606 | 0 | } |
7607 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
7608 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7609 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 71 && |
7610 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7611 | | // (BCCCTRL 71, CR0) |
7612 | 0 | AsmString = "bnectrl+"; |
7613 | 0 | break; |
7614 | 0 | } |
7615 | 0 | return NULL; |
7616 | 0 | case PPC_BCCL: |
7617 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7618 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7619 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
7620 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7621 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7622 | | // (BCCL 12, crrc:$cc, condbrtarget:$dst) |
7623 | 0 | AsmString = "bltl $\x02, $\xFF\x03\x01"; |
7624 | 0 | break; |
7625 | 0 | } |
7626 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7627 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7628 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
7629 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7630 | | // (BCCL 12, CR0, condbrtarget:$dst) |
7631 | 0 | AsmString = "bltl $\xFF\x03\x01"; |
7632 | 0 | break; |
7633 | 0 | } |
7634 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7635 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7636 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 14 && |
7637 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7638 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7639 | | // (BCCL 14, crrc:$cc, condbrtarget:$dst) |
7640 | 0 | AsmString = "bltl- $\x02, $\xFF\x03\x01"; |
7641 | 0 | break; |
7642 | 0 | } |
7643 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7644 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7645 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 14 && |
7646 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7647 | | // (BCCL 14, CR0, condbrtarget:$dst) |
7648 | 0 | AsmString = "bltl- $\xFF\x03\x01"; |
7649 | 0 | break; |
7650 | 0 | } |
7651 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7652 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7653 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 15 && |
7654 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7655 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7656 | | // (BCCL 15, crrc:$cc, condbrtarget:$dst) |
7657 | 0 | AsmString = "bltl+ $\x02, $\xFF\x03\x01"; |
7658 | 0 | break; |
7659 | 0 | } |
7660 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7661 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7662 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 15 && |
7663 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7664 | | // (BCCL 15, CR0, condbrtarget:$dst) |
7665 | 0 | AsmString = "bltl+ $\xFF\x03\x01"; |
7666 | 0 | break; |
7667 | 0 | } |
7668 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7669 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7670 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 44 && |
7671 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7672 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7673 | | // (BCCL 44, crrc:$cc, condbrtarget:$dst) |
7674 | 0 | AsmString = "bgtl $\x02, $\xFF\x03\x01"; |
7675 | 0 | break; |
7676 | 0 | } |
7677 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7678 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7679 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 44 && |
7680 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7681 | | // (BCCL 44, CR0, condbrtarget:$dst) |
7682 | 0 | AsmString = "bgtl $\xFF\x03\x01"; |
7683 | 0 | break; |
7684 | 0 | } |
7685 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7686 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7687 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 46 && |
7688 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7689 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7690 | | // (BCCL 46, crrc:$cc, condbrtarget:$dst) |
7691 | 0 | AsmString = "bgtl- $\x02, $\xFF\x03\x01"; |
7692 | 0 | break; |
7693 | 0 | } |
7694 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7695 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7696 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 46 && |
7697 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7698 | | // (BCCL 46, CR0, condbrtarget:$dst) |
7699 | 0 | AsmString = "bgtl- $\xFF\x03\x01"; |
7700 | 0 | break; |
7701 | 0 | } |
7702 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7703 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7704 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 47 && |
7705 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7706 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7707 | | // (BCCL 47, crrc:$cc, condbrtarget:$dst) |
7708 | 0 | AsmString = "bgtl+ $\x02, $\xFF\x03\x01"; |
7709 | 0 | break; |
7710 | 0 | } |
7711 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7712 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7713 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 47 && |
7714 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7715 | | // (BCCL 47, CR0, condbrtarget:$dst) |
7716 | 0 | AsmString = "bgtl+ $\xFF\x03\x01"; |
7717 | 0 | break; |
7718 | 0 | } |
7719 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7720 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7721 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 76 && |
7722 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7723 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7724 | | // (BCCL 76, crrc:$cc, condbrtarget:$dst) |
7725 | 0 | AsmString = "beql $\x02, $\xFF\x03\x01"; |
7726 | 0 | break; |
7727 | 0 | } |
7728 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7729 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7730 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 76 && |
7731 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7732 | | // (BCCL 76, CR0, condbrtarget:$dst) |
7733 | 0 | AsmString = "beql $\xFF\x03\x01"; |
7734 | 0 | break; |
7735 | 0 | } |
7736 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7737 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7738 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 78 && |
7739 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7740 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7741 | | // (BCCL 78, crrc:$cc, condbrtarget:$dst) |
7742 | 0 | AsmString = "beql- $\x02, $\xFF\x03\x01"; |
7743 | 0 | break; |
7744 | 0 | } |
7745 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7746 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7747 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 78 && |
7748 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7749 | | // (BCCL 78, CR0, condbrtarget:$dst) |
7750 | 0 | AsmString = "beql- $\xFF\x03\x01"; |
7751 | 0 | break; |
7752 | 0 | } |
7753 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7754 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7755 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 79 && |
7756 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7757 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7758 | | // (BCCL 79, crrc:$cc, condbrtarget:$dst) |
7759 | 0 | AsmString = "beql+ $\x02, $\xFF\x03\x01"; |
7760 | 0 | break; |
7761 | 0 | } |
7762 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7763 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7764 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 79 && |
7765 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7766 | | // (BCCL 79, CR0, condbrtarget:$dst) |
7767 | 0 | AsmString = "beql+ $\xFF\x03\x01"; |
7768 | 0 | break; |
7769 | 0 | } |
7770 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7771 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7772 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 68 && |
7773 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7774 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7775 | | // (BCCL 68, crrc:$cc, condbrtarget:$dst) |
7776 | 0 | AsmString = "bnel $\x02, $\xFF\x03\x01"; |
7777 | 0 | break; |
7778 | 0 | } |
7779 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7780 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7781 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 68 && |
7782 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7783 | | // (BCCL 68, CR0, condbrtarget:$dst) |
7784 | 0 | AsmString = "bnel $\xFF\x03\x01"; |
7785 | 0 | break; |
7786 | 0 | } |
7787 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7788 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7789 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 70 && |
7790 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7791 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7792 | | // (BCCL 70, crrc:$cc, condbrtarget:$dst) |
7793 | 0 | AsmString = "bnel- $\x02, $\xFF\x03\x01"; |
7794 | 0 | break; |
7795 | 0 | } |
7796 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7797 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7798 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 70 && |
7799 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7800 | | // (BCCL 70, CR0, condbrtarget:$dst) |
7801 | 0 | AsmString = "bnel- $\xFF\x03\x01"; |
7802 | 0 | break; |
7803 | 0 | } |
7804 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7805 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7806 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 71 && |
7807 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7808 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7809 | | // (BCCL 71, crrc:$cc, condbrtarget:$dst) |
7810 | 0 | AsmString = "bnel+ $\x02, $\xFF\x03\x01"; |
7811 | 0 | break; |
7812 | 0 | } |
7813 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7814 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7815 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 71 && |
7816 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7817 | | // (BCCL 71, CR0, condbrtarget:$dst) |
7818 | 0 | AsmString = "bnel+ $\xFF\x03\x01"; |
7819 | 0 | break; |
7820 | 0 | } |
7821 | 0 | return NULL; |
7822 | 0 | case PPC_BCCLA: |
7823 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7824 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7825 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
7826 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7827 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7828 | | // (BCCLA 12, crrc:$cc, abscondbrtarget:$dst) |
7829 | 0 | AsmString = "bltla $\x02, $\xFF\x03\x02"; |
7830 | 0 | break; |
7831 | 0 | } |
7832 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7833 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7834 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
7835 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7836 | | // (BCCLA 12, CR0, abscondbrtarget:$dst) |
7837 | 0 | AsmString = "bltla $\xFF\x03\x02"; |
7838 | 0 | break; |
7839 | 0 | } |
7840 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7841 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7842 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 14 && |
7843 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7844 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7845 | | // (BCCLA 14, crrc:$cc, abscondbrtarget:$dst) |
7846 | 0 | AsmString = "bltla- $\x02, $\xFF\x03\x02"; |
7847 | 0 | break; |
7848 | 0 | } |
7849 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7850 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7851 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 14 && |
7852 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7853 | | // (BCCLA 14, CR0, abscondbrtarget:$dst) |
7854 | 0 | AsmString = "bltla- $\xFF\x03\x02"; |
7855 | 0 | break; |
7856 | 0 | } |
7857 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7858 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7859 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 15 && |
7860 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7861 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7862 | | // (BCCLA 15, crrc:$cc, abscondbrtarget:$dst) |
7863 | 0 | AsmString = "bltla+ $\x02, $\xFF\x03\x02"; |
7864 | 0 | break; |
7865 | 0 | } |
7866 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7867 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7868 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 15 && |
7869 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7870 | | // (BCCLA 15, CR0, abscondbrtarget:$dst) |
7871 | 0 | AsmString = "bltla+ $\xFF\x03\x02"; |
7872 | 0 | break; |
7873 | 0 | } |
7874 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7875 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7876 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 44 && |
7877 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7878 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7879 | | // (BCCLA 44, crrc:$cc, abscondbrtarget:$dst) |
7880 | 0 | AsmString = "bgtla $\x02, $\xFF\x03\x02"; |
7881 | 0 | break; |
7882 | 0 | } |
7883 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7884 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7885 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 44 && |
7886 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7887 | | // (BCCLA 44, CR0, abscondbrtarget:$dst) |
7888 | 0 | AsmString = "bgtla $\xFF\x03\x02"; |
7889 | 0 | break; |
7890 | 0 | } |
7891 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7892 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7893 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 46 && |
7894 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7895 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7896 | | // (BCCLA 46, crrc:$cc, abscondbrtarget:$dst) |
7897 | 0 | AsmString = "bgtla- $\x02, $\xFF\x03\x02"; |
7898 | 0 | break; |
7899 | 0 | } |
7900 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7901 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7902 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 46 && |
7903 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7904 | | // (BCCLA 46, CR0, abscondbrtarget:$dst) |
7905 | 0 | AsmString = "bgtla- $\xFF\x03\x02"; |
7906 | 0 | break; |
7907 | 0 | } |
7908 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7909 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7910 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 47 && |
7911 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7912 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7913 | | // (BCCLA 47, crrc:$cc, abscondbrtarget:$dst) |
7914 | 0 | AsmString = "bgtla+ $\x02, $\xFF\x03\x02"; |
7915 | 0 | break; |
7916 | 0 | } |
7917 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7918 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7919 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 47 && |
7920 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7921 | | // (BCCLA 47, CR0, abscondbrtarget:$dst) |
7922 | 0 | AsmString = "bgtla+ $\xFF\x03\x02"; |
7923 | 0 | break; |
7924 | 0 | } |
7925 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7926 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7927 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 76 && |
7928 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7929 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7930 | | // (BCCLA 76, crrc:$cc, abscondbrtarget:$dst) |
7931 | 0 | AsmString = "beqla $\x02, $\xFF\x03\x02"; |
7932 | 0 | break; |
7933 | 0 | } |
7934 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7935 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7936 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 76 && |
7937 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7938 | | // (BCCLA 76, CR0, abscondbrtarget:$dst) |
7939 | 0 | AsmString = "beqla $\xFF\x03\x02"; |
7940 | 0 | break; |
7941 | 0 | } |
7942 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7943 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7944 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 78 && |
7945 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7946 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7947 | | // (BCCLA 78, crrc:$cc, abscondbrtarget:$dst) |
7948 | 0 | AsmString = "beqla- $\x02, $\xFF\x03\x02"; |
7949 | 0 | break; |
7950 | 0 | } |
7951 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7952 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7953 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 78 && |
7954 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7955 | | // (BCCLA 78, CR0, abscondbrtarget:$dst) |
7956 | 0 | AsmString = "beqla- $\xFF\x03\x02"; |
7957 | 0 | break; |
7958 | 0 | } |
7959 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7960 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7961 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 79 && |
7962 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7963 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7964 | | // (BCCLA 79, crrc:$cc, abscondbrtarget:$dst) |
7965 | 0 | AsmString = "beqla+ $\x02, $\xFF\x03\x02"; |
7966 | 0 | break; |
7967 | 0 | } |
7968 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7969 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7970 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 79 && |
7971 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7972 | | // (BCCLA 79, CR0, abscondbrtarget:$dst) |
7973 | 0 | AsmString = "beqla+ $\xFF\x03\x02"; |
7974 | 0 | break; |
7975 | 0 | } |
7976 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7977 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7978 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 68 && |
7979 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7980 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7981 | | // (BCCLA 68, crrc:$cc, abscondbrtarget:$dst) |
7982 | 0 | AsmString = "bnela $\x02, $\xFF\x03\x02"; |
7983 | 0 | break; |
7984 | 0 | } |
7985 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7986 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7987 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 68 && |
7988 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
7989 | | // (BCCLA 68, CR0, abscondbrtarget:$dst) |
7990 | 0 | AsmString = "bnela $\xFF\x03\x02"; |
7991 | 0 | break; |
7992 | 0 | } |
7993 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
7994 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
7995 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 70 && |
7996 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
7997 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
7998 | | // (BCCLA 70, crrc:$cc, abscondbrtarget:$dst) |
7999 | 0 | AsmString = "bnela- $\x02, $\xFF\x03\x02"; |
8000 | 0 | break; |
8001 | 0 | } |
8002 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
8003 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8004 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 70 && |
8005 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8006 | | // (BCCLA 70, CR0, abscondbrtarget:$dst) |
8007 | 0 | AsmString = "bnela- $\xFF\x03\x02"; |
8008 | 0 | break; |
8009 | 0 | } |
8010 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
8011 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8012 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 71 && |
8013 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8014 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8015 | | // (BCCLA 71, crrc:$cc, abscondbrtarget:$dst) |
8016 | 0 | AsmString = "bnela+ $\x02, $\xFF\x03\x02"; |
8017 | 0 | break; |
8018 | 0 | } |
8019 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
8020 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8021 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 71 && |
8022 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8023 | | // (BCCLA 71, CR0, abscondbrtarget:$dst) |
8024 | 0 | AsmString = "bnela+ $\xFF\x03\x02"; |
8025 | 0 | break; |
8026 | 0 | } |
8027 | 0 | return NULL; |
8028 | 0 | case PPC_BCCLR: |
8029 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8030 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8031 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
8032 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8033 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8034 | | // (BCCLR 12, crrc:$cc) |
8035 | 0 | AsmString = "bltlr $\x02"; |
8036 | 0 | break; |
8037 | 0 | } |
8038 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8039 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8040 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
8041 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8042 | | // (BCCLR 12, CR0) |
8043 | 0 | AsmString = "bltlr"; |
8044 | 0 | break; |
8045 | 0 | } |
8046 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8047 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8048 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 14 && |
8049 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8050 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8051 | | // (BCCLR 14, crrc:$cc) |
8052 | 0 | AsmString = "bltlr- $\x02"; |
8053 | 0 | break; |
8054 | 0 | } |
8055 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8056 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8057 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 14 && |
8058 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8059 | | // (BCCLR 14, CR0) |
8060 | 0 | AsmString = "bltlr-"; |
8061 | 0 | break; |
8062 | 0 | } |
8063 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8064 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8065 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 15 && |
8066 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8067 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8068 | | // (BCCLR 15, crrc:$cc) |
8069 | 0 | AsmString = "bltlr+ $\x02"; |
8070 | 0 | break; |
8071 | 0 | } |
8072 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8073 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8074 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 15 && |
8075 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8076 | | // (BCCLR 15, CR0) |
8077 | 0 | AsmString = "bltlr+"; |
8078 | 0 | break; |
8079 | 0 | } |
8080 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8081 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8082 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 44 && |
8083 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8084 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8085 | | // (BCCLR 44, crrc:$cc) |
8086 | 0 | AsmString = "bgtlr $\x02"; |
8087 | 0 | break; |
8088 | 0 | } |
8089 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8090 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8091 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 44 && |
8092 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8093 | | // (BCCLR 44, CR0) |
8094 | 0 | AsmString = "bgtlr"; |
8095 | 0 | break; |
8096 | 0 | } |
8097 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8098 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8099 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 46 && |
8100 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8101 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8102 | | // (BCCLR 46, crrc:$cc) |
8103 | 0 | AsmString = "bgtlr- $\x02"; |
8104 | 0 | break; |
8105 | 0 | } |
8106 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8107 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8108 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 46 && |
8109 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8110 | | // (BCCLR 46, CR0) |
8111 | 0 | AsmString = "bgtlr-"; |
8112 | 0 | break; |
8113 | 0 | } |
8114 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8115 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8116 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 47 && |
8117 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8118 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8119 | | // (BCCLR 47, crrc:$cc) |
8120 | 0 | AsmString = "bgtlr+ $\x02"; |
8121 | 0 | break; |
8122 | 0 | } |
8123 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8124 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8125 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 47 && |
8126 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8127 | | // (BCCLR 47, CR0) |
8128 | 0 | AsmString = "bgtlr+"; |
8129 | 0 | break; |
8130 | 0 | } |
8131 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8132 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8133 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 76 && |
8134 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8135 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8136 | | // (BCCLR 76, crrc:$cc) |
8137 | 0 | AsmString = "beqlr $\x02"; |
8138 | 0 | break; |
8139 | 0 | } |
8140 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8141 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8142 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 76 && |
8143 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8144 | | // (BCCLR 76, CR0) |
8145 | 0 | AsmString = "beqlr"; |
8146 | 0 | break; |
8147 | 0 | } |
8148 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8149 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8150 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 78 && |
8151 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8152 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8153 | | // (BCCLR 78, crrc:$cc) |
8154 | 0 | AsmString = "beqlr- $\x02"; |
8155 | 0 | break; |
8156 | 0 | } |
8157 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8158 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8159 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 78 && |
8160 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8161 | | // (BCCLR 78, CR0) |
8162 | 0 | AsmString = "beqlr-"; |
8163 | 0 | break; |
8164 | 0 | } |
8165 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8166 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8167 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 79 && |
8168 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8169 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8170 | | // (BCCLR 79, crrc:$cc) |
8171 | 0 | AsmString = "beqlr+ $\x02"; |
8172 | 0 | break; |
8173 | 0 | } |
8174 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8175 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8176 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 79 && |
8177 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8178 | | // (BCCLR 79, CR0) |
8179 | 0 | AsmString = "beqlr+"; |
8180 | 0 | break; |
8181 | 0 | } |
8182 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8183 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8184 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 68 && |
8185 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8186 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8187 | | // (BCCLR 68, crrc:$cc) |
8188 | 0 | AsmString = "bnelr $\x02"; |
8189 | 0 | break; |
8190 | 0 | } |
8191 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8192 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8193 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 68 && |
8194 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8195 | | // (BCCLR 68, CR0) |
8196 | 0 | AsmString = "bnelr"; |
8197 | 0 | break; |
8198 | 0 | } |
8199 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8200 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8201 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 70 && |
8202 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8203 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8204 | | // (BCCLR 70, crrc:$cc) |
8205 | 0 | AsmString = "bnelr- $\x02"; |
8206 | 0 | break; |
8207 | 0 | } |
8208 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8209 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8210 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 70 && |
8211 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8212 | | // (BCCLR 70, CR0) |
8213 | 0 | AsmString = "bnelr-"; |
8214 | 0 | break; |
8215 | 0 | } |
8216 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8217 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8218 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 71 && |
8219 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8220 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8221 | | // (BCCLR 71, crrc:$cc) |
8222 | 0 | AsmString = "bnelr+ $\x02"; |
8223 | 0 | break; |
8224 | 0 | } |
8225 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8226 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8227 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 71 && |
8228 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8229 | | // (BCCLR 71, CR0) |
8230 | 0 | AsmString = "bnelr+"; |
8231 | 0 | break; |
8232 | 0 | } |
8233 | 0 | return NULL; |
8234 | 0 | case PPC_BCCLRL: |
8235 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8236 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8237 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
8238 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8239 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8240 | | // (BCCLRL 12, crrc:$cc) |
8241 | 0 | AsmString = "bltlrl $\x02"; |
8242 | 0 | break; |
8243 | 0 | } |
8244 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8245 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8246 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
8247 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8248 | | // (BCCLRL 12, CR0) |
8249 | 0 | AsmString = "bltlrl"; |
8250 | 0 | break; |
8251 | 0 | } |
8252 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8253 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8254 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 14 && |
8255 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8256 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8257 | | // (BCCLRL 14, crrc:$cc) |
8258 | 0 | AsmString = "bltlrl- $\x02"; |
8259 | 0 | break; |
8260 | 0 | } |
8261 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8262 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8263 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 14 && |
8264 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8265 | | // (BCCLRL 14, CR0) |
8266 | 0 | AsmString = "bltlrl-"; |
8267 | 0 | break; |
8268 | 0 | } |
8269 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8270 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8271 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 15 && |
8272 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8273 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8274 | | // (BCCLRL 15, crrc:$cc) |
8275 | 0 | AsmString = "bltlrl+ $\x02"; |
8276 | 0 | break; |
8277 | 0 | } |
8278 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8279 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8280 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 15 && |
8281 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8282 | | // (BCCLRL 15, CR0) |
8283 | 0 | AsmString = "bltlrl+"; |
8284 | 0 | break; |
8285 | 0 | } |
8286 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8287 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8288 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 44 && |
8289 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8290 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8291 | | // (BCCLRL 44, crrc:$cc) |
8292 | 0 | AsmString = "bgtlrl $\x02"; |
8293 | 0 | break; |
8294 | 0 | } |
8295 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8296 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8297 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 44 && |
8298 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8299 | | // (BCCLRL 44, CR0) |
8300 | 0 | AsmString = "bgtlrl"; |
8301 | 0 | break; |
8302 | 0 | } |
8303 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8304 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8305 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 46 && |
8306 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8307 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8308 | | // (BCCLRL 46, crrc:$cc) |
8309 | 0 | AsmString = "bgtlrl- $\x02"; |
8310 | 0 | break; |
8311 | 0 | } |
8312 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8313 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8314 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 46 && |
8315 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8316 | | // (BCCLRL 46, CR0) |
8317 | 0 | AsmString = "bgtlrl-"; |
8318 | 0 | break; |
8319 | 0 | } |
8320 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8321 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8322 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 47 && |
8323 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8324 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8325 | | // (BCCLRL 47, crrc:$cc) |
8326 | 0 | AsmString = "bgtlrl+ $\x02"; |
8327 | 0 | break; |
8328 | 0 | } |
8329 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8330 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8331 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 47 && |
8332 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8333 | | // (BCCLRL 47, CR0) |
8334 | 0 | AsmString = "bgtlrl+"; |
8335 | 0 | break; |
8336 | 0 | } |
8337 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8338 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8339 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 76 && |
8340 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8341 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8342 | | // (BCCLRL 76, crrc:$cc) |
8343 | 0 | AsmString = "beqlrl $\x02"; |
8344 | 0 | break; |
8345 | 0 | } |
8346 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8347 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8348 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 76 && |
8349 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8350 | | // (BCCLRL 76, CR0) |
8351 | 0 | AsmString = "beqlrl"; |
8352 | 0 | break; |
8353 | 0 | } |
8354 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8355 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8356 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 78 && |
8357 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8358 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8359 | | // (BCCLRL 78, crrc:$cc) |
8360 | 0 | AsmString = "beqlrl- $\x02"; |
8361 | 0 | break; |
8362 | 0 | } |
8363 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8364 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8365 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 78 && |
8366 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8367 | | // (BCCLRL 78, CR0) |
8368 | 0 | AsmString = "beqlrl-"; |
8369 | 0 | break; |
8370 | 0 | } |
8371 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8372 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8373 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 79 && |
8374 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8375 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8376 | | // (BCCLRL 79, crrc:$cc) |
8377 | 0 | AsmString = "beqlrl+ $\x02"; |
8378 | 0 | break; |
8379 | 0 | } |
8380 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8381 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8382 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 79 && |
8383 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8384 | | // (BCCLRL 79, CR0) |
8385 | 0 | AsmString = "beqlrl+"; |
8386 | 0 | break; |
8387 | 0 | } |
8388 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8389 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8390 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 68 && |
8391 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8392 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8393 | | // (BCCLRL 68, crrc:$cc) |
8394 | 0 | AsmString = "bnelrl $\x02"; |
8395 | 0 | break; |
8396 | 0 | } |
8397 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8398 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8399 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 68 && |
8400 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8401 | | // (BCCLRL 68, CR0) |
8402 | 0 | AsmString = "bnelrl"; |
8403 | 0 | break; |
8404 | 0 | } |
8405 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8406 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8407 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 70 && |
8408 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8409 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8410 | | // (BCCLRL 70, crrc:$cc) |
8411 | 0 | AsmString = "bnelrl- $\x02"; |
8412 | 0 | break; |
8413 | 0 | } |
8414 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8415 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8416 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 70 && |
8417 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8418 | | // (BCCLRL 70, CR0) |
8419 | 0 | AsmString = "bnelrl-"; |
8420 | 0 | break; |
8421 | 0 | } |
8422 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8423 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8424 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 71 && |
8425 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8426 | 0 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 1)) { |
8427 | | // (BCCLRL 71, crrc:$cc) |
8428 | 0 | AsmString = "bnelrl+ $\x02"; |
8429 | 0 | break; |
8430 | 0 | } |
8431 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
8432 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8433 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 71 && |
8434 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_CR0) { |
8435 | | // (BCCLRL 71, CR0) |
8436 | 0 | AsmString = "bnelrl+"; |
8437 | 0 | break; |
8438 | 0 | } |
8439 | 0 | return NULL; |
8440 | 156 | case PPC_CMPD: |
8441 | 156 | if (MCInst_getNumOperands(MI) == 3 && |
8442 | 156 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == PPC_CR0 && |
8443 | 156 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8444 | 156 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1) && |
8445 | 156 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
8446 | 156 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 2)) { |
8447 | | // (CMPD CR0, g8rc:$rA, g8rc:$rB) |
8448 | 42 | AsmString = "cmpd $\x02, $\x03"; |
8449 | 42 | break; |
8450 | 42 | } |
8451 | 114 | return NULL; |
8452 | 2.36k | case PPC_CMPDI: |
8453 | 2.36k | if (MCInst_getNumOperands(MI) == 3 && |
8454 | 2.36k | MCOperand_getReg(MCInst_getOperand(MI, 0)) == PPC_CR0 && |
8455 | 2.36k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8456 | 2.36k | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1)) { |
8457 | | // (CMPDI CR0, g8rc:$rA, s16imm64:$imm) |
8458 | 1.51k | AsmString = "cmpdi $\x02, $\xFF\x03\x03"; |
8459 | 1.51k | break; |
8460 | 1.51k | } |
8461 | 850 | return NULL; |
8462 | 50 | case PPC_CMPLD: |
8463 | 50 | if (MCInst_getNumOperands(MI) == 3 && |
8464 | 50 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == PPC_CR0 && |
8465 | 50 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8466 | 50 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1) && |
8467 | 50 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
8468 | 50 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 2)) { |
8469 | | // (CMPLD CR0, g8rc:$rA, g8rc:$rB) |
8470 | 34 | AsmString = "cmpld $\x02, $\x03"; |
8471 | 34 | break; |
8472 | 34 | } |
8473 | 16 | return NULL; |
8474 | 2.45k | case PPC_CMPLDI: |
8475 | 2.45k | if (MCInst_getNumOperands(MI) == 3 && |
8476 | 2.45k | MCOperand_getReg(MCInst_getOperand(MI, 0)) == PPC_CR0 && |
8477 | 2.45k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8478 | 2.45k | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1)) { |
8479 | | // (CMPLDI CR0, g8rc:$rA, u16imm64:$imm) |
8480 | 2.08k | AsmString = "cmpldi $\x02, $\xFF\x03\x04"; |
8481 | 2.08k | break; |
8482 | 2.08k | } |
8483 | 373 | return NULL; |
8484 | 140 | case PPC_CMPLW: |
8485 | 140 | if (MCInst_getNumOperands(MI) == 3 && |
8486 | 140 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == PPC_CR0 && |
8487 | 140 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8488 | 140 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1) && |
8489 | 140 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
8490 | 140 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 2)) { |
8491 | | // (CMPLW CR0, gprc:$rA, gprc:$rB) |
8492 | 112 | AsmString = "cmplw $\x02, $\x03"; |
8493 | 112 | break; |
8494 | 112 | } |
8495 | 28 | return NULL; |
8496 | 379 | case PPC_CMPLWI: |
8497 | 379 | if (MCInst_getNumOperands(MI) == 3 && |
8498 | 379 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == PPC_CR0 && |
8499 | 379 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8500 | 379 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
8501 | | // (CMPLWI CR0, gprc:$rA, u16imm:$imm) |
8502 | 239 | AsmString = "cmplwi $\x02, $\xFF\x03\x04"; |
8503 | 239 | break; |
8504 | 239 | } |
8505 | 140 | return NULL; |
8506 | 155 | case PPC_CMPW: |
8507 | 155 | if (MCInst_getNumOperands(MI) == 3 && |
8508 | 155 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == PPC_CR0 && |
8509 | 155 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8510 | 155 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1) && |
8511 | 155 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
8512 | 155 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 2)) { |
8513 | | // (CMPW CR0, gprc:$rA, gprc:$rB) |
8514 | 95 | AsmString = "cmpw $\x02, $\x03"; |
8515 | 95 | break; |
8516 | 95 | } |
8517 | 60 | return NULL; |
8518 | 570 | case PPC_CMPWI: |
8519 | 570 | if (MCInst_getNumOperands(MI) == 3 && |
8520 | 570 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == PPC_CR0 && |
8521 | 570 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8522 | 570 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
8523 | | // (CMPWI CR0, gprc:$rA, s16imm:$imm) |
8524 | 217 | AsmString = "cmpwi $\x02, $\xFF\x03\x03"; |
8525 | 217 | break; |
8526 | 217 | } |
8527 | 353 | return NULL; |
8528 | 18 | case PPC_CNTLZW: |
8529 | 18 | if (MCInst_getNumOperands(MI) == 2 && |
8530 | 18 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8531 | 18 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8532 | 18 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8533 | 18 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
8534 | | // (CNTLZW gprc:$rA, gprc:$rS) |
8535 | 18 | AsmString = "cntlzw $\x01, $\x02"; |
8536 | 18 | break; |
8537 | 18 | } |
8538 | 0 | return NULL; |
8539 | 13 | case PPC_CNTLZWo: |
8540 | 13 | if (MCInst_getNumOperands(MI) == 2 && |
8541 | 13 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8542 | 13 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8543 | 13 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8544 | 13 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
8545 | | // (CNTLZWo gprc:$rA, gprc:$rS) |
8546 | 13 | AsmString = "cntlzw. $\x01, $\x02"; |
8547 | 13 | break; |
8548 | 13 | } |
8549 | 0 | return NULL; |
8550 | 268 | case PPC_CREQV: |
8551 | 268 | if (MCInst_getNumOperands(MI) == 3 && |
8552 | 268 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8553 | 268 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 0) && |
8554 | 268 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8555 | 268 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == MCOperand_getReg(MCInst_getOperand(MI, 0)) && |
8556 | 268 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
8557 | 268 | MCOperand_getReg(MCInst_getOperand(MI, 2)) == MCOperand_getReg(MCInst_getOperand(MI, 0))) { |
8558 | | // (CREQV crbitrc:$bx, crbitrc:$bx, crbitrc:$bx) |
8559 | 4 | AsmString = "crset $\x01"; |
8560 | 4 | break; |
8561 | 4 | } |
8562 | 264 | return NULL; |
8563 | 66 | case PPC_CRNOR: |
8564 | 66 | if (MCInst_getNumOperands(MI) == 3 && |
8565 | 66 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8566 | 66 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 0) && |
8567 | 66 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8568 | 66 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
8569 | 66 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
8570 | 66 | MCOperand_getReg(MCInst_getOperand(MI, 2)) == MCOperand_getReg(MCInst_getOperand(MI, 1))) { |
8571 | | // (CRNOR crbitrc:$bx, crbitrc:$by, crbitrc:$by) |
8572 | 27 | AsmString = "crnot $\x01, $\x02"; |
8573 | 27 | break; |
8574 | 27 | } |
8575 | 39 | return NULL; |
8576 | 582 | case PPC_CROR: |
8577 | 582 | if (MCInst_getNumOperands(MI) == 3 && |
8578 | 582 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8579 | 582 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 0) && |
8580 | 582 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8581 | 582 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
8582 | 582 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
8583 | 582 | MCOperand_getReg(MCInst_getOperand(MI, 2)) == MCOperand_getReg(MCInst_getOperand(MI, 1))) { |
8584 | | // (CROR crbitrc:$bx, crbitrc:$by, crbitrc:$by) |
8585 | 457 | AsmString = "crmove $\x01, $\x02"; |
8586 | 457 | break; |
8587 | 457 | } |
8588 | 125 | return NULL; |
8589 | 222 | case PPC_CRXOR: |
8590 | 222 | if (MCInst_getNumOperands(MI) == 3 && |
8591 | 222 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8592 | 222 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 0) && |
8593 | 222 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
8594 | 222 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == MCOperand_getReg(MCInst_getOperand(MI, 0)) && |
8595 | 222 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
8596 | 222 | MCOperand_getReg(MCInst_getOperand(MI, 2)) == MCOperand_getReg(MCInst_getOperand(MI, 0))) { |
8597 | | // (CRXOR crbitrc:$bx, crbitrc:$bx, crbitrc:$bx) |
8598 | 93 | AsmString = "crclr $\x01"; |
8599 | 93 | break; |
8600 | 93 | } |
8601 | 129 | return NULL; |
8602 | 131 | case PPC_MBAR: |
8603 | 131 | if (MCInst_getNumOperands(MI) == 1 && |
8604 | 131 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
8605 | 131 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0) { |
8606 | | // (MBAR 0) |
8607 | 48 | AsmString = "mbar"; |
8608 | 48 | break; |
8609 | 48 | } |
8610 | 83 | return NULL; |
8611 | 508 | case PPC_MFDCR: |
8612 | 508 | if (MCInst_getNumOperands(MI) == 2 && |
8613 | 508 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8614 | 508 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8615 | 508 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8616 | 508 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 128) { |
8617 | | // (MFDCR gprc:$Rx, 128) |
8618 | 18 | AsmString = "mfbr0 $\x01"; |
8619 | 18 | break; |
8620 | 18 | } |
8621 | 490 | if (MCInst_getNumOperands(MI) == 2 && |
8622 | 490 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8623 | 490 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8624 | 490 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8625 | 490 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 129) { |
8626 | | // (MFDCR gprc:$Rx, 129) |
8627 | 19 | AsmString = "mfbr1 $\x01"; |
8628 | 19 | break; |
8629 | 19 | } |
8630 | 471 | if (MCInst_getNumOperands(MI) == 2 && |
8631 | 471 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8632 | 471 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8633 | 471 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8634 | 471 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 130) { |
8635 | | // (MFDCR gprc:$Rx, 130) |
8636 | 35 | AsmString = "mfbr2 $\x01"; |
8637 | 35 | break; |
8638 | 35 | } |
8639 | 436 | if (MCInst_getNumOperands(MI) == 2 && |
8640 | 436 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8641 | 436 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8642 | 436 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8643 | 436 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 131) { |
8644 | | // (MFDCR gprc:$Rx, 131) |
8645 | 79 | AsmString = "mfbr3 $\x01"; |
8646 | 79 | break; |
8647 | 79 | } |
8648 | 357 | if (MCInst_getNumOperands(MI) == 2 && |
8649 | 357 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8650 | 357 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8651 | 357 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8652 | 357 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 132) { |
8653 | | // (MFDCR gprc:$Rx, 132) |
8654 | 28 | AsmString = "mfbr4 $\x01"; |
8655 | 28 | break; |
8656 | 28 | } |
8657 | 329 | if (MCInst_getNumOperands(MI) == 2 && |
8658 | 329 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8659 | 329 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8660 | 329 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8661 | 329 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 133) { |
8662 | | // (MFDCR gprc:$Rx, 133) |
8663 | 25 | AsmString = "mfbr5 $\x01"; |
8664 | 25 | break; |
8665 | 25 | } |
8666 | 304 | if (MCInst_getNumOperands(MI) == 2 && |
8667 | 304 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8668 | 304 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8669 | 304 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8670 | 304 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 134) { |
8671 | | // (MFDCR gprc:$Rx, 134) |
8672 | 15 | AsmString = "mfbr6 $\x01"; |
8673 | 15 | break; |
8674 | 15 | } |
8675 | 289 | if (MCInst_getNumOperands(MI) == 2 && |
8676 | 289 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8677 | 289 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8678 | 289 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8679 | 289 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 135) { |
8680 | | // (MFDCR gprc:$Rx, 135) |
8681 | 157 | AsmString = "mfbr7 $\x01"; |
8682 | 157 | break; |
8683 | 157 | } |
8684 | 132 | return NULL; |
8685 | 5.12k | case PPC_MFSPR: |
8686 | 5.12k | if (MCInst_getNumOperands(MI) == 2 && |
8687 | 5.12k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8688 | 5.12k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8689 | 5.12k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8690 | 5.12k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 1) { |
8691 | | // (MFSPR gprc:$Rx, 1) |
8692 | 90 | AsmString = "mfxer $\x01"; |
8693 | 90 | break; |
8694 | 90 | } |
8695 | 5.03k | if (MCInst_getNumOperands(MI) == 2 && |
8696 | 5.03k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8697 | 5.03k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8698 | 5.03k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8699 | 5.03k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 4) { |
8700 | | // (MFSPR gprc:$Rx, 4) |
8701 | 10 | AsmString = "mfrtcu $\x01"; |
8702 | 10 | break; |
8703 | 10 | } |
8704 | 5.02k | if (MCInst_getNumOperands(MI) == 2 && |
8705 | 5.02k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8706 | 5.02k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8707 | 5.02k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8708 | 5.02k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 5) { |
8709 | | // (MFSPR gprc:$Rx, 5) |
8710 | 225 | AsmString = "mfrtcl $\x01"; |
8711 | 225 | break; |
8712 | 225 | } |
8713 | 4.79k | if (MCInst_getNumOperands(MI) == 2 && |
8714 | 4.79k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8715 | 4.79k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8716 | 4.79k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8717 | 4.79k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 17) { |
8718 | | // (MFSPR gprc:$Rx, 17) |
8719 | 12 | AsmString = "mfdscr $\x01"; |
8720 | 12 | break; |
8721 | 12 | } |
8722 | 4.78k | if (MCInst_getNumOperands(MI) == 2 && |
8723 | 4.78k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8724 | 4.78k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8725 | 4.78k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8726 | 4.78k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 18) { |
8727 | | // (MFSPR gprc:$Rx, 18) |
8728 | 26 | AsmString = "mfdsisr $\x01"; |
8729 | 26 | break; |
8730 | 26 | } |
8731 | 4.76k | if (MCInst_getNumOperands(MI) == 2 && |
8732 | 4.76k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8733 | 4.76k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8734 | 4.76k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8735 | 4.76k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 19) { |
8736 | | // (MFSPR gprc:$Rx, 19) |
8737 | 18 | AsmString = "mfdar $\x01"; |
8738 | 18 | break; |
8739 | 18 | } |
8740 | 4.74k | if (MCInst_getNumOperands(MI) == 2 && |
8741 | 4.74k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8742 | 4.74k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8743 | 4.74k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8744 | 4.74k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 990) { |
8745 | | // (MFSPR gprc:$Rx, 990) |
8746 | 21 | AsmString = "mfsrr2 $\x01"; |
8747 | 21 | break; |
8748 | 21 | } |
8749 | 4.72k | if (MCInst_getNumOperands(MI) == 2 && |
8750 | 4.72k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8751 | 4.72k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8752 | 4.72k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8753 | 4.72k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 991) { |
8754 | | // (MFSPR gprc:$Rx, 991) |
8755 | 17 | AsmString = "mfsrr3 $\x01"; |
8756 | 17 | break; |
8757 | 17 | } |
8758 | 4.70k | if (MCInst_getNumOperands(MI) == 2 && |
8759 | 4.70k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8760 | 4.70k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8761 | 4.70k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8762 | 4.70k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 28) { |
8763 | | // (MFSPR gprc:$Rx, 28) |
8764 | 10 | AsmString = "mfcfar $\x01"; |
8765 | 10 | break; |
8766 | 10 | } |
8767 | 4.69k | if (MCInst_getNumOperands(MI) == 2 && |
8768 | 4.69k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8769 | 4.69k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8770 | 4.69k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8771 | 4.69k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 29) { |
8772 | | // (MFSPR gprc:$Rx, 29) |
8773 | 13 | AsmString = "mfamr $\x01"; |
8774 | 13 | break; |
8775 | 13 | } |
8776 | 4.68k | if (MCInst_getNumOperands(MI) == 2 && |
8777 | 4.68k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8778 | 4.68k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8779 | 4.68k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8780 | 4.68k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 48) { |
8781 | | // (MFSPR gprc:$Rx, 48) |
8782 | 24 | AsmString = "mfpid $\x01"; |
8783 | 24 | break; |
8784 | 24 | } |
8785 | 4.65k | if (MCInst_getNumOperands(MI) == 2 && |
8786 | 4.65k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8787 | 4.65k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8788 | 4.65k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8789 | 4.65k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 989) { |
8790 | | // (MFSPR gprc:$Rx, 989) |
8791 | 15 | AsmString = "mftblo $\x01"; |
8792 | 15 | break; |
8793 | 15 | } |
8794 | 4.64k | if (MCInst_getNumOperands(MI) == 2 && |
8795 | 4.64k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8796 | 4.64k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8797 | 4.64k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8798 | 4.64k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 988) { |
8799 | | // (MFSPR gprc:$Rx, 988) |
8800 | 12 | AsmString = "mftbhi $\x01"; |
8801 | 12 | break; |
8802 | 12 | } |
8803 | 4.63k | if (MCInst_getNumOperands(MI) == 2 && |
8804 | 4.63k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8805 | 4.63k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8806 | 4.63k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8807 | 4.63k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 536) { |
8808 | | // (MFSPR gprc:$Rx, 536) |
8809 | 49 | AsmString = "mfdbatu $\x01, 0"; |
8810 | 49 | break; |
8811 | 49 | } |
8812 | 4.58k | if (MCInst_getNumOperands(MI) == 2 && |
8813 | 4.58k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8814 | 4.58k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8815 | 4.58k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8816 | 4.58k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 537) { |
8817 | | // (MFSPR gprc:$Rx, 537) |
8818 | 352 | AsmString = "mfdbatl $\x01, 0"; |
8819 | 352 | break; |
8820 | 352 | } |
8821 | 4.23k | if (MCInst_getNumOperands(MI) == 2 && |
8822 | 4.23k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8823 | 4.23k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8824 | 4.23k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8825 | 4.23k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 528) { |
8826 | | // (MFSPR gprc:$Rx, 528) |
8827 | 100 | AsmString = "mfibatu $\x01, 0"; |
8828 | 100 | break; |
8829 | 100 | } |
8830 | 4.13k | if (MCInst_getNumOperands(MI) == 2 && |
8831 | 4.13k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8832 | 4.13k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8833 | 4.13k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8834 | 4.13k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 529) { |
8835 | | // (MFSPR gprc:$Rx, 529) |
8836 | 20 | AsmString = "mfibatl $\x01, 0"; |
8837 | 20 | break; |
8838 | 20 | } |
8839 | 4.11k | if (MCInst_getNumOperands(MI) == 2 && |
8840 | 4.11k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8841 | 4.11k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8842 | 4.11k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8843 | 4.11k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 538) { |
8844 | | // (MFSPR gprc:$Rx, 538) |
8845 | 13 | AsmString = "mfdbatu $\x01, 1"; |
8846 | 13 | break; |
8847 | 13 | } |
8848 | 4.09k | if (MCInst_getNumOperands(MI) == 2 && |
8849 | 4.09k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8850 | 4.09k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8851 | 4.09k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8852 | 4.09k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 539) { |
8853 | | // (MFSPR gprc:$Rx, 539) |
8854 | 191 | AsmString = "mfdbatl $\x01, 1"; |
8855 | 191 | break; |
8856 | 191 | } |
8857 | 3.90k | if (MCInst_getNumOperands(MI) == 2 && |
8858 | 3.90k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8859 | 3.90k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8860 | 3.90k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8861 | 3.90k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 530) { |
8862 | | // (MFSPR gprc:$Rx, 530) |
8863 | 47 | AsmString = "mfibatu $\x01, 1"; |
8864 | 47 | break; |
8865 | 47 | } |
8866 | 3.85k | if (MCInst_getNumOperands(MI) == 2 && |
8867 | 3.85k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8868 | 3.85k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8869 | 3.85k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8870 | 3.85k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 531) { |
8871 | | // (MFSPR gprc:$Rx, 531) |
8872 | 405 | AsmString = "mfibatl $\x01, 1"; |
8873 | 405 | break; |
8874 | 405 | } |
8875 | 3.45k | if (MCInst_getNumOperands(MI) == 2 && |
8876 | 3.45k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8877 | 3.45k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8878 | 3.45k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8879 | 3.45k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 540) { |
8880 | | // (MFSPR gprc:$Rx, 540) |
8881 | 21 | AsmString = "mfdbatu $\x01, 2"; |
8882 | 21 | break; |
8883 | 21 | } |
8884 | 3.43k | if (MCInst_getNumOperands(MI) == 2 && |
8885 | 3.43k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8886 | 3.43k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8887 | 3.43k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8888 | 3.43k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 541) { |
8889 | | // (MFSPR gprc:$Rx, 541) |
8890 | 731 | AsmString = "mfdbatl $\x01, 2"; |
8891 | 731 | break; |
8892 | 731 | } |
8893 | 2.70k | if (MCInst_getNumOperands(MI) == 2 && |
8894 | 2.70k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8895 | 2.70k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8896 | 2.70k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8897 | 2.70k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 532) { |
8898 | | // (MFSPR gprc:$Rx, 532) |
8899 | 101 | AsmString = "mfibatu $\x01, 2"; |
8900 | 101 | break; |
8901 | 101 | } |
8902 | 2.60k | if (MCInst_getNumOperands(MI) == 2 && |
8903 | 2.60k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8904 | 2.60k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8905 | 2.60k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8906 | 2.60k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 533) { |
8907 | | // (MFSPR gprc:$Rx, 533) |
8908 | 51 | AsmString = "mfibatl $\x01, 2"; |
8909 | 51 | break; |
8910 | 51 | } |
8911 | 2.55k | if (MCInst_getNumOperands(MI) == 2 && |
8912 | 2.55k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8913 | 2.55k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8914 | 2.55k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8915 | 2.55k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 542) { |
8916 | | // (MFSPR gprc:$Rx, 542) |
8917 | 19 | AsmString = "mfdbatu $\x01, 3"; |
8918 | 19 | break; |
8919 | 19 | } |
8920 | 2.53k | if (MCInst_getNumOperands(MI) == 2 && |
8921 | 2.53k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8922 | 2.53k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8923 | 2.53k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8924 | 2.53k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 543) { |
8925 | | // (MFSPR gprc:$Rx, 543) |
8926 | 41 | AsmString = "mfdbatl $\x01, 3"; |
8927 | 41 | break; |
8928 | 41 | } |
8929 | 2.49k | if (MCInst_getNumOperands(MI) == 2 && |
8930 | 2.49k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8931 | 2.49k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8932 | 2.49k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8933 | 2.49k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 534) { |
8934 | | // (MFSPR gprc:$Rx, 534) |
8935 | 54 | AsmString = "mfibatu $\x01, 3"; |
8936 | 54 | break; |
8937 | 54 | } |
8938 | 2.43k | if (MCInst_getNumOperands(MI) == 2 && |
8939 | 2.43k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8940 | 2.43k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8941 | 2.43k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8942 | 2.43k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 535) { |
8943 | | // (MFSPR gprc:$Rx, 535) |
8944 | 56 | AsmString = "mfibatl $\x01, 3"; |
8945 | 56 | break; |
8946 | 56 | } |
8947 | 2.38k | if (MCInst_getNumOperands(MI) == 2 && |
8948 | 2.38k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8949 | 2.38k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8950 | 2.38k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8951 | 2.38k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 1018) { |
8952 | | // (MFSPR gprc:$Rx, 1018) |
8953 | 16 | AsmString = "mfdccr $\x01"; |
8954 | 16 | break; |
8955 | 16 | } |
8956 | 2.36k | if (MCInst_getNumOperands(MI) == 2 && |
8957 | 2.36k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8958 | 2.36k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8959 | 2.36k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8960 | 2.36k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 1019) { |
8961 | | // (MFSPR gprc:$Rx, 1019) |
8962 | 3 | AsmString = "mficcr $\x01"; |
8963 | 3 | break; |
8964 | 3 | } |
8965 | 2.36k | if (MCInst_getNumOperands(MI) == 2 && |
8966 | 2.36k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8967 | 2.36k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8968 | 2.36k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8969 | 2.36k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 981) { |
8970 | | // (MFSPR gprc:$Rx, 981) |
8971 | 25 | AsmString = "mfdear $\x01"; |
8972 | 25 | break; |
8973 | 25 | } |
8974 | 2.33k | if (MCInst_getNumOperands(MI) == 2 && |
8975 | 2.33k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8976 | 2.33k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8977 | 2.33k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8978 | 2.33k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 980) { |
8979 | | // (MFSPR gprc:$Rx, 980) |
8980 | 12 | AsmString = "mfesr $\x01"; |
8981 | 12 | break; |
8982 | 12 | } |
8983 | 2.32k | if (MCInst_getNumOperands(MI) == 2 && |
8984 | 2.32k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8985 | 2.32k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8986 | 2.32k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8987 | 2.32k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 512) { |
8988 | | // (MFSPR gprc:$Rx, 512) |
8989 | 32 | AsmString = "mfspefscr $\x01"; |
8990 | 32 | break; |
8991 | 32 | } |
8992 | 2.29k | if (MCInst_getNumOperands(MI) == 2 && |
8993 | 2.29k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
8994 | 2.29k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
8995 | 2.29k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
8996 | 2.29k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 986) { |
8997 | | // (MFSPR gprc:$Rx, 986) |
8998 | 10 | AsmString = "mftcr $\x01"; |
8999 | 10 | break; |
9000 | 10 | } |
9001 | 2.28k | if (MCInst_getNumOperands(MI) == 2 && |
9002 | 2.28k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9003 | 2.28k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
9004 | 2.28k | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
9005 | 2.28k | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 280) { |
9006 | | // (MFSPR gprc:$RT, 280) |
9007 | 1.64k | AsmString = "mfasr $\x01"; |
9008 | 1.64k | break; |
9009 | 1.64k | } |
9010 | 637 | if (MCInst_getNumOperands(MI) == 2 && |
9011 | 637 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9012 | 637 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
9013 | 637 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
9014 | 637 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 287) { |
9015 | | // (MFSPR gprc:$RT, 287) |
9016 | 14 | AsmString = "mfpvr $\x01"; |
9017 | 14 | break; |
9018 | 14 | } |
9019 | 623 | return NULL; |
9020 | 14 | case PPC_MFTB: |
9021 | 14 | if (MCInst_getNumOperands(MI) == 2 && |
9022 | 14 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9023 | 14 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
9024 | 14 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
9025 | 14 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 269) { |
9026 | | // (MFTB gprc:$Rx, 269) |
9027 | 1 | AsmString = "mftbu $\x01"; |
9028 | 1 | break; |
9029 | 1 | } |
9030 | 13 | return NULL; |
9031 | 0 | case PPC_MFVRSAVE: |
9032 | 0 | if (MCInst_getNumOperands(MI) == 1 && |
9033 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9034 | 0 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0)) { |
9035 | | // (MFVRSAVE gprc:$rS) |
9036 | 0 | AsmString = "mfvrsave $\x01"; |
9037 | 0 | break; |
9038 | 0 | } |
9039 | 0 | return NULL; |
9040 | 44 | case PPC_MFVSRD: |
9041 | 44 | if (MCInst_getNumOperands(MI) == 2 && |
9042 | 44 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9043 | 44 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 0) && |
9044 | 44 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9045 | 44 | GETREGCLASS_CONTAIN(PPC_F8RCRegClassID, 1)) { |
9046 | | // (MFVSRD g8rc:$rA, f8rc:$src) |
9047 | 24 | AsmString = "mffprd $\x01, $\x02"; |
9048 | 24 | break; |
9049 | 24 | } |
9050 | 20 | return NULL; |
9051 | 0 | case PPC_MTCRF8: |
9052 | 0 | if (MCInst_getNumOperands(MI) == 2 && |
9053 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9054 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 255 && |
9055 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9056 | 0 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1)) { |
9057 | | // (MTCRF8 255, g8rc:$rA) |
9058 | 0 | AsmString = "mtcr $\x02"; |
9059 | 0 | break; |
9060 | 0 | } |
9061 | 0 | return NULL; |
9062 | 503 | case PPC_MTDCR: |
9063 | 503 | if (MCInst_getNumOperands(MI) == 2 && |
9064 | 503 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9065 | 503 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
9066 | 503 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
9067 | 503 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 128) { |
9068 | | // (MTDCR gprc:$Rx, 128) |
9069 | 28 | AsmString = "mtbr0 $\x01"; |
9070 | 28 | break; |
9071 | 28 | } |
9072 | 475 | if (MCInst_getNumOperands(MI) == 2 && |
9073 | 475 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9074 | 475 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
9075 | 475 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
9076 | 475 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 129) { |
9077 | | // (MTDCR gprc:$Rx, 129) |
9078 | 16 | AsmString = "mtbr1 $\x01"; |
9079 | 16 | break; |
9080 | 16 | } |
9081 | 459 | if (MCInst_getNumOperands(MI) == 2 && |
9082 | 459 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9083 | 459 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
9084 | 459 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
9085 | 459 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 130) { |
9086 | | // (MTDCR gprc:$Rx, 130) |
9087 | 80 | AsmString = "mtbr2 $\x01"; |
9088 | 80 | break; |
9089 | 80 | } |
9090 | 379 | if (MCInst_getNumOperands(MI) == 2 && |
9091 | 379 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9092 | 379 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
9093 | 379 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
9094 | 379 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 131) { |
9095 | | // (MTDCR gprc:$Rx, 131) |
9096 | 32 | AsmString = "mtbr3 $\x01"; |
9097 | 32 | break; |
9098 | 32 | } |
9099 | 347 | if (MCInst_getNumOperands(MI) == 2 && |
9100 | 347 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9101 | 347 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
9102 | 347 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
9103 | 347 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 132) { |
9104 | | // (MTDCR gprc:$Rx, 132) |
9105 | 35 | AsmString = "mtbr4 $\x01"; |
9106 | 35 | break; |
9107 | 35 | } |
9108 | 312 | if (MCInst_getNumOperands(MI) == 2 && |
9109 | 312 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9110 | 312 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
9111 | 312 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
9112 | 312 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 133) { |
9113 | | // (MTDCR gprc:$Rx, 133) |
9114 | 17 | AsmString = "mtbr5 $\x01"; |
9115 | 17 | break; |
9116 | 17 | } |
9117 | 295 | if (MCInst_getNumOperands(MI) == 2 && |
9118 | 295 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9119 | 295 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
9120 | 295 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
9121 | 295 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 134) { |
9122 | | // (MTDCR gprc:$Rx, 134) |
9123 | 21 | AsmString = "mtbr6 $\x01"; |
9124 | 21 | break; |
9125 | 21 | } |
9126 | 274 | if (MCInst_getNumOperands(MI) == 2 && |
9127 | 274 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9128 | 274 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
9129 | 274 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
9130 | 274 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 135) { |
9131 | | // (MTDCR gprc:$Rx, 135) |
9132 | 138 | AsmString = "mtbr7 $\x01"; |
9133 | 138 | break; |
9134 | 138 | } |
9135 | 136 | return NULL; |
9136 | 131 | case PPC_MTFSF: |
9137 | 131 | if (MCInst_getNumOperands(MI) == 4 && |
9138 | 131 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9139 | 131 | GETREGCLASS_CONTAIN(PPC_F8RCRegClassID, 1) && |
9140 | 131 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
9141 | 131 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0 && |
9142 | 131 | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
9143 | 131 | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 0) { |
9144 | | // (MTFSF i32imm:$FLM, f8rc:$FRB, 0, 0) |
9145 | 38 | AsmString = "mtfsf $\x01, $\x02"; |
9146 | 38 | break; |
9147 | 38 | } |
9148 | 93 | return NULL; |
9149 | 22 | case PPC_MTFSFI: |
9150 | 22 | if (MCInst_getNumOperands(MI) == 3 && |
9151 | 22 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9152 | 22 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 0) && |
9153 | 22 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
9154 | 22 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
9155 | | // (MTFSFI crrc:$BF, i32imm:$U, 0) |
9156 | 17 | AsmString = "mtfsfi $\x01, $\x02"; |
9157 | 17 | break; |
9158 | 17 | } |
9159 | 5 | return NULL; |
9160 | 60 | case PPC_MTFSFIo: |
9161 | 60 | if (MCInst_getNumOperands(MI) == 3 && |
9162 | 60 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9163 | 60 | GETREGCLASS_CONTAIN(PPC_CRRCRegClassID, 0) && |
9164 | 60 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
9165 | 60 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
9166 | | // (MTFSFIo crrc:$BF, i32imm:$U, 0) |
9167 | 17 | AsmString = "mtfsfi. $\x01, $\x02"; |
9168 | 17 | break; |
9169 | 17 | } |
9170 | 43 | return NULL; |
9171 | 44 | case PPC_MTFSFo: |
9172 | 44 | if (MCInst_getNumOperands(MI) == 4 && |
9173 | 44 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9174 | 44 | GETREGCLASS_CONTAIN(PPC_F8RCRegClassID, 1) && |
9175 | 44 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
9176 | 44 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0 && |
9177 | 44 | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
9178 | 44 | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 0) { |
9179 | | // (MTFSFo i32imm:$FLM, f8rc:$FRB, 0, 0) |
9180 | 15 | AsmString = "mtfsf. $\x01, $\x02"; |
9181 | 15 | break; |
9182 | 15 | } |
9183 | 29 | return NULL; |
9184 | 31 | case PPC_MTMSR: |
9185 | 31 | if (MCInst_getNumOperands(MI) == 2 && |
9186 | 31 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9187 | 31 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
9188 | 31 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
9189 | 31 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 0) { |
9190 | | // (MTMSR gprc:$RS, 0) |
9191 | 11 | AsmString = "mtmsr $\x01"; |
9192 | 11 | break; |
9193 | 11 | } |
9194 | 20 | return NULL; |
9195 | 29 | case PPC_MTMSRD: |
9196 | 29 | if (MCInst_getNumOperands(MI) == 2 && |
9197 | 29 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9198 | 29 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
9199 | 29 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
9200 | 29 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 0) { |
9201 | | // (MTMSRD gprc:$RS, 0) |
9202 | 13 | AsmString = "mtmsrd $\x01"; |
9203 | 13 | break; |
9204 | 13 | } |
9205 | 16 | return NULL; |
9206 | 4.66k | case PPC_MTSPR: |
9207 | 4.66k | if (MCInst_getNumOperands(MI) == 2 && |
9208 | 4.66k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9209 | 4.66k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 1 && |
9210 | 4.66k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9211 | 4.66k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9212 | | // (MTSPR 1, gprc:$Rx) |
9213 | 65 | AsmString = "mtxer $\x02"; |
9214 | 65 | break; |
9215 | 65 | } |
9216 | 4.59k | if (MCInst_getNumOperands(MI) == 2 && |
9217 | 4.59k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9218 | 4.59k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 17 && |
9219 | 4.59k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9220 | 4.59k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9221 | | // (MTSPR 17, gprc:$Rx) |
9222 | 15 | AsmString = "mtdscr $\x02"; |
9223 | 15 | break; |
9224 | 15 | } |
9225 | 4.58k | if (MCInst_getNumOperands(MI) == 2 && |
9226 | 4.58k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9227 | 4.58k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 18 && |
9228 | 4.58k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9229 | 4.58k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9230 | | // (MTSPR 18, gprc:$Rx) |
9231 | 10 | AsmString = "mtdsisr $\x02"; |
9232 | 10 | break; |
9233 | 10 | } |
9234 | 4.57k | if (MCInst_getNumOperands(MI) == 2 && |
9235 | 4.57k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9236 | 4.57k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 19 && |
9237 | 4.57k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9238 | 4.57k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9239 | | // (MTSPR 19, gprc:$Rx) |
9240 | 21 | AsmString = "mtdar $\x02"; |
9241 | 21 | break; |
9242 | 21 | } |
9243 | 4.55k | if (MCInst_getNumOperands(MI) == 2 && |
9244 | 4.55k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9245 | 4.55k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 990 && |
9246 | 4.55k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9247 | 4.55k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9248 | | // (MTSPR 990, gprc:$Rx) |
9249 | 35 | AsmString = "mtsrr2 $\x02"; |
9250 | 35 | break; |
9251 | 35 | } |
9252 | 4.51k | if (MCInst_getNumOperands(MI) == 2 && |
9253 | 4.51k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9254 | 4.51k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 991 && |
9255 | 4.51k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9256 | 4.51k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9257 | | // (MTSPR 991, gprc:$Rx) |
9258 | 6 | AsmString = "mtsrr3 $\x02"; |
9259 | 6 | break; |
9260 | 6 | } |
9261 | 4.50k | if (MCInst_getNumOperands(MI) == 2 && |
9262 | 4.50k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9263 | 4.50k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 28 && |
9264 | 4.50k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9265 | 4.50k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9266 | | // (MTSPR 28, gprc:$Rx) |
9267 | 21 | AsmString = "mtcfar $\x02"; |
9268 | 21 | break; |
9269 | 21 | } |
9270 | 4.48k | if (MCInst_getNumOperands(MI) == 2 && |
9271 | 4.48k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9272 | 4.48k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 29 && |
9273 | 4.48k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9274 | 4.48k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9275 | | // (MTSPR 29, gprc:$Rx) |
9276 | 16 | AsmString = "mtamr $\x02"; |
9277 | 16 | break; |
9278 | 16 | } |
9279 | 4.47k | if (MCInst_getNumOperands(MI) == 2 && |
9280 | 4.47k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9281 | 4.47k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 48 && |
9282 | 4.47k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9283 | 4.47k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9284 | | // (MTSPR 48, gprc:$Rx) |
9285 | 43 | AsmString = "mtpid $\x02"; |
9286 | 43 | break; |
9287 | 43 | } |
9288 | 4.42k | if (MCInst_getNumOperands(MI) == 2 && |
9289 | 4.42k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9290 | 4.42k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 284 && |
9291 | 4.42k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9292 | 4.42k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9293 | | // (MTSPR 284, gprc:$Rx) |
9294 | 19 | AsmString = "mttbl $\x02"; |
9295 | 19 | break; |
9296 | 19 | } |
9297 | 4.41k | if (MCInst_getNumOperands(MI) == 2 && |
9298 | 4.41k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9299 | 4.41k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 285 && |
9300 | 4.41k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9301 | 4.41k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9302 | | // (MTSPR 285, gprc:$Rx) |
9303 | 24 | AsmString = "mttbu $\x02"; |
9304 | 24 | break; |
9305 | 24 | } |
9306 | 4.38k | if (MCInst_getNumOperands(MI) == 2 && |
9307 | 4.38k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9308 | 4.38k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 989 && |
9309 | 4.38k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9310 | 4.38k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9311 | | // (MTSPR 989, gprc:$Rx) |
9312 | 67 | AsmString = "mttblo $\x02"; |
9313 | 67 | break; |
9314 | 67 | } |
9315 | 4.31k | if (MCInst_getNumOperands(MI) == 2 && |
9316 | 4.31k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9317 | 4.31k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 988 && |
9318 | 4.31k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9319 | 4.31k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9320 | | // (MTSPR 988, gprc:$Rx) |
9321 | 19 | AsmString = "mttbhi $\x02"; |
9322 | 19 | break; |
9323 | 19 | } |
9324 | 4.30k | if (MCInst_getNumOperands(MI) == 2 && |
9325 | 4.30k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9326 | 4.30k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 536 && |
9327 | 4.30k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9328 | 4.30k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9329 | | // (MTSPR 536, gprc:$Rx) |
9330 | 1.06k | AsmString = "mtdbatu 0, $\x02"; |
9331 | 1.06k | break; |
9332 | 1.06k | } |
9333 | 3.23k | if (MCInst_getNumOperands(MI) == 2 && |
9334 | 3.23k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9335 | 3.23k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 537 && |
9336 | 3.23k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9337 | 3.23k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9338 | | // (MTSPR 537, gprc:$Rx) |
9339 | 278 | AsmString = "mtdbatl 0, $\x02"; |
9340 | 278 | break; |
9341 | 278 | } |
9342 | 2.96k | if (MCInst_getNumOperands(MI) == 2 && |
9343 | 2.96k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9344 | 2.96k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 528 && |
9345 | 2.96k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9346 | 2.96k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9347 | | // (MTSPR 528, gprc:$Rx) |
9348 | 18 | AsmString = "mtibatu 0, $\x02"; |
9349 | 18 | break; |
9350 | 18 | } |
9351 | 2.94k | if (MCInst_getNumOperands(MI) == 2 && |
9352 | 2.94k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9353 | 2.94k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 529 && |
9354 | 2.94k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9355 | 2.94k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9356 | | // (MTSPR 529, gprc:$Rx) |
9357 | 120 | AsmString = "mtibatl 0, $\x02"; |
9358 | 120 | break; |
9359 | 120 | } |
9360 | 2.82k | if (MCInst_getNumOperands(MI) == 2 && |
9361 | 2.82k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9362 | 2.82k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 538 && |
9363 | 2.82k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9364 | 2.82k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9365 | | // (MTSPR 538, gprc:$Rx) |
9366 | 68 | AsmString = "mtdbatu 1, $\x02"; |
9367 | 68 | break; |
9368 | 68 | } |
9369 | 2.75k | if (MCInst_getNumOperands(MI) == 2 && |
9370 | 2.75k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9371 | 2.75k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 539 && |
9372 | 2.75k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9373 | 2.75k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9374 | | // (MTSPR 539, gprc:$Rx) |
9375 | 45 | AsmString = "mtdbatl 1, $\x02"; |
9376 | 45 | break; |
9377 | 45 | } |
9378 | 2.71k | if (MCInst_getNumOperands(MI) == 2 && |
9379 | 2.71k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9380 | 2.71k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 530 && |
9381 | 2.71k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9382 | 2.71k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9383 | | // (MTSPR 530, gprc:$Rx) |
9384 | 18 | AsmString = "mtibatu 1, $\x02"; |
9385 | 18 | break; |
9386 | 18 | } |
9387 | 2.69k | if (MCInst_getNumOperands(MI) == 2 && |
9388 | 2.69k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9389 | 2.69k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 531 && |
9390 | 2.69k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9391 | 2.69k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9392 | | // (MTSPR 531, gprc:$Rx) |
9393 | 115 | AsmString = "mtibatl 1, $\x02"; |
9394 | 115 | break; |
9395 | 115 | } |
9396 | 2.57k | if (MCInst_getNumOperands(MI) == 2 && |
9397 | 2.57k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9398 | 2.57k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 540 && |
9399 | 2.57k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9400 | 2.57k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9401 | | // (MTSPR 540, gprc:$Rx) |
9402 | 11 | AsmString = "mtdbatu 2, $\x02"; |
9403 | 11 | break; |
9404 | 11 | } |
9405 | 2.56k | if (MCInst_getNumOperands(MI) == 2 && |
9406 | 2.56k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9407 | 2.56k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 541 && |
9408 | 2.56k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9409 | 2.56k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9410 | | // (MTSPR 541, gprc:$Rx) |
9411 | 31 | AsmString = "mtdbatl 2, $\x02"; |
9412 | 31 | break; |
9413 | 31 | } |
9414 | 2.53k | if (MCInst_getNumOperands(MI) == 2 && |
9415 | 2.53k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9416 | 2.53k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 532 && |
9417 | 2.53k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9418 | 2.53k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9419 | | // (MTSPR 532, gprc:$Rx) |
9420 | 180 | AsmString = "mtibatu 2, $\x02"; |
9421 | 180 | break; |
9422 | 180 | } |
9423 | 2.35k | if (MCInst_getNumOperands(MI) == 2 && |
9424 | 2.35k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9425 | 2.35k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 533 && |
9426 | 2.35k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9427 | 2.35k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9428 | | // (MTSPR 533, gprc:$Rx) |
9429 | 68 | AsmString = "mtibatl 2, $\x02"; |
9430 | 68 | break; |
9431 | 68 | } |
9432 | 2.28k | if (MCInst_getNumOperands(MI) == 2 && |
9433 | 2.28k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9434 | 2.28k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 542 && |
9435 | 2.28k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9436 | 2.28k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9437 | | // (MTSPR 542, gprc:$Rx) |
9438 | 35 | AsmString = "mtdbatu 3, $\x02"; |
9439 | 35 | break; |
9440 | 35 | } |
9441 | 2.25k | if (MCInst_getNumOperands(MI) == 2 && |
9442 | 2.25k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9443 | 2.25k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 543 && |
9444 | 2.25k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9445 | 2.25k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9446 | | // (MTSPR 543, gprc:$Rx) |
9447 | 34 | AsmString = "mtdbatl 3, $\x02"; |
9448 | 34 | break; |
9449 | 34 | } |
9450 | 2.21k | if (MCInst_getNumOperands(MI) == 2 && |
9451 | 2.21k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9452 | 2.21k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 534 && |
9453 | 2.21k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9454 | 2.21k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9455 | | // (MTSPR 534, gprc:$Rx) |
9456 | 608 | AsmString = "mtibatu 3, $\x02"; |
9457 | 608 | break; |
9458 | 608 | } |
9459 | 1.61k | if (MCInst_getNumOperands(MI) == 2 && |
9460 | 1.61k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9461 | 1.61k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 535 && |
9462 | 1.61k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9463 | 1.61k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9464 | | // (MTSPR 535, gprc:$Rx) |
9465 | 782 | AsmString = "mtibatl 3, $\x02"; |
9466 | 782 | break; |
9467 | 782 | } |
9468 | 828 | if (MCInst_getNumOperands(MI) == 2 && |
9469 | 828 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9470 | 828 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 1018 && |
9471 | 828 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9472 | 828 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9473 | | // (MTSPR 1018, gprc:$Rx) |
9474 | 13 | AsmString = "mtdccr $\x02"; |
9475 | 13 | break; |
9476 | 13 | } |
9477 | 815 | if (MCInst_getNumOperands(MI) == 2 && |
9478 | 815 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9479 | 815 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 1019 && |
9480 | 815 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9481 | 815 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9482 | | // (MTSPR 1019, gprc:$Rx) |
9483 | 20 | AsmString = "mticcr $\x02"; |
9484 | 20 | break; |
9485 | 20 | } |
9486 | 795 | if (MCInst_getNumOperands(MI) == 2 && |
9487 | 795 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9488 | 795 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 981 && |
9489 | 795 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9490 | 795 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9491 | | // (MTSPR 981, gprc:$Rx) |
9492 | 46 | AsmString = "mtdear $\x02"; |
9493 | 46 | break; |
9494 | 46 | } |
9495 | 749 | if (MCInst_getNumOperands(MI) == 2 && |
9496 | 749 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9497 | 749 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 980 && |
9498 | 749 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9499 | 749 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9500 | | // (MTSPR 980, gprc:$Rx) |
9501 | 12 | AsmString = "mtesr $\x02"; |
9502 | 12 | break; |
9503 | 12 | } |
9504 | 737 | if (MCInst_getNumOperands(MI) == 2 && |
9505 | 737 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9506 | 737 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 512 && |
9507 | 737 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9508 | 737 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9509 | | // (MTSPR 512, gprc:$Rx) |
9510 | 345 | AsmString = "mtspefscr $\x02"; |
9511 | 345 | break; |
9512 | 345 | } |
9513 | 392 | if (MCInst_getNumOperands(MI) == 2 && |
9514 | 392 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9515 | 392 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 986 && |
9516 | 392 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9517 | 392 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
9518 | | // (MTSPR 986, gprc:$Rx) |
9519 | 13 | AsmString = "mttcr $\x02"; |
9520 | 13 | break; |
9521 | 13 | } |
9522 | 379 | return NULL; |
9523 | 0 | case PPC_MTVRSAVE: |
9524 | 0 | if (MCInst_getNumOperands(MI) == 1 && |
9525 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9526 | 0 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0)) { |
9527 | | // (MTVRSAVE gprc:$rS) |
9528 | 0 | AsmString = "mtvrsave $\x01"; |
9529 | 0 | break; |
9530 | 0 | } |
9531 | 0 | return NULL; |
9532 | 0 | case PPC_NOR8: |
9533 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
9534 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9535 | 0 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 0) && |
9536 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9537 | 0 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1) && |
9538 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
9539 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 2)) == MCOperand_getReg(MCInst_getOperand(MI, 1))) { |
9540 | | // (NOR8 g8rc:$rA, g8rc:$rB, g8rc:$rB) |
9541 | 0 | AsmString = "not $\x01, $\x02"; |
9542 | 0 | break; |
9543 | 0 | } |
9544 | 0 | return NULL; |
9545 | 0 | case PPC_NOR8o: |
9546 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
9547 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9548 | 0 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 0) && |
9549 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9550 | 0 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1) && |
9551 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
9552 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 2)) == MCOperand_getReg(MCInst_getOperand(MI, 1))) { |
9553 | | // (NOR8o g8rc:$rA, g8rc:$rB, g8rc:$rB) |
9554 | 0 | AsmString = "not. $\x01, $\x02"; |
9555 | 0 | break; |
9556 | 0 | } |
9557 | 0 | return NULL; |
9558 | 0 | case PPC_OR8: |
9559 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
9560 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9561 | 0 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 0) && |
9562 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9563 | 0 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1) && |
9564 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
9565 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 2)) == MCOperand_getReg(MCInst_getOperand(MI, 1))) { |
9566 | | // (OR8 g8rc:$rA, g8rc:$rB, g8rc:$rB) |
9567 | 0 | AsmString = "mr $\x01, $\x02"; |
9568 | 0 | break; |
9569 | 0 | } |
9570 | 0 | return NULL; |
9571 | 0 | case PPC_OR8o: |
9572 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
9573 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9574 | 0 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 0) && |
9575 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9576 | 0 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1) && |
9577 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
9578 | 0 | MCOperand_getReg(MCInst_getOperand(MI, 2)) == MCOperand_getReg(MCInst_getOperand(MI, 1))) { |
9579 | | // (OR8o g8rc:$rA, g8rc:$rB, g8rc:$rB) |
9580 | 0 | AsmString = "mr. $\x01, $\x02"; |
9581 | 0 | break; |
9582 | 0 | } |
9583 | 0 | return NULL; |
9584 | 1.40k | case PPC_QVFLOGICALb: |
9585 | 1.40k | if (MCInst_getNumOperands(MI) == 4 && |
9586 | 1.40k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9587 | 1.40k | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 0) && |
9588 | 1.40k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9589 | 1.40k | MCOperand_getReg(MCInst_getOperand(MI, 1)) == MCOperand_getReg(MCInst_getOperand(MI, 0)) && |
9590 | 1.40k | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
9591 | 1.40k | MCOperand_getReg(MCInst_getOperand(MI, 2)) == MCOperand_getReg(MCInst_getOperand(MI, 0)) && |
9592 | 1.40k | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
9593 | 1.40k | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 0) { |
9594 | | // (QVFLOGICALb qbrc:$FRT, qbrc:$FRT, qbrc:$FRT, 0) |
9595 | 24 | AsmString = "qvfclr $\x01"; |
9596 | 24 | break; |
9597 | 24 | } |
9598 | 1.37k | if (MCInst_getNumOperands(MI) == 4 && |
9599 | 1.37k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9600 | 1.37k | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 0) && |
9601 | 1.37k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9602 | 1.37k | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 1) && |
9603 | 1.37k | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
9604 | 1.37k | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 2) && |
9605 | 1.37k | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
9606 | 1.37k | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 1) { |
9607 | | // (QVFLOGICALb qbrc:$FRT, qbrc:$FRA, qbrc:$FRB, 1) |
9608 | 23 | AsmString = "qvfand $\x01, $\x02, $\x03"; |
9609 | 23 | break; |
9610 | 23 | } |
9611 | 1.35k | if (MCInst_getNumOperands(MI) == 4 && |
9612 | 1.35k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9613 | 1.35k | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 0) && |
9614 | 1.35k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9615 | 1.35k | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 1) && |
9616 | 1.35k | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
9617 | 1.35k | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 2) && |
9618 | 1.35k | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
9619 | 1.35k | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 4) { |
9620 | | // (QVFLOGICALb qbrc:$FRT, qbrc:$FRA, qbrc:$FRB, 4) |
9621 | 232 | AsmString = "qvfandc $\x01, $\x02, $\x03"; |
9622 | 232 | break; |
9623 | 232 | } |
9624 | 1.12k | if (MCInst_getNumOperands(MI) == 4 && |
9625 | 1.12k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9626 | 1.12k | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 0) && |
9627 | 1.12k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9628 | 1.12k | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 1) && |
9629 | 1.12k | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
9630 | 1.12k | MCOperand_getReg(MCInst_getOperand(MI, 2)) == MCOperand_getReg(MCInst_getOperand(MI, 1)) && |
9631 | 1.12k | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
9632 | 1.12k | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 5) { |
9633 | | // (QVFLOGICALb qbrc:$FRT, qbrc:$FRA, qbrc:$FRA, 5) |
9634 | 12 | AsmString = "qvfctfb $\x01, $\x02"; |
9635 | 12 | break; |
9636 | 12 | } |
9637 | 1.11k | if (MCInst_getNumOperands(MI) == 4 && |
9638 | 1.11k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9639 | 1.11k | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 0) && |
9640 | 1.11k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9641 | 1.11k | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 1) && |
9642 | 1.11k | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
9643 | 1.11k | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 2) && |
9644 | 1.11k | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
9645 | 1.11k | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 6) { |
9646 | | // (QVFLOGICALb qbrc:$FRT, qbrc:$FRA, qbrc:$FRB, 6) |
9647 | 13 | AsmString = "qvfxor $\x01, $\x02, $\x03"; |
9648 | 13 | break; |
9649 | 13 | } |
9650 | 1.09k | if (MCInst_getNumOperands(MI) == 4 && |
9651 | 1.09k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9652 | 1.09k | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 0) && |
9653 | 1.09k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9654 | 1.09k | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 1) && |
9655 | 1.09k | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
9656 | 1.09k | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 2) && |
9657 | 1.09k | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
9658 | 1.09k | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 7) { |
9659 | | // (QVFLOGICALb qbrc:$FRT, qbrc:$FRA, qbrc:$FRB, 7) |
9660 | 11 | AsmString = "qvfor $\x01, $\x02, $\x03"; |
9661 | 11 | break; |
9662 | 11 | } |
9663 | 1.08k | if (MCInst_getNumOperands(MI) == 4 && |
9664 | 1.08k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9665 | 1.08k | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 0) && |
9666 | 1.08k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9667 | 1.08k | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 1) && |
9668 | 1.08k | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
9669 | 1.08k | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 2) && |
9670 | 1.08k | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
9671 | 1.08k | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 8) { |
9672 | | // (QVFLOGICALb qbrc:$FRT, qbrc:$FRA, qbrc:$FRB, 8) |
9673 | 65 | AsmString = "qvfnor $\x01, $\x02, $\x03"; |
9674 | 65 | break; |
9675 | 65 | } |
9676 | 1.02k | if (MCInst_getNumOperands(MI) == 4 && |
9677 | 1.02k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9678 | 1.02k | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 0) && |
9679 | 1.02k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9680 | 1.02k | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 1) && |
9681 | 1.02k | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
9682 | 1.02k | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 2) && |
9683 | 1.02k | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
9684 | 1.02k | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 9) { |
9685 | | // (QVFLOGICALb qbrc:$FRT, qbrc:$FRA, qbrc:$FRB, 9) |
9686 | 15 | AsmString = "qvfequ $\x01, $\x02, $\x03"; |
9687 | 15 | break; |
9688 | 15 | } |
9689 | 1.00k | if (MCInst_getNumOperands(MI) == 4 && |
9690 | 1.00k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9691 | 1.00k | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 0) && |
9692 | 1.00k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9693 | 1.00k | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 1) && |
9694 | 1.00k | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
9695 | 1.00k | MCOperand_getReg(MCInst_getOperand(MI, 2)) == MCOperand_getReg(MCInst_getOperand(MI, 1)) && |
9696 | 1.00k | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
9697 | 1.00k | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 10) { |
9698 | | // (QVFLOGICALb qbrc:$FRT, qbrc:$FRA, qbrc:$FRA, 10) |
9699 | 328 | AsmString = "qvfnot $\x01, $\x02"; |
9700 | 328 | break; |
9701 | 328 | } |
9702 | 680 | if (MCInst_getNumOperands(MI) == 4 && |
9703 | 680 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9704 | 680 | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 0) && |
9705 | 680 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9706 | 680 | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 1) && |
9707 | 680 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
9708 | 680 | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 2) && |
9709 | 680 | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
9710 | 680 | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 13) { |
9711 | | // (QVFLOGICALb qbrc:$FRT, qbrc:$FRA, qbrc:$FRB, 13) |
9712 | 23 | AsmString = "qvforc $\x01, $\x02, $\x03"; |
9713 | 23 | break; |
9714 | 23 | } |
9715 | 657 | if (MCInst_getNumOperands(MI) == 4 && |
9716 | 657 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9717 | 657 | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 0) && |
9718 | 657 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9719 | 657 | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 1) && |
9720 | 657 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
9721 | 657 | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 2) && |
9722 | 657 | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
9723 | 657 | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 14) { |
9724 | | // (QVFLOGICALb qbrc:$FRT, qbrc:$FRA, qbrc:$FRB, 14) |
9725 | 243 | AsmString = "qvfnand $\x01, $\x02, $\x03"; |
9726 | 243 | break; |
9727 | 243 | } |
9728 | 414 | if (MCInst_getNumOperands(MI) == 4 && |
9729 | 414 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9730 | 414 | GETREGCLASS_CONTAIN(PPC_QBRCRegClassID, 0) && |
9731 | 414 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9732 | 414 | MCOperand_getReg(MCInst_getOperand(MI, 1)) == MCOperand_getReg(MCInst_getOperand(MI, 0)) && |
9733 | 414 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
9734 | 414 | MCOperand_getReg(MCInst_getOperand(MI, 2)) == MCOperand_getReg(MCInst_getOperand(MI, 0)) && |
9735 | 414 | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
9736 | 414 | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 15) { |
9737 | | // (QVFLOGICALb qbrc:$FRT, qbrc:$FRT, qbrc:$FRT, 15) |
9738 | 14 | AsmString = "qvfset $\x01"; |
9739 | 14 | break; |
9740 | 14 | } |
9741 | 400 | return NULL; |
9742 | 259 | case PPC_RLDCL: |
9743 | 259 | if (MCInst_getNumOperands(MI) == 4 && |
9744 | 259 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9745 | 259 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 0) && |
9746 | 259 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9747 | 259 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1) && |
9748 | 259 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
9749 | 259 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 2) && |
9750 | 259 | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
9751 | 259 | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 0) { |
9752 | | // (RLDCL g8rc:$rA, g8rc:$rS, gprc:$rB, 0) |
9753 | 35 | AsmString = "rotld $\x01, $\x02, $\x03"; |
9754 | 35 | break; |
9755 | 35 | } |
9756 | 224 | return NULL; |
9757 | 966 | case PPC_RLDCLo: |
9758 | 966 | if (MCInst_getNumOperands(MI) == 4 && |
9759 | 966 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9760 | 966 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 0) && |
9761 | 966 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9762 | 966 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1) && |
9763 | 966 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
9764 | 966 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 2) && |
9765 | 966 | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
9766 | 966 | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 0) { |
9767 | | // (RLDCLo g8rc:$rA, g8rc:$rS, gprc:$rB, 0) |
9768 | 686 | AsmString = "rotld. $\x01, $\x02, $\x03"; |
9769 | 686 | break; |
9770 | 686 | } |
9771 | 280 | return NULL; |
9772 | 247 | case PPC_RLDICL: |
9773 | 247 | if (MCInst_getNumOperands(MI) == 4 && |
9774 | 247 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9775 | 247 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 0) && |
9776 | 247 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9777 | 247 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1) && |
9778 | 247 | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
9779 | 247 | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 0) { |
9780 | | // (RLDICL g8rc:$rA, g8rc:$rS, u6imm:$n, 0) |
9781 | 55 | AsmString = "rotldi $\x01, $\x02, $\xFF\x03\x05"; |
9782 | 55 | break; |
9783 | 55 | } |
9784 | 192 | if (MCInst_getNumOperands(MI) == 4 && |
9785 | 192 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9786 | 192 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 0) && |
9787 | 192 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9788 | 192 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1) && |
9789 | 192 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
9790 | 192 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
9791 | | // (RLDICL g8rc:$rA, g8rc:$rS, 0, u6imm:$n) |
9792 | 66 | AsmString = "clrldi $\x01, $\x02, $\xFF\x04\x05"; |
9793 | 66 | break; |
9794 | 66 | } |
9795 | 126 | return NULL; |
9796 | 0 | case PPC_RLDICL_32_64: |
9797 | 0 | if (MCInst_getNumOperands(MI) == 4 && |
9798 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9799 | 0 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 0) && |
9800 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9801 | 0 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1) && |
9802 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
9803 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
9804 | | // (RLDICL_32_64 g8rc:$rA, gprc:$rS, 0, u6imm:$n) |
9805 | 0 | AsmString = "clrldi $\x01, $\x02, $\xFF\x04\x05"; |
9806 | 0 | break; |
9807 | 0 | } |
9808 | 0 | return NULL; |
9809 | 202 | case PPC_RLDICLo: |
9810 | 202 | if (MCInst_getNumOperands(MI) == 4 && |
9811 | 202 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9812 | 202 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 0) && |
9813 | 202 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9814 | 202 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1) && |
9815 | 202 | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
9816 | 202 | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 0) { |
9817 | | // (RLDICLo g8rc:$rA, g8rc:$rS, u6imm:$n, 0) |
9818 | 48 | AsmString = "rotldi. $\x01, $\x02, $\xFF\x03\x05"; |
9819 | 48 | break; |
9820 | 48 | } |
9821 | 154 | if (MCInst_getNumOperands(MI) == 4 && |
9822 | 154 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9823 | 154 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 0) && |
9824 | 154 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9825 | 154 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1) && |
9826 | 154 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
9827 | 154 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
9828 | | // (RLDICLo g8rc:$rA, g8rc:$rS, 0, u6imm:$n) |
9829 | 14 | AsmString = "clrldi. $\x01, $\x02, $\xFF\x04\x05"; |
9830 | 14 | break; |
9831 | 14 | } |
9832 | 140 | return NULL; |
9833 | 937 | case PPC_RLWINM: |
9834 | 937 | if (MCInst_getNumOperands(MI) == 5 && |
9835 | 937 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9836 | 937 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
9837 | 937 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9838 | 937 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1) && |
9839 | 937 | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
9840 | 937 | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 0 && |
9841 | 937 | MCOperand_isImm(MCInst_getOperand(MI, 4)) && |
9842 | 937 | MCOperand_getImm(MCInst_getOperand(MI, 4)) == 31) { |
9843 | | // (RLWINM gprc:$rA, gprc:$rS, u5imm:$n, 0, 31) |
9844 | 38 | AsmString = "rotlwi $\x01, $\x02, $\xFF\x03\x06"; |
9845 | 38 | break; |
9846 | 38 | } |
9847 | 899 | if (MCInst_getNumOperands(MI) == 5 && |
9848 | 899 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9849 | 899 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
9850 | 899 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9851 | 899 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1) && |
9852 | 899 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
9853 | 899 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0 && |
9854 | 899 | MCOperand_isImm(MCInst_getOperand(MI, 4)) && |
9855 | 899 | MCOperand_getImm(MCInst_getOperand(MI, 4)) == 31) { |
9856 | | // (RLWINM gprc:$rA, gprc:$rS, 0, u5imm:$n, 31) |
9857 | 4 | AsmString = "clrlwi $\x01, $\x02, $\xFF\x04\x06"; |
9858 | 4 | break; |
9859 | 4 | } |
9860 | 895 | return NULL; |
9861 | 625 | case PPC_RLWINMo: |
9862 | 625 | if (MCInst_getNumOperands(MI) == 5 && |
9863 | 625 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9864 | 625 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
9865 | 625 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9866 | 625 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1) && |
9867 | 625 | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
9868 | 625 | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 0 && |
9869 | 625 | MCOperand_isImm(MCInst_getOperand(MI, 4)) && |
9870 | 625 | MCOperand_getImm(MCInst_getOperand(MI, 4)) == 31) { |
9871 | | // (RLWINMo gprc:$rA, gprc:$rS, u5imm:$n, 0, 31) |
9872 | 20 | AsmString = "rotlwi. $\x01, $\x02, $\xFF\x03\x06"; |
9873 | 20 | break; |
9874 | 20 | } |
9875 | 605 | if (MCInst_getNumOperands(MI) == 5 && |
9876 | 605 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9877 | 605 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
9878 | 605 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9879 | 605 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1) && |
9880 | 605 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
9881 | 605 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0 && |
9882 | 605 | MCOperand_isImm(MCInst_getOperand(MI, 4)) && |
9883 | 605 | MCOperand_getImm(MCInst_getOperand(MI, 4)) == 31) { |
9884 | | // (RLWINMo gprc:$rA, gprc:$rS, 0, u5imm:$n, 31) |
9885 | 17 | AsmString = "clrlwi. $\x01, $\x02, $\xFF\x04\x06"; |
9886 | 17 | break; |
9887 | 17 | } |
9888 | 588 | return NULL; |
9889 | 1.18k | case PPC_RLWNM: |
9890 | 1.18k | if (MCInst_getNumOperands(MI) == 5 && |
9891 | 1.18k | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9892 | 1.18k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
9893 | 1.18k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9894 | 1.18k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1) && |
9895 | 1.18k | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
9896 | 1.18k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 2) && |
9897 | 1.18k | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
9898 | 1.18k | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 0 && |
9899 | 1.18k | MCOperand_isImm(MCInst_getOperand(MI, 4)) && |
9900 | 1.18k | MCOperand_getImm(MCInst_getOperand(MI, 4)) == 31) { |
9901 | | // (RLWNM gprc:$rA, gprc:$rS, gprc:$rB, 0, 31) |
9902 | 66 | AsmString = "rotlw $\x01, $\x02, $\x03"; |
9903 | 66 | break; |
9904 | 66 | } |
9905 | 1.12k | return NULL; |
9906 | 634 | case PPC_RLWNMo: |
9907 | 634 | if (MCInst_getNumOperands(MI) == 5 && |
9908 | 634 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9909 | 634 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
9910 | 634 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9911 | 634 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1) && |
9912 | 634 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
9913 | 634 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 2) && |
9914 | 634 | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
9915 | 634 | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 0 && |
9916 | 634 | MCOperand_isImm(MCInst_getOperand(MI, 4)) && |
9917 | 634 | MCOperand_getImm(MCInst_getOperand(MI, 4)) == 31) { |
9918 | | // (RLWNMo gprc:$rA, gprc:$rS, gprc:$rB, 0, 31) |
9919 | 17 | AsmString = "rotlw. $\x01, $\x02, $\x03"; |
9920 | 17 | break; |
9921 | 17 | } |
9922 | 617 | return NULL; |
9923 | 1.07k | case PPC_SC: |
9924 | 1.07k | if (MCInst_getNumOperands(MI) == 1 && |
9925 | 1.07k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9926 | 1.07k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0) { |
9927 | | // (SC 0) |
9928 | 45 | AsmString = "sc"; |
9929 | 45 | break; |
9930 | 45 | } |
9931 | 1.03k | return NULL; |
9932 | 0 | case PPC_SUBF8: |
9933 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
9934 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9935 | 0 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 0) && |
9936 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9937 | 0 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1) && |
9938 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
9939 | 0 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 2)) { |
9940 | | // (SUBF8 g8rc:$rA, g8rc:$rC, g8rc:$rB) |
9941 | 0 | AsmString = "sub $\x01, $\x03, $\x02"; |
9942 | 0 | break; |
9943 | 0 | } |
9944 | 0 | return NULL; |
9945 | 0 | case PPC_SUBF8o: |
9946 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
9947 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9948 | 0 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 0) && |
9949 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9950 | 0 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1) && |
9951 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
9952 | 0 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 2)) { |
9953 | | // (SUBF8o g8rc:$rA, g8rc:$rC, g8rc:$rB) |
9954 | 0 | AsmString = "sub. $\x01, $\x03, $\x02"; |
9955 | 0 | break; |
9956 | 0 | } |
9957 | 0 | return NULL; |
9958 | 0 | case PPC_SUBFC8: |
9959 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
9960 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9961 | 0 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 0) && |
9962 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9963 | 0 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1) && |
9964 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
9965 | 0 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 2)) { |
9966 | | // (SUBFC8 g8rc:$rA, g8rc:$rC, g8rc:$rB) |
9967 | 0 | AsmString = "subc $\x01, $\x03, $\x02"; |
9968 | 0 | break; |
9969 | 0 | } |
9970 | 0 | return NULL; |
9971 | 0 | case PPC_SUBFC8o: |
9972 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
9973 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
9974 | 0 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 0) && |
9975 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
9976 | 0 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1) && |
9977 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
9978 | 0 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 2)) { |
9979 | | // (SUBFC8o g8rc:$rA, g8rc:$rC, g8rc:$rB) |
9980 | 0 | AsmString = "subc. $\x01, $\x03, $\x02"; |
9981 | 0 | break; |
9982 | 0 | } |
9983 | 0 | return NULL; |
9984 | 80 | case PPC_SYNC: |
9985 | 80 | if (MCInst_getNumOperands(MI) == 1 && |
9986 | 80 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9987 | 80 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0) { |
9988 | | // (SYNC 0) |
9989 | 14 | AsmString = "sync"; |
9990 | 14 | break; |
9991 | 14 | } |
9992 | 66 | if (MCInst_getNumOperands(MI) == 1 && |
9993 | 66 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
9994 | 66 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 1) { |
9995 | | // (SYNC 1) |
9996 | 34 | AsmString = "lwsync"; |
9997 | 34 | break; |
9998 | 34 | } |
9999 | 32 | if (MCInst_getNumOperands(MI) == 1 && |
10000 | 32 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10001 | 32 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 2) { |
10002 | | // (SYNC 2) |
10003 | 16 | AsmString = "ptesync"; |
10004 | 16 | break; |
10005 | 16 | } |
10006 | 16 | return NULL; |
10007 | 509 | case PPC_TD: |
10008 | 509 | if (MCInst_getNumOperands(MI) == 3 && |
10009 | 509 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10010 | 509 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 16 && |
10011 | 509 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10012 | 509 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1) && |
10013 | 509 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10014 | 509 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 2)) { |
10015 | | // (TD 16, g8rc:$rA, g8rc:$rB) |
10016 | 13 | AsmString = "tdlt $\x02, $\x03"; |
10017 | 13 | break; |
10018 | 13 | } |
10019 | 496 | if (MCInst_getNumOperands(MI) == 3 && |
10020 | 496 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10021 | 496 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 4 && |
10022 | 496 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10023 | 496 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1) && |
10024 | 496 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10025 | 496 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 2)) { |
10026 | | // (TD 4, g8rc:$rA, g8rc:$rB) |
10027 | 22 | AsmString = "tdeq $\x02, $\x03"; |
10028 | 22 | break; |
10029 | 22 | } |
10030 | 474 | if (MCInst_getNumOperands(MI) == 3 && |
10031 | 474 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10032 | 474 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 8 && |
10033 | 474 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10034 | 474 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1) && |
10035 | 474 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10036 | 474 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 2)) { |
10037 | | // (TD 8, g8rc:$rA, g8rc:$rB) |
10038 | 20 | AsmString = "tdgt $\x02, $\x03"; |
10039 | 20 | break; |
10040 | 20 | } |
10041 | 454 | if (MCInst_getNumOperands(MI) == 3 && |
10042 | 454 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10043 | 454 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 24 && |
10044 | 454 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10045 | 454 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1) && |
10046 | 454 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10047 | 454 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 2)) { |
10048 | | // (TD 24, g8rc:$rA, g8rc:$rB) |
10049 | 222 | AsmString = "tdne $\x02, $\x03"; |
10050 | 222 | break; |
10051 | 222 | } |
10052 | 232 | if (MCInst_getNumOperands(MI) == 3 && |
10053 | 232 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10054 | 232 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 2 && |
10055 | 232 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10056 | 232 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1) && |
10057 | 232 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10058 | 232 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 2)) { |
10059 | | // (TD 2, g8rc:$rA, g8rc:$rB) |
10060 | 4 | AsmString = "tdllt $\x02, $\x03"; |
10061 | 4 | break; |
10062 | 4 | } |
10063 | 228 | if (MCInst_getNumOperands(MI) == 3 && |
10064 | 228 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10065 | 228 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 1 && |
10066 | 228 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10067 | 228 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1) && |
10068 | 228 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10069 | 228 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 2)) { |
10070 | | // (TD 1, g8rc:$rA, g8rc:$rB) |
10071 | 14 | AsmString = "tdlgt $\x02, $\x03"; |
10072 | 14 | break; |
10073 | 14 | } |
10074 | 214 | if (MCInst_getNumOperands(MI) == 3 && |
10075 | 214 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10076 | 214 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 31 && |
10077 | 214 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10078 | 214 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1) && |
10079 | 214 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10080 | 214 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 2)) { |
10081 | | // (TD 31, g8rc:$rA, g8rc:$rB) |
10082 | 24 | AsmString = "tdu $\x02, $\x03"; |
10083 | 24 | break; |
10084 | 24 | } |
10085 | 190 | return NULL; |
10086 | 3.39k | case PPC_TDI: |
10087 | 3.39k | if (MCInst_getNumOperands(MI) == 3 && |
10088 | 3.39k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10089 | 3.39k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 16 && |
10090 | 3.39k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10091 | 3.39k | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1)) { |
10092 | | // (TDI 16, g8rc:$rA, s16imm:$imm) |
10093 | 492 | AsmString = "tdlti $\x02, $\xFF\x03\x03"; |
10094 | 492 | break; |
10095 | 492 | } |
10096 | 2.90k | if (MCInst_getNumOperands(MI) == 3 && |
10097 | 2.90k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10098 | 2.90k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 4 && |
10099 | 2.90k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10100 | 2.90k | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1)) { |
10101 | | // (TDI 4, g8rc:$rA, s16imm:$imm) |
10102 | 37 | AsmString = "tdeqi $\x02, $\xFF\x03\x03"; |
10103 | 37 | break; |
10104 | 37 | } |
10105 | 2.86k | if (MCInst_getNumOperands(MI) == 3 && |
10106 | 2.86k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10107 | 2.86k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 8 && |
10108 | 2.86k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10109 | 2.86k | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1)) { |
10110 | | // (TDI 8, g8rc:$rA, s16imm:$imm) |
10111 | 932 | AsmString = "tdgti $\x02, $\xFF\x03\x03"; |
10112 | 932 | break; |
10113 | 932 | } |
10114 | 1.93k | if (MCInst_getNumOperands(MI) == 3 && |
10115 | 1.93k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10116 | 1.93k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 24 && |
10117 | 1.93k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10118 | 1.93k | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1)) { |
10119 | | // (TDI 24, g8rc:$rA, s16imm:$imm) |
10120 | 449 | AsmString = "tdnei $\x02, $\xFF\x03\x03"; |
10121 | 449 | break; |
10122 | 449 | } |
10123 | 1.48k | if (MCInst_getNumOperands(MI) == 3 && |
10124 | 1.48k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10125 | 1.48k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 2 && |
10126 | 1.48k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10127 | 1.48k | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1)) { |
10128 | | // (TDI 2, g8rc:$rA, s16imm:$imm) |
10129 | 86 | AsmString = "tdllti $\x02, $\xFF\x03\x03"; |
10130 | 86 | break; |
10131 | 86 | } |
10132 | 1.40k | if (MCInst_getNumOperands(MI) == 3 && |
10133 | 1.40k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10134 | 1.40k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 1 && |
10135 | 1.40k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10136 | 1.40k | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1)) { |
10137 | | // (TDI 1, g8rc:$rA, s16imm:$imm) |
10138 | 406 | AsmString = "tdlgti $\x02, $\xFF\x03\x03"; |
10139 | 406 | break; |
10140 | 406 | } |
10141 | 996 | if (MCInst_getNumOperands(MI) == 3 && |
10142 | 996 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10143 | 996 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 31 && |
10144 | 996 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10145 | 996 | GETREGCLASS_CONTAIN(PPC_G8RCRegClassID, 1)) { |
10146 | | // (TDI 31, g8rc:$rA, s16imm:$imm) |
10147 | 38 | AsmString = "tdui $\x02, $\xFF\x03\x03"; |
10148 | 38 | break; |
10149 | 38 | } |
10150 | 958 | return NULL; |
10151 | 390 | case PPC_TLBIE: |
10152 | 390 | if (MCInst_getNumOperands(MI) == 2 && |
10153 | 390 | MCOperand_getReg(MCInst_getOperand(MI, 0)) == PPC_R0 && |
10154 | 390 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10155 | 390 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
10156 | | // (TLBIE R0, gprc:$RB) |
10157 | 345 | AsmString = "tlbie $\x02"; |
10158 | 345 | break; |
10159 | 345 | } |
10160 | 45 | return NULL; |
10161 | 84 | case PPC_TLBRE2: |
10162 | 84 | if (MCInst_getNumOperands(MI) == 3 && |
10163 | 84 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
10164 | 84 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
10165 | 84 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10166 | 84 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1) && |
10167 | 84 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
10168 | 84 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
10169 | | // (TLBRE2 gprc:$RS, gprc:$A, 0) |
10170 | 75 | AsmString = "tlbrehi $\x01, $\x02"; |
10171 | 75 | break; |
10172 | 75 | } |
10173 | 9 | if (MCInst_getNumOperands(MI) == 3 && |
10174 | 9 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
10175 | 9 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
10176 | 9 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10177 | 9 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1) && |
10178 | 9 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
10179 | 9 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 1) { |
10180 | | // (TLBRE2 gprc:$RS, gprc:$A, 1) |
10181 | 9 | AsmString = "tlbrelo $\x01, $\x02"; |
10182 | 9 | break; |
10183 | 9 | } |
10184 | 0 | return NULL; |
10185 | 22 | case PPC_TLBWE2: |
10186 | 22 | if (MCInst_getNumOperands(MI) == 3 && |
10187 | 22 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
10188 | 22 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
10189 | 22 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10190 | 22 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1) && |
10191 | 22 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
10192 | 22 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
10193 | | // (TLBWE2 gprc:$RS, gprc:$A, 0) |
10194 | 6 | AsmString = "tlbwehi $\x01, $\x02"; |
10195 | 6 | break; |
10196 | 6 | } |
10197 | 16 | if (MCInst_getNumOperands(MI) == 3 && |
10198 | 16 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
10199 | 16 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 0) && |
10200 | 16 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10201 | 16 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1) && |
10202 | 16 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
10203 | 16 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 1) { |
10204 | | // (TLBWE2 gprc:$RS, gprc:$A, 1) |
10205 | 16 | AsmString = "tlbwelo $\x01, $\x02"; |
10206 | 16 | break; |
10207 | 16 | } |
10208 | 0 | return NULL; |
10209 | 181 | case PPC_TW: |
10210 | 181 | if (MCInst_getNumOperands(MI) == 3 && |
10211 | 181 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10212 | 181 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 16 && |
10213 | 181 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10214 | 181 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1) && |
10215 | 181 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10216 | 181 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 2)) { |
10217 | | // (TW 16, gprc:$rA, gprc:$rB) |
10218 | 6 | AsmString = "twlt $\x02, $\x03"; |
10219 | 6 | break; |
10220 | 6 | } |
10221 | 175 | if (MCInst_getNumOperands(MI) == 3 && |
10222 | 175 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10223 | 175 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 4 && |
10224 | 175 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10225 | 175 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1) && |
10226 | 175 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10227 | 175 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 2)) { |
10228 | | // (TW 4, gprc:$rA, gprc:$rB) |
10229 | 14 | AsmString = "tweq $\x02, $\x03"; |
10230 | 14 | break; |
10231 | 14 | } |
10232 | 161 | if (MCInst_getNumOperands(MI) == 3 && |
10233 | 161 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10234 | 161 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 8 && |
10235 | 161 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10236 | 161 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1) && |
10237 | 161 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10238 | 161 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 2)) { |
10239 | | // (TW 8, gprc:$rA, gprc:$rB) |
10240 | 37 | AsmString = "twgt $\x02, $\x03"; |
10241 | 37 | break; |
10242 | 37 | } |
10243 | 124 | if (MCInst_getNumOperands(MI) == 3 && |
10244 | 124 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10245 | 124 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 24 && |
10246 | 124 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10247 | 124 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1) && |
10248 | 124 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10249 | 124 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 2)) { |
10250 | | // (TW 24, gprc:$rA, gprc:$rB) |
10251 | 12 | AsmString = "twne $\x02, $\x03"; |
10252 | 12 | break; |
10253 | 12 | } |
10254 | 112 | if (MCInst_getNumOperands(MI) == 3 && |
10255 | 112 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10256 | 112 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 2 && |
10257 | 112 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10258 | 112 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1) && |
10259 | 112 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10260 | 112 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 2)) { |
10261 | | // (TW 2, gprc:$rA, gprc:$rB) |
10262 | 12 | AsmString = "twllt $\x02, $\x03"; |
10263 | 12 | break; |
10264 | 12 | } |
10265 | 100 | if (MCInst_getNumOperands(MI) == 3 && |
10266 | 100 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10267 | 100 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 1 && |
10268 | 100 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10269 | 100 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1) && |
10270 | 100 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10271 | 100 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 2)) { |
10272 | | // (TW 1, gprc:$rA, gprc:$rB) |
10273 | 19 | AsmString = "twlgt $\x02, $\x03"; |
10274 | 19 | break; |
10275 | 19 | } |
10276 | 81 | if (MCInst_getNumOperands(MI) == 3 && |
10277 | 81 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10278 | 81 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 31 && |
10279 | 81 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10280 | 81 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1) && |
10281 | 81 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10282 | 81 | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 2)) { |
10283 | | // (TW 31, gprc:$rA, gprc:$rB) |
10284 | 14 | AsmString = "twu $\x02, $\x03"; |
10285 | 14 | break; |
10286 | 14 | } |
10287 | 67 | return NULL; |
10288 | 3.86k | case PPC_TWI: |
10289 | 3.86k | if (MCInst_getNumOperands(MI) == 3 && |
10290 | 3.86k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10291 | 3.86k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 16 && |
10292 | 3.86k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10293 | 3.86k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
10294 | | // (TWI 16, gprc:$rA, s16imm:$imm) |
10295 | 564 | AsmString = "twlti $\x02, $\xFF\x03\x03"; |
10296 | 564 | break; |
10297 | 564 | } |
10298 | 3.30k | if (MCInst_getNumOperands(MI) == 3 && |
10299 | 3.30k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10300 | 3.30k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 4 && |
10301 | 3.30k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10302 | 3.30k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
10303 | | // (TWI 4, gprc:$rA, s16imm:$imm) |
10304 | 141 | AsmString = "tweqi $\x02, $\xFF\x03\x03"; |
10305 | 141 | break; |
10306 | 141 | } |
10307 | 3.15k | if (MCInst_getNumOperands(MI) == 3 && |
10308 | 3.15k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10309 | 3.15k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 8 && |
10310 | 3.15k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10311 | 3.15k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
10312 | | // (TWI 8, gprc:$rA, s16imm:$imm) |
10313 | 298 | AsmString = "twgti $\x02, $\xFF\x03\x03"; |
10314 | 298 | break; |
10315 | 298 | } |
10316 | 2.86k | if (MCInst_getNumOperands(MI) == 3 && |
10317 | 2.86k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10318 | 2.86k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 24 && |
10319 | 2.86k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10320 | 2.86k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
10321 | | // (TWI 24, gprc:$rA, s16imm:$imm) |
10322 | 629 | AsmString = "twnei $\x02, $\xFF\x03\x03"; |
10323 | 629 | break; |
10324 | 629 | } |
10325 | 2.23k | if (MCInst_getNumOperands(MI) == 3 && |
10326 | 2.23k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10327 | 2.23k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 2 && |
10328 | 2.23k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10329 | 2.23k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
10330 | | // (TWI 2, gprc:$rA, s16imm:$imm) |
10331 | 388 | AsmString = "twllti $\x02, $\xFF\x03\x03"; |
10332 | 388 | break; |
10333 | 388 | } |
10334 | 1.84k | if (MCInst_getNumOperands(MI) == 3 && |
10335 | 1.84k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10336 | 1.84k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 1 && |
10337 | 1.84k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10338 | 1.84k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
10339 | | // (TWI 1, gprc:$rA, s16imm:$imm) |
10340 | 340 | AsmString = "twlgti $\x02, $\xFF\x03\x03"; |
10341 | 340 | break; |
10342 | 340 | } |
10343 | 1.50k | if (MCInst_getNumOperands(MI) == 3 && |
10344 | 1.50k | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10345 | 1.50k | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 31 && |
10346 | 1.50k | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10347 | 1.50k | GETREGCLASS_CONTAIN(PPC_GPRCRegClassID, 1)) { |
10348 | | // (TWI 31, gprc:$rA, s16imm:$imm) |
10349 | 100 | AsmString = "twui $\x02, $\xFF\x03\x03"; |
10350 | 100 | break; |
10351 | 100 | } |
10352 | 1.40k | return NULL; |
10353 | 127 | case PPC_VNOR: |
10354 | 127 | if (MCInst_getNumOperands(MI) == 3 && |
10355 | 127 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
10356 | 127 | GETREGCLASS_CONTAIN(PPC_VRRCRegClassID, 0) && |
10357 | 127 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10358 | 127 | GETREGCLASS_CONTAIN(PPC_VRRCRegClassID, 1) && |
10359 | 127 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10360 | 127 | MCOperand_getReg(MCInst_getOperand(MI, 2)) == MCOperand_getReg(MCInst_getOperand(MI, 1))) { |
10361 | | // (VNOR vrrc:$vD, vrrc:$vA, vrrc:$vA) |
10362 | 33 | AsmString = "vnot $\x01, $\x02"; |
10363 | 33 | break; |
10364 | 33 | } |
10365 | 94 | return NULL; |
10366 | 51 | case PPC_VOR: |
10367 | 51 | if (MCInst_getNumOperands(MI) == 3 && |
10368 | 51 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
10369 | 51 | GETREGCLASS_CONTAIN(PPC_VRRCRegClassID, 0) && |
10370 | 51 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10371 | 51 | GETREGCLASS_CONTAIN(PPC_VRRCRegClassID, 1) && |
10372 | 51 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10373 | 51 | MCOperand_getReg(MCInst_getOperand(MI, 2)) == MCOperand_getReg(MCInst_getOperand(MI, 1))) { |
10374 | | // (VOR vrrc:$vD, vrrc:$vA, vrrc:$vA) |
10375 | 39 | AsmString = "vmr $\x01, $\x02"; |
10376 | 39 | break; |
10377 | 39 | } |
10378 | 12 | return NULL; |
10379 | 193 | case PPC_WAIT: |
10380 | 193 | if (MCInst_getNumOperands(MI) == 1 && |
10381 | 193 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10382 | 193 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0) { |
10383 | | // (WAIT 0) |
10384 | 26 | AsmString = "wait"; |
10385 | 26 | break; |
10386 | 26 | } |
10387 | 167 | if (MCInst_getNumOperands(MI) == 1 && |
10388 | 167 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10389 | 167 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 1) { |
10390 | | // (WAIT 1) |
10391 | 95 | AsmString = "waitrsv"; |
10392 | 95 | break; |
10393 | 95 | } |
10394 | 72 | if (MCInst_getNumOperands(MI) == 1 && |
10395 | 72 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10396 | 72 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 2) { |
10397 | | // (WAIT 2) |
10398 | 20 | AsmString = "waitimpl"; |
10399 | 20 | break; |
10400 | 20 | } |
10401 | 52 | return NULL; |
10402 | 1.11k | case PPC_XORI: |
10403 | 1.11k | if (MCInst_getNumOperands(MI) == 3 && |
10404 | 1.11k | MCOperand_getReg(MCInst_getOperand(MI, 0)) == PPC_R0 && |
10405 | 1.11k | MCOperand_getReg(MCInst_getOperand(MI, 1)) == PPC_R0 && |
10406 | 1.11k | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
10407 | 1.11k | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
10408 | | // (XORI R0, R0, 0) |
10409 | 11 | AsmString = "xnop"; |
10410 | 11 | break; |
10411 | 11 | } |
10412 | 1.10k | return NULL; |
10413 | 98 | case PPC_XVCPSGNDP: |
10414 | 98 | if (MCInst_getNumOperands(MI) == 3 && |
10415 | 98 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
10416 | 98 | GETREGCLASS_CONTAIN(PPC_VSRCRegClassID, 0) && |
10417 | 98 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10418 | 98 | GETREGCLASS_CONTAIN(PPC_VSRCRegClassID, 1) && |
10419 | 98 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10420 | 98 | MCOperand_getReg(MCInst_getOperand(MI, 2)) == MCOperand_getReg(MCInst_getOperand(MI, 1))) { |
10421 | | // (XVCPSGNDP vsrc:$XT, vsrc:$XB, vsrc:$XB) |
10422 | 82 | AsmString = "xvmovdp $\x01, $\x02"; |
10423 | 82 | break; |
10424 | 82 | } |
10425 | 16 | return NULL; |
10426 | 21 | case PPC_XVCPSGNSP: |
10427 | 21 | if (MCInst_getNumOperands(MI) == 3 && |
10428 | 21 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
10429 | 21 | GETREGCLASS_CONTAIN(PPC_VSRCRegClassID, 0) && |
10430 | 21 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10431 | 21 | GETREGCLASS_CONTAIN(PPC_VSRCRegClassID, 1) && |
10432 | 21 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10433 | 21 | MCOperand_getReg(MCInst_getOperand(MI, 2)) == MCOperand_getReg(MCInst_getOperand(MI, 1))) { |
10434 | | // (XVCPSGNSP vsrc:$XT, vsrc:$XB, vsrc:$XB) |
10435 | 7 | AsmString = "xvmovsp $\x01, $\x02"; |
10436 | 7 | break; |
10437 | 7 | } |
10438 | 14 | return NULL; |
10439 | 590 | case PPC_XXPERMDI: |
10440 | 590 | if (MCInst_getNumOperands(MI) == 4 && |
10441 | 590 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
10442 | 590 | GETREGCLASS_CONTAIN(PPC_VSRCRegClassID, 0) && |
10443 | 590 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10444 | 590 | GETREGCLASS_CONTAIN(PPC_VSRCRegClassID, 1) && |
10445 | 590 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10446 | 590 | MCOperand_getReg(MCInst_getOperand(MI, 2)) == MCOperand_getReg(MCInst_getOperand(MI, 1)) && |
10447 | 590 | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
10448 | 590 | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 0) { |
10449 | | // (XXPERMDI vsrc:$XT, vsrc:$XB, vsrc:$XB, 0) |
10450 | 15 | AsmString = "xxspltd $\x01, $\x02, 0"; |
10451 | 15 | break; |
10452 | 15 | } |
10453 | 575 | if (MCInst_getNumOperands(MI) == 4 && |
10454 | 575 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
10455 | 575 | GETREGCLASS_CONTAIN(PPC_VSRCRegClassID, 0) && |
10456 | 575 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10457 | 575 | GETREGCLASS_CONTAIN(PPC_VSRCRegClassID, 1) && |
10458 | 575 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10459 | 575 | MCOperand_getReg(MCInst_getOperand(MI, 2)) == MCOperand_getReg(MCInst_getOperand(MI, 1)) && |
10460 | 575 | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
10461 | 575 | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 3) { |
10462 | | // (XXPERMDI vsrc:$XT, vsrc:$XB, vsrc:$XB, 3) |
10463 | 129 | AsmString = "xxspltd $\x01, $\x02, 1"; |
10464 | 129 | break; |
10465 | 129 | } |
10466 | 446 | if (MCInst_getNumOperands(MI) == 4 && |
10467 | 446 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
10468 | 446 | GETREGCLASS_CONTAIN(PPC_VSRCRegClassID, 0) && |
10469 | 446 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10470 | 446 | GETREGCLASS_CONTAIN(PPC_VSRCRegClassID, 1) && |
10471 | 446 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10472 | 446 | GETREGCLASS_CONTAIN(PPC_VSRCRegClassID, 2) && |
10473 | 446 | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
10474 | 446 | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 0) { |
10475 | | // (XXPERMDI vsrc:$XT, vsrc:$XA, vsrc:$XB, 0) |
10476 | 71 | AsmString = "xxmrghd $\x01, $\x02, $\x03"; |
10477 | 71 | break; |
10478 | 71 | } |
10479 | 375 | if (MCInst_getNumOperands(MI) == 4 && |
10480 | 375 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
10481 | 375 | GETREGCLASS_CONTAIN(PPC_VSRCRegClassID, 0) && |
10482 | 375 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10483 | 375 | GETREGCLASS_CONTAIN(PPC_VSRCRegClassID, 1) && |
10484 | 375 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10485 | 375 | GETREGCLASS_CONTAIN(PPC_VSRCRegClassID, 2) && |
10486 | 375 | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
10487 | 375 | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 3) { |
10488 | | // (XXPERMDI vsrc:$XT, vsrc:$XA, vsrc:$XB, 3) |
10489 | 25 | AsmString = "xxmrgld $\x01, $\x02, $\x03"; |
10490 | 25 | break; |
10491 | 25 | } |
10492 | 350 | if (MCInst_getNumOperands(MI) == 4 && |
10493 | 350 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
10494 | 350 | GETREGCLASS_CONTAIN(PPC_VSRCRegClassID, 0) && |
10495 | 350 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10496 | 350 | GETREGCLASS_CONTAIN(PPC_VSRCRegClassID, 1) && |
10497 | 350 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10498 | 350 | MCOperand_getReg(MCInst_getOperand(MI, 2)) == MCOperand_getReg(MCInst_getOperand(MI, 1)) && |
10499 | 350 | MCOperand_isImm(MCInst_getOperand(MI, 3)) && |
10500 | 350 | MCOperand_getImm(MCInst_getOperand(MI, 3)) == 2) { |
10501 | | // (XXPERMDI vsrc:$XT, vsrc:$XB, vsrc:$XB, 2) |
10502 | 118 | AsmString = "xxswapd $\x01, $\x02"; |
10503 | 118 | break; |
10504 | 118 | } |
10505 | 232 | return NULL; |
10506 | 0 | case PPC_XXPERMDIs: |
10507 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10508 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
10509 | 0 | GETREGCLASS_CONTAIN(PPC_VSRCRegClassID, 0) && |
10510 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10511 | 0 | GETREGCLASS_CONTAIN(PPC_VSFRCRegClassID, 1) && |
10512 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
10513 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
10514 | | // (XXPERMDIs vsrc:$XT, vsfrc:$XB, 0) |
10515 | 0 | AsmString = "xxspltd $\x01, $\x02, 0"; |
10516 | 0 | break; |
10517 | 0 | } |
10518 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10519 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
10520 | 0 | GETREGCLASS_CONTAIN(PPC_VSRCRegClassID, 0) && |
10521 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10522 | 0 | GETREGCLASS_CONTAIN(PPC_VSFRCRegClassID, 1) && |
10523 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
10524 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 3) { |
10525 | | // (XXPERMDIs vsrc:$XT, vsfrc:$XB, 3) |
10526 | 0 | AsmString = "xxspltd $\x01, $\x02, 1"; |
10527 | 0 | break; |
10528 | 0 | } |
10529 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10530 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 0)) && |
10531 | 0 | GETREGCLASS_CONTAIN(PPC_VSRCRegClassID, 0) && |
10532 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10533 | 0 | GETREGCLASS_CONTAIN(PPC_VSFRCRegClassID, 1) && |
10534 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
10535 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 2) { |
10536 | | // (XXPERMDIs vsrc:$XT, vsfrc:$XB, 2) |
10537 | 0 | AsmString = "xxswapd $\x01, $\x02"; |
10538 | 0 | break; |
10539 | 0 | } |
10540 | 0 | return NULL; |
10541 | 0 | case PPC_gBC: |
10542 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10543 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10544 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
10545 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10546 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10547 | | // (gBC 12, crbitrc:$bi, condbrtarget:$dst) |
10548 | 0 | AsmString = "bt $\x02, $\xFF\x03\x01"; |
10549 | 0 | break; |
10550 | 0 | } |
10551 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10552 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10553 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 4 && |
10554 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10555 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10556 | | // (gBC 4, crbitrc:$bi, condbrtarget:$dst) |
10557 | 0 | AsmString = "bf $\x02, $\xFF\x03\x01"; |
10558 | 0 | break; |
10559 | 0 | } |
10560 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10561 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10562 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 14 && |
10563 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10564 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10565 | | // (gBC 14, crbitrc:$bi, condbrtarget:$dst) |
10566 | 0 | AsmString = "bt- $\x02, $\xFF\x03\x01"; |
10567 | 0 | break; |
10568 | 0 | } |
10569 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10570 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10571 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 6 && |
10572 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10573 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10574 | | // (gBC 6, crbitrc:$bi, condbrtarget:$dst) |
10575 | 0 | AsmString = "bf- $\x02, $\xFF\x03\x01"; |
10576 | 0 | break; |
10577 | 0 | } |
10578 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10579 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10580 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 15 && |
10581 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10582 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10583 | | // (gBC 15, crbitrc:$bi, condbrtarget:$dst) |
10584 | 0 | AsmString = "bt+ $\x02, $\xFF\x03\x01"; |
10585 | 0 | break; |
10586 | 0 | } |
10587 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10588 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10589 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 7 && |
10590 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10591 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10592 | | // (gBC 7, crbitrc:$bi, condbrtarget:$dst) |
10593 | 0 | AsmString = "bf+ $\x02, $\xFF\x03\x01"; |
10594 | 0 | break; |
10595 | 0 | } |
10596 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10597 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10598 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 8 && |
10599 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10600 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10601 | | // (gBC 8, crbitrc:$bi, condbrtarget:$dst) |
10602 | 0 | AsmString = "bdnzt $\x02, $\xFF\x03\x01"; |
10603 | 0 | break; |
10604 | 0 | } |
10605 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10606 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10607 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0 && |
10608 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10609 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10610 | | // (gBC 0, crbitrc:$bi, condbrtarget:$dst) |
10611 | 0 | AsmString = "bdnzf $\x02, $\xFF\x03\x01"; |
10612 | 0 | break; |
10613 | 0 | } |
10614 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10615 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10616 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 10 && |
10617 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10618 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10619 | | // (gBC 10, crbitrc:$bi, condbrtarget:$dst) |
10620 | 0 | AsmString = "bdzt $\x02, $\xFF\x03\x01"; |
10621 | 0 | break; |
10622 | 0 | } |
10623 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10624 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10625 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 2 && |
10626 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10627 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10628 | | // (gBC 2, crbitrc:$bi, condbrtarget:$dst) |
10629 | 0 | AsmString = "bdzf $\x02, $\xFF\x03\x01"; |
10630 | 0 | break; |
10631 | 0 | } |
10632 | 0 | return NULL; |
10633 | 0 | case PPC_gBCA: |
10634 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10635 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10636 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
10637 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10638 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10639 | | // (gBCA 12, crbitrc:$bi, abscondbrtarget:$dst) |
10640 | 0 | AsmString = "bta $\x02, $\xFF\x03\x02"; |
10641 | 0 | break; |
10642 | 0 | } |
10643 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10644 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10645 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 4 && |
10646 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10647 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10648 | | // (gBCA 4, crbitrc:$bi, abscondbrtarget:$dst) |
10649 | 0 | AsmString = "bfa $\x02, $\xFF\x03\x02"; |
10650 | 0 | break; |
10651 | 0 | } |
10652 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10653 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10654 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 14 && |
10655 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10656 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10657 | | // (gBCA 14, crbitrc:$bi, abscondbrtarget:$dst) |
10658 | 0 | AsmString = "bta- $\x02, $\xFF\x03\x02"; |
10659 | 0 | break; |
10660 | 0 | } |
10661 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10662 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10663 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 6 && |
10664 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10665 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10666 | | // (gBCA 6, crbitrc:$bi, abscondbrtarget:$dst) |
10667 | 0 | AsmString = "bfa- $\x02, $\xFF\x03\x02"; |
10668 | 0 | break; |
10669 | 0 | } |
10670 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10671 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10672 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 15 && |
10673 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10674 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10675 | | // (gBCA 15, crbitrc:$bi, abscondbrtarget:$dst) |
10676 | 0 | AsmString = "bta+ $\x02, $\xFF\x03\x02"; |
10677 | 0 | break; |
10678 | 0 | } |
10679 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10680 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10681 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 7 && |
10682 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10683 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10684 | | // (gBCA 7, crbitrc:$bi, abscondbrtarget:$dst) |
10685 | 0 | AsmString = "bfa+ $\x02, $\xFF\x03\x02"; |
10686 | 0 | break; |
10687 | 0 | } |
10688 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10689 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10690 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 8 && |
10691 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10692 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10693 | | // (gBCA 8, crbitrc:$bi, abscondbrtarget:$dst) |
10694 | 0 | AsmString = "bdnzta $\x02, $\xFF\x03\x02"; |
10695 | 0 | break; |
10696 | 0 | } |
10697 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10698 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10699 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0 && |
10700 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10701 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10702 | | // (gBCA 0, crbitrc:$bi, abscondbrtarget:$dst) |
10703 | 0 | AsmString = "bdnzfa $\x02, $\xFF\x03\x02"; |
10704 | 0 | break; |
10705 | 0 | } |
10706 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10707 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10708 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 10 && |
10709 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10710 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10711 | | // (gBCA 10, crbitrc:$bi, abscondbrtarget:$dst) |
10712 | 0 | AsmString = "bdzta $\x02, $\xFF\x03\x02"; |
10713 | 0 | break; |
10714 | 0 | } |
10715 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10716 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10717 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 2 && |
10718 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10719 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10720 | | // (gBCA 2, crbitrc:$bi, abscondbrtarget:$dst) |
10721 | 0 | AsmString = "bdzfa $\x02, $\xFF\x03\x02"; |
10722 | 0 | break; |
10723 | 0 | } |
10724 | 0 | return NULL; |
10725 | 0 | case PPC_gBCAat: |
10726 | 0 | if (MCInst_getNumOperands(MI) == 4 && |
10727 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
10728 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 3 && |
10729 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10730 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 2)) { |
10731 | | // (gBCAat u5imm:$bo, 3, crbitrc:$bi, condbrtarget:$dst) |
10732 | 0 | AsmString = "bca+ $\xFF\x01\x06, $\x03, $\xFF\x04\x01"; |
10733 | 0 | break; |
10734 | 0 | } |
10735 | 0 | if (MCInst_getNumOperands(MI) == 4 && |
10736 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
10737 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 2 && |
10738 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
10739 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 2)) { |
10740 | | // (gBCAat u5imm:$bo, 2, crbitrc:$bi, condbrtarget:$dst) |
10741 | 0 | AsmString = "bca- $\xFF\x01\x06, $\x03, $\xFF\x04\x01"; |
10742 | 0 | break; |
10743 | 0 | } |
10744 | 0 | return NULL; |
10745 | 0 | case PPC_gBCCTR: |
10746 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10747 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10748 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
10749 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
10750 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
10751 | | // (gBCCTR u5imm:$bo, crbitrc:$bi, 0) |
10752 | 0 | AsmString = "bcctr $\xFF\x01\x06, $\x02"; |
10753 | 0 | break; |
10754 | 0 | } |
10755 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10756 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10757 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
10758 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10759 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
10760 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
10761 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
10762 | | // (gBCCTR 12, crbitrc:$bi, 0) |
10763 | 0 | AsmString = "btctr $\x02"; |
10764 | 0 | break; |
10765 | 0 | } |
10766 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10767 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10768 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 4 && |
10769 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10770 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
10771 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
10772 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
10773 | | // (gBCCTR 4, crbitrc:$bi, 0) |
10774 | 0 | AsmString = "bfctr $\x02"; |
10775 | 0 | break; |
10776 | 0 | } |
10777 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10778 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10779 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 14 && |
10780 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10781 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
10782 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
10783 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
10784 | | // (gBCCTR 14, crbitrc:$bi, 0) |
10785 | 0 | AsmString = "btctr- $\x02"; |
10786 | 0 | break; |
10787 | 0 | } |
10788 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10789 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10790 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 6 && |
10791 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10792 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
10793 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
10794 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
10795 | | // (gBCCTR 6, crbitrc:$bi, 0) |
10796 | 0 | AsmString = "bfctr- $\x02"; |
10797 | 0 | break; |
10798 | 0 | } |
10799 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10800 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10801 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 15 && |
10802 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10803 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
10804 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
10805 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
10806 | | // (gBCCTR 15, crbitrc:$bi, 0) |
10807 | 0 | AsmString = "btctr+ $\x02"; |
10808 | 0 | break; |
10809 | 0 | } |
10810 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10811 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10812 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 7 && |
10813 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10814 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
10815 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
10816 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
10817 | | // (gBCCTR 7, crbitrc:$bi, 0) |
10818 | 0 | AsmString = "bfctr+ $\x02"; |
10819 | 0 | break; |
10820 | 0 | } |
10821 | 0 | return NULL; |
10822 | 0 | case PPC_gBCCTRL: |
10823 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10824 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10825 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
10826 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
10827 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
10828 | | // (gBCCTRL u5imm:$bo, crbitrc:$bi, 0) |
10829 | 0 | AsmString = "bcctrl $\xFF\x01\x06, $\x02"; |
10830 | 0 | break; |
10831 | 0 | } |
10832 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10833 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10834 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
10835 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10836 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
10837 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
10838 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
10839 | | // (gBCCTRL 12, crbitrc:$bi, 0) |
10840 | 0 | AsmString = "btctrl $\x02"; |
10841 | 0 | break; |
10842 | 0 | } |
10843 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10844 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10845 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 4 && |
10846 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10847 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
10848 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
10849 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
10850 | | // (gBCCTRL 4, crbitrc:$bi, 0) |
10851 | 0 | AsmString = "bfctrl $\x02"; |
10852 | 0 | break; |
10853 | 0 | } |
10854 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10855 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10856 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 14 && |
10857 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10858 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
10859 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
10860 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
10861 | | // (gBCCTRL 14, crbitrc:$bi, 0) |
10862 | 0 | AsmString = "btctrl- $\x02"; |
10863 | 0 | break; |
10864 | 0 | } |
10865 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10866 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10867 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 6 && |
10868 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10869 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
10870 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
10871 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
10872 | | // (gBCCTRL 6, crbitrc:$bi, 0) |
10873 | 0 | AsmString = "bfctrl- $\x02"; |
10874 | 0 | break; |
10875 | 0 | } |
10876 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10877 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10878 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 15 && |
10879 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10880 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
10881 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
10882 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
10883 | | // (gBCCTRL 15, crbitrc:$bi, 0) |
10884 | 0 | AsmString = "btctrl+ $\x02"; |
10885 | 0 | break; |
10886 | 0 | } |
10887 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10888 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10889 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 7 && |
10890 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10891 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
10892 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
10893 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
10894 | | // (gBCCTRL 7, crbitrc:$bi, 0) |
10895 | 0 | AsmString = "bfctrl+ $\x02"; |
10896 | 0 | break; |
10897 | 0 | } |
10898 | 0 | return NULL; |
10899 | 0 | case PPC_gBCL: |
10900 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10901 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10902 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
10903 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10904 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10905 | | // (gBCL 12, crbitrc:$bi, condbrtarget:$dst) |
10906 | 0 | AsmString = "btl $\x02, $\xFF\x03\x01"; |
10907 | 0 | break; |
10908 | 0 | } |
10909 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10910 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10911 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 4 && |
10912 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10913 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10914 | | // (gBCL 4, crbitrc:$bi, condbrtarget:$dst) |
10915 | 0 | AsmString = "bfl $\x02, $\xFF\x03\x01"; |
10916 | 0 | break; |
10917 | 0 | } |
10918 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10919 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10920 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 14 && |
10921 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10922 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10923 | | // (gBCL 14, crbitrc:$bi, condbrtarget:$dst) |
10924 | 0 | AsmString = "btl- $\x02, $\xFF\x03\x01"; |
10925 | 0 | break; |
10926 | 0 | } |
10927 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10928 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10929 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 6 && |
10930 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10931 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10932 | | // (gBCL 6, crbitrc:$bi, condbrtarget:$dst) |
10933 | 0 | AsmString = "bfl- $\x02, $\xFF\x03\x01"; |
10934 | 0 | break; |
10935 | 0 | } |
10936 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10937 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10938 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 15 && |
10939 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10940 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10941 | | // (gBCL 15, crbitrc:$bi, condbrtarget:$dst) |
10942 | 0 | AsmString = "btl+ $\x02, $\xFF\x03\x01"; |
10943 | 0 | break; |
10944 | 0 | } |
10945 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10946 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10947 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 7 && |
10948 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10949 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10950 | | // (gBCL 7, crbitrc:$bi, condbrtarget:$dst) |
10951 | 0 | AsmString = "bfl+ $\x02, $\xFF\x03\x01"; |
10952 | 0 | break; |
10953 | 0 | } |
10954 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10955 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10956 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 8 && |
10957 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10958 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10959 | | // (gBCL 8, crbitrc:$bi, condbrtarget:$dst) |
10960 | 0 | AsmString = "bdnztl $\x02, $\xFF\x03\x01"; |
10961 | 0 | break; |
10962 | 0 | } |
10963 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10964 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10965 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0 && |
10966 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10967 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10968 | | // (gBCL 0, crbitrc:$bi, condbrtarget:$dst) |
10969 | 0 | AsmString = "bdnzfl $\x02, $\xFF\x03\x01"; |
10970 | 0 | break; |
10971 | 0 | } |
10972 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10973 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10974 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 10 && |
10975 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10976 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10977 | | // (gBCL 10, crbitrc:$bi, condbrtarget:$dst) |
10978 | 0 | AsmString = "bdztl $\x02, $\xFF\x03\x01"; |
10979 | 0 | break; |
10980 | 0 | } |
10981 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10982 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10983 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 2 && |
10984 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10985 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10986 | | // (gBCL 2, crbitrc:$bi, condbrtarget:$dst) |
10987 | 0 | AsmString = "bdzfl $\x02, $\xFF\x03\x01"; |
10988 | 0 | break; |
10989 | 0 | } |
10990 | 0 | return NULL; |
10991 | 0 | case PPC_gBCLA: |
10992 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
10993 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
10994 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
10995 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
10996 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
10997 | | // (gBCLA 12, crbitrc:$bi, abscondbrtarget:$dst) |
10998 | 0 | AsmString = "btla $\x02, $\xFF\x03\x02"; |
10999 | 0 | break; |
11000 | 0 | } |
11001 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11002 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11003 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 4 && |
11004 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11005 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
11006 | | // (gBCLA 4, crbitrc:$bi, abscondbrtarget:$dst) |
11007 | 0 | AsmString = "bfla $\x02, $\xFF\x03\x02"; |
11008 | 0 | break; |
11009 | 0 | } |
11010 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11011 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11012 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 14 && |
11013 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11014 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
11015 | | // (gBCLA 14, crbitrc:$bi, abscondbrtarget:$dst) |
11016 | 0 | AsmString = "btla- $\x02, $\xFF\x03\x02"; |
11017 | 0 | break; |
11018 | 0 | } |
11019 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11020 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11021 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 6 && |
11022 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11023 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
11024 | | // (gBCLA 6, crbitrc:$bi, abscondbrtarget:$dst) |
11025 | 0 | AsmString = "bfla- $\x02, $\xFF\x03\x02"; |
11026 | 0 | break; |
11027 | 0 | } |
11028 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11029 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11030 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 15 && |
11031 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11032 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
11033 | | // (gBCLA 15, crbitrc:$bi, abscondbrtarget:$dst) |
11034 | 0 | AsmString = "btla+ $\x02, $\xFF\x03\x02"; |
11035 | 0 | break; |
11036 | 0 | } |
11037 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11038 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11039 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 7 && |
11040 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11041 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
11042 | | // (gBCLA 7, crbitrc:$bi, abscondbrtarget:$dst) |
11043 | 0 | AsmString = "bfla+ $\x02, $\xFF\x03\x02"; |
11044 | 0 | break; |
11045 | 0 | } |
11046 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11047 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11048 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 8 && |
11049 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11050 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
11051 | | // (gBCLA 8, crbitrc:$bi, abscondbrtarget:$dst) |
11052 | 0 | AsmString = "bdnztla $\x02, $\xFF\x03\x02"; |
11053 | 0 | break; |
11054 | 0 | } |
11055 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11056 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11057 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0 && |
11058 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11059 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
11060 | | // (gBCLA 0, crbitrc:$bi, abscondbrtarget:$dst) |
11061 | 0 | AsmString = "bdnzfla $\x02, $\xFF\x03\x02"; |
11062 | 0 | break; |
11063 | 0 | } |
11064 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11065 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11066 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 10 && |
11067 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11068 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
11069 | | // (gBCLA 10, crbitrc:$bi, abscondbrtarget:$dst) |
11070 | 0 | AsmString = "bdztla $\x02, $\xFF\x03\x02"; |
11071 | 0 | break; |
11072 | 0 | } |
11073 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11074 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11075 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 2 && |
11076 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11077 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1)) { |
11078 | | // (gBCLA 2, crbitrc:$bi, abscondbrtarget:$dst) |
11079 | 0 | AsmString = "bdzfla $\x02, $\xFF\x03\x02"; |
11080 | 0 | break; |
11081 | 0 | } |
11082 | 0 | return NULL; |
11083 | 0 | case PPC_gBCLAat: |
11084 | 0 | if (MCInst_getNumOperands(MI) == 4 && |
11085 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
11086 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 3 && |
11087 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
11088 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 2)) { |
11089 | | // (gBCLAat u5imm:$bo, 3, crbitrc:$bi, condbrtarget:$dst) |
11090 | 0 | AsmString = "bcla+ $\xFF\x01\x06, $\x03, $\xFF\x04\x01"; |
11091 | 0 | break; |
11092 | 0 | } |
11093 | 0 | if (MCInst_getNumOperands(MI) == 4 && |
11094 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
11095 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 2 && |
11096 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
11097 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 2)) { |
11098 | | // (gBCLAat u5imm:$bo, 2, crbitrc:$bi, condbrtarget:$dst) |
11099 | 0 | AsmString = "bcla- $\xFF\x01\x06, $\x03, $\xFF\x04\x01"; |
11100 | 0 | break; |
11101 | 0 | } |
11102 | 0 | return NULL; |
11103 | 0 | case PPC_gBCLR: |
11104 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11105 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11106 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
11107 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
11108 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
11109 | | // (gBCLR u5imm:$bo, crbitrc:$bi, 0) |
11110 | 0 | AsmString = "bclr $\xFF\x01\x06, $\x02"; |
11111 | 0 | break; |
11112 | 0 | } |
11113 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11114 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11115 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
11116 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11117 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
11118 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
11119 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
11120 | | // (gBCLR 12, crbitrc:$bi, 0) |
11121 | 0 | AsmString = "btlr $\x02"; |
11122 | 0 | break; |
11123 | 0 | } |
11124 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11125 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11126 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 4 && |
11127 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11128 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
11129 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
11130 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
11131 | | // (gBCLR 4, crbitrc:$bi, 0) |
11132 | 0 | AsmString = "bflr $\x02"; |
11133 | 0 | break; |
11134 | 0 | } |
11135 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11136 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11137 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 14 && |
11138 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11139 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
11140 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
11141 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
11142 | | // (gBCLR 14, crbitrc:$bi, 0) |
11143 | 0 | AsmString = "btlr- $\x02"; |
11144 | 0 | break; |
11145 | 0 | } |
11146 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11147 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11148 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 6 && |
11149 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11150 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
11151 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
11152 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
11153 | | // (gBCLR 6, crbitrc:$bi, 0) |
11154 | 0 | AsmString = "bflr- $\x02"; |
11155 | 0 | break; |
11156 | 0 | } |
11157 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11158 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11159 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 15 && |
11160 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11161 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
11162 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
11163 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
11164 | | // (gBCLR 15, crbitrc:$bi, 0) |
11165 | 0 | AsmString = "btlr+ $\x02"; |
11166 | 0 | break; |
11167 | 0 | } |
11168 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11169 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11170 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 7 && |
11171 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11172 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
11173 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
11174 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
11175 | | // (gBCLR 7, crbitrc:$bi, 0) |
11176 | 0 | AsmString = "bflr+ $\x02"; |
11177 | 0 | break; |
11178 | 0 | } |
11179 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11180 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11181 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 8 && |
11182 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11183 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
11184 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
11185 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
11186 | | // (gBCLR 8, crbitrc:$bi, 0) |
11187 | 0 | AsmString = "bdnztlr $\x02"; |
11188 | 0 | break; |
11189 | 0 | } |
11190 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11191 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11192 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0 && |
11193 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11194 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
11195 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
11196 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
11197 | | // (gBCLR 0, crbitrc:$bi, 0) |
11198 | 0 | AsmString = "bdnzflr $\x02"; |
11199 | 0 | break; |
11200 | 0 | } |
11201 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11202 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11203 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 10 && |
11204 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11205 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
11206 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
11207 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
11208 | | // (gBCLR 10, crbitrc:$bi, 0) |
11209 | 0 | AsmString = "bdztlr $\x02"; |
11210 | 0 | break; |
11211 | 0 | } |
11212 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11213 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11214 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 2 && |
11215 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11216 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
11217 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
11218 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
11219 | | // (gBCLR 2, crbitrc:$bi, 0) |
11220 | 0 | AsmString = "bdzflr $\x02"; |
11221 | 0 | break; |
11222 | 0 | } |
11223 | 0 | return NULL; |
11224 | 0 | case PPC_gBCLRL: |
11225 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11226 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11227 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
11228 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
11229 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
11230 | | // (gBCLRL u5imm:$bo, crbitrc:$bi, 0) |
11231 | 0 | AsmString = "bclrl $\xFF\x01\x06, $\x02"; |
11232 | 0 | break; |
11233 | 0 | } |
11234 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11235 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11236 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 12 && |
11237 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11238 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
11239 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
11240 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
11241 | | // (gBCLRL 12, crbitrc:$bi, 0) |
11242 | 0 | AsmString = "btlrl $\x02"; |
11243 | 0 | break; |
11244 | 0 | } |
11245 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11246 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11247 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 4 && |
11248 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11249 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
11250 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
11251 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
11252 | | // (gBCLRL 4, crbitrc:$bi, 0) |
11253 | 0 | AsmString = "bflrl $\x02"; |
11254 | 0 | break; |
11255 | 0 | } |
11256 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11257 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11258 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 14 && |
11259 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11260 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
11261 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
11262 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
11263 | | // (gBCLRL 14, crbitrc:$bi, 0) |
11264 | 0 | AsmString = "btlrl- $\x02"; |
11265 | 0 | break; |
11266 | 0 | } |
11267 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11268 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11269 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 6 && |
11270 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11271 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
11272 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
11273 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
11274 | | // (gBCLRL 6, crbitrc:$bi, 0) |
11275 | 0 | AsmString = "bflrl- $\x02"; |
11276 | 0 | break; |
11277 | 0 | } |
11278 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11279 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11280 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 15 && |
11281 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11282 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
11283 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
11284 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
11285 | | // (gBCLRL 15, crbitrc:$bi, 0) |
11286 | 0 | AsmString = "btlrl+ $\x02"; |
11287 | 0 | break; |
11288 | 0 | } |
11289 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11290 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11291 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 7 && |
11292 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11293 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
11294 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
11295 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
11296 | | // (gBCLRL 7, crbitrc:$bi, 0) |
11297 | 0 | AsmString = "bflrl+ $\x02"; |
11298 | 0 | break; |
11299 | 0 | } |
11300 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11301 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11302 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 8 && |
11303 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11304 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
11305 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
11306 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
11307 | | // (gBCLRL 8, crbitrc:$bi, 0) |
11308 | 0 | AsmString = "bdnztlrl $\x02"; |
11309 | 0 | break; |
11310 | 0 | } |
11311 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11312 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11313 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0 && |
11314 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11315 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
11316 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
11317 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
11318 | | // (gBCLRL 0, crbitrc:$bi, 0) |
11319 | 0 | AsmString = "bdnzflrl $\x02"; |
11320 | 0 | break; |
11321 | 0 | } |
11322 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11323 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11324 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 10 && |
11325 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11326 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
11327 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
11328 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
11329 | | // (gBCLRL 10, crbitrc:$bi, 0) |
11330 | 0 | AsmString = "bdztlrl $\x02"; |
11331 | 0 | break; |
11332 | 0 | } |
11333 | 0 | if (MCInst_getNumOperands(MI) == 3 && |
11334 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 0)) && |
11335 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 0)) == 2 && |
11336 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 1)) && |
11337 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 1) && |
11338 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 2)) && |
11339 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) { |
11340 | | // (gBCLRL 2, crbitrc:$bi, 0) |
11341 | 0 | AsmString = "bdzflrl $\x02"; |
11342 | 0 | break; |
11343 | 0 | } |
11344 | 0 | return NULL; |
11345 | 0 | case PPC_gBCLat: |
11346 | 0 | if (MCInst_getNumOperands(MI) == 4 && |
11347 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
11348 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 3 && |
11349 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
11350 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 2)) { |
11351 | | // (gBCLat u5imm:$bo, 3, crbitrc:$bi, condbrtarget:$dst) |
11352 | 0 | AsmString = "bcl+ $\xFF\x01\x06, $\x03, $\xFF\x04\x01"; |
11353 | 0 | break; |
11354 | 0 | } |
11355 | 0 | if (MCInst_getNumOperands(MI) == 4 && |
11356 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
11357 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 2 && |
11358 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
11359 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 2)) { |
11360 | | // (gBCLat u5imm:$bo, 2, crbitrc:$bi, condbrtarget:$dst) |
11361 | 0 | AsmString = "bcl- $\xFF\x01\x06, $\x03, $\xFF\x04\x01"; |
11362 | 0 | break; |
11363 | 0 | } |
11364 | 0 | return NULL; |
11365 | 0 | case PPC_gBCat: |
11366 | 0 | if (MCInst_getNumOperands(MI) == 4 && |
11367 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
11368 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 3 && |
11369 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
11370 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 2)) { |
11371 | | // (gBCat u5imm:$bo, 3, crbitrc:$bi, condbrtarget:$dst) |
11372 | 0 | AsmString = "bc+ $\xFF\x01\x06, $\x03, $\xFF\x04\x01"; |
11373 | 0 | break; |
11374 | 0 | } |
11375 | 0 | if (MCInst_getNumOperands(MI) == 4 && |
11376 | 0 | MCOperand_isImm(MCInst_getOperand(MI, 1)) && |
11377 | 0 | MCOperand_getImm(MCInst_getOperand(MI, 1)) == 2 && |
11378 | 0 | MCOperand_isReg(MCInst_getOperand(MI, 2)) && |
11379 | 0 | GETREGCLASS_CONTAIN(PPC_CRBITRCRegClassID, 2)) { |
11380 | | // (gBCat u5imm:$bo, 2, crbitrc:$bi, condbrtarget:$dst) |
11381 | 0 | AsmString = "bc- $\xFF\x01\x06, $\x03, $\xFF\x04\x01"; |
11382 | 0 | break; |
11383 | 0 | } |
11384 | 0 | return NULL; |
11385 | 94.8k | } |
11386 | | |
11387 | | |
11388 | 23.3k | tmpString = cs_strdup(AsmString); |
11389 | | |
11390 | 160k | while (AsmString[I] != ' ' && AsmString[I] != '\t' && |
11391 | 160k | AsmString[I] != '$' && AsmString[I] != '\0') |
11392 | 137k | ++I; |
11393 | | |
11394 | 23.3k | tmpString[I] = 0; |
11395 | 23.3k | SStream_concat0(OS, tmpString); |
11396 | | |
11397 | 23.3k | if (AsmString[I] != '\0') { |
11398 | 23.0k | if (AsmString[I] == ' ' || AsmString[I] == '\t') { |
11399 | 23.0k | SStream_concat0(OS, " "); |
11400 | 23.0k | ++I; |
11401 | 23.0k | } |
11402 | | |
11403 | 84.9k | do { |
11404 | 84.9k | if (AsmString[I] == '$') { |
11405 | 37.8k | ++I; |
11406 | 37.8k | if (AsmString[I] == (char)0xff) { |
11407 | 9.21k | ++I; |
11408 | 9.21k | OpIdx = AsmString[I++] - 1; |
11409 | 9.21k | PrintMethodIdx = AsmString[I++] - 1; |
11410 | 9.21k | printCustomAliasOperand(MI, OpIdx, PrintMethodIdx, OS); |
11411 | 9.21k | } else |
11412 | 28.6k | printOperand(MI, (unsigned)(AsmString[I++]) - 1, OS); |
11413 | 47.0k | } else { |
11414 | 47.0k | SStream_concat1(OS, AsmString[I++]); |
11415 | 47.0k | } |
11416 | 84.9k | } while (AsmString[I] != '\0'); |
11417 | 23.0k | } |
11418 | | |
11419 | 23.3k | return tmpString; |
11420 | 94.8k | } |
11421 | | |
11422 | | static void printCustomAliasOperand( |
11423 | | MCInst *MI, unsigned OpIdx, |
11424 | | unsigned PrintMethodIdx, |
11425 | | SStream *OS) |
11426 | 17.6k | { |
11427 | 17.6k | switch (PrintMethodIdx) { |
11428 | 0 | default: |
11429 | 0 | break; |
11430 | 8.46k | case 0: |
11431 | 8.46k | printBranchOperand(MI, OpIdx, OS); |
11432 | 8.46k | break; |
11433 | 0 | case 1: |
11434 | 0 | printAbsBranchOperand(MI, OpIdx, OS); |
11435 | 0 | break; |
11436 | 6.62k | case 2: |
11437 | 6.62k | printS16ImmOperand(MI, OpIdx, OS); |
11438 | 6.62k | break; |
11439 | 2.32k | case 3: |
11440 | 2.32k | printU16ImmOperand(MI, OpIdx, OS); |
11441 | 2.32k | break; |
11442 | 183 | case 4: |
11443 | 183 | printU6ImmOperand(MI, OpIdx, OS); |
11444 | 183 | break; |
11445 | 79 | case 5: |
11446 | 79 | printU5ImmOperand(MI, OpIdx, OS); |
11447 | 79 | break; |
11448 | 17.6k | } |
11449 | 17.6k | } |
11450 | | |
11451 | | #endif // PRINT_ALIAS_INSTR |