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Created: 2025-07-18 06:43

/src/capstonenext/arch/ARM/ARMGenAsmWriter.inc
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1
/* Capstone Disassembly Engine, https://www.capstone-engine.org */
2
/* By Nguyen Anh Quynh <aquynh@gmail.com>, 2013-2022, */
3
/*    Rot127 <unisono@quyllur.org> 2022-2024 */
4
/* Automatically generated file by Capstone's LLVM TableGen Disassembler Backend. */
5
6
/* LLVM-commit: <commit> */
7
/* LLVM-tag: <tag> */
8
9
/* Do not edit. */
10
11
/* Capstone's LLVM TableGen Backends: */
12
/* https://github.com/capstone-engine/llvm-capstone */
13
14
#include <capstone/platform.h>
15
#include "../../cs_priv.h"
16
17
/// getMnemonic - This method is automatically generated by tablegen
18
/// from the instruction set description.
19
1.21M
static MnemonicBitsInfo getMnemonic(MCInst *MI, SStream *O) {
20
1.21M
#ifndef CAPSTONE_DIET
21
1.21M
  static const char AsmStrs[] = {
22
1.21M
  /* 0 */ "vcx1\t\0"
23
1.21M
  /* 6 */ "vld20.32\t\0"
24
1.21M
  /* 16 */ "vst20.32\t\0"
25
1.21M
  /* 26 */ "vld40.32\t\0"
26
1.21M
  /* 36 */ "vst40.32\t\0"
27
1.21M
  /* 46 */ "sha1su0.32\t\0"
28
1.21M
  /* 58 */ "sha256su0.32\t\0"
29
1.21M
  /* 72 */ "vld21.32\t\0"
30
1.21M
  /* 82 */ "vst21.32\t\0"
31
1.21M
  /* 92 */ "vld41.32\t\0"
32
1.21M
  /* 102 */ "vst41.32\t\0"
33
1.21M
  /* 112 */ "sha1su1.32\t\0"
34
1.21M
  /* 124 */ "sha256su1.32\t\0"
35
1.21M
  /* 138 */ "vld42.32\t\0"
36
1.21M
  /* 148 */ "vst42.32\t\0"
37
1.21M
  /* 158 */ "sha256h2.32\t\0"
38
1.21M
  /* 171 */ "vld43.32\t\0"
39
1.21M
  /* 181 */ "vst43.32\t\0"
40
1.21M
  /* 191 */ "sha1c.32\t\0"
41
1.21M
  /* 201 */ "sha1h.32\t\0"
42
1.21M
  /* 211 */ "sha256h.32\t\0"
43
1.21M
  /* 223 */ "sha1m.32\t\0"
44
1.21M
  /* 233 */ "sha1p.32\t\0"
45
1.21M
  /* 243 */ "dlstp.32\t\0"
46
1.21M
  /* 253 */ "wlstp.32\t\0"
47
1.21M
  /* 263 */ "vcvta.s32.f32\t\0"
48
1.21M
  /* 278 */ "vcvtm.s32.f32\t\0"
49
1.21M
  /* 293 */ "vcvtn.s32.f32\t\0"
50
1.21M
  /* 308 */ "vcvtp.s32.f32\t\0"
51
1.21M
  /* 323 */ "vcvta.u32.f32\t\0"
52
1.21M
  /* 338 */ "vcvtm.u32.f32\t\0"
53
1.21M
  /* 353 */ "vcvtn.u32.f32\t\0"
54
1.21M
  /* 368 */ "vcvtp.u32.f32\t\0"
55
1.21M
  /* 383 */ "vcmla.f32\t\0"
56
1.21M
  /* 394 */ "vrinta.f32\t\0"
57
1.21M
  /* 406 */ "vcadd.f32\t\0"
58
1.21M
  /* 417 */ "vselge.f32\t\0"
59
1.21M
  /* 429 */ "vminnm.f32\t\0"
60
1.21M
  /* 441 */ "vmaxnm.f32\t\0"
61
1.21M
  /* 453 */ "vrintm.f32\t\0"
62
1.21M
  /* 465 */ "vrintn.f32\t\0"
63
1.21M
  /* 477 */ "vrintp.f32\t\0"
64
1.21M
  /* 489 */ "vseleq.f32\t\0"
65
1.21M
  /* 501 */ "vselvs.f32\t\0"
66
1.21M
  /* 513 */ "vselgt.f32\t\0"
67
1.21M
  /* 525 */ "vrintx.f32\t\0"
68
1.21M
  /* 537 */ "vrintz.f32\t\0"
69
1.21M
  /* 549 */ "ldc2\t\0"
70
1.21M
  /* 555 */ "mrc2\t\0"
71
1.21M
  /* 561 */ "mrrc2\t\0"
72
1.21M
  /* 568 */ "stc2\t\0"
73
1.21M
  /* 574 */ "cdp2\t\0"
74
1.21M
  /* 580 */ "mcr2\t\0"
75
1.21M
  /* 586 */ "mcrr2\t\0"
76
1.21M
  /* 593 */ "vcx2\t\0"
77
1.21M
  /* 599 */ "vcx3\t\0"
78
1.21M
  /* 605 */ "dlstp.64\t\0"
79
1.21M
  /* 615 */ "wlstp.64\t\0"
80
1.21M
  /* 625 */ "vcvta.s32.f64\t\0"
81
1.21M
  /* 640 */ "vcvtm.s32.f64\t\0"
82
1.21M
  /* 655 */ "vcvtn.s32.f64\t\0"
83
1.21M
  /* 670 */ "vcvtp.s32.f64\t\0"
84
1.21M
  /* 685 */ "vcvta.u32.f64\t\0"
85
1.21M
  /* 700 */ "vcvtm.u32.f64\t\0"
86
1.21M
  /* 715 */ "vcvtn.u32.f64\t\0"
87
1.21M
  /* 730 */ "vcvtp.u32.f64\t\0"
88
1.21M
  /* 745 */ "vrinta.f64\t\0"
89
1.21M
  /* 757 */ "vselge.f64\t\0"
90
1.21M
  /* 769 */ "vminnm.f64\t\0"
91
1.21M
  /* 781 */ "vmaxnm.f64\t\0"
92
1.21M
  /* 793 */ "vrintm.f64\t\0"
93
1.21M
  /* 805 */ "vrintn.f64\t\0"
94
1.21M
  /* 817 */ "vrintp.f64\t\0"
95
1.21M
  /* 829 */ "vseleq.f64\t\0"
96
1.21M
  /* 841 */ "vselvs.f64\t\0"
97
1.21M
  /* 853 */ "vselgt.f64\t\0"
98
1.21M
  /* 865 */ "vmull.p64\t\0"
99
1.21M
  /* 876 */ "vld20.16\t\0"
100
1.21M
  /* 886 */ "vst20.16\t\0"
101
1.21M
  /* 896 */ "vld40.16\t\0"
102
1.21M
  /* 906 */ "vst40.16\t\0"
103
1.21M
  /* 916 */ "vld21.16\t\0"
104
1.21M
  /* 926 */ "vst21.16\t\0"
105
1.21M
  /* 936 */ "vld41.16\t\0"
106
1.21M
  /* 946 */ "vst41.16\t\0"
107
1.21M
  /* 956 */ "vld42.16\t\0"
108
1.21M
  /* 966 */ "vst42.16\t\0"
109
1.21M
  /* 976 */ "vld43.16\t\0"
110
1.21M
  /* 986 */ "vst43.16\t\0"
111
1.21M
  /* 996 */ "dlstp.16\t\0"
112
1.21M
  /* 1006 */ "wlstp.16\t\0"
113
1.21M
  /* 1016 */ "vcvta.s32.f16\t\0"
114
1.21M
  /* 1031 */ "vcvtm.s32.f16\t\0"
115
1.21M
  /* 1046 */ "vcvtn.s32.f16\t\0"
116
1.21M
  /* 1061 */ "vcvtp.s32.f16\t\0"
117
1.21M
  /* 1076 */ "vcvta.u32.f16\t\0"
118
1.21M
  /* 1091 */ "vcvtm.u32.f16\t\0"
119
1.21M
  /* 1106 */ "vcvtn.u32.f16\t\0"
120
1.21M
  /* 1121 */ "vcvtp.u32.f16\t\0"
121
1.21M
  /* 1136 */ "vcvta.s16.f16\t\0"
122
1.21M
  /* 1151 */ "vcvtm.s16.f16\t\0"
123
1.21M
  /* 1166 */ "vcvtn.s16.f16\t\0"
124
1.21M
  /* 1181 */ "vcvtp.s16.f16\t\0"
125
1.21M
  /* 1196 */ "vcvta.u16.f16\t\0"
126
1.21M
  /* 1211 */ "vcvtm.u16.f16\t\0"
127
1.21M
  /* 1226 */ "vcvtn.u16.f16\t\0"
128
1.21M
  /* 1241 */ "vcvtp.u16.f16\t\0"
129
1.21M
  /* 1256 */ "vcmla.f16\t\0"
130
1.21M
  /* 1267 */ "vrinta.f16\t\0"
131
1.21M
  /* 1279 */ "vcadd.f16\t\0"
132
1.21M
  /* 1290 */ "vselge.f16\t\0"
133
1.21M
  /* 1302 */ "vfmal.f16\t\0"
134
1.21M
  /* 1313 */ "vfmsl.f16\t\0"
135
1.21M
  /* 1324 */ "vminnm.f16\t\0"
136
1.21M
  /* 1336 */ "vmaxnm.f16\t\0"
137
1.21M
  /* 1348 */ "vrintm.f16\t\0"
138
1.21M
  /* 1360 */ "vrintn.f16\t\0"
139
1.21M
  /* 1372 */ "vrintp.f16\t\0"
140
1.21M
  /* 1384 */ "vseleq.f16\t\0"
141
1.21M
  /* 1396 */ "vins.f16\t\0"
142
1.21M
  /* 1406 */ "vselvs.f16\t\0"
143
1.21M
  /* 1418 */ "vselgt.f16\t\0"
144
1.21M
  /* 1430 */ "vrintx.f16\t\0"
145
1.21M
  /* 1442 */ "vmovx.f16\t\0"
146
1.21M
  /* 1453 */ "vrintz.f16\t\0"
147
1.21M
  /* 1465 */ "vmmla.bf16\t\0"
148
1.21M
  /* 1477 */ "vfmab.bf16\t\0"
149
1.21M
  /* 1489 */ "vfmat.bf16\t\0"
150
1.21M
  /* 1501 */ "vdot.bf16\t\0"
151
1.21M
  /* 1512 */ "vld20.8\t\0"
152
1.21M
  /* 1521 */ "vst20.8\t\0"
153
1.21M
  /* 1530 */ "vld40.8\t\0"
154
1.21M
  /* 1539 */ "vst40.8\t\0"
155
1.21M
  /* 1548 */ "vld21.8\t\0"
156
1.21M
  /* 1557 */ "vst21.8\t\0"
157
1.21M
  /* 1566 */ "vld41.8\t\0"
158
1.21M
  /* 1575 */ "vst41.8\t\0"
159
1.21M
  /* 1584 */ "vld42.8\t\0"
160
1.21M
  /* 1593 */ "vst42.8\t\0"
161
1.21M
  /* 1602 */ "vld43.8\t\0"
162
1.21M
  /* 1611 */ "vst43.8\t\0"
163
1.21M
  /* 1620 */ "aesimc.8\t\0"
164
1.21M
  /* 1630 */ "aesmc.8\t\0"
165
1.21M
  /* 1639 */ "aesd.8\t\0"
166
1.21M
  /* 1647 */ "aese.8\t\0"
167
1.21M
  /* 1655 */ "dlstp.8\t\0"
168
1.21M
  /* 1664 */ "wlstp.8\t\0"
169
1.21M
  /* 1673 */ "vusmmla.s8\t\0"
170
1.21M
  /* 1685 */ "vsmmla.s8\t\0"
171
1.21M
  /* 1696 */ "vusdot.s8\t\0"
172
1.21M
  /* 1707 */ "vsdot.s8\t\0"
173
1.21M
  /* 1717 */ "vummla.u8\t\0"
174
1.21M
  /* 1728 */ "vsudot.u8\t\0"
175
1.21M
  /* 1739 */ "vudot.u8\t\0"
176
1.21M
  /* 1749 */ "vcx1a\t\0"
177
1.21M
  /* 1756 */ "vcx2a\t\0"
178
1.21M
  /* 1763 */ "vcx3a\t\0"
179
1.21M
  /* 1770 */ "rfeda\t\0"
180
1.21M
  /* 1777 */ "rfeia\t\0"
181
1.21M
  /* 1784 */ "crc32b\t\0"
182
1.21M
  /* 1792 */ "crc32cb\t\0"
183
1.21M
  /* 1801 */ "rfedb\t\0"
184
1.21M
  /* 1808 */ "rfeib\t\0"
185
1.21M
  /* 1815 */ "dmb\t\0"
186
1.21M
  /* 1820 */ "dsb\t\0"
187
1.21M
  /* 1825 */ "isb\t\0"
188
1.21M
  /* 1830 */ "tsb\t\0"
189
1.21M
  /* 1835 */ "csinc\t\0"
190
1.21M
  /* 1842 */ "hvc\t\0"
191
1.21M
  /* 1847 */ "cx1d\t\0"
192
1.21M
  /* 1853 */ "cx2d\t\0"
193
1.21M
  /* 1859 */ "cx3d\t\0"
194
1.21M
  /* 1865 */ "pld\t\0"
195
1.21M
  /* 1870 */ "setend\t\0"
196
1.21M
  /* 1878 */ "le\t\0"
197
1.21M
  /* 1882 */ "udf\t\0"
198
1.21M
  /* 1887 */ "csneg\t\0"
199
1.21M
  /* 1894 */ "crc32h\t\0"
200
1.21M
  /* 1902 */ "crc32ch\t\0"
201
1.21M
  /* 1911 */ "pli\t\0"
202
1.21M
  /* 1916 */ "bti\t\0"
203
1.21M
  /* 1921 */ "ldc2l\t\0"
204
1.21M
  /* 1928 */ "stc2l\t\0"
205
1.21M
  /* 1935 */ "bl\t\0"
206
1.21M
  /* 1939 */ "bfcsel\t\0"
207
1.21M
  /* 1947 */ "setpan\t\0"
208
1.21M
  /* 1955 */ "letp\t\0"
209
1.21M
  /* 1961 */ "dls\t\0"
210
1.21M
  /* 1966 */ "wls\t\0"
211
1.21M
  /* 1971 */ "cps\t\0"
212
1.21M
  /* 1976 */ "movs\t\0"
213
1.21M
  /* 1982 */ "hlt\t\0"
214
1.21M
  /* 1987 */ "bkpt\t\0"
215
1.21M
  /* 1993 */ "csinv\t\0"
216
1.21M
  /* 2000 */ "hvc.w\t\0"
217
1.21M
  /* 2007 */ "udf.w\t\0"
218
1.21M
  /* 2014 */ "crc32w\t\0"
219
1.21M
  /* 2022 */ "crc32cw\t\0"
220
1.21M
  /* 2031 */ "pldw\t\0"
221
1.21M
  /* 2037 */ "bx\t\0"
222
1.21M
  /* 2041 */ "blx\t\0"
223
1.21M
  /* 2046 */ "cbz\t\0"
224
1.21M
  /* 2051 */ "cbnz\t\0"
225
1.21M
  /* 2057 */ "srsda\tsp!, \0"
226
1.21M
  /* 2069 */ "srsia\tsp!, \0"
227
1.21M
  /* 2081 */ "srsdb\tsp!, \0"
228
1.21M
  /* 2093 */ "srsib\tsp!, \0"
229
1.21M
  /* 2105 */ "srsda\tsp, \0"
230
1.21M
  /* 2116 */ "srsia\tsp, \0"
231
1.21M
  /* 2127 */ "srsdb\tsp, \0"
232
1.21M
  /* 2138 */ "srsib\tsp, \0"
233
1.21M
  /* 2149 */ "# XRay Function Patchable RET.\0"
234
1.21M
  /* 2180 */ "# XRay Typed Event Log.\0"
235
1.21M
  /* 2204 */ "# XRay Custom Event Log.\0"
236
1.21M
  /* 2229 */ "# XRay Function Enter.\0"
237
1.21M
  /* 2252 */ "# XRay Tail Call Exit.\0"
238
1.21M
  /* 2275 */ "# XRay Function Exit.\0"
239
1.21M
  /* 2297 */ "__brkdiv0\0"
240
1.21M
  /* 2307 */ "vld1\0"
241
1.21M
  /* 2312 */ "dcps1\0"
242
1.21M
  /* 2318 */ "vst1\0"
243
1.21M
  /* 2323 */ "vcx1\0"
244
1.21M
  /* 2328 */ "vrev32\0"
245
1.21M
  /* 2335 */ "ldc2\0"
246
1.21M
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247
1.21M
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248
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  /* 2351 */ "stc2\0"
249
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250
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251
1.21M
  /* 2366 */ "mcr2\0"
252
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253
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254
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255
1.21M
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256
1.21M
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257
1.21M
  /* 2398 */ "dcps3\0"
258
1.21M
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259
1.21M
  /* 2409 */ "vcx3\0"
260
1.21M
  /* 2414 */ "vrev64\0"
261
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  /* 2421 */ "vld4\0"
262
1.21M
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263
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264
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266
1.21M
  /* 2454 */ "uxtb16\0"
267
1.21M
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268
1.21M
  /* 2469 */ "uhsub16\0"
269
1.21M
  /* 2477 */ "uqsub16\0"
270
1.21M
  /* 2485 */ "ssub16\0"
271
1.21M
  /* 2492 */ "usub16\0"
272
1.21M
  /* 2499 */ "shadd16\0"
273
1.21M
  /* 2507 */ "uhadd16\0"
274
1.21M
  /* 2515 */ "uqadd16\0"
275
1.21M
  /* 2523 */ "sadd16\0"
276
1.21M
  /* 2530 */ "uadd16\0"
277
1.21M
  /* 2537 */ "ssat16\0"
278
1.21M
  /* 2544 */ "usat16\0"
279
1.21M
  /* 2551 */ "vrev16\0"
280
1.21M
  /* 2558 */ "usada8\0"
281
1.21M
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282
1.21M
  /* 2572 */ "uhsub8\0"
283
1.21M
  /* 2579 */ "uqsub8\0"
284
1.21M
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285
1.21M
  /* 2592 */ "usub8\0"
286
1.21M
  /* 2598 */ "usad8\0"
287
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1.21M
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289
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290
1.21M
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  /* 2631 */ "uadd8\0"
292
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  /* 2637 */ "LIFETIME_END\0"
293
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294
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295
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296
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298
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299
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300
1.21M
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301
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302
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303
1.21M
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304
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307
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308
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  /* 2783 */ "lda\0"
309
1.21M
  /* 2787 */ "ldmda\0"
310
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  /* 2793 */ "stmda\0"
311
1.21M
  /* 2799 */ "vrmlaldavha\0"
312
1.21M
  /* 2811 */ "vrmlsldavha\0"
313
1.21M
  /* 2823 */ "rfeia\0"
314
1.21M
  /* 2829 */ "vldmia\0"
315
1.21M
  /* 2836 */ "vstmia\0"
316
1.21M
  /* 2843 */ "srsia\0"
317
1.21M
  /* 2849 */ "vcmla\0"
318
1.21M
  /* 2855 */ "smmla\0"
319
1.21M
  /* 2861 */ "vnmla\0"
320
1.21M
  /* 2867 */ "vmla\0"
321
1.21M
  /* 2872 */ "vfma\0"
322
1.21M
  /* 2877 */ "vfnma\0"
323
1.21M
  /* 2883 */ "vminnma\0"
324
1.21M
  /* 2891 */ "vmaxnma\0"
325
1.21M
  /* 2899 */ "vmina\0"
326
1.21M
  /* 2905 */ "vrsra\0"
327
1.21M
  /* 2911 */ "vsra\0"
328
1.21M
  /* 2916 */ "vrinta\0"
329
1.21M
  /* 2923 */ "tta\0"
330
1.21M
  /* 2927 */ "vcvta\0"
331
1.21M
  /* 2933 */ "vmladava\0"
332
1.21M
  /* 2942 */ "vmlaldava\0"
333
1.21M
  /* 2952 */ "vmlsldava\0"
334
1.21M
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335
1.21M
  /* 2971 */ "vaddva\0"
336
1.21M
  /* 2978 */ "vaddlva\0"
337
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  /* 2986 */ "vmaxa\0"
338
1.21M
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339
1.21M
  /* 2997 */ "sxtab\0"
340
1.21M
  /* 3003 */ "uxtab\0"
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  /* 3009 */ "smlabb\0"
342
1.21M
  /* 3016 */ "smlalbb\0"
343
1.21M
  /* 3024 */ "smulbb\0"
344
1.21M
  /* 3031 */ "tbb\0"
345
1.21M
  /* 3035 */ "rfedb\0"
346
1.21M
  /* 3041 */ "vldmdb\0"
347
1.21M
  /* 3048 */ "vstmdb\0"
348
1.21M
  /* 3055 */ "srsdb\0"
349
1.21M
  /* 3061 */ "ldmib\0"
350
1.21M
  /* 3067 */ "stmib\0"
351
1.21M
  /* 3073 */ "vshllb\0"
352
1.21M
  /* 3080 */ "vqdmullb\0"
353
1.21M
  /* 3089 */ "vmullb\0"
354
1.21M
  /* 3096 */ "stlb\0"
355
1.21M
  /* 3101 */ "vmovlb\0"
356
1.21M
  /* 3108 */ "dmb\0"
357
1.21M
  /* 3112 */ "vqshrnb\0"
358
1.21M
  /* 3120 */ "vqrshrnb\0"
359
1.21M
  /* 3129 */ "vrshrnb\0"
360
1.21M
  /* 3137 */ "vshrnb\0"
361
1.21M
  /* 3144 */ "vqshrunb\0"
362
1.21M
  /* 3153 */ "vqrshrunb\0"
363
1.21M
  /* 3163 */ "vqmovunb\0"
364
1.21M
  /* 3172 */ "vqmovnb\0"
365
1.21M
  /* 3180 */ "vmovnb\0"
366
1.21M
  /* 3187 */ "swpb\0"
367
1.21M
  /* 3192 */ "vldrb\0"
368
1.21M
  /* 3198 */ "vstrb\0"
369
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  /* 3204 */ "dsb\0"
370
1.21M
  /* 3208 */ "isb\0"
371
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  /* 3212 */ "ldrsb\0"
372
1.21M
  /* 3218 */ "tsb\0"
373
1.21M
  /* 3222 */ "smlatb\0"
374
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  /* 3229 */ "pkhtb\0"
375
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376
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377
1.21M
  /* 3250 */ "vcvtb\0"
378
1.21M
  /* 3256 */ "sxtb\0"
379
1.21M
  /* 3261 */ "uxtb\0"
380
1.21M
  /* 3266 */ "qdsub\0"
381
1.21M
  /* 3272 */ "vhsub\0"
382
1.21M
  /* 3278 */ "vqsub\0"
383
1.21M
  /* 3284 */ "vsub\0"
384
1.21M
  /* 3289 */ "smlawb\0"
385
1.21M
  /* 3296 */ "smulwb\0"
386
1.21M
  /* 3303 */ "ldaexb\0"
387
1.21M
  /* 3310 */ "stlexb\0"
388
1.21M
  /* 3317 */ "ldrexb\0"
389
1.21M
  /* 3324 */ "strexb\0"
390
1.21M
  /* 3331 */ "vsbc\0"
391
1.21M
  /* 3336 */ "vadc\0"
392
1.21M
  /* 3341 */ "ldc\0"
393
1.21M
  /* 3345 */ "bfc\0"
394
1.21M
  /* 3349 */ "vbic\0"
395
1.21M
  /* 3354 */ "vshlc\0"
396
1.21M
  /* 3360 */ "smc\0"
397
1.21M
  /* 3364 */ "mrc\0"
398
1.21M
  /* 3368 */ "mrrc\0"
399
1.21M
  /* 3373 */ "rsc\0"
400
1.21M
  /* 3377 */ "stc\0"
401
1.21M
  /* 3381 */ "svc\0"
402
1.21M
  /* 3385 */ "smlad\0"
403
1.21M
  /* 3391 */ "smuad\0"
404
1.21M
  /* 3397 */ "vabd\0"
405
1.21M
  /* 3402 */ "vhcadd\0"
406
1.21M
  /* 3409 */ "vcadd\0"
407
1.21M
  /* 3415 */ "qdadd\0"
408
1.21M
  /* 3421 */ "vrhadd\0"
409
1.21M
  /* 3428 */ "vhadd\0"
410
1.21M
  /* 3434 */ "vpadd\0"
411
1.21M
  /* 3440 */ "vqadd\0"
412
1.21M
  /* 3446 */ "vadd\0"
413
1.21M
  /* 3451 */ "smlald\0"
414
1.21M
  /* 3458 */ "pld\0"
415
1.21M
  /* 3462 */ "smlsld\0"
416
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  /* 3469 */ "vand\0"
417
1.21M
  /* 3474 */ "vldrd\0"
418
1.21M
  /* 3480 */ "vstrd\0"
419
1.21M
  /* 3486 */ "smlsd\0"
420
1.21M
  /* 3492 */ "smusd\0"
421
1.21M
  /* 3498 */ "ldaexd\0"
422
1.21M
  /* 3505 */ "stlexd\0"
423
1.21M
  /* 3512 */ "ldrexd\0"
424
1.21M
  /* 3519 */ "strexd\0"
425
1.21M
  /* 3526 */ "vacge\0"
426
1.21M
  /* 3532 */ "vcge\0"
427
1.21M
  /* 3537 */ "vcle\0"
428
1.21M
  /* 3542 */ "vrecpe\0"
429
1.21M
  /* 3549 */ "vcmpe\0"
430
1.21M
  /* 3555 */ "vrsqrte\0"
431
1.21M
  /* 3563 */ "bf\0"
432
1.21M
  /* 3566 */ "vbif\0"
433
1.21M
  /* 3571 */ "dbg\0"
434
1.21M
  /* 3575 */ "pacg\0"
435
1.21M
  /* 3580 */ "vqneg\0"
436
1.21M
  /* 3586 */ "vneg\0"
437
1.21M
  /* 3591 */ "sg\0"
438
1.21M
  /* 3594 */ "autg\0"
439
1.21M
  /* 3599 */ "ldah\0"
440
1.21M
  /* 3604 */ "vqdmlah\0"
441
1.21M
  /* 3612 */ "vqrdmlah\0"
442
1.21M
  /* 3621 */ "sxtah\0"
443
1.21M
  /* 3627 */ "uxtah\0"
444
1.21M
  /* 3633 */ "tbh\0"
445
1.21M
  /* 3637 */ "vqdmladh\0"
446
1.21M
  /* 3646 */ "vqrdmladh\0"
447
1.21M
  /* 3656 */ "vqdmlsdh\0"
448
1.21M
  /* 3665 */ "vqrdmlsdh\0"
449
1.21M
  /* 3675 */ "stlh\0"
450
1.21M
  /* 3680 */ "vqdmulh\0"
451
1.21M
  /* 3688 */ "vqrdmulh\0"
452
1.21M
  /* 3697 */ "vrmulh\0"
453
1.21M
  /* 3704 */ "vmulh\0"
454
1.21M
  /* 3710 */ "vldrh\0"
455
1.21M
  /* 3716 */ "vstrh\0"
456
1.21M
  /* 3722 */ "vqdmlash\0"
457
1.21M
  /* 3731 */ "vqrdmlash\0"
458
1.21M
  /* 3741 */ "vqrdmlsh\0"
459
1.21M
  /* 3750 */ "ldrsh\0"
460
1.21M
  /* 3756 */ "push\0"
461
1.21M
  /* 3761 */ "revsh\0"
462
1.21M
  /* 3767 */ "sxth\0"
463
1.21M
  /* 3772 */ "uxth\0"
464
1.21M
  /* 3777 */ "vrmlaldavh\0"
465
1.21M
  /* 3788 */ "vrmlsldavh\0"
466
1.21M
  /* 3799 */ "ldaexh\0"
467
1.21M
  /* 3806 */ "stlexh\0"
468
1.21M
  /* 3813 */ "ldrexh\0"
469
1.21M
  /* 3820 */ "strexh\0"
470
1.21M
  /* 3827 */ "vsbci\0"
471
1.21M
  /* 3833 */ "vadci\0"
472
1.21M
  /* 3839 */ "bfi\0"
473
1.21M
  /* 3843 */ "pli\0"
474
1.21M
  /* 3847 */ "vsli\0"
475
1.21M
  /* 3852 */ "vsri\0"
476
1.21M
  /* 3857 */ "bxj\0"
477
1.21M
  /* 3861 */ "ldc2l\0"
478
1.21M
  /* 3867 */ "stc2l\0"
479
1.21M
  /* 3873 */ "umaal\0"
480
1.21M
  /* 3879 */ "vabal\0"
481
1.21M
  /* 3885 */ "vpadal\0"
482
1.21M
  /* 3892 */ "vqdmlal\0"
483
1.21M
  /* 3900 */ "smlal\0"
484
1.21M
  /* 3906 */ "umlal\0"
485
1.21M
  /* 3912 */ "vmlal\0"
486
1.21M
  /* 3918 */ "vtbl\0"
487
1.21M
  /* 3923 */ "vsubl\0"
488
1.21M
  /* 3929 */ "ldcl\0"
489
1.21M
  /* 3934 */ "stcl\0"
490
1.21M
  /* 3939 */ "vabdl\0"
491
1.21M
  /* 3945 */ "vpaddl\0"
492
1.21M
  /* 3952 */ "vaddl\0"
493
1.21M
  /* 3958 */ "vpsel\0"
494
1.21M
  /* 3964 */ "bfl\0"
495
1.21M
  /* 3968 */ "sqshl\0"
496
1.21M
  /* 3974 */ "uqshl\0"
497
1.21M
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498
1.21M
  /* 3986 */ "uqrshl\0"
499
1.21M
  /* 3993 */ "vqrshl\0"
500
1.21M
  /* 4000 */ "vrshl\0"
501
1.21M
  /* 4006 */ "vshl\0"
502
1.21M
  /* 4011 */ "# FEntry call\0"
503
1.21M
  /* 4025 */ "sqshll\0"
504
1.21M
  /* 4032 */ "uqshll\0"
505
1.21M
  /* 4039 */ "uqrshll\0"
506
1.21M
  /* 4047 */ "vshll\0"
507
1.21M
  /* 4053 */ "lsll\0"
508
1.21M
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509
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777
1.21M
    4012U,  // FENTRY_CALL
778
1.21M
    0U, // PATCHPOINT
779
1.21M
    0U, // LOAD_STACK_GUARD
780
1.21M
    0U, // PREALLOCATED_SETUP
781
1.21M
    0U, // PREALLOCATED_ARG
782
1.21M
    0U, // STATEPOINT
783
1.21M
    0U, // LOCAL_ESCAPE
784
1.21M
    0U, // FAULTING_OP
785
1.21M
    0U, // PATCHABLE_OP
786
1.21M
    2230U,  // PATCHABLE_FUNCTION_ENTER
787
1.21M
    2150U,  // PATCHABLE_RET
788
1.21M
    2276U,  // PATCHABLE_FUNCTION_EXIT
789
1.21M
    2253U,  // PATCHABLE_TAIL_CALL
790
1.21M
    2205U,  // PATCHABLE_EVENT_CALL
791
1.21M
    2181U,  // PATCHABLE_TYPED_EVENT_CALL
792
1.21M
    0U, // ICALL_BRANCH_FUNNEL
793
1.21M
    0U, // MEMBARRIER
794
1.21M
    0U, // JUMP_TABLE_DEBUG_INFO
795
1.21M
    0U, // G_ASSERT_SEXT
796
1.21M
    0U, // G_ASSERT_ZEXT
797
1.21M
    0U, // G_ASSERT_ALIGN
798
1.21M
    0U, // G_ADD
799
1.21M
    0U, // G_SUB
800
1.21M
    0U, // G_MUL
801
1.21M
    0U, // G_SDIV
802
1.21M
    0U, // G_UDIV
803
1.21M
    0U, // G_SREM
804
1.21M
    0U, // G_UREM
805
1.21M
    0U, // G_SDIVREM
806
1.21M
    0U, // G_UDIVREM
807
1.21M
    0U, // G_AND
808
1.21M
    0U, // G_OR
809
1.21M
    0U, // G_XOR
810
1.21M
    0U, // G_IMPLICIT_DEF
811
1.21M
    0U, // G_PHI
812
1.21M
    0U, // G_FRAME_INDEX
813
1.21M
    0U, // G_GLOBAL_VALUE
814
1.21M
    0U, // G_CONSTANT_POOL
815
1.21M
    0U, // G_EXTRACT
816
1.21M
    0U, // G_UNMERGE_VALUES
817
1.21M
    0U, // G_INSERT
818
1.21M
    0U, // G_MERGE_VALUES
819
1.21M
    0U, // G_BUILD_VECTOR
820
1.21M
    0U, // G_BUILD_VECTOR_TRUNC
821
1.21M
    0U, // G_CONCAT_VECTORS
822
1.21M
    0U, // G_PTRTOINT
823
1.21M
    0U, // G_INTTOPTR
824
1.21M
    0U, // G_BITCAST
825
1.21M
    0U, // G_FREEZE
826
1.21M
    0U, // G_CONSTANT_FOLD_BARRIER
827
1.21M
    0U, // G_INTRINSIC_FPTRUNC_ROUND
828
1.21M
    0U, // G_INTRINSIC_TRUNC
829
1.21M
    0U, // G_INTRINSIC_ROUND
830
1.21M
    0U, // G_INTRINSIC_LRINT
831
1.21M
    0U, // G_INTRINSIC_ROUNDEVEN
832
1.21M
    0U, // G_READCYCLECOUNTER
833
1.21M
    0U, // G_LOAD
834
1.21M
    0U, // G_SEXTLOAD
835
1.21M
    0U, // G_ZEXTLOAD
836
1.21M
    0U, // G_INDEXED_LOAD
837
1.21M
    0U, // G_INDEXED_SEXTLOAD
838
1.21M
    0U, // G_INDEXED_ZEXTLOAD
839
1.21M
    0U, // G_STORE
840
1.21M
    0U, // G_INDEXED_STORE
841
1.21M
    0U, // G_ATOMIC_CMPXCHG_WITH_SUCCESS
842
1.21M
    0U, // G_ATOMIC_CMPXCHG
843
1.21M
    0U, // G_ATOMICRMW_XCHG
844
1.21M
    0U, // G_ATOMICRMW_ADD
845
1.21M
    0U, // G_ATOMICRMW_SUB
846
1.21M
    0U, // G_ATOMICRMW_AND
847
1.21M
    0U, // G_ATOMICRMW_NAND
848
1.21M
    0U, // G_ATOMICRMW_OR
849
1.21M
    0U, // G_ATOMICRMW_XOR
850
1.21M
    0U, // G_ATOMICRMW_MAX
851
1.21M
    0U, // G_ATOMICRMW_MIN
852
1.21M
    0U, // G_ATOMICRMW_UMAX
853
1.21M
    0U, // G_ATOMICRMW_UMIN
854
1.21M
    0U, // G_ATOMICRMW_FADD
855
1.21M
    0U, // G_ATOMICRMW_FSUB
856
1.21M
    0U, // G_ATOMICRMW_FMAX
857
1.21M
    0U, // G_ATOMICRMW_FMIN
858
1.21M
    0U, // G_ATOMICRMW_UINC_WRAP
859
1.21M
    0U, // G_ATOMICRMW_UDEC_WRAP
860
1.21M
    0U, // G_FENCE
861
1.21M
    0U, // G_PREFETCH
862
1.21M
    0U, // G_BRCOND
863
1.21M
    0U, // G_BRINDIRECT
864
1.21M
    0U, // G_INVOKE_REGION_START
865
1.21M
    0U, // G_INTRINSIC
866
1.21M
    0U, // G_INTRINSIC_W_SIDE_EFFECTS
867
1.21M
    0U, // G_INTRINSIC_CONVERGENT
868
1.21M
    0U, // G_INTRINSIC_CONVERGENT_W_SIDE_EFFECTS
869
1.21M
    0U, // G_ANYEXT
870
1.21M
    0U, // G_TRUNC
871
1.21M
    0U, // G_CONSTANT
872
1.21M
    0U, // G_FCONSTANT
873
1.21M
    0U, // G_VASTART
874
1.21M
    0U, // G_VAARG
875
1.21M
    0U, // G_SEXT
876
1.21M
    0U, // G_SEXT_INREG
877
1.21M
    0U, // G_ZEXT
878
1.21M
    0U, // G_SHL
879
1.21M
    0U, // G_LSHR
880
1.21M
    0U, // G_ASHR
881
1.21M
    0U, // G_FSHL
882
1.21M
    0U, // G_FSHR
883
1.21M
    0U, // G_ROTR
884
1.21M
    0U, // G_ROTL
885
1.21M
    0U, // G_ICMP
886
1.21M
    0U, // G_FCMP
887
1.21M
    0U, // G_SELECT
888
1.21M
    0U, // G_UADDO
889
1.21M
    0U, // G_UADDE
890
1.21M
    0U, // G_USUBO
891
1.21M
    0U, // G_USUBE
892
1.21M
    0U, // G_SADDO
893
1.21M
    0U, // G_SADDE
894
1.21M
    0U, // G_SSUBO
895
1.21M
    0U, // G_SSUBE
896
1.21M
    0U, // G_UMULO
897
1.21M
    0U, // G_SMULO
898
1.21M
    0U, // G_UMULH
899
1.21M
    0U, // G_SMULH
900
1.21M
    0U, // G_UADDSAT
901
1.21M
    0U, // G_SADDSAT
902
1.21M
    0U, // G_USUBSAT
903
1.21M
    0U, // G_SSUBSAT
904
1.21M
    0U, // G_USHLSAT
905
1.21M
    0U, // G_SSHLSAT
906
1.21M
    0U, // G_SMULFIX
907
1.21M
    0U, // G_UMULFIX
908
1.21M
    0U, // G_SMULFIXSAT
909
1.21M
    0U, // G_UMULFIXSAT
910
1.21M
    0U, // G_SDIVFIX
911
1.21M
    0U, // G_UDIVFIX
912
1.21M
    0U, // G_SDIVFIXSAT
913
1.21M
    0U, // G_UDIVFIXSAT
914
1.21M
    0U, // G_FADD
915
1.21M
    0U, // G_FSUB
916
1.21M
    0U, // G_FMUL
917
1.21M
    0U, // G_FMA
918
1.21M
    0U, // G_FMAD
919
1.21M
    0U, // G_FDIV
920
1.21M
    0U, // G_FREM
921
1.21M
    0U, // G_FPOW
922
1.21M
    0U, // G_FPOWI
923
1.21M
    0U, // G_FEXP
924
1.21M
    0U, // G_FEXP2
925
1.21M
    0U, // G_FEXP10
926
1.21M
    0U, // G_FLOG
927
1.21M
    0U, // G_FLOG2
928
1.21M
    0U, // G_FLOG10
929
1.21M
    0U, // G_FLDEXP
930
1.21M
    0U, // G_FFREXP
931
1.21M
    0U, // G_FNEG
932
1.21M
    0U, // G_FPEXT
933
1.21M
    0U, // G_FPTRUNC
934
1.21M
    0U, // G_FPTOSI
935
1.21M
    0U, // G_FPTOUI
936
1.21M
    0U, // G_SITOFP
937
1.21M
    0U, // G_UITOFP
938
1.21M
    0U, // G_FABS
939
1.21M
    0U, // G_FCOPYSIGN
940
1.21M
    0U, // G_IS_FPCLASS
941
1.21M
    0U, // G_FCANONICALIZE
942
1.21M
    0U, // G_FMINNUM
943
1.21M
    0U, // G_FMAXNUM
944
1.21M
    0U, // G_FMINNUM_IEEE
945
1.21M
    0U, // G_FMAXNUM_IEEE
946
1.21M
    0U, // G_FMINIMUM
947
1.21M
    0U, // G_FMAXIMUM
948
1.21M
    0U, // G_GET_FPENV
949
1.21M
    0U, // G_SET_FPENV
950
1.21M
    0U, // G_RESET_FPENV
951
1.21M
    0U, // G_GET_FPMODE
952
1.21M
    0U, // G_SET_FPMODE
953
1.21M
    0U, // G_RESET_FPMODE
954
1.21M
    0U, // G_PTR_ADD
955
1.21M
    0U, // G_PTRMASK
956
1.21M
    0U, // G_SMIN
957
1.21M
    0U, // G_SMAX
958
1.21M
    0U, // G_UMIN
959
1.21M
    0U, // G_UMAX
960
1.21M
    0U, // G_ABS
961
1.21M
    0U, // G_LROUND
962
1.21M
    0U, // G_LLROUND
963
1.21M
    0U, // G_BR
964
1.21M
    0U, // G_BRJT
965
1.21M
    0U, // G_INSERT_VECTOR_ELT
966
1.21M
    0U, // G_EXTRACT_VECTOR_ELT
967
1.21M
    0U, // G_SHUFFLE_VECTOR
968
1.21M
    0U, // G_CTTZ
969
1.21M
    0U, // G_CTTZ_ZERO_UNDEF
970
1.21M
    0U, // G_CTLZ
971
1.21M
    0U, // G_CTLZ_ZERO_UNDEF
972
1.21M
    0U, // G_CTPOP
973
1.21M
    0U, // G_BSWAP
974
1.21M
    0U, // G_BITREVERSE
975
1.21M
    0U, // G_FCEIL
976
1.21M
    0U, // G_FCOS
977
1.21M
    0U, // G_FSIN
978
1.21M
    0U, // G_FSQRT
979
1.21M
    0U, // G_FFLOOR
980
1.21M
    0U, // G_FRINT
981
1.21M
    0U, // G_FNEARBYINT
982
1.21M
    0U, // G_ADDRSPACE_CAST
983
1.21M
    0U, // G_BLOCK_ADDR
984
1.21M
    0U, // G_JUMP_TABLE
985
1.21M
    0U, // G_DYN_STACKALLOC
986
1.21M
    0U, // G_STACKSAVE
987
1.21M
    0U, // G_STACKRESTORE
988
1.21M
    0U, // G_STRICT_FADD
989
1.21M
    0U, // G_STRICT_FSUB
990
1.21M
    0U, // G_STRICT_FMUL
991
1.21M
    0U, // G_STRICT_FDIV
992
1.21M
    0U, // G_STRICT_FREM
993
1.21M
    0U, // G_STRICT_FMA
994
1.21M
    0U, // G_STRICT_FSQRT
995
1.21M
    0U, // G_STRICT_FLDEXP
996
1.21M
    0U, // G_READ_REGISTER
997
1.21M
    0U, // G_WRITE_REGISTER
998
1.21M
    0U, // G_MEMCPY
999
1.21M
    0U, // G_MEMCPY_INLINE
1000
1.21M
    0U, // G_MEMMOVE
1001
1.21M
    0U, // G_MEMSET
1002
1.21M
    0U, // G_BZERO
1003
1.21M
    0U, // G_VECREDUCE_SEQ_FADD
1004
1.21M
    0U, // G_VECREDUCE_SEQ_FMUL
1005
1.21M
    0U, // G_VECREDUCE_FADD
1006
1.21M
    0U, // G_VECREDUCE_FMUL
1007
1.21M
    0U, // G_VECREDUCE_FMAX
1008
1.21M
    0U, // G_VECREDUCE_FMIN
1009
1.21M
    0U, // G_VECREDUCE_FMAXIMUM
1010
1.21M
    0U, // G_VECREDUCE_FMINIMUM
1011
1.21M
    0U, // G_VECREDUCE_ADD
1012
1.21M
    0U, // G_VECREDUCE_MUL
1013
1.21M
    0U, // G_VECREDUCE_AND
1014
1.21M
    0U, // G_VECREDUCE_OR
1015
1.21M
    0U, // G_VECREDUCE_XOR
1016
1.21M
    0U, // G_VECREDUCE_SMAX
1017
1.21M
    0U, // G_VECREDUCE_SMIN
1018
1.21M
    0U, // G_VECREDUCE_UMAX
1019
1.21M
    0U, // G_VECREDUCE_UMIN
1020
1.21M
    0U, // G_SBFX
1021
1.21M
    0U, // G_UBFX
1022
1.21M
    0U, // ABS
1023
1.21M
    0U, // ADDSri
1024
1.21M
    0U, // ADDSrr
1025
1.21M
    0U, // ADDSrsi
1026
1.21M
    0U, // ADDSrsr
1027
1.21M
    0U, // ADJCALLSTACKDOWN
1028
1.21M
    0U, // ADJCALLSTACKUP
1029
1.21M
    12770U, // ASRi
1030
1.21M
    12770U, // ASRr
1031
1.21M
    0U, // B
1032
1.21M
    0U, // BCCZi64
1033
1.21M
    0U, // BCCi64
1034
1.21M
    0U, // BLX_noip
1035
1.21M
    0U, // BLX_pred_noip
1036
1.21M
    0U, // BL_PUSHLR
1037
1.21M
    0U, // BMOVPCB_CALL
1038
1.21M
    0U, // BMOVPCRX_CALL
1039
1.21M
    0U, // BR_JTadd
1040
1.21M
    0U, // BR_JTm_i12
1041
1.21M
    0U, // BR_JTm_rs
1042
1.21M
    0U, // BR_JTr
1043
1.21M
    0U, // BX_CALL
1044
1.21M
    0U, // CMP_SWAP_16
1045
1.21M
    0U, // CMP_SWAP_32
1046
1.21M
    0U, // CMP_SWAP_64
1047
1.21M
    0U, // CMP_SWAP_8
1048
1.21M
    0U, // CONSTPOOL_ENTRY
1049
1.21M
    0U, // COPY_STRUCT_BYVAL_I32
1050
1.21M
    67130072U,  // ITasm
1051
1.21M
    0U, // Int_eh_sjlj_dispatchsetup
1052
1.21M
    0U, // Int_eh_sjlj_longjmp
1053
1.21M
    0U, // Int_eh_sjlj_setjmp
1054
1.21M
    0U, // Int_eh_sjlj_setjmp_nofp
1055
1.21M
    0U, // Int_eh_sjlj_setup_dispatch
1056
1.21M
    0U, // JUMPTABLE_ADDRS
1057
1.21M
    0U, // JUMPTABLE_INSTS
1058
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1059
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1060
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1061
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1063
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1065
1.21M
    0U, // LDRLIT_ga_pcrel
1066
1.21M
    0U, // LDRLIT_ga_pcrel_ldr
1067
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1068
1.21M
    29391U, // LDRSHTii
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1070
1.21M
    0U, // LEApcrel
1071
1.21M
    0U, // LEApcrelJT
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    0U, // LOADDUAL
1073
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    12318U, // LSLi
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1076
1.21M
    12777U, // LSRr
1077
1.21M
    0U, // MEMCPY
1078
1.21M
    0U, // MLAv5
1079
1.21M
    0U, // MOVCCi
1080
1.21M
    0U, // MOVCCi16
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    0U, // MOVCCi32imm
1082
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    0U, // MOVCCr
1083
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    0U, // MOVCCsi
1084
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1085
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    0U, // MOVPCRX
1086
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1087
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1088
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    0U, // MOV_ga_pcrel_ldr
1089
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    0U, // MOVi16_ga_pcrel
1090
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1091
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1092
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1093
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1095
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    0U, // MQQQQPRLoad
1097
1.21M
    0U, // MQQQQPRStore
1098
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    0U, // MULv5
1099
1.21M
    0U, // MVE_MEMCPYLOOPINST
1100
1.21M
    0U, // MVE_MEMSETLOOPINST
1101
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    0U, // MVNCCi
1102
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    0U, // PICADD
1103
1.21M
    0U, // PICLDR
1104
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1109
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1112
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1113
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1114
1.21M
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1115
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1117
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    0U, // RSBSrsr
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1.21M
    0U, // SEH_EpilogEnd
1119
1.21M
    0U, // SEH_EpilogStart
1120
1.21M
    0U, // SEH_Nop
1121
1.21M
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1122
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1123
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    0U, // SEH_SaveRegs_Ret
1127
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    0U, // SEH_SaveSP
1128
1.21M
    0U, // SEH_StackAlloc
1129
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    0U, // SMLALv5
1130
1.21M
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1.21M
    0U, // SPACE
1132
1.21M
    0U, // STOREDUAL
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    29350U, // STRBT_POST
1134
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    0U, // STRBi_preidx
1135
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    0U, // STRBr_preidx
1136
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    0U, // STRH_preidx
1137
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1138
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    0U, // STRi_preidx
1139
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    0U, // STRr_preidx
1140
1.21M
    0U, // SUBS_PC_LR
1141
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    0U, // SUBSrsr
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1.21M
    0U, // SpeculationBarrierISBDSBEndBB
1146
1.21M
    0U, // SpeculationBarrierSBEndBB
1147
1.21M
    0U, // TAILJMPd
1148
1.21M
    0U, // TAILJMPr
1149
1.21M
    0U, // TAILJMPr4
1150
1.21M
    0U, // TCRETURNdi
1151
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    0U, // TCRETURNri
1152
1.21M
    0U, // TPsoft
1153
1.21M
    0U, // UMLALv5
1154
1.21M
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1160
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1171
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1173
1.21M
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1174
1.21M
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1.21M
    567605U,  // VLD2LNqWB_fixed_Asm_16
1176
1.21M
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1.21M
    575797U,  // VLD2LNqWB_register_Asm_16
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1.21M
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1.21M
    0U, // t2STRH_preidx
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1.21M
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1.21M
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1.21M
    0U, // t2STR_preidx
1445
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1.21M
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1.21M
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1449
1.21M
    0U, // t2SpeculationBarrierSBEndBB
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1.21M
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1469
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1472
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1474
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1.21M
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1476
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1.21M
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    0U, // tLDRLIT_ga_abs
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1.21M
    0U, // tLDR_postidx
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1.21M
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1.21M
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1484
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1.21M
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1488
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1.21M
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1.21M
    0U, // G_INTRINSIC_TRUNC
5297
1.21M
    0U, // G_INTRINSIC_ROUND
5298
1.21M
    0U, // G_INTRINSIC_LRINT
5299
1.21M
    0U, // G_INTRINSIC_ROUNDEVEN
5300
1.21M
    0U, // G_READCYCLECOUNTER
5301
1.21M
    0U, // G_LOAD
5302
1.21M
    0U, // G_SEXTLOAD
5303
1.21M
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5304
1.21M
    0U, // G_INDEXED_LOAD
5305
1.21M
    0U, // G_INDEXED_SEXTLOAD
5306
1.21M
    0U, // G_INDEXED_ZEXTLOAD
5307
1.21M
    0U, // G_STORE
5308
1.21M
    0U, // G_INDEXED_STORE
5309
1.21M
    0U, // G_ATOMIC_CMPXCHG_WITH_SUCCESS
5310
1.21M
    0U, // G_ATOMIC_CMPXCHG
5311
1.21M
    0U, // G_ATOMICRMW_XCHG
5312
1.21M
    0U, // G_ATOMICRMW_ADD
5313
1.21M
    0U, // G_ATOMICRMW_SUB
5314
1.21M
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5315
1.21M
    0U, // G_ATOMICRMW_NAND
5316
1.21M
    0U, // G_ATOMICRMW_OR
5317
1.21M
    0U, // G_ATOMICRMW_XOR
5318
1.21M
    0U, // G_ATOMICRMW_MAX
5319
1.21M
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5320
1.21M
    0U, // G_ATOMICRMW_UMAX
5321
1.21M
    0U, // G_ATOMICRMW_UMIN
5322
1.21M
    0U, // G_ATOMICRMW_FADD
5323
1.21M
    0U, // G_ATOMICRMW_FSUB
5324
1.21M
    0U, // G_ATOMICRMW_FMAX
5325
1.21M
    0U, // G_ATOMICRMW_FMIN
5326
1.21M
    0U, // G_ATOMICRMW_UINC_WRAP
5327
1.21M
    0U, // G_ATOMICRMW_UDEC_WRAP
5328
1.21M
    0U, // G_FENCE
5329
1.21M
    0U, // G_PREFETCH
5330
1.21M
    0U, // G_BRCOND
5331
1.21M
    0U, // G_BRINDIRECT
5332
1.21M
    0U, // G_INVOKE_REGION_START
5333
1.21M
    0U, // G_INTRINSIC
5334
1.21M
    0U, // G_INTRINSIC_W_SIDE_EFFECTS
5335
1.21M
    0U, // G_INTRINSIC_CONVERGENT
5336
1.21M
    0U, // G_INTRINSIC_CONVERGENT_W_SIDE_EFFECTS
5337
1.21M
    0U, // G_ANYEXT
5338
1.21M
    0U, // G_TRUNC
5339
1.21M
    0U, // G_CONSTANT
5340
1.21M
    0U, // G_FCONSTANT
5341
1.21M
    0U, // G_VASTART
5342
1.21M
    0U, // G_VAARG
5343
1.21M
    0U, // G_SEXT
5344
1.21M
    0U, // G_SEXT_INREG
5345
1.21M
    0U, // G_ZEXT
5346
1.21M
    0U, // G_SHL
5347
1.21M
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5348
1.21M
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5349
1.21M
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1.21M
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5351
1.21M
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5352
1.21M
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1.21M
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5354
1.21M
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1.21M
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5356
1.21M
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5357
1.21M
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5358
1.21M
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5359
1.21M
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5360
1.21M
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5361
1.21M
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5362
1.21M
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5363
1.21M
    0U, // G_SSUBE
5364
1.21M
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5365
1.21M
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1.21M
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5367
1.21M
    0U, // G_SMULH
5368
1.21M
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5369
1.21M
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1.21M
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1.21M
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1.21M
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5373
1.21M
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1.21M
    0U, // G_SMULFIX
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1.21M
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5377
1.21M
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1.21M
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5381
1.21M
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1.21M
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5383
1.21M
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1.21M
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1.21M
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1.21M
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1.21M
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1.21M
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1.21M
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1.21M
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1.21M
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1.21M
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1.21M
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1.21M
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5400
1.21M
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1.21M
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1.21M
    0U, // G_SITOFP
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1.21M
    0U, // G_FABS
5407
1.21M
    0U, // G_FCOPYSIGN
5408
1.21M
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5409
1.21M
    0U, // G_FCANONICALIZE
5410
1.21M
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1.21M
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5419
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    0U, // G_GET_FPMODE
5420
1.21M
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5421
1.21M
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5422
1.21M
    0U, // G_PTR_ADD
5423
1.21M
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5424
1.21M
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1.21M
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1.21M
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1.21M
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5430
1.21M
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5431
1.21M
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5432
1.21M
    0U, // G_BRJT
5433
1.21M
    0U, // G_INSERT_VECTOR_ELT
5434
1.21M
    0U, // G_EXTRACT_VECTOR_ELT
5435
1.21M
    0U, // G_SHUFFLE_VECTOR
5436
1.21M
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5437
1.21M
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1.21M
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1.21M
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5440
1.21M
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5441
1.21M
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5442
1.21M
    0U, // G_BITREVERSE
5443
1.21M
    0U, // G_FCEIL
5444
1.21M
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1.21M
    0U, // G_FSIN
5446
1.21M
    0U, // G_FSQRT
5447
1.21M
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5448
1.21M
    0U, // G_FRINT
5449
1.21M
    0U, // G_FNEARBYINT
5450
1.21M
    0U, // G_ADDRSPACE_CAST
5451
1.21M
    0U, // G_BLOCK_ADDR
5452
1.21M
    0U, // G_JUMP_TABLE
5453
1.21M
    0U, // G_DYN_STACKALLOC
5454
1.21M
    0U, // G_STACKSAVE
5455
1.21M
    0U, // G_STACKRESTORE
5456
1.21M
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5457
1.21M
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5458
1.21M
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1.21M
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1.21M
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5461
1.21M
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5462
1.21M
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5463
1.21M
    0U, // G_STRICT_FLDEXP
5464
1.21M
    0U, // G_READ_REGISTER
5465
1.21M
    0U, // G_WRITE_REGISTER
5466
1.21M
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5467
1.21M
    0U, // G_MEMCPY_INLINE
5468
1.21M
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5469
1.21M
    0U, // G_MEMSET
5470
1.21M
    0U, // G_BZERO
5471
1.21M
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5472
1.21M
    0U, // G_VECREDUCE_SEQ_FMUL
5473
1.21M
    0U, // G_VECREDUCE_FADD
5474
1.21M
    0U, // G_VECREDUCE_FMUL
5475
1.21M
    0U, // G_VECREDUCE_FMAX
5476
1.21M
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5477
1.21M
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5478
1.21M
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5479
1.21M
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5480
1.21M
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5482
1.21M
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1.21M
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1.21M
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1.21M
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1.21M
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1.21M
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1.21M
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5489
1.21M
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5490
1.21M
    0U, // ABS
5491
1.21M
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5492
1.21M
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5494
1.21M
    0U, // ADDSrsr
5495
1.21M
    0U, // ADJCALLSTACKDOWN
5496
1.21M
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5497
1.21M
    0U, // ASRi
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1.21M
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5499
1.21M
    0U, // B
5500
1.21M
    0U, // BCCZi64
5501
1.21M
    0U, // BCCi64
5502
1.21M
    0U, // BLX_noip
5503
1.21M
    0U, // BLX_pred_noip
5504
1.21M
    0U, // BL_PUSHLR
5505
1.21M
    0U, // BMOVPCB_CALL
5506
1.21M
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5507
1.21M
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1.21M
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5509
1.21M
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5510
1.21M
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5511
1.21M
    0U, // BX_CALL
5512
1.21M
    0U, // CMP_SWAP_16
5513
1.21M
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5514
1.21M
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5515
1.21M
    0U, // CMP_SWAP_8
5516
1.21M
    0U, // CONSTPOOL_ENTRY
5517
1.21M
    0U, // COPY_STRUCT_BYVAL_I32
5518
1.21M
    0U, // ITasm
5519
1.21M
    0U, // Int_eh_sjlj_dispatchsetup
5520
1.21M
    0U, // Int_eh_sjlj_longjmp
5521
1.21M
    0U, // Int_eh_sjlj_setjmp
5522
1.21M
    0U, // Int_eh_sjlj_setjmp_nofp
5523
1.21M
    0U, // Int_eh_sjlj_setup_dispatch
5524
1.21M
    0U, // JUMPTABLE_ADDRS
5525
1.21M
    0U, // JUMPTABLE_INSTS
5526
1.21M
    0U, // JUMPTABLE_TBB
5527
1.21M
    0U, // JUMPTABLE_TBH
5528
1.21M
    0U, // LDMIA_RET
5529
1.21M
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5530
1.21M
    16384U, // LDRConstPool
5531
1.21M
    128U, // LDRHTii
5532
1.21M
    0U, // LDRLIT_ga_abs
5533
1.21M
    0U, // LDRLIT_ga_pcrel
5534
1.21M
    0U, // LDRLIT_ga_pcrel_ldr
5535
1.21M
    128U, // LDRSBTii
5536
1.21M
    128U, // LDRSHTii
5537
1.21M
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5538
1.21M
    0U, // LEApcrel
5539
1.21M
    0U, // LEApcrelJT
5540
1.21M
    0U, // LOADDUAL
5541
1.21M
    0U, // LSLi
5542
1.21M
    0U, // LSLr
5543
1.21M
    0U, // LSRi
5544
1.21M
    0U, // LSRr
5545
1.21M
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5546
1.21M
    0U, // MLAv5
5547
1.21M
    0U, // MOVCCi
5548
1.21M
    0U, // MOVCCi16
5549
1.21M
    0U, // MOVCCi32imm
5550
1.21M
    0U, // MOVCCr
5551
1.21M
    0U, // MOVCCsi
5552
1.21M
    0U, // MOVCCsr
5553
1.21M
    0U, // MOVPCRX
5554
1.21M
    0U, // MOVTi16_ga_pcrel
5555
1.21M
    0U, // MOV_ga_pcrel
5556
1.21M
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5557
1.21M
    0U, // MOVi16_ga_pcrel
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1.21M
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1.21M
    0U, // MOVsra_glue
5560
1.21M
    0U, // MOVsrl_glue
5561
1.21M
    0U, // MQPRCopy
5562
1.21M
    0U, // MQQPRLoad
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1.21M
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1.21M
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1.21M
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1.21M
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1.21M
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1.21M
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1.21M
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1.21M
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1.21M
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5859
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1.21M
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5863
1.21M
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5864
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1.21M
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1.21M
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1.21M
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1.21M
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1.21M
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1.21M
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1.21M
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1.21M
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1.21M
    0U, // t2STR_preidx
5913
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1.21M
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1.21M
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1.21M
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1.21M
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1.21M
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1.21M
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5940
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1.21M
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1.21M
    0U, // tCMP_SWAP_8
5944
1.21M
    0U, // tLDMIA_UPD
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1.21M
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1.21M
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1.21M
    0U, // tLDR_postidx
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1.21M
    0U, // tLDRpci_pic
5950
1.21M
    0U, // tLEApcrel
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1.21M
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    0U, // tLSLSri
5953
1.21M
    0U, // tMOVCCr_pseudo
5954
1.21M
    0U, // tMOVi32imm
5955
1.21M
    0U, // tPOP_RET
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1.21M
    0U, // tRSBS
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1.21M
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1.21M
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1.21M
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1.21M
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5962
1.21M
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1.21M
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5965
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5966
1.21M
    0U, // tTPsoft
5967
1.21M
    1048576U, // ADCri
5968
1.21M
    0U, // ADCrr
5969
1.21M
    1572864U, // ADCrsi
5970
1.21M
    0U, // ADCrsr
5971
1.21M
    1048576U, // ADDri
5972
1.21M
    0U, // ADDrr
5973
1.21M
    1572864U, // ADDrsi
5974
1.21M
    0U, // ADDrsr
5975
1.21M
    1280U,  // ADR
5976
1.21M
    2U, // AESD
5977
1.21M
    2U, // AESE
5978
1.21M
    2U, // AESIMC
5979
1.21M
    2U, // AESMC
5980
1.21M
    1048576U, // ANDri
5981
1.21M
    0U, // ANDrr
5982
1.21M
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5983
1.21M
    0U, // ANDrsr
5984
1.21M
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5985
1.21M
    520U, // BF16VDOTI_VDOTQ
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1.21M
    2U, // BF16VDOTS_VDOTD
5987
1.21M
    2U, // BF16VDOTS_VDOTQ
5988
1.21M
    2U, // BF16_VCVT
5989
1.21M
    2U, // BF16_VCVTB
5990
1.21M
    2U, // BF16_VCVTT
5991
1.21M
    1408U,  // BFC
5992
1.21M
    2098688U, // BFI
5993
1.21M
    1048576U, // BICri
5994
1.21M
    0U, // BICrr
5995
1.21M
    1572864U, // BICrsi
5996
1.21M
    0U, // BICrsr
5997
1.21M
    0U, // BKPT
5998
1.21M
    0U, // BL
5999
1.21M
    0U, // BLX
6000
1.21M
    2U, // BLX_pred
6001
1.21M
    0U, // BLXi
6002
1.21M
    2U, // BL_pred
6003
1.21M
    0U, // BX
6004
1.21M
    2U, // BXJ
6005
1.21M
    0U, // BX_RET
6006
1.21M
    2U, // BX_pred
6007
1.21M
    2U, // Bcc
6008
1.21M
    2U, // CDE_CX1
6009
1.21M
    16778U, // CDE_CX1A
6010
1.21M
    0U, // CDE_CX1D
6011
1.21M
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6012
1.21M
    16768U, // CDE_CX2
6013
1.21M
    524682U,  // CDE_CX2A
6014
1.21M
    526U, // CDE_CX2D
6015
1.21M
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6016
1.21M
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6017
1.21M
    34079114U,  // CDE_CX3A
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1.21M
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1.21M
    70320908U,  // CDE_CX3DA
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1.21M
    2U, // CDE_VCX1A_fpdp
6021
1.21M
    2U, // CDE_VCX1A_fpsp
6022
1.21M
    16778U, // CDE_VCX1A_vec
6023
1.21M
    2U, // CDE_VCX1_fpdp
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1.21M
    2U, // CDE_VCX1_fpsp
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1.21M
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1.21M
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1.21M
    18048U, // CDE_VCX2A_fpsp
6028
1.21M
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1.21M
    16768U, // CDE_VCX2_fpdp
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1.21M
    16768U, // CDE_VCX2_fpsp
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1.21M
    3671562U, // CDE_VCX2_vec
6032
1.21M
    4195968U, // CDE_VCX3A_fpdp
6033
1.21M
    4195968U, // CDE_VCX3A_fpsp
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9578
1.21M
    0U, // t2UQASX
9579
1.21M
    0U, // t2UQSAX
9580
1.21M
    0U, // t2UQSUB16
9581
1.21M
    0U, // t2UQSUB8
9582
1.21M
    0U, // t2USAD8
9583
1.21M
    33554432U,  // t2USADA8
9584
1.21M
    301989888U, // t2USAT
9585
1.21M
    0U, // t2USAT16
9586
1.21M
    0U, // t2USAX
9587
1.21M
    0U, // t2USUB16
9588
1.21M
    0U, // t2USUB8
9589
1.21M
    268435456U, // t2UXTAB
9590
1.21M
    268435456U, // t2UXTAB16
9591
1.21M
    268435456U, // t2UXTAH
9592
1.21M
    229376U,  // t2UXTB
9593
1.21M
    229376U,  // t2UXTB16
9594
1.21M
    229376U,  // t2UXTH
9595
1.21M
    21504U, // t2WLS
9596
1.21M
    2U, // tADC
9597
1.21M
    17920U, // tADDhirr
9598
1.21M
    16768U, // tADDi3
9599
1.21M
    2U, // tADDi8
9600
1.21M
    0U, // tADDrSP
9601
1.21M
    19398656U,  // tADDrSPi
9602
1.21M
    16768U, // tADDrr
9603
1.21M
    8960U,  // tADDspi
9604
1.21M
    17920U, // tADDspr
9605
1.21M
    9088U,  // tADR
9606
1.21M
    2U, // tAND
9607
1.21M
    9216U,  // tASRri
9608
1.21M
    2U, // tASRrr
9609
1.21M
    2U, // tB
9610
1.21M
    2U, // tBIC
9611
1.21M
    0U, // tBKPT
9612
1.21M
    1U, // tBL
9613
1.21M
    2U, // tBLXNSr
9614
1.21M
    1U, // tBLXi
9615
1.21M
    2U, // tBLXr
9616
1.21M
    2U, // tBX
9617
1.21M
    2U, // tBXNS
9618
1.21M
    2U, // tBcc
9619
1.21M
    2U, // tCBNZ
9620
1.21M
    2U, // tCBZ
9621
1.21M
    16384U, // tCMNz
9622
1.21M
    16384U, // tCMPhir
9623
1.21M
    16384U, // tCMPi8
9624
1.21M
    16384U, // tCMPr
9625
1.21M
    2U, // tCPS
9626
1.21M
    2U, // tEOR
9627
1.21M
    2U, // tHINT
9628
1.21M
    0U, // tHLT
9629
1.21M
    0U, // tInt_WIN_eh_sjlj_longjmp
9630
1.21M
    0U, // tInt_eh_sjlj_longjmp
9631
1.21M
    0U, // tInt_eh_sjlj_setjmp
9632
1.21M
    18560U, // tLDMIA
9633
1.21M
    9344U,  // tLDRBi
9634
1.21M
    9472U,  // tLDRBr
9635
1.21M
    9600U,  // tLDRHi
9636
1.21M
    9472U,  // tLDRHr
9637
1.21M
    9472U,  // tLDRSB
9638
1.21M
    9472U,  // tLDRSH
9639
1.21M
    9728U,  // tLDRi
9640
1.21M
    8448U,  // tLDRpci
9641
1.21M
    9472U,  // tLDRr
9642
1.21M
    9856U,  // tLDRspi
9643
1.21M
    16768U, // tLSLri
9644
1.21M
    2U, // tLSLrr
9645
1.21M
    9216U,  // tLSRri
9646
1.21M
    2U, // tLSRrr
9647
1.21M
    2U, // tMOVSr
9648
1.21M
    0U, // tMOVi8
9649
1.21M
    16384U, // tMOVr
9650
1.21M
    16768U, // tMUL
9651
1.21M
    0U, // tMVN
9652
1.21M
    2U, // tORR
9653
1.21M
    0U, // tPICADD
9654
1.21M
    0U, // tPOP
9655
1.21M
    0U, // tPUSH
9656
1.21M
    16384U, // tREV
9657
1.21M
    16384U, // tREV16
9658
1.21M
    16384U, // tREVSH
9659
1.21M
    2U, // tROR
9660
1.21M
    0U, // tRSB
9661
1.21M
    2U, // tSBC
9662
1.21M
    0U, // tSETEND
9663
1.21M
    532U, // tSTMIA_UPD
9664
1.21M
    9344U,  // tSTRBi
9665
1.21M
    9472U,  // tSTRBr
9666
1.21M
    9600U,  // tSTRHi
9667
1.21M
    9472U,  // tSTRHr
9668
1.21M
    9728U,  // tSTRi
9669
1.21M
    9472U,  // tSTRr
9670
1.21M
    9856U,  // tSTRspi
9671
1.21M
    16768U, // tSUBi3
9672
1.21M
    2U, // tSUBi8
9673
1.21M
    16768U, // tSUBrr
9674
1.21M
    8960U,  // tSUBspi
9675
1.21M
    2U, // tSVC
9676
1.21M
    16384U, // tSXTB
9677
1.21M
    16384U, // tSXTH
9678
1.21M
    0U, // tTRAP
9679
1.21M
    16384U, // tTST
9680
1.21M
    0U, // tUDF
9681
1.21M
    16384U, // tUXTB
9682
1.21M
    16384U, // tUXTH
9683
1.21M
    0U, // t__brkdiv0
9684
1.21M
  };
9685
9686
  // Emit the opcode for the instruction.
9687
1.21M
  uint64_t Bits = 0;
9688
1.21M
  Bits |= (uint64_t)OpInfo0[MCInst_getOpcode(MI)] << 0;
9689
1.21M
  Bits |= (uint64_t)OpInfo1[MCInst_getOpcode(MI)] << 32;
9690
1.21M
  MnemonicBitsInfo MBI = {
9691
1.21M
#ifndef CAPSTONE_DIET
9692
1.21M
    AsmStrs+(Bits & 8191)-1,
9693
#else
9694
    NULL,
9695
#endif // CAPSTONE_DIET
9696
1.21M
    Bits
9697
1.21M
  };
9698
1.21M
  return MBI;
9699
1.21M
}
9700
9701
/// printInstruction - This method is automatically generated by tablegen
9702
/// from the instruction set description.
9703
1.21M
static void printInstruction(MCInst *MI, uint64_t Address, SStream *O) {
9704
1.21M
  SStream_concat0(O, "");
9705
1.21M
  MnemonicBitsInfo MnemonicInfo = getMnemonic(MI, O);
9706
9707
1.21M
  SStream_concat0(O, MnemonicInfo.first);
9708
9709
1.21M
  uint64_t Bits = MnemonicInfo.second;
9710
1.21M
  CS_ASSERT_RET(Bits != 0 && "Cannot print this instruction.");
9711
9712
  // Fragment 0 encoded into 6 bits for 43 unique commands.
9713
1.21M
  switch ((Bits >> 13) & 63) {
9714
0
  default: CS_ASSERT_RET(0 && "Invalid command number.");
9715
899
  case 0:
9716
    // DBG_VALUE, DBG_VALUE_LIST, DBG_INSTR_REF, DBG_PHI, DBG_LABEL, BUNDLE, ...
9717
899
    return;
9718
0
    break;
9719
19.2k
  case 1:
9720
    // ASRi, ASRr, LSLi, LSLr, LSRi, LSRr, RORi, RORr, ADCri, ADCrr, ADDri, A...
9721
19.2k
    printSBitModifierOperand(MI, 5, O);
9722
19.2k
    printPredicateOperand(MI, 3, O);
9723
19.2k
    break;
9724
13.2k
  case 2:
9725
    // ITasm, t2IT
9726
13.2k
    printThumbITMask(MI, 1, O);
9727
13.2k
    break;
9728
136k
  case 3:
9729
    // LDRBT_POST, LDRConstPool, LDRHTii, LDRSBTii, LDRSHTii, LDRT_POST, STRB...
9730
136k
    printPredicateOperand(MI, 2, O);
9731
136k
    break;
9732
1.90k
  case 4:
9733
    // RRXi, MOVi, MOVr, MOVr_TC, MVNi, MVNr, t2MOVi, t2MOVr, t2MVNi, t2MVNr,...
9734
1.90k
    printSBitModifierOperand(MI, 4, O);
9735
1.90k
    printPredicateOperand(MI, 2, O);
9736
1.90k
    break;
9737
87.3k
  case 5:
9738
    // VLD1LNdAsm_16, VLD1LNdAsm_32, VLD1LNdAsm_8, VLD1LNdWB_fixed_Asm_16, VL...
9739
87.3k
    printPredicateOperand(MI, 4, O);
9740
87.3k
    break;
9741
48.2k
  case 6:
9742
    // VLD1LNdWB_register_Asm_16, VLD1LNdWB_register_Asm_32, VLD1LNdWB_regist...
9743
48.2k
    printPredicateOperand(MI, 5, O);
9744
48.2k
    break;
9745
282k
  case 7:
9746
    // VLD3DUPdAsm_16, VLD3DUPdAsm_32, VLD3DUPdAsm_8, VLD3DUPdWB_fixed_Asm_16...
9747
282k
    printPredicateOperand(MI, 3, O);
9748
282k
    break;
9749
15.1k
  case 8:
9750
    // ADCrsi, ADDrsi, ANDrsi, BICrsi, EORrsi, MLA, MOVsr, MVNsr, ORRrsi, RSB...
9751
15.1k
    printSBitModifierOperand(MI, 6, O);
9752
15.1k
    printPredicateOperand(MI, 4, O);
9753
15.1k
    break;
9754
4.91k
  case 9:
9755
    // ADCrsr, ADDrsr, ANDrsr, BICrsr, EORrsr, ORRrsr, RSBrsr, RSCrsr, SBCrsr...
9756
4.91k
    printSBitModifierOperand(MI, 7, O);
9757
4.91k
    printPredicateOperand(MI, 5, O);
9758
4.91k
    SStream_concat0(O, "\t");
9759
4.91k
    printOperand(MI, 0, O);
9760
4.91k
    SStream_concat0(O, ", ");
9761
4.91k
    printOperand(MI, 1, O);
9762
4.91k
    SStream_concat0(O, ", ");
9763
4.91k
    printSORegRegOperand(MI, 2, O);
9764
4.91k
    return;
9765
0
    break;
9766
104k
  case 10:
9767
    // AESD, AESE, AESIMC, AESMC, BKPT, BLX, BX, CPS1p, CRC32B, CRC32CB, CRC3...
9768
104k
    printOperand(MI, 0, O);
9769
104k
    break;
9770
1.68k
  case 11:
9771
    // BF16VDOTI_VDOTD, BF16VDOTI_VDOTQ, BF16VDOTS_VDOTD, BF16VDOTS_VDOTQ, MV...
9772
1.68k
    printOperand(MI, 1, O);
9773
1.68k
    SStream_concat0(O, ", ");
9774
1.68k
    break;
9775
1.60k
  case 12:
9776
    // BL, BLXi, t2BFic, t2LE
9777
1.60k
    printOperandAddr(MI, Address, 0, O);
9778
1.60k
    break;
9779
76.8k
  case 13:
9780
    // BLX_pred, BL_pred, BXJ, BX_pred, Bcc, DBG, FLDMXIA, FSTMXIA, HINT, LDM...
9781
76.8k
    printPredicateOperand(MI, 1, O);
9782
76.8k
    break;
9783
16.5k
  case 14:
9784
    // BX_RET, ERET, FMSTAT, MOVPCLR, MVE_LCTP, VSCCLRMD, VSCCLRMS, t2AUTG, t...
9785
16.5k
    printPredicateOperand(MI, 0, O);
9786
16.5k
    break;
9787
532
  case 15:
9788
    // CDE_CX1, CDE_CX1D, CDE_CX2, CDE_CX2D, CDE_CX3, CDE_CX3D, CDE_VCX1A_fpd...
9789
532
    printPImmediate(MI, 1, O);
9790
532
    SStream_concat0(O, ", ");
9791
532
    break;
9792
45.2k
  case 16:
9793
    // CDE_CX3A, CDE_CX3DA, CDP, LDRD_POST, LDRD_PRE, MCR, MRC, MVE_SQRSHRL, ...
9794
45.2k
    printPredicateOperand(MI, 6, O);
9795
45.2k
    break;
9796
17.5k
  case 17:
9797
    // CDE_VCX1A_vec, CDE_VCX2_vec, MVE_VABAVs16, MVE_VABAVs32, MVE_VABAVs8, ...
9798
17.5k
    printVPTPredicateOperand(MI, 4, O);
9799
17.5k
    break;
9800
11.5k
  case 18:
9801
    // CDE_VCX1_vec, MVE_VABDf16, MVE_VABDf32, MVE_VABDs16, MVE_VABDs32, MVE_...
9802
11.5k
    printVPTPredicateOperand(MI, 3, O);
9803
11.5k
    break;
9804
3.00k
  case 19:
9805
    // CDE_VCX2A_vec, CDE_VCX3_vec, MVE_VADC, MVE_VADDLVs32acc, MVE_VADDLVu32...
9806
3.00k
    printVPTPredicateOperand(MI, 5, O);
9807
3.00k
    break;
9808
1.21k
  case 20:
9809
    // CDE_VCX3A_vec, MVE_VMLALDAVas16, MVE_VMLALDAVas32, MVE_VMLALDAVau16, M...
9810
1.21k
    printVPTPredicateOperand(MI, 6, O);
9811
1.21k
    break;
9812
5.69k
  case 21:
9813
    // CDP2, LDC2L_OFFSET, LDC2L_OPTION, LDC2L_POST, LDC2L_PRE, LDC2_OFFSET, ...
9814
5.69k
    printPImmediate(MI, 0, O);
9815
5.69k
    SStream_concat0(O, ", ");
9816
5.69k
    break;
9817
2.12k
  case 22:
9818
    // CPS2p, CPS3p, t2CPS2p, t2CPS3p, tCPS
9819
2.12k
    printCPSIMod(MI, 0, O);
9820
2.12k
    break;
9821
623
  case 23:
9822
    // DMB, DSB
9823
623
    printMemBOption(MI, 0, O);
9824
623
    return;
9825
0
    break;
9826
127
  case 24:
9827
    // ISB
9828
127
    printInstSyncBOption(MI, 0, O);
9829
127
    return;
9830
0
    break;
9831
678
  case 25:
9832
    // MRRC2
9833
678
    printPImmediate(MI, 2, O);
9834
678
    SStream_concat0(O, ", ");
9835
678
    printOperand(MI, 3, O);
9836
678
    SStream_concat0(O, ", ");
9837
678
    printOperand(MI, 0, O);
9838
678
    SStream_concat0(O, ", ");
9839
678
    printOperand(MI, 1, O);
9840
678
    SStream_concat0(O, ", ");
9841
678
    printCImmediate(MI, 4, O);
9842
678
    return;
9843
0
    break;
9844
2.92k
  case 26:
9845
    // MVE_VABSf16, MVE_VABSf32, MVE_VABSs16, MVE_VABSs32, MVE_VABSs8, MVE_VA...
9846
2.92k
    printVPTPredicateOperand(MI, 2, O);
9847
2.92k
    break;
9848
550
  case 27:
9849
    // MVE_VLD20_16, MVE_VLD20_16_wb, MVE_VLD20_32, MVE_VLD20_32_wb, MVE_VLD2...
9850
550
    printMVEVectorList_2(MI, 0, O);
9851
550
    SStream_concat0(O, ", ");
9852
550
    break;
9853
1.76k
  case 28:
9854
    // MVE_VLD40_16, MVE_VLD40_16_wb, MVE_VLD40_32, MVE_VLD40_32_wb, MVE_VLD4...
9855
1.76k
    printMVEVectorList_4(MI, 0, O);
9856
1.76k
    SStream_concat0(O, ", ");
9857
1.76k
    break;
9858
8.63k
  case 29:
9859
    // MVE_VPST, MVE_VPTv16i8, MVE_VPTv16i8r, MVE_VPTv16s8, MVE_VPTv16s8r, MV...
9860
8.63k
    printVPTMask(MI, 0, O);
9861
8.63k
    break;
9862
70
  case 30:
9863
    // MVE_VST20_16_wb, MVE_VST20_32_wb, MVE_VST20_8_wb, MVE_VST21_16_wb, MVE...
9864
70
    printMVEVectorList_2(MI, 1, O);
9865
70
    SStream_concat0(O, ", ");
9866
70
    printAddrMode7Operand(MI, 2, O);
9867
70
    SStream_concat1(O, '!');
9868
70
    return;
9869
0
    break;
9870
399
  case 31:
9871
    // MVE_VST40_16_wb, MVE_VST40_32_wb, MVE_VST40_8_wb, MVE_VST41_16_wb, MVE...
9872
399
    printMVEVectorList_4(MI, 1, O);
9873
399
    SStream_concat0(O, ", ");
9874
399
    printAddrMode7Operand(MI, 2, O);
9875
399
    SStream_concat1(O, '!');
9876
399
    return;
9877
0
    break;
9878
66
  case 32:
9879
    // PLDWi12, PLDi12, PLIi12
9880
66
    printAddrModeImm12Operand_0(MI, 0, O);
9881
66
    return;
9882
0
    break;
9883
248
  case 33:
9884
    // PLDWrs, PLDrs, PLIrs
9885
248
    printAddrMode2Operand(MI, 0, O);
9886
248
    return;
9887
0
    break;
9888
136
  case 34:
9889
    // SETEND, tSETEND
9890
136
    printSetendOperand(MI, 0, O);
9891
136
    return;
9892
0
    break;
9893
440
  case 35:
9894
    // SMLAL, UMLAL
9895
440
    printSBitModifierOperand(MI, 8, O);
9896
440
    printPredicateOperand(MI, 6, O);
9897
440
    SStream_concat0(O, "\t");
9898
440
    printOperand(MI, 0, O);
9899
440
    SStream_concat0(O, ", ");
9900
440
    printOperand(MI, 1, O);
9901
440
    SStream_concat0(O, ", ");
9902
440
    printOperand(MI, 2, O);
9903
440
    SStream_concat0(O, ", ");
9904
440
    printOperand(MI, 3, O);
9905
440
    return;
9906
0
    break;
9907
0
  case 36:
9908
    // TSB
9909
0
    printTraceSyncBOption(MI, 0, O);
9910
0
    return;
9911
0
    break;
9912
9.48k
  case 37:
9913
    // VLD1LNd16_UPD, VLD1LNd32_UPD, VLD1LNd8_UPD, VLD2LNd16, VLD2LNd32, VLD2...
9914
9.48k
    printPredicateOperand(MI, 7, O);
9915
9.48k
    break;
9916
2.60k
  case 38:
9917
    // VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_UPD, VLD2LNq32_U...
9918
2.60k
    printPredicateOperand(MI, 9, O);
9919
2.60k
    break;
9920
2.25k
  case 39:
9921
    // VLD3LNd16_UPD, VLD3LNd32_UPD, VLD3LNd8_UPD, VLD3LNq16_UPD, VLD3LNq32_U...
9922
2.25k
    printPredicateOperand(MI, 11, O);
9923
2.25k
    break;
9924
5.43k
  case 40:
9925
    // VLD4DUPd16_UPD, VLD4DUPd32_UPD, VLD4DUPd8_UPD, VLD4DUPq16_UPD, VLD4DUP...
9926
5.43k
    printPredicateOperand(MI, 8, O);
9927
5.43k
    break;
9928
1.30k
  case 41:
9929
    // VLD4LNd16_UPD, VLD4LNd32_UPD, VLD4LNd8_UPD, VLD4LNq16_UPD, VLD4LNq32_U...
9930
1.30k
    printPredicateOperand(MI, 13, O);
9931
1.30k
    break;
9932
281k
  case 42:
9933
    // tADC, tADDi3, tADDi8, tADDrr, tAND, tASRri, tASRrr, tBIC, tEOR, tLSLri...
9934
281k
    printSBitModifierOperand(MI, 1, O);
9935
281k
    break;
9936
1.21M
  }
9937
9938
9939
  // Fragment 1 encoded into 7 bits for 89 unique commands.
9940
1.20M
  switch ((Bits >> 19) & 127) {
9941
0
  default: CS_ASSERT_RET(0 && "Invalid command number.");
9942
640
  case 0:
9943
    // ASRi, ASRr, ITasm, LDRBT_POST, LDRConstPool, LDRHTii, LDRSBTii, LDRSHT...
9944
640
    SStream_concat1(O, ' ');
9945
640
    break;
9946
13.2k
  case 1:
9947
    // VLD1LNdAsm_16, VLD1LNdWB_fixed_Asm_16, VLD1LNdWB_register_Asm_16, VLD2...
9948
13.2k
    SStream_concat0(O, ".16\t");
9949
13.2k
    ARM_add_vector_size(MI, 16);
9950
13.2k
    break;
9951
14.8k
  case 2:
9952
    // VLD1LNdAsm_32, VLD1LNdWB_fixed_Asm_32, VLD1LNdWB_register_Asm_32, VLD2...
9953
14.8k
    SStream_concat0(O, ".32\t");
9954
14.8k
    ARM_add_vector_size(MI, 32);
9955
14.8k
    break;
9956
12.5k
  case 3:
9957
    // VLD1LNdAsm_8, VLD1LNdWB_fixed_Asm_8, VLD1LNdWB_register_Asm_8, VLD2LNd...
9958
12.5k
    SStream_concat0(O, ".8\t");
9959
12.5k
    ARM_add_vector_size(MI, 8);
9960
12.5k
    break;
9961
0
  case 4:
9962
    // t2LDRB_OFFSET_imm, t2LDRB_POST_imm, t2LDRB_PRE_imm, t2LDRH_OFFSET_imm,...
9963
0
    SStream_concat0(O, ".w ");
9964
0
    printOperand(MI, 0, O);
9965
0
    SStream_concat0(O, ", ");
9966
0
    break;
9967
628k
  case 5:
9968
    // ADCri, ADCrr, ADCrsi, ADDri, ADDrr, ADDrsi, ADR, ANDri, ANDrr, ANDrsi,...
9969
628k
    SStream_concat0(O, "\t");
9970
628k
    break;
9971
99.3k
  case 6:
9972
    // AESD, AESE, AESIMC, AESMC, CRC32B, CRC32CB, CRC32CH, CRC32CW, CRC32H, ...
9973
99.3k
    SStream_concat0(O, ", ");
9974
99.3k
    break;
9975
2.04k
  case 7:
9976
    // BF16VDOTI_VDOTD, BF16VDOTI_VDOTQ, BF16VDOTS_VDOTD, BF16VDOTS_VDOTQ, MR...
9977
2.04k
    printOperand(MI, 2, O);
9978
2.04k
    SStream_concat0(O, ", ");
9979
2.04k
    break;
9980
34
  case 8:
9981
    // BF16_VCVT, BF16_VCVTB, BF16_VCVTT
9982
34
    SStream_concat0(O, ".bf16.f32\t");
9983
34
    printOperand(MI, 0, O);
9984
34
    SStream_concat0(O, ", ");
9985
34
    break;
9986
6.37k
  case 9:
9987
    // BKPT, BL, BLX, BLXi, BX, CPS1p, ERET, HLT, HVC, RFEDA, RFEDB, RFEIA, R...
9988
6.37k
    return;
9989
0
    break;
9990
20
  case 10:
9991
    // BX_RET
9992
20
    SStream_concat0(O, "\tlr");
9993
20
    return;
9994
0
    break;
9995
0
  case 11:
9996
    // CDE_CX1, CDE_CX2, CDE_CX3, CDE_VCX1A_fpdp, CDE_VCX1A_fpsp, CDE_VCX1_fp...
9997
0
    printOperand(MI, 0, O);
9998
0
    SStream_concat0(O, ", ");
9999
0
    break;
10000
0
  case 12:
10001
    // CDE_CX1D, CDE_CX2D, CDE_CX3D
10002
0
    printGPRPairOperand(MI, 0, O);
10003
0
    SStream_concat0(O, ", ");
10004
0
    printOperand(MI, 2, O);
10005
0
    break;
10006
1.96k
  case 13:
10007
    // CDP2, MCR2, MCRR2
10008
1.96k
    printOperand(MI, 1, O);
10009
1.96k
    SStream_concat0(O, ", ");
10010
1.96k
    break;
10011
1.94k
  case 14:
10012
    // FCONSTD, VABSD, VADDD, VCMPD, VCMPED, VCMPEZD, VCMPZD, VDIVD, VFMAD, V...
10013
1.94k
    SStream_concat0(O, ".f64\t");
10014
1.94k
    ARM_add_vector_data(MI, ARM_VECTORDATA_F64);
10015
1.94k
    printOperand(MI, 0, O);
10016
1.94k
    break;
10017
7.02k
  case 15:
10018
    // FCONSTH, MVE_VABDf16, MVE_VABSf16, MVE_VADD_qr_f16, MVE_VADDf16, MVE_V...
10019
7.02k
    SStream_concat0(O, ".f16\t");
10020
7.02k
    ARM_add_vector_data(MI, ARM_VECTORDATA_F16);
10021
7.02k
    break;
10022
6.52k
  case 16:
10023
    // FCONSTS, MVE_VABDf32, MVE_VABSf32, MVE_VADD_qr_f32, MVE_VADDf32, MVE_V...
10024
6.52k
    SStream_concat0(O, ".f32\t");
10025
6.52k
    ARM_add_vector_data(MI, ARM_VECTORDATA_F32);
10026
6.52k
    break;
10027
36
  case 17:
10028
    // FMSTAT
10029
36
    SStream_concat0(O, "\tAPSR_nzcv, fpscr");
10030
36
    return;
10031
0
    break;
10032
3.73k
  case 18:
10033
    // LDC2L_OFFSET, LDC2L_OPTION, LDC2L_POST, LDC2L_PRE, LDC2_OFFSET, LDC2_O...
10034
3.73k
    printCImmediate(MI, 1, O);
10035
3.73k
    SStream_concat0(O, ", ");
10036
3.73k
    break;
10037
19
  case 19:
10038
    // MOVPCLR
10039
19
    SStream_concat0(O, "\tpc, lr");
10040
19
    return;
10041
0
    break;
10042
168
  case 20:
10043
    // MVE_LETP, t2LEUpdate
10044
168
    printOperandAddr(MI, Address, 2, O);
10045
168
    return;
10046
0
    break;
10047
5.00k
  case 21:
10048
    // MVE_VABAVs16, MVE_VABDs16, MVE_VABSs16, MVE_VADDVs16acc, MVE_VADDVs16n...
10049
5.00k
    SStream_concat0(O, ".s16\t");
10050
5.00k
    ARM_add_vector_data(MI, ARM_VECTORDATA_S16);
10051
5.00k
    break;
10052
10.9k
  case 22:
10053
    // MVE_VABAVs32, MVE_VABDs32, MVE_VABSs32, MVE_VADDLVs32acc, MVE_VADDLVs3...
10054
10.9k
    SStream_concat0(O, ".s32\t");
10055
10.9k
    ARM_add_vector_data(MI, ARM_VECTORDATA_S32);
10056
10.9k
    break;
10057
4.21k
  case 23:
10058
    // MVE_VABAVs8, MVE_VABDs8, MVE_VABSs8, MVE_VADDVs8acc, MVE_VADDVs8no_acc...
10059
4.21k
    SStream_concat0(O, ".s8\t");
10060
4.21k
    ARM_add_vector_data(MI, ARM_VECTORDATA_S8);
10061
4.21k
    break;
10062
4.24k
  case 24:
10063
    // MVE_VABAVu16, MVE_VABDu16, MVE_VADDVu16acc, MVE_VADDVu16no_acc, MVE_VC...
10064
4.24k
    SStream_concat0(O, ".u16\t");
10065
4.24k
    ARM_add_vector_data(MI, ARM_VECTORDATA_U16);
10066
4.24k
    break;
10067
6.83k
  case 25:
10068
    // MVE_VABAVu32, MVE_VABDu32, MVE_VADDLVu32acc, MVE_VADDLVu32no_acc, MVE_...
10069
6.83k
    SStream_concat0(O, ".u32\t");
10070
6.83k
    ARM_add_vector_data(MI, ARM_VECTORDATA_U32);
10071
6.83k
    break;
10072
6.89k
  case 26:
10073
    // MVE_VABAVu8, MVE_VABDu8, MVE_VADDVu8acc, MVE_VADDVu8no_acc, MVE_VCMPu8...
10074
6.89k
    SStream_concat0(O, ".u8\t");
10075
6.89k
    ARM_add_vector_data(MI, ARM_VECTORDATA_U8);
10076
6.89k
    break;
10077
7.39k
  case 27:
10078
    // MVE_VADC, MVE_VADCI, MVE_VADD_qr_i32, MVE_VADDi32, MVE_VBICimmi32, MVE...
10079
7.39k
    SStream_concat0(O, ".i32\t");
10080
7.39k
    ARM_add_vector_data(MI, ARM_VECTORDATA_I32);
10081
7.39k
    break;
10082
2.86k
  case 28:
10083
    // MVE_VADD_qr_i16, MVE_VADDi16, MVE_VBICimmi16, MVE_VCADDi16, MVE_VCLZs1...
10084
2.86k
    SStream_concat0(O, ".i16\t");
10085
2.86k
    ARM_add_vector_data(MI, ARM_VECTORDATA_I16);
10086
2.86k
    break;
10087
1.61k
  case 29:
10088
    // MVE_VADD_qr_i8, MVE_VADDi8, MVE_VCADDi8, MVE_VCLZs8, MVE_VCMPi8, MVE_V...
10089
1.61k
    SStream_concat0(O, ".i8\t");
10090
1.61k
    ARM_add_vector_data(MI, ARM_VECTORDATA_I8);
10091
1.61k
    break;
10092
4.45k
  case 30:
10093
    // MVE_VCTP64, MVE_VSTRD64_qi, MVE_VSTRD64_qi_pre, MVE_VSTRD64_rq, MVE_VS...
10094
4.45k
    SStream_concat0(O, ".64\t");
10095
4.45k
    ARM_add_vector_size(MI, 64);
10096
4.45k
    break;
10097
384
  case 31:
10098
    // MVE_VCVTf16f32bh, MVE_VCVTf16f32th, VCVTBSH, VCVTTSH, VCVTf2h
10099
384
    SStream_concat0(O, ".f16.f32\t");
10100
384
    ARM_add_vector_data(MI, ARM_VECTORDATA_F16F32);
10101
384
    printOperand(MI, 0, O);
10102
384
    SStream_concat0(O, ", ");
10103
384
    break;
10104
404
  case 32:
10105
    // MVE_VCVTf16s16_fix, MVE_VCVTf16s16n, VCVTs2hd, VCVTs2hq, VCVTxs2hd, VC...
10106
404
    SStream_concat0(O, ".f16.s16\t");
10107
404
    ARM_add_vector_data(MI, ARM_VECTORDATA_F16S16);
10108
404
    printOperand(MI, 0, O);
10109
404
    SStream_concat0(O, ", ");
10110
404
    printOperand(MI, 1, O);
10111
404
    break;
10112
610
  case 33:
10113
    // MVE_VCVTf16u16_fix, MVE_VCVTf16u16n, VCVTu2hd, VCVTu2hq, VCVTxu2hd, VC...
10114
610
    SStream_concat0(O, ".f16.u16\t");
10115
610
    ARM_add_vector_data(MI, ARM_VECTORDATA_F16U16);
10116
610
    printOperand(MI, 0, O);
10117
610
    SStream_concat0(O, ", ");
10118
610
    printOperand(MI, 1, O);
10119
610
    break;
10120
281
  case 34:
10121
    // MVE_VCVTf32f16bh, MVE_VCVTf32f16th, VCVTBHS, VCVTTHS, VCVTh2f
10122
281
    SStream_concat0(O, ".f32.f16\t");
10123
281
    ARM_add_vector_data(MI, ARM_VECTORDATA_F32F16);
10124
281
    printOperand(MI, 0, O);
10125
281
    SStream_concat0(O, ", ");
10126
281
    printOperand(MI, 1, O);
10127
281
    return;
10128
0
    break;
10129
466
  case 35:
10130
    // MVE_VCVTf32s32_fix, MVE_VCVTf32s32n, VCVTs2fd, VCVTs2fq, VCVTxs2fd, VC...
10131
466
    SStream_concat0(O, ".f32.s32\t");
10132
466
    ARM_add_vector_data(MI, ARM_VECTORDATA_F32S32);
10133
466
    printOperand(MI, 0, O);
10134
466
    SStream_concat0(O, ", ");
10135
466
    printOperand(MI, 1, O);
10136
466
    break;
10137
203
  case 36:
10138
    // MVE_VCVTf32u32_fix, MVE_VCVTf32u32n, VCVTu2fd, VCVTu2fq, VCVTxu2fd, VC...
10139
203
    SStream_concat0(O, ".f32.u32\t");
10140
203
    ARM_add_vector_data(MI, ARM_VECTORDATA_F32U32);
10141
203
    printOperand(MI, 0, O);
10142
203
    SStream_concat0(O, ", ");
10143
203
    printOperand(MI, 1, O);
10144
203
    break;
10145
759
  case 37:
10146
    // MVE_VCVTs16f16_fix, MVE_VCVTs16f16a, MVE_VCVTs16f16m, MVE_VCVTs16f16n,...
10147
759
    SStream_concat0(O, ".s16.f16\t");
10148
759
    ARM_add_vector_data(MI, ARM_VECTORDATA_S16F16);
10149
759
    printOperand(MI, 0, O);
10150
759
    SStream_concat0(O, ", ");
10151
759
    printOperand(MI, 1, O);
10152
759
    break;
10153
1.04k
  case 38:
10154
    // MVE_VCVTs32f32_fix, MVE_VCVTs32f32a, MVE_VCVTs32f32m, MVE_VCVTs32f32n,...
10155
1.04k
    SStream_concat0(O, ".s32.f32\t");
10156
1.04k
    ARM_add_vector_data(MI, ARM_VECTORDATA_S32F32);
10157
1.04k
    printOperand(MI, 0, O);
10158
1.04k
    SStream_concat0(O, ", ");
10159
1.04k
    printOperand(MI, 1, O);
10160
1.04k
    break;
10161
335
  case 39:
10162
    // MVE_VCVTu16f16_fix, MVE_VCVTu16f16a, MVE_VCVTu16f16m, MVE_VCVTu16f16n,...
10163
335
    SStream_concat0(O, ".u16.f16\t");
10164
335
    ARM_add_vector_data(MI, ARM_VECTORDATA_U16F16);
10165
335
    printOperand(MI, 0, O);
10166
335
    SStream_concat0(O, ", ");
10167
335
    printOperand(MI, 1, O);
10168
335
    break;
10169
134
  case 40:
10170
    // MVE_VCVTu32f32_fix, MVE_VCVTu32f32a, MVE_VCVTu32f32m, MVE_VCVTu32f32n,...
10171
134
    SStream_concat0(O, ".u32.f32\t");
10172
134
    ARM_add_vector_data(MI, ARM_VECTORDATA_U32F32);
10173
134
    printOperand(MI, 0, O);
10174
134
    SStream_concat0(O, ", ");
10175
134
    printOperand(MI, 1, O);
10176
134
    break;
10177
1.23k
  case 41:
10178
    // MVE_VLD20_16, MVE_VLD20_32, MVE_VLD20_8, MVE_VLD21_16, MVE_VLD21_32, M...
10179
1.23k
    printAddrMode7Operand(MI, 2, O);
10180
1.23k
    return;
10181
0
    break;
10182
208
  case 42:
10183
    // MVE_VLD20_16_wb, MVE_VLD20_32_wb, MVE_VLD20_8_wb, MVE_VLD21_16_wb, MVE...
10184
208
    printAddrMode7Operand(MI, 3, O);
10185
208
    SStream_concat1(O, '!');
10186
208
    return;
10187
0
    break;
10188
1.49k
  case 43:
10189
    // MVE_VLDRDU64_qi, MVE_VLDRDU64_qi_pre, MVE_VLDRDU64_rq, MVE_VLDRDU64_rq...
10190
1.49k
    SStream_concat0(O, ".u64\t");
10191
1.49k
    ARM_add_vector_data(MI, ARM_VECTORDATA_U64);
10192
1.49k
    break;
10193
633
  case 44:
10194
    // MVE_VMOVimmi64, VADDHNv2i32, VADDv1i64, VADDv2i64, VMOVNv2i32, VMOVv1i...
10195
633
    SStream_concat0(O, ".i64\t");
10196
633
    ARM_add_vector_data(MI, ARM_VECTORDATA_I64);
10197
633
    printOperand(MI, 0, O);
10198
633
    SStream_concat0(O, ", ");
10199
633
    break;
10200
258
  case 45:
10201
    // MVE_VMULLBp16, MVE_VMULLTp16
10202
258
    SStream_concat0(O, ".p16\t");
10203
258
    ARM_add_vector_data(MI, ARM_VECTORDATA_P16);
10204
258
    printOperand(MI, 0, O);
10205
258
    SStream_concat0(O, ", ");
10206
258
    printOperand(MI, 1, O);
10207
258
    SStream_concat0(O, ", ");
10208
258
    printOperand(MI, 2, O);
10209
258
    return;
10210
0
    break;
10211
96
  case 46:
10212
    // MVE_VMULLBp8, MVE_VMULLTp8, VMULLp8, VMULpd, VMULpq
10213
96
    SStream_concat0(O, ".p8\t");
10214
96
    ARM_add_vector_data(MI, ARM_VECTORDATA_P8);
10215
96
    printOperand(MI, 0, O);
10216
96
    SStream_concat0(O, ", ");
10217
96
    printOperand(MI, 1, O);
10218
96
    SStream_concat0(O, ", ");
10219
96
    printOperand(MI, 2, O);
10220
96
    return;
10221
0
    break;
10222
878
  case 47:
10223
    // MVE_VST20_16, MVE_VST20_32, MVE_VST20_8, MVE_VST21_16, MVE_VST21_32, M...
10224
878
    printAddrMode7Operand(MI, 1, O);
10225
878
    return;
10226
0
    break;
10227
696
  case 48:
10228
    // RFEDA_UPD, RFEDB_UPD, RFEIA_UPD, RFEIB_UPD
10229
696
    SStream_concat1(O, '!');
10230
696
    return;
10231
0
    break;
10232
323
  case 49:
10233
    // VCVTBDH, VCVTTDH
10234
323
    SStream_concat0(O, ".f16.f64\t");
10235
323
    ARM_add_vector_data(MI, ARM_VECTORDATA_F16F64);
10236
323
    printOperand(MI, 0, O);
10237
323
    SStream_concat0(O, ", ");
10238
323
    printOperand(MI, 2, O);
10239
323
    return;
10240
0
    break;
10241
99
  case 50:
10242
    // VCVTBHD, VCVTTHD
10243
99
    SStream_concat0(O, ".f64.f16\t");
10244
99
    ARM_add_vector_data(MI, ARM_VECTORDATA_F64F16);
10245
99
    printOperand(MI, 0, O);
10246
99
    SStream_concat0(O, ", ");
10247
99
    printOperand(MI, 1, O);
10248
99
    return;
10249
0
    break;
10250
481
  case 51:
10251
    // VCVTDS
10252
481
    SStream_concat0(O, ".f64.f32\t");
10253
481
    ARM_add_vector_data(MI, ARM_VECTORDATA_F64F32);
10254
481
    printOperand(MI, 0, O);
10255
481
    SStream_concat0(O, ", ");
10256
481
    printOperand(MI, 1, O);
10257
481
    return;
10258
0
    break;
10259
18
  case 52:
10260
    // VCVTSD
10261
18
    SStream_concat0(O, ".f32.f64\t");
10262
18
    ARM_add_vector_data(MI, ARM_VECTORDATA_F32F64);
10263
18
    printOperand(MI, 0, O);
10264
18
    SStream_concat0(O, ", ");
10265
18
    printOperand(MI, 1, O);
10266
18
    return;
10267
0
    break;
10268
106
  case 53:
10269
    // VJCVT, VTOSIRD, VTOSIZD, VTOSLD
10270
106
    SStream_concat0(O, ".s32.f64\t");
10271
106
    ARM_add_vector_data(MI, ARM_VECTORDATA_S32F64);
10272
106
    printOperand(MI, 0, O);
10273
106
    SStream_concat0(O, ", ");
10274
106
    printOperand(MI, 1, O);
10275
106
    break;
10276
9.26k
  case 54:
10277
    // VLD1LNd16, VLD1LNd16_UPD, VLD2LNd16, VLD2LNd16_UPD, VLD2LNq16, VLD2LNq...
10278
9.26k
    SStream_concat0(O, ".16\t{");
10279
9.26k
    ARM_add_vector_size(MI, 16);
10280
9.26k
    break;
10281
9.85k
  case 55:
10282
    // VLD1LNd32, VLD1LNd32_UPD, VLD2LNd32, VLD2LNd32_UPD, VLD2LNq32, VLD2LNq...
10283
9.85k
    SStream_concat0(O, ".32\t{");
10284
9.85k
    ARM_add_vector_size(MI, 32);
10285
9.85k
    break;
10286
10.7k
  case 56:
10287
    // VLD1LNd8, VLD1LNd8_UPD, VLD2LNd8, VLD2LNd8_UPD, VLD3DUPd8, VLD3DUPd8_U...
10288
10.7k
    SStream_concat0(O, ".8\t{");
10289
10.7k
    ARM_add_vector_size(MI, 8);
10290
10.7k
    break;
10291
1.14k
  case 57:
10292
    // VLDR_FPCXTNS_off, VLDR_FPCXTNS_post, VLDR_FPCXTNS_pre, VMSR_FPCXTNS, V...
10293
1.14k
    SStream_concat0(O, "\tfpcxtns, ");
10294
1.14k
    break;
10295
996
  case 58:
10296
    // VLDR_FPCXTS_off, VLDR_FPCXTS_post, VLDR_FPCXTS_pre, VMSR_FPCXTS, VSTR_...
10297
996
    SStream_concat0(O, "\tfpcxts, ");
10298
996
    break;
10299
1.18k
  case 59:
10300
    // VLDR_FPSCR_NZCVQC_off, VLDR_FPSCR_NZCVQC_post, VLDR_FPSCR_NZCVQC_pre, ...
10301
1.18k
    SStream_concat0(O, "\tfpscr_nzcvqc, ");
10302
1.18k
    break;
10303
2.18k
  case 60:
10304
    // VLDR_FPSCR_off, VLDR_FPSCR_post, VLDR_FPSCR_pre, VMSR, VSTR_FPSCR_off,...
10305
2.18k
    SStream_concat0(O, "\tfpscr, ");
10306
2.18k
    break;
10307
0
  case 61:
10308
    // VLDR_P0_off, VLDR_P0_post, VLDR_P0_pre, VMSR_P0, VSTR_P0_off, VSTR_P0_...
10309
0
    SStream_concat0(O, "\tp0, ");
10310
0
    break;
10311
0
  case 62:
10312
    // VLDR_VPR_off, VLDR_VPR_post, VLDR_VPR_pre, VMSR_VPR, VSTR_VPR_off, VST...
10313
0
    SStream_concat0(O, "\tvpr, ");
10314
0
    break;
10315
18
  case 63:
10316
    // VMSR_FPEXC
10317
18
    SStream_concat0(O, "\tfpexc, ");
10318
18
    printOperand(MI, 0, O);
10319
18
    return;
10320
0
    break;
10321
170
  case 64:
10322
    // VMSR_FPINST
10323
170
    SStream_concat0(O, "\tfpinst, ");
10324
170
    printOperand(MI, 0, O);
10325
170
    return;
10326
0
    break;
10327
100
  case 65:
10328
    // VMSR_FPINST2
10329
100
    SStream_concat0(O, "\tfpinst2, ");
10330
100
    printOperand(MI, 0, O);
10331
100
    return;
10332
0
    break;
10333
36
  case 66:
10334
    // VMSR_FPSID
10335
36
    SStream_concat0(O, "\tfpsid, ");
10336
36
    printOperand(MI, 0, O);
10337
36
    return;
10338
0
    break;
10339
1.01k
  case 67:
10340
    // VQADDsv1i64, VQADDsv2i64, VQMOVNsuv2i32, VQMOVNsv2i32, VQRSHLsv1i64, V...
10341
1.01k
    SStream_concat0(O, ".s64\t");
10342
1.01k
    ARM_add_vector_data(MI, ARM_VECTORDATA_S64);
10343
1.01k
    printOperand(MI, 0, O);
10344
1.01k
    SStream_concat0(O, ", ");
10345
1.01k
    break;
10346
84
  case 68:
10347
    // VSHTOD
10348
84
    SStream_concat0(O, ".f64.s16\t");
10349
84
    ARM_add_vector_data(MI, ARM_VECTORDATA_F64S16);
10350
84
    printOperand(MI, 0, O);
10351
84
    SStream_concat0(O, ", ");
10352
84
    printOperand(MI, 1, O);
10353
84
    SStream_concat0(O, ", ");
10354
84
    printFBits16(MI, 2, O);
10355
84
    return;
10356
0
    break;
10357
397
  case 69:
10358
    // VSHTOS
10359
397
    SStream_concat0(O, ".f32.s16\t");
10360
397
    ARM_add_vector_data(MI, ARM_VECTORDATA_F32S16);
10361
397
    printOperand(MI, 0, O);
10362
397
    SStream_concat0(O, ", ");
10363
397
    printOperand(MI, 1, O);
10364
397
    SStream_concat0(O, ", ");
10365
397
    printFBits16(MI, 2, O);
10366
397
    return;
10367
0
    break;
10368
86
  case 70:
10369
    // VSITOD, VSLTOD
10370
86
    SStream_concat0(O, ".f64.s32\t");
10371
86
    ARM_add_vector_data(MI, ARM_VECTORDATA_F64S32);
10372
86
    printOperand(MI, 0, O);
10373
86
    SStream_concat0(O, ", ");
10374
86
    printOperand(MI, 1, O);
10375
86
    break;
10376
72
  case 71:
10377
    // VSITOH, VSLTOH
10378
72
    SStream_concat0(O, ".f16.s32\t");
10379
72
    ARM_add_vector_data(MI, ARM_VECTORDATA_F16S32);
10380
72
    printOperand(MI, 0, O);
10381
72
    SStream_concat0(O, ", ");
10382
72
    printOperand(MI, 1, O);
10383
72
    break;
10384
132
  case 72:
10385
    // VTOSHD
10386
132
    SStream_concat0(O, ".s16.f64\t");
10387
132
    ARM_add_vector_data(MI, ARM_VECTORDATA_S16F64);
10388
132
    printOperand(MI, 0, O);
10389
132
    SStream_concat0(O, ", ");
10390
132
    printOperand(MI, 1, O);
10391
132
    SStream_concat0(O, ", ");
10392
132
    printFBits16(MI, 2, O);
10393
132
    return;
10394
0
    break;
10395
73
  case 73:
10396
    // VTOSHS
10397
73
    SStream_concat0(O, ".s16.f32\t");
10398
73
    ARM_add_vector_data(MI, ARM_VECTORDATA_S16F32);
10399
73
    printOperand(MI, 0, O);
10400
73
    SStream_concat0(O, ", ");
10401
73
    printOperand(MI, 1, O);
10402
73
    SStream_concat0(O, ", ");
10403
73
    printFBits16(MI, 2, O);
10404
73
    return;
10405
0
    break;
10406
109
  case 74:
10407
    // VTOSIRH, VTOSIZH, VTOSLH
10408
109
    SStream_concat0(O, ".s32.f16\t");
10409
109
    ARM_add_vector_data(MI, ARM_VECTORDATA_S32F16);
10410
109
    printOperand(MI, 0, O);
10411
109
    SStream_concat0(O, ", ");
10412
109
    printOperand(MI, 1, O);
10413
109
    break;
10414
139
  case 75:
10415
    // VTOUHD
10416
139
    SStream_concat0(O, ".u16.f64\t");
10417
139
    ARM_add_vector_data(MI, ARM_VECTORDATA_U16F64);
10418
139
    printOperand(MI, 0, O);
10419
139
    SStream_concat0(O, ", ");
10420
139
    printOperand(MI, 1, O);
10421
139
    SStream_concat0(O, ", ");
10422
139
    printFBits16(MI, 2, O);
10423
139
    return;
10424
0
    break;
10425
208
  case 76:
10426
    // VTOUHS
10427
208
    SStream_concat0(O, ".u16.f32\t");
10428
208
    ARM_add_vector_data(MI, ARM_VECTORDATA_U16F32);
10429
208
    printOperand(MI, 0, O);
10430
208
    SStream_concat0(O, ", ");
10431
208
    printOperand(MI, 1, O);
10432
208
    SStream_concat0(O, ", ");
10433
208
    printFBits16(MI, 2, O);
10434
208
    return;
10435
0
    break;
10436
46
  case 77:
10437
    // VTOUIRD, VTOUIZD, VTOULD
10438
46
    SStream_concat0(O, ".u32.f64\t");
10439
46
    ARM_add_vector_data(MI, ARM_VECTORDATA_U32F64);
10440
46
    printOperand(MI, 0, O);
10441
46
    SStream_concat0(O, ", ");
10442
46
    printOperand(MI, 1, O);
10443
46
    break;
10444
147
  case 78:
10445
    // VTOUIRH, VTOUIZH, VTOULH
10446
147
    SStream_concat0(O, ".u32.f16\t");
10447
147
    ARM_add_vector_data(MI, ARM_VECTORDATA_U32F16);
10448
147
    printOperand(MI, 0, O);
10449
147
    SStream_concat0(O, ", ");
10450
147
    printOperand(MI, 1, O);
10451
147
    break;
10452
220
  case 79:
10453
    // VUHTOD
10454
220
    SStream_concat0(O, ".f64.u16\t");
10455
220
    ARM_add_vector_data(MI, ARM_VECTORDATA_F64U16);
10456
220
    printOperand(MI, 0, O);
10457
220
    SStream_concat0(O, ", ");
10458
220
    printOperand(MI, 1, O);
10459
220
    SStream_concat0(O, ", ");
10460
220
    printFBits16(MI, 2, O);
10461
220
    return;
10462
0
    break;
10463
511
  case 80:
10464
    // VUHTOS
10465
511
    SStream_concat0(O, ".f32.u16\t");
10466
511
    ARM_add_vector_data(MI, ARM_VECTORDATA_F32U16);
10467
511
    printOperand(MI, 0, O);
10468
511
    SStream_concat0(O, ", ");
10469
511
    printOperand(MI, 1, O);
10470
511
    SStream_concat0(O, ", ");
10471
511
    printFBits16(MI, 2, O);
10472
511
    return;
10473
0
    break;
10474
35
  case 81:
10475
    // VUITOD, VULTOD
10476
35
    SStream_concat0(O, ".f64.u32\t");
10477
35
    ARM_add_vector_data(MI, ARM_VECTORDATA_F64U32);
10478
35
    printOperand(MI, 0, O);
10479
35
    SStream_concat0(O, ", ");
10480
35
    printOperand(MI, 1, O);
10481
35
    break;
10482
73
  case 82:
10483
    // VUITOH, VULTOH
10484
73
    SStream_concat0(O, ".f16.u32\t");
10485
73
    ARM_add_vector_data(MI, ARM_VECTORDATA_F16U32);
10486
73
    printOperand(MI, 0, O);
10487
73
    SStream_concat0(O, ", ");
10488
73
    printOperand(MI, 1, O);
10489
73
    break;
10490
23.6k
  case 83:
10491
    // t2ADCrr, t2ADCrs, t2ADDri, t2ADDrr, t2ADDrs, t2ADDspImm, t2ADR, t2ANDr...
10492
23.6k
    SStream_concat0(O, ".w\t");
10493
23.6k
    break;
10494
130
  case 84:
10495
    // t2SRSDB, t2SRSIA
10496
130
    SStream_concat0(O, "\tsp, ");
10497
130
    printOperand(MI, 0, O);
10498
130
    return;
10499
0
    break;
10500
174
  case 85:
10501
    // t2SRSDB_UPD, t2SRSIA_UPD
10502
174
    SStream_concat0(O, "\tsp!, ");
10503
174
    printOperand(MI, 0, O);
10504
174
    return;
10505
0
    break;
10506
79
  case 86:
10507
    // t2SUBS_PC_LR
10508
79
    SStream_concat0(O, "\tpc, lr, ");
10509
79
    printOperand(MI, 0, O);
10510
79
    return;
10511
0
    break;
10512
246k
  case 87:
10513
    // tADC, tADDi3, tADDi8, tADDrr, tAND, tASRri, tASRrr, tBIC, tEOR, tLSLri...
10514
246k
    printPredicateOperand(MI, 4, O);
10515
246k
    SStream_concat0(O, "\t");
10516
246k
    printOperand(MI, 0, O);
10517
246k
    SStream_concat0(O, ", ");
10518
246k
    break;
10519
34.8k
  case 88:
10520
    // tMOVi8, tMVN, tRSB
10521
34.8k
    printPredicateOperand(MI, 3, O);
10522
34.8k
    SStream_concat0(O, "\t");
10523
34.8k
    printOperand(MI, 0, O);
10524
34.8k
    SStream_concat0(O, ", ");
10525
34.8k
    printOperand(MI, 2, O);
10526
34.8k
    break;
10527
1.20M
  }
10528
10529
10530
  // Fragment 2 encoded into 7 bits for 71 unique commands.
10531
1.19M
  switch ((Bits >> 26) & 127) {
10532
0
  default: CS_ASSERT_RET(0 && "Invalid command number.");
10533
526k
  case 0:
10534
    // ASRi, ASRr, LDRBT_POST, LDRConstPool, LDRHTii, LDRSBTii, LDRSHTii, LDR...
10535
526k
    printOperand(MI, 0, O);
10536
526k
    break;
10537
13.2k
  case 1:
10538
    // ITasm, t2IT
10539
13.2k
    printMandatoryPredicateOperand(MI, 0, O);
10540
13.2k
    return;
10541
0
    break;
10542
0
  case 2:
10543
    // VLD3DUPdAsm_16, VLD3DUPdAsm_32, VLD3DUPdAsm_8, VLD3DUPdWB_fixed_Asm_16...
10544
0
    printVectorListThreeAllLanes(MI, 0, O);
10545
0
    SStream_concat0(O, ", ");
10546
0
    printAddrMode6Operand(MI, 1, O);
10547
0
    break;
10548
0
  case 3:
10549
    // VLD3DUPqAsm_16, VLD3DUPqAsm_32, VLD3DUPqAsm_8, VLD3DUPqWB_fixed_Asm_16...
10550
0
    printVectorListThreeSpacedAllLanes(MI, 0, O);
10551
0
    SStream_concat0(O, ", ");
10552
0
    printAddrMode6Operand(MI, 1, O);
10553
0
    break;
10554
1.63k
  case 4:
10555
    // VLD3dAsm_16, VLD3dAsm_32, VLD3dAsm_8, VLD3dWB_fixed_Asm_16, VLD3dWB_fi...
10556
1.63k
    printVectorListThree(MI, 0, O);
10557
1.63k
    SStream_concat0(O, ", ");
10558
1.63k
    break;
10559
0
  case 5:
10560
    // VLD3qAsm_16, VLD3qAsm_32, VLD3qAsm_8, VLD3qWB_fixed_Asm_16, VLD3qWB_fi...
10561
0
    printVectorListThreeSpaced(MI, 0, O);
10562
0
    SStream_concat0(O, ", ");
10563
0
    printAddrMode6Operand(MI, 1, O);
10564
0
    break;
10565
0
  case 6:
10566
    // VLD4DUPdAsm_16, VLD4DUPdAsm_32, VLD4DUPdAsm_8, VLD4DUPdWB_fixed_Asm_16...
10567
0
    printVectorListFourAllLanes(MI, 0, O);
10568
0
    SStream_concat0(O, ", ");
10569
0
    printAddrMode6Operand(MI, 1, O);
10570
0
    break;
10571
0
  case 7:
10572
    // VLD4DUPqAsm_16, VLD4DUPqAsm_32, VLD4DUPqAsm_8, VLD4DUPqWB_fixed_Asm_16...
10573
0
    printVectorListFourSpacedAllLanes(MI, 0, O);
10574
0
    SStream_concat0(O, ", ");
10575
0
    printAddrMode6Operand(MI, 1, O);
10576
0
    break;
10577
3.03k
  case 8:
10578
    // VLD4dAsm_16, VLD4dAsm_32, VLD4dAsm_8, VLD4dWB_fixed_Asm_16, VLD4dWB_fi...
10579
3.03k
    printVectorListFour(MI, 0, O);
10580
3.03k
    SStream_concat0(O, ", ");
10581
3.03k
    break;
10582
0
  case 9:
10583
    // VLD4qAsm_16, VLD4qAsm_32, VLD4qAsm_8, VLD4qWB_fixed_Asm_16, VLD4qWB_fi...
10584
0
    printVectorListFourSpaced(MI, 0, O);
10585
0
    SStream_concat0(O, ", ");
10586
0
    printAddrMode6Operand(MI, 1, O);
10587
0
    break;
10588
0
  case 10:
10589
    // t2LDRB_OFFSET_imm, t2LDRH_OFFSET_imm, t2LDRSB_OFFSET_imm, t2LDRSH_OFFS...
10590
0
    printT2AddrModeImm8Operand_0(MI, 1, O);
10591
0
    return;
10592
0
    break;
10593
1.43k
  case 11:
10594
    // t2LDRB_POST_imm, t2LDRH_POST_imm, t2LDRSB_POST_imm, t2LDRSH_POST_imm, ...
10595
1.43k
    printAddrMode7Operand(MI, 1, O);
10596
1.43k
    break;
10597
0
  case 12:
10598
    // t2LDRB_PRE_imm, t2LDRH_PRE_imm, t2LDRSB_PRE_imm, t2LDRSH_PRE_imm, t2LD...
10599
0
    printT2AddrModeImm8Operand_1(MI, 1, O);
10600
0
    SStream_concat1(O, '!');
10601
0
    return;
10602
0
    break;
10603
178k
  case 13:
10604
    // AESD, AESE, BF16_VCVTB, BF16_VCVTT, CDE_CX1, CDE_CX2, CDE_CX3, CDE_VCX...
10605
178k
    printOperand(MI, 2, O);
10606
178k
    break;
10607
137k
  case 14:
10608
    // AESIMC, AESMC, BF16_VCVT, CRC32B, CRC32CB, CRC32CH, CRC32CW, CRC32H, C...
10609
137k
    printOperand(MI, 1, O);
10610
137k
    break;
10611
80.5k
  case 15:
10612
    // BF16VDOTI_VDOTD, BF16VDOTI_VDOTQ, BF16VDOTS_VDOTD, BF16VDOTS_VDOTQ, CD...
10613
80.5k
    printOperand(MI, 3, O);
10614
80.5k
    break;
10615
47.2k
  case 16:
10616
    // BL_pred, Bcc, t2B, t2BFLi, t2BFLr, t2BFi, t2BFr, t2Bcc, tB, tBcc
10617
47.2k
    printOperandAddr(MI, Address, 0, O);
10618
47.2k
    break;
10619
5.65k
  case 17:
10620
    // CDE_CX1A, CDE_CX1DA, CDE_CX2A, CDE_CX2DA, CDE_CX3A, CDE_CX3DA, CDE_VCX...
10621
5.65k
    printPImmediate(MI, 1, O);
10622
5.65k
    SStream_concat0(O, ", ");
10623
5.65k
    break;
10624
35.9k
  case 18:
10625
    // CDE_CX1D, MVE_LCTP, MVE_VCVTf16s16n, MVE_VCVTf16u16n, MVE_VCVTf32s32n,...
10626
35.9k
    return;
10627
0
    break;
10628
6.02k
  case 19:
10629
    // CDE_CX2D, CDE_CX3D, FCONSTD, MVE_VCVTf16s16_fix, MVE_VCVTf16u16_fix, M...
10630
6.02k
    SStream_concat0(O, ", ");
10631
6.02k
    break;
10632
61.4k
  case 20:
10633
    // CDP, LDCL_OFFSET, LDCL_OPTION, LDCL_POST, LDCL_PRE, LDC_OFFSET, LDC_OP...
10634
61.4k
    printPImmediate(MI, 0, O);
10635
61.4k
    SStream_concat0(O, ", ");
10636
61.4k
    break;
10637
1.18k
  case 21:
10638
    // CDP2
10639
1.18k
    printCImmediate(MI, 2, O);
10640
1.18k
    SStream_concat0(O, ", ");
10641
1.18k
    printCImmediate(MI, 3, O);
10642
1.18k
    SStream_concat0(O, ", ");
10643
1.18k
    printCImmediate(MI, 4, O);
10644
1.18k
    SStream_concat0(O, ", ");
10645
1.18k
    printOperand(MI, 5, O);
10646
1.18k
    return;
10647
0
    break;
10648
2.12k
  case 22:
10649
    // CPS2p, CPS3p, t2CPS2p, t2CPS3p, tCPS
10650
2.12k
    printCPSIFlag(MI, 1, O);
10651
2.12k
    break;
10652
285
  case 23:
10653
    // LDAEXD, LDREXD
10654
285
    printGPRPairOperand(MI, 0, O);
10655
285
    SStream_concat0(O, ", ");
10656
285
    printAddrMode7Operand(MI, 1, O);
10657
285
    return;
10658
0
    break;
10659
747
  case 24:
10660
    // LDC2L_OFFSET, LDC2_OFFSET, STC2L_OFFSET, STC2_OFFSET
10661
747
    printAddrMode5Operand_0(MI, 2, O);
10662
747
    return;
10663
0
    break;
10664
1.84k
  case 25:
10665
    // LDC2L_OPTION, LDC2L_POST, LDC2_OPTION, LDC2_POST, STC2L_OPTION, STC2L_...
10666
1.84k
    printAddrMode7Operand(MI, 2, O);
10667
1.84k
    break;
10668
1.13k
  case 26:
10669
    // LDC2L_PRE, LDC2_PRE, STC2L_PRE, STC2_PRE
10670
1.13k
    printAddrMode5Operand_1(MI, 2, O);
10671
1.13k
    SStream_concat1(O, '!');
10672
1.13k
    return;
10673
0
    break;
10674
952
  case 27:
10675
    // MRRC, t2MRRC, t2MRRC2
10676
952
    printPImmediate(MI, 2, O);
10677
952
    SStream_concat0(O, ", ");
10678
952
    printOperand(MI, 3, O);
10679
952
    SStream_concat0(O, ", ");
10680
952
    printOperand(MI, 0, O);
10681
952
    SStream_concat0(O, ", ");
10682
952
    printOperand(MI, 1, O);
10683
952
    SStream_concat0(O, ", ");
10684
952
    printCImmediate(MI, 4, O);
10685
952
    return;
10686
0
    break;
10687
7.77k
  case 28:
10688
    // MSR, MSRi, t2MSR_AR, t2MSR_M
10689
7.77k
    printMSRMaskOperand(MI, 0, O);
10690
7.77k
    SStream_concat0(O, ", ");
10691
7.77k
    break;
10692
323
  case 29:
10693
    // MSRbanked, t2MSRbanked
10694
323
    printBankedRegOperand(MI, 0, O);
10695
323
    SStream_concat0(O, ", ");
10696
323
    printOperand(MI, 1, O);
10697
323
    return;
10698
0
    break;
10699
12.7k
  case 30:
10700
    // MVE_VCMPf16, MVE_VCMPf16r, MVE_VCMPf32, MVE_VCMPf32r, MVE_VCMPi16, MVE...
10701
12.7k
    printMandatoryRestrictedPredicateOperand(MI, 3, O);
10702
12.7k
    SStream_concat0(O, ", ");
10703
12.7k
    printOperand(MI, 1, O);
10704
12.7k
    SStream_concat0(O, ", ");
10705
12.7k
    printOperand(MI, 2, O);
10706
12.7k
    return;
10707
0
    break;
10708
525
  case 31:
10709
    // MVE_VMOVimmi64, VMOVv1i64, VMOVv2i64
10710
525
    printVMOVModImmOperand(MI, 1, O);
10711
525
    return;
10712
0
    break;
10713
627
  case 32:
10714
    // VCMPEZD, VCMPZD, tRSB
10715
627
    SStream_concat0(O, ", #0");
10716
627
    return;
10717
0
    break;
10718
395
  case 33:
10719
    // VLD1DUPd16, VLD1DUPd16wb_fixed, VLD1DUPd16wb_register, VLD1DUPd32, VLD...
10720
395
    printVectorListOneAllLanes(MI, 0, O);
10721
395
    SStream_concat0(O, ", ");
10722
395
    break;
10723
1.23k
  case 34:
10724
    // VLD1DUPq16, VLD1DUPq16wb_fixed, VLD1DUPq16wb_register, VLD1DUPq32, VLD...
10725
1.23k
    printVectorListTwoAllLanes(MI, 0, O);
10726
1.23k
    SStream_concat0(O, ", ");
10727
1.23k
    break;
10728
1.31k
  case 35:
10729
    // VLD1d16, VLD1d16wb_fixed, VLD1d16wb_register, VLD1d32, VLD1d32wb_fixed...
10730
1.31k
    printVectorListOne(MI, 0, O);
10731
1.31k
    SStream_concat0(O, ", ");
10732
1.31k
    break;
10733
3.03k
  case 36:
10734
    // VLD1q16, VLD1q16wb_fixed, VLD1q16wb_register, VLD1q32, VLD1q32wb_fixed...
10735
3.03k
    printVectorListTwo(MI, 0, O);
10736
3.03k
    SStream_concat0(O, ", ");
10737
3.03k
    break;
10738
922
  case 37:
10739
    // VLD2DUPd16x2, VLD2DUPd16x2wb_fixed, VLD2DUPd16x2wb_register, VLD2DUPd3...
10740
922
    printVectorListTwoSpacedAllLanes(MI, 0, O);
10741
922
    SStream_concat0(O, ", ");
10742
922
    break;
10743
1.44k
  case 38:
10744
    // VLD2b16, VLD2b16wb_fixed, VLD2b16wb_register, VLD2b32, VLD2b32wb_fixed...
10745
1.44k
    printVectorListTwoSpaced(MI, 0, O);
10746
1.44k
    SStream_concat0(O, ", ");
10747
1.44k
    break;
10748
1.17k
  case 39:
10749
    // VLDR_FPCXTNS_off, VLDR_FPCXTS_off, VLDR_FPSCR_NZCVQC_off, VLDR_FPSCR_o...
10750
1.17k
    printT2AddrModeImm8s4Operand_0(MI, 0, O);
10751
1.17k
    return;
10752
0
    break;
10753
2.48k
  case 40:
10754
    // VLDR_FPCXTNS_pre, VLDR_FPCXTS_pre, VLDR_FPSCR_NZCVQC_pre, VLDR_FPSCR_p...
10755
2.48k
    printT2AddrModeImm8s4Operand_1(MI, 1, O);
10756
2.48k
    SStream_concat1(O, '!');
10757
2.48k
    return;
10758
0
    break;
10759
0
  case 41:
10760
    // VLDR_P0_off, VSTR_P0_off
10761
0
    printT2AddrModeImm8s4Operand_0(MI, 1, O);
10762
0
    return;
10763
0
    break;
10764
0
  case 42:
10765
    // VLDR_P0_pre, VSTR_P0_pre
10766
0
    printT2AddrModeImm8s4Operand_1(MI, 2, O);
10767
0
    SStream_concat1(O, '!');
10768
0
    return;
10769
0
    break;
10770
10.7k
  case 43:
10771
    // VSCCLRMD, VSCCLRMS, t2CLRM, tPOP, tPUSH
10772
10.7k
    printRegisterList(MI, 2, O);
10773
10.7k
    return;
10774
0
    break;
10775
10.3k
  case 44:
10776
    // VST1LNd16_UPD, VST1LNd32_UPD, VST1LNd8_UPD, VST2LNd16_UPD, VST2LNd32_U...
10777
10.3k
    printOperand(MI, 4, O);
10778
10.3k
    break;
10779
109
  case 45:
10780
    // VST1d16, VST1d32, VST1d64, VST1d8
10781
109
    printVectorListOne(MI, 2, O);
10782
109
    SStream_concat0(O, ", ");
10783
109
    printAddrMode6Operand(MI, 0, O);
10784
109
    return;
10785
0
    break;
10786
98
  case 46:
10787
    // VST1d16Q, VST1d32Q, VST1d64Q, VST1d8Q, VST2q16, VST2q32, VST2q8
10788
98
    printVectorListFour(MI, 2, O);
10789
98
    SStream_concat0(O, ", ");
10790
98
    printAddrMode6Operand(MI, 0, O);
10791
98
    return;
10792
0
    break;
10793
1.40k
  case 47:
10794
    // VST1d16Qwb_fixed, VST1d32Qwb_fixed, VST1d64Qwb_fixed, VST1d8Qwb_fixed,...
10795
1.40k
    printVectorListFour(MI, 3, O);
10796
1.40k
    SStream_concat0(O, ", ");
10797
1.40k
    printAddrMode6Operand(MI, 1, O);
10798
1.40k
    SStream_concat1(O, '!');
10799
1.40k
    return;
10800
0
    break;
10801
1.41k
  case 48:
10802
    // VST1d16Qwb_register, VST1d32Qwb_register, VST1d64Qwb_register, VST1d8Q...
10803
1.41k
    printVectorListFour(MI, 4, O);
10804
1.41k
    SStream_concat0(O, ", ");
10805
1.41k
    printAddrMode6Operand(MI, 1, O);
10806
1.41k
    SStream_concat0(O, ", ");
10807
1.41k
    printOperand(MI, 3, O);
10808
1.41k
    return;
10809
0
    break;
10810
313
  case 49:
10811
    // VST1d16T, VST1d32T, VST1d64T, VST1d8T
10812
313
    printVectorListThree(MI, 2, O);
10813
313
    SStream_concat0(O, ", ");
10814
313
    printAddrMode6Operand(MI, 0, O);
10815
313
    return;
10816
0
    break;
10817
1.38k
  case 50:
10818
    // VST1d16Twb_fixed, VST1d32Twb_fixed, VST1d64Twb_fixed, VST1d8Twb_fixed
10819
1.38k
    printVectorListThree(MI, 3, O);
10820
1.38k
    SStream_concat0(O, ", ");
10821
1.38k
    printAddrMode6Operand(MI, 1, O);
10822
1.38k
    SStream_concat1(O, '!');
10823
1.38k
    return;
10824
0
    break;
10825
746
  case 51:
10826
    // VST1d16Twb_register, VST1d32Twb_register, VST1d64Twb_register, VST1d8T...
10827
746
    printVectorListThree(MI, 4, O);
10828
746
    SStream_concat0(O, ", ");
10829
746
    printAddrMode6Operand(MI, 1, O);
10830
746
    SStream_concat0(O, ", ");
10831
746
    printOperand(MI, 3, O);
10832
746
    return;
10833
0
    break;
10834
724
  case 52:
10835
    // VST1d16wb_fixed, VST1d32wb_fixed, VST1d64wb_fixed, VST1d8wb_fixed
10836
724
    printVectorListOne(MI, 3, O);
10837
724
    SStream_concat0(O, ", ");
10838
724
    printAddrMode6Operand(MI, 1, O);
10839
724
    SStream_concat1(O, '!');
10840
724
    return;
10841
0
    break;
10842
529
  case 53:
10843
    // VST1d16wb_register, VST1d32wb_register, VST1d64wb_register, VST1d8wb_r...
10844
529
    printVectorListOne(MI, 4, O);
10845
529
    SStream_concat0(O, ", ");
10846
529
    printAddrMode6Operand(MI, 1, O);
10847
529
    SStream_concat0(O, ", ");
10848
529
    printOperand(MI, 3, O);
10849
529
    return;
10850
0
    break;
10851
1.09k
  case 54:
10852
    // VST1q16, VST1q32, VST1q64, VST1q8, VST2d16, VST2d32, VST2d8
10853
1.09k
    printVectorListTwo(MI, 2, O);
10854
1.09k
    SStream_concat0(O, ", ");
10855
1.09k
    printAddrMode6Operand(MI, 0, O);
10856
1.09k
    return;
10857
0
    break;
10858
1.68k
  case 55:
10859
    // VST1q16wb_fixed, VST1q32wb_fixed, VST1q64wb_fixed, VST1q8wb_fixed, VST...
10860
1.68k
    printVectorListTwo(MI, 3, O);
10861
1.68k
    SStream_concat0(O, ", ");
10862
1.68k
    printAddrMode6Operand(MI, 1, O);
10863
1.68k
    SStream_concat1(O, '!');
10864
1.68k
    return;
10865
0
    break;
10866
1.40k
  case 56:
10867
    // VST1q16wb_register, VST1q32wb_register, VST1q64wb_register, VST1q8wb_r...
10868
1.40k
    printVectorListTwo(MI, 4, O);
10869
1.40k
    SStream_concat0(O, ", ");
10870
1.40k
    printAddrMode6Operand(MI, 1, O);
10871
1.40k
    SStream_concat0(O, ", ");
10872
1.40k
    printOperand(MI, 3, O);
10873
1.40k
    return;
10874
0
    break;
10875
317
  case 57:
10876
    // VST2b16, VST2b32, VST2b8
10877
317
    printVectorListTwoSpaced(MI, 2, O);
10878
317
    SStream_concat0(O, ", ");
10879
317
    printAddrMode6Operand(MI, 0, O);
10880
317
    return;
10881
0
    break;
10882
274
  case 58:
10883
    // VST2b16wb_fixed, VST2b32wb_fixed, VST2b8wb_fixed
10884
274
    printVectorListTwoSpaced(MI, 3, O);
10885
274
    SStream_concat0(O, ", ");
10886
274
    printAddrMode6Operand(MI, 1, O);
10887
274
    SStream_concat1(O, '!');
10888
274
    return;
10889
0
    break;
10890
815
  case 59:
10891
    // VST2b16wb_register, VST2b32wb_register, VST2b8wb_register
10892
815
    printVectorListTwoSpaced(MI, 4, O);
10893
815
    SStream_concat0(O, ", ");
10894
815
    printAddrMode6Operand(MI, 1, O);
10895
815
    SStream_concat0(O, ", ");
10896
815
    printOperand(MI, 3, O);
10897
815
    return;
10898
0
    break;
10899
8.74k
  case 60:
10900
    // t2BFic, tCBNZ, tCBZ
10901
8.74k
    printOperandAddr(MI, Address, 1, O);
10902
8.74k
    break;
10903
3.29k
  case 61:
10904
    // t2DMB, t2DSB
10905
3.29k
    printMemBOption(MI, 0, O);
10906
3.29k
    return;
10907
0
    break;
10908
817
  case 62:
10909
    // t2ISB
10910
817
    printInstSyncBOption(MI, 0, O);
10911
817
    return;
10912
0
    break;
10913
879
  case 63:
10914
    // t2PLDWi12, t2PLDi12, t2PLIi12
10915
879
    printAddrModeImm12Operand_0(MI, 0, O);
10916
879
    return;
10917
0
    break;
10918
413
  case 64:
10919
    // t2PLDWi8, t2PLDi8, t2PLIi8
10920
413
    printT2AddrModeImm8Operand_0(MI, 0, O);
10921
413
    return;
10922
0
    break;
10923
935
  case 65:
10924
    // t2PLDWs, t2PLDs, t2PLIs
10925
935
    printT2AddrModeSoRegOperand(MI, 0, O);
10926
935
    return;
10927
0
    break;
10928
1.90k
  case 66:
10929
    // t2PLDpci, t2PLIpci
10930
1.90k
    printThumbLdrLabelOperand(MI, 0, O);
10931
1.90k
    return;
10932
0
    break;
10933
127
  case 67:
10934
    // t2TBB
10935
127
    printAddrModeTBB(MI, 0, O);
10936
127
    return;
10937
0
    break;
10938
540
  case 68:
10939
    // t2TBH
10940
540
    printAddrModeTBH(MI, 0, O);
10941
540
    return;
10942
0
    break;
10943
0
  case 69:
10944
    // t2TSB
10945
0
    printTraceSyncBOption(MI, 0, O);
10946
0
    return;
10947
0
    break;
10948
3.59k
  case 70:
10949
    // tBL, tBLXi
10950
3.59k
    printOperandAddr(MI, Address, 2, O);
10951
3.59k
    return;
10952
0
    break;
10953
1.19M
  }
10954
10955
10956
  // Fragment 3 encoded into 6 bits for 38 unique commands.
10957
1.08M
  switch ((Bits >> 33) & 63) {
10958
0
  default: CS_ASSERT_RET(0 && "Invalid command number.");
10959
708k
  case 0:
10960
    // ASRi, ASRr, LDRBT_POST, LDRConstPool, LDRHTii, LDRSBTii, LDRSHTii, LDR...
10961
708k
    SStream_concat0(O, ", ");
10962
708k
    break;
10963
240k
  case 1:
10964
    // VLD3DUPdAsm_16, VLD3DUPdAsm_32, VLD3DUPdAsm_8, VLD3DUPqAsm_16, VLD3DUP...
10965
240k
    return;
10966
0
    break;
10967
66
  case 2:
10968
    // VLD3DUPdWB_fixed_Asm_16, VLD3DUPdWB_fixed_Asm_32, VLD3DUPdWB_fixed_Asm...
10969
66
    SStream_concat1(O, '!');
10970
66
    return;
10971
0
    break;
10972
2.03k
  case 3:
10973
    // VLD3dAsm_16, VLD3dAsm_32, VLD3dAsm_8, VLD3dWB_fixed_Asm_16, VLD3dWB_fi...
10974
2.03k
    printAddrMode6Operand(MI, 1, O);
10975
2.03k
    break;
10976
1.07k
  case 4:
10977
    // BF16VDOTI_VDOTD, BF16VDOTI_VDOTQ, MVE_VMOV_q_rr, VBF16MALBQI, VBF16MAL...
10978
1.07k
    printVectorIndex(MI, 4, O);
10979
1.07k
    break;
10980
0
  case 5:
10981
    // CDE_CX1A, CDE_CX2A, CDE_CX3A, CDE_VCX1A_vec, CDE_VCX1_vec, CDE_VCX2A_v...
10982
0
    printOperand(MI, 0, O);
10983
0
    SStream_concat0(O, ", ");
10984
0
    break;
10985
0
  case 6:
10986
    // CDE_CX1DA, CDE_CX2DA, CDE_CX3DA
10987
0
    printGPRPairOperand(MI, 0, O);
10988
0
    SStream_concat0(O, ", ");
10989
0
    printOperand(MI, 3, O);
10990
0
    break;
10991
0
  case 7:
10992
    // CDE_CX2D, CDE_CX3D
10993
0
    printOperand(MI, 3, O);
10994
0
    break;
10995
37.6k
  case 8:
10996
    // CDP, MCR, MCRR, MSR, VABSD, VADDD, VCMPD, VCMPED, VDIVD, VMOVD, VMULD,...
10997
37.6k
    printOperand(MI, 1, O);
10998
37.6k
    break;
10999
486
  case 9:
11000
    // FCONSTD
11001
486
    printFPImmOperand(MI, 1, O);
11002
486
    return;
11003
0
    break;
11004
19.1k
  case 10:
11005
    // FLDMXDB_UPD, FLDMXIA_UPD, FSTMXDB_UPD, FSTMXIA_UPD, LDMDA_UPD, LDMDB_U...
11006
19.1k
    SStream_concat0(O, "!, ");
11007
19.1k
    printRegisterList(MI, 4, O);
11008
19.1k
    break;
11009
31.7k
  case 11:
11010
    // LDCL_OFFSET, LDCL_OPTION, LDCL_POST, LDCL_PRE, LDC_OFFSET, LDC_OPTION,...
11011
31.7k
    printCImmediate(MI, 1, O);
11012
31.7k
    SStream_concat0(O, ", ");
11013
31.7k
    break;
11014
9.23k
  case 12:
11015
    // MRC, MVE_VCVTf16s16_fix, MVE_VCVTf16u16_fix, MVE_VCVTf32s32_fix, MVE_V...
11016
9.23k
    printOperand(MI, 2, O);
11017
9.23k
    break;
11018
520
  case 13:
11019
    // MRS, t2MRS_AR
11020
520
    SStream_concat0(O, ", apsr");
11021
520
    return;
11022
0
    break;
11023
109
  case 14:
11024
    // MRSsys, t2MRSsys_AR
11025
109
    SStream_concat0(O, ", spsr");
11026
109
    return;
11027
0
    break;
11028
453
  case 15:
11029
    // MSRi
11030
453
    printModImmOperand(MI, 1, O);
11031
453
    return;
11032
0
    break;
11033
1.53k
  case 16:
11034
    // MVE_VMOV_to_lane_16, MVE_VMOV_to_lane_32, MVE_VMOV_to_lane_8, VSETLNi1...
11035
1.53k
    printVectorIndex(MI, 3, O);
11036
1.53k
    SStream_concat0(O, ", ");
11037
1.53k
    printOperand(MI, 2, O);
11038
1.53k
    return;
11039
0
    break;
11040
1.16k
  case 17:
11041
    // VCMPEZH, VCMPEZS, VCMPZH, VCMPZS
11042
1.16k
    SStream_concat0(O, ", #0");
11043
1.16k
    return;
11044
0
    break;
11045
10.9k
  case 18:
11046
    // VLD1DUPd16wb_fixed, VLD1DUPd16wb_register, VLD1DUPd32wb_fixed, VLD1DUP...
11047
10.9k
    printAddrMode6Operand(MI, 2, O);
11048
10.9k
    break;
11049
18.0k
  case 19:
11050
    // VLD1LNd16, VLD1LNd16_UPD, VLD1LNd32, VLD1LNd32_UPD, VLD1LNd8, VLD1LNd8...
11051
18.0k
    SStream_concat1(O, '[');
11052
18.0k
    break;
11053
1.19k
  case 20:
11054
    // VLD3DUPd16, VLD3DUPd16_UPD, VLD3DUPd32, VLD3DUPd32_UPD, VLD3DUPd8, VLD...
11055
1.19k
    SStream_concat0(O, "[], ");
11056
1.19k
    printOperand(MI, 1, O);
11057
1.19k
    SStream_concat0(O, "[], ");
11058
1.19k
    printOperand(MI, 2, O);
11059
1.19k
    break;
11060
1.43k
  case 21:
11061
    // VLDR_FPCXTNS_post, VLDR_FPCXTS_post, VLDR_FPSCR_NZCVQC_post, VLDR_FPSC...
11062
1.43k
    printT2AddrModeImm8s4OffsetOperand(MI, 2, O);
11063
1.43k
    return;
11064
0
    break;
11065
0
  case 22:
11066
    // VLDR_P0_post, VSTR_P0_post
11067
0
    printT2AddrModeImm8s4OffsetOperand(MI, 3, O);
11068
0
    return;
11069
0
    break;
11070
69
  case 23:
11071
    // VMRS
11072
69
    SStream_concat0(O, ", fpscr");
11073
69
    return;
11074
0
    break;
11075
10
  case 24:
11076
    // VMRS_FPCXTNS
11077
10
    SStream_concat0(O, ", fpcxtns");
11078
10
    return;
11079
0
    break;
11080
34
  case 25:
11081
    // VMRS_FPCXTS
11082
34
    SStream_concat0(O, ", fpcxts");
11083
34
    return;
11084
0
    break;
11085
199
  case 26:
11086
    // VMRS_FPEXC
11087
199
    SStream_concat0(O, ", fpexc");
11088
199
    return;
11089
0
    break;
11090
86
  case 27:
11091
    // VMRS_FPINST
11092
86
    SStream_concat0(O, ", fpinst");
11093
86
    return;
11094
0
    break;
11095
313
  case 28:
11096
    // VMRS_FPINST2
11097
313
    SStream_concat0(O, ", fpinst2");
11098
313
    return;
11099
0
    break;
11100
77
  case 29:
11101
    // VMRS_FPSCR_NZCVQC
11102
77
    SStream_concat0(O, ", fpscr_nzcvqc");
11103
77
    return;
11104
0
    break;
11105
36
  case 30:
11106
    // VMRS_FPSID
11107
36
    SStream_concat0(O, ", fpsid");
11108
36
    return;
11109
0
    break;
11110
39
  case 31:
11111
    // VMRS_MVFR0
11112
39
    SStream_concat0(O, ", mvfr0");
11113
39
    return;
11114
0
    break;
11115
19
  case 32:
11116
    // VMRS_MVFR1
11117
19
    SStream_concat0(O, ", mvfr1");
11118
19
    return;
11119
0
    break;
11120
461
  case 33:
11121
    // VMRS_MVFR2
11122
461
    SStream_concat0(O, ", mvfr2");
11123
461
    return;
11124
0
    break;
11125
0
  case 34:
11126
    // VMRS_P0
11127
0
    SStream_concat0(O, ", p0");
11128
0
    return;
11129
0
    break;
11130
0
  case 35:
11131
    // VMRS_VPR
11132
0
    SStream_concat0(O, ", vpr");
11133
0
    return;
11134
0
    break;
11135
38
  case 36:
11136
    // VSHTOH, VTOSHH, VTOUHH, VUHTOH
11137
38
    printFBits16(MI, 2, O);
11138
38
    return;
11139
0
    break;
11140
1.18k
  case 37:
11141
    // VSLTOD, VSLTOH, VSLTOS, VTOSLD, VTOSLH, VTOSLS, VTOULD, VTOULH, VTOULS...
11142
1.18k
    printFBits32(MI, 2, O);
11143
1.18k
    return;
11144
0
    break;
11145
1.08M
  }
11146
11147
11148
  // Fragment 4 encoded into 7 bits for 78 unique commands.
11149
839k
  switch ((Bits >> 39) & 127) {
11150
0
  default: CS_ASSERT_RET(0 && "Invalid command number.");
11151
168k
  case 0:
11152
    // ASRi, ASRr, LDRConstPool, LSLi, LSLr, LSRi, LSRr, RORi, RORr, RRXi, t2...
11153
168k
    printOperand(MI, 1, O);
11154
168k
    break;
11155
158
  case 1:
11156
    // LDRBT_POST, LDRHTii, LDRSBTii, LDRSHTii, LDRT_POST, STRBT_POST, STRT_P...
11157
158
    printAddrMode7Operand(MI, 1, O);
11158
158
    return;
11159
0
    break;
11160
0
  case 2:
11161
    // VLD1LNdAsm_16, VLD1LNdAsm_32, VLD1LNdAsm_8, VLD1LNdWB_fixed_Asm_16, VL...
11162
0
    printAddrMode6Operand(MI, 2, O);
11163
0
    break;
11164
115k
  case 3:
11165
    // VLD3DUPdWB_register_Asm_16, VLD3DUPdWB_register_Asm_32, VLD3DUPdWB_reg...
11166
115k
    printOperand(MI, 3, O);
11167
115k
    break;
11168
30.9k
  case 4:
11169
    // VLD3dAsm_16, VLD3dAsm_32, VLD3dAsm_8, VLD4dAsm_16, VLD4dAsm_32, VLD4dA...
11170
30.9k
    return;
11171
0
    break;
11172
5.52k
  case 5:
11173
    // VLD3dWB_fixed_Asm_16, VLD3dWB_fixed_Asm_32, VLD3dWB_fixed_Asm_8, VLD4d...
11174
5.52k
    SStream_concat1(O, '!');
11175
5.52k
    return;
11176
0
    break;
11177
41.5k
  case 6:
11178
    // VLD3dWB_register_Asm_16, VLD3dWB_register_Asm_32, VLD3dWB_register_Asm...
11179
41.5k
    SStream_concat0(O, ", ");
11180
41.5k
    break;
11181
0
  case 7:
11182
    // t2LDRB_POST_imm, t2LDRH_POST_imm, t2LDRSB_POST_imm, t2LDRSH_POST_imm, ...
11183
0
    printT2AddrModeImm8OffsetOperand(MI, 2, O);
11184
0
    return;
11185
0
    break;
11186
957
  case 8:
11187
    // t2MOVSsi, t2MOVsi, t2CMNzrs, t2CMPrs, t2MVNs, t2TEQrs, t2TSTrs
11188
957
    printT2SOOperand(MI, 1, O);
11189
957
    return;
11190
0
    break;
11191
1.79k
  case 9:
11192
    // t2MOVSsr, t2MOVsr, CMNzrsr, CMPrsr, MOVsr, MVNsr, TEQrsr, TSTrsr
11193
1.79k
    printSORegRegOperand(MI, 1, O);
11194
1.79k
    return;
11195
0
    break;
11196
619
  case 10:
11197
    // ADR, t2ADR
11198
619
    printAdrLabelOperand_0(MI, 1, O);
11199
619
    return;
11200
0
    break;
11201
142
  case 11:
11202
    // BFC, t2BFC
11203
142
    printBitfieldInvMaskImmOperand(MI, 2, O);
11204
142
    return;
11205
0
    break;
11206
26.4k
  case 12:
11207
    // BFI, CDE_VCX1_vec, CDE_VCX2_vec, CDE_VCX3_vec, CPS3p, CRC32B, CRC32CB,...
11208
26.4k
    printOperand(MI, 2, O);
11209
26.4k
    break;
11210
0
  case 13:
11211
    // CDE_VCX2A_fpdp, CDE_VCX2A_fpsp, CDE_VCX3A_fpdp, CDE_VCX3A_fpsp
11212
0
    printOperand(MI, 4, O);
11213
0
    break;
11214
2.07k
  case 14:
11215
    // CMNri, CMPri, MOVi, MVNi, TEQri, TSTri
11216
2.07k
    printModImmOperand(MI, 1, O);
11217
2.07k
    return;
11218
0
    break;
11219
1.86k
  case 15:
11220
    // CMNzrsi, CMPrsi, MOVsi, MVNsi, TEQrsi, TSTrsi
11221
1.86k
    printSORegImmOperand(MI, 1, O);
11222
1.86k
    return;
11223
0
    break;
11224
398
  case 16:
11225
    // FCONSTH, FCONSTS, MVE_VMOVimmf32, VMOVv2f32, VMOVv4f32
11226
398
    printFPImmOperand(MI, 1, O);
11227
398
    return;
11228
0
    break;
11229
5.70k
  case 17:
11230
    // FLDMXIA, FSTMXIA, LDMDA, LDMDB, LDMIA, LDMIB, STMDA, STMDB, STMIA, STM...
11231
5.70k
    printRegisterList(MI, 3, O);
11232
5.70k
    break;
11233
568
  case 18:
11234
    // LDC2L_OPTION, LDC2_OPTION, STC2L_OPTION, STC2_OPTION
11235
568
    printCoprocOptionImm(MI, 3, O);
11236
568
    return;
11237
0
    break;
11238
1.28k
  case 19:
11239
    // LDC2L_POST, LDC2_POST, STC2L_POST, STC2_POST
11240
1.28k
    printPostIdxImm8s4Operand(MI, 3, O);
11241
1.28k
    return;
11242
0
    break;
11243
7.69k
  case 20:
11244
    // LDCL_OFFSET, LDC_OFFSET, STCL_OFFSET, STC_OFFSET, t2LDC2L_OFFSET, t2LD...
11245
7.69k
    printAddrMode5Operand_0(MI, 2, O);
11246
7.69k
    return;
11247
0
    break;
11248
33.8k
  case 21:
11249
    // LDCL_OPTION, LDCL_POST, LDC_OPTION, LDC_POST, LDRBT_POST_IMM, LDRBT_PO...
11250
33.8k
    printAddrMode7Operand(MI, 2, O);
11251
33.8k
    break;
11252
9.73k
  case 22:
11253
    // LDCL_PRE, LDC_PRE, STCL_PRE, STC_PRE, t2LDC2L_PRE, t2LDC2_PRE, t2LDCL_...
11254
9.73k
    printAddrMode5Operand_1(MI, 2, O);
11255
9.73k
    SStream_concat1(O, '!');
11256
9.73k
    return;
11257
0
    break;
11258
5.13k
  case 23:
11259
    // LDRB_PRE_IMM, LDR_PRE_IMM, STRB_PRE_IMM, STR_PRE_IMM
11260
5.13k
    printAddrModeImm12Operand_1(MI, 2, O);
11261
5.13k
    SStream_concat1(O, '!');
11262
5.13k
    return;
11263
0
    break;
11264
4.49k
  case 24:
11265
    // LDRB_PRE_REG, LDR_PRE_REG, STRB_PRE_REG, STR_PRE_REG
11266
4.49k
    printAddrMode2Operand(MI, 2, O);
11267
4.49k
    SStream_concat1(O, '!');
11268
4.49k
    return;
11269
0
    break;
11270
4.86k
  case 25:
11271
    // LDRBi12, LDRcp, LDRi12, STRBi12, STRi12, t2LDRBi12, t2LDRHi12, t2LDRSB...
11272
4.86k
    printAddrModeImm12Operand_0(MI, 1, O);
11273
4.86k
    return;
11274
0
    break;
11275
2.68k
  case 26:
11276
    // LDRBrs, LDRrs, STRBrs, STRrs
11277
2.68k
    printAddrMode2Operand(MI, 1, O);
11278
2.68k
    return;
11279
0
    break;
11280
1.95k
  case 27:
11281
    // LDRH, LDRSB, LDRSH, STRH
11282
1.95k
    printAddrMode3Operand_0(MI, 1, O);
11283
1.95k
    return;
11284
0
    break;
11285
1.56k
  case 28:
11286
    // LDRH_PRE, LDRSB_PRE, LDRSH_PRE, STRH_PRE
11287
1.56k
    printAddrMode3Operand_1(MI, 2, O);
11288
1.56k
    SStream_concat1(O, '!');
11289
1.56k
    return;
11290
0
    break;
11291
906
  case 29:
11292
    // MCR2, MRC2
11293
906
    printCImmediate(MI, 3, O);
11294
906
    SStream_concat0(O, ", ");
11295
906
    printCImmediate(MI, 4, O);
11296
906
    SStream_concat0(O, ", ");
11297
906
    printOperand(MI, 5, O);
11298
906
    return;
11299
0
    break;
11300
109
  case 30:
11301
    // MRSbanked, t2MRSbanked
11302
109
    printBankedRegOperand(MI, 1, O);
11303
109
    return;
11304
0
    break;
11305
552
  case 31:
11306
    // MVE_VBICimmi16, MVE_VBICimmi32, MVE_VORRimmi16, MVE_VORRimmi32
11307
552
    printVMOVModImmOperand(MI, 2, O);
11308
552
    return;
11309
0
    break;
11310
7.63k
  case 32:
11311
    // MVE_VLDRBS16, MVE_VLDRBS32, MVE_VLDRBU16, MVE_VLDRBU32, MVE_VLDRBU8, M...
11312
7.63k
    printT2AddrModeImm8Operand_0(MI, 1, O);
11313
7.63k
    return;
11314
0
    break;
11315
2.59k
  case 33:
11316
    // MVE_VLDRBS16_pre, MVE_VLDRBS32_pre, MVE_VLDRBU16_pre, MVE_VLDRBU32_pre...
11317
2.59k
    printT2AddrModeImm8Operand_0(MI, 2, O);
11318
2.59k
    SStream_concat1(O, '!');
11319
2.59k
    return;
11320
0
    break;
11321
80
  case 34:
11322
    // MVE_VLDRBS16_rq, MVE_VLDRBS32_rq, MVE_VLDRBU16_rq, MVE_VLDRBU32_rq, MV...
11323
80
    printMveAddrModeRQOperand_0(MI, 1, O);
11324
80
    return;
11325
0
    break;
11326
4.03k
  case 35:
11327
    // MVE_VLDRBU8_pre, MVE_VLDRHU16_pre, MVE_VLDRWU32_pre, MVE_VSTRBU8_pre, ...
11328
4.03k
    printT2AddrModeImm8Operand_1(MI, 2, O);
11329
4.03k
    SStream_concat1(O, '!');
11330
4.03k
    return;
11331
0
    break;
11332
205
  case 36:
11333
    // MVE_VLDRDU64_rq, MVE_VSTRD64_rq
11334
205
    printMveAddrModeRQOperand_3(MI, 1, O);
11335
205
    return;
11336
0
    break;
11337
222
  case 37:
11338
    // MVE_VLDRHS32_rq, MVE_VLDRHU16_rq, MVE_VLDRHU32_rq, MVE_VSTRH16_rq, MVE...
11339
222
    printMveAddrModeRQOperand_1(MI, 1, O);
11340
222
    return;
11341
0
    break;
11342
85
  case 38:
11343
    // MVE_VLDRWU32_rq, MVE_VSTRW32_rq
11344
85
    printMveAddrModeRQOperand_2(MI, 1, O);
11345
85
    return;
11346
0
    break;
11347
2.99k
  case 39:
11348
    // MVE_VMOVimmi16, MVE_VMOVimmi32, MVE_VMOVimmi8, MVE_VMVNimmi16, MVE_VMV...
11349
2.99k
    printVMOVModImmOperand(MI, 1, O);
11350
2.99k
    return;
11351
0
    break;
11352
724
  case 40:
11353
    // MVE_WLSTP_16, MVE_WLSTP_32, MVE_WLSTP_64, MVE_WLSTP_8, t2BFic, t2WLS
11354
724
    printOperandAddr(MI, Address, 2, O);
11355
724
    break;
11356
1.06k
  case 41:
11357
    // SSAT, SSAT16, t2SSAT, t2SSAT16
11358
1.06k
    printImmPlusOneOperand(MI, 1, O);
11359
1.06k
    SStream_concat0(O, ", ");
11360
1.06k
    printOperand(MI, 2, O);
11361
1.06k
    break;
11362
485
  case 42:
11363
    // STLEXD, STREXD
11364
485
    printGPRPairOperand(MI, 1, O);
11365
485
    SStream_concat0(O, ", ");
11366
485
    printAddrMode7Operand(MI, 2, O);
11367
485
    return;
11368
0
    break;
11369
1.82k
  case 43:
11370
    // VLD1LNd16, VLD1LNd32, VLD1LNd8, VST2LNd16, VST2LNd32, VST2LNd8, VST2LN...
11371
1.82k
    printNoHashImmediate(MI, 4, O);
11372
1.82k
    break;
11373
6.28k
  case 44:
11374
    // VLD1LNd16_UPD, VLD1LNd32_UPD, VLD1LNd8_UPD, VLD2LNd16, VLD2LNd32, VLD2...
11375
6.28k
    printNoHashImmediate(MI, 6, O);
11376
6.28k
    break;
11377
2.60k
  case 45:
11378
    // VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_UPD, VLD2LNq32_U...
11379
2.60k
    printNoHashImmediate(MI, 8, O);
11380
2.60k
    SStream_concat0(O, "], ");
11381
2.60k
    break;
11382
668
  case 46:
11383
    // VLD3DUPd16, VLD3DUPd16_UPD, VLD3DUPd32, VLD3DUPd32_UPD, VLD3DUPd8, VLD...
11384
668
    SStream_concat0(O, "[]}, ");
11385
668
    break;
11386
2.25k
  case 47:
11387
    // VLD3LNd16_UPD, VLD3LNd32_UPD, VLD3LNd8_UPD, VLD3LNq16_UPD, VLD3LNq32_U...
11388
2.25k
    printNoHashImmediate(MI, 10, O);
11389
2.25k
    SStream_concat0(O, "], ");
11390
2.25k
    printOperand(MI, 1, O);
11391
2.25k
    SStream_concat1(O, '[');
11392
2.25k
    printNoHashImmediate(MI, 10, O);
11393
2.25k
    SStream_concat0(O, "], ");
11394
2.25k
    printOperand(MI, 2, O);
11395
2.25k
    SStream_concat1(O, '[');
11396
2.25k
    printNoHashImmediate(MI, 10, O);
11397
2.25k
    break;
11398
527
  case 48:
11399
    // VLD4DUPd16, VLD4DUPd16_UPD, VLD4DUPd32, VLD4DUPd32_UPD, VLD4DUPd8, VLD...
11400
527
    SStream_concat0(O, "[], ");
11401
527
    printOperand(MI, 3, O);
11402
527
    SStream_concat0(O, "[]}, ");
11403
527
    break;
11404
1.30k
  case 49:
11405
    // VLD4LNd16_UPD, VLD4LNd32_UPD, VLD4LNd8_UPD, VLD4LNq16_UPD, VLD4LNq32_U...
11406
1.30k
    printNoHashImmediate(MI, 12, O);
11407
1.30k
    SStream_concat0(O, "], ");
11408
1.30k
    printOperand(MI, 1, O);
11409
1.30k
    SStream_concat1(O, '[');
11410
1.30k
    printNoHashImmediate(MI, 12, O);
11411
1.30k
    SStream_concat0(O, "], ");
11412
1.30k
    printOperand(MI, 2, O);
11413
1.30k
    SStream_concat1(O, '[');
11414
1.30k
    printNoHashImmediate(MI, 12, O);
11415
1.30k
    SStream_concat0(O, "], ");
11416
1.30k
    printOperand(MI, 3, O);
11417
1.30k
    SStream_concat1(O, '[');
11418
1.30k
    printNoHashImmediate(MI, 12, O);
11419
1.30k
    SStream_concat0(O, "]}, ");
11420
1.30k
    printAddrMode6Operand(MI, 5, O);
11421
1.30k
    printAddrMode6OffsetOperand(MI, 7, O);
11422
1.30k
    return;
11423
0
    break;
11424
1.25k
  case 50:
11425
    // VLDRD, VLDRS, VSTRD, VSTRS
11426
1.25k
    printAddrMode5Operand_0(MI, 1, O);
11427
1.25k
    return;
11428
0
    break;
11429
901
  case 51:
11430
    // VLDRH, VSTRH
11431
901
    printAddrMode5FP16Operand_0(MI, 1, O);
11432
901
    return;
11433
0
    break;
11434
312
  case 52:
11435
    // VST1LNd16, VST1LNd32, VST1LNd8
11436
312
    printNoHashImmediate(MI, 3, O);
11437
312
    SStream_concat0(O, "]}, ");
11438
312
    printAddrMode6Operand(MI, 0, O);
11439
312
    return;
11440
0
    break;
11441
2.36k
  case 53:
11442
    // VST1LNd16_UPD, VST1LNd32_UPD, VST1LNd8_UPD, VST3LNd16, VST3LNd32, VST3...
11443
2.36k
    printNoHashImmediate(MI, 5, O);
11444
2.36k
    break;
11445
1.14k
  case 54:
11446
    // VST3LNd16_UPD, VST3LNd32_UPD, VST3LNd8_UPD, VST3LNq16_UPD, VST3LNq32_U...
11447
1.14k
    printNoHashImmediate(MI, 7, O);
11448
1.14k
    SStream_concat0(O, "], ");
11449
1.14k
    printOperand(MI, 5, O);
11450
1.14k
    SStream_concat1(O, '[');
11451
1.14k
    printNoHashImmediate(MI, 7, O);
11452
1.14k
    SStream_concat0(O, "], ");
11453
1.14k
    printOperand(MI, 6, O);
11454
1.14k
    SStream_concat1(O, '[');
11455
1.14k
    printNoHashImmediate(MI, 7, O);
11456
1.14k
    SStream_concat0(O, "]}, ");
11457
1.14k
    printAddrMode6Operand(MI, 1, O);
11458
1.14k
    printAddrMode6OffsetOperand(MI, 3, O);
11459
1.14k
    return;
11460
0
    break;
11461
3.84k
  case 55:
11462
    // VST3d16_UPD, VST3d32_UPD, VST3d8_UPD, VST3q16_UPD, VST3q32_UPD, VST3q8...
11463
3.84k
    printOperand(MI, 5, O);
11464
3.84k
    SStream_concat0(O, ", ");
11465
3.84k
    printOperand(MI, 6, O);
11466
3.84k
    break;
11467
252
  case 56:
11468
    // VTBL1
11469
252
    printVectorListOne(MI, 1, O);
11470
252
    SStream_concat0(O, ", ");
11471
252
    printOperand(MI, 2, O);
11472
252
    return;
11473
0
    break;
11474
319
  case 57:
11475
    // VTBL2
11476
319
    printVectorListTwo(MI, 1, O);
11477
319
    SStream_concat0(O, ", ");
11478
319
    printOperand(MI, 2, O);
11479
319
    return;
11480
0
    break;
11481
129
  case 58:
11482
    // VTBL3
11483
129
    printVectorListThree(MI, 1, O);
11484
129
    SStream_concat0(O, ", ");
11485
129
    printOperand(MI, 2, O);
11486
129
    return;
11487
0
    break;
11488
43
  case 59:
11489
    // VTBL4
11490
43
    printVectorListFour(MI, 1, O);
11491
43
    SStream_concat0(O, ", ");
11492
43
    printOperand(MI, 2, O);
11493
43
    return;
11494
0
    break;
11495
133
  case 60:
11496
    // VTBX1
11497
133
    printVectorListOne(MI, 2, O);
11498
133
    SStream_concat0(O, ", ");
11499
133
    printOperand(MI, 3, O);
11500
133
    return;
11501
0
    break;
11502
491
  case 61:
11503
    // VTBX2
11504
491
    printVectorListTwo(MI, 2, O);
11505
491
    SStream_concat0(O, ", ");
11506
491
    printOperand(MI, 3, O);
11507
491
    return;
11508
0
    break;
11509
164
  case 62:
11510
    // VTBX3
11511
164
    printVectorListThree(MI, 2, O);
11512
164
    SStream_concat0(O, ", ");
11513
164
    printOperand(MI, 3, O);
11514
164
    return;
11515
0
    break;
11516
112
  case 63:
11517
    // VTBX4
11518
112
    printVectorListFour(MI, 2, O);
11519
112
    SStream_concat0(O, ", ");
11520
112
    printOperand(MI, 3, O);
11521
112
    return;
11522
0
    break;
11523
2.14k
  case 64:
11524
    // sysLDMDA_UPD, sysLDMDB_UPD, sysLDMIA_UPD, sysLDMIB_UPD, sysSTMDA_UPD, ...
11525
2.14k
    SStream_concat0(O, " ^");
11526
2.14k
    return;
11527
0
    break;
11528
660
  case 65:
11529
    // t2BFLi, t2BFi
11530
660
    printOperandAddr(MI, Address, 1, O);
11531
660
    return;
11532
0
    break;
11533
23.2k
  case 66:
11534
    // t2LDRBpci, t2LDRHpci, t2LDRSBpci, t2LDRSHpci, t2LDRpci, tLDRpci
11535
23.2k
    printThumbLdrLabelOperand(MI, 1, O);
11536
23.2k
    return;
11537
0
    break;
11538
1.35k
  case 67:
11539
    // t2LDRBs, t2LDRHs, t2LDRSBs, t2LDRSHs, t2LDRs, t2STRBs, t2STRHs, t2STRs
11540
1.35k
    printT2AddrModeSoRegOperand(MI, 1, O);
11541
1.35k
    return;
11542
0
    break;
11543
88
  case 68:
11544
    // t2LDREX
11545
88
    printT2AddrModeImm0_1020s4Operand(MI, 1, O);
11546
88
    return;
11547
0
    break;
11548
1.28k
  case 69:
11549
    // t2MRS_M
11550
1.28k
    printMSRMaskOperand(MI, 1, O);
11551
1.28k
    return;
11552
0
    break;
11553
2.57k
  case 70:
11554
    // tADDspi, tSUBspi
11555
2.57k
    printThumbS4ImmOperand(MI, 2, O);
11556
2.57k
    return;
11557
0
    break;
11558
16.8k
  case 71:
11559
    // tADR
11560
16.8k
    printAdrLabelOperandAddr_2(MI, Address, 1, O);
11561
16.8k
    return;
11562
0
    break;
11563
56.7k
  case 72:
11564
    // tASRri, tLSRri
11565
56.7k
    printThumbSRImm(MI, 3, O);
11566
56.7k
    return;
11567
0
    break;
11568
49.8k
  case 73:
11569
    // tLDRBi, tSTRBi
11570
49.8k
    printThumbAddrModeImm5S1Operand(MI, 1, O);
11571
49.8k
    return;
11572
0
    break;
11573
29.3k
  case 74:
11574
    // tLDRBr, tLDRHr, tLDRSB, tLDRSH, tLDRr, tSTRBr, tSTRHr, tSTRr
11575
29.3k
    printThumbAddrModeRROperand(MI, 1, O);
11576
29.3k
    return;
11577
0
    break;
11578
48.3k
  case 75:
11579
    // tLDRHi, tSTRHi
11580
48.3k
    printThumbAddrModeImm5S2Operand(MI, 1, O);
11581
48.3k
    return;
11582
0
    break;
11583
56.1k
  case 76:
11584
    // tLDRi, tSTRi
11585
56.1k
    printThumbAddrModeImm5S4Operand(MI, 1, O);
11586
56.1k
    return;
11587
0
    break;
11588
25.7k
  case 77:
11589
    // tLDRspi, tSTRspi
11590
25.7k
    printThumbAddrModeSPOperand(MI, 1, O);
11591
25.7k
    return;
11592
0
    break;
11593
839k
  }
11594
11595
11596
  // Fragment 5 encoded into 5 bits for 27 unique commands.
11597
414k
  switch ((Bits >> 46) & 31) {
11598
0
  default: CS_ASSERT_RET(0 && "Invalid command number.");
11599
161k
  case 0:
11600
    // ASRi, ASRr, LSLi, LSLr, LSRi, LSRr, RORi, RORr, VLD1LNdWB_register_Asm...
11601
161k
    SStream_concat0(O, ", ");
11602
161k
    break;
11603
174k
  case 1:
11604
    // LDRConstPool, RRXi, VLD1LNdAsm_16, VLD1LNdAsm_32, VLD1LNdAsm_8, VLD2LN...
11605
174k
    return;
11606
0
    break;
11607
0
  case 2:
11608
    // VLD1LNdWB_fixed_Asm_16, VLD1LNdWB_fixed_Asm_32, VLD1LNdWB_fixed_Asm_8,...
11609
0
    SStream_concat1(O, '!');
11610
0
    return;
11611
0
    break;
11612
568
  case 3:
11613
    // VLD3dWB_register_Asm_16, VLD3dWB_register_Asm_32, VLD3dWB_register_Asm...
11614
568
    printOperand(MI, 3, O);
11615
568
    return;
11616
0
    break;
11617
5.45k
  case 4:
11618
    // CDE_CX2DA, CDE_CX3D, CDE_CX3DA, VLD1DUPd16wb_register, VLD1DUPd32wb_re...
11619
5.45k
    printOperand(MI, 4, O);
11620
5.45k
    break;
11621
24.8k
  case 5:
11622
    // CDP, t2CDP, t2CDP2
11623
24.8k
    printCImmediate(MI, 2, O);
11624
24.8k
    SStream_concat0(O, ", ");
11625
24.8k
    printCImmediate(MI, 3, O);
11626
24.8k
    SStream_concat0(O, ", ");
11627
24.8k
    printCImmediate(MI, 4, O);
11628
24.8k
    SStream_concat0(O, ", ");
11629
24.8k
    printOperand(MI, 5, O);
11630
24.8k
    return;
11631
0
    break;
11632
5.01k
  case 6:
11633
    // MCR, MCRR, VADDD, VDIVD, VMULD, VNMULD, VSUBD, t2MCR, t2MCR2, t2MCRR, ...
11634
5.01k
    printOperand(MI, 2, O);
11635
5.01k
    break;
11636
5.65k
  case 7:
11637
    // MRC, t2MRC, t2MRC2
11638
5.65k
    printOperand(MI, 0, O);
11639
5.65k
    SStream_concat0(O, ", ");
11640
5.65k
    printCImmediate(MI, 3, O);
11641
5.65k
    SStream_concat0(O, ", ");
11642
5.65k
    printCImmediate(MI, 4, O);
11643
5.65k
    SStream_concat0(O, ", ");
11644
5.65k
    printOperand(MI, 5, O);
11645
5.65k
    return;
11646
0
    break;
11647
2.89k
  case 8:
11648
    // MVE_VLDRBS16_post, MVE_VLDRBS32_post, MVE_VLDRBU16_post, MVE_VLDRBU32_...
11649
2.89k
    printT2AddrModeImm8OffsetOperand(MI, 3, O);
11650
2.89k
    return;
11651
0
    break;
11652
2.00k
  case 9:
11653
    // MVE_VMOV_from_lane_32, MVE_VMOV_from_lane_s16, MVE_VMOV_from_lane_s8, ...
11654
2.00k
    printVectorIndex(MI, 2, O);
11655
2.00k
    return;
11656
0
    break;
11657
1.41k
  case 10:
11658
    // MVE_VMOV_q_rr, VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_U...
11659
1.41k
    printOperand(MI, 1, O);
11660
1.41k
    break;
11661
379
  case 11:
11662
    // MVE_VSHLL_lws16bh, MVE_VSHLL_lws16th, MVE_VSHLL_lwu16bh, MVE_VSHLL_lwu...
11663
379
    SStream_concat0(O, ", #16");
11664
379
    return;
11665
0
    break;
11666
785
  case 12:
11667
    // MVE_VSHLL_lws8bh, MVE_VSHLL_lws8th, MVE_VSHLL_lwu8bh, MVE_VSHLL_lwu8th
11668
785
    SStream_concat0(O, ", #8");
11669
785
    return;
11670
0
    break;
11671
1.01k
  case 13:
11672
    // SSAT, t2SSAT
11673
1.01k
    printShiftImmOperand(MI, 3, O);
11674
1.01k
    return;
11675
0
    break;
11676
938
  case 14:
11677
    // SXTB, SXTB16, SXTH, UXTB, UXTB16, UXTH, t2SXTB, t2SXTB16, t2SXTH, t2UX...
11678
938
    printRotImmOperand(MI, 2, O);
11679
938
    return;
11680
0
    break;
11681
7.99k
  case 15:
11682
    // VCEQzv16i8, VCEQzv2f32, VCEQzv2i32, VCEQzv4f16, VCEQzv4f32, VCEQzv4i16...
11683
7.99k
    SStream_concat0(O, ", #0");
11684
7.99k
    return;
11685
0
    break;
11686
690
  case 16:
11687
    // VCMLAv2f32_indexed, VCMLAv4f16_indexed, VCMLAv4f32_indexed, VCMLAv8f16...
11688
690
    printVectorIndex(MI, 4, O);
11689
690
    SStream_concat0(O, ", ");
11690
690
    printComplexRotationOp_90_0(MI, 5, O);
11691
690
    return;
11692
0
    break;
11693
260
  case 17:
11694
    // VFMALDI, VFMALQI, VFMSLDI, VFMSLQI
11695
260
    printVectorIndex(MI, 3, O);
11696
260
    return;
11697
0
    break;
11698
3.87k
  case 18:
11699
    // VLD1LNd16, VLD1LNd16_UPD, VLD1LNd32, VLD1LNd32_UPD, VLD1LNd8, VLD1LNd8...
11700
3.87k
    SStream_concat0(O, "]}, ");
11701
3.87k
    break;
11702
8.85k
  case 19:
11703
    // VLD2LNd16, VLD2LNd32, VLD2LNd8, VLD2LNq16, VLD2LNq32, VLD4LNd16, VLD4L...
11704
8.85k
    SStream_concat0(O, "], ");
11705
8.85k
    break;
11706
83
  case 20:
11707
    // VLD3DUPd16, VLD3DUPd32, VLD3DUPd8, VLD3DUPq16, VLD3DUPq32, VLD3DUPq8
11708
83
    printAddrMode6Operand(MI, 3, O);
11709
83
    return;
11710
0
    break;
11711
751
  case 21:
11712
    // VLD3DUPd16_UPD, VLD3DUPd32_UPD, VLD3DUPd8_UPD, VLD3DUPq16_UPD, VLD3DUP...
11713
751
    printAddrMode6Operand(MI, 4, O);
11714
751
    break;
11715
361
  case 22:
11716
    // VLD4DUPd16_UPD, VLD4DUPd32_UPD, VLD4DUPd8_UPD, VLD4DUPq16_UPD, VLD4DUP...
11717
361
    printAddrMode6Operand(MI, 5, O);
11718
361
    printAddrMode6OffsetOperand(MI, 7, O);
11719
361
    return;
11720
0
    break;
11721
1.43k
  case 23:
11722
    // VST3d16_UPD, VST3d32_UPD, VST3d8_UPD, VST3q16_UPD, VST3q32_UPD, VST3q8...
11723
1.43k
    SStream_concat0(O, "}, ");
11724
1.43k
    printAddrMode6Operand(MI, 1, O);
11725
1.43k
    printAddrMode6OffsetOperand(MI, 3, O);
11726
1.43k
    return;
11727
0
    break;
11728
1.18k
  case 24:
11729
    // VST4LNd16_UPD, VST4LNd32_UPD, VST4LNd8_UPD, VST4LNq16_UPD, VST4LNq32_U...
11730
1.18k
    printOperand(MI, 5, O);
11731
1.18k
    SStream_concat1(O, '[');
11732
1.18k
    printNoHashImmediate(MI, 8, O);
11733
1.18k
    SStream_concat0(O, "], ");
11734
1.18k
    printOperand(MI, 6, O);
11735
1.18k
    SStream_concat1(O, '[');
11736
1.18k
    printNoHashImmediate(MI, 8, O);
11737
1.18k
    SStream_concat0(O, "], ");
11738
1.18k
    printOperand(MI, 7, O);
11739
1.18k
    SStream_concat1(O, '[');
11740
1.18k
    printNoHashImmediate(MI, 8, O);
11741
1.18k
    SStream_concat0(O, "]}, ");
11742
1.18k
    printAddrMode6Operand(MI, 1, O);
11743
1.18k
    printAddrMode6OffsetOperand(MI, 3, O);
11744
1.18k
    return;
11745
0
    break;
11746
1.83k
  case 25:
11747
    // sysLDMDA, sysLDMDB, sysLDMIA, sysLDMIB, sysSTMDA, sysSTMDB, sysSTMIA, ...
11748
1.83k
    SStream_concat0(O, " ^");
11749
1.83k
    return;
11750
0
    break;
11751
0
  case 26:
11752
    // t2MOVsra_glue, t2MOVsrl_glue
11753
0
    SStream_concat0(O, ", #1");
11754
0
    return;
11755
0
    break;
11756
414k
  }
11757
11758
11759
  // Fragment 6 encoded into 6 bits for 38 unique commands.
11760
186k
  switch ((Bits >> 51) & 63) {
11761
0
  default: CS_ASSERT_RET(0 && "Invalid command number.");
11762
58.0k
  case 0:
11763
    // ASRi, ASRr, LSLi, LSLr, LSRi, LSRr, RORi, RORr, ADCrr, ADDrr, ANDrr, B...
11764
58.0k
    printOperand(MI, 2, O);
11765
58.0k
    break;
11766
5.20k
  case 1:
11767
    // VLD1LNdWB_register_Asm_16, VLD1LNdWB_register_Asm_32, VLD1LNdWB_regist...
11768
5.20k
    printOperand(MI, 4, O);
11769
5.20k
    break;
11770
5.19k
  case 2:
11771
    // ADCri, ADDri, ANDri, BICri, EORri, ORRri, RSBri, RSCri, SBCri, SUBri
11772
5.19k
    printModImmOperand(MI, 2, O);
11773
5.19k
    return;
11774
0
    break;
11775
11.1k
  case 3:
11776
    // ADCrsi, ADDrsi, ANDrsi, BICrsi, EORrsi, ORRrsi, RSBrsi, RSCrsi, SBCrsi...
11777
11.1k
    printSORegImmOperand(MI, 2, O);
11778
11.1k
    return;
11779
0
    break;
11780
994
  case 4:
11781
    // BFI, t2BFI
11782
994
    printBitfieldInvMaskImmOperand(MI, 3, O);
11783
994
    return;
11784
0
    break;
11785
5.84k
  case 5:
11786
    // CDE_CX2DA, CDE_CX3D, VADDD, VDIVD, VLD1DUPd16wb_register, VLD1DUPd32wb...
11787
5.84k
    return;
11788
0
    break;
11789
4.78k
  case 6:
11790
    // CDE_CX3DA, MCR, MCRR, t2MCR, t2MCR2, t2MCRR, t2MCRR2
11791
4.78k
    SStream_concat0(O, ", ");
11792
4.78k
    break;
11793
17.2k
  case 7:
11794
    // CDE_VCX2_vec, CDE_VCX3_vec, MVE_VABAVs16, MVE_VABAVs32, MVE_VABAVs8, M...
11795
17.2k
    printOperand(MI, 3, O);
11796
17.2k
    break;
11797
2.87k
  case 8:
11798
    // CDE_VCX3A_fpdp, CDE_VCX3A_fpsp, VST2LNd16_UPD, VST2LNd32_UPD, VST2LNd8...
11799
2.87k
    printOperand(MI, 5, O);
11800
2.87k
    break;
11801
5.15k
  case 9:
11802
    // LDCL_OPTION, LDC_OPTION, STCL_OPTION, STC_OPTION, t2LDC2L_OPTION, t2LD...
11803
5.15k
    printCoprocOptionImm(MI, 3, O);
11804
5.15k
    return;
11805
0
    break;
11806
9.19k
  case 10:
11807
    // LDCL_POST, LDC_POST, STCL_POST, STC_POST, t2LDC2L_POST, t2LDC2_POST, t...
11808
9.19k
    printPostIdxImm8s4Operand(MI, 3, O);
11809
9.19k
    return;
11810
0
    break;
11811
10.8k
  case 11:
11812
    // LDRBT_POST_IMM, LDRBT_POST_REG, LDRB_POST_IMM, LDRB_POST_REG, LDRT_POS...
11813
10.8k
    printAddrMode2OffsetOperand(MI, 3, O);
11814
10.8k
    return;
11815
0
    break;
11816
1.07k
  case 12:
11817
    // LDRD, STRD
11818
1.07k
    printAddrMode3Operand_0(MI, 2, O);
11819
1.07k
    return;
11820
0
    break;
11821
3.95k
  case 13:
11822
    // LDRD_POST, STRD_POST, t2LDRD_POST, t2STRD_POST
11823
3.95k
    printAddrMode7Operand(MI, 3, O);
11824
3.95k
    break;
11825
1.10k
  case 14:
11826
    // LDRD_PRE, STRD_PRE
11827
1.10k
    printAddrMode3Operand_1(MI, 3, O);
11828
1.10k
    SStream_concat1(O, '!');
11829
1.10k
    return;
11830
0
    break;
11831
565
  case 15:
11832
    // LDRHTi, LDRSBTi, LDRSHTi, STRHTi
11833
565
    printPostIdxImm8Operand(MI, 3, O);
11834
565
    return;
11835
0
    break;
11836
1.78k
  case 16:
11837
    // LDRHTr, LDRSBTr, LDRSHTr, STRHTr
11838
1.78k
    printPostIdxRegOperand(MI, 3, O);
11839
1.78k
    return;
11840
0
    break;
11841
3.47k
  case 17:
11842
    // LDRH_POST, LDRSB_POST, LDRSH_POST, STRH_POST
11843
3.47k
    printAddrMode3OffsetOperand(MI, 3, O);
11844
3.47k
    return;
11845
0
    break;
11846
404
  case 18:
11847
    // MCRR2
11848
404
    printCImmediate(MI, 4, O);
11849
404
    return;
11850
0
    break;
11851
0
  case 19:
11852
    // MVE_SQRSHRL, MVE_UQRSHLL
11853
0
    printMveSaturateOp(MI, 5, O);
11854
0
    SStream_concat0(O, ", ");
11855
0
    printOperand(MI, 4, O);
11856
0
    return;
11857
0
    break;
11858
0
  case 20:
11859
    // MVE_VMOV_q_rr
11860
0
    printVectorIndex(MI, 5, O);
11861
0
    SStream_concat0(O, ", ");
11862
0
    printOperand(MI, 2, O);
11863
0
    SStream_concat0(O, ", ");
11864
0
    printOperand(MI, 3, O);
11865
0
    return;
11866
0
    break;
11867
561
  case 21:
11868
    // STLEX, STLEXB, STLEXH, STREX, STREXB, STREXH, SWP, SWPB, t2LDAEXD, t2L...
11869
561
    printAddrMode7Operand(MI, 2, O);
11870
561
    return;
11871
0
    break;
11872
158
  case 22:
11873
    // VCADDv2f32, VCADDv4f16, VCADDv4f32, VCADDv8f16
11874
158
    printComplexRotationOp_180_90(MI, 3, O);
11875
158
    return;
11876
0
    break;
11877
309
  case 23:
11878
    // VCMLAv2f32, VCMLAv4f16, VCMLAv4f32, VCMLAv8f16
11879
309
    printComplexRotationOp_90_0(MI, 4, O);
11880
309
    return;
11881
0
    break;
11882
1.54k
  case 24:
11883
    // VLD1LNd16, VLD1LNd32, VLD1LNd8, VST1LNd16_UPD, VST1LNd32_UPD, VST1LNd8...
11884
1.54k
    printAddrMode6Operand(MI, 1, O);
11885
1.54k
    break;
11886
1.73k
  case 25:
11887
    // VLD1LNd16_UPD, VLD1LNd32_UPD, VLD1LNd8_UPD
11888
1.73k
    printAddrMode6Operand(MI, 2, O);
11889
1.73k
    printAddrMode6OffsetOperand(MI, 4, O);
11890
1.73k
    return;
11891
0
    break;
11892
670
  case 26:
11893
    // VLD2LNd16, VLD2LNd32, VLD2LNd8, VLD2LNq16, VLD2LNq32
11894
670
    printOperand(MI, 1, O);
11895
670
    SStream_concat1(O, '[');
11896
670
    printNoHashImmediate(MI, 6, O);
11897
670
    SStream_concat0(O, "]}, ");
11898
670
    printAddrMode6Operand(MI, 2, O);
11899
670
    return;
11900
0
    break;
11901
1.41k
  case 27:
11902
    // VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_UPD, VLD2LNq32_U...
11903
1.41k
    SStream_concat1(O, '[');
11904
1.41k
    printNoHashImmediate(MI, 8, O);
11905
1.41k
    break;
11906
585
  case 28:
11907
    // VLD3DUPd16_UPD, VLD3DUPd32_UPD, VLD3DUPd8_UPD, VLD3DUPq16_UPD, VLD3DUP...
11908
585
    printAddrMode6OffsetOperand(MI, 6, O);
11909
585
    return;
11910
0
    break;
11911
597
  case 29:
11912
    // VLD3LNd16_UPD, VLD3LNd32_UPD, VLD3LNd8_UPD, VLD3LNq16_UPD, VLD3LNq32_U...
11913
597
    printAddrMode6Operand(MI, 4, O);
11914
597
    printAddrMode6OffsetOperand(MI, 6, O);
11915
597
    return;
11916
0
    break;
11917
2.41k
  case 30:
11918
    // VST4d16_UPD, VST4d32_UPD, VST4d8_UPD, VST4q16_UPD, VST4q32_UPD, VST4q8...
11919
2.41k
    printOperand(MI, 7, O);
11920
2.41k
    SStream_concat0(O, "}, ");
11921
2.41k
    printAddrMode6Operand(MI, 1, O);
11922
2.41k
    printAddrMode6OffsetOperand(MI, 3, O);
11923
2.41k
    return;
11924
0
    break;
11925
2.77k
  case 31:
11926
    // t2ADCrs, t2ADDrs, t2ANDrs, t2BICrs, t2EORrs, t2ORNrs, t2ORRrs, t2RSBrs...
11927
2.77k
    printT2SOOperand(MI, 2, O);
11928
2.77k
    return;
11929
0
    break;
11930
193
  case 32:
11931
    // t2ASRri, t2LSRri
11932
193
    printThumbSRImm(MI, 2, O);
11933
193
    return;
11934
0
    break;
11935
415
  case 33:
11936
    // t2BFic, t2CSEL, t2CSINC, t2CSINV, t2CSNEG
11937
415
    printMandatoryPredicateOperand(MI, 3, O);
11938
415
    return;
11939
0
    break;
11940
5.15k
  case 34:
11941
    // t2LDRD_PRE, t2STRD_PRE
11942
5.15k
    printT2AddrModeImm8s4Operand_1(MI, 3, O);
11943
5.15k
    SStream_concat1(O, '!');
11944
5.15k
    return;
11945
0
    break;
11946
1.14k
  case 35:
11947
    // t2LDRDi8, t2STRDi8
11948
1.14k
    printT2AddrModeImm8s4Operand_0(MI, 2, O);
11949
1.14k
    return;
11950
0
    break;
11951
476
  case 36:
11952
    // t2STREX
11953
476
    printT2AddrModeImm0_1020s4Operand(MI, 2, O);
11954
476
    return;
11955
0
    break;
11956
17.9k
  case 37:
11957
    // tADDrSPi
11958
17.9k
    printThumbS4ImmOperand(MI, 2, O);
11959
17.9k
    return;
11960
0
    break;
11961
186k
  }
11962
11963
11964
  // Fragment 7 encoded into 5 bits for 17 unique commands.
11965
95.0k
  switch ((Bits >> 57) & 31) {
11966
0
  default: CS_ASSERT_RET(0 && "Invalid command number.");
11967
39.4k
  case 0:
11968
    // ASRi, ASRr, LSLi, LSLr, LSRi, LSRr, RORi, RORr, VLD1LNdWB_register_Asm...
11969
39.4k
    return;
11970
0
    break;
11971
24.8k
  case 1:
11972
    // CDE_CX3A, CDE_VCX3A_vec, CDE_VCX3_vec, LDRD_POST, MLA, MLS, MVE_VCADDf...
11973
24.8k
    SStream_concat0(O, ", ");
11974
24.8k
    break;
11975
0
  case 2:
11976
    // CDE_CX3DA
11977
0
    printOperand(MI, 5, O);
11978
0
    return;
11979
0
    break;
11980
4.09k
  case 3:
11981
    // MCR, t2MCR, t2MCR2
11982
4.09k
    printCImmediate(MI, 3, O);
11983
4.09k
    SStream_concat0(O, ", ");
11984
4.09k
    printCImmediate(MI, 4, O);
11985
4.09k
    SStream_concat0(O, ", ");
11986
4.09k
    printOperand(MI, 5, O);
11987
4.09k
    return;
11988
0
    break;
11989
694
  case 4:
11990
    // MCRR, t2MCRR, t2MCRR2
11991
694
    printOperand(MI, 3, O);
11992
694
    SStream_concat0(O, ", ");
11993
694
    printCImmediate(MI, 4, O);
11994
694
    return;
11995
0
    break;
11996
4.53k
  case 5:
11997
    // MVE_VMOV_rr_q, VMULLslsv2i32, VMULLslsv4i16, VMULLsluv2i32, VMULLsluv4...
11998
4.53k
    printVectorIndex(MI, 3, O);
11999
4.53k
    break;
12000
484
  case 6:
12001
    // PKHBT, t2PKHBT
12002
484
    printPKHLSLShiftImm(MI, 3, O);
12003
484
    return;
12004
0
    break;
12005
1.03k
  case 7:
12006
    // PKHTB, t2PKHTB
12007
1.03k
    printPKHASRShiftImm(MI, 3, O);
12008
1.03k
    return;
12009
0
    break;
12010
611
  case 8:
12011
    // SXTAB, SXTAB16, SXTAH, UXTAB, UXTAB16, UXTAH, t2SXTAB, t2SXTAB16, t2SX...
12012
611
    printRotImmOperand(MI, 3, O);
12013
611
    return;
12014
0
    break;
12015
1.22k
  case 9:
12016
    // USAT, t2USAT
12017
1.22k
    printShiftImmOperand(MI, 3, O);
12018
1.22k
    return;
12019
0
    break;
12020
1.27k
  case 10:
12021
    // VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_UPD, VLD2LNq32_U...
12022
1.27k
    SStream_concat0(O, "]}, ");
12023
1.27k
    printAddrMode6Operand(MI, 3, O);
12024
1.27k
    printAddrMode6OffsetOperand(MI, 5, O);
12025
1.27k
    return;
12026
0
    break;
12027
137
  case 11:
12028
    // VLD3LNd16, VLD3LNd32, VLD3LNd8, VLD3LNq16, VLD3LNq32
12029
137
    SStream_concat0(O, "], ");
12030
137
    printOperand(MI, 2, O);
12031
137
    SStream_concat1(O, '[');
12032
137
    printNoHashImmediate(MI, 8, O);
12033
137
    SStream_concat0(O, "]}, ");
12034
137
    printAddrMode6Operand(MI, 3, O);
12035
137
    return;
12036
0
    break;
12037
3.08k
  case 12:
12038
    // VLD3d16, VLD3d16_UPD, VLD3d32, VLD3d32_UPD, VLD3d8, VLD3d8_UPD, VLD3q1...
12039
3.08k
    SStream_concat0(O, "}, ");
12040
3.08k
    break;
12041
8.18k
  case 13:
12042
    // VLD4LNd16, VLD4LNd32, VLD4LNd8, VLD4LNq16, VLD4LNq32, VST2LNd16, VST2L...
12043
8.18k
    SStream_concat1(O, '[');
12044
8.18k
    break;
12045
2.32k
  case 14:
12046
    // VMLALslsv2i32, VMLALslsv4i16, VMLALsluv2i32, VMLALsluv4i16, VMLAslfd, ...
12047
2.32k
    printVectorIndex(MI, 4, O);
12048
2.32k
    return;
12049
0
    break;
12050
1.28k
  case 15:
12051
    // VST1LNd16_UPD, VST1LNd32_UPD, VST1LNd8_UPD
12052
1.28k
    printAddrMode6OffsetOperand(MI, 3, O);
12053
1.28k
    return;
12054
0
    break;
12055
1.69k
  case 16:
12056
    // t2LDRD_POST, t2STRD_POST
12057
1.69k
    printT2AddrModeImm8s4OffsetOperand(MI, 4, O);
12058
1.69k
    return;
12059
0
    break;
12060
95.0k
  }
12061
12062
40.6k
  switch (MCInst_getOpcode(MI)) {
12063
0
  default: CS_ASSERT_RET(0 && "Unexpected opcode.");
12064
0
  case ARM_CDE_CX3A:
12065
0
  case ARM_CDE_VCX3A_vec:
12066
0
  case ARM_CDE_VCX3_vec:
12067
1.16k
  case ARM_LDRD_POST:
12068
1.51k
  case ARM_MLA:
12069
1.61k
  case ARM_MLS:
12070
1.68k
  case ARM_MVE_VCADDf16:
12071
1.75k
  case ARM_MVE_VCADDf32:
12072
1.79k
  case ARM_MVE_VCADDi16:
12073
1.83k
  case ARM_MVE_VCADDi32:
12074
2.12k
  case ARM_MVE_VCADDi8:
12075
2.22k
  case ARM_MVE_VCMLAf16:
12076
2.82k
  case ARM_MVE_VCMLAf32:
12077
3.12k
  case ARM_MVE_VCMULf16:
12078
3.37k
  case ARM_MVE_VCMULf32:
12079
3.87k
  case ARM_MVE_VDWDUPu16:
12080
4.09k
  case ARM_MVE_VDWDUPu32:
12081
4.34k
  case ARM_MVE_VDWDUPu8:
12082
4.42k
  case ARM_MVE_VHCADDs16:
12083
4.59k
  case ARM_MVE_VHCADDs32:
12084
4.89k
  case ARM_MVE_VHCADDs8:
12085
4.96k
  case ARM_MVE_VIWDUPu16:
12086
5.03k
  case ARM_MVE_VIWDUPu32:
12087
5.19k
  case ARM_MVE_VIWDUPu8:
12088
5.19k
  case ARM_MVE_VMLALDAVas16:
12089
5.19k
  case ARM_MVE_VMLALDAVas32:
12090
5.19k
  case ARM_MVE_VMLALDAVau16:
12091
5.19k
  case ARM_MVE_VMLALDAVau32:
12092
5.19k
  case ARM_MVE_VMLALDAVaxs16:
12093
6.36k
  case ARM_MVE_VMLALDAVaxs32:
12094
6.36k
  case ARM_MVE_VMLALDAVs16:
12095
6.36k
  case ARM_MVE_VMLALDAVs32:
12096
6.36k
  case ARM_MVE_VMLALDAVu16:
12097
6.36k
  case ARM_MVE_VMLALDAVu32:
12098
6.56k
  case ARM_MVE_VMLALDAVxs16:
12099
6.81k
  case ARM_MVE_VMLALDAVxs32:
12100
6.82k
  case ARM_MVE_VMLSLDAVas16:
12101
6.82k
  case ARM_MVE_VMLSLDAVas32:
12102
6.82k
  case ARM_MVE_VMLSLDAVaxs16:
12103
6.83k
  case ARM_MVE_VMLSLDAVaxs32:
12104
6.91k
  case ARM_MVE_VMLSLDAVs16:
12105
6.99k
  case ARM_MVE_VMLSLDAVs32:
12106
7.22k
  case ARM_MVE_VMLSLDAVxs16:
12107
7.32k
  case ARM_MVE_VMLSLDAVxs32:
12108
7.32k
  case ARM_MVE_VRMLALDAVHas32:
12109
7.32k
  case ARM_MVE_VRMLALDAVHau32:
12110
7.34k
  case ARM_MVE_VRMLALDAVHaxs32:
12111
7.34k
  case ARM_MVE_VRMLALDAVHs32:
12112
7.34k
  case ARM_MVE_VRMLALDAVHu32:
12113
7.54k
  case ARM_MVE_VRMLALDAVHxs32:
12114
7.55k
  case ARM_MVE_VRMLSLDAVHas32:
12115
7.56k
  case ARM_MVE_VRMLSLDAVHaxs32:
12116
7.73k
  case ARM_MVE_VRMLSLDAVHs32:
12117
7.86k
  case ARM_MVE_VRMLSLDAVHxs32:
12118
8.08k
  case ARM_SBFX:
12119
8.37k
  case ARM_SMLABB:
12120
8.60k
  case ARM_SMLABT:
12121
9.05k
  case ARM_SMLAD:
12122
9.25k
  case ARM_SMLADX:
12123
9.33k
  case ARM_SMLALBB:
12124
9.78k
  case ARM_SMLALBT:
12125
9.86k
  case ARM_SMLALD:
12126
9.96k
  case ARM_SMLALDX:
12127
10.0k
  case ARM_SMLALTB:
12128
10.3k
  case ARM_SMLALTT:
12129
10.6k
  case ARM_SMLATB:
12130
11.0k
  case ARM_SMLATT:
12131
11.1k
  case ARM_SMLAWB:
12132
11.1k
  case ARM_SMLAWT:
12133
11.2k
  case ARM_SMLSD:
12134
11.4k
  case ARM_SMLSDX:
12135
11.5k
  case ARM_SMLSLD:
12136
11.7k
  case ARM_SMLSLDX:
12137
11.8k
  case ARM_SMMLA:
12138
11.8k
  case ARM_SMMLAR:
12139
12.0k
  case ARM_SMMLS:
12140
12.2k
  case ARM_SMMLSR:
12141
12.3k
  case ARM_SMULL:
12142
13.4k
  case ARM_STRD_POST:
12143
13.5k
  case ARM_UBFX:
12144
13.7k
  case ARM_UMAAL:
12145
14.2k
  case ARM_UMULL:
12146
14.2k
  case ARM_USADA8:
12147
14.3k
  case ARM_VEXTd16:
12148
14.4k
  case ARM_VEXTd32:
12149
14.9k
  case ARM_VEXTd8:
12150
14.9k
  case ARM_VEXTq16:
12151
15.0k
  case ARM_VEXTq32:
12152
15.0k
  case ARM_VEXTq64:
12153
15.2k
  case ARM_VEXTq8:
12154
15.2k
  case ARM_VLD3d16:
12155
15.4k
  case ARM_VLD3d32:
12156
15.4k
  case ARM_VLD3d8:
12157
15.6k
  case ARM_VLD3q16:
12158
15.7k
  case ARM_VLD3q32:
12159
15.7k
  case ARM_VLD3q8:
12160
16.1k
  case ARM_VMOVRRS:
12161
16.3k
  case ARM_VMOVSRR:
12162
16.4k
  case ARM_VST3d16:
12163
16.6k
  case ARM_VST3d32:
12164
16.7k
  case ARM_VST3d8:
12165
16.8k
  case ARM_VST3q16:
12166
17.4k
  case ARM_VST3q32:
12167
17.6k
  case ARM_VST3q8:
12168
17.8k
  case ARM_t2MLA:
12169
17.9k
  case ARM_t2MLS:
12170
18.2k
  case ARM_t2SBFX:
12171
18.3k
  case ARM_t2SMLABB:
12172
18.4k
  case ARM_t2SMLABT:
12173
18.7k
  case ARM_t2SMLAD:
12174
18.7k
  case ARM_t2SMLADX:
12175
18.8k
  case ARM_t2SMLAL:
12176
18.8k
  case ARM_t2SMLALBB:
12177
18.9k
  case ARM_t2SMLALBT:
12178
19.0k
  case ARM_t2SMLALD:
12179
19.1k
  case ARM_t2SMLALDX:
12180
19.2k
  case ARM_t2SMLALTB:
12181
19.3k
  case ARM_t2SMLALTT:
12182
19.5k
  case ARM_t2SMLATB:
12183
19.5k
  case ARM_t2SMLATT:
12184
19.7k
  case ARM_t2SMLAWB:
12185
20.0k
  case ARM_t2SMLAWT:
12186
20.2k
  case ARM_t2SMLSD:
12187
20.3k
  case ARM_t2SMLSDX:
12188
20.4k
  case ARM_t2SMLSLD:
12189
20.5k
  case ARM_t2SMLSLDX:
12190
20.8k
  case ARM_t2SMMLA:
12191
21.3k
  case ARM_t2SMMLAR:
12192
21.7k
  case ARM_t2SMMLS:
12193
21.8k
  case ARM_t2SMMLSR:
12194
21.9k
  case ARM_t2SMULL:
12195
22.0k
  case ARM_t2STLEXD:
12196
22.1k
  case ARM_t2STREXD:
12197
22.6k
  case ARM_t2UBFX:
12198
22.8k
  case ARM_t2UMAAL:
12199
22.9k
  case ARM_t2UMLAL:
12200
23.0k
  case ARM_t2UMULL:
12201
23.1k
  case ARM_t2USADA8:
12202
23.1k
    switch (MCInst_getOpcode(MI)) {
12203
0
    default: CS_ASSERT_RET(0 && "Unexpected opcode.");
12204
0
    case ARM_CDE_CX3A:
12205
0
    case ARM_CDE_VCX3A_vec:
12206
0
    case ARM_MVE_VMLALDAVas16:
12207
0
    case ARM_MVE_VMLALDAVas32:
12208
0
    case ARM_MVE_VMLALDAVau16:
12209
0
    case ARM_MVE_VMLALDAVau32:
12210
0
    case ARM_MVE_VMLALDAVaxs16:
12211
1.16k
    case ARM_MVE_VMLALDAVaxs32:
12212
1.16k
    case ARM_MVE_VMLSLDAVas16:
12213
1.17k
    case ARM_MVE_VMLSLDAVas32:
12214
1.17k
    case ARM_MVE_VMLSLDAVaxs16:
12215
1.17k
    case ARM_MVE_VMLSLDAVaxs32:
12216
1.17k
    case ARM_MVE_VRMLALDAVHas32:
12217
1.17k
    case ARM_MVE_VRMLALDAVHau32:
12218
1.19k
    case ARM_MVE_VRMLALDAVHaxs32:
12219
1.20k
    case ARM_MVE_VRMLSLDAVHas32:
12220
1.21k
    case ARM_MVE_VRMLSLDAVHaxs32:
12221
1.21k
      printOperand(MI, 5, O);
12222
1.21k
      break;
12223
0
    case ARM_CDE_VCX3_vec:
12224
506
    case ARM_MVE_VDWDUPu16:
12225
724
    case ARM_MVE_VDWDUPu32:
12226
971
    case ARM_MVE_VDWDUPu8:
12227
1.04k
    case ARM_MVE_VIWDUPu16:
12228
1.11k
    case ARM_MVE_VIWDUPu32:
12229
1.27k
    case ARM_MVE_VIWDUPu8:
12230
1.27k
      printOperand(MI, 4, O);
12231
1.27k
      break;
12232
1.16k
    case ARM_LDRD_POST:
12233
2.26k
    case ARM_STRD_POST:
12234
2.26k
      printAddrMode3OffsetOperand(MI, 4, O);
12235
2.26k
      break;
12236
347
    case ARM_MLA:
12237
448
    case ARM_MLS:
12238
448
    case ARM_MVE_VMLALDAVs16:
12239
448
    case ARM_MVE_VMLALDAVs32:
12240
448
    case ARM_MVE_VMLALDAVu16:
12241
448
    case ARM_MVE_VMLALDAVu32:
12242
647
    case ARM_MVE_VMLALDAVxs16:
12243
906
    case ARM_MVE_VMLALDAVxs32:
12244
993
    case ARM_MVE_VMLSLDAVs16:
12245
1.06k
    case ARM_MVE_VMLSLDAVs32:
12246
1.30k
    case ARM_MVE_VMLSLDAVxs16:
12247
1.39k
    case ARM_MVE_VMLSLDAVxs32:
12248
1.39k
    case ARM_MVE_VRMLALDAVHs32:
12249
1.39k
    case ARM_MVE_VRMLALDAVHu32:
12250
1.60k
    case ARM_MVE_VRMLALDAVHxs32:
12251
1.76k
    case ARM_MVE_VRMLSLDAVHs32:
12252
1.89k
    case ARM_MVE_VRMLSLDAVHxs32:
12253
2.18k
    case ARM_SMLABB:
12254
2.41k
    case ARM_SMLABT:
12255
2.86k
    case ARM_SMLAD:
12256
3.06k
    case ARM_SMLADX:
12257
3.14k
    case ARM_SMLALBB:
12258
3.60k
    case ARM_SMLALBT:
12259
3.68k
    case ARM_SMLALD:
12260
3.77k
    case ARM_SMLALDX:
12261
3.86k
    case ARM_SMLALTB:
12262
4.18k
    case ARM_SMLALTT:
12263
4.46k
    case ARM_SMLATB:
12264
4.83k
    case ARM_SMLATT:
12265
4.91k
    case ARM_SMLAWB:
12266
4.98k
    case ARM_SMLAWT:
12267
5.07k
    case ARM_SMLSD:
12268
5.30k
    case ARM_SMLSDX:
12269
5.33k
    case ARM_SMLSLD:
12270
5.54k
    case ARM_SMLSLDX:
12271
5.61k
    case ARM_SMMLA:
12272
5.67k
    case ARM_SMMLAR:
12273
5.89k
    case ARM_SMMLS:
12274
6.08k
    case ARM_SMMLSR:
12275
6.17k
    case ARM_SMULL:
12276
6.39k
    case ARM_UMAAL:
12277
6.86k
    case ARM_UMULL:
12278
6.89k
    case ARM_USADA8:
12279
7.00k
    case ARM_VEXTd16:
12280
7.11k
    case ARM_VEXTd32:
12281
7.56k
    case ARM_VEXTd8:
12282
7.61k
    case ARM_VEXTq16:
12283
7.67k
    case ARM_VEXTq32:
12284
7.72k
    case ARM_VEXTq64:
12285
7.84k
    case ARM_VEXTq8:
12286
8.17k
    case ARM_VMOVRRS:
12287
8.41k
    case ARM_VMOVSRR:
12288
8.56k
    case ARM_t2MLA:
12289
8.71k
    case ARM_t2MLS:
12290
8.82k
    case ARM_t2SMLABB:
12291
8.95k
    case ARM_t2SMLABT:
12292
9.21k
    case ARM_t2SMLAD:
12293
9.24k
    case ARM_t2SMLADX:
12294
9.35k
    case ARM_t2SMLAL:
12295
9.37k
    case ARM_t2SMLALBB:
12296
9.47k
    case ARM_t2SMLALBT:
12297
9.58k
    case ARM_t2SMLALD:
12298
9.63k
    case ARM_t2SMLALDX:
12299
9.70k
    case ARM_t2SMLALTB:
12300
9.80k
    case ARM_t2SMLALTT:
12301
10.0k
    case ARM_t2SMLATB:
12302
10.0k
    case ARM_t2SMLATT:
12303
10.2k
    case ARM_t2SMLAWB:
12304
10.5k
    case ARM_t2SMLAWT:
12305
10.7k
    case ARM_t2SMLSD:
12306
10.8k
    case ARM_t2SMLSDX:
12307
10.9k
    case ARM_t2SMLSLD:
12308
11.0k
    case ARM_t2SMLSLDX:
12309
11.3k
    case ARM_t2SMMLA:
12310
11.8k
    case ARM_t2SMMLAR:
12311
12.2k
    case ARM_t2SMMLS:
12312
12.3k
    case ARM_t2SMMLSR:
12313
12.4k
    case ARM_t2SMULL:
12314
12.6k
    case ARM_t2UMAAL:
12315
12.7k
    case ARM_t2UMLAL:
12316
12.8k
    case ARM_t2UMULL:
12317
12.9k
    case ARM_t2USADA8:
12318
12.9k
      printOperand(MI, 3, O);
12319
12.9k
      break;
12320
77
    case ARM_MVE_VCADDf16:
12321
146
    case ARM_MVE_VCADDf32:
12322
184
    case ARM_MVE_VCADDi16:
12323
224
    case ARM_MVE_VCADDi32:
12324
509
    case ARM_MVE_VCADDi8:
12325
594
    case ARM_MVE_VHCADDs16:
12326
765
    case ARM_MVE_VHCADDs32:
12327
1.05k
    case ARM_MVE_VHCADDs8:
12328
1.05k
      printComplexRotationOp_180_90(MI, 3, O);
12329
1.05k
      break;
12330
101
    case ARM_MVE_VCMLAf16:
12331
709
    case ARM_MVE_VCMLAf32:
12332
709
      printComplexRotationOp_90_0(MI, 4, O);
12333
709
      break;
12334
292
    case ARM_MVE_VCMULf16:
12335
542
    case ARM_MVE_VCMULf32:
12336
542
      printComplexRotationOp_90_0(MI, 3, O);
12337
542
      break;
12338
222
    case ARM_SBFX:
12339
308
    case ARM_UBFX:
12340
540
    case ARM_t2SBFX:
12341
1.00k
    case ARM_t2UBFX:
12342
1.00k
      printImmPlusOneOperand(MI, 3, O);
12343
1.00k
      break;
12344
80
    case ARM_VLD3d16:
12345
221
    case ARM_VLD3d32:
12346
269
    case ARM_VLD3d8:
12347
398
    case ARM_VLD3q16:
12348
492
    case ARM_VLD3q32:
12349
568
    case ARM_VLD3q8:
12350
568
      printAddrMode6Operand(MI, 3, O);
12351
568
      break;
12352
140
    case ARM_VST3d16:
12353
250
    case ARM_VST3d32:
12354
379
    case ARM_VST3d8:
12355
462
    case ARM_VST3q16:
12356
1.12k
    case ARM_VST3q32:
12357
1.33k
    case ARM_VST3q8:
12358
1.33k
      printAddrMode6Operand(MI, 0, O);
12359
1.33k
      break;
12360
96
    case ARM_t2STLEXD:
12361
221
    case ARM_t2STREXD:
12362
221
      printAddrMode7Operand(MI, 3, O);
12363
221
      break;
12364
23.1k
    }
12365
23.1k
    return;
12366
23.1k
    break;
12367
23.1k
  case ARM_MVE_VMOV_rr_q:
12368
0
    SStream_concat0(O, ", ");
12369
0
    printOperand(MI, 2, O);
12370
0
    printVectorIndex(MI, 4, O);
12371
0
    return;
12372
0
    break;
12373
126
  case ARM_VLD3d16_UPD:
12374
369
  case ARM_VLD3d32_UPD:
12375
740
  case ARM_VLD3d8_UPD:
12376
812
  case ARM_VLD3q16_UPD:
12377
864
  case ARM_VLD3q32_UPD:
12378
1.18k
  case ARM_VLD3q8_UPD:
12379
1.18k
    printAddrMode6Operand(MI, 4, O);
12380
1.18k
    printAddrMode6OffsetOperand(MI, 6, O);
12381
1.18k
    return;
12382
0
    break;
12383
389
  case ARM_VLD4LNd16:
12384
486
  case ARM_VLD4LNd32:
12385
1.18k
  case ARM_VLD4LNd8:
12386
1.27k
  case ARM_VLD4LNq16:
12387
1.65k
  case ARM_VLD4LNq32:
12388
1.65k
    printNoHashImmediate(MI, 10, O);
12389
1.65k
    SStream_concat0(O, "]}, ");
12390
1.65k
    printAddrMode6Operand(MI, 4, O);
12391
1.65k
    return;
12392
0
    break;
12393
333
  case ARM_VLD4d16:
12394
469
  case ARM_VLD4d32:
12395
717
  case ARM_VLD4d8:
12396
812
  case ARM_VLD4q16:
12397
1.02k
  case ARM_VLD4q32:
12398
1.10k
  case ARM_VLD4q8:
12399
1.10k
    printOperand(MI, 3, O);
12400
1.10k
    SStream_concat0(O, "}, ");
12401
1.10k
    printAddrMode6Operand(MI, 4, O);
12402
1.10k
    return;
12403
0
    break;
12404
412
  case ARM_VLD4d16_UPD:
12405
603
  case ARM_VLD4d32_UPD:
12406
1.07k
  case ARM_VLD4d8_UPD:
12407
1.25k
  case ARM_VLD4q16_UPD:
12408
1.36k
  case ARM_VLD4q32_UPD:
12409
1.51k
  case ARM_VLD4q8_UPD:
12410
1.51k
    printOperand(MI, 3, O);
12411
1.51k
    SStream_concat0(O, "}, ");
12412
1.51k
    printAddrMode6Operand(MI, 5, O);
12413
1.51k
    printAddrMode6OffsetOperand(MI, 7, O);
12414
1.51k
    return;
12415
0
    break;
12416
185
  case ARM_VMULLslsv2i32:
12417
526
  case ARM_VMULLslsv4i16:
12418
597
  case ARM_VMULLsluv2i32:
12419
770
  case ARM_VMULLsluv4i16:
12420
851
  case ARM_VMULslfd:
12421
967
  case ARM_VMULslfq:
12422
1.24k
  case ARM_VMULslhd:
12423
1.53k
  case ARM_VMULslhq:
12424
2.00k
  case ARM_VMULslv2i32:
12425
2.58k
  case ARM_VMULslv4i16:
12426
2.81k
  case ARM_VMULslv4i32:
12427
2.88k
  case ARM_VMULslv8i16:
12428
2.92k
  case ARM_VQDMULHslv2i32:
12429
3.01k
  case ARM_VQDMULHslv4i16:
12430
3.32k
  case ARM_VQDMULHslv4i32:
12431
3.39k
  case ARM_VQDMULHslv8i16:
12432
3.54k
  case ARM_VQDMULLslv2i32:
12433
3.67k
  case ARM_VQDMULLslv4i16:
12434
4.15k
  case ARM_VQRDMULHslv2i32:
12435
4.22k
  case ARM_VQRDMULHslv4i16:
12436
4.45k
  case ARM_VQRDMULHslv4i32:
12437
4.53k
  case ARM_VQRDMULHslv8i16:
12438
4.53k
    return;
12439
0
    break;
12440
198
  case ARM_VST2LNd16:
12441
668
  case ARM_VST2LNd32:
12442
1.24k
  case ARM_VST2LNd8:
12443
1.46k
  case ARM_VST2LNq16:
12444
1.56k
  case ARM_VST2LNq32:
12445
1.56k
    printNoHashImmediate(MI, 4, O);
12446
1.56k
    SStream_concat0(O, "]}, ");
12447
1.56k
    printAddrMode6Operand(MI, 0, O);
12448
1.56k
    return;
12449
0
    break;
12450
391
  case ARM_VST2LNd16_UPD:
12451
707
  case ARM_VST2LNd32_UPD:
12452
2.22k
  case ARM_VST2LNd8_UPD:
12453
2.62k
  case ARM_VST2LNq16_UPD:
12454
2.87k
  case ARM_VST2LNq32_UPD:
12455
2.87k
    printNoHashImmediate(MI, 6, O);
12456
2.87k
    SStream_concat0(O, "]}, ");
12457
2.87k
    printAddrMode6Operand(MI, 1, O);
12458
2.87k
    printAddrMode6OffsetOperand(MI, 3, O);
12459
2.87k
    return;
12460
0
    break;
12461
260
  case ARM_VST3LNd16:
12462
461
  case ARM_VST3LNd32:
12463
734
  case ARM_VST3LNd8:
12464
801
  case ARM_VST3LNq16:
12465
1.08k
  case ARM_VST3LNq32:
12466
1.08k
    printNoHashImmediate(MI, 5, O);
12467
1.08k
    SStream_concat0(O, "], ");
12468
1.08k
    printOperand(MI, 4, O);
12469
1.08k
    SStream_concat1(O, '[');
12470
1.08k
    printNoHashImmediate(MI, 5, O);
12471
1.08k
    SStream_concat0(O, "]}, ");
12472
1.08k
    printAddrMode6Operand(MI, 0, O);
12473
1.08k
    return;
12474
0
    break;
12475
698
  case ARM_VST4LNd16:
12476
765
  case ARM_VST4LNd32:
12477
831
  case ARM_VST4LNd8:
12478
949
  case ARM_VST4LNq16:
12479
1.00k
  case ARM_VST4LNq32:
12480
1.00k
    printNoHashImmediate(MI, 6, O);
12481
1.00k
    SStream_concat0(O, "], ");
12482
1.00k
    printOperand(MI, 4, O);
12483
1.00k
    SStream_concat1(O, '[');
12484
1.00k
    printNoHashImmediate(MI, 6, O);
12485
1.00k
    SStream_concat0(O, "], ");
12486
1.00k
    printOperand(MI, 5, O);
12487
1.00k
    SStream_concat1(O, '[');
12488
1.00k
    printNoHashImmediate(MI, 6, O);
12489
1.00k
    SStream_concat0(O, "]}, ");
12490
1.00k
    printAddrMode6Operand(MI, 0, O);
12491
1.00k
    return;
12492
0
    break;
12493
313
  case ARM_VST4d16:
12494
388
  case ARM_VST4d32:
12495
502
  case ARM_VST4d8:
12496
600
  case ARM_VST4q16:
12497
806
  case ARM_VST4q32:
12498
1.02k
  case ARM_VST4q8:
12499
1.02k
    printOperand(MI, 5, O);
12500
1.02k
    SStream_concat0(O, "}, ");
12501
1.02k
    printAddrMode6Operand(MI, 0, O);
12502
1.02k
    return;
12503
0
    break;
12504
40.6k
  }
12505
40.6k
}
12506
12507
12508
/// getRegisterName - This method is automatically generated by tblgen
12509
/// from the register set description.  This returns the assembler name
12510
/// for the specified register.
12511
static const char *
12512
4.03M
getRegisterName(unsigned RegNo, unsigned AltIdx) {
12513
4.03M
#ifndef CAPSTONE_DIET
12514
4.03M
  CS_ASSERT_RET_VAL(RegNo && RegNo < 296 && "Invalid register number!", NULL);
12515
12516
4.03M
  static const char AsmStrsNoRegAltName[] = {
12517
4.03M
  /* 0 */ "D4_D6_D8_D10\0"
12518
4.03M
  /* 13 */ "D7_D8_D9_D10\0"
12519
4.03M
  /* 26 */ "Q7_Q8_Q9_Q10\0"
12520
4.03M
  /* 39 */ "d10\0"
12521
4.03M
  /* 43 */ "q10\0"
12522
4.03M
  /* 47 */ "r10\0"
12523
4.03M
  /* 51 */ "s10\0"
12524
4.03M
  /* 55 */ "D14_D16_D18_D20\0"
12525
4.03M
  /* 71 */ "D17_D18_D19_D20\0"
12526
4.03M
  /* 87 */ "d20\0"
12527
4.03M
  /* 91 */ "s20\0"
12528
4.03M
  /* 95 */ "D24_D26_D28_D30\0"
12529
4.03M
  /* 111 */ "D27_D28_D29_D30\0"
12530
4.03M
  /* 127 */ "d30\0"
12531
4.03M
  /* 131 */ "s30\0"
12532
4.03M
  /* 135 */ "d0\0"
12533
4.03M
  /* 138 */ "p0\0"
12534
4.03M
  /* 141 */ "q0\0"
12535
4.03M
  /* 144 */ "mvfr0\0"
12536
4.03M
  /* 150 */ "s0\0"
12537
4.03M
  /* 153 */ "D9_D10_D11\0"
12538
4.03M
  /* 164 */ "D5_D7_D9_D11\0"
12539
4.03M
  /* 177 */ "Q8_Q9_Q10_Q11\0"
12540
4.03M
  /* 191 */ "R10_R11\0"
12541
4.03M
  /* 199 */ "d11\0"
12542
4.03M
  /* 203 */ "q11\0"
12543
4.03M
  /* 207 */ "r11\0"
12544
4.03M
  /* 211 */ "s11\0"
12545
4.03M
  /* 215 */ "D19_D20_D21\0"
12546
4.03M
  /* 227 */ "D15_D17_D19_D21\0"
12547
4.03M
  /* 243 */ "d21\0"
12548
4.03M
  /* 247 */ "s21\0"
12549
4.03M
  /* 251 */ "D29_D30_D31\0"
12550
4.03M
  /* 263 */ "D25_D27_D29_D31\0"
12551
4.03M
  /* 279 */ "d31\0"
12552
4.03M
  /* 283 */ "s31\0"
12553
4.03M
  /* 287 */ "Q0_Q1\0"
12554
4.03M
  /* 293 */ "R0_R1\0"
12555
4.03M
  /* 299 */ "d1\0"
12556
4.03M
  /* 302 */ "q1\0"
12557
4.03M
  /* 305 */ "mvfr1\0"
12558
4.03M
  /* 311 */ "s1\0"
12559
4.03M
  /* 314 */ "D6_D8_D10_D12\0"
12560
4.03M
  /* 328 */ "D9_D10_D11_D12\0"
12561
4.03M
  /* 343 */ "Q9_Q10_Q11_Q12\0"
12562
4.03M
  /* 358 */ "d12\0"
12563
4.03M
  /* 362 */ "q12\0"
12564
4.03M
  /* 366 */ "r12\0"
12565
4.03M
  /* 370 */ "s12\0"
12566
4.03M
  /* 374 */ "D16_D18_D20_D22\0"
12567
4.03M
  /* 390 */ "D19_D20_D21_D22\0"
12568
4.03M
  /* 406 */ "d22\0"
12569
4.03M
  /* 410 */ "s22\0"
12570
4.03M
  /* 414 */ "D0_D2\0"
12571
4.03M
  /* 420 */ "D0_D1_D2\0"
12572
4.03M
  /* 429 */ "Q1_Q2\0"
12573
4.03M
  /* 435 */ "d2\0"
12574
4.03M
  /* 438 */ "q2\0"
12575
4.03M
  /* 441 */ "mvfr2\0"
12576
4.03M
  /* 447 */ "s2\0"
12577
4.03M
  /* 450 */ "fpinst2\0"
12578
4.03M
  /* 458 */ "D7_D9_D11_D13\0"
12579
4.03M
  /* 472 */ "D11_D12_D13\0"
12580
4.03M
  /* 484 */ "Q10_Q11_Q12_Q13\0"
12581
4.03M
  /* 500 */ "d13\0"
12582
4.03M
  /* 504 */ "q13\0"
12583
4.03M
  /* 508 */ "s13\0"
12584
4.03M
  /* 512 */ "D17_D19_D21_D23\0"
12585
4.03M
  /* 528 */ "D21_D22_D23\0"
12586
4.03M
  /* 540 */ "d23\0"
12587
4.03M
  /* 544 */ "s23\0"
12588
4.03M
  /* 548 */ "D1_D3\0"
12589
4.03M
  /* 554 */ "D1_D2_D3\0"
12590
4.03M
  /* 563 */ "Q0_Q1_Q2_Q3\0"
12591
4.03M
  /* 575 */ "R2_R3\0"
12592
4.03M
  /* 581 */ "d3\0"
12593
4.03M
  /* 584 */ "q3\0"
12594
4.03M
  /* 587 */ "r3\0"
12595
4.03M
  /* 590 */ "s3\0"
12596
4.03M
  /* 593 */ "D8_D10_D12_D14\0"
12597
4.03M
  /* 608 */ "D11_D12_D13_D14\0"
12598
4.03M
  /* 624 */ "Q11_Q12_Q13_Q14\0"
12599
4.03M
  /* 640 */ "d14\0"
12600
4.03M
  /* 644 */ "q14\0"
12601
4.03M
  /* 648 */ "s14\0"
12602
4.03M
  /* 652 */ "D18_D20_D22_D24\0"
12603
4.03M
  /* 668 */ "D21_D22_D23_D24\0"
12604
4.03M
  /* 684 */ "d24\0"
12605
4.03M
  /* 688 */ "s24\0"
12606
4.03M
  /* 692 */ "D0_D2_D4\0"
12607
4.03M
  /* 701 */ "D1_D2_D3_D4\0"
12608
4.03M
  /* 713 */ "Q1_Q2_Q3_Q4\0"
12609
4.03M
  /* 725 */ "d4\0"
12610
4.03M
  /* 728 */ "q4\0"
12611
4.03M
  /* 731 */ "r4\0"
12612
4.03M
  /* 734 */ "s4\0"
12613
4.03M
  /* 737 */ "D9_D11_D13_D15\0"
12614
4.03M
  /* 752 */ "D13_D14_D15\0"
12615
4.03M
  /* 764 */ "Q12_Q13_Q14_Q15\0"
12616
4.03M
  /* 780 */ "d15\0"
12617
4.03M
  /* 784 */ "q15\0"
12618
4.03M
  /* 788 */ "s15\0"
12619
4.03M
  /* 792 */ "D19_D21_D23_D25\0"
12620
4.03M
  /* 808 */ "D23_D24_D25\0"
12621
4.03M
  /* 820 */ "d25\0"
12622
4.03M
  /* 824 */ "s25\0"
12623
4.03M
  /* 828 */ "D1_D3_D5\0"
12624
4.03M
  /* 837 */ "D3_D4_D5\0"
12625
4.03M
  /* 846 */ "Q2_Q3_Q4_Q5\0"
12626
4.03M
  /* 858 */ "R4_R5\0"
12627
4.03M
  /* 864 */ "d5\0"
12628
4.03M
  /* 867 */ "q5\0"
12629
4.03M
  /* 870 */ "r5\0"
12630
4.03M
  /* 873 */ "s5\0"
12631
4.03M
  /* 876 */ "D10_D12_D14_D16\0"
12632
4.03M
  /* 892 */ "D13_D14_D15_D16\0"
12633
4.03M
  /* 908 */ "d16\0"
12634
4.03M
  /* 912 */ "s16\0"
12635
4.03M
  /* 916 */ "D20_D22_D24_D26\0"
12636
4.03M
  /* 932 */ "D23_D24_D25_D26\0"
12637
4.03M
  /* 948 */ "d26\0"
12638
4.03M
  /* 952 */ "s26\0"
12639
4.03M
  /* 956 */ "D0_D2_D4_D6\0"
12640
4.03M
  /* 968 */ "D3_D4_D5_D6\0"
12641
4.03M
  /* 980 */ "Q3_Q4_Q5_Q6\0"
12642
4.03M
  /* 992 */ "d6\0"
12643
4.03M
  /* 995 */ "q6\0"
12644
4.03M
  /* 998 */ "r6\0"
12645
4.03M
  /* 1001 */ "s6\0"
12646
4.03M
  /* 1004 */ "D11_D13_D15_D17\0"
12647
4.03M
  /* 1020 */ "D15_D16_D17\0"
12648
4.03M
  /* 1032 */ "d17\0"
12649
4.03M
  /* 1036 */ "s17\0"
12650
4.03M
  /* 1040 */ "D21_D23_D25_D27\0"
12651
4.03M
  /* 1056 */ "D25_D26_D27\0"
12652
4.03M
  /* 1068 */ "d27\0"
12653
4.03M
  /* 1072 */ "s27\0"
12654
4.03M
  /* 1076 */ "D1_D3_D5_D7\0"
12655
4.03M
  /* 1088 */ "D5_D6_D7\0"
12656
4.03M
  /* 1097 */ "Q4_Q5_Q6_Q7\0"
12657
4.03M
  /* 1109 */ "R6_R7\0"
12658
4.03M
  /* 1115 */ "d7\0"
12659
4.03M
  /* 1118 */ "q7\0"
12660
4.03M
  /* 1121 */ "r7\0"
12661
4.03M
  /* 1124 */ "s7\0"
12662
4.03M
  /* 1127 */ "D12_D14_D16_D18\0"
12663
4.03M
  /* 1143 */ "D15_D16_D17_D18\0"
12664
4.03M
  /* 1159 */ "d18\0"
12665
4.03M
  /* 1163 */ "s18\0"
12666
4.03M
  /* 1167 */ "D22_D24_D26_D28\0"
12667
4.03M
  /* 1183 */ "D25_D26_D27_D28\0"
12668
4.03M
  /* 1199 */ "d28\0"
12669
4.03M
  /* 1203 */ "s28\0"
12670
4.03M
  /* 1207 */ "D2_D4_D6_D8\0"
12671
4.03M
  /* 1219 */ "D5_D6_D7_D8\0"
12672
4.03M
  /* 1231 */ "Q5_Q6_Q7_Q8\0"
12673
4.03M
  /* 1243 */ "d8\0"
12674
4.03M
  /* 1246 */ "q8\0"
12675
4.03M
  /* 1249 */ "r8\0"
12676
4.03M
  /* 1252 */ "s8\0"
12677
4.03M
  /* 1255 */ "D13_D15_D17_D19\0"
12678
4.03M
  /* 1271 */ "D17_D18_D19\0"
12679
4.03M
  /* 1283 */ "d19\0"
12680
4.03M
  /* 1287 */ "s19\0"
12681
4.03M
  /* 1291 */ "D23_D25_D27_D29\0"
12682
4.03M
  /* 1307 */ "D27_D28_D29\0"
12683
4.03M
  /* 1319 */ "d29\0"
12684
4.03M
  /* 1323 */ "s29\0"
12685
4.03M
  /* 1327 */ "D3_D5_D7_D9\0"
12686
4.03M
  /* 1339 */ "D7_D8_D9\0"
12687
4.03M
  /* 1348 */ "Q6_Q7_Q8_Q9\0"
12688
4.03M
  /* 1360 */ "R8_R9\0"
12689
4.03M
  /* 1366 */ "d9\0"
12690
4.03M
  /* 1369 */ "q9\0"
12691
4.03M
  /* 1372 */ "r9\0"
12692
4.03M
  /* 1375 */ "s9\0"
12693
4.03M
  /* 1378 */ "R12_SP\0"
12694
4.03M
  /* 1385 */ "pc\0"
12695
4.03M
  /* 1388 */ "fpscr_nzcvqc\0"
12696
4.03M
  /* 1401 */ "fpexc\0"
12697
4.03M
  /* 1407 */ "fpsid\0"
12698
4.03M
  /* 1413 */ "ra_auth_code\0"
12699
4.03M
  /* 1426 */ "itstate\0"
12700
4.03M
  /* 1434 */ "sp\0"
12701
4.03M
  /* 1437 */ "fpscr\0"
12702
4.03M
  /* 1443 */ "lr\0"
12703
4.03M
  /* 1446 */ "vpr\0"
12704
4.03M
  /* 1450 */ "apsr\0"
12705
4.03M
  /* 1455 */ "cpsr\0"
12706
4.03M
  /* 1460 */ "spsr\0"
12707
4.03M
  /* 1465 */ "zr\0"
12708
4.03M
  /* 1468 */ "fpcxtns\0"
12709
4.03M
  /* 1476 */ "fpcxts\0"
12710
4.03M
  /* 1483 */ "fpinst\0"
12711
4.03M
  /* 1490 */ "fpscr_nzcv\0"
12712
4.03M
  /* 1501 */ "apsr_nzcv\0"
12713
4.03M
};
12714
4.03M
  static const uint16_t RegAsmOffsetNoRegAltName[] = {
12715
4.03M
    1450, 1501, 1455, 1468, 1476, 1401, 1483, 1437, 1490, 1388, 1407, 1426, 1443, 1385, 
12716
4.03M
    1413, 1434, 1460, 1446, 1465, 135, 299, 435, 581, 725, 864, 992, 1115, 1243, 
12717
4.03M
    1366, 39, 199, 358, 500, 640, 780, 908, 1032, 1159, 1283, 87, 243, 406, 
12718
4.03M
    540, 684, 820, 948, 1068, 1199, 1319, 127, 279, 450, 144, 305, 441, 138, 
12719
4.03M
    141, 302, 438, 584, 728, 867, 995, 1118, 1246, 1369, 43, 203, 362, 504, 
12720
4.03M
    644, 784, 147, 308, 444, 587, 731, 870, 998, 1121, 1249, 1372, 47, 207, 
12721
4.03M
    366, 150, 311, 447, 590, 734, 873, 1001, 1124, 1252, 1375, 51, 211, 370, 
12722
4.03M
    508, 648, 788, 912, 1036, 1163, 1287, 91, 247, 410, 544, 688, 824, 952, 
12723
4.03M
    1072, 1203, 1323, 131, 283, 414, 548, 695, 831, 962, 1082, 1213, 1333, 6, 
12724
4.03M
    170, 320, 464, 600, 744, 884, 1012, 1135, 1263, 63, 235, 382, 520, 660, 
12725
4.03M
    800, 924, 1048, 1175, 1299, 103, 271, 287, 429, 569, 719, 852, 986, 1103, 
12726
4.03M
    1237, 1354, 32, 183, 350, 492, 632, 772, 563, 713, 846, 980, 1097, 1231, 
12727
4.03M
    1348, 26, 177, 343, 484, 624, 764, 293, 575, 858, 1109, 1360, 191, 1378, 
12728
4.03M
    420, 554, 704, 837, 971, 1088, 1222, 1339, 16, 153, 331, 472, 612, 752, 
12729
4.03M
    896, 1020, 1147, 1271, 75, 215, 394, 528, 672, 808, 936, 1056, 1187, 1307, 
12730
4.03M
    115, 251, 692, 828, 959, 1079, 1210, 1330, 3, 167, 317, 461, 596, 740, 
12731
4.03M
    880, 1008, 1131, 1259, 59, 231, 378, 516, 656, 796, 920, 1044, 1171, 1295, 
12732
4.03M
    99, 267, 956, 1076, 1207, 1327, 0, 164, 314, 458, 593, 737, 876, 1004, 
12733
4.03M
    1127, 1255, 55, 227, 374, 512, 652, 792, 916, 1040, 1167, 1291, 95, 263, 
12734
4.03M
    423, 707, 974, 1225, 19, 335, 616, 900, 1151, 79, 398, 676, 940, 1191, 
12735
4.03M
    119, 701, 968, 1219, 13, 328, 608, 892, 1143, 71, 390, 668, 932, 1183, 
12736
4.03M
    111, 
12737
4.03M
  };
12738
12739
4.03M
  static const char AsmStrsRegNamesRaw[] = {
12740
4.03M
  /* 0 */ "r13\0"
12741
4.03M
  /* 4 */ "r14\0"
12742
4.03M
  /* 8 */ "r15\0"
12743
4.03M
};
12744
4.03M
  static const uint8_t RegAsmOffsetRegNamesRaw[] = {
12745
4.03M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 4, 8, 
12746
4.03M
    3, 0, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12747
4.03M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12748
4.03M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12749
4.03M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12750
4.03M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12751
4.03M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12752
4.03M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12753
4.03M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12754
4.03M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12755
4.03M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12756
4.03M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12757
4.03M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12758
4.03M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12759
4.03M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12760
4.03M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12761
4.03M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12762
4.03M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12763
4.03M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12764
4.03M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12765
4.03M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12766
4.03M
    3, 
12767
4.03M
  };
12768
12769
4.03M
  switch(AltIdx) {
12770
0
  default: CS_ASSERT_RET_VAL(0 && "Invalid register alt name index!", NULL);
12771
3.22M
  case ARM_NoRegAltName:
12772
3.22M
    CS_ASSERT_RET_VAL(*(AsmStrsNoRegAltName+RegAsmOffsetNoRegAltName[RegNo-1]) &&
12773
3.22M
           "Invalid alt name index for register!", NULL);
12774
3.22M
    return AsmStrsNoRegAltName+RegAsmOffsetNoRegAltName[RegNo-1];
12775
803k
  case ARM_RegNamesRaw:
12776
803k
    if (!*(AsmStrsRegNamesRaw+RegAsmOffsetRegNamesRaw[RegNo-1]))
12777
731k
      return getRegisterName(RegNo, ARM_NoRegAltName);
12778
72.0k
    return AsmStrsRegNamesRaw+RegAsmOffsetRegNamesRaw[RegNo-1];
12779
4.03M
  }
12780
#else
12781
  return NULL;
12782
#endif // CAPSTONE_DIET
12783
4.03M
}
12784
#ifdef PRINT_ALIAS_INSTR
12785
#undef PRINT_ALIAS_INSTR
12786
12787
1.22M
static bool printAliasInstr(MCInst *MI, uint64_t Address, SStream *OS) {
12788
1.22M
#ifndef CAPSTONE_DIET
12789
1.22M
  static const PatternsForOpcode OpToPatterns[] = {
12790
1.22M
    {ARM_DSB, 0, 3 },
12791
1.22M
    {ARM_HINT, 3, 9 },
12792
1.22M
    {ARM_MVE_VMLADAVas16, 12, 1 },
12793
1.22M
    {ARM_MVE_VMLADAVas32, 13, 1 },
12794
1.22M
    {ARM_MVE_VMLADAVas8, 14, 1 },
12795
1.22M
    {ARM_MVE_VMLADAVau16, 15, 1 },
12796
1.22M
    {ARM_MVE_VMLADAVau32, 16, 1 },
12797
1.22M
    {ARM_MVE_VMLADAVau8, 17, 1 },
12798
1.22M
    {ARM_MVE_VMLADAVs16, 18, 1 },
12799
1.22M
    {ARM_MVE_VMLADAVs32, 19, 1 },
12800
1.22M
    {ARM_MVE_VMLADAVs8, 20, 1 },
12801
1.22M
    {ARM_MVE_VMLADAVu16, 21, 1 },
12802
1.22M
    {ARM_MVE_VMLADAVu32, 22, 1 },
12803
1.22M
    {ARM_MVE_VMLADAVu8, 23, 1 },
12804
1.22M
    {ARM_MVE_VMLALDAVas16, 24, 1 },
12805
1.22M
    {ARM_MVE_VMLALDAVas32, 25, 1 },
12806
1.22M
    {ARM_MVE_VMLALDAVau16, 26, 1 },
12807
1.22M
    {ARM_MVE_VMLALDAVau32, 27, 1 },
12808
1.22M
    {ARM_MVE_VMLALDAVs16, 28, 1 },
12809
1.22M
    {ARM_MVE_VMLALDAVs32, 29, 1 },
12810
1.22M
    {ARM_MVE_VMLALDAVu16, 30, 1 },
12811
1.22M
    {ARM_MVE_VMLALDAVu32, 31, 1 },
12812
1.22M
    {ARM_MVE_VORR, 32, 1 },
12813
1.22M
    {ARM_MVE_VRMLALDAVHas32, 33, 1 },
12814
1.22M
    {ARM_MVE_VRMLALDAVHau32, 34, 1 },
12815
1.22M
    {ARM_MVE_VRMLALDAVHs32, 35, 1 },
12816
1.22M
    {ARM_MVE_VRMLALDAVHu32, 36, 1 },
12817
1.22M
    {ARM_t2CSINC, 37, 2 },
12818
1.22M
    {ARM_t2CSINV, 39, 2 },
12819
1.22M
    {ARM_t2CSNEG, 41, 1 },
12820
1.22M
    {ARM_t2DSB, 42, 3 },
12821
1.22M
    {ARM_t2HINT, 45, 13 },
12822
1.22M
    {ARM_t2SUBS_PC_LR, 58, 1 },
12823
1.22M
    {ARM_tHINT, 59, 6 },
12824
1.22M
  {0},  };
12825
12826
1.22M
  static const AliasPattern Patterns[] = {
12827
    // ARM_DSB - 0
12828
1.22M
    {0, 0, 1, 3 },
12829
1.22M
    {5, 3, 1, 3 },
12830
1.22M
    {11, 6, 1, 3 },
12831
    // ARM_HINT - 3
12832
1.22M
    {15, 9, 3, 3 },
12833
1.22M
    {23, 12, 3, 3 },
12834
1.22M
    {33, 15, 3, 3 },
12835
1.22M
    {41, 18, 3, 3 },
12836
1.22M
    {49, 21, 3, 3 },
12837
1.22M
    {57, 24, 3, 3 },
12838
1.22M
    {66, 27, 3, 3 },
12839
1.22M
    {74, 30, 3, 3 },
12840
1.22M
    {83, 33, 3, 4 },
12841
    // ARM_MVE_VMLADAVas16 - 12
12842
1.22M
    {94, 37, 7, 6 },
12843
    // ARM_MVE_VMLADAVas32 - 13
12844
1.22M
    {120, 43, 7, 6 },
12845
    // ARM_MVE_VMLADAVas8 - 14
12846
1.22M
    {146, 49, 7, 6 },
12847
    // ARM_MVE_VMLADAVau16 - 15
12848
1.22M
    {171, 55, 7, 6 },
12849
    // ARM_MVE_VMLADAVau32 - 16
12850
1.22M
    {197, 61, 7, 6 },
12851
    // ARM_MVE_VMLADAVau8 - 17
12852
1.22M
    {223, 67, 7, 6 },
12853
    // ARM_MVE_VMLADAVs16 - 18
12854
1.22M
    {248, 73, 6, 5 },
12855
    // ARM_MVE_VMLADAVs32 - 19
12856
1.22M
    {273, 78, 6, 5 },
12857
    // ARM_MVE_VMLADAVs8 - 20
12858
1.22M
    {298, 83, 6, 5 },
12859
    // ARM_MVE_VMLADAVu16 - 21
12860
1.22M
    {322, 88, 6, 5 },
12861
    // ARM_MVE_VMLADAVu32 - 22
12862
1.22M
    {347, 93, 6, 5 },
12863
    // ARM_MVE_VMLADAVu8 - 23
12864
1.22M
    {372, 98, 6, 5 },
12865
    // ARM_MVE_VMLALDAVas16 - 24
12866
1.22M
    {396, 103, 9, 8 },
12867
    // ARM_MVE_VMLALDAVas32 - 25
12868
1.22M
    {427, 111, 9, 8 },
12869
    // ARM_MVE_VMLALDAVau16 - 26
12870
1.22M
    {458, 119, 9, 8 },
12871
    // ARM_MVE_VMLALDAVau32 - 27
12872
1.22M
    {489, 127, 9, 8 },
12873
    // ARM_MVE_VMLALDAVs16 - 28
12874
1.22M
    {520, 135, 7, 6 },
12875
    // ARM_MVE_VMLALDAVs32 - 29
12876
1.22M
    {550, 141, 7, 6 },
12877
    // ARM_MVE_VMLALDAVu16 - 30
12878
1.22M
    {580, 147, 7, 6 },
12879
    // ARM_MVE_VMLALDAVu32 - 31
12880
1.22M
    {610, 153, 7, 6 },
12881
    // ARM_MVE_VORR - 32
12882
1.22M
    {640, 159, 7, 5 },
12883
    // ARM_MVE_VRMLALDAVHas32 - 33
12884
1.22M
    {656, 164, 9, 8 },
12885
    // ARM_MVE_VRMLALDAVHau32 - 34
12886
1.22M
    {689, 172, 9, 8 },
12887
    // ARM_MVE_VRMLALDAVHs32 - 35
12888
1.22M
    {722, 180, 7, 6 },
12889
    // ARM_MVE_VRMLALDAVHu32 - 36
12890
1.22M
    {754, 186, 7, 6 },
12891
    // ARM_t2CSINC - 37
12892
1.22M
    {786, 192, 4, 4 },
12893
1.22M
    {800, 196, 4, 4 },
12894
    // ARM_t2CSINV - 39
12895
1.22M
    {818, 200, 4, 4 },
12896
1.22M
    {833, 204, 4, 4 },
12897
    // ARM_t2CSNEG - 41
12898
1.22M
    {851, 208, 4, 4 },
12899
    // ARM_t2DSB - 42
12900
1.22M
    {0, 212, 3, 6 },
12901
1.22M
    {5, 218, 3, 6 },
12902
1.22M
    {869, 224, 3, 2 },
12903
    // ARM_t2HINT - 45
12904
1.22M
    {877, 226, 3, 3 },
12905
1.22M
    {887, 229, 3, 3 },
12906
1.22M
    {899, 232, 3, 3 },
12907
1.22M
    {909, 235, 3, 3 },
12908
1.22M
    {919, 238, 3, 3 },
12909
1.22M
    {929, 241, 3, 4 },
12910
1.22M
    {940, 245, 3, 4 },
12911
1.22M
    {74, 249, 3, 3 },
12912
1.22M
    {950, 252, 3, 3 },
12913
1.22M
    {971, 255, 3, 3 },
12914
1.22M
    {979, 258, 3, 3 },
12915
1.22M
    {997, 261, 3, 3 },
12916
1.22M
    {83, 264, 3, 5 },
12917
    // ARM_t2SUBS_PC_LR - 58
12918
1.22M
    {1015, 269, 3, 4 },
12919
    // ARM_tHINT - 59
12920
1.22M
    {15, 273, 3, 3 },
12921
1.22M
    {23, 276, 3, 3 },
12922
1.22M
    {33, 279, 3, 3 },
12923
1.22M
    {41, 282, 3, 3 },
12924
1.22M
    {49, 285, 3, 3 },
12925
1.22M
    {57, 288, 3, 4 },
12926
1.22M
  {0},  };
12927
12928
1.22M
  static const AliasPatternCond Conds[] = {
12929
    // (DSB 0) - 0
12930
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)0},
12931
1.22M
    {AliasPatternCond_K_NegFeature, ARM_ModeThumb},
12932
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureDB},
12933
    // (DSB 4) - 3
12934
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)4},
12935
1.22M
    {AliasPatternCond_K_NegFeature, ARM_ModeThumb},
12936
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureDB},
12937
    // (DSB 12) - 6
12938
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)12},
12939
1.22M
    {AliasPatternCond_K_NegFeature, ARM_ModeThumb},
12940
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureDFB},
12941
    // (HINT 0, pred:$p) - 9
12942
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)0},
12943
1.22M
    {AliasPatternCond_K_NegFeature, ARM_ModeThumb},
12944
1.22M
    {AliasPatternCond_K_Feature, ARM_HasV6KOps},
12945
    // (HINT 1, pred:$p) - 12
12946
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)1},
12947
1.22M
    {AliasPatternCond_K_NegFeature, ARM_ModeThumb},
12948
1.22M
    {AliasPatternCond_K_Feature, ARM_HasV6KOps},
12949
    // (HINT 2, pred:$p) - 15
12950
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)2},
12951
1.22M
    {AliasPatternCond_K_NegFeature, ARM_ModeThumb},
12952
1.22M
    {AliasPatternCond_K_Feature, ARM_HasV6KOps},
12953
    // (HINT 3, pred:$p) - 18
12954
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)3},
12955
1.22M
    {AliasPatternCond_K_NegFeature, ARM_ModeThumb},
12956
1.22M
    {AliasPatternCond_K_Feature, ARM_HasV6KOps},
12957
    // (HINT 4, pred:$p) - 21
12958
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)4},
12959
1.22M
    {AliasPatternCond_K_NegFeature, ARM_ModeThumb},
12960
1.22M
    {AliasPatternCond_K_Feature, ARM_HasV6KOps},
12961
    // (HINT 5, pred:$p) - 24
12962
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)5},
12963
1.22M
    {AliasPatternCond_K_NegFeature, ARM_ModeThumb},
12964
1.22M
    {AliasPatternCond_K_Feature, ARM_HasV8Ops},
12965
    // (HINT 16, pred:$p) - 27
12966
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)16},
12967
1.22M
    {AliasPatternCond_K_NegFeature, ARM_ModeThumb},
12968
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureRAS},
12969
    // (HINT 20, pred:$p) - 30
12970
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)20},
12971
1.22M
    {AliasPatternCond_K_NegFeature, ARM_ModeThumb},
12972
1.22M
    {AliasPatternCond_K_Feature, ARM_HasV6KOps},
12973
    // (HINT 22, pred:$p) - 33
12974
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)22},
12975
1.22M
    {AliasPatternCond_K_NegFeature, ARM_ModeThumb},
12976
1.22M
    {AliasPatternCond_K_Feature, ARM_HasV8Ops},
12977
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureCLRBHB},
12978
    // (MVE_VMLADAVas16 tGPREven:$RdaDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 37
12979
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
12980
1.22M
    {AliasPatternCond_K_Ignore, 0},
12981
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
12982
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
12983
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
12984
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
12985
    // (MVE_VMLADAVas32 tGPREven:$RdaDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 43
12986
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
12987
1.22M
    {AliasPatternCond_K_Ignore, 0},
12988
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
12989
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
12990
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
12991
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
12992
    // (MVE_VMLADAVas8 tGPREven:$RdaDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 49
12993
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
12994
1.22M
    {AliasPatternCond_K_Ignore, 0},
12995
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
12996
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
12997
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
12998
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
12999
    // (MVE_VMLADAVau16 tGPREven:$RdaDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 55
13000
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13001
1.22M
    {AliasPatternCond_K_Ignore, 0},
13002
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13003
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13004
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13005
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13006
    // (MVE_VMLADAVau32 tGPREven:$RdaDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 61
13007
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13008
1.22M
    {AliasPatternCond_K_Ignore, 0},
13009
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13010
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13011
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13012
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13013
    // (MVE_VMLADAVau8 tGPREven:$RdaDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 67
13014
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13015
1.22M
    {AliasPatternCond_K_Ignore, 0},
13016
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13017
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13018
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13019
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13020
    // (MVE_VMLADAVs16 tGPREven:$RdaDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 73
13021
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13022
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13023
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13024
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13025
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13026
    // (MVE_VMLADAVs32 tGPREven:$RdaDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 78
13027
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13028
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13029
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13030
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13031
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13032
    // (MVE_VMLADAVs8 tGPREven:$RdaDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 83
13033
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13034
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13035
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13036
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13037
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13038
    // (MVE_VMLADAVu16 tGPREven:$RdaDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 88
13039
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13040
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13041
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13042
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13043
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13044
    // (MVE_VMLADAVu32 tGPREven:$RdaDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 93
13045
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13046
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13047
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13048
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13049
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13050
    // (MVE_VMLADAVu8 tGPREven:$RdaDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 98
13051
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13052
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13053
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13054
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13055
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13056
    // (MVE_VMLALDAVas16 tGPREven:$RdaLoDest, tGPROdd:$RdaHiDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 103
13057
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13058
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPROddRegClassID},
13059
1.22M
    {AliasPatternCond_K_Ignore, 0},
13060
1.22M
    {AliasPatternCond_K_Ignore, 0},
13061
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13062
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13063
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13064
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13065
    // (MVE_VMLALDAVas32 tGPREven:$RdaLoDest, tGPROdd:$RdaHiDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 111
13066
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13067
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPROddRegClassID},
13068
1.22M
    {AliasPatternCond_K_Ignore, 0},
13069
1.22M
    {AliasPatternCond_K_Ignore, 0},
13070
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13071
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13072
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13073
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13074
    // (MVE_VMLALDAVau16 tGPREven:$RdaLoDest, tGPROdd:$RdaHiDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 119
13075
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13076
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPROddRegClassID},
13077
1.22M
    {AliasPatternCond_K_Ignore, 0},
13078
1.22M
    {AliasPatternCond_K_Ignore, 0},
13079
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13080
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13081
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13082
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13083
    // (MVE_VMLALDAVau32 tGPREven:$RdaLoDest, tGPROdd:$RdaHiDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 127
13084
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13085
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPROddRegClassID},
13086
1.22M
    {AliasPatternCond_K_Ignore, 0},
13087
1.22M
    {AliasPatternCond_K_Ignore, 0},
13088
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13089
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13090
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13091
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13092
    // (MVE_VMLALDAVs16 tGPREven:$RdaLoDest, tGPROdd:$RdaHiDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 135
13093
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13094
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPROddRegClassID},
13095
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13096
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13097
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13098
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13099
    // (MVE_VMLALDAVs32 tGPREven:$RdaLoDest, tGPROdd:$RdaHiDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 141
13100
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13101
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPROddRegClassID},
13102
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13103
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13104
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13105
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13106
    // (MVE_VMLALDAVu16 tGPREven:$RdaLoDest, tGPROdd:$RdaHiDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 147
13107
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13108
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPROddRegClassID},
13109
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13110
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13111
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13112
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13113
    // (MVE_VMLALDAVu32 tGPREven:$RdaLoDest, tGPROdd:$RdaHiDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 153
13114
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13115
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPROddRegClassID},
13116
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13117
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13118
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13119
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13120
    // (MVE_VORR MQPR:$Qd, MQPR:$Qm, MQPR:$Qm, vpred_r:$vp) - 159
13121
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13122
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13123
1.22M
    {AliasPatternCond_K_TiedReg, 1},
13124
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13125
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13126
    // (MVE_VRMLALDAVHas32 tGPREven:$RdaLo, tGPROdd:$RdaHi, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 164
13127
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13128
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPROddRegClassID},
13129
1.22M
    {AliasPatternCond_K_Ignore, 0},
13130
1.22M
    {AliasPatternCond_K_Ignore, 0},
13131
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13132
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13133
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13134
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13135
    // (MVE_VRMLALDAVHau32 tGPREven:$RdaLo, tGPROdd:$RdaHi, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 172
13136
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13137
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPROddRegClassID},
13138
1.22M
    {AliasPatternCond_K_Ignore, 0},
13139
1.22M
    {AliasPatternCond_K_Ignore, 0},
13140
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13141
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13142
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13143
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13144
    // (MVE_VRMLALDAVHs32 tGPREven:$RdaLo, tGPROdd:$RdaHi, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 180
13145
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13146
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPROddRegClassID},
13147
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13148
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13149
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13150
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13151
    // (MVE_VRMLALDAVHu32 tGPREven:$RdaLo, tGPROdd:$RdaHi, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 186
13152
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13153
1.22M
    {AliasPatternCond_K_RegClass, ARM_tGPROddRegClassID},
13154
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13155
1.22M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13156
1.22M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13157
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13158
    // (t2CSINC rGPR:$Rd, ZR, ZR, pred_noal_inv:$fcond) - 192
13159
1.22M
    {AliasPatternCond_K_RegClass, ARM_rGPRRegClassID},
13160
1.22M
    {AliasPatternCond_K_Reg, ARM_ZR},
13161
1.22M
    {AliasPatternCond_K_Reg, ARM_ZR},
13162
1.22M
    {AliasPatternCond_K_Feature, ARM_HasV8_1MMainlineOps},
13163
    // (t2CSINC rGPR:$Rd, GPRwithZRnosp:$Rn, GPRwithZRnosp:$Rn, pred_noal_inv:$fcond) - 196
13164
1.22M
    {AliasPatternCond_K_RegClass, ARM_rGPRRegClassID},
13165
1.22M
    {AliasPatternCond_K_RegClass, ARM_GPRwithZRnospRegClassID},
13166
1.22M
    {AliasPatternCond_K_TiedReg, 1},
13167
1.22M
    {AliasPatternCond_K_Feature, ARM_HasV8_1MMainlineOps},
13168
    // (t2CSINV rGPR:$Rd, ZR, ZR, pred_noal_inv:$fcond) - 200
13169
1.22M
    {AliasPatternCond_K_RegClass, ARM_rGPRRegClassID},
13170
1.22M
    {AliasPatternCond_K_Reg, ARM_ZR},
13171
1.22M
    {AliasPatternCond_K_Reg, ARM_ZR},
13172
1.22M
    {AliasPatternCond_K_Feature, ARM_HasV8_1MMainlineOps},
13173
    // (t2CSINV rGPR:$Rd, GPRwithZRnosp:$Rn, GPRwithZRnosp:$Rn, pred_noal_inv:$fcond) - 204
13174
1.22M
    {AliasPatternCond_K_RegClass, ARM_rGPRRegClassID},
13175
1.22M
    {AliasPatternCond_K_RegClass, ARM_GPRwithZRnospRegClassID},
13176
1.22M
    {AliasPatternCond_K_TiedReg, 1},
13177
1.22M
    {AliasPatternCond_K_Feature, ARM_HasV8_1MMainlineOps},
13178
    // (t2CSNEG rGPR:$Rd, GPRwithZRnosp:$Rn, GPRwithZRnosp:$Rn, pred_noal_inv:$fcond) - 208
13179
1.22M
    {AliasPatternCond_K_RegClass, ARM_rGPRRegClassID},
13180
1.22M
    {AliasPatternCond_K_RegClass, ARM_GPRwithZRnospRegClassID},
13181
1.22M
    {AliasPatternCond_K_TiedReg, 1},
13182
1.22M
    {AliasPatternCond_K_Feature, ARM_HasV8_1MMainlineOps},
13183
    // (t2DSB 0, 14, 0) - 212
13184
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)0},
13185
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)14},
13186
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)0},
13187
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureDB},
13188
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13189
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13190
    // (t2DSB 4, 14, 0) - 218
13191
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)4},
13192
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)14},
13193
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)0},
13194
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureDB},
13195
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13196
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13197
    // (t2DSB 12, pred:$p) - 224
13198
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)12},
13199
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureDFB},
13200
    // (t2HINT 0, pred:$p) - 226
13201
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)0},
13202
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13203
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13204
    // (t2HINT 1, pred:$p) - 229
13205
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)1},
13206
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13207
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13208
    // (t2HINT 2, pred:$p) - 232
13209
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)2},
13210
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13211
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13212
    // (t2HINT 3, pred:$p) - 235
13213
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)3},
13214
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13215
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13216
    // (t2HINT 4, pred:$p) - 238
13217
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)4},
13218
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13219
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13220
    // (t2HINT 5, pred:$p) - 241
13221
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)5},
13222
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13223
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13224
1.22M
    {AliasPatternCond_K_Feature, ARM_HasV8Ops},
13225
    // (t2HINT 16, pred:$p) - 245
13226
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)16},
13227
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13228
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13229
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureRAS},
13230
    // (t2HINT 20, pred:$p) - 249
13231
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)20},
13232
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13233
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13234
    // (t2HINT 13, pred:$p) - 252
13235
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)13},
13236
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13237
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13238
    // (t2HINT 15, pred:$p) - 255
13239
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)15},
13240
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13241
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13242
    // (t2HINT 29, pred:$p) - 258
13243
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)29},
13244
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13245
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13246
    // (t2HINT 45, pred:$p) - 261
13247
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)45},
13248
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13249
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13250
    // (t2HINT 22, pred:$p) - 264
13251
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)22},
13252
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13253
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13254
1.22M
    {AliasPatternCond_K_Feature, ARM_HasV8Ops},
13255
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureCLRBHB},
13256
    // (t2SUBS_PC_LR 0, pred:$p) - 269
13257
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)0},
13258
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13259
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13260
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureVirtualization},
13261
    // (tHINT 0, pred:$p) - 273
13262
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)0},
13263
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13264
1.22M
    {AliasPatternCond_K_Feature, ARM_HasV6MOps},
13265
    // (tHINT 1, pred:$p) - 276
13266
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)1},
13267
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13268
1.22M
    {AliasPatternCond_K_Feature, ARM_HasV6MOps},
13269
    // (tHINT 2, pred:$p) - 279
13270
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)2},
13271
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13272
1.22M
    {AliasPatternCond_K_Feature, ARM_HasV6MOps},
13273
    // (tHINT 3, pred:$p) - 282
13274
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)3},
13275
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13276
1.22M
    {AliasPatternCond_K_Feature, ARM_HasV6MOps},
13277
    // (tHINT 4, pred:$p) - 285
13278
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)4},
13279
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13280
1.22M
    {AliasPatternCond_K_Feature, ARM_HasV6MOps},
13281
    // (tHINT 5, pred:$p) - 288
13282
1.22M
    {AliasPatternCond_K_Imm, (uint32_t)5},
13283
1.22M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13284
1.22M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13285
1.22M
    {AliasPatternCond_K_Feature, ARM_HasV8Ops},
13286
1.22M
  {0},  };
13287
13288
1.22M
  static const char AsmStrings[] =
13289
1.22M
    /* 0 */ "ssbb\0"
13290
1.22M
    /* 5 */ "pssbb\0"
13291
1.22M
    /* 11 */ "dfb\0"
13292
1.22M
    /* 15 */ "nop$\xFF\x02\x01\0"
13293
1.22M
    /* 23 */ "yield$\xFF\x02\x01\0"
13294
1.22M
    /* 33 */ "wfe$\xFF\x02\x01\0"
13295
1.22M
    /* 41 */ "wfi$\xFF\x02\x01\0"
13296
1.22M
    /* 49 */ "sev$\xFF\x02\x01\0"
13297
1.22M
    /* 57 */ "sevl$\xFF\x02\x01\0"
13298
1.22M
    /* 66 */ "esb$\xFF\x02\x01\0"
13299
1.22M
    /* 74 */ "csdb$\xFF\x02\x01\0"
13300
1.22M
    /* 83 */ "clrbhb$\xFF\x02\x01\0"
13301
1.22M
    /* 94 */ "vmlava$\xFF\x05\x02.s16 $\x01, $\x03, $\x04\0"
13302
1.22M
    /* 120 */ "vmlava$\xFF\x05\x02.s32  $\x01, $\x03, $\x04\0"
13303
1.22M
    /* 146 */ "vmlava$\xFF\x05\x02.s8 $\x01, $\x03, $\x04\0"
13304
1.22M
    /* 171 */ "vmlava$\xFF\x05\x02.u16  $\x01, $\x03, $\x04\0"
13305
1.22M
    /* 197 */ "vmlava$\xFF\x05\x02.u32  $\x01, $\x03, $\x04\0"
13306
1.22M
    /* 223 */ "vmlava$\xFF\x05\x02.u8 $\x01, $\x03, $\x04\0"
13307
1.22M
    /* 248 */ "vmlav$\xFF\x04\x02.s16 $\x01, $\x02, $\x03\0"
13308
1.22M
    /* 273 */ "vmlav$\xFF\x04\x02.s32 $\x01, $\x02, $\x03\0"
13309
1.22M
    /* 298 */ "vmlav$\xFF\x04\x02.s8  $\x01, $\x02, $\x03\0"
13310
1.22M
    /* 322 */ "vmlav$\xFF\x04\x02.u16 $\x01, $\x02, $\x03\0"
13311
1.22M
    /* 347 */ "vmlav$\xFF\x04\x02.u32 $\x01, $\x02, $\x03\0"
13312
1.22M
    /* 372 */ "vmlav$\xFF\x04\x02.u8  $\x01, $\x02, $\x03\0"
13313
1.22M
    /* 396 */ "vmlalva$\xFF\x07\x02.s16 $\x01, $\x02, $\x05, $\x06\0"
13314
1.22M
    /* 427 */ "vmlalva$\xFF\x07\x02.s32 $\x01, $\x02, $\x05, $\x06\0"
13315
1.22M
    /* 458 */ "vmlalva$\xFF\x07\x02.u16 $\x01, $\x02, $\x05, $\x06\0"
13316
1.22M
    /* 489 */ "vmlalva$\xFF\x07\x02.u32 $\x01, $\x02, $\x05, $\x06\0"
13317
1.22M
    /* 520 */ "vmlalv$\xFF\x05\x02.s16  $\x01, $\x02, $\x03, $\x04\0"
13318
1.22M
    /* 550 */ "vmlalv$\xFF\x05\x02.s32  $\x01, $\x02, $\x03, $\x04\0"
13319
1.22M
    /* 580 */ "vmlalv$\xFF\x05\x02.u16  $\x01, $\x02, $\x03, $\x04\0"
13320
1.22M
    /* 610 */ "vmlalv$\xFF\x05\x02.u32  $\x01, $\x02, $\x03, $\x04\0"
13321
1.22M
    /* 640 */ "vmov$\xFF\x04\x02  $\x01, $\x02\0"
13322
1.22M
    /* 656 */ "vrmlalvha$\xFF\x07\x02.s32 $\x01, $\x02, $\x05, $\x06\0"
13323
1.22M
    /* 689 */ "vrmlalvha$\xFF\x07\x02.u32 $\x01, $\x02, $\x05, $\x06\0"
13324
1.22M
    /* 722 */ "vrmlalvh$\xFF\x05\x02.s32  $\x01, $\x02, $\x03, $\x04\0"
13325
1.22M
    /* 754 */ "vrmlalvh$\xFF\x05\x02.u32  $\x01, $\x02, $\x03, $\x04\0"
13326
1.22M
    /* 786 */ "cset $\x01, $\xFF\x04\x03\0"
13327
1.22M
    /* 800 */ "cinc $\x01, $\x02, $\xFF\x04\x03\0"
13328
1.22M
    /* 818 */ "csetm  $\x01, $\xFF\x04\x03\0"
13329
1.22M
    /* 833 */ "cinv $\x01, $\x02, $\xFF\x04\x03\0"
13330
1.22M
    /* 851 */ "cneg $\x01, $\x02, $\xFF\x04\x03\0"
13331
1.22M
    /* 869 */ "dfb$\xFF\x02\x01\0"
13332
1.22M
    /* 877 */ "nop$\xFF\x02\x01.w\0"
13333
1.22M
    /* 887 */ "yield$\xFF\x02\x01.w\0"
13334
1.22M
    /* 899 */ "wfe$\xFF\x02\x01.w\0"
13335
1.22M
    /* 909 */ "wfi$\xFF\x02\x01.w\0"
13336
1.22M
    /* 919 */ "sev$\xFF\x02\x01.w\0"
13337
1.22M
    /* 929 */ "sevl$\xFF\x02\x01.w\0"
13338
1.22M
    /* 940 */ "esb$\xFF\x02\x01.w\0"
13339
1.22M
    /* 950 */ "pacbti$\xFF\x02\x01 r12,lr,sp\0"
13340
1.22M
    /* 971 */ "bti$\xFF\x02\x01\0"
13341
1.22M
    /* 979 */ "pac$\xFF\x02\x01 r12,lr,sp\0"
13342
1.22M
    /* 997 */ "aut$\xFF\x02\x01 r12,lr,sp\0"
13343
1.22M
    /* 1015 */ "eret$\xFF\x02\x01\0"
13344
1.22M
  ;
13345
13346
1.22M
#ifndef NDEBUG
13347
  //static struct SortCheck {
13348
  //  SortCheck(ArrayRef<PatternsForOpcode> OpToPatterns) {
13349
  //    assert(std::is_sorted(
13350
  //               OpToPatterns.begin(), OpToPatterns.end(),
13351
  //               [](const PatternsForOpcode &L, const //PatternsForOpcode &R) {
13352
  //                 return L.Opcode < R.Opcode;
13353
  //               }) &&
13354
  //           "tablegen failed to sort opcode patterns");
13355
  //  }
13356
  //} sortCheckVar(OpToPatterns);
13357
1.22M
#endif
13358
13359
1.22M
  AliasMatchingData M = {
13360
1.22M
    OpToPatterns,
13361
1.22M
    Patterns,
13362
1.22M
    Conds,
13363
1.22M
    AsmStrings,
13364
1.22M
    NULL,
13365
1.22M
  };
13366
1.22M
  const char *AsmString = matchAliasPatterns(MI, &M);
13367
1.22M
  if (!AsmString) return false;
13368
13369
3.78k
  unsigned I = 0;
13370
20.6k
  while (AsmString[I] != ' ' && AsmString[I] != '\t' &&
13371
20.6k
         AsmString[I] != '$' && AsmString[I] != '\0')
13372
16.8k
    ++I;
13373
3.78k
  SStream_concat1(OS, '\t');
13374
3.78k
  char *substr = malloc(I+1);
13375
3.78k
  memcpy(substr, AsmString, I);
13376
3.78k
  substr[I] = '\0';
13377
3.78k
  SStream_concat0(OS, substr);
13378
3.78k
  free(substr);
13379
3.78k
  if (AsmString[I] != '\0') {
13380
3.76k
    if (AsmString[I] == ' ' || AsmString[I] == '\t') {
13381
1.12k
      SStream_concat1(OS, '\t');
13382
1.12k
      ++I;
13383
1.12k
    }
13384
23.3k
    do {
13385
23.3k
      if (AsmString[I] == '$') {
13386
9.36k
        ++I;
13387
9.36k
        if (AsmString[I] == (char)0xff) {
13388
3.76k
          ++I;
13389
3.76k
          int OpIdx = AsmString[I++] - 1;
13390
3.76k
          int PrintMethodIdx = AsmString[I++] - 1;
13391
3.76k
          printCustomAliasOperand(MI, Address, OpIdx, PrintMethodIdx, OS);
13392
3.76k
        } else
13393
5.59k
          printOperand(MI, ((unsigned)AsmString[I++]) - 1, OS);
13394
13.9k
      } else {
13395
13.9k
        SStream_concat1(OS, AsmString[I++]);
13396
13.9k
      }
13397
23.3k
    } while (AsmString[I] != '\0');
13398
3.76k
  }
13399
13400
3.78k
  return true;
13401
#else
13402
  return false;
13403
#endif // CAPSTONE_DIET
13404
1.22M
}
13405
13406
static void printCustomAliasOperand(
13407
         MCInst *MI, uint64_t Address, unsigned OpIdx,
13408
         unsigned PrintMethodIdx,
13409
3.76k
         SStream *OS) {
13410
3.76k
#ifndef CAPSTONE_DIET
13411
3.76k
  switch (PrintMethodIdx) {
13412
0
  default:
13413
0
    CS_ASSERT_RET(0 && "Unknown PrintMethod kind");
13414
0
    break;
13415
1.32k
  case 0:
13416
1.32k
    printPredicateOperand(MI, OpIdx, OS);
13417
1.32k
    break;
13418
1.31k
  case 1:
13419
1.31k
    printVPTPredicateOperand(MI, OpIdx, OS);
13420
1.31k
    break;
13421
1.12k
  case 2:
13422
1.12k
    printMandatoryInvertedPredicateOperand(MI, OpIdx, OS);
13423
1.12k
    break;
13424
3.76k
  }
13425
3.76k
#endif // CAPSTONE_DIET
13426
3.76k
}
13427
13428
#endif // PRINT_ALIAS_INSTR