Coverage Report

Created: 2026-08-31 06:58

next uncovered line (L), next uncovered region (R), next uncovered branch (B)
/src/capstonenext/arch/ARM/ARMGenAsmWriter.inc
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1
/* Capstone Disassembly Engine, https://www.capstone-engine.org */
2
/* By Nguyen Anh Quynh <aquynh@gmail.com>, 2013-2022, */
3
/*    Rot127 <unisono@quyllur.org> 2022-2024 */
4
/* Automatically generated file by Capstone's LLVM TableGen Disassembler Backend. */
5
6
/* LLVM-commit: <commit> */
7
/* LLVM-tag: <tag> */
8
9
/* Do not edit. */
10
11
/* Capstone's LLVM TableGen Backends: */
12
/* https://github.com/capstone-engine/llvm-capstone */
13
14
#include <capstone/platform.h>
15
#include "../../cs_priv.h"
16
17
/// getMnemonic - This method is automatically generated by tablegen
18
/// from the instruction set description.
19
1.40M
static MnemonicBitsInfo getMnemonic(MCInst *MI, SStream *O) {
20
1.40M
#ifndef CAPSTONE_DIET
21
1.40M
  static const char AsmStrs[] = {
22
1.40M
  /* 0 */ "vcx1\t\0"
23
1.40M
  /* 6 */ "vld20.32\t\0"
24
1.40M
  /* 16 */ "vst20.32\t\0"
25
1.40M
  /* 26 */ "vld40.32\t\0"
26
1.40M
  /* 36 */ "vst40.32\t\0"
27
1.40M
  /* 46 */ "sha1su0.32\t\0"
28
1.40M
  /* 58 */ "sha256su0.32\t\0"
29
1.40M
  /* 72 */ "vld21.32\t\0"
30
1.40M
  /* 82 */ "vst21.32\t\0"
31
1.40M
  /* 92 */ "vld41.32\t\0"
32
1.40M
  /* 102 */ "vst41.32\t\0"
33
1.40M
  /* 112 */ "sha1su1.32\t\0"
34
1.40M
  /* 124 */ "sha256su1.32\t\0"
35
1.40M
  /* 138 */ "vld42.32\t\0"
36
1.40M
  /* 148 */ "vst42.32\t\0"
37
1.40M
  /* 158 */ "sha256h2.32\t\0"
38
1.40M
  /* 171 */ "vld43.32\t\0"
39
1.40M
  /* 181 */ "vst43.32\t\0"
40
1.40M
  /* 191 */ "sha1c.32\t\0"
41
1.40M
  /* 201 */ "sha1h.32\t\0"
42
1.40M
  /* 211 */ "sha256h.32\t\0"
43
1.40M
  /* 223 */ "sha1m.32\t\0"
44
1.40M
  /* 233 */ "sha1p.32\t\0"
45
1.40M
  /* 243 */ "dlstp.32\t\0"
46
1.40M
  /* 253 */ "wlstp.32\t\0"
47
1.40M
  /* 263 */ "vcvta.s32.f32\t\0"
48
1.40M
  /* 278 */ "vcvtm.s32.f32\t\0"
49
1.40M
  /* 293 */ "vcvtn.s32.f32\t\0"
50
1.40M
  /* 308 */ "vcvtp.s32.f32\t\0"
51
1.40M
  /* 323 */ "vcvta.u32.f32\t\0"
52
1.40M
  /* 338 */ "vcvtm.u32.f32\t\0"
53
1.40M
  /* 353 */ "vcvtn.u32.f32\t\0"
54
1.40M
  /* 368 */ "vcvtp.u32.f32\t\0"
55
1.40M
  /* 383 */ "vcmla.f32\t\0"
56
1.40M
  /* 394 */ "vrinta.f32\t\0"
57
1.40M
  /* 406 */ "vcadd.f32\t\0"
58
1.40M
  /* 417 */ "vselge.f32\t\0"
59
1.40M
  /* 429 */ "vminnm.f32\t\0"
60
1.40M
  /* 441 */ "vmaxnm.f32\t\0"
61
1.40M
  /* 453 */ "vrintm.f32\t\0"
62
1.40M
  /* 465 */ "vrintn.f32\t\0"
63
1.40M
  /* 477 */ "vrintp.f32\t\0"
64
1.40M
  /* 489 */ "vseleq.f32\t\0"
65
1.40M
  /* 501 */ "vselvs.f32\t\0"
66
1.40M
  /* 513 */ "vselgt.f32\t\0"
67
1.40M
  /* 525 */ "vrintx.f32\t\0"
68
1.40M
  /* 537 */ "vrintz.f32\t\0"
69
1.40M
  /* 549 */ "ldc2\t\0"
70
1.40M
  /* 555 */ "mrc2\t\0"
71
1.40M
  /* 561 */ "mrrc2\t\0"
72
1.40M
  /* 568 */ "stc2\t\0"
73
1.40M
  /* 574 */ "cdp2\t\0"
74
1.40M
  /* 580 */ "mcr2\t\0"
75
1.40M
  /* 586 */ "mcrr2\t\0"
76
1.40M
  /* 593 */ "vcx2\t\0"
77
1.40M
  /* 599 */ "vcx3\t\0"
78
1.40M
  /* 605 */ "dlstp.64\t\0"
79
1.40M
  /* 615 */ "wlstp.64\t\0"
80
1.40M
  /* 625 */ "vcvta.s32.f64\t\0"
81
1.40M
  /* 640 */ "vcvtm.s32.f64\t\0"
82
1.40M
  /* 655 */ "vcvtn.s32.f64\t\0"
83
1.40M
  /* 670 */ "vcvtp.s32.f64\t\0"
84
1.40M
  /* 685 */ "vcvta.u32.f64\t\0"
85
1.40M
  /* 700 */ "vcvtm.u32.f64\t\0"
86
1.40M
  /* 715 */ "vcvtn.u32.f64\t\0"
87
1.40M
  /* 730 */ "vcvtp.u32.f64\t\0"
88
1.40M
  /* 745 */ "vrinta.f64\t\0"
89
1.40M
  /* 757 */ "vselge.f64\t\0"
90
1.40M
  /* 769 */ "vminnm.f64\t\0"
91
1.40M
  /* 781 */ "vmaxnm.f64\t\0"
92
1.40M
  /* 793 */ "vrintm.f64\t\0"
93
1.40M
  /* 805 */ "vrintn.f64\t\0"
94
1.40M
  /* 817 */ "vrintp.f64\t\0"
95
1.40M
  /* 829 */ "vseleq.f64\t\0"
96
1.40M
  /* 841 */ "vselvs.f64\t\0"
97
1.40M
  /* 853 */ "vselgt.f64\t\0"
98
1.40M
  /* 865 */ "vmull.p64\t\0"
99
1.40M
  /* 876 */ "vld20.16\t\0"
100
1.40M
  /* 886 */ "vst20.16\t\0"
101
1.40M
  /* 896 */ "vld40.16\t\0"
102
1.40M
  /* 906 */ "vst40.16\t\0"
103
1.40M
  /* 916 */ "vld21.16\t\0"
104
1.40M
  /* 926 */ "vst21.16\t\0"
105
1.40M
  /* 936 */ "vld41.16\t\0"
106
1.40M
  /* 946 */ "vst41.16\t\0"
107
1.40M
  /* 956 */ "vld42.16\t\0"
108
1.40M
  /* 966 */ "vst42.16\t\0"
109
1.40M
  /* 976 */ "vld43.16\t\0"
110
1.40M
  /* 986 */ "vst43.16\t\0"
111
1.40M
  /* 996 */ "dlstp.16\t\0"
112
1.40M
  /* 1006 */ "wlstp.16\t\0"
113
1.40M
  /* 1016 */ "vcvta.s32.f16\t\0"
114
1.40M
  /* 1031 */ "vcvtm.s32.f16\t\0"
115
1.40M
  /* 1046 */ "vcvtn.s32.f16\t\0"
116
1.40M
  /* 1061 */ "vcvtp.s32.f16\t\0"
117
1.40M
  /* 1076 */ "vcvta.u32.f16\t\0"
118
1.40M
  /* 1091 */ "vcvtm.u32.f16\t\0"
119
1.40M
  /* 1106 */ "vcvtn.u32.f16\t\0"
120
1.40M
  /* 1121 */ "vcvtp.u32.f16\t\0"
121
1.40M
  /* 1136 */ "vcvta.s16.f16\t\0"
122
1.40M
  /* 1151 */ "vcvtm.s16.f16\t\0"
123
1.40M
  /* 1166 */ "vcvtn.s16.f16\t\0"
124
1.40M
  /* 1181 */ "vcvtp.s16.f16\t\0"
125
1.40M
  /* 1196 */ "vcvta.u16.f16\t\0"
126
1.40M
  /* 1211 */ "vcvtm.u16.f16\t\0"
127
1.40M
  /* 1226 */ "vcvtn.u16.f16\t\0"
128
1.40M
  /* 1241 */ "vcvtp.u16.f16\t\0"
129
1.40M
  /* 1256 */ "vcmla.f16\t\0"
130
1.40M
  /* 1267 */ "vrinta.f16\t\0"
131
1.40M
  /* 1279 */ "vcadd.f16\t\0"
132
1.40M
  /* 1290 */ "vselge.f16\t\0"
133
1.40M
  /* 1302 */ "vfmal.f16\t\0"
134
1.40M
  /* 1313 */ "vfmsl.f16\t\0"
135
1.40M
  /* 1324 */ "vminnm.f16\t\0"
136
1.40M
  /* 1336 */ "vmaxnm.f16\t\0"
137
1.40M
  /* 1348 */ "vrintm.f16\t\0"
138
1.40M
  /* 1360 */ "vrintn.f16\t\0"
139
1.40M
  /* 1372 */ "vrintp.f16\t\0"
140
1.40M
  /* 1384 */ "vseleq.f16\t\0"
141
1.40M
  /* 1396 */ "vins.f16\t\0"
142
1.40M
  /* 1406 */ "vselvs.f16\t\0"
143
1.40M
  /* 1418 */ "vselgt.f16\t\0"
144
1.40M
  /* 1430 */ "vrintx.f16\t\0"
145
1.40M
  /* 1442 */ "vmovx.f16\t\0"
146
1.40M
  /* 1453 */ "vrintz.f16\t\0"
147
1.40M
  /* 1465 */ "vmmla.bf16\t\0"
148
1.40M
  /* 1477 */ "vfmab.bf16\t\0"
149
1.40M
  /* 1489 */ "vfmat.bf16\t\0"
150
1.40M
  /* 1501 */ "vdot.bf16\t\0"
151
1.40M
  /* 1512 */ "vld20.8\t\0"
152
1.40M
  /* 1521 */ "vst20.8\t\0"
153
1.40M
  /* 1530 */ "vld40.8\t\0"
154
1.40M
  /* 1539 */ "vst40.8\t\0"
155
1.40M
  /* 1548 */ "vld21.8\t\0"
156
1.40M
  /* 1557 */ "vst21.8\t\0"
157
1.40M
  /* 1566 */ "vld41.8\t\0"
158
1.40M
  /* 1575 */ "vst41.8\t\0"
159
1.40M
  /* 1584 */ "vld42.8\t\0"
160
1.40M
  /* 1593 */ "vst42.8\t\0"
161
1.40M
  /* 1602 */ "vld43.8\t\0"
162
1.40M
  /* 1611 */ "vst43.8\t\0"
163
1.40M
  /* 1620 */ "aesimc.8\t\0"
164
1.40M
  /* 1630 */ "aesmc.8\t\0"
165
1.40M
  /* 1639 */ "aesd.8\t\0"
166
1.40M
  /* 1647 */ "aese.8\t\0"
167
1.40M
  /* 1655 */ "dlstp.8\t\0"
168
1.40M
  /* 1664 */ "wlstp.8\t\0"
169
1.40M
  /* 1673 */ "vusmmla.s8\t\0"
170
1.40M
  /* 1685 */ "vsmmla.s8\t\0"
171
1.40M
  /* 1696 */ "vusdot.s8\t\0"
172
1.40M
  /* 1707 */ "vsdot.s8\t\0"
173
1.40M
  /* 1717 */ "vummla.u8\t\0"
174
1.40M
  /* 1728 */ "vsudot.u8\t\0"
175
1.40M
  /* 1739 */ "vudot.u8\t\0"
176
1.40M
  /* 1749 */ "vcx1a\t\0"
177
1.40M
  /* 1756 */ "vcx2a\t\0"
178
1.40M
  /* 1763 */ "vcx3a\t\0"
179
1.40M
  /* 1770 */ "rfeda\t\0"
180
1.40M
  /* 1777 */ "rfeia\t\0"
181
1.40M
  /* 1784 */ "crc32b\t\0"
182
1.40M
  /* 1792 */ "crc32cb\t\0"
183
1.40M
  /* 1801 */ "rfedb\t\0"
184
1.40M
  /* 1808 */ "rfeib\t\0"
185
1.40M
  /* 1815 */ "dmb\t\0"
186
1.40M
  /* 1820 */ "dsb\t\0"
187
1.40M
  /* 1825 */ "isb\t\0"
188
1.40M
  /* 1830 */ "tsb\t\0"
189
1.40M
  /* 1835 */ "csinc\t\0"
190
1.40M
  /* 1842 */ "hvc\t\0"
191
1.40M
  /* 1847 */ "cx1d\t\0"
192
1.40M
  /* 1853 */ "cx2d\t\0"
193
1.40M
  /* 1859 */ "cx3d\t\0"
194
1.40M
  /* 1865 */ "pld\t\0"
195
1.40M
  /* 1870 */ "setend\t\0"
196
1.40M
  /* 1878 */ "le\t\0"
197
1.40M
  /* 1882 */ "udf\t\0"
198
1.40M
  /* 1887 */ "csneg\t\0"
199
1.40M
  /* 1894 */ "crc32h\t\0"
200
1.40M
  /* 1902 */ "crc32ch\t\0"
201
1.40M
  /* 1911 */ "pli\t\0"
202
1.40M
  /* 1916 */ "bti\t\0"
203
1.40M
  /* 1921 */ "ldc2l\t\0"
204
1.40M
  /* 1928 */ "stc2l\t\0"
205
1.40M
  /* 1935 */ "bl\t\0"
206
1.40M
  /* 1939 */ "bfcsel\t\0"
207
1.40M
  /* 1947 */ "setpan\t\0"
208
1.40M
  /* 1955 */ "letp\t\0"
209
1.40M
  /* 1961 */ "dls\t\0"
210
1.40M
  /* 1966 */ "wls\t\0"
211
1.40M
  /* 1971 */ "cps\t\0"
212
1.40M
  /* 1976 */ "movs\t\0"
213
1.40M
  /* 1982 */ "hlt\t\0"
214
1.40M
  /* 1987 */ "bkpt\t\0"
215
1.40M
  /* 1993 */ "csinv\t\0"
216
1.40M
  /* 2000 */ "hvc.w\t\0"
217
1.40M
  /* 2007 */ "udf.w\t\0"
218
1.40M
  /* 2014 */ "crc32w\t\0"
219
1.40M
  /* 2022 */ "crc32cw\t\0"
220
1.40M
  /* 2031 */ "pldw\t\0"
221
1.40M
  /* 2037 */ "bx\t\0"
222
1.40M
  /* 2041 */ "blx\t\0"
223
1.40M
  /* 2046 */ "cbz\t\0"
224
1.40M
  /* 2051 */ "cbnz\t\0"
225
1.40M
  /* 2057 */ "srsda\tsp!, \0"
226
1.40M
  /* 2069 */ "srsia\tsp!, \0"
227
1.40M
  /* 2081 */ "srsdb\tsp!, \0"
228
1.40M
  /* 2093 */ "srsib\tsp!, \0"
229
1.40M
  /* 2105 */ "srsda\tsp, \0"
230
1.40M
  /* 2116 */ "srsia\tsp, \0"
231
1.40M
  /* 2127 */ "srsdb\tsp, \0"
232
1.40M
  /* 2138 */ "srsib\tsp, \0"
233
1.40M
  /* 2149 */ "# XRay Function Patchable RET.\0"
234
1.40M
  /* 2180 */ "# XRay Typed Event Log.\0"
235
1.40M
  /* 2204 */ "# XRay Custom Event Log.\0"
236
1.40M
  /* 2229 */ "# XRay Function Enter.\0"
237
1.40M
  /* 2252 */ "# XRay Tail Call Exit.\0"
238
1.40M
  /* 2275 */ "# XRay Function Exit.\0"
239
1.40M
  /* 2297 */ "__brkdiv0\0"
240
1.40M
  /* 2307 */ "vld1\0"
241
1.40M
  /* 2312 */ "dcps1\0"
242
1.40M
  /* 2318 */ "vst1\0"
243
1.40M
  /* 2323 */ "vcx1\0"
244
1.40M
  /* 2328 */ "vrev32\0"
245
1.40M
  /* 2335 */ "ldc2\0"
246
1.40M
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247
1.40M
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248
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250
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251
1.40M
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256
1.40M
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258
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259
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269
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271
1.40M
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272
1.40M
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273
1.40M
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1.40M
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275
1.40M
  /* 2523 */ "sadd16\0"
276
1.40M
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277
1.40M
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278
1.40M
  /* 2544 */ "usat16\0"
279
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280
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1.40M
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1.40M
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294
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300
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309
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311
1.40M
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312
1.40M
  /* 2811 */ "vrmlsldavha\0"
313
1.40M
  /* 2823 */ "rfeia\0"
314
1.40M
  /* 2829 */ "vldmia\0"
315
1.40M
  /* 2836 */ "vstmia\0"
316
1.40M
  /* 2843 */ "srsia\0"
317
1.40M
  /* 2849 */ "vcmla\0"
318
1.40M
  /* 2855 */ "smmla\0"
319
1.40M
  /* 2861 */ "vnmla\0"
320
1.40M
  /* 2867 */ "vmla\0"
321
1.40M
  /* 2872 */ "vfma\0"
322
1.40M
  /* 2877 */ "vfnma\0"
323
1.40M
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324
1.40M
  /* 2891 */ "vmaxnma\0"
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1.40M
  /* 2899 */ "vmina\0"
326
1.40M
  /* 2905 */ "vrsra\0"
327
1.40M
  /* 2911 */ "vsra\0"
328
1.40M
  /* 2916 */ "vrinta\0"
329
1.40M
  /* 2923 */ "tta\0"
330
1.40M
  /* 2927 */ "vcvta\0"
331
1.40M
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332
1.40M
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333
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1.40M
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336
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338
1.40M
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1.40M
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1.40M
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343
1.40M
  /* 3024 */ "smulbb\0"
344
1.40M
  /* 3031 */ "tbb\0"
345
1.40M
  /* 3035 */ "rfedb\0"
346
1.40M
  /* 3041 */ "vldmdb\0"
347
1.40M
  /* 3048 */ "vstmdb\0"
348
1.40M
  /* 3055 */ "srsdb\0"
349
1.40M
  /* 3061 */ "ldmib\0"
350
1.40M
  /* 3067 */ "stmib\0"
351
1.40M
  /* 3073 */ "vshllb\0"
352
1.40M
  /* 3080 */ "vqdmullb\0"
353
1.40M
  /* 3089 */ "vmullb\0"
354
1.40M
  /* 3096 */ "stlb\0"
355
1.40M
  /* 3101 */ "vmovlb\0"
356
1.40M
  /* 3108 */ "dmb\0"
357
1.40M
  /* 3112 */ "vqshrnb\0"
358
1.40M
  /* 3120 */ "vqrshrnb\0"
359
1.40M
  /* 3129 */ "vrshrnb\0"
360
1.40M
  /* 3137 */ "vshrnb\0"
361
1.40M
  /* 3144 */ "vqshrunb\0"
362
1.40M
  /* 3153 */ "vqrshrunb\0"
363
1.40M
  /* 3163 */ "vqmovunb\0"
364
1.40M
  /* 3172 */ "vqmovnb\0"
365
1.40M
  /* 3180 */ "vmovnb\0"
366
1.40M
  /* 3187 */ "swpb\0"
367
1.40M
  /* 3192 */ "vldrb\0"
368
1.40M
  /* 3198 */ "vstrb\0"
369
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  /* 3204 */ "dsb\0"
370
1.40M
  /* 3208 */ "isb\0"
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372
1.40M
  /* 3218 */ "tsb\0"
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1.40M
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378
1.40M
  /* 3256 */ "sxtb\0"
379
1.40M
  /* 3261 */ "uxtb\0"
380
1.40M
  /* 3266 */ "qdsub\0"
381
1.40M
  /* 3272 */ "vhsub\0"
382
1.40M
  /* 3278 */ "vqsub\0"
383
1.40M
  /* 3284 */ "vsub\0"
384
1.40M
  /* 3289 */ "smlawb\0"
385
1.40M
  /* 3296 */ "smulwb\0"
386
1.40M
  /* 3303 */ "ldaexb\0"
387
1.40M
  /* 3310 */ "stlexb\0"
388
1.40M
  /* 3317 */ "ldrexb\0"
389
1.40M
  /* 3324 */ "strexb\0"
390
1.40M
  /* 3331 */ "vsbc\0"
391
1.40M
  /* 3336 */ "vadc\0"
392
1.40M
  /* 3341 */ "ldc\0"
393
1.40M
  /* 3345 */ "bfc\0"
394
1.40M
  /* 3349 */ "vbic\0"
395
1.40M
  /* 3354 */ "vshlc\0"
396
1.40M
  /* 3360 */ "smc\0"
397
1.40M
  /* 3364 */ "mrc\0"
398
1.40M
  /* 3368 */ "mrrc\0"
399
1.40M
  /* 3373 */ "rsc\0"
400
1.40M
  /* 3377 */ "stc\0"
401
1.40M
  /* 3381 */ "svc\0"
402
1.40M
  /* 3385 */ "smlad\0"
403
1.40M
  /* 3391 */ "smuad\0"
404
1.40M
  /* 3397 */ "vabd\0"
405
1.40M
  /* 3402 */ "vhcadd\0"
406
1.40M
  /* 3409 */ "vcadd\0"
407
1.40M
  /* 3415 */ "qdadd\0"
408
1.40M
  /* 3421 */ "vrhadd\0"
409
1.40M
  /* 3428 */ "vhadd\0"
410
1.40M
  /* 3434 */ "vpadd\0"
411
1.40M
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412
1.40M
  /* 3446 */ "vadd\0"
413
1.40M
  /* 3451 */ "smlald\0"
414
1.40M
  /* 3458 */ "pld\0"
415
1.40M
  /* 3462 */ "smlsld\0"
416
1.40M
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417
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418
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419
1.40M
  /* 3486 */ "smlsd\0"
420
1.40M
  /* 3492 */ "smusd\0"
421
1.40M
  /* 3498 */ "ldaexd\0"
422
1.40M
  /* 3505 */ "stlexd\0"
423
1.40M
  /* 3512 */ "ldrexd\0"
424
1.40M
  /* 3519 */ "strexd\0"
425
1.40M
  /* 3526 */ "vacge\0"
426
1.40M
  /* 3532 */ "vcge\0"
427
1.40M
  /* 3537 */ "vcle\0"
428
1.40M
  /* 3542 */ "vrecpe\0"
429
1.40M
  /* 3549 */ "vcmpe\0"
430
1.40M
  /* 3555 */ "vrsqrte\0"
431
1.40M
  /* 3563 */ "bf\0"
432
1.40M
  /* 3566 */ "vbif\0"
433
1.40M
  /* 3571 */ "dbg\0"
434
1.40M
  /* 3575 */ "pacg\0"
435
1.40M
  /* 3580 */ "vqneg\0"
436
1.40M
  /* 3586 */ "vneg\0"
437
1.40M
  /* 3591 */ "sg\0"
438
1.40M
  /* 3594 */ "autg\0"
439
1.40M
  /* 3599 */ "ldah\0"
440
1.40M
  /* 3604 */ "vqdmlah\0"
441
1.40M
  /* 3612 */ "vqrdmlah\0"
442
1.40M
  /* 3621 */ "sxtah\0"
443
1.40M
  /* 3627 */ "uxtah\0"
444
1.40M
  /* 3633 */ "tbh\0"
445
1.40M
  /* 3637 */ "vqdmladh\0"
446
1.40M
  /* 3646 */ "vqrdmladh\0"
447
1.40M
  /* 3656 */ "vqdmlsdh\0"
448
1.40M
  /* 3665 */ "vqrdmlsdh\0"
449
1.40M
  /* 3675 */ "stlh\0"
450
1.40M
  /* 3680 */ "vqdmulh\0"
451
1.40M
  /* 3688 */ "vqrdmulh\0"
452
1.40M
  /* 3697 */ "vrmulh\0"
453
1.40M
  /* 3704 */ "vmulh\0"
454
1.40M
  /* 3710 */ "vldrh\0"
455
1.40M
  /* 3716 */ "vstrh\0"
456
1.40M
  /* 3722 */ "vqdmlash\0"
457
1.40M
  /* 3731 */ "vqrdmlash\0"
458
1.40M
  /* 3741 */ "vqrdmlsh\0"
459
1.40M
  /* 3750 */ "ldrsh\0"
460
1.40M
  /* 3756 */ "push\0"
461
1.40M
  /* 3761 */ "revsh\0"
462
1.40M
  /* 3767 */ "sxth\0"
463
1.40M
  /* 3772 */ "uxth\0"
464
1.40M
  /* 3777 */ "vrmlaldavh\0"
465
1.40M
  /* 3788 */ "vrmlsldavh\0"
466
1.40M
  /* 3799 */ "ldaexh\0"
467
1.40M
  /* 3806 */ "stlexh\0"
468
1.40M
  /* 3813 */ "ldrexh\0"
469
1.40M
  /* 3820 */ "strexh\0"
470
1.40M
  /* 3827 */ "vsbci\0"
471
1.40M
  /* 3833 */ "vadci\0"
472
1.40M
  /* 3839 */ "bfi\0"
473
1.40M
  /* 3843 */ "pli\0"
474
1.40M
  /* 3847 */ "vsli\0"
475
1.40M
  /* 3852 */ "vsri\0"
476
1.40M
  /* 3857 */ "bxj\0"
477
1.40M
  /* 3861 */ "ldc2l\0"
478
1.40M
  /* 3867 */ "stc2l\0"
479
1.40M
  /* 3873 */ "umaal\0"
480
1.40M
  /* 3879 */ "vabal\0"
481
1.40M
  /* 3885 */ "vpadal\0"
482
1.40M
  /* 3892 */ "vqdmlal\0"
483
1.40M
  /* 3900 */ "smlal\0"
484
1.40M
  /* 3906 */ "umlal\0"
485
1.40M
  /* 3912 */ "vmlal\0"
486
1.40M
  /* 3918 */ "vtbl\0"
487
1.40M
  /* 3923 */ "vsubl\0"
488
1.40M
  /* 3929 */ "ldcl\0"
489
1.40M
  /* 3934 */ "stcl\0"
490
1.40M
  /* 3939 */ "vabdl\0"
491
1.40M
  /* 3945 */ "vpaddl\0"
492
1.40M
  /* 3952 */ "vaddl\0"
493
1.40M
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494
1.40M
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  /* 3968 */ "sqshl\0"
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  /* 3974 */ "uqshl\0"
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1.40M
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502
1.40M
  /* 4011 */ "# FEntry call\0"
503
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504
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1.40M
  /* 4053 */ "lsll\0"
508
1.40M
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509
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777
1.40M
    4012U,  // FENTRY_CALL
778
1.40M
    0U, // PATCHPOINT
779
1.40M
    0U, // LOAD_STACK_GUARD
780
1.40M
    0U, // PREALLOCATED_SETUP
781
1.40M
    0U, // PREALLOCATED_ARG
782
1.40M
    0U, // STATEPOINT
783
1.40M
    0U, // LOCAL_ESCAPE
784
1.40M
    0U, // FAULTING_OP
785
1.40M
    0U, // PATCHABLE_OP
786
1.40M
    2230U,  // PATCHABLE_FUNCTION_ENTER
787
1.40M
    2150U,  // PATCHABLE_RET
788
1.40M
    2276U,  // PATCHABLE_FUNCTION_EXIT
789
1.40M
    2253U,  // PATCHABLE_TAIL_CALL
790
1.40M
    2205U,  // PATCHABLE_EVENT_CALL
791
1.40M
    2181U,  // PATCHABLE_TYPED_EVENT_CALL
792
1.40M
    0U, // ICALL_BRANCH_FUNNEL
793
1.40M
    0U, // MEMBARRIER
794
1.40M
    0U, // JUMP_TABLE_DEBUG_INFO
795
1.40M
    0U, // G_ASSERT_SEXT
796
1.40M
    0U, // G_ASSERT_ZEXT
797
1.40M
    0U, // G_ASSERT_ALIGN
798
1.40M
    0U, // G_ADD
799
1.40M
    0U, // G_SUB
800
1.40M
    0U, // G_MUL
801
1.40M
    0U, // G_SDIV
802
1.40M
    0U, // G_UDIV
803
1.40M
    0U, // G_SREM
804
1.40M
    0U, // G_UREM
805
1.40M
    0U, // G_SDIVREM
806
1.40M
    0U, // G_UDIVREM
807
1.40M
    0U, // G_AND
808
1.40M
    0U, // G_OR
809
1.40M
    0U, // G_XOR
810
1.40M
    0U, // G_IMPLICIT_DEF
811
1.40M
    0U, // G_PHI
812
1.40M
    0U, // G_FRAME_INDEX
813
1.40M
    0U, // G_GLOBAL_VALUE
814
1.40M
    0U, // G_CONSTANT_POOL
815
1.40M
    0U, // G_EXTRACT
816
1.40M
    0U, // G_UNMERGE_VALUES
817
1.40M
    0U, // G_INSERT
818
1.40M
    0U, // G_MERGE_VALUES
819
1.40M
    0U, // G_BUILD_VECTOR
820
1.40M
    0U, // G_BUILD_VECTOR_TRUNC
821
1.40M
    0U, // G_CONCAT_VECTORS
822
1.40M
    0U, // G_PTRTOINT
823
1.40M
    0U, // G_INTTOPTR
824
1.40M
    0U, // G_BITCAST
825
1.40M
    0U, // G_FREEZE
826
1.40M
    0U, // G_CONSTANT_FOLD_BARRIER
827
1.40M
    0U, // G_INTRINSIC_FPTRUNC_ROUND
828
1.40M
    0U, // G_INTRINSIC_TRUNC
829
1.40M
    0U, // G_INTRINSIC_ROUND
830
1.40M
    0U, // G_INTRINSIC_LRINT
831
1.40M
    0U, // G_INTRINSIC_ROUNDEVEN
832
1.40M
    0U, // G_READCYCLECOUNTER
833
1.40M
    0U, // G_LOAD
834
1.40M
    0U, // G_SEXTLOAD
835
1.40M
    0U, // G_ZEXTLOAD
836
1.40M
    0U, // G_INDEXED_LOAD
837
1.40M
    0U, // G_INDEXED_SEXTLOAD
838
1.40M
    0U, // G_INDEXED_ZEXTLOAD
839
1.40M
    0U, // G_STORE
840
1.40M
    0U, // G_INDEXED_STORE
841
1.40M
    0U, // G_ATOMIC_CMPXCHG_WITH_SUCCESS
842
1.40M
    0U, // G_ATOMIC_CMPXCHG
843
1.40M
    0U, // G_ATOMICRMW_XCHG
844
1.40M
    0U, // G_ATOMICRMW_ADD
845
1.40M
    0U, // G_ATOMICRMW_SUB
846
1.40M
    0U, // G_ATOMICRMW_AND
847
1.40M
    0U, // G_ATOMICRMW_NAND
848
1.40M
    0U, // G_ATOMICRMW_OR
849
1.40M
    0U, // G_ATOMICRMW_XOR
850
1.40M
    0U, // G_ATOMICRMW_MAX
851
1.40M
    0U, // G_ATOMICRMW_MIN
852
1.40M
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853
1.40M
    0U, // G_ATOMICRMW_UMIN
854
1.40M
    0U, // G_ATOMICRMW_FADD
855
1.40M
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856
1.40M
    0U, // G_ATOMICRMW_FMAX
857
1.40M
    0U, // G_ATOMICRMW_FMIN
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1.40M
    0U, // G_ATOMICRMW_UINC_WRAP
859
1.40M
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860
1.40M
    0U, // G_FENCE
861
1.40M
    0U, // G_PREFETCH
862
1.40M
    0U, // G_BRCOND
863
1.40M
    0U, // G_BRINDIRECT
864
1.40M
    0U, // G_INVOKE_REGION_START
865
1.40M
    0U, // G_INTRINSIC
866
1.40M
    0U, // G_INTRINSIC_W_SIDE_EFFECTS
867
1.40M
    0U, // G_INTRINSIC_CONVERGENT
868
1.40M
    0U, // G_INTRINSIC_CONVERGENT_W_SIDE_EFFECTS
869
1.40M
    0U, // G_ANYEXT
870
1.40M
    0U, // G_TRUNC
871
1.40M
    0U, // G_CONSTANT
872
1.40M
    0U, // G_FCONSTANT
873
1.40M
    0U, // G_VASTART
874
1.40M
    0U, // G_VAARG
875
1.40M
    0U, // G_SEXT
876
1.40M
    0U, // G_SEXT_INREG
877
1.40M
    0U, // G_ZEXT
878
1.40M
    0U, // G_SHL
879
1.40M
    0U, // G_LSHR
880
1.40M
    0U, // G_ASHR
881
1.40M
    0U, // G_FSHL
882
1.40M
    0U, // G_FSHR
883
1.40M
    0U, // G_ROTR
884
1.40M
    0U, // G_ROTL
885
1.40M
    0U, // G_ICMP
886
1.40M
    0U, // G_FCMP
887
1.40M
    0U, // G_SELECT
888
1.40M
    0U, // G_UADDO
889
1.40M
    0U, // G_UADDE
890
1.40M
    0U, // G_USUBO
891
1.40M
    0U, // G_USUBE
892
1.40M
    0U, // G_SADDO
893
1.40M
    0U, // G_SADDE
894
1.40M
    0U, // G_SSUBO
895
1.40M
    0U, // G_SSUBE
896
1.40M
    0U, // G_UMULO
897
1.40M
    0U, // G_SMULO
898
1.40M
    0U, // G_UMULH
899
1.40M
    0U, // G_SMULH
900
1.40M
    0U, // G_UADDSAT
901
1.40M
    0U, // G_SADDSAT
902
1.40M
    0U, // G_USUBSAT
903
1.40M
    0U, // G_SSUBSAT
904
1.40M
    0U, // G_USHLSAT
905
1.40M
    0U, // G_SSHLSAT
906
1.40M
    0U, // G_SMULFIX
907
1.40M
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908
1.40M
    0U, // G_SMULFIXSAT
909
1.40M
    0U, // G_UMULFIXSAT
910
1.40M
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911
1.40M
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912
1.40M
    0U, // G_SDIVFIXSAT
913
1.40M
    0U, // G_UDIVFIXSAT
914
1.40M
    0U, // G_FADD
915
1.40M
    0U, // G_FSUB
916
1.40M
    0U, // G_FMUL
917
1.40M
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918
1.40M
    0U, // G_FMAD
919
1.40M
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920
1.40M
    0U, // G_FREM
921
1.40M
    0U, // G_FPOW
922
1.40M
    0U, // G_FPOWI
923
1.40M
    0U, // G_FEXP
924
1.40M
    0U, // G_FEXP2
925
1.40M
    0U, // G_FEXP10
926
1.40M
    0U, // G_FLOG
927
1.40M
    0U, // G_FLOG2
928
1.40M
    0U, // G_FLOG10
929
1.40M
    0U, // G_FLDEXP
930
1.40M
    0U, // G_FFREXP
931
1.40M
    0U, // G_FNEG
932
1.40M
    0U, // G_FPEXT
933
1.40M
    0U, // G_FPTRUNC
934
1.40M
    0U, // G_FPTOSI
935
1.40M
    0U, // G_FPTOUI
936
1.40M
    0U, // G_SITOFP
937
1.40M
    0U, // G_UITOFP
938
1.40M
    0U, // G_FABS
939
1.40M
    0U, // G_FCOPYSIGN
940
1.40M
    0U, // G_IS_FPCLASS
941
1.40M
    0U, // G_FCANONICALIZE
942
1.40M
    0U, // G_FMINNUM
943
1.40M
    0U, // G_FMAXNUM
944
1.40M
    0U, // G_FMINNUM_IEEE
945
1.40M
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946
1.40M
    0U, // G_FMINIMUM
947
1.40M
    0U, // G_FMAXIMUM
948
1.40M
    0U, // G_GET_FPENV
949
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    0U, // G_SET_FPENV
950
1.40M
    0U, // G_RESET_FPENV
951
1.40M
    0U, // G_GET_FPMODE
952
1.40M
    0U, // G_SET_FPMODE
953
1.40M
    0U, // G_RESET_FPMODE
954
1.40M
    0U, // G_PTR_ADD
955
1.40M
    0U, // G_PTRMASK
956
1.40M
    0U, // G_SMIN
957
1.40M
    0U, // G_SMAX
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1.40M
    0U, // G_UMIN
959
1.40M
    0U, // G_UMAX
960
1.40M
    0U, // G_ABS
961
1.40M
    0U, // G_LROUND
962
1.40M
    0U, // G_LLROUND
963
1.40M
    0U, // G_BR
964
1.40M
    0U, // G_BRJT
965
1.40M
    0U, // G_INSERT_VECTOR_ELT
966
1.40M
    0U, // G_EXTRACT_VECTOR_ELT
967
1.40M
    0U, // G_SHUFFLE_VECTOR
968
1.40M
    0U, // G_CTTZ
969
1.40M
    0U, // G_CTTZ_ZERO_UNDEF
970
1.40M
    0U, // G_CTLZ
971
1.40M
    0U, // G_CTLZ_ZERO_UNDEF
972
1.40M
    0U, // G_CTPOP
973
1.40M
    0U, // G_BSWAP
974
1.40M
    0U, // G_BITREVERSE
975
1.40M
    0U, // G_FCEIL
976
1.40M
    0U, // G_FCOS
977
1.40M
    0U, // G_FSIN
978
1.40M
    0U, // G_FSQRT
979
1.40M
    0U, // G_FFLOOR
980
1.40M
    0U, // G_FRINT
981
1.40M
    0U, // G_FNEARBYINT
982
1.40M
    0U, // G_ADDRSPACE_CAST
983
1.40M
    0U, // G_BLOCK_ADDR
984
1.40M
    0U, // G_JUMP_TABLE
985
1.40M
    0U, // G_DYN_STACKALLOC
986
1.40M
    0U, // G_STACKSAVE
987
1.40M
    0U, // G_STACKRESTORE
988
1.40M
    0U, // G_STRICT_FADD
989
1.40M
    0U, // G_STRICT_FSUB
990
1.40M
    0U, // G_STRICT_FMUL
991
1.40M
    0U, // G_STRICT_FDIV
992
1.40M
    0U, // G_STRICT_FREM
993
1.40M
    0U, // G_STRICT_FMA
994
1.40M
    0U, // G_STRICT_FSQRT
995
1.40M
    0U, // G_STRICT_FLDEXP
996
1.40M
    0U, // G_READ_REGISTER
997
1.40M
    0U, // G_WRITE_REGISTER
998
1.40M
    0U, // G_MEMCPY
999
1.40M
    0U, // G_MEMCPY_INLINE
1000
1.40M
    0U, // G_MEMMOVE
1001
1.40M
    0U, // G_MEMSET
1002
1.40M
    0U, // G_BZERO
1003
1.40M
    0U, // G_VECREDUCE_SEQ_FADD
1004
1.40M
    0U, // G_VECREDUCE_SEQ_FMUL
1005
1.40M
    0U, // G_VECREDUCE_FADD
1006
1.40M
    0U, // G_VECREDUCE_FMUL
1007
1.40M
    0U, // G_VECREDUCE_FMAX
1008
1.40M
    0U, // G_VECREDUCE_FMIN
1009
1.40M
    0U, // G_VECREDUCE_FMAXIMUM
1010
1.40M
    0U, // G_VECREDUCE_FMINIMUM
1011
1.40M
    0U, // G_VECREDUCE_ADD
1012
1.40M
    0U, // G_VECREDUCE_MUL
1013
1.40M
    0U, // G_VECREDUCE_AND
1014
1.40M
    0U, // G_VECREDUCE_OR
1015
1.40M
    0U, // G_VECREDUCE_XOR
1016
1.40M
    0U, // G_VECREDUCE_SMAX
1017
1.40M
    0U, // G_VECREDUCE_SMIN
1018
1.40M
    0U, // G_VECREDUCE_UMAX
1019
1.40M
    0U, // G_VECREDUCE_UMIN
1020
1.40M
    0U, // G_SBFX
1021
1.40M
    0U, // G_UBFX
1022
1.40M
    0U, // ABS
1023
1.40M
    0U, // ADDSri
1024
1.40M
    0U, // ADDSrr
1025
1.40M
    0U, // ADDSrsi
1026
1.40M
    0U, // ADDSrsr
1027
1.40M
    0U, // ADJCALLSTACKDOWN
1028
1.40M
    0U, // ADJCALLSTACKUP
1029
1.40M
    12770U, // ASRi
1030
1.40M
    12770U, // ASRr
1031
1.40M
    0U, // B
1032
1.40M
    0U, // BCCZi64
1033
1.40M
    0U, // BCCi64
1034
1.40M
    0U, // BLX_noip
1035
1.40M
    0U, // BLX_pred_noip
1036
1.40M
    0U, // BL_PUSHLR
1037
1.40M
    0U, // BMOVPCB_CALL
1038
1.40M
    0U, // BMOVPCRX_CALL
1039
1.40M
    0U, // BR_JTadd
1040
1.40M
    0U, // BR_JTm_i12
1041
1.40M
    0U, // BR_JTm_rs
1042
1.40M
    0U, // BR_JTr
1043
1.40M
    0U, // BX_CALL
1044
1.40M
    0U, // CMP_SWAP_16
1045
1.40M
    0U, // CMP_SWAP_32
1046
1.40M
    0U, // CMP_SWAP_64
1047
1.40M
    0U, // CMP_SWAP_8
1048
1.40M
    0U, // CONSTPOOL_ENTRY
1049
1.40M
    0U, // COPY_STRUCT_BYVAL_I32
1050
1.40M
    67130072U,  // ITasm
1051
1.40M
    0U, // Int_eh_sjlj_dispatchsetup
1052
1.40M
    0U, // Int_eh_sjlj_longjmp
1053
1.40M
    0U, // Int_eh_sjlj_setjmp
1054
1.40M
    0U, // Int_eh_sjlj_setjmp_nofp
1055
1.40M
    0U, // Int_eh_sjlj_setup_dispatch
1056
1.40M
    0U, // JUMPTABLE_ADDRS
1057
1.40M
    0U, // JUMPTABLE_INSTS
1058
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1063
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1066
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    0U, // LDRLIT_ga_pcrel_ldr
1067
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1068
1.40M
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1070
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    0U, // LEApcrel
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1.40M
    0U, // LEApcrelJT
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1.40M
    12777U, // LSRr
1077
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1079
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1082
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1089
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1090
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1092
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    0U, // MQQQQPRLoad
1097
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    0U, // MQQQQPRStore
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1100
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    0U, // MVE_MEMSETLOOPINST
1101
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    0U, // MVNCCi
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1103
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1104
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1109
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1112
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1115
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    0U, // SEH_EpilogEnd
1119
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    0U, // SEH_EpilogStart
1120
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1122
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    0U, // SEH_SaveRegs_Ret
1127
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    0U, // SEH_StackAlloc
1129
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    0U, // STOREDUAL
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1134
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    0U, // STRBi_preidx
1135
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    0U, // STRBr_preidx
1136
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1138
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    0U, // STRi_preidx
1139
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    0U, // STRr_preidx
1140
1.40M
    0U, // SUBS_PC_LR
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1.40M
    0U, // SpeculationBarrierISBDSBEndBB
1146
1.40M
    0U, // SpeculationBarrierSBEndBB
1147
1.40M
    0U, // TAILJMPd
1148
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    0U, // TAILJMPr
1149
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    0U, // TAILJMPr4
1150
1.40M
    0U, // TCRETURNdi
1151
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    0U, // TCRETURNri
1152
1.40M
    0U, // TPsoft
1153
1.40M
    0U, // UMLALv5
1154
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1171
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1.40M
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1.40M
    567605U,  // VLD2LNqWB_fixed_Asm_16
1176
1.40M
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1.40M
    575797U,  // VLD2LNqWB_register_Asm_16
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1.40M
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1.40M
    0U, // G_INTRINSIC_TRUNC
5297
1.40M
    0U, // G_INTRINSIC_ROUND
5298
1.40M
    0U, // G_INTRINSIC_LRINT
5299
1.40M
    0U, // G_INTRINSIC_ROUNDEVEN
5300
1.40M
    0U, // G_READCYCLECOUNTER
5301
1.40M
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5302
1.40M
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5303
1.40M
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5304
1.40M
    0U, // G_INDEXED_LOAD
5305
1.40M
    0U, // G_INDEXED_SEXTLOAD
5306
1.40M
    0U, // G_INDEXED_ZEXTLOAD
5307
1.40M
    0U, // G_STORE
5308
1.40M
    0U, // G_INDEXED_STORE
5309
1.40M
    0U, // G_ATOMIC_CMPXCHG_WITH_SUCCESS
5310
1.40M
    0U, // G_ATOMIC_CMPXCHG
5311
1.40M
    0U, // G_ATOMICRMW_XCHG
5312
1.40M
    0U, // G_ATOMICRMW_ADD
5313
1.40M
    0U, // G_ATOMICRMW_SUB
5314
1.40M
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5315
1.40M
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5316
1.40M
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5317
1.40M
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5318
1.40M
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5319
1.40M
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5320
1.40M
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5321
1.40M
    0U, // G_ATOMICRMW_UMIN
5322
1.40M
    0U, // G_ATOMICRMW_FADD
5323
1.40M
    0U, // G_ATOMICRMW_FSUB
5324
1.40M
    0U, // G_ATOMICRMW_FMAX
5325
1.40M
    0U, // G_ATOMICRMW_FMIN
5326
1.40M
    0U, // G_ATOMICRMW_UINC_WRAP
5327
1.40M
    0U, // G_ATOMICRMW_UDEC_WRAP
5328
1.40M
    0U, // G_FENCE
5329
1.40M
    0U, // G_PREFETCH
5330
1.40M
    0U, // G_BRCOND
5331
1.40M
    0U, // G_BRINDIRECT
5332
1.40M
    0U, // G_INVOKE_REGION_START
5333
1.40M
    0U, // G_INTRINSIC
5334
1.40M
    0U, // G_INTRINSIC_W_SIDE_EFFECTS
5335
1.40M
    0U, // G_INTRINSIC_CONVERGENT
5336
1.40M
    0U, // G_INTRINSIC_CONVERGENT_W_SIDE_EFFECTS
5337
1.40M
    0U, // G_ANYEXT
5338
1.40M
    0U, // G_TRUNC
5339
1.40M
    0U, // G_CONSTANT
5340
1.40M
    0U, // G_FCONSTANT
5341
1.40M
    0U, // G_VASTART
5342
1.40M
    0U, // G_VAARG
5343
1.40M
    0U, // G_SEXT
5344
1.40M
    0U, // G_SEXT_INREG
5345
1.40M
    0U, // G_ZEXT
5346
1.40M
    0U, // G_SHL
5347
1.40M
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5348
1.40M
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5349
1.40M
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1.40M
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5351
1.40M
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5352
1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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5357
1.40M
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5358
1.40M
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5359
1.40M
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5360
1.40M
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5361
1.40M
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5362
1.40M
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5363
1.40M
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1.40M
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5365
1.40M
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1.40M
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5367
1.40M
    0U, // G_SMULH
5368
1.40M
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5369
1.40M
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1.40M
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1.40M
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1.40M
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5373
1.40M
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1.40M
    0U, // G_SMULFIX
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
    0U, // G_FABS
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1.40M
    0U, // G_FCOPYSIGN
5408
1.40M
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5409
1.40M
    0U, // G_FCANONICALIZE
5410
1.40M
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5420
1.40M
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5421
1.40M
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5422
1.40M
    0U, // G_PTR_ADD
5423
1.40M
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1.40M
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1.40M
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1.40M
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5430
1.40M
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1.40M
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1.40M
    0U, // G_BRJT
5433
1.40M
    0U, // G_INSERT_VECTOR_ELT
5434
1.40M
    0U, // G_EXTRACT_VECTOR_ELT
5435
1.40M
    0U, // G_SHUFFLE_VECTOR
5436
1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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5442
1.40M
    0U, // G_BITREVERSE
5443
1.40M
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5444
1.40M
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1.40M
    0U, // G_FSIN
5446
1.40M
    0U, // G_FSQRT
5447
1.40M
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5448
1.40M
    0U, // G_FRINT
5449
1.40M
    0U, // G_FNEARBYINT
5450
1.40M
    0U, // G_ADDRSPACE_CAST
5451
1.40M
    0U, // G_BLOCK_ADDR
5452
1.40M
    0U, // G_JUMP_TABLE
5453
1.40M
    0U, // G_DYN_STACKALLOC
5454
1.40M
    0U, // G_STACKSAVE
5455
1.40M
    0U, // G_STACKRESTORE
5456
1.40M
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5457
1.40M
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5458
1.40M
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1.40M
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1.40M
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5461
1.40M
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5462
1.40M
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5463
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    0U, // G_STRICT_FLDEXP
5464
1.40M
    0U, // G_READ_REGISTER
5465
1.40M
    0U, // G_WRITE_REGISTER
5466
1.40M
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5467
1.40M
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5468
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5469
1.40M
    0U, // G_MEMSET
5470
1.40M
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5471
1.40M
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5472
1.40M
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5473
1.40M
    0U, // G_VECREDUCE_FADD
5474
1.40M
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5475
1.40M
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5476
1.40M
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5477
1.40M
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5478
1.40M
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5479
1.40M
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5480
1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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5490
1.40M
    0U, // ABS
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1.40M
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5492
1.40M
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5494
1.40M
    0U, // ADDSrsr
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1.40M
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5496
1.40M
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1.40M
    0U, // ASRi
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1.40M
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5499
1.40M
    0U, // B
5500
1.40M
    0U, // BCCZi64
5501
1.40M
    0U, // BCCi64
5502
1.40M
    0U, // BLX_noip
5503
1.40M
    0U, // BLX_pred_noip
5504
1.40M
    0U, // BL_PUSHLR
5505
1.40M
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5506
1.40M
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5507
1.40M
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1.40M
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5509
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5510
1.40M
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5511
1.40M
    0U, // BX_CALL
5512
1.40M
    0U, // CMP_SWAP_16
5513
1.40M
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1.40M
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5515
1.40M
    0U, // CMP_SWAP_8
5516
1.40M
    0U, // CONSTPOOL_ENTRY
5517
1.40M
    0U, // COPY_STRUCT_BYVAL_I32
5518
1.40M
    0U, // ITasm
5519
1.40M
    0U, // Int_eh_sjlj_dispatchsetup
5520
1.40M
    0U, // Int_eh_sjlj_longjmp
5521
1.40M
    0U, // Int_eh_sjlj_setjmp
5522
1.40M
    0U, // Int_eh_sjlj_setjmp_nofp
5523
1.40M
    0U, // Int_eh_sjlj_setup_dispatch
5524
1.40M
    0U, // JUMPTABLE_ADDRS
5525
1.40M
    0U, // JUMPTABLE_INSTS
5526
1.40M
    0U, // JUMPTABLE_TBB
5527
1.40M
    0U, // JUMPTABLE_TBH
5528
1.40M
    0U, // LDMIA_RET
5529
1.40M
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5530
1.40M
    16384U, // LDRConstPool
5531
1.40M
    128U, // LDRHTii
5532
1.40M
    0U, // LDRLIT_ga_abs
5533
1.40M
    0U, // LDRLIT_ga_pcrel
5534
1.40M
    0U, // LDRLIT_ga_pcrel_ldr
5535
1.40M
    128U, // LDRSBTii
5536
1.40M
    128U, // LDRSHTii
5537
1.40M
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5538
1.40M
    0U, // LEApcrel
5539
1.40M
    0U, // LEApcrelJT
5540
1.40M
    0U, // LOADDUAL
5541
1.40M
    0U, // LSLi
5542
1.40M
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5543
1.40M
    0U, // LSRi
5544
1.40M
    0U, // LSRr
5545
1.40M
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5546
1.40M
    0U, // MLAv5
5547
1.40M
    0U, // MOVCCi
5548
1.40M
    0U, // MOVCCi16
5549
1.40M
    0U, // MOVCCi32imm
5550
1.40M
    0U, // MOVCCr
5551
1.40M
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5552
1.40M
    0U, // MOVCCsr
5553
1.40M
    0U, // MOVPCRX
5554
1.40M
    0U, // MOVTi16_ga_pcrel
5555
1.40M
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5556
1.40M
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5557
1.40M
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1.40M
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1.40M
    0U, // MOVsra_glue
5560
1.40M
    0U, // MOVsrl_glue
5561
1.40M
    0U, // MQPRCopy
5562
1.40M
    0U, // MQQPRLoad
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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1.40M
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5940
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1.40M
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1.40M
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1.40M
    0U, // tCMP_SWAP_8
5944
1.40M
    0U, // tLDMIA_UPD
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1.40M
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1.40M
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1.40M
    0U, // tLDR_postidx
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1.40M
    0U, // tLDRpci_pic
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1.40M
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1.40M
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1.40M
    0U, // tLSLSri
5953
1.40M
    0U, // tMOVCCr_pseudo
5954
1.40M
    0U, // tMOVi32imm
5955
1.40M
    0U, // tPOP_RET
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1.40M
    0U, // tRSBS
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1.40M
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1.40M
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1.40M
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5962
1.40M
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1.40M
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5965
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5966
1.40M
    0U, // tTPsoft
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1.40M
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5968
1.40M
    0U, // ADCrr
5969
1.40M
    1572864U, // ADCrsi
5970
1.40M
    0U, // ADCrsr
5971
1.40M
    1048576U, // ADDri
5972
1.40M
    0U, // ADDrr
5973
1.40M
    1572864U, // ADDrsi
5974
1.40M
    0U, // ADDrsr
5975
1.40M
    1280U,  // ADR
5976
1.40M
    2U, // AESD
5977
1.40M
    2U, // AESE
5978
1.40M
    2U, // AESIMC
5979
1.40M
    2U, // AESMC
5980
1.40M
    1048576U, // ANDri
5981
1.40M
    0U, // ANDrr
5982
1.40M
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5983
1.40M
    0U, // ANDrsr
5984
1.40M
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5985
1.40M
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1.40M
    2U, // BF16VDOTS_VDOTD
5987
1.40M
    2U, // BF16VDOTS_VDOTQ
5988
1.40M
    2U, // BF16_VCVT
5989
1.40M
    2U, // BF16_VCVTB
5990
1.40M
    2U, // BF16_VCVTT
5991
1.40M
    1408U,  // BFC
5992
1.40M
    2098688U, // BFI
5993
1.40M
    1048576U, // BICri
5994
1.40M
    0U, // BICrr
5995
1.40M
    1572864U, // BICrsi
5996
1.40M
    0U, // BICrsr
5997
1.40M
    0U, // BKPT
5998
1.40M
    0U, // BL
5999
1.40M
    0U, // BLX
6000
1.40M
    2U, // BLX_pred
6001
1.40M
    0U, // BLXi
6002
1.40M
    2U, // BL_pred
6003
1.40M
    0U, // BX
6004
1.40M
    2U, // BXJ
6005
1.40M
    0U, // BX_RET
6006
1.40M
    2U, // BX_pred
6007
1.40M
    2U, // Bcc
6008
1.40M
    2U, // CDE_CX1
6009
1.40M
    16778U, // CDE_CX1A
6010
1.40M
    0U, // CDE_CX1D
6011
1.40M
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1.40M
    16768U, // CDE_CX2
6013
1.40M
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6014
1.40M
    526U, // CDE_CX2D
6015
1.40M
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6016
1.40M
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1.40M
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1.40M
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1.40M
    70320908U,  // CDE_CX3DA
6020
1.40M
    2U, // CDE_VCX1A_fpdp
6021
1.40M
    2U, // CDE_VCX1A_fpsp
6022
1.40M
    16778U, // CDE_VCX1A_vec
6023
1.40M
    2U, // CDE_VCX1_fpdp
6024
1.40M
    2U, // CDE_VCX1_fpsp
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1.40M
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1.40M
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1.40M
    18048U, // CDE_VCX2A_fpsp
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1.40M
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1.40M
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1.40M
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1.40M
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6032
1.40M
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6033
1.40M
    4195968U, // CDE_VCX3A_fpsp
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9578
1.40M
    0U, // t2UQASX
9579
1.40M
    0U, // t2UQSAX
9580
1.40M
    0U, // t2UQSUB16
9581
1.40M
    0U, // t2UQSUB8
9582
1.40M
    0U, // t2USAD8
9583
1.40M
    33554432U,  // t2USADA8
9584
1.40M
    301989888U, // t2USAT
9585
1.40M
    0U, // t2USAT16
9586
1.40M
    0U, // t2USAX
9587
1.40M
    0U, // t2USUB16
9588
1.40M
    0U, // t2USUB8
9589
1.40M
    268435456U, // t2UXTAB
9590
1.40M
    268435456U, // t2UXTAB16
9591
1.40M
    268435456U, // t2UXTAH
9592
1.40M
    229376U,  // t2UXTB
9593
1.40M
    229376U,  // t2UXTB16
9594
1.40M
    229376U,  // t2UXTH
9595
1.40M
    21504U, // t2WLS
9596
1.40M
    2U, // tADC
9597
1.40M
    17920U, // tADDhirr
9598
1.40M
    16768U, // tADDi3
9599
1.40M
    2U, // tADDi8
9600
1.40M
    0U, // tADDrSP
9601
1.40M
    19398656U,  // tADDrSPi
9602
1.40M
    16768U, // tADDrr
9603
1.40M
    8960U,  // tADDspi
9604
1.40M
    17920U, // tADDspr
9605
1.40M
    9088U,  // tADR
9606
1.40M
    2U, // tAND
9607
1.40M
    9216U,  // tASRri
9608
1.40M
    2U, // tASRrr
9609
1.40M
    2U, // tB
9610
1.40M
    2U, // tBIC
9611
1.40M
    0U, // tBKPT
9612
1.40M
    1U, // tBL
9613
1.40M
    2U, // tBLXNSr
9614
1.40M
    1U, // tBLXi
9615
1.40M
    2U, // tBLXr
9616
1.40M
    2U, // tBX
9617
1.40M
    2U, // tBXNS
9618
1.40M
    2U, // tBcc
9619
1.40M
    2U, // tCBNZ
9620
1.40M
    2U, // tCBZ
9621
1.40M
    16384U, // tCMNz
9622
1.40M
    16384U, // tCMPhir
9623
1.40M
    16384U, // tCMPi8
9624
1.40M
    16384U, // tCMPr
9625
1.40M
    2U, // tCPS
9626
1.40M
    2U, // tEOR
9627
1.40M
    2U, // tHINT
9628
1.40M
    0U, // tHLT
9629
1.40M
    0U, // tInt_WIN_eh_sjlj_longjmp
9630
1.40M
    0U, // tInt_eh_sjlj_longjmp
9631
1.40M
    0U, // tInt_eh_sjlj_setjmp
9632
1.40M
    18560U, // tLDMIA
9633
1.40M
    9344U,  // tLDRBi
9634
1.40M
    9472U,  // tLDRBr
9635
1.40M
    9600U,  // tLDRHi
9636
1.40M
    9472U,  // tLDRHr
9637
1.40M
    9472U,  // tLDRSB
9638
1.40M
    9472U,  // tLDRSH
9639
1.40M
    9728U,  // tLDRi
9640
1.40M
    8448U,  // tLDRpci
9641
1.40M
    9472U,  // tLDRr
9642
1.40M
    9856U,  // tLDRspi
9643
1.40M
    16768U, // tLSLri
9644
1.40M
    2U, // tLSLrr
9645
1.40M
    9216U,  // tLSRri
9646
1.40M
    2U, // tLSRrr
9647
1.40M
    2U, // tMOVSr
9648
1.40M
    0U, // tMOVi8
9649
1.40M
    16384U, // tMOVr
9650
1.40M
    16768U, // tMUL
9651
1.40M
    0U, // tMVN
9652
1.40M
    2U, // tORR
9653
1.40M
    0U, // tPICADD
9654
1.40M
    0U, // tPOP
9655
1.40M
    0U, // tPUSH
9656
1.40M
    16384U, // tREV
9657
1.40M
    16384U, // tREV16
9658
1.40M
    16384U, // tREVSH
9659
1.40M
    2U, // tROR
9660
1.40M
    0U, // tRSB
9661
1.40M
    2U, // tSBC
9662
1.40M
    0U, // tSETEND
9663
1.40M
    532U, // tSTMIA_UPD
9664
1.40M
    9344U,  // tSTRBi
9665
1.40M
    9472U,  // tSTRBr
9666
1.40M
    9600U,  // tSTRHi
9667
1.40M
    9472U,  // tSTRHr
9668
1.40M
    9728U,  // tSTRi
9669
1.40M
    9472U,  // tSTRr
9670
1.40M
    9856U,  // tSTRspi
9671
1.40M
    16768U, // tSUBi3
9672
1.40M
    2U, // tSUBi8
9673
1.40M
    16768U, // tSUBrr
9674
1.40M
    8960U,  // tSUBspi
9675
1.40M
    2U, // tSVC
9676
1.40M
    16384U, // tSXTB
9677
1.40M
    16384U, // tSXTH
9678
1.40M
    0U, // tTRAP
9679
1.40M
    16384U, // tTST
9680
1.40M
    0U, // tUDF
9681
1.40M
    16384U, // tUXTB
9682
1.40M
    16384U, // tUXTH
9683
1.40M
    0U, // t__brkdiv0
9684
1.40M
  };
9685
9686
  // Emit the opcode for the instruction.
9687
1.40M
  uint64_t Bits = 0;
9688
1.40M
  Bits |= (uint64_t)OpInfo0[MCInst_getOpcode(MI)] << 0;
9689
1.40M
  Bits |= (uint64_t)OpInfo1[MCInst_getOpcode(MI)] << 32;
9690
1.40M
  MnemonicBitsInfo MBI = {
9691
1.40M
#ifndef CAPSTONE_DIET
9692
1.40M
    AsmStrs+(Bits & 8191)-1,
9693
#else
9694
    NULL,
9695
#endif // CAPSTONE_DIET
9696
1.40M
    Bits
9697
1.40M
  };
9698
1.40M
  return MBI;
9699
1.40M
}
9700
9701
/// printInstruction - This method is automatically generated by tablegen
9702
/// from the instruction set description.
9703
1.40M
static void printInstruction(MCInst *MI, uint64_t Address, SStream *O) {
9704
1.40M
  SStream_concat0(O, "");
9705
1.40M
  MnemonicBitsInfo MnemonicInfo = getMnemonic(MI, O);
9706
9707
1.40M
  SStream_concat0(O, MnemonicInfo.first);
9708
9709
1.40M
  uint64_t Bits = MnemonicInfo.second;
9710
1.40M
  CS_ASSERT_RET(Bits != 0 && "Cannot print this instruction.");
9711
9712
  // Fragment 0 encoded into 6 bits for 43 unique commands.
9713
1.40M
  switch ((Bits >> 13) & 63) {
9714
0
  default: CS_ASSERT_RET(0 && "Invalid command number.");
9715
1.50k
  case 0:
9716
    // DBG_VALUE, DBG_VALUE_LIST, DBG_INSTR_REF, DBG_PHI, DBG_LABEL, BUNDLE, ...
9717
1.50k
    return;
9718
0
    break;
9719
25.1k
  case 1:
9720
    // ASRi, ASRr, LSLi, LSLr, LSRi, LSRr, RORi, RORr, ADCri, ADCrr, ADDri, A...
9721
25.1k
    printSBitModifierOperand(MI, 5, O);
9722
25.1k
    printPredicateOperand(MI, 3, O);
9723
25.1k
    break;
9724
13.6k
  case 2:
9725
    // ITasm, t2IT
9726
13.6k
    printThumbITMask(MI, 1, O);
9727
13.6k
    break;
9728
156k
  case 3:
9729
    // LDRBT_POST, LDRConstPool, LDRHTii, LDRSBTii, LDRSHTii, LDRT_POST, STRB...
9730
156k
    printPredicateOperand(MI, 2, O);
9731
156k
    break;
9732
3.64k
  case 4:
9733
    // RRXi, MOVi, MOVr, MOVr_TC, MVNi, MVNr, t2MOVi, t2MOVr, t2MVNi, t2MVNr,...
9734
3.64k
    printSBitModifierOperand(MI, 4, O);
9735
3.64k
    printPredicateOperand(MI, 2, O);
9736
3.64k
    break;
9737
93.4k
  case 5:
9738
    // VLD1LNdAsm_16, VLD1LNdAsm_32, VLD1LNdAsm_8, VLD1LNdWB_fixed_Asm_16, VL...
9739
93.4k
    printPredicateOperand(MI, 4, O);
9740
93.4k
    break;
9741
51.6k
  case 6:
9742
    // VLD1LNdWB_register_Asm_16, VLD1LNdWB_register_Asm_32, VLD1LNdWB_regist...
9743
51.6k
    printPredicateOperand(MI, 5, O);
9744
51.6k
    break;
9745
320k
  case 7:
9746
    // VLD3DUPdAsm_16, VLD3DUPdAsm_32, VLD3DUPdAsm_8, VLD3DUPdWB_fixed_Asm_16...
9747
320k
    printPredicateOperand(MI, 3, O);
9748
320k
    break;
9749
17.0k
  case 8:
9750
    // ADCrsi, ADDrsi, ANDrsi, BICrsi, EORrsi, MLA, MOVsr, MVNsr, ORRrsi, RSB...
9751
17.0k
    printSBitModifierOperand(MI, 6, O);
9752
17.0k
    printPredicateOperand(MI, 4, O);
9753
17.0k
    break;
9754
5.56k
  case 9:
9755
    // ADCrsr, ADDrsr, ANDrsr, BICrsr, EORrsr, ORRrsr, RSBrsr, RSCrsr, SBCrsr...
9756
5.56k
    printSBitModifierOperand(MI, 7, O);
9757
5.56k
    printPredicateOperand(MI, 5, O);
9758
5.56k
    SStream_concat0(O, "\t");
9759
5.56k
    printOperand(MI, 0, O);
9760
5.56k
    SStream_concat0(O, ", ");
9761
5.56k
    printOperand(MI, 1, O);
9762
5.56k
    SStream_concat0(O, ", ");
9763
5.56k
    printSORegRegOperand(MI, 2, O);
9764
5.56k
    return;
9765
0
    break;
9766
123k
  case 10:
9767
    // AESD, AESE, AESIMC, AESMC, BKPT, BLX, BX, CPS1p, CRC32B, CRC32CB, CRC3...
9768
123k
    printOperand(MI, 0, O);
9769
123k
    break;
9770
702
  case 11:
9771
    // BF16VDOTI_VDOTD, BF16VDOTI_VDOTQ, BF16VDOTS_VDOTD, BF16VDOTS_VDOTQ, MV...
9772
702
    printOperand(MI, 1, O);
9773
702
    SStream_concat0(O, ", ");
9774
702
    break;
9775
1.99k
  case 12:
9776
    // BL, BLXi, t2BFic, t2LE
9777
1.99k
    printOperandAddr(MI, Address, 0, O);
9778
1.99k
    break;
9779
90.0k
  case 13:
9780
    // BLX_pred, BL_pred, BXJ, BX_pred, Bcc, DBG, FLDMXIA, FSTMXIA, HINT, LDM...
9781
90.0k
    printPredicateOperand(MI, 1, O);
9782
90.0k
    break;
9783
20.1k
  case 14:
9784
    // BX_RET, ERET, FMSTAT, MOVPCLR, MVE_LCTP, VSCCLRMD, VSCCLRMS, t2AUTG, t...
9785
20.1k
    printPredicateOperand(MI, 0, O);
9786
20.1k
    break;
9787
568
  case 15:
9788
    // CDE_CX1, CDE_CX1D, CDE_CX2, CDE_CX2D, CDE_CX3, CDE_CX3D, CDE_VCX1A_fpd...
9789
568
    printPImmediate(MI, 1, O);
9790
568
    SStream_concat0(O, ", ");
9791
568
    break;
9792
53.0k
  case 16:
9793
    // CDE_CX3A, CDE_CX3DA, CDP, LDRD_POST, LDRD_PRE, MCR, MRC, MVE_SQRSHRL, ...
9794
53.0k
    printPredicateOperand(MI, 6, O);
9795
53.0k
    break;
9796
20.3k
  case 17:
9797
    // CDE_VCX1A_vec, CDE_VCX2_vec, MVE_VABAVs16, MVE_VABAVs32, MVE_VABAVs8, ...
9798
20.3k
    printVPTPredicateOperand(MI, 4, O);
9799
20.3k
    break;
9800
11.9k
  case 18:
9801
    // CDE_VCX1_vec, MVE_VABDf16, MVE_VABDf32, MVE_VABDs16, MVE_VABDs32, MVE_...
9802
11.9k
    printVPTPredicateOperand(MI, 3, O);
9803
11.9k
    break;
9804
2.28k
  case 19:
9805
    // CDE_VCX2A_vec, CDE_VCX3_vec, MVE_VADC, MVE_VADDLVs32acc, MVE_VADDLVu32...
9806
2.28k
    printVPTPredicateOperand(MI, 5, O);
9807
2.28k
    break;
9808
1.09k
  case 20:
9809
    // CDE_VCX3A_vec, MVE_VMLALDAVas16, MVE_VMLALDAVas32, MVE_VMLALDAVau16, M...
9810
1.09k
    printVPTPredicateOperand(MI, 6, O);
9811
1.09k
    break;
9812
7.18k
  case 21:
9813
    // CDP2, LDC2L_OFFSET, LDC2L_OPTION, LDC2L_POST, LDC2L_PRE, LDC2_OFFSET, ...
9814
7.18k
    printPImmediate(MI, 0, O);
9815
7.18k
    SStream_concat0(O, ", ");
9816
7.18k
    break;
9817
1.33k
  case 22:
9818
    // CPS2p, CPS3p, t2CPS2p, t2CPS3p, tCPS
9819
1.33k
    printCPSIMod(MI, 0, O);
9820
1.33k
    break;
9821
615
  case 23:
9822
    // DMB, DSB
9823
615
    printMemBOption(MI, 0, O);
9824
615
    return;
9825
0
    break;
9826
1.09k
  case 24:
9827
    // ISB
9828
1.09k
    printInstSyncBOption(MI, 0, O);
9829
1.09k
    return;
9830
0
    break;
9831
1.09k
  case 25:
9832
    // MRRC2
9833
1.09k
    printPImmediate(MI, 2, O);
9834
1.09k
    SStream_concat0(O, ", ");
9835
1.09k
    printOperand(MI, 3, O);
9836
1.09k
    SStream_concat0(O, ", ");
9837
1.09k
    printOperand(MI, 0, O);
9838
1.09k
    SStream_concat0(O, ", ");
9839
1.09k
    printOperand(MI, 1, O);
9840
1.09k
    SStream_concat0(O, ", ");
9841
1.09k
    printCImmediate(MI, 4, O);
9842
1.09k
    return;
9843
0
    break;
9844
2.80k
  case 26:
9845
    // MVE_VABSf16, MVE_VABSf32, MVE_VABSs16, MVE_VABSs32, MVE_VABSs8, MVE_VA...
9846
2.80k
    printVPTPredicateOperand(MI, 2, O);
9847
2.80k
    break;
9848
1.57k
  case 27:
9849
    // MVE_VLD20_16, MVE_VLD20_16_wb, MVE_VLD20_32, MVE_VLD20_32_wb, MVE_VLD2...
9850
1.57k
    printMVEVectorList_2(MI, 0, O);
9851
1.57k
    SStream_concat0(O, ", ");
9852
1.57k
    break;
9853
1.73k
  case 28:
9854
    // MVE_VLD40_16, MVE_VLD40_16_wb, MVE_VLD40_32, MVE_VLD40_32_wb, MVE_VLD4...
9855
1.73k
    printMVEVectorList_4(MI, 0, O);
9856
1.73k
    SStream_concat0(O, ", ");
9857
1.73k
    break;
9858
7.61k
  case 29:
9859
    // MVE_VPST, MVE_VPTv16i8, MVE_VPTv16i8r, MVE_VPTv16s8, MVE_VPTv16s8r, MV...
9860
7.61k
    printVPTMask(MI, 0, O);
9861
7.61k
    break;
9862
67
  case 30:
9863
    // MVE_VST20_16_wb, MVE_VST20_32_wb, MVE_VST20_8_wb, MVE_VST21_16_wb, MVE...
9864
67
    printMVEVectorList_2(MI, 1, O);
9865
67
    SStream_concat0(O, ", ");
9866
67
    printAddrMode7Operand(MI, 2, O);
9867
67
    SStream_concat1(O, '!');
9868
67
    return;
9869
0
    break;
9870
73
  case 31:
9871
    // MVE_VST40_16_wb, MVE_VST40_32_wb, MVE_VST40_8_wb, MVE_VST41_16_wb, MVE...
9872
73
    printMVEVectorList_4(MI, 1, O);
9873
73
    SStream_concat0(O, ", ");
9874
73
    printAddrMode7Operand(MI, 2, O);
9875
73
    SStream_concat1(O, '!');
9876
73
    return;
9877
0
    break;
9878
151
  case 32:
9879
    // PLDWi12, PLDi12, PLIi12
9880
151
    printAddrModeImm12Operand_0(MI, 0, O);
9881
151
    return;
9882
0
    break;
9883
34
  case 33:
9884
    // PLDWrs, PLDrs, PLIrs
9885
34
    printAddrMode2Operand(MI, 0, O);
9886
34
    return;
9887
0
    break;
9888
175
  case 34:
9889
    // SETEND, tSETEND
9890
175
    printSetendOperand(MI, 0, O);
9891
175
    return;
9892
0
    break;
9893
787
  case 35:
9894
    // SMLAL, UMLAL
9895
787
    printSBitModifierOperand(MI, 8, O);
9896
787
    printPredicateOperand(MI, 6, O);
9897
787
    SStream_concat0(O, "\t");
9898
787
    printOperand(MI, 0, O);
9899
787
    SStream_concat0(O, ", ");
9900
787
    printOperand(MI, 1, O);
9901
787
    SStream_concat0(O, ", ");
9902
787
    printOperand(MI, 2, O);
9903
787
    SStream_concat0(O, ", ");
9904
787
    printOperand(MI, 3, O);
9905
787
    return;
9906
0
    break;
9907
0
  case 36:
9908
    // TSB
9909
0
    printTraceSyncBOption(MI, 0, O);
9910
0
    return;
9911
0
    break;
9912
8.15k
  case 37:
9913
    // VLD1LNd16_UPD, VLD1LNd32_UPD, VLD1LNd8_UPD, VLD2LNd16, VLD2LNd32, VLD2...
9914
8.15k
    printPredicateOperand(MI, 7, O);
9915
8.15k
    break;
9916
2.23k
  case 38:
9917
    // VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_UPD, VLD2LNq32_U...
9918
2.23k
    printPredicateOperand(MI, 9, O);
9919
2.23k
    break;
9920
1.46k
  case 39:
9921
    // VLD3LNd16_UPD, VLD3LNd32_UPD, VLD3LNd8_UPD, VLD3LNq16_UPD, VLD3LNq32_U...
9922
1.46k
    printPredicateOperand(MI, 11, O);
9923
1.46k
    break;
9924
5.88k
  case 40:
9925
    // VLD4DUPd16_UPD, VLD4DUPd32_UPD, VLD4DUPd8_UPD, VLD4DUPq16_UPD, VLD4DUP...
9926
5.88k
    printPredicateOperand(MI, 8, O);
9927
5.88k
    break;
9928
880
  case 41:
9929
    // VLD4LNd16_UPD, VLD4LNd32_UPD, VLD4LNd8_UPD, VLD4LNq16_UPD, VLD4LNq32_U...
9930
880
    printPredicateOperand(MI, 13, O);
9931
880
    break;
9932
349k
  case 42:
9933
    // tADC, tADDi3, tADDi8, tADDrr, tAND, tASRri, tASRrr, tBIC, tEOR, tLSLri...
9934
349k
    printSBitModifierOperand(MI, 1, O);
9935
349k
    break;
9936
1.40M
  }
9937
9938
9939
  // Fragment 1 encoded into 7 bits for 89 unique commands.
9940
1.39M
  switch ((Bits >> 19) & 127) {
9941
0
  default: CS_ASSERT_RET(0 && "Invalid command number.");
9942
525
  case 0:
9943
    // ASRi, ASRr, ITasm, LDRBT_POST, LDRConstPool, LDRHTii, LDRSBTii, LDRSHT...
9944
525
    SStream_concat1(O, ' ');
9945
525
    break;
9946
13.6k
  case 1:
9947
    // VLD1LNdAsm_16, VLD1LNdWB_fixed_Asm_16, VLD1LNdWB_register_Asm_16, VLD2...
9948
13.6k
    SStream_concat0(O, ".16\t");
9949
13.6k
    ARM_add_vector_size(MI, 16);
9950
13.6k
    break;
9951
16.6k
  case 2:
9952
    // VLD1LNdAsm_32, VLD1LNdWB_fixed_Asm_32, VLD1LNdWB_register_Asm_32, VLD2...
9953
16.6k
    SStream_concat0(O, ".32\t");
9954
16.6k
    ARM_add_vector_size(MI, 32);
9955
16.6k
    break;
9956
12.2k
  case 3:
9957
    // VLD1LNdAsm_8, VLD1LNdWB_fixed_Asm_8, VLD1LNdWB_register_Asm_8, VLD2LNd...
9958
12.2k
    SStream_concat0(O, ".8\t");
9959
12.2k
    ARM_add_vector_size(MI, 8);
9960
12.2k
    break;
9961
0
  case 4:
9962
    // t2LDRB_OFFSET_imm, t2LDRB_POST_imm, t2LDRB_PRE_imm, t2LDRH_OFFSET_imm,...
9963
0
    SStream_concat0(O, ".w ");
9964
0
    printOperand(MI, 0, O);
9965
0
    SStream_concat0(O, ", ");
9966
0
    break;
9967
725k
  case 5:
9968
    // ADCri, ADCrr, ADCrsi, ADDri, ADDrr, ADDrsi, ADR, ANDri, ANDrr, ANDrsi,...
9969
725k
    SStream_concat0(O, "\t");
9970
725k
    break;
9971
115k
  case 6:
9972
    // AESD, AESE, AESIMC, AESMC, CRC32B, CRC32CB, CRC32CH, CRC32CW, CRC32H, ...
9973
115k
    SStream_concat0(O, ", ");
9974
115k
    break;
9975
877
  case 7:
9976
    // BF16VDOTI_VDOTD, BF16VDOTI_VDOTQ, BF16VDOTS_VDOTD, BF16VDOTS_VDOTQ, MR...
9977
877
    printOperand(MI, 2, O);
9978
877
    SStream_concat0(O, ", ");
9979
877
    break;
9980
54
  case 8:
9981
    // BF16_VCVT, BF16_VCVTB, BF16_VCVTT
9982
54
    SStream_concat0(O, ".bf16.f32\t");
9983
54
    printOperand(MI, 0, O);
9984
54
    SStream_concat0(O, ", ");
9985
54
    break;
9986
9.19k
  case 9:
9987
    // BKPT, BL, BLX, BLXi, BX, CPS1p, ERET, HLT, HVC, RFEDA, RFEDB, RFEIA, R...
9988
9.19k
    return;
9989
0
    break;
9990
73
  case 10:
9991
    // BX_RET
9992
73
    SStream_concat0(O, "\tlr");
9993
73
    return;
9994
0
    break;
9995
0
  case 11:
9996
    // CDE_CX1, CDE_CX2, CDE_CX3, CDE_VCX1A_fpdp, CDE_VCX1A_fpsp, CDE_VCX1_fp...
9997
0
    printOperand(MI, 0, O);
9998
0
    SStream_concat0(O, ", ");
9999
0
    break;
10000
0
  case 12:
10001
    // CDE_CX1D, CDE_CX2D, CDE_CX3D
10002
0
    printGPRPairOperand(MI, 0, O);
10003
0
    SStream_concat0(O, ", ");
10004
0
    printOperand(MI, 2, O);
10005
0
    break;
10006
2.26k
  case 13:
10007
    // CDP2, MCR2, MCRR2
10008
2.26k
    printOperand(MI, 1, O);
10009
2.26k
    SStream_concat0(O, ", ");
10010
2.26k
    break;
10011
1.27k
  case 14:
10012
    // FCONSTD, VABSD, VADDD, VCMPD, VCMPED, VCMPEZD, VCMPZD, VDIVD, VFMAD, V...
10013
1.27k
    SStream_concat0(O, ".f64\t");
10014
1.27k
    ARM_add_vector_data(MI, ARM_VECTORDATA_F64);
10015
1.27k
    printOperand(MI, 0, O);
10016
1.27k
    break;
10017
7.02k
  case 15:
10018
    // FCONSTH, MVE_VABDf16, MVE_VABSf16, MVE_VADD_qr_f16, MVE_VADDf16, MVE_V...
10019
7.02k
    SStream_concat0(O, ".f16\t");
10020
7.02k
    ARM_add_vector_data(MI, ARM_VECTORDATA_F16);
10021
7.02k
    break;
10022
8.42k
  case 16:
10023
    // FCONSTS, MVE_VABDf32, MVE_VABSf32, MVE_VADD_qr_f32, MVE_VADDf32, MVE_V...
10024
8.42k
    SStream_concat0(O, ".f32\t");
10025
8.42k
    ARM_add_vector_data(MI, ARM_VECTORDATA_F32);
10026
8.42k
    break;
10027
112
  case 17:
10028
    // FMSTAT
10029
112
    SStream_concat0(O, "\tAPSR_nzcv, fpscr");
10030
112
    return;
10031
0
    break;
10032
4.92k
  case 18:
10033
    // LDC2L_OFFSET, LDC2L_OPTION, LDC2L_POST, LDC2L_PRE, LDC2_OFFSET, LDC2_O...
10034
4.92k
    printCImmediate(MI, 1, O);
10035
4.92k
    SStream_concat0(O, ", ");
10036
4.92k
    break;
10037
513
  case 19:
10038
    // MOVPCLR
10039
513
    SStream_concat0(O, "\tpc, lr");
10040
513
    return;
10041
0
    break;
10042
393
  case 20:
10043
    // MVE_LETP, t2LEUpdate
10044
393
    printOperandAddr(MI, Address, 2, O);
10045
393
    return;
10046
0
    break;
10047
5.94k
  case 21:
10048
    // MVE_VABAVs16, MVE_VABDs16, MVE_VABSs16, MVE_VADDVs16acc, MVE_VADDVs16n...
10049
5.94k
    SStream_concat0(O, ".s16\t");
10050
5.94k
    ARM_add_vector_data(MI, ARM_VECTORDATA_S16);
10051
5.94k
    break;
10052
9.89k
  case 22:
10053
    // MVE_VABAVs32, MVE_VABDs32, MVE_VABSs32, MVE_VADDLVs32acc, MVE_VADDLVs3...
10054
9.89k
    SStream_concat0(O, ".s32\t");
10055
9.89k
    ARM_add_vector_data(MI, ARM_VECTORDATA_S32);
10056
9.89k
    break;
10057
5.55k
  case 23:
10058
    // MVE_VABAVs8, MVE_VABDs8, MVE_VABSs8, MVE_VADDVs8acc, MVE_VADDVs8no_acc...
10059
5.55k
    SStream_concat0(O, ".s8\t");
10060
5.55k
    ARM_add_vector_data(MI, ARM_VECTORDATA_S8);
10061
5.55k
    break;
10062
5.00k
  case 24:
10063
    // MVE_VABAVu16, MVE_VABDu16, MVE_VADDVu16acc, MVE_VADDVu16no_acc, MVE_VC...
10064
5.00k
    SStream_concat0(O, ".u16\t");
10065
5.00k
    ARM_add_vector_data(MI, ARM_VECTORDATA_U16);
10066
5.00k
    break;
10067
7.95k
  case 25:
10068
    // MVE_VABAVu32, MVE_VABDu32, MVE_VADDLVu32acc, MVE_VADDLVu32no_acc, MVE_...
10069
7.95k
    SStream_concat0(O, ".u32\t");
10070
7.95k
    ARM_add_vector_data(MI, ARM_VECTORDATA_U32);
10071
7.95k
    break;
10072
7.16k
  case 26:
10073
    // MVE_VABAVu8, MVE_VABDu8, MVE_VADDVu8acc, MVE_VADDVu8no_acc, MVE_VCMPu8...
10074
7.16k
    SStream_concat0(O, ".u8\t");
10075
7.16k
    ARM_add_vector_data(MI, ARM_VECTORDATA_U8);
10076
7.16k
    break;
10077
4.82k
  case 27:
10078
    // MVE_VADC, MVE_VADCI, MVE_VADD_qr_i32, MVE_VADDi32, MVE_VBICimmi32, MVE...
10079
4.82k
    SStream_concat0(O, ".i32\t");
10080
4.82k
    ARM_add_vector_data(MI, ARM_VECTORDATA_I32);
10081
4.82k
    break;
10082
2.31k
  case 28:
10083
    // MVE_VADD_qr_i16, MVE_VADDi16, MVE_VBICimmi16, MVE_VCADDi16, MVE_VCLZs1...
10084
2.31k
    SStream_concat0(O, ".i16\t");
10085
2.31k
    ARM_add_vector_data(MI, ARM_VECTORDATA_I16);
10086
2.31k
    break;
10087
4.17k
  case 29:
10088
    // MVE_VADD_qr_i8, MVE_VADDi8, MVE_VCADDi8, MVE_VCLZs8, MVE_VCMPi8, MVE_V...
10089
4.17k
    SStream_concat0(O, ".i8\t");
10090
4.17k
    ARM_add_vector_data(MI, ARM_VECTORDATA_I8);
10091
4.17k
    break;
10092
5.03k
  case 30:
10093
    // MVE_VCTP64, MVE_VSTRD64_qi, MVE_VSTRD64_qi_pre, MVE_VSTRD64_rq, MVE_VS...
10094
5.03k
    SStream_concat0(O, ".64\t");
10095
5.03k
    ARM_add_vector_size(MI, 64);
10096
5.03k
    break;
10097
155
  case 31:
10098
    // MVE_VCVTf16f32bh, MVE_VCVTf16f32th, VCVTBSH, VCVTTSH, VCVTf2h
10099
155
    SStream_concat0(O, ".f16.f32\t");
10100
155
    ARM_add_vector_data(MI, ARM_VECTORDATA_F16F32);
10101
155
    printOperand(MI, 0, O);
10102
155
    SStream_concat0(O, ", ");
10103
155
    break;
10104
305
  case 32:
10105
    // MVE_VCVTf16s16_fix, MVE_VCVTf16s16n, VCVTs2hd, VCVTs2hq, VCVTxs2hd, VC...
10106
305
    SStream_concat0(O, ".f16.s16\t");
10107
305
    ARM_add_vector_data(MI, ARM_VECTORDATA_F16S16);
10108
305
    printOperand(MI, 0, O);
10109
305
    SStream_concat0(O, ", ");
10110
305
    printOperand(MI, 1, O);
10111
305
    break;
10112
232
  case 33:
10113
    // MVE_VCVTf16u16_fix, MVE_VCVTf16u16n, VCVTu2hd, VCVTu2hq, VCVTxu2hd, VC...
10114
232
    SStream_concat0(O, ".f16.u16\t");
10115
232
    ARM_add_vector_data(MI, ARM_VECTORDATA_F16U16);
10116
232
    printOperand(MI, 0, O);
10117
232
    SStream_concat0(O, ", ");
10118
232
    printOperand(MI, 1, O);
10119
232
    break;
10120
88
  case 34:
10121
    // MVE_VCVTf32f16bh, MVE_VCVTf32f16th, VCVTBHS, VCVTTHS, VCVTh2f
10122
88
    SStream_concat0(O, ".f32.f16\t");
10123
88
    ARM_add_vector_data(MI, ARM_VECTORDATA_F32F16);
10124
88
    printOperand(MI, 0, O);
10125
88
    SStream_concat0(O, ", ");
10126
88
    printOperand(MI, 1, O);
10127
88
    return;
10128
0
    break;
10129
254
  case 35:
10130
    // MVE_VCVTf32s32_fix, MVE_VCVTf32s32n, VCVTs2fd, VCVTs2fq, VCVTxs2fd, VC...
10131
254
    SStream_concat0(O, ".f32.s32\t");
10132
254
    ARM_add_vector_data(MI, ARM_VECTORDATA_F32S32);
10133
254
    printOperand(MI, 0, O);
10134
254
    SStream_concat0(O, ", ");
10135
254
    printOperand(MI, 1, O);
10136
254
    break;
10137
210
  case 36:
10138
    // MVE_VCVTf32u32_fix, MVE_VCVTf32u32n, VCVTu2fd, VCVTu2fq, VCVTxu2fd, VC...
10139
210
    SStream_concat0(O, ".f32.u32\t");
10140
210
    ARM_add_vector_data(MI, ARM_VECTORDATA_F32U32);
10141
210
    printOperand(MI, 0, O);
10142
210
    SStream_concat0(O, ", ");
10143
210
    printOperand(MI, 1, O);
10144
210
    break;
10145
734
  case 37:
10146
    // MVE_VCVTs16f16_fix, MVE_VCVTs16f16a, MVE_VCVTs16f16m, MVE_VCVTs16f16n,...
10147
734
    SStream_concat0(O, ".s16.f16\t");
10148
734
    ARM_add_vector_data(MI, ARM_VECTORDATA_S16F16);
10149
734
    printOperand(MI, 0, O);
10150
734
    SStream_concat0(O, ", ");
10151
734
    printOperand(MI, 1, O);
10152
734
    break;
10153
80
  case 38:
10154
    // MVE_VCVTs32f32_fix, MVE_VCVTs32f32a, MVE_VCVTs32f32m, MVE_VCVTs32f32n,...
10155
80
    SStream_concat0(O, ".s32.f32\t");
10156
80
    ARM_add_vector_data(MI, ARM_VECTORDATA_S32F32);
10157
80
    printOperand(MI, 0, O);
10158
80
    SStream_concat0(O, ", ");
10159
80
    printOperand(MI, 1, O);
10160
80
    break;
10161
125
  case 39:
10162
    // MVE_VCVTu16f16_fix, MVE_VCVTu16f16a, MVE_VCVTu16f16m, MVE_VCVTu16f16n,...
10163
125
    SStream_concat0(O, ".u16.f16\t");
10164
125
    ARM_add_vector_data(MI, ARM_VECTORDATA_U16F16);
10165
125
    printOperand(MI, 0, O);
10166
125
    SStream_concat0(O, ", ");
10167
125
    printOperand(MI, 1, O);
10168
125
    break;
10169
505
  case 40:
10170
    // MVE_VCVTu32f32_fix, MVE_VCVTu32f32a, MVE_VCVTu32f32m, MVE_VCVTu32f32n,...
10171
505
    SStream_concat0(O, ".u32.f32\t");
10172
505
    ARM_add_vector_data(MI, ARM_VECTORDATA_U32F32);
10173
505
    printOperand(MI, 0, O);
10174
505
    SStream_concat0(O, ", ");
10175
505
    printOperand(MI, 1, O);
10176
505
    break;
10177
1.60k
  case 41:
10178
    // MVE_VLD20_16, MVE_VLD20_32, MVE_VLD20_8, MVE_VLD21_16, MVE_VLD21_32, M...
10179
1.60k
    printAddrMode7Operand(MI, 2, O);
10180
1.60k
    return;
10181
0
    break;
10182
880
  case 42:
10183
    // MVE_VLD20_16_wb, MVE_VLD20_32_wb, MVE_VLD20_8_wb, MVE_VLD21_16_wb, MVE...
10184
880
    printAddrMode7Operand(MI, 3, O);
10185
880
    SStream_concat1(O, '!');
10186
880
    return;
10187
0
    break;
10188
1.51k
  case 43:
10189
    // MVE_VLDRDU64_qi, MVE_VLDRDU64_qi_pre, MVE_VLDRDU64_rq, MVE_VLDRDU64_rq...
10190
1.51k
    SStream_concat0(O, ".u64\t");
10191
1.51k
    ARM_add_vector_data(MI, ARM_VECTORDATA_U64);
10192
1.51k
    break;
10193
537
  case 44:
10194
    // MVE_VMOVimmi64, VADDHNv2i32, VADDv1i64, VADDv2i64, VMOVNv2i32, VMOVv1i...
10195
537
    SStream_concat0(O, ".i64\t");
10196
537
    ARM_add_vector_data(MI, ARM_VECTORDATA_I64);
10197
537
    printOperand(MI, 0, O);
10198
537
    SStream_concat0(O, ", ");
10199
537
    break;
10200
103
  case 45:
10201
    // MVE_VMULLBp16, MVE_VMULLTp16
10202
103
    SStream_concat0(O, ".p16\t");
10203
103
    ARM_add_vector_data(MI, ARM_VECTORDATA_P16);
10204
103
    printOperand(MI, 0, O);
10205
103
    SStream_concat0(O, ", ");
10206
103
    printOperand(MI, 1, O);
10207
103
    SStream_concat0(O, ", ");
10208
103
    printOperand(MI, 2, O);
10209
103
    return;
10210
0
    break;
10211
373
  case 46:
10212
    // MVE_VMULLBp8, MVE_VMULLTp8, VMULLp8, VMULpd, VMULpq
10213
373
    SStream_concat0(O, ".p8\t");
10214
373
    ARM_add_vector_data(MI, ARM_VECTORDATA_P8);
10215
373
    printOperand(MI, 0, O);
10216
373
    SStream_concat0(O, ", ");
10217
373
    printOperand(MI, 1, O);
10218
373
    SStream_concat0(O, ", ");
10219
373
    printOperand(MI, 2, O);
10220
373
    return;
10221
0
    break;
10222
830
  case 47:
10223
    // MVE_VST20_16, MVE_VST20_32, MVE_VST20_8, MVE_VST21_16, MVE_VST21_32, M...
10224
830
    printAddrMode7Operand(MI, 1, O);
10225
830
    return;
10226
0
    break;
10227
912
  case 48:
10228
    // RFEDA_UPD, RFEDB_UPD, RFEIA_UPD, RFEIB_UPD
10229
912
    SStream_concat1(O, '!');
10230
912
    return;
10231
0
    break;
10232
194
  case 49:
10233
    // VCVTBDH, VCVTTDH
10234
194
    SStream_concat0(O, ".f16.f64\t");
10235
194
    ARM_add_vector_data(MI, ARM_VECTORDATA_F16F64);
10236
194
    printOperand(MI, 0, O);
10237
194
    SStream_concat0(O, ", ");
10238
194
    printOperand(MI, 2, O);
10239
194
    return;
10240
0
    break;
10241
76
  case 50:
10242
    // VCVTBHD, VCVTTHD
10243
76
    SStream_concat0(O, ".f64.f16\t");
10244
76
    ARM_add_vector_data(MI, ARM_VECTORDATA_F64F16);
10245
76
    printOperand(MI, 0, O);
10246
76
    SStream_concat0(O, ", ");
10247
76
    printOperand(MI, 1, O);
10248
76
    return;
10249
0
    break;
10250
359
  case 51:
10251
    // VCVTDS
10252
359
    SStream_concat0(O, ".f64.f32\t");
10253
359
    ARM_add_vector_data(MI, ARM_VECTORDATA_F64F32);
10254
359
    printOperand(MI, 0, O);
10255
359
    SStream_concat0(O, ", ");
10256
359
    printOperand(MI, 1, O);
10257
359
    return;
10258
0
    break;
10259
84
  case 52:
10260
    // VCVTSD
10261
84
    SStream_concat0(O, ".f32.f64\t");
10262
84
    ARM_add_vector_data(MI, ARM_VECTORDATA_F32F64);
10263
84
    printOperand(MI, 0, O);
10264
84
    SStream_concat0(O, ", ");
10265
84
    printOperand(MI, 1, O);
10266
84
    return;
10267
0
    break;
10268
81
  case 53:
10269
    // VJCVT, VTOSIRD, VTOSIZD, VTOSLD
10270
81
    SStream_concat0(O, ".s32.f64\t");
10271
81
    ARM_add_vector_data(MI, ARM_VECTORDATA_S32F64);
10272
81
    printOperand(MI, 0, O);
10273
81
    SStream_concat0(O, ", ");
10274
81
    printOperand(MI, 1, O);
10275
81
    break;
10276
8.26k
  case 54:
10277
    // VLD1LNd16, VLD1LNd16_UPD, VLD2LNd16, VLD2LNd16_UPD, VLD2LNq16, VLD2LNq...
10278
8.26k
    SStream_concat0(O, ".16\t{");
10279
8.26k
    ARM_add_vector_size(MI, 16);
10280
8.26k
    break;
10281
9.09k
  case 55:
10282
    // VLD1LNd32, VLD1LNd32_UPD, VLD2LNd32, VLD2LNd32_UPD, VLD2LNq32, VLD2LNq...
10283
9.09k
    SStream_concat0(O, ".32\t{");
10284
9.09k
    ARM_add_vector_size(MI, 32);
10285
9.09k
    break;
10286
9.30k
  case 56:
10287
    // VLD1LNd8, VLD1LNd8_UPD, VLD2LNd8, VLD2LNd8_UPD, VLD3DUPd8, VLD3DUPd8_U...
10288
9.30k
    SStream_concat0(O, ".8\t{");
10289
9.30k
    ARM_add_vector_size(MI, 8);
10290
9.30k
    break;
10291
519
  case 57:
10292
    // VLDR_FPCXTNS_off, VLDR_FPCXTNS_post, VLDR_FPCXTNS_pre, VMSR_FPCXTNS, V...
10293
519
    SStream_concat0(O, "\tfpcxtns, ");
10294
519
    break;
10295
277
  case 58:
10296
    // VLDR_FPCXTS_off, VLDR_FPCXTS_post, VLDR_FPCXTS_pre, VMSR_FPCXTS, VSTR_...
10297
277
    SStream_concat0(O, "\tfpcxts, ");
10298
277
    break;
10299
1.37k
  case 59:
10300
    // VLDR_FPSCR_NZCVQC_off, VLDR_FPSCR_NZCVQC_post, VLDR_FPSCR_NZCVQC_pre, ...
10301
1.37k
    SStream_concat0(O, "\tfpscr_nzcvqc, ");
10302
1.37k
    break;
10303
2.08k
  case 60:
10304
    // VLDR_FPSCR_off, VLDR_FPSCR_post, VLDR_FPSCR_pre, VMSR, VSTR_FPSCR_off,...
10305
2.08k
    SStream_concat0(O, "\tfpscr, ");
10306
2.08k
    break;
10307
0
  case 61:
10308
    // VLDR_P0_off, VLDR_P0_post, VLDR_P0_pre, VMSR_P0, VSTR_P0_off, VSTR_P0_...
10309
0
    SStream_concat0(O, "\tp0, ");
10310
0
    break;
10311
0
  case 62:
10312
    // VLDR_VPR_off, VLDR_VPR_post, VLDR_VPR_pre, VMSR_VPR, VSTR_VPR_off, VST...
10313
0
    SStream_concat0(O, "\tvpr, ");
10314
0
    break;
10315
103
  case 63:
10316
    // VMSR_FPEXC
10317
103
    SStream_concat0(O, "\tfpexc, ");
10318
103
    printOperand(MI, 0, O);
10319
103
    return;
10320
0
    break;
10321
109
  case 64:
10322
    // VMSR_FPINST
10323
109
    SStream_concat0(O, "\tfpinst, ");
10324
109
    printOperand(MI, 0, O);
10325
109
    return;
10326
0
    break;
10327
80
  case 65:
10328
    // VMSR_FPINST2
10329
80
    SStream_concat0(O, "\tfpinst2, ");
10330
80
    printOperand(MI, 0, O);
10331
80
    return;
10332
0
    break;
10333
96
  case 66:
10334
    // VMSR_FPSID
10335
96
    SStream_concat0(O, "\tfpsid, ");
10336
96
    printOperand(MI, 0, O);
10337
96
    return;
10338
0
    break;
10339
455
  case 67:
10340
    // VQADDsv1i64, VQADDsv2i64, VQMOVNsuv2i32, VQMOVNsv2i32, VQRSHLsv1i64, V...
10341
455
    SStream_concat0(O, ".s64\t");
10342
455
    ARM_add_vector_data(MI, ARM_VECTORDATA_S64);
10343
455
    printOperand(MI, 0, O);
10344
455
    SStream_concat0(O, ", ");
10345
455
    break;
10346
29
  case 68:
10347
    // VSHTOD
10348
29
    SStream_concat0(O, ".f64.s16\t");
10349
29
    ARM_add_vector_data(MI, ARM_VECTORDATA_F64S16);
10350
29
    printOperand(MI, 0, O);
10351
29
    SStream_concat0(O, ", ");
10352
29
    printOperand(MI, 1, O);
10353
29
    SStream_concat0(O, ", ");
10354
29
    printFBits16(MI, 2, O);
10355
29
    return;
10356
0
    break;
10357
103
  case 69:
10358
    // VSHTOS
10359
103
    SStream_concat0(O, ".f32.s16\t");
10360
103
    ARM_add_vector_data(MI, ARM_VECTORDATA_F32S16);
10361
103
    printOperand(MI, 0, O);
10362
103
    SStream_concat0(O, ", ");
10363
103
    printOperand(MI, 1, O);
10364
103
    SStream_concat0(O, ", ");
10365
103
    printFBits16(MI, 2, O);
10366
103
    return;
10367
0
    break;
10368
98
  case 70:
10369
    // VSITOD, VSLTOD
10370
98
    SStream_concat0(O, ".f64.s32\t");
10371
98
    ARM_add_vector_data(MI, ARM_VECTORDATA_F64S32);
10372
98
    printOperand(MI, 0, O);
10373
98
    SStream_concat0(O, ", ");
10374
98
    printOperand(MI, 1, O);
10375
98
    break;
10376
85
  case 71:
10377
    // VSITOH, VSLTOH
10378
85
    SStream_concat0(O, ".f16.s32\t");
10379
85
    ARM_add_vector_data(MI, ARM_VECTORDATA_F16S32);
10380
85
    printOperand(MI, 0, O);
10381
85
    SStream_concat0(O, ", ");
10382
85
    printOperand(MI, 1, O);
10383
85
    break;
10384
90
  case 72:
10385
    // VTOSHD
10386
90
    SStream_concat0(O, ".s16.f64\t");
10387
90
    ARM_add_vector_data(MI, ARM_VECTORDATA_S16F64);
10388
90
    printOperand(MI, 0, O);
10389
90
    SStream_concat0(O, ", ");
10390
90
    printOperand(MI, 1, O);
10391
90
    SStream_concat0(O, ", ");
10392
90
    printFBits16(MI, 2, O);
10393
90
    return;
10394
0
    break;
10395
401
  case 73:
10396
    // VTOSHS
10397
401
    SStream_concat0(O, ".s16.f32\t");
10398
401
    ARM_add_vector_data(MI, ARM_VECTORDATA_S16F32);
10399
401
    printOperand(MI, 0, O);
10400
401
    SStream_concat0(O, ", ");
10401
401
    printOperand(MI, 1, O);
10402
401
    SStream_concat0(O, ", ");
10403
401
    printFBits16(MI, 2, O);
10404
401
    return;
10405
0
    break;
10406
371
  case 74:
10407
    // VTOSIRH, VTOSIZH, VTOSLH
10408
371
    SStream_concat0(O, ".s32.f16\t");
10409
371
    ARM_add_vector_data(MI, ARM_VECTORDATA_S32F16);
10410
371
    printOperand(MI, 0, O);
10411
371
    SStream_concat0(O, ", ");
10412
371
    printOperand(MI, 1, O);
10413
371
    break;
10414
62
  case 75:
10415
    // VTOUHD
10416
62
    SStream_concat0(O, ".u16.f64\t");
10417
62
    ARM_add_vector_data(MI, ARM_VECTORDATA_U16F64);
10418
62
    printOperand(MI, 0, O);
10419
62
    SStream_concat0(O, ", ");
10420
62
    printOperand(MI, 1, O);
10421
62
    SStream_concat0(O, ", ");
10422
62
    printFBits16(MI, 2, O);
10423
62
    return;
10424
0
    break;
10425
79
  case 76:
10426
    // VTOUHS
10427
79
    SStream_concat0(O, ".u16.f32\t");
10428
79
    ARM_add_vector_data(MI, ARM_VECTORDATA_U16F32);
10429
79
    printOperand(MI, 0, O);
10430
79
    SStream_concat0(O, ", ");
10431
79
    printOperand(MI, 1, O);
10432
79
    SStream_concat0(O, ", ");
10433
79
    printFBits16(MI, 2, O);
10434
79
    return;
10435
0
    break;
10436
106
  case 77:
10437
    // VTOUIRD, VTOUIZD, VTOULD
10438
106
    SStream_concat0(O, ".u32.f64\t");
10439
106
    ARM_add_vector_data(MI, ARM_VECTORDATA_U32F64);
10440
106
    printOperand(MI, 0, O);
10441
106
    SStream_concat0(O, ", ");
10442
106
    printOperand(MI, 1, O);
10443
106
    break;
10444
50
  case 78:
10445
    // VTOUIRH, VTOUIZH, VTOULH
10446
50
    SStream_concat0(O, ".u32.f16\t");
10447
50
    ARM_add_vector_data(MI, ARM_VECTORDATA_U32F16);
10448
50
    printOperand(MI, 0, O);
10449
50
    SStream_concat0(O, ", ");
10450
50
    printOperand(MI, 1, O);
10451
50
    break;
10452
51
  case 79:
10453
    // VUHTOD
10454
51
    SStream_concat0(O, ".f64.u16\t");
10455
51
    ARM_add_vector_data(MI, ARM_VECTORDATA_F64U16);
10456
51
    printOperand(MI, 0, O);
10457
51
    SStream_concat0(O, ", ");
10458
51
    printOperand(MI, 1, O);
10459
51
    SStream_concat0(O, ", ");
10460
51
    printFBits16(MI, 2, O);
10461
51
    return;
10462
0
    break;
10463
336
  case 80:
10464
    // VUHTOS
10465
336
    SStream_concat0(O, ".f32.u16\t");
10466
336
    ARM_add_vector_data(MI, ARM_VECTORDATA_F32U16);
10467
336
    printOperand(MI, 0, O);
10468
336
    SStream_concat0(O, ", ");
10469
336
    printOperand(MI, 1, O);
10470
336
    SStream_concat0(O, ", ");
10471
336
    printFBits16(MI, 2, O);
10472
336
    return;
10473
0
    break;
10474
469
  case 81:
10475
    // VUITOD, VULTOD
10476
469
    SStream_concat0(O, ".f64.u32\t");
10477
469
    ARM_add_vector_data(MI, ARM_VECTORDATA_F64U32);
10478
469
    printOperand(MI, 0, O);
10479
469
    SStream_concat0(O, ", ");
10480
469
    printOperand(MI, 1, O);
10481
469
    break;
10482
92
  case 82:
10483
    // VUITOH, VULTOH
10484
92
    SStream_concat0(O, ".f16.u32\t");
10485
92
    ARM_add_vector_data(MI, ARM_VECTORDATA_F16U32);
10486
92
    printOperand(MI, 0, O);
10487
92
    SStream_concat0(O, ", ");
10488
92
    printOperand(MI, 1, O);
10489
92
    break;
10490
26.3k
  case 83:
10491
    // t2ADCrr, t2ADCrs, t2ADDri, t2ADDrr, t2ADDrs, t2ADDspImm, t2ADR, t2ANDr...
10492
26.3k
    SStream_concat0(O, ".w\t");
10493
26.3k
    break;
10494
101
  case 84:
10495
    // t2SRSDB, t2SRSIA
10496
101
    SStream_concat0(O, "\tsp, ");
10497
101
    printOperand(MI, 0, O);
10498
101
    return;
10499
0
    break;
10500
53
  case 85:
10501
    // t2SRSDB_UPD, t2SRSIA_UPD
10502
53
    SStream_concat0(O, "\tsp!, ");
10503
53
    printOperand(MI, 0, O);
10504
53
    return;
10505
0
    break;
10506
163
  case 86:
10507
    // t2SUBS_PC_LR
10508
163
    SStream_concat0(O, "\tpc, lr, ");
10509
163
    printOperand(MI, 0, O);
10510
163
    return;
10511
0
    break;
10512
308k
  case 87:
10513
    // tADC, tADDi3, tADDi8, tADDrr, tAND, tASRri, tASRrr, tBIC, tEOR, tLSLri...
10514
308k
    printPredicateOperand(MI, 4, O);
10515
308k
    SStream_concat0(O, "\t");
10516
308k
    printOperand(MI, 0, O);
10517
308k
    SStream_concat0(O, ", ");
10518
308k
    break;
10519
41.2k
  case 88:
10520
    // tMOVi8, tMVN, tRSB
10521
41.2k
    printPredicateOperand(MI, 3, O);
10522
41.2k
    SStream_concat0(O, "\t");
10523
41.2k
    printOperand(MI, 0, O);
10524
41.2k
    SStream_concat0(O, ", ");
10525
41.2k
    printOperand(MI, 2, O);
10526
41.2k
    break;
10527
1.39M
  }
10528
10529
10530
  // Fragment 2 encoded into 7 bits for 71 unique commands.
10531
1.37M
  switch ((Bits >> 26) & 127) {
10532
0
  default: CS_ASSERT_RET(0 && "Invalid command number.");
10533
595k
  case 0:
10534
    // ASRi, ASRr, LDRBT_POST, LDRConstPool, LDRHTii, LDRSBTii, LDRSHTii, LDR...
10535
595k
    printOperand(MI, 0, O);
10536
595k
    break;
10537
13.6k
  case 1:
10538
    // ITasm, t2IT
10539
13.6k
    printMandatoryPredicateOperand(MI, 0, O);
10540
13.6k
    return;
10541
0
    break;
10542
0
  case 2:
10543
    // VLD3DUPdAsm_16, VLD3DUPdAsm_32, VLD3DUPdAsm_8, VLD3DUPdWB_fixed_Asm_16...
10544
0
    printVectorListThreeAllLanes(MI, 0, O);
10545
0
    SStream_concat0(O, ", ");
10546
0
    printAddrMode6Operand(MI, 1, O);
10547
0
    break;
10548
0
  case 3:
10549
    // VLD3DUPqAsm_16, VLD3DUPqAsm_32, VLD3DUPqAsm_8, VLD3DUPqWB_fixed_Asm_16...
10550
0
    printVectorListThreeSpacedAllLanes(MI, 0, O);
10551
0
    SStream_concat0(O, ", ");
10552
0
    printAddrMode6Operand(MI, 1, O);
10553
0
    break;
10554
1.01k
  case 4:
10555
    // VLD3dAsm_16, VLD3dAsm_32, VLD3dAsm_8, VLD3dWB_fixed_Asm_16, VLD3dWB_fi...
10556
1.01k
    printVectorListThree(MI, 0, O);
10557
1.01k
    SStream_concat0(O, ", ");
10558
1.01k
    break;
10559
0
  case 5:
10560
    // VLD3qAsm_16, VLD3qAsm_32, VLD3qAsm_8, VLD3qWB_fixed_Asm_16, VLD3qWB_fi...
10561
0
    printVectorListThreeSpaced(MI, 0, O);
10562
0
    SStream_concat0(O, ", ");
10563
0
    printAddrMode6Operand(MI, 1, O);
10564
0
    break;
10565
0
  case 6:
10566
    // VLD4DUPdAsm_16, VLD4DUPdAsm_32, VLD4DUPdAsm_8, VLD4DUPdWB_fixed_Asm_16...
10567
0
    printVectorListFourAllLanes(MI, 0, O);
10568
0
    SStream_concat0(O, ", ");
10569
0
    printAddrMode6Operand(MI, 1, O);
10570
0
    break;
10571
0
  case 7:
10572
    // VLD4DUPqAsm_16, VLD4DUPqAsm_32, VLD4DUPqAsm_8, VLD4DUPqWB_fixed_Asm_16...
10573
0
    printVectorListFourSpacedAllLanes(MI, 0, O);
10574
0
    SStream_concat0(O, ", ");
10575
0
    printAddrMode6Operand(MI, 1, O);
10576
0
    break;
10577
2.94k
  case 8:
10578
    // VLD4dAsm_16, VLD4dAsm_32, VLD4dAsm_8, VLD4dWB_fixed_Asm_16, VLD4dWB_fi...
10579
2.94k
    printVectorListFour(MI, 0, O);
10580
2.94k
    SStream_concat0(O, ", ");
10581
2.94k
    break;
10582
0
  case 9:
10583
    // VLD4qAsm_16, VLD4qAsm_32, VLD4qAsm_8, VLD4qWB_fixed_Asm_16, VLD4qWB_fi...
10584
0
    printVectorListFourSpaced(MI, 0, O);
10585
0
    SStream_concat0(O, ", ");
10586
0
    printAddrMode6Operand(MI, 1, O);
10587
0
    break;
10588
0
  case 10:
10589
    // t2LDRB_OFFSET_imm, t2LDRH_OFFSET_imm, t2LDRSB_OFFSET_imm, t2LDRSH_OFFS...
10590
0
    printT2AddrModeImm8Operand_0(MI, 1, O);
10591
0
    return;
10592
0
    break;
10593
1.02k
  case 11:
10594
    // t2LDRB_POST_imm, t2LDRH_POST_imm, t2LDRSB_POST_imm, t2LDRSH_POST_imm, ...
10595
1.02k
    printAddrMode7Operand(MI, 1, O);
10596
1.02k
    break;
10597
0
  case 12:
10598
    // t2LDRB_PRE_imm, t2LDRH_PRE_imm, t2LDRSB_PRE_imm, t2LDRSH_PRE_imm, t2LD...
10599
0
    printT2AddrModeImm8Operand_1(MI, 1, O);
10600
0
    SStream_concat1(O, '!');
10601
0
    return;
10602
0
    break;
10603
228k
  case 13:
10604
    // AESD, AESE, BF16_VCVTB, BF16_VCVTT, CDE_CX1, CDE_CX2, CDE_CX3, CDE_VCX...
10605
228k
    printOperand(MI, 2, O);
10606
228k
    break;
10607
158k
  case 14:
10608
    // AESIMC, AESMC, BF16_VCVT, CRC32B, CRC32CB, CRC32CH, CRC32CW, CRC32H, C...
10609
158k
    printOperand(MI, 1, O);
10610
158k
    break;
10611
90.1k
  case 15:
10612
    // BF16VDOTI_VDOTD, BF16VDOTI_VDOTQ, BF16VDOTS_VDOTD, BF16VDOTS_VDOTQ, CD...
10613
90.1k
    printOperand(MI, 3, O);
10614
90.1k
    break;
10615
59.1k
  case 16:
10616
    // BL_pred, Bcc, t2B, t2BFLi, t2BFLr, t2BFi, t2BFr, t2Bcc, tB, tBcc
10617
59.1k
    printOperandAddr(MI, Address, 0, O);
10618
59.1k
    break;
10619
6.55k
  case 17:
10620
    // CDE_CX1A, CDE_CX1DA, CDE_CX2A, CDE_CX2DA, CDE_CX3A, CDE_CX3DA, CDE_VCX...
10621
6.55k
    printPImmediate(MI, 1, O);
10622
6.55k
    SStream_concat0(O, ", ");
10623
6.55k
    break;
10624
39.9k
  case 18:
10625
    // CDE_CX1D, MVE_LCTP, MVE_VCVTf16s16n, MVE_VCVTf16u16n, MVE_VCVTf32s32n,...
10626
39.9k
    return;
10627
0
    break;
10628
4.71k
  case 19:
10629
    // CDE_CX2D, CDE_CX3D, FCONSTD, MVE_VCVTf16s16_fix, MVE_VCVTf16u16_fix, M...
10630
4.71k
    SStream_concat0(O, ", ");
10631
4.71k
    break;
10632
75.1k
  case 20:
10633
    // CDP, LDCL_OFFSET, LDCL_OPTION, LDCL_POST, LDCL_PRE, LDC_OFFSET, LDC_OP...
10634
75.1k
    printPImmediate(MI, 0, O);
10635
75.1k
    SStream_concat0(O, ", ");
10636
75.1k
    break;
10637
759
  case 21:
10638
    // CDP2
10639
759
    printCImmediate(MI, 2, O);
10640
759
    SStream_concat0(O, ", ");
10641
759
    printCImmediate(MI, 3, O);
10642
759
    SStream_concat0(O, ", ");
10643
759
    printCImmediate(MI, 4, O);
10644
759
    SStream_concat0(O, ", ");
10645
759
    printOperand(MI, 5, O);
10646
759
    return;
10647
0
    break;
10648
1.33k
  case 22:
10649
    // CPS2p, CPS3p, t2CPS2p, t2CPS3p, tCPS
10650
1.33k
    printCPSIFlag(MI, 1, O);
10651
1.33k
    break;
10652
114
  case 23:
10653
    // LDAEXD, LDREXD
10654
114
    printGPRPairOperand(MI, 0, O);
10655
114
    SStream_concat0(O, ", ");
10656
114
    printAddrMode7Operand(MI, 1, O);
10657
114
    return;
10658
0
    break;
10659
1.07k
  case 24:
10660
    // LDC2L_OFFSET, LDC2_OFFSET, STC2L_OFFSET, STC2_OFFSET
10661
1.07k
    printAddrMode5Operand_0(MI, 2, O);
10662
1.07k
    return;
10663
0
    break;
10664
2.62k
  case 25:
10665
    // LDC2L_OPTION, LDC2L_POST, LDC2_OPTION, LDC2_POST, STC2L_OPTION, STC2L_...
10666
2.62k
    printAddrMode7Operand(MI, 2, O);
10667
2.62k
    break;
10668
1.21k
  case 26:
10669
    // LDC2L_PRE, LDC2_PRE, STC2L_PRE, STC2_PRE
10670
1.21k
    printAddrMode5Operand_1(MI, 2, O);
10671
1.21k
    SStream_concat1(O, '!');
10672
1.21k
    return;
10673
0
    break;
10674
1.28k
  case 27:
10675
    // MRRC, t2MRRC, t2MRRC2
10676
1.28k
    printPImmediate(MI, 2, O);
10677
1.28k
    SStream_concat0(O, ", ");
10678
1.28k
    printOperand(MI, 3, O);
10679
1.28k
    SStream_concat0(O, ", ");
10680
1.28k
    printOperand(MI, 0, O);
10681
1.28k
    SStream_concat0(O, ", ");
10682
1.28k
    printOperand(MI, 1, O);
10683
1.28k
    SStream_concat0(O, ", ");
10684
1.28k
    printCImmediate(MI, 4, O);
10685
1.28k
    return;
10686
0
    break;
10687
8.02k
  case 28:
10688
    // MSR, MSRi, t2MSR_AR, t2MSR_M
10689
8.02k
    printMSRMaskOperand(MI, 0, O);
10690
8.02k
    SStream_concat0(O, ", ");
10691
8.02k
    break;
10692
625
  case 29:
10693
    // MSRbanked, t2MSRbanked
10694
625
    printBankedRegOperand(MI, 0, O);
10695
625
    SStream_concat0(O, ", ");
10696
625
    printOperand(MI, 1, O);
10697
625
    return;
10698
0
    break;
10699
11.9k
  case 30:
10700
    // MVE_VCMPf16, MVE_VCMPf16r, MVE_VCMPf32, MVE_VCMPf32r, MVE_VCMPi16, MVE...
10701
11.9k
    printMandatoryRestrictedPredicateOperand(MI, 3, O);
10702
11.9k
    SStream_concat0(O, ", ");
10703
11.9k
    printOperand(MI, 1, O);
10704
11.9k
    SStream_concat0(O, ", ");
10705
11.9k
    printOperand(MI, 2, O);
10706
11.9k
    return;
10707
0
    break;
10708
519
  case 31:
10709
    // MVE_VMOVimmi64, VMOVv1i64, VMOVv2i64
10710
519
    printVMOVModImmOperand(MI, 1, O);
10711
519
    return;
10712
0
    break;
10713
2.07k
  case 32:
10714
    // VCMPEZD, VCMPZD, tRSB
10715
2.07k
    SStream_concat0(O, ", #0");
10716
2.07k
    return;
10717
0
    break;
10718
141
  case 33:
10719
    // VLD1DUPd16, VLD1DUPd16wb_fixed, VLD1DUPd16wb_register, VLD1DUPd32, VLD...
10720
141
    printVectorListOneAllLanes(MI, 0, O);
10721
141
    SStream_concat0(O, ", ");
10722
141
    break;
10723
2.55k
  case 34:
10724
    // VLD1DUPq16, VLD1DUPq16wb_fixed, VLD1DUPq16wb_register, VLD1DUPq32, VLD...
10725
2.55k
    printVectorListTwoAllLanes(MI, 0, O);
10726
2.55k
    SStream_concat0(O, ", ");
10727
2.55k
    break;
10728
881
  case 35:
10729
    // VLD1d16, VLD1d16wb_fixed, VLD1d16wb_register, VLD1d32, VLD1d32wb_fixed...
10730
881
    printVectorListOne(MI, 0, O);
10731
881
    SStream_concat0(O, ", ");
10732
881
    break;
10733
3.16k
  case 36:
10734
    // VLD1q16, VLD1q16wb_fixed, VLD1q16wb_register, VLD1q32, VLD1q32wb_fixed...
10735
3.16k
    printVectorListTwo(MI, 0, O);
10736
3.16k
    SStream_concat0(O, ", ");
10737
3.16k
    break;
10738
1.61k
  case 37:
10739
    // VLD2DUPd16x2, VLD2DUPd16x2wb_fixed, VLD2DUPd16x2wb_register, VLD2DUPd3...
10740
1.61k
    printVectorListTwoSpacedAllLanes(MI, 0, O);
10741
1.61k
    SStream_concat0(O, ", ");
10742
1.61k
    break;
10743
1.39k
  case 38:
10744
    // VLD2b16, VLD2b16wb_fixed, VLD2b16wb_register, VLD2b32, VLD2b32wb_fixed...
10745
1.39k
    printVectorListTwoSpaced(MI, 0, O);
10746
1.39k
    SStream_concat0(O, ", ");
10747
1.39k
    break;
10748
802
  case 39:
10749
    // VLDR_FPCXTNS_off, VLDR_FPCXTS_off, VLDR_FPSCR_NZCVQC_off, VLDR_FPSCR_o...
10750
802
    printT2AddrModeImm8s4Operand_0(MI, 0, O);
10751
802
    return;
10752
0
    break;
10753
1.84k
  case 40:
10754
    // VLDR_FPCXTNS_pre, VLDR_FPCXTS_pre, VLDR_FPSCR_NZCVQC_pre, VLDR_FPSCR_p...
10755
1.84k
    printT2AddrModeImm8s4Operand_1(MI, 1, O);
10756
1.84k
    SStream_concat1(O, '!');
10757
1.84k
    return;
10758
0
    break;
10759
0
  case 41:
10760
    // VLDR_P0_off, VSTR_P0_off
10761
0
    printT2AddrModeImm8s4Operand_0(MI, 1, O);
10762
0
    return;
10763
0
    break;
10764
0
  case 42:
10765
    // VLDR_P0_pre, VSTR_P0_pre
10766
0
    printT2AddrModeImm8s4Operand_1(MI, 2, O);
10767
0
    SStream_concat1(O, '!');
10768
0
    return;
10769
0
    break;
10770
10.5k
  case 43:
10771
    // VSCCLRMD, VSCCLRMS, t2CLRM, tPOP, tPUSH
10772
10.5k
    printRegisterList(MI, 2, O);
10773
10.5k
    return;
10774
0
    break;
10775
7.93k
  case 44:
10776
    // VST1LNd16_UPD, VST1LNd32_UPD, VST1LNd8_UPD, VST2LNd16_UPD, VST2LNd32_U...
10777
7.93k
    printOperand(MI, 4, O);
10778
7.93k
    break;
10779
140
  case 45:
10780
    // VST1d16, VST1d32, VST1d64, VST1d8
10781
140
    printVectorListOne(MI, 2, O);
10782
140
    SStream_concat0(O, ", ");
10783
140
    printAddrMode6Operand(MI, 0, O);
10784
140
    return;
10785
0
    break;
10786
298
  case 46:
10787
    // VST1d16Q, VST1d32Q, VST1d64Q, VST1d8Q, VST2q16, VST2q32, VST2q8
10788
298
    printVectorListFour(MI, 2, O);
10789
298
    SStream_concat0(O, ", ");
10790
298
    printAddrMode6Operand(MI, 0, O);
10791
298
    return;
10792
0
    break;
10793
1.08k
  case 47:
10794
    // VST1d16Qwb_fixed, VST1d32Qwb_fixed, VST1d64Qwb_fixed, VST1d8Qwb_fixed,...
10795
1.08k
    printVectorListFour(MI, 3, O);
10796
1.08k
    SStream_concat0(O, ", ");
10797
1.08k
    printAddrMode6Operand(MI, 1, O);
10798
1.08k
    SStream_concat1(O, '!');
10799
1.08k
    return;
10800
0
    break;
10801
1.25k
  case 48:
10802
    // VST1d16Qwb_register, VST1d32Qwb_register, VST1d64Qwb_register, VST1d8Q...
10803
1.25k
    printVectorListFour(MI, 4, O);
10804
1.25k
    SStream_concat0(O, ", ");
10805
1.25k
    printAddrMode6Operand(MI, 1, O);
10806
1.25k
    SStream_concat0(O, ", ");
10807
1.25k
    printOperand(MI, 3, O);
10808
1.25k
    return;
10809
0
    break;
10810
395
  case 49:
10811
    // VST1d16T, VST1d32T, VST1d64T, VST1d8T
10812
395
    printVectorListThree(MI, 2, O);
10813
395
    SStream_concat0(O, ", ");
10814
395
    printAddrMode6Operand(MI, 0, O);
10815
395
    return;
10816
0
    break;
10817
941
  case 50:
10818
    // VST1d16Twb_fixed, VST1d32Twb_fixed, VST1d64Twb_fixed, VST1d8Twb_fixed
10819
941
    printVectorListThree(MI, 3, O);
10820
941
    SStream_concat0(O, ", ");
10821
941
    printAddrMode6Operand(MI, 1, O);
10822
941
    SStream_concat1(O, '!');
10823
941
    return;
10824
0
    break;
10825
1.16k
  case 51:
10826
    // VST1d16Twb_register, VST1d32Twb_register, VST1d64Twb_register, VST1d8T...
10827
1.16k
    printVectorListThree(MI, 4, O);
10828
1.16k
    SStream_concat0(O, ", ");
10829
1.16k
    printAddrMode6Operand(MI, 1, O);
10830
1.16k
    SStream_concat0(O, ", ");
10831
1.16k
    printOperand(MI, 3, O);
10832
1.16k
    return;
10833
0
    break;
10834
306
  case 52:
10835
    // VST1d16wb_fixed, VST1d32wb_fixed, VST1d64wb_fixed, VST1d8wb_fixed
10836
306
    printVectorListOne(MI, 3, O);
10837
306
    SStream_concat0(O, ", ");
10838
306
    printAddrMode6Operand(MI, 1, O);
10839
306
    SStream_concat1(O, '!');
10840
306
    return;
10841
0
    break;
10842
344
  case 53:
10843
    // VST1d16wb_register, VST1d32wb_register, VST1d64wb_register, VST1d8wb_r...
10844
344
    printVectorListOne(MI, 4, O);
10845
344
    SStream_concat0(O, ", ");
10846
344
    printAddrMode6Operand(MI, 1, O);
10847
344
    SStream_concat0(O, ", ");
10848
344
    printOperand(MI, 3, O);
10849
344
    return;
10850
0
    break;
10851
1.07k
  case 54:
10852
    // VST1q16, VST1q32, VST1q64, VST1q8, VST2d16, VST2d32, VST2d8
10853
1.07k
    printVectorListTwo(MI, 2, O);
10854
1.07k
    SStream_concat0(O, ", ");
10855
1.07k
    printAddrMode6Operand(MI, 0, O);
10856
1.07k
    return;
10857
0
    break;
10858
1.83k
  case 55:
10859
    // VST1q16wb_fixed, VST1q32wb_fixed, VST1q64wb_fixed, VST1q8wb_fixed, VST...
10860
1.83k
    printVectorListTwo(MI, 3, O);
10861
1.83k
    SStream_concat0(O, ", ");
10862
1.83k
    printAddrMode6Operand(MI, 1, O);
10863
1.83k
    SStream_concat1(O, '!');
10864
1.83k
    return;
10865
0
    break;
10866
1.32k
  case 56:
10867
    // VST1q16wb_register, VST1q32wb_register, VST1q64wb_register, VST1q8wb_r...
10868
1.32k
    printVectorListTwo(MI, 4, O);
10869
1.32k
    SStream_concat0(O, ", ");
10870
1.32k
    printAddrMode6Operand(MI, 1, O);
10871
1.32k
    SStream_concat0(O, ", ");
10872
1.32k
    printOperand(MI, 3, O);
10873
1.32k
    return;
10874
0
    break;
10875
873
  case 57:
10876
    // VST2b16, VST2b32, VST2b8
10877
873
    printVectorListTwoSpaced(MI, 2, O);
10878
873
    SStream_concat0(O, ", ");
10879
873
    printAddrMode6Operand(MI, 0, O);
10880
873
    return;
10881
0
    break;
10882
749
  case 58:
10883
    // VST2b16wb_fixed, VST2b32wb_fixed, VST2b8wb_fixed
10884
749
    printVectorListTwoSpaced(MI, 3, O);
10885
749
    SStream_concat0(O, ", ");
10886
749
    printAddrMode6Operand(MI, 1, O);
10887
749
    SStream_concat1(O, '!');
10888
749
    return;
10889
0
    break;
10890
794
  case 59:
10891
    // VST2b16wb_register, VST2b32wb_register, VST2b8wb_register
10892
794
    printVectorListTwoSpaced(MI, 4, O);
10893
794
    SStream_concat0(O, ", ");
10894
794
    printAddrMode6Operand(MI, 1, O);
10895
794
    SStream_concat0(O, ", ");
10896
794
    printOperand(MI, 3, O);
10897
794
    return;
10898
0
    break;
10899
13.4k
  case 60:
10900
    // t2BFic, tCBNZ, tCBZ
10901
13.4k
    printOperandAddr(MI, Address, 1, O);
10902
13.4k
    break;
10903
1.20k
  case 61:
10904
    // t2DMB, t2DSB
10905
1.20k
    printMemBOption(MI, 0, O);
10906
1.20k
    return;
10907
0
    break;
10908
413
  case 62:
10909
    // t2ISB
10910
413
    printInstSyncBOption(MI, 0, O);
10911
413
    return;
10912
0
    break;
10913
597
  case 63:
10914
    // t2PLDWi12, t2PLDi12, t2PLIi12
10915
597
    printAddrModeImm12Operand_0(MI, 0, O);
10916
597
    return;
10917
0
    break;
10918
304
  case 64:
10919
    // t2PLDWi8, t2PLDi8, t2PLIi8
10920
304
    printT2AddrModeImm8Operand_0(MI, 0, O);
10921
304
    return;
10922
0
    break;
10923
1.20k
  case 65:
10924
    // t2PLDWs, t2PLDs, t2PLIs
10925
1.20k
    printT2AddrModeSoRegOperand(MI, 0, O);
10926
1.20k
    return;
10927
0
    break;
10928
2.32k
  case 66:
10929
    // t2PLDpci, t2PLIpci
10930
2.32k
    printThumbLdrLabelOperand(MI, 0, O);
10931
2.32k
    return;
10932
0
    break;
10933
137
  case 67:
10934
    // t2TBB
10935
137
    printAddrModeTBB(MI, 0, O);
10936
137
    return;
10937
0
    break;
10938
1.16k
  case 68:
10939
    // t2TBH
10940
1.16k
    printAddrModeTBH(MI, 0, O);
10941
1.16k
    return;
10942
0
    break;
10943
0
  case 69:
10944
    // t2TSB
10945
0
    printTraceSyncBOption(MI, 0, O);
10946
0
    return;
10947
0
    break;
10948
6.67k
  case 70:
10949
    // tBL, tBLXi
10950
6.67k
    printOperandAddr(MI, Address, 2, O);
10951
6.67k
    return;
10952
0
    break;
10953
1.37M
  }
10954
10955
10956
  // Fragment 3 encoded into 6 bits for 38 unique commands.
10957
1.26M
  switch ((Bits >> 33) & 63) {
10958
0
  default: CS_ASSERT_RET(0 && "Invalid command number.");
10959
835k
  case 0:
10960
    // ASRi, ASRr, LDRBT_POST, LDRConstPool, LDRHTii, LDRSBTii, LDRSHTii, LDR...
10961
835k
    SStream_concat0(O, ", ");
10962
835k
    break;
10963
276k
  case 1:
10964
    // VLD3DUPdAsm_16, VLD3DUPdAsm_32, VLD3DUPdAsm_8, VLD3DUPqAsm_16, VLD3DUP...
10965
276k
    return;
10966
0
    break;
10967
69
  case 2:
10968
    // VLD3DUPdWB_fixed_Asm_16, VLD3DUPdWB_fixed_Asm_32, VLD3DUPdWB_fixed_Asm...
10969
69
    SStream_concat1(O, '!');
10970
69
    return;
10971
0
    break;
10972
3.27k
  case 3:
10973
    // VLD3dAsm_16, VLD3dAsm_32, VLD3dAsm_8, VLD3dWB_fixed_Asm_16, VLD3dWB_fi...
10974
3.27k
    printAddrMode6Operand(MI, 1, O);
10975
3.27k
    break;
10976
219
  case 4:
10977
    // BF16VDOTI_VDOTD, BF16VDOTI_VDOTQ, MVE_VMOV_q_rr, VBF16MALBQI, VBF16MAL...
10978
219
    printVectorIndex(MI, 4, O);
10979
219
    break;
10980
0
  case 5:
10981
    // CDE_CX1A, CDE_CX2A, CDE_CX3A, CDE_VCX1A_vec, CDE_VCX1_vec, CDE_VCX2A_v...
10982
0
    printOperand(MI, 0, O);
10983
0
    SStream_concat0(O, ", ");
10984
0
    break;
10985
0
  case 6:
10986
    // CDE_CX1DA, CDE_CX2DA, CDE_CX3DA
10987
0
    printGPRPairOperand(MI, 0, O);
10988
0
    SStream_concat0(O, ", ");
10989
0
    printOperand(MI, 3, O);
10990
0
    break;
10991
0
  case 7:
10992
    // CDE_CX2D, CDE_CX3D
10993
0
    printOperand(MI, 3, O);
10994
0
    break;
10995
44.9k
  case 8:
10996
    // CDP, MCR, MCRR, MSR, VABSD, VADDD, VCMPD, VCMPED, VDIVD, VMOVD, VMULD,...
10997
44.9k
    printOperand(MI, 1, O);
10998
44.9k
    break;
10999
133
  case 9:
11000
    // FCONSTD
11001
133
    printFPImmOperand(MI, 1, O);
11002
133
    return;
11003
0
    break;
11004
25.4k
  case 10:
11005
    // FLDMXDB_UPD, FLDMXIA_UPD, FSTMXDB_UPD, FSTMXIA_UPD, LDMDA_UPD, LDMDB_U...
11006
25.4k
    SStream_concat0(O, "!, ");
11007
25.4k
    printRegisterList(MI, 4, O);
11008
25.4k
    break;
11009
38.1k
  case 11:
11010
    // LDCL_OFFSET, LDCL_OPTION, LDCL_POST, LDCL_PRE, LDC_OFFSET, LDC_OPTION,...
11011
38.1k
    printCImmediate(MI, 1, O);
11012
38.1k
    SStream_concat0(O, ", ");
11013
38.1k
    break;
11014
9.10k
  case 12:
11015
    // MRC, MVE_VCVTf16s16_fix, MVE_VCVTf16u16_fix, MVE_VCVTf32s32_fix, MVE_V...
11016
9.10k
    printOperand(MI, 2, O);
11017
9.10k
    break;
11018
619
  case 13:
11019
    // MRS, t2MRS_AR
11020
619
    SStream_concat0(O, ", apsr");
11021
619
    return;
11022
0
    break;
11023
143
  case 14:
11024
    // MRSsys, t2MRSsys_AR
11025
143
    SStream_concat0(O, ", spsr");
11026
143
    return;
11027
0
    break;
11028
628
  case 15:
11029
    // MSRi
11030
628
    printModImmOperand(MI, 1, O);
11031
628
    return;
11032
0
    break;
11033
790
  case 16:
11034
    // MVE_VMOV_to_lane_16, MVE_VMOV_to_lane_32, MVE_VMOV_to_lane_8, VSETLNi1...
11035
790
    printVectorIndex(MI, 3, O);
11036
790
    SStream_concat0(O, ", ");
11037
790
    printOperand(MI, 2, O);
11038
790
    return;
11039
0
    break;
11040
855
  case 17:
11041
    // VCMPEZH, VCMPEZS, VCMPZH, VCMPZS
11042
855
    SStream_concat0(O, ", #0");
11043
855
    return;
11044
0
    break;
11045
10.4k
  case 18:
11046
    // VLD1DUPd16wb_fixed, VLD1DUPd16wb_register, VLD1DUPd32wb_fixed, VLD1DUP...
11047
10.4k
    printAddrMode6Operand(MI, 2, O);
11048
10.4k
    break;
11049
13.2k
  case 19:
11050
    // VLD1LNd16, VLD1LNd16_UPD, VLD1LNd32, VLD1LNd32_UPD, VLD1LNd8, VLD1LNd8...
11051
13.2k
    SStream_concat1(O, '[');
11052
13.2k
    break;
11053
2.64k
  case 20:
11054
    // VLD3DUPd16, VLD3DUPd16_UPD, VLD3DUPd32, VLD3DUPd32_UPD, VLD3DUPd8, VLD...
11055
2.64k
    SStream_concat0(O, "[], ");
11056
2.64k
    printOperand(MI, 1, O);
11057
2.64k
    SStream_concat0(O, "[], ");
11058
2.64k
    printOperand(MI, 2, O);
11059
2.64k
    break;
11060
1.02k
  case 21:
11061
    // VLDR_FPCXTNS_post, VLDR_FPCXTS_post, VLDR_FPSCR_NZCVQC_post, VLDR_FPSC...
11062
1.02k
    printT2AddrModeImm8s4OffsetOperand(MI, 2, O);
11063
1.02k
    return;
11064
0
    break;
11065
0
  case 22:
11066
    // VLDR_P0_post, VSTR_P0_post
11067
0
    printT2AddrModeImm8s4OffsetOperand(MI, 3, O);
11068
0
    return;
11069
0
    break;
11070
288
  case 23:
11071
    // VMRS
11072
288
    SStream_concat0(O, ", fpscr");
11073
288
    return;
11074
0
    break;
11075
36
  case 24:
11076
    // VMRS_FPCXTNS
11077
36
    SStream_concat0(O, ", fpcxtns");
11078
36
    return;
11079
0
    break;
11080
134
  case 25:
11081
    // VMRS_FPCXTS
11082
134
    SStream_concat0(O, ", fpcxts");
11083
134
    return;
11084
0
    break;
11085
138
  case 26:
11086
    // VMRS_FPEXC
11087
138
    SStream_concat0(O, ", fpexc");
11088
138
    return;
11089
0
    break;
11090
295
  case 27:
11091
    // VMRS_FPINST
11092
295
    SStream_concat0(O, ", fpinst");
11093
295
    return;
11094
0
    break;
11095
137
  case 28:
11096
    // VMRS_FPINST2
11097
137
    SStream_concat0(O, ", fpinst2");
11098
137
    return;
11099
0
    break;
11100
351
  case 29:
11101
    // VMRS_FPSCR_NZCVQC
11102
351
    SStream_concat0(O, ", fpscr_nzcvqc");
11103
351
    return;
11104
0
    break;
11105
23
  case 30:
11106
    // VMRS_FPSID
11107
23
    SStream_concat0(O, ", fpsid");
11108
23
    return;
11109
0
    break;
11110
236
  case 31:
11111
    // VMRS_MVFR0
11112
236
    SStream_concat0(O, ", mvfr0");
11113
236
    return;
11114
0
    break;
11115
70
  case 32:
11116
    // VMRS_MVFR1
11117
70
    SStream_concat0(O, ", mvfr1");
11118
70
    return;
11119
0
    break;
11120
37
  case 33:
11121
    // VMRS_MVFR2
11122
37
    SStream_concat0(O, ", mvfr2");
11123
37
    return;
11124
0
    break;
11125
0
  case 34:
11126
    // VMRS_P0
11127
0
    SStream_concat0(O, ", p0");
11128
0
    return;
11129
0
    break;
11130
0
  case 35:
11131
    // VMRS_VPR
11132
0
    SStream_concat0(O, ", vpr");
11133
0
    return;
11134
0
    break;
11135
397
  case 36:
11136
    // VSHTOH, VTOSHH, VTOUHH, VUHTOH
11137
397
    printFBits16(MI, 2, O);
11138
397
    return;
11139
0
    break;
11140
1.14k
  case 37:
11141
    // VSLTOD, VSLTOH, VSLTOS, VTOSLD, VTOSLH, VTOSLS, VTOULD, VTOULH, VTOULS...
11142
1.14k
    printFBits32(MI, 2, O);
11143
1.14k
    return;
11144
0
    break;
11145
1.26M
  }
11146
11147
11148
  // Fragment 4 encoded into 7 bits for 78 unique commands.
11149
983k
  switch ((Bits >> 39) & 127) {
11150
0
  default: CS_ASSERT_RET(0 && "Invalid command number.");
11151
188k
  case 0:
11152
    // ASRi, ASRr, LDRConstPool, LSLi, LSLr, LSRi, LSRr, RORi, RORr, RRXi, t2...
11153
188k
    printOperand(MI, 1, O);
11154
188k
    break;
11155
116
  case 1:
11156
    // LDRBT_POST, LDRHTii, LDRSBTii, LDRSHTii, LDRT_POST, STRBT_POST, STRT_P...
11157
116
    printAddrMode7Operand(MI, 1, O);
11158
116
    return;
11159
0
    break;
11160
0
  case 2:
11161
    // VLD1LNdAsm_16, VLD1LNdAsm_32, VLD1LNdAsm_8, VLD1LNdWB_fixed_Asm_16, VL...
11162
0
    printAddrMode6Operand(MI, 2, O);
11163
0
    break;
11164
152k
  case 3:
11165
    // VLD3DUPdWB_register_Asm_16, VLD3DUPdWB_register_Asm_32, VLD3DUPdWB_reg...
11166
152k
    printOperand(MI, 3, O);
11167
152k
    break;
11168
35.1k
  case 4:
11169
    // VLD3dAsm_16, VLD3dAsm_32, VLD3dAsm_8, VLD4dAsm_16, VLD4dAsm_32, VLD4dA...
11170
35.1k
    return;
11171
0
    break;
11172
4.71k
  case 5:
11173
    // VLD3dWB_fixed_Asm_16, VLD3dWB_fixed_Asm_32, VLD3dWB_fixed_Asm_8, VLD4d...
11174
4.71k
    SStream_concat1(O, '!');
11175
4.71k
    return;
11176
0
    break;
11177
50.1k
  case 6:
11178
    // VLD3dWB_register_Asm_16, VLD3dWB_register_Asm_32, VLD3dWB_register_Asm...
11179
50.1k
    SStream_concat0(O, ", ");
11180
50.1k
    break;
11181
0
  case 7:
11182
    // t2LDRB_POST_imm, t2LDRH_POST_imm, t2LDRSB_POST_imm, t2LDRSH_POST_imm, ...
11183
0
    printT2AddrModeImm8OffsetOperand(MI, 2, O);
11184
0
    return;
11185
0
    break;
11186
753
  case 8:
11187
    // t2MOVSsi, t2MOVsi, t2CMNzrs, t2CMPrs, t2MVNs, t2TEQrs, t2TSTrs
11188
753
    printT2SOOperand(MI, 1, O);
11189
753
    return;
11190
0
    break;
11191
1.56k
  case 9:
11192
    // t2MOVSsr, t2MOVsr, CMNzrsr, CMPrsr, MOVsr, MVNsr, TEQrsr, TSTrsr
11193
1.56k
    printSORegRegOperand(MI, 1, O);
11194
1.56k
    return;
11195
0
    break;
11196
612
  case 10:
11197
    // ADR, t2ADR
11198
612
    printAdrLabelOperand_0(MI, 1, O);
11199
612
    return;
11200
0
    break;
11201
660
  case 11:
11202
    // BFC, t2BFC
11203
660
    printBitfieldInvMaskImmOperand(MI, 2, O);
11204
660
    return;
11205
0
    break;
11206
33.1k
  case 12:
11207
    // BFI, CDE_VCX1_vec, CDE_VCX2_vec, CDE_VCX3_vec, CPS3p, CRC32B, CRC32CB,...
11208
33.1k
    printOperand(MI, 2, O);
11209
33.1k
    break;
11210
0
  case 13:
11211
    // CDE_VCX2A_fpdp, CDE_VCX2A_fpsp, CDE_VCX3A_fpdp, CDE_VCX3A_fpsp
11212
0
    printOperand(MI, 4, O);
11213
0
    break;
11214
1.55k
  case 14:
11215
    // CMNri, CMPri, MOVi, MVNi, TEQri, TSTri
11216
1.55k
    printModImmOperand(MI, 1, O);
11217
1.55k
    return;
11218
0
    break;
11219
2.77k
  case 15:
11220
    // CMNzrsi, CMPrsi, MOVsi, MVNsi, TEQrsi, TSTrsi
11221
2.77k
    printSORegImmOperand(MI, 1, O);
11222
2.77k
    return;
11223
0
    break;
11224
645
  case 16:
11225
    // FCONSTH, FCONSTS, MVE_VMOVimmf32, VMOVv2f32, VMOVv4f32
11226
645
    printFPImmOperand(MI, 1, O);
11227
645
    return;
11228
0
    break;
11229
7.82k
  case 17:
11230
    // FLDMXIA, FSTMXIA, LDMDA, LDMDB, LDMIA, LDMIB, STMDA, STMDB, STMIA, STM...
11231
7.82k
    printRegisterList(MI, 3, O);
11232
7.82k
    break;
11233
525
  case 18:
11234
    // LDC2L_OPTION, LDC2_OPTION, STC2L_OPTION, STC2_OPTION
11235
525
    printCoprocOptionImm(MI, 3, O);
11236
525
    return;
11237
0
    break;
11238
2.10k
  case 19:
11239
    // LDC2L_POST, LDC2_POST, STC2L_POST, STC2_POST
11240
2.10k
    printPostIdxImm8s4Operand(MI, 3, O);
11241
2.10k
    return;
11242
0
    break;
11243
10.1k
  case 20:
11244
    // LDCL_OFFSET, LDC_OFFSET, STCL_OFFSET, STC_OFFSET, t2LDC2L_OFFSET, t2LD...
11245
10.1k
    printAddrMode5Operand_0(MI, 2, O);
11246
10.1k
    return;
11247
0
    break;
11248
36.6k
  case 21:
11249
    // LDCL_OPTION, LDCL_POST, LDC_OPTION, LDC_POST, LDRBT_POST_IMM, LDRBT_PO...
11250
36.6k
    printAddrMode7Operand(MI, 2, O);
11251
36.6k
    break;
11252
12.6k
  case 22:
11253
    // LDCL_PRE, LDC_PRE, STCL_PRE, STC_PRE, t2LDC2L_PRE, t2LDC2_PRE, t2LDCL_...
11254
12.6k
    printAddrMode5Operand_1(MI, 2, O);
11255
12.6k
    SStream_concat1(O, '!');
11256
12.6k
    return;
11257
0
    break;
11258
4.68k
  case 23:
11259
    // LDRB_PRE_IMM, LDR_PRE_IMM, STRB_PRE_IMM, STR_PRE_IMM
11260
4.68k
    printAddrModeImm12Operand_1(MI, 2, O);
11261
4.68k
    SStream_concat1(O, '!');
11262
4.68k
    return;
11263
0
    break;
11264
3.99k
  case 24:
11265
    // LDRB_PRE_REG, LDR_PRE_REG, STRB_PRE_REG, STR_PRE_REG
11266
3.99k
    printAddrMode2Operand(MI, 2, O);
11267
3.99k
    SStream_concat1(O, '!');
11268
3.99k
    return;
11269
0
    break;
11270
5.36k
  case 25:
11271
    // LDRBi12, LDRcp, LDRi12, STRBi12, STRi12, t2LDRBi12, t2LDRHi12, t2LDRSB...
11272
5.36k
    printAddrModeImm12Operand_0(MI, 1, O);
11273
5.36k
    return;
11274
0
    break;
11275
3.73k
  case 26:
11276
    // LDRBrs, LDRrs, STRBrs, STRrs
11277
3.73k
    printAddrMode2Operand(MI, 1, O);
11278
3.73k
    return;
11279
0
    break;
11280
1.73k
  case 27:
11281
    // LDRH, LDRSB, LDRSH, STRH
11282
1.73k
    printAddrMode3Operand_0(MI, 1, O);
11283
1.73k
    return;
11284
0
    break;
11285
1.67k
  case 28:
11286
    // LDRH_PRE, LDRSB_PRE, LDRSH_PRE, STRH_PRE
11287
1.67k
    printAddrMode3Operand_1(MI, 2, O);
11288
1.67k
    SStream_concat1(O, '!');
11289
1.67k
    return;
11290
0
    break;
11291
1.28k
  case 29:
11292
    // MCR2, MRC2
11293
1.28k
    printCImmediate(MI, 3, O);
11294
1.28k
    SStream_concat0(O, ", ");
11295
1.28k
    printCImmediate(MI, 4, O);
11296
1.28k
    SStream_concat0(O, ", ");
11297
1.28k
    printOperand(MI, 5, O);
11298
1.28k
    return;
11299
0
    break;
11300
169
  case 30:
11301
    // MRSbanked, t2MRSbanked
11302
169
    printBankedRegOperand(MI, 1, O);
11303
169
    return;
11304
0
    break;
11305
420
  case 31:
11306
    // MVE_VBICimmi16, MVE_VBICimmi32, MVE_VORRimmi16, MVE_VORRimmi32
11307
420
    printVMOVModImmOperand(MI, 2, O);
11308
420
    return;
11309
0
    break;
11310
7.97k
  case 32:
11311
    // MVE_VLDRBS16, MVE_VLDRBS32, MVE_VLDRBU16, MVE_VLDRBU32, MVE_VLDRBU8, M...
11312
7.97k
    printT2AddrModeImm8Operand_0(MI, 1, O);
11313
7.97k
    return;
11314
0
    break;
11315
2.65k
  case 33:
11316
    // MVE_VLDRBS16_pre, MVE_VLDRBS32_pre, MVE_VLDRBU16_pre, MVE_VLDRBU32_pre...
11317
2.65k
    printT2AddrModeImm8Operand_0(MI, 2, O);
11318
2.65k
    SStream_concat1(O, '!');
11319
2.65k
    return;
11320
0
    break;
11321
158
  case 34:
11322
    // MVE_VLDRBS16_rq, MVE_VLDRBS32_rq, MVE_VLDRBU16_rq, MVE_VLDRBU32_rq, MV...
11323
158
    printMveAddrModeRQOperand_0(MI, 1, O);
11324
158
    return;
11325
0
    break;
11326
3.80k
  case 35:
11327
    // MVE_VLDRBU8_pre, MVE_VLDRHU16_pre, MVE_VLDRWU32_pre, MVE_VSTRBU8_pre, ...
11328
3.80k
    printT2AddrModeImm8Operand_1(MI, 2, O);
11329
3.80k
    SStream_concat1(O, '!');
11330
3.80k
    return;
11331
0
    break;
11332
80
  case 36:
11333
    // MVE_VLDRDU64_rq, MVE_VSTRD64_rq
11334
80
    printMveAddrModeRQOperand_3(MI, 1, O);
11335
80
    return;
11336
0
    break;
11337
102
  case 37:
11338
    // MVE_VLDRHS32_rq, MVE_VLDRHU16_rq, MVE_VLDRHU32_rq, MVE_VSTRH16_rq, MVE...
11339
102
    printMveAddrModeRQOperand_1(MI, 1, O);
11340
102
    return;
11341
0
    break;
11342
251
  case 38:
11343
    // MVE_VLDRWU32_rq, MVE_VSTRW32_rq
11344
251
    printMveAddrModeRQOperand_2(MI, 1, O);
11345
251
    return;
11346
0
    break;
11347
4.05k
  case 39:
11348
    // MVE_VMOVimmi16, MVE_VMOVimmi32, MVE_VMOVimmi8, MVE_VMVNimmi16, MVE_VMV...
11349
4.05k
    printVMOVModImmOperand(MI, 1, O);
11350
4.05k
    return;
11351
0
    break;
11352
1.69k
  case 40:
11353
    // MVE_WLSTP_16, MVE_WLSTP_32, MVE_WLSTP_64, MVE_WLSTP_8, t2BFic, t2WLS
11354
1.69k
    printOperandAddr(MI, Address, 2, O);
11355
1.69k
    break;
11356
675
  case 41:
11357
    // SSAT, SSAT16, t2SSAT, t2SSAT16
11358
675
    printImmPlusOneOperand(MI, 1, O);
11359
675
    SStream_concat0(O, ", ");
11360
675
    printOperand(MI, 2, O);
11361
675
    break;
11362
1.11k
  case 42:
11363
    // STLEXD, STREXD
11364
1.11k
    printGPRPairOperand(MI, 1, O);
11365
1.11k
    SStream_concat0(O, ", ");
11366
1.11k
    printAddrMode7Operand(MI, 2, O);
11367
1.11k
    return;
11368
0
    break;
11369
1.28k
  case 43:
11370
    // VLD1LNd16, VLD1LNd32, VLD1LNd8, VST2LNd16, VST2LNd32, VST2LNd8, VST2LN...
11371
1.28k
    printNoHashImmediate(MI, 4, O);
11372
1.28k
    break;
11373
4.54k
  case 44:
11374
    // VLD1LNd16_UPD, VLD1LNd32_UPD, VLD1LNd8_UPD, VLD2LNd16, VLD2LNd32, VLD2...
11375
4.54k
    printNoHashImmediate(MI, 6, O);
11376
4.54k
    break;
11377
2.23k
  case 45:
11378
    // VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_UPD, VLD2LNq32_U...
11379
2.23k
    printNoHashImmediate(MI, 8, O);
11380
2.23k
    SStream_concat0(O, "], ");
11381
2.23k
    break;
11382
522
  case 46:
11383
    // VLD3DUPd16, VLD3DUPd16_UPD, VLD3DUPd32, VLD3DUPd32_UPD, VLD3DUPd8, VLD...
11384
522
    SStream_concat0(O, "[]}, ");
11385
522
    break;
11386
1.46k
  case 47:
11387
    // VLD3LNd16_UPD, VLD3LNd32_UPD, VLD3LNd8_UPD, VLD3LNq16_UPD, VLD3LNq32_U...
11388
1.46k
    printNoHashImmediate(MI, 10, O);
11389
1.46k
    SStream_concat0(O, "], ");
11390
1.46k
    printOperand(MI, 1, O);
11391
1.46k
    SStream_concat1(O, '[');
11392
1.46k
    printNoHashImmediate(MI, 10, O);
11393
1.46k
    SStream_concat0(O, "], ");
11394
1.46k
    printOperand(MI, 2, O);
11395
1.46k
    SStream_concat1(O, '[');
11396
1.46k
    printNoHashImmediate(MI, 10, O);
11397
1.46k
    break;
11398
2.11k
  case 48:
11399
    // VLD4DUPd16, VLD4DUPd16_UPD, VLD4DUPd32, VLD4DUPd32_UPD, VLD4DUPd8, VLD...
11400
2.11k
    SStream_concat0(O, "[], ");
11401
2.11k
    printOperand(MI, 3, O);
11402
2.11k
    SStream_concat0(O, "[]}, ");
11403
2.11k
    break;
11404
880
  case 49:
11405
    // VLD4LNd16_UPD, VLD4LNd32_UPD, VLD4LNd8_UPD, VLD4LNq16_UPD, VLD4LNq32_U...
11406
880
    printNoHashImmediate(MI, 12, O);
11407
880
    SStream_concat0(O, "], ");
11408
880
    printOperand(MI, 1, O);
11409
880
    SStream_concat1(O, '[');
11410
880
    printNoHashImmediate(MI, 12, O);
11411
880
    SStream_concat0(O, "], ");
11412
880
    printOperand(MI, 2, O);
11413
880
    SStream_concat1(O, '[');
11414
880
    printNoHashImmediate(MI, 12, O);
11415
880
    SStream_concat0(O, "], ");
11416
880
    printOperand(MI, 3, O);
11417
880
    SStream_concat1(O, '[');
11418
880
    printNoHashImmediate(MI, 12, O);
11419
880
    SStream_concat0(O, "]}, ");
11420
880
    printAddrMode6Operand(MI, 5, O);
11421
880
    printAddrMode6OffsetOperand(MI, 7, O);
11422
880
    return;
11423
0
    break;
11424
851
  case 50:
11425
    // VLDRD, VLDRS, VSTRD, VSTRS
11426
851
    printAddrMode5Operand_0(MI, 1, O);
11427
851
    return;
11428
0
    break;
11429
534
  case 51:
11430
    // VLDRH, VSTRH
11431
534
    printAddrMode5FP16Operand_0(MI, 1, O);
11432
534
    return;
11433
0
    break;
11434
215
  case 52:
11435
    // VST1LNd16, VST1LNd32, VST1LNd8
11436
215
    printNoHashImmediate(MI, 3, O);
11437
215
    SStream_concat0(O, "]}, ");
11438
215
    printAddrMode6Operand(MI, 0, O);
11439
215
    return;
11440
0
    break;
11441
1.85k
  case 53:
11442
    // VST1LNd16_UPD, VST1LNd32_UPD, VST1LNd8_UPD, VST3LNd16, VST3LNd32, VST3...
11443
1.85k
    printNoHashImmediate(MI, 5, O);
11444
1.85k
    break;
11445
779
  case 54:
11446
    // VST3LNd16_UPD, VST3LNd32_UPD, VST3LNd8_UPD, VST3LNq16_UPD, VST3LNq32_U...
11447
779
    printNoHashImmediate(MI, 7, O);
11448
779
    SStream_concat0(O, "], ");
11449
779
    printOperand(MI, 5, O);
11450
779
    SStream_concat1(O, '[');
11451
779
    printNoHashImmediate(MI, 7, O);
11452
779
    SStream_concat0(O, "], ");
11453
779
    printOperand(MI, 6, O);
11454
779
    SStream_concat1(O, '[');
11455
779
    printNoHashImmediate(MI, 7, O);
11456
779
    SStream_concat0(O, "]}, ");
11457
779
    printAddrMode6Operand(MI, 1, O);
11458
779
    printAddrMode6OffsetOperand(MI, 3, O);
11459
779
    return;
11460
0
    break;
11461
2.83k
  case 55:
11462
    // VST3d16_UPD, VST3d32_UPD, VST3d8_UPD, VST3q16_UPD, VST3q32_UPD, VST3q8...
11463
2.83k
    printOperand(MI, 5, O);
11464
2.83k
    SStream_concat0(O, ", ");
11465
2.83k
    printOperand(MI, 6, O);
11466
2.83k
    break;
11467
457
  case 56:
11468
    // VTBL1
11469
457
    printVectorListOne(MI, 1, O);
11470
457
    SStream_concat0(O, ", ");
11471
457
    printOperand(MI, 2, O);
11472
457
    return;
11473
0
    break;
11474
542
  case 57:
11475
    // VTBL2
11476
542
    printVectorListTwo(MI, 1, O);
11477
542
    SStream_concat0(O, ", ");
11478
542
    printOperand(MI, 2, O);
11479
542
    return;
11480
0
    break;
11481
163
  case 58:
11482
    // VTBL3
11483
163
    printVectorListThree(MI, 1, O);
11484
163
    SStream_concat0(O, ", ");
11485
163
    printOperand(MI, 2, O);
11486
163
    return;
11487
0
    break;
11488
299
  case 59:
11489
    // VTBL4
11490
299
    printVectorListFour(MI, 1, O);
11491
299
    SStream_concat0(O, ", ");
11492
299
    printOperand(MI, 2, O);
11493
299
    return;
11494
0
    break;
11495
34
  case 60:
11496
    // VTBX1
11497
34
    printVectorListOne(MI, 2, O);
11498
34
    SStream_concat0(O, ", ");
11499
34
    printOperand(MI, 3, O);
11500
34
    return;
11501
0
    break;
11502
27
  case 61:
11503
    // VTBX2
11504
27
    printVectorListTwo(MI, 2, O);
11505
27
    SStream_concat0(O, ", ");
11506
27
    printOperand(MI, 3, O);
11507
27
    return;
11508
0
    break;
11509
180
  case 62:
11510
    // VTBX3
11511
180
    printVectorListThree(MI, 2, O);
11512
180
    SStream_concat0(O, ", ");
11513
180
    printOperand(MI, 3, O);
11514
180
    return;
11515
0
    break;
11516
299
  case 63:
11517
    // VTBX4
11518
299
    printVectorListFour(MI, 2, O);
11519
299
    SStream_concat0(O, ", ");
11520
299
    printOperand(MI, 3, O);
11521
299
    return;
11522
0
    break;
11523
3.46k
  case 64:
11524
    // sysLDMDA_UPD, sysLDMDB_UPD, sysLDMIA_UPD, sysLDMIB_UPD, sysSTMDA_UPD, ...
11525
3.46k
    SStream_concat0(O, " ^");
11526
3.46k
    return;
11527
0
    break;
11528
664
  case 65:
11529
    // t2BFLi, t2BFi
11530
664
    printOperandAddr(MI, Address, 1, O);
11531
664
    return;
11532
0
    break;
11533
27.7k
  case 66:
11534
    // t2LDRBpci, t2LDRHpci, t2LDRSBpci, t2LDRSHpci, t2LDRpci, tLDRpci
11535
27.7k
    printThumbLdrLabelOperand(MI, 1, O);
11536
27.7k
    return;
11537
0
    break;
11538
1.29k
  case 67:
11539
    // t2LDRBs, t2LDRHs, t2LDRSBs, t2LDRSHs, t2LDRs, t2STRBs, t2STRHs, t2STRs
11540
1.29k
    printT2AddrModeSoRegOperand(MI, 1, O);
11541
1.29k
    return;
11542
0
    break;
11543
50
  case 68:
11544
    // t2LDREX
11545
50
    printT2AddrModeImm0_1020s4Operand(MI, 1, O);
11546
50
    return;
11547
0
    break;
11548
1.78k
  case 69:
11549
    // t2MRS_M
11550
1.78k
    printMSRMaskOperand(MI, 1, O);
11551
1.78k
    return;
11552
0
    break;
11553
2.57k
  case 70:
11554
    // tADDspi, tSUBspi
11555
2.57k
    printThumbS4ImmOperand(MI, 2, O);
11556
2.57k
    return;
11557
0
    break;
11558
24.6k
  case 71:
11559
    // tADR
11560
24.6k
    printAdrLabelOperandAddr_2(MI, Address, 1, O);
11561
24.6k
    return;
11562
0
    break;
11563
72.1k
  case 72:
11564
    // tASRri, tLSRri
11565
72.1k
    printThumbSRImm(MI, 3, O);
11566
72.1k
    return;
11567
0
    break;
11568
47.1k
  case 73:
11569
    // tLDRBi, tSTRBi
11570
47.1k
    printThumbAddrModeImm5S1Operand(MI, 1, O);
11571
47.1k
    return;
11572
0
    break;
11573
32.2k
  case 74:
11574
    // tLDRBr, tLDRHr, tLDRSB, tLDRSH, tLDRr, tSTRBr, tSTRHr, tSTRr
11575
32.2k
    printThumbAddrModeRROperand(MI, 1, O);
11576
32.2k
    return;
11577
0
    break;
11578
61.5k
  case 75:
11579
    // tLDRHi, tSTRHi
11580
61.5k
    printThumbAddrModeImm5S2Operand(MI, 1, O);
11581
61.5k
    return;
11582
0
    break;
11583
62.4k
  case 76:
11584
    // tLDRi, tSTRi
11585
62.4k
    printThumbAddrModeImm5S4Operand(MI, 1, O);
11586
62.4k
    return;
11587
0
    break;
11588
34.7k
  case 77:
11589
    // tLDRspi, tSTRspi
11590
34.7k
    printThumbAddrModeSPOperand(MI, 1, O);
11591
34.7k
    return;
11592
0
    break;
11593
983k
  }
11594
11595
11596
  // Fragment 5 encoded into 5 bits for 27 unique commands.
11597
487k
  switch ((Bits >> 46) & 31) {
11598
0
  default: CS_ASSERT_RET(0 && "Invalid command number.");
11599
187k
  case 0:
11600
    // ASRi, ASRr, LSLi, LSLr, LSRi, LSRr, RORi, RORr, VLD1LNdWB_register_Asm...
11601
187k
    SStream_concat0(O, ", ");
11602
187k
    break;
11603
215k
  case 1:
11604
    // LDRConstPool, RRXi, VLD1LNdAsm_16, VLD1LNdAsm_32, VLD1LNdAsm_8, VLD2LN...
11605
215k
    return;
11606
0
    break;
11607
0
  case 2:
11608
    // VLD1LNdWB_fixed_Asm_16, VLD1LNdWB_fixed_Asm_32, VLD1LNdWB_fixed_Asm_8,...
11609
0
    SStream_concat1(O, '!');
11610
0
    return;
11611
0
    break;
11612
519
  case 3:
11613
    // VLD3dWB_register_Asm_16, VLD3dWB_register_Asm_32, VLD3dWB_register_Asm...
11614
519
    printOperand(MI, 3, O);
11615
519
    return;
11616
0
    break;
11617
5.72k
  case 4:
11618
    // CDE_CX2DA, CDE_CX3D, CDE_CX3DA, VLD1DUPd16wb_register, VLD1DUPd32wb_re...
11619
5.72k
    printOperand(MI, 4, O);
11620
5.72k
    break;
11621
29.4k
  case 5:
11622
    // CDP, t2CDP, t2CDP2
11623
29.4k
    printCImmediate(MI, 2, O);
11624
29.4k
    SStream_concat0(O, ", ");
11625
29.4k
    printCImmediate(MI, 3, O);
11626
29.4k
    SStream_concat0(O, ", ");
11627
29.4k
    printCImmediate(MI, 4, O);
11628
29.4k
    SStream_concat0(O, ", ");
11629
29.4k
    printOperand(MI, 5, O);
11630
29.4k
    return;
11631
0
    break;
11632
7.86k
  case 6:
11633
    // MCR, MCRR, VADDD, VDIVD, VMULD, VNMULD, VSUBD, t2MCR, t2MCR2, t2MCRR, ...
11634
7.86k
    printOperand(MI, 2, O);
11635
7.86k
    break;
11636
6.55k
  case 7:
11637
    // MRC, t2MRC, t2MRC2
11638
6.55k
    printOperand(MI, 0, O);
11639
6.55k
    SStream_concat0(O, ", ");
11640
6.55k
    printCImmediate(MI, 3, O);
11641
6.55k
    SStream_concat0(O, ", ");
11642
6.55k
    printCImmediate(MI, 4, O);
11643
6.55k
    SStream_concat0(O, ", ");
11644
6.55k
    printOperand(MI, 5, O);
11645
6.55k
    return;
11646
0
    break;
11647
2.92k
  case 8:
11648
    // MVE_VLDRBS16_post, MVE_VLDRBS32_post, MVE_VLDRBU16_post, MVE_VLDRBU32_...
11649
2.92k
    printT2AddrModeImm8OffsetOperand(MI, 3, O);
11650
2.92k
    return;
11651
0
    break;
11652
1.88k
  case 9:
11653
    // MVE_VMOV_from_lane_32, MVE_VMOV_from_lane_s16, MVE_VMOV_from_lane_s8, ...
11654
1.88k
    printVectorIndex(MI, 2, O);
11655
1.88k
    return;
11656
0
    break;
11657
1.43k
  case 10:
11658
    // MVE_VMOV_q_rr, VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_U...
11659
1.43k
    printOperand(MI, 1, O);
11660
1.43k
    break;
11661
752
  case 11:
11662
    // MVE_VSHLL_lws16bh, MVE_VSHLL_lws16th, MVE_VSHLL_lwu16bh, MVE_VSHLL_lwu...
11663
752
    SStream_concat0(O, ", #16");
11664
752
    return;
11665
0
    break;
11666
845
  case 12:
11667
    // MVE_VSHLL_lws8bh, MVE_VSHLL_lws8th, MVE_VSHLL_lwu8bh, MVE_VSHLL_lwu8th
11668
845
    SStream_concat0(O, ", #8");
11669
845
    return;
11670
0
    break;
11671
635
  case 13:
11672
    // SSAT, t2SSAT
11673
635
    printShiftImmOperand(MI, 3, O);
11674
635
    return;
11675
0
    break;
11676
554
  case 14:
11677
    // SXTB, SXTB16, SXTH, UXTB, UXTB16, UXTH, t2SXTB, t2SXTB16, t2SXTH, t2UX...
11678
554
    printRotImmOperand(MI, 2, O);
11679
554
    return;
11680
0
    break;
11681
9.37k
  case 15:
11682
    // VCEQzv16i8, VCEQzv2f32, VCEQzv2i32, VCEQzv4f16, VCEQzv4f32, VCEQzv4i16...
11683
9.37k
    SStream_concat0(O, ", #0");
11684
9.37k
    return;
11685
0
    break;
11686
413
  case 16:
11687
    // VCMLAv2f32_indexed, VCMLAv4f16_indexed, VCMLAv4f32_indexed, VCMLAv8f16...
11688
413
    printVectorIndex(MI, 4, O);
11689
413
    SStream_concat0(O, ", ");
11690
413
    printComplexRotationOp_90_0(MI, 5, O);
11691
413
    return;
11692
0
    break;
11693
389
  case 17:
11694
    // VFMALDI, VFMALQI, VFMSLDI, VFMSLQI
11695
389
    printVectorIndex(MI, 3, O);
11696
389
    return;
11697
0
    break;
11698
2.71k
  case 18:
11699
    // VLD1LNd16, VLD1LNd16_UPD, VLD1LNd32, VLD1LNd32_UPD, VLD1LNd8, VLD1LNd8...
11700
2.71k
    SStream_concat0(O, "]}, ");
11701
2.71k
    break;
11702
6.43k
  case 19:
11703
    // VLD2LNd16, VLD2LNd32, VLD2LNd8, VLD2LNq16, VLD2LNq32, VLD4LNd16, VLD4L...
11704
6.43k
    SStream_concat0(O, "], ");
11705
6.43k
    break;
11706
159
  case 20:
11707
    // VLD3DUPd16, VLD3DUPd32, VLD3DUPd8, VLD3DUPq16, VLD3DUPq32, VLD3DUPq8
11708
159
    printAddrMode6Operand(MI, 3, O);
11709
159
    return;
11710
0
    break;
11711
672
  case 21:
11712
    // VLD3DUPd16_UPD, VLD3DUPd32_UPD, VLD3DUPd8_UPD, VLD3DUPq16_UPD, VLD3DUP...
11713
672
    printAddrMode6Operand(MI, 4, O);
11714
672
    break;
11715
1.81k
  case 22:
11716
    // VLD4DUPd16_UPD, VLD4DUPd32_UPD, VLD4DUPd8_UPD, VLD4DUPq16_UPD, VLD4DUP...
11717
1.81k
    printAddrMode6Operand(MI, 5, O);
11718
1.81k
    printAddrMode6OffsetOperand(MI, 7, O);
11719
1.81k
    return;
11720
0
    break;
11721
1.34k
  case 23:
11722
    // VST3d16_UPD, VST3d32_UPD, VST3d8_UPD, VST3q16_UPD, VST3q32_UPD, VST3q8...
11723
1.34k
    SStream_concat0(O, "}, ");
11724
1.34k
    printAddrMode6Operand(MI, 1, O);
11725
1.34k
    printAddrMode6OffsetOperand(MI, 3, O);
11726
1.34k
    return;
11727
0
    break;
11728
806
  case 24:
11729
    // VST4LNd16_UPD, VST4LNd32_UPD, VST4LNd8_UPD, VST4LNq16_UPD, VST4LNq32_U...
11730
806
    printOperand(MI, 5, O);
11731
806
    SStream_concat1(O, '[');
11732
806
    printNoHashImmediate(MI, 8, O);
11733
806
    SStream_concat0(O, "], ");
11734
806
    printOperand(MI, 6, O);
11735
806
    SStream_concat1(O, '[');
11736
806
    printNoHashImmediate(MI, 8, O);
11737
806
    SStream_concat0(O, "], ");
11738
806
    printOperand(MI, 7, O);
11739
806
    SStream_concat1(O, '[');
11740
806
    printNoHashImmediate(MI, 8, O);
11741
806
    SStream_concat0(O, "]}, ");
11742
806
    printAddrMode6Operand(MI, 1, O);
11743
806
    printAddrMode6OffsetOperand(MI, 3, O);
11744
806
    return;
11745
0
    break;
11746
2.10k
  case 25:
11747
    // sysLDMDA, sysLDMDB, sysLDMIA, sysLDMIB, sysSTMDA, sysSTMDB, sysSTMIA, ...
11748
2.10k
    SStream_concat0(O, " ^");
11749
2.10k
    return;
11750
0
    break;
11751
0
  case 26:
11752
    // t2MOVsra_glue, t2MOVsrl_glue
11753
0
    SStream_concat0(O, ", #1");
11754
0
    return;
11755
0
    break;
11756
487k
  }
11757
11758
11759
  // Fragment 6 encoded into 6 bits for 38 unique commands.
11760
211k
  switch ((Bits >> 51) & 63) {
11761
0
  default: CS_ASSERT_RET(0 && "Invalid command number.");
11762
69.2k
  case 0:
11763
    // ASRi, ASRr, LSLi, LSLr, LSRi, LSRr, RORi, RORr, ADCrr, ADDrr, ANDrr, B...
11764
69.2k
    printOperand(MI, 2, O);
11765
69.2k
    break;
11766
5.31k
  case 1:
11767
    // VLD1LNdWB_register_Asm_16, VLD1LNdWB_register_Asm_32, VLD1LNdWB_regist...
11768
5.31k
    printOperand(MI, 4, O);
11769
5.31k
    break;
11770
8.36k
  case 2:
11771
    // ADCri, ADDri, ANDri, BICri, EORri, ORRri, RSBri, RSCri, SBCri, SUBri
11772
8.36k
    printModImmOperand(MI, 2, O);
11773
8.36k
    return;
11774
0
    break;
11775
12.7k
  case 3:
11776
    // ADCrsi, ADDrsi, ANDrsi, BICrsi, EORrsi, ORRrsi, RSBrsi, RSCrsi, SBCrsi...
11777
12.7k
    printSORegImmOperand(MI, 2, O);
11778
12.7k
    return;
11779
0
    break;
11780
673
  case 4:
11781
    // BFI, t2BFI
11782
673
    printBitfieldInvMaskImmOperand(MI, 3, O);
11783
673
    return;
11784
0
    break;
11785
6.32k
  case 5:
11786
    // CDE_CX2DA, CDE_CX3D, VADDD, VDIVD, VLD1DUPd16wb_register, VLD1DUPd32wb...
11787
6.32k
    return;
11788
0
    break;
11789
7.57k
  case 6:
11790
    // CDE_CX3DA, MCR, MCRR, t2MCR, t2MCR2, t2MCRR, t2MCRR2
11791
7.57k
    SStream_concat0(O, ", ");
11792
7.57k
    break;
11793
19.2k
  case 7:
11794
    // CDE_VCX2_vec, CDE_VCX3_vec, MVE_VABAVs16, MVE_VABAVs32, MVE_VABAVs8, M...
11795
19.2k
    printOperand(MI, 3, O);
11796
19.2k
    break;
11797
2.26k
  case 8:
11798
    // CDE_VCX3A_fpdp, CDE_VCX3A_fpsp, VST2LNd16_UPD, VST2LNd32_UPD, VST2LNd8...
11799
2.26k
    printOperand(MI, 5, O);
11800
2.26k
    break;
11801
4.81k
  case 9:
11802
    // LDCL_OPTION, LDC_OPTION, STCL_OPTION, STC_OPTION, t2LDC2L_OPTION, t2LD...
11803
4.81k
    printCoprocOptionImm(MI, 3, O);
11804
4.81k
    return;
11805
0
    break;
11806
10.5k
  case 10:
11807
    // LDCL_POST, LDC_POST, STCL_POST, STC_POST, t2LDC2L_POST, t2LDC2_POST, t...
11808
10.5k
    printPostIdxImm8s4Operand(MI, 3, O);
11809
10.5k
    return;
11810
0
    break;
11811
12.7k
  case 11:
11812
    // LDRBT_POST_IMM, LDRBT_POST_REG, LDRB_POST_IMM, LDRB_POST_REG, LDRT_POS...
11813
12.7k
    printAddrMode2OffsetOperand(MI, 3, O);
11814
12.7k
    return;
11815
0
    break;
11816
969
  case 12:
11817
    // LDRD, STRD
11818
969
    printAddrMode3Operand_0(MI, 2, O);
11819
969
    return;
11820
0
    break;
11821
4.17k
  case 13:
11822
    // LDRD_POST, STRD_POST, t2LDRD_POST, t2STRD_POST
11823
4.17k
    printAddrMode7Operand(MI, 3, O);
11824
4.17k
    break;
11825
365
  case 14:
11826
    // LDRD_PRE, STRD_PRE
11827
365
    printAddrMode3Operand_1(MI, 3, O);
11828
365
    SStream_concat1(O, '!');
11829
365
    return;
11830
0
    break;
11831
1.34k
  case 15:
11832
    // LDRHTi, LDRSBTi, LDRSHTi, STRHTi
11833
1.34k
    printPostIdxImm8Operand(MI, 3, O);
11834
1.34k
    return;
11835
0
    break;
11836
1.41k
  case 16:
11837
    // LDRHTr, LDRSBTr, LDRSHTr, STRHTr
11838
1.41k
    printPostIdxRegOperand(MI, 3, O);
11839
1.41k
    return;
11840
0
    break;
11841
2.77k
  case 17:
11842
    // LDRH_POST, LDRSB_POST, LDRSH_POST, STRH_POST
11843
2.77k
    printAddrMode3OffsetOperand(MI, 3, O);
11844
2.77k
    return;
11845
0
    break;
11846
786
  case 18:
11847
    // MCRR2
11848
786
    printCImmediate(MI, 4, O);
11849
786
    return;
11850
0
    break;
11851
0
  case 19:
11852
    // MVE_SQRSHRL, MVE_UQRSHLL
11853
0
    printMveSaturateOp(MI, 5, O);
11854
0
    SStream_concat0(O, ", ");
11855
0
    printOperand(MI, 4, O);
11856
0
    return;
11857
0
    break;
11858
0
  case 20:
11859
    // MVE_VMOV_q_rr
11860
0
    printVectorIndex(MI, 5, O);
11861
0
    SStream_concat0(O, ", ");
11862
0
    printOperand(MI, 2, O);
11863
0
    SStream_concat0(O, ", ");
11864
0
    printOperand(MI, 3, O);
11865
0
    return;
11866
0
    break;
11867
1.21k
  case 21:
11868
    // STLEX, STLEXB, STLEXH, STREX, STREXB, STREXH, SWP, SWPB, t2LDAEXD, t2L...
11869
1.21k
    printAddrMode7Operand(MI, 2, O);
11870
1.21k
    return;
11871
0
    break;
11872
502
  case 22:
11873
    // VCADDv2f32, VCADDv4f16, VCADDv4f32, VCADDv8f16
11874
502
    printComplexRotationOp_180_90(MI, 3, O);
11875
502
    return;
11876
0
    break;
11877
463
  case 23:
11878
    // VCMLAv2f32, VCMLAv4f16, VCMLAv4f32, VCMLAv8f16
11879
463
    printComplexRotationOp_90_0(MI, 4, O);
11880
463
    return;
11881
0
    break;
11882
1.58k
  case 24:
11883
    // VLD1LNd16, VLD1LNd32, VLD1LNd8, VST1LNd16_UPD, VST1LNd32_UPD, VST1LNd8...
11884
1.58k
    printAddrMode6Operand(MI, 1, O);
11885
1.58k
    break;
11886
554
  case 25:
11887
    // VLD1LNd16_UPD, VLD1LNd32_UPD, VLD1LNd8_UPD
11888
554
    printAddrMode6Operand(MI, 2, O);
11889
554
    printAddrMode6OffsetOperand(MI, 4, O);
11890
554
    return;
11891
0
    break;
11892
663
  case 26:
11893
    // VLD2LNd16, VLD2LNd32, VLD2LNd8, VLD2LNq16, VLD2LNq32
11894
663
    printOperand(MI, 1, O);
11895
663
    SStream_concat1(O, '[');
11896
663
    printNoHashImmediate(MI, 6, O);
11897
663
    SStream_concat0(O, "]}, ");
11898
663
    printAddrMode6Operand(MI, 2, O);
11899
663
    return;
11900
0
    break;
11901
1.43k
  case 27:
11902
    // VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_UPD, VLD2LNq32_U...
11903
1.43k
    SStream_concat1(O, '[');
11904
1.43k
    printNoHashImmediate(MI, 8, O);
11905
1.43k
    break;
11906
363
  case 28:
11907
    // VLD3DUPd16_UPD, VLD3DUPd32_UPD, VLD3DUPd8_UPD, VLD3DUPq16_UPD, VLD3DUP...
11908
363
    printAddrMode6OffsetOperand(MI, 6, O);
11909
363
    return;
11910
0
    break;
11911
578
  case 29:
11912
    // VLD3LNd16_UPD, VLD3LNd32_UPD, VLD3LNd8_UPD, VLD3LNq16_UPD, VLD3LNq32_U...
11913
578
    printAddrMode6Operand(MI, 4, O);
11914
578
    printAddrMode6OffsetOperand(MI, 6, O);
11915
578
    return;
11916
0
    break;
11917
1.48k
  case 30:
11918
    // VST4d16_UPD, VST4d32_UPD, VST4d8_UPD, VST4q16_UPD, VST4q32_UPD, VST4q8...
11919
1.48k
    printOperand(MI, 7, O);
11920
1.48k
    SStream_concat0(O, "}, ");
11921
1.48k
    printAddrMode6Operand(MI, 1, O);
11922
1.48k
    printAddrMode6OffsetOperand(MI, 3, O);
11923
1.48k
    return;
11924
0
    break;
11925
2.53k
  case 31:
11926
    // t2ADCrs, t2ADDrs, t2ANDrs, t2BICrs, t2EORrs, t2ORNrs, t2ORRrs, t2RSBrs...
11927
2.53k
    printT2SOOperand(MI, 2, O);
11928
2.53k
    return;
11929
0
    break;
11930
483
  case 32:
11931
    // t2ASRri, t2LSRri
11932
483
    printThumbSRImm(MI, 2, O);
11933
483
    return;
11934
0
    break;
11935
409
  case 33:
11936
    // t2BFic, t2CSEL, t2CSINC, t2CSINV, t2CSNEG
11937
409
    printMandatoryPredicateOperand(MI, 3, O);
11938
409
    return;
11939
0
    break;
11940
7.88k
  case 34:
11941
    // t2LDRD_PRE, t2STRD_PRE
11942
7.88k
    printT2AddrModeImm8s4Operand_1(MI, 3, O);
11943
7.88k
    SStream_concat1(O, '!');
11944
7.88k
    return;
11945
0
    break;
11946
684
  case 35:
11947
    // t2LDRDi8, t2STRDi8
11948
684
    printT2AddrModeImm8s4Operand_0(MI, 2, O);
11949
684
    return;
11950
0
    break;
11951
1.23k
  case 36:
11952
    // t2STREX
11953
1.23k
    printT2AddrModeImm0_1020s4Operand(MI, 2, O);
11954
1.23k
    return;
11955
0
    break;
11956
18.2k
  case 37:
11957
    // tADDrSPi
11958
18.2k
    printThumbS4ImmOperand(MI, 2, O);
11959
18.2k
    return;
11960
0
    break;
11961
211k
  }
11962
11963
11964
  // Fragment 7 encoded into 5 bits for 17 unique commands.
11965
110k
  switch ((Bits >> 57) & 31) {
11966
0
  default: CS_ASSERT_RET(0 && "Invalid command number.");
11967
52.6k
  case 0:
11968
    // ASRi, ASRr, LSLi, LSLr, LSRi, LSRr, RORi, RORr, VLD1LNdWB_register_Asm...
11969
52.6k
    return;
11970
0
    break;
11971
30.2k
  case 1:
11972
    // CDE_CX3A, CDE_VCX3A_vec, CDE_VCX3_vec, LDRD_POST, MLA, MLS, MVE_VCADDf...
11973
30.2k
    SStream_concat0(O, ", ");
11974
30.2k
    break;
11975
0
  case 2:
11976
    // CDE_CX3DA
11977
0
    printOperand(MI, 5, O);
11978
0
    return;
11979
0
    break;
11980
6.06k
  case 3:
11981
    // MCR, t2MCR, t2MCR2
11982
6.06k
    printCImmediate(MI, 3, O);
11983
6.06k
    SStream_concat0(O, ", ");
11984
6.06k
    printCImmediate(MI, 4, O);
11985
6.06k
    SStream_concat0(O, ", ");
11986
6.06k
    printOperand(MI, 5, O);
11987
6.06k
    return;
11988
0
    break;
11989
1.50k
  case 4:
11990
    // MCRR, t2MCRR, t2MCRR2
11991
1.50k
    printOperand(MI, 3, O);
11992
1.50k
    SStream_concat0(O, ", ");
11993
1.50k
    printCImmediate(MI, 4, O);
11994
1.50k
    return;
11995
0
    break;
11996
1.53k
  case 5:
11997
    // MVE_VMOV_rr_q, VMULLslsv2i32, VMULLslsv4i16, VMULLsluv2i32, VMULLsluv4...
11998
1.53k
    printVectorIndex(MI, 3, O);
11999
1.53k
    break;
12000
735
  case 6:
12001
    // PKHBT, t2PKHBT
12002
735
    printPKHLSLShiftImm(MI, 3, O);
12003
735
    return;
12004
0
    break;
12005
710
  case 7:
12006
    // PKHTB, t2PKHTB
12007
710
    printPKHASRShiftImm(MI, 3, O);
12008
710
    return;
12009
0
    break;
12010
516
  case 8:
12011
    // SXTAB, SXTAB16, SXTAH, UXTAB, UXTAB16, UXTAH, t2SXTAB, t2SXTAB16, t2SX...
12012
516
    printRotImmOperand(MI, 3, O);
12013
516
    return;
12014
0
    break;
12015
1.17k
  case 9:
12016
    // USAT, t2USAT
12017
1.17k
    printShiftImmOperand(MI, 3, O);
12018
1.17k
    return;
12019
0
    break;
12020
1.03k
  case 10:
12021
    // VLD2LNd16_UPD, VLD2LNd32_UPD, VLD2LNd8_UPD, VLD2LNq16_UPD, VLD2LNq32_U...
12022
1.03k
    SStream_concat0(O, "]}, ");
12023
1.03k
    printAddrMode6Operand(MI, 3, O);
12024
1.03k
    printAddrMode6OffsetOperand(MI, 5, O);
12025
1.03k
    return;
12026
0
    break;
12027
394
  case 11:
12028
    // VLD3LNd16, VLD3LNd32, VLD3LNd8, VLD3LNq16, VLD3LNq32
12029
394
    SStream_concat0(O, "], ");
12030
394
    printOperand(MI, 2, O);
12031
394
    SStream_concat1(O, '[');
12032
394
    printNoHashImmediate(MI, 8, O);
12033
394
    SStream_concat0(O, "]}, ");
12034
394
    printAddrMode6Operand(MI, 3, O);
12035
394
    return;
12036
0
    break;
12037
3.37k
  case 12:
12038
    // VLD3d16, VLD3d16_UPD, VLD3d32, VLD3d32_UPD, VLD3d8, VLD3d8_UPD, VLD3q1...
12039
3.37k
    SStream_concat0(O, "}, ");
12040
3.37k
    break;
12041
5.76k
  case 13:
12042
    // VLD4LNd16, VLD4LNd32, VLD4LNd8, VLD4LNq16, VLD4LNq32, VST2LNd16, VST2L...
12043
5.76k
    SStream_concat1(O, '[');
12044
5.76k
    break;
12045
1.91k
  case 14:
12046
    // VMLALslsv2i32, VMLALslsv4i16, VMLALsluv2i32, VMLALsluv4i16, VMLAslfd, ...
12047
1.91k
    printVectorIndex(MI, 4, O);
12048
1.91k
    return;
12049
0
    break;
12050
1.24k
  case 15:
12051
    // VST1LNd16_UPD, VST1LNd32_UPD, VST1LNd8_UPD
12052
1.24k
    printAddrMode6OffsetOperand(MI, 3, O);
12053
1.24k
    return;
12054
0
    break;
12055
1.88k
  case 16:
12056
    // t2LDRD_POST, t2STRD_POST
12057
1.88k
    printT2AddrModeImm8s4OffsetOperand(MI, 4, O);
12058
1.88k
    return;
12059
0
    break;
12060
110k
  }
12061
12062
40.9k
  switch (MCInst_getOpcode(MI)) {
12063
0
  default: CS_ASSERT_RET(0 && "Unexpected opcode.");
12064
0
  case ARM_CDE_CX3A:
12065
0
  case ARM_CDE_VCX3A_vec:
12066
0
  case ARM_CDE_VCX3_vec:
12067
575
  case ARM_LDRD_POST:
12068
1.24k
  case ARM_MLA:
12069
1.33k
  case ARM_MLS:
12070
1.37k
  case ARM_MVE_VCADDf16:
12071
1.42k
  case ARM_MVE_VCADDf32:
12072
1.63k
  case ARM_MVE_VCADDi16:
12073
1.89k
  case ARM_MVE_VCADDi32:
12074
2.02k
  case ARM_MVE_VCADDi8:
12075
2.08k
  case ARM_MVE_VCMLAf16:
12076
2.27k
  case ARM_MVE_VCMLAf32:
12077
2.37k
  case ARM_MVE_VCMULf16:
12078
2.62k
  case ARM_MVE_VCMULf32:
12079
2.72k
  case ARM_MVE_VDWDUPu16:
12080
3.06k
  case ARM_MVE_VDWDUPu32:
12081
3.32k
  case ARM_MVE_VDWDUPu8:
12082
3.35k
  case ARM_MVE_VHCADDs16:
12083
3.52k
  case ARM_MVE_VHCADDs32:
12084
3.62k
  case ARM_MVE_VHCADDs8:
12085
3.71k
  case ARM_MVE_VIWDUPu16:
12086
4.15k
  case ARM_MVE_VIWDUPu32:
12087
4.25k
  case ARM_MVE_VIWDUPu8:
12088
4.25k
  case ARM_MVE_VMLALDAVas16:
12089
4.25k
  case ARM_MVE_VMLALDAVas32:
12090
4.25k
  case ARM_MVE_VMLALDAVau16:
12091
4.25k
  case ARM_MVE_VMLALDAVau32:
12092
4.39k
  case ARM_MVE_VMLALDAVaxs16:
12093
4.46k
  case ARM_MVE_VMLALDAVaxs32:
12094
4.46k
  case ARM_MVE_VMLALDAVs16:
12095
4.46k
  case ARM_MVE_VMLALDAVs32:
12096
4.46k
  case ARM_MVE_VMLALDAVu16:
12097
4.46k
  case ARM_MVE_VMLALDAVu32:
12098
4.64k
  case ARM_MVE_VMLALDAVxs16:
12099
4.75k
  case ARM_MVE_VMLALDAVxs32:
12100
4.92k
  case ARM_MVE_VMLSLDAVas16:
12101
4.99k
  case ARM_MVE_VMLSLDAVas32:
12102
5.06k
  case ARM_MVE_VMLSLDAVaxs16:
12103
5.17k
  case ARM_MVE_VMLSLDAVaxs32:
12104
5.32k
  case ARM_MVE_VMLSLDAVs16:
12105
5.69k
  case ARM_MVE_VMLSLDAVs32:
12106
5.80k
  case ARM_MVE_VMLSLDAVxs16:
12107
6.47k
  case ARM_MVE_VMLSLDAVxs32:
12108
6.47k
  case ARM_MVE_VRMLALDAVHas32:
12109
6.47k
  case ARM_MVE_VRMLALDAVHau32:
12110
6.81k
  case ARM_MVE_VRMLALDAVHaxs32:
12111
6.81k
  case ARM_MVE_VRMLALDAVHs32:
12112
6.81k
  case ARM_MVE_VRMLALDAVHu32:
12113
6.89k
  case ARM_MVE_VRMLALDAVHxs32:
12114
6.91k
  case ARM_MVE_VRMLSLDAVHas32:
12115
7.01k
  case ARM_MVE_VRMLSLDAVHaxs32:
12116
7.09k
  case ARM_MVE_VRMLSLDAVHs32:
12117
7.56k
  case ARM_MVE_VRMLSLDAVHxs32:
12118
7.74k
  case ARM_SBFX:
12119
8.23k
  case ARM_SMLABB:
12120
8.69k
  case ARM_SMLABT:
12121
9.13k
  case ARM_SMLAD:
12122
9.24k
  case ARM_SMLADX:
12123
9.41k
  case ARM_SMLALBB:
12124
9.78k
  case ARM_SMLALBT:
12125
9.87k
  case ARM_SMLALD:
12126
10.1k
  case ARM_SMLALDX:
12127
10.3k
  case ARM_SMLALTB:
12128
10.4k
  case ARM_SMLALTT:
12129
11.0k
  case ARM_SMLATB:
12130
11.5k
  case ARM_SMLATT:
12131
12.0k
  case ARM_SMLAWB:
12132
12.1k
  case ARM_SMLAWT:
12133
12.3k
  case ARM_SMLSD:
12134
12.4k
  case ARM_SMLSDX:
12135
12.6k
  case ARM_SMLSLD:
12136
12.8k
  case ARM_SMLSLDX:
12137
12.9k
  case ARM_SMMLA:
12138
13.0k
  case ARM_SMMLAR:
12139
13.8k
  case ARM_SMMLS:
12140
13.9k
  case ARM_SMMLSR:
12141
14.1k
  case ARM_SMULL:
12142
15.8k
  case ARM_STRD_POST:
12143
16.0k
  case ARM_UBFX:
12144
16.3k
  case ARM_UMAAL:
12145
16.7k
  case ARM_UMULL:
12146
16.7k
  case ARM_USADA8:
12147
17.0k
  case ARM_VEXTd16:
12148
17.1k
  case ARM_VEXTd32:
12149
17.2k
  case ARM_VEXTd8:
12150
17.5k
  case ARM_VEXTq16:
12151
17.7k
  case ARM_VEXTq32:
12152
17.8k
  case ARM_VEXTq64:
12153
17.9k
  case ARM_VEXTq8:
12154
18.1k
  case ARM_VLD3d16:
12155
18.2k
  case ARM_VLD3d32:
12156
18.3k
  case ARM_VLD3d8:
12157
18.4k
  case ARM_VLD3q16:
12158
18.7k
  case ARM_VLD3q32:
12159
18.9k
  case ARM_VLD3q8:
12160
19.9k
  case ARM_VMOVRRS:
12161
20.4k
  case ARM_VMOVSRR:
12162
20.5k
  case ARM_VST3d16:
12163
20.6k
  case ARM_VST3d32:
12164
20.7k
  case ARM_VST3d8:
12165
20.8k
  case ARM_VST3q16:
12166
20.9k
  case ARM_VST3q32:
12167
21.0k
  case ARM_VST3q8:
12168
21.3k
  case ARM_t2MLA:
12169
21.4k
  case ARM_t2MLS:
12170
21.6k
  case ARM_t2SBFX:
12171
21.8k
  case ARM_t2SMLABB:
12172
21.9k
  case ARM_t2SMLABT:
12173
22.0k
  case ARM_t2SMLAD:
12174
22.4k
  case ARM_t2SMLADX:
12175
22.4k
  case ARM_t2SMLAL:
12176
22.5k
  case ARM_t2SMLALBB:
12177
22.6k
  case ARM_t2SMLALBT:
12178
22.8k
  case ARM_t2SMLALD:
12179
23.0k
  case ARM_t2SMLALDX:
12180
23.1k
  case ARM_t2SMLALTB:
12181
23.2k
  case ARM_t2SMLALTT:
12182
23.4k
  case ARM_t2SMLATB:
12183
23.7k
  case ARM_t2SMLATT:
12184
24.0k
  case ARM_t2SMLAWB:
12185
24.2k
  case ARM_t2SMLAWT:
12186
24.2k
  case ARM_t2SMLSD:
12187
24.3k
  case ARM_t2SMLSDX:
12188
24.6k
  case ARM_t2SMLSLD:
12189
24.7k
  case ARM_t2SMLSLDX:
12190
25.0k
  case ARM_t2SMMLA:
12191
25.4k
  case ARM_t2SMMLAR:
12192
25.5k
  case ARM_t2SMMLS:
12193
25.6k
  case ARM_t2SMMLSR:
12194
25.7k
  case ARM_t2SMULL:
12195
25.8k
  case ARM_t2STLEXD:
12196
25.9k
  case ARM_t2STREXD:
12197
26.2k
  case ARM_t2UBFX:
12198
26.3k
  case ARM_t2UMAAL:
12199
26.5k
  case ARM_t2UMLAL:
12200
26.6k
  case ARM_t2UMULL:
12201
27.1k
  case ARM_t2USADA8:
12202
27.1k
    switch (MCInst_getOpcode(MI)) {
12203
0
    default: CS_ASSERT_RET(0 && "Unexpected opcode.");
12204
0
    case ARM_CDE_CX3A:
12205
0
    case ARM_CDE_VCX3A_vec:
12206
0
    case ARM_MVE_VMLALDAVas16:
12207
0
    case ARM_MVE_VMLALDAVas32:
12208
0
    case ARM_MVE_VMLALDAVau16:
12209
0
    case ARM_MVE_VMLALDAVau32:
12210
149
    case ARM_MVE_VMLALDAVaxs16:
12211
210
    case ARM_MVE_VMLALDAVaxs32:
12212
380
    case ARM_MVE_VMLSLDAVas16:
12213
447
    case ARM_MVE_VMLSLDAVas32:
12214
522
    case ARM_MVE_VMLSLDAVaxs16:
12215
631
    case ARM_MVE_VMLSLDAVaxs32:
12216
631
    case ARM_MVE_VRMLALDAVHas32:
12217
631
    case ARM_MVE_VRMLALDAVHau32:
12218
972
    case ARM_MVE_VRMLALDAVHaxs32:
12219
996
    case ARM_MVE_VRMLSLDAVHas32:
12220
1.09k
    case ARM_MVE_VRMLSLDAVHaxs32:
12221
1.09k
      printOperand(MI, 5, O);
12222
1.09k
      break;
12223
0
    case ARM_CDE_VCX3_vec:
12224
102
    case ARM_MVE_VDWDUPu16:
12225
440
    case ARM_MVE_VDWDUPu32:
12226
709
    case ARM_MVE_VDWDUPu8:
12227
800
    case ARM_MVE_VIWDUPu16:
12228
1.24k
    case ARM_MVE_VIWDUPu32:
12229
1.33k
    case ARM_MVE_VIWDUPu8:
12230
1.33k
      printOperand(MI, 4, O);
12231
1.33k
      break;
12232
575
    case ARM_LDRD_POST:
12233
2.28k
    case ARM_STRD_POST:
12234
2.28k
      printAddrMode3OffsetOperand(MI, 4, O);
12235
2.28k
      break;
12236
672
    case ARM_MLA:
12237
755
    case ARM_MLS:
12238
755
    case ARM_MVE_VMLALDAVs16:
12239
755
    case ARM_MVE_VMLALDAVs32:
12240
755
    case ARM_MVE_VMLALDAVu16:
12241
755
    case ARM_MVE_VMLALDAVu32:
12242
937
    case ARM_MVE_VMLALDAVxs16:
12243
1.04k
    case ARM_MVE_VMLALDAVxs32:
12244
1.19k
    case ARM_MVE_VMLSLDAVs16:
12245
1.56k
    case ARM_MVE_VMLSLDAVs32:
12246
1.67k
    case ARM_MVE_VMLSLDAVxs16:
12247
2.35k
    case ARM_MVE_VMLSLDAVxs32:
12248
2.35k
    case ARM_MVE_VRMLALDAVHs32:
12249
2.35k
    case ARM_MVE_VRMLALDAVHu32:
12250
2.42k
    case ARM_MVE_VRMLALDAVHxs32:
12251
2.50k
    case ARM_MVE_VRMLSLDAVHs32:
12252
2.97k
    case ARM_MVE_VRMLSLDAVHxs32:
12253
3.47k
    case ARM_SMLABB:
12254
3.92k
    case ARM_SMLABT:
12255
4.37k
    case ARM_SMLAD:
12256
4.47k
    case ARM_SMLADX:
12257
4.64k
    case ARM_SMLALBB:
12258
5.01k
    case ARM_SMLALBT:
12259
5.11k
    case ARM_SMLALD:
12260
5.39k
    case ARM_SMLALDX:
12261
5.58k
    case ARM_SMLALTB:
12262
5.68k
    case ARM_SMLALTT:
12263
6.28k
    case ARM_SMLATB:
12264
6.82k
    case ARM_SMLATT:
12265
7.29k
    case ARM_SMLAWB:
12266
7.37k
    case ARM_SMLAWT:
12267
7.53k
    case ARM_SMLSD:
12268
7.64k
    case ARM_SMLSDX:
12269
7.88k
    case ARM_SMLSLD:
12270
8.06k
    case ARM_SMLSLDX:
12271
8.16k
    case ARM_SMMLA:
12272
8.24k
    case ARM_SMMLAR:
12273
9.03k
    case ARM_SMMLS:
12274
9.18k
    case ARM_SMMLSR:
12275
9.34k
    case ARM_SMULL:
12276
9.58k
    case ARM_UMAAL:
12277
9.99k
    case ARM_UMULL:
12278
10.0k
    case ARM_USADA8:
12279
10.2k
    case ARM_VEXTd16:
12280
10.3k
    case ARM_VEXTd32:
12281
10.5k
    case ARM_VEXTd8:
12282
10.8k
    case ARM_VEXTq16:
12283
11.0k
    case ARM_VEXTq32:
12284
11.1k
    case ARM_VEXTq64:
12285
11.2k
    case ARM_VEXTq8:
12286
12.2k
    case ARM_VMOVRRS:
12287
12.7k
    case ARM_VMOVSRR:
12288
13.1k
    case ARM_t2MLA:
12289
13.2k
    case ARM_t2MLS:
12290
13.3k
    case ARM_t2SMLABB:
12291
13.4k
    case ARM_t2SMLABT:
12292
13.5k
    case ARM_t2SMLAD:
12293
13.9k
    case ARM_t2SMLADX:
12294
14.0k
    case ARM_t2SMLAL:
12295
14.0k
    case ARM_t2SMLALBB:
12296
14.1k
    case ARM_t2SMLALBT:
12297
14.3k
    case ARM_t2SMLALD:
12298
14.5k
    case ARM_t2SMLALDX:
12299
14.6k
    case ARM_t2SMLALTB:
12300
14.7k
    case ARM_t2SMLALTT:
12301
15.0k
    case ARM_t2SMLATB:
12302
15.2k
    case ARM_t2SMLATT:
12303
15.6k
    case ARM_t2SMLAWB:
12304
15.7k
    case ARM_t2SMLAWT:
12305
15.7k
    case ARM_t2SMLSD:
12306
15.8k
    case ARM_t2SMLSDX:
12307
16.1k
    case ARM_t2SMLSLD:
12308
16.2k
    case ARM_t2SMLSLDX:
12309
16.5k
    case ARM_t2SMMLA:
12310
16.9k
    case ARM_t2SMMLAR:
12311
17.0k
    case ARM_t2SMMLS:
12312
17.2k
    case ARM_t2SMMLSR:
12313
17.2k
    case ARM_t2SMULL:
12314
17.3k
    case ARM_t2UMAAL:
12315
17.5k
    case ARM_t2UMLAL:
12316
17.6k
    case ARM_t2UMULL:
12317
18.2k
    case ARM_t2USADA8:
12318
18.2k
      printOperand(MI, 3, O);
12319
18.2k
      break;
12320
44
    case ARM_MVE_VCADDf16:
12321
94
    case ARM_MVE_VCADDf32:
12322
306
    case ARM_MVE_VCADDi16:
12323
568
    case ARM_MVE_VCADDi32:
12324
696
    case ARM_MVE_VCADDi8:
12325
718
    case ARM_MVE_VHCADDs16:
12326
893
    case ARM_MVE_VHCADDs32:
12327
991
    case ARM_MVE_VHCADDs8:
12328
991
      printComplexRotationOp_180_90(MI, 3, O);
12329
991
      break;
12330
55
    case ARM_MVE_VCMLAf16:
12331
253
    case ARM_MVE_VCMLAf32:
12332
253
      printComplexRotationOp_90_0(MI, 4, O);
12333
253
      break;
12334
97
    case ARM_MVE_VCMULf16:
12335
341
    case ARM_MVE_VCMULf32:
12336
341
      printComplexRotationOp_90_0(MI, 3, O);
12337
341
      break;
12338
181
    case ARM_SBFX:
12339
454
    case ARM_UBFX:
12340
688
    case ARM_t2SBFX:
12341
969
    case ARM_t2UBFX:
12342
969
      printImmPlusOneOperand(MI, 3, O);
12343
969
      break;
12344
206
    case ARM_VLD3d16:
12345
238
    case ARM_VLD3d32:
12346
389
    case ARM_VLD3d8:
12347
479
    case ARM_VLD3q16:
12348
816
    case ARM_VLD3q32:
12349
936
    case ARM_VLD3q8:
12350
936
      printAddrMode6Operand(MI, 3, O);
12351
936
      break;
12352
96
    case ARM_VST3d16:
12353
198
    case ARM_VST3d32:
12354
255
    case ARM_VST3d8:
12355
357
    case ARM_VST3q16:
12356
464
    case ARM_VST3q32:
12357
541
    case ARM_VST3q8:
12358
541
      printAddrMode6Operand(MI, 0, O);
12359
541
      break;
12360
105
    case ARM_t2STLEXD:
12361
206
    case ARM_t2STREXD:
12362
206
      printAddrMode7Operand(MI, 3, O);
12363
206
      break;
12364
27.1k
    }
12365
27.1k
    return;
12366
27.1k
    break;
12367
27.1k
  case ARM_MVE_VMOV_rr_q:
12368
0
    SStream_concat0(O, ", ");
12369
0
    printOperand(MI, 2, O);
12370
0
    printVectorIndex(MI, 4, O);
12371
0
    return;
12372
0
    break;
12373
313
  case ARM_VLD3d16_UPD:
12374
586
  case ARM_VLD3d32_UPD:
12375
1.02k
  case ARM_VLD3d8_UPD:
12376
1.28k
  case ARM_VLD3q16_UPD:
12377
1.48k
  case ARM_VLD3q32_UPD:
12378
1.90k
  case ARM_VLD3q8_UPD:
12379
1.90k
    printAddrMode6Operand(MI, 4, O);
12380
1.90k
    printAddrMode6OffsetOperand(MI, 6, O);
12381
1.90k
    return;
12382
0
    break;
12383
96
  case ARM_VLD4LNd16:
12384
263
  case ARM_VLD4LNd32:
12385
426
  case ARM_VLD4LNd8:
12386
562
  case ARM_VLD4LNq16:
12387
884
  case ARM_VLD4LNq32:
12388
884
    printNoHashImmediate(MI, 10, O);
12389
884
    SStream_concat0(O, "]}, ");
12390
884
    printAddrMode6Operand(MI, 4, O);
12391
884
    return;
12392
0
    break;
12393
47
  case ARM_VLD4d16:
12394
452
  case ARM_VLD4d32:
12395
564
  case ARM_VLD4d8:
12396
605
  case ARM_VLD4q16:
12397
691
  case ARM_VLD4q32:
12398
828
  case ARM_VLD4q8:
12399
828
    printOperand(MI, 3, O);
12400
828
    SStream_concat0(O, "}, ");
12401
828
    printAddrMode6Operand(MI, 4, O);
12402
828
    return;
12403
0
    break;
12404
565
  case ARM_VLD4d16_UPD:
12405
891
  case ARM_VLD4d32_UPD:
12406
1.15k
  case ARM_VLD4d8_UPD:
12407
1.55k
  case ARM_VLD4q16_UPD:
12408
1.66k
  case ARM_VLD4q32_UPD:
12409
1.80k
  case ARM_VLD4q8_UPD:
12410
1.80k
    printOperand(MI, 3, O);
12411
1.80k
    SStream_concat0(O, "}, ");
12412
1.80k
    printAddrMode6Operand(MI, 5, O);
12413
1.80k
    printAddrMode6OffsetOperand(MI, 7, O);
12414
1.80k
    return;
12415
0
    break;
12416
209
  case ARM_VMULLslsv2i32:
12417
213
  case ARM_VMULLslsv4i16:
12418
218
  case ARM_VMULLsluv2i32:
12419
220
  case ARM_VMULLsluv4i16:
12420
525
  case ARM_VMULslfd:
12421
526
  case ARM_VMULslfq:
12422
527
  case ARM_VMULslhd:
12423
958
  case ARM_VMULslhq:
12424
963
  case ARM_VMULslv2i32:
12425
965
  case ARM_VMULslv4i16:
12426
989
  case ARM_VMULslv4i32:
12427
1.02k
  case ARM_VMULslv8i16:
12428
1.04k
  case ARM_VQDMULHslv2i32:
12429
1.04k
  case ARM_VQDMULHslv4i16:
12430
1.04k
  case ARM_VQDMULHslv4i32:
12431
1.04k
  case ARM_VQDMULHslv8i16:
12432
1.04k
  case ARM_VQDMULLslv2i32:
12433
1.04k
  case ARM_VQDMULLslv4i16:
12434
1.07k
  case ARM_VQRDMULHslv2i32:
12435
1.25k
  case ARM_VQRDMULHslv4i16:
12436
1.45k
  case ARM_VQRDMULHslv4i32:
12437
1.53k
  case ARM_VQRDMULHslv8i16:
12438
1.53k
    return;
12439
0
    break;
12440
109
  case ARM_VST2LNd16:
12441
239
  case ARM_VST2LNd32:
12442
604
  case ARM_VST2LNd8:
12443
834
  case ARM_VST2LNq16:
12444
951
  case ARM_VST2LNq32:
12445
951
    printNoHashImmediate(MI, 4, O);
12446
951
    SStream_concat0(O, "]}, ");
12447
951
    printAddrMode6Operand(MI, 0, O);
12448
951
    return;
12449
0
    break;
12450
465
  case ARM_VST2LNd16_UPD:
12451
1.14k
  case ARM_VST2LNd32_UPD:
12452
1.99k
  case ARM_VST2LNd8_UPD:
12453
2.12k
  case ARM_VST2LNq16_UPD:
12454
2.26k
  case ARM_VST2LNq32_UPD:
12455
2.26k
    printNoHashImmediate(MI, 6, O);
12456
2.26k
    SStream_concat0(O, "]}, ");
12457
2.26k
    printAddrMode6Operand(MI, 1, O);
12458
2.26k
    printAddrMode6OffsetOperand(MI, 3, O);
12459
2.26k
    return;
12460
0
    break;
12461
72
  case ARM_VST3LNd16:
12462
209
  case ARM_VST3LNd32:
12463
249
  case ARM_VST3LNd8:
12464
420
  case ARM_VST3LNq16:
12465
609
  case ARM_VST3LNq32:
12466
609
    printNoHashImmediate(MI, 5, O);
12467
609
    SStream_concat0(O, "], ");
12468
609
    printOperand(MI, 4, O);
12469
609
    SStream_concat1(O, '[');
12470
609
    printNoHashImmediate(MI, 5, O);
12471
609
    SStream_concat0(O, "]}, ");
12472
609
    printAddrMode6Operand(MI, 0, O);
12473
609
    return;
12474
0
    break;
12475
35
  case ARM_VST4LNd16:
12476
95
  case ARM_VST4LNd32:
12477
214
  case ARM_VST4LNd8:
12478
293
  case ARM_VST4LNq16:
12479
1.05k
  case ARM_VST4LNq32:
12480
1.05k
    printNoHashImmediate(MI, 6, O);
12481
1.05k
    SStream_concat0(O, "], ");
12482
1.05k
    printOperand(MI, 4, O);
12483
1.05k
    SStream_concat1(O, '[');
12484
1.05k
    printNoHashImmediate(MI, 6, O);
12485
1.05k
    SStream_concat0(O, "], ");
12486
1.05k
    printOperand(MI, 5, O);
12487
1.05k
    SStream_concat1(O, '[');
12488
1.05k
    printNoHashImmediate(MI, 6, O);
12489
1.05k
    SStream_concat0(O, "]}, ");
12490
1.05k
    printAddrMode6Operand(MI, 0, O);
12491
1.05k
    return;
12492
0
    break;
12493
423
  case ARM_VST4d16:
12494
569
  case ARM_VST4d32:
12495
760
  case ARM_VST4d8:
12496
1.42k
  case ARM_VST4q16:
12497
1.59k
  case ARM_VST4q32:
12498
1.90k
  case ARM_VST4q8:
12499
1.90k
    printOperand(MI, 5, O);
12500
1.90k
    SStream_concat0(O, "}, ");
12501
1.90k
    printAddrMode6Operand(MI, 0, O);
12502
1.90k
    return;
12503
0
    break;
12504
40.9k
  }
12505
40.9k
}
12506
12507
12508
/// getRegisterName - This method is automatically generated by tblgen
12509
/// from the register set description.  This returns the assembler name
12510
/// for the specified register.
12511
static const char *
12512
4.67M
getRegisterName(unsigned RegNo, unsigned AltIdx) {
12513
4.67M
#ifndef CAPSTONE_DIET
12514
4.67M
  CS_ASSERT_RET_VAL(RegNo && RegNo < 296 && "Invalid register number!", NULL);
12515
12516
4.67M
  static const char AsmStrsNoRegAltName[] = {
12517
4.67M
  /* 0 */ "D4_D6_D8_D10\0"
12518
4.67M
  /* 13 */ "D7_D8_D9_D10\0"
12519
4.67M
  /* 26 */ "Q7_Q8_Q9_Q10\0"
12520
4.67M
  /* 39 */ "d10\0"
12521
4.67M
  /* 43 */ "q10\0"
12522
4.67M
  /* 47 */ "r10\0"
12523
4.67M
  /* 51 */ "s10\0"
12524
4.67M
  /* 55 */ "D14_D16_D18_D20\0"
12525
4.67M
  /* 71 */ "D17_D18_D19_D20\0"
12526
4.67M
  /* 87 */ "d20\0"
12527
4.67M
  /* 91 */ "s20\0"
12528
4.67M
  /* 95 */ "D24_D26_D28_D30\0"
12529
4.67M
  /* 111 */ "D27_D28_D29_D30\0"
12530
4.67M
  /* 127 */ "d30\0"
12531
4.67M
  /* 131 */ "s30\0"
12532
4.67M
  /* 135 */ "d0\0"
12533
4.67M
  /* 138 */ "p0\0"
12534
4.67M
  /* 141 */ "q0\0"
12535
4.67M
  /* 144 */ "mvfr0\0"
12536
4.67M
  /* 150 */ "s0\0"
12537
4.67M
  /* 153 */ "D9_D10_D11\0"
12538
4.67M
  /* 164 */ "D5_D7_D9_D11\0"
12539
4.67M
  /* 177 */ "Q8_Q9_Q10_Q11\0"
12540
4.67M
  /* 191 */ "R10_R11\0"
12541
4.67M
  /* 199 */ "d11\0"
12542
4.67M
  /* 203 */ "q11\0"
12543
4.67M
  /* 207 */ "r11\0"
12544
4.67M
  /* 211 */ "s11\0"
12545
4.67M
  /* 215 */ "D19_D20_D21\0"
12546
4.67M
  /* 227 */ "D15_D17_D19_D21\0"
12547
4.67M
  /* 243 */ "d21\0"
12548
4.67M
  /* 247 */ "s21\0"
12549
4.67M
  /* 251 */ "D29_D30_D31\0"
12550
4.67M
  /* 263 */ "D25_D27_D29_D31\0"
12551
4.67M
  /* 279 */ "d31\0"
12552
4.67M
  /* 283 */ "s31\0"
12553
4.67M
  /* 287 */ "Q0_Q1\0"
12554
4.67M
  /* 293 */ "R0_R1\0"
12555
4.67M
  /* 299 */ "d1\0"
12556
4.67M
  /* 302 */ "q1\0"
12557
4.67M
  /* 305 */ "mvfr1\0"
12558
4.67M
  /* 311 */ "s1\0"
12559
4.67M
  /* 314 */ "D6_D8_D10_D12\0"
12560
4.67M
  /* 328 */ "D9_D10_D11_D12\0"
12561
4.67M
  /* 343 */ "Q9_Q10_Q11_Q12\0"
12562
4.67M
  /* 358 */ "d12\0"
12563
4.67M
  /* 362 */ "q12\0"
12564
4.67M
  /* 366 */ "r12\0"
12565
4.67M
  /* 370 */ "s12\0"
12566
4.67M
  /* 374 */ "D16_D18_D20_D22\0"
12567
4.67M
  /* 390 */ "D19_D20_D21_D22\0"
12568
4.67M
  /* 406 */ "d22\0"
12569
4.67M
  /* 410 */ "s22\0"
12570
4.67M
  /* 414 */ "D0_D2\0"
12571
4.67M
  /* 420 */ "D0_D1_D2\0"
12572
4.67M
  /* 429 */ "Q1_Q2\0"
12573
4.67M
  /* 435 */ "d2\0"
12574
4.67M
  /* 438 */ "q2\0"
12575
4.67M
  /* 441 */ "mvfr2\0"
12576
4.67M
  /* 447 */ "s2\0"
12577
4.67M
  /* 450 */ "fpinst2\0"
12578
4.67M
  /* 458 */ "D7_D9_D11_D13\0"
12579
4.67M
  /* 472 */ "D11_D12_D13\0"
12580
4.67M
  /* 484 */ "Q10_Q11_Q12_Q13\0"
12581
4.67M
  /* 500 */ "d13\0"
12582
4.67M
  /* 504 */ "q13\0"
12583
4.67M
  /* 508 */ "s13\0"
12584
4.67M
  /* 512 */ "D17_D19_D21_D23\0"
12585
4.67M
  /* 528 */ "D21_D22_D23\0"
12586
4.67M
  /* 540 */ "d23\0"
12587
4.67M
  /* 544 */ "s23\0"
12588
4.67M
  /* 548 */ "D1_D3\0"
12589
4.67M
  /* 554 */ "D1_D2_D3\0"
12590
4.67M
  /* 563 */ "Q0_Q1_Q2_Q3\0"
12591
4.67M
  /* 575 */ "R2_R3\0"
12592
4.67M
  /* 581 */ "d3\0"
12593
4.67M
  /* 584 */ "q3\0"
12594
4.67M
  /* 587 */ "r3\0"
12595
4.67M
  /* 590 */ "s3\0"
12596
4.67M
  /* 593 */ "D8_D10_D12_D14\0"
12597
4.67M
  /* 608 */ "D11_D12_D13_D14\0"
12598
4.67M
  /* 624 */ "Q11_Q12_Q13_Q14\0"
12599
4.67M
  /* 640 */ "d14\0"
12600
4.67M
  /* 644 */ "q14\0"
12601
4.67M
  /* 648 */ "s14\0"
12602
4.67M
  /* 652 */ "D18_D20_D22_D24\0"
12603
4.67M
  /* 668 */ "D21_D22_D23_D24\0"
12604
4.67M
  /* 684 */ "d24\0"
12605
4.67M
  /* 688 */ "s24\0"
12606
4.67M
  /* 692 */ "D0_D2_D4\0"
12607
4.67M
  /* 701 */ "D1_D2_D3_D4\0"
12608
4.67M
  /* 713 */ "Q1_Q2_Q3_Q4\0"
12609
4.67M
  /* 725 */ "d4\0"
12610
4.67M
  /* 728 */ "q4\0"
12611
4.67M
  /* 731 */ "r4\0"
12612
4.67M
  /* 734 */ "s4\0"
12613
4.67M
  /* 737 */ "D9_D11_D13_D15\0"
12614
4.67M
  /* 752 */ "D13_D14_D15\0"
12615
4.67M
  /* 764 */ "Q12_Q13_Q14_Q15\0"
12616
4.67M
  /* 780 */ "d15\0"
12617
4.67M
  /* 784 */ "q15\0"
12618
4.67M
  /* 788 */ "s15\0"
12619
4.67M
  /* 792 */ "D19_D21_D23_D25\0"
12620
4.67M
  /* 808 */ "D23_D24_D25\0"
12621
4.67M
  /* 820 */ "d25\0"
12622
4.67M
  /* 824 */ "s25\0"
12623
4.67M
  /* 828 */ "D1_D3_D5\0"
12624
4.67M
  /* 837 */ "D3_D4_D5\0"
12625
4.67M
  /* 846 */ "Q2_Q3_Q4_Q5\0"
12626
4.67M
  /* 858 */ "R4_R5\0"
12627
4.67M
  /* 864 */ "d5\0"
12628
4.67M
  /* 867 */ "q5\0"
12629
4.67M
  /* 870 */ "r5\0"
12630
4.67M
  /* 873 */ "s5\0"
12631
4.67M
  /* 876 */ "D10_D12_D14_D16\0"
12632
4.67M
  /* 892 */ "D13_D14_D15_D16\0"
12633
4.67M
  /* 908 */ "d16\0"
12634
4.67M
  /* 912 */ "s16\0"
12635
4.67M
  /* 916 */ "D20_D22_D24_D26\0"
12636
4.67M
  /* 932 */ "D23_D24_D25_D26\0"
12637
4.67M
  /* 948 */ "d26\0"
12638
4.67M
  /* 952 */ "s26\0"
12639
4.67M
  /* 956 */ "D0_D2_D4_D6\0"
12640
4.67M
  /* 968 */ "D3_D4_D5_D6\0"
12641
4.67M
  /* 980 */ "Q3_Q4_Q5_Q6\0"
12642
4.67M
  /* 992 */ "d6\0"
12643
4.67M
  /* 995 */ "q6\0"
12644
4.67M
  /* 998 */ "r6\0"
12645
4.67M
  /* 1001 */ "s6\0"
12646
4.67M
  /* 1004 */ "D11_D13_D15_D17\0"
12647
4.67M
  /* 1020 */ "D15_D16_D17\0"
12648
4.67M
  /* 1032 */ "d17\0"
12649
4.67M
  /* 1036 */ "s17\0"
12650
4.67M
  /* 1040 */ "D21_D23_D25_D27\0"
12651
4.67M
  /* 1056 */ "D25_D26_D27\0"
12652
4.67M
  /* 1068 */ "d27\0"
12653
4.67M
  /* 1072 */ "s27\0"
12654
4.67M
  /* 1076 */ "D1_D3_D5_D7\0"
12655
4.67M
  /* 1088 */ "D5_D6_D7\0"
12656
4.67M
  /* 1097 */ "Q4_Q5_Q6_Q7\0"
12657
4.67M
  /* 1109 */ "R6_R7\0"
12658
4.67M
  /* 1115 */ "d7\0"
12659
4.67M
  /* 1118 */ "q7\0"
12660
4.67M
  /* 1121 */ "r7\0"
12661
4.67M
  /* 1124 */ "s7\0"
12662
4.67M
  /* 1127 */ "D12_D14_D16_D18\0"
12663
4.67M
  /* 1143 */ "D15_D16_D17_D18\0"
12664
4.67M
  /* 1159 */ "d18\0"
12665
4.67M
  /* 1163 */ "s18\0"
12666
4.67M
  /* 1167 */ "D22_D24_D26_D28\0"
12667
4.67M
  /* 1183 */ "D25_D26_D27_D28\0"
12668
4.67M
  /* 1199 */ "d28\0"
12669
4.67M
  /* 1203 */ "s28\0"
12670
4.67M
  /* 1207 */ "D2_D4_D6_D8\0"
12671
4.67M
  /* 1219 */ "D5_D6_D7_D8\0"
12672
4.67M
  /* 1231 */ "Q5_Q6_Q7_Q8\0"
12673
4.67M
  /* 1243 */ "d8\0"
12674
4.67M
  /* 1246 */ "q8\0"
12675
4.67M
  /* 1249 */ "r8\0"
12676
4.67M
  /* 1252 */ "s8\0"
12677
4.67M
  /* 1255 */ "D13_D15_D17_D19\0"
12678
4.67M
  /* 1271 */ "D17_D18_D19\0"
12679
4.67M
  /* 1283 */ "d19\0"
12680
4.67M
  /* 1287 */ "s19\0"
12681
4.67M
  /* 1291 */ "D23_D25_D27_D29\0"
12682
4.67M
  /* 1307 */ "D27_D28_D29\0"
12683
4.67M
  /* 1319 */ "d29\0"
12684
4.67M
  /* 1323 */ "s29\0"
12685
4.67M
  /* 1327 */ "D3_D5_D7_D9\0"
12686
4.67M
  /* 1339 */ "D7_D8_D9\0"
12687
4.67M
  /* 1348 */ "Q6_Q7_Q8_Q9\0"
12688
4.67M
  /* 1360 */ "R8_R9\0"
12689
4.67M
  /* 1366 */ "d9\0"
12690
4.67M
  /* 1369 */ "q9\0"
12691
4.67M
  /* 1372 */ "r9\0"
12692
4.67M
  /* 1375 */ "s9\0"
12693
4.67M
  /* 1378 */ "R12_SP\0"
12694
4.67M
  /* 1385 */ "pc\0"
12695
4.67M
  /* 1388 */ "fpscr_nzcvqc\0"
12696
4.67M
  /* 1401 */ "fpexc\0"
12697
4.67M
  /* 1407 */ "fpsid\0"
12698
4.67M
  /* 1413 */ "ra_auth_code\0"
12699
4.67M
  /* 1426 */ "itstate\0"
12700
4.67M
  /* 1434 */ "sp\0"
12701
4.67M
  /* 1437 */ "fpscr\0"
12702
4.67M
  /* 1443 */ "lr\0"
12703
4.67M
  /* 1446 */ "vpr\0"
12704
4.67M
  /* 1450 */ "apsr\0"
12705
4.67M
  /* 1455 */ "cpsr\0"
12706
4.67M
  /* 1460 */ "spsr\0"
12707
4.67M
  /* 1465 */ "zr\0"
12708
4.67M
  /* 1468 */ "fpcxtns\0"
12709
4.67M
  /* 1476 */ "fpcxts\0"
12710
4.67M
  /* 1483 */ "fpinst\0"
12711
4.67M
  /* 1490 */ "fpscr_nzcv\0"
12712
4.67M
  /* 1501 */ "apsr_nzcv\0"
12713
4.67M
};
12714
4.67M
  static const uint16_t RegAsmOffsetNoRegAltName[] = {
12715
4.67M
    1450, 1501, 1455, 1468, 1476, 1401, 1483, 1437, 1490, 1388, 1407, 1426, 1443, 1385, 
12716
4.67M
    1413, 1434, 1460, 1446, 1465, 135, 299, 435, 581, 725, 864, 992, 1115, 1243, 
12717
4.67M
    1366, 39, 199, 358, 500, 640, 780, 908, 1032, 1159, 1283, 87, 243, 406, 
12718
4.67M
    540, 684, 820, 948, 1068, 1199, 1319, 127, 279, 450, 144, 305, 441, 138, 
12719
4.67M
    141, 302, 438, 584, 728, 867, 995, 1118, 1246, 1369, 43, 203, 362, 504, 
12720
4.67M
    644, 784, 147, 308, 444, 587, 731, 870, 998, 1121, 1249, 1372, 47, 207, 
12721
4.67M
    366, 150, 311, 447, 590, 734, 873, 1001, 1124, 1252, 1375, 51, 211, 370, 
12722
4.67M
    508, 648, 788, 912, 1036, 1163, 1287, 91, 247, 410, 544, 688, 824, 952, 
12723
4.67M
    1072, 1203, 1323, 131, 283, 414, 548, 695, 831, 962, 1082, 1213, 1333, 6, 
12724
4.67M
    170, 320, 464, 600, 744, 884, 1012, 1135, 1263, 63, 235, 382, 520, 660, 
12725
4.67M
    800, 924, 1048, 1175, 1299, 103, 271, 287, 429, 569, 719, 852, 986, 1103, 
12726
4.67M
    1237, 1354, 32, 183, 350, 492, 632, 772, 563, 713, 846, 980, 1097, 1231, 
12727
4.67M
    1348, 26, 177, 343, 484, 624, 764, 293, 575, 858, 1109, 1360, 191, 1378, 
12728
4.67M
    420, 554, 704, 837, 971, 1088, 1222, 1339, 16, 153, 331, 472, 612, 752, 
12729
4.67M
    896, 1020, 1147, 1271, 75, 215, 394, 528, 672, 808, 936, 1056, 1187, 1307, 
12730
4.67M
    115, 251, 692, 828, 959, 1079, 1210, 1330, 3, 167, 317, 461, 596, 740, 
12731
4.67M
    880, 1008, 1131, 1259, 59, 231, 378, 516, 656, 796, 920, 1044, 1171, 1295, 
12732
4.67M
    99, 267, 956, 1076, 1207, 1327, 0, 164, 314, 458, 593, 737, 876, 1004, 
12733
4.67M
    1127, 1255, 55, 227, 374, 512, 652, 792, 916, 1040, 1167, 1291, 95, 263, 
12734
4.67M
    423, 707, 974, 1225, 19, 335, 616, 900, 1151, 79, 398, 676, 940, 1191, 
12735
4.67M
    119, 701, 968, 1219, 13, 328, 608, 892, 1143, 71, 390, 668, 932, 1183, 
12736
4.67M
    111, 
12737
4.67M
  };
12738
12739
4.67M
  static const char AsmStrsRegNamesRaw[] = {
12740
4.67M
  /* 0 */ "r13\0"
12741
4.67M
  /* 4 */ "r14\0"
12742
4.67M
  /* 8 */ "r15\0"
12743
4.67M
};
12744
4.67M
  static const uint8_t RegAsmOffsetRegNamesRaw[] = {
12745
4.67M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 4, 8, 
12746
4.67M
    3, 0, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12747
4.67M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12748
4.67M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12749
4.67M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12750
4.67M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12751
4.67M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12752
4.67M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12753
4.67M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12754
4.67M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12755
4.67M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12756
4.67M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12757
4.67M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12758
4.67M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12759
4.67M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12760
4.67M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12761
4.67M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12762
4.67M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12763
4.67M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12764
4.67M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12765
4.67M
    3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 3, 
12766
4.67M
    3, 
12767
4.67M
  };
12768
12769
4.67M
  switch(AltIdx) {
12770
0
  default: CS_ASSERT_RET_VAL(0 && "Invalid register alt name index!", NULL);
12771
3.73M
  case ARM_NoRegAltName:
12772
3.73M
    CS_ASSERT_RET_VAL(*(AsmStrsNoRegAltName+RegAsmOffsetNoRegAltName[RegNo-1]) &&
12773
3.73M
           "Invalid alt name index for register!", NULL);
12774
3.73M
    return AsmStrsNoRegAltName+RegAsmOffsetNoRegAltName[RegNo-1];
12775
939k
  case ARM_RegNamesRaw:
12776
939k
    if (!*(AsmStrsRegNamesRaw+RegAsmOffsetRegNamesRaw[RegNo-1]))
12777
851k
      return getRegisterName(RegNo, ARM_NoRegAltName);
12778
88.1k
    return AsmStrsRegNamesRaw+RegAsmOffsetRegNamesRaw[RegNo-1];
12779
4.67M
  }
12780
#else
12781
  return NULL;
12782
#endif // CAPSTONE_DIET
12783
4.67M
}
12784
#ifdef PRINT_ALIAS_INSTR
12785
#undef PRINT_ALIAS_INSTR
12786
12787
1.41M
static bool printAliasInstr(MCInst *MI, uint64_t Address, SStream *OS) {
12788
1.41M
#ifndef CAPSTONE_DIET
12789
1.41M
  static const PatternsForOpcode OpToPatterns[] = {
12790
1.41M
    {ARM_DSB, 0, 3 },
12791
1.41M
    {ARM_HINT, 3, 9 },
12792
1.41M
    {ARM_MVE_VMLADAVas16, 12, 1 },
12793
1.41M
    {ARM_MVE_VMLADAVas32, 13, 1 },
12794
1.41M
    {ARM_MVE_VMLADAVas8, 14, 1 },
12795
1.41M
    {ARM_MVE_VMLADAVau16, 15, 1 },
12796
1.41M
    {ARM_MVE_VMLADAVau32, 16, 1 },
12797
1.41M
    {ARM_MVE_VMLADAVau8, 17, 1 },
12798
1.41M
    {ARM_MVE_VMLADAVs16, 18, 1 },
12799
1.41M
    {ARM_MVE_VMLADAVs32, 19, 1 },
12800
1.41M
    {ARM_MVE_VMLADAVs8, 20, 1 },
12801
1.41M
    {ARM_MVE_VMLADAVu16, 21, 1 },
12802
1.41M
    {ARM_MVE_VMLADAVu32, 22, 1 },
12803
1.41M
    {ARM_MVE_VMLADAVu8, 23, 1 },
12804
1.41M
    {ARM_MVE_VMLALDAVas16, 24, 1 },
12805
1.41M
    {ARM_MVE_VMLALDAVas32, 25, 1 },
12806
1.41M
    {ARM_MVE_VMLALDAVau16, 26, 1 },
12807
1.41M
    {ARM_MVE_VMLALDAVau32, 27, 1 },
12808
1.41M
    {ARM_MVE_VMLALDAVs16, 28, 1 },
12809
1.41M
    {ARM_MVE_VMLALDAVs32, 29, 1 },
12810
1.41M
    {ARM_MVE_VMLALDAVu16, 30, 1 },
12811
1.41M
    {ARM_MVE_VMLALDAVu32, 31, 1 },
12812
1.41M
    {ARM_MVE_VORR, 32, 1 },
12813
1.41M
    {ARM_MVE_VRMLALDAVHas32, 33, 1 },
12814
1.41M
    {ARM_MVE_VRMLALDAVHau32, 34, 1 },
12815
1.41M
    {ARM_MVE_VRMLALDAVHs32, 35, 1 },
12816
1.41M
    {ARM_MVE_VRMLALDAVHu32, 36, 1 },
12817
1.41M
    {ARM_t2CSINC, 37, 2 },
12818
1.41M
    {ARM_t2CSINV, 39, 2 },
12819
1.41M
    {ARM_t2CSNEG, 41, 1 },
12820
1.41M
    {ARM_t2DSB, 42, 3 },
12821
1.41M
    {ARM_t2HINT, 45, 13 },
12822
1.41M
    {ARM_t2SUBS_PC_LR, 58, 1 },
12823
1.41M
    {ARM_tHINT, 59, 6 },
12824
1.41M
  {0},  };
12825
12826
1.41M
  static const AliasPattern Patterns[] = {
12827
    // ARM_DSB - 0
12828
1.41M
    {0, 0, 1, 3 },
12829
1.41M
    {5, 3, 1, 3 },
12830
1.41M
    {11, 6, 1, 3 },
12831
    // ARM_HINT - 3
12832
1.41M
    {15, 9, 3, 3 },
12833
1.41M
    {23, 12, 3, 3 },
12834
1.41M
    {33, 15, 3, 3 },
12835
1.41M
    {41, 18, 3, 3 },
12836
1.41M
    {49, 21, 3, 3 },
12837
1.41M
    {57, 24, 3, 3 },
12838
1.41M
    {66, 27, 3, 3 },
12839
1.41M
    {74, 30, 3, 3 },
12840
1.41M
    {83, 33, 3, 4 },
12841
    // ARM_MVE_VMLADAVas16 - 12
12842
1.41M
    {94, 37, 7, 6 },
12843
    // ARM_MVE_VMLADAVas32 - 13
12844
1.41M
    {120, 43, 7, 6 },
12845
    // ARM_MVE_VMLADAVas8 - 14
12846
1.41M
    {146, 49, 7, 6 },
12847
    // ARM_MVE_VMLADAVau16 - 15
12848
1.41M
    {171, 55, 7, 6 },
12849
    // ARM_MVE_VMLADAVau32 - 16
12850
1.41M
    {197, 61, 7, 6 },
12851
    // ARM_MVE_VMLADAVau8 - 17
12852
1.41M
    {223, 67, 7, 6 },
12853
    // ARM_MVE_VMLADAVs16 - 18
12854
1.41M
    {248, 73, 6, 5 },
12855
    // ARM_MVE_VMLADAVs32 - 19
12856
1.41M
    {273, 78, 6, 5 },
12857
    // ARM_MVE_VMLADAVs8 - 20
12858
1.41M
    {298, 83, 6, 5 },
12859
    // ARM_MVE_VMLADAVu16 - 21
12860
1.41M
    {322, 88, 6, 5 },
12861
    // ARM_MVE_VMLADAVu32 - 22
12862
1.41M
    {347, 93, 6, 5 },
12863
    // ARM_MVE_VMLADAVu8 - 23
12864
1.41M
    {372, 98, 6, 5 },
12865
    // ARM_MVE_VMLALDAVas16 - 24
12866
1.41M
    {396, 103, 9, 8 },
12867
    // ARM_MVE_VMLALDAVas32 - 25
12868
1.41M
    {427, 111, 9, 8 },
12869
    // ARM_MVE_VMLALDAVau16 - 26
12870
1.41M
    {458, 119, 9, 8 },
12871
    // ARM_MVE_VMLALDAVau32 - 27
12872
1.41M
    {489, 127, 9, 8 },
12873
    // ARM_MVE_VMLALDAVs16 - 28
12874
1.41M
    {520, 135, 7, 6 },
12875
    // ARM_MVE_VMLALDAVs32 - 29
12876
1.41M
    {550, 141, 7, 6 },
12877
    // ARM_MVE_VMLALDAVu16 - 30
12878
1.41M
    {580, 147, 7, 6 },
12879
    // ARM_MVE_VMLALDAVu32 - 31
12880
1.41M
    {610, 153, 7, 6 },
12881
    // ARM_MVE_VORR - 32
12882
1.41M
    {640, 159, 7, 5 },
12883
    // ARM_MVE_VRMLALDAVHas32 - 33
12884
1.41M
    {656, 164, 9, 8 },
12885
    // ARM_MVE_VRMLALDAVHau32 - 34
12886
1.41M
    {689, 172, 9, 8 },
12887
    // ARM_MVE_VRMLALDAVHs32 - 35
12888
1.41M
    {722, 180, 7, 6 },
12889
    // ARM_MVE_VRMLALDAVHu32 - 36
12890
1.41M
    {754, 186, 7, 6 },
12891
    // ARM_t2CSINC - 37
12892
1.41M
    {786, 192, 4, 4 },
12893
1.41M
    {800, 196, 4, 4 },
12894
    // ARM_t2CSINV - 39
12895
1.41M
    {818, 200, 4, 4 },
12896
1.41M
    {833, 204, 4, 4 },
12897
    // ARM_t2CSNEG - 41
12898
1.41M
    {851, 208, 4, 4 },
12899
    // ARM_t2DSB - 42
12900
1.41M
    {0, 212, 3, 6 },
12901
1.41M
    {5, 218, 3, 6 },
12902
1.41M
    {869, 224, 3, 2 },
12903
    // ARM_t2HINT - 45
12904
1.41M
    {877, 226, 3, 3 },
12905
1.41M
    {887, 229, 3, 3 },
12906
1.41M
    {899, 232, 3, 3 },
12907
1.41M
    {909, 235, 3, 3 },
12908
1.41M
    {919, 238, 3, 3 },
12909
1.41M
    {929, 241, 3, 4 },
12910
1.41M
    {940, 245, 3, 4 },
12911
1.41M
    {74, 249, 3, 3 },
12912
1.41M
    {950, 252, 3, 3 },
12913
1.41M
    {971, 255, 3, 3 },
12914
1.41M
    {979, 258, 3, 3 },
12915
1.41M
    {997, 261, 3, 3 },
12916
1.41M
    {83, 264, 3, 5 },
12917
    // ARM_t2SUBS_PC_LR - 58
12918
1.41M
    {1015, 269, 3, 4 },
12919
    // ARM_tHINT - 59
12920
1.41M
    {15, 273, 3, 3 },
12921
1.41M
    {23, 276, 3, 3 },
12922
1.41M
    {33, 279, 3, 3 },
12923
1.41M
    {41, 282, 3, 3 },
12924
1.41M
    {49, 285, 3, 3 },
12925
1.41M
    {57, 288, 3, 4 },
12926
1.41M
  {0},  };
12927
12928
1.41M
  static const AliasPatternCond Conds[] = {
12929
    // (DSB 0) - 0
12930
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)0},
12931
1.41M
    {AliasPatternCond_K_NegFeature, ARM_ModeThumb},
12932
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureDB},
12933
    // (DSB 4) - 3
12934
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)4},
12935
1.41M
    {AliasPatternCond_K_NegFeature, ARM_ModeThumb},
12936
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureDB},
12937
    // (DSB 12) - 6
12938
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)12},
12939
1.41M
    {AliasPatternCond_K_NegFeature, ARM_ModeThumb},
12940
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureDFB},
12941
    // (HINT 0, pred:$p) - 9
12942
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)0},
12943
1.41M
    {AliasPatternCond_K_NegFeature, ARM_ModeThumb},
12944
1.41M
    {AliasPatternCond_K_Feature, ARM_HasV6KOps},
12945
    // (HINT 1, pred:$p) - 12
12946
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)1},
12947
1.41M
    {AliasPatternCond_K_NegFeature, ARM_ModeThumb},
12948
1.41M
    {AliasPatternCond_K_Feature, ARM_HasV6KOps},
12949
    // (HINT 2, pred:$p) - 15
12950
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)2},
12951
1.41M
    {AliasPatternCond_K_NegFeature, ARM_ModeThumb},
12952
1.41M
    {AliasPatternCond_K_Feature, ARM_HasV6KOps},
12953
    // (HINT 3, pred:$p) - 18
12954
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)3},
12955
1.41M
    {AliasPatternCond_K_NegFeature, ARM_ModeThumb},
12956
1.41M
    {AliasPatternCond_K_Feature, ARM_HasV6KOps},
12957
    // (HINT 4, pred:$p) - 21
12958
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)4},
12959
1.41M
    {AliasPatternCond_K_NegFeature, ARM_ModeThumb},
12960
1.41M
    {AliasPatternCond_K_Feature, ARM_HasV6KOps},
12961
    // (HINT 5, pred:$p) - 24
12962
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)5},
12963
1.41M
    {AliasPatternCond_K_NegFeature, ARM_ModeThumb},
12964
1.41M
    {AliasPatternCond_K_Feature, ARM_HasV8Ops},
12965
    // (HINT 16, pred:$p) - 27
12966
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)16},
12967
1.41M
    {AliasPatternCond_K_NegFeature, ARM_ModeThumb},
12968
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureRAS},
12969
    // (HINT 20, pred:$p) - 30
12970
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)20},
12971
1.41M
    {AliasPatternCond_K_NegFeature, ARM_ModeThumb},
12972
1.41M
    {AliasPatternCond_K_Feature, ARM_HasV6KOps},
12973
    // (HINT 22, pred:$p) - 33
12974
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)22},
12975
1.41M
    {AliasPatternCond_K_NegFeature, ARM_ModeThumb},
12976
1.41M
    {AliasPatternCond_K_Feature, ARM_HasV8Ops},
12977
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureCLRBHB},
12978
    // (MVE_VMLADAVas16 tGPREven:$RdaDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 37
12979
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
12980
1.41M
    {AliasPatternCond_K_Ignore, 0},
12981
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
12982
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
12983
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
12984
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
12985
    // (MVE_VMLADAVas32 tGPREven:$RdaDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 43
12986
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
12987
1.41M
    {AliasPatternCond_K_Ignore, 0},
12988
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
12989
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
12990
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
12991
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
12992
    // (MVE_VMLADAVas8 tGPREven:$RdaDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 49
12993
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
12994
1.41M
    {AliasPatternCond_K_Ignore, 0},
12995
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
12996
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
12997
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
12998
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
12999
    // (MVE_VMLADAVau16 tGPREven:$RdaDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 55
13000
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13001
1.41M
    {AliasPatternCond_K_Ignore, 0},
13002
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13003
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13004
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13005
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13006
    // (MVE_VMLADAVau32 tGPREven:$RdaDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 61
13007
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13008
1.41M
    {AliasPatternCond_K_Ignore, 0},
13009
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13010
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13011
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13012
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13013
    // (MVE_VMLADAVau8 tGPREven:$RdaDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 67
13014
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13015
1.41M
    {AliasPatternCond_K_Ignore, 0},
13016
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13017
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13018
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13019
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13020
    // (MVE_VMLADAVs16 tGPREven:$RdaDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 73
13021
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13022
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13023
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13024
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13025
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13026
    // (MVE_VMLADAVs32 tGPREven:$RdaDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 78
13027
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13028
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13029
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13030
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13031
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13032
    // (MVE_VMLADAVs8 tGPREven:$RdaDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 83
13033
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13034
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13035
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13036
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13037
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13038
    // (MVE_VMLADAVu16 tGPREven:$RdaDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 88
13039
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13040
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13041
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13042
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13043
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13044
    // (MVE_VMLADAVu32 tGPREven:$RdaDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 93
13045
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13046
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13047
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13048
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13049
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13050
    // (MVE_VMLADAVu8 tGPREven:$RdaDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 98
13051
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13052
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13053
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13054
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13055
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13056
    // (MVE_VMLALDAVas16 tGPREven:$RdaLoDest, tGPROdd:$RdaHiDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 103
13057
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13058
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPROddRegClassID},
13059
1.41M
    {AliasPatternCond_K_Ignore, 0},
13060
1.41M
    {AliasPatternCond_K_Ignore, 0},
13061
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13062
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13063
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13064
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13065
    // (MVE_VMLALDAVas32 tGPREven:$RdaLoDest, tGPROdd:$RdaHiDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 111
13066
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13067
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPROddRegClassID},
13068
1.41M
    {AliasPatternCond_K_Ignore, 0},
13069
1.41M
    {AliasPatternCond_K_Ignore, 0},
13070
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13071
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13072
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13073
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13074
    // (MVE_VMLALDAVau16 tGPREven:$RdaLoDest, tGPROdd:$RdaHiDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 119
13075
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13076
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPROddRegClassID},
13077
1.41M
    {AliasPatternCond_K_Ignore, 0},
13078
1.41M
    {AliasPatternCond_K_Ignore, 0},
13079
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13080
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13081
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13082
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13083
    // (MVE_VMLALDAVau32 tGPREven:$RdaLoDest, tGPROdd:$RdaHiDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 127
13084
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13085
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPROddRegClassID},
13086
1.41M
    {AliasPatternCond_K_Ignore, 0},
13087
1.41M
    {AliasPatternCond_K_Ignore, 0},
13088
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13089
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13090
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13091
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13092
    // (MVE_VMLALDAVs16 tGPREven:$RdaLoDest, tGPROdd:$RdaHiDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 135
13093
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13094
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPROddRegClassID},
13095
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13096
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13097
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13098
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13099
    // (MVE_VMLALDAVs32 tGPREven:$RdaLoDest, tGPROdd:$RdaHiDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 141
13100
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13101
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPROddRegClassID},
13102
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13103
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13104
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13105
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13106
    // (MVE_VMLALDAVu16 tGPREven:$RdaLoDest, tGPROdd:$RdaHiDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 147
13107
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13108
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPROddRegClassID},
13109
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13110
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13111
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13112
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13113
    // (MVE_VMLALDAVu32 tGPREven:$RdaLoDest, tGPROdd:$RdaHiDest, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 153
13114
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13115
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPROddRegClassID},
13116
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13117
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13118
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13119
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13120
    // (MVE_VORR MQPR:$Qd, MQPR:$Qm, MQPR:$Qm, vpred_r:$vp) - 159
13121
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13122
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13123
1.41M
    {AliasPatternCond_K_TiedReg, 1},
13124
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13125
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13126
    // (MVE_VRMLALDAVHas32 tGPREven:$RdaLo, tGPROdd:$RdaHi, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 164
13127
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13128
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPROddRegClassID},
13129
1.41M
    {AliasPatternCond_K_Ignore, 0},
13130
1.41M
    {AliasPatternCond_K_Ignore, 0},
13131
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13132
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13133
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13134
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13135
    // (MVE_VRMLALDAVHau32 tGPREven:$RdaLo, tGPROdd:$RdaHi, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 172
13136
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13137
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPROddRegClassID},
13138
1.41M
    {AliasPatternCond_K_Ignore, 0},
13139
1.41M
    {AliasPatternCond_K_Ignore, 0},
13140
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13141
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13142
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13143
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13144
    // (MVE_VRMLALDAVHs32 tGPREven:$RdaLo, tGPROdd:$RdaHi, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 180
13145
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13146
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPROddRegClassID},
13147
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13148
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13149
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13150
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13151
    // (MVE_VRMLALDAVHu32 tGPREven:$RdaLo, tGPROdd:$RdaHi, MQPR:$Qn, MQPR:$Qm, vpred_n:$vp) - 186
13152
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPREvenRegClassID},
13153
1.41M
    {AliasPatternCond_K_RegClass, ARM_tGPROddRegClassID},
13154
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13155
1.41M
    {AliasPatternCond_K_RegClass, ARM_MQPRRegClassID},
13156
1.41M
    {AliasPatternCond_K_Feature, ARM_HasMVEIntegerOps},
13157
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13158
    // (t2CSINC rGPR:$Rd, ZR, ZR, pred_noal_inv:$fcond) - 192
13159
1.41M
    {AliasPatternCond_K_RegClass, ARM_rGPRRegClassID},
13160
1.41M
    {AliasPatternCond_K_Reg, ARM_ZR},
13161
1.41M
    {AliasPatternCond_K_Reg, ARM_ZR},
13162
1.41M
    {AliasPatternCond_K_Feature, ARM_HasV8_1MMainlineOps},
13163
    // (t2CSINC rGPR:$Rd, GPRwithZRnosp:$Rn, GPRwithZRnosp:$Rn, pred_noal_inv:$fcond) - 196
13164
1.41M
    {AliasPatternCond_K_RegClass, ARM_rGPRRegClassID},
13165
1.41M
    {AliasPatternCond_K_RegClass, ARM_GPRwithZRnospRegClassID},
13166
1.41M
    {AliasPatternCond_K_TiedReg, 1},
13167
1.41M
    {AliasPatternCond_K_Feature, ARM_HasV8_1MMainlineOps},
13168
    // (t2CSINV rGPR:$Rd, ZR, ZR, pred_noal_inv:$fcond) - 200
13169
1.41M
    {AliasPatternCond_K_RegClass, ARM_rGPRRegClassID},
13170
1.41M
    {AliasPatternCond_K_Reg, ARM_ZR},
13171
1.41M
    {AliasPatternCond_K_Reg, ARM_ZR},
13172
1.41M
    {AliasPatternCond_K_Feature, ARM_HasV8_1MMainlineOps},
13173
    // (t2CSINV rGPR:$Rd, GPRwithZRnosp:$Rn, GPRwithZRnosp:$Rn, pred_noal_inv:$fcond) - 204
13174
1.41M
    {AliasPatternCond_K_RegClass, ARM_rGPRRegClassID},
13175
1.41M
    {AliasPatternCond_K_RegClass, ARM_GPRwithZRnospRegClassID},
13176
1.41M
    {AliasPatternCond_K_TiedReg, 1},
13177
1.41M
    {AliasPatternCond_K_Feature, ARM_HasV8_1MMainlineOps},
13178
    // (t2CSNEG rGPR:$Rd, GPRwithZRnosp:$Rn, GPRwithZRnosp:$Rn, pred_noal_inv:$fcond) - 208
13179
1.41M
    {AliasPatternCond_K_RegClass, ARM_rGPRRegClassID},
13180
1.41M
    {AliasPatternCond_K_RegClass, ARM_GPRwithZRnospRegClassID},
13181
1.41M
    {AliasPatternCond_K_TiedReg, 1},
13182
1.41M
    {AliasPatternCond_K_Feature, ARM_HasV8_1MMainlineOps},
13183
    // (t2DSB 0, 14, 0) - 212
13184
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)0},
13185
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)14},
13186
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)0},
13187
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureDB},
13188
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13189
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13190
    // (t2DSB 4, 14, 0) - 218
13191
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)4},
13192
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)14},
13193
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)0},
13194
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureDB},
13195
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13196
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13197
    // (t2DSB 12, pred:$p) - 224
13198
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)12},
13199
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureDFB},
13200
    // (t2HINT 0, pred:$p) - 226
13201
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)0},
13202
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13203
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13204
    // (t2HINT 1, pred:$p) - 229
13205
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)1},
13206
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13207
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13208
    // (t2HINT 2, pred:$p) - 232
13209
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)2},
13210
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13211
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13212
    // (t2HINT 3, pred:$p) - 235
13213
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)3},
13214
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13215
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13216
    // (t2HINT 4, pred:$p) - 238
13217
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)4},
13218
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13219
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13220
    // (t2HINT 5, pred:$p) - 241
13221
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)5},
13222
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13223
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13224
1.41M
    {AliasPatternCond_K_Feature, ARM_HasV8Ops},
13225
    // (t2HINT 16, pred:$p) - 245
13226
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)16},
13227
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13228
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13229
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureRAS},
13230
    // (t2HINT 20, pred:$p) - 249
13231
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)20},
13232
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13233
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13234
    // (t2HINT 13, pred:$p) - 252
13235
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)13},
13236
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13237
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13238
    // (t2HINT 15, pred:$p) - 255
13239
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)15},
13240
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13241
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13242
    // (t2HINT 29, pred:$p) - 258
13243
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)29},
13244
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13245
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13246
    // (t2HINT 45, pred:$p) - 261
13247
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)45},
13248
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13249
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13250
    // (t2HINT 22, pred:$p) - 264
13251
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)22},
13252
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13253
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13254
1.41M
    {AliasPatternCond_K_Feature, ARM_HasV8Ops},
13255
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureCLRBHB},
13256
    // (t2SUBS_PC_LR 0, pred:$p) - 269
13257
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)0},
13258
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13259
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13260
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureVirtualization},
13261
    // (tHINT 0, pred:$p) - 273
13262
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)0},
13263
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13264
1.41M
    {AliasPatternCond_K_Feature, ARM_HasV6MOps},
13265
    // (tHINT 1, pred:$p) - 276
13266
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)1},
13267
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13268
1.41M
    {AliasPatternCond_K_Feature, ARM_HasV6MOps},
13269
    // (tHINT 2, pred:$p) - 279
13270
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)2},
13271
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13272
1.41M
    {AliasPatternCond_K_Feature, ARM_HasV6MOps},
13273
    // (tHINT 3, pred:$p) - 282
13274
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)3},
13275
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13276
1.41M
    {AliasPatternCond_K_Feature, ARM_HasV6MOps},
13277
    // (tHINT 4, pred:$p) - 285
13278
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)4},
13279
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13280
1.41M
    {AliasPatternCond_K_Feature, ARM_HasV6MOps},
13281
    // (tHINT 5, pred:$p) - 288
13282
1.41M
    {AliasPatternCond_K_Imm, (uint32_t)5},
13283
1.41M
    {AliasPatternCond_K_Feature, ARM_ModeThumb},
13284
1.41M
    {AliasPatternCond_K_Feature, ARM_FeatureThumb2},
13285
1.41M
    {AliasPatternCond_K_Feature, ARM_HasV8Ops},
13286
1.41M
  {0},  };
13287
13288
1.41M
  static const char AsmStrings[] =
13289
1.41M
    /* 0 */ "ssbb\0"
13290
1.41M
    /* 5 */ "pssbb\0"
13291
1.41M
    /* 11 */ "dfb\0"
13292
1.41M
    /* 15 */ "nop$\xFF\x02\x01\0"
13293
1.41M
    /* 23 */ "yield$\xFF\x02\x01\0"
13294
1.41M
    /* 33 */ "wfe$\xFF\x02\x01\0"
13295
1.41M
    /* 41 */ "wfi$\xFF\x02\x01\0"
13296
1.41M
    /* 49 */ "sev$\xFF\x02\x01\0"
13297
1.41M
    /* 57 */ "sevl$\xFF\x02\x01\0"
13298
1.41M
    /* 66 */ "esb$\xFF\x02\x01\0"
13299
1.41M
    /* 74 */ "csdb$\xFF\x02\x01\0"
13300
1.41M
    /* 83 */ "clrbhb$\xFF\x02\x01\0"
13301
1.41M
    /* 94 */ "vmlava$\xFF\x05\x02.s16 $\x01, $\x03, $\x04\0"
13302
1.41M
    /* 120 */ "vmlava$\xFF\x05\x02.s32  $\x01, $\x03, $\x04\0"
13303
1.41M
    /* 146 */ "vmlava$\xFF\x05\x02.s8 $\x01, $\x03, $\x04\0"
13304
1.41M
    /* 171 */ "vmlava$\xFF\x05\x02.u16  $\x01, $\x03, $\x04\0"
13305
1.41M
    /* 197 */ "vmlava$\xFF\x05\x02.u32  $\x01, $\x03, $\x04\0"
13306
1.41M
    /* 223 */ "vmlava$\xFF\x05\x02.u8 $\x01, $\x03, $\x04\0"
13307
1.41M
    /* 248 */ "vmlav$\xFF\x04\x02.s16 $\x01, $\x02, $\x03\0"
13308
1.41M
    /* 273 */ "vmlav$\xFF\x04\x02.s32 $\x01, $\x02, $\x03\0"
13309
1.41M
    /* 298 */ "vmlav$\xFF\x04\x02.s8  $\x01, $\x02, $\x03\0"
13310
1.41M
    /* 322 */ "vmlav$\xFF\x04\x02.u16 $\x01, $\x02, $\x03\0"
13311
1.41M
    /* 347 */ "vmlav$\xFF\x04\x02.u32 $\x01, $\x02, $\x03\0"
13312
1.41M
    /* 372 */ "vmlav$\xFF\x04\x02.u8  $\x01, $\x02, $\x03\0"
13313
1.41M
    /* 396 */ "vmlalva$\xFF\x07\x02.s16 $\x01, $\x02, $\x05, $\x06\0"
13314
1.41M
    /* 427 */ "vmlalva$\xFF\x07\x02.s32 $\x01, $\x02, $\x05, $\x06\0"
13315
1.41M
    /* 458 */ "vmlalva$\xFF\x07\x02.u16 $\x01, $\x02, $\x05, $\x06\0"
13316
1.41M
    /* 489 */ "vmlalva$\xFF\x07\x02.u32 $\x01, $\x02, $\x05, $\x06\0"
13317
1.41M
    /* 520 */ "vmlalv$\xFF\x05\x02.s16  $\x01, $\x02, $\x03, $\x04\0"
13318
1.41M
    /* 550 */ "vmlalv$\xFF\x05\x02.s32  $\x01, $\x02, $\x03, $\x04\0"
13319
1.41M
    /* 580 */ "vmlalv$\xFF\x05\x02.u16  $\x01, $\x02, $\x03, $\x04\0"
13320
1.41M
    /* 610 */ "vmlalv$\xFF\x05\x02.u32  $\x01, $\x02, $\x03, $\x04\0"
13321
1.41M
    /* 640 */ "vmov$\xFF\x04\x02  $\x01, $\x02\0"
13322
1.41M
    /* 656 */ "vrmlalvha$\xFF\x07\x02.s32 $\x01, $\x02, $\x05, $\x06\0"
13323
1.41M
    /* 689 */ "vrmlalvha$\xFF\x07\x02.u32 $\x01, $\x02, $\x05, $\x06\0"
13324
1.41M
    /* 722 */ "vrmlalvh$\xFF\x05\x02.s32  $\x01, $\x02, $\x03, $\x04\0"
13325
1.41M
    /* 754 */ "vrmlalvh$\xFF\x05\x02.u32  $\x01, $\x02, $\x03, $\x04\0"
13326
1.41M
    /* 786 */ "cset $\x01, $\xFF\x04\x03\0"
13327
1.41M
    /* 800 */ "cinc $\x01, $\x02, $\xFF\x04\x03\0"
13328
1.41M
    /* 818 */ "csetm  $\x01, $\xFF\x04\x03\0"
13329
1.41M
    /* 833 */ "cinv $\x01, $\x02, $\xFF\x04\x03\0"
13330
1.41M
    /* 851 */ "cneg $\x01, $\x02, $\xFF\x04\x03\0"
13331
1.41M
    /* 869 */ "dfb$\xFF\x02\x01\0"
13332
1.41M
    /* 877 */ "nop$\xFF\x02\x01.w\0"
13333
1.41M
    /* 887 */ "yield$\xFF\x02\x01.w\0"
13334
1.41M
    /* 899 */ "wfe$\xFF\x02\x01.w\0"
13335
1.41M
    /* 909 */ "wfi$\xFF\x02\x01.w\0"
13336
1.41M
    /* 919 */ "sev$\xFF\x02\x01.w\0"
13337
1.41M
    /* 929 */ "sevl$\xFF\x02\x01.w\0"
13338
1.41M
    /* 940 */ "esb$\xFF\x02\x01.w\0"
13339
1.41M
    /* 950 */ "pacbti$\xFF\x02\x01 r12,lr,sp\0"
13340
1.41M
    /* 971 */ "bti$\xFF\x02\x01\0"
13341
1.41M
    /* 979 */ "pac$\xFF\x02\x01 r12,lr,sp\0"
13342
1.41M
    /* 997 */ "aut$\xFF\x02\x01 r12,lr,sp\0"
13343
1.41M
    /* 1015 */ "eret$\xFF\x02\x01\0"
13344
1.41M
  ;
13345
13346
1.41M
#ifndef NDEBUG
13347
  //static struct SortCheck {
13348
  //  SortCheck(ArrayRef<PatternsForOpcode> OpToPatterns) {
13349
  //    assert(std::is_sorted(
13350
  //               OpToPatterns.begin(), OpToPatterns.end(),
13351
  //               [](const PatternsForOpcode &L, const //PatternsForOpcode &R) {
13352
  //                 return L.Opcode < R.Opcode;
13353
  //               }) &&
13354
  //           "tablegen failed to sort opcode patterns");
13355
  //  }
13356
  //} sortCheckVar(OpToPatterns);
13357
1.41M
#endif
13358
13359
1.41M
  AliasMatchingData M = {
13360
1.41M
    OpToPatterns,
13361
1.41M
    Patterns,
13362
1.41M
    Conds,
13363
1.41M
    AsmStrings,
13364
1.41M
    NULL,
13365
1.41M
  };
13366
1.41M
  const char *AsmString = matchAliasPatterns(MI, &M);
13367
1.41M
  if (!AsmString) return false;
13368
13369
3.14k
  unsigned I = 0;
13370
17.7k
  while (AsmString[I] != ' ' && AsmString[I] != '\t' &&
13371
17.0k
         AsmString[I] != '$' && AsmString[I] != '\0')
13372
14.5k
    ++I;
13373
3.14k
  SStream_concat1(OS, '\t');
13374
3.14k
  char *substr = malloc(I+1);
13375
3.14k
  memcpy(substr, AsmString, I);
13376
3.14k
  substr[I] = '\0';
13377
3.14k
  SStream_concat0(OS, substr);
13378
3.14k
  free(substr);
13379
3.14k
  if (AsmString[I] != '\0') {
13380
3.12k
    if (AsmString[I] == ' ' || AsmString[I] == '\t') {
13381
675
      SStream_concat1(OS, '\t');
13382
675
      ++I;
13383
675
    }
13384
16.9k
    do {
13385
16.9k
      if (AsmString[I] == '$') {
13386
7.02k
        ++I;
13387
7.02k
        if (AsmString[I] == (char)0xff) {
13388
3.12k
          ++I;
13389
3.12k
          int OpIdx = AsmString[I++] - 1;
13390
3.12k
          int PrintMethodIdx = AsmString[I++] - 1;
13391
3.12k
          printCustomAliasOperand(MI, Address, OpIdx, PrintMethodIdx, OS);
13392
3.12k
        } else
13393
3.89k
          printOperand(MI, ((unsigned)AsmString[I++]) - 1, OS);
13394
9.91k
      } else {
13395
9.91k
        SStream_concat1(OS, AsmString[I++]);
13396
9.91k
      }
13397
16.9k
    } while (AsmString[I] != '\0');
13398
3.12k
  }
13399
13400
3.14k
  return true;
13401
#else
13402
  return false;
13403
#endif // CAPSTONE_DIET
13404
1.41M
}
13405
13406
static void printCustomAliasOperand(
13407
         MCInst *MI, uint64_t Address, unsigned OpIdx,
13408
         unsigned PrintMethodIdx,
13409
3.12k
         SStream *OS) {
13410
3.12k
#ifndef CAPSTONE_DIET
13411
3.12k
  switch (PrintMethodIdx) {
13412
0
  default:
13413
0
    CS_ASSERT_RET(0 && "Unknown PrintMethod kind");
13414
0
    break;
13415
1.55k
  case 0:
13416
1.55k
    printPredicateOperand(MI, OpIdx, OS);
13417
1.55k
    break;
13418
895
  case 1:
13419
895
    printVPTPredicateOperand(MI, OpIdx, OS);
13420
895
    break;
13421
675
  case 2:
13422
675
    printMandatoryInvertedPredicateOperand(MI, OpIdx, OS);
13423
675
    break;
13424
3.12k
  }
13425
3.12k
#endif // CAPSTONE_DIET
13426
3.12k
}
13427
13428
#endif // PRINT_ALIAS_INSTR