Coverage Report

Created: 2026-11-12 06:22

next uncovered line (L), next uncovered region (R), next uncovered branch (B)
/src/capstonev5/arch/Mips/MipsGenAsmWriter.inc
Line
Count
Source
1
/*===- TableGen'erated file -------------------------------------*- C++ -*-===*\
2
|*                                                                            *|
3
|*Assembly Writer Source Fragment                                             *|
4
|*                                                                            *|
5
|* Automatically generated file, do not edit!                                 *|
6
|*                                                                            *|
7
\*===----------------------------------------------------------------------===*/
8
9
/* Capstone Disassembly Engine, http://www.capstone-engine.org */
10
/* By Nguyen Anh Quynh <aquynh@gmail.com>, 2013-2015 */
11
12
/// printInstruction - This method is automatically generated by tablegen
13
/// from the instruction set description.
14
static void printInstruction(MCInst *MI, SStream *O, const MCRegisterInfo *MRI)
15
92.4k
{
16
92.4k
  static const uint32_t OpInfo[] = {
17
92.4k
    0U, // PHI
18
92.4k
    0U, // INLINEASM
19
92.4k
    0U, // CFI_INSTRUCTION
20
92.4k
    0U, // EH_LABEL
21
92.4k
    0U, // GC_LABEL
22
92.4k
    0U, // KILL
23
92.4k
    0U, // EXTRACT_SUBREG
24
92.4k
    0U, // INSERT_SUBREG
25
92.4k
    0U, // IMPLICIT_DEF
26
92.4k
    0U, // SUBREG_TO_REG
27
92.4k
    0U, // COPY_TO_REGCLASS
28
92.4k
    9396U,  // DBG_VALUE
29
92.4k
    0U, // REG_SEQUENCE
30
92.4k
    0U, // COPY
31
92.4k
    9389U,  // BUNDLE
32
92.4k
    9406U,  // LIFETIME_START
33
92.4k
    9376U,  // LIFETIME_END
34
92.4k
    0U, // STACKMAP
35
92.4k
    0U, // PATCHPOINT
36
92.4k
    0U, // LOAD_STACK_GUARD
37
92.4k
    0U, // STATEPOINT
38
92.4k
    0U, // FRAME_ALLOC
39
92.4k
    21660U, // ABSQ_S_PH
40
92.4k
    18025U, // ABSQ_S_QB
41
92.4k
    24850U, // ABSQ_S_W
42
92.4k
    134237992U, // ADD
43
92.4k
    18294U, // ADDIUPC
44
92.4k
    18294U, // ADDIUPC_MM
45
92.4k
    22527U, // ADDIUR1SP_MM
46
92.4k
    134234410U, // ADDIUR2_MM
47
92.4k
    8683851U, // ADDIUS5_MM
48
92.4k
    546875U,  // ADDIUSP_MM
49
92.4k
    134239193U, // ADDQH_PH
50
92.4k
    134239310U, // ADDQH_R_PH
51
92.4k
    134242253U, // ADDQH_R_W
52
92.4k
    134241856U, // ADDQH_W
53
92.4k
    134239267U, // ADDQ_PH
54
92.4k
    134239366U, // ADDQ_S_PH
55
92.4k
    134242558U, // ADDQ_S_W
56
92.4k
    134236055U, // ADDSC
57
92.4k
    134234730U, // ADDS_A_B
58
92.4k
    134236180U, // ADDS_A_D
59
92.4k
    134238138U, // ADDS_A_H
60
92.4k
    134241564U, // ADDS_A_W
61
92.4k
    134235198U, // ADDS_S_B
62
92.4k
    134237269U, // ADDS_S_D
63
92.4k
    134238695U, // ADDS_S_H
64
92.4k
    134242608U, // ADDS_S_W
65
92.4k
    134235413U, // ADDS_U_B
66
92.4k
    134237736U, // ADDS_U_D
67
92.4k
    134238973U, // ADDS_U_H
68
92.4k
    134243026U, // ADDS_U_W
69
92.4k
    134234575U, // ADDU16_MM
70
92.4k
    134235621U, // ADDUH_QB
71
92.4k
    134235729U, // ADDUH_R_QB
72
92.4k
    134239465U, // ADDU_PH
73
92.4k
    134235834U, // ADDU_QB
74
92.4k
    134239410U, // ADDU_S_PH
75
92.4k
    134235775U, // ADDU_S_QB
76
92.4k
    2281718627U,  // ADDVI_B
77
92.4k
    2281720348U,  // ADDVI_D
78
92.4k
    2281722002U,  // ADDVI_H
79
92.4k
    2281725637U,  // ADDVI_W
80
92.4k
    134235491U, // ADDV_B
81
92.4k
    134237836U, // ADDV_D
82
92.4k
    134239051U, // ADDV_H
83
92.4k
    134243126U, // ADDV_W
84
92.4k
    134236094U, // ADDWC
85
92.4k
    134234712U, // ADD_A_B
86
92.4k
    134236161U, // ADD_A_D
87
92.4k
    134238120U, // ADD_A_H
88
92.4k
    134241545U, // ADD_A_W
89
92.4k
    134237992U, // ADD_MM
90
92.4k
    134239685U, // ADDi
91
92.4k
    134239685U, // ADDi_MM
92
92.4k
    134241307U, // ADDiu
93
92.4k
    134241307U, // ADDiu_MM
94
92.4k
    134241261U, // ADDu
95
92.4k
    134241261U, // ADDu_MM
96
92.4k
    0U, // ADJCALLSTACKDOWN
97
92.4k
    0U, // ADJCALLSTACKUP
98
92.4k
    134240158U, // ALIGN
99
92.4k
    18286U, // ALUIPC
100
92.4k
    134238014U, // AND
101
92.4k
    835930U,  // AND16_MM
102
92.4k
    134238014U, // AND64
103
92.4k
    134234471U, // ANDI16_MM
104
92.4k
    2281718486U,  // ANDI_B
105
92.4k
    134238014U, // AND_MM
106
92.4k
    134241389U, // AND_V
107
92.4k
    0U, // AND_V_D_PSEUDO
108
92.4k
    0U, // AND_V_H_PSEUDO
109
92.4k
    0U, // AND_V_W_PSEUDO
110
92.4k
    134239691U, // ANDi
111
92.4k
    134239691U, // ANDi64
112
92.4k
    134239691U, // ANDi_MM
113
92.4k
    134238028U, // APPEND
114
92.4k
    134235092U, // ASUB_S_B
115
92.4k
    134237099U, // ASUB_S_D
116
92.4k
    134238527U, // ASUB_S_H
117
92.4k
    134242388U, // ASUB_S_W
118
92.4k
    134235307U, // ASUB_U_B
119
92.4k
    134237566U, // ASUB_U_D
120
92.4k
    134238815U, // ASUB_U_H
121
92.4k
    134242856U, // ASUB_U_W
122
92.4k
    0U, // ATOMIC_CMP_SWAP_I16
123
92.4k
    0U, // ATOMIC_CMP_SWAP_I32
124
92.4k
    0U, // ATOMIC_CMP_SWAP_I64
125
92.4k
    0U, // ATOMIC_CMP_SWAP_I8
126
92.4k
    0U, // ATOMIC_LOAD_ADD_I16
127
92.4k
    0U, // ATOMIC_LOAD_ADD_I32
128
92.4k
    0U, // ATOMIC_LOAD_ADD_I64
129
92.4k
    0U, // ATOMIC_LOAD_ADD_I8
130
92.4k
    0U, // ATOMIC_LOAD_AND_I16
131
92.4k
    0U, // ATOMIC_LOAD_AND_I32
132
92.4k
    0U, // ATOMIC_LOAD_AND_I64
133
92.4k
    0U, // ATOMIC_LOAD_AND_I8
134
92.4k
    0U, // ATOMIC_LOAD_NAND_I16
135
92.4k
    0U, // ATOMIC_LOAD_NAND_I32
136
92.4k
    0U, // ATOMIC_LOAD_NAND_I64
137
92.4k
    0U, // ATOMIC_LOAD_NAND_I8
138
92.4k
    0U, // ATOMIC_LOAD_OR_I16
139
92.4k
    0U, // ATOMIC_LOAD_OR_I32
140
92.4k
    0U, // ATOMIC_LOAD_OR_I64
141
92.4k
    0U, // ATOMIC_LOAD_OR_I8
142
92.4k
    0U, // ATOMIC_LOAD_SUB_I16
143
92.4k
    0U, // ATOMIC_LOAD_SUB_I32
144
92.4k
    0U, // ATOMIC_LOAD_SUB_I64
145
92.4k
    0U, // ATOMIC_LOAD_SUB_I8
146
92.4k
    0U, // ATOMIC_LOAD_XOR_I16
147
92.4k
    0U, // ATOMIC_LOAD_XOR_I32
148
92.4k
    0U, // ATOMIC_LOAD_XOR_I64
149
92.4k
    0U, // ATOMIC_LOAD_XOR_I8
150
92.4k
    0U, // ATOMIC_SWAP_I16
151
92.4k
    0U, // ATOMIC_SWAP_I32
152
92.4k
    0U, // ATOMIC_SWAP_I64
153
92.4k
    0U, // ATOMIC_SWAP_I8
154
92.4k
    134239795U, // AUI
155
92.4k
    18279U, // AUIPC
156
92.4k
    134235178U, // AVER_S_B
157
92.4k
    134237249U, // AVER_S_D
158
92.4k
    134238665U, // AVER_S_H
159
92.4k
    134242588U, // AVER_S_W
160
92.4k
    134235393U, // AVER_U_B
161
92.4k
    134237716U, // AVER_U_D
162
92.4k
    134238953U, // AVER_U_H
163
92.4k
    134243006U, // AVER_U_W
164
92.4k
    134235120U, // AVE_S_B
165
92.4k
    134237181U, // AVE_S_D
166
92.4k
    134238597U, // AVE_S_H
167
92.4k
    134242470U, // AVE_S_W
168
92.4k
    134235335U, // AVE_U_B
169
92.4k
    134237648U, // AVE_U_D
170
92.4k
    134238885U, // AVE_U_H
171
92.4k
    134242938U, // AVE_U_W
172
92.4k
    23579U, // AddiuRxImmX16
173
92.4k
    1072155U, // AddiuRxPcImmX16
174
92.4k
    285236251U, // AddiuRxRxImm16
175
92.4k
    16800795U,  // AddiuRxRxImmX16
176
92.4k
    25189403U,  // AddiuRxRyOffMemX16
177
92.4k
    1336343U, // AddiuSpImm16
178
92.4k
    549911U,  // AddiuSpImmX16
179
92.4k
    134241261U, // AdduRxRyRz16
180
92.4k
    16797502U,  // AndRxRxRy16
181
92.4k
    0U, // B
182
92.4k
    541013U,  // B16_MM
183
92.4k
    134241260U, // BADDu
184
92.4k
    546393U,  // BAL
185
92.4k
    542494U,  // BALC
186
92.4k
    134240157U, // BALIGN
187
92.4k
    0U, // BAL_BR
188
92.4k
    167788585U, // BBIT0
189
92.4k
    167788717U, // BBIT032
190
92.4k
    167788710U, // BBIT1
191
92.4k
    167788726U, // BBIT132
192
92.4k
    542473U,  // BC
193
92.4k
    20351U, // BC0F
194
92.4k
    22218U, // BC0FL
195
92.4k
    23455U, // BC0T
196
92.4k
    22347U, // BC0TL
197
92.4k
    25733U, // BC1EQZ
198
92.4k
    20357U, // BC1F
199
92.4k
    22225U, // BC1FL
200
92.4k
    20357U, // BC1F_MM
201
92.4k
    25717U, // BC1NEZ
202
92.4k
    23461U, // BC1T
203
92.4k
    22354U, // BC1TL
204
92.4k
    23461U, // BC1T_MM
205
92.4k
    25741U, // BC2EQZ
206
92.4k
    20363U, // BC2F
207
92.4k
    22232U, // BC2FL
208
92.4k
    25725U, // BC2NEZ
209
92.4k
    23467U, // BC2T
210
92.4k
    22361U, // BC2TL
211
92.4k
    20369U, // BC3F
212
92.4k
    22239U, // BC3FL
213
92.4k
    23473U, // BC3T
214
92.4k
    22368U, // BC3TL
215
92.4k
    2281718555U,  // BCLRI_B
216
92.4k
    2281720292U,  // BCLRI_D
217
92.4k
    2281721946U,  // BCLRI_H
218
92.4k
    2281725581U,  // BCLRI_W
219
92.4k
    134235059U, // BCLR_B
220
92.4k
    134237023U, // BCLR_D
221
92.4k
    134238494U, // BCLR_H
222
92.4k
    134242304U, // BCLR_W
223
92.4k
    134240340U, // BEQ
224
92.4k
    134240340U, // BEQ64
225
92.4k
    134236044U, // BEQC
226
92.4k
    134240063U, // BEQL
227
92.4k
    16882U, // BEQZ16_MM
228
92.4k
    18246U, // BEQZALC
229
92.4k
    18394U, // BEQZC
230
92.4k
    18394U, // BEQZC_MM
231
92.4k
    134240340U, // BEQ_MM
232
92.4k
    134235917U, // BGEC
233
92.4k
    134236068U, // BGEUC
234
92.4k
    25500U, // BGEZ
235
92.4k
    25500U, // BGEZ64
236
92.4k
    22115U, // BGEZAL
237
92.4k
    18219U, // BGEZALC
238
92.4k
    22311U, // BGEZALL
239
92.4k
    23424U, // BGEZALS_MM
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1384
92.4k
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1385
92.4k
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92.4k
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1402
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1404
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1405
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1411
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1413
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92.4k
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92.4k
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1482
92.4k
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1484
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1505
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1514
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    0U
1803
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  };
1804
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  static const uint8_t OpInfo2[] = {
1806
92.4k
    0U, // PHI
1807
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    0U, // INLINEASM
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1809
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1812
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    0U, // EXTRACT_SUBREG
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    0U, // DBG_VALUE
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    0U, // BUNDLE
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    0U, // LIFETIME_START
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1843
92.4k
    0U, // ADDQ_S_PH
1844
92.4k
    0U, // ADDQ_S_W
1845
92.4k
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1846
92.4k
    0U, // ADDS_A_B
1847
92.4k
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1848
92.4k
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1849
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1853
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1854
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1856
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1859
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1860
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1861
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1864
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1865
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1869
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1870
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1871
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1872
92.4k
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1873
92.4k
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1874
92.4k
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1875
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1876
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1877
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1878
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1879
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1880
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1881
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1882
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1883
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1884
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1885
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1886
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1887
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    4U, // ALIGN
1888
92.4k
    0U, // ALUIPC
1889
92.4k
    0U, // AND
1890
92.4k
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1891
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1892
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1893
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1894
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1895
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1896
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1897
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1898
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1899
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1900
92.4k
    1U, // ANDi64
1901
92.4k
    1U, // ANDi_MM
1902
92.4k
    1U, // APPEND
1903
92.4k
    0U, // ASUB_S_B
1904
92.4k
    0U, // ASUB_S_D
1905
92.4k
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1906
92.4k
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1907
92.4k
    0U, // ASUB_U_B
1908
92.4k
    0U, // ASUB_U_D
1909
92.4k
    0U, // ASUB_U_H
1910
92.4k
    0U, // ASUB_U_W
1911
92.4k
    0U, // ATOMIC_CMP_SWAP_I16
1912
92.4k
    0U, // ATOMIC_CMP_SWAP_I32
1913
92.4k
    0U, // ATOMIC_CMP_SWAP_I64
1914
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1915
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    0U, // ATOMIC_LOAD_ADD_I16
1916
92.4k
    0U, // ATOMIC_LOAD_ADD_I32
1917
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1918
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    0U, // ATOMIC_LOAD_ADD_I8
1919
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1920
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1921
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1922
92.4k
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1933
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1934
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1942
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    0U, // ATOMIC_SWAP_I8
1943
92.4k
    0U, // AUI
1944
92.4k
    0U, // AUIPC
1945
92.4k
    0U, // AVER_S_B
1946
92.4k
    0U, // AVER_S_D
1947
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1948
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    0U, // AVER_S_W
1949
92.4k
    0U, // AVER_U_B
1950
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    0U, // AVER_U_D
1951
92.4k
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1952
92.4k
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1953
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    0U, // AVE_S_B
1954
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1955
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1957
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1958
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1959
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    0U, // AVE_U_H
1960
92.4k
    0U, // AVE_U_W
1961
92.4k
    0U, // AddiuRxImmX16
1962
92.4k
    0U, // AddiuRxPcImmX16
1963
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1964
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    0U, // AddiuRxRxImmX16
1965
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1966
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    0U, // AddiuSpImm16
1967
92.4k
    0U, // AddiuSpImmX16
1968
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    0U, // AdduRxRyRz16
1969
92.4k
    0U, // AndRxRxRy16
1970
92.4k
    0U, // B
1971
92.4k
    0U, // B16_MM
1972
92.4k
    0U, // BADDu
1973
92.4k
    0U, // BAL
1974
92.4k
    0U, // BALC
1975
92.4k
    1U, // BALIGN
1976
92.4k
    0U, // BAL_BR
1977
92.4k
    0U, // BBIT0
1978
92.4k
    0U, // BBIT032
1979
92.4k
    0U, // BBIT1
1980
92.4k
    0U, // BBIT132
1981
92.4k
    0U, // BC
1982
92.4k
    0U, // BC0F
1983
92.4k
    0U, // BC0FL
1984
92.4k
    0U, // BC0T
1985
92.4k
    0U, // BC0TL
1986
92.4k
    0U, // BC1EQZ
1987
92.4k
    0U, // BC1F
1988
92.4k
    0U, // BC1FL
1989
92.4k
    0U, // BC1F_MM
1990
92.4k
    0U, // BC1NEZ
1991
92.4k
    0U, // BC1T
1992
92.4k
    0U, // BC1TL
1993
92.4k
    0U, // BC1T_MM
1994
92.4k
    0U, // BC2EQZ
1995
92.4k
    0U, // BC2F
1996
92.4k
    0U, // BC2FL
1997
92.4k
    0U, // BC2NEZ
1998
92.4k
    0U, // BC2T
1999
92.4k
    0U, // BC2TL
2000
92.4k
    0U, // BC3F
2001
92.4k
    0U, // BC3FL
2002
92.4k
    0U, // BC3T
2003
92.4k
    0U, // BC3TL
2004
92.4k
    0U, // BCLRI_B
2005
92.4k
    0U, // BCLRI_D
2006
92.4k
    0U, // BCLRI_H
2007
92.4k
    0U, // BCLRI_W
2008
92.4k
    0U, // BCLR_B
2009
92.4k
    0U, // BCLR_D
2010
92.4k
    0U, // BCLR_H
2011
92.4k
    0U, // BCLR_W
2012
92.4k
    0U, // BEQ
2013
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2014
92.4k
    0U, // BEQC
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92.4k
    0U, // BEQL
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2021
92.4k
    0U, // BGEC
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2025
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    0U, // BGEZAL
2026
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2027
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    0U, // BGEZALL
2028
92.4k
    0U, // BGEZALS_MM
2029
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    0U, // BGEZAL_MM
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92.4k
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2038
92.4k
    0U, // BGTZ_MM
2039
92.4k
    1U, // BINSLI_B
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    0U, // BLTC
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    0U, // BLTUC
2065
92.4k
    0U, // BLTZ
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92.4k
    0U, // BLTZ64
2067
92.4k
    0U, // BLTZAL
2068
92.4k
    0U, // BLTZALC
2069
92.4k
    0U, // BLTZALL
2070
92.4k
    0U, // BLTZALS_MM
2071
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92.4k
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2079
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    0U, // BNE
2080
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    0U, // BNEGI_B
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92.4k
    0U, // BNEL
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92.4k
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92.4k
    0U, // BNZ_B
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2100
92.4k
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2106
92.4k
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2116
92.4k
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2117
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2262
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2272
92.4k
    0U, // CTC1
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92.4k
    0U, // CVT_D64_W
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92.4k
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2301
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92.4k
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2304
92.4k
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2305
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2306
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92.4k
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92.4k
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2336
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2338
92.4k
    0U, // C_ULE_S
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2340
92.4k
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92.4k
    0U, // C_ULT_S
2342
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    0U, // C_UN_D32
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92.4k
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    0U, // C_UN_S
2345
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    0U, // CmpRxRy16
2346
92.4k
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2349
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    0U, // DADD
2350
92.4k
    0U, // DADDi
2351
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    0U, // DADDiu
2352
92.4k
    0U, // DADDu
2353
92.4k
    0U, // DAHI
2354
92.4k
    4U, // DALIGN
2355
92.4k
    0U, // DATI
2356
92.4k
    0U, // DAUI
2357
92.4k
    0U, // DBITSWAP
2358
92.4k
    0U, // DCLO
2359
92.4k
    0U, // DCLO_R6
2360
92.4k
    0U, // DCLZ
2361
92.4k
    0U, // DCLZ_R6
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92.4k
    0U, // DDIV
2363
92.4k
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2364
92.4k
    0U, // DERET
2365
92.4k
    0U, // DERET_MM
2366
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2367
92.4k
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    0U, // DI
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92.4k
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92.4k
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2372
92.4k
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2373
92.4k
    0U, // DIV
2374
92.4k
    0U, // DIVU
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92.4k
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92.4k
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2810
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2811
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2812
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92.4k
    0U, // LiRxImm16
2821
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2822
92.4k
    0U, // LiRxImmX16
2823
92.4k
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2824
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92.4k
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92.4k
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    0U, // MIPSeh_return32
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2924
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92.4k
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2926
92.4k
    0U, // MODU
2927
92.4k
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92.4k
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3450
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3451
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    0U, // SWC2
3455
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    0U, // SWC3
3457
92.4k
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3458
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3459
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    0U, // SWL_MM
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3462
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3463
92.4k
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92.4k
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3465
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3470
92.4k
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3471
92.4k
    0U, // SYNC
3472
92.4k
    0U, // SYNCI
3473
92.4k
    0U, // SYNC_MM
3474
92.4k
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3475
92.4k
    0U, // SYSCALL_MM
3476
92.4k
    0U, // SZ_B_PSEUDO
3477
92.4k
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3478
92.4k
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3479
92.4k
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3480
92.4k
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3481
92.4k
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3482
92.4k
    0U, // SaveX16
3483
92.4k
    0U, // SbRxRyOffMemX16
3484
92.4k
    0U, // SebRx16
3485
92.4k
    0U, // SehRx16
3486
92.4k
    0U, // SelBeqZ
3487
92.4k
    0U, // SelBneZ
3488
92.4k
    0U, // SelTBteqZCmp
3489
92.4k
    0U, // SelTBteqZCmpi
3490
92.4k
    0U, // SelTBteqZSlt
3491
92.4k
    0U, // SelTBteqZSlti
3492
92.4k
    0U, // SelTBteqZSltiu
3493
92.4k
    0U, // SelTBteqZSltu
3494
92.4k
    0U, // SelTBtneZCmp
3495
92.4k
    0U, // SelTBtneZCmpi
3496
92.4k
    0U, // SelTBtneZSlt
3497
92.4k
    0U, // SelTBtneZSlti
3498
92.4k
    0U, // SelTBtneZSltiu
3499
92.4k
    0U, // SelTBtneZSltu
3500
92.4k
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3501
92.4k
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3502
92.4k
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3503
92.4k
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3504
92.4k
    0U, // SltRxRy16
3505
92.4k
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3506
92.4k
    0U, // SltiRxImm16
3507
92.4k
    0U, // SltiRxImmX16
3508
92.4k
    0U, // SltiuCCRxImmX16
3509
92.4k
    0U, // SltiuRxImm16
3510
92.4k
    0U, // SltiuRxImmX16
3511
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3512
92.4k
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3513
92.4k
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3514
92.4k
    1U, // SraX16
3515
92.4k
    0U, // SravRxRy16
3516
92.4k
    1U, // SrlX16
3517
92.4k
    0U, // SrlvRxRy16
3518
92.4k
    0U, // SubuRxRyRz16
3519
92.4k
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3520
92.4k
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3521
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3522
92.4k
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3523
92.4k
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    1U, // TEQ
3525
92.4k
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3526
92.4k
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3527
92.4k
    1U, // TEQ_MM
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3529
92.4k
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3530
92.4k
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3531
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92.4k
    1U, // TGEU
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92.4k
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92.4k
    1U, // TGE_MM
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92.4k
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92.4k
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92.4k
    0U, // TLBWI_MM
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92.4k
    0U, // TLBWR
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92.4k
    0U, // TLBWR_MM
3544
92.4k
    1U, // TLT
3545
92.4k
    0U, // TLTI
3546
92.4k
    0U, // TLTIU_MM
3547
92.4k
    0U, // TLTI_MM
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92.4k
    1U, // TLTU
3549
92.4k
    1U, // TLTU_MM
3550
92.4k
    1U, // TLT_MM
3551
92.4k
    1U, // TNE
3552
92.4k
    0U, // TNEI
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92.4k
    0U, // TNEI_MM
3554
92.4k
    1U, // TNE_MM
3555
92.4k
    0U, // TRAP
3556
92.4k
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    0U, // TRUNC_W_S
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92.4k
    0U, // TTLTIU
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92.4k
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92.4k
    0U, // UDIV_MM
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92.4k
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92.4k
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92.4k
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3569
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92.4k
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92.4k
    0U, // WAIT
3574
92.4k
    0U, // WAIT_MM
3575
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3576
92.4k
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3577
92.4k
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3578
92.4k
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3579
92.4k
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3580
92.4k
    0U, // XOR64
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92.4k
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92.4k
    0U, // XOR_MM
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92.4k
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92.4k
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    1U, // XORi
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92.4k
    1U, // XORi64
3589
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    1U, // XORi_MM
3590
92.4k
    0U, // XorRxRxRy16
3591
92.4k
    0U
3592
92.4k
  };
3593
3594
92.4k
#ifndef CAPSTONE_DIET
3595
92.4k
  static const char AsmStrs[] = {
3596
92.4k
  /* 0 */ 'j', 'a', 'l', 'r', 'c', 32, 9, 0,
3597
92.4k
  /* 8 */ 'd', 'm', 'f', 'c', '0', 9, 0,
3598
92.4k
  /* 15 */ 'd', 'm', 't', 'c', '0', 9, 0,
3599
92.4k
  /* 22 */ 'v', 'm', 'm', '0', 9, 0,
3600
92.4k
  /* 28 */ 'm', 't', 'm', '0', 9, 0,
3601
92.4k
  /* 34 */ 'm', 't', 'p', '0', 9, 0,
3602
92.4k
  /* 40 */ 'b', 'b', 'i', 't', '0', 9, 0,
3603
92.4k
  /* 47 */ 'l', 'd', 'c', '1', 9, 0,
3604
92.4k
  /* 53 */ 's', 'd', 'c', '1', 9, 0,
3605
92.4k
  /* 59 */ 'c', 'f', 'c', '1', 9, 0,
3606
92.4k
  /* 65 */ 'd', 'm', 'f', 'c', '1', 9, 0,
3607
92.4k
  /* 72 */ 'm', 'f', 'h', 'c', '1', 9, 0,
3608
92.4k
  /* 79 */ 'm', 't', 'h', 'c', '1', 9, 0,
3609
92.4k
  /* 86 */ 'c', 't', 'c', '1', 9, 0,
3610
92.4k
  /* 92 */ 'd', 'm', 't', 'c', '1', 9, 0,
3611
92.4k
  /* 99 */ 'l', 'w', 'c', '1', 9, 0,
3612
92.4k
  /* 105 */ 's', 'w', 'c', '1', 9, 0,
3613
92.4k
  /* 111 */ 'l', 'd', 'x', 'c', '1', 9, 0,
3614
92.4k
  /* 118 */ 's', 'd', 'x', 'c', '1', 9, 0,
3615
92.4k
  /* 125 */ 'l', 'u', 'x', 'c', '1', 9, 0,
3616
92.4k
  /* 132 */ 's', 'u', 'x', 'c', '1', 9, 0,
3617
92.4k
  /* 139 */ 'l', 'w', 'x', 'c', '1', 9, 0,
3618
92.4k
  /* 146 */ 's', 'w', 'x', 'c', '1', 9, 0,
3619
92.4k
  /* 153 */ 'm', 't', 'm', '1', 9, 0,
3620
92.4k
  /* 159 */ 'm', 't', 'p', '1', 9, 0,
3621
92.4k
  /* 165 */ 'b', 'b', 'i', 't', '1', 9, 0,
3622
92.4k
  /* 172 */ 'b', 'b', 'i', 't', '0', '3', '2', 9, 0,
3623
92.4k
  /* 181 */ 'b', 'b', 'i', 't', '1', '3', '2', 9, 0,
3624
92.4k
  /* 190 */ 'd', 's', 'r', 'a', '3', '2', 9, 0,
3625
92.4k
  /* 198 */ 'b', 'p', 'o', 's', 'g', 'e', '3', '2', 9, 0,
3626
92.4k
  /* 208 */ 'd', 's', 'l', 'l', '3', '2', 9, 0,
3627
92.4k
  /* 216 */ 'd', 's', 'r', 'l', '3', '2', 9, 0,
3628
92.4k
  /* 224 */ 'l', 'w', 'm', '3', '2', 9, 0,
3629
92.4k
  /* 231 */ 's', 'w', 'm', '3', '2', 9, 0,
3630
92.4k
  /* 238 */ 'd', 'r', 'o', 't', 'r', '3', '2', 9, 0,
3631
92.4k
  /* 247 */ 'l', 'd', 'c', '2', 9, 0,
3632
92.4k
  /* 253 */ 's', 'd', 'c', '2', 9, 0,
3633
92.4k
  /* 259 */ 'd', 'm', 'f', 'c', '2', 9, 0,
3634
92.4k
  /* 266 */ 'd', 'm', 't', 'c', '2', 9, 0,
3635
92.4k
  /* 273 */ 'l', 'w', 'c', '2', 9, 0,
3636
92.4k
  /* 279 */ 's', 'w', 'c', '2', 9, 0,
3637
92.4k
  /* 285 */ 'm', 't', 'm', '2', 9, 0,
3638
92.4k
  /* 291 */ 'm', 't', 'p', '2', 9, 0,
3639
92.4k
  /* 297 */ 'a', 'd', 'd', 'i', 'u', 'r', '2', 9, 0,
3640
92.4k
  /* 306 */ 'l', 'd', 'c', '3', 9, 0,
3641
92.4k
  /* 312 */ 's', 'd', 'c', '3', 9, 0,
3642
92.4k
  /* 318 */ 'l', 'w', 'c', '3', 9, 0,
3643
92.4k
  /* 324 */ 's', 'w', 'c', '3', 9, 0,
3644
92.4k
  /* 330 */ 'a', 'd', 'd', 'i', 'u', 's', '5', 9, 0,
3645
92.4k
  /* 339 */ 's', 'b', '1', '6', 9, 0,
3646
92.4k
  /* 345 */ 'a', 'n', 'd', '1', '6', 9, 0,
3647
92.4k
  /* 352 */ 's', 'h', '1', '6', 9, 0,
3648
92.4k
  /* 358 */ 'a', 'n', 'd', 'i', '1', '6', 9, 0,
3649
92.4k
  /* 366 */ 'l', 'i', '1', '6', 9, 0,
3650
92.4k
  /* 372 */ 'b', 'r', 'e', 'a', 'k', '1', '6', 9, 0,
3651
92.4k
  /* 381 */ 's', 'l', 'l', '1', '6', 9, 0,
3652
92.4k
  /* 388 */ 's', 'r', 'l', '1', '6', 9, 0,
3653
92.4k
  /* 395 */ 'l', 'w', 'm', '1', '6', 9, 0,
3654
92.4k
  /* 402 */ 's', 'w', 'm', '1', '6', 9, 0,
3655
92.4k
  /* 409 */ 's', 'd', 'b', 'b', 'p', '1', '6', 9, 0,
3656
92.4k
  /* 418 */ 'j', 'r', '1', '6', 9, 0,
3657
92.4k
  /* 424 */ 'x', 'o', 'r', '1', '6', 9, 0,
3658
92.4k
  /* 431 */ 'j', 'a', 'l', 'r', 's', '1', '6', 9, 0,
3659
92.4k
  /* 440 */ 'n', 'o', 't', '1', '6', 9, 0,
3660
92.4k
  /* 447 */ 'l', 'b', 'u', '1', '6', 9, 0,
3661
92.4k
  /* 454 */ 's', 'u', 'b', 'u', '1', '6', 9, 0,
3662
92.4k
  /* 462 */ 'a', 'd', 'd', 'u', '1', '6', 9, 0,
3663
92.4k
  /* 470 */ 'l', 'h', 'u', '1', '6', 9, 0,
3664
92.4k
  /* 477 */ 'l', 'w', '1', '6', 9, 0,
3665
92.4k
  /* 483 */ 's', 'w', '1', '6', 9, 0,
3666
92.4k
  /* 489 */ 'b', 'n', 'e', 'z', '1', '6', 9, 0,
3667
92.4k
  /* 497 */ 'b', 'e', 'q', 'z', '1', '6', 9, 0,
3668
92.4k
  /* 505 */ 'p', 'r', 'e', 'c', 'e', 'u', '.', 'p', 'h', '.', 'q', 'b', 'l', 'a', 9, 0,
3669
92.4k
  /* 521 */ 'p', 'r', 'e', 'c', 'e', 'q', 'u', '.', 'p', 'h', '.', 'q', 'b', 'l', 'a', 9, 0,
3670
92.4k
  /* 538 */ 'p', 'r', 'e', 'c', 'e', 'u', '.', 'p', 'h', '.', 'q', 'b', 'r', 'a', 9, 0,
3671
92.4k
  /* 554 */ 'p', 'r', 'e', 'c', 'e', 'q', 'u', '.', 'p', 'h', '.', 'q', 'b', 'r', 'a', 9, 0,
3672
92.4k
  /* 571 */ 'd', 's', 'r', 'a', 9, 0,
3673
92.4k
  /* 577 */ 'd', 'l', 's', 'a', 9, 0,
3674
92.4k
  /* 583 */ 'c', 'f', 'c', 'm', 's', 'a', 9, 0,
3675
92.4k
  /* 591 */ 'c', 't', 'c', 'm', 's', 'a', 9, 0,
3676
92.4k
  /* 599 */ 'a', 'd', 'd', '_', 'a', '.', 'b', 9, 0,
3677
92.4k
  /* 608 */ 'm', 'i', 'n', '_', 'a', '.', 'b', 9, 0,
3678
92.4k
  /* 617 */ 'a', 'd', 'd', 's', '_', 'a', '.', 'b', 9, 0,
3679
92.4k
  /* 627 */ 'm', 'a', 'x', '_', 'a', '.', 'b', 9, 0,
3680
92.4k
  /* 636 */ 's', 'r', 'a', '.', 'b', 9, 0,
3681
92.4k
  /* 643 */ 'n', 'l', 'o', 'c', '.', 'b', 9, 0,
3682
92.4k
  /* 651 */ 'n', 'l', 'z', 'c', '.', 'b', 9, 0,
3683
92.4k
  /* 659 */ 's', 'l', 'd', '.', 'b', 9, 0,
3684
92.4k
  /* 666 */ 'p', 'c', 'k', 'o', 'd', '.', 'b', 9, 0,
3685
92.4k
  /* 675 */ 'i', 'l', 'v', 'o', 'd', '.', 'b', 9, 0,
3686
92.4k
  /* 684 */ 'i', 'n', 's', 'v', 'e', '.', 'b', 9, 0,
3687
92.4k
  /* 693 */ 'v', 's', 'h', 'f', '.', 'b', 9, 0,
3688
92.4k
  /* 701 */ 'b', 'n', 'e', 'g', '.', 'b', 9, 0,
3689
92.4k
  /* 709 */ 's', 'r', 'a', 'i', '.', 'b', 9, 0,
3690
92.4k
  /* 717 */ 's', 'l', 'd', 'i', '.', 'b', 9, 0,
3691
92.4k
  /* 725 */ 'a', 'n', 'd', 'i', '.', 'b', 9, 0,
3692
92.4k
  /* 733 */ 'b', 'n', 'e', 'g', 'i', '.', 'b', 9, 0,
3693
92.4k
  /* 742 */ 'b', 's', 'e', 'l', 'i', '.', 'b', 9, 0,
3694
92.4k
  /* 751 */ 's', 'l', 'l', 'i', '.', 'b', 9, 0,
3695
92.4k
  /* 759 */ 's', 'r', 'l', 'i', '.', 'b', 9, 0,
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  /* 767 */ 'b', 'i', 'n', 's', 'l', 'i', '.', 'b', 9, 0,
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  /* 777 */ 'c', 'e', 'q', 'i', '.', 'b', 9, 0,
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92.4k
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3699
92.4k
  /* 794 */ 'b', 'c', 'l', 'r', 'i', '.', 'b', 9, 0,
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3837
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3839
92.4k
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  };
4692
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4693
4694
  // Emit the opcode for the instruction.
4695
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  uint64_t Bits1 = OpInfo[MCInst_getOpcode(MI)];
4696
92.4k
  uint64_t Bits2 = OpInfo2[MCInst_getOpcode(MI)];
4697
92.4k
  uint64_t Bits = (Bits2 << 32) | Bits1;
4698
  // assert(Bits != 0 && "Cannot print this instruction.");
4699
92.4k
#ifndef CAPSTONE_DIET
4700
92.4k
  SStream_concat0(O, AsmStrs+(Bits & 16383)-1);
4701
92.4k
#endif
4702
4703
4704
  // Fragment 0 encoded into 4 bits for 11 unique commands.
4705
  //printf("Frag-0: %"PRIu64"\n", (Bits >> 14) & 15);
4706
92.4k
  switch ((Bits >> 14) & 15) {
4707
0
  default: // llvm_unreachable("Invalid command number.");
4708
629
  case 0:
4709
    // DBG_VALUE, BUNDLE, LIFETIME_START, LIFETIME_END, Break16, CONSTPOOL_EN...
4710
629
    return;
4711
0
    break;
4712
84.3k
  case 1:
4713
    // ABSQ_S_PH, ABSQ_S_QB, ABSQ_S_W, ADD, ADDIUPC, ADDIUPC_MM, ADDIUR1SP_MM...
4714
84.3k
    printOperand(MI, 0, O); 
4715
84.3k
    break;
4716
3.38k
  case 2:
4717
    // ADDIUS5_MM, CTC1, CTC1_MM, DAHI, DATI, DMTC1, MTC1, MTC1_MM, MTHI_DSP,...
4718
3.38k
    printOperand(MI, 1, O); 
4719
3.38k
    SStream_concat0(O, ", "); 
4720
3.38k
    break;
4721
528
  case 3:
4722
    // AND16_MM, MTHC1_D32, MTHC1_D64, MTHC1_MM, OR16_MM, XOR16_MM
4723
528
    printOperand(MI, 2, O); 
4724
528
    SStream_concat0(O, ", "); 
4725
528
    break;
4726
236
  case 4:
4727
    // BREAK16_MM, SDBBP16_MM
4728
236
    printUnsignedImm8(MI, 0, O); 
4729
236
    return;
4730
0
    break;
4731
771
  case 5:
4732
    // CACHE, CACHE_MM, CACHE_R6, PREF, PREF_MM, PREF_R6
4733
771
    printUnsignedImm(MI, 2, O); 
4734
771
    SStream_concat0(O, ", "); 
4735
771
    printMemOperand(MI, 0, O); 
4736
771
    return;
4737
0
    break;
4738
0
  case 6:
4739
    // FCMP_D32, FCMP_D32_MM, FCMP_D64, FCMP_S32, FCMP_S32_MM
4740
0
    printFCCOperand(MI, 2, O); 
4741
0
    break;
4742
1.87k
  case 7:
4743
    // LWM16_MM, LWM32_MM, LWM_MM, MOVEP_MM, SWM16_MM, SWM32_MM, SWM_MM
4744
1.87k
    printRegisterList(MI, 0, O); 
4745
1.87k
    SStream_concat0(O, ", "); 
4746
1.87k
    break;
4747
394
  case 8:
4748
    // LWP_MM, SWP_MM
4749
394
    printRegisterPair(MI, 0, O); 
4750
394
    SStream_concat0(O, ", "); 
4751
394
    printMemOperand(MI, 2, O); 
4752
394
    return;
4753
0
    break;
4754
203
  case 9:
4755
    // SYNCI
4756
203
    printMemOperand(MI, 0, O); 
4757
203
    return;
4758
0
    break;
4759
0
  case 10:
4760
    // SelBeqZ, SelBneZ, SelTBteqZCmp, SelTBteqZCmpi, SelTBteqZSlt, SelTBteqZ...
4761
0
    printOperand(MI, 3, O); 
4762
0
    break;
4763
92.4k
  }
4764
4765
4766
  // Fragment 1 encoded into 5 bits for 17 unique commands.
4767
  //printf("Frag-1: %"PRIu64"\n", (Bits >> 18) & 31);
4768
90.1k
  switch ((Bits >> 18) & 31) {
4769
0
  default: // llvm_unreachable("Invalid command number.");
4770
75.0k
  case 0:
4771
    // ABSQ_S_PH, ABSQ_S_QB, ABSQ_S_W, ADD, ADDIUPC, ADDIUPC_MM, ADDIUR1SP_MM...
4772
75.0k
    SStream_concat0(O, ", "); 
4773
75.0k
    break;
4774
534
  case 1:
4775
    // ADDIUS5_MM, DAHI, DATI, MOVEP_MM, MultRxRyRz16, MultuRxRyRz16, SltCCRx...
4776
534
    printOperand(MI, 2, O); 
4777
534
    break;
4778
7.31k
  case 2:
4779
    // ADDIUSP_MM, AddiuSpImmX16, B16_MM, BAL, BALC, BC, BPOSGE32, B_MM_Pseud...
4780
7.31k
    return;
4781
0
    break;
4782
211
  case 3:
4783
    // AND16_MM, OR16_MM, XOR16_MM
4784
211
    printOperand(MI, 1, O); 
4785
211
    return;
4786
0
    break;
4787
0
  case 4:
4788
    // AddiuRxPcImmX16
4789
0
    SStream_concat0(O, ", $pc, "); 
4790
0
    printOperand(MI, 1, O); 
4791
0
    return;
4792
0
    break;
4793
0
  case 5:
4794
    // AddiuSpImm16, Bimm16
4795
0
    SStream_concat0(O, " # 16 bit inst"); 
4796
0
    return;
4797
0
    break;
4798
0
  case 6:
4799
    // Bteqz16, Btnez16
4800
0
    SStream_concat0(O, "  # 16 bit inst"); 
4801
0
    return;
4802
0
    break;
4803
1.53k
  case 7:
4804
    // CTC1, CTC1_MM, DMTC1, MTC1, MTC1_MM, MTHC1_D32, MTHC1_D64, MTHC1_MM, M...
4805
1.53k
    printOperand(MI, 0, O); 
4806
1.53k
    return;
4807
0
    break;
4808
0
  case 8:
4809
    // FCMP_D32, FCMP_D32_MM, FCMP_D64
4810
0
    SStream_concat0(O, ".d\t"); 
4811
0
    printOperand(MI, 0, O); 
4812
0
    SStream_concat0(O, ", "); 
4813
0
    printOperand(MI, 1, O); 
4814
0
    return;
4815
0
    break;
4816
0
  case 9:
4817
    // FCMP_S32, FCMP_S32_MM
4818
0
    SStream_concat0(O, ".s\t"); 
4819
0
    printOperand(MI, 0, O); 
4820
0
    SStream_concat0(O, ", "); 
4821
0
    printOperand(MI, 1, O); 
4822
0
    return;
4823
0
    break;
4824
2.04k
  case 10:
4825
    // INSERT_B, INSERT_D, INSERT_H, INSERT_W, INSVE_B, INSVE_D, INSVE_H, INS...
4826
2.04k
    SStream_concat0(O, "["); 
4827
2.04k
    break;
4828
0
  case 11:
4829
    // Jal16
4830
0
    SStream_concat0(O, "\n\tnop"); 
4831
0
    return;
4832
0
    break;
4833
0
  case 12:
4834
    // JalB16
4835
0
    SStream_concat0(O, "\t# branch\n\tnop"); 
4836
0
    return;
4837
0
    break;
4838
1.61k
  case 13:
4839
    // LWM16_MM, LWM32_MM, LWM_MM, SWM16_MM, SWM32_MM, SWM_MM
4840
1.61k
    printMemOperand(MI, 1, O); 
4841
1.61k
    return;
4842
0
    break;
4843
0
  case 14:
4844
    // LwConstant32
4845
0
    SStream_concat0(O, ", 1f\n\tb\t2f\n\t.align\t2\n1: \t.word\t"); 
4846
0
    printOperand(MI, 1, O); 
4847
0
    SStream_concat0(O, "\n2:"); 
4848
0
    return;
4849
0
    break;
4850
1.89k
  case 15:
4851
    // SC, SCD, SCD_R6, SC_MM, SC_R6
4852
1.89k
    printMemOperand(MI, 2, O); 
4853
1.89k
    return;
4854
0
    break;
4855
0
  case 16:
4856
    // SelBeqZ, SelBneZ
4857
0
    SStream_concat0(O, ", .+4\n\t\n\tmove "); 
4858
0
    printOperand(MI, 1, O); 
4859
0
    SStream_concat0(O, ", "); 
4860
0
    printOperand(MI, 2, O); 
4861
0
    return;
4862
0
    break;
4863
90.1k
  }
4864
4865
4866
  // Fragment 2 encoded into 4 bits for 12 unique commands.
4867
  //printf("Frag-2: %"PRIu64"\n", (Bits >> 23) & 15);
4868
77.6k
  switch ((Bits >> 23) & 15) {
4869
0
  default: // llvm_unreachable("Invalid command number.");
4870
54.0k
  case 0:
4871
    // ABSQ_S_PH, ABSQ_S_QB, ABSQ_S_W, ADD, ADDIUPC, ADDIUPC_MM, ADDIUR1SP_MM...
4872
54.0k
    printOperand(MI, 1, O); 
4873
54.0k
    break;
4874
274
  case 1:
4875
    // ADDIUS5_MM, DAHI, DATI
4876
274
    return;
4877
0
    break;
4878
7.38k
  case 2:
4879
    // AddiuRxRxImm16, AddiuRxRxImmX16, AndRxRxRy16, BINSLI_B, BINSLI_D, BINS...
4880
7.38k
    printOperand(MI, 2, O); 
4881
7.38k
    break;
4882
0
  case 3:
4883
    // AddiuRxRyOffMemX16, LEA_ADDiu, LEA_ADDiu64, LEA_ADDiu_MM
4884
0
    printMemOperandEA(MI, 1, O); 
4885
0
    return;
4886
0
    break;
4887
1.79k
  case 4:
4888
    // BBIT0, BBIT032, BBIT1, BBIT132, LUi, LUi64, LUi_MM, LoadAddr32Imm, Loa...
4889
1.79k
    printUnsignedImm(MI, 1, O); 
4890
1.79k
    break;
4891
1.11k
  case 5:
4892
    // INSERT_B, INSERT_D, INSERT_H, INSERT_W
4893
1.11k
    printUnsignedImm(MI, 3, O); 
4894
1.11k
    SStream_concat0(O, "], "); 
4895
1.11k
    printOperand(MI, 2, O); 
4896
1.11k
    return;
4897
0
    break;
4898
930
  case 6:
4899
    // INSVE_B, INSVE_D, INSVE_H, INSVE_W
4900
930
    printUnsignedImm(MI, 2, O); 
4901
930
    SStream_concat0(O, "], "); 
4902
930
    printOperand(MI, 3, O); 
4903
930
    SStream_concat0(O, "["); 
4904
930
    printUnsignedImm(MI, 4, O); 
4905
930
    SStream_concat0(O, "]"); 
4906
930
    return;
4907
0
    break;
4908
11.7k
  case 7:
4909
    // LB, LB64, LBU16_MM, LB_MM, LBu, LBu64, LBu_MM, LD, LDC1, LDC164, LDC1_...
4910
11.7k
    printMemOperand(MI, 1, O); 
4911
11.7k
    return;
4912
0
    break;
4913
260
  case 8:
4914
    // MOVEP_MM
4915
260
    SStream_concat0(O, ", "); 
4916
260
    printOperand(MI, 3, O); 
4917
260
    return;
4918
0
    break;
4919
0
  case 9:
4920
    // MultRxRyRz16, MultuRxRyRz16
4921
0
    SStream_concat0(O, "\n\tmflo\t"); 
4922
0
    printOperand(MI, 0, O); 
4923
0
    return;
4924
0
    break;
4925
0
  case 10:
4926
    // SelTBteqZCmp, SelTBteqZCmpi, SelTBteqZSlt, SelTBteqZSlti, SelTBteqZSlt...
4927
0
    printOperand(MI, 4, O); 
4928
0
    break;
4929
0
  case 11:
4930
    // SltCCRxRy16, SltiCCRxImmX16, SltiuCCRxImmX16, SltuCCRxRy16, SltuRxRyRz...
4931
0
    SStream_concat0(O, "\n\tmove\t"); 
4932
0
    printOperand(MI, 0, O); 
4933
0
    SStream_concat0(O, ", $t8"); 
4934
0
    return;
4935
0
    break;
4936
77.6k
  }
4937
4938
4939
  // Fragment 3 encoded into 4 bits for 15 unique commands.
4940
  //printf("Frag-3: %"PRIu64"\n", (Bits >> 27) & 15);
4941
63.2k
  switch ((Bits >> 27) & 15) {
4942
0
  default: // llvm_unreachable("Invalid command number.");
4943
23.0k
  case 0:
4944
    // ABSQ_S_PH, ABSQ_S_QB, ABSQ_S_W, ADDIUPC, ADDIUPC_MM, ADDIUR1SP_MM, ALU...
4945
23.0k
    return;
4946
0
    break;
4947
33.9k
  case 1:
4948
    // ADD, ADDIUR2_MM, ADDQH_PH, ADDQH_R_PH, ADDQH_R_W, ADDQH_W, ADDQ_PH, AD...
4949
33.9k
    SStream_concat0(O, ", "); 
4950
33.9k
    break;
4951
0
  case 2:
4952
    // AddiuRxRxImm16, LwRxPcTcp16
4953
0
    SStream_concat0(O, "\t# 16 bit inst"); 
4954
0
    return;
4955
0
    break;
4956
0
  case 3:
4957
    // BeqzRxImm16, BnezRxImm16
4958
0
    SStream_concat0(O, "  # 16 bit inst"); 
4959
0
    return;
4960
0
    break;
4961
0
  case 4:
4962
    // BteqzT8CmpX16, BteqzT8CmpiX16, BteqzT8SltX16, BteqzT8SltiX16, BteqzT8S...
4963
0
    SStream_concat0(O, "\n\tbteqz\t"); 
4964
0
    printOperand(MI, 2, O); 
4965
0
    return;
4966
0
    break;
4967
0
  case 5:
4968
    // BtnezT8CmpX16, BtnezT8CmpiX16, BtnezT8SltX16, BtnezT8SltiX16, BtnezT8S...
4969
0
    SStream_concat0(O, "\n\tbtnez\t"); 
4970
0
    printOperand(MI, 2, O); 
4971
0
    return;
4972
0
    break;
4973
4.66k
  case 6:
4974
    // COPY_S_B, COPY_S_D, COPY_S_H, COPY_S_W, COPY_U_B, COPY_U_D, COPY_U_H, ...
4975
4.66k
    SStream_concat0(O, "["); 
4976
4.66k
    break;
4977
0
  case 7:
4978
    // CmpiRxImm16, LiRxImm16, SltiRxImm16, SltiuRxImm16
4979
0
    SStream_concat0(O, " \t# 16 bit inst"); 
4980
0
    return;
4981
0
    break;
4982
0
  case 8:
4983
    // DSLL64_32
4984
0
    SStream_concat0(O, ", 32"); 
4985
0
    return;
4986
0
    break;
4987
0
  case 9:
4988
    // GotPrologue16
4989
0
    SStream_concat0(O, "\n\taddiu\t"); 
4990
0
    printOperand(MI, 1, O); 
4991
0
    SStream_concat0(O, ", $pc, "); 
4992
0
    printOperand(MI, 3, O); 
4993
0
    SStream_concat0(O, "\n "); 
4994
0
    return;
4995
0
    break;
4996
1.65k
  case 10:
4997
    // LBUX, LDXC1, LDXC164, LHX, LUXC1, LUXC164, LUXC1_MM, LWX, LWXC1, LWXC1...
4998
1.65k
    SStream_concat0(O, "("); 
4999
1.65k
    printOperand(MI, 1, O); 
5000
1.65k
    SStream_concat0(O, ")"); 
5001
1.65k
    return;
5002
0
    break;
5003
0
  case 11:
5004
    // LwRxSpImmX16, SwRxSpImmX16
5005
0
    SStream_concat0(O, " ( "); 
5006
0
    printOperand(MI, 1, O); 
5007
0
    SStream_concat0(O, " ); "); 
5008
0
    return;
5009
0
    break;
5010
0
  case 12:
5011
    // SLL64_32, SLL64_64
5012
0
    SStream_concat0(O, ", 0"); 
5013
0
    return;
5014
0
    break;
5015
0
  case 13:
5016
    // SelTBteqZCmp, SelTBteqZCmpi, SelTBteqZSlt, SelTBteqZSlti, SelTBteqZSlt...
5017
0
    SStream_concat0(O, "\n\tbteqz\t.+4\n\tmove "); 
5018
0
    printOperand(MI, 1, O); 
5019
0
    SStream_concat0(O, ", "); 
5020
0
    printOperand(MI, 2, O); 
5021
0
    return;
5022
0
    break;
5023
0
  case 14:
5024
    // SelTBtneZCmp, SelTBtneZCmpi, SelTBtneZSlt, SelTBtneZSlti, SelTBtneZSlt...
5025
0
    SStream_concat0(O, "\n\tbtnez\t.+4\n\tmove "); 
5026
0
    printOperand(MI, 1, O); 
5027
0
    SStream_concat0(O, ", "); 
5028
0
    printOperand(MI, 2, O); 
5029
0
    return;
5030
0
    break;
5031
63.2k
  }
5032
5033
5034
  // Fragment 4 encoded into 3 bits for 5 unique commands.
5035
  //printf("Frag-4: %"PRIu64"\n", (Bits >> 31) & 7);
5036
38.6k
  switch ((Bits >> 31) & 7) {
5037
0
  default: // llvm_unreachable("Invalid command number.");
5038
20.3k
  case 0:
5039
    // ADD, ADDIUR2_MM, ADDQH_PH, ADDQH_R_PH, ADDQH_R_W, ADDQH_W, ADDQ_PH, AD...
5040
20.3k
    printOperand(MI, 2, O); 
5041
20.3k
    break;
5042
4.55k
  case 1:
5043
    // ADDVI_B, ADDVI_D, ADDVI_H, ADDVI_W, ANDI_B, BCLRI_B, BCLRI_D, BCLRI_H,...
5044
4.55k
    printUnsignedImm8(MI, 2, O); 
5045
4.55k
    break;
5046
8.17k
  case 2:
5047
    // ANDi, ANDi64, ANDi_MM, APPEND, BALIGN, CINS, CINS32, DEXT, DEXTM, DEXT...
5048
8.17k
    printUnsignedImm(MI, 2, O); 
5049
8.17k
    break;
5050
1.95k
  case 3:
5051
    // BINSLI_B, BINSLI_D, BINSLI_H, BINSLI_W, BINSRI_B, BINSRI_D, BINSRI_H, ...
5052
1.95k
    printUnsignedImm8(MI, 3, O); 
5053
1.95k
    break;
5054
3.58k
  case 4:
5055
    // BINSL_B, BINSL_D, BINSL_H, BINSL_W, BINSR_B, BINSR_D, BINSR_H, BINSR_W...
5056
3.58k
    printOperand(MI, 3, O); 
5057
3.58k
    break;
5058
38.6k
  }
5059
5060
5061
  // Fragment 5 encoded into 2 bits for 3 unique commands.
5062
  //printf("Frag-5: %"PRIu64"\n", (Bits >> 34) & 3);
5063
38.6k
  switch ((Bits >> 34) & 3) {
5064
0
  default: // llvm_unreachable("Invalid command number.");
5065
31.0k
  case 0:
5066
    // ADD, ADDIUR2_MM, ADDQH_PH, ADDQH_R_PH, ADDQH_R_W, ADDQH_W, ADDQ_PH, AD...
5067
31.0k
    return;
5068
0
    break;
5069
2.93k
  case 1:
5070
    // ALIGN, CINS, CINS32, DALIGN, DEXT, DEXTM, DEXTU, DINS, DINSM, DINSU, D...
5071
2.93k
    SStream_concat0(O, ", "); 
5072
2.93k
    break;
5073
4.66k
  case 2:
5074
    // COPY_S_B, COPY_S_D, COPY_S_H, COPY_S_W, COPY_U_B, COPY_U_D, COPY_U_H, ...
5075
4.66k
    SStream_concat0(O, "]"); 
5076
4.66k
    return;
5077
0
    break;
5078
38.6k
  }
5079
5080
5081
  // Fragment 6 encoded into 1 bits for 2 unique commands.
5082
  //printf("Frag-6: %"PRIu64"\n", (Bits >> 36) & 1);
5083
2.93k
  if ((Bits >> 36) & 1) {
5084
    // DEXT, DEXTM, DEXTU, DINS, DINSM, DINSU, EXT, EXT_MM, INS, INS_MM, MADD...
5085
1.94k
    printOperand(MI, 3, O); 
5086
1.94k
    return;
5087
1.94k
  } else {
5088
    // ALIGN, CINS, CINS32, DALIGN, DLSA, DLSA_R6, EXTS, EXTS32, LSA, LSA_R6
5089
993
    printUnsignedImm(MI, 3, O); 
5090
993
    return;
5091
993
  }
5092
2.93k
}
5093
5094
5095
/// getRegisterName - This method is automatically generated by tblgen
5096
/// from the register set description.  This returns the assembler name
5097
/// for the specified register.
5098
static const char *getRegisterName(unsigned RegNo)
5099
183k
{
5100
  // assert(RegNo && RegNo < 394 && "Invalid register number!");
5101
5102
183k
#ifndef CAPSTONE_DIET
5103
183k
  static const char AsmStrs[] = {
5104
183k
  /* 0 */ 'f', '1', '0', 0,
5105
183k
  /* 4 */ 'w', '1', '0', 0,
5106
183k
  /* 8 */ 'f', '2', '0', 0,
5107
183k
  /* 12 */ 'D', 'S', 'P', 'O', 'u', 't', 'F', 'l', 'a', 'g', '2', '0', 0,
5108
183k
  /* 25 */ 'w', '2', '0', 0,
5109
183k
  /* 29 */ 'f', '3', '0', 0,
5110
183k
  /* 33 */ 'w', '3', '0', 0,
5111
183k
  /* 37 */ 'a', '0', 0,
5112
183k
  /* 40 */ 'a', 'c', '0', 0,
5113
183k
  /* 44 */ 'f', 'c', 'c', '0', 0,
5114
183k
  /* 49 */ 'f', '0', 0,
5115
183k
  /* 52 */ 'k', '0', 0,
5116
183k
  /* 55 */ 'm', 'p', 'l', '0', 0,
5117
183k
  /* 60 */ 'p', '0', 0,
5118
183k
  /* 63 */ 's', '0', 0,
5119
183k
  /* 66 */ 't', '0', 0,
5120
183k
  /* 69 */ 'v', '0', 0,
5121
183k
  /* 72 */ 'w', '0', 0,
5122
183k
  /* 75 */ 'f', '1', '1', 0,
5123
183k
  /* 79 */ 'w', '1', '1', 0,
5124
183k
  /* 83 */ 'f', '2', '1', 0,
5125
183k
  /* 87 */ 'D', 'S', 'P', 'O', 'u', 't', 'F', 'l', 'a', 'g', '2', '1', 0,
5126
183k
  /* 100 */ 'w', '2', '1', 0,
5127
183k
  /* 104 */ 'f', '3', '1', 0,
5128
183k
  /* 108 */ 'w', '3', '1', 0,
5129
183k
  /* 112 */ 'a', '1', 0,
5130
183k
  /* 115 */ 'a', 'c', '1', 0,
5131
183k
  /* 119 */ 'f', 'c', 'c', '1', 0,
5132
183k
  /* 124 */ 'f', '1', 0,
5133
183k
  /* 127 */ 'k', '1', 0,
5134
183k
  /* 130 */ 'm', 'p', 'l', '1', 0,
5135
183k
  /* 135 */ 'p', '1', 0,
5136
183k
  /* 138 */ 's', '1', 0,
5137
183k
  /* 141 */ 't', '1', 0,
5138
183k
  /* 144 */ 'v', '1', 0,
5139
183k
  /* 147 */ 'w', '1', 0,
5140
183k
  /* 150 */ 'f', '1', '2', 0,
5141
183k
  /* 154 */ 'w', '1', '2', 0,
5142
183k
  /* 158 */ 'f', '2', '2', 0,
5143
183k
  /* 162 */ 'D', 'S', 'P', 'O', 'u', 't', 'F', 'l', 'a', 'g', '2', '2', 0,
5144
183k
  /* 175 */ 'w', '2', '2', 0,
5145
183k
  /* 179 */ 'a', '2', 0,
5146
183k
  /* 182 */ 'a', 'c', '2', 0,
5147
183k
  /* 186 */ 'f', 'c', 'c', '2', 0,
5148
183k
  /* 191 */ 'f', '2', 0,
5149
183k
  /* 194 */ 'm', 'p', 'l', '2', 0,
5150
183k
  /* 199 */ 'p', '2', 0,
5151
183k
  /* 202 */ 's', '2', 0,
5152
183k
  /* 205 */ 't', '2', 0,
5153
183k
  /* 208 */ 'w', '2', 0,
5154
183k
  /* 211 */ 'f', '1', '3', 0,
5155
183k
  /* 215 */ 'w', '1', '3', 0,
5156
183k
  /* 219 */ 'f', '2', '3', 0,
5157
183k
  /* 223 */ 'D', 'S', 'P', 'O', 'u', 't', 'F', 'l', 'a', 'g', '2', '3', 0,
5158
183k
  /* 236 */ 'w', '2', '3', 0,
5159
183k
  /* 240 */ 'a', '3', 0,
5160
183k
  /* 243 */ 'a', 'c', '3', 0,
5161
183k
  /* 247 */ 'f', 'c', 'c', '3', 0,
5162
183k
  /* 252 */ 'f', '3', 0,
5163
183k
  /* 255 */ 's', '3', 0,
5164
183k
  /* 258 */ 't', '3', 0,
5165
183k
  /* 261 */ 'w', '3', 0,
5166
183k
  /* 264 */ 'f', '1', '4', 0,
5167
183k
  /* 268 */ 'w', '1', '4', 0,
5168
183k
  /* 272 */ 'f', '2', '4', 0,
5169
183k
  /* 276 */ 'w', '2', '4', 0,
5170
183k
  /* 280 */ 'f', 'c', 'c', '4', 0,
5171
183k
  /* 285 */ 'f', '4', 0,
5172
183k
  /* 288 */ 's', '4', 0,
5173
183k
  /* 291 */ 't', '4', 0,
5174
183k
  /* 294 */ 'w', '4', 0,
5175
183k
  /* 297 */ 'f', '1', '5', 0,
5176
183k
  /* 301 */ 'w', '1', '5', 0,
5177
183k
  /* 305 */ 'f', '2', '5', 0,
5178
183k
  /* 309 */ 'w', '2', '5', 0,
5179
183k
  /* 313 */ 'f', 'c', 'c', '5', 0,
5180
183k
  /* 318 */ 'f', '5', 0,
5181
183k
  /* 321 */ 's', '5', 0,
5182
183k
  /* 324 */ 't', '5', 0,
5183
183k
  /* 327 */ 'w', '5', 0,
5184
183k
  /* 330 */ 'f', '1', '6', 0,
5185
183k
  /* 334 */ 'w', '1', '6', 0,
5186
183k
  /* 338 */ 'f', '2', '6', 0,
5187
183k
  /* 342 */ 'w', '2', '6', 0,
5188
183k
  /* 346 */ 'f', 'c', 'c', '6', 0,
5189
183k
  /* 351 */ 'f', '6', 0,
5190
183k
  /* 354 */ 's', '6', 0,
5191
183k
  /* 357 */ 't', '6', 0,
5192
183k
  /* 360 */ 'w', '6', 0,
5193
183k
  /* 363 */ 'f', '1', '7', 0,
5194
183k
  /* 367 */ 'w', '1', '7', 0,
5195
183k
  /* 371 */ 'f', '2', '7', 0,
5196
183k
  /* 375 */ 'w', '2', '7', 0,
5197
183k
  /* 379 */ 'f', 'c', 'c', '7', 0,
5198
183k
  /* 384 */ 'f', '7', 0,
5199
183k
  /* 387 */ 's', '7', 0,
5200
183k
  /* 390 */ 't', '7', 0,
5201
183k
  /* 393 */ 'w', '7', 0,
5202
183k
  /* 396 */ 'f', '1', '8', 0,
5203
183k
  /* 400 */ 'w', '1', '8', 0,
5204
183k
  /* 404 */ 'f', '2', '8', 0,
5205
183k
  /* 408 */ 'w', '2', '8', 0,
5206
183k
  /* 412 */ 'f', '8', 0,
5207
183k
  /* 415 */ 't', '8', 0,
5208
183k
  /* 418 */ 'w', '8', 0,
5209
183k
  /* 421 */ 'D', 'S', 'P', 'O', 'u', 't', 'F', 'l', 'a', 'g', '1', '6', '_', '1', '9', 0,
5210
183k
  /* 437 */ 'f', '1', '9', 0,
5211
183k
  /* 441 */ 'w', '1', '9', 0,
5212
183k
  /* 445 */ 'f', '2', '9', 0,
5213
183k
  /* 449 */ 'w', '2', '9', 0,
5214
183k
  /* 453 */ 'f', '9', 0,
5215
183k
  /* 456 */ 't', '9', 0,
5216
183k
  /* 459 */ 'w', '9', 0,
5217
183k
  /* 462 */ 'D', 'S', 'P', 'E', 'F', 'I', 0,
5218
183k
  /* 469 */ 'r', 'a', 0,
5219
183k
  /* 472 */ 'h', 'w', 'r', '_', 'c', 'c', 0,
5220
183k
  /* 479 */ 'p', 'c', 0,
5221
183k
  /* 482 */ 'D', 'S', 'P', 'C', 'C', 'o', 'n', 'd', 0,
5222
183k
  /* 491 */ 'D', 'S', 'P', 'O', 'u', 't', 'F', 'l', 'a', 'g', 0,
5223
183k
  /* 502 */ 'h', 'i', 0,
5224
183k
  /* 505 */ 'h', 'w', 'r', '_', 'c', 'p', 'u', 'n', 'u', 'm', 0,
5225
183k
  /* 516 */ 'l', 'o', 0,
5226
183k
  /* 519 */ 'z', 'e', 'r', 'o', 0,
5227
183k
  /* 524 */ 'h', 'w', 'r', '_', 's', 'y', 'n', 'c', 'i', '_', 's', 't', 'e', 'p', 0,
5228
183k
  /* 539 */ 'f', 'p', 0,
5229
183k
  /* 542 */ 'g', 'p', 0,
5230
183k
  /* 545 */ 's', 'p', 0,
5231
183k
  /* 548 */ 'h', 'w', 'r', '_', 'c', 'c', 'r', 'e', 's', 0,
5232
183k
  /* 558 */ 'D', 'S', 'P', 'P', 'o', 's', 0,
5233
183k
  /* 565 */ 'a', 't', 0,
5234
183k
  /* 568 */ 'D', 'S', 'P', 'S', 'C', 'o', 'u', 'n', 't', 0,
5235
183k
  /* 578 */ 'D', 'S', 'P', 'C', 'a', 'r', 'r', 'y', 0,
5236
183k
  };
5237
5238
183k
  static const uint16_t RegAsmOffset[] = {
5239
183k
    565, 482, 578, 462, 491, 558, 568, 539, 542, 152, 77, 2, 332, 266, 
5240
183k
    299, 213, 365, 479, 469, 545, 519, 37, 112, 179, 240, 40, 115, 182, 
5241
183k
    243, 565, 45, 120, 187, 248, 281, 314, 347, 380, 2, 77, 152, 213, 
5242
183k
    266, 299, 332, 365, 398, 435, 2, 77, 152, 213, 266, 299, 332, 365, 
5243
183k
    398, 435, 1, 76, 151, 212, 265, 298, 331, 364, 397, 434, 9, 84, 
5244
183k
    159, 220, 273, 306, 339, 372, 405, 446, 30, 105, 1, 76, 151, 212, 
5245
183k
    265, 298, 331, 364, 397, 434, 9, 84, 159, 220, 273, 306, 339, 372, 
5246
183k
    405, 446, 30, 105, 49, 191, 285, 351, 412, 0, 150, 264, 330, 396, 
5247
183k
    8, 158, 272, 338, 404, 29, 12, 87, 162, 223, 49, 124, 191, 252, 
5248
183k
    285, 318, 351, 384, 412, 453, 0, 75, 150, 211, 264, 297, 330, 363, 
5249
183k
    396, 437, 8, 83, 158, 219, 272, 305, 338, 371, 404, 445, 29, 104, 
5250
183k
    44, 119, 186, 247, 280, 313, 346, 379, 2, 77, 152, 213, 266, 299, 
5251
183k
    332, 365, 398, 435, 1, 76, 151, 212, 265, 298, 331, 364, 397, 434, 
5252
183k
    9, 84, 159, 220, 273, 306, 339, 372, 405, 446, 30, 105, 539, 49, 
5253
183k
    124, 191, 252, 285, 318, 351, 384, 412, 453, 0, 75, 150, 211, 264, 
5254
183k
    297, 330, 363, 396, 437, 8, 83, 158, 219, 272, 305, 338, 371, 404, 
5255
183k
    445, 29, 104, 542, 40, 115, 182, 243, 505, 524, 472, 548, 266, 299, 
5256
183k
    332, 365, 398, 435, 1, 76, 151, 212, 265, 298, 331, 364, 397, 434, 
5257
183k
    9, 84, 159, 220, 273, 306, 339, 372, 405, 446, 30, 105, 52, 127, 
5258
183k
    40, 115, 182, 243, 55, 130, 194, 60, 135, 199, 469, 63, 138, 202, 
5259
183k
    255, 288, 321, 354, 387, 545, 66, 141, 205, 258, 291, 324, 357, 390, 
5260
183k
    415, 456, 69, 144, 72, 147, 208, 261, 294, 327, 360, 393, 418, 459, 
5261
183k
    4, 79, 154, 215, 268, 301, 334, 367, 400, 441, 25, 100, 175, 236, 
5262
183k
    276, 309, 342, 375, 408, 449, 33, 108, 519, 37, 112, 179, 240, 40, 
5263
183k
    49, 124, 191, 252, 285, 318, 351, 384, 412, 453, 0, 75, 150, 211, 
5264
183k
    264, 297, 330, 363, 396, 437, 8, 83, 158, 219, 272, 305, 338, 371, 
5265
183k
    404, 445, 29, 104, 421, 502, 52, 127, 516, 63, 138, 202, 255, 288, 
5266
183k
    321, 354, 387, 66, 141, 205, 258, 291, 324, 357, 390, 415, 456, 69, 
5267
183k
    144, 
5268
183k
  };
5269
5270
  //printf("==== RegNo = %u, id = %s\n", RegNo, AsmStrs+RegAsmOffset[RegNo-1]);
5271
  //int i;
5272
  //for (i = 0; i < sizeof(RegAsmOffset)/2; i++)
5273
  //     printf("%s = %u\n", AsmStrs+RegAsmOffset[i], i + 1);
5274
  //printf("-------------------------\n");
5275
183k
  return AsmStrs+RegAsmOffset[RegNo-1];
5276
#else
5277
  return NULL;
5278
#endif
5279
183k
}
5280
5281
#ifdef PRINT_ALIAS_INSTR
5282
#undef PRINT_ALIAS_INSTR
5283
5284
static void printCustomAliasOperand(MCInst *MI, unsigned OpIdx,
5285
  unsigned PrintMethodIdx, SStream *OS)
5286
0
{
5287
0
}
5288
5289
static char *printAliasInstr(MCInst *MI, SStream *OS, void *info)
5290
103k
{
5291
103k
  #define GETREGCLASS_CONTAIN(_class, _reg) MCRegisterClass_contains(MCRegisterInfo_getRegClass(MRI, _class), MCOperand_getReg(MCInst_getOperand(MI, _reg)))
5292
103k
  const char *AsmString;
5293
103k
  char *tmp, *AsmMnem, *AsmOps, *c;
5294
103k
  int OpIdx, PrintMethodIdx;
5295
103k
  MCRegisterInfo *MRI = (MCRegisterInfo *)info;
5296
103k
  switch (MCInst_getOpcode(MI)) {
5297
83.9k
  default: return NULL;
5298
394
  case Mips_ADDu:
5299
394
    if (MCInst_getNumOperands(MI) == 3 &&
5300
394
        MCOperand_isReg(MCInst_getOperand(MI, 0)) &&
5301
394
        GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 0) &&
5302
394
        MCOperand_isReg(MCInst_getOperand(MI, 1)) &&
5303
394
        GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 1) &&
5304
394
        MCOperand_getReg(MCInst_getOperand(MI, 2)) == Mips_ZERO) {
5305
      // (ADDu GPR32Opnd:$dst, GPR32Opnd:$src, ZERO)
5306
196
      AsmString = "move $\x01, $\x02";
5307
196
      break;
5308
196
    }
5309
198
    return NULL;
5310
495
  case Mips_BC0F:
5311
495
    if (MCInst_getNumOperands(MI) == 2 &&
5312
495
        MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_CC0) {
5313
      // (BC0F CC0, brtarget:$offset)
5314
298
      AsmString = "bc0f $\x02";
5315
298
      break;
5316
298
    }
5317
197
    return NULL;
5318
351
  case Mips_BC0FL:
5319
351
    if (MCInst_getNumOperands(MI) == 2 &&
5320
351
        MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_CC0) {
5321
      // (BC0FL CC0, brtarget:$offset)
5322
69
      AsmString = "bc0fl $\x02";
5323
69
      break;
5324
69
    }
5325
282
    return NULL;
5326
526
  case Mips_BC0T:
5327
526
    if (MCInst_getNumOperands(MI) == 2 &&
5328
526
        MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_CC0) {
5329
      // (BC0T CC0, brtarget:$offset)
5330
325
      AsmString = "bc0t $\x02";
5331
325
      break;
5332
325
    }
5333
201
    return NULL;
5334
265
  case Mips_BC0TL:
5335
265
    if (MCInst_getNumOperands(MI) == 2 &&
5336
265
        MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_CC0) {
5337
      // (BC0TL CC0, brtarget:$offset)
5338
66
      AsmString = "bc0tl $\x02";
5339
66
      break;
5340
66
    }
5341
199
    return NULL;
5342
628
  case Mips_BC1F:
5343
628
    if (MCInst_getNumOperands(MI) == 2 &&
5344
628
        MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_FCC0) {
5345
      // (BC1F FCC0, brtarget:$offset)
5346
198
      AsmString = "bc1f $\x02";
5347
198
      break;
5348
198
    }
5349
430
    return NULL;
5350
395
  case Mips_BC1FL:
5351
395
    if (MCInst_getNumOperands(MI) == 2 &&
5352
395
        MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_FCC0) {
5353
      // (BC1FL FCC0, brtarget:$offset)
5354
318
      AsmString = "bc1fl $\x02";
5355
318
      break;
5356
318
    }
5357
77
    return NULL;
5358
446
  case Mips_BC1T:
5359
446
    if (MCInst_getNumOperands(MI) == 2 &&
5360
446
        MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_FCC0) {
5361
      // (BC1T FCC0, brtarget:$offset)
5362
202
      AsmString = "bc1t $\x02";
5363
202
      break;
5364
202
    }
5365
244
    return NULL;
5366
354
  case Mips_BC1TL:
5367
354
    if (MCInst_getNumOperands(MI) == 2 &&
5368
354
        MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_FCC0) {
5369
      // (BC1TL FCC0, brtarget:$offset)
5370
66
      AsmString = "bc1tl $\x02";
5371
66
      break;
5372
66
    }
5373
288
    return NULL;
5374
291
  case Mips_BC2F:
5375
291
    if (MCInst_getNumOperands(MI) == 2 &&
5376
291
        MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_CC0) {
5377
      // (BC2F CC0, brtarget:$offset)
5378
205
      AsmString = "bc2f $\x02";
5379
205
      break;
5380
205
    }
5381
86
    return NULL;
5382
443
  case Mips_BC2FL:
5383
443
    if (MCInst_getNumOperands(MI) == 2 &&
5384
443
        MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_CC0) {
5385
      // (BC2FL CC0, brtarget:$offset)
5386
241
      AsmString = "bc2fl $\x02";
5387
241
      break;
5388
241
    }
5389
202
    return NULL;
5390
390
  case Mips_BC2T:
5391
390
    if (MCInst_getNumOperands(MI) == 2 &&
5392
390
        MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_CC0) {
5393
      // (BC2T CC0, brtarget:$offset)
5394
195
      AsmString = "bc2t $\x02";
5395
195
      break;
5396
195
    }
5397
195
    return NULL;
5398
392
  case Mips_BC2TL:
5399
392
    if (MCInst_getNumOperands(MI) == 2 &&
5400
392
        MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_CC0) {
5401
      // (BC2TL CC0, brtarget:$offset)
5402
197
      AsmString = "bc2tl $\x02";
5403
197
      break;
5404
197
    }
5405
195
    return NULL;
5406
403
  case Mips_BC3F:
5407
403
    if (MCInst_getNumOperands(MI) == 2 &&
5408
403
        MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_CC0) {
5409
      // (BC3F CC0, brtarget:$offset)
5410
195
      AsmString = "bc3f $\x02";
5411
195
      break;
5412
195
    }
5413
208
    return NULL;
5414
268
  case Mips_BC3FL:
5415
268
    if (MCInst_getNumOperands(MI) == 2 &&
5416
268
        MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_CC0) {
5417
      // (BC3FL CC0, brtarget:$offset)
5418
70
      AsmString = "bc3fl $\x02";
5419
70
      break;
5420
70
    }
5421
198
    return NULL;
5422
268
  case Mips_BC3T:
5423
268
    if (MCInst_getNumOperands(MI) == 2 &&
5424
268
        MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_CC0) {
5425
      // (BC3T CC0, brtarget:$offset)
5426
66
      AsmString = "bc3t $\x02";
5427
66
      break;
5428
66
    }
5429
202
    return NULL;
5430
134
  case Mips_BC3TL:
5431
134
    if (MCInst_getNumOperands(MI) == 2 &&
5432
134
        MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_CC0) {
5433
      // (BC3TL CC0, brtarget:$offset)
5434
68
      AsmString = "bc3tl $\x02";
5435
68
      break;
5436
68
    }
5437
66
    return NULL;
5438
775
  case Mips_BREAK:
5439
775
    if (MCInst_getNumOperands(MI) == 2 &&
5440
775
        MCOperand_isImm(MCInst_getOperand(MI, 0)) &&
5441
775
        MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0 &&
5442
463
        MCOperand_isImm(MCInst_getOperand(MI, 1)) &&
5443
463
        MCOperand_getImm(MCInst_getOperand(MI, 1)) == 0) {
5444
      // (BREAK 0, 0)
5445
260
      AsmString = "break";
5446
260
      break;
5447
260
    }
5448
515
    if (MCInst_getNumOperands(MI) == 2 &&
5449
515
        MCOperand_isImm(MCInst_getOperand(MI, 1)) &&
5450
515
        MCOperand_getImm(MCInst_getOperand(MI, 1)) == 0) {
5451
      // (BREAK uimm10:$imm, 0)
5452
208
      AsmString = "break $\x01";
5453
208
      break;
5454
208
    }
5455
307
    return NULL;
5456
671
  case Mips_DADDu:
5457
671
    if (MCInst_getNumOperands(MI) == 3 &&
5458
671
        MCOperand_isReg(MCInst_getOperand(MI, 0)) &&
5459
671
        GETREGCLASS_CONTAIN(Mips_GPR64RegClassID, 0) &&
5460
671
        MCOperand_isReg(MCInst_getOperand(MI, 1)) &&
5461
671
        GETREGCLASS_CONTAIN(Mips_GPR64RegClassID, 1) &&
5462
671
        MCOperand_getReg(MCInst_getOperand(MI, 2)) == Mips_ZERO_64) {
5463
      // (DADDu GPR64Opnd:$dst, GPR64Opnd:$src, ZERO_64)
5464
241
      AsmString = "move $\x01, $\x02";
5465
241
      break;
5466
241
    }
5467
430
    return NULL;
5468
474
  case Mips_DI:
5469
474
    if (MCInst_getNumOperands(MI) == 1 &&
5470
474
        MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_ZERO) {
5471
      // (DI ZERO)
5472
277
      AsmString = "di";
5473
277
      break;
5474
277
    }
5475
197
    return NULL;
5476
393
  case Mips_EI:
5477
393
    if (MCInst_getNumOperands(MI) == 1 &&
5478
393
        MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_ZERO) {
5479
      // (EI ZERO)
5480
197
      AsmString = "ei";
5481
197
      break;
5482
197
    }
5483
196
    return NULL;
5484
1.12k
  case Mips_JALR:
5485
1.12k
    if (MCInst_getNumOperands(MI) == 2 &&
5486
1.12k
        MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_ZERO &&
5487
195
        MCOperand_isReg(MCInst_getOperand(MI, 1)) &&
5488
195
        GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 1)) {
5489
      // (JALR ZERO, GPR32Opnd:$rs)
5490
195
      AsmString = "jr $\x02";
5491
195
      break;
5492
195
    }
5493
926
    return NULL;
5494
0
  case Mips_JALR64:
5495
0
    if (MCInst_getNumOperands(MI) == 2 &&
5496
0
        MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_ZERO_64 &&
5497
0
        MCOperand_isReg(MCInst_getOperand(MI, 1)) &&
5498
0
        GETREGCLASS_CONTAIN(Mips_GPR64RegClassID, 1)) {
5499
      // (JALR64 ZERO_64, GPR64Opnd:$rs)
5500
0
      AsmString = "jr $\x02";
5501
0
      break;
5502
0
    }
5503
0
    return NULL;
5504
276
  case Mips_JALR_HB:
5505
276
    if (MCInst_getNumOperands(MI) == 2 &&
5506
276
        MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_RA &&
5507
206
        MCOperand_isReg(MCInst_getOperand(MI, 1)) &&
5508
206
        GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 1)) {
5509
      // (JALR_HB RA, GPR32Opnd:$rs)
5510
206
      AsmString = "jalr.hb $\x02";
5511
206
      break;
5512
206
    }
5513
70
    return NULL;
5514
671
  case Mips_MOVE16_MM:
5515
671
    if (MCInst_getNumOperands(MI) == 2 &&
5516
671
        MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_ZERO &&
5517
395
        MCOperand_getReg(MCInst_getOperand(MI, 1)) == Mips_ZERO) {
5518
      // (MOVE16_MM ZERO, ZERO)
5519
198
      AsmString = "nop";
5520
198
      break;
5521
198
    }
5522
473
    return NULL;
5523
422
  case Mips_SDBBP:
5524
422
    if (MCInst_getNumOperands(MI) == 1 &&
5525
422
        MCOperand_isImm(MCInst_getOperand(MI, 0)) &&
5526
422
        MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0) {
5527
      // (SDBBP 0)
5528
204
      AsmString = "sdbbp";
5529
204
      break;
5530
204
    }
5531
218
    return NULL;
5532
427
  case Mips_SDBBP_R6:
5533
427
    if (MCInst_getNumOperands(MI) == 1 &&
5534
427
        MCOperand_isImm(MCInst_getOperand(MI, 0)) &&
5535
427
        MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0) {
5536
      // (SDBBP_R6 0)
5537
195
      AsmString = "sdbbp";
5538
195
      break;
5539
195
    }
5540
232
    return NULL;
5541
2.01k
  case Mips_SLL:
5542
2.01k
    if (MCInst_getNumOperands(MI) == 3 &&
5543
2.01k
        MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_ZERO &&
5544
1.57k
        MCOperand_getReg(MCInst_getOperand(MI, 1)) == Mips_ZERO &&
5545
1.11k
        MCOperand_isImm(MCInst_getOperand(MI, 2)) &&
5546
1.11k
        MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) {
5547
      // (SLL ZERO, ZERO, 0)
5548
891
      AsmString = "nop";
5549
891
      break;
5550
891
    }
5551
1.12k
    return NULL;
5552
887
  case Mips_SLL_MM:
5553
887
    if (MCInst_getNumOperands(MI) == 3 &&
5554
887
        MCOperand_getReg(MCInst_getOperand(MI, 0)) == Mips_ZERO &&
5555
658
        MCOperand_getReg(MCInst_getOperand(MI, 1)) == Mips_ZERO &&
5556
451
        MCOperand_isImm(MCInst_getOperand(MI, 2)) &&
5557
451
        MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) {
5558
      // (SLL_MM ZERO, ZERO, 0)
5559
250
      AsmString = "nop";
5560
250
      break;
5561
250
    }
5562
637
    return NULL;
5563
439
  case Mips_SUB:
5564
439
    if (MCInst_getNumOperands(MI) == 3 &&
5565
439
        MCOperand_isReg(MCInst_getOperand(MI, 0)) &&
5566
439
        GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 0) &&
5567
439
        MCOperand_getReg(MCInst_getOperand(MI, 1)) == Mips_ZERO &&
5568
371
        MCOperand_isReg(MCInst_getOperand(MI, 2)) &&
5569
371
        GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 2)) {
5570
      // (SUB GPR32Opnd:$rt, ZERO, GPR32Opnd:$rs)
5571
371
      AsmString = "neg $\x01, $\x03";
5572
371
      break;
5573
371
    }
5574
68
    return NULL;
5575
270
  case Mips_SUBu:
5576
270
    if (MCInst_getNumOperands(MI) == 3 &&
5577
270
        MCOperand_isReg(MCInst_getOperand(MI, 0)) &&
5578
270
        GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 0) &&
5579
270
        MCOperand_getReg(MCInst_getOperand(MI, 1)) == Mips_ZERO &&
5580
196
        MCOperand_isReg(MCInst_getOperand(MI, 2)) &&
5581
196
        GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 2)) {
5582
      // (SUBu GPR32Opnd:$rt, ZERO, GPR32Opnd:$rs)
5583
196
      AsmString = "negu $\x01, $\x03";
5584
196
      break;
5585
196
    }
5586
74
    return NULL;
5587
392
  case Mips_SYNC:
5588
392
    if (MCInst_getNumOperands(MI) == 1 &&
5589
392
        MCOperand_isImm(MCInst_getOperand(MI, 0)) &&
5590
392
        MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0) {
5591
      // (SYNC 0)
5592
196
      AsmString = "sync";
5593
196
      break;
5594
196
    }
5595
196
    return NULL;
5596
436
  case Mips_SYSCALL:
5597
436
    if (MCInst_getNumOperands(MI) == 1 &&
5598
436
        MCOperand_isImm(MCInst_getOperand(MI, 0)) &&
5599
436
        MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0) {
5600
      // (SYSCALL 0)
5601
199
      AsmString = "syscall";
5602
199
      break;
5603
199
    }
5604
237
    return NULL;
5605
528
  case Mips_TEQ:
5606
528
    if (MCInst_getNumOperands(MI) == 3 &&
5607
528
        MCOperand_isReg(MCInst_getOperand(MI, 0)) &&
5608
528
        GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 0) &&
5609
528
        MCOperand_isReg(MCInst_getOperand(MI, 1)) &&
5610
528
        GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 1) &&
5611
528
        MCOperand_isImm(MCInst_getOperand(MI, 2)) &&
5612
528
        MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) {
5613
      // (TEQ GPR32Opnd:$rs, GPR32Opnd:$rt, 0)
5614
263
      AsmString = "teq $\x01, $\x02";
5615
263
      break;
5616
263
    }
5617
265
    return NULL;
5618
439
  case Mips_TGE:
5619
439
    if (MCInst_getNumOperands(MI) == 3 &&
5620
439
        MCOperand_isReg(MCInst_getOperand(MI, 0)) &&
5621
439
        GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 0) &&
5622
439
        MCOperand_isReg(MCInst_getOperand(MI, 1)) &&
5623
439
        GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 1) &&
5624
439
        MCOperand_isImm(MCInst_getOperand(MI, 2)) &&
5625
439
        MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) {
5626
      // (TGE GPR32Opnd:$rs, GPR32Opnd:$rt, 0)
5627
219
      AsmString = "tge $\x01, $\x02";
5628
219
      break;
5629
219
    }
5630
220
    return NULL;
5631
604
  case Mips_TGEU:
5632
604
    if (MCInst_getNumOperands(MI) == 3 &&
5633
604
        MCOperand_isReg(MCInst_getOperand(MI, 0)) &&
5634
604
        GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 0) &&
5635
604
        MCOperand_isReg(MCInst_getOperand(MI, 1)) &&
5636
604
        GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 1) &&
5637
604
        MCOperand_isImm(MCInst_getOperand(MI, 2)) &&
5638
604
        MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) {
5639
      // (TGEU GPR32Opnd:$rs, GPR32Opnd:$rt, 0)
5640
399
      AsmString = "tgeu $\x01, $\x02";
5641
399
      break;
5642
399
    }
5643
205
    return NULL;
5644
281
  case Mips_TLT:
5645
281
    if (MCInst_getNumOperands(MI) == 3 &&
5646
281
        MCOperand_isReg(MCInst_getOperand(MI, 0)) &&
5647
281
        GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 0) &&
5648
281
        MCOperand_isReg(MCInst_getOperand(MI, 1)) &&
5649
281
        GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 1) &&
5650
281
        MCOperand_isImm(MCInst_getOperand(MI, 2)) &&
5651
281
        MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) {
5652
      // (TLT GPR32Opnd:$rs, GPR32Opnd:$rt, 0)
5653
68
      AsmString = "tlt $\x01, $\x02";
5654
68
      break;
5655
68
    }
5656
213
    return NULL;
5657
556
  case Mips_TLTU:
5658
556
    if (MCInst_getNumOperands(MI) == 3 &&
5659
556
        MCOperand_isReg(MCInst_getOperand(MI, 0)) &&
5660
556
        GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 0) &&
5661
556
        MCOperand_isReg(MCInst_getOperand(MI, 1)) &&
5662
556
        GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 1) &&
5663
556
        MCOperand_isImm(MCInst_getOperand(MI, 2)) &&
5664
556
        MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) {
5665
      // (TLTU GPR32Opnd:$rs, GPR32Opnd:$rt, 0)
5666
201
      AsmString = "tltu $\x01, $\x02";
5667
201
      break;
5668
201
    }
5669
355
    return NULL;
5670
406
  case Mips_TNE:
5671
406
    if (MCInst_getNumOperands(MI) == 3 &&
5672
406
        MCOperand_isReg(MCInst_getOperand(MI, 0)) &&
5673
406
        GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 0) &&
5674
406
        MCOperand_isReg(MCInst_getOperand(MI, 1)) &&
5675
406
        GETREGCLASS_CONTAIN(Mips_GPR32RegClassID, 1) &&
5676
406
        MCOperand_isImm(MCInst_getOperand(MI, 2)) &&
5677
406
        MCOperand_getImm(MCInst_getOperand(MI, 2)) == 0) {
5678
      // (TNE GPR32Opnd:$rs, GPR32Opnd:$rt, 0)
5679
207
      AsmString = "tne $\x01, $\x02";
5680
207
      break;
5681
207
    }
5682
199
    return NULL;
5683
446
  case Mips_WAIT_MM:
5684
446
    if (MCInst_getNumOperands(MI) == 1 &&
5685
446
        MCOperand_isImm(MCInst_getOperand(MI, 0)) &&
5686
446
        MCOperand_getImm(MCInst_getOperand(MI, 0)) == 0) {
5687
      // (WAIT_MM 0)
5688
208
      AsmString = "wait";
5689
208
      break;
5690
208
    }
5691
238
    return NULL;
5692
103k
  }
5693
5694
8.82k
  tmp = cs_strdup(AsmString);
5695
8.82k
  AsmMnem = tmp;
5696
43.4k
  for(AsmOps = tmp; *AsmOps; AsmOps++) {
5697
40.4k
    if (*AsmOps == ' ' || *AsmOps == '\t') {
5698
5.74k
      *AsmOps = '\0';
5699
5.74k
      AsmOps++;
5700
5.74k
      break;
5701
5.74k
    }
5702
40.4k
  }
5703
8.82k
  SStream_concat0(OS, AsmMnem);
5704
8.82k
  if (*AsmOps) {
5705
5.74k
    SStream_concat0(OS, "\t");
5706
18.5k
    for (c = AsmOps; *c; c++) {
5707
12.8k
      if (*c == '$') {
5708
8.11k
        c += 1;
5709
8.11k
        if (*c == (char)0xff) {
5710
0
          c += 1;
5711
0
          OpIdx = *c - 1;
5712
0
          c += 1;
5713
0
          PrintMethodIdx = *c - 1;
5714
0
          printCustomAliasOperand(MI, OpIdx, PrintMethodIdx, OS);
5715
0
        } else
5716
8.11k
          printOperand(MI, *c - 1, OS);
5717
8.11k
      } else {
5718
4.72k
        SStream_concat(OS, "%c", *c);
5719
4.72k
      }
5720
12.8k
    }
5721
5.74k
  }
5722
8.82k
  return tmp;
5723
103k
}
5724
5725
#endif // PRINT_ALIAS_INSTR